JPS62127885A - 画像表示装置 - Google Patents
画像表示装置Info
- Publication number
- JPS62127885A JPS62127885A JP60269022A JP26902285A JPS62127885A JP S62127885 A JPS62127885 A JP S62127885A JP 60269022 A JP60269022 A JP 60269022A JP 26902285 A JP26902285 A JP 26902285A JP S62127885 A JPS62127885 A JP S62127885A
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- JP
- Japan
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- control data
- brain
- area
- screen
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は画像表示*置に関し、更に詳しくは画像信号切
替回路を改善した画像表示装置に関する。
替回路を改善した画像表示装置に関する。
(従来の技術)
この画像表示#A置は例えば0AII器等において画面
上に領域を表示して、その内外に異なるii!ii像デ
ータを表示しようとする装置である。
上に領域を表示して、その内外に異なるii!ii像デ
ータを表示しようとする装置である。
第5図(イ)、(ロ)は従来の画像表示装置の構成を示
すブロック図である。第5図(イ)に示すブロック図で
は制御回路1にROM11及び11−が使用され、第5
図(ロ)に示すブロック図では制御回路2にレジスタ2
1及び21′が使用されている。第6図は、第5図(イ
)、(ロ)の装置が画面30上に表示する画像の区分さ
れた領域を示す。第5図(イ)、(ロ)の装置では、水
平アドレス信号■及び垂直アドレス信号■のそれぞれに
よって水平方向切替部分aおよび垂直方向切替部分すの
範囲が設定され、この選定された範囲で形成される矩形
輪郭31によって画面30が2つの領域に区分される。
すブロック図である。第5図(イ)に示すブロック図で
は制御回路1にROM11及び11−が使用され、第5
図(ロ)に示すブロック図では制御回路2にレジスタ2
1及び21′が使用されている。第6図は、第5図(イ
)、(ロ)の装置が画面30上に表示する画像の区分さ
れた領域を示す。第5図(イ)、(ロ)の装置では、水
平アドレス信号■及び垂直アドレス信号■のそれぞれに
よって水平方向切替部分aおよび垂直方向切替部分すの
範囲が設定され、この選定された範囲で形成される矩形
輪郭31によって画面30が2つの領域に区分される。
画像信号■及び画像信号■めいずれか一方の画像信号は
、この区分された画面30の一方の領域に表示され、又
、他方の領域には他方の画像信号が表示される。
、この区分された画面30の一方の領域に表示され、又
、他方の領域には他方の画像信号が表示される。
(発明が解決しようとする問題点)
この区分される領域の形状は前述のように矩形に限定さ
れ、第6図(ロ)に示すような任意形、状の輪郭32で
区分して画面30上に切替表示することのできない欠点
があった。又、複数の画像を同時に表示すること、特に
複数の画像を同一画面に積重ね表示することはできなか
った。
れ、第6図(ロ)に示すような任意形、状の輪郭32で
区分して画面30上に切替表示することのできない欠点
があった。又、複数の画像を同時に表示すること、特に
複数の画像を同一画面に積重ね表示することはできなか
った。
本発明は上記の問題点に鑑みてなされたもので、その目
的は、画面上に任意形状の輪郭で切替表示し、又、複数
の画像を同一画面にv4重ね、合成することのできる画
像表示装置を実現することである。
的は、画面上に任意形状の輪郭で切替表示し、又、複数
の画像を同一画面にv4重ね、合成することのできる画
像表示装置を実現することである。
(問題点を解決するための手段)
前記の問題点を解決するための本発明は、タイミング発
生回路と、フレームバッファと、プライオリティ エン
コーダと、セレクタとから構成され、前記フレームバッ
ファは複数の制御データブレーンと複数の画像データバ
ッフ7プレーンを含み、任意に描く領域図形を前記制御
データブレーンに格納し、前記制御データプレーンを掃
引して逐次読み出して画像合成を行うことを特徴とする
ものである。
生回路と、フレームバッファと、プライオリティ エン
コーダと、セレクタとから構成され、前記フレームバッ
ファは複数の制御データブレーンと複数の画像データバ
ッフ7プレーンを含み、任意に描く領域図形を前記制御
データブレーンに格納し、前記制御データプレーンを掃
引して逐次読み出して画像合成を行うことを特徴とする
ものである。
(作用)
トラックボール又はカーソル等の手段でCPUを通じて
制御データプレーン上に領域を設定し、該制御データブ
レーンを希引してタイミング発生回路からの続出しタイ
ミング信号によって逐次プライオリティ エンコーダ(
以下エンコーダという)に領域内外の信号を送出し、定
められた擾先′順位に基づいてセレクタに画像データプ
レーン選択信号を送って所望の画像を所望の領域に且複
数の画像の積重ね表示を行う。
制御データプレーン上に領域を設定し、該制御データブ
レーンを希引してタイミング発生回路からの続出しタイ
ミング信号によって逐次プライオリティ エンコーダ(
以下エンコーダという)に領域内外の信号を送出し、定
められた擾先′順位に基づいてセレクタに画像データプ
レーン選択信号を送って所望の画像を所望の領域に且複
数の画像の積重ね表示を行う。
(実施例)
以下に図面を参照して本発明の実施例につぎ詳細に説明
する。
する。
第1図は本発明の実施例を示すブロック図である。10
1は読出しタイミング発生回路でフレームバッファ10
3への読出しタイミング信号を発生する。102はC’
PtJでその端末器として接続されているトラックボー
ル又はカーソルコントロール機能(図示せず)によって
フレームバッファ103内の制御データブレーン110
,120゜130上に図形を描かせて領域を設定させる
。103はフレームバッファで制御データブレーン11
0.120.130及び画像データプレーン150.1
60,170,180で構成されている。
1は読出しタイミング発生回路でフレームバッファ10
3への読出しタイミング信号を発生する。102はC’
PtJでその端末器として接続されているトラックボー
ル又はカーソルコントロール機能(図示せず)によって
フレームバッファ103内の制御データブレーン110
,120゜130上に図形を描かせて領域を設定させる
。103はフレームバッファで制御データブレーン11
0.120.130及び画像データプレーン150.1
60,170,180で構成されている。
104はエンコーダで、次に画像表示装置に送出すべき
画像が格納されている画像データブレーンの端子番号を
定められた優先順序に従って2進数で出力する。セレク
タ105は選択された画像データブレーンからの画像デ
ータ信号を図示しない画像表示装置に与えて画像表示さ
せる。CPU102はフレームバッファ103に対して
アドレス信号を送り画像データの書込み、j!出しを行
う。
画像が格納されている画像データブレーンの端子番号を
定められた優先順序に従って2進数で出力する。セレク
タ105は選択された画像データブレーンからの画像デ
ータ信号を図示しない画像表示装置に与えて画像表示さ
せる。CPU102はフレームバッファ103に対して
アドレス信号を送り画像データの書込み、j!出しを行
う。
以上の構成の本装置の動作を説明する。先ずCPU10
2の端末器であるトラックボール又はカーソルによりフ
レームバッファ103内の制御データブレーン110,
120,130上に図形111.121.131 (第
4図参照)が描かれる。
2の端末器であるトラックボール又はカーソルによりフ
レームバッファ103内の制御データブレーン110,
120,130上に図形111.121.131 (第
4図参照)が描かれる。
この図形は画像表示装置により画面上に重畳されて表示
され、オペレータが領域を設定する手段とする。次いで
CPU102は図形111,121゜131で囲まれた
領域内を外部とは異なるデータで埋めつくす。例えば外
部をl Q 11、内部を1″とする。その後図形11
1,121,131を消して画像表示装置の上では何も
見えなくするが、制御データブレーン110,120,
130上で図形111,121,131で囲まれたデー
タ域を生成する。第2図にフレームバッファ103の構
成を示寸。フレームバッファ103は前部に制御データ
ブレーン、後部に画像データブレーンを配置しである。
され、オペレータが領域を設定する手段とする。次いで
CPU102は図形111,121゜131で囲まれた
領域内を外部とは異なるデータで埋めつくす。例えば外
部をl Q 11、内部を1″とする。その後図形11
1,121,131を消して画像表示装置の上では何も
見えなくするが、制御データブレーン110,120,
130上で図形111,121,131で囲まれたデー
タ域を生成する。第2図にフレームバッファ103の構
成を示寸。フレームバッファ103は前部に制御データ
ブレーン、後部に画像データブレーンを配置しである。
この一番手前の制御データブレーン110には図形11
1が格納されていて、その内部は1″で埋め尽くされて
いる。図のように左から右へ矢印の様に掃引し、図形1
11を通過したときは″゛11パ号が出力される。図形
111の領域外の場合はO″を出力する。制御データブ
レーン120では第4図の図形121の内部を通過した
とき°“1″を、その外部のときは“O″を出力する。
1が格納されていて、その内部は1″で埋め尽くされて
いる。図のように左から右へ矢印の様に掃引し、図形1
11を通過したときは″゛11パ号が出力される。図形
111の領域外の場合はO″を出力する。制御データブ
レーン120では第4図の図形121の内部を通過した
とき°“1″を、その外部のときは“O″を出力する。
制御データブレーン130も同様にしてl Q II、
“1″の信号を出力づる。このような回路において画面
の表示動作を行うと、制御データブレーン110,12
0.130のすべてのデータが″OIIの司会はエンコ
ーダ104の端子がなく、エンコーダ出力端子A、Bは
共に110 IIでセレクタ105で入力が“O11な
のでOOa子に入っている画像データブレーン150が
選択される。エンコーダ104では入力端子の数字に基
づいて[3,A端子が2進数字の出力を出すようになっ
ており、セレクタ105ではこのB、Aの2進数字に基
づいて出力端子0,1.2.3の何れかが選択され、そ
れにつながった画像データブレーン150,160,1
70,180の画像データが画像表示装置へ送出される
。フレームバッファ103の掃引が進/Vで例えば制御
データブレーン110の出力が゛1″になると、エンコ
ーダ104の入力端子3につながっているのでB、Aは
“’ 11 ”となってセレクタ105では2進数字“
11°′に基づいて入力端子3が選択されて画像データ
ブレーン180が選ばれる。更に制御データブレーン1
20と130の出力が同時にJJ I Tlとなったと
きは、エンコーダ104のプライオリティill il
lにより、制御データブレーン120が優先的に選ばれ
、B、Δは’10”となり、セレクタ105では゛2″
を選択して画像データブレーン170の画像データが送
出される。この画像表示装置への読出しはタイミング発
生回路101からの続出しタイミングパルスによって行
われる。
“1″の信号を出力づる。このような回路において画面
の表示動作を行うと、制御データブレーン110,12
0.130のすべてのデータが″OIIの司会はエンコ
ーダ104の端子がなく、エンコーダ出力端子A、Bは
共に110 IIでセレクタ105で入力が“O11な
のでOOa子に入っている画像データブレーン150が
選択される。エンコーダ104では入力端子の数字に基
づいて[3,A端子が2進数字の出力を出すようになっ
ており、セレクタ105ではこのB、Aの2進数字に基
づいて出力端子0,1.2.3の何れかが選択され、そ
れにつながった画像データブレーン150,160,1
70,180の画像データが画像表示装置へ送出される
。フレームバッファ103の掃引が進/Vで例えば制御
データブレーン110の出力が゛1″になると、エンコ
ーダ104の入力端子3につながっているのでB、Aは
“’ 11 ”となってセレクタ105では2進数字“
11°′に基づいて入力端子3が選択されて画像データ
ブレーン180が選ばれる。更に制御データブレーン1
20と130の出力が同時にJJ I Tlとなったと
きは、エンコーダ104のプライオリティill il
lにより、制御データブレーン120が優先的に選ばれ
、B、Δは’10”となり、セレクタ105では゛2″
を選択して画像データブレーン170の画像データが送
出される。この画像表示装置への読出しはタイミング発
生回路101からの続出しタイミングパルスによって行
われる。
この関係を第3図に示し、第3図の読出しタイミングパ
ルスと各波形の関係について説明する。8時点において
制御データブレーン110,120゜130の何れもO
°′なのでエンフーダ出力は11 Q II、従ってセ
レクタ105はli!i像データブレーン150を選択
して1ifi像151(領域外部で画像はない)が画面
に表われる。b時点では制御データブレーン130の出
力が“1″になってエンコーダの1#子に信号が入り、
B、At、t″01″となってセレクタ105の1端子
が選ばれ、画像161が表示される。C時点では制御デ
ータブレーン120と130の出力が1°′になるが1
20が優先となってエンコーダの104の2端子に入力
が入ってB、Aは“10″となりセレクタ105の2端
子が選ばれ、画像171が表示される。
ルスと各波形の関係について説明する。8時点において
制御データブレーン110,120゜130の何れもO
°′なのでエンフーダ出力は11 Q II、従ってセ
レクタ105はli!i像データブレーン150を選択
して1ifi像151(領域外部で画像はない)が画面
に表われる。b時点では制御データブレーン130の出
力が“1″になってエンコーダの1#子に信号が入り、
B、At、t″01″となってセレクタ105の1端子
が選ばれ、画像161が表示される。C時点では制御デ
ータブレーン120と130の出力が1°′になるが1
20が優先となってエンコーダの104の2端子に入力
が入ってB、Aは“10″となりセレクタ105の2端
子が選ばれ、画像171が表示される。
この時は画像が重なっているときで画像171が画像1
61の上にある。同様にしてe時点でぽ制御データブレ
ーン110,120.130すべてが“1゛°となって
プライオリティの高い110が選ばれて図形181が表
示される。この第3図のタイミングチャートは第2図に
示寸制御データブレーンの掃引の1ラインのみを表した
もので、これを1画面の掃引数だけ行って1画面が完成
する。
61の上にある。同様にしてe時点でぽ制御データブレ
ーン110,120.130すべてが“1゛°となって
プライオリティの高い110が選ばれて図形181が表
示される。この第3図のタイミングチャートは第2図に
示寸制御データブレーンの掃引の1ラインのみを表した
もので、これを1画面の掃引数だけ行って1画面が完成
する。
この画面の状態を第4図に示1°。図において31は画
像表示装置を見ながらカーソル等で描いてCPUを通し
て制御データブレーン110上に描いた画像で111の
領域を表示しである。これはやがて111の中は“1″
で埋められて輪郭は消されるものである。32は画像デ
ータブレーン180の上の画像で++ A ++が記さ
れている。点線の円は制御データブレーン110上に描
かれた領域を示したもので画mAはこの円内にある部分
だけが表示される。画面33,34.35.36は何れ
も同様である。画面37は制御データブレーン110.
120.130の全面を掃引して画面を完成した画像表
示装置に表われた表示画面である。
像表示装置を見ながらカーソル等で描いてCPUを通し
て制御データブレーン110上に描いた画像で111の
領域を表示しである。これはやがて111の中は“1″
で埋められて輪郭は消されるものである。32は画像デ
ータブレーン180の上の画像で++ A ++が記さ
れている。点線の円は制御データブレーン110上に描
かれた領域を示したもので画mAはこの円内にある部分
だけが表示される。画面33,34.35.36は何れ
も同様である。画面37は制御データブレーン110.
120.130の全面を掃引して画面を完成した画像表
示装置に表われた表示画面である。
これによって明らかなように画@161が一番下にあり
、次いで171、−11に181があって重ねられてい
る。これは既述のように優先順位に従って表示されたか
らである。
、次いで171、−11に181があって重ねられてい
る。これは既述のように優先順位に従って表示されたか
らである。
以上の構造及び動作で明らかなように画面上をトラック
ボール又はカーソルで任意に描くことができるので任意
形状輪郭を描くことができ、更に複数の画面を重畳し、
合成することが可能になった。
ボール又はカーソルで任意に描くことができるので任意
形状輪郭を描くことができ、更に複数の画面を重畳し、
合成することが可能になった。
この実施例では各制御データブレーン上の図形は各1個
の例を示したが、各々のブレーン内で図形が重ならない
限り複数個の図形が存在しても良い。
の例を示したが、各々のブレーン内で図形が重ならない
限り複数個の図形が存在しても良い。
又、各ブレーンの優先度は必要に応じて変更できるよう
にブOグラムすることは可能である。
にブOグラムすることは可能である。
更にこの実施例では図形内部の領域を示ずためにCPL
Jにより図形内部を1″で埋めつくしたが、簡単な矩形
のような図形の場合は輪郭に来たときフリップフロップ
を働かせる等ハードウェアで同等の機能を実現すること
もできる。
Jにより図形内部を1″で埋めつくしたが、簡単な矩形
のような図形の場合は輪郭に来たときフリップフロップ
を働かせる等ハードウェアで同等の機能を実現すること
もできる。
(発明の効果)
以上詳細に説明したように本発明によれば、部分画像の
切替情報を書込み、読出しのできるメモリであるυ1l
llデータブレーンにトラックボール又はカーソル等で
オペレータが任意に描いて記録することができるため、
任意の形状の画像を描き、又、切替えることが可能であ
る。又、複数の制御データプレーンと優先処理回路の組
合せで互いに1なるに4域でも紙を載せるように積重ね
合成ができる。
切替情報を書込み、読出しのできるメモリであるυ1l
llデータブレーンにトラックボール又はカーソル等で
オペレータが任意に描いて記録することができるため、
任意の形状の画像を描き、又、切替えることが可能であ
る。又、複数の制御データプレーンと優先処理回路の組
合せで互いに1なるに4域でも紙を載せるように積重ね
合成ができる。
第1図は本発明の実施例の構成を示すブロック図、第2
図はフレームバッファの構成及び制御データブレーンの
掃引状況の説明図、第3図は11i1%引のタイミング
チャート、第4図はフレームバッファ上の像と表示両面
の図、m5図(イ) (ロ)は従来装置の構成を示すブ
ロック図、第6図は切替領域を示す図で、(イ)は従来
例@置で実現できる領域を示す説明図、(ロ)は任意形
状の領域を示す説明図である。 1.2・・・制御回路 3・・・V)■回路 11.11−・・・ROM 12.23・・・アンド回路 2.1.21−・・・レジスタ 22.22−・・・比較器 30・・・画面 31.32・・・領域を区分する輪郭 101・・・タイミング発生1!lit路102・・・
CPU 103・・・フレームバッファ 104・・・プライオリティ エンコーダ105・・・
セレクタ 110.120,130・・・制御データブレーン11
1.121,131・・・領域を区分する輪郭160.
170.180−・・画像データプレーン161.17
1.181・・・画像 特許出願人 横同メディカルシスデム株式会社第5図 (イ) 第6 図 (ロ)
図はフレームバッファの構成及び制御データブレーンの
掃引状況の説明図、第3図は11i1%引のタイミング
チャート、第4図はフレームバッファ上の像と表示両面
の図、m5図(イ) (ロ)は従来装置の構成を示すブ
ロック図、第6図は切替領域を示す図で、(イ)は従来
例@置で実現できる領域を示す説明図、(ロ)は任意形
状の領域を示す説明図である。 1.2・・・制御回路 3・・・V)■回路 11.11−・・・ROM 12.23・・・アンド回路 2.1.21−・・・レジスタ 22.22−・・・比較器 30・・・画面 31.32・・・領域を区分する輪郭 101・・・タイミング発生1!lit路102・・・
CPU 103・・・フレームバッファ 104・・・プライオリティ エンコーダ105・・・
セレクタ 110.120,130・・・制御データブレーン11
1.121,131・・・領域を区分する輪郭160.
170.180−・・画像データプレーン161.17
1.181・・・画像 特許出願人 横同メディカルシスデム株式会社第5図 (イ) 第6 図 (ロ)
Claims (1)
- タイミング発生回路と、フレームバッファと、プライオ
リティエンコーダと、セレクタとから構成され、前記フ
レームバッファは複数の制御データブレーンと複数の画
像データバッファブレーンを含み、任意に描く領域図形
を前記制御データブレーンに格納し、前記制御データブ
レーンを掃引して逐次読み出して画像合成を行うことを
特徴とする画像表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60269022A JPS62127885A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60269022A JPS62127885A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62127885A true JPS62127885A (ja) | 1987-06-10 |
Family
ID=17466583
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60269022A Pending JPS62127885A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62127885A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01109482A (ja) * | 1987-10-22 | 1989-04-26 | Iizeru:Kk | 映像処理システム |
JPH06175646A (ja) * | 1992-09-11 | 1994-06-24 | Internatl Business Mach Corp <Ibm> | グラフィックス・システム用フレーム・バッファおよびラスタ・プロセッサならびにピクセル変数のバッファリング方法 |
JP2006317636A (ja) * | 2005-05-11 | 2006-11-24 | Sony Corp | 画像処理装置および方法、記録媒体、並びに、プログラム |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59222888A (ja) * | 1983-06-01 | 1984-12-14 | 三菱電機株式会社 | 映像表示装置 |
JPS60176093A (ja) * | 1984-02-23 | 1985-09-10 | 富士ゼロックス株式会社 | 画像表示装置 |
-
1985
- 1985-11-29 JP JP60269022A patent/JPS62127885A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59222888A (ja) * | 1983-06-01 | 1984-12-14 | 三菱電機株式会社 | 映像表示装置 |
JPS60176093A (ja) * | 1984-02-23 | 1985-09-10 | 富士ゼロックス株式会社 | 画像表示装置 |
Cited By (3)
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---|---|---|---|---|
JPH01109482A (ja) * | 1987-10-22 | 1989-04-26 | Iizeru:Kk | 映像処理システム |
JPH06175646A (ja) * | 1992-09-11 | 1994-06-24 | Internatl Business Mach Corp <Ibm> | グラフィックス・システム用フレーム・バッファおよびラスタ・プロセッサならびにピクセル変数のバッファリング方法 |
JP2006317636A (ja) * | 2005-05-11 | 2006-11-24 | Sony Corp | 画像処理装置および方法、記録媒体、並びに、プログラム |
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