JPS6255301B2 - - Google Patents
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Description
【発明の詳細な説明】
本発明は半導体装置、特にメモリー機能を有す
回路が構成された半導体ペレツト(半導体素子)
を封止して成る半導体装置に関する。
回路が構成された半導体ペレツト(半導体素子)
を封止して成る半導体装置に関する。
一般に、半導体ペレツトはセラミツク、ガラス
あるいはプラスチツク(樹脂)から成る封止体
(パツケージ)により封止される。
あるいはプラスチツク(樹脂)から成る封止体
(パツケージ)により封止される。
ところで、メモリー機能を有する回路、例えば
CCD(Charge Coupled Device)メモリー回
路、IMOS(Metal―Oxide―Semiconductor)ダ
イナミツクメモリー回路あるいはスタテイツクメ
モリー回路等を構成する半導体ペレツトをかかる
パツケージにより封止した場合、これらのパツケ
ージの影響によりメモリーの誤動作が生じるとい
う問題が知られている。すなわち、パツケージか
らα粒子を放出し、このα粒子によつてメモリー
回路が誤動作してしまうのである。
CCD(Charge Coupled Device)メモリー回
路、IMOS(Metal―Oxide―Semiconductor)ダ
イナミツクメモリー回路あるいはスタテイツクメ
モリー回路等を構成する半導体ペレツトをかかる
パツケージにより封止した場合、これらのパツケ
ージの影響によりメモリーの誤動作が生じるとい
う問題が知られている。すなわち、パツケージか
らα粒子を放出し、このα粒子によつてメモリー
回路が誤動作してしまうのである。
このようなα粒子によるメモリー回路の誤動作
防止を計るために半導体ペレツト表面にポリイミ
ド系樹脂等の低α粒子発生源の少くない有機物質
膜を被覆しておくことが本願出願人により特願昭
53−142375号あるいは特願昭54−35480号として
提案されている。
防止を計るために半導体ペレツト表面にポリイミ
ド系樹脂等の低α粒子発生源の少くない有機物質
膜を被覆しておくことが本願出願人により特願昭
53−142375号あるいは特願昭54−35480号として
提案されている。
しかしながら、かかる処理が施された半導体装
置において、以下のような問題があることが本願
発明者等によつて明らかとされた。
置において、以下のような問題があることが本願
発明者等によつて明らかとされた。
すなわち、半導体ペレツトを封止する際の封止
温度によつてその有機物質膜が分解し、水分ある
いはCO2のようなガスを発生する。特にこの水分
により半導体ペレツト上に形成された低抵抗で安
価に形成できるアルミニウム配線層が侵蝕される
問題がある。ポリイミド系樹脂から成る有機物質
膜の耐熱温度は約380℃程度である。したがつ
て、特に380℃以上の温度で封止を行う場合には
その有機物質膜が分解し、問題となる。
温度によつてその有機物質膜が分解し、水分ある
いはCO2のようなガスを発生する。特にこの水分
により半導体ペレツト上に形成された低抵抗で安
価に形成できるアルミニウム配線層が侵蝕される
問題がある。ポリイミド系樹脂から成る有機物質
膜の耐熱温度は約380℃程度である。したがつ
て、特に380℃以上の温度で封止を行う場合には
その有機物質膜が分解し、問題となる。
したがつて、380℃以下の封止温度により半導
体ペレツトを封止する方法が考えられた。
体ペレツトを封止する方法が考えられた。
具体的にはAu―Sn共晶合金ろう材による封止
もしくはシームウエルド封止法である。
もしくはシームウエルド封止法である。
しかし、これら封止法を採用するためには封止
部分に金属材を用いたパツケージ構造であること
が必要であり、具体的にはセラミツクパツケージ
部材表面に金属材を結合した積層型セラミツクパ
ツケージが必要とされる。
部分に金属材を用いたパツケージ構造であること
が必要であり、具体的にはセラミツクパツケージ
部材表面に金属材を結合した積層型セラミツクパ
ツケージが必要とされる。
かかる積層型セラミツクパツケージにおいて
は、(1)パツケージ材の費用が他のパツケージのそ
れに比べて1桁も高い、(2)パツケージに半導体ペ
レツトを組込む加工費が高い等の問題がある。
は、(1)パツケージ材の費用が他のパツケージのそ
れに比べて1桁も高い、(2)パツケージに半導体ペ
レツトを組込む加工費が高い等の問題がある。
一方、パツケージの低コスト化の手法の一つと
して低融点ガラス(PbO:60重量%以上)によつ
て封止した構造を使用する方法がある。この場合
は、例えば前記した積層型セラミツクパツケージ
において使用されるAu―Snの代りにコストの安
いガラスを使用している。しかも、パツケージ封
止部のメタライズも不要である。それゆえ、大幅
なコスト低減が可能である。
して低融点ガラス(PbO:60重量%以上)によつ
て封止した構造を使用する方法がある。この場合
は、例えば前記した積層型セラミツクパツケージ
において使用されるAu―Snの代りにコストの安
いガラスを使用している。しかも、パツケージ封
止部のメタライズも不要である。それゆえ、大幅
なコスト低減が可能である。
しかし、このガラスは約400〜450℃の加熱で溶
融するものである。それゆえ、封止温度は410℃
〜460℃となる。
融するものである。それゆえ、封止温度は410℃
〜460℃となる。
したがつて、低コスト化を計ることができるに
もかかわらず有機物質膜の分解によるアルミニウ
ム配線層の腐蝕による素子特性の劣化を生ずるお
それがある。
もかかわらず有機物質膜の分解によるアルミニウ
ム配線層の腐蝕による素子特性の劣化を生ずるお
それがある。
本発明は上記した問題点を解決するために成さ
れたものである。
れたものである。
すなわち、本発明の目的とするところはメモリ
ー機能回路を構成する半導体ペレツトに適した封
止構造を有する半導体装置を提供することにあ
る。
ー機能回路を構成する半導体ペレツトに適した封
止構造を有する半導体装置を提供することにあ
る。
本発明の他の目的はメモリー機能回路を構成す
る半導体ペレツトに適し、かつ安価な封止構造を
有する半導体装置を提供することにある。
る半導体ペレツトに適し、かつ安価な封止構造を
有する半導体装置を提供することにある。
上記目的を達成するための本発明の要旨は、複
数のセラミツク体をガラスにより固着して成るセ
ラミツクパツケージ内の半導体ペレツトが存在す
る半導体装置において、上記半導体ペレツト内に
はメモリー機能を有する回路が構成され、上記半
導体ペレツト表面には有機物質膜が被覆され、さ
らに、上記ガラスを加熱して封止する際に上記有
機物質膜から発生するガスを吸収するためのゲツ
ター剤が上記絶縁性パツケージ内に設けられてな
ることを特徴とする半導体装置にある。
数のセラミツク体をガラスにより固着して成るセ
ラミツクパツケージ内の半導体ペレツトが存在す
る半導体装置において、上記半導体ペレツト内に
はメモリー機能を有する回路が構成され、上記半
導体ペレツト表面には有機物質膜が被覆され、さ
らに、上記ガラスを加熱して封止する際に上記有
機物質膜から発生するガスを吸収するためのゲツ
ター剤が上記絶縁性パツケージ内に設けられてな
ることを特徴とする半導体装置にある。
以下、本発明の具体的実施例を図面を用いて説
明する。
明する。
第1図は本発明による半導体装置の一実施例の
断面図を示すものである。同図において、1は
CCDメモリー回路、1MOSダイナミツクメモリー
回路あるいはスタテイツクメモリー回路等を構成
する半導体チツプである。具体的には64Kビツト
1MOSダイナミツクRAM(Random Access
Memory)を構成する半導体ペレツトである。こ
の半導体ペレツト1はセラミツク(Al2O3:90重
量%以上)パツケージの下部部材(ベース)2に
固着されている。そして、セラミツクパツケージ
の上部部材(キヤツプ)3がPbO―B2O3系
(PbO:60重量%以上)の低融点ガラス4により
ベース2に固着され、半導体ペレツト1を気密封
止している。5は低α粒子発生材料であるポリイ
ミド系の有機物質膜、例えば、ポリイミド樹脂膜
あるいはポリイミド・イソインドロ・キナゾリン
ジオン樹脂膜である。この有機物質膜5の厚さは
10μm以上あればよい。すなわち、キヤツプ3か
ら照射したα粒子が半導体ペレツト(Si)1の表
面まで到達しない程度の膜厚を有していればよ
い。封止後の好ましい有機物質膜5の厚さとして
は60μm〜100μmである。6はゲツター剤であ
る。例えばアルミナ系ゲル(デシカウントPD―
08:オーエンスイリノイ社商品名)、アルミナシ
リケート系ゲル、シリカ系ゲルあるいはバイコー
ルガラス(コーニング社商品名)を焼成したもの
が用いられる。このゲツター剤はH2O、CO2、O2
あるいはN2等の分子径に近い穴を有する粉末状
となつている。ここでは特に有害となるH2Oを吸
収するために上述したようなゲツター剤が選択さ
れる。
断面図を示すものである。同図において、1は
CCDメモリー回路、1MOSダイナミツクメモリー
回路あるいはスタテイツクメモリー回路等を構成
する半導体チツプである。具体的には64Kビツト
1MOSダイナミツクRAM(Random Access
Memory)を構成する半導体ペレツトである。こ
の半導体ペレツト1はセラミツク(Al2O3:90重
量%以上)パツケージの下部部材(ベース)2に
固着されている。そして、セラミツクパツケージ
の上部部材(キヤツプ)3がPbO―B2O3系
(PbO:60重量%以上)の低融点ガラス4により
ベース2に固着され、半導体ペレツト1を気密封
止している。5は低α粒子発生材料であるポリイ
ミド系の有機物質膜、例えば、ポリイミド樹脂膜
あるいはポリイミド・イソインドロ・キナゾリン
ジオン樹脂膜である。この有機物質膜5の厚さは
10μm以上あればよい。すなわち、キヤツプ3か
ら照射したα粒子が半導体ペレツト(Si)1の表
面まで到達しない程度の膜厚を有していればよ
い。封止後の好ましい有機物質膜5の厚さとして
は60μm〜100μmである。6はゲツター剤であ
る。例えばアルミナ系ゲル(デシカウントPD―
08:オーエンスイリノイ社商品名)、アルミナシ
リケート系ゲル、シリカ系ゲルあるいはバイコー
ルガラス(コーニング社商品名)を焼成したもの
が用いられる。このゲツター剤はH2O、CO2、O2
あるいはN2等の分子径に近い穴を有する粉末状
となつている。ここでは特に有害となるH2Oを吸
収するために上述したようなゲツター剤が選択さ
れる。
7はリード部材であつて、リードフレームの状
態でパツケージに組立てられ、低融点ガラス4に
より包囲されその内端がパツケージ内部に外端が
パツケージ外部に導出された状態で封止される。
リードフレームは封止後、個々のリードとなるよ
う外端部分で切り離される。8は半導体素子の各
電極とリードとの間でボンデイングされた金等の
ワイヤである。なお、上述した半導体装置は第2
図に示された斜面図の如く形成される。
態でパツケージに組立てられ、低融点ガラス4に
より包囲されその内端がパツケージ内部に外端が
パツケージ外部に導出された状態で封止される。
リードフレームは封止後、個々のリードとなるよ
う外端部分で切り離される。8は半導体素子の各
電極とリードとの間でボンデイングされた金等の
ワイヤである。なお、上述した半導体装置は第2
図に示された斜面図の如く形成される。
上記した実施例の構造によれば下記の理由で前
記発明が達成できる。
記発明が達成できる。
上述した如く、リードフレームをセラミツクベ
ース及びセラミツクキヤツプからなる上下2体の
パツケージ部材でサンドイツチ状に挾み低融点ガ
ラスで封止して成る半導体装置は、Au―Sn共晶
合金ろう材を使用せず、また、何枚セラミツク板
を積層したベースを使用しないため極めて安価に
得られる。
ース及びセラミツクキヤツプからなる上下2体の
パツケージ部材でサンドイツチ状に挾み低融点ガ
ラスで封止して成る半導体装置は、Au―Sn共晶
合金ろう材を使用せず、また、何枚セラミツク板
を積層したベースを使用しないため極めて安価に
得られる。
さらに、本発明によれば有機物質膜が存在して
いるためガラスの封止温度が問題となるわけであ
るが、以下の理由によりアルミニウムから成るボ
ンデイングパツドあるいは配線層の腐蝕は生じな
い。すなわち、パツケージの封止に使用した低融
点ガラスは最も低い封止温度を持つもので410℃
である。好ましくは450℃で溶融される低融点ガ
ラスが使用される。この低融点ガラスを再溶融さ
せて封止作業を完成するためには410〜460℃10分
間程度の加熱が必要となる。このときα粒子の遮
断のため半導体ペレツト上に被覆された前記有機
物質膜が分解反応し、ガスを発生する。実験によ
れば、第3図に示す如く前記有機物質膜の一つで
あるポリイミド・イソインドロ・キナゾリンジオ
ン樹脂は400℃以上でガスの放出量が急激に増加
する。
いるためガラスの封止温度が問題となるわけであ
るが、以下の理由によりアルミニウムから成るボ
ンデイングパツドあるいは配線層の腐蝕は生じな
い。すなわち、パツケージの封止に使用した低融
点ガラスは最も低い封止温度を持つもので410℃
である。好ましくは450℃で溶融される低融点ガ
ラスが使用される。この低融点ガラスを再溶融さ
せて封止作業を完成するためには410〜460℃10分
間程度の加熱が必要となる。このときα粒子の遮
断のため半導体ペレツト上に被覆された前記有機
物質膜が分解反応し、ガスを発生する。実験によ
れば、第3図に示す如く前記有機物質膜の一つで
あるポリイミド・イソインドロ・キナゾリンジオ
ン樹脂は400℃以上でガスの放出量が急激に増加
する。
しかしながら、本発明によれば、ゲツター剤が
パツケージ内に存在していることによりそのゲツ
ター剤がない場合に比べてパツケージの空間内に
存在する水蒸気(H2O)の量は大幅に減少する。
すなわち、ゲツター剤がない場合にはパツケージ
の空間内に存在する水蒸気の量は約3000〜
8000ppm位である。しかし、本発明の前記実施
例のように上述したようなゲツター剤(例えば、
デシカウント:PD―08(オーエンスイリノイ社
商品名)はその重量の18重量%の水蒸気を吸着す
る。)が存在していることにより内部の水蒸気量
は約500ppm以下になる。したがつて、本発明に
よれば米国軍用規格(500ppm以下)を満足する
高信頼性の半導体装置が得られる。
パツケージ内に存在していることによりそのゲツ
ター剤がない場合に比べてパツケージの空間内に
存在する水蒸気(H2O)の量は大幅に減少する。
すなわち、ゲツター剤がない場合にはパツケージ
の空間内に存在する水蒸気の量は約3000〜
8000ppm位である。しかし、本発明の前記実施
例のように上述したようなゲツター剤(例えば、
デシカウント:PD―08(オーエンスイリノイ社
商品名)はその重量の18重量%の水蒸気を吸着す
る。)が存在していることにより内部の水蒸気量
は約500ppm以下になる。したがつて、本発明に
よれば米国軍用規格(500ppm以下)を満足する
高信頼性の半導体装置が得られる。
本発明は前記実施例に限定されず、基本的には
低融点ガラスにより気密封止するパツケージ方式
であること、絶縁性パツケージからのα粒子によ
る半導体ペレツト内に構成されたメモリー回路の
誤動作を防止するために有機物質膜を半導体ペレ
ツト上に被覆していること及びパツケージの内部
にゲツター剤を取付けることが満足すれば本発明
の第1の目的が達成される。
低融点ガラスにより気密封止するパツケージ方式
であること、絶縁性パツケージからのα粒子によ
る半導体ペレツト内に構成されたメモリー回路の
誤動作を防止するために有機物質膜を半導体ペレ
ツト上に被覆していること及びパツケージの内部
にゲツター剤を取付けることが満足すれば本発明
の第1の目的が達成される。
したがつて、上記構成要件がが満足していれば
以下のような変形例も考えられる。
以下のような変形例も考えられる。
(1) 第4図に示す如くベース2として積層セラミ
ツク板を使用した半導体装置であつてもよい。
図において、1はメモリー回路を構成する半導
体ペレツトであり、その表面に前記実施例のよ
うな有機物質膜5が被覆されている。2は半導
体ペレツト1を支持している積層セラミツク板
から成るベースである。3はセラミツクから成
るキヤツプであり、低融点ガラス4によりベー
ス2の上面に固着され、半導体ペレツト1を気
密封止している。このキヤツプ3の内面には前
記実施例のようなゲツター剤6が貼り付けられ
ている。9はMo等から成るメタライズ層であ
り、ワイヤー8およびリード7が接続される表
面部分9′にはAuメツキが施されている。
ツク板を使用した半導体装置であつてもよい。
図において、1はメモリー回路を構成する半導
体ペレツトであり、その表面に前記実施例のよ
うな有機物質膜5が被覆されている。2は半導
体ペレツト1を支持している積層セラミツク板
から成るベースである。3はセラミツクから成
るキヤツプであり、低融点ガラス4によりベー
ス2の上面に固着され、半導体ペレツト1を気
密封止している。このキヤツプ3の内面には前
記実施例のようなゲツター剤6が貼り付けられ
ている。9はMo等から成るメタライズ層であ
り、ワイヤー8およびリード7が接続される表
面部分9′にはAuメツキが施されている。
このような構造の半導体装置によれば、ベー
スが積層セラミツク板から成つているため製造
工数も増加し、かつセラミツク材料も多く必要
とするために前記実施例に比べてコスト高にな
る欠点は有するものの本発明の第1の目的は達
成することができる。
スが積層セラミツク板から成つているため製造
工数も増加し、かつセラミツク材料も多く必要
とするために前記実施例に比べてコスト高にな
る欠点は有するものの本発明の第1の目的は達
成することができる。
(2) 第1図に示された半導体装置において、キヤ
ツプ3およびベース2としてエポキシ樹脂を成
形したものを用いてもよい。
ツプ3およびベース2としてエポキシ樹脂を成
形したものを用いてもよい。
(3) 第1図および第4図に示された半導体装置に
おいて、半導体ペレツト1に被覆された有機物
質膜はワイヤボンデイングした後に被覆してい
る。しかし、第5図あるいは第6図のようにワ
イヤーボンデイング前に形成した構造であつて
もよい。第5図および第6図において、10は
メモリー回路の一部を構成する基板1と反対導
電型の半導体領域、11は例えばSiO2のよう
な酸化膜、12はリン・シリケートガラス膜、
13はアルミニウムより成る配線層、14はア
ルミニウムより成るボンデイングパツドであ
る。そして、5は有機物質膜である。また、こ
の有機物質膜5は第7図に示す如くα粒子によ
つて障害を受ける部分、例えばセルマツト15
上のみ被覆された構造であつてもよい。
おいて、半導体ペレツト1に被覆された有機物
質膜はワイヤボンデイングした後に被覆してい
る。しかし、第5図あるいは第6図のようにワ
イヤーボンデイング前に形成した構造であつて
もよい。第5図および第6図において、10は
メモリー回路の一部を構成する基板1と反対導
電型の半導体領域、11は例えばSiO2のよう
な酸化膜、12はリン・シリケートガラス膜、
13はアルミニウムより成る配線層、14はア
ルミニウムより成るボンデイングパツドであ
る。そして、5は有機物質膜である。また、こ
の有機物質膜5は第7図に示す如くα粒子によ
つて障害を受ける部分、例えばセルマツト15
上のみ被覆された構造であつてもよい。
第1図は本発明に係る半導体装置の断面図、第
2図は本発明による半導体装置の組立て形態を示
す斜視図、第3図はガス放出量と温度の関係を示
す曲線図、第4図は本発明に係る他の実施例を示
す半導体装置の断面図、第5図および第6図はそ
れぞれ本発明に係る半導体ペレツトの部分断面
図、第7図は本発明に係る半導体ペレツトの平面
図である。 1……半導体ペレツト、2……パツケージ(ベ
ース)、3……パツケージ(キヤツプ)、4……低
融点ガラス、5……有機物質膜、6……ゲツター
剤、7……リード、8……ワイヤ。
2図は本発明による半導体装置の組立て形態を示
す斜視図、第3図はガス放出量と温度の関係を示
す曲線図、第4図は本発明に係る他の実施例を示
す半導体装置の断面図、第5図および第6図はそ
れぞれ本発明に係る半導体ペレツトの部分断面
図、第7図は本発明に係る半導体ペレツトの平面
図である。 1……半導体ペレツト、2……パツケージ(ベ
ース)、3……パツケージ(キヤツプ)、4……低
融点ガラス、5……有機物質膜、6……ゲツター
剤、7……リード、8……ワイヤ。
Claims (1)
- 【特許請求の範囲】 1 複数のセラミツク体をガラスにより固着して
成るセラミツクパツケージ内に半導体ペレツトが
存在する半導体装置において、上記半導体ペレツ
ト内にはメモリー機能を有する回路が構成され、
上記半導体ペレツト表面には有機物質膜が被覆さ
れ、さらに、上記ガラスを加熱して封止する際に
上記有機物質膜から発生するガスを吸収するため
のゲツター剤が上記絶縁性パツケージ内に設けら
れてなることを特徴とする半導体装置。 2 上記有機物質膜はポリイミド系樹脂から成る
ことを特徴とする特許請求の範囲第1項記載の半
導体装置。 3 上記ガラスはPbO―B2O3系(PbO:60重量
%以上)ガラスより成ることを特徴とする特許請
求の範囲第1項記載の半導体装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4050580A JPS56137658A (en) | 1980-03-31 | 1980-03-31 | Semiconductor device |
DE19813112564 DE3112564A1 (de) | 1980-03-31 | 1981-03-30 | Gekapselte halbleiteranordnung |
US06/626,200 US4630095A (en) | 1980-03-31 | 1984-06-29 | Packaged semiconductor device structure including getter material for decreasing gas from a protective organic covering |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4050580A JPS56137658A (en) | 1980-03-31 | 1980-03-31 | Semiconductor device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS56137658A JPS56137658A (en) | 1981-10-27 |
JPS6255301B2 true JPS6255301B2 (ja) | 1987-11-19 |
Family
ID=12582402
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4050580A Granted JPS56137658A (en) | 1980-03-31 | 1980-03-31 | Semiconductor device |
Country Status (3)
Country | Link |
---|---|
US (1) | US4630095A (ja) |
JP (1) | JPS56137658A (ja) |
DE (1) | DE3112564A1 (ja) |
Families Citing this family (40)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2538618B1 (fr) * | 1982-12-28 | 1986-03-07 | Inf Milit Spatiale Aeronaut | Boitier pour composant electronique comportant un element fixant l'humidite |
DE3575497D1 (de) * | 1984-05-02 | 1990-02-22 | Gte Prod Corp | Verfahren zum herstellen eines gekapselten ic-plaettchens. |
DE3566476D1 (en) * | 1984-05-02 | 1988-12-29 | Gte Prod Corp | Packaged integrated circuit chip |
JPH0237752Y2 (ja) * | 1985-05-21 | 1990-10-12 | ||
JPH0783075B2 (ja) * | 1986-03-14 | 1995-09-06 | 三菱電機株式会社 | 半導体装置の製造方法 |
US4769345A (en) * | 1987-03-12 | 1988-09-06 | Olin Corporation | Process for producing a hermetically sealed package for an electrical component containing a low amount of oxygen and water vapor |
US4958216A (en) * | 1987-03-23 | 1990-09-18 | Kyocera Corporation | Package for housing semiconductor elements |
US4961106A (en) * | 1987-03-27 | 1990-10-02 | Olin Corporation | Metal packages having improved thermal dissipation |
US5184208A (en) * | 1987-06-30 | 1993-02-02 | Hitachi, Ltd. | Semiconductor device |
US5365113A (en) * | 1987-06-30 | 1994-11-15 | Hitachi, Ltd. | Semiconductor device |
JPH0727921B2 (ja) * | 1987-07-31 | 1995-03-29 | 日本電気株式会社 | 半導体装置の製造方法 |
US4953002A (en) * | 1988-03-31 | 1990-08-28 | Honeywell Inc. | Semiconductor device housing with magnetic field protection |
US5041396A (en) * | 1989-07-18 | 1991-08-20 | Vlsi Technology, Inc. | Reusable package for holding a semiconductor chip and method for reusing the package |
US5196919A (en) * | 1990-12-07 | 1993-03-23 | Kyocera America, Inc. | Use of a contamination shield during the manufacture of semiconductor packages |
US5308533A (en) * | 1991-11-29 | 1994-05-03 | The United States Of America As Represented By The Secretary Of The Air Force | Aerogel mesh getter |
US5360572A (en) * | 1991-11-29 | 1994-11-01 | The United States Of America As Represented By The Secretary Of The Air Force | Aerogel mesh getter |
US5244707A (en) * | 1992-01-10 | 1993-09-14 | Shores A Andrew | Enclosure for electronic devices |
US5734226A (en) * | 1992-08-12 | 1998-03-31 | Micron Technology, Inc. | Wire-bonded getters useful in evacuated displays |
JP2522186B2 (ja) * | 1993-10-15 | 1996-08-07 | 日本電気株式会社 | 半導体パッケ―ジ |
US5883429A (en) * | 1995-04-25 | 1999-03-16 | Siemens Aktiengesellschaft | Chip cover |
US5939785A (en) * | 1996-04-12 | 1999-08-17 | Texas Instruments Incorporated | Micromechanical device including time-release passivant |
US5929515A (en) * | 1997-10-01 | 1999-07-27 | The Charles Stark Draper Laboratory, Inc. | Gettering enclosure for a semiconductor device |
US6093302A (en) * | 1998-01-05 | 2000-07-25 | Combimatrix Corporation | Electrochemical solid phase synthesis |
AU2003200747B2 (en) * | 1998-01-05 | 2006-11-23 | Combimatrix Corporation | Gettering device for ion capture |
CA2251251A1 (en) * | 1998-10-21 | 2000-04-21 | Hualon Microelectronics Corporation | A construction method of hybrid integrated circuit with charge coupled device for image sensing (ccdis) |
US7091605B2 (en) * | 2001-09-21 | 2006-08-15 | Eastman Kodak Company | Highly moisture-sensitive electronic device element and method for fabrication |
US6543617B2 (en) * | 2001-03-09 | 2003-04-08 | International Business Machines Corporation | Packaged radiation sensitive coated workpiece process for making and method of storing same |
TW583049B (en) * | 2001-07-20 | 2004-04-11 | Getters Spa | Support with integrated deposit of gas absorbing material for manufacturing microelectronic, microoptoelectronic or micromechanical devices |
TW533188B (en) * | 2001-07-20 | 2003-05-21 | Getters Spa | Support for microelectronic, microoptoelectronic or micromechanical devices |
US6929974B2 (en) * | 2002-10-18 | 2005-08-16 | Motorola, Inc. | Feedthrough design and method for a hermetically sealed microdevice |
JP2005129735A (ja) * | 2003-10-23 | 2005-05-19 | Fujitsu Media Device Kk | 電子部品 |
US7871660B2 (en) * | 2003-11-14 | 2011-01-18 | Saes Getters, S.P.A. | Preparation of getter surfaces using caustic chemicals |
US7042076B2 (en) * | 2004-03-09 | 2006-05-09 | Northrop Grumman Corporation | Vacuum sealed microdevice packaging with getters |
JP4885426B2 (ja) * | 2004-03-12 | 2012-02-29 | ルネサスエレクトロニクス株式会社 | 半導体記憶装置、半導体装置及びその製造方法 |
US7211881B2 (en) * | 2004-03-24 | 2007-05-01 | Hewlett-Packard Development Company, L.P. | Structure for containing desiccant |
JP4453546B2 (ja) * | 2004-12-22 | 2010-04-21 | 日産自動車株式会社 | パッケージ素子 |
WO2006067730A2 (en) * | 2004-12-22 | 2006-06-29 | Koninklijke Philips Electronics N.V. | Device and method for holding a substrate |
FR2956521B1 (fr) * | 2010-02-16 | 2012-08-17 | Thales Sa | Dispositif comprenant des composants electriques, electroniques, electromecaniques ou electro-optiques, a sensibilite reduite a faible debit de dose |
ITMI20111987A1 (it) | 2011-11-03 | 2013-05-04 | Getters Spa | Getters compositi perfezionati |
EP2736071B8 (en) | 2012-11-22 | 2017-04-19 | Tronic's Microsystems S.A. | Wafer level package with getter |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US2686279A (en) * | 1949-09-28 | 1954-08-10 | Rca Corp | Semiconductor device |
JPS5258469A (en) * | 1975-11-10 | 1977-05-13 | Hitachi Ltd | Resin-molded type semiconductor device |
US4427992A (en) * | 1975-12-17 | 1984-01-24 | Motorola, Inc. | Method for incorporating a desiccant in a semiconductor package |
JPS55130149A (en) * | 1979-03-30 | 1980-10-08 | Hitachi Ltd | Semiconductor device |
-
1980
- 1980-03-31 JP JP4050580A patent/JPS56137658A/ja active Granted
-
1981
- 1981-03-30 DE DE19813112564 patent/DE3112564A1/de not_active Withdrawn
-
1984
- 1984-06-29 US US06/626,200 patent/US4630095A/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
DE3112564A1 (de) | 1982-06-03 |
JPS56137658A (en) | 1981-10-27 |
US4630095A (en) | 1986-12-16 |
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