JPS5922353A - Icカ−ド - Google Patents

Icカ−ド

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JPS5922353A
JPS5922353A JP57132511A JP13251182A JPS5922353A JP S5922353 A JPS5922353 A JP S5922353A JP 57132511 A JP57132511 A JP 57132511A JP 13251182 A JP13251182 A JP 13251182A JP S5922353 A JPS5922353 A JP S5922353A
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JP
Japan
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contact terminals
card
semiconductive
circuit
circuit substrate
Prior art date
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Pending
Application number
JP57132511A
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English (en)
Inventor
Seiichi Nishikawa
誠一 西川
Koichi Okada
浩一 岡田
Teruaki Jo
輝明 城
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Dai Nippon Printing Co Ltd
Original Assignee
Dai Nippon Printing Co Ltd
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Publication date
Application filed by Dai Nippon Printing Co Ltd filed Critical Dai Nippon Printing Co Ltd
Priority to JP57132511A priority Critical patent/JPS5922353A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明はICカードに関するものであり、特にメモリ
やデータ処理」回h1?1等の゛重子1!−il路を内
蔵したIC素子(LSI 、超LSIをも含む)をM旧
没されたカードに関する。
カード本体に工C素子を埋設したカードは、ICカード
やクレジットカード、欽行カード等の個人識別カードと
して利用されていると共に、その他の分野に広く利用さ
れるようになって米た。
このようなカードをここではICカードと称する/Iり
、かかるICカードはメモリやデータ処理回路等の市1
子回路を内蔵したIC素イと、1(2素子をデータ伝送
装置等の外部装置に電気的に接続するための接点端子(
電極)とを具備している。ぞし。
て、ICカード上の外部接続用の長点端子と、埋設され
たIC素子のリード端子とは導体ワイヤにより電気的に
接続されているため、10カードの携帯時やICカード
の未使用時に、接点店1.1子に静電、的偵荷又はi[
!¥lt、ない電圧がかかり、IC素子ないしは電子回
路が破壊されてt、まう恐わがあった。特に、この棟の
ICカードの性質として携帯される可能性が制(・ため
、人体からの静車気により1.C素子ないtl、は」℃
子回路が破壊されることが多かった。よって、この発明
の目的は、上述の如き静電的負荷又は意図しない電圧が
かかった場合にも、IC素子ないしは電子回路を(↓1
υ壊■−1,(いようにしたICカードを提供すること
にある。
以下にこの発明を説明する。
こσ)発明は、カードに内蔵したIC素子を静電荷の局
79i集中から防ぐようにしたICカードに関するもの
であり、第1図に示すように、ボッティング枠1の上面
に#:導電性材浩(たとえば、カーボン混入ガラスエポ
キシ鈑)で成る回路基板2を配設し、回路基板2の外面
にデータ伝送装置等の外部装置と電気的に接続するため
の4数の接点端子3〜(3を設けると共に、回路基板2
の内面1111に埋設されたIC素子7をボンディング
するための回路パターン8及び9を設け、接点端子3,
4と回路パターン8及び接点端子5,6ど回路パターン
9どを′それぞれスルーポール1.0 、11を介して
接続することにより、第2図に示すように接点端子3〜
6を相互に抵抗R1−几6で接続し、その半等電特性に
より印加される静電荷を分散″′4〜るようにしたもの
である。なお、Itk素子7はボッティング枠1に包囲
された領域でモールド樹脂12で固定されており、IC
g子7と回路パターン8,9と(」、導体ワ1ヤ13 
、14でボンディングされている。
このような構造において、外部装置からのデータ等は接
点端子3〜6.スルーホール10 、11 、1z7J
路パターン8,9.ワイヤ13 、14を経て1c素子
7に伝送され、IC素子7からのデータも同様な経路で
外部装ffGl(に送られる。ここにおいて、スルーホ
ール10 、11はIi:!回路基板2を貫通して形成
されており、回路基板2が半導電性材料で構成されてい
ることから、スルーホール10 、11との間は電気的
には半導電的に結合されることになる。したがって、接
点端子がこの実施例で述べているように4個の場合には
、接点端子3〜6は第2図に示すように抵抗■(・1〜
R6で相互に半導電的に接続される。すなわち、接点端
子3及び4は抵抗■(,1で接続され、接点端子3及び
5は抵抗几4で接続され、接点端子5及び6は抵抗R3
で接続されており、以下同様に接点端子3〜6が相互に
抵抗几1〜1(,6で接続される。したかって、任意の
2つの接点端子間に静電的負荷かがかった場合にも、半
導γL性の回路基板2(抵抗)も1〜R16)内に分散
されてしまい、埋設されたIC素子7への静電荷の局所
集中を防止することができる。
なお、半導電性の回路基板2は、接点端子間及び回路パ
ターン間で短絡を生じない程度の抵抗値を有するように
なっており、隣接する接点端子間の抵抗値は数にΩ〜数
10にΩの帥囲にあることが望ましい。この抵抗値は埋
設するIC素子の内部抵抗により異なるが、最適条件を
選択することにより、耐静電気性を従来の10〜100
倍に向上させることが可能である。
以上のようにこの発明のICカードによれば、接点端子
間を半導電性の回路基板によって電気的に半導電的に接
続し、流六電荷を回路基板内で分散するようにしている
ので、ICカードの携帯時に人体からの静電荷によって
ICカード内のIC素子が破壊されたり、使用不能とな
る恐れも軽減され、ICカード自体の信頼性も向」ニす
る旧態かk)る。また、このづ6明の[カードは、従来
の絶糾性基板を半導電性基板に代えるだけで、削節電気
特性を著しく向上し得るものであり、ICカードの製造
工程が増えるといった欠点もない。
なお、上述の実施例では接点端子を4個としているが、
接点端子及び回路パターンの数は任意であり、各接点端
子間を半導電性の回路基板、・で接続できるようになっ
ておれば良い。
【図面の簡単な説明】
第1図はこの発明の一実施例を示すカード断面■1、第
2図はその接点端子及びIC素子の電気的な等価回路を
示1−結線図である。 ]・・・ポツティング枠、2明回路基板、3〜6・・・
接点端子、7・・・IC素子、8,9・・・回路パター
ン、10,11・・・スルーホール、】2・・・モール
ド樹脂、13 、14・・・ワイヤ。

Claims (1)

    【特許請求の範囲】
  1. ポツティング枠の上面に半導電性旧制で成る回路基板を
    配役し、前記回路基板の外面に外部装置と電気的に接続
    するための複数の接点端子を設けると共に、前記回路基
    板の内面側にJj■設されたIC素子をボンディングす
    るためσ)回路パターンを設け、前記接点端子とm+記
    回路パターンとをスルーホール接続することにより、%
    i、 yf旧名点端子間を相互に半導電的に接続するよ
    うにしたことを特徴とするICカード。
JP57132511A 1982-07-29 1982-07-29 Icカ−ド Pending JPS5922353A (ja)

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JP57132511A JPS5922353A (ja) 1982-07-29 1982-07-29 Icカ−ド

Applications Claiming Priority (1)

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JP57132511A JPS5922353A (ja) 1982-07-29 1982-07-29 Icカ−ド

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JPS5922353A true JPS5922353A (ja) 1984-02-04

Family

ID=15083048

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JP57132511A Pending JPS5922353A (ja) 1982-07-29 1982-07-29 Icカ−ド

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01171992A (ja) * 1987-12-28 1989-07-06 Ibiden Co Ltd Icカード用プリント配線板
US5048179A (en) * 1986-05-23 1991-09-17 Ricoh Company, Ltd. IC chip mounting method

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5811197A (ja) * 1981-07-13 1983-01-21 東京磁気印刷株式会社 照合カ−ド用基体

Patent Citations (1)

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