JPH09243994A - 液晶表示装置 - Google Patents

液晶表示装置

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JPH09243994A
JPH09243994A JP8050623A JP5062396A JPH09243994A JP H09243994 A JPH09243994 A JP H09243994A JP 8050623 A JP8050623 A JP 8050623A JP 5062396 A JP5062396 A JP 5062396A JP H09243994 A JPH09243994 A JP H09243994A
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electrode
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政彦 秋山
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Abstract

(57)【要約】 【課題】 液晶ディスプレイでの消費電力を低減するこ
と。メモリ性を有していながら、液晶は階調を得ること
ができ、画像の情報量を高めることができ、良好な画質
が得られること。 【解決手段】 ゲート線９が高電圧でトランジスタ１が
オンした際の信号電圧が蓄積容量２に保持される。その
出力は電圧比較器３に接続され参照電圧線１０との電圧
差で出力パルスを得て波形整形器４に供給される。その
波形整形器４の出力が画素電極６と接続される。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、液晶表示装置に関
する。
【０００２】
【従来の技術】液晶ディスプレイは、薄型で低消費電力
であり、携帯型パソコンなどに広く用いられている。今
後特に消費電力が小さいことが他のＣＲＴ、プラズマデ
ィスプレイなどのディスプレイと比べて優れた特徴であ
り、携帯情報機器への応用が期待されている。
【０００３】ところで、携帯機器の場合、ディスプレイ
の消費電力が５００ｍＷ以下、できれば数ｍＷと小さい
ことが望ましい。この要求に対して、従来はＴＮ型液晶
の単純マトリクス型で反射型を用いてきた。反射型では
バックライトがないため消費電力が下がるのでよいが、
ＴＮ型では偏光板が必要であり反射率が３０％程度と暗
いこと、単純マトリクス型では画素数を増やすとコント
ラストが下がりさらに見にくくなるなどの問題がある。
また、液晶表示に偏光板を用いないＰＣＧＨ（相変化ゲ
ストホスト型）モードを用いてアクティブマトリクスに
よる駆動を行うことにより、反射率が高く、コントラス
トも高い表示を得ることが出来る。
【０００４】図１０にこのような従来の液晶表示装置の
構成を示す。
【０００５】同図に示す回路構成は、従来の透過型ＴＮ
液晶のアクティブマトリクスと同等であり、信号線301
、ゲート線302 およびその交点にある薄膜トランジス
タＴＦＴ303 により、各画素の液晶304 および蓄積容量
（Ｃｓ）305 に電荷を与える。液晶304 には交流を印加
する必要があり、対向基板の対向電極306 の電圧Ｖcom
を中心に正電圧、負電圧となるように信号線電圧を与え
て実現している。
【０００６】このような液晶ディスプレイでは、表示が
全く変化しない場合でも交流電圧を印加する必要から信
号電圧を与え続ける必要がある。容量に交流を印加する
場合の消費電力は、 Ｐ＝ｆ×Ｖ2 ×Ｃ （周波数ｆ；電圧Ｖ；容量Ｃ）となり、周波数に比例す
る。
【０００７】ＶＧＡの６４０×ＲＧＢ×４８０画素の場
合、信号線用ドライバＩＣのクロック周波数はフレーム
周波数６０Ｈｚ、ＲＧＢごとに独立したシフトレジスタ
を用いるとして、６０×４８０×６４０＝１８ＭＨｚと
なる。駆動回路のＩＣの設計に依存する部分があるが２
００ｍＷ程度となる。各信号線には６０×４８０＝２９
ｋＨｚが印加される。対角１０．４インチでは信号線１
本当りの容量は約４０ｐＦ、とするとパネルを駆動する
ことによる消費電力は約５０ｍＷとなる。画素数を増や
した場合、例えば１６００×１２００画素ではパネルの
消費電力はゲート線に比例するから２．５倍に、駆動Ｉ
Ｃも同程度以上の割合で増加するから１Ｗ近くになり、
携帯機器に用いるには問題があった。
【０００８】このような問題に対して双安定の強誘電性
液晶（ＳＳＦＬＣ）を用いると液晶にメモリ性があり、
表示が変らない限り電圧の供給を停止することができる
ことが知られており、消費電力の低減が可能である。
【０００９】しかし、このような双安定性を用いると画
素は２値でしか動作せず、画面の解像度は大きいものの
情報量が大幅に下がってしまう問題があった。特にカラ
ー表示の場合、２値しか表示出来ないと色合いを出すた
めに空間変調（ディザ）や時間変調を行わなければなら
ず、実効的な解像度の低下やちらつきなどの画質の低下
が避けられなかった。また、双安定の強誘電性液晶で
は、衝撃により配向が乱れて表示不良が発生することが
知られており、携帯型表示デバイスとしては採用できな
い問題があった。さらにメモリ性を持った液晶では表示
品位（コントラスト、反射率など）が制限されることが
多く、ＳＳＦＬＣでも偏光板の使用が不可欠の表示モー
ドであり、反射率は３０％程度と暗い画面しか得られな
い問題もあった。
【００１０】
【発明が解決しようとする課題】前述したように、パソ
コンの画面や携帯情報機器の画面などでは静止画が多く
画面が書き変らないでも信号線に交流を供給することに
なり、電力を無駄に消費していることになる。
【００１１】そこで、本発明では上述の問題点を解決
し、電力消費を低減することができる液晶表示装置を提
供することを目的とする。
【００１２】さらに、本発明では、液晶に階調信号を供
給することができ、２値以上の表示が可能となる液晶表
示装置を提供することを目的とする。
【００１３】
【課題を解決するための手段】上記課題を解決するた
め、請求項１記載の本発明は、２つの電極間に液晶層を
有する液晶表示装置において、表示信号を記憶し、表示
信号に応じたアナログ信号を出力する記憶手段と、前記
アナログ信号に応じた実効値あるいは平均値を有する交
流電圧を前記電極を介して前記液晶層に印加する印加手
段とを具備するものである。
【００１４】記憶手段としては、例えば蓄積容量素子と
してのコンデンサがある。また、例えば請求項４記載の
「表示信号をディジタル信号に変換する第１の変換手段
と、前記ディジタル信号に変換された表示信号を記憶す
る記憶手段と、前記記憶手段に記憶された表示信号をア
ナログ信号に変換する第２の変換手段」をこの記憶手段
として用いることもできる。
【００１５】そして、本発明によれば、液晶に交流電圧
を印加しながら、画面の書換えが不要な場合には信号線
への電圧供給を止めることができる。液晶には実効値と
してアナログ的な信号が供給できる。
【００１６】請求項２記載の本発明は、第１の電極と第
２の電極間に液晶層を有する液晶表示装置において、前
記第１の電極に第１の交流電圧を印加する第１の印加手
段と、表示信号を記憶し、表示信号に応じたアナログ信
号を出力する記憶手段と、前記第１の交流電圧に対して
前記アナログ信号に応じた位相差をもつ第２の交流電圧
を前記第２の電極に印加する第２の印加手段とを具備す
る。
【００１７】請求項３記載の本発明は、第１の電極と第
２の電極間に液晶層を有する液晶表示装置において、前
記第１の電極に第１の交流電圧を印加する第１の印加手
段と、第１のタイミングで表示信号を当該表示信号に応
じたアナログ信号として記憶する記憶手段と、前記アナ
ログ信号を入力し、前記第１の交流電圧に対して当該ア
ナログ信号に応じた位相差をもつ第２の交流電圧を前記
第２の電極に印加する第２の印加手段と、前記第１のタ
イミングより所定期間遅延した第２のタイミングで前記
アナログ信号を前記記憶手段から前記第２の印加手段に
送る手段とを具備する。
【００１８】そして、本発明によれば、表示信号を記憶
手段に一旦記憶した後、所定時間遅延させて第２の印加
手段に送るように構成しているので、画像書換え時にお
ける画面の乱れを防止することができる。例えば、１画
素文の記憶が終わったあとに一斉に第２の印加手段に送
ることで動画時でも問題のない表示ができる。
【００１９】請求項４記載の本発明は、アナログ信号の
表示信号を送出する信号線と、前記信号線に接続され、
前記表示信号をディジタル信号に変換する第１の変換手
段と、前記ディジタル信号に変換された表示信号を記憶
する記憶手段と、前記記憶手段に記憶された表示信号を
アナログ信号に変換する第２の変換手段と、前記アナロ
グ信号に変換された表示信号に基づいて液晶層を駆動す
る駆動手段とを具備する。 本発明によれば、記憶手段
に記憶された表示信号がディジタル信号であることか
ら、信号の変動や各種回路の特性のばらつきの影響を受
けずにデータを保持でき、表示画像を良好にできる。
【００２０】さらに、この発明は、信号線にディジタル
信号が伝送するようにしても変形してもい。つまり、ア
ナログ信号またはディジタル信号の表示信号を送出する
信号線と、信号線から送られた表示信号をディジタル信
号の形式で記憶する記憶手段と、前記記憶手段に記憶さ
れた表示信号をアナログ信号に変換する第２の変換手段
と、前記アナログ信号に変換された表示信号に基づいて
液晶層を駆動する駆動手段とを持つように変形すること
ができる。
【００２１】
【発明の実施の形態】図１に本発明に係る液晶表示装置
の一例を示す。
【００２２】同図に示す液晶表示装置は、縦横に画素電
極が形成された絶縁基板と対向電極が形成された対向基
板との間に液晶を挟持してなるものであり、単位画素毎
に、スイッチング用のトランジスタ１、蓄積容量（Ｃs
1）２、電圧比較器３、波形整形器４、画素電極６等を
有する。
【００２３】絶縁基板上には、表示信号を供給する複数
の信号線８とトランジスタ１のオンオフを制御する複数
のゲート線９が交差するように形成されており、ｍ列ｎ
行目の画素の信号線をＳｍ、ゲート線をＧｎとする。信
号線８はトランジスタ１のソースに接続され、ゲート線
９はトランジスタ１のゲートに接続されている。トラン
ジスタ１のドレインには蓄積容量線１１に接続された蓄
積容量２が接続され、ゲート線９が高電圧でトランジス
タ１がオン（トランジスタ１がｎチャネル型の場合）し
た際の信号電圧が蓄積容量２に保持される。この電圧を
Ｖ1 ´とする。蓄積容量２はトランジスタ１２のソース
に接続され、トランジスタ１２のゲートはタイミング線
１３に接続され、トランジスタ１２のドレインは電圧比
較器３に接続される。電圧比較器３の入力電圧をＶ1 と
する。蓄積容量（Ｃs2）１４はＶ1 の電圧を維持するた
めに設けられている。
【００２４】電圧比較器３のもう一方の入力端は、参照
電圧線１０に接続されている。参照電圧線１０は少なく
とも複数の画素（通常は全画素）で共通の電圧が印加さ
れる。電圧比較器３は両者の入力電圧の大小を比較して
一方の電圧が高くなれば、電圧比較器の出力がハイレベ
ルになるものである。その出力電圧をＶ2 とする。この
出力は波形整形器４に供給される。
【００２５】波形整形器４はＴフリップフロップであ
り、Ｖ2 の波形立ち上がりに対応して出力が反転する機
能を持っている。その波形整形器４の出力が画素電極６
と接続される。
【００２６】以上の回路が含まれた絶縁基板に対して対
向電極７を持つ対向基板との間に液晶５が設けられ、画
素電極６と対向電極７との間の電圧ＶLCが液晶に印加さ
れることになる。対向電極７の電圧をＶcom とする。
【００２７】以上の構成に対して、各部の電圧波形を図
２に示す。
【００２８】まず、静止画状態を基本に考えるとして、
信号電圧のサンプリングは終り、電圧比較器３の入力は
Ｖ1 の電圧となっているとする。参照電圧線１０にはラ
ンプ波を、対向電極７にはこの参照電圧とタイミング、
周期を合わせた方形波を、印加する（図２（ａ））。図
２（ａ）には参照線電圧Ｖr （実線）と蓄積容量の電圧
Ｖ1 （一点鎖線）の両方を示す。Ｖr は１２０Ｈｚのラ
ンプ波とした。ランプ波とＶ1 の比較でランプ波の電圧
が低いと電圧比較器３の出力電圧Ｖ2 がローレベル、高
くなったタイミングでハイレベルとなり、図２（ｂ）の
波形が得られる。出力電圧Ｖ2 の出力波形の立ち上がり
のタイミングで波形整形器３の出力である画素電圧Ｖp
が図２（ｃ）のようなランプ波に対して位相がシフトし
た方形波となる。
【００２９】対向電極７の電圧Ｖcom は図２（ｄ）に示
すようにランプ波とほぼ同じ位相での方形波を与えてい
る。Ｖp 、Ｖcom の波高をＶH とすると、液晶５に印加
される電圧ＶLC（＝Ｖp −Ｖcom ）は、図２（ｅ）に示
すような３値の波形で±ＶHの振幅を持ち、パルス幅Ｔw
がランプ波と画素電圧Ｖp の位相差に対応する波形と
なる。液晶は一般に実効値に応答して動作するものが多
いのでこのパルス幅が変化することで液晶への実効電圧
値が制御され、光学応答（光透過率、反射率など）が得
られる。なお、図２（ｅ）において、一点鎖線は実線に
対する実効値、二点鎖線は破線に対する実効値を示す。
【００３０】液晶は、ゲストホスト型としたが、ＴＮ型
でもよく、コレステリック液晶や、強誘電性液晶、反強
誘電性液晶、高分子分散型液晶、などでもよく、表示方
式も自由であり、光学的な変化の分類でいえば、透過−
吸収を得るもの、透過−散乱を得るもの、散乱−吸収を
得るもの、などいずれでもよい。強誘電性液晶あるいは
反強誘電性液晶では、図２（ｅ）の実線あるいは点線の
電圧が印加される場合、液晶の印加電圧に対する光学応
答が速いので、印加電圧の平均値が液晶の光学応答を決
定することとなる。画素の素子数が多いので素子の上に
絶縁膜を設けて画素電極を形成した反射型が望ましい
が、画素サイズによっては透過型でも可能である。モノ
クロでもカラー表示でも当然かまわない。
【００３１】以上の構成の結果、静止画の場合では、蓄
積容量（Ｃs2）１４に１画面分の電圧を書き込んだ後に
ゲートパルスを止めることができ、同時に信号線ドライ
バも停止することができた。周辺回路の停止では回路の
電源を切ってしまうことができることから交流による電
力消費の他に直流的な電力消費もなくすことができ、消
費電力を０にできた。液晶に交流を印加する回路の周波
数は参照電圧Ｖr 、対向電極Ｖcom とも１２０Ｈｚと低
周波であり、Ｖr 、Ｖcom を供給する外部回路の消費電
力は十数ｍＷと小さかった。画素内の回路も多結晶Ｓｉ
ＴＦＴを用いたＣＭＯＳ回路で構成しており、直流消費
電力も同程度に小さかった。総合的に対角１３インチ
（Ａ４サイズ）の液晶ディスプレイで５０ｍＷと十分小
さい値が実現出来た。なお、蓄積容量の放電により電圧
が数％変化する時間ごとに同じ画像情報を書込む必要が
あるが、数秒〜数分毎であるため、平均した消費電力は
数十ｍＷの増加となるに留まった。
【００３２】図２（ａ）では参照電圧はランプ波とした
が、図２（ａ）´のように階段波とすることも可能であ
る。この場合階調数に合わせた段数とすることができる
が、この場合は入力電圧Ｖ1 が多少ばらついていても所
定の階調とすることが出来ることから画面を均一にする
ことができる。画素が細かい場合は１画素あたりの階調
数は１６階調程度でも十分であることからこのような階
段波は有効な方法といえる。
【００３３】次に、信号電圧のサンプリングについて、
図３の波形を使って説明する。
【００３４】静止画が中心の場合（ドキュメントビュア
など）では、信号のサンプリングタイミングは任意でよ
いと考えれるが、動画表示を行う場合、静止画でも画像
書換え時に画面が乱れるのを嫌う場合はタイミングを合
わせる必要がある。この例の場合次のような駆動方法で
解決できる。
【００３５】図３でゲートパルス波形Ｇｎが高電圧とな
る期間に信号線電圧Ｓｍをサンプリングして蓄積容量
（Ｃs1）２上にＶ1 ´の電圧が決まる。通常のＴＶ信号
ではＣＲＴを基本としていることから帰線期間が存在す
る。他の信号源の場合でも画面を書換える期間（信号書
込み期間）を全フレーム周期より若干短くして余剰の時
間を設けることができる。これらの期間（帰線期間と総
称する）の間にトランジスタ１２をオン、オフするＶT
を高電圧にして蓄積容量（Ｃs1）２の電圧を１フレーム
の同一タイミングで電圧比較器３の入力電圧Ｖ1 を保持
する蓄積容量（Ｃs2）１４に移すことにより、画面の上
下に関わらず適正な信号が１フレームごとに電圧比較器
３に供給されるので動画でも問題のない良好な表示が得
られる。なお、電荷が分割されることからＶ1 はＶ1 ´
よりも小さい値になるが低減分を考慮して信号電圧を印
加すればよい。
【００３６】図１において、波形整形器４には、セッ
ト、リセット端子が設けられており、画素ごとにどちら
か一方を共通に接続している。同図に示す例ではセット
端子を蓄積容量線１１に接続した。画素ごとでどちらを
接続するかは、任意であるが、セット端子を接続した場
合とリセット端子を接続した場合で液晶に印加される電
圧の極性が逆にできるので、隣接画素ごと、あるいは数
画素ごとに接続を変えることで正負の極性のバランスの
ずれによるフリッカの発生を抑えることができる。これ
により画面全体でちらつくことがなく良好な画像を得る
ことができる。なお、蓄積容量線１１はディスプレイを
動作させる最初の時にハイレベルにしてからその後はロ
ーレベルに保持することで初期の電圧位相を合わせるこ
とが可能になる。 図４に電圧比較回路の一例、図５に
波形整形回路の一例を示す。図５（ａ）は波形整形回路
の論理回路の構成であり、図５（ｂ）にこの論理回路の
構成要素であるナンド回路の回路図、図５（ｂ）にこの
論理回路の構成要素である反転回路の回路図である。こ
れらの回路は、いずれも多結晶ＳｉＴＦＴによるＣＭＯ
Ｓの回路となっている。回路構成としては別のものでも
よく、ｎチャネルトランジスタのみで構成することも可
能である。トランジスタは多結晶ＳｉＴＦＴの他、アモ
ルファスシリコンＴＦＴでもよく、ＣｄＳｅなどの化合
物半導体でもよい。
【００３７】図６に本発明の他の例の画素回路を示す。
【００３８】同図に示す回路は、ゲート線110 、信号線
109 の交点に画素があり、トランジスタ101 を介して蓄
積コンデンサ102 に電圧を保持するメモリ構成である。
その出力をアナログバッファ104 で受け、反転信号を形
成する反転回路105 があり、アナログバッファ104 また
は反転回路105 のいずれかを選択するアナログスイッチ
106 を通して対向電極113 との間に挟持された液晶108
に電圧を印加する駆動回路103 となっている。すなわ
ち、アナログスイッチ106 の切替えにより極性の反転す
るパルス（交流）を順次液晶108 に印加している。
【００３９】アナログスイッチ106 に印加される信号反
転は反転信号線112 に印加される信号Ｖacのタイミング
で切替えられるようになっており、ここではフリップフ
ロップ107 で実現した。液晶に印加する信号の交流周期
はこのＶacの周期の２倍と同じとなり、例えばＶacを１
２０Ｈｚとすれば液晶には６０Ｈｚで供給される。最初
の例と同様に起動時にフリップフロップの極性を決める
セット、リセットパルスを印加することで画素ごとの電
圧極性を制御できる。同パルスを補助容量線111 で供給
するようにしたが、別の供給線を設けてもよい。
【００４０】この例では各画素で交流電圧を生成するこ
とから、信号を画面全体で同時に供給する図１のトラン
ジスタ１２のような回路は不要にできる。また、対向電
極の電圧は一定とすることができ、その部分での消費電
力を低減できる。
【００４１】図７に本発明のさらに他の例の画素回路の
ブロック図を示す。
【００４２】同図に示す回路では、ゲート線207 、信号
線206 があり、サンプリング回路201 により、画素の階
調信号をディジタル信号として得てメモリ回路202 に保
存する。サンプリング回路では信号線をビット数に合わ
せて複数にすることも可能であるが、この例では時分割
に供給し、クロック信号線208 のタイミングで各ビット
の情報を得るようにしている。その伝送方式は他の方法
でもよく、この例ではメモリがディジタルデータを保存
することが特徴である。アナログ信号を信号線から供給
し、アナログ−ディジタル変換器（ＡＤＣ）によりメモ
リ702 に記憶することもできる。このメモリの出力はデ
ィジタル−アナログ変換器（ＤＡＣ）203 を通してアナ
ログ信号に変換され、液晶駆動回路(204) を介して液晶
205 に電圧を供給する。液晶駆動回路としては図１の駆
動回路１５や図６の駆動回路103などを採用できる。
【００４３】この例ではメモリ部がディジタルであるこ
とから信号の変動やサンプリング回路、メモリ回路の特
性のばらつきの影響を受けずにデータを保持できるので
画像の良好にできる。さらに、メモリ回路として薄膜ト
ランジスタとすることで素子数が低減できるとともにリ
フレッシュがほぼ完全に不要となり、全体の電源を切っ
てしまっても、再度電源を入れれば前の画面が得られる
ことから、外部のビデオメモリを省略することが可能で
ある。これによってコスト削減とともにさらなる低消費
電力が可能となる。
【００４４】図８は以上の例いずれにも適用できる別の
構成例である。
【００４５】すなわち、同図に示す回路構成は、画面の
任意の箇所に書込みが出来るもので、トランジスタ801
とトランジスタ802 が同時にオンしたとき画素に信号線
806からデータを画素に書き込むようになっている。ト
ランジスタ801 のオンオフはＹゲート線807 、トランジ
スタ802 のオンオフはＸゲート線808 により行われる。
この後にメモリ回路803 、液晶駆動回路804 があり、液
晶805 に電圧が印加される。任意の画素に書き込むこと
により、画面の変化する点のみの書換えによる信号供給
量の低減に伴う低消費電力化が得られる。さらに、静止
画の中の一部に動画が出る窓があれば、動画部分のみ高
速で画像を書き込むことができるようになる。なお、図
８の構成はトランジスタ２つで作られているが、他の方
法でも良い。例えば非線形素子を入れてある電圧以上に
なると始めてオンするようになっていても良い。
【００４６】図９は図１の例を図８に基づいた変形を行
った場合のシステムブロック図である。同図に示すよう
に、各画素が図１に示した回路構成を有する液晶表示素
子901 には、信号線駆動回路902 、ゲート線駆動回路90
3 、対向電極駆動回路904 、基準電圧波形発生回路905
、タイミング発生回路906 、ＣＳ線駆動回路907 が接
続されている。静止画ＶＲＡＭ908 、動画用ＶＲＡＭ90
9 の表示信号がＤ／Ａ変換回路ＤＡＣ910 を介して信号
線駆動回路902 に供給され、タイミング発生回路906 が
各部に所定のタイミング信号を供給することで、装置が
駆動される構成となっている。
【００４７】この例では、動画用ＶＲＡＭ909 を用意し
て動画信号を供給することにより、静止画部分はＶＲＡ
Ｍでの消費電力を低減することができる。ＶＲＡＭとし
ては同一として動画部分をその一部のブロックとするこ
とも可能である。
【００４８】なお、図１の例で述べた回路方式や液晶表
示方式のバリエーションは他の例でも同様に適用するこ
とができる。
【００４９】その他、本発明の趣旨を逸脱しない範囲で
あれば様々な変形をすることは可能である。
【００５０】
【発明の効果】以上詳述したように、本発明によれば、
液晶ディスプレイでの消費電力を低減することができ
る。また、メモリ性を有していながら、液晶は階調を得
ることができるので画像の情報量を高めることができ、
良好な画質が得られる。
【図面の簡単な説明】
【図１】 本発明の一例に係る画素部の回路図。
【図２】 本発明の一例に係る電圧波形図。
【図３】 本発明の一例に係る電圧波形図。
【図４】 本発明の一例に係る電圧比較回路の詳細回路
図。
【図５】 本発明の一例に係る波形整形回路の詳細回路
図。
【図６】 本発明の他の例に係る画素部の回路図。
【図７】 本発明の他の例に係る画素部の回路図。
【図８】 本発明の他の例に係る画素部の回路図。
【図９】 本発明の他の例に係るディスプレイシステム
ブロック図。
【図１０】 従来の画素部の回路図。
【符号の説明】
１ 薄膜トランジスタ ２、１４ 蓄積容量 ３ 電圧比較器 ４ 波形整形器 ５ 液晶 ６ 画素電極 ７ 対向電極 ８ 信号線 ９ ゲート線 １０ 参照電圧線 １１ 蓄積容量線 １２ 薄膜トランジスタ １５ 液晶駆動回路

Claims (4)

    【特許請求の範囲】
  1. 【請求項１】 ２つの電極間に液晶層を有する液晶表示
    装置において、 表示信号を記憶し、表示信号に応じたアナログ信号を出
    力する記憶手段と、 前記アナログ信号に応じた実効値あるいは平均値を有す
    る交流電圧を前記電極を介して前記液晶層に印加する印
    加手段とを具備することを特徴とする液晶表示装置。
  2. 【請求項２】 第１の電極と第２の電極間に液晶層を有
    する液晶表示装置において、 前記第１の電極に第１の交流電圧を印加する第１の印加
    手段と、 表示信号を記憶し、表示信号に応じたアナログ信号を出
    力する記憶手段と、 前記第１の交流電圧に対して前記アナログ信号に応じた
    位相差をもつ第２の交流電圧を前記第２の電極に印加す
    る第２の印加手段とを具備することを特徴とする液晶表
    示装置。
  3. 【請求項３】 第１の電極と第２の電極間に液晶層を有
    する液晶表示装置において、 前記第１の電極に第１の交流電圧を印加する第１の印加
    手段と、 第１のタイミングで表示信号を当該表示信号に応じたア
    ナログ信号として記憶する記憶手段と、 前記アナログ信号を入力し、前記第１の交流電圧に対し
    て当該アナログ信号に応じた位相差をもつ第２の交流電
    圧を前記第２の電極に印加する第２の印加手段と、 前記第１のタイミングより所定期間遅延した第２のタイ
    ミングで前記アナログ信号を前記記憶手段から前記第２
    の印加手段に送る手段とを具備することを特徴とする液
    晶表示装置。
  4. 【請求項４】 アナログ信号の表示信号を送出する信号
    線と、 前記信号線に接続され、前記表示信号をディジタル信号
    に変換する第１の変換手段と、 前記ディジタル信号に変換された表示信号を記憶する記
    憶手段と、 前記記憶手段に記憶された表示信号をアナログ信号に変
    換する第２の変換手段と、 前記アナログ信号に変換された表示信号に基づいて液晶
    層を駆動する駆動手段とを具備することを特徴とする液
    晶表示装置。
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