JPH0461670A - 再生装置 - Google Patents

再生装置

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JPH0461670A
JPH0461670A JP2168514A JP16851490A JPH0461670A JP H0461670 A JPH0461670 A JP H0461670A JP 2168514 A JP2168514 A JP 2168514A JP 16851490 A JP16851490 A JP 16851490A JP H0461670 A JPH0461670 A JP H0461670A
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memory
playback
address
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control circuit
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JP2168514A
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Katsumi Karasawa
勝己 柄沢
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［産業上の利用分野コ 本発明は、情報を所定単位数毎にブロック化し、各ブロ
ックにアドレス情報を付加して記録媒体に記録するシス
テムにおける再生装置に関する。
［従来の技術］ このような記録システムの一例として、所謂ディジタル
ＶＴＲがある。ディジタルＶＴＲでは、記録しようとす
る所定単位数量の映像情報データＤＡＴＡに、同期フー
ド５ＹＮＣ，アドレス信号ＩＤ、及び伝送誤り検出及び
訂正のための誤り訂正符号ＰＡＲＩＴＹを付加して、第
４図に示すような同期ブロックを形成する。そして例え
ば、第５図に示すような、アジマスの異なる２つのヘッ
ドＩＯＡ、ＩＯＢを具備する回転ドラム１２により映像
情報データを磁気テープに記録する。テープ上の記録フ
ォーマットの一例を巻第６図に示す。第６図では１フイ
ールドを１本のトラックで記録できると仮定しており、
Ａ＋、Ａ２．・・・、Ａｎ、Ｂｌ、１３２．・”、Ｂｎ
は第４図に図示した同期ブロックであり、ｎ個の同期ブ
ロックＡ、　、Ａｓ　、−、Ａｎ　；　Ｂ、　、Ｂ２．
−・・、Ｂｎで１つのトラックを形成している。同期ブ
ロックＡｓ　、Ａ２　、・・・、Ａｎのトラックは磁気
ヘッドＩＯＡにより記録され、同期ブロックＢ＋、Ｂｎ
、・・・、Ｂｎのトラックは磁気ヘッド１０Ｂにより記
録される。即ち、各トラックは、交互に異なるアジマス
で記録される。
第６図に示すように記録された映像情報を１／４倍速再
生したときの磁気ヘッドの軌跡を第７図に示す。但し、
同じアジマスのヘッドによりトラックの５０％以上をト
レースされている領域を、再生可能領域とする。第７図
では、斜線を施した領域が再生可能領域になる。
第９図は、従来の再生装置の構成ブロック図を示す。入
力端子２０にはヘッドＩＯＡ、ＩＯＨの出力が入力し、
スイッチ２２及びデータ・ブロック制御回路２４により
、映像情報データとアドレス信号ＩＤに分離される。Ｉ
Ｄ復号回路２６は、分離されたアドレス信号ＩＤを復号
して、メモリ２８の書き込みアドレスを発生する。分離
された映像情報データは、ＩＤ復号回路２６からの書き
込みアドレスに従ってメモリ２８に格納される。１／４
倍速再生時には、第７図に図示したように同じトラック
を複数回トレースするので、メモリ２２には重複した書
き込みが行なわれる。第８図は、１／４倍速再生時のメ
モリ５８への書き込みのアドレッシングを示す。実線１
４が書き込みアドレスを示す。
また、入力端子３０には、倍速情報、即ち再生速度倍率
の情報が入力しており、ＦＣＣ制御回路３２はこれに応
じて、誤り訂正回路３４を起動する。
ここでは、誤り検出及び訂正符号は、第４図に示す同期
ブロックを複数個含むデータマトリクスに対し、所謂積
符号を付加するものとし、このデータ・マトリクスを記
録時にトラック（フィールド）単位で形成するものと仮
定する。即ち、誤り検出及び訂正符号はフィールド単位
で付加されているので、誤り訂正回路３４による誤り訂
正時には、第８図に斜線領域１６で示すように、フィー
ルド単位で処理が行なわれ、そのためアドレッシングも
フィールド単位となる。メモリ制御回路３６は入力端子
３０からの倍速情報に従い、メモリ２８の読み出しを制
御する。具体的には、第８図の破線１８に示すタイミン
グで読み出しアドレスを発生する。メモリ２８から読み
出されたデータは出力端子３８から、外部回路に供給さ
れる。
［発明が解決しようとする課題］ 上記従来例では、１／４倍速再生の場合、第１０図（ａ
）に示すように、前述したデータ書き込みのためのアド
レッシング４１、誤り検出及び訂正処理のためのアドレ
ッシング４０．及びデータ読み出しのためのアドレッシ
ング４２が互いに競合しないようにしなければならない
。従って、誤り訂正起動タイミング及びデータ読ろ出し
起動タイミングを夫々第１０図（ｃ）、（ｄ）に示すよ
うにしている。
しかし、更に再生速度が遅くなると、例えば第１０図（
ｂ）に示すような１７８倍速の場合、第１０図（ｃ）、
（ｄ）の各起動タイミングのままでは、データ書き込み
のアドレッシング４４に対して誤り検出検出及び訂正の
アドレッシング４６及びデータ読み出しアドレッシング
４８が競合してしまう。そこで、１／８倍速の場合には
、誤り訂正起動タイミング及びデータ読み出し起動タイ
ミングを夫々第１１図に示すように設定しなければなら
ない。
このように、従来例では、再生速度に柔軟に対応できる
構成になっていなかった。特に、再生速度が通常再生時
の整数分の１とならない場合には、上記誤り訂正起動の
タイミングや、データ読み出し起動のタイミングを決定
するのは難しかった。
更には、予定されていたトラッキング状態にない場合等
には、上記アドレッシングの競合が発生してしまうこと
があった。
そこで本発明は、再生速度などの再生状態や再生条件に
柔軟に対応できる再生装置を提示することを目的とする
。
［課題を解決するための手段］ 本発明に係る再生装置は、所定量の情報をブロック化し
て各ブロックにアドレス情報を付加して記録媒体に記録
する記録システムにおける再生装置であって、再生され
た情報を再生されたアドレス情報に従い記憶するメモリ
手段を具備し、再生されたアドレス情報に応じて、当該
メモリ手段に記憶された情報の誤り検出又は訂正処理や
、当該メモリ手段からの情報読み出しを起動することを
特徴とする。
［作用］ 上記手段により、トラッキング状態、再生速度にかかわ
らず、メモリ手段に記憶されている情報の誤り検出訂正
処理や、メモリ手段からの情報読み出し処理、メモリ手
段への情報書き込み処理が互いに競合しないようにする
ことができる。従って、再生速度に柔軟に対応できるよ
うになる。
［実施例］ 以下、図面を参照して本発明の詳細な説明する。
第１図は本発明の一実施例の構成ブロック図を示し、第
２図は１／４倍速再生の場合のメモリ・アドレッシング
、第３図は１／８倍速再生の場合のメモリ・アドレッシ
ングを示す。
入力端子５０にはヘッドＩＯＡ、ＩＯＨの出力が入力し
、スイッチ５２及びデータ・ブロック制御回路５４によ
り、映像情報データとアドレス信号ＴＤに分離される。
ＩＤ復号回路５６は、分離されたアドレス信号ＴＤを復
号して、メモリ５８の書き込みアドレスを発生する。分
離された映像情報データは、ＩＤ復号回路５６からの書
き込みアドレスに従ってメモリ５８に格納される。
ＩＤ復号回路５６はまた、入力したアドレス信号ＩＤに
応じて、誤り検出及び訂正の起動タイミング信号及び読
み出しアドレッシングの起動タイミング信号を発生し、
それぞれＥＣＣ制御回路６０及びメモリ制御回路６４に
供給する。具体的にその一例を示すと、ＩＤ復号回路５
６は、同期ブロックＡ。
の映像情報データがメモリ５８に書き込まれる時に、誤
り検出及び訂正の起動タイミング信号をＥＣＣ制御回路
６０に印加し、同期ブロックＢ１の映像情報データがメ
モリ５８に書き込まれる時に、データ読み出しの起動タ
イミング信号をメモリ制御回路６４に印加する。
ＥＣＣ制御回路６０は誤り検出及び訂正の起動タイミン
グ信号に応じて誤り訂正回路６２を起動し、これにより
、誤り検出及び訂正処理が行なわれる。
また、メモリ制御回路６４は、データ読み出しの起動タ
イミング信号に応じて、メモリ５８の記憶データの読み
出しを開始する。メモリ５８から読み出されたデータは
出力端子６６から外部回路に送られる。
１／４倍速再生の場合、ＩＤ復号回路５６は第２図に実
線６８で示すような書き込みアドレスを発生してメモリ
５８に印加し、誤り訂正回路６２はを第２図に斜線領域
７０で示すタイミングで誤り検出及び訂正処理を行ない
、メモリ制御回路６４は第２図に破線７２で示すタイミ
ングでデータ読み出しを行なう。
１／８倍速再生の場合、ＩＤ復号回路５６は第３図に直
線７４で示すような書き込みアドレスを発生してメモリ
５８に印加し、誤り訂正回路６２はを第３図に斜線領域
７６で示すタイミングで誤り検出及び訂正処理を行ない
、メモリ制御口６４は第３図に破線７８で示すタイミン
グでデータ読み出しを行なう。第３図から分かるように
、従来例のようなアドレッシングの競合は発生しない。
１７４倍速再生及び１７８倍速再生の場合を説明したが
、その他の倍速再生の場合にもアドレッシングの競合が
発生しないことは勿論である。即ち、再生速度が通常再
生時の整数分の１にならない場合にも、上述の実施例に
より、データ書き込みアドレスに対し誤り訂正のアクセ
ス・アドレス、データ読み出しアドレス等が競合しない
。
なお、上述の実施例では同期ブロックＡ、の書き込み時
に誤り訂正を起動し、同期ブロックＢ、の書き込み時に
データ読み出しを起動したが、これらの起動タイミング
と再生されたＩＤのアドレスとの関係は適宜変更可能で
ある。
［発明の効果］ 以上の説明から容易に理解できるように、本発明によれ
ば、同期ブロックのアドレス信号ＩＤに応じて誤り検出
訂正処理やデータ読み出しを起動するので、メモリ・ア
ドレッシングの競合を回避できる。従って、再生速度に
柔軟に対応できるようになる。
【図面の簡単な説明】
第１図は本発明の一実施例の構成ブロック図、第２図は
１／４倍速再生時のメモリ・アドレッシング図、第３図
は１／８倍速再生時のメモリ・アドレッシング図、第４
図は同期ブロックのフォーマット、第５図は回転ドラム
の平面図、第６図は磁気テープの記録フォーマット、第
７図は１／４倍速再生時のヘッド・トレースの変化図、
第８図は従来例での１／４倍速再生時のメモリ・アドレ
ッシング図、第９図は従来例の構成ブロック図、第１Ｏ
図は１／４倍速再生時のメモリ・アドレッシング及び同
しタイミングでの１／８倍速再生時のメモリ・アドレッ
シング図、第１１図は１／８倍速再生のためのメモリ・
アドレッシング及びタイミング図である。 ５０コ入力端子　５４．データ・ブロック制御回路　５
６：ＩＤ復号回路　５８．メモリ　６０・ＥＣＣ制御回
路　６２．誤り訂正回路　６４：メモリ制御回路　６６
：出力端子　６８．７４：書き込みアドレス　７０．７
６：誤り検出訂正処理　７２７８：読み出しアドレス

Claims (2)

    【特許請求の範囲】
  1. （１）所定量の情報をブロック化して各ブロックにアド
    レス情報を付加して記録媒体に記録する記録システムに
    おける再生装置であって、再生された情報を再生された
    アドレス情報に従い記憶するメモリ手段を具備し、再生
    されたアドレス情報に応じて、当該メモリ手段に記憶さ
    れた情報の誤り検出又は訂正処理を起動することを特徴
    とする再生装置。
  2. （２）所定量の情報をブロック化して各ブロックにアド
    レス情報を付加して記録媒体に記録する記録システムに
    おける再生装置であって、再生された情報を再生された
    アドレス情報に従い記憶するメモリ手段を具備し、再生
    されたアドレス情報に応じて当該メモリ手段からの情報
    読み出しを起動することを特徴とする再生装置。
JP2168514A 1990-06-28 1990-06-28 再生装置 Pending JPH0461670A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2168514A JPH0461670A (ja) 1990-06-28 1990-06-28 再生装置
EP19910305847 EP0468646A3 (en) 1990-06-28 1991-06-27 Reproducing apparatus for temporarily writing reproduced data into memory
EP97203793A EP0833329A3 (en) 1990-06-28 1991-06-27 Reproducing apparatus for temporarily writing reproduced data into memory
US08/261,303 US5483389A (en) 1990-06-28 1994-06-16 Reproducing apparatus for temporarily writing reproducing data into memory

Applications Claiming Priority (1)

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JP2168514A JPH0461670A (ja) 1990-06-28 1990-06-28 再生装置

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US5483389A (en) 1996-01-09
EP0468646A3 (en) 1992-11-04
EP0833329A2 (en) 1998-04-01
EP0833329A3 (en) 1999-09-01
EP0468646A2 (en) 1992-01-29

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