JPH01310589A - 積重基板の表裏導通構造 - Google Patents
積重基板の表裏導通構造Info
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- H01L2924/191—Disposition
- H01L2924/19101—Disposition of discrete passive components
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- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/40—Forming printed elements for providing electric connections to or between printed circuits
- H05K3/4038—Through-connections; Vertical interconnect access [VIA] connections
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- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/46—Manufacturing multilayer circuits
- H05K3/4688—Composite multilayer circuits, i.e. comprising insulating layers having different properties
- H05K3/4691—Rigid-flexible multilayer circuits comprising rigid and flexible layers, e.g. having in the bending regions only flexible layers
Landscapes
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
[産業上の利用分野1
この発明は電子機器の回路基板の高密度実装に関し、詳
しくは厚みの異なる複数枚の配線基板を積重した構造の
表と裏の電極の接続方法に関するものである。
しくは厚みの異なる複数枚の配線基板を積重した構造の
表と裏の電極の接続方法に関するものである。
[発明の概要]
この発明は、硬質の多層印刷配線基板(以下硬質板と略
す)と、薄い可撓性印刷配線基板(フレキシブルプリン
ト基板)、(以下FPCと略す)を張り合せ、かつこの
FPCの表面には複数個の集積回路素子(以下ICと略
す)を実装したいわゆるチップオンボーと称される構造
で、高密度を実現するに際し、硬質板とFPCの間の相
互の接続手段を簡素化するとともに、従来のスルホール
手段に寄因するスペースの必要性及び回路パターンの制
約から解放されることを目的とするもので、そのために
FPCと硬質基板を積重した状態において両者を貫通す
る穴を設け、この穴にワイヤリードを挿通して両者の導
通パターン同士の接続を行うものである。
す)と、薄い可撓性印刷配線基板(フレキシブルプリン
ト基板)、(以下FPCと略す)を張り合せ、かつこの
FPCの表面には複数個の集積回路素子(以下ICと略
す)を実装したいわゆるチップオンボーと称される構造
で、高密度を実現するに際し、硬質板とFPCの間の相
互の接続手段を簡素化するとともに、従来のスルホール
手段に寄因するスペースの必要性及び回路パターンの制
約から解放されることを目的とするもので、そのために
FPCと硬質基板を積重した状態において両者を貫通す
る穴を設け、この穴にワイヤリードを挿通して両者の導
通パターン同士の接続を行うものである。
[従来の技術]
従来の技術で、本発明の提唱する高密度実装の構造を実
現すれば、第2図に示す断面構造となる。この実施の好
例として、ドツトマトリックスの液晶パネルをX−Y方
向に走査する駆動回路のICを、液晶表示部の周辺に設
けたものを引用する0図示の硬質基板1は表示パネル全
体の基台となるもので、外部との接続、表示部との接続
などの機能を備え、これに接着剤3で積重して固着され
たFPC2は、その表面にIC4やその他の電子部品を
搭載し、能動基板としての機能をはたしている。
現すれば、第2図に示す断面構造となる。この実施の好
例として、ドツトマトリックスの液晶パネルをX−Y方
向に走査する駆動回路のICを、液晶表示部の周辺に設
けたものを引用する0図示の硬質基板1は表示パネル全
体の基台となるもので、外部との接続、表示部との接続
などの機能を備え、これに接着剤3で積重して固着され
たFPC2は、その表面にIC4やその他の電子部品を
搭載し、能動基板としての機能をはたしている。
このような構造で課題となる要点を述べると、IC4の
パッド41から、硬質基板1の裏面のパターン11への
接続に際し、パッド41からボンデングワイヤ42でF
PC2の接続パターン21に接続し、次にこの接続パタ
ーン21から硬質基板1の表パターン12との間を接続
&’1122をはんだ付等で接続し、硬質基板1のスル
ホール13により裏パターン11に至っている。このよ
うな構造は硬質板1とFPC2は、その機能故に別個の
工程で製造され、積重された後に接続処理されるためで
、今後とも避けられない手順である。そこでこの構造と
手順のために多くの問題をもっていた。その一つは硬質
基板lは機械的な基台としての機能のためと複雑な配線
処理のため多層構造で硬い厚板となる。この厚板にスル
ホール13を施すにはその深さHと穴径りの比(H/D
ニアスペクト比)を一定に保つため、その板厚に沿っ
た穴径となり、平面的スペースが必要で小型化、高密度
化ができなかった。次に第二点として、FPC2はパッ
ド41を多数持ったIC4の端子を硬質基板1の表パタ
ーン12に導くため接続パターン21を備えているが、
この接続パッド23の位置はFPCの周辺24に限られ
ている。そのため配線は長く浮遊容量は大きくなり、か
つ周辺を確保するため小型化できず問題であった。
パッド41から、硬質基板1の裏面のパターン11への
接続に際し、パッド41からボンデングワイヤ42でF
PC2の接続パターン21に接続し、次にこの接続パタ
ーン21から硬質基板1の表パターン12との間を接続
&’1122をはんだ付等で接続し、硬質基板1のスル
ホール13により裏パターン11に至っている。このよ
うな構造は硬質板1とFPC2は、その機能故に別個の
工程で製造され、積重された後に接続処理されるためで
、今後とも避けられない手順である。そこでこの構造と
手順のために多くの問題をもっていた。その一つは硬質
基板lは機械的な基台としての機能のためと複雑な配線
処理のため多層構造で硬い厚板となる。この厚板にスル
ホール13を施すにはその深さHと穴径りの比(H/D
ニアスペクト比)を一定に保つため、その板厚に沿っ
た穴径となり、平面的スペースが必要で小型化、高密度
化ができなかった。次に第二点として、FPC2はパッ
ド41を多数持ったIC4の端子を硬質基板1の表パタ
ーン12に導くため接続パターン21を備えているが、
この接続パッド23の位置はFPCの周辺24に限られ
ている。そのため配線は長く浮遊容量は大きくなり、か
つ周辺を確保するため小型化できず問題であった。
[発明が解決しようとする課題]
本発明は上述した問題点を解決するため、IC4のパッ
ド41から硬質基板1の裏面のパターン11への接続を
行うに際し、スルホール13及び接続パッド23と接続
!822の各部材を用いることなく接続するものである
。
ド41から硬質基板1の裏面のパターン11への接続を
行うに際し、スルホール13及び接続パッド23と接続
!822の各部材を用いることなく接続するものである
。
[課題を解決するための手段]
本発明は上述した問題となる部材を用いることなく硬質
基板1とそれに積重されたFPC2の両者が接着された
状態において、所定の位置で両者を貫通する穴を設け、
この穴を使ってIC4と裏面のパターン11を接続する
ものである。
基板1とそれに積重されたFPC2の両者が接着された
状態において、所定の位置で両者を貫通する穴を設け、
この穴を使ってIC4と裏面のパターン11を接続する
ものである。
[イ乍用1
本発明は上記した貫通穴の中を、先端が折り返えされた
5字状のワイヤリードを挿通し、折り返久した部分が裏
パターンに引っかけられた状態で接合され、J字状ワイ
ヤリードの上方は貫通穴の上部の接続パターンに接合さ
れる。
5字状のワイヤリードを挿通し、折り返久した部分が裏
パターンに引っかけられた状態で接合され、J字状ワイ
ヤリードの上方は貫通穴の上部の接続パターンに接合さ
れる。
[実施例]
第1図は、本発明による接続を施す回路基板の断面図で
、第2図と共通する部材は同じ符番となっている。硬質
基板1とFPC2は表面にIC4を搭載して接着剤3で
積重されている。ここで硬質基板1の表パターン12と
裏パターン11を接続するスルホール13、硬質基板1
の表パターン12とFPCの接続パッド23とを接続す
る接続線22は従来の構造と同じである。このような構
造の回路基板に対し、本発明の特徴はFPC2の周辺部
24とIC4との間の領域にキリ穴による貫通穴5を設
け、この貫通穴の開口部の上面は接続パターン21のラ
ンド部25があり、下面は裏面のパターン11の裏ラン
ド14がある。これら位置の確保は設計的に定められる
ものであり、貫通穴5の穴径はスルホール13より小径
でたりる。次に本発明の別の特徴は、上記貫通穴5を挿
通して上下面のパッドを導通するワイヤリード51にあ
る。第3図A、B、Cはこのワイヤリード51を接合す
る工程の概略を示す断面図で、ワイヤリード51はその
先端を図示してない整形機により略J字型に折曲され、
同図Aに示すようにガイド穴61から矢示aの方向に挿
通される。次に同図Bに示す矢示すのように上方に引張
るとワイヤリードの先端のあご部52が裏ランド14に
引っかかり位置を定める。このとき下面溶接ヘッド61
がワイヤリード51を裏ランド14に圧接しながら通電
62により両者を接合する。次に同図Cに示すようにガ
イド60が矢示Cの方向に移動しワイヤリード51とラ
ンド部25の位置が定まる。この状態で上面溶接ヘッド
63で両者を圧接し通電64により接合する。そして図
示していないがワイヤリード51は接合部をランド部2
5に残して切断され、第1図に示すワイヤリード51の
状態になる。なお接合の手段について、ここでは加熱ヘ
ッド方式で説明したがこの他の抵抗溶接、パラレルギャ
ップなどでもよい。
、第2図と共通する部材は同じ符番となっている。硬質
基板1とFPC2は表面にIC4を搭載して接着剤3で
積重されている。ここで硬質基板1の表パターン12と
裏パターン11を接続するスルホール13、硬質基板1
の表パターン12とFPCの接続パッド23とを接続す
る接続線22は従来の構造と同じである。このような構
造の回路基板に対し、本発明の特徴はFPC2の周辺部
24とIC4との間の領域にキリ穴による貫通穴5を設
け、この貫通穴の開口部の上面は接続パターン21のラ
ンド部25があり、下面は裏面のパターン11の裏ラン
ド14がある。これら位置の確保は設計的に定められる
ものであり、貫通穴5の穴径はスルホール13より小径
でたりる。次に本発明の別の特徴は、上記貫通穴5を挿
通して上下面のパッドを導通するワイヤリード51にあ
る。第3図A、B、Cはこのワイヤリード51を接合す
る工程の概略を示す断面図で、ワイヤリード51はその
先端を図示してない整形機により略J字型に折曲され、
同図Aに示すようにガイド穴61から矢示aの方向に挿
通される。次に同図Bに示す矢示すのように上方に引張
るとワイヤリードの先端のあご部52が裏ランド14に
引っかかり位置を定める。このとき下面溶接ヘッド61
がワイヤリード51を裏ランド14に圧接しながら通電
62により両者を接合する。次に同図Cに示すようにガ
イド60が矢示Cの方向に移動しワイヤリード51とラ
ンド部25の位置が定まる。この状態で上面溶接ヘッド
63で両者を圧接し通電64により接合する。そして図
示していないがワイヤリード51は接合部をランド部2
5に残して切断され、第1図に示すワイヤリード51の
状態になる。なお接合の手段について、ここでは加熱ヘ
ッド方式で説明したがこの他の抵抗溶接、パラレルギャ
ップなどでもよい。
[発明の効果]
以上述べたように、本発明によればICを搭載したFP
Cの表面と、それと積重した硬質基板の裏面を貫通穴を
介してワイヤリードで導通することにより、 (1)、メツキ工程を要するスルホールを使うことなく
、アスペクト比の大きな小径穴で実現でき小型高密度化
が実現できる。
Cの表面と、それと積重した硬質基板の裏面を貫通穴を
介してワイヤリードで導通することにより、 (1)、メツキ工程を要するスルホールを使うことなく
、アスペクト比の大きな小径穴で実現でき小型高密度化
が実現できる。
(2)、上、下面を接合する位置が限定されることなく
自由度があり設計が容易になる。
自由度があり設計が容易になる。
(3)、ワイヤリードによる上下面の接合で自動化がで
きる。
きる。
などチップオンボードと硬質機能基板を積重する構造の
高密度化に大きな効果を有するものである。
高密度化に大きな効果を有するものである。
第1図は、本発明の主要部を示す断面図。
第2図は、従来の機能基板を示す断面図。
第3図A、B、Cは、本発明のワイヤリードの接合の工
程を示す断面図。 ■・・・硬質基板 2・・・FPC 3・・・接着剤 4・・・ICチップ 5・・・貫通穴 11・・・裏パターン 14・・・裏ランド 21・・・接続パターン 25・・・ランド部 51・・・ワイヤリード 52・・・あご部 60・・・ガイド 61・・・下面溶接ヘッド 以上 出願人 セイコー電子工業株式会社 代理人 弁理士 林 敬 之 肋本4注日月り導
通を示1節面四] Y)2図 △挿通 BTj妾合 C上蒋令
本゛迦明の接合工程6示オ前面図 第3図
程を示す断面図。 ■・・・硬質基板 2・・・FPC 3・・・接着剤 4・・・ICチップ 5・・・貫通穴 11・・・裏パターン 14・・・裏ランド 21・・・接続パターン 25・・・ランド部 51・・・ワイヤリード 52・・・あご部 60・・・ガイド 61・・・下面溶接ヘッド 以上 出願人 セイコー電子工業株式会社 代理人 弁理士 林 敬 之 肋本4注日月り導
通を示1節面四] Y)2図 △挿通 BTj妾合 C上蒋令
本゛迦明の接合工程6示オ前面図 第3図
Claims (1)
- 半導体集積素子を搭載した薄い回路基板と、該薄い回路
基板を接着で積重した比較的厚味のある硬質基板よりな
る積重構造の基板において、前記薄い回路基板の表面の
導電パターンと、前記硬質基板の裏面の導電パターンと
を、前記積重構造を貫通した穴に挿通したワイヤリード
により導通したことを特徴とする積重基板の表裏導通構
造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14116288A JPH01310589A (ja) | 1988-06-08 | 1988-06-08 | 積重基板の表裏導通構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14116288A JPH01310589A (ja) | 1988-06-08 | 1988-06-08 | 積重基板の表裏導通構造 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01310589A true JPH01310589A (ja) | 1989-12-14 |
Family
ID=15285576
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14116288A Pending JPH01310589A (ja) | 1988-06-08 | 1988-06-08 | 積重基板の表裏導通構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01310589A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2001059829A2 (fr) * | 2000-02-10 | 2001-08-16 | Bull S.A. | Procede de montage de circuits integres sur un support conducteur et support en resultant |
JP2007157771A (ja) * | 2005-11-30 | 2007-06-21 | Matsushita Electric Ind Co Ltd | プリント配線基板及びその導通形成方法 |
JP2008536311A (ja) * | 2005-04-08 | 2008-09-04 | マイクロン テクノロジー, インク. | スルーワイヤ相互連結による半導体構成要素製造方法及びシステム |
US9013044B2 (en) | 2005-12-07 | 2015-04-21 | Micron Technology, Inc. | Through wire interconnect (TWI) for semiconductor components having wire in via and bonded connection with substrate contact |
US9018751B2 (en) | 2006-04-24 | 2015-04-28 | Micron Technology, Inc. | Semiconductor module system having encapsulated through wire interconnect (TWI) |
-
1988
- 1988-06-08 JP JP14116288A patent/JPH01310589A/ja active Pending
Cited By (8)
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---|---|---|---|---|
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FR2805083A1 (fr) * | 2000-02-10 | 2001-08-17 | Bull Sa | Procede de montage et de fabrication de circuits integres sur un support et support en resultant |
WO2001059829A3 (fr) * | 2000-02-10 | 2002-03-28 | Bull Sa | Procede de montage de circuits integres sur un support conducteur et support en resultant |
JP2008536311A (ja) * | 2005-04-08 | 2008-09-04 | マイクロン テクノロジー, インク. | スルーワイヤ相互連結による半導体構成要素製造方法及びシステム |
JP4936078B2 (ja) * | 2005-04-08 | 2012-05-23 | マイクロン テクノロジー, インク. | スルーワイヤ相互連結による半導体構成要素製造方法及びシステム |
JP2007157771A (ja) * | 2005-11-30 | 2007-06-21 | Matsushita Electric Ind Co Ltd | プリント配線基板及びその導通形成方法 |
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