JP5057113B2 - 半導体装置および電子部品並びにそれらの製造方法 - Google Patents

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Description

本発明は、半導体装置および電子部品並びにそれらの製造方法に関する。
例えば、液晶表示装置等の電子部品のガラスまたはプラスチック等からなる配線基板に実装される駆動用の半導体装置として、樹脂突起と、その上に形成された複数の配線から構成された外部端子を有する半導体装置が知られている(特許文献1)。このような半導体装置を用いることで、外部端子を配線基板に押し当てて電気的に接続する際、外部端子の樹脂突起の弾性力によって物理的ダメージを回避しながら導通性を確保することができる。
ところで、このような半導体装置の外部端子の配線構造は、互いに異なる金属からなる下地配線と、表層配線の2層構造であること知られている(特許文献1)。
このような配線構造の材料としては、例えば、樹脂突起に直接接する下地配線層には、樹脂材料との密着性の良好な金属材料などを用い、表層配線層には、導電性が良好で耐腐食性や耐酸化性を有する安定的な金属材料を用いることができる。
しかしながら、配線構造内に異なる金属材料を用いることによって、下地配線層と表層配線層との界面領域での金属元素の相互拡散が発生する可能性がある。また、樹脂突起に含まれる水分や酸素などが要因となって、樹脂材料と接触している下地配線層の信頼性を低下させる可能性が指摘される。
特開2005−101527号公報
本発明の様態の1つは、信頼性の高い半導体装置を提供することにある。
本発明の様態の1つは、上記の半導体装置が実装された、信頼性の高い電子部品を提供することにある。
本発明の様態の1つは、信頼性の高い半導体装置の製造方法を提供することにある。
本発明の様態の1つは、信頼性の高い電子部品の製造方法を提供することにある。
(1)本発明の様態の1つである半導体装置は、
第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、
前記半導体基板の前記第1の面の上に設けられた電極と、
前記半導体基板の前記第1の面の上に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、
前記絶縁膜の上に設けられた樹脂突起と、
前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層と、
を有し、
前記配線層は、前記電極および前記樹脂突起の上に形成された第1の導電層と、前記第1の導電層の上に形成された第2の導電層とを有し、
前記第1の導電層は、前記半導体基板側の第1の面と、前記第2の導電層側の第2の面と、を有し、
前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜が形成され、前記第1の導電層の前記第1の面の前記樹脂突起と接触する領域に、下地層が形成される
なお、本発明に係る記載では、「〜の上」という文言を、例えば、「特定のもの(以下「A」という)の「上」に他の特定のもの(以下「B」という)を形成する」などと用いている。本発明に係る記載では、この例のような場合に、A上に直接Bを形成するような場合と、A上に他のものを介してBを形成するような場合とが含まれるものとして、「〜の上」という文言を用いている。同様に、「〜の下」という文言は、A下に直接Bを形成するような場合と、A下に他のものを介してBを形成するような場合とが含まれるものとする。
本発明によれば、第1の導電層と第2の導電層の界面において、第1の導電層の酸化膜または窒化膜からなる中間層が形成される。中間層は、拡散防止層として作用し、第1の導電層と第2の導電層の界面における構成元素の相互拡散を防止することができる。したがって、半導体装置の配線の信頼性を向上することができる。
(2)本発明の様態の1つにおいて、
前記下地層、前記第1の導電層の第2の酸化膜または第2の窒化膜により形成されてもよい。
これによれば、第1の導電層の樹脂突起との接触面において、第1の導電層の酸化膜または窒化膜からなる下地層が形成される。下地層は、第1の導電層を、樹脂突起からの水分による金属腐食や、樹脂突起の酸素、窒素による化学的作用から防ぐことができる。したがって、半導体装置の配線の信頼性を向上することができる。
(3)本発明の様態の1つにおいて、
前記下地層は、前記第1の導電層を形成する前に、前記第1の導電層と同じ材料からなる導電層を形成し、前記導電層を酸素雰囲気または窒素雰囲気において熱処理することにより形成されてもよい。
(4)本発明の様態の1つにおいて、
前記下地層は、酸素雰囲気または窒素雰囲気において前記第1の導電層を熱処理することにより形成されてもよい。
)本発明の様態の1つにおいて、
前記下地層は、前記第1の導電層の前記第1の面の全面に形成されてもよい。
)本発明の様態の1つにおいて、
前記第1の導電層は、チタン、ニッケル、クロム、タングステンのいずれか1つを含み、
前記第2の導電層は、金、白金、銅のいずれか1つを含んでいてもよい。
)本発明の様態の1つである電子部品は、上記いずれかの半導体装置が電気的に接続される。
本発明によれば、信頼性の高い半導体装置が電気的に接続された電子部品を提供することができる。したがって、信頼性の高い電子部品を提供することができる。
)本発明の様態の1つである半導体装置の製造方法は、
第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、前記半導体基板の前記第1の面に設けられた電極と、前記半導体基板の前記第1の面に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、を有する構造体を用意する工程と、
前記絶縁膜の上に樹脂突起を形成する工程と、
前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層を形成する工程と、
を有し、
前記配線層を形成する工程は、
前記電極および前記樹脂突起の上に、前記半導体基板側の第1の面と、前記第1の面と反対側の第2の面と、を有する第1の導電層を形成する工程と、
前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜を形成する工程と、
前記第1の導電層の前記第1の酸化膜または前記第1の窒化膜の上に第2の導電層を形成する工程と、
前記第1の導電層の前記第1の面に、第2の酸化膜または第2の窒化膜を形成する工程と、
を有し、
前記第2の酸化膜または前記第2の窒化膜を形成する工程は、前記第1の導電層を形成する前に、前記第1の導電層と同じ材料からなる導電層を形成し、前記導電層を酸素雰囲気または窒素雰囲気において熱処理する工程を有する
本発明によれば、信頼性の高い半導体装置の製造方法を提供することができる。
また、本発明によれば、第1の導電層と第2の導電層の材料のみでもって、第1の導電層と第2の導電層との界面において拡散防止効果等のバリア効果を有する膜を形成することができる。したがって、生産性の高い半導体装置の製造方法を提供することができる。
本発明の様態の1つである半導体装置の製造方法は、
第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、前記半導体基板の前記第1の面に設けられた電極と、前記半導体基板の前記第1の面に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、を有する構造体を用意する工程と、
前記絶縁膜の上に樹脂突起を形成する工程と、
前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層を形成する工程と、
を有し、
前記配線層を形成する工程は、
前記電極および前記樹脂突起の上に、前記半導体基板側の第1の面と、前記第1の面と反対側の第2の面と、を有する第1の導電層を形成する工程と、
前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜を形成する工程と、
前記第1の導電層の前記第1の酸化膜または前記第1の窒化膜の上に第2の導電層を形成する工程と、
前記第1の導電層の前記第1の面の前記樹脂突起と接触する領域に、前記第1の導電層の第3の酸化膜または第3の窒化膜を形成する工程と、
を、有し、
前記第3の酸化膜または前記第3の窒化膜は、酸素雰囲気または窒素雰囲気において前記第1の導電層を熱処理することにより形成される。
10)本発明の様態の1つである電子部品の製造方法は、
上記いずれかに記載の半導体装置の製造方法によって製造された半導体装置を準備する工程と、
前記半導体装置を配線基板に電気的に接続する工程と、を有する。
本発明によれば、信頼性の高い半導体装置を有する電子部品の製造方法を提供することができる。
本実施形態に係る半導体装置の要部を模式的に示す平面図および断面図。 第1の実施の形態及び第2の実施形態に係る半導体装置の要部の変形例を模式的に示す平面図。 本実施形態に係る半導体装置の製造方法を模式的に示す断面図。 本実施形態に係る半導体装置の製造方法を模式的に示す断面図。 第1の実施の形態に係る半導体装置の製造方法を模式的に示す断面図。 第2の実施の形態に係る半導体装置の製造方法を模式的に示す断面図。 本実施形態に係る電子部品の一例を模式的に示す斜視図。
以下に、本発明を適用した実施形態の一例について図面を参照して説明する。ただし、本発明は以下の実施形態のみに限定されるものではない。本発明は、以下の実施形態およびその変形例を自由に組み合わせたものを含むものとする。
1. 半導体装置
以下、図面を参照して、第1の実施の形態及び第2の実施の形態に係る半導体装置について説明する。
図1(A)は、本実施の形態に係る半導体装置100を模式的に示す平面図である。図1(B)は、図1(A)に示す半導体装置100のIB−IB線の要部を模式的に示す断面図である。半導体装置100の下地層については、第1の実施の形態及び第2の実施の形態の説明において後述する。
半導体基板10は、図1(A)に示すように、チップ状をなしていてもよい。すなわち、半導体基板10は半導体チップであってもよい。あるいは、半導体基板10は、複数の半導体基板10からなるウエハ状をなしていてもよい(図示せず)。例えば、導体基板10は、シリコン基板であってもよい。図示はされないが、半導体基板10には、集積回路が形成される。集積回路の構成は特に限定されないが、例えば、トランジスタ等の能動素子や、抵抗、コイル、コンデンサ等の受動素子を含んでいてもよい。
半導体基板10がチップ状をなす場合、図1(B)に示すように、半導体基板10は、第1の面11と、第1の面11の反対側の面である第2の面12と、を有する。図1(A)および図1(B)に示すように、第1の面11は、複数の外部端子60が形成される面である。
第1の面11の上において外部端子60が形成される領域は特に限定されず、図1(A)に示すように、例えば、第1の面11が長方形をなす場合、第1の面11の長辺に沿って複数設けられていてもよい。また、図示はしないが、第1の面11の短辺(長辺よりも短い辺)に沿って複数設けられていてもよい。また、図示はしないが、外部端子60は、集積回路が形成される領域上に設けられてもよいし、集積回路が形成される領域以外に形成されていてもよい。
図1(A)および図1(B)に示すように、半導体装置100は、第1の面11上に電極14を有する。電極14は、半導体基板10の内部に形成された集積回路と内部配線(図示せず)によって電気的に接続されていてもよい。電極14は、半導体基板10の内部配線の一部であってもよい。
電極14が形成される領域は、第1の面11の上である限り、特に限定されない。電極14は、集積回路が形成される領域の上方に形成されてもよい。または、電極14は、集積回路が形成される領域以外に形成されていてもよい。電極14は、図1(A)に示すように、複数形成されてもよい。また、電極14は、第1の面11の長辺に沿って配置されていてもよい。
電極14の材質は、導電性を有する限り、特に限定されない。例えば、電極14は、アルミニウム(Al)又は銅(Cu)等の金属で形成されていてもよい。電極14は、単層の導電層であってもよいし、アルミニウム等の金属拡散を防止するバリア層を含む、複数の導電層の積層体であってもよい。
図1(B)に示すように、半導体装置100は、絶縁膜16を有する。絶縁膜16はパッシベーション膜であってもよい。絶縁膜16は、第1の面11上で、電極14の少なくとも一部を露出させるように形成されていてもよい。つまりは、絶縁膜16は、電極14の少なくとも一部とオーバーラップする開口部16aを有していてもよい。絶縁膜16は、電気的絶縁性を有する膜であれば、特に限定されない。例えば、絶縁膜16は、SiOやSiN等の無機絶縁膜であってもよい。あるいは、絶縁膜16は、ポリイミド樹脂等の有機絶縁膜であってもよい。
以下において本実施形態にかかる外部端子60について説明する。
図1(B)に示すように、半導体装置100は、絶縁膜16の上に形成された樹脂突起18を有する。樹脂突起18が形成される位置は特に限定されるものではなく、図1(A)に示すように、樹脂突起18は、電極14に隣接して形成される。
樹脂突起18の形状は、特に限定されるものではない。図1(A)に示すように、樹脂突起18は、特定の方向に延びるように形成されていてもよい。また、図1(A)に示すように、樹脂突起18は、例えば、第1の面11の長辺に沿って延びるように形成されていてもよい。
ここで、図1(A)に示すように、樹脂突起18が延びる方向を第1の方向110とし、第1の方向110と直交する方向を第2の方向120とする。
図1(B)に示すように、樹脂突起18の表面は、曲面になっていてもよい。樹脂突起18は、第2の方向120において、図1(B)に示すように、略半円の断面形状を有していてもよい。また、図示はしないが、樹脂突起18の後述される配線層20が形成されない部分において、凹部が形成されていてもよい。凹部の深さは、特に限定されない。これによれば、外部端子の配線間の距離が大きくなり、マイグレーションを防止することができる。また、接着剤を介して、半導体装置を配線基板へ押し当てて実装する際、凹部から不要な接着剤が排出されるため、接着剤の排出性が向上する。
樹脂突起18の材料は特に限定されず、既に公知となっているいずれかの樹脂材料を適用することができる。例えば、樹脂突起18は、公知の感光性樹脂材料から形成されていてもよい。具体的には、樹脂突起18は、ポリイミド樹脂、シリコーン変性ポリイミド樹脂、エポキシ樹脂、シリコーン変性エポキシ樹脂、ベンゾシクロブテン(BCB;benzocyclobutene)、ポリベンゾオキサゾール(PBO;polybenzoxazole)、フェノール樹脂等の樹脂で形成されていてもよい。
図1(A)および図1(B)に示すように、半導体装置100は、電極14と電気的に接続され、一部が樹脂突起18の上に設けられた配線層20を有する。つまりは、図1(A)および図1(B)に示すように、配線層20は、絶縁膜16の開口部16a内の電極14に電気的に接続し、開口部16aから絶縁膜16の上を介して樹脂突起18の上に至るように設けられる。図1(B)に示すように、配線層20は、樹脂突起18の最も厚みのある部分を覆うように形成される。
図1(B)に示すように、配線層20は、第1の導電層21と第2の導電層22とを有する。第1の導電層21は、第2の導電層22と、半導体基板10との間に位置する導電層であって、配線層20の下地配線層であってもよい。第2の導電層22は、第1の導電層21の上に形成される導電層であって、配線層20の表層配線層であってもよい。
ここで、図1(B)に示すように第1の導電層21は、半導体基板10側の第1の面21aと、第2の導電層22側の第2の面21bと、を有する。第1の面21aは、半導体基板10と対向し、例えば、電極14や樹脂突起18と接触する面であってもよい。
第1の導電層21の材料は、樹脂などの材料と密着性の高い導電層材料から形成されていている限り特に限定されない。具体的には、第1の導電層21は、チタン(Ti)、チタンタングステン(TiW)、ニッケル(Ni)、クロム(Cr)およびタングステン(W)などの少なくとも1つを含む層であってもよい。
第2の導電層22の材料は、第1の導電層21よりも高い導電性を有する材料であればよい。また、第2の導電層22の材料は、第1の導電層21の材料よりも、耐腐食性や耐酸化性を有する安定的な金属を用いてもよい。具体的には、第2の導電層22は、金(Au)、白金(Pt)および銅(Cu)などの少なくとも1つを含む層であってもよい。
図1(B)に示すように、配線層20は、第1の導電層21の第2の面21bと第2の導電層22との間に中間層30を有する。中間層30は、第1の導電層21の第2の面21bの全面に形成されていてもよい。
中間層30は、第1の導電層21の酸化膜または窒化膜からなる層である。また、中間層30は、第1の導電層21の酸窒化膜からなる層であってもよい。つまりは、中間層30は、第1の導電層21と第2の導電層22の界面において相互拡散等を防止するバリア層であってもよい。例えば、第1の導電層21が、チタン(Ti)から形成される場合、中間層30は、酸化チタン(TiO)または窒化チタン(TiN)であることができる。また、例えば、第1の導電層21が、クロム(Cr)から形成される場合、中間層30は、酸化クロム(Cr3、CrO3、CrO)または窒化クロム(CrN)であることができる。
中間層30は、第1の導電層21と第2の導電層22との間で、金属元素の相互拡散を防止でき、電極14から第2の導電層への導電性を阻害しない程度の膜厚を有するように形成される。例えば、第1の導電層21の膜厚を、50nm以上、1000nm以下にて形成する場合、中間層30は、5nm以上、100nm以下にて形成すればよい。これによれば、配線層20の良好な導電性と、実装の際の配線層20の変形性を確保しつつ、第1の導電層21と第2の導電層22との間での金属拡散を確実に防ぐことができる。
以上のいずれかの構成によって、外部端子60を有する半導体装置100を構成することができる。
本実施の形態に係る半導体装置100は、例えば、以下の特徴を有する。
本発明によれば、第1の導電層21が第2の導電層22と接触する面である第2の面21bにおいて、第1の導電層の酸化膜または窒化膜からなる中間層30が設けられる。第1の導電層21と第2の導電層22に用いられる金(Au)やチタン(Ti)は、活性の金属元素である。これによれば、中間層30を第1の導電層21と第2の導電層22との間に設けることによって、界面における相互拡散を防止することができる。したがって、経時的に、第1導電層21と第2導電層22との間に、不安定な化合物や固溶体が形成されないため、配線層20の信頼性を向上させることができる。
以上により、信頼性の高い半導体装置100を提供することができる。
(第1の実施の形態
図2において、第1の実施形態に係る半導体装置100の一例を示す。
図2(A)に示すように、第1の導電層21の第1の面21aの、少なくとも樹脂突起18と接触する領域に、下地層31が形成されてい。下地層31は、第1の導電層21の酸化膜または窒化膜からなる層である。つまりは、下地層31は、第1の導電層21の樹脂突起18との接触領域において、樹脂突起18に含まれる水分などによって第1の導電層21が腐食されること等を防止するバリア層であってもよい。下地層31の詳細は、中間層30の説明を適応し、省略する。例えば、中間層30と下地層31は同じ材料で構成されていてもよい。
これによれば、第1の導電層21の樹脂突起18との接触面において、第1の導電層21の酸化膜または窒化膜からなる下地層が形成されるため、樹脂突起18からの水分による経時的な金属腐食や、樹脂突起18の酸素、窒素による経時的な化学的作用から、第1の導電層21を保護することができる。したがって、配線層20の信頼性を更に向上することができる。
(第2の実施の形態
また、図2(B)に示すように、第1の導電層21の第1の面21aの全面に下地層31を形成してもよい。言い換えれば、配線層20の最下層を下地層31としてもよい。
これによれば、第1の導電層21の樹脂突起18との接触面を含む第1の面21aの全面に下地層31が形成されるため、樹脂突起18からの水分による経時的な金属腐食や、樹脂突起18の酸素、窒素による経時的な化学的作用から、第1の導電層21をより確実に保護することができる。したがって、配線層20の信頼性を更に向上することができる。
2. 半導体装置の製造方法
以下、図面を参照して、本実施の形態に係る半導体装置の製造方法について説明する。
図3および図4は、本実施の形態に係る半導体装置の製造方法の一例を模式的に説明する要部の断面図である。半導体装置に下地層を形成する工程については、第1の実施の形態及び第2の実施の形態の説明において後述する。
図3(A)に示すように、第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板10(半導体ウエハまたはチップ)と、半導体基板10の第1の面11に設けられた電極14と、半導体基板10の第1の面11に設けられ、電極14の少なくとも一部とオーバーラップする開口部16aを有する絶縁膜16と、を有する構造体を用意する。図示はされないが、半導体基板10の内部には集積回路が形成されている。半導体基板10、電極14および絶縁膜16との詳細な構成は、上述されているため、省略する。
図3(B)に示すように、電極14および絶縁膜16の上に、樹脂前駆体組成物からなる樹脂材料膜40が形成される。樹脂材料膜40は、熱硬化性を有した熱硬化性樹脂組成物であってもよいし、感光性を有した感光性樹脂組成物であってもよい。以下の本実施の形態では、感光性を有した樹脂材料膜40を用いた場合の製造方法の一例について後述する。
樹脂材料膜40は、半導体装置10の第1の面11の上方において全面的に塗布されて形成されてもよい。また、樹脂材料膜40は、塗布された後、プリベークされてもよい。また、樹脂材料膜40は、例えばシート状物であってもよい。樹脂材料膜40は、ポリイミド樹脂、シリコーン変性ポリイミド樹脂、エポキシ樹脂、シリコーン変性エポキシ樹脂、ベンゾシクロブテン(BCB;benzocyclobutene)、ポリベンゾオキサゾール(PBO;polybenzoxazole)、フェノール樹脂、アクリル樹脂等の樹脂であってもよい。
次に、図3(C)に示すように、樹脂材料膜40を図示しないマスク等の露光装置によって露光した後、現像液によって現像し、パターニングを行って、樹脂層41を形成する。
樹脂層41は、キュアリングの後に樹脂突起18となる樹脂層である。図示はされないが、樹脂層41は、第1の方向110に沿って延びるように形成されてもよい。例えば、半導体基板10の長辺に沿って延びるように形成されてもよい(図1参照)。
本工程における露光現像処理は、公知のフォトリソグラフィー技術を用いることができる。例えば、樹脂材料膜40がポジ型のレジストである場合、マスク(図示せず)は、樹脂突起18が形成される領域において、樹脂材料膜40が露光処理されるように配置される。また、樹脂材料膜40がネガ型のレジストである場合は、樹脂突起18が形成される領域においてマスクが配置されてもよい。マスクは、遮光性を有していればよく、例えば、クロム等の遮光膜が形成されたガラス板であってもよい。マスクが所定配置に配置された後、図示しない光源ランプから例えば紫外線の照射が行われて、露光処理が行われる。現像処理に用いられる現像液は、不要な樹脂層を除去できる公知の現像液であればよく、例えば、有機アルカリ現像液であってもよい。
樹脂突起18を形成する工程は、図3(D)に示すように、樹脂層41を熱処理(キュアリング)することによって、樹脂層41を変形させる工程をさらに含む。
加熱する手段は特に限定されず、図示しない熱源から赤外線を照射することによって加熱してもよい。樹脂層41が加熱されることによって粘性が低下し、樹脂層41の自重と表面張力の作用によって、樹脂層41は形状を変形することができる。その結果、図3(D)に示すように、上面形状が滑らかな曲線を有し、その断面が略半円形状である樹脂突起18が形成される。
次に、図4(A)に示すように、第1の面11の上方にて電極14、絶縁膜16および樹脂突起18を連続して覆う、第1の導電膜50を形成する。第1の導電膜50は、第1の導電層21を構成する導電膜である。従って、第1の導電膜50の材料および構成は、第1の導電膜21の説明を適用し、省略する。第1の導電膜50の成膜方法は特に限定されず、公知の成膜方法を用いることができる。例えば、第1の導電膜50は、スパッタリングにて形成してもよい。
ここで、第1の導電膜50は、第1の導電層21の所望の膜厚よりも厚い膜厚を有するように形成される。つまりは、第1の導電膜50の膜厚は、第1の導電層21と中間層30を合計した膜厚となるように形成される。
次に、図4(B)に示すように、第1の導電膜50の表面を酸化処理または窒化処理することによって、中間膜51を形成する。酸化処理および窒化処理の方法は、特に限定されず、公知の方法を用いることができる。例えば、酸化処理を行う場合は、酸素雰囲気にて第1の導電膜50を熱処理すればよい。また、例えば、窒化処理を行う場合は、窒素雰囲気にて第1の導電膜50を熱処理すればよい。具体的には、酸化処理を行う場合、酸素チャンバー等の中で、窒素、酸素または大気導入を行いながら、例えば、100℃以上、300℃以下の温度範囲で第1の導電膜50を熱処理すればよい。これによって、緻密な酸化膜または窒化膜からなる中間膜51を形成することができる。
また、図4(B)に示すように、第1の導電膜50の表面に、所望の膜厚からなる中間膜51を形成することによって、第1の導電層21の膜厚を有する第1の導電膜50aが形成される。
次に、図4(C)に示すように、中間膜51の上に第2の導電膜52を形成する。第2の導電膜52は、第2の導電層22を構成する導電膜である。従って、第2の導電膜52の材料および構成は、第2の導電膜22の説明を適用し、省略する。第2の導電膜52の成膜方法は特に限定されず、公知の成膜方法を用いることができる。例えば、第2の導電膜52は、スパッタリングにて形成してもよい。
次に、図4(D)に示すように、第2の導電膜52を所望の形状にパターニングし、第2の導電層22を形成する。ここで、第2の導電膜52をパターニングする形状は、配線層20の形状である。
次に、図4(E)に示すように、第2の導電層22をエッチングマスクとして、中間膜51と第1の導電膜50aをパターニングし、第1の導電層21と、第1の導電層21と第2の導電層22との間に設けられた中間層30と、を形成することができる。これによって、図4(E)に示すように、中間層30が、第1の導電層21の第2の面21bの上に形成された半導体装置100を製造することができる。
半導体基板10が半導体ウエハである場合、第1および第2の配線層25、35が形成された後、所望のサイズに切断され、半導体装置100を形成してもよい(図示せず)。
以上のいずれかの構成によって、外部端子60を有する半導体装置100の製造方法を構成することができる。
本実施の形態に係る半導体装置100の製造方法は、例えば、以下の特徴を有する。
本発明によれば、信頼性の高い半導体装置100の製造方法を提供することができる。
また、本発明によれば、第1の導電層21の材料でもって中間層30を形成することができる。これによれば、第1の導電層21の材料以外に、拡散防止効果等を有するバリア層を形成するための材料を用意する必要がない。したがって、生産性の高い、半導体装置の製造方法を提供することができる。
(第1の実施の形態
以下、図面を参照して、第1の実施の形態に係る半導体装置の製造方法について説明する。図5は、第1の実施の形態に係る半導体装置の製造方法を模式的に説明する要部の断面図である。
図5(A)に示すように、電極14、樹脂突起18および絶縁膜16を有した半導体基板10(半導体ウエハまたはチップ)を用意し、電極14、絶縁膜16および樹脂突起18を連続して覆う、第3の導電膜53を形成する。第3の導電膜53の構成および材料は、第1の導電膜51と同じであるため、詳細な説明は省略する。本変形例に係る製造方法においては、第3の導電膜53の膜厚が、中間層30、下地層31および第1導電層21の膜厚の合計した膜厚となるように形成される。
次に、図5(B)に示すように、第3の導電膜53を加熱し、酸化処理または窒化処理することにより、第3の導電膜53の表面に中間膜51を形成する。ここで、図5(B)に示すように、酸素雰囲気または窒素雰囲気において第3の導電層53を熱処理することによって、酸素または窒素を含むことができる樹脂突起18から、第3の導電膜53の樹脂突起18との接触面において、酸化反応または窒化反応を起こすことができる。換言すれば、樹脂突起18内に含まれる酸素または窒素を用いて、第3の導電膜53の樹脂突起18との接触領域の酸化処理または窒化処理を行ってもよい。これによって、第1の導電膜50aの、樹脂突起18との接触する領域において、下地層31を形成することができる。
次に、図示はしないが、本実施形態に係る図4(C)と同様の工程を実施することによって、第2の導電膜52を形成する(図4(C)参照)。
次に、第2の導電膜52を所望の形状にパターニングし、第2の導電層22を形成した後、第2の導電層22をマスクとして、エッチングを行う(図4(D)および図4(E)参照)。これによって、図5(C)に示すように、下地層31が、第1の導電層21の第1の面21aの、樹脂突起18との接触する領域に形成された半導体装置100を製造することができる。
実施の形態によれば、第1の導電層21の第1の面21aの樹脂突起18との接触する領域に、効率的に下地層31を形成することができ、工程の簡便化を図ることができる。
尚、図示はされないが、下地層31の膜厚を有する第3の導電膜53を、樹脂突起18を上のみに形成し、第3の導電膜53を酸化または窒化処理することによって下地層31を第1の導電層21の第1の面21aの樹脂突起18との接触する領域に形成してもよい。
(第2の実施の形態
以下、図面を参照して、第2の実施の形態に係る半導体装置の製造方法について説明する。図6は、第2の実施の形態に係る半導体装置の製造方法を模式的に説明する要部の断面図である。
図6(A)に示すように、電極14、樹脂突起18および絶縁膜16を有した半導体基板10(半導体ウエハまたはチップ)を用意し、電極14、絶縁膜16および樹脂突起18を連続して覆う、第4の導電膜54を形成する。第4の導電膜54の構成および材料は、第1の導電膜51と同じであるため、詳細な説明は省略する。本変形例に係る製造方法においては、第4の導電膜54の膜厚が、下地層31の膜厚となるように形成される。
次に、図6(B)に示すように、第4の導電膜54を全て酸化処理または窒化処理することによって、下地膜55を形成する。酸化処理および窒化処理の方法は、中間膜51の形成方法と同じであるため、詳細な説明は省略する。
次に、図6(C)に示すように、本実施形態に係る図4(A)から図4(C)と同様の工程を実施することによって、下地膜55の上に、第1の導電膜50a、中間膜51、第2の導電膜52を形成する(図4(A)から図4(C)参照)。
次に、第2の導電膜52を所望の形状にパターニングし、第2の導電層22を形成した後、第2の導電層22をマスクとして、エッチングを行う(図4(D)および図4(E)参照)。これによって、図6(D)に示すように、下地層31が、第1の導電層21の第1の面21aの上に形成された半導体装置100を製造することができる。
これによれば、第1の導電層21の樹脂突起18との接触面を含む第1の面21aの全面に下地層31が形成された半導体装置を提供できる。つまりは、樹脂突起18からの水分による経時的な金属腐食や、樹脂突起18の酸素、窒素による経時的な化学的作用から、第1の導電層21が確実に保護された半導体装置の製造方法を提供することができる。したがって、より信頼性の高い半導体装置の製造方法を提供することができる。
3. 電子部品、およびその製造方法
以下、図面を参照して、本実施の形態に係る電子部品、およびその製造方法について説明する。
図7は、本実施の形態に係る電子部品1000が表示デバイスである場合の一例を示す斜視図である。表示デバイスは、例えば液晶表示デバイスやEL(Electrical Luminescence)表示デバイスであってもよい。そして、半導体装置100は、表示デバイスである電子部品1000を制御するドライバICであってもよい。
本実施の形態に係る電子部品1000の製造方法は、半導体装置100を用意することを含む。半導体装置100は、既に上述された、いずれかの構成をなしていればよい。
本実施の形態に係る電子部品1000の製造方法は、配線基板80を用意することを含む。配線基板80は、図7に示すように、半導体装置100が実装される基板であって、配線パターンとベース基板とを含む(図示せず)。
配線パターンは、電気的接続部を有する。電気的接続部は、配線パターンのうち、他の部材との電気的な接続に利用される部分である。配線パターンは、例えば、液晶を駆動する電極(走査電極、信号電極、対向電極等)に電気的に接続されていてもよい。配線パターンは、ITO(Indium Tin Oxide)、アルミニウム(Al)、銅(Cu)、クロム(Cr)、チタン(Ti)、ニッケル(Ni)、チタンタングステン(Ti−W)などの金属膜、金属化合物膜、又は、それらの複合膜によって形成されていてもよい。また、配線パターンは、その一部がベース基板の内側を通るように形成されていてもよい。
ベース基板の、材料または構成は、特に限定されない。例えば、ベース基板の材料は、光透過性を有する無機系の材料であることができる。このとき、ベース基板は、ガラス基板やセラミックス基板であってもよい。ベース基板が、ガラス基板である場合、配線基板80は、電気光学パネル(液晶パネル・エレクトロルミネッセンスパネル等)の一部であってもよい。あるいは、ベース基板は、有機系の材料であってもよく、ポリエチレンテレフタレート(PET)からなる基板又はフィルムであってもよい。あるいは、ベース基板としてポリイミド樹脂からなるフレキシブル基板を使用してもよい。フレキシブル基板としてFPC(Flexible Printed Circuit)や、TAB(Tape Automated Bonding)技術で使用されるテープを使用してもよい。
本実施の形態に係る電子部品1000の製造方法は、半導体装置100を配線基板80に搭載することを含む。本工程によって、半導体装置100の外部端子60と配線パターンの電気的接続部とを接触させて電気的に接続する。これによって、半導体装置100が、配線基板80に電気的に接続される。
半導体装置100を配線基板80に搭載する方法は、外部端子60を、配線基板80の電気的接続部に押し当てることができる限り、特に限定されない。例えば、半導体装置100を配線基板80上方に配置して、半導体装置100の外部端子60と配線基板80の配線パターンとが対向するように位置合わせをする。次に、半導体装置100の第1の面11と、配線基板80との間に接着剤を設ける。接着剤は、予め、配線基板80側に設けておいてもよいが、特に限定されるものではなく、半導体装置100側に設けられていてもよい。接着剤は、例えば、フィルム状の接着剤を利用してもよい。接着剤は、絶縁性の接着剤であってもよい。接着剤は、公知のNCF(Non−conductive Film)接着剤であってもよい。
次に、半導体装置100と配線基板80との間に押圧力を加えることで押圧して、外部端子60と配線パターンとをそれぞれ接触させる。このとき、半導体装置100と配線基板80とによって外部端子60を押圧力によって、弾性変形させることができる。このとき、樹脂突起18の弾性力によって、発生する応力を緩和しつつ、外部端子60と電気的接続部とを押し付けることができるため、半導体装置の信頼性を低下させることなく、電気的な接続信頼性の高い電子部品を提供することができる。
次に、半導体装置100を配線基板80に搭載する工程の後に、接着剤を硬化させて、接着層を形成してもよい。接着層によって、半導体装置100と配線基板80との間隔を維持してもよい。すなわち、接着層によって、樹脂突起18が弾性変形した状態を維持してもよい。
さらに検査工程や切り出し工程等を経て、本実施の形態に係る電子部品1000を製造してもよい。
本実施の形態に係る電子部品1000および電子部品の製造方法は、例えば、以下の特徴を有する。
本実施の形態に係る電子部品1000によれば、信頼性の高い半導体装置100が実装されるため、信頼性の高い電子部品1000を提供することができる。
また、本実施の形態に係る電子部品1000の製造方法によれば、信頼性の高い半導体装置が実装された、信頼性の高い電子部品の製造方法を提供することができる。
上記のように、本発明の実施の形態について詳細に説明したが、本発明の新規事項および効果から実体的に逸脱しない多くの変形が可能であることは、当業者には容易に理解できよう。従って、このような変形例はすべて本発明の範囲に含まれるものとする。
10 半導体基板、11 第1の面、12 第2の面、14 電極、16 絶縁膜、
16a 開口部、18 樹脂突起、20 配線層、21 第1の導電層、
21a 第1の面、21b 第2の面、22 第2の導電層、30 中間層、
31 下地層、40 樹脂材料膜、41 樹脂層、50 第1の導電膜、
50a 第1の導電膜、51 中間膜、52 第2の導電膜、
53 第3の導電膜、54 第4の導電膜、55 下地膜、60 外部端子、
80 配線基板、100 半導体装置、110 第1の方向、120 第2の方向、
1000 電子部品。

Claims (10)

  1. 第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、
    前記半導体基板の前記第1の面の上に設けられた電極と、
    前記半導体基板の前記第1の面の上に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、
    前記絶縁膜の上に設けられた樹脂突起と、
    前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層と、
    を有し、
    前記配線層は、前記電極および前記樹脂突起の上に形成された第1の導電層と、前記第1の導電層の上に形成された第2の導電層とを有し、
    前記第1の導電層は、前記半導体基板側の第1の面と、前記第2の導電層側の第2の面と、を有し、
    前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜が形成され、前記第1の導電層の前記第1の面の前記樹脂突起と接触する領域に、下地層が形成された、半導体装置。
  2. 請求項1において、
    前記下地層、前記第1の導電層の第2の酸化膜または第2の窒化膜により形成される、半導体装置。
  3. 請求項1又は2において、
    前記下地層は、前記第1の導電層を形成する前に、前記第1の導電層と同じ材料からなる導電層を形成し、前記導電層を酸素雰囲気または窒素雰囲気において熱処理することにより形成される、半導体装置。
  4. 請求項1において、
    前記下地層は、酸素雰囲気または窒素雰囲気において前記第1の導電層を熱処理することにより形成される、半導体装置。
  5. 請求項1から3のいずれか1項において、
    前記下地層は、前記第1の導電層の前記第1の面の全面に形成された、半導体装置。
  6. 請求項1から3のいずれか1項において、
    前記第1の導電層は、チタン、ニッケル、クロム、タングステンのいずれか1つを含み、
    前記第2の導電層は、金、白金、銅のいずれか1つを含む、半導体装置。
  7. 請求項1からのいずれか1項に記載の半導体装置が電気的に接続された、電子部品。
  8. 第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、前記半導体基板の前記第1の面に設けられた電極と、前記半導体基板の前記第1の面に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、を有する構造体を用意する工程と、
    前記絶縁膜の上に樹脂突起を形成する工程と、
    前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層を形成する工程と、
    を有し、
    前記配線層を形成する工程は、
    前記電極および前記樹脂突起の上に、前記半導体基板側の第1の面と、前記第1の面と反対側の第2の面と、を有する第1の導電層を形成する工程と、
    前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜を形成する工程と、
    前記第1の導電層の前記第1の酸化膜または前記第1の窒化膜の上に第2の導電層を形成する工程と、
    前記第1の導電層の前記第1の面に、第2の酸化膜または第2の窒化膜を形成する工程と、
    を有し、
    前記第2の酸化膜または前記第2の窒化膜を形成する工程は、前記第1の導電層を形成する前に、前記第1の導電層と同じ材料からなる導電層を形成し、前記導電層を酸素雰囲気または窒素雰囲気において熱処理する工程を有する、半導体装置の製造方法。
  9. 第1の面と、前記第1の面の反対側の第2の面とを有する半導体基板と、前記半導体基板の前記第1の面に設けられた電極と、前記半導体基板の前記第1の面に設けられ、前記電極の少なくとも一部とオーバーラップする開口部を有する絶縁膜と、を有する構造体を用意する工程と、
    前記絶縁膜の上に樹脂突起を形成する工程と、
    前記電極と電気的に接続され、一部が前記樹脂突起の上に設けられた配線層を形成する工程と、
    を有し、
    前記配線層を形成する工程は、
    前記電極および前記樹脂突起の上に、前記半導体基板側の第1の面と、前記第1の面と反対側の第2の面と、を有する第1の導電層を形成する工程と、
    前記第1の導電層の前記第2の面に、前記第1の導電層の第1の酸化膜または第1の窒化膜を形成する工程と、
    前記第1の導電層の前記第1の酸化膜または前記第1の窒化膜の上に第2の導電層を形成する工程と、
    前記第1の導電層の前記第1の面の前記樹脂突起と接触する領域に、前記第1の導電層の第3の酸化膜または第3の窒化膜を形成する工程と、
    を、有し、
    前記第3の酸化膜または前記第3の窒化膜は、酸素雰囲気または窒素雰囲気において前記第1の導電層を熱処理することにより形成される、半導体装置の製造方法。
  10. 請求項8又は9のいずれかに記載の半導体装置の製造方法によって製造された半導体装置を準備する工程と、
    前記半導体装置を配線基板に電気的に接続する工程と、
    を有する、電子部品の製造方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6459690B2 (ja) * 2015-03-25 2019-01-30 セイコーエプソン株式会社 電子部品及びその製造方法
KR20180041296A (ko) * 2016-10-13 2018-04-24 삼성디스플레이 주식회사 표시 패널
KR101897653B1 (ko) * 2017-03-06 2018-09-12 엘비세미콘 주식회사 컴플라이언트 범프의 제조방법
KR102425807B1 (ko) * 2017-09-25 2022-07-28 엘지전자 주식회사 디스플레이 디바이스
KR102414125B1 (ko) * 2020-07-21 2022-06-29 (주)티에스이 연성인쇄회로기판 및 이의 제조방법
KR102358393B1 (ko) * 2020-09-22 2022-02-08 (주)티에스이 연성인쇄회로기판 및 이의 제조방법

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5886724A (ja) * 1981-11-18 1983-05-24 Nec Corp 電極および配線の製造方法
JPH04259242A (ja) 1991-02-14 1992-09-14 Fujitsu Ltd 半導体装置の製造方法
JP2005101527A (ja) 2003-08-21 2005-04-14 Seiko Epson Corp 電子部品の実装構造、電気光学装置、電子機器及び電子部品の実装方法
JP4061506B2 (ja) * 2005-06-21 2008-03-19 セイコーエプソン株式会社 半導体装置の製造方法
JP4235834B2 (ja) * 2005-07-12 2009-03-11 セイコーエプソン株式会社 半導体装置の製造方法
JP4328970B2 (ja) * 2005-08-02 2009-09-09 セイコーエプソン株式会社 半導体装置
JP2008171942A (ja) * 2007-01-10 2008-07-24 Seiko Epson Corp 電子デバイス及びその製造方法
JP2008187021A (ja) * 2007-01-30 2008-08-14 Seiko Epson Corp 半導体装置及び電子デバイス、並びに、それらの製造方法

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