JP4396519B2 - 電源回路及び電源回路の駆動方法 - Google Patents
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Description
TG タイミングジェネレータ
10 カウンタ回路
11、12 インバータ
13、15、19 PMOS
14、16、20 NMOS
17 NAND回路
18 AND回路
R1、R2 抵抗
C1、C2 キャパシタ
D ダイオード
Claims (8)
- 少なくとも一つのキャパシタを備えるチャージポンプ型の電源回路において、
複数のスイッチ手段を有し、前記複数のスイッチ手段を制御して複数の電圧を周期的に切替えて前記キャパシタの一端へ印加する切替手段を備え、
前記切替手段は、前記複数の電圧の何れかが前記キャパシタの一端に印加された直後の電流制限期間においては、当該電圧を抵抗を介して前記キャパシタの一端に印加し、
前記電流制限期間は、前記キャパシタに対する予め定めた印加電圧切替え回数として設定されていることを特徴とする電源回路。 - 前記切替手段は、駆動パルス信号を出力する信号生成手段と、該信号生成手段より出力された駆動パルス信号のパルス数をカウントするカウント手段と、を備え、前記駆動パルス信号に応じて前記複数のスイッチ手段を制御し、前記電流制限期間は前記カウント手段によるカウント数に基づいて設定されることを特徴とする請求項1記載の電源回路。
- 前記電流制限期間は、1msecから30msecの時間を有することを特徴とする請求項1記載の電源回路。
- 前記キャパシタは第1キャパシタ及び第2キャパシタからなり、
前記切替手段は、駆動パルス信号を出力する信号生成手段と、前記信号生成手段より出力される前記駆動パルス信号に応じて前記第1キャパシタの一端に印加する電圧を第1電圧又は第2電圧に切り替える第1切替手段と、前記駆動パルス信号に応じて前記第1キャパシタの他端に第3電圧を印加するか又は前記第2キャパシタの一端を接続するかを切り替える第2切替手段と、前記信号生成手段より出力された駆動パルス信号のパルス数をカウントするカウント手段と、を備え、前記電流制限期間は前記カウント手段によるカウント数に基づいて設定され、該電流制限期間において、少なくとも、前記第1切替手段における前記第1キャパシタの一端への前記第1電圧の印加を前記抵抗を介して行う手段、又は、前記第2切替手段における前記第3電圧の前記第1キャパシタの他端への印加を前記抵抗を介して行う手段、の何れかを備えることを特徴とする請求項1記載の電源回路。 - 少なくとも一つのキャパシタを備え、前記キャパシタの一端へ複数の電圧の何れかを周期的に印加して所定の電圧を生成するチャージポンプ型の電源回路の駆動方法において、
前記キャパシタの一端に前記複数の電圧の何れかが印加された直後の電流制限期間においては、当該電圧を抵抗を介して前記キャパシタの一端に印加するステップと、
前記電流制限期間経過後においては、前記キャパシタの一端に前記複数の電圧の何れかを直接印加するステップと、を含み、
前記電流制限期間は、前記キャパシタに対する予め定めた印加電圧切替え回数として設定することを特徴とする電源回路の駆動方法。 - 前記電圧を前記抵抗を介して前記キャパシタの一端に印加するステップは、駆動パルス信号のパルス数をカウントして前記電流制限期間を設定するステップを含むことを特徴とする請求項5記載の電源回路の駆動方法。
- 前記電流制限期間は、1msecから30msecの時間を有することを特徴とする請求項5記載の電源回路の駆動方法。
- 前記キャパシタは第1キャパシタ及び第2キャパシタからなり、
前記電圧を前記抵抗を介して前記キャパシタの一端に供給するステップは、
駆動パルス信号のパルス数をカウントするステップと、
前記駆動パルス信号に応じて前記第1キャパシタの一端に印加する電圧を第1電圧又は第2電圧に切り替えるステップと、
前記駆動パルス信号に応じて前記第1キャパシタの他端に第3電圧を印加するか又は前記第2キャパシタの一端を接続するかを切り替えるステップと、
前記駆動パルス信号のパルス数をカウントして前記電流制限期間を設定するステップと、
前記電流制限期間中において、少なくとも、前記第1キャパシタの一端へ前記抵抗を介して前記第1電圧の印加を行うステップ、又は、前記第1キャパシタの他端へ前記抵抗を介して前記第3電圧の印加を行うステップ、の何れかを含むことを特徴とする請求項5記載の電源回路の駆動方法。
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