JP4024951B2 - 半導体装置のマイクロコンタクト形成方法 - Google Patents
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Description
【発明の属する技術分野】
本発明は、半導体装置のマイクロコンタクト(microcontact)形成方法に関するものであり、より詳しくは半導体メモリ装置の埋没コンタクト(buried contact)形成時、ストレージノード電極(storage node electrode)の間のブリッジ(bridge)現象を防止する半導体装置のマイクロコンタクト形成方法に関するものである。
【0002】
【従来の技術】
素子が高集積化されることによって、微細パターンのための露光技術が非常に重要視される。一般的に露光技術は、g−line(波長436nm)、i−line(波長365nm)、KrFeximer laser(波長248nm)等、次第に短い波長が使用され、今後は、ArF exmier laser(波長193nm)が有力である。
【0003】
しかし、通常i−lineは0.3μm、KrFは0.15μmを限界で見なすが、0.1μmの小さいパターンを形成することは現実的に不可能である。
【0004】
現在、MLR(Multi Level Resistor)工程で微細なコンタクトを形成しているが、セルのピッチ(cell pitch)を徐々に減らしながら限界解像力(resolution)以上でコンタクト大きさを形成すると、隣接なセルのコンタクトが互いに短絡(short)される現象が発生される。
【0005】
図1乃至図2は、従来の半導体装置のマイクロコンタクト形成方法を順次的に示す断面図である。
【0006】
図1を参照すると、半導体基板10上に活性領域と非活性領域を定義して素子隔離領域12が形成されている。活性領域の半導体基板10上にポリパッド14が形成されているし、ポリパッド14の上部表面が露出されるように1層間絶縁膜16が形成されている。
【0007】
そして、ポリパッド14の間の1層間絶縁膜16上に、即ち非活性領域上にビットライン電極18が形成されている。ビットライン電極18は、キャッピング膜20及びスペーサー21を有し、これらは各々シリコン窒化膜Si3N4で形成されている。
【0008】
この時、ビットライン電極18を含んで1層間絶縁膜16上に他の層間絶縁膜22を形成し、層間絶縁膜16、22をエッチングして活性領域のポリパッド14が露出されるようにコンタクトホール25を形成する。
【0009】
しかし、ビットライン電極18形成とは異なりコンタクトホール25形成において、マスク膜であるフォトレジスト膜パターン24が全てのビットライン電極18上の他の層間絶縁膜22上に形成されないという問題点が発生する。
【0010】
従って、図2に図示されたように、フォトレジスト膜パターン24をマスクとして層間絶縁膜16、22をエッチングした時、コンタクトホール25の間の必要ない他の層間絶縁膜22がエッチングされるという問題点が発生する。
【0011】
従って、コンタクトホール25を充填するようにストレージポリシリコン膜26を形成した時、ブリッジ現象(符号28参照)が発生される。
【0012】
例えば、0.30μmのピッチを有するセルで埋没コンタクトを形成する場合に、埋没コンタクトの大きさが0.20μmなら、コンタクトとコンタクトとの間のスペース(space)が0.1μmしかならないため近接効果によって埋没コンタクト間の短絡が発生する。
【0013】
【発明が解決しようとする課題】
本発明は、上述の諸般問題点を解決するため提案されたものとして、埋没コンタクトの間の短絡が防止でき、マイクロコンタクトを容易に形成できる半導体装置のマイクロコンタクト形成方法を提供することがその目的である。
【0014】
【課題を解決するための手段】
(構成)
上述の目的を達成するための本発明によると、半導体装置のコンタクト形成方法は、下部配線が形成された半導体基板上に第1層間絶縁膜を形成する段階と、第1層間絶縁膜上に導電膜パターンを形成する段階と、導電膜パターンを含んで第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、導電膜パターンとオーバーラップされるように第2層間絶縁間膜上にブロッキングパターン層を形成するが、少なくとも導電膜パターンの幅以上を有するように形成し、第1及び第2層間絶縁膜のエッチング選択比より大きい選択比を有する物質で形成する段階と、ブロッキングパターン層をマスクで使用して第1及び第2層間絶縁膜をエッチングするが、下部配線が露出されるようにエッチングしてコンタクトホールを形成する段階とを含む半導体装置のコンタクト形成方法。
【0015】
この方法の望ましい実施形態において、ブロッキングパターン層は、ポリシリコン膜及びシリコン窒化膜Si3N4のうちのいずれか1つである。
【0016】
この方法の望ましい実施形態において、半導体装置のコンタクト形成方法は、導電膜パターン形成後、導電膜パターンを覆うように保護膜を形成するが、第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階とを付加的に含む。
【0017】
この方法の望ましい実施形態において、保護膜は、導電膜パターン上に形成されたキャッピング膜と、導電膜パターン両側壁に形成されたスペーサーを含む。
【0018】
この方法の望ましい実施形態において、保護膜は、シリコン窒化膜Si3N4である。
【0019】
上述の目的を達成するための本発明によると、半導体装置のコンタクト形成方法は、活性領域と非活性領域が定義された半導体基板の活性領域上にキャパシタコンタクト用パッド電極を形成する段階と、パッド電極を含んで半導体基板上に第1層間絶縁膜を形成する段階と、非活性領域の第1層間絶縁膜上にビットライン電極を形成する段階と、ビットライン電極を覆うように保護膜を形成する段階と、保護膜を含んで第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、ビットライン電極とオーバーラップされるように第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくともビットライン電極の幅以上を有するように形成する段階と、ブロッキングパターン層をマスクで使用して第1及び第2層間絶縁膜をエッチングするが、パッド電極上部表面の一部が露出されるようにエッチングしてコンタクトホールを形成する段階とを含み、保護膜及びブロッキングパターン層は、第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成されてコンタクトホールを自己整列させる。
【0020】
この方法の望ましい実施形態において、ブロッキングパターン層物質は、ポリシリコン膜及びシリコン窒化膜Si3N4のうちのいずれか1つである。
【0021】
この方法の望ましい実施形態において、半導体装置のコンタクト形成方法は、コンタクトホールを導電膜でオーバーフィルさせる段階と、導電膜及びブロッキングパターン層を平坦化エッチングするが、第2層間絶縁膜の上部表面が露出されるようにエッチングしてキャパシタコンタクト用コンタクトプラグを形成する段階とを付加的に含む。
【0022】
上述の目的を達成するための本発明によると、半導体装置のコンタクト形成方法は、下部配線が形成された半導体基板上に第1層間絶縁膜を形成する段階と、第1層間絶縁膜上に導電膜パターンを形成する段階と、導電膜を含んで第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、導電膜パターンとオーバーラップされるように第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくとも導電膜パターンの幅以上を有するように形成し、第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階と、ブロッキングパターン層の間の第2層間絶縁膜の上部表面が露出されるようにフォトレジスト膜パターンを形成するが、オープン領域が少なくとも1つ以上のブロッキングパターン層を含むように形成する段階と、フォトレジスト膜パターン及びブロッキングパターン層をマスクとして使用して第1及び第2層間絶縁膜をエッチングするが、下部配線が露出されるようにエッチングしてコンタクトホールを形成する段階とを含む。
【0023】
この方法の望ましい実施形態において、ブロッキングパターン層は、ポリシリコン膜及びシリコン窒化膜Si3N4のうちのいずれか1つである。
【0024】
この方法の望ましい実施形態において、半導体装置のコンタクト形成方法は、導電膜パターン形成後、導電膜パターンを覆うように保護膜を形成するが、第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階を付加的に含む。
【0025】
この方法の望ましい実施形態において、保護膜は、導電膜パターン上に形成されたキャッピング膜と、導電膜パターン両側壁に形成されたスペーサーを含む。
【0026】
この方法の望ましい実施形態において、保護膜は、シリコン窒化膜Si3N4である。
【0027】
上述の目的を達成するための本発明によると、半導体装置のコンタクト形成方法は、活性領域と非活性領域が定義された半導体基板の活性領域上にキャパシタコンタクト用パッド電極を形成する段階と、パッド電極を含んで半導体基板上に第1層間絶縁膜を形成する段階と、非活性領域の第1層間絶縁膜上にビットライン電極を形成する段階と、ビットライン電極を覆うように保護膜を形成する段階と、保護膜を含んで第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、ビットライン電極とオーバーラップされるように第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくともビットライン電極の幅以上を有するように形成する段階と、ブロッキングパターン層の間の第2層間絶縁膜の上部表面が露出されるようにフォトレジスト膜パターンを形成するがオープン領域が少なくとも1つ以上のブロッキングパターン層を含むように形成する段階と、フォトレジスト膜パターン及びブロッキングパター層をマスクで使用して第1及び第2層間絶縁膜をエッチングするが、導電膜パターン上部表面の一部が露出されるようにエッチングしてコンタクトホールを形成する段階とを含み、保護膜及びブロッキングパターン層は、第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成されてコンタクトホールを自己整列させる。
【0028】
この方法の望ましい実施形態において、ブロッキングパターン層物質は、ポリシリコン膜及びシリコン窒化膜Si3N4のうちのいずれか1つである。
【0029】
この方法の望ましい実施形態において、半導体装置のコンタクト形成方法は、コンタクトホールを導電膜でオーバーフィルさせる段階と、導電膜及びブロッキングパターン層を平坦化エッチングするが、第2層間絶縁膜の上部表面が露出されるようにエッチングしてコンタクトプラグを形成する段階を付加的に含む。
【0030】
(作用)
本発明による半導体出のマイクロコンタクト形成方法は、埋没コンタクトの間の段落を防止し、マイクロコンタクトが容易に形成されるようにする。
【0031】
【発明の実施の形態】
図8を参照すると、本発明の実施形態による新規した半導体装置のマイクロコンタクト形成方法は、下部配線が形成された半導体基板上に第1層間絶縁膜を形成し、第1層間絶縁膜上に導電膜パターンを形成し、導電膜パターンを含んで第1層間絶縁膜上に第2層間絶縁膜を形成する。そして、導電膜パターンとオーバーラッジプされるように第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくとも導電膜パターンの幅以上を有するように形成し、層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する。続いてブロッキングパターン層をマスクとして使用して層間絶縁膜をエッチングするが、下部配線が露出されるようにエッチングしてコンタクトホールを形成する。このような半導体装置のコンタクト形成方法によって、ブロッキングパターン層をマスクとして使用して層間絶縁膜をエッチングすることによって、マスクパターン不良によるコンタクトホール両側の層間絶縁膜のエッチングが防止できることによって、埋没コンタクトの間の段落が防止でき、マイクロコンタクト容易に形成できる。
【0032】
以下、図3から図9までを参照して、本発明の実施の形態を詳細に説明する。
【0033】
図3は、本発明の実施形態による半導体装置のマイクロコンタクト形成のためのマスクレイアウト(mask layout)を示す断面図である。
【0034】
図3を参照すると、符号“50a〜50d”は活性領域と非活性領域を定義してアクチブマスク(active mask)、符号“52a〜52d”はゲート電極マスク(gateelectrode mask)、符号“54a、54b”は、本発明によるブロッキングパターンマスク(blocking pattern mask)を示す。
【0035】
そして、符号“56a〜56d”は、埋没コンタクト形成のための埋没コンタクトエッチングマスク(buried contact etch mask)としてフォトレジスト膜パターンのオープン(open)領域を示し、反対に符号“57”フォトレジスト膜パターンによってカバーされた(covered)領域を示す。
【0036】
この時、オープン領域は図示されたように、隣接なセルを2つずつ縛ってバー形態(bar type)も形成でき、例えばバーを連結してオープン領域“56a”と“56b”を連結し、オープン領域“56c”と“56d”を連結してライン形態(line type)で長く形成することもできる。
【0037】
そして、レイアウト上には図示されなかったが、ブロッキングパターン領域下部にあるビットライン電極マスク(bit line electrode mask)を付加的に含む。
【0038】
図4から図9までは、本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を順次的に示す断面図である。
【0039】
図4を参照すると、本発明の実施の形態によるDRAMのマイクロコンタクト形成方法は、アクティブマスク50a〜50dを使用して半導体基板100上に活性領域と非活性領域を定義して素子隔離領域102を定義して素子隔離領域102を形成する。
【0040】
この時、素子隔離領域102は、ここでSTI(Shallow Trench Isolation)で形成されている。
【0041】
活性領域の半導体基板100上にキャパシタコンタクト用ポリパッド104を形成する。そして、ポリパッド104を含んで半導体基板100上に平坦な上部表面を有するように第1の層間絶縁膜106を形成する。
【0042】
第1の層間絶縁膜106上にビットライン電極マスク(図面に未図示)を使用してビットライン電極108を形成した後、ビットライン電極108を覆うように保護膜110、111を形成する。
【0043】
この時、保護膜110、111は、ビットライン電極108上に形成されたキャッピング膜110及びビットライン電極108の両側壁に形成されたスペーサー111とを含む。
【0044】
キャッピング膜110及びスペーサー111は、各々第1の層間絶縁膜106及び以後蒸着される第2の層間絶縁膜112のエッチング選択比より大きいエッチング選択比を有する物質、例えばシリコン窒化膜Si3N4等で形成される。
【0045】
続いて、半導体基板100全面に平坦な上部表面を有する他の層間絶縁膜112を形成する。
【0046】
図5において、第2の層間絶縁膜112上に層間絶縁膜106、112のエッチング選択比より大きいエッチング選択比を有する物質、例えばポリシリコン膜、又はシリコン窒化膜114を形成する。
【0047】
そして、図6に図示されたように、ブロッキングパターンマスク54a、54bを使用して膜114をエッチングして後続埋没コンタクト形成のための層間絶縁膜106、112のエッチングを容易にするブロッキングパターン層114aを形成する。
【0048】
この時、ブロッキングパターン層114aは、ビットライン電極108とオーバーラップされるように形成されるが、ビットライン電極108の幅以上を有するように形成する。
【0049】
次、図7において、埋没コンタクトエッチングマスク56a〜56dを使用してブロッキングパターン層114aの間の他の層間絶縁膜112の上部表面が露出されるようにフォトレジスト膜パターン116を形成する。
【0050】
この時、フォトレジスト膜パターン116によってオープンされた領域は、埋没コンタクトエッチングマスク56a〜56dに沿って隣接なセルを2つずつ縛ってバー形態(bar type)で形成されるようにでき、バーを連結してライン形態(line type)で長く形成することもできる。
【0051】
この時、図7のSEC A−A’部分は、図3に図示されたA−A’部分の断面構造、即ちバー形態のオープン領域を有する埋没コンタクトエッチングマスクによって形成されたフォトレジスト膜パターン116を示す半導体装置の断面図である。
【0052】
続いて、図8を参照すると、オープン領域の形態によってブロッキングパターン層114a、又はブロッキングパターン層114a及びフォトレジスト膜パターン116をマスクとして使用してポリパッド104の上部表面の一部が露出されるように層間絶縁膜106、112をエッチングしてコンタクトホール117を形成する。
【0053】
言い換えれば、ライン形態の埋没コンタクトエッチングマスクを使用する場合、ブロッキングパターン層114aだけが埋没コンタクト形成部位のビットライン電極108保護のためのエッチング防止膜になり、バー形態の埋没コンタクトエッチングマスクを使用する場合、ブロッキングパターン層114a及びフォトレジスト膜パター116が埋没コンタクト形成部位のビットライン電極108保護のためのエッチング防止膜になる。
【0054】
この時、ブロッキングパター層114aが誤整列(mis−align)されてもビットライン電極108を覆っている窒化膜110、111が層間絶縁膜106、112の大きいエッチング選択比の差によってビットライン電極108が保護され、従ってビットライン電極108とコンタクトホール117を充填して形成されるストレージポリシリコン膜118の段落を防止するようになる。
【0055】
このように、ブロッキングパターン層114aを使用することによって、埋没コンタクト形成のためのフォトレジスト膜パターン116形成時、微細パターン形成に対する限界を克服できる。
【0056】
再び、図8を参照すると、コンタクトホール117をストレージポリシリコン膜118で充填(オーバーフィル:overfill)させる。
【0057】
最後に、他の層間絶縁膜112の上部表面が露出されるようにストレージポリシリコン膜118及びブロッキングパターン層114aをエッチングすると、図9に図示されたように、キャパシタの下部電極と電気的に接続されるコンタクトプラグ118aが形成されて半導体装置のマイクロコンタクトが完成される。
【0058】
【発明の効果】
本発明は、フォトレジスト膜パターンをマスクでコンタクトホールを形成することにおいて、フォトレジスト膜パターン形成限界によって発生されるマスクパターン不良と、これによって必要ない部分の層間絶縁膜のエッチングでコンタクトの間に段落が発生される問題点を解決したことで、埋没コンタクトの間の段落が防止でき、マイクロコンタクトが容易に形成できる。
【図面の簡単な説明】
【図1】 従来の半導体装置のマイクロコンタクト形成方法を順次的に示す断面図である。
【図2】 従来の半導体装置のマイクロコンタクト形成方法を順次的に示す断面図である。
【図3】 本発明の実施の形態による半導体装置のマイクロコンタクト形成のためのマスクレイアウトを示す図面である。
【図4】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【図5】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【図6】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【図7】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【図8】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【図9】 本発明の実施の形態による半導体装置のマイクロコンタクト形成方法を示す断面図である。
【符号の説明】
10、100:半導体基板
12、102:素子隔離領域
14、104:ポリパッド電極
16、22、106、112:層間絶縁膜
18、108:ビットライン
20、110:キャッピング膜
21、111:窒化膜スペーサー
24、116:フォトレジスト膜パターン
25、117:コンタクトホール
26、118:ストレージポリシリコン膜
50a〜50d:アクチブマスク
52a〜52d:ゲート電極マスク
114a:ブロッキング層
118a:コンタクトプラグ
54a、54b:ブロッキングパターンマスク
56a〜56d:埋没コンタクトエッチングマスク
Claims (16)
- 下部配線が形成された半導体基板上に第1層間絶縁膜を形成する段階と、
前記第1層間絶縁膜上に導電膜パターンを形成する段階と、
前記導電膜パターンを含んで前記第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、
前記導電膜パターンとオーバーラップされるように前記第2層間絶縁間膜上にブロッキングパターン層を形成するが、少なくとも前記導電膜パターンの幅以上を有するように形成し、前記第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階と、
前記第2層間絶縁膜の上部表面らを露出させて前記ブロッキングパターン層を横切るバー (BAR) 形態のオープン (OPEN) 領域を持つフォトレジストパターンを前記ブロッキングパターン層の上に形成する段階と、
前記ブロッキングパターン層及び前記フォトレジストパターンをマスクで使用して前記第1及び第2層間絶縁膜をエッチングするが、前記下部配線が露出されるようにエッチングしてコンタクトホールを形成する段階とを含むことを特徴とする半導体装置のコンタクト形成方法。 - 前記ブロッキングパターン層は、ポリシリコン膜及びシリコン窒化膜Si3 N4 のうちのいずれか1つであることを特徴とする請求項1に記載の半導体装置のコンタクト形成方法。
- 前記半導体装置のコンタクト形成方法は、前記導電膜パターン形成後、前記導電膜パターンを覆うように保護膜を形成するが、前記第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階とを付加的に含むことを特徴とする請求項1に記載の半導体装置のコンタクト形成方法。
- 前記保護膜は、前記導電膜パターン上に形成されたキャッピング膜と、
前記導電膜パターン両側壁に形成されたスペーサーを含むことを特徴とする請求項3に記載の半導体装置のコンタクト形成方法。 - 前記保護膜は、シリコン窒化膜Si3 N4であることを特徴とする請求項3に記載の半導体装置のコンタクト形成方法。
- 活性領域と非活性領域が定義された半導体基板の前記活性領域上にキャパシタコンタクト用パッド電極を形成する段階と、
前記パッド電極を含んで前記半導体基板上に第1層間絶縁膜を形成する段階と、
前記活性領域の前記第1層間絶縁膜上にビットライン電極を形成する段階と、
前記ビットライン電極を覆うように保護膜を形成する段階と、
前記保護膜を含んで前記第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、
前記ビットライン電極とオーバーラップされるように前記第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくとも前記ビットライン電極の幅以上を有するように形成する段階と、
前記第2層間絶縁膜の上部表面らを露出させて前記ブロッキングパターン層を横切るバー (BAR) 形態のオープン (OPEN) 領域を持つフォトレジストパターンを前記ブロッキングパターン層の上に形成する段階と、
前記ブロッキングパターン層及び前記フォトレジストパターンをマスクで使用して前記第1層間絶縁膜及び第2層間絶縁膜をエッチングするが、
前記パッド電極上部表面の一部が露出されるようにエッチングしてコンタクトホールを形成する段階とを含み、
前記保護膜及びブロッキングパターン層は、前記第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成されて前記コンタクトホールを自己整列させることを特徴とする半導体装置のコンタクト形成方法。 - 前記ブロッキングパターン層物質は、ポリシリコン膜及びシリコン窒化膜Si3 N4 のうちのいずれか1つであることを特徴とする請求項6に記載の半導体装置のコンタクト形成方法。
- 前記半導体装置のコンタクト形成方法は、前記コンタクトホールを導電膜で充填(オーバーフィル)させる段階と、
前記導電膜及びブロッキングパターン層を平坦化エッチングするが、前記第2層間絶縁膜の上部表面が露出されるようにエッチングしてキャパシタコンタクト用コンタクトプラグを形成する段階とを付加的に含むことを特徴とする請求項6に記載の半導体装置のコンタクト形成方法。 - 下部配線が形成された半導体基板上に第1層間絶縁膜を形成する段階と、
前記第1層間絶縁膜上に導電膜パターンを形成する段階と、
前記導電膜を含んで前記第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、
前記導電膜パターンとオーバーラップされるように第2層間絶縁膜上にブロッキングパターン層を形成するが、
少なくとも前記導電膜パターンの幅以上を有するように形成し、第1層間絶縁膜及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階と、
前記第2層間絶縁膜の上部表面らを露出させて前記ブロッキングパターン層を横切るバー (BAR) 形態のオープン (OPEN) 領域を持つフォトレジストパターンを前記ブロッキングパターン層の上に形成する段階と、
前記ブロッキングパターン層及び前記フォトレジストパターンをマスクとして使用して前記第1層間絶縁膜及び第2層間絶縁膜をエッチングするが、前記下部配線が露出されるようにエッチングしてコンタクトホールを形成する段階とを含むことを特徴とする半導体装置のコンタクト形成方法。 - 前記ブロッキングパターン層は、ポリシリコン膜及びシリコン窒化膜Si3 N4 のうち、ある1つであることを特徴とする請求項9に記載の半導体装置のコンタクト形成方法。
- 前記半導体装置のコンタクト形成方法は、前記導電膜パターン形成後、前記導電膜パターンを覆うように保護膜を形成するが、前記第1層間絶縁膜及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成する段階を付加的に含むことを特徴とする請求項9に記載の半導体装置のコンタクト形成方法。
- 前記保護膜は、前記導電膜パターン上に形成されたキャッピング膜と、
前記導電膜パターン両側壁に形成されたスペーサーを含むことを特徴とする請求項11に記載の半導体装置のコンタクト形成方法。 - 前記保護膜は、シリコン窒化膜Si3N4 であることを特徴とする請求項11に記載の半導体装置のコンタクト形成方法。
- 活性領域と非活性領域が定義された半導体基板の前記活性領域上にキャパシタコンタクト用パッド電極を形成する段階と、
前記パッド電極を含んで前記半導体基板上に第1層間絶縁膜を形成する段階と、
前記非活性領域の前記第1層間絶縁膜上にビットライン電極を形成する段階と、
前記ビットライン電極を覆うように保護膜を形成する段階と、
前記保護膜を含んで前記第1層間絶縁膜上に第2層間絶縁膜を形成する段階と、
前記ビットライン電極とオーバーラップされるように前記第2層間絶縁膜上にブロッキングパターン層を形成するが、少なくとも前記ビットライン電極の幅以上を有するように形成する段階と、
前記第2層間絶縁膜の上部表面らを露出させて前記ブロッキングパターン層を横切るバー (BAR) 形態のオープン (OPEN) 領域を持つフォトレジストパターンを前記ブロッキングパターン層の上に形成する段階と、
前記ブロッキングパターン層及び前記フォトレジストパターンをマスクで使用して前記第1及び第2層間絶縁膜をエッチングするが、前記導電膜パターン上部表面の一部が露出されるようにエッチングしてコンタクトホールを形成する段階とを含み、
前記保護膜及びブロッキングパターン層は、前記第1及び第2層間絶縁膜のエッチング選択比より大きいエッチング選択比を有する物質で形成されて前記コンタクトホールを自己整列させることを特徴とする半導体装置のコンタクト形成方法。 - 前記ブロッキングパターン層物質は、
ポリシリコン膜及びシリコン窒化膜Si3 N4 のうち、ある1であることを特徴とする請求項14に記載の半導体装置のコンタクト形成方法。 - 前記半導体装置のコンタクト形成方法は、前記コンタクトホールを導電膜でオーバーフィルさせる段階と、
前記導電膜及び前記ブロッキングパターン層を平坦化エッチングするが、前記第2層間絶縁膜の上部表面が露出されるようにエッチングしてコンタクトプラグを形成する段階を付加的に含むことを特徴とする請求項14に記載の半導体装置のコンタクト形成方法。
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