JP3907926B2 - Game machine - Google Patents

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Description

【０００１】
【発明の属する技術分野】
本発明は、遊技者の操作に応じて遊技が行われるパチンコ遊技機、コイン遊技機、スロット機等の遊技機に関し、特に、遊技盤における遊技領域において遊技者の操作に応じて遊技が行われる遊技機に関する。
【０００２】
【従来の技術】
遊技機として、遊技球などの遊技媒体を発射装置によって遊技領域に発射し、遊技領域に設けられている入賞口などの入賞領域に遊技媒体が入賞すると、所定個の賞球等の価値が遊技者に払い出されるものがある。遊技媒体の払い出しは払出機構によって行われる。
【０００３】
払出機構は、一般に、払出制御基板に搭載された賞球制御手段によって制御される。遊技の進行は主基板に搭載された遊技制御手段によって制御されるので、入賞にもとづく賞球個数は、遊技制御手段によって決定され、払出制御基板に送信される。
【０００４】
また、遊技者は、遊技媒体を借り出し、借り出した遊技媒体および入賞に応じて払い出された遊技媒体を用いて遊技を行う。その際、遊技者からの遊技媒体貸し要求はカードユニット等の貸出要求処理装置で一旦受け付けられ、遊技機の貸出制御手段は貸出要求処理装置と通信することによって遊技者からの貸出要求を受け付ける。遊技機は、遊技者からの貸出要求に応じて遊技媒体を貸し出すのであるが、賞球制御手段と貸出制御手段とは一体化された払出制御手段で構成されていることが多い。また、一般に、払出制御手段は払出制御マイクロコンピュータを含む構成とされる。
【０００５】
【発明が解決しようとする課題】
遊技機に停電等による電源断状態が発生すると、停電等からの復旧時には、最初の状態（例えば、遊技店においてその日最初に遊技機に電源投入されたときの状態）に戻さざるを得ないので、遊技者に不利益がもたらされる可能性がある。例えば、払出制御手段が貸出要求処理装置を介した貸出要求に対応する全ての遊技媒体の貸出処理を完了していないうちに、停電等による電源断状態が発生すると、電源が復旧したときに、遊技機の状態が初期状態に戻ると貸出遊技媒体の未払出が生じ、遊技者に不利益がもたらされる。また、入賞に応じた賞球払出が完了していないうちに、停電等による電源断状態が発生すると、電源が復旧したときに、遊技機の状態が初期状態に戻ると賞球としての遊技媒体の未払出が生じ、遊技者に不利益がもたらされる。
【０００６】
そのような問題が生じないようにするには、電源の供給が停止する前に、そのときの遊技状態を、遊技機に対する電力供給停止中でも電源バックアップされている記憶手段（バックアップ記憶手段）に保存しておき、記憶手段に遊技状態が保存されている状態で電力供給が再開されたら、保存されている遊技状態にもとづいて遊技を再開するようにすることが考えられる。
【０００７】
しかし、保存されている遊技状態にもとづいて遊技の再開を行うような制御を行うと、遊技機が設置されている遊技店の利便性が損なわれる場合がある。例えば、停電が生じて遊技が続行できなくなった場合に遊技の再開を待たずに遊技の続行をあきらめた遊技者があったときには、他の遊技者が遊技途中の状態から遊技を開始できることになるので、遊技状態を停電前の状態に復旧させることは好ましくない。
【０００８】
そこで、本発明は、遊技機に停電等による電源断状態が発生しても、遊技媒体等の価値払出に関して遊技者に不利益を与えることを防止することができるとともに、遊技店での遊技機運用上の利便性を向上させることもできる遊技機を提供することを目的とする。
【０００９】
【課題を解決するための手段】
本発明による遊技機は、遊技者が所定の遊技を行うことが可能な遊技機であって、制御を行う際に発生する変動データを記憶する遊技制御用変動データ記憶手段を有し、遊技の進行を制御する遊技制御用マイクロコンピュータと、制御を行う際に発生する変動データを記憶する払出制御用変動データ記憶手段を有し、遊技媒体の払出の制御を行う払出制御用マイクロコンピュータと、払出制御用マイクロコンピュータによって制御され、貸出要求に応じた遊技媒体の払出を行う貸出遊技媒体払出機構部と、遊技機への電力供給が停止していても遊技制御用変動データ記憶手段および払出制御用変動データ記憶手段の記憶内容を所定期間保持させることが可能な記憶内容保持手段と、遊技機で使用される所定の電源の状態を監視して電源断の発生を検出したときに検出信号を出力する電源監視手段と、操作に応じて操作信号を出力する初期化操作手段とを含み、遊技制御用マイクロコンピュータは、検出信号の入力に応じて、バックアップフラグを遊技制御用変動データ記憶手段に設定し、かつ、遊技制御用変動データ記憶手段へのアクセスを禁止する遊技制御用電力供給停止時処理を行う遊技制御用電力供給停止時処理手段を含み、電力供給が開始されたときに、初期化操作手段からの操作信号が入力されていないときには、遊技制御用変動データ記憶手段にバックアップフラグが設定されていることを条件に遊技制御用変動データ記憶手段に保存されていた記憶内容にもとづいて制御状態を遊技制御用電力供給停止時処理を開始したときの状態に復旧させる遊技制御用状態復帰制御を行い、電力供給が開始されたときに、遊技制御用変動データ記憶手段にバックアップフラグが設定されていても初期化操作手段からの操作信号が入力されていれば遊技制御用変動データ記憶手段の記憶内容を初期化する処理を行い、遊技制御用マイクロコンピュータが遊技制御用電力供給停止時処理を完了した後に、遊技制御用マイクロコンピュータを動作停止状態とするための信号を出力するリセット手段を備え、払出制御用変動データ記憶手段に記憶される変動データには、貸出要求にもとづいた遊技媒体の払出数のうち払出しが完了していない未払出数を特定可能なデータが含まれており、払出制御用マイクロコンピュータは、検出信号の入力に応じて、未払出数を特定可能なデータを含む制御状態を払出制御用変動データ記憶手段に保存させるための処理である払出制御用電力供給停止時処理を行う払出制御用電力供給停止時処理手段と、初期化操作手段からの操作信号が入力されているか否かを確認する操作信号確認処理を行う操作信号確認処理手段とを含み、操作信号確認処理手段により初期化操作手段からの操作信号が入力されていることが確認されなかったことを条件に、未払出数を特定可能なデータが払出制御用変動データ記憶手段に保存されているときに該未払出数を特定可能なデータにもとづいて遊技媒体の払出制御を再開し、操作信号確認処理手段により初期化操作手段からの操作信号が入力されていることが確認されたときには、払出制御用変動データ記憶手段に記憶内容が保存されていても、該払出制御用変動データ記憶手段の記憶内容を初期化する処理を行い、遊技制御用マイクロコンピュータおよび払出制御用マイクロコンピュータは、初期化操作手段からの操作信号が入力されているか否かを、遊技媒体を検出するための遊技媒体検出手段からの検出出力を判定する遊技媒体検出判定期間よりも短い要求検出判定期間で判定することを特徴とするものである。
【００１０】
払出制御用マイクロコンピュータが所定のデータを取得するための入力ポートが設けられ、初期化操作手段からの操作信号は入力ポートに入力されることが好ましい。また、払出制御用マイクロコンピュータは、電源監視手段が検出信号を出力したときに、遊技媒体検出手段からの検出出力の入力処理を所定期間実行した後、払出制御用電力供給停止時処理を行うように構成されていてもよい。
【００１１】
払出制御用マイクロコンピュータは、出力ポートを介して貸出遊技媒体払出機構部に駆動信号を出力し、電源監視手段が検出信号を出力したときに、出力ポートをオフ状態にした後、遊技媒体検出手段からの検出出力の入力処理を実行するように構成されていてもよい。また、電源監視手段が検出信号を出力した後の、払出制御用マイクロコンピュータによる遊技媒体検出手段からの検出出力の入力処理の実行中に、払出制御用マイクロコンピュータおよび遊技媒体検出手段を駆動可能な電源を供給可能な補助駆動電源供給手段を備えていてもよい。
【００１２】
また、払出制御用マイクロコンピュータによって制御され、入賞に応じて遊技媒体の払出を行う賞遊技媒体払出機構部を備え、払出制御用変動データ記憶手段に記憶される変動データは、入賞に応じて払い出される遊技媒体の払出数のうち賞遊技媒体払出機構部による払出しが完了していない未払出数を特定可能なデータを含む構成とされていてもよい。
【００１３】
遊技媒体検出手段として、賞遊技媒体払出機構部から払い出された遊技媒体を検出する賞遊技媒体検出手段と、貸出遊技媒体払出機構部から払い出された遊技媒体を検出する貸出遊技媒体検出手段とを別個に設けるようにしてもよい。
【００１４】
払出制御用マイクロコンピュータは、払出制御用電力供給停止時処理手段により払出制御用電力供給停止時処理が実行されていることを示す払出制御用情報を払出制御用変動データ記憶手段に保存するとともに、払出制御用変動データ記憶手段の記憶内容が正常か否かの判定に用いる払出制御用チェックデータを作成して払出制御用変動データ記憶手段に保存し、操作信号確認処理手段により初期化操作手段からの操作信号が入力されていることが確認されなかったことを条件に、払出制御用変動データ記憶手段に払出制御用情報が保存されているか否かを確認し、払出制御用変動データ記憶手段に払出制御用情報が保存されていることを確認したことを条件に、払出制御用変動データ記憶手段における払出制御用チェックデータにもとづいて記憶内容が正常か否かの判定を行い、正常と判定したことを条件に、未払出数を特定可能なデータが払出制御用変動データ記憶手段に保存されているときに該未払出数を特定可能なデータにもとづいて遊技媒体の払出制御を再開するように構成されていてもよい。
【００１５】
遊技制御用マイクロコンピュータは、遊技制御用電力供給停止時処理手段により遊技制御用電力供給停止時処理が実行されていることを示す遊技制御用情報を遊技制御用変動データ記憶手段に保存するとともに、遊技制御用変動データ記憶手段の記憶内容が正常か否かの判定に用いる遊技制御用チェックデータを作成して遊技制御用変動データ記憶手段に保存し、初期化操作手段からの操作信号が入力されているか否かを確認する遊技制御側操作信号確認処理を行う遊技制御側操作信号確認処理手段を含み、遊技制御側操作信号確認処理手段により初期化操作手段からの操作信号が入力されていることが確認されなかったことを条件に、遊技制御用変動データ記憶手段に遊技制御用情報が保存されているか否かを確認し、遊技制御用変動データ記憶手段に遊技制御用情報が保存されていることを確認したことを条件に、遊技制御用変動データ記憶手段における遊技制御用チェックデータにもとづいて記憶内容が正常か否かの判定を行い、正常と判定したときに制御状態を遊技制御用電力供給停止時処理を開始したときの状態に復帰させるように構成されていてもよい。
【００１６】
払出制御用マイクロコンピュータは、操作信号確認処理手段により初期化操作手段からの操作信号が入力されているか否かを確認した後に、定期的にタイマ割込が発生するように設定し、定期的に発生するタイマ割込が生じたことにもとづいて遊技媒体の払出の制御を行うための割込処理を実行し、払出制御用電力供給停止時処理にて、割込処理の実行を禁止する割込禁止状態または実行を許可する割込許可状態のうちいずれの状態であるかを示す割込状態データを払出制御用変動データ記憶手段に保存させる処理を実行し、電力供給が開始されたときに、割込状態データにもとづいて割込禁止状態または割込許可状態に復旧させる状態復旧処理を行うように構成されていてもよい。
【００１７】
払出制御用マイクロコンピュータは、遊技制御用マイクロコンピュータから遊技媒体の払出に関するコマンドを受信する処理中では割込処理の実行を禁止する割込禁止状態に設定するように構成されていてもよい。
【００１８】
遊技制御用マイクロコンピュータは、初期化操作手段からの操作信号が入力されているか否かを確認する遊技制御側操作信号確認処理を行う遊技制御側操作信号確認処理手段を含み、遊技制御側操作信号確認処理手段により初期化操作手段からの操作信号が入力されているか否かを確認した後に、定期的にタイマ割込が発生するように設定し、定期的に発生するタイマ割込が生じたことにもとづいて遊技の進行を制御するための割込処理を実行し、遊技制御用電力供給停止時処理にて、割込処理の実行を禁止する割込禁止状態または実行を許可する割込許可状態のうちいずれの状態であるかを示す割込状態データを遊技制御用変動データ記憶手段に保存させる処理を実行し、電力供給が開始されたときに、割込状態データにもとづいて割込禁止状態または割込許可状態に復旧させる状態復旧処理を行うように構成されていてもよい。
【００１９】
【発明の実施の形態】
以下、本発明の一実施形態を図面を参照して説明する。
まず、遊技機の一例であるパチンコ遊技機の全体の構成について説明する。図１はパチンコ遊技機１を正面からみた正面図である。なお、ここでは、遊技機の一例としてパチンコ遊技機を示すが、本発明はパチンコ遊技機に限られず、例えばコイン遊技機やスロット機等であってもよい。
【００２０】
図１に示すように、パチンコ遊技機１は、額縁状に形成されたガラス扉枠２を有する。ガラス扉枠２の下部表面には打球供給皿３がある。打球供給皿３の下部には、打球供給皿３からあふれた遊技球を貯留する余剰玉受皿４と打球を発射する打球操作ハンドル（操作ノブ）５が設けられている。ガラス扉枠２の後方には、遊技盤６が着脱可能に取り付けられている。また、遊技盤６の前面には遊技領域７が設けられている。
【００２１】
遊技領域７の中央付近には、複数種類の図柄を可変表示するための可変表示部（特別図柄表示装置）９と７セグメントＬＥＤによる普通図柄表示器（普通図柄表示装置）１０とを含む可変表示装置８が設けられている。可変表示部９には、例えば「左」、「中」、「右」の３つの図柄表示エリアがある。可変表示装置８の側部には、打球を導く通過ゲート１１が設けられている。通過ゲート１１を通過した打球は、玉出口１３を経て始動入賞口１４の方に導かれる。通過ゲート１１と玉出口１３との間の通路には、通過ゲート１１を通過した打球を検出するゲートスイッチ１２がある。また、始動入賞口１４に入った入賞球は、遊技盤６の背面に導かれ、始動口スイッチ１７によって検出される。また、始動入賞口１４の下部には開閉動作を行う可変入賞球装置１５が設けられている。可変入賞球装置１５は、ソレノイド１６によって開状態とされる。
【００２２】
可変入賞球装置１５の下部には、特定遊技状態（大当り状態）においてソレノイド２１によって開状態とされる開閉板２０が設けられている。この実施の形態では、開閉板２０が大入賞口を開閉する手段となる。開閉板２０から遊技盤６の背面に導かれた入賞球のうち一方（Ｖゾーン）に入った入賞球はＶ入賞スイッチ２２で検出される。また、開閉板２０からの入賞球はカウントスイッチ２３で検出される。可変表示装置８の下部には、始動入賞口１４に入った入賞球数を表示する４個の表示部を有する始動入賞記憶表示器１８が設けられている。この例では、４個を上限として、始動入賞がある毎に、始動入賞記憶表示器１８は点灯している表示部を１つずつ増やす。そして、可変表示部９の可変表示が開始される毎に、点灯している表示部を１つ減らす。
【００２３】
遊技盤６には、複数の入賞口１９，２４が設けられ、遊技球のそれぞれの入賞口１９，２４への入賞は、対応して設けられている入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂによって検出される。遊技領域７の左右周辺には、遊技中に点滅表示される装飾ランプ２５が設けられ、下部には、入賞しなかった打球を吸収するアウト口２６がある。また、遊技領域７の外側の左右上部には、効果音を発する２つのスピーカ２７が設けられている。遊技領域７の外周には、遊技効果ＬＥＤ２８ａおよび遊技効果ランプ２８ｂ，２８ｃが設けられている。
【００２４】
そして、この例では、一方のスピーカ２７の近傍に、賞球残数があるときに点灯する賞球ランプ５１が設けられ、他方のスピーカ２７の近傍に、補給球が切れたときに点灯する球切れランプ５２が設けられている。さらに、図１には、パチンコ遊技機１に隣接して設置され、プリペイドカードが挿入されることによって球貸しを可能にするカードユニット５０も示されている。
【００２５】
カードユニット５０には、使用可能状態であるか否かを示す使用可表示ランプ１５１、カード内に記録された残額情報に端数（１００円未満の数）が存在する場合にその端数を打球供給皿３の近傍に設けられる度数表示ＬＥＤに表示させるための端数表示スイッチ１５２、カードユニット５０がいずれの側のパチンコ遊技機１に対応しているのかを示す連結台方向表示器１５３、カードユニット５０内にカードが投入されていることを示すカード投入表示ランプ１５４、記録媒体としてのカードが挿入されるカード挿入口１５５、およびカード挿入口１５５の裏面に設けられているカードリーダライタの機構を点検する場合にカードユニット５０を解放するためのカードユニット錠１５６が設けられている。
【００２６】
打球発射装置から発射された打球は、打球レールを通って遊技領域７に入り、その後、遊技領域７を下りてくる。打球が通過ゲート１１を通ってゲートスイッチ１２で検出されると、普通図柄表示器１０の表示数字が連続的に変化する状態になる。また、打球が始動入賞口１４に入り始動口スイッチ１７で検出されると、図柄の変動を開始できる状態であれば、可変表示部９内の図柄が回転を始める。図柄の変動を開始できる状態でなければ、始動入賞記憶を１増やす。
【００２７】
可変表示部９内の画像の回転は、一定時間が経過したときに停止する。停止時の画像の組み合わせが大当り図柄の組み合わせであると、大当り遊技状態に移行する。すなわち、開閉板２０が、一定時間経過するまで、または、所定個数（例えば１０個）の打球が入賞するまで開放する。そして、開閉板２０の開放中に打球が特定入賞領域に入賞しＶ入賞スイッチ２２で検出されると、継続権が発生し開閉板２０の開放が再度行われる。継続権の発生は、所定回数（例えば１５ラウンド）許容される。
【００２８】
停止時の可変表示部９内の画像の組み合わせが確率変動を伴う大当り図柄の組み合わせである場合には、次に大当りとなる確率が高くなる。すなわち、高確率状態という遊技者にとってさらに有利な状態となる。また、普通図柄表示器１０における停止図柄が所定の図柄（当り図柄＝小当り図柄）である場合に、可変入賞球装置１５が所定時間だけ開状態になる。さらに、高確率状態では、普通図柄表示器１０における停止図柄が当り図柄になる確率が高められるとともに、可変入賞球装置１５の開放時間と開放回数が高められる。
【００２９】
次に、パチンコ遊技機１の裏面に配置されている各基板について説明する。
図２に示すように、パチンコ遊技機１の裏面では、枠体２Ａ内の機構板の上部に玉貯留タンク３８が設けられ、パチンコ遊技機１が遊技機設置島に設置された状態でその上方から遊技球が球貯留タンク３８に供給される。球貯留タンク３８内の遊技球は、誘導樋３９を通って賞球ケース４０Ａで覆われる球払出装置に至る。
【００３０】
遊技機裏面側では、可変表示部９を制御する可変表示制御ユニット２９、遊技制御用マイクロコンピュータ等が搭載された遊技制御基板（主基板）３１が設置されている。また、球払出制御を行う払出制御用マイクロコンピュータ等が搭載された払出制御基板３７、およびモータの回転力を利用して打球を遊技領域７に発射する打球発射装置が設置されている。さらに、装飾ランプ２５、遊技効果ＬＥＤ２８ａ、遊技効果ランプ２８ｂ，２８ｃ、賞球ランプ５１および球切れランプ５２に信号を送るためのランプ制御基板３５、スピーカ２７からの音声発生を制御するための音声制御基板７０および打球発射装置を制御するための発射制御基板９１も設けられている。なお、払出制御基板３７には、エラー表示用ＬＥＤ３７４も搭載されている。
【００３１】
また、ＤＣ３０Ｖ、ＤＣ２１Ｖ、ＤＣ１２ＶおよびＤＣ５Ｖを作成する電源回路が搭載された電源基板９１０が設けられ、上方には、各種情報を遊技機外部に出力するための各端子を備えたターミナル基板１６０が設置されている。ターミナル基板１６０には、少なくとも、球切れ検出スイッチの出力を導入して外部出力するための球切れ用端子、賞球個数信号を外部出力するための賞球用端子および球貸し個数信号を外部出力するための球貸し用端子が設けられている。また、中央付近には、主基板３１からの各種情報を遊技機外部に出力するための各端子を備えた情報端子盤３４が設置されている。
【００３２】
さらに、図２には、ランプ制御基板３５および音声制御基板７０からの信号を、枠側に設けられている遊技効果ＬＥＤ２８ａ、遊技効果ランプ２８ｂ，２８ｃ、賞球ランプ５１および球切れランプ５２に供給するための電飾中継基板Ａ７７および度数表示ＬＥＤ等を搭載した残高表示基板７４が示されている。また、この実施の形態では、各基板（例えば、主基板３１、払出制御基板３７）に含まれる変動データ記憶手段（例えば、バックアップＲＡＭ）に記憶されたバックアップデータをクリアするためのクリアスイッチ９２１が搭載されたスイッチ基板１９０が設けられている。なお、スイッチ基板１９０には、例えば主基板などの他の基板と接続されるコネクタ（図６、図７参照）が設けられている。さらに、図示はしないが、信号中継の必要に応じて他の中継基板も設けられる。
【００３３】
図３はパチンコ遊技機１の機構板を背面からみた背面図である。球貯留タンク３８に貯留された玉は誘導樋３９を通り、図３に示されるように、球切れ検出器（球切れスイッチ）１８７ａ，１８７ｂを通過して球供給樋１８６ａ，１８６ｂを経て球払出装置９７に至る。球切れスイッチ１８７ａ，１８７ｂは遊技球通路内の遊技球の有無を検出するスイッチであるが、球タンク３８内の補給球の不足を検出する球切れ検出スイッチ１６７も設けられている。以下、球切れスイッチ１８７ａ，１８７ｂを、球切れスイッチ１８７と表現することがある。
【００３４】
球払出装置９７から払い出された遊技球は、連絡口４５を通ってパチンコ遊技機１の前面に設けられている打球供給皿３に供給される。連絡口４５の側方には、パチンコ遊技機１の前面に設けられている余剰玉受皿４に連通する余剰玉通路４６が形成されている。
【００３５】
入賞にもとづく景品球が多数払い出されて打球供給皿３が満杯になり、ついには遊技球が連絡口４５に到達した後さらに遊技球が払い出されると遊技球は、余剰玉通路４６を経て余剰玉受皿４に導かれる。さらに遊技球が払い出されると、感知レバー４７が満タンスイッチ４８を押圧して満タンスイッチ４８がオンする。その状態では、球払出装置９７内のステッピングモータの回転が停止して球払出装置９７の動作が停止するとともに打球発射装置３４の駆動も停止する。
【００３６】
次に、機構板３６に設置されている中間ベースユニットの構成について説明する。中間ベースユニットには、球供給樋１８６ａ，１８６ｂや球払出装置９７が設置される。図４に示すように、中間ベースユニットの上下には連結凹突部１８２が形成されている。連結凹突部１８２は、中間ベースユニットと機構板３６の上部ベースユニットおよび下部ベースユニットを連結固定するものである。
【００３７】
中間ベースユニットの上部には通路体１８４が固定されている。そして、通路体１８４の下部に球払出装置９７が固定されている。通路体１８４は、カーブ樋１７４（図３参照）によって流下方向を左右方向に変換された２列の遊技球を流下させる払出球通路１８６ａ，１８６ｂを有する。払出球通路１８６ａ，１８６ｂの上流側には、球切れスイッチ１８７ａ，１８７ｂが設置されている。球切れスイッチ１８７ａ，１８７ｂは、払出球通路１８６ａ，１８６ｂ内の遊技球の有無を検出するものであって、球切れスイッチ１８７ａ，１８７ｂが遊技球を検出しなくなると球払出装置９７における払出モータ（図４において図示せず）の回転を停止して球払出が不動化される。
【００３８】
なお、球切れスイッチ１８７ａ，１８７ｂは、払出球通路１８６ａ，１８６ｂに２７〜２８個程度の遊技球が存在することを検出できるような位置に係止片１８８によって係止されている。すなわち、球切れスイッチ１８７ａ，１８７ｂは、賞球の一単位の最大払出量（この実施の形態では１５個）および球貸しの一単位の最大払出量（この実施の形態では１００円：２５個）以上が確保されていることが確認できるような位置に設置されている。
【００３９】
通路体１８４の中央部は、内部を流下する遊技球の球圧を弱めるように、左右に湾曲する形状に形成されている。そして、払出球通路１８６ａ，１８６ｂの間に止め穴１８９が形成されている。止め穴１８９の裏面は中間ベースユニットに設けられている取付ボスがはめ込まれる。その状態で止めねじがねじ止めされて、通路体１８４は中間ベースユニットに固定される。なお、ねじ止めされる前に、中間ベースユニットに設けられている係止突片１８５によって通路体１８４の位置合わせを行えるようになっている。
【００４０】
通路体１８４の下方には、球払出装置９７に遊技球を供給するとともに故障時等には球払出装置９７への遊技球の供給を停止する球止め装置１９０が設けられている。球止め装置１９０の下方に設置される球払出装置９７は、直方体状のケース１９８の内部に収納されている。ケース１９８の左右４箇所には突部が設けられている。各突部が中間ベースユニットに設けられている位置決め突片に係った状態で、中間ベースユニットの下部に設けられている弾性係合片にケース１９８の下端がはめ込まれる。
【００４１】
図５は球払出装置９７の分解斜視図である。球払出装置９７の構成および作用について図５を参照して説明する。この実施形態における球払出装置９７は、ステッピングモータ（払出モータ）２８９がスクリュー２８８を回転させることによりパチンコ玉を１個ずつ払い出す。なお、球払出装置９７は、入賞にもとづく景品球だけでなく、貸し出すべき遊技球も払い出す。
【００４２】
図５に示すように、球払出装置９７は、２つのケース１９８ａ，１９８ｂを有する。それぞれのケース１９８ａ，１９８ｂの左右２箇所に、球払出装置９７の設置位置上部に設けられた位置決め突片に当接される係合突部２８０が設けられている。また、それぞれのケース１９８ａ，１９８ｂには、球供給路２８１ａ，２８１ｂが形成されている。球供給路２８１ａ，２８１ｂは湾曲面２８２ａ，２８２ｂを有し、湾曲面２８２ａ，２８２ｂの終端の下方には、球送り水平路２８４ａ，２８４ｂが形成されている。さらに、球送り水平路２８４ａ，２８４ｂの終端に球排出路２８３ａ，２８３ｂが形成されている。
【００４３】
球供給路２８１ａ，２８１ｂ、球送り水平路２８４ａ，２８４ｂ、球排出路２８３ａ，２８３ｂは、ケース１９８ａ，１９８ｂをそれぞれ前後に区画する区画壁２９５ａ，２９５ｂの前方に形成されている。また、区画壁２９５ａ，２９５ｂの前方において、玉圧緩衝部材２８５がケース１９８ａ，１９８ｂ間に挟み込まれる。玉圧緩衝部材２８５は、球払出装置９７に供給される玉を左右側方に振り分けて球供給路２８１ａ，２８１ｂに誘導する。
【００４４】
また、玉圧緩衝部材２８５の下部には、発光素子（ＬＥＤ）２８６と受光素子（図示せず）とによる払出モータ位置センサが設けられている。発光素子２８６と受光素子とは、所定の間隔をあけて設けられている。そして、この間隔内に、スクリュー２８８の先端が挿入されるようになっている。なお、玉圧緩衝部材２８５は、ケース１９８ａ，１９８ｂが張り合わされたときに、完全にその内部に収納固定される。
【００４５】
球送り水平路２８４ａ，２８４ｂには、払出モータ２８９によって回転させられるスクリュー２８８が配置されている。払出モータ２８９はモータ固定板２９０に固定され、モータ固定板２９０は、区画壁２９５ａ，２９５ｂの後方に形成される固定溝２９１ａ，２９１ｂにはめ込まれる。その状態で払出モータ２８９のモータ軸が区画壁２９５ａ，２９５ｂの前方に突出するので、その突出の前方にスクリュー２８８が固定される。スクリュー２８８の外周には、払出モータ２８９の回転によって球送り水平路２８４ａ，２８４ｂに載置された遊技球を前方に移動させるための螺旋突起２８８ａが設けられている。
【００４６】
そして、スクリュー２８８の先端には、発光素子２８６を収納するように凹部が形成され、その凹部の外周には、２つの切欠部２９２が互いに１８０度離れて形成されている。従って、スクリュー２８８が１回転する間に、発光素子２８６からの光は、切欠部２９２を介して受光素子で２回検出される。
【００４７】
つまり、発光素子２８６と受光素子とによる払出モータ位置センサは、スクリュー２８８を定位置で停止するためのものであり、かつ、払出動作が行われた旨を検出するものである。なお、発光素子２８６、受光素子および払出モータ２８９からの配線は、まとめられてケース１９８ａ，１９８ｂの後部下方に形成された引出穴から外部に引き出されコネクタに結線される。
【００４８】
遊技球が球送り水平路２８４ａ，２８４ｂに載置された状態において、払出モータ２８９が回転すると、スクリュー２８８の螺旋突起２８８ａによって、遊技球は、球送り水平路２８４ａ，２８４ｂ上を前方に向かって移動する。そして、遂には、球送り水平路２８４ａ，２８４ｂの終端から球排出路２８３ａ，２８３ｂに落下する。このとき、左右の球送り水平路２８４ａ，２８４ｂからの落下は交互に行われる。すなわち、スクリュー２８８が半回転する毎に一方から１個の遊技球が落下する。従って、１個の遊技球が落下する毎に、発光素子２８６からの光が受光素子によって検出される。
【００４９】
図４に示すように、球払出装置９７の下方には、球振分部材３１１が設けられている。球振分部材３１１は、振分ソレノイド３１０によって駆動される。例えば、ソレノイド３１０のオン時には、球振分部材３１１は右側に倒れ、オフ時には左側に倒れる。振分ソレノイド３１０の下方には、近接スイッチによる賞球カウントスイッチ３０１Ａおよび球貸しカウントスイッチ３０１Ｂが設けられている。入賞にもとづく賞球時には、球振分部材３１１は右側に倒れ、球排出路２８３ａ，２８３ｂからの玉はともに賞球カウントスイッチ３０１Ａを通過する。また、球貸し時には、球振分部材３１１は左側に倒れ、球排出路２８３ａ，２８３ｂからの玉はともに球貸しカウントスイッチ３０１Ｂを通過する。従って、球払出装置９７は、賞球時と球貸し時とで払出流下路を切り替えて、所定数の遊技媒体の払出を行うことができる。
【００５０】
このように、球振分部材３１１を設けることによって、２条の玉流路を落下してきた玉は、賞球カウントスイッチ３０１Ａと球貸しカウントスイッチ３０１Ｂとのうちのいずれか一方しか通過しない。従って、賞球であるのか球貸しであるのかの判断をすることなく、賞球カウントスイッチ３０１Ａと球貸しカウントスイッチ３０１Ｂの検出出力から、直ちに賞球数または球貸し数を把握することができる。
【００５１】
なお、この実施の形態では、電気的駆動源の駆動によって遊技球を払い出す球払出装置として、ステッピングモータの回転によって遊技球が払い出される球払出装置９７を用いることにするが、その他の駆動源によって遊技球を送り出す構造の球払出装置を用いてもよいし、電気的駆動源の駆動によってストッパを外し遊技球の自重によって払い出しがなされる構造の球払出装置を用いてもよい。また、この実施の形態では、球払出装置９７は賞球にもとづく景品球と貸出要求にもとづく貸し球の双方を払い出すが、それぞれについて払出装置が設けられていてもよい。
【００５２】
図６は、スイッチ基板１９０が搭載された遊技盤６を正面からみた例を示す正面図である。図２において、パチンコ遊技機１の裏面にスイッチ基板１９０が搭載された状態の例として、枠体２Ａを含む裏面の状態について説明したが、さらに詳細には、スイッチ基板１９０は、例えば図６に示すように、遊技機１の裏面側の遊技盤６に設置されている。なお、図６には、例えば主基板などの他の基板と接続されるためのコネクタ９２２が開示されている。
【００５３】
図７は、スイッチ基板１９０に搭載されたクリアスイッチ９２１の回路構成の一例を示す回路図である。クリアスイッチ９２１は、本例では、押しボタン構造とされている。クリアスイッチ９２１が押下されていれば（オン状態であれば）、ローレベルのクリアスイッチ信号が出力され、コネクタ９２２を介して例えば主基板３１などの各基板に対して送信される。また、クリアスイッチ９２１が押下されていなければ（オフ状態であれば）、ハイレベルの出力信号が出力される。
【００５４】
図８は、主基板３１における回路構成の一例を示すブロック図である。なお、図８には、払出制御基板３７、ランプ制御基板３５、音声制御基板７０、発射制御基板９１、図柄制御基板８０およびスイッチ基板１９０も示されている。主基板３１には、プログラムに従ってパチンコ遊技機１を制御する基本回路５３と、ゲートスイッチ１２、始動口スイッチ１７、Ｖ入賞スイッチ２２、カウントスイッチ２３、入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂ、満タンスイッチ４８、球切れスイッチ１８７および賞球カウントスイッチ３０１Ａからの信号を基本回路５３に与えるスイッチ回路５８と、可変入賞球装置１５を開閉するソレノイド１６、開閉板２０を開閉するソレノイド２１および大入賞口内の経路を切り換えるためのソレノイド２１Ａを基本回路５３からの指令に従って駆動するソレノイド回路５９とが搭載されている。なお、この実施の形態では、スイッチ回路５８は、スイッチ基板１９０に搭載されたクリアスイッチ９２１からの信号をも基本回路５３に与える。また、図８には示されていないが、カウントスイッチ短絡信号もスイッチ回路５８を介して基本回路５３に伝達される。
【００５５】
また、基本回路５３から与えられるデータに従って、大当りの発生を示す大当り情報、可変表示部９の画像表示開始に利用された始動入賞球の個数を示す有効始動情報、確率変動が生じたことを示す確変情報等の情報出力信号をホールコンピュータ等の外部機器に対して出力する情報出力回路６４が搭載されている。
【００５６】
基本回路５３は、ゲーム制御用のプログラム等を記憶するＲＯＭ５４、ワークメモリとして使用される記憶手段の一例であるＲＡＭ５５、プログラムに従って制御動作を行うＣＰＵ５６およびＩ／Ｏポート部５７を含む。この実施の形態では、ＲＯＭ５４，ＲＡＭ５５はＣＰＵ５６に内蔵されている。すなわち、ＣＰＵ５６は、１チップマイクロコンピュータである。なお、１チップマイクロコンピュータは、少なくともＲＡＭ５５が内蔵されていればよく、ＲＯＭ５４およびＩ／Ｏポート部５７は外付けであっても内蔵されていてもよい。
【００５７】
さらに、主基板３１には、電源投入時に基本回路５３をリセットするためのシステムリセット回路６５が設けられている。
【００５８】
遊技球を打撃して発射する打球発射装置は発射制御基板９１上の回路によって制御される駆動モータ９４で駆動される。そして、駆動モータ９４の駆動力は、操作ノブ５の操作量に従って調整される。すなわち、発射制御基板９１上の回路によって、操作ノブ５の操作量に応じた速度で打球が発射されるように制御される。
【００５９】
なお、この実施の形態では、ランプ制御基板３５に搭載されているランプ制御手段が、遊技盤に設けられている始動記憶表示器１８、ゲート通過記憶表示器４１および装飾ランプ２５の表示制御を行うとともに、枠側に設けられている遊技効果ランプ・ＬＥＤ２８ａ，２８ｂ，２８ｃ、賞球ランプ５１および球切れランプ５２の表示制御を行う。また、特別図柄を可変表示する可変表示部９および普通図柄を可変表示する普通図柄表示器１０の表示制御は、図柄制御基板８０に搭載されている表示制御手段によって行われる。
【００６０】
図９は、払出制御基板３７および球払出装置９７の構成要素などの払出に関連する構成要素を示すブロック図である。図９に示すように、満タンスイッチ４８からの検出信号は、中継基板７１を介して主基板３１のＩ／Ｏポート５７に入力される。満タンスイッチ４８は、余剰球受皿４の満タンを検出するスイッチである。また、球切れスイッチ１８７（１８７ａ，１８７ｂ）からの検出信号も、中継基板７２および中継基板７１を介して主基板３１のＩ／Ｏポート５７に入力される。
【００６１】
主基板３１のＣＰＵ５６は、球切れスイッチ１８７からの検出信号が球切れ状態を示しているか、または、満タンスイッチ４８からの検出信号が満タン状態を示していると、払出禁止を指示する払出制御コマンドを送出する。払出禁止を指示する払出制御コマンドを受信すると、払出制御基板３７の払出制御用ＣＰＵ３７１は球払出処理を停止する。
【００６２】
さらに、賞球カウントスイッチ３０１Ａからの検出信号は、中継基板７２および中継基板７１を介して主基板３１のＩ／Ｏポート５７に入力されるとともに、中継基板７２を介して払出制御基板３７の入力ポート３７２ｂに入力される。賞球カウントスイッチ３０１Ａは、球払出装置９７の払出機構部分に設けられ、実際に払い出された賞球払出球を検出する。
【００６３】
入賞があると、払出制御基板３７には、主基板３１の出力ポート（ポート０，１）５７０，５７１から賞球個数を示す払出制御コマンドが入力される。出力ポート（出力ポート１）５７１は８ビットのデータを出力し、出力ポート５７０は１ビットのストローブ信号（ＩＮＴ信号）を出力する。賞球個数を示す払出制御コマンドは、入力バッファ回路３７３Ａを介してＩ／Ｏポート３７２ａに入力される。ＩＮＴ信号は、入力バッファ回路３７３Ｂを介して払出制御用ＣＰＵ３７１の割込端子に入力されている。払出制御用ＣＰＵ３７１は、Ｉ／Ｏポート３７２ａを介して払出制御コマンドを入力し、払出制御コマンドに応じて球払出装置９７を駆動して賞球払出を行う。
なお、この実施の形態では、払出制御用ＣＰＵ３７１は、１チップマイクロコンピュータであり、少なくともＲＡＭが内蔵されている。
【００６４】
また、主基板３１において、出力ポート５７０，５７１の外側にバッファ回路６２０，６８Ａが設けられている。バッファ回路６２０，６８Ａとして、例えば、汎用のＣＭＯＳ−ＩＣである７４ＨＣ２５０，７４ＨＣ１４が用いられる。このような構成によれば、外部から主基板３１の内部に入力される信号が阻止されるので、払出制御基板３７から主基板３１に信号が与えられる可能性がある信号ラインをさらに確実になくすことができる。なお、バッファ回路６２０，６８Ａの出力側にノイズフィルタを設けてもよい。
【００６５】
払出制御用ＣＰＵ３７１は、出力ポート３７２ｃを介して、貸し球数を示す球貸し個数信号をターミナル基板１６０に出力する。さらに、出力ポート３７２ｄを介して、エラー表示用ＬＥＤ３７４にエラー信号を出力する。
【００６６】
さらに、払出制御基板３７の入力ポート３７２ｂには、中継基板７２を介して球貸しカウントスイッチ３０１Ｂからの検出信号が入力される。球貸しカウントスイッチ３０１Ｂは、球払出装置９７の払出機構部分に設けられ、実際に払い出された貸し球を検出する。払出制御基板３７からの払出モータ２８９への駆動信号はあ、出力ポート３７２ｃおよび中継基板７２を介して球払出装置９７の払出機構部分における払出モータ２８９に伝えられ、振分ソレノイド３１０への駆動信号は、出力ポート３７２ｅおよび中継基板７２を介して球払出装置９７の払出機構部分における振分ソレノイド３１０に伝えられる。
【００６７】
カードユニット５０には、カードユニット制御用マイクロコンピュータが搭載されている。また、カードユニット５０には、端数表示スイッチ１５２、連結台方向表示器１５３、カード投入表示ランプ１５４およびカード挿入口１５５が設けられている（図１参照）。残高表示基板７４には、打球供給皿３の近傍に設けられている度数表示ＬＥＤ、球貸しスイッチおよび返却スイッチが接続される。
【００６８】
残高表示基板７４からカードユニット５０には、遊技者の操作に応じて、球貸しスイッチ信号および返却スイッチ信号が払出制御基板３７を介して与えられる。また、カードユニット５０から残高表示基板７４には、プリペイドカードの残高を示すカード残高表示信号および球貸し可表示信号が払出制御基板３７を介して与えられる。カードユニット５０と払出制御基板３７の間では、接続信号（ＶＬ信号）、ユニット操作信号（ＢＲＤＹ信号）、球貸し要求信号（ＢＲＱ信号）、球貸し完了信号（ＥＸＳ信号）およびパチンコ機動作信号（ＰＲＤＹ信号）が入力ポート３７２ｂおよび出力ポート３７２ｅを介してやりとりされる。
【００６９】
パチンコ遊技機１の電源が投入されると、払出制御基板３７の払出制御用ＣＰＵ３７１は、カードユニット５０にＰＲＤＹ信号を出力する。また、カードユニット制御用マイクロコンピュータは、ＶＬ信号を出力する。払出制御用ＣＰＵ３７１は、ＶＬ信号の入力状態により接続状態／未接続状態を判定する。カードユニット５０においてカードが受け付けられ、球貸しスイッチが操作され球貸しスイッチ信号が入力されると、カードユニット制御用マイクロコンピュータは、払出制御基板３７にＢＲＤＹ信号を出力する。この時点から所定の遅延時間が経過すると、カードユニット制御用マイクロコンピュータは、払出制御基板３７にＢＲＱ信号を出力する。
【００７０】
そして、払出制御基板３７の払出制御用ＣＰＵ３７１は、カードユニット５０に対するＥＸＳ信号を立ち上げ、カードユニット５０からのＢＲＱ信号の立ち下がりを検出すると、払出モータ２８９を駆動し、所定個の貸し球を遊技者に払い出す。このとき、振分ソレノイド３１０は駆動状態とされている。すなわち、球振分部材３１１を球貸し側に向ける。そして、払出が完了したら、払出制御用ＣＰＵ３７１は、カードユニット５０に対するＥＸＳ信号を立ち下げる。その後、カードユニット５０からのＢＲＤＹ信号がオン状態でなければ、賞球払出制御を実行する。
【００７１】
以上のように、カードユニット５０からの信号は全て払出制御基板３７に入力される構成になっている。従って、球貸し制御に関して、カードユニット５０から主基板３１に信号が入力されることはなく、主基板３１の基本回路５３にカードユニット５０の側から不正に信号が入力される余地はない。また、カードユニット５０で用いられる電源電圧ＡＣ２４Ｖは払出制御基板３７から供給される。
【００７２】
なお、この実施の形態では、カードユニット５０が遊技機とは別体として遊技機に隣接して設置されている場合を例にするが、カードユニット５０は遊技機と一体化されていてもよい。また、コイン投入に応じてその金額に応じた遊技球を遊技機が貸し出すように構成した場合でも本発明を適用できる。
【００７３】
図１０は、電源基板９１０の一構成例を示すブロック図である。電源基板９１０は、主基板３１、図柄制御基板８０、音声制御基板７０、ランプ制御基板３５および払出制御基板３７等の電気部品制御基板と独立して設置され、遊技機内の各電気部品制御基板および機構部品が使用する電圧を生成する。この例では、ＡＣ２４Ｖ、ＶSL（ＤＣ＋３０Ｖ）、ＤＣ＋２１Ｖ、ＤＣ＋１２ＶおよびＤＣ＋５Ｖを生成する。また、バックアップ電源となるコンデンサ９１６は、ＤＣ＋５Ｖすなわち各基板上のＩＣ等を駆動する電源のラインから充電される。なお、ＶSLは、整流回路９１２において、整流素子でＡＣ２４Ｖを整流昇圧することによって生成される。ＶSLは、ソレノイド駆動電源となる。
【００７４】
トランス９１１は、交流電源からの交流電圧を２４Ｖに変換する。ＡＣ２４Ｖ電圧は、コネクタ９１５に出力される。また、整流回路９１２は、ＡＣ２４Ｖから＋３０Ｖの直流電圧を生成し、ＤＣ−ＤＣコンバータ９１３およびコネクタ９１５に出力する。ＤＣ−ＤＣコンバータ９１３は、１つまたは複数のコンバータＩＣ９２２（図１０では１つのみを示す。）を有し、ＶSLにもとづいて＋２１Ｖ、＋１２Ｖおよび＋５Ｖを生成してコネクタ９１５に出力する。コンバータＩＣ９２２の入力側には、比較的大容量のコンデンサ９２３が接続されている。従って、外部からの遊技機に対する電力供給が停止したときに、＋３０Ｖ、＋１２Ｖ、＋５Ｖ等の直流電圧は、比較的緩やかに低下する。この結果、コンデンサ９２３は、後述する補助駆動電源の役割を果たす。コネクタ９１５は例えば中継基板に接続され、中継基板から各電気部品制御基板および機構部品に必要な電圧の電力が供給される。
【００７５】
ただし、電源基板９１０に各電気部品制御基板に至る各コネクタを設け、電源基板９１０から、中継基板を介さずにそれぞれの基板に至る各電圧を供給するようにしてもよい。また、図１０には１つのコネクタ９１５が代表して示されているが、コネクタは、各電気部品制御基板対応に設けられている。
【００７６】
ＤＣ−ＤＣコンバータ９１３からの＋５Ｖラインは分岐してバックアップ＋５Ｖラインを形成する。バックアップ＋５Ｖラインとグラウンドレベルとの間には大容量のコンデンサ９１６が接続されている。コンデンサ９１６は、遊技機に対する電力供給が遮断されたときの電気部品制御基板のバックアップＲＡＭ（電源バックアップされているＲＡＭすなわち電力供給停止時にも記憶内容保持状態となりうるバックアップ記憶手段）に対して記憶状態を保持できるように電力を供給するバックアップ電源となる。また、＋５Ｖラインとバックアップ＋５Ｖラインとの間に、逆流防止用のダイオード９１７が挿入される。この実施の形態では、バックアップ用の＋５Ｖは、主基板３１および払出制御基板３７に供給される。
【００７７】
なお、バックアップ電源として、＋５Ｖ電源から充電可能な電池を用いてもよい。電池を用いる場合には、＋５Ｖ電源から電力供給されない状態が所定時間継続すると容量がなくなるような充電池が用いられる。
【００７８】
また、電源基板９１０には、電源監視用ＩＣ９０２が搭載されている。電源監視用ＩＣ９０２は、ＶSL電圧を導入し、ＶSL電圧を監視することによって電源断の発生を検出する。具体的には、ＶSL電圧が所定値（この例では＋２２Ｖ）以下になったら、電源断が生ずるとして電圧低下信号（電源断信号）を出力する。なお、監視対象の電源電圧は、各電気部品制御基板に搭載されている回路素子の電源電圧（この例では＋５Ｖ）よりも高い電圧であることが好ましい。この例では、交流から直流に変換された直後の電圧であるＶSLが用いられている。電源監視用ＩＣ９０２からの電圧低下信号は、主基板３１や払出制御基板３７等に供給される。
【００７９】
電源監視用ＩＣ９０２が電源断を検知するための所定値は、通常時の電圧より低いが、各電気部品制御基板上のＣＰＵが暫くの間動作しうる程度の電圧である。また、電源監視用ＩＣ９０２が、ＣＰＵ等の回路素子を駆動するための電圧（この例では＋５Ｖ）よりも高く、また、交流から直流に変換された直後の電圧を監視するように構成されているので、ＣＰＵが必要とする電圧に対して監視範囲を広げることができる。従って、より精密な監視を行うことができる。さらに、監視電圧としてＶSL（＋３０Ｖ）を用いる場合には、遊技機の各種スイッチに供給される電圧が＋１２Ｖであることから、電源瞬断時のスイッチオン誤検出の防止も期待できる。すなわち、＋３０Ｖ電源の電圧を監視すると、＋３０Ｖ作成の以降に作られる＋１２Ｖが落ち始める以前の段階でそれの低下を検出できる。
【００８０】
よって、＋１２Ｖ電源の電圧が低下するとスイッチ出力がオン状態を呈するようになるが、＋１２Ｖより早く低下する＋３０Ｖ電源電圧を監視して電源断を認識すれば、スイッチ出力がオン状態を呈する前に電源復旧待ちの状態に入ってスイッチ出力を検出しない状態となることができる。
【００８１】
また、電源監視用ＩＣ９０２は、電気部品制御基板とは別個の電源基板９１０に搭載されているので、電源監視回路から複数の電気部品制御基板に電源断信号を供給することができる。電源断信号を必要とする電気部品制御基板が幾つあっても電源監視手段は１つ設けられていればよいので、各電気部品制御基板における各電気部品制御手段が後述する復帰制御を行っても、遊技機のコストはさほど上昇しない。
【００８２】
なお、図１０に示された構成では、電源監視用ＩＣ９０２の検出出力（電源断信号）は、バッファ回路９１８，９１９を介してそれぞれの電気部品制御基板（例えば主基板３１と払出制御基板３７）に伝達されるが、例えば、１つの検出出力を中継基板に伝達し、中継基板から各電気部品制御基板に同じ信号を分配する構成でもよい。また、電源断信号を必要とする基板数に応じたバッファ回路を設けてもよい。
【００８３】
図１１は、主基板３１におけるＣＰＵ５６周りの一構成例を示すブロック図である。図１１に示すように、電源基板９１０の電源監視回路（電源監視手段）からの電源断信号（電圧低下信号）が、ＣＰＵ５６のマスク不能割込端子（ＸＮＭＩ端子）に接続されている。電源監視回路は、遊技機が使用する各種直流電源のうちのいずれかの電源の電圧を監視して電源電圧低下を検出する回路である。この実施の形態では、ＶSLの電源電圧を監視して電圧値が所定値以下になるとローレベルの電源断信号を発生する。ＶSLは、遊技機で使用される直流電圧のうちで最大のものであり、この例では＋３０Ｖである。従って、ＣＰＵ５６は、割込処理によって電源断の発生を確認することができる。
【００８４】
図１１には、システムリセット回路６５も示されている。リセットＩＣ６５１は、電源投入時に、外付けのコンデンサの容量で決まる所定時間だけ出力をローレベルとし、所定時間が経過すると出力をハイレベルにする。すなわち、リセット信号をハイレベルに立ち上げてＣＰＵ５６を動作可能状態にする。また、リセットＩＣ６５１は、電源監視回路が監視する電源電圧と等しい電源電圧であるＶSLの電源電圧を監視して電圧値が所定値（電源監視回路が電源断信号を出力する電源電圧値よりも低い値）以下になると出力をローレベルにする。従って、ＣＰＵ５６は、電源監視回路からの電源断信号に応じて所定の電力供給停止時処理を行った後、システムリセットされる。
【００８５】
図１１に示すように、リセットＩＣ６５１からのリセット信号は、ＮＡＮＤ回路９４７に入力されるとともに、反転回路（ＮＯＴ回路）９４４を介してカウンタＩＣ９４１のクリア端子に入力される。カウンタＩＣ９４１は、クリア端子への入力がローレベルになると、発振器９４３からのクロック信号をカウントする。そして、カウンタＩＣ９４１のＱ５出力がＮＯＴ回路９４５，９４６を介してＮＡＮＤ回路９４７に入力される。また、カウンタＩＣ９４１のＱ６出力は、フリップフロップ（ＦＦ）９４２のクロック端子に入力される。フリップフロップ９４２のＤ入力はハイレベルに固定され、Ｑ出力は論理和回路（ＯＲ回路）９４９に入力される。ＯＲ回路９４９の他方の入力には、ＮＡＮＤ回路９４７の出力がＮＯＴ回路９４８を介して導入される。そして、ＯＲ回路９４９の出力がＣＰＵ５６のリセット端子に接続されている。このような構成によれば、電源投入時に、ＣＰＵ５６のリセット端子に２回のリセット信号（ローレベル信号）が与えられるので、ＣＰＵ５６は、確実に動作を開始する。
【００８６】
そして、例えば、電源監視回路の検出電圧（電源断信号を出力することになる電圧）を＋２２Ｖとし、リセット信号をローレベルにするための検出電圧を＋９Ｖとする。そのように構成した場合には、電源監視回路とシステムリセット回路６５とが、同一の電源ＶSLの電圧を監視するので、電圧監視回路が電源断信号を出力するタイミングとシステムリセット回路６５がシステムリセット信号を出力するタイミングの差を所望の所定期間に確実に設定することができる。所望の所定期間とは、電源監視回路からの電源断信号に応じて電力供給停止時処理を開始してから電力供給停止時処理が確実に完了するまでの期間である。
【００８７】
ＣＰＵ５６等の駆動電源である＋５Ｖ電源から電力が供給されていない間、ＲＡＭの少なくとも一部は、電源基板から供給されるバックアップ電源によってバックアップされ、遊技機に対する電源が断しても内容は保存される。そして、＋５Ｖ電源が復旧すると、システムリセット回路６５からリセット信号が発せられるので、ＣＰＵ５６は、通常の動作状態に復帰する。そのとき、必要なデータがバックアップＲＡＭに保存されているので、停電等からの復旧時に停電発生時の遊技状態に復帰することができる。
【００８８】
なお、図１１に示す構成では、電源投入時にＣＰＵ５６のリセット端子に２回のリセット信号（ローレベル信号）が与えられるが、リセット信号の立ち上がりタイミングが１回しかなくても確実にリセット解除されるＣＰＵを使用する場合には、符号９４１〜９４９で示された回路素子は不要である。その場合、リセットＩＣ６５１の出力がそのままＣＰＵ５６のリセット端子に接続される。
【００８９】
この実施の形態で用いられるＣＰＵ５６は、Ｉ／Ｏポート（ＰＩＯ）およびタイマ／カウンタ回路（ＣＴＣ）も内蔵している。ＰＩＯは、ＰＢ０〜ＰＢ３の４ビットおよびＰＡ０〜ＰＡ７の１バイトのポートを有する。ＰＢ０〜ＰＢ３およびＰＡ０〜ＰＡ７のポートは、入力／出力いずれにも設定できる。
【００９０】
また、図１１に示すように、スイッチ基板１９０に搭載されたクリアスイッチ９２１の出力信号が、論理を反転させるバッファ回路５７８Ａ、および入力ポート５７８を介して入力される。なお、入力ポート５７８には、バッファ回路５７８Ａを介して、Ｖ入賞スイッチ２２などの他の各スイッチの出力信号も入力されている。このような構成によれば、クリアスイッチ９２１の切換により出力信号がクリアスイッチ信号（ローレベル信号）とされていると、クリアスイッチ信号が反転（なお、バッファ回路５７８Ａがクリアスイッチ信号を反転して出力した信号を、クリアスイッチ信号と呼ぶことがある。）されてＣＰＵ５６に与えられるので、ＣＰＵ５６により変動データ記憶手段の記憶内容が初期データとされる処理が行われるが、その詳細は後述する。このように、クリアスイッチ９２１の出力信号が入力ポート５７８を介して入力するようにしているので、簡単な構成でクリアスイッチ信号を導入することが可能となる。
【００９１】
図１２は、この実施の形態における入力ポートのビット割り当てを示す説明図である。図１２に示すように、入力ポート０のビット０〜７には、それぞれ、入賞口スイッチ２４ａ、入賞口スイッチ２４ｂ、入賞口スイッチ１９ａ、入賞口スイッチ１９ｂ、始動口スイッチ１７、カウントスイッチ２３、Ｖ入賞スイッチ（特定領域スイッチ）２２、ゲートスイッチ１２の検出信号が入力される。また、入力ポート１のビット０〜４には、それぞれ、賞球カウントスイッチ３０１Ａ、満タンスイッチ４８、球切れスイッチ１８７の検出信号、カウントスイッチ短絡信号、クリアスイッチ９２１の出力信号が入力される。
【００９２】
次に遊技機の動作について説明する。
図１３は、主基板３１におけるＣＰＵ５６が実行するメイン処理を示すフローチャートである。遊技機に対する電源が投入されると、メイン処理において、ＣＰＵ５６は、まず、必要な初期設定を行う。
【００９３】
初期設定処理において、ＣＰＵ５６は、まず、割込禁止に設定する（ステップＳ１）。次に、割込モードを割込モード２に設定し（ステップＳ２）、スタックポインタにスタックポインタ指定アドレスを設定する（ステップＳ３）。そして、内蔵デバイスレジスタの初期化を行う（ステップＳ４）。また、内蔵デバイス（内蔵周辺回路）であるＣＴＣ（カウンタ／タイマ）およびＰＩＯ（パラレル入出力ポート）の初期化（ステップＳ５）を行った後、ＲＡＭをアクセス可能状態に設定する（ステップＳ６）。
【００９４】
この実施の形態で用いられているＣＰＵ５６には、マスク可能な割込（ＩＮＴ）のモードとして以下の３種類のモードが用意されている。なお、マスク可能な割込が発生すると、ＣＰＵ５６は、自動的に割込禁止状態に設定するとともに、プログラムカウンタの内容をスタックにセーブする。
【００９５】
割込モード０：割込要求を行った内蔵デバイスがＲＳＴ命令（１バイト）またはＣＡＬＬ命令（３バイト）をＣＰＵの内部データバス上に送出する。よって、ＣＰＵ５６は、ＲＳＴ命令に対応したアドレスまたはＣＡＬＬ命令で指定されるアドレスの命令を実行する。リセット時に、ＣＰＵ５６は自動的に割込モード０になる。よって、割込モード１または割込モード２に設定したい場合には、初期設定処理において、割込モード１または割込モード２に設定するための処理を行う必要がある。
【００９６】
割込モード１：割込が受け付けられると、常に００３８（ｈ）番地に飛ぶモードである。
【００９７】
割込モード２：ＣＰＵ５６の特定レジスタ（Ｉレジスタ）の値（１バイト）と内蔵デバイスが出力する割込ベクタ（１バイト：最下位ビット０）から合成されるアドレスが、割込番地を示すモードである。すなわち、割込番地は、上位アドレスが特定レジスタの値とされ下位アドレスが割込ベクタとされた２バイトで示されるアドレスである。従って、任意の（飛び飛びではあるが）偶数番地に割込処理を設置することができる。各内蔵デバイスは割込要求を行うときに割込ベクタを送出する機能を有している。
【００９８】
よって、割込モード２に設定されると、各内蔵デバイスからの割込要求を容易に処理することが可能になり、また、プログラムにおける任意の位置に割込処理を設置することが可能になる。さらに、割込モード１とは異なり、割込発生要因毎のそれぞれの割込処理を用意しておくことも容易である。上述したように、この実施の形態では、初期設定処理のステップＳ２において、ＣＰＵ５６は割込モード２に設定される。
【００９９】
次いで、ＣＰＵ５６は、入力ポート５７８を介して入力されるクリアスイッチ９２１の出力信号の状態を、本例では１回だけ確認する（ステップＳ７）。クリアスイッチ９２１がオンである場合（押下されている場合）には、ローレベルのクリアスイッチ信号が出力されている。従って、ＣＰＵ５６は、クリアスイッチ９２１がオンとされていれば、通常の初期化処理を実行する（ステップＳ１１〜ステップＳ１５）。クリアスイッチ９２１のオン判定は、初期設定を行う前に実行することが好ましい。遊技機の起動に先立ってバックアップ記憶（最終記憶内容）の消去の意思を確認したのちに制御を再開することができるからである。この様な場合、初期設定を行う前に、タイマ処理やスイッチ入力判定（複数回）を行うと、バックアップ内容を壊す可能性がある。また、遊技中のパチンコ遊技機の裏側には、遊技球が流動しておりノイズが発生しやすく、このため、通常スイッチ検出は複数回入力判定を行うが、クリアスイッチ９２１のオン判定は、遊技開始前に行われるため、ノイズの影響を受けにくい。従って、クリアスイッチ９２１入力判定を１回のみとしても、ノイズの影響は受け難く、また、プログラム開発効率も上がる。なお、クリアスイッチ９２１が確実に操作されたか否かを重視する場合には、ＣＰＵ５６がクリアスイッチ９２１の出力信号の状態を例えば３秒間確認する構成としてもよい。
【０１００】
クリアスイッチ９２１がオンの状態でなければ（押下されていない状態）、ＣＰＵ５６は、電源断時にバックアップＲＡＭ領域のデータ保護処理（例えばパリティデータの付加等の停電発生ＮＭＩ処理）が行われたか否か確認する（ステップＳ８）。この実施の形態では、不測の電源断が生じた場合には、バックアップＲＡＭ領域のデータを保護するための処理が行われている。そのような保護処理が行われていた場合をバックアップありとする。バックアップなしを確認したら、ＣＰＵ５６は初期化処理を実行する。
【０１０１】
この実施の形態では、バックアップＲＡＭ領域にバックアップデータがあるか否かは、電源断時にバックアップＲＡＭ領域に設定されるバックアップフラグの状態によって確認される。この例では、図１４に示すように、バックアップフラグ領域に「５５Ｈ」が設定されていればバックアップあり（オン状態）を意味し、「５５Ｈ」以外の値が設定されていればバックアップなし（オフ状態）を意味する。
【０１０２】
バックアップありを確認したら、ＣＰＵ５６は、バックアップＲＡＭ領域のデータチェック（この例ではパリティチェック）を行う。不測の電源断が生じた後に復旧した場合には、バックアップＲＡＭ領域のデータは保存されていたはずであるから、チェック結果は正常になる。チェック結果が正常でない場合には、内部状態を電源断時の状態に戻すことができないので、停電復旧時でない電源投入時に実行される初期化処理を実行する。
【０１０３】
チェック結果が正常であれば（ステップＳ９）、ＣＰＵ５６は、遊技制御手段の内部状態と表示制御手段等の電気部品制御手段の制御状態を電源断時の状態に戻すための遊技状態復旧処理を行う（ステップＳ１０）。そして、バックアップＲＡＭ領域に保存されていたＰＣ（プログラムカウンタ）の退避値がＰＣに設定され、そのアドレスに復帰する。
【０１０４】
なお、この実施の形態では、ステップＳ７でクリアスイッチ９２１がオンでない場合に、バックアップデータの有無が確認されていたが、逆に、バックアップデータの有無を確認した後、バックアップデータが存在する場合（さらに、バックアップ領域のチェックを行い、バックアップ領域のチェック結果が正常であったことが確認された場合であってもよい）にクリアスイッチ９２１の操作状態を確認するようにしてもよい。
【０１０５】
また、この実施の形態では、ステップＳ８でバックアップデータの有無が確認された後、バックアップデータが存在する場合にステップＳ９でバックアップ領域のチェックが行われたが、逆に、バックアップ領域のチェック結果が正常であったことが確認された後、バックアップデータの有無の確認を行うようにしてもよい。また、バックアップデータの有無の確認、またはバックアップ領域のチェックの何れか一方の確認を行うことによって、停電復旧処理を実行するか否かを判定してもよい。
【０１０６】
また、例えば停電復旧処理を実行するか否か判断する場合のパリティチェック（ステップＳ９）の際に、すなわち、遊技状態を復旧するか否か判断する際に、保存されていたＲＡＭデータにおける特別プロセスフラグ等や始動入賞記憶数データによって、遊技機が遊技待機状態（図柄変動中でなく、大当り遊技中でなく、確変中でなく、また、始動入賞記憶がない状態）であることが確認されたら、遊技状態復旧処理を行わずに初期化処理を実行するようにしてもよい。
【０１０７】
このように、クリアスイッチ９２１の操作状態に応じて電源断時の遊技状態に復旧するか否かの判断を行うようにし、その際、クリアスイッチ９２１がオン状態であれば、遊技状態復旧処理は実行されず、通常の初期化処理を実行する構成としたので、遊技店員等は、遊技機の電源供給再開時に、クリアスイッチ９２１を操作することによって、バックアップデータ記憶領域（変動データ記憶手段）に記憶されているバックアップデータにもとづく遊技状態復旧処理を実行するか否かを選択することができる。従って、電源断が発生しても遊技者に不利益がもたらされることを防止することができるとともに、遊技店での遊技機運用上の利便性を向上させることもできる遊技機が提供される。
【０１０８】
なお、電源投入時に、変動データ記憶手段にバックアップデータが記憶されていない場合に実行される初期化処理と、変動データ記憶手段にバックアップデータが記憶されていてもクリアスイッチ９２１がオフ状態である場合に実行される初期化処理とは、プログラム上兼用されている。従って、遊技店での運用上の利便性を向上させる制御を付加しても、プログラム容量はさほど増えない。
【０１０９】
初期化処理では、ＣＰＵ５６は、まず、ＲＡＭクリア処理を行う（ステップＳ１１）。また、所定の作業領域（例えば、普通図柄判定用乱数カウンタ、普通図柄判定用バッファ、特別図柄左中右図柄バッファ、払出コマンド格納ポインタなど）に初期値を設定する初期値設定処理も行われる。さらに、サブ基板（ランプ制御基板３５、払出制御基板３７、音声制御基板７０、図柄制御基板８０）を初期化するための処理を実行する（ステップＳ１３）。サブ基板を初期化する処理とは、例えば初期設定コマンドを送出する処理である。
【０１１０】
そして、２ｍｓ毎に定期的にタイマ割込がかかるようにＣＰＵ５６に設けられているＣＴＣのレジスタの設定が行われる（ステップＳ１４）。すなわち、初期値として２ｍｓに相当する値が所定のレジスタ（時間定数レジスタ）に設定される。そして、初期設定処理のステップＳ１において割込禁止とされているので、初期化処理を終える前に割込が許可される（ステップＳ１５）。
【０１１１】
この実施の形態では、ＣＰＵ５６の内蔵ＣＴＣが繰り返しタイマ割込を発生するように設定される。この実施の形態では、繰り返し周期は２ｍｓに設定される。そして、タイマ割込が発生すると、図１５に示すように、ＣＰＵ５６は、例えばタイマ割込が発生したことを示すタイマ割込フラグをセットする（ステップＳ１２）。
【０１１２】
初期化処理の実行（ステップＳ１１〜Ｓ１５）が完了すると、メイン処理で、タイマ割込が発生したか否かの監視（ステップＳ１７）の確認が行われるループ処理に移行する。なお、ループ内では、表示用乱数更新処理（ステップＳ１６）も実行される。
【０１１３】
ＣＰＵ５６は、ステップＳ１７において、タイマ割込が発生したことを認識すると、ステップＳ２１〜Ｓ３１の遊技制御処理を実行する。遊技制御処理において、ＣＰＵ５６は、まず、スイッチ回路５８を介して、ゲートセンサ１２、始動口センサ１７、カウントセンサ２３および入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂ等のスイッチの状態を入力し、それらの状態判定を行う（スイッチ処理：ステップＳ２１）。
【０１１４】
次いで、パチンコ遊技機１の内部に備えられている自己診断機能によって種々の異常診断処理が行われ、その結果に応じて必要ならば警報が発せられる（エラー処理：ステップＳ２２）。
【０１１５】
次に、遊技制御に用いられる大当り判定用の乱数等の各判定用乱数を示す各カウンタを更新する処理を行う（ステップＳ２３）。ＣＰＵ５６は、さらに、停止図柄の種類を決定する乱数等の表示用乱数を更新する処理を行う（ステップＳ２４）。
【０１１６】
さらに、ＣＰＵ５６は、特別図柄プロセス処理を行う（ステップＳ２５）。特別図柄プロセス制御では、遊技状態に応じてパチンコ遊技機１を所定の順序で制御するための特別図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、特別図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。また、普通図柄プロセス処理を行う（ステップＳ２６）。普通図柄プロセス処理では、７セグメントＬＥＤによる可変表示器１０を所定の順序で制御するための普通図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、普通図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。
【０１１７】
次いで、ＣＰＵ５６は、特別図柄に関する表示制御コマンドをＲＡＭ５５の所定の領域に設定して表示制御コマンドを送出する処理を行う（特別図柄コマンド制御処理：ステップＳ２７）。また、普通図柄に関する表示制御コマンドをＲＡＭ５５の所定の領域に設定して表示制御コマンドを送出する処理を行う（普通図柄コマンド制御処理：ステップＳ２８）。
【０１１８】
さらに、ＣＰＵ５６は、例えばホール管理用コンピュータに供給される大当り情報、始動情報、確率変動情報などのデータを出力する情報出力処理を行う（ステップＳ２９）。
【０１１９】
また、ＣＰＵ５６は、所定の条件が成立したときにソレノイド回路５９に駆動指令を行う（ステップＳ３０）。ソレノイド回路５９は、駆動指令に応じてソレノイド１６，２１を駆動し、可変入賞球装置１５または開閉板２０を開状態または閉状態とする。
【０１２０】
そして、ＣＰＵ５６は、各入賞口への入賞を検出するためのスイッチ１７，２３，１９ａ，１９ｂ，２４ａ，２４ｂの検出出力にもとづく賞球数の設定などを行う賞球処理を実行する（ステップＳ３１）。具体的には、入賞検出に応じて払出制御基板３７に払出制御コマンドを出力する。払出制御基板３７に搭載されている払出制御用ＣＰＵ３７１は、払出制御コマンドに応じて球払出装置９７を駆動する。
【０１２１】
以上の制御によって、この実施の形態では、遊技制御処理は２ｍｓ毎に起動されることになる。なお、この実施の形態では、タイマ割込処理では例えば割込が発生したことを示すフラグのセットのみがなされ、遊技制御処理はメイン処理において実行されるが、タイマ割込処理で遊技制御処理を実行してもよい。
【０１２２】
また、メイン処理には遊技制御処理に移行すべきか否かを判定する処理が含まれ、ＣＰＵ５６の内部タイマが定期的に発生するタイマ割込にもとづくタイマ割込処理で遊技制御処理に移行すべきか否かを判定するためのフラグがセット等がなされるので、遊技制御処理の全てが確実に実行される。つまり、遊技制御処理の全てが実行されるまでは、次回の遊技制御処理に移行すべきか否かの判定が行われないので、遊技制御処理中の全ての各処理が実行完了することは保証されている。
【０１２３】
以上に説明したように、この実施の形態では、ＣＴＣやＰＩＯを内蔵するＣＰＵ５６に対して、初期設定処理で割込モード２が設定される。従って、内蔵ＣＴＣを用いた定期的なタイマ割込処理を容易に実現できる。また、タイマ割込処理をプログラム上の任意の位置に設置できる。また、内蔵ＰＩＯを用いたスイッチ検出処理等を容易に割込処理で実現できる。その結果、プログラム構成が簡略化され、プログラム開発工数が低減する等の効果を得ることができる。
【０１２４】
次に、メイン処理におけるスイッチ処理（ステップＳ２１）の具体例を説明する。この実施の形態では、検出信号のオン状態が所定時間継続すると、確かにスイッチがオンしたと判定されスイッチオンに対応した処理が開始される。所定時間を計測するために、スイッチタイマが用いられる。スイッチタイマは、バックアップＲＡＭ領域に形成された１バイトのカウンタであり、検出信号がオン状態を示している場合に２ｍｓ毎に＋１される。図１６に示すように、スイッチタイマは検出信号の数Ｎだけ設けられている。この実施の形態ではＮ＝１２である。なお、Ｎ＝１２である（１３でない）のは、クリアスイッチ９２１の出力信号に対応したスイッチタイマが設けられていない（クリア信号の検出の有無の判断はスイッチ処理で実行されないため不必要）からである。また、ＲＡＭにおいて、各スイッチタイマのアドレスは、入力ポートのビット配列順（図１２に示された上から下への順）と同じ順序で並んでいる。
【０１２５】
図１７は、遊技制御処理におけるステップＳ２１のスイッチ処理の処理例を示すフローチャートである。なお、スイッチ処理は、図１３に示すように遊技制御処理において最初に実行される。スイッチ処理において、ＣＰＵ５６は、まず、入力ポート０に入力されているデータを入力する（ステップＳ７１）。次いで、処理数として「８」を設定し（ステップＳ７２）、入賞口スイッチ２４ａのためのスイッチタイマのアドレスをポインタにセットする（ステップＳ７３）。そして、スイッチチェック処理サブルーチンをコールする（ステップＳ７４）。
【０１２６】
図１８は、スイッチチェック処理サブルーチンを示すフローチャートである。スイッチチェック処理サブルーチンにおいて、ＣＰＵ５６は、ポート入力データ、この場合には入力ポート０からの入力データを「比較値」として設定する（ステップＳ８１）。また、クリアデータ（００）をセットする（ステップＳ８２）。そして、ポインタ（スイッチタイマのアドレスが設定されている）が指すスイッチタイマをロードするとともに（ステップＳ８３）、比較値を右（上位ビットから下位ビットへの方向）にシフトする（ステップＳ８４）。比較値には入力ポート０のデータ設定されている。そして、この場合には、入賞口スイッチ２４ａの検出信号がキャリーフラグに押し出される。
【０１２７】
キャリーフラグの値が「１」であれば（ステップＳ８５）、すなわち入賞口スイッチ２４ａの検出信号がオン状態であれば、スイッチタイマの値を１加算する（ステップＳ８７）。加算後の値が０でなければ加算値をスイッチタイマに戻す（ステップＳ８８，Ｓ８９）。加算後の値が０になった場合には加算値をスイッチタイマに戻さない。すなわち、スイッチタイマの値が既に最大値（２５５）に達している場合には、それよりも値を増やさない。
【０１２８】
キャリーフラグの値が「０」であれば、すなわち入賞口スイッチ２４ａの検出信号がオフ状態であれば、スイッチタイマにクリアデータをセットする（ステップＳ８６）。すなわち、スイッチがオフ状態であれば、スイッチタイマの値が０に戻る。
【０１２９】
その後、ＣＰＵ５６は、ポインタ（スイッチタイマのアドレス）を１加算するとともに（ステップＳ９０）、処理数を１減算する（ステップＳ９１）。処理数が０になっていなければステップＳ８２に戻る。そして、ステップＳ８２〜Ｓ９２の処理が繰り返される。
【０１３０】
ステップＳ８２〜Ｓ９２の処理は、処理数分すなわち８回繰り返され、その間に、入力ポート０の８ビットに入力されるスイッチの検出信号について、順次、オン状態かオフ状態か否かのチェック処理が行われ、オン状態であれば、対応するスイッチタイマの値が１増やされる。
【０１３１】
ＣＰＵ５６は、スイッチ処理のステップＳ７５において、入力ポート１に入力されているデータを入力する。次いで、処理数として「４」を設定し（ステップＳ７６）、賞球カウントスイッチ３０１Ａのためのスイッチタイマのアドレスをポインタにセットする（ステップＳ７７）。そして、スイッチチェック処理サブルーチンをコールする（ステップＳ７８）。
【０１３２】
スイッチチェック処理サブルーチンでは、上述した処理が実行されるので、ステップＳ８２〜Ｓ９２の処理が、処理数分すなわち４回繰り返され、その間に、入力ポート１の４ビットに入力されるスイッチの検出信号について、順次、オン状態かオフ状態か否かのチェック処理が行われ、オン状態であれば、対応するスイッチタイマの値が１増やされる。
【０１３３】
なお、この実施の形態では、遊技制御処理が２ｍｓ毎に起動されるので、スイッチ処理も２ｍｓに１回実行される。従って、スイッチタイマは、２ｍｓ毎に＋１される。
【０１３４】
図１９〜図２１は、遊技制御処理におけるステップＳ３１の賞球処理の一例を示すフローチャートである。この実施の形態では、賞球処理では、入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂ、カウントスイッチ２３および始動口スイッチ１７が確実にオンしたか否か判定されるとともに、オンしたら所定の払出制御コマンドが払出制御基板３７に送出されるように制御し、また、満タンスイッチ４８および球切れスイッチ１８７が確実にオンしたか否か判定されるとともに、オンしたら所定の払出制御コマンドが払出制御基板３７に送出されるように制御する等の処理が行われる。
【０１３５】
賞球処理において、ＣＰＵ５６は、入力判定値テーブルのオフセットとして「０」を設定し（ステップＳ１２１）、スイッチタイマのアドレスのオフセットとして「０」を設定する（ステップＳ１２２）。入力判定値テーブルのオフセット「０」は、入力判定値テーブルの最初のデータを使用することを意味する。また、各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチタイマのアドレスのオフセット「０」は入賞口スイッチ２４ａに対応したスイッチタイマが指定されることを意味する。また、繰り返し数として「４」をセットする（ステップＳ１２３）。そして、スイッチオンチェックルーチンがコールされる（ステップＳ１２４）。
【０１３６】
入力判定値テーブルとは、各スイッチについて、連続何回のオンが検出されたら確かにスイッチがオンしたと判定するための判定値が設定されているＲＯＭ領域である。入力判定値テーブルの構成例は図２４に示されている。図２４に示すように、入力判定値テーブルには、上から順に、すなわちアドレス値が小さい領域から順に、「２」、「５０」、「２５０」、「３０」、「２５０」、「１」の判定値が設定されている。また、スイッチオンチェックルーチンでは、入力判定値テーブルの先頭アドレスとオフセット値とで決まるアドレスに設定されている判定値と、スイッチタイマの先頭アドレスとオフセット値とで決まるスイッチタイマの値とが比較され、一致した場合には、例えばスイッチオンフラグがセットされる。
【０１３７】
スイッチオンチェックルーチンの一例が図２２に示されている。スイッチオンチェックルーチンにおいて、ＣＰＵ５６は、入力判定値テーブル（図２４参照）の先頭アドレスを設定する（ステップＳ１０１）。そして、そのアドレスにオフセットを加算し（ステップＳ１０２）、加算後のアドレスからスイッチオン判定値をロードする（ステップＳ１０３）。
【０１３８】
次いで、ＣＰＵ５６は、スイッチタイマの先頭アドレスを設定し（ステップＳ１０４）、そのアドレスにオフセットを加算し（ステップＳ１０５）、加算後のアドレスからスイッチタイマの値をロードする（ステップＳ１０６）。各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチに対応したスイッチタイマの値がロードされる。
【０１３９】
そして、ＣＰＵ５６は、ロードしたスイッチタイマの値とスイッチオン判定値とを比較する（ステップＳ１０７）。それらが一致すれば、スイッチオンフラグをセットする（ステップ１０８）。
【０１４０】
この場合には、スイッチオンチェックルーチンにおいて、入賞口スイッチ２４ａに対応するスイッチタイマの値がスイッチオン判定値「２」に一致していればスイッチオンフラグがセットされる（ステップＳ１２５）。スイッチオンフラグがセットされたら、１０個カウンタが１加算される（ステップＳ１２６）。スイッチチェックオンルーチンは、スイッチタイマのアドレスのオフセットが更新されつつ（ステップＳ１２９）、最初に設定された繰り返し数分だけ実行されるので（ステップＳ１２７，Ｓ１２８）、結局、入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂについて、対応するスイッチタイマの値がスイッチオン判定値「２」と比較されることになる。なお、１０個カウンタとは、景品としての１０個の遊技球払出の回数を示すカウンタである。
【０１４１】
次に、ＣＰＵ５６は、入力判定値テーブルのオフセットとして「０」を設定し（ステップＳ１３０）、スイッチタイマのアドレスのオフセットとして「４」を設定する（ステップＳ１３１）。入力判定値テーブルのオフセット「０」は、入力判定値テーブルの最初のデータを使用することを意味する。また、各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチタイマのアドレスのオフセット「４」は始動口スイッチ１７に対応したスイッチタイマが指定されることを意味する。そして、スイッチオンチェックルーチンがコールされる（ステップＳ１３２）。
【０１４２】
スイッチオンチェックルーチンにおいて、始動口スイッチ１７に対応するスイッチタイマの値がスイッチオン判定値「２」に一致していればスイッチオンフラグがセットされるので（ステップＳ１３３）、６個カウンタが１加算される（ステップＳ１３４）。なお、６個カウンタとは、景品としての６個の遊技球払出の回数を示すカウンタである。
【０１４３】
次いで、ＣＰＵ５６は、入力判定値テーブルのオフセットとして「０」を設定し（ステップＳ１３５）、スイッチタイマのアドレスのオフセットとして「５」を設定する（ステップＳ１３６）。入力判定値テーブルのオフセット「０」は、入力判定値テーブルの最初のデータを使用することを意味する。また、各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチタイマのアドレスのオフセット「５」はカウントスイッチ２３に対応したスイッチタイマが指定されることを意味する。そして、スイッチオンチェックルーチンがコールされる（ステップＳ１３７）。
【０１４４】
スイッチオンチェックルーチンにおいて、カウントスイッチ２３に対応するスイッチタイマの値がスイッチオン判定値「２」に一致していればスイッチオンフラグがセットされるので（ステップＳ１３８）、１５個カウンタが１加算される（ステップＳ１３４）。なお、１５個カウンタとは、景品としての１５個の遊技球払出の回数を示すカウンタである。
【０１４５】
さらに、ＣＰＵ５６は、入力判定値テーブルのオフセットとして「１」を設定し（ステップＳ１５０）、スイッチタイマのアドレスのオフセットとして「９」を設定する（ステップＳ１５１）。入力判定値テーブルのオフセット「１」は、入力判定値テーブルの２番目のデータ「５０」を使用することを意味する。また、各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチタイマのアドレスのオフセット「９」は満タンスイッチ４８に対応したスイッチタイマが指定されることを意味する。そして、スイッチオンチェックルーチンがコールされる（ステップＳ１５２）。
【０１４６】
スイッチオンチェックルーチンにおいて、満タンスイッチ４８に対応するスイッチタイマの値が満タンスイッチオン判定値「５０」に一致していればスイッチオンフラグがセットされるので（ステップＳ１５３）、満タンフラグがセットされる（ステップＳ１５４）。なお、図２０には明示されていないが、満タンスイッチ４８に対応したスイッチタイマの値が０になると、満タンフラグはリセットされる。
【０１４７】
また、ＣＰＵ５６は、入力判定値テーブルのオフセットとして「２」を設定し（ステップＳ１５６）、スイッチタイマのアドレスのオフセットとして「０Ａ（Ｈ）」を設定する（ステップＳ１５７）。入力判定値テーブルのオフセット「２」は、入力判定値テーブルの３番目のデータ「２５０」を使用することを意味する。また、各スイッチタイマは、図１２に示された入力ポートのビット順と同順に並んでいるので、スイッチタイマのアドレスのオフセット「０Ａ（Ｈ）」は球切れスイッチ１８７に対応したスイッチタイマが指定されることを意味する。そして、スイッチオンチェックルーチンがコールされる（ステップＳ１５８）。
【０１４８】
スイッチオンチェックルーチンにおいて、球切れスイッチ１８７に対応するスイッチタイマの値が球切れスイッチオン判定値「２５０」に一致していればスイッチオンフラグがセットされるので（ステップＳ１５９）、球切れフラグがセットされる（ステップＳ１６０）。なお、図２０には明示されていないが、球切れスイッチ１８７に対応したスイッチオフタイマが用意され、その値が５０になると、球切れフラグはリセットされる。
【０１４９】
そして、ＣＰＵ５６は、払出停止状態であるか否か確認する（ステップＳ２０１）。払出停止状態は、払出制御基板３７に対して払出停止状態指定のコマンドを送出した後の状態である。払出停止状態でなければ、上述した球切れ状態フラグまたは満タンフラグがオンになったか否かを確認する（ステップＳ２０２）。
【０１５０】
いずれかがオン状態に変化したときには、払出停止状態指定に関するコマンド送信制御処理を行う（ステップＳ２０３）。コマンド送信制御処理では、払出制御コマンド用のコマンド送信テーブルに所定のデータが設定された後、払出制御コマンドの送出処理が実行される。なお、ステップＳ２０２において、いずれか一方のフラグが既にオン状態であったときに他方のフラグがオン状態になったときには、コマンド送信制御処理（ステップＳ２０３）は行われない。
【０１５１】
また、払出停止状態であれば、球切れ状態フラグおよび満タンフラグがともにオフ状態になったか否かを確認する（ステップＳ２０４）。ともにオフ状態となったときには、払出停止解除指定に関するコマンド送信制御処理を行う（ステップＳ２０５）。
【０１５２】
次いで、ＣＰＵ５６は、入賞に応じた賞球個数に関する払出制御コマンドをコマンド送信テーブルに設定し、設定内容に応じた払出制御コマンドを送出する制御を行う。まず、１５個カウンタの値をチェックする（ステップＳ２２１）。上述したように、１５個カウンタは、遊技球が大入賞口に入賞してカウントスイッチ２３がオンするとカウントアップされる。１５個カウンタの値が０でない場合には、１５個の賞球個数指示に関するコマンド送信制御処理を行う（ステップＳ２２２）。コマンド送信制御処理では、払出制御コマンド用のコマンド送信テーブルに所定のデータが設定された後、払出制御コマンドの送出処理が実行される。また、１５個カウンタの値を−１する（ステップＳ２２３）。さらに、総賞球数格納バッファの格納値に１５を加算する（ステップＳ２２４）。
【０１５３】
総賞球数格納バッファは、払出制御手段に対して指示した賞球個数の累積値（ただし、払い出しがなされると減算される）が格納されるバッファであり、バックアップＲＡＭに形成されている。
【０１５４】
１５個カウンタの値が０であれば、１０個カウンタの値をチェックする（ステップＳ２２５）。上述したように、１０個カウンタは、遊技球が入賞口に入賞して入賞口スイッチ１９ａ，１９ｂ，２４ａ，２４ｂがオンするとカウントアップされる。１０個カウンタの値が０でない場合には、１０個の賞球個数指示に関するコマンド送信制御処理を行う（ステップＳ２２６）。また、１０個カウンタの値を−１する（ステップＳ２２７）。さらに、総賞球数格納バッファの格納値に１０を加算する（ステップＳ２２８）。
【０１５５】
１０個カウンタの値が０であれば、６個カウンタの値をチェックする（ステップＳ２３１）。上述したように、６個カウンタは、遊技球が始動入賞口に入賞して始動口スイッチ１７がオンするとカウントアップされる。６個カウンタの値が０でない場合には、６個の賞球個数指示に関するコマンド送信制御処理を行う（ステップＳ２３２）。また、６個カウンタの値を−１する（ステップＳ２３３）。さらに、総賞球数格納バッファの格納値に６を加算する（ステップＳ２３４）。
【０１５６】
以上にようにして、遊技制御手段から払出制御基板３７に賞球個数を指示する払出制御コマンドを出力しようとするときに、コマンド送信テーブルの設定が行われた後、コマンド送信テーブルに設定された払出制御コマンドが払出制御基板３７に送出される。そして、賞球個数を指示する払出制御コマンドの送出が行われたときには、賞球払出中フラグをオンする（ステップＳ２３５）。また、賞球払出中フラグをオンしているときには（ステップＳ２３６）、球払出装置９７から実際に払い出された賞球数を監視して総賞球数格納バッファの格納値を減算する賞球個数減算処理が行われる（ステップＳ２３７）。なお、賞球払出中フラグがオンからオフに変化したときには、ランプ制御基板３５に対して、賞球ランプ５１の点灯を指示するランプ制御コマンドが送出される。
【０１５７】
図２３は、賞球個数減算処理の一例を示すフローチャートである。賞球個数減算処理において、ＣＰＵ５６は、まず、総賞球数格納バッファの格納値をロードする（ステップＳ２４１）。そして、格納値が０であるか否か確認する（ステップＳ２４２）。０であれば処理を終了する。
【０１５８】
０でなければ、賞球カウントスイッチ用のスイッチタイマをロードし（ステップＳ２４３）、ロード値とオン判定値（この場合は「２」）とを比較する（ステップＳ２４４）。一致したら（ステップＳ２４５）、賞球カウントスイッチ３０１Ａが確かにオンしたとして、すなわち、確かに１個の遊技球が球払出装置９７から払い出されたとして、総賞球数格納バッファの格納値を１減算する（ステップＳ２４６）。
【０１５９】
また、賞球情報カウンタの値を＋１する（ステップＳ２４７）。そして、賞球情報カウンタの値が１０以上であれば（ステップＳ２４８）、賞球情報出力カウンタの値を＋１するとともに（ステップＳ２４９）、賞球情報カウンタの値を−１０する（ステップＳ２５０）。なお、賞球情報出力カウンタの値は、図１３に示されたメイン処理における情報出力処理（ステップＳ２９）で参照され、その値が１以上であれば、賞球信号（出力ポート５のビット７：図１４参照）として１パルスが出力される。よって、この実施の形態では、１０個の遊技球が賞球として払い出される度に、１つの賞球信号が遊技機外部に出力される。
【０１６０】
そして、総賞球数格納バッファの格納値が０になったら（ステップＳ２５１）、賞球払出中フラグをクリアし（ステップＳ２５２）、賞球残数がないことを報知するために、ランプ制御コマンド用のコマンド送信テーブルに賞球ランプ５１の消灯を示すコマンドデータを設定した後（ステップＳ２５３）、ランプ制御コマンドの送出処理を実行する（ステップＳ２５４）。
【０１６１】
次に、遊技制御手段から各電気部品制御手段に対する制御コマンドの送出方式について説明しておく。図２５は、主基板３１から他の電気部品制御基板に送出される制御コマンドのコマンド形態の一例を示す説明図である。この実施の形態では、制御コマンドは２バイト構成であり、１バイト目はＭＯＤＥ（コマンドの分類）を表し、２バイト目はＥＸＴ（コマンドの種類）を表す。ＭＯＤＥデータの先頭ビット（ビット７）は必ず「１」とされ、ＥＸＴデータの先頭ビット（ビット７）は必ず「０」とされる。なお、図２５に示されたコマンド形態は一例であって他のコマンド形態を用いてもよい。
【０１６２】
図２６は、遊技制御基板から他の各電気部品制御基板に対する制御コマンドを構成する８ビットの制御信号とＩＮＴ信号（ストローブ信号）との関係を示すタイミング図である。図２６に示すように、ＭＯＤＥまたはＥＸＴのデータが出力ポートに出力されてから、所定期間が経過すると、ＣＰＵ５６は、データ出力を示す信号であるＩＮＴ信号をオン状態にする。また、そこから所定期間が経過するとＩＮＴ信号をオフ状態にする。
【０１６３】
図２７は、払出制御コマンドの内容の一例を示す説明図である。図２７に示された例において、ＭＯＤＥ＝ＦＦ（Ｈ），ＥＸＴ＝００（Ｈ）のコマンドＦＦ００（Ｈ）は、払出可能状態を指定する払出制御コマンドである。ＭＯＤＥ＝ＦＦ（Ｈ），ＥＸＴ＝０１（Ｈ）のコマンドＦＦ０１（Ｈ）は、払出停止状態を指定する払出制御コマンドである。また、ＭＯＤＥ＝Ｆ０（Ｈ）のコマンドＦ０ＸＸ（Ｈ）は、賞球個数を指定する払出制御コマンドである。ＥＸＴである「ＸＸ」が払出個数を示す。
【０１６４】
払出制御手段は、主基板３１の遊技制御手段からＦＦ０１（Ｈ）の払出制御コマンドを受信すると賞球払出および球貸しを停止する状態となり、ＦＦ００（Ｈ）の払出制御コマンドを受信すると賞球払出および球貸しができる状態になる。また、賞球個数を指定する払出制御コマンドを受信すると、受信したコマンドで指定された個数に応じた賞球払出制御を行う。
【０１６５】
なお、払出制御コマンドは、払出制御手段が認識可能に１回だけ送出される。認識可能とは、この例では、ＩＮＴ信号がオン状態になることであり、認識可能に１回だけ送出されるとは、この例では、払出制御信号の１バイト目および２バイト目のそれぞれに応じてＩＮＴ信号が１回だけオン状態になることである。
【０１６６】
遊技制御手段から払出制御基板等の各電気部品制御基板に制御コマンドを出力しようとするときに、コマンド送信テーブルの設定が行われる。図２８（Ａ）は、コマンド送信テーブルの一構成例を示す説明図である。１つのコマンド送信テーブルは３バイトで構成され、１バイト目にはＩＮＴデータが設定される。また、２バイト目のコマンドデータ１には、制御コマンドの１バイト目のＭＯＤＥデータが設定される。そして、３バイト目のコマンドデータ２には、制御コマンドの２バイト目のＥＸＴデータが設定される。
【０１６７】
なお、ＥＸＴデータそのものがコマンドデータ２の領域に設定されてもよいが、コマンドデータ２には、ＥＸＴデータが格納されているテーブルのアドレスを指定するためのデータが設定されるようにしてもよい。この実施の形態では、コマンドデータ２のビット７（ワークエリア参照ビット）が０あれば、コマンドデータ２にＥＸＴデータそのものが設定されていることを示す。そのようなＥＸＴデータはビット７が０であるデータである。ワークエリア参照ビットが１あれば、他の７ビットが、ＥＸＴデータが格納されているテーブルのアドレスを指定するためのオフセットであることを示す。また、この実施の形態では各制御コマンド毎にコマンド送信テーブルが用意されている。
【０１６８】
図２８（Ｂ）ＩＮＴデータの一構成例を示す説明図である。ＩＮＴデータにおけるビット０は、払出制御基板３７に払出制御コマンドを送出すべきか否かを示す。ビット０が「１」であるならば、払出制御コマンドを送出すべきことを示す。従って、ＣＰＵ５６は、例えば賞球処理において、払出制御コマンドを送出するときには、払出制御コマンド用のコマンド送信テーブルのＩＮＴデータに「０１（Ｈ）」を設定する。
【０１６９】
ＩＮＴデータのビット１，２，３は、それぞれ、表示制御コマンド、ランプ制御コマンド、音声制御コマンドを送出すべきか否かを示すビットであり、ＣＰＵ５６は、それらのコマンドを送出すべき場合には、ポインタが指しているコマンド送信テーブルに、ＩＮＴデータ、コマンドデータ１およびコマンドデータ２を設定する。それらのコマンドを送出するときには、ＩＮＴデータの該当ビットが「１」に設定され、コマンドデータ１およびコマンドデータ２にＭＯＤＥデータおよびＥＸＴデータが設定される。
【０１７０】
各電気部品制御基板への制御コマンドを、対応する出力ポート（出力ポート１〜４）に出力する際に、出力ポート０のビット０〜３のうちのいずれかのビットが所定期間オン状態になるのであるが、ＩＮＴデータにおけるビット配列と出力ポート０におけるビット配列とは対応している。従って、各電気部品制御基板に御コマンドを送出する際に、コマンド送信テーブルに設定されているＩＮＴデータにもとづいて、容易にＩＮＴ信号の出力を行うことができる。
【０１７１】
図２９〜図３１は、電源基板９１０からの電源断信号に応じて実行されるマスク不能割込処理（電力供給停止時処理）の処理例を示すフローチャートである。
【０１７２】
電力供給停止時処理において、ＣＰＵ５６は、ＡＦレジスタ（アキュミュレータとフラグのレジスタ）を所定のバックアップＲＡＭ領域に退避する（ステップＳ４５１）。また、割込フラグをパリティフラグにコピーする（ステップＳ４５２）。パリティフラグはバックアップＲＡＭ領域に形成されている。また、ＢＣレジスタ、ＤＥレジスタ、ＨＬレジスタ、ＩＸレジスタおよびスタックポインタをバックアップＲＡＭ領域に退避する（ステップＳ４５４〜Ｓ４５８）。なお、電源復旧時には、退避された内容にもとづいてレジスタ内容が復元され、パリティフラグの内容に応じて、割込許可状態／禁止状態の内部設定がなされる。
【０１７３】
次いで、この実施の形態では、所定期間、賞球カウントスイッチ３０１Ａの検出信号をチェックする。そして、賞球カウントスイッチ３０１Ａがオンしたら総賞球数バッファの内容を１減らす。
【０１７４】
なお、この実施の形態では、所定期間を計測するために、所定期間計測用カウンタが用いられる。所定期間計測用カウンタの値は、初期値ｍから、以下に説明するスイッチ検出処理のループ（Ｓ４６１から始まってＳ４６１に戻るループ）が１回実行される毎に−１され、その値が０になると、所定期間が終了したとする。検出処理のループでは、例外はあるがほぼ一定の処理が行われるので、ループの１周に要する時間のｍ倍の時間が、ほぼ所定期間に相当する。
【０１７５】
所定期間を計測するために、ＣＰＵ５６の内蔵タイマを用いてもよい。すなわち、スイッチ検出処理開始時に、内蔵タイマに所定値（所定期間に相当）を設定しておく。そして、スイッチ検出処理のループが１回実行される毎に、内蔵タイマのカウント値をチェックする。そして、カウント値が０になったら、所定期間が終了したとする。内蔵タイマの値が０になったことを検出するために内蔵タイマによる割込を用いることもできるが、この段階では制御内容（ＲＡＭに格納されている各値など）を変化させないように、割込を用いず、内蔵タイマのカウント値を読み出してチェックするようなプログラム構成の方が好ましい。
【０１７６】
また、所定期間は、遊技球が、球払出装置９７から落下した時点から、賞球カウントスイッチ３０１Ａに到達するまでの時間以上に設定される。球払出装置９７から賞球カウントスイッチ３０１Ａまでの距離をＬとすると、その間の落下時間ｔは、ｔ＝√（２Ｌ／ｇ）（ｇ：重力加速度）になるので、所定期間は、それ以上に設定される。
【０１７７】
少なくとも、スイッチ検出処理が実行される所定期間では、賞球カウントスイッチ３０１Ａが遊技球を検出できる状態でなければならない。そこで、この実施の形態では、図１０に示されたように、電源基板９１０におけるコンバータＩＣ９２２の入力側に比較的大容量の補助駆動電源としてのコンデンサ９２３が接続されている。よって、遊技機に対する電力供給停止時にも、ある程度の期間は＋１２Ｖ電源電圧がスイッチ駆動可能な範囲に維持され、賞球カウントスイッチ３０１Ａが動作可能になる。その期間が、上記の所定期間以上になるように、コンデンサの容量が決定される。
【０１７８】
なお、入力ポートおよびＣＰＵ５６も、コンバータＩＣ９２２で作成される＋５Ｖ電源で駆動されるので、電力供給停止時にも、比較的長い期間動作可能になっている。
【０１７９】
ステップＳ４６１において、２ｍｓ計測用カウンタに２ｍｓの時間に相当する初期値ｎが設定される。そして、２ｍｓ計測用カウンタの値が０になるまで（ステップＳ４６２）、２ｍｓ計測用カウンタの値が−１される（ステップＳ４６３）。
【０１８０】
２ｍｓ計測用カウンタの値が０になると、賞球カウントスイッチ３０１Ａの検出信号の入力チェックが行われる。すなわち、図１７および図１８に示されたスイッチ処理およびスイッチチェック処理に類似した処理が行われる。具体的には、入力ポート１に入力されているデータを入力する（ステップＳ４６４）。次いで、クリアデータ（００）をセットする（ステップＳ４６５）。また、ポート入力データ、この場合には入力ポート１からの入力データを「比較値」として設定する（ステップＳ４６６）。さらに、賞球カウントスイッチ３０１Ａのためのスイッチタイマのアドレスをポインタにセットする（ステップＳ４６７）。
【０１８１】
そして、ポインタ（スイッチタイマのアドレスが設定されている）が指すスイッチタイマをロードするとともに（ステップＳ４６８）、比較値を右（上位ビットから下位ビットへの方向）にシフトする（ステップＳ４６９）。比較値には入力ポート１のデータ設定されている。そして、この場合には、賞球カウントスイッチ３０１Ａの検出信号がキャリーフラグに押し出される。
【０１８２】
キャリーフラグの値が「１」であれば（ステップＳ４７０）、すなわち賞球カウントスイッチ３０１Ａの検出信号がオン状態であれば、スイッチタイマの値を１加算する（ステップＳ４７１）。キャリーフラグの値が「０」であれば、すなわち賞球カウントスイッチ３０１Ａの検出信号がオフ状態であれば、スイッチタイマにクリアデータをセットする（ステップＳ４７２）。すなわち、スイッチがオフ状態であれば、スイッチタイマの値が０に戻る。
【０１８３】
そして、スイッチタイマの値が２になったときに（ステップＳ４７３）、総賞球数格納バッファの格納値を１減算するとともに（ステップＳ４７４）、賞球情報カウンタの値を＋１する（ステップＳ４７５）。そして、賞球情報カウンタの値が１０以上であれば（ステップＳ４７６）、賞球情報出力カウンタの値を＋１するとともに（ステップＳ４７７）、賞球情報カウンタの値を−１０する（ステップＳ４７８）。
【０１８４】
次いで、所定期間計測用カウンタの値を−１し（ステップＳ４７９）、その値が０になっていなければステップＳ４６１に戻る。
【０１８５】
以上の処理によって、所定期間内に賞球カウントスイッチ３０１Ａがオンしたら、総賞球数格納バッファの値が−１される。バックアップＲＡＭの内容を保存するための処理は、このようなスイッチ検出処理の後で行われるので、払出が完了した賞球について、必ず総賞球数格納バッファが−１される。従って、遊技球の払出に関して、保存される制御状態に矛盾が生じてしまうことが防止される。また、上記のスイッチ検出処理では、検出期間用カウンタを用いたタイマ処理が施されている。すなわち、２ｍｓ毎に賞球カウントスイッチ３０１Ａの検出出力のチェックが行われ、２回連続してオン検出した場合に、賞球カウントスイッチ３０１Ａが確実にオンしたと見なされる。従って、誤ってスイッチオン検出がなされてしまうことは防止される。また、スイッチ検出処理において、遊技機外部への賞球情報出力のための賞球情報出力回数カウンタの演算も行われるので、外部に出力される賞球情報と実際の払出賞球数とが食い違ってしまうようなこともない。
【０１８６】
なお、この実施の形態では、賞球カウントスイッチ３０１Ａのみのスイッチ検出処理が行われたが、始動入賞口のスイッチや大入賞口に関連するＶ入賞スイッチ２２やカウントスイッチについても同様のスイッチ検出処理を行ってもよい。また、他の入賞についても同様のスイッチ検出処理を行ってもよい。そのようなオンチェックも行う場合には、入賞口に遊技球が入賞した直後に停電が発生したような場合でも、その入賞が確実に検出され、保存される遊技状態に反映される。
【０１８７】
所定期間が経過すると（ステップＳ４８０）、すなわち、所定期間計測用カウンタの値が０になると、バックアップあり指定値（この例では「５５Ｈ」）をバックアップフラグにストアする（ステップＳ４８１）。バックアップフラグはバックアップＲＡＭ領域に形成されている。次いで、パリティデータを作成する（ステップＳ４８２〜Ｓ４９１）。すなわち、まず、クリアデータ（００）をチェックサムデータエリアにセットし（ステップＳ４８２）、チェックサム算出開始アドレスをポインタにセットする（ステップＳ４８３）。また、チェックサム算出回数をセットする（ステップＳ４８４）。
【０１８８】
そして、チェックサムデータエリアの内容とポインタが指すＲＡＭ領域の内容との排他的論理和を演算する（ステップＳ４８５）。演算結果をチェックサムデータエリアにストアするとともに（ステップＳ４８６）、ポインタの値を１増やし（ステップＳ４８７）、チェックサム算出回数の値を１減算する（ステップＳ４８８）。ステップＳ４８５〜Ｓ４８８の処理が、チェックサム算出回数の値が０になるまで繰り返される（ステップＳ４８９）。
【０１８９】
チェックサム算出回数の値が０になったら、ＣＰＵ５６は、チェックサムデータエリアの内容の各ビットの値を反転する（ステップＳ４９０）。そして、反転後のデータをチェックサムデータエリアにストアする（ステップＳ４９１）。このデータが、電源投入時にチェックされるパリティデータとなる。次いで、ＲＡＭアクセスレジスタにアクセス禁止値を設定する（ステップＳ４９２）。以後、内蔵ＲＡＭ５５のアクセスができなくなる。
【０１９０】
なお、この実施の形態では、遊技制御処理において用いられるデータが格納されるＲＡＭ領域は全て電源バックアップされている。従って、その内容が正しく保存されているか否かを示すチェックサムの生成処理、およびその内容を書き換えないようにするためのＲＡＭアクセス防止処理が、遊技状態を保存するための処理に相当する。
【０１９１】
内蔵ＲＡＭ５５のアクセスを禁止する処理を実行すると、ＣＰＵ５６は、待機状態（ループ状態）に入る。従って、システムリセットされるまで、何もしない状態になる。
【０１９２】
なお、この実施の形態では、ＮＭＩに応じて電力供給停止時処理が実行されたが、電源断信号をＣＰＵ５６のマスク可能端子に接続し、マスク可能割込処理によって電力供給停止時処理を実行してもよい。また、電源断信号を入力ポートに入力し、入力ポートのチェック結果に応じて電力供給停止時処理を実行してもよい。
【０１９３】
また、この実施の形態では、電源断信号に応じて起動される処理の最初にレジスタの保存処理が行われたが、スイッチ検出処理においてレジスタを使用しない場合には、スイッチ検出処理の実行後に、すなわち、バックアップフラグの設定とチェックサムの算出の処理の前にレジスタ保存処理を行うことができる。その場合には、レジスタ保存処理、バックアップフラグ設定処理、およびチェックサム算出処理を電力供給停止時処理と見なすことができる。さらに、スイッチ検出処理において幾つかのレジスタを使用する場合であっても、使用しないレジスタについては、バックアップフラグの設定とチェックサムの算出の処理の前にレジスタ保存処理を行うことができる。
【０１９４】
図３２は、払出検出手段からの検出信号の入力処理が実行される様子の一例を示すタイミング図である。この実施の形態では、電源断信号は、主基板３１および払出制御基板３７に入力され、主基板３１のＣＰＵ５６および払出制御用ＣＰＵ３７１のＮＭＩ端子に入力される。主基板３１のＣＰＵ５６は、マスク不能割込処理によって、上述した電力供給停止時処理を実行する。
【０１９５】
図３２に示すように、電源断信号がオン（この例ではハイレベルからローレベルに変化）するあたりで賞球払出が実行された場合、払出検出手段からの検出信号の入力処理が実行される所定期間内で賞球カウントスイッチ３０１Ａがオンする。従って、電源断信号がオンするあたりで実行された球払出についても、電力供給停止時処理が実行される際に、総賞球数バッファに反映することができる。
【０１９６】
ＶSLの電圧値がさらに低下して所定値（この例では＋９Ｖ）にまで低下すると、図１１に示されたように主基板３１搭載されているリセットＩＣ６５１の出力がローレベルになり、ＣＰＵ５６がシステムリセット状態になる。なお、ＣＰＵ５６は、システムリセット状態とされる前に、電力供給停止時処理を完了している。
【０１９７】
ＶSLの電圧値がさらに低下してＶcc（各種回路を駆動するための＋５Ｖ）を生成することが可能な電圧を下回ると、各基板において各回路が動作できない状態となる。しかし、主基板３１では、電力供給停止時処理が実行され、ＣＰＵ５６がシステムリセット状態とされている。
【０１９８】
なお、後述するように、払出制御基板３７における払出制御用ＣＰＵ３７１も、同様に電力供給停止時処理を行った後にシステムリセット状態になる。
【０１９９】
上記の実施の形態のパチンコ遊技機１は、始動入賞にもとづいて可変表示部９に可変表示される特別図柄の停止図柄が所定の図柄の組み合わせになると所定の遊技価値が遊技者に付与可能になる第１種パチンコ遊技機であったが、始動入賞にもとづいて可変表示される図柄の停止図柄が所定の図柄の組み合わせになると開放する所定の電動役物への入賞があると所定の権利が発生または継続する第３種パチンコ遊技機であっても、本発明を適用できる。
【０２００】
図３３は、第３種パチンコ遊技機の遊技領域７の一例を示す説明図である。この例では、始動入賞口３０Ａに入賞があると可変表示部９において、図柄の可変表示が開始される。そして、図柄の停止図柄が所定の図柄の組み合わせになると、権利発生用電動役物３０Ｂが所定期間開放して入賞しやすい状態になる。その状態で、権利発生用電動役物３０Ｂへの入賞により権利が発生すると、モータ等で駆動されるロータ３０Ｃに入った遊技球が大入賞口３０Ｄの始動口スイッチに導かれ、その始動口スイッチで検出されると大入賞口３０Ｄが開放される。なお、始動入賞口３０Ａ、権利発生用電動役物３０Ｂ、ロータ３０Ｃおよび大入賞口３０Ｄに入賞した遊技球を検出するそれぞれのスイッチが設けられている。
【０２０１】
このような第３種パチンコ遊技機において、停電等の発生に応じて制御状態を保存するように構成した場合にも、例えば電源断信号に応じて起動される処理で、まず、出力ポートのクリア処理でロータ３０Ｃを駆動するモータ等を停止する。そして、ロータ３０Ｃによって始動口スイッチ（ロータ３０Ｃに入った遊技球を検出するスイッチ）に導かれた遊技球は、電源が断することが検出された後でも所定期間スイッチ検出処理が実行されるので、始動口スイッチで検出可能である。従って、電源が復旧したときに、大入賞口３０Ｄの作動条件が成立することが保証される。この場合、所定期間は、ロータ３０Ｃの遊技球を保持する部位から始動口スイッチまで遊技球が移動するまでの時間以上の期間である。また、権利発生用電動役物３０Ｂに設けられているスイッチについても、電源が断することが検出された後でも所定期間検出処理が実行されることによって、不当な権利消滅を防止することができる。
【０２０２】
なお、電源断信号の発生に応じて起動される処理におけるスイッチ検出処理において全てのスイッチの検出を行う場合には、図１７に示されたスイッチ処理を、所定期間中に呼び出すようにしてもよい。そして、そのように構成した場合には、スイッチタイマ値がオン判定値に達した場合の処理も行う。例えば、入賞球スイッチのスイッチタイマ値がオン判定値に達したら賞球個数を設定するための処理を行ったり（１５個カウンタのインクリメント等）、Ｖ入賞スイッチ２２のスイッチタイマ値がオン判定値に達したらＶ入賞があった旨のフラグを設定する等の処理を行う。
【０２０３】
以下、遊技状態復旧処理について説明する。
図３４は、図１３のステップＳ１０に示された遊技状態復旧処理の一例を示すフローチャートである。この例では、ＣＰＵ５６は、バックアップＲＡＭに保存されていた値を各レジスタに復元する（ステップＳ９１）。そして、バックアップＲＡＭに保存されていたデータにもとづいて停電時の遊技状態を確認して復帰させる。すなわち、バックアップＲＡＭに保存されていたデータにもとづいて、ソレノイド回路５９を介してソレノイド１６やソレノイド２１を駆動し、始動入賞口１４や開閉板２０の開閉状態の復旧を行う（ステップＳ９２，Ｓ９３）。また、電源断中でも保存されていた特別図柄プロセスフラグおよび普通図柄プロセスフラグの値に応じて、電源断時の特別図柄プロセス処理の進行状況および普通図柄プロセス処理の進行状況に対応した制御コマンドを、図柄制御基板８０、ランプ制御基板３５および音声制御基板７０に送出する（ステップＳ９４）。
【０２０４】
以上のように、遊技状態復旧処理では、復元された内部状態に応じて、各種電気部品の状態復元が行われるとともに、図柄制御基板８０、ランプ制御基板３５および音声制御基板７０に対して、制御状態を電源断時の状態に戻すための制御コマンド（電源断時の制御状態を生じさせるための制御コマンド）が送出される。そのような制御コマンドは、一般に、電源断前に最後に送出された１つまたは複数の制御コマンドである。
【０２０５】
遊技状態を電源断時の状態に復帰させると、この実施の形態では、ＣＰＵ５６は、前回の電源断時の割込許可／禁止状態を復帰させるため、バックアップＲＡＭに保存されていたパリティフラグの値を確認する（ステップＳ９５）。パリティフラグがオフ状態であれば、割込許可設定を行う（ステップＳ９６）。しかし、パリティフラグがオン状態であれば、そのまま（ステップＳ１で設定された割込禁止状態のまま）遊技状態復旧処理を終了する。パリティフラグがオン状態であるということは、図２９におけるステップＳ４５２に示されたように、前回の電源断時に割込禁止状態であったことを意味する。従って、パリティフラグがオン状態である場合には、割込許可はなされない。
【０２０６】
この実施の形態では、上述した遊技状態復旧処理によって、以下のような状態復旧が可能である。
【０２０７】
始動入賞口１４および大入賞口（開閉板２０）の状態が復元される。表示制御手段によって制御される普通図柄の表示状態（可変表示器１０の表示状態）は、電源断時に変動中であった場合を除いて復元される。表示制御手段によって制御される特別図柄の表示状態（可変表示部９の表示状態）は、電源断時に変動中であった場合を除いて復元される。さらに、可変表示部９に表示される背景やキャラクタは、特別図柄変動中および大当り遊技中であった場合を除いて復元される。
【０２０８】
特別図柄の変動中に電源断となった場合には、可変表示パターンの変動時間（例えば１０秒）および既に実行した時間（例えば４秒）の情報がバックアップされる。そして、主基板３１は、復旧時に、表示パターンを示す表示制御コマンドおよび停止図柄を示す表示制御コマンドを表示制御基板８０に出力し、残り時間（上述の例では６秒）経過後に、図柄を停止させるため表示制御コマンドを出力する。従って、特別図柄の表示状態は、電源断時に特別図柄の変動中であった場合には、復旧時に、表示されていない残りの時間（上述の例では６秒）につき可変表示が実行される。なお、復旧時に表示制御基板８０に対して出力される表示パターンを示す表示制御コマンドは、電源断前に出力された表示パターンを示す表示制御コマンドと同じものであってもよいが、「停電復旧中です」のような画像を表示させるためのコマンドとしてもよい。この場合、「停電復旧中です」の表示は、残りの時間（上述の例では６秒）表示される。なお、特別図柄の変動中に電源断となった場合の、普通図柄の表示状態にについても、上述と同様の制御が行われる。
【０２０９】
なお、大当り遊技中に電源断となった場合にも、上述した特別図柄の変動中に電源断となった場合と同様に、ラウンド中あるいはラウンド間のインターバルの残り時間について、復旧時に、表示、音、ランプ、ソレノイド２１などを制御するが、主基板３１は、表示制御基板８０に対して電源断前に出力した確定時の図柄（停止図柄）を指定する表示制御コマンドを出力する。これにより、ラウンド中あるいはラウンド間の大当り図柄による演出が可能となり（大当り図柄で大当り演出する機種について）、また、大当り終了後の変動開始時に表示する図柄も表示制御基板８０が認識することができる。
【０２１０】
ランプ制御手段が制御する装飾ランプ２５、始動記憶表示器１８、ゲート通過記憶表示器４１、賞球ランプ５１および球切れランプ５２の表示状態が復元される。遊技効果ランプ・ＬＥＤ２８ａ，２８ｂ，２８ｃの表示状態は、特別図柄変動中および大当り遊技中であった場合を除いて復元される。ただし、電源断時に大当り遊技中であった場合には、各制御区間の最初の状態に復元可能である。各制御区間とは、例えば、大当り開始報知状態、大入賞口開放前状態、大入賞口開放中状態、大当り終了報知状態である。なお、特別図柄変動中に電源断となったあと復旧した場合には、上述した可変表示部９や可変表示装置１０の表示制御と同様に、残り時間分だけ遊技効果ランプ・ＬＥＤ２８ａ，２８ｂ，２８ｃの表示状態を制御するようにしてもよいが、消灯または停電復旧時特有のパターンで点灯／点滅させるようにしてもよい。
【０２１１】
音声制御手段が制御する音発生状態は、特別図柄変動中および大当り遊技中であった場合を除いて復元される。ただし、電源断時に大当り遊技中であった場合には、各制御区間の最初の状態に復元可能である。なお、特別図柄変動中に電源断となったあと復旧した場合には、上述した可変表示部９や可変表示装置１０の表示制御と同様に、残り時間分だけ音発生状態を制御するようにしてもよいが、無音または停電復旧時特有の音声パターン（例えば「停電復旧中です」との音声）を出力するようにしてもよい。
【０２１２】
なお、この実施の形態では、電源断からの復旧時に、主基板３１の遊技制御手段から表示制御手段、ランプ制御手段および音声制御手段に対して状態復元のための制御コマンドが送出されるが、表示制御手段、ランプ制御手段および音声制御手段が電源バックアップされる場合には、主基板３１からの制御コマンドを用いることなく、表示制御手段、ランプ制御手段および音声制御手段が独自に制御状態を復元するように構成してもよい。
【０２１３】
また、後述するように、払出制御基板３７に搭載されている払出制御手段は、電源バックアップされているので、電源断からの復旧時に、賞球払出状態および球貸し制御状態は、電源断時の状態（電圧低下を検出したときから所定時間が経過したあとの状態）に復旧する。この実施の形態では、発射制御基板は払出制御手段に接続されているので、発射制御基板９１における制御状態も同様に復元される。
【０２１４】
なお、上記の実施の形態では、遊技制御手段において、データ保存処理および復旧処理が行われる場合について説明したが、払出制御手段、音声制御手段、ランプ制御手段および表示制御手段におけるＲＡＭの一部も電源バックアップされ、払出制御手段、表示制御手段、音制御手段およびランプ制御手段も、上述したような処理を行ってもよい。ただし、払出制御手段、表示制御手段、音制御手段およびランプ制御手段は、復旧時にコマンド送出処理を行う必要はない。
【０２１５】
次に、遊技制御手段以外の電気部品制御手段においてデータ保存処理および復旧処理が行われる場合の例として、払出制御手段においてデータ保存や復旧が行われる場合について説明する。
【０２１６】
図３５は、払出制御用ＣＰＵ３７１周りの一構成例を示すブロック図である。図３５に示すように、電源基板９１０の電源監視回路（電源監視手段）からの電源断信号が、バッファ回路９６０を介して払出制御用ＣＰＵ３７１のマスク不能割込端子（ＸＮＭＩ端子）に接続されている。従って、払出制御用ＣＰＵ３７１は、マスク不能割込処理によって電源断の発生を確認することができる。
【０２１７】
払出制御用ＣＰＵ３７１のＣＬＫ／ＴＲＧ２端子には、主基板３１からのＩＮＴ信号が接続されている。ＣＬＫ／ＴＲＧ２端子にクロック信号が入力されると、払出制御用ＣＰＵ３７１に内蔵されているタイマカウンタレジスタＣＬＫ／ＴＲＧ２の値がダウンカウントされる。そして、レジスタ値が０になると割込が発生する。従って、タイマカウンタレジスタＣＬＫ／ＴＲＧ２の初期値を「１」に設定しておけば、ＩＮＴ信号の入力に応じて割込が発生することになる。
【０２１８】
払出制御基板３７には、システムリセット回路９７５も搭載されているが、この実施の形態では、システムリセット回路９７５におけるリセットＩＣ９７６は、電源投入時に、外付けのコンデンサに容量で決まる所定時間だけ出力をローレベルとし、所定時間が経過すると出力をハイレベルにする。また、リセットＩＣ９７６は、ＶSLの電源電圧を監視して電圧値が所定値（例えば＋９Ｖ）以下になると出力をローレベルにする。従って、電源断時には、リセットＩＣ９７６からの信号がローレベルになることによって払出制御用ＣＰＵ３７１がシステムリセットされる。
【０２１９】
リセットＩＣ９７６が電源断を検知するための所定値は、通常時の電圧より低いが、払出制御用ＣＰＵ３７１が暫くの間動作しうる程度の電圧である。また、リセットＩＣ９７６が、払出制御用ＣＰＵ３７１が必要とする電圧（この例では＋５Ｖ）よりも高い電圧を監視するように構成されているので、払出制御用ＣＰＵ３７１が必要とする電圧に対して監視範囲を広げることができる。従って、より精密な監視を行うことができる。
【０２２０】
＋５Ｖ電源から電力が供給されていない間、払出制御用ＣＰＵ３７１の内蔵ＲＡＭの少なくとも一部は、電源基板から供給されるバックアップ電源がバックアップ端子に接続されることによってバックアップされ、遊技機に対する電源が断しても内容は保存される。そして、＋５Ｖ電源が復旧すると、システムリセット回路９７５からリセット信号が発せられるので、払出制御用ＣＰＵ３７１は、通常の動作状態に復帰する。そのとき、必要なデータがバックアップされているので、停電等からの復旧時には停電発生時の払出制御状態に復帰することができる。
【０２２１】
なお、図３５に示すように、スイッチ基板１９０に搭載されたクリアスイッチ９２１の出力信号が、論理を反転させるバッファ回路３７２Ａ、および入力ポート３７２を介して入力される。なお、入力ポート３７２には、本例では、バッファ回路３７２Ａを介して、賞球カウントスイッチ３０１Ａおよび球貸しカウントスイッチ３０１Ｂの各スイッチの出力信号も入力されている。このような構成によれば、クリアスイッチ９２１の切換により出力信号がクリアスイッチ信号（ローレベル信号）とされていると、クリアスイッチ信号が反転（なお、バッファ回路３７２Ａがクリアスイッチ信号を反転して出力した信号を、クリアスイッチ信号と呼ぶことがある。）されて払出制御用ＣＰＵ３７１に与えられるので、払出制御用ＣＰＵ３７１により後述する初期化処理が行われる。
【０２２２】
なお、図３５に示された構成では、システムリセット回路９７５は、電源投入時に、コンデンサの容量で決まる期間のローレベルを出力し、その後ハイレベルを出力する。すなわち、リセット解除タイミングは１回だけである。しかし、図１１に示された主基板３１の場合と同様に、複数回のリセット解除タイミングが発生するような回路構成を用いてもよい。
【０２２３】
図３６は、この実施の形態における出力ポートの割り当てを示す説明図である。図３６に示すように、出力ポートＣ（アドレス００Ｈ）は、払出モータ２８９に出力される駆動信号の出力ポートである。また、出力ポートＤ（アドレス０１Ｈ）は、７セグメントＬＥＤであるエラー表示ＬＥＤ３７４に出力される表示制御信号の出力ポートである。そして、出力ポートＥ（アドレス０２Ｈ）は、振分ソレノイド３１０に出力される駆動信号、およびカードユニット５０に対するＥＸＳ信号とＰＲＤＹ信号とを出力するための出力ポートである。
【０２２４】
図３７は、この実施の形態における入力ポートのビット割り当てを示す説明図である。図３７に示すように、入力ポートＡ（アドレス０６Ｈ）は、主基板３１から送出された払出制御コマンドの８ビットの払出制御信号を取り込むための入力ポートである。また、入力ポートＢ（アドレス０７Ｈ）のビット０〜２には、それぞれ、賞球カウントスイッチ３０１Ａ、球貸しカウントスイッチ３０１Ｂ、モータ位置センサの検出信号が入力される。ビット３〜５には、カードユニット５０からのＢＲＤＹ信号、ＢＲＱ信号およびＶＬ信号が入力される。ビット６には、クリアスイッチ９２１の出力信号が入力される。
【０２２５】
図３８は、払出制御用ＣＰＵ３７１のメイン処理を示すフローチャートである。メイン処理では、払出制御用ＣＰＵ３７１は、まず、必要な初期設定を行う。すなわち、払出制御用ＣＰＵ３７１は、まず、割込禁止に設定する（ステップＳ７０１）。次に、割込モードを割込モード２に設定し（ステップＳ７０２）、スタックポインタにスタックポインタ指定アドレスを設定する（ステップＳ７０３）。また、払出制御用ＣＰＵ３７１は、内蔵デバイスレジスタの初期化を行い（ステップＳ７０４）、ＣＴＣおよびＰＩＯの初期化（ステップＳ７０５）を行った後に、ＲＡＭをアクセス可能状態に設定する（ステップＳ７０６）。
【０２２６】
この実施の形態では、内蔵ＣＴＣのうちの一つのチャネルがタイマモードで使用される。従って、ステップＳ７０４の内蔵デバイスレジスタの設定処理およびステップＳ７０５の処理において、使用するチャネルをタイマモードに設定するためのレジスタ設定、割込発生を許可するためのレジスタ設定および割込ベクタを設定するためのレジスタ設定が行われる。そして、そのチャネルによる割込がタイマ割込として用いられる。タイマ割込を例えば２ｍｓ毎に発生させたい場合は、初期値として２ｍｓに相当する値が所定のレジスタ（時間定数レジスタ）に設定される。
【０２２７】
なお、タイマモードに設定されたチャネル（この実施の形態ではチャネル３）に設定される割込ベクタは、タイマ割込処理の先頭番地に相当するものである。具体的は、Ｉレジスタに設定された値と割込ベクタとでタイマ割込処理の先頭番地が特定される。タイマ割込処理ではタイマ割込フラグがセットされ、メイン処理でタイマ割込フラグがセットされていることが検知されると、払出制御処理が実行される。すなわち、タイマ割込処理では、電気部品制御処理の一例である払出制御処理を実行するための設定がなされる。
【０２２８】
また、内蔵ＣＴＣのうちの他の一つのチャネル（この実施の形態ではチャネル２）が、遊技制御手段からの払出制御コマンド受信のための割込発生用のチャネルとして用いられ、そのチャネルがカウンタモードで使用される。従って、ステップＳ７０４の内蔵デバイスレジスタの設定処理およびステップＳ７０５の処理において、使用するチャネルをカウンタモードに設定するためのレジスタ設定、割込発生を許可するためのレジスタ設定および割込ベクタを設定するためのレジスタ設定が行われる。
【０２２９】
カウンタモードに設定されたチャネル（チャネル２）に設定される割込ベクタは、後述するコマンド受信割込処理の先頭番地に相当するものである。具体的は、Ｉレジスタに設定された値と割込ベクタとでコマンド受信割込処理の先頭番地が特定される。
【０２３０】
この実施の形態では、払出制御用ＣＰＵ３７１でも割込モード２が設定される。従って、内蔵ＣＴＣのカウントアップにもとづく割込処理を使用することができる。また、ＣＴＣが送出した割込ベクタに応じた割込処理開始番地を設定することができる。
【０２３１】
ＣＴＣのチャネル２（ＣＨ２）のカウントアップにもとづく割込は、上述したタイマカウンタレジスタＣＬＫ／ＴＲＧ２の値が「０」になったときに発生する割込である。従って、例えばステップＳ７０５において、特定レジスタとしてのタイマカウンタレジスタＣＬＫ／ＴＲＧ２に初期値「１」が設定される。また、ＣＴＣのチャネル３（ＣＨ３）のカウントアップにもとづく割込は、ＣＰＵの内部クロック（システムクロック）をカウントダウンしてレジスタ値が「０」になったら発生する割込であり、後述する２ｍｓタイマ割込として用いられる。具体的には、ＣＨ３のレジスタ値はシステムクロックの１／２５６周期で減算される。ステップＳ７０５において、ＣＨ３のレジスタには、初期値として２ｍｓに相当する値が設定される。
【０２３２】
ＣＴＣのＣＨ２のカウントアップにもとづく割込は、ＣＨ３のカウントアップにもとづく割込よりも優先順位が高い。従って、同時にカウントアップが生じた場合に、ＣＨ２のカウントアップにもとづく割込、すなわち、コマンド受信割込処理の実行契機となる割込の方が優先される。
【０２３３】
次いで、払出制御用ＣＰＵ３７１は、入力ポート３７２を介して入力されるクリアスイッチ９２１の出力信号の状態を、本例では１回だけ所定期間（例えば、０．００１秒）確認する（ステップＳ７０７）。クリアスイッチ９２１がオン（クリアスイッチ９２１が押下されている状態）である場合には、ローレベルのクリアスイッチ信号が出力されている。従って、払出制御用ＣＰＵ３７１は、クリアスイッチ９２１がオンとされていれば、通常の初期化処理を実行する（ステップＳ７１１〜ステップＳ７１３）。なお、ＣＰＵ５６がクリアスイッチ９２１の出力信号の状態を２回以上確認する構成としてもよい。
【０２３４】
クリアスイッチ９２１がオンの状態でなければ（すなわち、クリアスイッチ９２１が押下されていない状態であれば）、払出制御用ＣＰＵ３７１は、払出制御用のバックアップＲＡＭ領域にバックアップデータが存在しているか否かの確認を行う（ステップＳ７０８）。すなわち、例えば、主基板３１のＣＰＵ５６の処理と同様に、電源断時にセットされるバックアップフラグがセット状態になっているか否かによって、バックアップデータが存在しているか否か確認する。バックアップフラグがセット状態になっている場合には、バックアップデータありと判断する。
【０２３５】
バックアップありを確認したら、払出制御用ＣＰＵ３７１は、バックアップＲＡＭ領域のデータチェック（この例ではパリティチェック）を行う。不測の電源断が生じた後に復旧した場合には、バックアップＲＡＭ領域のデータは保存されていたはずであるから、チェック結果は正常になる。チェック結果が正常でない場合には、内部状態を電源断時の状態に戻すことができないので、停電復旧時でない電源投入時に実行される初期化処理を実行する。
【０２３６】
チェック結果が正常であれば（ステップＳ７０９）、払出制御用ＣＰＵ３７１は、内部状態を電源断時の状態に戻すための払出状態復旧処理を行う（ステップＳ７１０）。そして、バックアップＲＡＭ領域に保存されていたＰＣ（プログラムカウンタ）の指すアドレスに復帰する。
【０２３７】
このように、クリアスイッチ９２１の操作状態に応じて電源断時の遊技状態に復旧するか否かの判断を行うようにし、その際、クリアスイッチ９２１がオン状態であれば、遊技状態復旧処理は実行されず、通常の初期化処理を実行する構成としたので、遊技店員等は、遊技機の電源供給再開時に、クリアスイッチ９２１を操作することによって、バックアップデータ記憶領域（変動データ記憶手段）に記憶されているバックアップデータにもとづく遊技状態復旧処理を実行するか否かを選択することができる。従って、電源断が発生しても遊技者に不利益がもたらされることを防止することができるとともに、遊技店での遊技機運用上の利便性を向上させることもできる遊技機が提供される。
【０２３８】
なお、電源投入時に、変動データ記憶手段にバックアップデータが記憶されていない場合に実行される初期化処理と、変動データ記憶手段にバックアップデータが記憶されていてもクリアスイッチ９２１がオフ状態である場合に実行される初期化処理とは、プログラム上兼用されている。従って、遊技店での運用上の利便性を向上させる制御を付加しても、プログラム容量はさほど増えない。
【０２３９】
初期化処理では、払出制御用ＣＰＵ３７１は、まず、ＲＡＭクリア処理を行う（ステップＳ７１１）。そして、２ｍｓ毎に定期的にタイマ割込がかかるように払出制御用ＣＰＵ３７１に設けられているＣＴＣのレジスタの設定が行われる（ステップＳ７１２）。すなわち、初期値として２ｍｓに相当する値が所定のレジスタ（時間定数レジスタ）に設定される。そして、初期設定処理のステップＳ７０１において割込禁止とされているので、初期化処理を終える前に割込が許可される（ステップＳ７１３）。
【０２４０】
この実施の形態では、払出制御用ＣＰＵ３７１の内蔵ＣＴＣが繰り返しタイマ割込を発生するように設定される。この実施の形態では、繰り返し周期は２ｍｓに設定される。そして、タイマ割込が発生すると、図３９に示すように、払出制御用ＣＰＵ３７１は、例えばタイマ割込が発生したことを示すタイマ割込フラグをセットする（ステップＳ７２１）。なお、図３９には割込を許可することも明示されているが（ステップＳ７２０）、２ｍｓタイマ割込処理では、最初に割込許可状態に設定される。すなわち、２ｍｓタイマ割込処理中には割込許可状態になってので、ＩＮＴ信号の入力にもとづく払出制御コマンド受信処理を優先して実行することができる。
【０２４１】
払出制御用ＣＰＵ３７１は、ステップＳ７２４において、タイマ割込フラグがセットされたことを検出するとステップＳ７５１以降の払出制御処理を実行する。以上の制御によって、この実施の形態では、払出制御処理は２ｍｓ毎に起動されることになる。なお、この実施の形態では、タイマ割込処理ではフラグセットのみがなされ、払出制御処理はメイン処理において実行されるが、タイマ割込処理で払出制御処理を実行してもよい。
【０２４２】
払出制御処理において、払出制御用ＣＰＵ３７１は、まず、中継基板７２を介して入力ポート３７２ｂに入力される賞球カウントスイッチ３０１Ａ、球貸しカウントスイッチ３０１Ｂがオンしたか否かを判定する（スイッチ処理：ステップＳ７５１）。
【０２４３】
次に、払出制御用ＣＰＵ３７１は、センサ（例えば、払出モータ２８９の回転数を検出するモータ位置センサ）からの信号入力状態を確認してセンサの状態を判定する等の処理を行う（入力判定処理：ステップＳ７５２）。払出制御用ＣＰＵ３７１は、さらに、受信した払出制御コマンドを解析し、解析結果に応じた処理を実行する（コマンド解析実行処理：ステップＳ７５３）。
【０２４４】
次いで、払出制御用ＣＰＵ３７１は、主基板３１から払出停止指示コマンドを受信していたら払出停止状態に設定し、払出開始指示コマンドを受信していたら払出停止状態の解除を行う（ステップＳ７５４）。また、プリペイドカードユニット制御処理を行う（ステップＳ７５５）。
【０２４５】
次いで、払出制御用ＣＰＵ３７１は、球貸し要求に応じて貸し球を払い出す制御を行う（ステップＳ７５６）。このとき、払出制御用ＣＰＵ３７１は、振分ソレノイド３１０によって球振分部材３１１を球貸し側に設定する。
【０２４６】
さらに、払出制御用ＣＰＵ３７１は、総合個数記憶に格納された個数の賞球を払い出す賞球制御処理を行う（ステップＳ７５７）。このとき、払出制御用ＣＰＵ３７１は、振分ソレノイド３１０によって球振分部材３１１を賞球側に設定する。そして、出力ポート３７２ｃおよび中継基板７２を介して球払出装置９７の払出機構部分における払出モータ２８９に対して駆動信号を出力し、所定の回転数分払出モータ２８９を回転させる払出モータ制御処理を行う（ステップＳ７５８）。
【０２４７】
なお、この実施の形態では、払出モータ２８９としてステッピングモータが用いられ、それらを制御するために１−２相励磁方式が用いられる。従って、具体的には、払出モータ制御処理において、８種類の励磁パターンデータが繰り返し払出モータ２８９に出力される。また、この実施の形態では、各励磁パターンデータが４ｍｓずつ出力される。
【０２４８】
次いで、エラー検出処理が行われ、その結果に応じてエラー表示ＬＥＤ３７４に所定の表示を行う（エラー処理：ステップＳ７５９）。
【０２４９】
なお、出力ポートＣは、払出制御処理における払出モータ制御処理（ステップＳ７５８）でアクセスされる。また、出力ポートＤは、払出制御処理におけるエラー処理（ステップＳ７５９）でアクセスされる。そして、出力ポートＥは、払出制御処理における球貸し制御処理（ステップＳ７５６）および賞球制御処理（ステップＳ７５７）でアクセスされる。
【０２５０】
図４０は、払出制御用ＣＰＵ３７１が内蔵するＲＡＭの使用例を示す説明図である。この例では、バックアップＲＡＭ領域に、総合個数記憶（例えば２バイト）と貸し球個数記憶とがそれぞれ形成されている。総合個数記憶は、主基板３１の側から指示された賞球払出個数の総数を記憶するものである。貸し球個数記憶は、未払出の球貸し個数を記憶するものである。
【０２５１】
このように、未払出の賞球個数と貸し球個数とが、所定期間はその内容を保持可能なバックアップＲＡＭ領域に記憶されるので、停電等の不測の電源断が生じても、所定期間内に電源復旧すれば、バックアップＲＡＭ領域に記憶される賞球処理および球貸し処理を続行できる。従って、遊技者に与えられる不利益を低減することができる。
【０２５２】
図４１は、主基板３１から受信した払出制御コマンドを格納するための受信バッファの一構成例を示す説明図である。この例では、２バイト構成の払出制御コマンドを６個格納可能なリングバッファ形式の受信バッファが用いられる。従って、受信バッファは、確定コマンドバッファ１〜１２の１２バイトの領域で構成される。そして、受信したコマンドをどの領域に格納するのかを示すコマンド受信個数カウンタが用いられる。コマンド受信個数カウンタは、０〜１１の値をとる。
【０２５３】
図４２は、割込処理による払出制御コマンド受信処理を示すフローチャートである。主基板３１からの払出制御用のＩＮＴ信号は払出制御用ＣＰＵ３７１のＣＬＫ／ＴＲＧ２端子に入力されている。よって、主基板３１からのＩＮＴ信号がオン状態になると、初期値として「１」が設定されていたタイマカウンタレジスタＣＬＫ／ＴＲＧ２の値が０になって払出制御用ＣＰＵ３７１において割込がかかる。そして、図４２に示す払出制御コマンドの受信処理が開始される。なお、払出制御コマンド受信処理の開始番地は、内蔵ＣＴＣから出力される割込ベクタとＩレジスタに設定された値とで決定される番地である。また、タイマカウンタレジスタＣＬＫ／ＴＲＧ２の値が０になると、その値は自動的に初期値（この例では「１」）に戻される。
【０２５４】
払出制御コマンドの受信処理において、払出制御用ＣＰＵ３７１は、まず、各レジスタをスタックに退避する（ステップＳ８５０）。なお、割込が発生するとＣＰＵ３７１は自動的に割込禁止状態に設定するが、自動的に割込禁止状態にならないＣＰＵを用いている場合には、ステップＳ８５０の処理の実行前に割込禁止命令（ＤＩ命令）を発行することが好ましい。次いで、払出制御コマンドデータの入力に割り当てられている入力ポート３７２ａからデータを読み込む（ステップＳ８５１）。そして、２バイト構成の払出制御コマンドのうちの１バイト目であるか否か確認する（ステップＳ８５２）。１バイト目であるか否かは、受信したコマンドの先頭ビットが「１」であるか否かによって確認される。先頭ビットが「１」であるのは、２バイト構成である払出制御コマンドのうちのＭＯＤＥバイト（１バイト目）のはずである（図２５参照）。そこで、払出制御用ＣＰＵ３７１は、先頭ビットが「１」であれば、有効な１バイト目を受信したとして、受信したコマンドを受信バッファ領域におけるコマンド受信個数カウンタが示す確定コマンドバッファに格納する（ステップＳ８５３）。
【０２５５】
払出制御コマンドのうちの１バイト目でなければ、１バイト目を既に受信したか否か確認する（ステップＳ８５４）。既に受信したか否かは、受信バッファ（確定コマンドバッファ）に有効なデータが設定されているか否かによって確認される。
【０２５６】
１バイト目を既に受信している場合には、受信した１バイトのうちの先頭ビットが「０」であるか否か確認する。そして、先頭ビットが「０」であれば、有効な２バイト目を受信したとして、受信したコマンドを、受信バッファ領域におけるコマンド受信個数カウンタ＋１が示す確定コマンドバッファに格納する（ステップＳ８５５）。先頭ビットが「０」であるのは、２バイト構成である払出制御コマンドのうちのＥＸＴバイト（２バイト目）のはずである（図２５参照）。なお、ステップＳ８５４における確認結果が１バイト目を既に受信したである場合には、２バイト目として受信したデータのうちの先頭ビットが「０」でなければ処理を終了する。
【０２５７】
ステップＳ８５５において、２バイト目のコマンドデータを格納すると、コマンド受信個数カウンタに２を加算する（ステップＳ８５６）。そして、コマンド受信カウンタが１２以上であるか否か確認し（ステップＳ８５７）、１２以上であればコマンド受信個数カウンタをクリアする（ステップＳ８５８）。その後、退避されていたレジスタを復帰し（ステップＳ８５９）、割込許可に設定する（ステップＳ８５９）。
【０２５８】
コマンド受信割込処理中は割込禁止状態になっている。上述したように、２ｍｓタイマ割込処理中は割込許可状態になっているので、２ｍｓタイマ割込中にコマンド受信割込が発生した場合には、コマンド受信割込処理が優先して実行される。また、コマンド受信割込処理中に２ｍｓタイマ割込が発生しても、その割込処理は待たされる。このように、この実施の形態では、主基板３１からのコマンド受信処理の処理優先度が高くなっている。
【０２５９】
なお、払出制御コマンドは２バイト構成であって、１バイト目（ＭＯＤＥ）と２バイト目（ＥＸＴ）とは、受信側で直ちに区別可能に構成されている。すなわち、先頭ビットによって、ＭＯＤＥとしてのデータを受信したのかＥＸＴとしてのデータを受信したのかを、受信側において直ちに検出できる。よって、上述したように、適正なデータを受信したのか否かを容易に判定することができる。
【０２６０】
図４３は、ステップＳ７５３のコマンド解析実行処理の一例を示すフローチャートである。コマンド解析実行処理において、払出制御用ＣＰＵ３７１は、確定コマンドバッファ領域中に受信コマンドがあるか否かの確認を行う（ステップＳ７５３ａ）。受信コマンドがあれば、受信した払出制御コマンドが払出個数指示コマンドであるか否かの確認を行う（ステップＳ７５３ｂ）。なお、確定コマンドバッファ領域中に複数の受信コマンドがある場合には、受信した払出制御コマンドが払出個数指示コマンドであるか否かの確認は、最も前に受信された受信された受信コマンドについて行われる。
【０２６１】
受信した払出制御コマンドが払出個数指示コマンドであれば、払出個数指示コマンドで指示された個数を総合個数記憶に加算する（ステップＳ７５３ｃ）。すなわち、払出制御用ＣＰＵ３７１は、主基板３１のＣＰＵ５６から送られた払出個数指示コマンドに含まれる賞球数をバックアップＲＡＭ領域（総合個数記憶）に記憶する。なお、払出制御用ＣＰＵ３７１は、必要ならば、コマンド受信個数カウンタの減算や確定コマンドバッファ領域における受信コマンドシフト処理を行う。
【０２６２】
図４４は、ステップＳ７５４の払出停止状態設定処理の一例を示すフローチャートである。払出停止状態設定処理において、払出制御用ＣＰＵ３７１は、確定コマンドバッファ領域中に受信コマンドがあるか否かの確認を行う（ステップＳ７５４ａ）。確定コマンドバッファ領域中に受信コマンドがあれば、受信した払出制御コマンドが払出停止指示コマンドであるか否かの確認を行う（ステップＳ７５４ｂ）。払出停止指示コマンドであれば、払出制御用ＣＰＵ３７１は、払出停止状態に設定する（ステップＳ７５４ｃ）。
【０２６３】
ステップＳ７５４ｂで受信コマンドが払出停止指示コマンドでないことを確認すると、受信した払出制御コマンドが払出開始指示コマンドであるか否かの確認を行う（ステップＳ７５４ｄ）。払出開始指示コマンドであれば、払出停止状態を解除する（ステップＳ７５４ｅ）。
【０２６４】
図４５は、ステップＳ７５１のスイッチ処理の一例を示すフローチャートである。スイッチ処理において、払出制御用ＣＰＵ３７１は、賞球カウントスイッチ３０１Ａがオン状態を示しているか否か確認する（ステップＳ７５１ａ）。オン状態を示していれば、払出制御用ＣＰＵ３７１は、賞球カウントスイッチオンカウンタを＋１する（ステップＳ７５１ｂ）。賞球カウントスイッチオンカウンタは、賞球カウントスイッチ３０１Ａのオン状態を検出した回数を計数するためのカウンタである。
【０２６５】
そして、賞球カウントスイッチオンカウンタの値をチェックし、その値が２５０になっていれば（ステップＳ７５１ｃ）、賞球球詰まりフラグをセットする（ステップＳ７５１ｄ）。つまり、賞球カウントスイッチ３０１Ａのオン状態が長期間継続した場合に賞球球詰まりフラグがセットされる。
【０２６６】
また、賞球カウントスイッチオンカウンタの値が２になったときには（ステップＳ７５１ｅ）、確実に賞球カウントスイッチ３０１Ａがオンした判断し、賞球カウントスイッチオンフラグをセットする（ステップＳ７５１ｆ）。
【０２６７】
ステップＳ７５１ａにおいて賞球カウントスイッチ３０１Ａがオン状態でないことが確認されると、払出制御用ＣＰＵ３７１は、賞球カウントスイッチオンフラグをリセットするとともに（ステップＳ７５１ｈ）、賞球カウントスイッチオンカウンタをクリアする（ステップＳ７５１ｉ）。そして、球貸しカウントスイッチ３０１Ｂがオン状態を示しているか否か確認する（ステップＳ７５１ｊ）。オン状態を示していれば、払出制御用ＣＰＵ３７１は、球貸しカウントスイッチオンカウンタを＋１する（ステップＳ７５１ｋ）。球貸しカウントスイッチオンカウンタは、球貸しカウントスイッチ３０１Ｂのオン状態を検出した回数を計数するためのカウンタである。
【０２６８】
そして、球貸しカウントスイッチオンカウンタの値をチェックし、その値が２５０になっていれば（ステップＳ７５１ｌ）、貸し球詰まりフラグをセットする（ステップＳ７５１ｍ）。つまり、球貸しカウントスイッチ３０１Ｂのオン状態が長期間継続した場合に貸し球球詰まりフラグがセットされる。
【０２６９】
また、球貸しカウントスイッチオンカウンタの値が２になったときには（ステップＳ７５１ｎ）、確実に球貸しカウントスイッチ３０１Ｂがオンした判断し、球貸しカウントスイッチオンフラグをセットする（ステップＳ７５１ｏ）。
【０２７０】
ステップＳ７５１ｊにおいて球貸しカウントスイッチ３０１Ｂがオン状態でないことが確認されると、払出制御用ＣＰＵ３７１は、球貸しカウントスイッチオンフラグをリセットするとともに（ステップＳ７５１ｐ）球貸しカウントスイッチオンカウンタをクリアする（ステップＳ７５１ｑ）。
【０２７１】
図４６は、ステップＳ７５６の球貸し制御処理の一例を示すフローチャートである。なお、この実施の形態では、連続的な払出数の最大値を貸し球の一単位（例えば２５個）とするが、連続的な払出数の最大値は他の数であってもよい。
【０２７２】
球貸し制御処理において、払出制御用ＣＰＵ３７１は、球貸し停止中であるか否かを確認する（ステップＳ５０１）。球貸し停止中でなければ、払出制御用ＣＰＵ３７１は、貸し球払出中であるか否かの確認を行い（ステップＳ５１１）、貸し球払出中であれば、ステップＳ５１８以降の球貸し中の処理に移行する。なお、貸し球払出中であるか否かは、後述する球貸し処理中フラグの状態によって判断される。貸し球払出中でなければ、払出制御用ＣＰＵ３７１は、カードユニット５０から球貸し要求があったか否かを確認する（ステップＳ５１２）。要求があれば、球貸し処理中フラグをオンするとともに（ステップＳ５１３）、２５（球貸し一単位数：ここでは１００円分）をバックアップＲＡＭ領域の貸し球個数記憶に設定する（ステップＳ５１４）。そして、払出制御用ＣＰＵ３７１は、ＥＸＳ信号をオンして（ステップＳ５１５）、球払出装置９７の下方の球振分部材３１１を球貸し側に設定するために振分用ソレノイド３１０を駆動する（ステップＳ５１６）。また、払出モータ２８９をオンする（ステップＳ５１７）。
【０２７３】
なお、払出モータ２８９をオンするのは、厳密には、カードユニット５０が受付を認識したことを示すためにＢＲＱ信号をＯＦＦとしてからである。なお、球貸し処理中フラグはバックアップＲＡＭ領域に設定される。
【０２７４】
ステップＳ５１８において、払出制御用ＣＰＵ３７１は、貸し球通過待ち時間中であるか否かの確認を行う（ステップＳ５１８）。貸し球通過待ち時間中でなければ、球貸し用センサ（本例では、払出モータ位置センサ）のチェックを行い（ステップＳ５１９）、また、後述する球貸しカウントスイッチチェック処理を行う（ステップＳ５２０）。
【０２７５】
次いで、払出制御用ＣＰＵ３７１は、払出モータ２８９の駆動を終了すべきか（一単位の払出動作が終了したか）否かの確認を行う（ステップＳ５２１）。具体的には、所定個数の払出に対応した回転が完了したか否かを確認する。所定個数の払出に対応した回転は、払出モータ位置センサの出力によって監視される。所定個数の払出に対応した回転が完了した場合には、払出制御用ＣＰＵ３７１は、払出モータ２８９の駆動を停止し（ステップＳ５２２）、貸し球通過待ち時間の設定を行う（ステップＳ５２３）。
【０２７６】
ステップＳ５１８で貸し球通過待ち時間中であれば、払出制御用ＣＰＵ３７１は、後述する球貸しカウントスイッチチェック処理を行うとともに（ステップＳ５２４）、貸し球通過待ち時間が終了したか否かの確認を行う（ステップＳ５２５）。貸し球通過待ち時間は、最後の払出球が払出モータ２８９によって払い出されてから球貸しカウントスイッチ３０１Ｂを通過するまでの時間である。
【０２７７】
貸し球通過待ち時間の終了を確認すると、一単位の貸し球は全て払い出された状態であるので、振分用ソレノイド３１０をオフして、カードユニット５０に対して次の球貸し要求の受付が可能になったことを示すためにＥＸＳ信号をオフにする（ステップＳ５２６）。また、球貸し処理中フラグをオフする（ステップＳ５２７）。
【０２７８】
なお、球貸し要求の受付を示すＥＸＳ信号をオフにした後、所定期間内に再び球貸し要求信号であるＢＲＱ信号がオンしたら、振分用ソレノイド３１０、および払出モータ２８９をオフせずに球貸し処理を続行するようにしてもよい。すなわち、所定単位（この例では１００円単位）毎に球貸し処理を行うのではなく、球貸し処理を連続して実行するように構成することもできる。
【０２７９】
貸し球個数記憶の内容は、遊技機の電源が断しても、所定期間電源基板９１０のバックアップ電源によって保存される。従って、所定期間中に電源が回復すると、払出制御用ＣＰＵ３７１は、貸し球個数記憶の内容にもとづいて球貸し処理を継続することができる。
【０２８０】
図４７は、ステップＳ５２０およびＳ５２４で実行される球貸しカウントスイッチチェック処理を示すフローチャートである。球貸しカウントスイッチチェック処理は、球貸しカウントスイッチ３０１Ｂの状態を監視して、貸し球個数記憶を減算する処理である。
【０２８１】
球貸しカウントスイッチチェック処理において、払出制御用ＣＰＵ３７１は、まず、球貸しカウントスイッチＯＮ待ちフラグがセットされているか否か確認する（ステップＳ５２０ａ）。球貸しカウントスイッチＯＮ待ちフラグがセットされていれば、球貸しカウントスイッチオンフラグがオン状態になるのを待つ（ステップＳ５２０ｂ）。なお、球貸しカウントスイッチオンフラグは、図４５に示されたスイッチ処理におけるステップＳ７５１ｏでセットされる。球貸しカウントスイッチオンフラグがオン状態になる前にタイマＴ１１がタイムアウトすると球貸し経路エラーフラグをセットする（ステップＳ５２０ｆ，Ｓ５２０ｇ）。球貸しカウントスイッチ３０１Ｂがオンすると、タイマＴ１１を停止して（ステップＳ５２０ｃ）、球貸しカウントスイッチＯＮ待ちフラグをリセットする（ステップＳ５２０ｄ）。なお、タイマＴ１１は、球貸しカウントスイッチ３０１Ｂが所定期間内にオンするか否かを確認するためのタイマである。
【０２８２】
球貸しカウントスイッチ３０１Ｂがオンした場合には、球貸しカウントスイッチ３０１Ｂがオフすることを確認するために、オフを待つ状態であることを示す球貸しカウントスイッチＯＦＦ待ちフラグをセットする（ステップＳ５２０ｅ）。
【０２８３】
従って、払出制御用ＣＰＵ３７１は、球貸しカウントスイッチＯＦＦ待ちフラグがオンしていれば（ステップＳ５２０ｈ）、球貸しカウントスイッチオンフラグがオフするのを待つ（ステップＳ５２０ｋ）。球貸しカウントスイッチオンフラグがオフすると、球貸しカウントスイッチＯＦＦ待ちフラグをリセットする（ステップＳ５２０ｌ）。そして、１個の遊技球が払い出されたことが検出されたとして、貸し球個数記憶を−１する（ステップＳ５２０ｍ）。
【０２８４】
ステップＳ５２０ｈで、球貸しカウントスイッチＯＦＦ待ちフラグもオンしていないことを確認したら、タイマＴ１１をスタートするとともに（ステップＳ５２０ｉ）、球貸しカウントスイッチＯＮ待ちフラグをセットする（ステップＳ５２０ｊ）。
【０２８５】
以上のように、この実施の形態では、１個の遊技球が貸し出されたことを確認する度に、貸し球個数記憶が−１される。
【０２８６】
図４８および図４９は、ステップＳ７５８の賞球制御処理の一例を示すフローチャートである。なお、この例では、連続的な払出数の最大値を貸し球の一単位と同数（例えば２５個）とするが、連続的な払出数の最大値は他の数であってもよい。
【０２８７】
賞球制御処理において、払出制御用ＣＰＵ３７１は、貸し球払出中であるか否か確認する（ステップＳ５３１）。貸し球払出中であるか否かは、球貸し処理中フラグの状態によって判断される。貸し球払出中でなければ賞球の払出中であるか否か確認し（ステップＳ５３２）、賞球の払出中であれば図４９に示す賞球中の処理に移行する。賞球の払出中であるか否かは、後述する賞球処理中フラグの状態によって判断される。
【０２８８】
貸し球払出中でも賞球払出中でもなければ、払出制御用ＣＰＵ３７１は、カードユニット５０からの球貸し準備要求があるか否か確認する（ステップＳ５３３）。球貸し準備要求があるか否かは、カードユニット５０から入力されるＢＲＤＹ信号のオン（要求あり）またはオフ（要求なし）を確認することによって行われる。
【０２８９】
カードユニット５０からの球貸し準備要求がなければ、払出制御用ＣＰＵ３７１は、総合個数記憶に格納されている賞球数（未払出の賞球数）が０でないか否か確認する（ステップＳ５３４）。総合個数記憶に格納されている賞球数が０でなければ、賞球制御用ＣＰＵ３７１は、賞球処理中フラグをオンし（ステップＳ５３５）、総合個数記憶の値が２５以上であるか否か確認する（ステップＳ５３６）。なお、賞球処理中フラグは、バックアップＲＡＭ領域に設定される。
【０２９０】
総合個数記憶に格納されている賞球数が２５以上であると、払出制御用ＣＰＵ３７１は、２５個分の遊技球を払い出すまで払出モータ２８９を回転させるように払出モータ２８９に対して駆動信号を出力するために２５個払出動作の設定を行う（ステップＳ５３７）。総合個数記憶に格納されている賞球数が２５以上でなければ、払出制御用ＣＰＵ３７１は、総合個数記憶に格納されている全ての遊技球を払い出すまで払出モータ２８９を回転させるように駆動信号を出力するために、全個数払出動作の設定を行う（ステップＳ５３８）。次いで、球払出装置９７の下方の球振分部材３１１を賞球側に設定し（ステップＳ５３９）、払出モータ２８９をオンする（ステップＳ５４０）。そして、図４９に示す賞球制御処理における賞球払出中の処理に移行する。
【０２９１】
図４９は、払出制御用ＣＰＵ３７１による払出制御処理における賞球中の処理の一例を示すフローチャートである。賞球中の処理において、払出制御用ＣＰＵ３７１は、賞球通過待ち時間中であるか否かの確認を行う（ステップＳ５４１）。賞球通過待ち時間中でなければ、賞球用センサ（本例では、払出モータ位置センサ）のチェックを行い（ステップＳ５４２）、また、後述する賞球カウントスイッチチェック処理を行う（ステップＳ５４３）。
【０２９２】
そして、払出制御用ＣＰＵ３７１は、払出モータ２８９の駆動を終了すべきか（２５個または２５個未満の所定の個数の払出動作が終了したか）否かの確認を行う（ステップＳ５４４）。具体的には、所定個数の払出に対応した回転が完了したか否かを確認する。所定個数の払出に対応した回転は、払出モータ位置センサの出力によって監視される。所定個数の払出に対応した回転が完了した場合には、払出制御用ＣＰＵ３７１は、払出モータ２８９の駆動を停止し（ステップＳ５４５）、賞球通過待ち時間の設定を行う（ステップＳ５４６）。賞球通過待ち時間は、最後の払出球が払出モータ２８９によって払い出されてから賞球カウントスイッチ３０１Ａを通過するまでの時間である。
【０２９３】
ステップＳ５４１において、賞球通過待ち時間中であれば、払出制御用ＣＰＵ３７１は、後述する賞球カウントスイッチチェック処理を行い（ステップＳ５４７）、賞球通過待ち時間が終了したか否かの確認を行う（ステップＳ５４８）。賞球通過待ち時間が終了した時点は、ステップＳ５３７またはステップＳ５３８で設定された賞球が全て払い出された状態である。そこで、払出制御用ＣＰＵ３７１は、賞球処理中フラグをオフする（ステップＳ５４９）。なお、賞球通過待ち時間が経過するまでに最後の払出球が賞球カウントスイッチ３０１Ａを通過しなかった場合には、賞球経路エラーとされる。
【０２９４】
なお、この実施の形態では、ステップＳ５３１の判断によって球貸しが賞球処理よりも優先されることになるが、賞球処理が球貸しに優先するようにしてもよい。
【０２９５】
図５０は、ステップＳ５４３およびＳ５４７で実行される賞球カウントスイッチチェック処理を示すフローチャートである。賞球カウントスイッチチェック処理は、賞球カウントスイッチ３０１Ａの状態を監視して、総合個数記憶を減算する処理である。
【０２９６】
賞球カウントスイッチチェック処理において、払出制御用ＣＰＵ３７１は、まず、賞球カウントスイッチＯＮ待ちフラグがセットされているか否か確認する（ステップＳ５４３ａ）。賞球カウントスイッチＯＮ待ちフラグがセットされていれば、賞球カウントスイッチオンフラグがオン状態になるのを待つ（ステップＳ５４３ｂ）。なお、賞球カウントスイッチオンフラグは、図４５に示されたスイッチ処理におけるステップＳ７５１ｆでセットされる。賞球カウントスイッチオンフラグがオン状態になる前にタイマＴ１２がタイムアウトすると賞球経路エラーフラグをセットする（ステップＳ５４３ｆ，Ｓ５４３ｇ）。賞球カウントスイッチ３０１Ａがオンすると、タイマＴ１２を停止して（ステップＳ５４３ｃ）、賞球カウントスイッチＯＮ待ちフラグをリセットする（ステップＳ５４３ｄ）。タイマＴ１２は、賞球カウントスイッチ３０１Ａが所定期間内にオンするか否かを確認するためのタイマである。
【０２９７】
賞球カウントスイッチ３０１Ａがオンした場合には、賞球カウントスイッチ３０１Ａがオフすることを確認するために、オフを待つ状態であることを示す賞球カウントスイッチＯＦＦ待ちフラグをセットする（ステップＳ５４３ｅ）。
【０２９８】
従って、払出制御用ＣＰＵ３７１は、賞球カウントスイッチＯＦＦ待ちフラグがオンしていれば（ステップＳ５４３ｈ）、賞球カウントスイッチオンフラグがオフするのを待つ（ステップＳ５４３ｋ）。賞球カウントスイッチオンフラグがオフすると、賞球カウントスイッチＯＦＦ待ちフラグをリセットする（ステップＳ５４３ｌ）。そして、総合個数記憶を−１する（ステップＳ５４３ｍ）。
【０２９９】
ステップＳ５４３ｈで、賞球カウントスイッチＯＦＦ待ちフラグもオンしていないことを確認したら、タイマＴ１２をスタートするとともに（ステップＳ５４３ｉ）、賞球カウントスイッチＯＮ待ちフラグをセットする（ステップＳ５４３ｊ）。
【０３００】
総合個数記憶および貸し球個数記憶の内容は、それぞれ、遊技機の電源が断しても、所定期間電源基板９１０のバックアップ電源によって保存される。従って、所定期間中に電源が回復すると、払出制御用ＣＰＵ３７１は、総合個数記憶および貸し球個数記憶の内容にもとづいて払出処理を継続することができる。
【０３０１】
なお、払出制御用ＣＰＵ３７１は、主基板３１から指示された賞球個数を賞球個数記憶で総数として管理したが、賞球数毎（例えば１５個、１０個、６個）に管理してもよい。例えば、賞球数毎に対応した個数カウンタを設け、払出個数指定コマンドを受信すると、そのコマンドで指定された個数に対応する個数カウンタを＋１する。そして、個数カウンタに対応した賞球払出が行われると、その個数カウンタを−１する（この場合、払出制御処理にて減算処理を行うようにする）。その場合にも、各個数カウンタはバックアップＲＡＭ領域に形成される。よって、遊技機の電源が断しても、所定期間中に電源が回復すれば、払出制御用ＣＰＵ３７１は、各個数カウンタの内容にもとづいて賞球払出処理を継続することができる。
【０３０２】
図５１〜図５３は、電源基板９１０からの電源断信号に応じて実行されるマスク不能割込処理の処理例を示すフローチャートである。この例では、ＮＭＩに応じて電力供給停止時処理が実行されるが、電源断信号を払出制御用ＣＰＵ３７１のマスク可能端子に接続し、マスク可能割込処理によって電力供給停止時処理を実行してもよい。また、電源断信号を入力ポートに入力し、入力ポートのチェック結果に応じて電力供給停止時処理を実行してもよい。
【０３０３】
マスク不能割込処理において、払出制御用ＣＰＵ３７１は、ＡＦレジスタを所定のバックアップＲＡＭ領域に退避する（ステップＳ８０１）。また、割込フラグをパリティフラグにコピーする（ステップＳ８０２）。パリティフラグはバックアップＲＡＭ領域に形成されている。また、ＢＣレジスタ、ＤＥレジスタ、ＨＬレジスタ、ＩＸレジスタおよびスタックポインタをバックアップＲＡＭ領域に退避する（ステップＳ８０４〜８０８）。なお、電源復旧時には、退避された内容にもとづいてレジスタ内容が復元され、パリティフラグの内容に応じて、割込許可状態／禁止状態の内部設定がなされる。
【０３０４】
次いで、払出モータ２８９に出力される駆動信号をオフ状態にする（ステップＳ７６１）。よって、球払出装置９７の駆動は停止する。その後、この実施の形態では、所定期間、払出検出手段としての賞球カウントスイッチ３０１Ａ（賞遊技媒体検出手段に相当）および球貸しカウントスイッチ３０１Ｂ（貸出遊技媒体検出手段に相当）の検出信号をチェックする。そして、賞球カウントスイッチ３０１Ａがオンしたら総合個数記憶の内容を１減らす。また、球貸しカウントスイッチ３０１Ｂがオンしたら貸し球個数記憶の内容を１減らす。
【０３０５】
なお、この実施の形態では、所定期間を計測するために、所定期間計測用カウンタが用いられる。所定期間計測用カウンタの値は、初期値ｍから、以下に説明するスイッチ検出処理のループ（Ｓ７６３から始まってＳ７６３に戻るループ）が１回実行される毎に−１され、その値が０になると、所定期間が終了したとする。検出処理のループでは、例外はあるがほぼ一定の処理が行われるので、ループの１周に要する時間のｍ倍の時間が、ほぼ所定期間に相当する。
【０３０６】
所定期間を計測するために、払出制御用ＣＰＵ３７１の内蔵タイマを用いてもよい。すなわち、スイッチ検出処理開始時に、内蔵タイマに所定値（所定期間に相当）を設定しておく。そして、スイッチ検出処理のループが１回実行される毎に、内蔵タイマのカウント値をチェックする。そして、カウント値が０になったら、所定期間が終了したとする。内蔵タイマの値が０になったことを検出するために内蔵タイマによる割込を用いることもできるが、この段階では制御内容（ＲＡＭに格納されている各値など）を変化させないように、割込を用いず、内蔵タイマのカウント値を読み出してチェックするようなプログラム構成の方が好ましい。また、所定期間は、遊技球が、球払出装置９７から落下した時点から、賞球カウントスイッチ３０１Ａまたは球貸しカウントスイッチ３０１Ｂに到達するまでの時間以上に設定される。
【０３０７】
少なくとも、スイッチ検出処理が実行される所定期間では、賞球カウントスイッチ３０１Ａおよび球貸しカウントスイッチ３０１Ｂが遊技球を検出できる状態でなければならない。そこで、この実施の形態では、図１０に示されたように、電源基板９１０におけるコンバータＩＣ９２２の入力側に比較的大容量の補助駆動電源としてのコンデンサ９２３が接続されている。よって、遊技機に対する電力供給停止時にも、ある程度の期間は＋１２Ｖ電源電圧がスイッチ駆動可能な範囲に維持され、賞球カウントスイッチ３０１Ａおよび球貸しカウントスイッチ３０１Ｂが動作可能になる。その期間が、上記の所定期間以上になるように、コンデンサの容量が決定される。
【０３０８】
なお、入力ポートおよび払出制御用ＣＰＵ３７１も、コンバータＩＣ９２２で作成される＋５Ｖ電源で駆動されるので、電力供給停止時にも、比較的長い期間動作可能になっている。
【０３０９】
さらに、この実施の形態では、賞球路と貸し球路とを切り換えるために振分ソレノイド３１０が用いられている。よって、図１０に示されたコンデンサ９２３の容量は、少なくとも上記の所定期間の間、振分ソレノイド３１０も駆動できるような容量になっている。なお、コンデンサ９２３は、ＶSLの電源ラインと並列接続されているが、電源断信号に応じて遊技制御手段が他のソレノイド（大入賞口開閉用等）の駆動信号をオフ状態にしているので、電源断信号発生後では、コンデンサ９２３は、各ソレノイドのうちでは振分ソレノイド３１０のみを駆動できればよい。
【０３１０】
なお、この実施の形態で用いられているコンデンサ９２３は補助駆動電源の一つの例であるが、補助駆動電源として他のものを用いてもよい。少なくとも、上記の所定期間の間は、賞球カウントスイッチ３０１Ａ、球貸しカウントスイッチ３０１Ｂ、振分ソレノイド３１０および払出制御用ＣＰＵ３７１等の払出制御手段を駆動できるものであれば、他の態様の補助駆動電源を用いることができる。
【０３１１】
払出検出手段からの検出信号の入力処理（スイッチ検出処理）では、払出制御用ＣＰＵ３７１は、まず、所定期間計測用カウンタに、所定期間に対応した値ｍを設定する（ステップＳ７６２）。そして、払出制御用ＣＰＵ３７１は、所定期間計測用カウンタの値を−１し（ステップＳ７６３）、所定期間計測用カウンタの値を確認する（ステップＳ７６４）。その値が０であれば、スイッチ検出処理を終了し、制御状態を保存するための処理である電力供給停止時処理に移行する。
【０３１２】
所定期間計測用カウンタの値が０になっていなければ、賞球カウントスイッチオン中であるか否か確認する（ステップＳ７６５）。オン中であれば、検出期間用カウンタの値を１減らした後（ステップＳ７６６）、検出期間用カウンタの値が０になったか否か確認する（ステップＳ７６７）。０になっていれば、入力ポートを介して賞球カウントスイッチ３０１Ａの検出信号を確認し（ステップＳ７６８）、オン状態を示していれば、賞球カウントスイッチ３０１Ａが確実にオンしたとして、総合個数記憶の値を１減らす（ステップＳ７６９）。
【０３１３】
ステップＳ７６５で、賞球カウントスイッチオン中でないことを確認したら、入力ポートを介して賞球カウントスイッチ３０１Ａの検出信号を確認し（ステップＳ７７０）、オン状態を示していれば、賞球カウントスイッチＯＮ中フラグをセットするとともに（ステップＳ７７１）、検出期間用カウンタに初期値ｎをセットする（ステップＳ７７２）。
【０３１４】
以上の処理によって、所定期間内に賞球カウントスイッチ３０１Ａがオンしたら、総合個数記憶の値が−１される。バックアップＲＡＭの内容を保存するための処理は、このようなスイッチ検出処理の後で行われるので、払出が完了した賞球について、必ず総合個数記憶が−１される。従って、遊技球の払出に関して、保存される制御状態に矛盾が生じてしまうことが防止される。また、上記のスイッチ検出処理では、検出期間用カウンタを用いたタイマ処理が施されている。すなわち、一度賞球カウントスイッチ３０１Ａのオンが検出された後、所定時間（Ｓ７６３からＳ７６７に至りＳ７６３に戻るループにおける処理時間のｎ倍）の経過後にもオンが検出されないとスイッチオンと見なされない。従って、誤ってスイッチオン検出がなされてしまうことは防止される。
【０３１５】
なお、通常時のスイッチ処理（図３８におけるステップＳ７５１）でも、誤検出防止用のタイマ処理が施されている。よって、そのような通常時のスイッチ処理をコールするようにしてもよい。また、ここでは、検出期間用カウンタを用いたタイマ処理が行われたが、所定期間の計測の場合にＣＰＵ内蔵タイマを用いてもよいのと同様、ＣＰＵ内蔵タイマを用いてスイッチ検出処理におけるタイマ処理を実現してもよい。
【０３１６】
賞球カウントスイッチオン中でなく、かつ、賞球カウントスイッチ３０１Ａのオン状態が検出できない場合には、球貸しカウントスイッチ３０１Ｂについてスイッチ検出処理を行う。すなわち、払出制御用ＣＰＵ３７１は、球貸しカウントスイッチオン中であるか否か確認する（ステップＳ７７５）。オン中であれば、検出期間用カウンタの値を１減らした後（ステップＳ７７６）、検出期間用カウンタの値が０になったか否か確認する（ステップＳ７７７）。０になっていれば、入力ポートを介して球貸しカウントスイッチ３０１Ｂの検出信号を確認し（ステップＳ７７８）、オン状態を示していれば、球貸しカウントスイッチ３０１Ｂが確実にオンしたとして、貸し球個数記憶の値を１減らす（ステップＳ７７９）。
【０３１７】
ステップＳ７７５で、球貸しカウントスイッチオン中でないことを確認したら、入力ポートを介して球貸しカウントスイッチ３０１Ｂの検出信号を確認し（ステップＳ７８０）、オン状態を示していれば、球貸しカウントスイッチＯＮ中フラグをセットするとともに（ステップＳ７８１）、検出期間用カウンタに初期値ｎをセットする（ステップＳ７８２）。
【０３１８】
以上の処理によって、所定期間内に球貸しカウントスイッチ３０１Ｂがオンしたら、貸し球個数記憶の値が−１される。バックアップＲＡＭの内容を保存するための処理は、このようなスイッチ検出処理の後で行われるので、払出が完了した貸し球について、必ず貸し球個数記憶が−１される。従って、遊技球の払出に関して、保存される制御状態に矛盾が生じてしまうことが防止される。また、上記のスイッチ検出処理では、検出期間用カウンタを用いたタイマ処理が施されている。すなわち、球貸しカウントスイッチ３０１Ｂのオンが所定時間以上継続しないとスイッチオンと見なされない。従って、誤ってスイッチオン検出がなされてしまうことは防止される。
【０３１９】
所定期間が経過すると（ステップＳ７６４）、払出制御用ＣＰＵ３７１は、バックアップあり指定値（この例では「５５Ｈ」）をバックアップフラグにストアする（ステップＳ８０９）。バックアップフラグはバックアップＲＡＭ領域に形成されている。次いで、主基板３１のＣＰＵ５６の処理と同様の処理を行ってパリティデータを作成しバックアップＲＡＭ領域に保存する（ステップＳ８１０〜Ｓ８１９）。そして、ＲＡＭアクセスレジスタにアクセス禁止値を設定する（ステップＳ８２０）。以後、内蔵ＲＡＭのアクセスができなくなる。
【０３２０】
なお、この実施の形態では、払出制御処理において用いられるデータが格納されるＲＡＭ領域は全て電源バックアップされている。従って、その内容が正しく保存されているか否かを示すチェックサムの生成処理、およびその内容を書き換えないようにするためのＲＡＭアクセス防止処理が、払出制御状態を保存するための処理に相当する。
【０３２１】
以上のように、この実施の形態では、停電等の発生に応じて電源断信号が出力されたら、まず、球払出装置９７の駆動を停止した後、所定期間、払出検出手段からの検出信号の入力処理が実行され、その後、払出制御状態を保存するための処理が行われる。従って、停電発生時に払出途中であった遊技球も、バックアップＲＡＭの保存内容に反映される。
【０３２２】
すなわち、この実施の形態では、遊技機への電力供給停止時に制御状態をバックアップ記憶手段に保存するように構成した場合に、制御の矛盾等を生じさせないようにすることができる。
【０３２３】
ＲＡＭアクセス防止処理が完了すると、払出制御用ＣＰＵ３７１は、待機状態（ループ状態）に入る。従って、システムリセットされるまで、何もしない状態になる。
【０３２４】
なお、ここでは、賞球カウントスイッチ３０１Ａまたは球貸しカウントスイッチ３０１Ｂの検出信号がオン状態を示したらタイマ（検出期間用カウンタ）をセットし、タイマがタイムアップしたときにも検出信号がオン状態を示していたら、スイッチが確実にオンしたと判定したが、主基板３１のＣＰＵ５６と同様に、２ｍｓのタイマ（２ｍｓ計測用カウンタ）がタイムアップする毎に検出信号の判定を行うように構成してもよい。
【０３２５】
また、この実施の形態でも、電源断信号に応じて起動される処理の最初にレジスタの保存処理が行われたが、スイッチ検出処理においてレジスタを使用しない場合には、スイッチ検出処理の実行後に、すなわち、バックアップフラグの設定とチェックサムの算出の処理の前にレジスタ保存処理を行うことができる。その場合には、レジスタ保存処理、バックアップフラグ設定処理、およびチェックサム算出処理を電力供給停止時処理と見なすことができる。さらに、スイッチ検出処理において幾つかのレジスタを使用する場合であっても、使用しないレジスタについては、バックアップフラグの設定とチェックサムの算出の処理の前にレジスタ保存処理を行うことができる。
【０３２６】
この実施の形態では、未払出の賞球および貸し球の総数が保存されるが、払出回数（例えば１回について２５個）を記憶するというような他の保存方式を用いている場合であっても、電源断信号に応じて、所定期間は払出検出手段からの検出信号の入力処理が実行されるように構成されている場合には、保存される制御状態に矛盾が生じてしまうことが防止される。
【０３２７】
以上に説明したように、上記の各実施の形態では、停電等の発生に応じて電源断信号が出力されたら、まず、払出装置の駆動を停止した後、所定期間、払出検出手段からの検出信号の入力処理が実行され、その後、未払出の賞球および貸し球の総数を含む払出制御状態を保存するための処理が行われる。従って、停電発生時に払出途中であった遊技球も、バックアップＲＡＭの保存内容に反映される。よって、遊技機への電力供給停止時に制御状態をバックアップ記憶手段に保存するように構成した場合に、保存される制御状態と実際の制御状態との間に矛盾等を生じさせないようにすることができる。
【０３２８】
保存される制御状態と実際の制御状態とは合致しているが、例えば電源断前に遊技していた遊技者とは異なる者が遊技を行う場合には、そのまま制御状態を復旧させることは好ましくない。上述した各実施の形態では、クリアスイッチ９２１の操作状態に応じて電源断時の遊技状態に復旧するか否かの判断を行うようにし、その際、クリアスイッチ９２１がオン状態であれば、遊技状態復旧処理は実行されず、通常の初期化処理を実行する構成としているので、遊技店員等は、遊技機の電源供給再開時に、クリアスイッチ９２１を操作することによって、バックアップデータ記憶領域（変動データ記憶手段）に記憶されているバックアップデータにもとづく遊技状態復旧処理を実行するか否かを選択することができる。このように、保存される例えば未払出の賞球や貸し球の総数などの制御状態と実際の制御状態との間に矛盾等を生じさせないようにするだけでなく、遊技の再開時に例えば未払出の賞球や貸し球の総数などの制御状態をクリアすることを可能として、遊技店での遊技機運用上の利便性を向上させることもできる。
【０３２９】
上述した実施の形態では、電源断信号に応じて発生する割込による割込処理（上述した例ではマスク不能割込処理）の開始時に球払出装置の動作を止めるとともに、所定期間、払出検出手段からの検出信号の入力処理を行った。しかし、遊技機への電力供給停止時に、まず、そのことを示す第１の信号を発生し、さらに電圧が低下すると第２の信号を発生するようにしてもよい。そして、第１の信号に応じて球払出装置の動作を止めるとともに払出検出手段からの検出信号の入力処理を行い、第２の信号に応じて、制御状態をバックアップＲＡＭに保存するための処理を行ってもよい。
【０３３０】
図５４は、そのような制御を行うための電源基板９１０Ａの一構成例を示すブロック図である。この例では、電源基板９１０Ａには、電源監視用ＩＣ９３２も搭載されている。電源監視用ＩＣ９３２は、ＶSL電源電圧を導入し、ＶSL電源電圧を監視することによって電源断の発生を検出する。具体的には、ＶSL電源電圧が所定値（例えば＋２４Ｖ）以下になったら、電源電圧が低下したとして電圧低下信号（第１の信号）を出力する。そして、電源監視用ＩＣ９０２は、ＶSL電源電圧が所定値（この例では＋２２Ｖ）以下になったら、電源断が生ずるとして電源断信号（第２の信号）を出力する。
【０３３１】
第１の信号が発生してから第２の信号が発生するまでの期間は、遊技球が、球払出装置９７（または、賞球払出装置９７Ａ，貸し球払出装置９７Ｃ）から落下した時点から、賞球カウントスイッチ３０１Ａまたは球貸しカウントスイッチ３０１Ｂに到達するまでの時間以上に設定される。すなわち、その時間以上になるように、電源監視用ＩＣ９０２，９３２の監視電圧が設定される。電源監視用ＩＣ９３２の出力は、バッファ回路９３９，９４０を経て主基板３１および払出制御基板３７に至る。
【０３３２】
主基板３１において、第１の信号である電圧低下信号は、ＣＰＵ５６のマスク可能外部割り込み端子に接続される。また、第２の信号である電源断信号は、上述した実施の形態と同様に、マスク不能割込端子に接続される。すなわち、第２の信号にもとづく割込の優先度は、第１の信号にもとづく割込の優先度よりも高い。
【０３３３】
図５４、図５５は、第１の信号の発生に応じて生ずる割込にもとづいて起動される割込処理（電圧低下割込処理）の一例を示すフローチャートである。主基板３１のＣＰＵ５６は、ＡＦレジスタ（アキュミュレータとフラグのレジスタ）を所定のバックアップＲＡＭ領域に退避する（ステップＳ４５１）。また、割込フラグをパリティフラグにコピーする（ステップＳ４５２）。パリティフラグはバックアップＲＡＭ領域に形成されている。また、ＢＣレジスタ、ＤＥレジスタ、ＨＬレジスタ、ＩＸレジスタおよびスタックポインタをバックアップＲＡＭ領域に退避する（ステップＳ４５４〜Ｓ４５８）。
【０３３４】
次いで、ＣＰＵ５６は、２ｍｓ計測用カウンタに２ｍｓの時間に相当する初期値ｎを設定する（ステップＳ４６１）。そして、２ｍｓ計測用カウンタの値が０になるまで（ステップＳ４６２）、２ｍｓ計測用カウンタの値を−１する（ステップＳ４６５）。２ｍｓ計測用カウンタの値が０になると、入力ポート１に入力されているデータを入力する（ステップＳ４６４）。次いで、クリアデータ（００）をセットする（ステップＳ４６５）。また、入力ポート１からの入力データを「比較値」として設定する（ステップＳ４６６）。さらに、賞球カウントスイッチ３０１Ａのためのスイッチタイマのアドレスをポインタにセットする（ステップＳ４６７）。
【０３３５】
そして、ポインタ（スイッチタイマのアドレスが設定されている）が指すスイッチタイマをロードするとともに（ステップＳ４６８）、比較値を右（上位ビットから下位ビットへの方向）にシフトする（ステップＳ４６９）。比較値には入力ポート１のデータ設定されている。そして、この場合には、賞球カウントスイッチ３０１Ａの検出信号がキャリーフラグに押し出される。
【０３３６】
キャリーフラグの値が「１」であれば（ステップＳ４７０）、すなわち賞球カウントスイッチ３０１Ａの検出信号がオン状態であれば、スイッチタイマの値を１加算する（ステップＳ４７１）。キャリーフラグの値が「０」であれば、すなわち賞球カウントスイッチ３０１Ａの検出信号がオフ状態であれば、スイッチタイマにクリアデータをセットする（ステップＳ４７２）。すなわち、スイッチがオフ状態であれば、スイッチタイマの値が０に戻る。
【０３３７】
そして、スイッチタイマの値が２になったときに（ステップＳ４７３）、総賞球数格納バッファの格納値を１減算するとともに（ステップＳ４７４）、賞球情報カウンタの値を＋１する（ステップＳ４７５）。そして、賞球情報カウンタの値が１０以上であれば（ステップＳ４７６）、賞球情報出力カウンタの値を＋１するとともに（ステップＳ４７７）、賞球情報カウンタの値を−１０する（ステップＳ４７８）。そして、ステップＳ４６１に戻る。
【０３３８】
ステップＳ４６１〜Ｓ４７８のスイッチ検出処理を行っている間に、電源電圧が低下していくので、第２の信号が発生するはずである。従って、マスク不能割込が発生する。図５７は、マスク不能割込の一例を示すフローチャートである。
【０３３９】
マスク不能割込処理において、ＣＰＵ５６は、バックアップあり指定値（この例では「５５Ｈ」）をバックアップフラグにストアする（ステップＳ４８１）。バックアップフラグはバックアップＲＡＭ領域に形成されている。次いで、パリティデータを作成する（ステップＳ４８２〜Ｓ４９１）。
【０３４０】
そして、ＲＡＭアクセスを禁止した後に（ステップＳ４９２）、全ての出力ポートをオフ状態にする（ステップＳ４９３〜Ｓ４９９）。出力ポートに対するクリア処理が完了すると、ＣＰＵ５６は、待機状態（ループ状態）に入る。従って、システムリセットされるまで、何もしない状態になる。
【０３４１】
以上の処理によって、所定期間（第１の信号発生から第２の信号発生までの期間）内に賞球カウントスイッチ３０１Ａがオンしたら、総賞球数バッファの値が−１される。バックアップＲＡＭの内容を保存するための処理は、このようなスイッチ検出処理の後で行われるので、払出が完了した賞球について、必ず総賞球数バッファが−１される。従って、遊技球の払出に関して、保存される制御状態に矛盾が生じてしまうことが防止される。なお、既に説明したように、所定期間において、払出検出手段以外の他の検出手段（スイッチ）の検出信号についても入力チェック処理を行ってもよい。
【０３４２】
また、出力ポートのクリア処理を、図５５および図５６に示した電圧低下割込処理におけるスイッチ検出処理の前（ステップＳ４５８の後）に行ってもよい。
【０３４３】
なお、この実施の形態では、電圧低下信号（第１の信号）に応じて起動される処理の最初にレジスタの保存処理が行われたが、スイッチ検出処理においてレジスタを使用しない場合には、スイッチ検出処理の実行後に、すなわち、第２の信号に応じて起動される処理において、レジスタ保存処理を行うことができる。その場合には、レジスタ保存処理、バックアップフラグ設定処理、チェックサム算出処理および出力ポートのオフ設定処理を電力供給停止時処理と見なすことができる。さらに、スイッチ検出処理において幾つかのレジスタを使用する場合であっても、使用しないレジスタについては、第２の信号に応じて起動される処理においてレジスタ保存処理を行うことができる。
【０３４４】
図５８は、払出検出手段からの検出信号の入力処理が実行される様子の一例を示すタイミング図である。図５８に示すように、電圧低下信号がオン（この例ではハイレベルからローレベルに変化）するあたりで球払出が実行された場合、払出検出手段からの検出信号の入力処理が実行される所定期間（第２の信号が発生する前での期間）内で賞球カウントスイッチ３０１Ａがオンする。従って、電圧低下信号がオンするあたりで実行された球払出についても、総賞球数バッファに反映することができる。
【０３４５】
払出制御基板３７においも、第１の信号である電圧低下信号は、払出制御用ＣＰＵ３７１のマスク可能外部割り込み端子に接続される。また、第２の信号である電源断信号は、上述した実施の形態と同様に、マスク不能割込端子に接続される。すなわち、第２の信号にもとづく割込の優先度は、第１の信号にもとづく割込の優先度よりも高い。
【０３４６】
図５９は、第１の信号の発生に応じて生ずる割込にもとづいて起動される割込処理（電圧低下割込処理）の一例を示すフローチャートである。払出制御用ＣＰＵ３７１は、まず、ＡＦレジスタを所定のバックアップＲＡＭ領域に退避する（ステップＳ８０１）。また、割込フラグをパリティフラグにコピーする（ステップＳ８０２）。パリティフラグはバックアップＲＡＭ領域に形成されている。また、ＢＣレジスタ、ＤＥレジスタ、ＨＬレジスタ、ＩＸレジスタおよびスタックポインタをバックアップＲＡＭ領域に退避する（ステップＳ８０４〜８０８）。
【０３４７】
次いで、払出モータ２８９に出力される駆動信号をオフ状態にする（ステップＳ７６１）。よって、球払出装置９７の駆動は停止する。賞球払出装置９７Ａと貸し球払出装置９７Ｃとが別個に設けられている場合には、双方の駆動を停止する。
【０３４８】
そして、賞球カウントスイッチオン中であるか否か確認する（ステップＳ７６５）。オン中であれば、検出期間用カウンタの値を１減らした後（ステップＳ７６６）、検出期間用カウンタの値が０になったか否か確認する（ステップＳ７６７）。０になっていれば、入力ポートを介して賞球カウントスイッチ３０１Ａの検出信号を確認し（ステップＳ７６８）、オン状態を示していれば、賞球カウントスイッチ３０１Ａが確実にオンしたとして、総合個数記憶の値を１減らす（ステップＳ７６９）。
【０３４９】
ステップＳ７６５で、賞球カウントスイッチオン中でないことを確認したら、入力ポートを介して賞球カウントスイッチ３０１Ａの検出信号を確認し（ステップＳ７７０）、オン状態を示していれば、賞球カウントスイッチＯＮ中フラグをセットするとともに（ステップＳ７７１）、検出期間用カウンタに初期値ｎをセットする（ステップＳ７７２）。
【０３５０】
以上の処理によって、所定期間内に賞球カウントスイッチ３０１Ａがオンしたら、総合個数記憶の値が−１される。バックアップＲＡＭの内容を保存するための処理は、このようなスイッチ検出処理の後で行われるので、払出が完了した賞球について、必ず総合個数記憶が−１される。従って、遊技球の払出に関して、保存される制御状態に矛盾が生じてしまうことが防止される。また、上記の処理では、検出期間用カウンタを用いたタイマ処理が施されている。すなわち、一度賞球カウントスイッチ３０１Ａのオンが検出された後、所定時間（Ｓ７６３からＳ７６７に至りＳ７６３に戻るループにおける処理時間のｎ倍）の経過後にもオンが検出されないとスイッチオンと見なされない。従って、誤ってスイッチオン検出がなされてしまうことは防止される。
【０３５１】
賞球カウントスイッチオン中でなく、かつ、賞球カウントスイッチ３０１Ａのオン状態が検出できない場合には、球貸しカウントスイッチ３０１Ｂについてスイッチ検出処理を行う。なお、その処理は、既に説明した実施の形態の場合と同様である（図５２参照）。賞球カウントスイッチ３０１Ａおよび球貸しカウントスイッチ３０１Ｂについてスイッチ検出処理を行っている間に、電源電圧が低下していくので、第２の信号が発生するはずである。従って、マスク不能割込が発生する。
【０３５２】
なお、この実施の形態でも、少なくとも第２の信号が発生するまでの間、賞球カウントスイッチ３０１Ａ、球貸しカウントスイッチ３０１Ｂおよび振分ソレノイド３１０のスイッチ検出処理を行う部分と払出制御手段を駆動可能な補助駆動電源（この例ではコンデンサ９２３）が用いられている。
【０３５３】
また、ここでは、賞球カウントスイッチ３０１Ａまたは球貸しカウントスイッチ３０１Ｂの検出信号がオン状態を示したらタイマ（検出期間用カウンタ）をセットし、タイマがタイムアップしたときにも検出信号がオン状態を示していたら、スイッチが確実にオンしたと判定したが、主基板３１のＣＰＵ５６と同様に、２ｍｓのタイマ（２ｍｓ計測用カウンタ）がタイムアップする毎に検出信号の判定を行うように構成してもよい。
【０３５４】
また、出力ポートのクリア処理を、図５９に示す電圧低下割込処理におけるスイッチ検出処理の前（ステップＳ８０８の後）に行ってもよい。
【０３５５】
図６０は、マスク不能割込の一例を示すフローチャートである。マスク不能割込処理において、払出制御用ＣＰＵ３７１は、まず、バックアップあり指定値（この例では「５５Ｈ」）をバックアップフラグにストアする（ステップＳ８０９）。バックアップフラグはバックアップＲＡＭ領域に形成されている。次いで、主基板３１のＣＰＵ５６の処理と同様の処理を行ってパリティデータを作成しバックアップＲＡＭ領域に保存する（ステップＳ８１０〜Ｓ８１９）。そして、ＲＡＭアクセスレジスタにアクセス禁止値を設定する（ステップＳ８２０）。以後、内蔵ＲＡＭのアクセスができなくなる。
【０３５６】
さらに、払出制御用ＣＰＵ３７１は、クリアデータ（００）を適当なレジスタにセットし（ステップＳ８２１）、処理数（この例では「３」）を別のレジスタにセットする（ステップＳ８２２）。また、出力ポートＣのアドレス（この例では「００Ｈ」）をＩＯポインタに設定する（ステップＳ８２３）。ＩＯポインタとして、さらに別のレジスタが用いられる。
【０３５７】
そして、ＩＯポインタが指すアドレスにクリアデータをセットするとともに（ステップＳ８２４）、ＩＯポインタの値を１増やし（ステップＳ８２５）、処理数の値を１減算する（ステップＳ８２７）。ステップＳ８２４〜Ｓ８２６の処理が、処理数の値が０になるまで繰り返される。その結果、全ての出力ポートＣ〜Ｅ（図３６参照）にクリアデータが設定される。
【０３５８】
出力ポートに対するクリア処理が完了すると、払出制御用ＣＰＵ３７１は、待機状態（ループ状態）に入る。従って、システムリセットされるまで、何もしない状態になる。
【０３５９】
この実施の形態では、電源基板９１０Ａに搭載された電源監視手段（この例では電源監視用ＩＣ９０２，９３２）が電源を監視し、第１の条件（この例では＋３０Ｖ電源電圧が＋２４Ｖ以下になること）が成立したら第１の信号を出力し、第２の条件（この例では＋３０Ｖ電源電圧が＋２２Ｖ以下になること）が成立したら第２の信号を出力する。第１の信号が発生してから第２の信号が発生するまでの期間は、払出手段から払い出された遊技球が払出検出手段に到達するまでの時間以上に設定されている。なお、この実施の形態で用いた＋２２Ｖおよび＋２４Ｖの条件は一例であって、遊技機の機種に応じて異なる値になることもある。
【０３６０】
そして、第１の信号に応じた処理において、まず、払出装置の駆動を停止した後、払出検出手段からの検出信号の入力処理が繰り返し実行され、その後、第２の信号に応じて払出制御状態を保存するための処理が行われる。従って、停電発生時に払出途中であった遊技球も第１の信号に応じた処理で検出されるので、第２の信号に応じた処理においてバックアップＲＡＭの保存内容に反映される。よって、遊技機への電力供給停止時に制御状態をバックアップ記憶手段に保存するように構成した場合に、保存される制御状態と実際の制御状態との間に矛盾等を生じさせないようにすることができる。
【０３６１】
電圧低下信号がオン（この例ではハイレベルからローレベルに変化）するあたりで球払出が実行された場合、払出検出手段からの検出信号の入力処理が実行される所定期間（第２の信号が発生する前での期間）内で賞球カウントスイッチ３０１Ａまたは球貸しカウントスイッチ３０１Ｂがオンする。この実施の形態では、第１の信号の発生に応じて起動される電圧低下割込処理（図５９参照）でスイッチ入力処理が実行されるので、従って、電圧低下信号がオンするあたりで実行された球払出についても、総合個数記憶または貸し球個数記憶に反映することができる。
【０３６２】
なお、この実施の形態では、電圧低下信号（第１の信号）に応じて起動される処理の最初にレジスタの保存処理が行われたが、スイッチ検出処理においてレジスタを使用しない場合には、スイッチ検出処理の実行後に、すなわち、第２の信号に応じて起動される処理において、レジスタ保存処理を行うことができる。その場合には、レジスタ保存処理、バックアップフラグ設定処理、チェックサム算出処理および出力ポートのオフ設定処理を電力供給停止時処理と見なすことができる。さらに、スイッチ検出処理において幾つかのレジスタを使用する場合であっても、使用しないレジスタについては、第２の信号に応じて起動される処理においてレジスタ保存処理を行うことができる。
【０３６３】
また、上記の各実施の形態では、遊技制御手段および払出制御手段が電源断信号に応じてスイッチ検出処理を行う場合を例示したが、表示制御手段、音制御手段およびランプ制御手段についても、制御状態保存処理が行われる場合に、電源断信号に応じて、所定の電気部品の駆動を停止し、その電気部品に関連するスイッチ手段の検出信号を所定期間に渡って確認した後に、制御状態保存処理を行うように構成してもよい。
【０３６４】
また、上記の各実施の形態では、クリアスイッチ９２１を押しボタン構造としていたが、他の構造であってもよい。図６１は、スイッチ基板１９０に搭載された他の実施の形態におけるクリアスイッチ９２１の構成の一例を示す外観構成図である。図６１に示すクリアスイッチ９２１は、「ＯＦＦ」、「ＯＮ」および「クリア」の選択切り換えがされる切換操作スイッチ９２１ａを有する。この例では、クリアスイッチ９２１の「ＯＦＦ」が選択されているときは何らの信号も発生せずに動作停止中となっており、「ＯＮ」が選択されているときはハイレベルの信号を出力する。クリアスイッチ９２１は、この例では、遊技機１に対する電源供給のオン／オフ切換のためのスイッチと連動された構成とされている。従って、クリアスイッチ９２１で「ＯＦＦ」が選択されているときには遊技機１の電源供給が停止された状態（遊技機の電源がオフの状態）にあり、「ＯＮ」および「クリア」が選択されているときには遊技機１が稼動している状態（遊技機の電源がオンの状態）にあるとすればよい。また、クリアスイッチ９２１の「クリア」が選択されているときに、ローレベルのクリア信号を出力するようにすればよい。
【０３６５】
なお、上述した各実施の形態において説明したように、貸し球個数記憶の内容は、遊技機の電源が断しても、所定期間電源基板９１０のバックアップ電源によって保存され、所定期間中に電源が回復すると、払出制御用ＣＰＵ３７１は、貸し球個数記憶の内容にもとづいて球貸し処理を継続することができる。このような処理がなされる場合に、入力ポート３７２ｂおよび出力ポート３７２ｅを介して、カードユニット５０と払出制御基板３７の間でやりとりされる各種信号（ＢＲＤＹ信号、ＢＲＱ信号、ＥＸＳ信号、およびＰＲＤＹ信号）の状態について説明する。
【０３６６】
図６２は、電源供給が復帰した場合に、貸し球個数記憶の内容にもとづいて未払出数の貸し球を払出すための払出処理が実行されるときの各信号の状態の一例を示すタイミング図である。なお、図６２には、電源の供給が停止されるまでの各信号の状態の例も示されている。
【０３６７】
図６２に示すように、パチンコ遊技機１の電源が投入されると、払出制御基板３７の払出制御用ＣＰＵ３７１がカードユニット５０にＰＲＤＹ信号を出力するため、ＰＲＤＹ信号がオンとなる。次いで、カードユニット５０においてカードが受け付けられ、球貸しスイッチが操作され球貸しスイッチ信号が入力されると、カードユニット制御用マイクロコンピュータが払出制御基板３７にＢＲＤＹ信号を出力するため、ＢＲＤＹ信号がオンとなる。この時点から所定の遅延時間が経過すると、カードユニット制御用マイクロコンピュータが払出制御基板３７にＢＲＱ信号を出力するので、ＢＲＱ信号がオンとなる。
【０３６８】
そして、払出制御基板３７の払出制御用ＣＰＵ３７１は、カードユニット５０に対するＥＸＳ信号を立ち上げ、カードユニット５０からのＢＲＱ信号の立ち下がりを検出すると、払出モータ２８９を駆動し、所定個の貸し球を遊技者に払い出す。そして、払出が完了したら、払出制御用ＣＰＵ３７１は、カードユニット５０に対するＥＸＳ信号を立ち下げる。しかし、払出が完了する前に電源断が発生すると、遊技機は、貸し球個数記憶の内容が所定期間電源基板９１０のバックアップ電源によって保存された状態で電源の供給が開始されるのを待つ。
【０３６９】
貸し球個数記憶の内容が保存された状態で電源の供給が開始されると、払出制御用ＣＰＵ３７１がカードユニット５０にＰＲＤＹ信号を出力するため、ＰＲＤＹ信号がオンとなる。そして、払出制御用ＣＰＵ３７１は、ＢＲＤＹ信号、およびＢＲＱ信号を受けていない状態ではあるが、カードユニット５０に対するＥＸＳ信号を立ち上げ、未払出数の貸し球を払出す。このとき、カードユニット５０側では、一時的にエラー状態となる。未払出の貸し球の払出処理が実行されている際には、上記のように、各信号が立ち上げられ、または立ち下げられる。
【０３７０】
また、上記の各実施の形態では、電源監視回路は電源基板９１０に設けられたが、電源監視回路は主基板３１や払出制御基板３７などの電気部品制御基板に設けられていてもよい。電源回路が搭載された電気部品制御基板が構成される場合には、電源基板には電源監視回路は搭載されない。
【０３７１】
上記の各実施の形態のパチンコ遊技機１は、主として、始動入賞にもとづいて可変表示部９に可変表示される特別図柄の停止図柄が所定の図柄の組み合わせになると所定の遊技価値が遊技者に付与可能になる第１種パチンコ遊技機であったが、始動入賞にもとづいて開放する電動役物の所定領域への入賞があると所定の遊技価値が遊技者に付与可能になる第２種パチンコ遊技機や、始動入賞にもとづいて可変表示される図柄の停止図柄が所定の図柄の組み合わせになると開放する所定の電動役物への入賞があると所定の権利が発生または継続する第３種パチンコ遊技機であっても、本発明を適用できる。
【０３７２】
さらに、遊技媒体が遊技球であるパチンコ遊技機に限られず、スロット機等においても、遊技媒体の払い出しを行う電気部品が備えられている場合には本発明を適用することができる。
【０３７３】
【発明の効果】
以上のように、本発明によれば、払出制御用変動データ記憶手段に記憶される変動データには、貸出要求にもとづいた遊技媒体の払出数のうち払出しが完了していない未払出数を特定可能なデータが含まれており、払出制御用マイクロコンピュータは、電力供給再開時に記憶内容保持手段により保持された未払出数を特定可能なデータにもとづいて遊技媒体の払出制御を再開することが可能であるとともに、初期化操作手段が所定の操作状態である場合に記憶内容保持手段によって保持される最終記憶内容を初期化することが可能である構成としたので、電源断が発生した場合であっても、未払出しの貸出遊技媒体数をバックアップ記憶することができ、適正な制御状態を保存することが可能となる。また、遊技店員などの判断により、保存された制御状態に復旧させないようにすることもできる。また、遊技制御用マイクロコンピュータおよび払出制御用マイクロコンピュータが、初期化操作手段からの操作信号が入力されているか否かを、遊技媒体を検出するための遊技媒体検出手段からの検出出力を判定する遊技媒体検出判定期間よりも短い要求検出判定期間で判定する場合には、初期化操作手段の操作状態を判定する処理と遊技媒体の検出ありを判定する処理とを異ならせることができるので、各々のオン判定期間を適切な期間に設定することが容易である。
【０３７５】
払出制御用マイクロコンピュータが所定のデータを取得するための入力ポートが設けられ、初期化操作手段が所定の操作状態とされているときに出力される初期化信号が入力ポートに入力されるとした場合には、既存の入力ポートを利用した簡単な構成で、初期化操作手段の操作の操作状態に応じて出力される初期化信号を導入することが可能となる。
【０３７６】
払出制御用マイクロコンピュータが、電源監視手段が検出信号を出力したときに、遊技媒体検出手段からの検出出力の入力処理を所定期間実行した後、払出制御用電力供給停止時処理を行うとした場合には、検出すべき遊技媒体を検出することができ、遊技媒体数に関する適正な制御状態をバックアップ記憶することができる。
【０３７７】
払出制御用マイクロコンピュータが出力ポートを介して貸出遊技媒体払出機構部に駆動信号を出力し、電源監視手段が検出信号を出力したときに、出力ポートをオフ状態にした後、遊技媒体検出手段からの検出出力の入力処理を実行するとした場合には、貸出遊技媒体払出機構部によって新たに遊技媒体が払い出されることがないようにした状態で、遊技媒体の検出を行うことができるため、遊技媒体数に関するさらに適正な制御状態をバックアップ記憶することができる。
【０３７８】
電源監視手段が検出信号を出力した後の、払出制御用マイクロコンピュータによる遊技媒体検出手段からの検出出力の入力処理の実行中に、払出制御用マイクロコンピュータおよび遊技媒体検出手段を駆動可能な電源を供給可能な補助駆動電源供給手段を備えるとした場合には、遊技媒体検出手段からの検出信号の入力処理を確実に完了することができるため、適正な遊技媒体の検出処理を行うことが可能となる。
【０３８０】
払出制御用マイクロコンピュータによって制御され、入賞に応じて遊技媒体の払出を行う賞遊技媒体払出機構部を備え、払出制御用変動データ記憶手段に記憶される変動データは、入賞に応じて払い出される遊技媒体の払出数のうち賞遊技媒体払出機構部による払出しが完了していない未払出数を特定可能なデータを含むとした場合には、貸出要求に応じて払い出される遊技媒体の未払出数だけでなく、遊技の進行に応じて払い出される遊技媒体の未払出数をも適正にバックアップ記憶することが可能となる。
【０３８１】
遊技媒体検出手段として、賞遊技媒体検出手段と、貸出遊技媒体検出手段とを別個に設けた場合には、貸出要求に応じて払い出される遊技媒体の検出と、遊技の進行に応じて払い出される遊技媒体の検出とをそれぞれ別個に行うことが可能となる。
【図面の簡単な説明】
【図１】 パチンコ遊技機を正面からみた正面図である。
【図２】 パチンコ遊技機の裏面に設けられている各基板を示す説明図である。
【図３】 パチンコ遊技機の機構盤を背面からみた背面図である。
【図４】 機構板に設置されている中間ベースユニット周りの構成を示す正面図である。
【図５】 球払出装置を示す分解斜視図である。
【図６】 スイッチ基板が搭載された遊技盤を正面からみた例を示す正面図である。
【図７】 クリアスイッチの構成の例を示す回路図である。
【図８】 遊技制御基板（主基板）の回路構成を示すブロック図である。
【図９】 払出制御基板および球払出装置の構成要素などの賞球に関連する構成要素を示すブロック図である。
【図１０】 電源基板の一構成例を示すブロック図である。
【図１１】 主基板におけるＣＰＵ周りの一構成例を示すブロック図である。
【図１２】 入力ポートのビット割り当ての一例を示す説明図である。
【図１３】 主基板におけるＣＰＵが実行するメイン処理を示すフローチャートである。
【図１４】 バックアップフラグと遊技状態復旧処理を実行するか否かとの関係の一例を示す説明図である。
【図１５】 ２ｍｓタイマ割込処理を示すフローチャートである。
【図１６】 ＲＡＭにおけるスイッチタイマの形成例を示す説明図である。
【図１７】 スイッチ処理の一例を示すフローチャートである。
【図１８】 スイッチチェック処理の一例を示すフローチャートである。
【図１９】 賞球処理の一例を示すフローチャートである。
【図２０】 賞球処理の一例を示すフローチャートである。
【図２１】 賞球処理の一例を示すフローチャートである。
【図２２】 スイッチオンチェック処理を示すフローチャートである。
【図２３】 賞球個数減算処理の一例を示すフローチャートである。
【図２４】 入力判定値テーブルの構成例を示す説明図である。
【図２５】 制御コマンドのコマンド形態の一例を示す説明図である。
【図２６】 制御コマンドを構成する８ビットの制御信号とＩＮＴ信号との関係を示すタイミング図である。
【図２７】 払出制御コマンドの内容の一例を示す説明図である。
【図２８】 コマンド送信テーブルの一構成例を示す説明図である。
【図２９】 遊技制御手段におけるマスク不能割込処理を示すフローチャートである。
【図３０】 遊技制御手段におけるマスク不能割込処理を示すフローチャートである。
【図３１】 遊技制御手段におけるマスク不能割込処理を示すフローチャートである。
【図３２】 検出信号の入力処理が実行される様子の一例を示すタイミング図である。
【図３３】 第３種パチンコ遊技機の遊技領域の一例を示す説明図である。
【図３４】 遊技状態復旧処理の一例を示すフローチャートである。
【図３５】 電源監視および電源バックアップのための払出制御用ＣＰＵ周りの一構成例を示すブロック図である。
【図３６】 出力ポートのビット割り当ての一例を示す説明図である。
【図３７】 入力ポートのビット割り当ての一例を示す説明図である。
【図３８】 払出制御基板におけるＣＰＵが実行するメイン処理を示すフローチャートである。
【図３９】 ２ｍｓタイマ割込処理を示すフローチャートである。
【図４０】 払出制御手段におけるＲＡＭの一構成例を示す説明図である。
【図４１】 受信バッファの一構成例を示す説明図である。
【図４２】 払出制御用ＣＰＵのコマンド受信処理の例を示すフローチャートである。
【図４３】 コマンド解析実行処理の例を示すフローチャートである。
【図４４】 払出停止状態設定処理の例を示すフローチャートである。
【図４５】 スイッチ処理の例を示すフローチャートである。
【図４６】 球貸し制御処理の例を示すフローチャートである。
【図４７】 球貸しカウントスイッチチェック処理の例を示すフローチャートである。
【図４８】 賞球制御処理の例を示すフローチャートである。
【図４９】 賞球制御処理の例を示すフローチャートである。
【図５０】 賞球カウントスイッチチェック処理の例を示すフローチャートである。
【図５１】 払出制御手段におけるマスク不能割込処理を示すフローチャートである。
【図５２】 払出制御手段におけるマスク不能割込処理を示すフローチャートである。
【図５３】 払出制御手段におけるマスク不能割込処理を示すフローチャートである。
【図５４】 電源基板の他の構成例を示すブロック図である。
【図５５】 遊技制御手段の電圧低下割込処理を示すフローチャートである。
【図５６】 遊技制御手段の電圧低下割込処理を示すフローチャートである。
【図５７】 遊技制御手段のマスク不能割込処理の他の例を示すフローチャートである。
【図５８】 検出信号の入力処理が実行される様子の一例を示すタイミング図である。
【図５９】 払出制御手段の電圧低下割込処理を示すフローチャートである。
【図６０】 払出制御手段のマスク不能割込処理の他の例を示すフローチャートである。
【図６１】 他の実施の形態におけるクリアスイッチの外観構成の例を示す説明図である。
【図６２】 未払出数の貸し球の払出処理が実行されるときの各信号の状態の一例を示すタイミング図である。
【符号の説明】
３１ 遊技制御基板（主基板）
３７ 払出制御基板
５４ ＲＯＭ
５５ ＲＡＭ
５６ ＣＰＵ
９７ 球払出装置
３０１Ａ 賞球カウントスイッチ
３０１Ｂ 貸し球カウントスイッチ
３７１ 払出制御用ＣＰＵ
９２１ クリアスイッチ[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a gaming machine such as a pachinko gaming machine, a coin gaming machine, or a slot machine in which a game is performed according to a player's operation, and particularly, a game is performed according to a player's operation in a gaming area on a gaming board. It relates to gaming machines.
[0002]
[Prior art]
As a gaming machine, when a game medium such as a game ball is launched into a game area by a launching device and the game medium wins in a prize area such as a prize opening provided in the game area, the value of a predetermined number of prize balls etc. Is paid out to the person. The game medium is paid out by a payout mechanism.
[0003]
The payout mechanism is generally controlled by prize ball control means mounted on the payout control board. Since the progress of the game is controlled by game control means mounted on the main board, the number of winning balls based on the winning is determined by the game control means and transmitted to the payout control board.
[0004]
The player also borrows game media and plays a game using the borrowed game media and the game media paid out in accordance with the winning. At that time, the game medium lending request from the player is received once by a lending request processing device such as a card unit, and the lending control means of the gaming machine receives the lending request from the player by communicating with the lending request processing device. A gaming machine lends game media in response to a lending request from a player, but the prize ball control means and the lending control means are often constituted by an integrated payout control means. In general, the payout control means includes a payout control microcomputer.
[0005]
[Problems to be solved by the invention]
When a power failure occurs due to a power failure, etc., the game machine must be restored to its initial state (for example, the state when the game machine was first turned on that day at the amusement store). , There may be a penalty for the player. For example, when the power-off state occurs due to a power failure, etc., while the payout control means has not completed the lending processing of all game media corresponding to the lending request via the lending request processing device, When the state of the gaming machine returns to the initial state, the rented game medium is not paid out, resulting in a disadvantage to the player. In addition, if a power-off state due to a power failure or the like occurs while the prize ball payout according to the winning is not completed, when the power supply is restored, the gaming medium as a prize ball when the state of the gaming machine returns to the initial state Unpaid, resulting in a disadvantage to the player.
[0006]
In order to prevent such a problem from occurring, before the power supply is stopped, the gaming state at that time is saved in a storage means (backup storage means) that is backed up while the power supply to the gaming machine is stopped. In addition, when power supply is resumed in a state where the gaming state is stored in the storage means, it is conceivable to resume the game based on the saved gaming state.
[0007]
However, if the control is performed such that the game is restarted based on the stored game state, the convenience of the game store where the game machine is installed may be impaired. For example, if there is a player who has given up to continue the game without waiting for the game to resume when a power failure occurs and the game can not be continued, other players can start the game from the middle of the game Therefore, it is not preferable to restore the gaming state to the state before the power failure.
[0008]
Therefore, the present invention can prevent a player from being disadvantaged with respect to the value payout of a game medium or the like even if a power failure state due to a power failure or the like occurs in the game machine, and a game machine at a game store It is an object of the present invention to provide a gaming machine that can improve operational convenience.
[0009]
[Means for Solving the Problems]
  A gaming machine according to the present invention is a gaming machine in which a player can play a predetermined game, and has a game control variation data storage means for storing variation data generated when control is performed. A game control microcomputer for controlling the progress, a payout control fluctuation data storage means for storing fluctuation data generated when the control is performed, and a payout control microcomputer for controlling the payout of the game medium; A rented game medium payout mechanism that is controlled by a control microcomputer and pays out game media in response to a rent request, and a game control variable data storage means and payout control even when power supply to the gaming machine is stopped The storage contents holding means capable of holding the storage contents of the fluctuation data storage means for a predetermined period, and the state of a predetermined power source used in the gaming machine are monitored to generate a power interruption. Power detection means for outputting a detection signal when detecting the operation, and initialization operation means for outputting an operation signal in response to an operation. The game control microcomputer sets a backup flag in response to the input of the detection signal. Power supply including game control power supply stop processing means for performing game control power supply stop processing for setting in the game control variable data storage means and prohibiting access to the game control variable data storage means When the operation signal from the initialization operation means is not inputted when the game is started, the game control variable data storage means is saved on condition that the backup flag is set in the game control fluctuation data storage means. A state return control for game control that restores the control state to the state when the game control power supply stop process was started based on the stored contents. When the power supply is started, if the operation signal from the initialization operation means is input even if the backup flag is set in the game control fluctuation data storage means, the game control fluctuation data storage means It has a reset means for performing processing for initializing the stored contents and outputting a signal for stopping the operation of the game control microcomputer after the game control microcomputer completes the process for stopping the power supply for game control. The fluctuation data stored in the fluctuation data storage means for payout control includes data that can identify the number of payouts that have not been paid out of the number of game media payouts based on the lending request. The control microcomputer is a variable data storage means for payout control including a control state including data capable of specifying the number of unpaid according to the detection signal input. Operation control for confirming whether or not an operation signal is input from the initialization operation means Data that can specify the number of unpaid items on the condition that the operation signal from the initialization operation means has not been input by the operation signal confirmation processing means. Is stored in the payout control variation data storage means, the game medium payout control is resumed based on the data that can specify the number of unpaid out, and the operation signal from the initialization operation means is operated by the operation signal confirmation processing means. Is confirmed, the stored contents of the payout control variable data storage means are initialized even if the stored contents are stored in the payout control variable data storage means. Line processingThe game control microcomputer and the payout control microcomputer determine whether or not the operation signal from the initialization operation means is input, and determine the detection output from the game medium detection means for detecting the game medium. Determine with a request detection determination period shorter than the game medium detection determination periodIt is characterized by this.
[0010]
  It is preferable that an input port is provided for the payout control microcomputer to acquire predetermined data, and an operation signal from the initialization operation means is input to the input port. Also,PayThe output control microcomputer is configured to execute a process for stopping the supply of power for payout control after executing a detection output input process from the game medium detection means for a predetermined period when the power supply monitoring means outputs a detection signal. May be.
[0011]
  Dispensing controlThe microcomputer for use outputs a drive signal to the rental game medium payout mechanism through the output port, and when the power supply monitoring means outputs a detection signal, the microcomputer turns off the output port and then outputs from the game medium detection means. You may be comprised so that the input process of a detection output may be performed. In addition, the payout control microcomputer and the game medium detection means can be driven while the detection output from the game medium detection means is executed by the payout control microcomputer after the power supply monitoring means outputs the detection signal. Auxiliary drive power supply means capable of supplying power may be provided..
[0012]
  MaIn addition, it includes a prize game medium payout mechanism that is controlled by a payout control microcomputer and pays out game media in accordance with winnings, and the fluctuation data stored in the payout control fluctuation data storage means is paid out in accordance with winnings. The game medium payout number may include data that can identify the number of unpaid outs that have not been paid out by the award game medium payout mechanism unit.
[0013]
  As game medium detection means, a prize game medium detection means for detecting a game medium paid out from the award game medium payout mechanism section, and a rental game medium detection means for detecting a game medium paid out from the rental game medium payout mechanism section. May be provided separately..
[0014]
  The payout control microcomputer stores payout control information indicating that the payout control power supply stop processing is being executed by the payout control power supply stop processing means in the payout control variation data storage means, and A check data for payout control used to determine whether or not the storage contents of the payout control variation data storage means are normal is created and stored in the payout control variable data storage means, and is initialized from the initialization operation means by the operation signal confirmation processing means. On the condition that the operation signal is not input, it is confirmed whether or not the payout control information is stored in the payout control variation data storage means, and the payout control variation data storage means Based on the check data for payout control in the change data storage means for payout control, provided that it is confirmed that the payout control information is saved. Judgment is made whether the stored contents are normal, and on the condition that it is determined to be normal, the number of unpaid is specified when data that can specify the number of unpaid is stored in the variable data storage means for payout control The game medium payout control may be resumed based on the possible data..
[0015]
  The game control microcomputer stores in the game control variation data storage means game control information indicating that the game control power supply stop time processing means is being executed by the game control power supply stop time processing means. Game control check data used for determining whether or not the stored contents of the game control variation data storage means are normal are stored in the game control variation data storage means, and an operation signal is input from the initialization operation means. Including a game control side operation signal confirmation processing means for performing a game control side operation signal confirmation process for confirming whether or not an operation signal is input from the initialization operation means by the game control side operation signal confirmation processing means On the condition that the game control information is not confirmed, it is confirmed whether or not the game control information is stored in the game control variation data storage means. On the condition that it is confirmed that the game control information is stored in the storage means, it is determined whether or not the stored content is normal based on the game control check data in the game control variation data storage means. It may be configured to return the control state to the state when the game control power supply stop process is started when it is determined that.
[0016]
  Dispensing controlThe microcomputer is set to periodically generate a timer interrupt after confirming whether or not the operation signal from the initialization operation means is input by the operation signal confirmation processing means, and is periodically generated Interrupt disabled state that executes interrupt processing to control payout of game media based on the occurrence of timer interrupt, and prohibits execution of interrupt processing in the power supply stop processing for payout control Or, when the power supply is started when the processing to save the interrupt status data that indicates which of the interrupt permission states to permit execution is saved in the payout control variable data storage means is executed Based on the status data, it is configured to perform status recovery processing that recovers to the interrupt disabled status or interrupt enabled status.May be.
[0017]
  The payout control microcomputer is configured to set an interrupt prohibited state in which execution of an interrupt process is prohibited during a process of receiving a command related to payout of game media from the game control microcomputer.May be.
[0018]
  The game control microcomputer includes a game control side operation signal confirmation processing means for performing a game control side operation signal confirmation process for confirming whether or not an operation signal from the initialization operation means is input, and includes a game control side operation signal. After confirming whether or not the operation signal from the initialization operation means has been input by the confirmation processing means, it was set to generate a timer interrupt periodically, and a timer interrupt that occurred periodically occurred. Execute interrupt processing to control the progress of the game based on the above, interrupt disabled state to prohibit the execution of the interrupt processing in the processing at the time of game control power supply stop or interrupt permission state to permit the execution The interrupt state data indicating which state is stored in the game control variable data storage means is executed, and when power supply is started, interrupts are prohibited based on the interrupt state data. It may be configured to perform state recovery process to restore the state or interrupt enable state.
[0019]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, an embodiment of the present invention will be described with reference to the drawings.
First, an overall configuration of a pachinko gaming machine that is an example of a gaming machine will be described. FIG. 1 is a front view of the pachinko gaming machine 1 as seen from the front. Here, a pachinko gaming machine is shown as an example of a gaming machine, but the present invention is not limited to a pachinko gaming machine and may be, for example, a coin gaming machine or a slot machine.
[0020]
As shown in FIG. 1, the pachinko gaming machine 1 has a glass door frame 2 formed in a frame shape. On the lower surface of the glass door frame 2 is a hitting ball supply tray 3. Under the hitting ball supply tray 3, there are provided an extra ball receiving tray 4 for storing game balls overflowing from the hitting ball supply tray 3 and a hitting operation handle (operation knob) 5 for firing the hitting ball. A game board 6 is detachably attached to the rear side of the glass door frame 2. A game area 7 is provided in front of the game board 6.
[0021]
Near the center of the game area 7, a variable display including a variable display unit (special symbol display device) 9 for variably displaying a plurality of types of symbols and a normal symbol display device (ordinary symbol display device) 10 using a 7-segment LED. A device 8 is provided. The variable display unit 9 has, for example, three symbol display areas of “left”, “middle”, and “right”. A passing gate 11 for guiding a hit ball is provided on the side of the variable display device 8. The hit ball that has passed through the passing gate 11 is guided to the start winning opening 14 through the ball outlet 13. In the passage between the passage gate 11 and the ball exit 13, there is a gate switch 12 that detects a hit ball that has passed through the passage gate 11. The winning ball that has entered the start winning opening 14 is guided to the back of the game board 6 and detected by the start opening switch 17. A variable winning ball device 15 that opens and closes is provided below the start winning opening 14. The variable winning ball device 15 is opened by a solenoid 16.
[0022]
An open / close plate 20 that is opened by a solenoid 21 in a specific gaming state (big hit state) is provided below the variable winning ball device 15. In this embodiment, the opening / closing plate 20 is a means for opening and closing the special winning opening. Of the winning balls guided from the opening / closing plate 20 to the back of the game board 6, the winning ball entering one (V zone) is detected by the V winning switch 22. A winning ball from the opening / closing plate 20 is detected by the count switch 23. At the bottom of the variable display device 8, a start winning memory display 18 having four display units for displaying the number of winning balls that have entered the start winning opening 14 is provided. In this example, with the upper limit being four, each time there is a start prize, the start prize storage display 18 increases the number of lit display units one by one. Then, each time the variable display of the variable display unit 9 is started, the lit display unit is reduced by one.
[0023]
The game board 6 is provided with a plurality of winning holes 19, 24, and winning of the game balls to the respective winning holes 19, 24 is performed by correspondingly provided winning hole switches 19a, 19b, 24a, 24b. Detected. Decorative lamps 25 blinking during the game are provided around the left and right sides of the game area 7, and an outlet 26 for absorbing a hit ball that has not won a prize is provided below. Two speakers 27 that emit sound effects are provided on the left and right upper portions outside the game area 7. On the outer periphery of the game area 7, a game effect LED 28a and game effect lamps 28b and 28c are provided.
[0024]
In this example, a prize ball lamp 51 that is lit when there is a remaining number of prize balls is provided in the vicinity of one speaker 27, and a sphere that is lit when a supply ball is cut near the other speaker 27. A cut lamp 52 is provided. Further, FIG. 1 also shows a card unit 50 that is installed adjacent to the pachinko gaming machine 1 and enables lending of a ball by inserting a prepaid card.
[0025]
The card unit 50 has a usable indicator lamp 151 indicating whether or not it is in a usable state, and when the remaining amount information recorded in the card has a fraction (a number less than 100 yen), the fraction is indicated as a hitting tray. 3, a fraction display switch 152 for displaying on a frequency display LED provided in the vicinity of 3, a connecting table direction indicator 153 indicating which side of the pachinko gaming machine 1 corresponds to the card unit 50, in the card unit 50 Check the card insertion indicator lamp 154 indicating that a card is inserted, the card insertion slot 155 into which a card as a recording medium is inserted, and the mechanism of the card reader / writer provided on the back of the card insertion slot 155. In some cases, a card unit lock 156 is provided for releasing the card unit 50.
[0026]
The hit ball fired from the hit ball launching device enters the game area 7 through the hit ball rail, and then descends the game area 7. When the hit ball is detected by the gate switch 12 through the passing gate 11, the display number of the normal symbol display 10 changes continuously. Further, when the hit ball enters the start winning opening 14 and is detected by the start opening switch 17, the symbol in the variable display portion 9 starts to rotate if the variation of the symbol can be started. If it is not in a state where the change of the symbol can be started, the start winning memory is increased by one.
[0027]
The rotation of the image in the variable display unit 9 stops when a certain time has elapsed. If the combination of images at the time of the stop is a combination of jackpot symbols, the game shifts to a jackpot gaming state. That is, the opening / closing plate 20 is opened until a predetermined time elapses or a predetermined number (for example, 10) of hit balls wins. When the hit ball enters the specific winning area while the opening / closing plate 20 is opened and is detected by the V winning switch 22, a continuation right is generated and the opening / closing plate 20 is opened again. The generation of the continuation right is allowed a predetermined number of times (for example, 15 rounds).
[0028]
When the combination of images in the variable display section 9 at the time of stop is a combination of jackpot symbols with probability fluctuations, the probability of the next jackpot increases. That is, it becomes a more advantageous state for the player in a high probability state. Further, when the stop symbol in the normal symbol display 10 is a predetermined symbol (winning symbol = small winning symbol), the variable winning ball device 15 is opened for a predetermined time. Further, in the high probability state, the probability that the stop symbol in the normal symbol display 10 becomes a winning symbol is increased, and the opening time and the number of times of opening of the variable winning ball device 15 are increased.
[0029]
Next, each board | substrate arrange | positioned at the back surface of the pachinko game machine 1 is demonstrated.
As shown in FIG. 2, on the back surface of the pachinko gaming machine 1, a ball storage tank 38 is provided on the upper part of the mechanism plate in the frame 2 </ b> A, and the pachinko gaming machine 1 is installed above the gaming machine installation island. The game balls are supplied to the ball storage tank 38. The game balls in the ball storage tank 38 pass through the guide basket 39 and reach the ball payout device covered with the prize ball case 40A.
[0030]
On the back side of the gaming machine, there are installed a variable display control unit 29 for controlling the variable display unit 9, a game control board (main board) 31 on which a game control microcomputer and the like are mounted. Further, a payout control board 37 on which a payout control microcomputer for performing ball payout control and the like, and a hitting ball launching device for hitting a hitting ball into the game area 7 using the rotational force of the motor are installed. Furthermore, the sound control for controlling the sound generation from the decoration lamp 25, the game effect LED 28a, the game effect lamps 28b and 28c, the lamp control board 35 for sending signals to the prize ball lamp 51 and the ball break lamp 52, and the speaker 27. A launch control board 91 for controlling the board 70 and the ball hitting device is also provided. The payout control board 37 is also equipped with an error display LED 374.
[0031]
In addition, a power supply board 910 on which a power supply circuit for creating DC30V, DC21V, DC12V and DC5V is mounted is provided, and a terminal board 160 having various terminals for outputting various information to the outside of the gaming machine is installed above. Has been. The terminal board 160 has at least a ball break terminal for introducing and outputting an output of the ball break detection switch, an award ball terminal for outputting the award ball number signal to the outside, and a ball lending number signal externally output. A ball lending terminal is provided. In addition, an information terminal board 34 having terminals for outputting various information from the main board 31 to the outside of the gaming machine is installed near the center.
[0032]
Further, in FIG. 2, signals from the lamp control board 35 and the sound control board 70 are supplied to the game effect LED 28 a, the game effect lamps 28 b and 28 c, the prize ball lamp 51 and the ball-out lamp 52 provided on the frame side. The balance display board | substrate 74 carrying the electrical decoration relay board | substrate A77 and frequency display LED etc. for doing is shown. In this embodiment, the clear switch 921 for clearing the backup data stored in the fluctuation data storage means (for example, backup RAM) included in each board (for example, the main board 31 and the payout control board 37) is provided. A mounted switch board 190 is provided. The switch board 190 is provided with a connector (see FIGS. 6 and 7) that is connected to another board such as a main board. Further, although not shown, other relay boards are also provided as necessary for signal relay.
[0033]
FIG. 3 is a rear view of the mechanism plate of the pachinko gaming machine 1 as seen from the back. The balls stored in the ball storage tank 38 pass through the guide rod 39 and pass through the ball break detectors (ball break switches) 187a and 187b, as shown in FIG. 3, through the ball supply rods 186a and 186b. Device 97 is reached. The ball break switches 187a and 187b are switches that detect the presence or absence of a game ball in the game ball passage, but a ball break detection switch 167 that detects a shortage of supply balls in the ball tank 38 is also provided. Hereinafter, the ball break switches 187a and 187b may be expressed as ball break switches 187.
[0034]
The game balls paid out from the ball payout device 97 are supplied to the hitting ball supply tray 3 provided on the front surface of the pachinko gaming machine 1 through the connection port 45. A surplus ball passage 46 communicating with the surplus ball receiving tray 4 provided on the front surface of the pachinko gaming machine 1 is formed on the side of the communication port 45.
[0035]
A lot of premium balls based on the winnings are paid out and the hitting ball supply tray 3 becomes full. Finally, when the game balls reach the contact port 45 and further game balls are paid out, the game balls are surplus via the surplus ball passage 46. It is guided to the ball receiving tray 4. When the game ball is further paid out, the sensing lever 47 presses the full tank switch 48 and the full tank switch 48 is turned on. In this state, the rotation of the stepping motor in the ball dispensing device 97 is stopped, the operation of the ball dispensing device 97 is stopped, and the driving of the ball hitting device 34 is also stopped.
[0036]
Next, the configuration of the intermediate base unit installed on the mechanism plate 36 will be described. In the intermediate base unit, ball supply rods 186a and 186b and a ball dispensing device 97 are installed. As shown in FIG. 4, connection concave protrusions 182 are formed on the upper and lower sides of the intermediate base unit. The connection concave protrusion 182 connects and fixes the intermediate base unit and the upper base unit and the lower base unit of the mechanism plate 36.
[0037]
A passage body 184 is fixed to the upper part of the intermediate base unit. A ball dispensing device 97 is fixed to the lower part of the passage body 184. The passage body 184 has payout ball passages 186a and 186b for flowing down two rows of game balls whose flow direction has been changed to the left and right directions by a curve rod 174 (see FIG. 3). On the upstream side of the payout ball passages 186a, 186b, ball break switches 187a, 187b are installed. The ball break switches 187a and 187b detect the presence or absence of a game ball in the payout ball passages 186a and 186b. When the ball break switches 187a and 187b no longer detect a game ball, the payout motor ( The rotation of the ball (not shown in FIG. 4) is stopped and the ball payout is immobilized.
[0038]
The ball break switches 187a and 187b are locked by locking pieces 188 at positions where it can be detected that about 27 to 28 game balls are present in the payout ball passages 186a and 186b. In other words, the ball break switches 187a and 187b have a maximum payout amount per unit of prize balls (15 in this embodiment) and a maximum payout amount per unit of ball lending (100 yen: 25 in this embodiment). It is installed at a position where the above can be confirmed.
[0039]
The central portion of the passage body 184 is formed in a shape that curves to the left and right so as to weaken the ball pressure of the game ball flowing down inside. A stop hole 189 is formed between the payout ball passages 186a and 186b. A mounting boss provided in the intermediate base unit is fitted into the back surface of the stop hole 189. In this state, the set screw is screwed, and the passage body 184 is fixed to the intermediate base unit. The passage body 184 can be aligned by the locking protrusion 185 provided on the intermediate base unit before being screwed.
[0040]
Below the passage body 184, a ball stopper 190 is provided for supplying the game ball to the ball payout device 97 and stopping the supply of the game ball to the ball payout device 97 in the event of a failure. A ball payout device 97 installed below the ball stopper 190 is housed in a rectangular parallelepiped case 198. Projections are provided at four places on the left and right sides of the case 198. The lower end of the case 198 is fitted into the elastic engagement piece provided at the lower part of the intermediate base unit in a state where each protrusion is engaged with the positioning protrusion provided on the intermediate base unit.
[0041]
FIG. 5 is an exploded perspective view of the ball dispensing device 97. The configuration and operation of the ball dispensing device 97 will be described with reference to FIG. In the ball dispensing device 97 in this embodiment, a stepping motor (dispensing motor) 289 rotates a screw 288 to pay out pachinko balls one by one. Note that the ball payout device 97 pays out not only a prize ball based on a prize but also a game ball to be lent.
[0042]
As shown in FIG. 5, the ball dispensing device 97 has two cases 198a and 198b. Engagement protrusions 280 are provided at two positions on the left and right sides of the cases 198a and 198b. In addition, ball supply paths 281a and 281b are formed in the cases 198a and 198b, respectively. The ball supply paths 281a and 281b have curved surfaces 282a and 282b, and ball feed horizontal paths 284a and 284b are formed below the ends of the curved surfaces 282a and 282b. Furthermore, ball discharge paths 283a and 283b are formed at the ends of the ball feed horizontal paths 284a and 284b.
[0043]
The ball supply paths 281a and 281b, the ball feed horizontal paths 284a and 284b, and the ball discharge paths 283a and 283b are formed in front of partition walls 295a and 295b that divide the cases 198a and 198b in the front-rear direction. Further, a ball pressure buffering member 285 is sandwiched between the cases 198a and 198b in front of the partition walls 295a and 295b. The ball pressure buffering member 285 distributes the balls supplied to the ball dispensing device 97 to the left and right sides and guides the balls to the ball supply paths 281a and 281b.
[0044]
In addition, below the ball pressure buffering member 285, a payout motor position sensor using a light emitting element (LED) 286 and a light receiving element (not shown) is provided. The light emitting element 286 and the light receiving element are provided at a predetermined interval. The tip of the screw 288 is inserted within this interval. The ball pressure buffering member 285 is completely housed and fixed inside the cases 198a and 198b.
[0045]
Screws 288 that are rotated by a payout motor 289 are disposed in the ball feed horizontal paths 284a and 284b. The payout motor 289 is fixed to the motor fixing plate 290, and the motor fixing plate 290 is fitted into fixing grooves 291a and 291b formed at the rear of the partition walls 295a and 295b. In this state, the motor shaft of the payout motor 289 protrudes in front of the partition walls 295a and 295b, so that the screw 288 is fixed in front of the protrusion. On the outer periphery of the screw 288, there is provided a spiral projection 288a for moving the game ball placed on the ball feed horizontal paths 284a, 284b forward by the rotation of the payout motor 289.
[0046]
A recess is formed at the tip of the screw 288 so as to accommodate the light emitting element 286, and two notches 292 are formed 180 degrees apart from each other on the outer periphery of the recess. Therefore, during one rotation of the screw 288, the light from the light emitting element 286 is detected twice by the light receiving element through the notch 292.
[0047]
In other words, the payout motor position sensor including the light emitting element 286 and the light receiving element is for stopping the screw 288 at a fixed position, and detects that the payout operation has been performed. The wiring from the light emitting element 286, the light receiving element, and the payout motor 289 are collectively drawn out from a drawing hole formed below the rear portions of the cases 198a and 198b and connected to the connector.
[0048]
When the payout motor 289 rotates in a state where the game ball is placed on the ball feed horizontal paths 284a and 284b, the game ball is moved forward on the ball feed horizontal paths 284a and 284b by the spiral protrusion 288a of the screw 288. Moving. And finally, it falls to the ball discharge paths 283a and 283b from the end of the ball feed horizontal paths 284a and 284b. At this time, the left and right ball feed horizontal paths 284a and 284b are alternately dropped. That is, each time the screw 288 is rotated halfway, one game ball falls from one side. Therefore, each time one game ball falls, the light from the light emitting element 286 is detected by the light receiving element.
[0049]
As shown in FIG. 4, a ball sorting member 311 is provided below the ball dispensing device 97. The ball sorting member 311 is driven by the sorting solenoid 310. For example, when the solenoid 310 is on, the ball sorting member 311 falls to the right, and when it is off, the ball sorting member 311 falls to the left. Below the sorting solenoid 310, a prize ball count switch 301A and a ball lending count switch 301B by proximity switches are provided. At the time of a winning ball based on winning, the ball sorting member 311 falls to the right side, and balls from the ball discharge paths 283a and 283b both pass the winning ball count switch 301A. Further, at the time of lending a ball, the ball sorting member 311 falls to the left side, and balls from the ball discharge paths 283a and 283b both pass the ball lending count switch 301B. Accordingly, the ball payout device 97 can change the payout flow path between the winning ball and the ball lending and pay out a predetermined number of game media.
[0050]
In this way, by providing the ball sorting member 311, the ball that has fallen through the two ball passages passes only one of the prize ball count switch 301 </ b> A and the ball lending count switch 301 </ b> B. Accordingly, the number of winning balls or the number of balls lent can be immediately grasped from the detection outputs of the winning ball count switch 301A and the ball lending count switch 301B without determining whether the ball is a winning ball or a lending ball.
[0051]
In this embodiment, a ball payout device 97 for paying out game balls by rotation of a stepping motor is used as a ball payout device for paying out game balls by driving an electric drive source. A ball payout device having a structure for delivering a game ball may be used, or a ball payout device having a structure in which a stopper is removed by driving of an electric drive source and the game ball is paid out by its own weight may be used. In this embodiment, the ball payout device 97 pays out a prize ball based on the prize ball and a loaned ball based on the loan request, but a payout device may be provided for each.
[0052]
FIG. 6 is a front view showing an example of the game board 6 on which the switch board 190 is mounted as seen from the front. In FIG. 2, the state of the back surface including the frame 2 </ b> A has been described as an example of the state in which the switch substrate 190 is mounted on the back surface of the pachinko gaming machine 1, but more specifically, the switch substrate 190 is illustrated in FIG. 6, for example. As shown, it is installed on the game board 6 on the back side of the gaming machine 1. FIG. 6 discloses a connector 922 for connecting to another board such as a main board.
[0053]
FIG. 7 is a circuit diagram showing an example of a circuit configuration of the clear switch 921 mounted on the switch board 190. The clear switch 921 has a push button structure in this example. If the clear switch 921 is pressed (if it is on), a low-level clear switch signal is output and transmitted to each board such as the main board 31 via the connector 922. If the clear switch 921 is not pressed (if it is in an off state), a high level output signal is output.
[0054]
FIG. 8 is a block diagram illustrating an example of a circuit configuration in the main board 31. 8 also shows a payout control board 37, a lamp control board 35, a sound control board 70, a launch control board 91, a symbol control board 80, and a switch board 190. The main board 31 includes a basic circuit 53 for controlling the pachinko gaming machine 1 according to a program, a gate switch 12, a start port switch 17, a V winning switch 22, a count switch 23, winning port switches 19a, 19b, 24a, 24b, The switch circuit 58 for supplying signals from the tongue switch 48, the ball break switch 187 and the prize ball count switch 301A to the basic circuit 53, the solenoid 16 for opening / closing the variable prize ball device 15, the solenoid 21 for opening / closing the opening / closing plate 20, and the big prize A solenoid circuit 59 for driving the solenoid 21A for switching the route in the mouth according to a command from the basic circuit 53 is mounted. In this embodiment, the switch circuit 58 also provides the basic circuit 53 with a signal from the clear switch 921 mounted on the switch board 190. Although not shown in FIG. 8, the count switch short circuit signal is also transmitted to the basic circuit 53 via the switch circuit 58.
[0055]
Further, according to the data given from the basic circuit 53, the jackpot information indicating the occurrence of the jackpot, the effective starting information indicating the number of starting winning balls used for starting the image display of the variable display unit 9, and the fact that the probability variation has occurred. An information output circuit 64 that outputs an information output signal such as probability variation information to an external device such as a hall computer is mounted.
[0056]
The basic circuit 53 includes a ROM 54 that stores a game control program and the like, a RAM 55 that is an example of storage means used as a work memory, a CPU 56 that performs control operations according to the program, and an I / O port unit 57. In this embodiment, the ROM 54 and RAM 55 are built in the CPU 56. That is, the CPU 56 is a one-chip microcomputer. The one-chip microcomputer only needs to incorporate at least the RAM 55, and the ROM 54 and the I / O port unit 57 may be externally attached or built-in.
[0057]
Further, the main board 31 is provided with a system reset circuit 65 for resetting the basic circuit 53 when the power is turned on.
[0058]
A ball hitting device for hitting and launching a game ball is driven by a drive motor 94 controlled by a circuit on the launch control board 91. Then, the driving force of the drive motor 94 is adjusted according to the operation amount of the operation knob 5. That is, the circuit on the firing control board 91 is controlled so that the hit ball is fired at a speed corresponding to the operation amount of the operation knob 5.
[0059]
In this embodiment, the lamp control means mounted on the lamp control board 35 controls the display of the start memory indicator 18, the gate passing memory indicator 41 and the decoration lamp 25 provided on the game board. At the same time, display control of the game effect lamps / LEDs 28a, 28b, 28c, the prize ball lamp 51 and the ball break lamp 52 provided on the frame side is performed. The display control of the variable display unit 9 for variably displaying the special symbol and the normal symbol display 10 for variably displaying the normal symbol is performed by display control means mounted on the symbol control board 80.
[0060]
FIG. 9 is a block diagram showing components related to payout, such as components of the payout control board 37 and the ball payout device 97. As shown in FIG. 9, the detection signal from the full switch 48 is input to the I / O port 57 of the main board 31 via the relay board 71. The full tank switch 48 is a switch for detecting a full tank of the surplus ball tray 4. The detection signal from the ball break switch 187 (187a, 187b) is also input to the I / O port 57 of the main board 31 through the relay board 72 and the relay board 71.
[0061]
The CPU 56 of the main board 31 issues a payout prohibition when the detection signal from the ball break switch 187 indicates a ball shortage state or when the detection signal from the full tank switch 48 indicates a full tank state. Send a control command. When a payout control command for instructing payout is received, the payout control CPU 371 of the payout control board 37 stops the ball payout process.
[0062]
Further, the detection signal from the prize ball count switch 301A is input to the I / O port 57 of the main board 31 via the relay board 72 and the relay board 71, and input to the payout control board 37 via the relay board 72. Input to port 372b. The prize ball count switch 301A is provided in a payout mechanism portion of the ball payout device 97, and detects a prize ball payout ball actually paid out.
[0063]
When there is a winning, a payout control command indicating the number of winning balls is input to the payout control board 37 from the output ports (ports 0, 1) 570, 571 of the main board 31. The output port (output port 1) 571 outputs 8-bit data, and the output port 570 outputs a 1-bit strobe signal (INT signal). A payout control command indicating the number of winning balls is input to the I / O port 372a via the input buffer circuit 373A. The INT signal is input to the interrupt terminal of the payout control CPU 371 via the input buffer circuit 373B. The payout control CPU 371 inputs a payout control command via the I / O port 372a, and drives the ball payout device 97 in accordance with the payout control command to perform prize ball payout.
In this embodiment, the payout control CPU 371 is a one-chip microcomputer and incorporates at least a RAM.
[0064]
In the main board 31, buffer circuits 620 and 68A are provided outside the output ports 570 and 571. As the buffer circuits 620 and 68A, for example, general-purpose CMOS-ICs 74HC250 and 74HC14 are used. According to such a configuration, since a signal input from the outside to the inside of the main board 31 is blocked, it is possible to more reliably eliminate a signal line from which a signal may be given from the payout control board 37 to the main board 31. be able to. A noise filter may be provided on the output side of the buffer circuits 620 and 68A.
[0065]
The payout control CPU 371 outputs a ball lending number signal indicating the number of lending balls to the terminal board 160 via the output port 372c. Further, an error signal is output to the error display LED 374 via the output port 372d.
[0066]
Further, a detection signal from the ball lending count switch 301B is input to the input port 372b of the payout control board 37 via the relay board 72. The ball lending count switch 301B is provided in a payout mechanism portion of the ball payout device 97, and detects a lending ball actually paid out. The drive signal from the payout control board 37 to the payout motor 289 is transmitted to the payout motor 289 in the payout mechanism portion of the ball payout device 97 via the output port 372c and the relay board 72, and the drive signal to the sorting solenoid 310 is transmitted. Is transmitted to the sorting solenoid 310 in the payout mechanism portion of the ball payout device 97 via the output port 372e and the relay board 72.
[0067]
The card unit 50 is equipped with a card unit control microcomputer. Further, the card unit 50 is provided with a fraction display switch 152, a connecting table direction indicator 153, a card insertion display lamp 154, and a card insertion slot 155 (see FIG. 1). The balance display board 74 is connected with a frequency display LED, a ball lending switch, and a return switch provided in the vicinity of the hitting ball supply tray 3.
[0068]
A ball lending switch signal and a return switch signal are given from the balance display board 74 to the card unit 50 via the payout control board 37 in accordance with the player's operation. Further, a card balance display signal indicating a prepaid card balance and a ball lending display signal are given to the balance display board 74 from the card unit 50 via the payout control board 37. Between the card unit 50 and the payout control board 37, a connection signal (VL signal), a unit operation signal (BRDY signal), a ball lending request signal (BRQ signal), a ball lending completion signal (EXS signal) and a pachinko machine operation signal ( PRDY signal) is exchanged via the input port 372b and the output port 372e.
[0069]
When the power of the pachinko gaming machine 1 is turned on, the payout control CPU 371 of the payout control board 37 outputs a PRDY signal to the card unit 50. The card unit control microcomputer outputs a VL signal. The payout control CPU 371 determines the connected / unconnected state based on the input state of the VL signal. When a card is received in the card unit 50, the ball lending switch is operated and a ball lending switch signal is input, the card unit control microcomputer outputs a BRDY signal to the payout control board 37. When a predetermined delay time elapses from this point, the card unit control microcomputer outputs a BRQ signal to the payout control board 37.
[0070]
Then, the payout control CPU 371 of the payout control board 37 raises the EXS signal to the card unit 50, and when detecting the fall of the BRQ signal from the card unit 50, drives the payout motor 289 to draw a predetermined number of rental balls. Pay to the player. At this time, the sorting solenoid 310 is in a driving state. That is, the ball distribution member 311 is directed to the ball lending side. When the payout is completed, the payout control CPU 371 causes the EXS signal to the card unit 50 to fall. Thereafter, if the BRDY signal from the card unit 50 is not on, prize ball payout control is executed.
[0071]
As described above, all signals from the card unit 50 are input to the payout control board 37. Accordingly, regarding the ball lending control, no signal is input from the card unit 50 to the main board 31, and there is no room for an illegal signal input from the card unit 50 side to the basic circuit 53 of the main board 31. The power supply voltage AC24V used in the card unit 50 is supplied from the payout control board 37.
[0072]
In this embodiment, the case where the card unit 50 is installed adjacent to the gaming machine as a separate body from the gaming machine is taken as an example, but the card unit 50 may be integrated with the gaming machine. . Further, the present invention can be applied even when the gaming machine is lent out according to the amount of coins inserted according to the amount of coins.
[0073]
FIG. 10 is a block diagram illustrating a configuration example of the power supply substrate 910. The power supply board 910 is installed independently of the electric component control boards such as the main board 31, the symbol control board 80, the voice control board 70, the lamp control board 35, and the payout control board 37, and each electric part control board in the gaming machine and Generates voltage used by mechanical components. In this example, AC24V, VSL (DC + 30V), DC + 21V, DC + 12V, and DC + 5V are generated. A capacitor 916 serving as a backup power supply is charged from a line of power supply for driving DC + 5V, that is, an IC or the like on each substrate. Note that VSL is generated by rectifying and boosting AC24V with a rectifier element in the rectifier circuit 912. VSL is a solenoid driving power source.
[0074]
The transformer 911 converts AC voltage from the AC power source into 24V. The AC 24V voltage is output to the connector 915. The rectifier circuit 912 also generates a DC voltage of +30 V from AC 24 V and outputs it to the DC-DC converter 913 and the connector 915. The DC-DC converter 913 includes one or a plurality of converter ICs 922 (only one is shown in FIG. 10), generates + 21V, + 12V, and + 5V based on VSL and outputs the generated voltages to the connector 915. A relatively large capacitor 923 is connected to the input side of the converter IC 922. Accordingly, when the power supply to the gaming machine from the outside is stopped, the DC voltage such as + 30V, + 12V, + 5V, etc., decreases relatively slowly. As a result, the capacitor 923 serves as an auxiliary drive power source described later. The connector 915 is connected to, for example, a relay board, and power of a voltage necessary for each electric component control board and the mechanism component is supplied from the relay board.
[0075]
However, each connector reaching each electric component control board may be provided on the power supply board 910 to supply each voltage from the power supply board 910 to each board without going through the relay board. FIG. 10 shows one connector 915 as a representative, but the connector is provided for each electric component control board.
[0076]
The + 5V line from the DC-DC converter 913 branches to form a backup + 5V line. A large-capacitance capacitor 916 is connected between the backup + 5V line and the ground level. The capacitor 916 is in a storage state with respect to the backup RAM of the electrical component control board when the power supply to the gaming machine is cut off (a RAM that is backed up, that is, a backup storage means that can be in a storage content holding state even when the power supply is stopped). This is a backup power supply that supplies power so that the Further, a backflow preventing diode 917 is inserted between the + 5V line and the backup + 5V line. In this embodiment, + 5V for backup is supplied to the main board 31 and the payout control board 37.
[0077]
A battery that can be charged from a + 5V power supply may be used as the backup power supply. In the case of using a battery, a rechargeable battery is used in which the capacity disappears when a state in which no power is supplied from the +5 V power source continues for a predetermined time.
[0078]
Further, a power supply monitoring IC 902 is mounted on the power supply board 910. The power supply monitoring IC 902 detects the occurrence of power interruption by introducing the VSL voltage and monitoring the VSL voltage. Specifically, when the VSL voltage becomes equal to or lower than a predetermined value (+22 V in this example), a voltage drop signal (power-off signal) is output as power-off occurs. The power supply voltage to be monitored is preferably higher than the power supply voltage (+5 V in this example) of the circuit element mounted on each electric component control board. In this example, VSL, which is a voltage immediately after being converted from AC to DC, is used. The voltage drop signal from the power monitoring IC 902 is supplied to the main board 31, the payout control board 37, and the like.
[0079]
The predetermined value for the power monitoring IC 902 to detect the power-off is lower than the normal voltage, but is a voltage that allows the CPU on each electrical component control board to operate for a while. Further, the power monitoring IC 902 is configured to monitor a voltage that is higher than a voltage for driving a circuit element such as a CPU (+5 V in this example) and immediately after being converted from AC to DC. Therefore, the monitoring range can be expanded for the voltage required by the CPU. Therefore, more precise monitoring can be performed. Furthermore, when VSL (+ 30V) is used as the monitoring voltage, the voltage supplied to the various switches of the gaming machine is + 12V, so that it can be expected to prevent erroneous switch-on detection at the time of instantaneous power interruption. That is, when the voltage of the + 30V power supply is monitored, it is possible to detect a decrease in the level before + 12V created after the creation of + 30V starts to drop.
[0080]
Therefore, when the voltage of the + 12V power supply decreases, the switch output becomes an on-state. However, if the power-off is recognized by monitoring the + 30V power supply voltage that decreases faster than + 12V, the switch output is turned on before the switch output shows the on-state. It is possible to enter a state of waiting for recovery and not detect switch output.
[0081]
Further, since the power monitoring IC 902 is mounted on the power supply board 910 that is separate from the electrical component control board, a power-off signal can be supplied from the power monitoring circuit to the plurality of electrical component control boards. Even if there are any number of electrical component control boards that require a power-off signal, it is only necessary to provide one power supply monitoring means. Therefore, even if each electrical component control means on each electrical component control board performs return control described later. The cost of the gaming machine does not increase so much.
[0082]
In the configuration shown in FIG. 10, the detection output (power cut-off signal) of the power monitoring IC 902 is sent to the respective electric component control boards (for example, the main board 31 and the payout control board 37) via the buffer circuits 918 and 919. However, for example, a configuration may be adopted in which one detection output is transmitted to the relay board and the same signal is distributed from the relay board to each electric component control board. Further, a buffer circuit corresponding to the number of substrates that require a power-off signal may be provided.
[0083]
FIG. 11 is a block diagram illustrating a configuration example around the CPU 56 in the main board 31. As shown in FIG. 11, the power-off signal (voltage drop signal) from the power supply monitoring circuit (power supply monitoring means) of the power supply board 910 is connected to the non-maskable interrupt terminal (XNMI terminal) of the CPU 56. The power supply monitoring circuit is a circuit that detects a power supply voltage drop by monitoring the voltage of any of the various DC power supplies used by the gaming machine. In this embodiment, the power supply voltage of VSL is monitored, and when the voltage value falls below a predetermined value, a low-level power cut-off signal is generated. VSL is the largest DC voltage used in gaming machines, and is + 30V in this example. Therefore, the CPU 56 can confirm the occurrence of power interruption by the interrupt process.
[0084]
FIG. 11 also shows a system reset circuit 65. When the power is turned on, the reset IC 651 sets the output to a low level for a predetermined time determined by the capacity of the external capacitor, and sets the output to a high level when the predetermined time has elapsed. That is, the reset signal is raised to a high level to make the CPU 56 operable. The reset IC 651 monitors the power supply voltage of VSL, which is the same as the power supply voltage monitored by the power supply monitoring circuit, and the voltage value is lower than a predetermined value (the power supply voltage value at which the power supply monitoring circuit outputs a power-off signal). When the value is less than or equal to, the output is set to low level. Accordingly, the CPU 56 performs a predetermined power supply stop process in response to the power-off signal from the power supply monitoring circuit, and then the system is reset.
[0085]
As shown in FIG. 11, the reset signal from the reset IC 651 is input to the NAND circuit 947 and also input to the clear terminal of the counter IC 941 via the inverting circuit (NOT circuit) 944. The counter IC 941 counts the clock signal from the oscillator 943 when the input to the clear terminal becomes low level. The Q5 output of the counter IC 941 is input to the NAND circuit 947 via the NOT circuits 945 and 946. The Q6 output of the counter IC 941 is input to the clock terminal of the flip-flop (FF) 942. The D input of the flip-flop 942 is fixed at a high level, and the Q output is input to an OR circuit (OR circuit) 949. The output of the NAND circuit 947 is introduced into the other input of the OR circuit 949 via the NOT circuit 948. The output of the OR circuit 949 is connected to the reset terminal of the CPU 56. According to such a configuration, since the reset signal (low level signal) is given twice to the reset terminal of the CPU 56 when the power is turned on, the CPU 56 surely starts operation.
[0086]
For example, the detection voltage of the power supply monitoring circuit (the voltage that outputs the power-off signal) is + 22V, and the detection voltage for setting the reset signal to low level is + 9V. In such a configuration, since the power supply monitoring circuit and the system reset circuit 65 monitor the voltage of the same power supply VSL, the timing at which the voltage monitoring circuit outputs a power-off signal and the system reset circuit 65 reset the system. It is possible to reliably set the difference in timing for outputting the signal within a desired predetermined period. The desired predetermined period is a period from the start of the power supply stop process in response to the power-off signal from the power supply monitoring circuit until the completion of the power supply stop process.
[0087]
While power is not supplied from the + 5V power source that is the driving power source of the CPU 56 or the like, at least a part of the RAM is backed up by the backup power source supplied from the power supply board, and the contents are preserved even if the power source for the gaming machine is cut off. The When the +5 V power supply is restored, a reset signal is issued from the system reset circuit 65, so that the CPU 56 returns to a normal operation state. At that time, since necessary data is stored in the backup RAM, it is possible to return to the gaming state at the time of occurrence of the power failure when recovering from the power failure.
[0088]
In the configuration shown in FIG. 11, two reset signals (low level signals) are given to the reset terminal of the CPU 56 when the power is turned on, but the reset is reliably released even if the reset signal rises only once. When the CPU is used, the circuit elements denoted by reference numerals 941 to 949 are not necessary. In that case, the output of the reset IC 651 is directly connected to the reset terminal of the CPU 56.
[0089]
The CPU 56 used in this embodiment also incorporates an I / O port (PIO) and a timer / counter circuit (CTC). The PIO has 4 bits PB0 to PB3 and 1 byte port PA0 to PA7. The ports PB0 to PB3 and PA0 to PA7 can be set to either input / output.
[0090]
Also, as shown in FIG. 11, the output signal of the clear switch 921 mounted on the switch board 190 is input via a buffer circuit 578A that inverts logic and an input port 578. Note that output signals of other switches such as the V winning switch 22 are also input to the input port 578 via the buffer circuit 578A. According to such a configuration, when the output signal is a clear switch signal (low level signal) by switching the clear switch 921, the clear switch signal is inverted (the buffer circuit 578A inverts the clear switch signal). The output signal may be referred to as a clear switch signal.) And is provided to the CPU 56, so that the CPU 56 performs processing for setting the storage contents of the variation data storage means as initial data, details of which will be described later. Thus, since the output signal of the clear switch 921 is input via the input port 578, the clear switch signal can be introduced with a simple configuration.
[0091]
FIG. 12 is an explanatory diagram showing bit assignment of input ports in this embodiment. As shown in FIG. 12, the winning port switch 24a, the winning port switch 24b, the winning port switch 19a, the winning port switch 19b, the starting port switch 17, the count switch 23, V Detection signals from the winning switch (specific area switch) 22 and the gate switch 12 are input. Further, the detection signals of the winning ball count switch 301A, the full switch 48, the ball break switch 187, the count switch short-circuit signal, and the output signal of the clear switch 921 are input to bits 0 to 4 of the input port 1, respectively.
[0092]
Next, the operation of the gaming machine will be described.
FIG. 13 is a flowchart showing main processing executed by the CPU 56 on the main board 31. When the power to the gaming machine is turned on, in the main process, the CPU 56 first performs necessary initial settings.
[0093]
In the initial setting process, the CPU 56 first sets the interrupt prohibition (step S1). Next, the interrupt mode is set to interrupt mode 2 (step S2), and a stack pointer designation address is set to the stack pointer (step S3). Then, the built-in device register is initialized (step S4). Further, after initialization (step S5) of CTC (counter / timer) and PIO (parallel input / output port) which are built-in devices (built-in peripheral circuits), the RAM is set to an accessible state (step S6).
[0094]
The CPU 56 used in this embodiment has the following three types of maskable interrupt (INT) modes. When a maskable interrupt occurs, the CPU 56 automatically sets the interrupt disabled state and saves the contents of the program counter in the stack.
[0095]
Interrupt mode 0: The built-in device that has issued the interrupt request sends an RST instruction (1 byte) or a CALL instruction (3 bytes) onto the internal data bus of the CPU. Therefore, the CPU 56 executes the instruction at the address corresponding to the RST instruction or the address specified by the CALL instruction. At reset, the CPU 56 automatically enters interrupt mode 0. Therefore, when setting to interrupt mode 1 or interrupt mode 2, it is necessary to perform a process for setting to interrupt mode 1 or interrupt mode 2 in the initial setting process.
[0096]
Interrupt mode 1: In this mode, when an interrupt is accepted, the mode always jumps to address 0038 (h).
[0097]
Interrupt mode 2: A mode in which the address synthesized from the value (1 byte) of the specific register (I register) of the CPU 56 and the interrupt vector (1 byte: least significant bit 0) output by the built-in device indicates the interrupt address It is. That is, the interrupt address is an address indicated by 2 bytes in which the upper address is the value of the specific register and the lower address is the interrupt vector. Therefore, an interrupt process can be set at an arbitrary address (although it is skipped). Each built-in device has a function of sending an interrupt vector when making an interrupt request.
[0098]
Therefore, when the interrupt mode 2 is set, it becomes possible to easily process an interrupt request from each built-in device, and it is possible to install an interrupt process at an arbitrary position in the program. . Further, unlike the interrupt mode 1, it is easy to prepare each interrupt process for each interrupt generation factor. As described above, in this embodiment, the CPU 56 is set to the interrupt mode 2 in step S2 of the initial setting process.
[0099]
Next, the CPU 56 checks the state of the output signal of the clear switch 921 input through the input port 578 only once in this example (step S7). When the clear switch 921 is on (when pressed), a low-level clear switch signal is output. Therefore, if the clear switch 921 is turned on, the CPU 56 executes normal initialization processing (steps S11 to S15). It is preferable to execute the ON determination of the clear switch 921 before performing the initial setting. This is because the control can be resumed after confirming the intention of erasing the backup storage (final storage contents) prior to the start of the gaming machine. In such a case, if the timer process or the switch input determination (multiple times) is performed before the initial setting, the backup contents may be destroyed. In addition, game balls are flowing behind the pachinko gaming machine that is playing, and noise is likely to be generated. For this reason, normal switch detection performs input determination a plurality of times, but clear switch 921 ON determination Since it is performed before the start, it is less susceptible to noise. Therefore, even if the clear switch 921 input determination is made only once, it is not easily affected by noise, and the program development efficiency is improved. In the case where emphasis is placed on whether or not the clear switch 921 has been operated reliably, the CPU 56 may check the state of the output signal of the clear switch 921 for 3 seconds, for example.
[0100]
If the clear switch 921 is not in the on state (not pressed), the CPU 56 determines whether or not the backup RAM area data protection processing (for example, power failure occurrence NMI processing such as addition of parity data) is performed when the power is turned off. Confirm (step S8). In this embodiment, when an unexpected power failure occurs, processing for protecting data in the backup RAM area is performed. When such protection processing is performed, it is assumed that there is a backup. When it is confirmed that there is no backup, the CPU 56 executes an initialization process.
[0101]
In this embodiment, whether or not there is backup data in the backup RAM area is confirmed by the state of the backup flag set in the backup RAM area when the power is turned off. In this example, as shown in FIG. 14, if “55H” is set in the backup flag area, it means that there is a backup (ON state), and if a value other than “55H” is set, there is no backup (OFF). State).
[0102]
After confirming that there is a backup, the CPU 56 performs a data check of the backup RAM area (parity check in this example). In the case of recovery after an unexpected power failure, the data in the backup RAM area should have been saved, so the check result is normal. If the check result is not normal, the internal state cannot be returned to the state at the time of power-off, and therefore an initialization process that is executed at the time of power-on not at the time of power failure recovery is executed.
[0103]
If the check result is normal (step S9), the CPU 56 performs a game state restoration process for returning the internal state of the game control means and the control state of the electric component control means such as the display control means to the state when the power is cut off. (Step S10). Then, the saved value of the PC (program counter) saved in the backup RAM area is set in the PC, and the address is restored.
[0104]
In this embodiment, the presence / absence of backup data is confirmed when the clear switch 921 is not turned on in step S7, but conversely, after the presence / absence of backup data is confirmed, the backup data exists ( Further, the operation state of the clear switch 921 may be confirmed when the backup area is checked and the check result of the backup area may be confirmed to be normal.
[0105]
In this embodiment, after the presence or absence of backup data is confirmed in step S8, the backup area is checked in step S9 when backup data exists. Conversely, the check result of the backup area is After it is confirmed that the data is normal, the presence / absence of backup data may be confirmed. Further, it may be determined whether or not to execute the power failure recovery processing by confirming either one of the presence / absence of backup data or the check of the backup area.
[0106]
Further, for example, in the parity check (step S9) when determining whether or not to execute the power failure recovery process, that is, when determining whether or not to restore the gaming state, a special process in the stored RAM data If it is confirmed that the gaming machine is in a game standby state (not changing in design, not in big hit game, not in probable change, or without starting prize memory) by flag or the like and starting winning memory data The initialization process may be executed without performing the game state restoration process.
[0107]
In this way, it is determined whether or not to restore the gaming state when the power is turned off according to the operation state of the clear switch 921. At this time, if the clear switch 921 is in the on state, the gaming state restoration process is performed. Since it is configured not to be executed but to perform normal initialization processing, the game store clerk or the like operates the clear switch 921 when resuming the power supply to the gaming machine, thereby storing the backup data storage area (variable data storage means). It is possible to select whether or not to execute the game state restoration process based on the stored backup data. Therefore, there is provided a gaming machine that can prevent the player from being disadvantaged even if the power is cut off and can improve the convenience of operating the gaming machine at the gaming store.
[0108]
It should be noted that, when the backup data is not stored in the fluctuation data storage means when the power is turned on, and the clear switch 921 is in the OFF state even if the backup data is stored in the fluctuation data storage means The initialization process executed in the above is also used in the program. Therefore, even if control for improving convenience in operation at a game store is added, the program capacity does not increase so much.
[0109]
In the initialization process, the CPU 56 first performs a RAM clear process (step S11). Also, initial value setting processing is performed for setting initial values in predetermined work areas (for example, a normal symbol determination random number counter, a normal symbol determination buffer, a special symbol left middle right symbol buffer, a payout command storage pointer, etc.). Further, processing for initializing the sub-boards (lamp control board 35, payout control board 37, voice control board 70, symbol control board 80) is executed (step S13). The process of initializing the sub board is a process of sending an initial setting command, for example.
[0110]
Then, a CTC register set in the CPU 56 is set so that a timer interrupt is periodically generated every 2 ms (step S14). That is, a value corresponding to 2 ms is set in a predetermined register (time constant register) as an initial value. Since the interruption is prohibited in step S1 of the initial setting process, the interruption is permitted before the initialization process is completed (step S15).
[0111]
In this embodiment, the built-in CTC of the CPU 56 is set to repeatedly generate a timer interrupt. In this embodiment, the repetition period is set to 2 ms. When a timer interrupt occurs, as shown in FIG. 15, the CPU 56 sets a timer interrupt flag indicating that a timer interrupt has occurred, for example (step S12).
[0112]
When the execution of the initialization process (steps S11 to S15) is completed, the main process shifts to a loop process in which it is confirmed whether or not a timer interrupt has occurred (step S17). In the loop, display random number update processing (step S16) is also executed.
[0113]
When the CPU 56 recognizes that a timer interrupt has occurred in step S17, it executes the game control process of steps S21 to S31. In the game control process, the CPU 56 first inputs the states of the switches such as the gate sensor 12, the start port sensor 17, the count sensor 23, and the winning port switches 19a, 19b, 24a, and 24b via the switch circuit 58, Is determined (switching process: step S21).
[0114]
Next, various abnormality diagnosis processes are performed by the self-diagnosis function provided in the pachinko gaming machine 1, and an alarm is issued if necessary according to the result (error process: step S22).
[0115]
Next, a process of updating each counter indicating each determination random number such as a big hit determination random number used for game control is performed (step S23). The CPU 56 further performs a process of updating a display random number such as a random number that determines the type of stop symbol (step S24).
[0116]
Further, the CPU 56 performs special symbol process processing (step S25). In the special symbol process control, corresponding processing is selected and executed according to a special symbol process flag for controlling the pachinko gaming machine 1 in a predetermined order according to the gaming state. The value of the special symbol process flag is updated during each process according to the gaming state. Further, normal symbol process processing is performed (step S26). In the normal symbol process, the corresponding process is selected and executed in accordance with the normal symbol process flag for controlling the variable display 10 using the 7-segment LED in a predetermined order. The value of the normal symbol process flag is updated during each process according to the gaming state.
[0117]
Next, the CPU 56 performs a process of setting a display control command related to the special symbol in a predetermined area of the RAM 55 and sending the display control command (special symbol command control process: step S27). In addition, a display control command related to the normal symbol is set in a predetermined area of the RAM 55, and a process of sending the display control command is performed (normal symbol command control process: step S28).
[0118]
Further, the CPU 56 performs information output processing for outputting data such as jackpot information, start information, probability variation information supplied to the hall management computer, for example (step S29).
[0119]
Further, the CPU 56 issues a drive command to the solenoid circuit 59 when a predetermined condition is established (step S30). The solenoid circuit 59 drives the solenoids 16 and 21 in accordance with the drive command, thereby bringing the variable winning ball device 15 or the opening / closing plate 20 into an open state or a closed state.
[0120]
Then, the CPU 56 executes a prize ball process for setting the number of prize balls based on the detection outputs of the switches 17, 23, 19a, 19b, 24a, 24b for detecting a winning at each winning mouth (step S31). ). Specifically, a payout control command is output to the payout control board 37 in response to winning detection. The payout control CPU 371 mounted on the payout control board 37 drives the ball payout device 97 according to the payout control command.
[0121]
With the above control, in this embodiment, the game control process is started every 2 ms. In this embodiment, in the timer interrupt process, for example, only a flag indicating that an interrupt has occurred is set, and the game control process is executed in the main process, but the game control process is performed in the timer interrupt process. May be executed.
[0122]
In addition, the main process includes a process for determining whether or not to shift to the game control process, and whether or not the CPU 56 should shift to the game control process by the timer interrupt process based on the timer interrupt generated periodically. Since the flag for determining whether or not is set or the like, all of the game control processing is surely executed. In other words, until all the game control processes are executed, it is not determined whether or not to shift to the next game control process, so it is guaranteed that all the processes in the game control process are completed. ing.
[0123]
As described above, in this embodiment, the interrupt mode 2 is set in the initial setting process for the CPU 56 incorporating the CTC and PIO. Therefore, a periodic timer interrupt process using the built-in CTC can be easily realized. Also, the timer interrupt process can be set at an arbitrary position on the program. In addition, switch detection processing using the built-in PIO can be easily realized by interrupt processing. As a result, it is possible to obtain effects such as a simplified program configuration and a reduced number of program development steps.
[0124]
Next, a specific example of the switch process (step S21) in the main process will be described. In this embodiment, when the ON state of the detection signal continues for a predetermined time, it is certainly determined that the switch is turned on, and processing corresponding to the switch on is started. A switch timer is used to measure the predetermined time. The switch timer is a 1-byte counter formed in the backup RAM area, and is incremented by 1 every 2 ms when the detection signal indicates an ON state. As shown in FIG. 16, the switch timer is provided by the number N of detection signals. In this embodiment, N = 12. Note that N = 12 (not 13) because the switch timer corresponding to the output signal of the clear switch 921 is not provided (the determination of whether or not the clear signal is detected is unnecessary because it is not executed in the switch process). It is. In the RAM, the addresses of the switch timers are arranged in the same order as the bit arrangement order of the input ports (from top to bottom shown in FIG. 12).
[0125]
FIG. 17 is a flowchart illustrating a processing example of the switch processing in step S21 in the game control processing. The switch process is first executed in the game control process as shown in FIG. In the switch process, the CPU 56 first inputs data input to the input port 0 (step S71). Next, “8” is set as the number of processes (step S72), and the address of the switch timer for the winning opening switch 24a is set in the pointer (step S73). Then, a switch check processing subroutine is called (step S74).
[0126]
FIG. 18 is a flowchart showing a switch check processing subroutine. In the switch check processing subroutine, the CPU 56 sets port input data, in this case, input data from the input port 0, as a “comparison value” (step S81). Further, clear data (00) is set (step S82). Then, the switch timer pointed to by the pointer (the switch timer address is set) is loaded (step S83), and the comparison value is shifted to the right (from the upper bit to the lower bit) (step S84). Data of input port 0 is set as the comparison value. In this case, the detection signal of the winning opening switch 24a is pushed out to the carry flag.
[0127]
If the value of the carry flag is “1” (step S85), that is, if the detection signal of the winning opening switch 24a is ON, the value of the switch timer is incremented by 1 (step S87). If the value after addition is not 0, the addition value is returned to the switch timer (steps S88 and S89). When the value after addition becomes 0, the addition value is not returned to the switch timer. That is, when the value of the switch timer has already reached the maximum value (255), the value is not increased further.
[0128]
If the value of the carry flag is “0”, that is, if the detection signal of the winning opening switch 24a is in the OFF state, clear data is set in the switch timer (step S86). That is, if the switch is off, the value of the switch timer returns to zero.
[0129]
Thereafter, the CPU 56 adds 1 to the pointer (switch timer address) (step S90) and subtracts 1 from the number of processes (step S91). If the number of processes is not 0, the process returns to step S82. Then, the processes in steps S82 to S92 are repeated.
[0130]
The processes of steps S82 to S92 are repeated for the number of processes, that is, eight times, and during that time, the detection signal of the switch input to the 8 bits of the input port 0 is sequentially checked to determine whether it is on or off. If it is ON, the value of the corresponding switch timer is incremented by one.
[0131]
The CPU 56 inputs the data input to the input port 1 in step S75 of the switch process. Next, “4” is set as the processing number (step S76), and the address of the switch timer for the winning ball count switch 301A is set in the pointer (step S77). Then, a switch check processing subroutine is called (step S78).
[0132]
In the switch check processing subroutine, since the above-described processing is executed, the processing of steps S82 to S92 is repeated for the number of processing, that is, four times, and the detection signal of the switch input to the 4 bits of the input port 1 during that time. Then, a check process is sequentially performed to determine whether the state is on or off. If the state is on, the value of the corresponding switch timer is incremented by one.
[0133]
In this embodiment, since the game control process is started every 2 ms, the switch process is also executed once every 2 ms. Therefore, the switch timer is incremented by 1 every 2 ms.
[0134]
19 to 21 are flowcharts showing an example of the prize ball process in step S31 in the game control process. In this embodiment, in the prize ball processing, it is determined whether or not the prize opening switches 19a, 19b, 24a, 24b, the count switch 23 and the start opening switch 17 are turned on, and if they are turned on, a predetermined payout control command is determined. Is sent to the payout control board 37, and it is determined whether or not the full switch 48 and the ball break switch 187 are turned on, and when it is turned on, a predetermined payout control command is issued. For example, control is performed so as to be sent to the terminal.
[0135]
In the prize ball process, the CPU 56 sets “0” as the offset of the input determination value table (step S121), and sets “0” as the offset of the address of the switch timer (step S122). The offset “0” in the input determination value table means that the first data in the input determination value table is used. Also, since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the switch timer address offset “0” designates the switch timer corresponding to the winning port switch 24a. Means. Also, “4” is set as the number of repetitions (step S123). Then, a switch-on check routine is called (step S124).
[0136]
The input determination value table is a ROM area in which a determination value for determining that the switch has been turned on when it is detected how many times it is continuously turned on is set for each switch. A configuration example of the input determination value table is shown in FIG. As shown in FIG. 24, the input determination value table includes “2”, “50”, “250”, “30”, “250”, “1” in order from the top, that is, from the area with the smallest address value. The judgment value is set. In the switch-on check routine, the judgment value set at the address determined by the head address and the offset value in the input judgment value table is compared with the value of the switch timer determined by the head address and the offset value of the switch timer. If they match, for example, a switch-on flag is set.
[0137]
An example of a switch-on check routine is shown in FIG. In the switch-on check routine, the CPU 56 sets the head address of the input determination value table (see FIG. 24) (step S101). Then, an offset is added to the address (step S102), and a switch-on determination value is loaded from the address after the addition (step S103).
[0138]
Next, the CPU 56 sets the start address of the switch timer (step S104), adds an offset to the address (step S105), and loads the value of the switch timer from the address after the addition (step S106). Since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the value of the switch timer corresponding to the switch is loaded.
[0139]
Then, the CPU 56 compares the loaded switch timer value with the switch-on determination value (step S107). If they match, a switch-on flag is set (step 108).
[0140]
In this case, in the switch-on check routine, the switch-on flag is set if the value of the switch timer corresponding to the winning opening switch 24a matches the switch-on determination value “2” (step S125). When the switch-on flag is set, 10 counters are incremented by 1 (step S126). The switch check-on routine is executed for the number of repetitions initially set (step S127, S128) while the offset of the switch timer address is updated (step S129). For 24a and 24b, the value of the corresponding switch timer is compared with the switch-on determination value “2”. The 10-piece counter is a counter that indicates the number of paying out 10 game balls as prizes.
[0141]
Next, the CPU 56 sets “0” as the offset of the input determination value table (step S130), and sets “4” as the offset of the switch timer address (step S131). The offset “0” in the input determination value table means that the first data in the input determination value table is used. Also, since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the switch timer address offset “4” designates the switch timer corresponding to the start port switch 17. Means. Then, a switch-on check routine is called (step S132).
[0142]
In the switch-on check routine, if the value of the switch timer corresponding to the start port switch 17 matches the switch-on determination value “2”, the switch-on flag is set (step S133). (Step S134). The 6-counter is a counter that indicates the number of 6 game ball payouts as a prize.
[0143]
Next, the CPU 56 sets “0” as the offset of the input determination value table (step S135), and sets “5” as the offset of the switch timer address (step S136). The offset “0” in the input determination value table means that the first data in the input determination value table is used. Also, since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the offset “5” of the switch timer address indicates that the switch timer corresponding to the count switch 23 is designated. means. Then, a switch-on check routine is called (step S137).
[0144]
In the switch-on check routine, if the value of the switch timer corresponding to the count switch 23 matches the switch-on determination value “2”, the switch-on flag is set (step S138), so 15 counters are incremented by one. (Step S134). The 15 counter is a counter that indicates the number of paying out 15 game balls as prizes.
[0145]
Further, the CPU 56 sets “1” as the offset of the input determination value table (step S150), and sets “9” as the offset of the switch timer address (step S151). The offset “1” in the input determination value table means that the second data “50” in the input determination value table is used. Further, since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the switch timer address offset “9” designates the switch timer corresponding to the full switch 48. Means. Then, a switch-on check routine is called (step S152).
[0146]
In the switch-on check routine, if the value of the switch timer corresponding to the full tank switch 48 matches the full tank switch on determination value “50”, the switch on flag is set (step S153), so the full tank flag is set. (Step S154). Although not explicitly shown in FIG. 20, when the value of the switch timer corresponding to the full tank switch 48 becomes 0, the full tank flag is reset.
[0147]
Further, the CPU 56 sets “2” as the offset of the input determination value table (step S156), and sets “0A (H)” as the offset of the switch timer address (step S157). The offset “2” in the input determination value table means that the third data “250” in the input determination value table is used. Further, since the switch timers are arranged in the same order as the bit order of the input ports shown in FIG. 12, the switch timer address offset “0A (H)” is designated by the switch timer corresponding to the ball break switch 187. Means that Then, a switch-on check routine is called (step S158).
[0148]
In the switch-on check routine, if the value of the switch timer corresponding to the ball-out switch 187 matches the ball-out switch-on determination value “250”, the switch-on flag is set (step S159). It is set (step S160). Although not explicitly shown in FIG. 20, when a switch-off timer corresponding to the ball break switch 187 is prepared and the value becomes 50, the ball break flag is reset.
[0149]
Then, the CPU 56 confirms whether or not the payout is stopped (step S201). The payout stop state is a state after a payout stop state designation command is sent to the payout control board 37. If it is not in the payout stop state, it is confirmed whether or not the above-described ball-out state flag or full tank flag is turned on (step S202).
[0150]
When any of them changes to the on state, a command transmission control process related to designation of the payout stop state is performed (step S203). In the command transmission control process, after predetermined data is set in the command transmission table for the payout control command, the payout control command sending process is executed. In step S202, when one of the flags is already in the on state and the other flag is in the on state, the command transmission control process (step S203) is not performed.
[0151]
If it is in the payout stop state, it is checked whether both the ball-out state flag and the full tank flag are turned off (step S204). When both are turned off, command transmission control processing relating to designation of canceling the payout stop is performed (step S205).
[0152]
Next, the CPU 56 sets a payout control command related to the number of winning balls according to the winning in the command transmission table, and performs control to send out a payout control command according to the set content. First, the value of the 15 counter is checked (step S221). As described above, the 15 counter is counted up when the game ball wins the big winning opening and the count switch 23 is turned on. If the value of the 15 counter is not 0, command transmission control processing relating to the 15 winning ball number instructions is performed (step S222). In the command transmission control process, after predetermined data is set in the command transmission table for the payout control command, the payout control command sending process is executed. Further, the value of the 15 counter is decremented by 1 (step S223). Further, 15 is added to the stored value of the total winning ball number storage buffer (step S224).
[0153]
The total winning ball number storage buffer is a buffer for storing a cumulative value of the number of winning balls instructed to the payout control means (however, subtracted when paying out), and is formed in the backup RAM.
[0154]
If the value of the 15 counter is 0, the value of the 10 counter is checked (step S225). As described above, the 10 counter is counted up when a game ball wins a winning opening and the winning opening switches 19a, 19b, 24a, 24b are turned on. If the value of the 10 counter is not 0, command transmission control processing relating to the 10 winning ball number instructions is performed (step S226). Also, the value of the 10 counter is decremented by 1 (step S227). Further, 10 is added to the stored value of the total winning ball number storage buffer (step S228).
[0155]
If the value of the 10 counter is 0, the value of the 6 counter is checked (step S231). As described above, the six counter is counted up when the game ball wins the start winning opening and the start opening switch 17 is turned on. If the value of the six counter is not 0, command transmission control processing relating to the six prize ball number instructions is performed (step S232). Further, the value of the six counter is decremented by -1 (step S233). Further, 6 is added to the stored value of the total winning ball number storage buffer (step S234).
[0156]
As described above, when the payout control command for instructing the number of prize balls is output from the game control means to the payout control board 37, the command transmission table is set and then set in the command transmission table. A payout control command is sent to the payout control board 37. Then, when a payout control command for instructing the number of prize balls is sent, the prize ball payout flag is turned on (step S235). When the prize ball paying flag is on (step S236), the number of prize balls actually paid out from the ball payout device 97 is monitored and the value stored in the total prize ball number storage buffer is subtracted. A number subtraction process is performed (step S237). When the prize ball paying flag changes from on to off, a lamp control command for instructing lighting of the prize ball lamp 51 is sent to the lamp control board 35.
[0157]
FIG. 23 is a flowchart showing an example of the winning ball number subtraction process. In the winning ball number subtraction process, the CPU 56 first loads the stored value of the total winning ball number storage buffer (step S241). Then, it is confirmed whether or not the stored value is 0 (step S242). If 0, the process ends.
[0158]
If it is not 0, the switch timer for the prize ball count switch is loaded (step S243), and the load value is compared with the ON determination value (in this case, “2”) (step S244). If they match (step S245), it is assumed that the prize ball count switch 301A has been turned on, that is, one game ball has been paid out from the ball payout device 97, and the stored value in the total prize ball number storage buffer is set. 1 is subtracted (step S246).
[0159]
Also, the value of the prize ball information counter is incremented by 1 (step S247). If the value of the prize ball information counter is 10 or more (step S248), the value of the prize ball information output counter is incremented by 1 (step S249), and the value of the prize ball information counter is incremented by -10 (step S250). The value of the prize ball information output counter is referred to in the information output process (step S29) in the main process shown in FIG. 13. If the value is 1 or more, the prize ball signal (bit 7 of the output port 5). : See FIG. 14), one pulse is output. Therefore, in this embodiment, each time ten game balls are paid out as prize balls, one prize ball signal is output to the outside of the gaming machine.
[0160]
When the value stored in the total prize ball number storage buffer becomes 0 (step S251), the prize ball paying-in flag is cleared (step S252), and a lamp control command is issued to notify that there is no prize ball remaining number. After command data indicating that the prize ball lamp 51 is extinguished is set in the command transmission table (step S253), a lamp control command sending process is executed (step S254).
[0161]
Next, a method for sending a control command from the game control means to each electric component control means will be described. FIG. 25 is an explanatory diagram showing an example of a command form of a control command sent from the main board 31 to another electrical component control board. In this embodiment, the control command has a 2-byte configuration, the first byte represents MODE (command classification), and the second byte represents EXT (command type). The first bit (bit 7) of the MODE data is always “1”, and the first bit (bit 7) of the EXT data is always “0”. Note that the command form shown in FIG. 25 is an example, and other command forms may be used.
[0162]
FIG. 26 is a timing chart showing the relationship between an 8-bit control signal and an INT signal (strobe signal) that constitute a control command from the game control board to each of the other electrical component control boards. As shown in FIG. 26, when a predetermined period elapses after MODE or EXT data is output to the output port, the CPU 56 turns on an INT signal that is a signal indicating data output. Further, when a predetermined period has elapsed from that point, the INT signal is turned off.
[0163]
FIG. 27 is an explanatory diagram showing an example of the contents of the payout control command. In the example shown in FIG. 27, a command FF00 (H) with MODE = FF (H) and EXT = 00 (H) is a payout control command for designating a payout enabled state. A command FF01 (H) with MODE = FF (H) and EXT = 01 (H) is a payout control command for designating a payout stop state. A command F0XX (H) with MODE = F0 (H) is a payout control command for designating the number of winning balls. “XX”, which is EXT, indicates the number of payouts.
[0164]
When the payout control means receives the payout control command of FF01 (H) from the game control means of the main board 31, the payout payout and ball lending are stopped, and when the payout control command of FF00 (H) is received, the payout ball payout And you can rent a ball. When a payout control command for designating the number of prize balls is received, prize ball payout control is performed according to the number designated by the received command.
[0165]
The payout control command is sent only once so that the payout control means can recognize it. In this example, “recognizable” means that the INT signal is turned on, and “recognizable only once” means that in this example, each of the first and second bytes of the payout control signal is sent. In response, the INT signal is turned on only once.
[0166]
When a control command is to be output from the game control means to each electrical component control board such as a payout control board, the command transmission table is set. FIG. 28A is an explanatory diagram showing a configuration example of the command transmission table. One command transmission table is composed of 3 bytes, and INT data is set in the first byte. In the command data 1 of the second byte, MODE data of the first byte of the control command is set. Then, in the command data 2 of the third byte, the EXT data of the second byte of the control command is set.
[0167]
Although the EXT data itself may be set in the area of the command data 2, the command data 2 may be set with data for designating the address of the table storing the EXT data. . In this embodiment, if bit 7 (work area reference bit) of command data 2 is 0, it indicates that EXT data itself is set in command data 2. Such EXT data is data in which bit 7 is 0. If the work area reference bit is 1, it indicates that the other 7 bits are an offset for designating the address of the table storing the EXT data. In this embodiment, a command transmission table is prepared for each control command.
[0168]
FIG. 28 (B) is an explanatory diagram showing a configuration example of INT data. Bit 0 in the INT data indicates whether or not a payout control command should be sent to the payout control board 37. If bit 0 is “1”, it indicates that a payout control command should be sent. Therefore, for example, in award ball processing, the CPU 56 sets “01 (H)” in the INT data of the command transmission table for payout control commands when sending out payout control commands.
[0169]
Bits 1, 2, and 3 of the INT data are bits indicating whether or not a display control command, a lamp control command, and a voice control command should be sent, respectively. When the CPU 56 should send these commands, , INT data, command data 1 and command data 2 are set in the command transmission table pointed to by the pointer. When these commands are transmitted, the corresponding bit of the INT data is set to “1”, and MODE data and EXT data are set to the command data 1 and the command data 2.
[0170]
When a control command for each electric component control board is output to the corresponding output port (output ports 1 to 4), any one of bits 0 to 3 of output port 0 is turned on for a predetermined period. However, the bit arrangement in the INT data and the bit arrangement in the output port 0 correspond to each other. Therefore, when a command is sent to each electrical component control board, the INT signal can be easily output based on the INT data set in the command transmission table.
[0171]
FIGS. 29 to 31 are flowcharts showing a processing example of the non-maskable interrupt processing (power supply stop time processing) executed in response to the power-off signal from the power supply board 910.
[0172]
In the power supply stop process, the CPU 56 saves the AF register (accumulator and flag register) in a predetermined backup RAM area (step S451). Further, the interrupt flag is copied to the parity flag (step S452). The parity flag is formed in the backup RAM area. Also, the BC register, DE register, HL register, IX register, and stack pointer are saved in the backup RAM area (steps S454 to S458). When the power is restored, the register contents are restored based on the saved contents, and the interrupt permission / prohibition state is internally set according to the contents of the parity flag.
[0173]
Next, in this embodiment, the detection signal of the prize ball count switch 301A is checked for a predetermined period. When the prize ball count switch 301A is turned on, the content of the total prize ball number buffer is reduced by one.
[0174]
In this embodiment, a predetermined period measuring counter is used to measure the predetermined period. The value of the counter for measuring the predetermined period is decremented by 1 every time a loop of the switch detection process (a loop starting from S461 and returning to S461) described below is executed once from the initial value m, and the value becomes 0. It is assumed that the predetermined period has ended. Since there is an exception in the detection processing loop, almost constant processing is performed, and therefore, m times the time required for one round of the loop corresponds to a predetermined period.
[0175]
In order to measure the predetermined period, a built-in timer of the CPU 56 may be used. That is, a predetermined value (corresponding to a predetermined period) is set in the built-in timer at the start of the switch detection process. Each time the switch detection processing loop is executed once, the count value of the built-in timer is checked. When the count value reaches 0, it is assumed that the predetermined period has ended. An interrupt by the internal timer can be used to detect that the value of the internal timer has reached 0, but at this stage, the control content (such as each value stored in the RAM) should not be changed. A program configuration is preferred in which the count value of the built-in timer is read and checked instead of using a program.
[0176]
The predetermined period is set to be equal to or longer than the time from when the game ball falls from the ball dispensing device 97 until it reaches the prize ball count switch 301A. If the distance from the ball payout device 97 to the prize ball count switch 301A is L, the drop time t during that time is t = √ (2L / g) (g: gravitational acceleration). Is set.
[0177]
At least for a predetermined period during which the switch detection process is executed, the prize ball count switch 301A must be in a state where it can detect a game ball. Therefore, in this embodiment, as shown in FIG. 10, a capacitor 923 serving as a relatively large capacity auxiliary drive power source is connected to the input side of the converter IC 922 in the power supply substrate 910. Therefore, even when the power supply to the gaming machine is stopped, the + 12V power supply voltage is maintained in a range in which the switch can be driven for a certain period, and the winning ball count switch 301A becomes operable. The capacitance of the capacitor is determined so that the period is equal to or longer than the predetermined period.
[0178]
Since the input port and the CPU 56 are also driven by the + 5V power source created by the converter IC 922, the operation can be performed for a relatively long period even when the power supply is stopped.
[0179]
In step S461, an initial value n corresponding to a time of 2 ms is set in the 2 ms measurement counter. Then, until the value of the 2 ms measurement counter becomes 0 (step S462), the value of the 2 ms measurement counter is decremented by 1 (step S463).
[0180]
When the value of the 2 ms measurement counter becomes 0, the input of the detection signal of the prize ball count switch 301A is checked. That is, processing similar to the switch processing and switch check processing shown in FIGS. 17 and 18 is performed. Specifically, the data input to the input port 1 is input (step S464). Next, clear data (00) is set (step S465). Further, port input data, in this case, input data from the input port 1 is set as a “comparison value” (step S466). Further, the address of the switch timer for the prize ball count switch 301A is set in the pointer (step S467).
[0181]
Then, the switch timer indicated by the pointer (the address of the switch timer is set) is loaded (step S468), and the comparison value is shifted to the right (from the upper bit to the lower bit) (step S469). Data of the input port 1 is set as the comparison value. In this case, the detection signal of the winning ball count switch 301A is pushed out to the carry flag.
[0182]
If the value of the carry flag is “1” (step S470), that is, if the detection signal of the prize ball count switch 301A is ON, the value of the switch timer is incremented by 1 (step S471). If the value of the carry flag is “0”, that is, if the detection signal of the prize ball count switch 301A is OFF, clear data is set in the switch timer (step S472). That is, if the switch is off, the value of the switch timer returns to zero.
[0183]
When the value of the switch timer becomes 2 (step S473), 1 is subtracted from the value stored in the total prize ball number storage buffer (step S474), and the value of the prize ball information counter is incremented by 1 (step S475). . If the value of the prize ball information counter is 10 or more (step S476), the value of the prize ball information output counter is incremented by 1 (step S477), and the value of the prize ball information counter is incremented by -10 (step S478).
[0184]
Next, the value of the counter for measuring the predetermined period is decremented by -1 (step S479). If the value is not 0, the process returns to step S461.
[0185]
If the prize ball count switch 301A is turned on within the predetermined period by the above processing, the value of the total prize ball number storage buffer is decremented by one. Since the processing for saving the contents of the backup RAM is performed after such switch detection processing, the total winning ball number storage buffer is always decremented by 1 for winning balls that have been paid out. Therefore, it is possible to prevent a contradiction in the stored control state with respect to the game ball payout. In the above switch detection process, a timer process using a detection period counter is performed. That is, the detection output of the prize ball count switch 301A is checked every 2 ms, and it is considered that the prize ball count switch 301A is reliably turned on when it is detected to be turned on twice in succession. Therefore, erroneous switch-on detection is prevented. In addition, in the switch detection process, the calculation of a prize ball information output number counter for outputting prize ball information to the outside of the gaming machine is also performed, so the prize ball information output to the outside and the actual number of paid-out prize balls are different. There is no such thing.
[0186]
In this embodiment, the switch detection process of only the winning ball count switch 301A is performed, but the same switch detection process is also performed for the V winning switch 22 and the count switch related to the start winning opening switch and the big winning opening. May be performed. The same switch detection process may be performed for other winnings. When such an on-check is also performed, even if a power failure occurs immediately after a game ball wins a winning opening, the winning is reliably detected and reflected in the saved game state.
[0187]
When the predetermined period has elapsed (step S480), that is, when the value of the counter for measuring the predetermined period becomes 0, the backup specified value ("55H" in this example) is stored in the backup flag (step S481). The backup flag is formed in the backup RAM area. Next, parity data is created (steps S482 to S491). That is, first, the clear data (00) is set in the checksum data area (step S482), and the checksum calculation start address is set in the pointer (step S483). Also, the number of checksum calculations is set (step S484).
[0188]
Then, an exclusive OR between the contents of the checksum data area and the contents of the RAM area pointed to by the pointer is calculated (step S485). The calculation result is stored in the checksum data area (step S486), the pointer value is incremented by 1 (step S487), and the checksum calculation count value is decremented by 1 (step S488). The processing of steps S485 to S488 is repeated until the value of the checksum calculation count becomes 0 (step S489).
[0189]
When the value of the checksum calculation count becomes 0, the CPU 56 inverts the value of each bit of the contents of the checksum data area (step S490). Then, the inverted data is stored in the checksum data area (step S491). This data becomes parity data to be checked when the power is turned on. Next, an access prohibition value is set in the RAM access register (step S492). Thereafter, the built-in RAM 55 cannot be accessed.
[0190]
In this embodiment, the RAM area in which data used in the game control process is stored is all backed up. Therefore, the checksum generation process indicating whether or not the contents are correctly stored and the RAM access prevention process for preventing the contents from being rewritten correspond to the process for storing the gaming state.
[0191]
When processing for prohibiting access to the internal RAM 55 is executed, the CPU 56 enters a standby state (loop state). Therefore, nothing is done until the system is reset.
[0192]
In this embodiment, the power supply stop process is executed according to the NMI. However, the power supply stop signal is connected to the maskable terminal of the CPU 56 and the power supply stop process is executed by the maskable interrupt process. May be. Alternatively, a power-off signal may be input to the input port and the power supply stop process may be executed according to the input port check result.
[0193]
Further, in this embodiment, the register saving process is performed at the beginning of the process activated in response to the power-off signal, but when the register is not used in the switch detection process, after executing the switch detection process, That is, the register saving process can be performed before the backup flag setting and the checksum calculation process. In that case, the register saving process, the backup flag setting process, and the checksum calculation process can be regarded as a power supply stop process. Further, even when several registers are used in the switch detection process, the register storage process can be performed before the backup flag setting process and the checksum calculation process for the unused registers.
[0194]
FIG. 32 is a timing chart showing an example of how detection signal input processing from the payout detection means is executed. In this embodiment, the power-off signal is input to the main board 31 and the payout control board 37 and input to the NMI terminals of the CPU 56 of the main board 31 and the payout control CPU 371. The CPU 56 of the main board 31 executes the above-described power supply stop process by the non-maskable interrupt process.
[0195]
As shown in FIG. 32, when a prize ball payout is executed when the power-off signal is turned on (in this example, changes from a high level to a low level), detection signal input processing from the payout detection means is executed. Within a predetermined period, the prize ball count switch 301A is turned on. Therefore, the ball payout executed when the power-off signal is turned on can also be reflected in the total winning ball number buffer when the power supply stop process is executed.
[0196]
When the voltage value of VSL further decreases to a predetermined value (+9 V in this example), the output of the reset IC 651 mounted on the main board 31 becomes low level as shown in FIG. Reset state. Note that the CPU 56 has completed the power supply stop process before entering the system reset state.
[0197]
When the voltage value of VSL is further decreased to be lower than a voltage capable of generating Vcc (+5 V for driving various circuits), each circuit cannot be operated on each substrate. However, in the main board 31, the power supply stop process is executed, and the CPU 56 is in a system reset state.
[0198]
As will be described later, the payout control CPU 371 on the payout control board 37 also enters the system reset state after performing the power supply stop process.
[0199]
The pachinko gaming machine 1 according to the above embodiment can give a predetermined game value to a player when a special symbol stop symbol variably displayed on the variable display unit 9 based on a start winning combination is a combination of a predetermined symbol. The first type pachinko gaming machine is, but if there is a prize for a predetermined electric combination that is released when the symbol of the symbol that is variably displayed based on the start winning combination becomes a combination of the predetermined symbol, the predetermined right is given The present invention can be applied even to a third type pachinko game machine that is generated or continued.
[0200]
FIG. 33 is an explanatory diagram showing an example of the game area 7 of the third type pachinko gaming machine. In this example, when there is a winning at the start winning opening 30A, the variable display unit 9 starts variable display of symbols. Then, when the symbol stop symbol becomes a combination of predetermined symbols, the right generating electric accessory 30B is opened for a predetermined period so that it becomes easy to win. In this state, when a right is generated by winning a prize in the right-generating electric accessory 30B, the game ball that has entered the rotor 30C driven by a motor or the like is led to the start opening switch of the big winning opening 30D, and the start opening switch If it is detected, the special winning opening 30D is opened. In addition, each switch which detects the game ball which won the start winning opening 30A, the electric power generation tool 30B for rights generation, the rotor 30C, and the big winning opening 30D is provided.
[0201]
In such a third type pachinko gaming machine, even when it is configured to save the control state in response to the occurrence of a power failure or the like, first, for example, in the process activated in response to the power-off signal, the output port is cleared. In the process, the motor or the like that drives the rotor 30C is stopped. Since the game ball guided to the start port switch (the switch for detecting the game ball entering the rotor 30C) by the rotor 30C is subjected to the switch detection process for a predetermined period even after it is detected that the power is cut off. It can be detected by the start switch. Therefore, when the power supply is restored, it is guaranteed that the operating condition of the special winning opening 30D is established. In this case, the predetermined period is a period longer than the time until the game ball moves from the part holding the game ball of the rotor 30C to the start port switch. In addition, even for the switch provided in the right-generating electric accessory 30B, even if it is detected that the power supply is cut off, the detection process is executed for a predetermined period, thereby preventing unauthorized loss of the right. .
[0202]
Note that when all switches are detected in the switch detection process in the process activated in response to the occurrence of the power-off signal, the switch process shown in FIG. 17 may be called during a predetermined period. . And when comprised in that way, the process when a switch timer value reaches an ON determination value is also performed. For example, when the switch timer value of the winning ball switch reaches the ON determination value, a process for setting the number of winning balls is performed (for example, increment of 15 counters), or the switch timer value of the V winning switch 22 is changed to the ON determination value. When it reaches, processing such as setting a flag indicating that there has been a V prize is performed.
[0203]
Hereinafter, the gaming state restoration process will be described.
FIG. 34 is a flowchart showing an example of the gaming state recovery process shown in step S10 of FIG. In this example, the CPU 56 restores the value stored in the backup RAM to each register (step S91). Then, based on the data stored in the backup RAM, the gaming state at the time of power failure is confirmed and returned. That is, based on the data stored in the backup RAM, the solenoid 16 and the solenoid 21 are driven via the solenoid circuit 59 to restore the open / closed state of the start winning opening 14 and the open / close plate 20 (steps S92 and S93). . In addition, according to the value of the special symbol process flag and the normal symbol process flag stored even when the power is turned off, the control commands corresponding to the progress status of the special symbol process processing and the progress status of the normal symbol process processing when the power is turned off, This is sent to the symbol control board 80, the lamp control board 35, and the voice control board 70 (step S94).
[0204]
As described above, in the game state restoration process, the state of various electrical components is restored according to the restored internal state, and control is performed on the symbol control board 80, the lamp control board 35, and the voice control board 70. A control command for returning the state to the state at the time of power-off (control command for causing a control state at the time of power-off) is sent out. Such control commands are generally one or more control commands that were last sent prior to a power failure.
[0205]
In this embodiment, when the gaming state is restored to the power-off state, the CPU 56 restores the interrupt permission / prohibition state at the previous power-off, so that the value of the parity flag stored in the backup RAM is restored. Is confirmed (step S95). If the parity flag is off, interrupt permission is set (step S96). However, if the parity flag is in the on state, the gaming state restoration process is terminated as it is (while keeping the interrupt prohibited state set in step S1). The fact that the parity flag is in the on state means that the interrupt was prohibited at the previous power-off as shown in step S452 in FIG. Therefore, when the parity flag is in the on state, no interrupt is permitted.
[0206]
In this embodiment, the following state recovery is possible by the gaming state recovery process described above.
[0207]
The states of the start winning opening 14 and the big winning opening (opening / closing plate 20) are restored. The display state of the normal symbol (display state of the variable display 10) controlled by the display control means is restored except when it is changing at the time of power-off. The display state of the special symbol controlled by the display control means (display state of the variable display unit 9) is restored except when it is changing when the power is turned off. Further, the background and characters displayed on the variable display unit 9 are restored except when the special symbol is changing and the big hit game is being played.
[0208]
When the power is cut off during the change of the special symbol, information on the change time (for example, 10 seconds) of the variable display pattern and the already executed time (for example, 4 seconds) is backed up. Then, at the time of recovery, the main board 31 outputs a display control command indicating a display pattern and a display control command indicating a stop pattern to the display control board 80, and stops the pattern after the remaining time (6 seconds in the above example) has elapsed. Display control commands are output. Accordingly, if the special symbol is in a changing state when the power is turned off, the variable symbol is displayed for the remaining time (6 seconds in the above example) that is not displayed at the time of recovery. The display control command indicating the display pattern output to the display control board 80 at the time of recovery may be the same as the display control command indicating the display pattern output before the power is turned off. It is also possible to use a command for displaying an image such as “In”. In this case, the display of “currently recovering from power failure” is displayed for the remaining time (6 seconds in the above example). Note that the same control as described above is performed for the display state of the normal symbol when the power is cut off during the variation of the special symbol.
[0209]
Even if the power is cut off during the big hit game, the remaining time of the interval between rounds or between rounds is displayed at the time of recovery, as in the case where the power is cut off during the special symbol change described above. The main board 31 outputs a display control command for designating a fixed symbol (stopped symbol) output before the power supply is cut off to the display control board 80. As a result, it is possible to produce a jackpot symbol during a round or between rounds (for models that produce a jackpot symbol with a jackpot symbol), and the display control board 80 can also recognize a symbol displayed at the start of fluctuation after the jackpot ends. .
[0210]
The display states of the decoration lamp 25, the start memory display 18, the gate passing memory display 41, the prize ball lamp 51, and the ball break lamp 52 controlled by the lamp control means are restored. The display state of the game effect lamps / LEDs 28a, 28b, and 28c is restored except when the special symbol is changing and the big hit game is being played. However, if the game is a big hit game when the power is turned off, it can be restored to the initial state of each control section. Each control section is, for example, a jackpot start notification state, a state before the big winning opening is opened, a state where the big winning opening is open, and a big hit end notification state. When the power is cut off during the special symbol fluctuation, the game effect lamps / LEDs 28a, 28b, 28c are left for the remaining time as in the display control of the variable display unit 9 and the variable display device 10 described above. The display state may be controlled, but may be turned on / flashed in a pattern peculiar to turning off or recovering from a power failure.
[0211]
The sound generation state controlled by the sound control means is restored except when the special symbol is changing and the big hit game is being played. However, if the game is a big hit game when the power is turned off, it can be restored to the initial state of each control section. When the power is cut off during the special symbol fluctuation, the sound generation state is controlled for the remaining time in the same manner as the display control of the variable display unit 9 and the variable display device 10 described above. However, it is also possible to output a sound pattern peculiar to silence or power failure recovery (for example, “sound recovery from power failure”).
[0212]
In this embodiment, a control command for restoring the state is sent from the game control means of the main board 31 to the display control means, the lamp control means and the sound control means at the time of recovery from the power interruption. When the display control means, the lamp control means and the sound control means are backed up, the display control means, the lamp control means and the sound control means independently restore the control state without using the control command from the main board 31. You may comprise so that it may do.
[0213]
Further, as will be described later, since the payout control means mounted on the payout control board 37 is backed up by the power supply, the prize ball payout state and the ball lending control state are the same as those at the time of the power supply cut off when the power supply is restored. The state is restored (the state after a predetermined time has elapsed since the voltage drop was detected). In this embodiment, since the launch control board is connected to the payout control means, the control state on the launch control board 91 is similarly restored.
[0214]
In the above embodiment, the case where the data storage process and the restoration process are performed in the game control means has been described, but part of the RAM in the payout control means, the sound control means, the lamp control means, and the display control means is also included. The power supply is backed up, and the payout control means, the display control means, the sound control means, and the lamp control means may perform the processing as described above. However, the payout control means, the display control means, the sound control means, and the lamp control means do not need to perform command transmission processing at the time of recovery.
[0215]
Next, as an example of the case where the data storage process and the recovery process are performed in the electrical component control means other than the game control means, the case where the data storage and recovery is performed in the payout control means will be described.
[0216]
FIG. 35 is a block diagram showing a configuration example around the payout control CPU 371. As shown in FIG. 35, the power-off signal from the power supply monitoring circuit (power supply monitoring means) of the power supply board 910 is connected to the non-maskable interrupt terminal (XNMI terminal) of the payout control CPU 371 via the buffer circuit 960. Yes. Therefore, the payout control CPU 371 can confirm the occurrence of power interruption by the non-maskable interrupt process.
[0217]
The INT signal from the main board 31 is connected to the CLK / TRG2 terminal of the payout control CPU 371. When a clock signal is input to the CLK / TRG2 terminal, the value of the timer counter register CLK / TRG2 built in the payout control CPU 371 is down-counted. When the register value becomes 0, an interrupt occurs. Therefore, if the initial value of the timer counter register CLK / TRG2 is set to “1”, an interrupt is generated according to the input of the INT signal.
[0218]
Although the system reset circuit 975 is also mounted on the payout control board 37, in this embodiment, the reset IC 976 in the system reset circuit 975 outputs an output to the external capacitor for a predetermined time determined by the capacity when the power is turned on. The output is set to a low level and the output is set to a high level when a predetermined time has elapsed. Further, the reset IC 976 monitors the power supply voltage of VSL, and when the voltage value becomes a predetermined value (for example, +9 V) or less, the reset IC 976 sets the output to a low level. Therefore, when the power is turned off, the payout control CPU 371 is system reset by the signal from the reset IC 976 becoming low level.
[0219]
The predetermined value for the reset IC 976 to detect power-off is lower than the normal voltage, but is a voltage that allows the payout control CPU 371 to operate for a while. Further, since the reset IC 976 is configured to monitor a voltage higher than the voltage required by the payout control CPU 371 (in this example, +5 V), the monitoring range for the voltage required by the payout control CPU 371 is set. Can be spread. Therefore, more precise monitoring can be performed.
[0220]
While power is not supplied from the + 5V power supply, at least a part of the built-in RAM of the payout control CPU 371 is backed up by connecting the backup power supplied from the power supply board to the backup terminal, and the power to the gaming machine is cut off. The contents are saved. When the +5 V power supply is restored, a reset signal is issued from the system reset circuit 975, so that the payout control CPU 371 returns to a normal operation state. At that time, since necessary data is backed up, it is possible to return to the payout control state at the time of the power failure when recovering from the power failure.
[0221]
As shown in FIG. 35, the output signal of the clear switch 921 mounted on the switch board 190 is input via the buffer circuit 372A that inverts the logic and the input port 372. In this example, output signals of the prize ball count switch 301A and the ball lending count switch 301B are also input to the input port 372 via the buffer circuit 372A. According to such a configuration, when the output signal is a clear switch signal (low level signal) by switching the clear switch 921, the clear switch signal is inverted (the buffer circuit 372A inverts the clear switch signal). The output signal may be referred to as a clear switch signal.) And is provided to the payout control CPU 371, so that the payout control CPU 371 performs an initialization process to be described later.
[0222]
In the configuration shown in FIG. 35, the system reset circuit 975 outputs a low level during a period determined by the capacitance of the capacitor when power is turned on, and then outputs a high level. That is, the reset release timing is only once. However, as in the case of the main board 31 shown in FIG. 11, a circuit configuration that generates a plurality of reset release timings may be used.
[0223]
FIG. 36 is an explanatory diagram showing output port assignment in this embodiment. As shown in FIG. 36, the output port C (address 00H) is an output port for a drive signal output to the payout motor 289. The output port D (address 01H) is an output port for a display control signal output to the error display LED 374 which is a 7 segment LED. The output port E (address 02H) is an output port for outputting a drive signal output to the sorting solenoid 310 and an EXS signal and a PRDY signal for the card unit 50.
[0224]
FIG. 37 is an explanatory diagram showing bit assignment of input ports in this embodiment. As shown in FIG. 37, the input port A (address 06H) is an input port for taking in an 8-bit payout control signal of the payout control command sent from the main board 31. In addition, detection signals from the winning ball count switch 301A, the ball lending count switch 301B, and the motor position sensor are input to bits 0 to 2 of the input port B (address 07H), respectively. Bits 3 to 5 are supplied with a BRDY signal, a BRQ signal, and a VL signal from the card unit 50. In bit 6, the output signal of the clear switch 921 is input.
[0225]
FIG. 38 is a flowchart showing main processing of the payout control CPU 371. In the main process, the payout control CPU 371 first performs necessary initial settings. That is, the payout control CPU 371 first sets the interruption prohibition (step S701). Next, the interrupt mode is set to interrupt mode 2 (step S702), and a stack pointer designation address is set to the stack pointer (step S703). The payout control CPU 371 initializes the built-in device register (step S704), initializes the CTC and PIO (step S705), and then sets the RAM in an accessible state (step S706).
[0226]
In this embodiment, one channel of the built-in CTC is used in the timer mode. Accordingly, in the built-in device register setting process in step S704 and the process in step S705, register setting for setting the channel to be used to timer mode, register setting for permitting interrupt generation, and setting an interrupt vector. The register is set. The interrupt by the channel is used as a timer interrupt. For example, when it is desired to generate a timer interrupt every 2 ms, a value corresponding to 2 ms is set as an initial value in a predetermined register (time constant register).
[0227]
The interrupt vector set for the channel set to the timer mode (channel 3 in this embodiment) corresponds to the start address of the timer interrupt process. Specifically, the start address of the timer interrupt process is specified by the value set in the I register and the interrupt vector. In the timer interrupt process, a timer interrupt flag is set. When it is detected in the main process that the timer interrupt flag is set, a payout control process is executed. That is, in the timer interrupt process, settings for executing a payout control process, which is an example of an electrical component control process, are made.
[0228]
Further, another channel (channel 2 in this embodiment) of the built-in CTC is used as an interrupt generation channel for receiving a payout control command from the game control means, and this channel is used in the counter mode. Used in. Accordingly, in the built-in device register setting process in step S704 and the process in step S705, register setting for setting the channel to be used to the counter mode, register setting for permitting interrupt generation, and setting an interrupt vector. The register is set.
[0229]
The interrupt vector set in the channel (channel 2) set in the counter mode corresponds to the head address of the command reception interrupt process described later. Specifically, the start address of the command reception interrupt process is specified by the value set in the I register and the interrupt vector.
[0230]
In this embodiment, the interruption mode 2 is also set in the payout control CPU 371. Therefore, an interrupt process based on counting up the built-in CTC can be used. Further, it is possible to set an interrupt processing start address corresponding to the interrupt vector transmitted by the CTC.
[0231]
The interrupt based on the count-up of the CTC channel 2 (CH2) is an interrupt that occurs when the value of the timer counter register CLK / TRG2 described above becomes “0”. Therefore, for example, in step S705, the initial value “1” is set in the timer counter register CLK / TRG2 as the specific register. An interrupt based on the count-up of CTC channel 3 (CH3) is an interrupt that occurs when the internal clock (system clock) of the CPU is counted down and the register value becomes “0”. Used as an interrupt. Specifically, the register value of CH3 is subtracted at 1/256 period of the system clock. In step S705, the CH3 register is set to a value corresponding to 2 ms as an initial value.
[0232]
Interrupts based on CTC CH2 count-up have a higher priority than interrupts based on CH3 count-up. Therefore, when the count-up occurs simultaneously, the interrupt based on the CH2 count-up, that is, the interrupt that triggers the execution of the command reception interrupt process is given priority.
[0233]
Next, the payout control CPU 371 checks the state of the output signal of the clear switch 921 input via the input port 372 only once in this example for a predetermined period (for example, 0.001 second) (step S707). When the clear switch 921 is on (a state where the clear switch 921 is pressed), a low-level clear switch signal is output. Therefore, if the clear switch 921 is turned on, the payout control CPU 371 executes a normal initialization process (steps S711 to S713). The CPU 56 may confirm the state of the output signal of the clear switch 921 at least twice.
[0234]
If the clear switch 921 is not in an on state (that is, if the clear switch 921 is not pressed), the payout control CPU 371 determines whether backup data exists in the payout control backup RAM area. Is confirmed (step S708). That is, for example, similarly to the processing of the CPU 56 of the main board 31, whether or not backup data exists is confirmed by whether or not the backup flag that is set when the power is turned off is set. If the backup flag is set, it is determined that there is backup data.
[0235]
After confirming that there is a backup, the payout control CPU 371 performs a data check (parity check in this example) in the backup RAM area. In the case of recovery after an unexpected power failure, the data in the backup RAM area should have been saved, so the check result is normal. If the check result is not normal, the internal state cannot be returned to the state at the time of power-off, and therefore an initialization process that is executed at the time of power-on not at the time of power failure recovery is executed.
[0236]
If the check result is normal (step S709), the payout control CPU 371 performs a payout state recovery process for returning the internal state to the state when the power is turned off (step S710). Then, it returns to the address indicated by the PC (program counter) stored in the backup RAM area.
[0237]
In this way, it is determined whether or not to restore the gaming state when the power is turned off according to the operation state of the clear switch 921. At this time, if the clear switch 921 is in the on state, the gaming state restoration process is performed. Since it is configured not to be executed but to perform normal initialization processing, the game store clerk or the like operates the clear switch 921 when resuming the power supply to the gaming machine, thereby storing the backup data storage area (variable data storage means). It is possible to select whether or not to execute the game state restoration process based on the stored backup data. Therefore, there is provided a gaming machine that can prevent the player from being disadvantaged even if the power is cut off and can improve the convenience of operating the gaming machine at the gaming store.
[0238]
It should be noted that, when the backup data is not stored in the fluctuation data storage means when the power is turned on, and the clear switch 921 is in the OFF state even if the backup data is stored in the fluctuation data storage means The initialization process executed in the above is also used in the program. Therefore, even if control for improving convenience in operation at a game store is added, the program capacity does not increase so much.
[0239]
In the initialization process, the payout control CPU 371 first performs a RAM clear process (step S711). Then, the CTC register provided in the payout control CPU 371 is set so that a timer interrupt is periodically generated every 2 ms (step S712). That is, a value corresponding to 2 ms is set in a predetermined register (time constant register) as an initial value. Since the interruption is prohibited in step S701 of the initial setting process, the interruption is permitted before the initialization process is finished (step S713).
[0240]
In this embodiment, the built-in CTC of the payout control CPU 371 is set to repeatedly generate a timer interrupt. In this embodiment, the repetition period is set to 2 ms. When a timer interrupt occurs, as shown in FIG. 39, the payout control CPU 371 sets, for example, a timer interrupt flag indicating that a timer interrupt has occurred (step S721). In FIG. 39, it is also clearly indicated that the interrupt is permitted (step S720). In the 2 ms timer interrupt process, the interrupt permission state is first set. In other words, since the interrupt is permitted during the 2 ms timer interrupt process, the payout control command receiving process based on the input of the INT signal can be preferentially executed.
[0241]
The payout control CPU 371 executes a payout control process after step S751 when detecting that the timer interrupt flag is set in step S724. With the above control, in this embodiment, the payout control process is started every 2 ms. In this embodiment, only the flag is set in the timer interrupt process, and the payout control process is executed in the main process, but the payout control process may be executed in the timer interrupt process.
[0242]
In the payout control process, the payout control CPU 371 first determines whether or not the prize ball count switch 301A and the ball lending count switch 301B input to the input port 372b via the relay board 72 are turned on (switch process: Step S751).
[0243]
Next, the payout control CPU 371 performs processing such as checking the signal input state from a sensor (for example, a motor position sensor that detects the rotation speed of the payout motor 289) and determining the state of the sensor (input determination processing). : Step S752). The payout control CPU 371 further analyzes the received payout control command and executes a process according to the analysis result (command analysis execution process: step S753).
[0244]
Next, the payout control CPU 371 sets the payout stop state if the payout stop instruction command is received from the main board 31, and cancels the payout stop state if the payout start instruction command is received (step S754). Further, a prepaid card unit control process is performed (step S755).
[0245]
Next, the payout control CPU 371 performs control for paying out the rental balls in response to the ball rental request (step S756). At this time, the payout control CPU 371 sets the ball sorting member 311 to the ball lending side by the sorting solenoid 310.
[0246]
Further, the payout control CPU 371 performs prize ball control processing for paying out the number of prize balls stored in the total number memory (step S757). At this time, the payout control CPU 371 sets the ball sorting member 311 to the prize ball side by the sorting solenoid 310. Then, a drive signal is output to the payout motor 289 in the payout mechanism portion of the ball payout device 97 via the output port 372c and the relay board 72, and a payout motor control process for rotating the payout motor 289 by a predetermined number of rotations is performed. (Step S758).
[0247]
In this embodiment, a stepping motor is used as the payout motor 289, and a 1-2 phase excitation method is used to control them. Therefore, specifically, eight types of excitation pattern data are repeatedly output to the payout motor 289 in the payout motor control process. In this embodiment, each excitation pattern data is output by 4 ms.
[0248]
Next, error detection processing is performed, and predetermined display is performed on the error display LED 374 according to the result (error processing: step S759).
[0249]
The output port C is accessed in the payout motor control process (step S758) in the payout control process. The output port D is accessed by error processing (step S759) in the payout control processing. The output port E is accessed in the ball lending control process (step S756) and the prize ball control process (step S757) in the payout control process.
[0250]
FIG. 40 is an explanatory diagram showing an example of use of the RAM built in the payout control CPU 371. In this example, a total number storage (for example, 2 bytes) and a lending ball number storage are formed in the backup RAM area. The total number storage stores the total number of prize balls paid out instructed from the main board 31 side. The rented ball number storage stores the number of balls that have not been paid out.
[0251]
As described above, the number of unpaid prize balls and the number of rented balls are stored in the backup RAM area capable of holding the contents for a predetermined period. Therefore, even if an unexpected power failure such as a power failure occurs, If the power is restored, the winning ball processing and ball lending processing stored in the backup RAM area can be continued. Therefore, the disadvantage given to the player can be reduced.
[0252]
FIG. 41 is an explanatory diagram showing a configuration example of a reception buffer for storing a payout control command received from the main board 31. In this example, a ring buffer type reception buffer capable of storing six 2-byte payout control commands is used. Therefore, the reception buffer is configured by a 12-byte area of the confirmed command buffers 1 to 12. A command reception number counter indicating in which area the received command is stored is used. The command reception number counter takes a value from 0 to 11.
[0253]
FIG. 42 is a flowchart showing a payout control command reception process by an interrupt process. The payout control INT signal from the main board 31 is input to the CLK / TRG2 terminal of the payout control CPU 371. Therefore, when the INT signal from the main board 31 is turned on, the value of the timer counter register CLK / TRG2 that has been set to “1” as the initial value becomes 0, and the payout control CPU 371 is interrupted. Then, the payout control command receiving process shown in FIG. 42 is started. Note that the start address of the payout control command reception process is an address determined by the interrupt vector output from the built-in CTC and the value set in the I register. Further, when the value of the timer counter register CLK / TRG2 becomes 0, the value is automatically returned to the initial value (“1” in this example).
[0254]
In the payout control command reception process, the payout control CPU 371 first saves each register in the stack (step S850). Note that when an interrupt occurs, the CPU 371 automatically sets the interrupt prohibited state. However, if a CPU that does not automatically enter the interrupt prohibited state is used, the interrupt is prohibited before executing the process of step S850. It is preferable to issue an instruction (DI instruction). Next, data is read from the input port 372a assigned to input of the payout control command data (step S851). Then, it is confirmed whether or not it is the first byte of the 2-byte payout control command (step S852). Whether or not it is the first byte is confirmed by whether or not the first bit of the received command is “1”. The first bit is “1”, which should be the MODE byte (first byte) in the payout control command having a 2-byte configuration (see FIG. 25). Therefore, if the first bit is “1”, the payout control CPU 371 determines that the valid first byte has been received, and stores the received command in the confirmed command buffer indicated by the command reception number counter in the reception buffer area (step S31). S853).
[0255]
If it is not the first byte of the payout control command, it is confirmed whether or not the first byte has already been received (step S854). Whether or not it has already been received is confirmed by whether or not valid data is set in the reception buffer (deterministic command buffer).
[0256]
If the first byte has already been received, it is confirmed whether or not the first bit of the received 1 byte is “0”. If the first bit is “0”, it is determined that the valid second byte has been received, and the received command is stored in the confirmed command buffer indicated by the command reception number counter + 1 in the reception buffer area (step S855). The leading bit “0” should be the EXT byte (second byte) of the payout control command having a two-byte configuration (see FIG. 25). If the confirmation result in step S854 indicates that the first byte has already been received, the process ends unless the first bit of the data received as the second byte is “0”.
[0257]
When the second byte of command data is stored in step S855, 2 is added to the command reception number counter (step S856). Then, it is confirmed whether or not the command reception counter is 12 or more (step S857). If it is 12 or more, the command reception number counter is cleared (step S858). Thereafter, the saved register is restored (step S859), and interrupt permission is set (step S859).
[0258]
Interrupts are disabled during command reception interrupt processing. As described above, since the interrupt is enabled during the 2 ms timer interrupt processing, if a command reception interrupt occurs during the 2 ms timer interrupt, the command reception interrupt processing is executed with priority. The Even if a 2 ms timer interrupt occurs during command reception interrupt processing, the interrupt processing is awaited. Thus, in this embodiment, the processing priority of command reception processing from the main board 31 is high.
[0259]
The payout control command has a 2-byte configuration, and the first byte (MODE) and the second byte (EXT) can be immediately distinguished on the receiving side. In other words, the reception side can immediately detect whether the data as MODE or the data as EXT has been received by the first bit. Therefore, as described above, it can be easily determined whether or not appropriate data has been received.
[0260]
FIG. 43 is a flowchart illustrating an example of the command analysis execution process in step S753. In the command analysis execution process, the payout control CPU 371 checks whether or not there is a received command in the confirmed command buffer area (step S753a). If there is a received command, it is checked whether or not the received payout control command is a payout number instruction command (step S753b). If there are a plurality of received commands in the fixed command buffer area, whether or not the received payout control command is a payout number instruction command is checked for the received command received the earliest. Is called.
[0261]
If the received payout control command is a payout number instruction command, the number specified by the payout number instruction command is added to the total number memory (step S753c). That is, the payout control CPU 371 stores the number of prize balls included in the payout number instruction command sent from the CPU 56 of the main board 31 in the backup RAM area (total number memory). The payout control CPU 371 performs subtraction of the command reception number counter and reception command shift processing in the confirmed command buffer area, if necessary.
[0262]
FIG. 44 is a flowchart showing an example of the payout stop state setting process in step S754. In the payout stop state setting process, the payout control CPU 371 checks whether or not there is a received command in the confirmed command buffer area (step S754a). If there is a received command in the fixed command buffer area, it is checked whether or not the received payout control command is a payout stop instruction command (step S754b). If it is a payout stop instruction command, the payout control CPU 371 sets the payout stop state (step S754c).
[0263]
If it is confirmed in step S754b that the received command is not a payout stop instruction command, it is checked whether or not the received payout control command is a payout start instruction command (step S754d). If it is a payout start instruction command, the payout stop state is canceled (step S754e).
[0264]
FIG. 45 is a flowchart illustrating an example of the switch processing in step S751. In the switch process, the payout control CPU 371 checks whether or not the prize ball count switch 301A indicates the on state (step S751a). If the on state is indicated, the payout control CPU 371 increments the prize ball count switch on counter by 1 (step S751b). The prize ball count switch on counter is a counter for counting the number of times the on state of the prize ball count switch 301A is detected.
[0265]
Then, the value of the prize ball count switch-on counter is checked. If the value is 250 (step S751c), a prize ball clogging flag is set (step S751d). That is, the prize ball clogging flag is set when the prize ball count switch 301A remains on for a long time.
[0266]
When the value of the prize ball count switch on counter becomes 2 (step S751e), it is determined that the prize ball count switch 301A is turned on, and the prize ball count switch on flag is set (step S751f).
[0267]
When it is confirmed in step S751a that the prize ball count switch 301A is not in the on state, the payout control CPU 371 resets the prize ball count switch on flag (step S751h) and clears the prize ball count switch on counter (step S751h). Step S751i). Then, it is confirmed whether or not the ball lending count switch 301B indicates the on state (step S751j). If the on state is indicated, the payout control CPU 371 increments the ball lending count switch on counter by 1 (step S751k). The ball lending count switch on counter is a counter for counting the number of times that the ball lending count switch 301B is turned on.
[0268]
Then, the value of the ball lending count switch-on counter is checked. If the value is 250 (step S7511), the lending ball clogging flag is set (step S751m). In other words, the lending ball clogging flag is set when the ball lending count switch 301B remains on for a long period of time.
[0269]
When the value of the ball lending count switch on counter becomes 2 (step S751n), it is determined that the ball lending count switch 301B is turned on, and the ball lending count switch on flag is set (step S751o).
[0270]
When it is confirmed in step S751j that the ball lending count switch 301B is not in the on state, the payout control CPU 371 resets the ball lending count switch on flag (step S751p) and clears the ball lending count switch on counter (step S751p). S751q).
[0271]
FIG. 46 is a flowchart illustrating an example of the ball lending control process in step S756. In this embodiment, the maximum value of the continuous payout number is set as one unit (for example, 25) of the lending ball, but the maximum value of the continuous payout number may be another number.
[0272]
In the ball lending control process, the payout control CPU 371 checks whether or not the ball lending is stopped (step S501). If the ball lending is not stopped, the payout control CPU 371 checks whether or not the lending ball is being paid out (step S511). If the ball lending is being paid out, the ball lending process after step S518 is performed. Transition. Whether or not the lending ball is being paid out is determined by the state of a ball lending process flag which will be described later. If the ball lending is not being paid out, the payout control CPU 371 checks whether or not there is a ball lending request from the card unit 50 (step S512). If there is a request, the ball lending process flag is turned on (step S513), and 25 (number of ball lending units: 100 yen here) is set in the lending ball number storage in the backup RAM area (step S514). Then, the payout control CPU 371 turns on the EXS signal (step S515), and drives the sorting solenoid 310 to set the ball sorting member 311 below the ball payout device 97 to the ball lending side (step S515). S516). Further, the payout motor 289 is turned on (step S517).
[0273]
Strictly speaking, the payout motor 289 is turned on after the BRQ signal is turned off to indicate that the card unit 50 has recognized acceptance. The ball lending process flag is set in the backup RAM area.
[0274]
In step S518, the payout control CPU 371 checks whether or not it is during the lending ball passage waiting time (step S518). If it is not during the lending ball passage waiting time, a ball lending sensor (in this example, a payout motor position sensor) is checked (step S519), and a ball lending count switch check process described later is performed (step S520).
[0275]
Next, the payout control CPU 371 checks whether or not the driving of the payout motor 289 should be finished (whether the payout operation for one unit has been finished) (step S521). Specifically, it is confirmed whether or not the rotation corresponding to the predetermined number of payouts has been completed. The rotation corresponding to the predetermined number of payouts is monitored by the output of the payout motor position sensor. When the rotation corresponding to the predetermined number of payouts is completed, the payout control CPU 371 stops driving the payout motor 289 (step S522) and sets the lending ball passage waiting time (step S523).
[0276]
If it is during the lending ball passage waiting time in step S518, the payout control CPU 371 performs a ball lending count switch check process described later (step S524) and confirms whether or not the lending ball passage waiting time has ended. (Step S525). The rental ball passage waiting time is the time from when the last payout ball is paid out by the payout motor 289 until it passes through the ball lending count switch 301B.
[0277]
When the end of the lending ball passage waiting time is confirmed, all the lending balls in one unit are in a state of being paid out. Therefore, the distribution solenoid 310 is turned off and the card unit 50 receives the next lending request. The EXS signal is turned off in order to indicate that it has become possible (step S526). Also, the ball lending process flag is turned off (step S527).
[0278]
After turning off the EXS signal indicating acceptance of the ball lending request, if the BRQ signal, which is the ball lending request signal, is turned on again within a predetermined period, the ball without turning off the sorting solenoid 310 and the dispensing motor 289. The lending process may be continued. That is, instead of performing the ball lending process for each predetermined unit (100 yen unit in this example), the ball lending process may be executed continuously.
[0279]
The contents of the rental ball number storage are saved by the backup power source of the power supply board 910 for a predetermined period even if the gaming machine is powered off. Accordingly, when the power supply is restored during the predetermined period, the payout control CPU 371 can continue the ball lending process based on the contents of the lending ball number storage.
[0280]
FIG. 47 is a flowchart showing the ball lending count switch check process executed in steps S520 and S524. The ball lending count switch check process is a process of monitoring the state of the ball lending count switch 301B and subtracting the lending ball number storage.
[0281]
In the ball lending count switch check process, the payout control CPU 371 first checks whether or not the ball lending count switch ON waiting flag is set (step S520a). If the ball lending count switch ON waiting flag is set, it waits for the ball lending count switch on flag to be turned on (step S520b). The ball lending count switch-on flag is set in step S751o in the switch process shown in FIG. If the timer T11 times out before the ball lending count switch on flag is turned on, the ball lending route error flag is set (steps S520f and S520g). When the ball lending count switch 301B is turned on, the timer T11 is stopped (step S520c), and the ball lending count switch ON waiting flag is reset (step S520d). The timer T11 is a timer for confirming whether or not the ball lending count switch 301B is turned on within a predetermined period.
[0282]
When the ball lending count switch 301B is turned on, in order to confirm that the ball lending count switch 301B is turned off, a ball lending count switch OFF waiting flag indicating that the ball lending count switch 301B is waiting is set (step S520e). .
[0283]
Accordingly, when the ball lending count switch OFF waiting flag is on (step S520h), the payout control CPU 371 waits for the ball lending count switch on flag to be turned off (step S520k). When the ball lending count switch on flag is turned off, the ball lending count switch off waiting flag is reset (step S520l). Then, assuming that one game ball has been paid out, the lending ball number storage is decremented by 1 (step S520m).
[0284]
If it is confirmed in step S520h that the ball lending count switch OFF waiting flag is not turned on, the timer T11 is started (step S520i), and the ball lending count switch ON waiting flag is set (step S520j).
[0285]
As described above, in this embodiment, every time it is confirmed that one game ball has been lent, the rented ball number storage is decremented by one.
[0286]
48 and 49 are flowcharts showing an example of the prize ball control process in step S758. In this example, the maximum value of the continuous payout number is the same as the unit of the lending ball (for example, 25), but the maximum value of the continuous payout number may be another number.
[0287]
In the winning ball control process, the payout control CPU 371 checks whether or not the lending ball is being paid out (step S531). Whether or not the ball lending is being paid out is determined by the state of the ball lending process flag. If the ball is not paid out, it is confirmed whether or not the prize ball is being paid out (step S532). If the prize ball is being paid out, the process proceeds to the process in the prize ball shown in FIG. Whether or not a prize ball is being paid out is determined based on a state of a prize ball processing flag to be described later.
[0288]
If neither the lending ball payout nor the prize ball payout is found, the payout control CPU 371 checks whether or not there is a ball lending preparation request from the card unit 50 (step S533). Whether or not there is a ball lending preparation request is determined by confirming whether the BRDY signal input from the card unit 50 is on (requested) or off (no request).
[0289]
If there is no ball lending preparation request from the card unit 50, the payout control CPU 371 checks whether or not the number of award balls (the number of unpaid award balls) stored in the total number memory is 0 (step S534). . If the number of prize balls stored in the total number memory is not 0, the prize ball control CPU 371 turns on the award ball processing flag (step S535), and whether or not the value of the total number memory is 25 or more. Confirmation is made (step S536). The prize ball processing flag is set in the backup RAM area.
[0290]
If the number of prize balls stored in the total number memory is 25 or more, the payout control CPU 371 drives the payout motor 289 to rotate the payout motor 289 until paying out 25 game balls. Is set to output 25 (step S537). If the number of prize balls stored in the total number memory is not 25 or more, the payout control CPU 371 drives the payout motor 289 to rotate until all the game balls stored in the total number memory are paid out. In order to output the total number delivery operation (step S538). Next, the ball sorting member 311 below the ball dispensing device 97 is set to the prize ball side (step S539), and the dispensing motor 289 is turned on (step S540). Then, the process proceeds to a process during payout of prize balls in the prize ball control process shown in FIG.
[0291]
FIG. 49 is a flowchart showing an example of a process during a prize ball in the payout control process by the payout control CPU 371. In the processing during the winning ball, the payout control CPU 371 checks whether or not it is during the waiting time for winning ball passing (step S541). If it is not during the waiting time for passing the prize ball, the prize ball sensor (in this example, the payout motor position sensor) is checked (step S542), and a prize ball count switch check process described later is performed (step S543).
[0292]
Then, the payout control CPU 371 checks whether or not the driving of the payout motor 289 should be terminated (whether a predetermined number of payout operations of 25 or less than 25 has been finished) (step S544). Specifically, it is confirmed whether or not the rotation corresponding to the predetermined number of payouts has been completed. The rotation corresponding to the predetermined number of payouts is monitored by the output of the payout motor position sensor. When the rotation corresponding to the predetermined number of payouts is completed, the payout control CPU 371 stops driving the payout motor 289 (step S545), and sets the award ball passage waiting time (step S546). The award ball passing waiting time is a time from when the last payout ball is paid out by the payout motor 289 until it passes through the prize ball count switch 301A.
[0293]
In step S541, if it is during the prize ball passage waiting time, the payout control CPU 371 performs a prize ball count switch check process to be described later (step S547), and confirms whether or not the prize ball passage waiting time has ended. (Step S548). When the prize ball passing waiting time ends, all the prize balls set in step S537 or step S538 have been paid out. Therefore, the payout control CPU 371 turns off the prize ball processing flag (step S549). If the last payout ball does not pass the prize ball count switch 301A before the prize ball passage waiting time elapses, a prize ball path error is determined.
[0294]
In this embodiment, the ball lending is prioritized over the prize ball processing according to the determination in step S531, but the prize ball processing may be prioritized over the ball lending.
[0295]
FIG. 50 is a flowchart showing the prize ball count switch check process executed in steps S543 and S547. The prize ball count switch check process is a process of monitoring the state of the prize ball count switch 301A and subtracting the total number memory.
[0296]
In the prize ball count switch check process, the payout control CPU 371 first checks whether or not the prize ball count switch ON waiting flag is set (step S543a). If the prize ball count switch ON waiting flag is set, the process waits for the prize ball count switch ON flag to be turned on (step S543b). The prize ball count switch-on flag is set in step S751f in the switch processing shown in FIG. If the timer T12 times out before the prize ball count switch-on flag is turned on, a prize ball path error flag is set (steps S543f and S543g). When the prize ball count switch 301A is turned on, the timer T12 is stopped (step S543c), and the prize ball count switch ON waiting flag is reset (step S543d). The timer T12 is a timer for confirming whether or not the prize ball count switch 301A is turned on within a predetermined period.
[0297]
When the prize ball count switch 301A is turned on, in order to confirm that the prize ball count switch 301A is turned off, a prize ball count switch OFF waiting flag indicating that the prize ball count switch 301A is waiting is set (step S543e). .
[0298]
Accordingly, the payout control CPU 371 waits for the prize ball count switch on flag to turn off (step S543k) if the prize ball count switch off wait flag is on (step S543h). When the prize ball count switch on flag is turned off, the prize ball count switch OFF waiting flag is reset (step S543l). Then, the total number storage is decremented by 1 (step S543m).
[0299]
If it is confirmed in step S543h that the award ball count switch OFF waiting flag is not turned on, the timer T12 is started (step S543i), and the award ball count switch ON waiting flag is set (step S543j).
[0300]
The contents of the total number storage and the rental ball number storage are stored by the backup power source of the power supply board 910 for a predetermined period even if the power of the gaming machine is cut off. Therefore, when the power is restored during the predetermined period, the payout control CPU 371 can continue the payout process based on the contents of the total number memory and the lending ball number memory.
[0301]
The payout control CPU 371 manages the number of prize balls instructed from the main board 31 as a total number in the prize ball number storage, but may manage each prize ball number (for example, 15, 10, or 6). Good. For example, a number counter corresponding to the number of winning balls is provided, and when a payout number designation command is received, the number counter corresponding to the number designated by the command is incremented by one. When a prize ball payout corresponding to the number counter is performed, the number counter is decremented by 1 (in this case, a subtraction process is performed in the payout control process). Also in that case, each number counter is formed in the backup RAM area. Therefore, even if the power of the gaming machine is cut off, if the power recovers during a predetermined period, the payout control CPU 371 can continue the prize ball payout process based on the contents of each number counter.
[0302]
51 to 53 are flowcharts showing an example of non-maskable interrupt processing that is executed in response to a power-off signal from the power supply board 910. In this example, the power supply stop process is executed according to the NMI, but the power cut signal is connected to the maskable terminal of the payout control CPU 371 and the power supply stop process is executed by the maskable interrupt process. Also good. Alternatively, a power-off signal may be input to the input port and the power supply stop process may be executed according to the input port check result.
[0303]
In the non-maskable interrupt process, the payout control CPU 371 saves the AF register in a predetermined backup RAM area (step S801). Further, the interrupt flag is copied to the parity flag (step S802). The parity flag is formed in the backup RAM area. Also, the BC register, DE register, HL register, IX register, and stack pointer are saved in the backup RAM area (steps S804 to S808). When the power is restored, the register contents are restored based on the saved contents, and the interrupt permission / prohibition state is internally set according to the contents of the parity flag.
[0304]
Next, the drive signal output to the dispensing motor 289 is turned off (step S761). Accordingly, the driving of the ball dispensing device 97 is stopped. Thereafter, in this embodiment, the detection signals of the prize ball count switch 301A (corresponding to the prize game medium detection means) and the ball rental count switch 301B (corresponding to the rental game medium detection means) as the payout detection means are checked for a predetermined period. To do. Then, when the prize ball count switch 301A is turned on, the content of the total number memory is reduced by one. Further, when the ball lending count switch 301B is turned on, the content of the lending ball number storage is reduced by one.
[0305]
In this embodiment, a predetermined period measuring counter is used to measure the predetermined period. The value of the counter for measuring the predetermined period is decremented by 1 every time a switch detection processing loop (a loop starting from S763 and returning to S763) described below is executed once from the initial value m. It is assumed that the predetermined period has ended. Since there is an exception in the detection processing loop, almost constant processing is performed, and therefore, m times the time required for one round of the loop corresponds to a predetermined period.
[0306]
In order to measure the predetermined period, an internal timer of the payout control CPU 371 may be used. That is, a predetermined value (corresponding to a predetermined period) is set in the built-in timer at the start of the switch detection process. Each time the switch detection processing loop is executed once, the count value of the built-in timer is checked. When the count value reaches 0, it is assumed that the predetermined period has ended. An interrupt by the internal timer can be used to detect that the value of the internal timer has reached 0, but at this stage, the control content (such as each value stored in the RAM) should not be changed. A program configuration is preferred in which the count value of the built-in timer is read and checked instead of using a program. Further, the predetermined period is set to be equal to or longer than the time from when the game ball falls from the ball dispensing device 97 until it reaches the prize ball count switch 301A or the ball lending count switch 301B.
[0307]
At least during a predetermined period in which the switch detection process is executed, the prize ball count switch 301A and the ball lending count switch 301B must be in a state in which a game ball can be detected. Therefore, in this embodiment, as shown in FIG. 10, a capacitor 923 serving as a relatively large capacity auxiliary drive power source is connected to the input side of the converter IC 922 in the power supply substrate 910. Therefore, even when the power supply to the gaming machine is stopped, the + 12V power supply voltage is maintained in a range in which the switch can be driven for a certain period, and the winning ball count switch 301A and the ball lending count switch 301B can be operated. The capacitance of the capacitor is determined so that the period is equal to or longer than the predetermined period.
[0308]
Since the input port and the payout control CPU 371 are also driven by the + 5V power source created by the converter IC 922, they can operate for a relatively long period even when the power supply is stopped.
[0309]
Furthermore, in this embodiment, the sorting solenoid 310 is used to switch between the award ball path and the rental ball path. Therefore, the capacity of the capacitor 923 shown in FIG. 10 is such that the sorting solenoid 310 can be driven at least for the predetermined period. The capacitor 923 is connected in parallel with the power line of the VSL, but the game control means turns off the drive signal of other solenoids (for opening / closing the big prize opening etc.) according to the power-off signal. After the power-off signal is generated, the capacitor 923 only needs to drive only the sorting solenoid 310 among the solenoids.
[0310]
Note that the capacitor 923 used in this embodiment is an example of an auxiliary driving power supply, but another auxiliary driving power supply may be used. At least during the above-mentioned predetermined period, auxiliary driving of other modes is possible as long as it can drive the payout control means such as the prize ball count switch 301A, the ball lending count switch 301B, the sorting solenoid 310, and the CPU 371 for payout control. A power supply can be used.
[0311]
In the detection signal input process (switch detection process) from the payout detection means, the payout control CPU 371 first sets a value m corresponding to the predetermined period in the predetermined period measurement counter (step S762). Then, the payout control CPU 371 decrements the value of the predetermined period measurement counter by 1 (step S763), and confirms the value of the predetermined period measurement counter (step S764). If the value is 0, the switch detection process is terminated, and the process proceeds to a power supply stop process, which is a process for saving the control state.
[0312]
If the value of the counter for measuring the predetermined period is not 0, it is confirmed whether or not the prize ball count switch is on (step S765). If it is ON, the value of the detection period counter is decremented by 1 (step S766), and then it is confirmed whether or not the value of the detection period counter becomes 0 (step S767). If it is 0, the detection signal of the prize ball count switch 301A is confirmed via the input port (step S768), and if the on state is indicated, it is determined that the prize ball count switch 301A is surely turned on. The stored value is decreased by 1 (step S769).
[0313]
If it is confirmed in step S765 that the prize ball count switch is not on, the detection signal of the prize ball count switch 301A is confirmed via the input port (step S770). An intermediate flag is set (step S771), and an initial value n is set in the detection period counter (step S772).
[0314]
If the prize ball count switch 301A is turned on within the predetermined period by the above processing, the value of the total number storage is decremented by one. Since the process for saving the contents of the backup RAM is performed after such a switch detection process, the total number storage is always reduced by -1 for a prize ball that has been paid out. Therefore, it is possible to prevent a contradiction in the stored control state with respect to the game ball payout. In the above switch detection process, a timer process using a detection period counter is performed. That is, once the award ball count switch 301A is detected to be on, the switch is not considered to be on unless a predetermined time (n times the processing time in the loop from S763 to S767 and back to S763) has elapsed. . Therefore, erroneous switch-on detection is prevented.
[0315]
Note that a timer process for preventing erroneous detection is also performed in the normal switch process (step S751 in FIG. 38). Therefore, such normal switch processing may be called. Here, the timer process using the counter for the detection period is performed, but the timer in the switch detection process using the CPU built-in timer is the same as in the case of measuring the predetermined period. Processing may be realized.
[0316]
When the winning ball count switch is not on and the ON state of the winning ball count switch 301A cannot be detected, a switch detection process is performed for the ball lending count switch 301B. That is, the payout control CPU 371 checks whether or not the ball lending count switch is on (step S775). If it is ON, the value of the detection period counter is decremented by 1 (step S776), and then it is confirmed whether or not the value of the detection period counter is 0 (step S777). If it is 0, the detection signal of the ball lending count switch 301B is confirmed via the input port (step S778), and if the on state is indicated, it is determined that the ball lending count switch 301B has been turned on, and the lending ball The number storage value is decreased by 1 (step S779).
[0317]
If it is confirmed in step S775 that the ball lending count switch is not on, the detection signal of the ball lending count switch 301B is confirmed via the input port (step S780). If the on-state is indicated, the ball lending count switch is turned on. An intermediate flag is set (step S781), and an initial value n is set in the detection period counter (step S782).
[0318]
If the ball lending count switch 301B is turned on within the predetermined period by the above processing, the value of the lending ball number storage is decremented by 1. Since the processing for saving the contents of the backup RAM is performed after such switch detection processing, the lending ball number storage is always decremented by 1 for the lending balls that have been paid out. Therefore, it is possible to prevent a contradiction in the stored control state with respect to the game ball payout. In the above switch detection process, a timer process using a detection period counter is performed. That is, if the ball lending count switch 301B is not turned on for a predetermined time or more, it is not considered to be switched on. Therefore, erroneous switch-on detection is prevented.
[0319]
When the predetermined period has elapsed (step S764), the payout control CPU 371 stores the backup specified value ("55H" in this example) in the backup flag (step S809). The backup flag is formed in the backup RAM area. Next, processing similar to that of the CPU 56 of the main board 31 is performed to create parity data and store it in the backup RAM area (steps S810 to S819). Then, an access prohibition value is set in the RAM access register (step S820). Thereafter, the built-in RAM cannot be accessed.
[0320]
In this embodiment, all RAM areas in which data used in the payout control process are stored are backed up. Therefore, the checksum generation process indicating whether or not the contents are correctly stored and the RAM access prevention process for preventing the contents from being rewritten correspond to the process for storing the payout control state.
[0321]
As described above, in this embodiment, when a power-off signal is output in response to the occurrence of a power failure or the like, first, the driving of the ball payout device 97 is stopped, and then the detection signal from the payout detection means is output for a predetermined period. Input processing is executed, and thereafter processing for saving the payout control state is performed. Therefore, the game ball that was being paid out when the power failure occurred is also reflected in the saved contents of the backup RAM.
[0322]
In other words, in this embodiment, when the control state is stored in the backup storage means when the power supply to the gaming machine is stopped, it is possible to prevent a control contradiction or the like from occurring.
[0323]
When the RAM access prevention process is completed, the payout control CPU 371 enters a standby state (loop state). Therefore, nothing is done until the system is reset.
[0324]
Here, a timer (detection period counter) is set when the detection signal of the winning ball count switch 301A or the ball lending count switch 301B indicates an on state, and the detection signal remains on when the timer expires. If it is shown, it is determined that the switch has been reliably turned on. However, like the CPU 56 of the main board 31, the detection signal is determined every time the 2 ms timer (2 ms measurement counter) is up. Also good.
[0325]
Also in this embodiment, the register saving process was performed at the beginning of the process activated in response to the power-off signal, but when the register is not used in the switch detection process, after executing the switch detection process, That is, the register saving process can be performed before the backup flag setting and the checksum calculation process. In that case, the register saving process, the backup flag setting process, and the checksum calculation process can be regarded as a power supply stop process. Further, even when several registers are used in the switch detection process, the register storage process can be performed before the backup flag setting process and the checksum calculation process for the unused registers.
[0326]
In this embodiment, the total number of unpaid prize balls and lending balls is stored, but other storage methods such as storing the number of payouts (for example, 25 per time) are used. However, when the detection signal input process from the payout detection means is executed for a predetermined period in response to the power-off signal, it is possible to prevent inconsistencies in the stored control state. Is done.
[0327]
As described above, in each of the above embodiments, when a power-off signal is output in response to the occurrence of a power failure or the like, first, after the driving of the dispensing device is stopped, detection from the dispensing detection means for a predetermined period. A signal input process is executed, and thereafter, a process for storing a payout control state including the total number of unpaid prize balls and lending balls is performed. Therefore, the game ball that was being paid out when the power failure occurred is also reflected in the saved contents of the backup RAM. Therefore, in a case where the control state is stored in the backup storage means when the power supply to the gaming machine is stopped, it is possible to prevent inconsistencies between the stored control state and the actual control state. it can.
[0328]
Although the stored control state matches the actual control state, it is preferable to restore the control state as it is when, for example, a player who is different from the player who played the game before turning off the power plays a game. Absent. In each of the above-described embodiments, it is determined whether or not the game state at the time of power-off is restored according to the operation state of the clear switch 921. At this time, if the clear switch 921 is in the on state, the game Since the state recovery process is not executed and the normal initialization process is executed, the game store clerk or the like operates the clear switch 921 when the power supply of the gaming machine is resumed, so that the backup data storage area (variable data) It is possible to select whether or not to execute the game state restoration process based on the backup data stored in the storage means). In this way, not only does it not cause a discrepancy between the actual control state and the control state such as the total number of unpaid prize balls and rental balls to be saved, for example, when the game is resumed, for example, unpaid It is possible to clear the control state such as the total number of prize balls and rental balls, and it is possible to improve the convenience of game machine operation at a game store.
[0329]
In the above-described embodiment, the operation of the ball payout device is stopped at the start of an interrupt process by an interrupt generated in response to a power-off signal (in the above-described example, the non-maskable interrupt process), and the payout detecting means is used for a predetermined period. The detection signal input processing from was performed. However, when power supply to the gaming machine is stopped, a first signal indicating that may be generated first, and a second signal may be generated when the voltage further decreases. Then, the operation of the ball dispensing device is stopped according to the first signal, the detection signal is input from the dispensing detection means, and the control state is stored in the backup RAM according to the second signal. You may go.
[0330]
FIG. 54 is a block diagram showing a configuration example of the power supply board 910A for performing such control. In this example, a power supply monitoring IC 932 is also mounted on the power supply board 910A. The power supply monitoring IC 932 detects the occurrence of power interruption by introducing the VSL power supply voltage and monitoring the VSL power supply voltage. Specifically, when the VSL power supply voltage becomes equal to or lower than a predetermined value (for example, +24 V), a voltage lowering signal (first signal) is output assuming that the power supply voltage has decreased. Then, when the VSL power supply voltage becomes equal to or lower than a predetermined value (+22 V in this example), the power monitoring IC 902 outputs a power-off signal (second signal) as a power-off occurs.
[0331]
The period from when the first signal is generated to when the second signal is generated is from the time when the game ball falls from the ball payout device 97 (or the prize ball payout device 97A or the lending ball payout device 97C). It is set to be equal to or longer than the time required to reach the prize ball count switch 301A or the ball lending count switch 301B. That is, the monitoring voltage of the power monitoring ICs 902 and 932 is set so as to be longer than that time. The output of the power monitoring IC 932 reaches the main board 31 and the payout control board 37 via the buffer circuits 939 and 940.
[0332]
In the main board 31, the voltage drop signal as the first signal is connected to the maskable external interrupt terminal of the CPU 56. Further, the power-off signal as the second signal is connected to the non-maskable interrupt terminal as in the above-described embodiment. That is, the priority of the interrupt based on the second signal is higher than the priority of the interrupt based on the first signal.
[0333]
54 and 55 are flowcharts showing an example of an interrupt process (voltage drop interrupt process) that is started based on an interrupt that occurs in response to the generation of the first signal. The CPU 56 of the main board 31 saves the AF register (accumulator and flag register) in a predetermined backup RAM area (step S451). Further, the interrupt flag is copied to the parity flag (step S452). The parity flag is formed in the backup RAM area. Also, the BC register, DE register, HL register, IX register, and stack pointer are saved in the backup RAM area (steps S454 to S458).
[0334]
Next, the CPU 56 sets an initial value n corresponding to a time of 2 ms in the 2 ms measurement counter (step S461). Then, the value of the 2 ms measurement counter is decremented by -1 (step S465) until the value of the 2 ms measurement counter becomes 0 (step S462). When the value of the 2 ms measurement counter becomes 0, the data input to the input port 1 is input (step S464). Next, clear data (00) is set (step S465). Further, the input data from the input port 1 is set as a “comparison value” (step S466). Further, the address of the switch timer for the prize ball count switch 301A is set in the pointer (step S467).
[0335]
Then, the switch timer indicated by the pointer (the address of the switch timer is set) is loaded (step S468), and the comparison value is shifted to the right (from the upper bit to the lower bit) (step S469). Data of the input port 1 is set as the comparison value. In this case, the detection signal of the winning ball count switch 301A is pushed out to the carry flag.
[0336]
If the value of the carry flag is “1” (step S470), that is, if the detection signal of the prize ball count switch 301A is ON, the value of the switch timer is incremented by 1 (step S471). If the value of the carry flag is “0”, that is, if the detection signal of the prize ball count switch 301A is OFF, clear data is set in the switch timer (step S472). That is, if the switch is off, the value of the switch timer returns to zero.
[0337]
When the value of the switch timer becomes 2 (step S473), 1 is subtracted from the value stored in the total prize ball number storage buffer (step S474), and the value of the prize ball information counter is incremented by 1 (step S475). . If the value of the prize ball information counter is 10 or more (step S476), the value of the prize ball information output counter is incremented by 1 (step S477), and the value of the prize ball information counter is incremented by -10 (step S478). Then, the process returns to step S461.
[0338]
Since the power supply voltage is lowered during the switch detection processing in steps S461 to S478, the second signal should be generated. Therefore, an unmaskable interrupt occurs. FIG. 57 is a flowchart illustrating an example of a non-maskable interrupt.
[0339]
In the non-maskable interrupt process, the CPU 56 stores the backup specified value (“55H” in this example) in the backup flag (step S481). The backup flag is formed in the backup RAM area. Next, parity data is created (steps S482 to S491).
[0340]
Then, after prohibiting RAM access (step S492), all output ports are turned off (steps S493 to S499). When the clear process for the output port is completed, the CPU 56 enters a standby state (loop state). Therefore, nothing is done until the system is reset.
[0341]
With the above processing, when the prize ball count switch 301A is turned on within a predetermined period (a period from the first signal generation to the second signal generation), the value of the total prize ball number buffer is decremented by one. Since the processing for saving the contents of the backup RAM is performed after such switch detection processing, the total winning ball number buffer is always set to -1 for the winning ball that has been paid out. Therefore, it is possible to prevent a contradiction in the stored control state with respect to the game ball payout. As already described, the input check process may be performed for detection signals of other detection means (switches) other than the payout detection means in a predetermined period.
[0342]
Further, the output port clearing process may be performed before the switch detection process (after step S458) in the voltage drop interruption process shown in FIGS.
[0343]
In this embodiment, the register saving process is performed at the beginning of the process activated in response to the voltage drop signal (first signal). However, when the register is not used in the switch detection process, The register saving process can be performed after the detection process is executed, that is, in the process activated in response to the second signal. In this case, the register saving process, the backup flag setting process, the checksum calculation process, and the output port off setting process can be regarded as a power supply stop process. Furthermore, even when some registers are used in the switch detection process, the register storage process can be performed in the process activated in response to the second signal for the unused registers.
[0344]
FIG. 58 is a timing chart showing an example of how detection signal input processing from the payout detection means is executed. As shown in FIG. 58, when the ball payout is executed around the time when the voltage drop signal is turned on (changed from the high level to the low level in this example), the detection signal input processing from the payout detecting means is executed. Within the period (period before the second signal is generated), the prize ball count switch 301A is turned on. Therefore, the ball payout executed when the voltage drop signal is turned on can also be reflected in the total winning ball number buffer.
[0345]
Also in the payout control board 37, the voltage drop signal as the first signal is connected to the maskable external interrupt terminal of the payout control CPU 371. Further, the power-off signal as the second signal is connected to the non-maskable interrupt terminal as in the above-described embodiment. That is, the priority of the interrupt based on the second signal is higher than the priority of the interrupt based on the first signal.
[0346]
FIG. 59 is a flowchart illustrating an example of an interrupt process (voltage drop interrupt process) that is started based on an interrupt that occurs in response to the generation of the first signal. The payout control CPU 371 first saves the AF register in a predetermined backup RAM area (step S801). Further, the interrupt flag is copied to the parity flag (step S802). The parity flag is formed in the backup RAM area. Also, the BC register, DE register, HL register, IX register, and stack pointer are saved in the backup RAM area (steps S804 to S808).
[0347]
Next, the drive signal output to the dispensing motor 289 is turned off (step S761). Accordingly, the driving of the ball dispensing device 97 is stopped. When the prize ball payout device 97A and the lending ball payout device 97C are provided separately, the drive of both is stopped.
[0348]
Then, it is confirmed whether or not the prize ball count switch is on (step S765). If it is ON, the value of the detection period counter is decremented by 1 (step S766), and then it is confirmed whether or not the value of the detection period counter becomes 0 (step S767). If it is 0, the detection signal of the prize ball count switch 301A is confirmed via the input port (step S768), and if the on state is indicated, it is determined that the prize ball count switch 301A is surely turned on. The stored value is decreased by 1 (step S769).
[0349]
If it is confirmed in step S765 that the prize ball count switch is not on, the detection signal of the prize ball count switch 301A is confirmed via the input port (step S770). An intermediate flag is set (step S771), and an initial value n is set in the detection period counter (step S772).
[0350]
If the prize ball count switch 301A is turned on within the predetermined period by the above processing, the value of the total number storage is decremented by one. Since the process for saving the contents of the backup RAM is performed after such a switch detection process, the total number storage is always reduced by -1 for a prize ball that has been paid out. Therefore, it is possible to prevent a contradiction in the stored control state with respect to the game ball payout. In the above processing, timer processing using a detection period counter is performed. That is, once the award ball count switch 301A is detected to be on, the switch is not considered to be on unless a predetermined time (n times the processing time in the loop from S763 to S767 and back to S763) has elapsed. . Therefore, erroneous switch-on detection is prevented.
[0351]
When the winning ball count switch is not on and the ON state of the winning ball count switch 301A cannot be detected, a switch detection process is performed for the ball lending count switch 301B. Note that the processing is the same as that in the embodiment already described (see FIG. 52). Since the power supply voltage decreases while the switch detection processing is being performed for the winning ball count switch 301A and the ball lending count switch 301B, the second signal should be generated. Therefore, an unmaskable interrupt occurs.
[0352]
Even in this embodiment, at least until the second signal is generated, the portion for performing the switch detection processing of the winning ball count switch 301A, the ball lending count switch 301B and the sorting solenoid 310 and the payout control means can be driven. An auxiliary drive power source (capacitor 923 in this example) is used.
[0353]
Also, here, when the detection signal of the winning ball count switch 301A or the ball lending count switch 301B indicates the on state, a timer (detection period counter) is set, and the detection signal is also in the on state when the timer times out. If it is shown, it is determined that the switch has been reliably turned on. However, like the CPU 56 of the main board 31, the detection signal is determined every time the 2 ms timer (2 ms measurement counter) is up. Also good.
[0354]
The output port clear process may be performed before the switch detection process (after step S808) in the voltage drop interrupt process shown in FIG.
[0355]
FIG. 60 is a flowchart illustrating an example of a non-maskable interrupt. In the non-maskable interrupt process, the payout control CPU 371 first stores the backup specified value (“55H” in this example) in the backup flag (step S809). The backup flag is formed in the backup RAM area. Next, processing similar to that of the CPU 56 of the main board 31 is performed to create parity data and store it in the backup RAM area (steps S810 to S819). Then, an access prohibition value is set in the RAM access register (step S820). Thereafter, the built-in RAM cannot be accessed.
[0356]
Further, the payout control CPU 371 sets clear data (00) in an appropriate register (step S821), and sets the number of processes (in this example, “3”) in another register (step S822). Further, the address of the output port C (“00H” in this example) is set in the IO pointer (step S823). Another register is used as the IO pointer.
[0357]
Then, clear data is set at the address pointed to by the IO pointer (step S824), the value of the IO pointer is incremented by 1 (step S825), and the value of the processing number is subtracted by 1 (step S827). The processes in steps S824 to S826 are repeated until the value of the number of processes becomes zero. As a result, clear data is set in all the output ports C to E (see FIG. 36).
[0358]
When the clear process for the output port is completed, the payout control CPU 371 enters a standby state (loop state). Therefore, nothing is done until the system is reset.
[0359]
In this embodiment, power supply monitoring means (power monitoring ICs 902 and 932 in this example) mounted on the power supply board 910A monitors the power supply, and the first condition (in this example, the + 30V power supply voltage is + 24V or less). ) Is output, the second signal is output when the second condition (in this example, the +30 V power supply voltage becomes +22 V or less) is satisfied. The period from when the first signal is generated to when the second signal is generated is set to be longer than the time until the game ball paid out from the payout means reaches the payout detection means. The conditions of + 22V and + 24V used in this embodiment are merely examples, and may be different values depending on the type of gaming machine.
[0360]
In the process according to the first signal, first, after the driving of the payout device is stopped, the input process of the detection signal from the payout detecting means is repeatedly executed, and then the payout control state according to the second signal. Processing for saving is performed. Therefore, the game ball that was being paid out when the power failure occurred is also detected by the process according to the first signal, and is therefore reflected in the stored contents of the backup RAM in the process according to the second signal. Therefore, in a case where the control state is stored in the backup storage means when the power supply to the gaming machine is stopped, it is possible to prevent inconsistencies between the stored control state and the actual control state. it can.
[0361]
When the ball payout is executed around the time when the voltage drop signal is turned on (in this example, the change from the high level to the low level), the detection signal input process from the payout detection means is executed for a predetermined period (the second signal is Within the period before the occurrence), the prize ball count switch 301A or the ball lending count switch 301B is turned on. In this embodiment, the switch input process is executed in the voltage drop interrupt process (see FIG. 59) activated in response to the generation of the first signal. Therefore, the switch input process is executed when the voltage drop signal is turned on. The ball payout can also be reflected in the total number memory or the lending ball number memory.
[0362]
In this embodiment, the register saving process is performed at the beginning of the process activated in response to the voltage drop signal (first signal). However, when the register is not used in the switch detection process, The register saving process can be performed after the detection process is executed, that is, in the process activated in response to the second signal. In this case, the register saving process, the backup flag setting process, the checksum calculation process, and the output port off setting process can be regarded as a power supply stop process. Furthermore, even when some registers are used in the switch detection process, the register storage process can be performed in the process activated in response to the second signal for the unused registers.
[0363]
Further, in each of the above embodiments, the case where the game control means and the payout control means perform the switch detection process in response to the power-off signal is exemplified, but the display control means, the sound control means, and the lamp control means are also controlled. When state saving processing is performed, in response to the power-off signal, the driving of a predetermined electrical component is stopped, and the control signal is saved after the detection signal of the switch means related to the electrical component is confirmed over a predetermined period. You may comprise so that a process may be performed.
[0364]
In each of the above embodiments, the clear switch 921 has a push button structure, but other structures may be used. FIG. 61 is an external configuration diagram showing an example of the configuration of the clear switch 921 according to another embodiment mounted on the switch board 190. The clear switch 921 shown in FIG. 61 has a switching operation switch 921a for selecting and switching between “OFF”, “ON”, and “clear”. In this example, when “OFF” of the clear switch 921 is selected, no signal is generated and the operation is stopped, and when “ON” is selected, a high level signal is output. To do. In this example, the clear switch 921 is configured in conjunction with a switch for switching on / off the power supply to the gaming machine 1. Therefore, when “OFF” is selected with the clear switch 921, the power supply of the gaming machine 1 is stopped (the gaming machine is turned off), and “ON” and “Clear” are selected. When the game machine 1 is in operation, the game machine 1 may be in an operating state (a power supply of the game machine is on). Further, when “clear” of the clear switch 921 is selected, a low-level clear signal may be output.
[0365]
Note that, as described in each of the above-described embodiments, the contents of the rental ball number storage are stored by the backup power source of the power supply board 910 for a predetermined period even when the gaming machine is turned off, and the power is turned on during the predetermined period. When recovered, the payout control CPU 371 can continue the ball lending process based on the contents of the lending ball number storage. When such processing is performed, various signals (BRDY signal, BRQ signal, EXS signal, and PRDY signal) exchanged between the card unit 50 and the payout control board 37 via the input port 372b and the output port 372e. ) Will be described.
[0366]
FIG. 62 is a timing chart showing an example of the state of each signal when a payout process for paying out an unpaid number of rental balls is executed based on the contents of the rental ball number storage when the power supply is restored. It is. FIG. 62 also shows an example of each signal state until the supply of power is stopped.
[0367]
As shown in FIG. 62, when the power of the pachinko gaming machine 1 is turned on, the payout control CPU 371 of the payout control board 37 outputs the PRDY signal to the card unit 50, so the PRDY signal is turned on. Next, when the card is received in the card unit 50, the ball lending switch is operated and a ball lending switch signal is input, the card unit control microcomputer outputs a BRDY signal to the payout control board 37, so that the BRDY signal is turned on. It becomes. When a predetermined delay time elapses from this point, the card unit control microcomputer outputs a BRQ signal to the payout control board 37, so that the BRQ signal is turned on.
[0368]
Then, the payout control CPU 371 of the payout control board 37 raises the EXS signal to the card unit 50, and when detecting the fall of the BRQ signal from the card unit 50, drives the payout motor 289 to draw a predetermined number of rental balls. Pay to the player. When the payout is completed, the payout control CPU 371 causes the EXS signal to the card unit 50 to fall. However, if the power interruption occurs before the payout is completed, the gaming machine waits for the supply of power to be started in a state where the contents of the rented ball number memory are stored by the backup power source of the power supply board 910 for a predetermined period.
[0369]
When the supply of power is started with the contents of the rented ball number stored, the payout control CPU 371 outputs a PRDY signal to the card unit 50, so the PRDY signal is turned on. Then, the payout control CPU 371 raises the EXS signal to the card unit 50 and pays out the lending balls for the number of unpaid out, although it does not receive the BRDY signal and the BRQ signal. At this time, the card unit 50 side temporarily enters an error state. When an unpaid lending ball payout process is being executed, each signal is raised or lowered as described above.
[0370]
In each of the above embodiments, the power supply monitoring circuit is provided on the power supply board 910. However, the power supply monitoring circuit may be provided on an electrical component control board such as the main board 31 or the payout control board 37. When an electrical component control board on which a power supply circuit is mounted is configured, a power supply monitoring circuit is not mounted on the power supply board.
[0371]
The pachinko gaming machine 1 according to each of the above-described embodiments mainly provides a player with a predetermined game value when a stop symbol of a special symbol variably displayed on the variable display unit 9 based on a start winning combination is a combination of a predetermined symbol. The first type pachinko gaming machine that can be granted, the second type pachinko that can be given a predetermined game value to the player if there is a winning in a predetermined area of the electric game that is released based on the start winning A third-class pachinko machine where a predetermined right is generated or continued when there is a prize for a predetermined electric combination that is released when a stop symbol of a symbol that is variably displayed based on a starting prize is a combination of a predetermined pattern The present invention can be applied even to a gaming machine.
[0372]
Furthermore, the present invention can be applied to a slot machine or the like provided with an electrical component for paying out the game medium, not limited to a pachinko game machine in which the game medium is a game ball.
[0373]
【The invention's effect】
  As described above, according to the present invention, the fluctuation data stored in the fluctuation data storage unit for payout control specifies the number of payouts that have not been paid out of the number of game media payouts based on the lending request. The payout control microcomputer can restart the payout control of the game medium based on the data that can specify the number of unpaid numbers held by the memory content holding means when the power supply is resumed. In addition, when the initialization operation unit is in a predetermined operation state, the final stored content held by the stored content holding unit can be initialized. However, the number of unpaid rental game media can be backed up, and an appropriate control state can be saved. Further, it is possible to prevent the stored control state from being restored based on the judgment of the game store clerk or the like.Further, the game control microcomputer and the payout control microcomputer determine whether or not an operation signal from the initialization operation means is input, and determine a detection output from the game medium detection means for detecting a game medium. When determining with a request detection determination period shorter than the game medium detection determination period, the process for determining the operation state of the initialization operation means and the process for determining the presence of a game medium can be made different. It is easy to set the ON determination period to an appropriate period.
[0375]
  Dispensing controlMicrocomputerIs provided with an input port for acquiring predetermined data, and an initialization signal output when the initialization operation means is in a predetermined operation state is input to the input port. It is possible to introduce an initialization signal output according to the operation state of the operation of the initialization operation means with a simple configuration using the input port.
[0376]
  PayWhen the output control microcomputer executes the detection output input processing from the game medium detection means for a predetermined period when the power supply monitoring means outputs a detection signal, and then performs the payout control power supply stop processing. The game media to be detected can be detected, and an appropriate control state relating to the number of game media can be backed up and stored.
[0377]
  Dispensing controlMicrocomputerButA drive signal is output to the rental game medium payout mechanism through the output port,Power supply monitoring meansWhen a detection signal is outputIn addition,Output portTheOffAfter detecting from the game medium detection meansoutputIn the state where the game medium is not newly paid out by the rented game medium payout mechanism unit, the game medium can be detected. An appropriate control state can be backed up and stored.
[0378]
  Power supply monitoring meansOutputs a detection signalAfterWith a microcomputer for payout controlDetection from game medium detection meansoutputDischarge control during execution of input processingMicrocomputerAnd the auxiliary drive power supply means capable of supplying power that can drive the game medium detection means, the detection signal input process from the game medium detection means can be completed with certainty. It is possible to perform a game medium detection process.
[0380]
  Dispensing controlMicrocomputerControlled byWinningAccording toTheA prize game medium payout mechanism for paying out game media;For payout controlFluctuating data storage meansRememberedFluctuation dataIs,WinningAccording toPaid outOf the number of game media payoutsBy award game media payout mechanismIf data that can identify the number of unpaid items that have not been paid out is included, not only the number of unpaid game media that are paid out in response to a lending request, but also the number of game media that are paid out as the game progresses It is possible to properly back up the number of unpaid items.
[0381]
When the award game medium detecting means and the rented game medium detecting means are separately provided as the game medium detecting means, the game medium to be paid out in response to the lending request and the game to be paid out as the game progresses The detection of the medium can be performed separately.
[Brief description of the drawings]
FIG. 1 is a front view of a pachinko gaming machine as viewed from the front.
FIG. 2 is an explanatory view showing each board provided on the back surface of the pachinko gaming machine.
FIG. 3 is a rear view of the mechanism board of the pachinko gaming machine as viewed from the back.
FIG. 4 is a front view showing a configuration around an intermediate base unit installed on a mechanism plate.
FIG. 5 is an exploded perspective view showing a ball dispensing device.
FIG. 6 is a front view showing an example of a game board on which a switch board is mounted as seen from the front.
FIG. 7 is a circuit diagram illustrating an example of a configuration of a clear switch.
FIG. 8 is a block diagram showing a circuit configuration of a game control board (main board).
FIG. 9 is a block diagram showing components related to a prize ball, such as components of a payout control board and a ball payout device.
FIG. 10 is a block diagram illustrating a configuration example of a power supply board.
FIG. 11 is a block diagram illustrating an example of a configuration around a CPU in a main board.
FIG. 12 is an explanatory diagram illustrating an example of bit assignment of an input port.
FIG. 13 is a flowchart showing main processing executed by the CPU on the main board.
FIG. 14 is an explanatory diagram showing an example of a relationship between a backup flag and whether or not to execute a game state recovery process.
FIG. 15 is a flowchart showing a 2 ms timer interrupt process.
FIG. 16 is an explanatory diagram showing an example of forming a switch timer in a RAM.
FIG. 17 is a flowchart illustrating an example of switch processing.
FIG. 18 is a flowchart illustrating an example of a switch check process.
FIG. 19 is a flowchart showing an example of a prize ball process.
FIG. 20 is a flowchart showing an example of a prize ball process.
FIG. 21 is a flowchart showing an example of a prize ball process.
FIG. 22 is a flowchart showing a switch-on check process.
FIG. 23 is a flowchart illustrating an example of a winning ball number subtraction process.
FIG. 24 is an explanatory diagram of a configuration example of an input determination value table.
FIG. 25 is an explanatory diagram showing an example of a command form of a control command.
FIG. 26 is a timing chart showing a relationship between an 8-bit control signal and an INT signal constituting a control command.
FIG. 27 is an explanatory diagram showing an example of the contents of a payout control command.
FIG. 28 is an explanatory diagram of a configuration example of a command transmission table.
FIG. 29 is a flowchart showing a non-maskable interrupt process in the game control means.
FIG. 30 is a flowchart showing a non-maskable interrupt process in the game control means.
FIG. 31 is a flowchart showing a non-maskable interrupt process in the game control means.
FIG. 32 is a timing diagram illustrating an example of how detection signal input processing is performed;
FIG. 33 is an explanatory diagram showing an example of a game area of the third type pachinko gaming machine.
FIG. 34 is a flowchart showing an example of a game state restoration process.
FIG. 35 is a block diagram showing a configuration example around a payout control CPU for power supply monitoring and power supply backup.
FIG. 36 is an explanatory diagram illustrating an example of bit assignment of an output port.
FIG. 37 is an explanatory diagram showing an example of bit assignment of an input port.
FIG. 38 is a flowchart showing main processing executed by the CPU in the payout control board.
FIG. 39 is a flowchart showing a 2 ms timer interrupt process.
FIG. 40 is an explanatory diagram showing a configuration example of a RAM in the payout control unit.
FIG. 41 is an explanatory diagram illustrating a configuration example of a reception buffer.
FIG. 42 is a flowchart illustrating an example of command reception processing of a payout control CPU.
FIG. 43 is a flowchart illustrating an example of command analysis execution processing.
FIG. 44 is a flowchart showing an example of a payout stop state setting process.
FIG. 45 is a flowchart illustrating an example of switch processing.
FIG. 46 is a flowchart showing an example of a ball lending control process.
FIG. 47 is a flowchart showing an example of a ball lending count switch check process.
FIG. 48 is a flowchart showing an example of a prize ball control process.
FIG. 49 is a flowchart showing an example of a prize ball control process.
FIG. 50 is a flowchart illustrating an example of a prize ball count switch check process.
FIG. 51 is a flowchart showing a non-maskable interrupt process in the payout control means.
FIG. 52 is a flowchart showing a non-maskable interrupt process in the payout control means.
FIG. 53 is a flowchart showing a non-maskable interrupt process in the payout control means.
FIG. 54 is a block diagram showing another configuration example of the power supply board.
FIG. 55 is a flowchart showing a voltage drop interrupt process of the game control means.
FIG. 56 is a flowchart showing a voltage drop interrupt process of the game control means.
FIG. 57 is a flowchart showing another example of non-maskable interrupt processing by the game control means.
FIG. 58 is a timing diagram illustrating an example of how detection signal input processing is performed;
FIG. 59 is a flowchart showing a voltage drop interruption process of the payout control means.
FIG. 60 is a flowchart showing another example of non-maskable interrupt processing by the payout control means.
FIG. 61 is an explanatory diagram illustrating an example of an external configuration of a clear switch according to another embodiment.
FIG. 62 is a timing chart showing an example of a state of each signal when a payout process for a lending ball with the number of unpaid is executed.
[Explanation of symbols]
31 Game control board (main board)
37 Dispensing control board
54 ROM
55 RAM
56 CPU
97 Ball dispenser
301A Prize ball count switch
301B Rental ball count switch
371 CPU for payout control
921 Clear switch

Claims (12)

遊技者が所定の遊技を行うことが可能な遊技機であって、
制御を行う際に発生する変動データを記憶する遊技制御用変動データ記憶手段を有し、遊技の進行を制御する遊技制御用マイクロコンピュータと、
制御を行う際に発生する変動データを記憶する払出制御用変動データ記憶手段を有し、遊技媒体の払出の制御を行う払出制御用マイクロコンピュータと、
前記払出制御用マイクロコンピュータによって制御され、貸出要求に応じた遊技媒体の払出を行う貸出遊技媒体払出機構部と、
遊技機への電力供給が停止していても前記遊技制御用変動データ記憶手段および前記払出制御用変動データ記憶手段の記憶内容を所定期間保持させることが可能な記憶内容保持手段と、
遊技機で使用される所定の電源の状態を監視して電源断の発生を検出したときに検出信号を出力する電源監視手段と、
操作に応じて操作信号を出力する初期化操作手段とを含み、
前記遊技制御用マイクロコンピュータは、
前記検出信号の入力に応じて、バックアップフラグを前記遊技制御用変動データ記憶手段に設定し、かつ、前記遊技制御用変動データ記憶手段へのアクセスを禁止する遊技制御用電力供給停止時処理を行う遊技制御用電力供給停止時処理手段を含み、
電力供給が開始されたときに、前記初期化操作手段からの操作信号が入力されていないときには、前記遊技制御用変動データ記憶手段に前記バックアップフラグが設定されていることを条件に前記遊技制御用変動データ記憶手段に保存されていた記憶内容にもとづいて制御状態を前記遊技制御用電力供給停止時処理を開始したときの状態に復旧させる遊技制御用状態復帰制御を行い、
電力供給が開始されたときに、前記遊技制御用変動データ記憶手段に前記バックアップフラグが設定されていても初期化操作手段からの操作信号が入力されていれば前記遊技制御用変動データ記憶手段の記憶内容を初期化する処理を行い、
前記遊技制御用マイクロコンピュータが前記遊技制御用電力供給停止時処理を完了した後に、前記遊技制御用マイクロコンピュータを動作停止状態とするための信号を出力するリセット手段を備え、
前記払出制御用変動データ記憶手段に記憶される前記変動データには、貸出要求にもとづいた遊技媒体の払出数のうち払出しが完了していない未払出数を特定可能なデータが含まれており、
前記払出制御用マイクロコンピュータは、
前記検出信号の入力に応じて、前記未払出数を特定可能なデータを含む制御状態を前記払出制御用変動データ記憶手段に保存させるための処理である払出制御用電力供給停止時処理を行う払出制御用電力供給停止時処理手段と、
前記初期化操作手段からの操作信号が入力されているか否かを確認する操作信号確認処理を行う操作信号確認処理手段とを含み、
前記操作信号確認処理手段により前記初期化操作手段からの前記操作信号が入力されていることが確認されなかったことを条件に、前記未払出数を特定可能なデータが前記払出制御用変動データ記憶手段に保存されているときに該未払出数を特定可能なデータにもとづいて遊技媒体の払出制御を再開し、
前記操作信号確認処理手段により前記初期化操作手段からの前記操作信号が入力されていることが確認されたときには、前記払出制御用変動データ記憶手段に記憶内容が保存されていても、該払出制御用変動データ記憶手段の記憶内容を初期化する処理を行い、
前記遊技制御用マイクロコンピュータおよび前記払出制御用マイクロコンピュータは、前記初期化操作手段からの操作信号が入力されているか否かを、遊技媒体を検出するための遊技媒体検出手段からの検出出力を判定する遊技媒体検出判定期間よりも短い要求検出判定期間で判定する
ことを特徴とする遊技機。A gaming machine in which a player can play a predetermined game,
A game control microcomputer for controlling the progress of the game, having a game control change data storage means for storing change data generated when the control is performed;
A payout control microcomputer for controlling payout of game media, having payout control variable data storage means for storing variable data generated when performing control;
A lending game medium payout mechanism controlled by the payout control microcomputer and paying out game media in response to a lending request;
Storage content holding means capable of holding the storage contents of the game control variation data storage means and the payout control variation data storage means for a predetermined period even when power supply to the gaming machine is stopped;
Power monitoring means for outputting a detection signal when the occurrence of power interruption is detected by monitoring the state of a predetermined power source used in the gaming machine;
Initialization operation means for outputting an operation signal according to the operation,
The game control microcomputer is:
In response to the input of the detection signal, a backup flag is set in the game control variation data storage means, and a game control power supply stop process for prohibiting access to the game control variation data storage means is performed. Including a power supply stop processing means for game control,
When the power supply is started and no operation signal is input from the initialization operation means, the game control variable is provided on the condition that the backup flag is set in the game control variation data storage means. Based on the stored content stored in the fluctuation data storage means, the control state is restored to the state at the time of starting the game control power supply stop processing, the state control for game control is performed,
Even if the backup flag is set in the game control variation data storage means when the power supply is started, if the operation signal from the initialization operation means is input, the game control variation data storage means Perform processing to initialize the memory contents,
A reset means for outputting a signal for setting the game control microcomputer to an operation stop state after the game control microcomputer completes the processing for stopping power supply for game control;
The fluctuation data stored in the payout control fluctuation data storage means includes data that can specify the number of payouts that have not been paid out of the number of game media payouts based on the lending request,
The dispensing control microcomputer is:
A payout for performing a power supply stop process for payout control, which is a process for storing in the payout control variable data storage means a control state including data capable of specifying the number of unpaid out according to the input of the detection signal Processing means for stopping power supply for control;
Operation signal confirmation processing means for performing an operation signal confirmation process for confirming whether or not an operation signal from the initialization operation means is input,
On the condition that the operation signal confirmation processing means does not confirm that the operation signal from the initialization operation means has been inputted, the data that can specify the number of unpaid out is the variable data storage for payout control. Restart the game medium payout control based on the data that can specify the number of unpaid when stored in the means,
When it is confirmed by the operation signal confirmation processing means that the operation signal is input from the initialization operation means, the payout control is performed even if the stored contents are stored in the payout control variation data storage means. There line a process of initializing the stored contents of use variation data storage means,
The game control microcomputer and the payout control microcomputer determine whether or not an operation signal from the initialization operation means is input, and determine a detection output from the game medium detection means for detecting a game medium A game machine characterized in that the determination is made in a request detection determination period shorter than the game medium detection determination period . 払出制御用マイクロコンピュータが所定のデータを取得するための入力ポートが設けられ、
初期化操作手段からの操作信号は前記入力ポートに入力される
請求項１記載の遊技機。An input port for the withdrawal control microcomputer to acquire predetermined data is provided,
The gaming machine according to claim 1, wherein an operation signal from the initialization operation means is input to the input port. 払出制御用マイクロコンピュータは、電源監視手段が検出信号を出力したときに、遊技媒体検出手段からの検出出力の入力処理を所定期間実行した後、払出制御用電力供給停止時処理を行う
請求項１または請求項２記載の遊技機。 Payment out control microcomputer, when the power supply monitoring means outputs the detection signal, after the input processing of the detected output from Yu technique medium detecting means has been executed a predetermined time period, wherein performing the payout control power supply stop process The gaming machine according to claim 1 or claim 2. 払出制御用マイクロコンピュータは、
出力ポートを介して貸出遊技媒体払出機構部に駆動信号を出力し、
電源監視手段が検出信号を出力したときに、出力ポートをオフ状態にした後、遊技媒体検出手段からの検出出力の入力処理を実行する
請求項３記載の遊技機。The dispensing control microcomputer
A drive signal is output to the rental game medium payout mechanism through the output port,
The gaming machine according to claim 3, wherein when the power supply monitoring means outputs a detection signal, after the output port is turned off, input processing of detection output from the game medium detection means is executed. 電源監視手段が検出信号を出力した後の、払出制御用マイクロコンピュータによる遊技媒体検出手段からの検出出力の入力処理の実行中に、前記払出制御用マイクロコンピュータおよび前記遊技媒体検出手段を駆動可能な電源を供給可能な補助駆動電源供給手段を備えた
請求項３または請求項４記載の遊技機。The payout control microcomputer and the game medium detection means can be driven during the execution of the detection output input process from the game medium detection means by the payout control microcomputer after the power supply monitoring means outputs the detection signal. The gaming machine according to claim 3, further comprising auxiliary drive power supply means capable of supplying power. 払出制御用マイクロコンピュータによって制御され、入賞に応じて遊技媒体の払出を行う賞遊技媒体払出機構部を備え、
払出制御用変動データ記憶手段に記憶される変動データは、入賞に応じて払い出される遊技媒体の払出数のうち前記賞遊技媒体払出機構部による払出しが完了していない未払出数を特定可能なデータを含む
請求項１から請求項５のうちのいずれかに記載の遊技機。An award game medium payout mechanism that is controlled by a payout control microcomputer and pays out game media in accordance with a prize;
The variation data stored in the variation data storage means for payout control is data that can identify the number of unpaid items that have not been paid out by the award game medium payout mechanism unit out of the number of game media paid out in accordance with the winning. The gaming machine according to any one of claims 1 to 5 . 遊技媒体検出手段として、賞遊技媒体払出機構部から払い出された遊技媒体を検出する賞遊技媒体検出手段と、貸出遊技媒体払出機構部から払い出された遊技媒体を検出する貸出遊技媒体検出手段とを別個に設けた
請求項６記載の遊技機。As game medium detection means, a prize game medium detection means for detecting a game medium paid out from the award game medium payout mechanism section, and a rental game medium detection means for detecting a game medium paid out from the rental game medium payout mechanism section And the game machine according to claim 6 . 払出制御用マイクロコンピュータは、
払出制御用電力供給停止時処理手段により払出制御用電力供給停止時処理が実行されていることを示す払出制御用情報を前記払出制御用変動データ記憶手段に保存するとともに、前記払出制御用変動データ記憶手段の記憶内容が正常か否かの判定に用いる払出制御用チェックデータを作成して前記払出制御用変動データ記憶手段に保存し、
操作信号確認処理手段により初期化操作手段からの操作信号が入力されていることが確認されなかったことを条件に、前記払出制御用変動データ記憶手段に前記払出制御用情報が保存されているか否かを確認し、前記払出制御用変動データ記憶手段に前記払出制御用情報が保存されていることを確認したことを条件に、前記払出制御用変動データ記憶手段における前記払出制御用チェックデータにもとづいて記憶内容が正常か否かの判定を行い、正常と判定したことを条件に、前記未払出数を特定可能なデータが前記払出制御用変動データ記憶手段に保存されているときに該未払出数を特定可能なデータにもとづいて遊技媒体の払出制御を再開する
請求項１から請求項７のうちのいずれかに記載の遊技機。The dispensing control microcomputer
The payout control fluctuation data storage means stores payout control information indicating that the payout control power supply stop processing is being executed by the payout control power supply stop processing means, and the payout control fluctuation data. Creating checkout data for payout control used to determine whether or not the storage content of the storage means is normal, and storing it in the payout control variation data storage means,
Whether or not the payout control information is stored in the payout control variation data storage means on the condition that the operation signal confirmation processing means has not confirmed that the operation signal from the initialization operating means has been input. On the basis of the check data for payout control in the payout control variable data storage means on the condition that the payout control information is stored in the payout control fluctuation data storage means. If the data that can specify the number of unpaid is stored in the payout control variable data storage means on the condition that the stored contents are normal or not, the unpaid The gaming machine according to any one of claims 1 to 7 , wherein the game medium payout control is resumed based on data whose number can be specified. 遊技制御用マイクロコンピュータは、
遊技制御用電力供給停止時処理手段により遊技制御用電力供給停止時処理が実行されていることを示す遊技制御用情報を前記遊技制御用変動データ記憶手段に保存するとともに、前記遊技制御用変動データ記憶手段の記憶内容が正常か否かの判定に用いる遊技制御用チェックデータを作成して前記遊技制御用変動データ記憶手段に保存し、
初期化操作手段からの操作信号が入力されているか否かを確認する遊技制御側操作信号確認処理を行う遊技制御側操作信号確認処理手段を含み、
前記遊技制御側操作信号確認処理手段により前記初期化操作手段からの操作信号が入力されていることが確認されなかったことを条件に、前記遊技制御用変動データ記憶手段に前記遊技制御用情報が保存されているか否かを確認し、前記遊技制御用変動データ記憶手段に前記遊技制御用情報が保存されていることを確認したことを条件に、前記遊技制御用変動データ記憶手段における前記遊技制御用チェックデータにもとづいて記憶内容が正常か否かの判定を行い、正常と判定したときに制御状態を前記遊技制御用電力供給停止時処理を開始したときの状態に復帰させる
請求項１から請求項８のうちのいずれかに記載の遊技機。The game control microcomputer
Game control information indicating that the game control power supply stop processing is being executed by the game control power supply stop processing means is stored in the game control change data storage means, and the game control change data Creating check data for game control used to determine whether or not the storage content of the storage means is normal and storing it in the game control variation data storage means;
Including game control side operation signal confirmation processing means for performing game control side operation signal confirmation processing for confirming whether or not an operation signal from the initialization operation means is input,
The game control information is stored in the game control variation data storage means on the condition that the game control side operation signal confirmation processing means does not confirm that the operation signal from the initialization operation means is input. The game control in the game control variation data storage means is confirmed on the condition that the game control variation data storage means confirms whether the game control information is stored in the game control variation data storage means. Whether or not the stored contents are normal is determined based on the check data for the game, and when it is determined to be normal, the control state is returned to the state when the processing for stopping power supply for game control is started. Item 9. A gaming machine according to any one of Items 8 to 8 . 払出制御用マイクロコンピュータは、
操作信号確認処理手段により初期化操作手段からの操作信号が入力されているか否かを確認した後に、定期的にタイマ割込が発生するように設定し、
定期的に発生するタイマ割込が生じたことにもとづいて遊技媒体の払出の制御を行うための割込処理を実行し、
払出制御用電力供給停止時処理にて、前記割込処理の実行を禁止する割込禁止状態または実行を許可する割込許可状態のうちいずれの状態であるかを示す割込状態データを払出制御用変動データ記憶手段に保存させる処理を実行し、
電力供給が開始されたときに、前記割込状態データにもとづいて前記割込禁止状態または前記割込許可状態に復旧させる状態復旧処理を行う
請求項１から請求項９のうちのいずれかに記載の遊技機。The dispensing control microcomputer
After confirming whether or not the operation signal from the initialization operation means is input by the operation signal confirmation processing means, set so that the timer interrupt is periodically generated,
Based on the occurrence of a periodic timer interruption, execute an interruption process to control the payout of game media,
Disbursement control of interrupt status data indicating which state is the interrupt disabled state that prohibits the execution of the interrupt process or the interrupt enabled state that permits the execution in the power supply stop processing for payout control Execute the process to save in the fluctuation data storage means for
When the power supply is started, according to any one of claims 1 to 9 for performing state restoration process to restore the interrupt disabled state, or the interrupt enable state based on the interrupt status data Game machines. 払出制御用マイクロコンピュータは、遊技制御用マイクロコンピュータから遊技媒体の払出に関するコマンドを受信する処理中では割込処理の実行を禁止する割込禁止状態に設定する
請求項１０記載の遊技機。The gaming machine according to claim 10, wherein the payout control microcomputer sets an interrupt prohibited state in which execution of an interrupt process is prohibited during a process of receiving a command related to payout of game media from the game control microcomputer. 遊技制御用マイクロコンピュータは、
初期化操作手段からの操作信号が入力されているか否かを確認する遊技制御側操作信号確認処理を行う遊技制御側操作信号確認処理手段を含み、
前記遊技制御側操作信号確認処理手段により初期化操作手段からの操作信号が入力されているか否かを確認した後に、定期的にタイマ割込が発生するように設定し、
定期的に発生するタイマ割込が生じたことにもとづいて遊技の進行を制御するための割込処理を実行し、
遊技制御用電力供給停止時処理にて、前記割込処理の実行を禁止する割込禁止状態または実行を許可する割込許可状態のうちいずれの状態であるかを示す割込状態データを遊技制御用変動データ記憶手段に保存させる処理を実行し、
電力供給が開始されたときに、前記割込状態データにもとづいて前記割込禁止状態または前記割込許可状態に復旧させる状態復旧処理を行う
請求項１から請求項１１のうちのいずれかに記載の遊技機。The game control microcomputer
Including game control side operation signal confirmation processing means for performing game control side operation signal confirmation processing for confirming whether or not an operation signal from the initialization operation means is input,
After confirming whether or not the operation signal from the initialization operation means is input by the game control side operation signal confirmation processing means, set so that a timer interrupt is periodically generated,
Based on the occurrence of a periodic timer interrupt, execute an interrupt process to control the progress of the game,
In the game control power supply stop process, the interrupt status data indicating which state is the interrupt disabled state for prohibiting the execution of the interrupt process or the interrupt permitted state for permitting the execution is game controlled. Execute the process to save in the fluctuation data storage means for
When the power supply is started, according to any one of claims 1 to 11 for performing state restoration process to restore the interrupt disabled state, or the interrupt enable state based on the interrupt status data Game machines.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4792630B2 (en) * 2000-10-24 2011-10-12 株式会社三洋物産 Game machine
JP4545359B2 (en) * 2001-09-06 2010-09-15 株式会社平和 Game machine
JP4545358B2 (en) * 2001-09-06 2010-09-15 株式会社平和 Game machine
JP4322773B2 (en) * 2004-10-01 2009-09-02 株式会社三共 Game machine
JP4322197B2 (en) * 2004-10-15 2009-08-26 株式会社三共 Game machine
JP5169103B2 (en) * 2007-09-25 2013-03-27 株式会社三洋物産 Game machine
JP2010259840A (en) * 2010-08-23 2010-11-18 Sanyo Product Co Ltd Game machine
JP5585568B2 (en) * 2011-11-16 2014-09-10 株式会社三洋物産 Game machine
JP5505495B2 (en) * 2012-12-28 2014-05-28 株式会社三洋物産 Game machine
JP5652563B2 (en) * 2014-03-18 2015-01-14 株式会社三洋物産 Game machine
JP2015037637A (en) * 2014-11-19 2015-02-26 株式会社三洋物産 Game machine

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6058186A (en) * 1983-09-09 1985-04-04 オムロン株式会社 Power failure treating apparatus of game machine
JPH0527880A (en) * 1991-07-23 1993-02-05 Nippon Steel Corp System restart device
JP2582489B2 (en) * 1991-08-21 1997-02-19 株式会社テック Power failure recovery device for electronic equipment
JPH06233867A (en) * 1993-02-08 1994-08-23 Sophia Co Ltd Game machine
JP2694521B2 (en) * 1995-11-10 1997-12-24 株式会社ソフィア Gaming machine
JPH10118265A (en) * 1996-10-16 1998-05-12 Sanyo Bussan Kk Pachinko machine
JP3142790B2 (en) * 1997-02-19 2001-03-07 株式会社ソフィア Pachinko machine
JPH11319279A (en) * 1998-05-11 1999-11-24 Daiichi Shokai Co Ltd Ball shooting game machine
JP2000140336A (en) * 1998-11-10 2000-05-23 Sankyo Kk Pachinko machine
JP4399890B2 (en) * 1999-03-23 2010-01-20 株式会社三洋物産 Game machine

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