JP3500322B2 - 定電流駆動装置および定電流駆動半導体集積回路 - Google Patents

定電流駆動装置および定電流駆動半導体集積回路

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Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、多数の負荷を一定
電流でそれぞれ駆動する定電流駆動装置およびそのよう
な定電流駆動装置に使用する定電流駆動半導体集積回路
に関する。
【０００２】
【従来の技術】従来から、発光ダイオード（以下「ＬＥ
Ｄ」と略称する）素子を多数個配列して形成されるＬＥ
Ｄプリンタ・ヘッドやＬＥＤディスプレイ・パネル、あ
るいは特定の有機化合物のエレクトロルミネッセンス
（以下「ＥＬ」と略称する）現象を利用する有機ＥＬデ
ィスプレイ・パネルなどは、多数の発光素子などの負荷
を定電流でそれぞれ駆動している。これらの負荷は、多
数個を同時に駆動しなければならないので、複数の定電
流出力端子を有する半導体集積回路（以下「ＩＣ」と略
称することがある）である定電流ドライバＩＣを複数個
使用して駆動する場合が多い。この場合に、各定電流ド
ライバＩＣの出力電流値にばらつきが生じると、発光素
子の発光量などにばらつきが生じ、プリンタでは印字む
ら、ディスプレイ・パネルでは表示むらを生じる。この
むらを低減するために、定電流ドライバＩＣの出力電流
は、各定電流出力端子間でのばらつきを小さく抑えるこ
とが要求されている。
【０００３】一方、ＩＣは、同一のマスクから同一のプ
ロセスに基づいて製造されても、半導体チップが異なる
と、半導体チップ上に形成されるトランジスタや抵抗な
どの各素子の電気的特性は異なり、整合性はあまり高く
ならない。しかしながら、同一の半導体チップ上に形成
されるトランジスタや抵抗などの間では、電気的特性の
相対的な誤差が小さくなり、整合性が高いという特徴を
有している。このため、ドライバＩＣの出力電流は、同
一ＩＣの定電流出力端子間では各出力間のばらつきが小
さくなるけれども、異なるＩＣ間では比較的ばらつきが
大きくなってしまう。したがって、複数のドライバＩＣ
を使用して、ＬＥＤプリンタ・ヘッド、ＬＥＤディスプ
レイ・パネル、有機ＥＬディスプレイ・パネルなどの発
光素子を駆動する場合は、ドライバＩＣ間のばらつきを
補正することが必要となる。
【０００４】ドライバＩＣ間のばらつきの補正は、各ド
ライバＩＣ毎に電流設定抵抗を外付けし、電流設定抵抗
の抵抗値を調整して行うことが一般的である。特開平８
−１６９１３９には、ＬＥＤヘッド駆動用のドライバＩ
Ｃに、組合わせによって合成抵抗値を変更することが可
能な電流設定抵抗を内蔵し、外部からの補正データに対
応させて抵抗の組合わせの合成抵抗値を変え、定電流値
を変更する先行技術が開示されている。
【０００５】
【発明が解決しようとする課題】定電流駆動用のドライ
バＩＣ間のばらつきを、電流設定抵抗値を調整して補正
する従来の方法では、表示素子とドライバＩＣとを組立
てるＬＥＤプリンタ・ヘッド、ＬＥＤディスプレイ・パ
ネルあるいは有機ＥＬ・ディスプレイ・パネルなどの組
立て工程を自動化しにくいという問題がある。ドライバ
ＩＣを１つの半導体集積回路として形成すれば、定電流
出力間のばらつきは小さくなるけれども、半導体集積回
路としての規模が大きくなり、半導体チップとして必要
な面積も大きくなってしまう。しかも、ドライバＩＣと
しての汎用性が失われ、特定のＬＥＤ・ヘッド、ＬＥＤ
ディスプレイ・パネルあるいは有機ＥＬ・ディスプレイ
・パネルなどに専用的にしか使用することができなくな
ってしまう。このような事情は、定電圧を出力するドラ
イバＩＣの場合も同様である。
【０００６】本発明の目的は、複数の半導体集積回路に
分けて負荷を駆動しても、半導体集積回路の出力間での
ばらつきを少なくすることができる定電流駆動装置およ
び定電流駆動半導体集積回路を提供することである。
【０００７】
【課題を解決するための手段】本発明は、複数の負荷
を、各負荷同一の電流で駆動する定電流駆動装置におい
て、負荷の総数より少ない複数の定電流駆動半導体集積
回路であって、各定電流駆動半導体集積回路は、同一の
半導体チップ上に集積され、１以上の基準電流入力端子
を有し、基準電流入力端子に入力される基準電流に対応
する一定電流で、負荷の総数のうちの一部に属する複数
の負荷をそれぞれ駆動する複数のドライブ回路と、各負
荷用の駆動入力端子を有し、駆動入力端子への入力信号
に従って該ドライブ回路の各出力をオンまたはオフにそ
れぞれ制御する制御回路とを含む、そのような複数の定
電流駆動半導体集積回路と、該複数の定電流駆動半導体
集積回路のうちの少なくとも１つと同一の半導体チップ
上に集積され、他の複数の定電流駆動半導体集積回路の
それぞれに基準電流を供給する基準電流出力端子であっ
て、該他の定電流駆動半導体集積回路に対応する数の基
準電流出力端子を備える基準電流発生回路とを含み、該
基準電流発生回路が同一の半導体チップ上に集積される
定電流駆動半導体集積回路では、基準電流出力端子から
出力される基準電流を自己のドライブ回路の基準電流入
力端子に入力することを特徴とする定電流駆動装置であ
る。
【０００８】 本発明に従えば、複数の定電流駆動半導
体集積回路にそれぞれ含まれる複数のドライブ回路によ
って、複数の負荷はそれぞれ同一の電流で駆動される。
各定電流駆動半導体回路は、ドライブ回路と制御回路と
を含む。ドライブ回路は、１以上の基準入力端子を有
し、基準入力端子に入力される基準電流に対応する一定
電流で、負荷の総数のうちの一部に属する複数の負荷を
それぞれ駆動する。制御回路は、各負荷用の駆動入力端
子を有し、駆動入力端子への入力信号に従って該ドライ
ブ回路の各出力をオンまたはオフにそれぞれ制御する。
ドライブ回路の基準入力端子には、基準電流発生回路か
らの基準電流が与えられる。基準電流発生回路は、複数
の定電流駆動半導体集積回路のうちの少なくとも１つと
同一の半導体チップ上に集積されて、他の定電流駆動半
導体集積回路の基準入力端子に同一の基準電流をそれぞ
れ与えるように基準電流を発生する。基準電流発生回路
からは、ばらつきの少ない基準電流が発生されて、他の
複数の定電流駆動半導体集積回路の基準入力端子に、そ
の定電流駆動半導体集積回路の数の基準電流出力端子か
らそれぞれ与えられる。基準電流発生回路が同一半導体
チップ上に集積される定電流駆動半導体集積回路の基準
電流入力端子には、自己の基準電流出力端子から基準電
流が入力される。
【０００９】
【００１０】 また、基準電流発生回路が複数の定電流
駆動半導体集積回路のうちの少なくとも１つと同一半導
体チップ上に集積されているので、基準電流発生回路を
定電流半導体集積回路と別に設ける必要はなく、負荷と
合わせてディスプレイ・パネルなどを組立てる際の小形
化を図ることができる。
【００１１】
【００１２】 また、複数の定電流半導体集積回路は、
基準電流発生回路からの同一の電流値の基準電流入力に
対応してそれぞれ同一の電流値で負荷を駆動するので、
多くの負荷をばらつきの少ない定電流値で駆動すること
ができる。
【００１３】 さらに本発明は、同一の半導体チップ上
に集積され、複数の負荷をそれぞれ同一の定電流値を有
する出力で駆動するための定電流駆動半導体集積回路で
あって、１以上の基準電流入力端子および複数の駆動出
力端子を有し、基準電流入力端子に入力される基準電流
に従って、各駆動出力端子に各負荷を同一の定電流値で
駆動するための出力を導出するドライブ回路と、複数の
基準電流出力端子を有し、各基準電流出力端子に同一電
流値を有する基準電流をそれぞれ発生し、各基準電流出
力端子から同一の半導体チップ上に集積されるドライブ
回路、および他の半導体チップ上に集積されるドライブ
回路の基準電流入力端子にそれぞれ供給可能である基準
電流発生回路とを含み、定電流駆動半導体集積回路内部
では、基準電流発生回路からの基準電流がドライブ回路
に入力されないことを特徴とする定電流駆動半導体集積
回路である。
【００１４】 本発明に従えば、定電流駆動半導体集積
回路は、同一の半導体チップ上に形成され、ドライブ回
路と基準電流発生回路とを含む。ドライブ回路は、１以
上の基準電流入力端子および複数の駆動出力端子を有
し、基準電流入力端子に入力される基準電流に従って、
各駆動出力端子に各負荷を同一の定電流値で駆動するた
めの出力を導出する。ドライブ回路は、同一の半導体チ
ップ上に形成されているので、各負荷を駆動する定電流
値のばらつきを小さくすることができる。基準電流発生
回路も、同一の半導体チップ上に形成されているので、
複数の基準電流出力端子に端子間のばらつきの小さい出
力をそれぞれ導出することができる。ばらつきの小さい
定電流出力値の１つを同一の半導体チップ上に形成され
るドライブ回路に与え、他の出力を他の半導体チップ上
に形成されるドライブ回路に与えるようにすれば、半導
体チップが異なるドライブ回路からばらつきの小さい定
電流値で複数の負荷をそれぞれ駆動させることができ
る。
【００１５】 また本発明で、前記複数のドライブ回路
の出力をオンまたはオフに制御するための信号がシリア
ルに入力されるシリアル入力端子を有し、シリアル入力
端子に入力された信号をパラレルに出力するシフトレジ
スタ回路と、ラッチ用入力端子を有し、ラッチ用入力端
子への入力信号に従って、シフトレジスタ回路のパラレ
ル出力をラッチし、ラッチされた出力で各ドライブ回路
の出力をオンまたはオフに制御するラッチ回路とを含む
ことを特徴とする。
【００１６】 本発明に従えば、各負荷に定電流出力を
与えるドライブ回路は、シフトレジスタ回路にシリアル
に入力される信号が、シフトレジスタ回路からパラレル
に出力され、ラッチ回路によってラッチされた出力でオ
ンまたはオフに制御される。シフトレジスタへのシリア
ル入力端子と、ラッチ回路のラッチ用入力端子とを用い
て、多くの駆動出力端子からの定電流出力のオンまたは
オフへの制御を行うことができる。
【００１７】
【発明の実施の形態】図１は、本発明の実施の一形態の
定電流駆動装置として、有機ＥＬディスプレイ・パネル
の概略的な電気的構成を示す。３個の定電流ドライバＩ
Ｃ１，２，３は、１つの基準電流入力端子ＩＲＥＦへ入
力される基準電流に対応して、６４の駆動出力端子Ｏ０
１〜Ｏ６４からそれぞれ同一電流値の駆動出力を導出す
ることができる。定電流ドライバＩＣ１には、基準電流
入力端子ＩＲＥＦに入力される基準電流に従って、６４
の駆動出力端子Ｏ０１〜Ｏ６４にそれぞれ駆動電流を供
給する定電流ドライバ回路１０と、定電流ドライバ回路
１０から出力される駆動電流を、入力信号に応じてオン
またはオフに制御するための制御回路１１と、定電流ド
ライバ回路１０の基準電流入力端子に基準電流を供給す
るための基準電流出力端子を含む３つの基準電流出力端
子ＯＲＥＦ１〜３から、同一電流値の基準電流を発生す
る基準電流発生回路１２とを含む。基準電流発生回路１
２は、定電流ドライバＩＣ１の外部に設けられる基準抵
抗１３で、各基準電流出力端子ＯＲＥＦ１〜３から導出
する基準電流値を調整することができる。他の定電流ド
ライバＩＣ２，３にも、定電流ドライバ回路２０，３０
および制御回路２１，３１が含まれる。
【００１８】定電流ドライバ回路ＩＣ１，２，３の駆動
出力端子Ｏ０１〜Ｏ６４は、ＥＬ表示パネル５０で、有
機ＥＬ素子５１，５２，…，が１９２ドット×ｎドット
のマトリクス状に配置されて構成される１９２列を、６
４列ずつに分割し、各列を負荷としてそれぞれ駆動す
る。ＥＬパネル５０のｎ行は、行選択回路６１に含まれ
るスイッチング素子ＳＷ１，ＳＷ２，…，ＳＷｎのうち
のいずれか１つのみが導通して選択される。行選択回路
６０によって選択される行と、各列との交点に配置され
る有機ＥＬ素子が選択され、定電流ドライバ回路１０，
２０，３０によって駆動される。
【００１９】ＥＬ表示パネル５０の各有機ＥＬ素子５
１，５２，…は、定電流ドライバＩＣ１，２，３のシリ
アル入力端子ＳＩに入力されるシリアル信号に基づいて
オンまたはオフに制御され、有機ＥＬ素子５１，５２，
…のオンまたはオフの表示に対応して、ＥＬ表示パネル
５０での画像表示が行われる。定電流ドライバＩＣ１，
２，３から同一電流値がオン状態の有機ＥＬ素子５１，
５２，…に与えられるので、オン状態の画素間の輝度の
ばらつきが少ない状態で表示を行うことができる。
【００２０】シリアル入力端子ＳＩに入力されるシリア
ル信号は、クロック端子ＣＬＯＣＫに入力されるクロッ
ク信号に同期して与えられ、シリアル出力端子ＳＯから
出力される。定電流ドライバＩＣ２のシリアル入力端子
ＳＩを定電流ドライバＩＣ１のシリアル出力端子ＳＯと
接続し、定電流ドライバＩＣ３のシリアル入力端子ＳＩ
を定電流ドライバＩＣ２のシリアル出力端子ＳＯに接続
する。定電流ドライバＩＣ１のシリアル入力端子ＳＩか
ら、１９２列分の表示データをクロック信号に同期して
入力させれば、制御回路１１，２１，３１内に含まれる
それぞれ６４段ずつのシフトレジスタ回路に、各列の表
示データを与えることができる。各列の表示データは、
ラッチ入力用端子ＬＡＴＣＨに入力されるラッチ信号に
応じてシフトレジスタからラッチ回路に取込まれ、イネ
ーブル入力端子ＥＮＡＢＬＥに与えられる信号に従って
定電流ドライバ回路１０から各駆動出力端子Ｏ０１〜Ｏ
６４への駆動出力のオンまたはオフの制御が行われる。
クロック入力信号ＣＬＯＣＫ、ラッチ用入力信号ＬＡＴ
ＣＨおよびイネーブル用入力信号ＥＮＡＢＬＥは、各定
電流ドライバＩＣ１，２，３に対し、それぞれ共通に与
えられる。
【００２１】図２は、図１に示す定電流ドライバＩＣ１
の概略的な電気的構成を示す。制御回路１１には、６４
ビット・シフト・レジスタ７０と、６４ビット・ラッチ
８０とが含まれる。６４ビット・シフト・レジスタ７０
は、クロック端子に入力されるクロック信号ＣＬＯＣＫ
に同期して、シリアル入力端子ＳＩから入力されるシリ
アル信号を６４ビット分のレジスタにそれぞれ記憶させ
る。ラッチ回路である６４ビットラッチ８０は、外部か
ら与えられるラッチ用信号ＬＡＴＣＨに応答して、６４
ビット・シフト・レジスタ６４からの出力データを取込
んで保持する。６４ビット・ラッチ８０の出力データ
は、常に導出され、６４のＡＮＤゲート１０１，１０
２，…，１６４を介して６４ビットの定電流ドライバ回
路１０を制御する。定電流ドライバ回路１０には、基準
電流が入力され、カレントミラー回路として、同一の出
力電流を導出する。なお基準電流入力端子ＩＲＥＦは複
数設け、入力電流値の和として、出力電流を導出させる
こともできる。
【００２２】図３は、図２に示す基準電流発生回路１２
の概略的な電気的構成を示す。定電圧回路１１０は、一
定の電圧を出力する。ＣＭＯＳオペアンプなどの演算増
幅器１１１は、定電圧回路１１０からの出力電圧を基準
にして、基準抵抗１３に発生する電圧が等しくなるよう
に、制御用ＮＭＯＳトランジスタ１１２のゲートに信号
電圧を与える。基準抵抗１３は、制御用ＮＭＯＳトラン
ジスタ１１２のソース側に、基準電圧入力端子ＶＲＥＦ
を介して接続される。制御用ＮＭＯＳトランジスタ１１
２のドレイン側には、制御用ＰＭＯＳトランジスタ１１
３のドレインが接続される。制御用ＮＭＯＳトランジス
タ１１２は、前記定電圧回路１１０からの出力電圧と、
図１および図２に示す外付けの基準抵抗１３に基づいて
定電流を流す。
【００２３】制御用ＰＭＯＳトランジスタ１１３は、カ
レントミラー回路１２０を構成し、カレントミラー回路
１２０に含まれる出力用ＰＭＯＳトランジスタ１２１，
１２２，１２３からそれぞれ同一電流値の基準電流を導
出させることができる。各ＰＭＯＳトランジスタ１２
１，１２２，１２３のソースは、制御用ＰＭＯＳトラン
ジスタ１１３のソースとともに共通接続され、正の電源
電圧Ｖｃｃが与えられる。制御用ＰＭＯＳトランジスタ
１１３および出力用ＰＭＯＳトランジスタ１２１，１２
２，１２３のゲートは共通接続され、制御用ＰＭＯＳト
ランジスタ１１３のドレインと制御用ＮＭＯＳトランジ
スタ１１２のドレインとの共通接続点に接続される。
【００２４】カレントミラー回路１２０では、制御用Ｐ
ＭＯＳトランジスタ１１３に流れるソース・ドレイン間
電流に対応して、各出力用ＰＭＯＳトランジスタ１２
１，１２２，１２３のソース・ドレイン間電流が流れ
る。出力用ＰＭＯＳトランジスタ１２１，１２２，１２
３は、同一の半導体チップ上に形成され、同一形状のマ
スクを用いる露光処理と、同一のプロセス処理とに従っ
て製造されるので、同一の特性を有するように製造する
ことができ、ばらつきの少ない電流値で各基準電流出力
端子ＯＲＥＦ１〜３から導出する基準電流を発生させる
ことができる。基準電流値は、定電圧回路１１０から発
生する定電圧を基準抵抗１３の抵抗値で除算した値に対
応させることができる。制御用ＰＭＯＳトランジスタ１
１３も出力用ＰＭＯＳトランジスタ１２１，１２２，１
２３と同一形状となるように形成しておけば、基準抵抗
１３を流れる電流と同一電流値の電流を各基準電流出力
端子ＯＲＥＦ１〜３からそれぞれ導出させることができ
る。
【００２５】図４は、図３の定電圧回路１１０を、ＮＰ
Ｎバンドギャップ型として構成する場合の例を示す。電
源から、定電流源１３０を介して一定電流をＮＰＮトラ
ンジスタ１３１，１３２，１３３および抵抗１３４，１
３５，１３６で構成されるバンドギャップ回路に供給す
ると、半導体素子として基本的なバンドギャップに基づ
く一定電圧を、取出すことができる。ＮＰＮトランジス
タ１３１はＰＮ接合ダイオードとして、ＰＮ接合順方向
電圧を発生し、ＮＰＮトランジスタ１３２からのバンド
ギャップ電圧と合せて、温度変化が小さい基準電圧を得
ることができる。
【００２６】図５は、図２の定電流ドライバ回路１０で
各駆動出力端子Ｏ０１〜Ｏ６４にそれぞれ接続される出
力素子の例を示す。図５（ａ）はＰＭＯＳトランジスタ
１４０から出力を取出す例を示す。図５（ｂ）は、ＮＭ
ＯＳトランジスタ１５０から出力を取出す例を示す。図
５（ｃ）は、バイポーラのＰＮＰトランジスタ１６０か
ら出力を取出す例を示す。図５（ｄ）は、バイポーラの
ＮＰＮトランジスタ１７０から出力を取出す例を示す。
各出力素子は、並列に、かつカレントミラー回路を構成
するように接続され、同一電流値の出力を容易に得るこ
とができる。
【００２７】図１の実施形態では、定電流ドライバＩＣ
１，２，３でＥＬ表示パネル５０の１９２列の有機ＥＬ
素子５１，５２，…を６４列ずつ分けてそれぞれ駆動し
ているけれども、列の数や、定電流ドライバＩＣの使用
個数、あるいは各定電流ドライバＩＣで駆動可能な出力
数などは他の数にすることもできる。また、定電流駆動
の負荷は、ＥＬ表示パネル５０の有機ＥＬ素子５１，５
２，…ばかりではなく、ＬＥＤディスプレイ・パネルの
各ＬＥＤ素子や、ＬＥＤプリンタ・ヘッドなどを、抵抗
などによる調製なしで、同様に定電流駆動することもで
きる。
【００２８】
【００２９】また、基準電流発生回路１２を、定電流ド
ライバＩＣ２，３にも内蔵させ、各定電流ドライバＩＣ
１，２，３を全く同一の構成とすることもできる。この
場合には、定電流ドライバＩＣ２，３では基準電流発生
回路１２の基準電流出力端子ＯＲＥＦは使用しないで、
定電流ドライバＩＣ１の基準電流出力端子ＯＲＥＳを基
準電流入力端子ＩＲＥＦに接続する。すなわち、定電流
ドライバＩＣ２，３では基準電流発生回路１２を内蔵す
るけれども、使用はしない。このようにすることによっ
て、定電流ドライバＩＣ１，２，３を標準化することが
でき、量産しやすくすることができる。
【００３０】また、基準電流の代りに、基準電圧や基準
周期の信号を与え、負荷を定電流で駆動することもでき
る。
【００３１】
【発明の効果】以上のように本発明によれば、複数の負
荷を、複数の定電流駆動半導体集積回路からのばらつき
の小さい一定電流で駆動し、駆動出力をオンまたはオフ
に制御することができる。出力のばらつきを小さくする
ために、各定電流駆動半導体集積回路間で調整を行う必
要はないので、定電流駆動装置の組立て時に必要な調整
の手間を省き、組立て工程の自動化も容易にすることが
できる。
【００３２】 また、複数の定電流駆動半導体集積回路
のうちの少なくとも１つには、基準電流発生回路が同一
の半導体チップ上に集積されているので、基準電流発生
回路を定電流駆動半導体集積回路と別に設ける必要はな
く、定電流駆動回路の小形化を図り、組立ても容易にす
ることができる。
【００３３】また、定電流半導体集積回路は、各負荷を
基準信号に対応してそれぞれ同一の電流値で駆動するの
で、複数の負荷を容易に定電流駆動することができる。
【００３４】 さらに本発明によれば、定電流駆動半導
体集積回路には、同一の半導体チップ上に複数の負荷を
定電流で駆動可能なドライブ回路と基準電流発生回路と
を含み、複数の基準電流出力端子と、１以上の基準電流
入力端子および複数の基準出力端子を有する。複数の基
準電流出力端子からは、ばらつきの小さい基準電流出力
を導出し、そのうちの１つを基準電流入力端子に入力さ
せれば、複数の駆動出力端子からばらつきの小さい定電
流出力を導出させることができる。残りの基準電流出力
端子を、他の定電流駆動半導体出力回路のドライブ回路
の基準入力端子に接続すれば、他の定電流駆動半導体集
積回路も含めて、ばらつきの小さい定電流出力で複数の
負荷を駆動することができる。
【００３５】また本発明によれば、複数の負荷を駆動す
る定電流出力を、シリアルに入力される信号に従ってオ
ンまたはオフに制御することができる。制御のための信
号はシリアルに入力されるので、入力端子の数を増やす
ことなく、多くの負荷を駆動する定電流出力のオンまた
はオフの制御を行うことができる。
【図面の簡単な説明】
【図１】本発明の実施の一形態の定電流駆動装置として
の有機ＥＬディスプレイ・パネルの概略的な電気的構成
を示すブロック図である。
【図２】図１の実施形態で使用する定電流ドライバＩＣ
１の概略的な電気的構成を示すブロック図である。
【図３】図２の定電流ドライバＩＣ１に使用される基準
電流発生回路１２の概略的な電気的構成を示すブロック
図である。
【図４】図３の定電圧回路１１０をＮＰＮバンドギャッ
プ型で構成する等価的電気回路図である。
【図５】図２の定電流ドライバ回路１０の出力の例を示
す部分的な電気回路図である。
【符号の説明】
１，２，３ 定電流ドライバＩＣ １０，２０，３０ 定電流ドライバ回路 １１，２１，３１ 制御回路 １２ 基準電流発生回路 １３ 基準抵抗 ５０ ＥＬ表示パネル ５１，５２，… 有機ＥＬ素子 ６０ 行選択回路 １１０ 定電圧回路 １２０ カレントミラー回路 １２１，１２２，１２３ 出力用ＰＭＯＳトランジスタ １３０ 定電流源 １３１，１３２，１３３，１７０ ＮＰＮトランジスタ １４０ ＰＭＯＳトランジスタ １５０ ＮＭＯＳトランジスタ １６０ ＰＮＰトランジスタ
フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G05F 1/00 - 1/70 H01L 33/00,27/04 - 27/06 B41J 3/16 - 3/21

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項１】 複数の負荷を、各負荷同一の電流で駆動
    する定電流駆動装置において、 負荷の総数より少ない複数の定電流駆動半導体集積回路
    であって、 各定電流駆動半導体集積回路は、 同一の半導体チップ上に集積され、１以上の基準電流入
    力端子を有し、基準電流入力端子に入力される基準電流
    に対応する一定電流で、負荷の総数のうちの一部に属す
    る複数の負荷をそれぞれ駆動する複数のドライブ回路
    と、 各負荷用の駆動入力端子を有し、駆動入力端子への入力
    信号に従って該ドライブ回路の各出力をオンまたはオフ
    にそれぞれ制御する制御回路とを含む、そのような複数
    の定電流駆動半導体集積回路と、 該複数の定電流駆動半導体集積回路のうちの少なくとも
    １つと同一の半導体チップ上に集積され、他の複数の定
    電流駆動半導体集積回路のそれぞれに基準電流を供給す
    る基準電流出力端子であって、該他の定電流駆動半導体
    集積回路に対応する数の基準電流出力端子を備える基準
    電流発生回路とを含み、 該基準電流発生回路が同一の半導体チップ上に集積され
    る定電流駆動半導体集積回路では、基準電流出力端子か
    ら出力される基準電流を自己のドライブ回路の基準電流
    入力端子に入力することを特徴とする定電流駆動装置。
  2. 【請求項２】 同一の半導体チップ上に集積され、複数
    の負荷をそれぞれ同一の定電流値を有する出力で駆動す
    るための定電流駆動半導体集積回路であって、 １以上の基準電流入力端子および複数の駆動出力端子を
    有し、基準電流入力端子に入力される基準電流に従っ
    て、各駆動出力端子に各負荷を同一の定電流値で駆動す
    るための出力を導出するドライブ回路と、 複数の基準電流出力端子を有し、各基準電流出力端子に
    同一電流値を有する基準電流をそれぞれ発生し、各基準
    電流出力端子から同一の半導体チップ上に集積されるド
    ライブ回路、および他の半導体チップ上に集積されるド
    ライブ回路の基準電流入力端子にそれぞれ供給可能であ
    る基準電流発生回路とを含み、 定電流駆動半導体集積回路内部では、基準電流発生回路
    からの基準電流がドライブ回路に入力されないことを特
    徴とする定電流駆動半導体集積回路。
  3. 【請求項３】 前記複数のドライブ回路の出力をオンま
    たはオフに制御するための信号がシリアルに入力される
    シリアル入力端子を有し、シリアル入力端子に入力され
    た信号をパラレルに出力するシフトレジスタ回路と、 ラッチ用入力端子を有し、ラッチ用入力端子への入力信
    号に従って、シフトレジスタ回路のパラレル出力をラッ
    チし、ラッチされた出力で各ドライブ回路の出力をオン
    またはオフに制御するラッチ回路とを含むことを特徴と
    する請求項２記載の定電流駆動半導体集積回路。
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