JP2538717B2 - 樹脂封止型半導体装置 - Google Patents

樹脂封止型半導体装置

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Description

【発明の詳細な説明】 〔発明の目的〕 (産業上の利用分野) 本発明は樹脂封止型半導体装置に関するものである。
(従来の技術) 第12図は従来一般的に知られている樹脂封止型半導体
装置であるSOJ型の半導体装置用のリードフレームを示
す平面図、第13図は第12図のリードフレームに半導体素
子を搭載した様子を示す平面図、第14図は第13図におけ
るA−A′断面図である。
このようなリードフレームの中央部にはベッド2が設
けられ、その周囲には外部との信号および電位を授受す
るためのリード3が配設されている。なお、以下に示す
リードフレームの図面においては外枠の外形は省略して
ある。
リード3には後述するようにワイヤでボンディングが
なされるが、このボンディング特性を向上させるため、
ボンディングが行われる可能性のあるリード先端部3aに
は接続の信頼性を向上させるため、銀めっき、金めっき
などが施されている。また、電源供給などに使用される
コーナ部のリードの先端部は配線容量を増加させるため
に他の信号リードの先端よりも大きくなっている。
第13図および第14図を参照すると、上述したベッド2
の上に半導体素子1がダイマウント材4により固着され
て搭載され、この半導体素子1表面のボンディングパッ
ド9とリード先端部3aとは金やアルミニウムなどの導電
性の高い金属細線5により接続されている。そして、こ
のようなワイヤボンディング終了後、半導体素子を外部
環境から保護し、外部から加わる力や衝撃から保護する
ため、全体は樹脂封止され、樹脂封止体8が形成されて
いる。前述したリードのうち、この樹脂封止体内にある
ものをインナリード6、樹脂封止体外にあるものをアウ
タリード7と称する。
第14図に示すように、アウタリード7は切断されてリ
ードフレームの外枠から離され、続いて断面J型にする
ような曲げ加工が行われる。
近年、半導体装置の高機能化により、半導体素子の大
きさは拡大傾向にあり、大形化した半導体素子を指定さ
れた大きさのパッケージに組み込むことが困難となりつ
つある。
このため、半導体素子自体の大きさを縮小することが
望まれ、このために設計ルール自体が縮小化されつつあ
る。
しかしながら、このような縮小された設計ルールにお
いては半導体素子内での配線が細くなり、配線抵抗が増
加する。特に、電源関係の配線で配線抵抗が増加した場
合、外部ノイズを拾って、信号にノイズがのりやすい。
このことを考慮するとノズルの影響を受けないように、
動作速度を増加させることが困難となる。一般に電源関
係の配線は半導体素子の面積のうちかなりの部分を占め
ているため、電源関係の配線面積の縮小は上記問題の存
在にもかかわらず、必要になっている。
このため、次のような半導体装置が従来提案されてい
る。
その1つは第15図に示されるようなもので、電位を供
給するボンディングパッドとして半導体素子11上の両端
の2点(20,21)を設けることにより、配線容量を増加
させている。これにより、配線抵抗が減少し、これに伴
ってノイズが減少し、動作速度を増大することが可能と
なる。
(発明が解決しようとする課題) しかしながら、この半導体装置では配線の引き回しと
いう新たな問題が発生する。これを図を用いて説明す
る。
第15図およびこれを模式化した第16図において、電位
供給源X(例えばグランド電位0V)が左上に設けられて
いるものとすれば、ボンディングパッド20は距離が近い
ため、第15図に示すように電源供給リード30とのボンデ
ィングワイヤ配線は容易であるが、ボンディングパッド
21については距離が非常に離れているため、半導体素子
11のまわりを半周程度迂回して配線する必要がある。し
かし、このような配線は第15図のような構成では不可能
である。
これを解決するため、3次元的な配線が必要であり、
この様子を第17図およびそのB−B′断面図である第18
図に示す。
この構造ではダイマウント材として絶縁性接着剤22を
用いて半導体素子11をベッド12に固着し、電位供給リー
ド31をタイバー32に接続し、ボンディングパッド21の近
傍のベッド上にもボンディングパッド23を設けてこれら
をボンディングワイヤ5で接続するようにする。したが
って、ベッド部12は配線の一部として用いられることに
なり、第18図の断面図および第19図の模式図に示される
ように配線が立体的となって電流供給量が増大する。
しかしながら、このような構造では絶縁性接着剤22に
よって半導体素子11とベッド12とを絶縁しているため、
絶縁性接着剤の膜厚管理が重要となる。すなわち、絶縁
性接着剤の膜厚が極端に薄い場合には半導体素子11とベ
ッド12とが直接短絡する虞れがあり、またその膜厚が薄
い場合にはそこに空気の巣が存在し外部から水分が進入
することにより半導体素子11とベッド12との間に電流リ
ークが生じて歩留りおよび信頼性を著しく損なうという
問題がある。このため、確実な絶縁性を確保するために
は一定以上の膜厚が必要であるが、そのための工程管理
は煩雑かつ困難である。
したがって、本発明は煩雑な工程管理などが不要で、
かつ配線抵抗が小さい、縮小化された半導体装置を提供
することを目的とする。
〔発明の構成〕
(課題を解決するための手段) 本発明によれば、金属薄板から形成され、半導体素子
の下面を支持するベッドと、半導体素子の周囲に配設さ
れ、半導体素子上の電極とワイヤにより接続されたリー
ドを有し、樹脂封止してなる樹脂封止型半導体装置にお
いて、ベッドは、支持部と、これと所定の間隙を有しか
つ半導体素子と絶縁状態に形成された素子下配線部とに
分割されており、素子下配線部により電源関係リードと
この電源関係リードと離れた位置に存在する半導体素子
上の電源関係電極との接続を行うようにしたことを特徴
とする樹脂封止型半導体装置が提供される。
半導体素子下面と素子下配線部との間に介挿された絶
縁体をさらに備えると良い。
素子下配線部は、その上面の位置が前記支持部の上面
の位置よりも低くなるようにデプレスされていると良
い。
素子下配線部は支持部よりも薄い厚さを有しており、
素子下配線部の底面と前記支持部の底面とは同一平面を
なしていると良い。
(作 用) 本発明による半導体装置においては従来のベッドが分
割されており、分割された一部は半導体素子を支持し、
残りの一部は電位供給源から離れた半導体素子の部分へ
電位を供給する為の配線部位として使用される。このた
め、立体的な引き回し配線が容易にできる。このような
構造を実現するにあたっては、素子下配線部には接着剤
を塗布しないようにするだけで良く、煩雑な工程管理を
必要としない。
素子下配線部と半導体素子との間に絶縁体が介装さ
れ、あるいは素子下配線部が支持部よりも大きくデプレ
スされていると絶縁体である封止樹脂が侵入して両者の
絶縁を確実化することができる。
また、素子下配線部を支持部よりも薄く形成し両部の
底面が同一平面をなすようにすると、デプレスを大きく
することなしに樹脂を素子下配線部と半導体素子との間
に充填させることができ、半導体装置の厚さを減少させ
ることができる。
(実施例) 以下、図面を参照して本発明の実施例のいくつかを詳
細に説明する。
第1図(a)から第1図(c)までは本発明にかかる
半導体装置の断面図であって、SOJ(Small Outline J−
lead Package)型の樹脂封止型半導体装置を示してい
る。これらは後述する第6図におけるC−C′断面図で
あって、それぞれ異なる実施例を示している。
この半導体装置ではベッドは3つの部分に分かれてお
り、2つの支持部101とこれらの間に所定の間隙をもっ
て配設された素子下リード102が設けられている。支持
部101上には半導体素子100がダイマウント材103により
固着され、支持されている。支持部101の周囲にはリー
ド106が配設されており、ここには半導体素子100の上面
にあるボンディングパッド104との間でボンディングワ
イヤ105を用いた接続が行われている。そして、全体は
樹脂108により成型され、水分や衝撃からの保護を図っ
ている。また、アウタリード107は従来と同様に、断面
J型に切断および曲げ加工が行われている。
第1図(a)においては、素子下リード102の上面に
はダイマウント材103が塗布されていない。このため、
素子下リード102の上面と半導体素子100の下面とはダイ
マウント材の厚みだけ離れ、樹脂封止によって絶縁体で
ある封止樹脂が侵入し絶縁されている。
第1図(b)においては、酸素下リード102の上面と
半導体素子100の下面との絶縁を積極的に図るため、素
子下リード102の上面には絶縁性樹脂が塗布され、絶縁
材が介装された状態となっている。
第1図(c)においては、素子下リード102は支持部1
01よりも大きくデプレスされている。すなわち、半導体
素子の上面とインナリードの高さをほぼ一致させてワイ
ヤボンディングの信頼性を向上させるため、支持部はほ
ぼ半導体素子の厚さ分だけデプレスが行われているが、
この実施例では素子下リード102の上面と半導体素子100
の下面との距離を増加させて絶縁特性を向上させるた
め、素子下リード102を支持部101よりもさらに大きくデ
プレスしたものである。
第2図は、本発明で使用するリードフレームの形状を
示す平面図、第3図(a)(b)(c)は第2図のB−
B′断面図であって、第1図(a)(b)(c)にそれ
ぞれ対応するリードフレーム構造を示すものである。
第2図からわかるように、従来ベッド部として形成さ
れていた部分は半導体素子を支持するための2つの支持
部101とこれらの間に間隙をもって形成された素子下リ
ード102の3つの部分に分割されている。支持部101はダ
イバー121により、素子下リード102はタイバー122によ
りリードフレームの外枠(図示せず)に連結されてい
る。
第3図(a)においては、支持部101と素子下リード1
02のデプレスの程度が同じであること、第3図(b)に
おいては、素子下リード102の表面に前述した絶縁性樹
脂が塗布されていること、第3図(c)においては、素
子下リード102が支持部101よりもさらに大きくデプレス
されていることを示しており、これらについては第1図
において説明したとおりである。なお、素子下リード10
2の表面の絶縁化を図るために、ポリイミドシートなど
の絶縁材シートを貼着するようにしてもよい。
このようなリードフレームを用いて本発明の半導体装
置を製造する過程を第4図から第6図を用いて説明す
る。
第4図は支持部101の上にダイマウント材を塗布し、
半導体素子100を搭載する。このとき、素子下リード102
の上にはダイマウント材を塗布しない。なお、このダイ
マウント材としては半導体素子の基板を支持部101と同
電位にするときには導電性のものを、そうでないときに
は絶縁性のものを用いる。ダイマウント材としてはエポ
キシ系樹脂、はんだ、シリコーン樹脂などが知られてお
り、使用される。第5図(a)(b)(c)は第4図の
C−C′断面図であって、それぞれ第1図(a)(b)
(c)の各実施例に対応している。第5図(a)では素
子下リード102の上面と半導体素子100の下面とはダイマ
ウント材の厚み分だけの間隙を隔てて絶縁状態が保たれ
ている。このような間隙が存在することにより、樹脂封
止を行うと、この間隙に樹脂が侵入することによって両
者の絶縁はより完全になる。
第5図(b)では素子下リード102の上面に絶縁性樹
脂109が塗布されているので、素子下リード102の高さ位
置の変動があっても確実に絶縁を図ることができる。第
5図(c)では素子下リード102は支持部101よりもさら
にデプレスされているため、作業性良く絶縁を確実化さ
せることができる。
第6図は第4図に示した工程の後、ワイヤボンディン
グを行う様子を示す平面図である。第1図で説明したよ
うに、半導体素子上の電極104とリード106とはボンディ
ングワイヤ105で接続されているが、電源電位を供給す
るリード110はボンディングワイヤ111によって近くの電
極20と接続されるとともに、素子下リード102の一部に
設けられたパッド113とボンディングワイヤ112により接
続されている。また、素子下リード102の延長上に設け
られたパッド114は半導体素子上の電極21とボンディン
グワイヤ115により接続されている。この様子は第7図
において強調されている。また、第8図は半導体素子の
下を通って電源電位供給リードから離れた電極21に電源
電位を供給する様子を示す模式図であり、半導体素子の
下を通るリードを設けることにより電源電位供給リード
から離れた電極に電源電位を与えることができることが
わかる。
この後、従来と同様に樹脂封止、アウタリードの切断
および折り曲げを行なうことにより第1図に示した構造
を得ることができる。
第9図ないし第11図は本発明のさらに他の実施例を表
わす図面で、第9図はその平面図、第10図は第9図にお
けるC−C′断面図、第11図はC−C′断面に対応する
リードフレーム部分の断面図である。以下の説明におい
ては、これらの図面における第1図〜第3図と対応する
部分には同じ参照番号を付してその詳細な説明を省略す
る。
この実施例では第11図に示されるように、素子下リー
ド102の厚さt2は支持部101の厚さt1よりも薄くなってい
る。これらの底面は同一平面をなすようにデプレスされ
ているので、第10図に示すように、素子下リード102の
上面と半導体素子100の下面との間には間隙が生じ、こ
の部分に樹脂が充填されることにより十分な絶縁が確保
されている。
この実施例では第5図(C)に示した実施例のように
素子下リード102が支持部101よりも下に飛び出すことが
ないため、近年要求の高い薄型パッケージへの対応が可
能となる。
なお、素子下リード102の厚さt2を支持部101の厚さt1
よりも薄くするには、例えば素子下リード102のみをデ
プレス後にハーフエッチングすれば良い。
以上の実施例においては、半導体素子支持部を2か
所、素子下リードを一本設けるようにしたが、これに限
られることなく、同電位のパッドの位置と数により任意
の個数を選択することができる。
〔発明の効果〕
以上のように、本発明によれば、半導体素子の下を通
るリードをリードフレームを分割して素子下配線部とし
て形成し、これを用いて電源供給リードから離れたパッ
ドへの接続を行うようにしているので、配線ルールが縮
小化された場合にも電源関係の配線抵抗を増加させずに
済み、ノイズを発生することなく高速化を実現できる樹
脂封止型半導体装置を提供することができる。また、厳
密な管理を行なわなくても素子下配線部と半導体素子と
の絶縁を安定に図ることができるため、製造工程の安定
化、低いコスト化を図ることができる。
また、素子下配線部と半導体素子との間に絶縁物を介
装させ、あるいは素子下配線部を支持部よりも大きくデ
プレスさせることにより、半導体素子との絶縁をより確
実化させることができる。
さらに、素子下配線部の厚さを支持部よりも薄く形成
することにより、支持部よりも下に突出させることなく
半導体素子との確実な絶縁を図ることができる。
【図面の簡単な説明】
第1図(a)から第1図(c)までは本発明にかかる半
導体装置の断面図、第2図は本発明にかかる半導体装置
に用いられるリードフレームの外観を示す平面図、第3
図(a)から第3図(c)は第1図(a)から第1図
(c)までの実施例にそれぞれ対応するリードフレーム
の構造を示す断面図、第4図は第2図のリードフレーム
に半導体素子を搭載した状態を示す平面図、第5図
(a)から第5図(c)までは第4図におけるC−C′
断面を示す断面図、第6図はワイヤボンディングを行っ
た様子を示す平面図、第7図は第6図における電源関係
の接続を強調して示す平面図、第8図は第6図の電源関
係の接続の模式的説明図、第9図は本発明の他の実施例
にかかる半導体装置の断面図、第10図はそのC−C′断
面を示す断面図、第11図はリードフレームの構造を示す
断面図、第12図は従来一般的に知られている樹脂封止型
半導体装置であるSOJ型の半導体装置用のリードフレー
ムを示す平面図、第13図は第12図のリードフレームに半
導体素子を搭載した様子を示す平面図、第14図は第13図
におけるA−A′断面図、第15図は電源供給のための電
極を増加させた従来の半導体装置を示す平面図、第16図
は第15図における電位供給を示す模式的説明図、第17図
は3次元的な電源配線を行った例を示す平面図、第18図
はそのB−B′断面図、第19図は第18図に示された立体
配線構造を示す模式的説明図である。 101……半導体素子、101……支持部、102……素子下リ
ード、103……ダイマウント材、103……電極、105,111,
112,115……ボンディングワイヤ、106……インナリー
ド、107……アウタリード、108……樹脂封止体、109…
…絶縁性樹脂、113,114……パッド、121,122……タイバ
ー。

Claims (4)

    (57)【特許請求の範囲】
  1. 【請求項1】金属薄板から形成され、半導体素子の下面
    を支持するベッドと、前記半導体素子の周囲に配設さ
    れ、前記半導体素子上の電極とワイヤにより接続された
    リードを有し、樹脂封止してなる樹脂封止型半導体装置
    において、 前記ベッドは、支持部と、これと所定の間隙を有しかつ
    前記半導体素子と絶縁状態に形成された素子下配線部と
    に分割されており、前記素子下配線部により電源関係リ
    ードとこの電源関係リードと離れた位置に存在する前記
    半導体素子上の電源関係電極との接続を行うようにした
    ことを特徴とする樹脂封止型半導体装置。
  2. 【請求項2】前記半導体素子下面と前記素子下配線部と
    の間に介挿された絶縁体をさらに備えたことを特徴とす
    る請求項1に記載の樹脂封止型半導体装置。
  3. 【請求項3】前記素子下配線部は、その上面の位置が前
    記支持部の上面の位置よりも低くなるようにデプレスさ
    れていることを特徴とする請求項1に記載の樹脂封止型
    半導体装置。
  4. 【請求項4】前記素子下配線部は前記支持部よりも薄い
    厚さを有しており、前記素子下配線部の底面と前記支持
    部の底面とは同一平面をなしていることを特徴とする請
    求項1に記載の樹脂封止型半導体装置。
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Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100552353B1 (ko) 1992-03-27 2006-06-20 가부시키가이샤 히타치초엘에스아이시스템즈 리이드프레임및그것을사용한반도체집적회로장치와그제조방법
US5907769A (en) * 1996-12-30 1999-05-25 Micron Technology, Inc. Leads under chip in conventional IC package
US5869898A (en) * 1997-04-25 1999-02-09 Nec Corporation Lead-frame having interdigitated signal and ground leads with high frequency leads positioned adjacent a corner and shielded by ground leads on either side thereof
TW330337B (en) * 1997-05-23 1998-04-21 Siliconware Precision Industries Co Ltd Semiconductor package with detached die pad
US6436736B1 (en) * 2000-11-13 2002-08-20 Semiconductor Components Industries Llc Method for manufacturing a semiconductor package on a leadframe
KR100586699B1 (ko) * 2004-04-29 2006-06-08 삼성전자주식회사 반도체 칩 패키지와 그 제조 방법

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5927558A (ja) * 1982-08-03 1984-02-14 Toshiba Corp 半導体装置用リ−ドフレ−ム
US4595945A (en) * 1983-10-21 1986-06-17 At&T Bell Laboratories Plastic package with lead frame crossunder
US4612564A (en) * 1984-06-04 1986-09-16 At&T Bell Laboratories Plastic integrated circuit package
US4937656A (en) * 1988-04-22 1990-06-26 Mitsubishi Denki Kabushiki Kaisha Semiconductor device
JPH0231454A (ja) * 1988-07-20 1990-02-01 Hitachi Ltd 半導体装置
JP2798427B2 (ja) * 1989-07-17 1998-09-17 沖電気工業株式会社 半導体装置用積層リードフレームおよびそれを用いた半導体装置の製造方法
JPH0760837B2 (ja) * 1990-03-13 1995-06-28 株式会社東芝 樹脂封止型半導体装置

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