JP2019216250A - Semiconductor light-emitting device - Google Patents
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Abstract
Description
本発明は、半導体発光装置に関する。 The present invention relates to a semiconductor light emitting device.
図27は、従来の半導体発光装置の一例を示している。同図に示された半導体発光装置9は、基材91にリード92が設けられている。リード92には、LEDチップ93が実装されている。LEDチップ93は、半導体層94およびサブマウント基板95を有する。半導体層94は、たとえばn型半導体層、p型半導体層、およびこれらに挟まれた活性層を有する。サブマウント基板95は、半導体層94を支持しており、たとえばSiからなる。LEDチップ93は、ワイヤ96によってリード92に導通している。封止樹脂97は、LEDチップ93を覆っており、LEDチップ93からの光を透過する。
FIG. 27 shows an example of a conventional semiconductor light emitting device. The semiconductor light emitting device 9 shown in FIG. An
LEDチップ93が発光すると、主に前記活性層から熱が発生する。この熱は、リード92および基材91へと伝えられることにより放熱される。しかしながら、前記活性層とリード92との間には、サブマウント基板95が介在している。このサブマウント基板95は、LEDチップ93からの放熱を妨げる。したがって、LEDチップ93の発光効率が低下するという問題があった。
When the
図28は、従来の半導体発光装置の他の一例を示している(たとえば、特許文献2参照)。同図に示された半導体発光装置900は、基板901にLEDチップ902が搭載されている。LEDチップ902は、枠状のリフレクタ905によって囲まれている。リフレクタ905によって囲まれた空間には、封止樹脂906が充填されている。LEDチップ902は、たとえばSiからなるサブマウント基板903とサブマウント基板903上に積層された半導体層904を有する。半導体層904は、サブマウント基板903を介して基板901に導通している。
FIG. 28 shows another example of a conventional semiconductor light emitting device (for example, see Patent Document 2). In the semiconductor
LEDチップ902から側方に出射した光は、リフレクタ905によって上向きに反射される。反射された光をより多く半導体発光装置900から出射するには、リフレクタ905の内壁面を基板901に対して直角である角度から大きく傾けることが有効である。しかしながら、前記内壁面を傾けるほど、半導体発光装置900が大きくなってしまう。半導体発光装置900は、搭載される電子機器などのスペース制約から、小型化の要請が強い。このため、半導体発光装置900の小型化と高輝度化とを両立することは困難である。
Light emitted laterally from the
本発明は、上述した事情のもとで考え出されたものであって、LEDチップの発光効率を高めることが可能な半導体発光装置を提供することをその課題とする。 The present invention has been conceived under the circumstances described above, and it is an object of the present invention to provide a semiconductor light emitting device that can increase the luminous efficiency of an LED chip.
本発明の第1の側面によると、複数のLEDチップと、前記複数のLEDチップが搭載されたケースと、を備え、前記各LEDチップは、基板、およびこの基板に積層されたn型半導体層、活性層、p型半導体層、前記p型半導体層に導通するアノード電極および前記n型半導体層に導通するカソード電極を有しており、前記アノード電極および前記カソード電極が前記ケースと対面する姿勢で前記ケースに搭載されており、前記ケースは、セラミックからなり、かつ表面および裏面を有する基材と、前記表面に形成された複数ずつのアノードパッドおよびカソードパッドを含む表面層、前記裏面に形成されたアノード実装電極およびカソード実装電極を含む裏面層、前記複数のアノードパッドと前記アノード実装電極とを導通させ、かつ前記基材の厚さ方向の少なくとも一部を貫通する複数のアノード貫通配線、前記複数のカソードパッドと前記カソード実装電極とを導通させ、かつ前記基材の厚さ方向の少なくとも一部を貫通する複数のカソード貫通配線、を有する配線と、を有することを特徴とする、半導体発光装置が提供される。 According to a first aspect of the present invention, there are provided a plurality of LED chips, and a case on which the plurality of LED chips are mounted, wherein each of the LED chips is a substrate, and an n-type semiconductor layer laminated on the substrate. An active layer, a p-type semiconductor layer, an anode electrode connected to the p-type semiconductor layer, and a cathode electrode connected to the n-type semiconductor layer, wherein the anode electrode and the cathode electrode face the case. The case is made of ceramic and has a front surface and a back surface, and a surface layer including a plurality of anode pads and cathode pads formed on the front surface, formed on the back surface. A back surface layer including the separated anode mounting electrode and the cathode mounting electrode, electrically connecting the plurality of anode pads and the anode mounting electrode, and A plurality of anode through wirings penetrating at least a part of the thickness direction of the base, a plurality of the plurality of cathode pads and the plurality of cathode pads and the plurality of the cathode mounting electrodes are electrically connected, and a plurality of the through holes penetrate at least a part of the thickness of the base. And a wiring having the above-described cathode through wiring.
本発明の実施において好ましくは、前記複数のアノード貫通配線は、前記表面から前記裏面まで前記基材を貫通する複数の全厚アノード貫通配線を含む。 Preferably, in the practice of the present invention, the plurality of through-anode wirings include a plurality of through-thick anode through-wirings penetrating the base material from the front surface to the back surface.
本発明の実施において好ましくは、前記配線は、前記基材の厚さ方向において前記表面および前記裏面の間に位置する中間層を有している。 In the practice of the present invention, preferably, the wiring has an intermediate layer located between the front surface and the back surface in the thickness direction of the base material.
本発明の実施において好ましくは、前記複数のカソード貫通配線は、前記表面から前記中間層まで前記基材を貫通している1以上の表面側カソード貫通配線と、前記中間層から前記裏面まで前記基材を貫通している1以上の裏面側カソード貫通配線と、を含む。 In the practice of the present invention, preferably, the plurality of cathode through wirings include one or more front surface side cathode through wirings penetrating the substrate from the front surface to the intermediate layer, and the base through the intermediate layer to the back surface. And at least one back-side cathode through wiring penetrating the material.
本発明の実施において好ましくは、前記中間層は、前記表面側カソード貫通配線と、前記裏面側カソード貫通配線とにつながるカソード中継配線を有する。 In an embodiment of the present invention, preferably, the intermediate layer has a cathode relay wiring connected to the front-side cathode through wiring and the back-side cathode through wiring.
本発明の実施において好ましくは、前記表面層は、前記基材の厚さ方向視において前記基材の一端から前記基材の他端へと至るアノードメッキ配線およびカソードメッキ配線を有する。 In the practice of the present invention, preferably, the surface layer has an anode plating wiring and a cathode plating wiring extending from one end of the base material to the other end of the base material in a thickness direction of the base material.
本発明の実施において好ましくは、前記複数のアノード貫通配線は、前記アノードメッキ配線と前記アノード実装電極とをつなぐメッキ用アノード貫通配線を含む。 Preferably, in the practice of the present invention, the plurality of anode through wirings include a plating anode through wiring connecting the anode plating wiring and the anode mounting electrode.
本発明の実施において好ましくは、前記複数のカソード貫通配線は、前記カソードメッキ配線と前記カソード実装電極とをつなぐメッキ用カソード貫通配線を含む。 Preferably, in the practice of the present invention, the plurality of cathode through wirings include a cathode through wiring for plating that connects the cathode plating wiring and the cathode mounting electrode.
本発明の実施において好ましくは、前記複数のアノード貫通配線のうち前記表面に露出するものは、その前記表面側端面が前記複数のアノードパッドによって覆われている。 In the practice of the present invention, preferably, among the plurality of anode through wirings, the one exposed on the surface is covered with the plurality of anode pads on the front end surface.
本発明の実施において好ましくは、前記複数のカソード貫通配線のうち前記表面に露出するものは、その前記表面側端面が前記複数のカソードパッドによって覆われている。 In the embodiment of the present invention, preferably, among the plurality of cathode through wirings, the one exposed on the surface is covered with the plurality of cathode pads on the front end surface.
本発明の実施において好ましくは、前記複数のアノード貫通配線のうち前記裏面に露出するものは、その前記裏面側端面が前記アノード実装電極によって覆われている。 In the practice of the present invention, preferably, among the plurality of anode through wirings, those exposed on the back surface have their back side end surfaces covered with the anode mounting electrodes.
本発明の実施において好ましくは、前記複数のカソード貫通配線のうち前記裏面に露出するものは、その前記裏面側端面が前記カソード実装電極によって覆われている。 In the practice of the present invention, preferably, of the plurality of cathode through wirings, which is exposed on the back surface, the back surface side end surface is covered with the cathode mounting electrode.
本発明の実施において好ましくは、前記複数のアノード貫通配線および前記複数のカソード貫通配線は、Agからなる。 In the practice of the present invention, preferably, the plurality of anode through wirings and the plurality of cathode through wirings are made of Ag.
本発明の実施において好ましくは、前記複数ずつのアノードパッドおよびカソードパッドは、Auからなる。 Preferably, in the practice of the present invention, each of the plurality of anode pads and cathode pads is made of Au.
本発明の実施において好ましくは、前記アノード実装電極および前記カソード実装電極は、Auからなる。 In the practice of the present invention, preferably, the anode mounting electrode and the cathode mounting electrode are made of Au.
本発明の実施において好ましくは、前記配線は、前記表面に形成されたバイパスカソードパッドおよびバイパスアノードパッドを有しており、前記複数のアノード貫通配線は、前記バイパスカソードパッドと前記アノード実装電極とを導通させるバイパスカソード貫通配線を含んでおり、前記複数のカソード貫通配線は、前記バイパスアノードパッドと前記カソード実装電極とを導通させるバイパスアノード貫通配線を含んでいる。 In the practice of the present invention, preferably, the wiring has a bypass cathode pad and a bypass anode pad formed on the surface, and the plurality of anode through wirings connect the bypass cathode pad and the anode mounting electrode. The plurality of cathode through wirings include a bypass anode through wiring for conducting the conduction between the bypass anode pad and the cathode mounting electrode.
本発明の実施において好ましくは、前記バイパスカソードパッドにはツェナーダイオードが導通接合されており、前記バイパスアノードパッドと前記ツェナーダイオードとを導通させるワイヤを備える。 In an embodiment of the present invention, preferably, a Zener diode is conductively connected to the bypass cathode pad, and a wire for electrically connecting the bypass anode pad to the Zener diode is provided.
本発明の実施において好ましくは、前記ケースには、その厚さ方向において前記複数のLEDチップを収容する収容凹部が形成されている。 In the embodiment of the present invention, preferably, the case has a housing recess for housing the plurality of LED chips in a thickness direction thereof.
本発明の実施において好ましくは、前記収容凹部には、前記複数のLEDチップを覆う封止樹脂が充填されている。 In a preferred embodiment of the present invention, the housing recess is filled with a sealing resin covering the plurality of LED chips.
本発明の実施において好ましくは、前記封止樹脂は、前記LEDチップからの光によって励起されることにより前記LEDチップからの光とは異なる波長の光を発する蛍光材料が混入されている。 In the practice of the present invention, preferably, the sealing resin is mixed with a fluorescent material that emits light having a different wavelength from the light from the LED chip when excited by the light from the LED chip.
本発明の実施において好ましくは、前記ケースは、その厚さ方向において略矩形状であり、その四隅には、厚さ方向断面形状が四半円状のコーナー凹部が形成されている。 Preferably, in the embodiment of the present invention, the case has a substantially rectangular shape in the thickness direction, and corner recesses having a quadrangular cross section in the thickness direction are formed at four corners.
本発明の実施において好ましくは、前記複数のアノード貫通配線および前記複数のカソード貫通配線の少なくともいずれかには、第1凹部が形成され、前記表面層には、前記基材の厚さ方向視において、前記第1凹部に重なる第2凹部が形成され、前記第2凹部に充填された充填部をさらに備え、前記充填部は、前記基材の厚さ方向視において前記複数のLEDチップのいずれか一つに重なる。 In the practice of the present invention, preferably, at least one of the plurality of anode through wirings and the plurality of cathode through wirings has a first recess, and the surface layer has a thickness in the thickness direction of the base material. A second recess overlapping the first recess, further comprising a filling portion filled in the second recess, wherein the filling portion is one of the plurality of LED chips when viewed in a thickness direction of the base material. Overlap one.
本発明の実施において好ましくは、前記複数のLEDチップのいずれか一つおよび前記表面層の間に介在する接合部をさらに備え、前記充填部は、前記接合部および前記表面層の間に介在し、且つ、前記接合部および前記表面層のいずれにも接している。 In the practice of the present invention, preferably, further comprises a bonding portion interposed between any one of the plurality of LED chips and the surface layer, the filling portion is interposed between the bonding portion and the surface layer In addition, it is in contact with both the junction and the surface layer.
本発明の実施において好ましくは、前記充填部は、導電性の材料よりなる。 In the practice of the present invention, preferably, the filling portion is made of a conductive material.
本発明の実施において好ましくは、前記充填部は、AuとSnとの合金よりなる。 In the practice of the present invention, preferably, the filling portion is made of an alloy of Au and Sn.
本発明の実施において好ましくは、前記接合部は、導電性の材料よりなる。 In the practice of the present invention, preferably, the joint is made of a conductive material.
本発明の実施において好ましくは、前記接合部は、AuとSnとの合金よりなる。 In the practice of the present invention, preferably, the joint is made of an alloy of Au and Sn.
本発明の第2の側面によると、1以上のLEDチップと、前記LEDチップが搭載された表面、およびこの表面とは反対側に位置する裏面を有するケースとを備えた半導体発光装置であって、前記ケースは、前記LEDチップを囲む内壁面を有する基材を含んでおり、前記LEDチップ側に位置する内縁、前記内壁面に接する外縁、これら内縁および外縁を繋いでおり、かつ前記内縁から前記外縁に向かうほど前記表面から離間するように傾斜した反射面、を有する反射樹脂を備えることを特徴とする、半導体発光装置が提供される。 According to a second aspect of the present invention, there is provided a semiconductor light emitting device including one or more LED chips, a surface having the LED chip mounted thereon, and a case having a back surface located on a side opposite to the front surface. The case includes a base material having an inner wall surface surrounding the LED chip, an inner edge located on the LED chip side, an outer edge contacting the inner wall surface, connecting these inner edges and outer edges, and from the inner edge. A semiconductor light emitting device is provided, comprising: a reflective resin having a reflective surface that is inclined so as to be more distant from the surface toward the outer edge.
本発明の実施において好ましくは、前記反射樹脂は、前記基材よりも反射率が高い。 In the practice of the present invention, preferably, the reflection resin has a higher reflectance than the base material.
本発明の実施において好ましくは、前記反射樹脂は、白色である。 In the practice of the present invention, preferably, the reflective resin is white.
本発明の実施において好ましくは、前記基材は、セラミックからなる。 Preferably, in the practice of the present invention, the substrate is made of ceramic.
本発明の実施において好ましくは、前記ケースは、前記LEDチップに導通し、かつ少なくともその一部が前記基材によって覆われたリードを具備しており、前記基材は、熱硬化性樹脂または熱可塑性樹脂を含んでいる。 In the practice of the present invention, preferably, the case includes a lead that is electrically connected to the LED chip, and at least a part of the lead is covered with the base material, and the base material is a thermosetting resin or a thermosetting resin. Contains plastic resin.
本発明の実施において好ましくは、前記表面から前記外縁までの高さが、前記表面から前記LEDチップの活性層までの高さよりも高い。 In the practice of the present invention, preferably, the height from the surface to the outer edge is higher than the height from the surface to the active layer of the LED chip.
本発明の実施において好ましくは、前記内壁面は、前記表面に対して直角である。 Preferably, in the practice of the present invention, the inner wall surface is perpendicular to the surface.
本発明の実施において好ましくは、前記LEDチップに過大な逆電圧が印加されることを防止するバイパス機能素子を備えており、前記反射樹脂は、前記バイパス機能素子を覆っている。 In a preferred embodiment of the present invention, the LED chip preferably includes a bypass function element for preventing an excessive reverse voltage from being applied to the LED chip, and the reflective resin covers the bypass function element.
本発明の実施において好ましくは、前記反射樹脂は、前記バイパス機能素子に接続されたワイヤを覆っている。 In the practice of the present invention, preferably, the reflective resin covers a wire connected to the bypass functional element.
本発明の実施において好ましくは、前記基材は、前記表面から前記裏面側に凹んでおり、かつ前記LEDチップから離間しているとともに、前記バイパス機能素子を収容するせき止め凹部を有している。 In the practice of the present invention, preferably, the base material is recessed from the front surface to the back surface side, is separated from the LED chip, and has a damming recess for accommodating the bypass function element.
本発明の実施において好ましくは、前記内縁は、前記せき止め凹部の端縁と一致している。 Preferably, in the practice of the present invention, the inner edge coincides with an edge of the damming recess.
本発明の実施において好ましくは、前記せき止め凹部は、前記バイパス機能素子に接続されたワイヤがボンディングされたパッドを収容している。 In the practice of the present invention, preferably, the damming recess houses a pad to which a wire connected to the bypass functional element is bonded.
本発明の実施において好ましくは、前記せき止め凹部は、前記LEDチップを囲む包囲部を有している。 Preferably, in the practice of the present invention, the damming recess has a surrounding portion surrounding the LED chip.
本発明の実施において好ましくは、複数の前記LEDチップを備えており、前記反射樹脂は、前記包囲部から互いに隣り合う前記LEDチップどうしの間に入り込んだ突出部を有している。 In a preferred embodiment of the present invention, a plurality of the LED chips are provided, and the reflective resin has a protruding portion that enters between the LED chips adjacent to each other from the surrounding portion.
本発明の実施において好ましくは、前記隣り合うLEDチップどうしの間に入り込んだ部分よりも、前記ケースの中央寄りに位置する前記LEDチップを備える。 Preferably, in the practice of the present invention, the apparatus further includes the LED chip located closer to the center of the case than a portion inserted between the adjacent LED chips.
本発明の実施において好ましくは、前記LEDチップは、前記表面に対面するアノード電極およびカソード電極を有するフリップチップタイプである。 In the practice of the present invention, preferably, the LED chip is a flip chip type having an anode electrode and a cathode electrode facing the surface.
本発明の実施において好ましくは、前記反射樹脂の前記内縁は、前記LEDチップから離間している。 In the practice of the present invention, preferably, the inner edge of the reflective resin is separated from the LED chip.
本発明の実施において好ましくは、前記LEDチップは、前記表面とは反対側に位置し、かつそれぞれにワイヤが接続されたアノード電極およびカソード電極を有する2ワイヤタイプである。 Preferably, in the practice of the present invention, the LED chip is of a two-wire type having an anode electrode and a cathode electrode, which are located on the opposite side of the surface and each has a wire connected thereto.
本発明の実施において好ましくは、前記反射樹脂の前記内縁は、前記LEDチップから離間している。 In the practice of the present invention, preferably, the inner edge of the reflective resin is separated from the LED chip.
本発明の実施において好ましくは、前記ケースは、前記LEDチップに接続されたワイヤがボンディングされたアノードパッドおよびカソードパッドを備えており、前記アノードパッドおよびカソードパッドは、前記LEDチップよりも外側に配置されている。 Preferably, in the practice of the present invention, the case includes an anode pad and a cathode pad to which wires connected to the LED chip are bonded, and the anode pad and the cathode pad are arranged outside the LED chip. Have been.
本発明の実施において好ましくは、前記反射樹脂は、前記アノードパッドおよび前記カソードパッドを覆っている。 In the practice of the present invention, preferably, the reflective resin covers the anode pad and the cathode pad.
本発明の実施において好ましくは、前記LEDチップは、互いに積層されたn型半導体層、活性層、p型半導体層、これらを支持するサブマウント基板を有している。 Preferably, in the practice of the present invention, the LED chip includes an n-type semiconductor layer, an active layer, a p-type semiconductor layer, and a submount substrate that supports these layers.
本発明の実施において好ましくは、前記反射樹脂は、前記内壁面に囲まれた前記表面のうち、前記サブマウント基板が接合された部分以外のすべてを覆っている。 In the practice of the present invention, preferably, the reflective resin covers all of the surface surrounded by the inner wall surface except for the portion where the submount substrate is joined.
本発明の実施において好ましくは、前記LEDチップおよび前記反射樹脂を覆い、前記LEDチップからの光を透過させる透明樹脂に、前記LEDチップからの光によって励起されることにより異なる波長の光を発する蛍光材料が混入された材料からなる封止樹脂を備える。 In the practice of the present invention, preferably, a fluorescent resin that covers the LED chip and the reflective resin and emits light of different wavelengths when excited by light from the LED chip is provided on a transparent resin that transmits light from the LED chip. A sealing resin made of a material mixed with the material is provided.
本発明の実施において好ましくは、前記ケースは、表面層、裏面層、複数のアノード貫通配線、および複数のカソード貫通配線を含み、前記表面層は、前記基材の表面に形成された複数ずつのアノードパッドおよびカソードパッドを含み、前記裏面層は、前記基材の裏面に形成されたアノード実装電極およびカソード実装電極を含み、前記複数のアノード貫通配線は、前記複数のアノードパッドと前記アノード実装電極とを導通させ、かつ前記基材の厚さ方向の少なくとも一部を貫通しており、前記複数のカソード貫通配線は、前記複数のカソードパッドと前記カソード実装電極とを導通させ、かつ前記基材の厚さ方向の少なくとも一部を貫通している。 In the practice of the present invention, preferably, the case includes a front surface layer, a back surface layer, a plurality of through-anode wirings, and a plurality of through-cathode wirings, and the front surface layer is formed by a plurality of each formed on the surface of the base material. An anode pad and a cathode pad, wherein the back surface layer includes an anode mounting electrode and a cathode mounting electrode formed on a back surface of the substrate, and the plurality of anode through wirings include the plurality of anode pads and the anode mounting electrode. And, penetrates at least a part of the thickness direction of the base material, the plurality of cathode through wirings conducts the plurality of cathode pads and the cathode mounting electrodes, and the base material Penetrates at least a part of the thickness direction.
本発明の実施において好ましくは、前記複数のアノード貫通配線および前記複数のカソード貫通配線の少なくともいずれかには、第1凹部が形成され、前記表面層には、前記基材の厚さ方向視において、前記第1凹部に重なる第2凹部が形成され、前記第2凹部に充填された充填部をさらに備え、前記充填部は、前記基材の厚さ方向視において前記複数のLEDチップのいずれか一つに重なる。 In the practice of the present invention, preferably, at least one of the plurality of anode through wirings and the plurality of cathode through wirings has a first recess, and the surface layer has a thickness in the thickness direction of the base material. A second recess overlapping the first recess, further comprising a filling portion filled in the second recess, wherein the filling portion is one of the plurality of LED chips when viewed in a thickness direction of the base material. Overlap one.
本発明の実施において好ましくは、前記複数のLEDチップのいずれか一つおよび前記表面層の間に介在する接合部をさらに備え、前記充填部は、前記接合部および前記表面層の間に介在し、且つ、前記接合部および前記表面層のいずれにも接している。 In the practice of the present invention, preferably, further comprises a bonding portion interposed between any one of the plurality of LED chips and the surface layer, the filling portion is interposed between the bonding portion and the surface layer In addition, it is in contact with both the junction and the surface layer.
本発明の実施において好ましくは、前記充填部は、導電性の材料よりなる。 In the practice of the present invention, preferably, the filling portion is made of a conductive material.
本発明の実施において好ましくは、前記充填部は、AuとSnとの合金よりなる。 In the practice of the present invention, preferably, the filling portion is made of an alloy of Au and Sn.
本発明の実施において好ましくは、前記接合部は、導電性の材料よりなる。 In the practice of the present invention, preferably, the joint is made of a conductive material.
本発明の実施において好ましくは、前記接合部は、AuとSnとの合金よりなる。 In the practice of the present invention, preferably, the joint is made of an alloy of Au and Sn.
本発明のその他の特徴および利点は、添付図面を参照して以下に行う詳細な説明によって、より明らかとなろう。 Other features and advantages of the present invention will become more apparent from the detailed description given below with reference to the accompanying drawings.
以下、本発明の実施形態について、図面を参照して具体的に説明する。 Hereinafter, embodiments of the present invention will be specifically described with reference to the drawings.
図1〜図6は、本発明の第1実施形態の半導体発光装置の一例およびこれに用いられるLEDチップの一例を示している。本実施形態の半導体発光装置A1は、ケース2、複数のLEDチップ5、ツェナーダイオード6、および封止樹脂7を備えている。なお、図1においては、理解の便宜上封止樹脂7を省略している。
1 to 6 show an example of the semiconductor light emitting device according to the first embodiment of the present invention and an example of an LED chip used for the device. The semiconductor light emitting device A1 of this embodiment includes a
ケース2は、半導体発光装置A1の土台となるものであり、基材3と配線4とを有している。ケース2のサイズは、平面視寸法が5〜10mm角程度、厚さが1.0mm程度とされている。
The
基材3は、平面視略矩形状の厚板状とされており、たとえばアルミナなどのセラミックからなる。本実施形態においては、このセラミックとして、低温同時焼成セラミックと称される、焼成温度が900℃程度と比較的低い材質が用いられている。この低温同時焼成セラミックは、低焼成温度により、配線4の材質となる金属と同時に焼成することが可能である。基材3の中央には、収容凹部33が形成されている。収容凹部33は、複数のLEDチップ5を収容しており、平面視形状が円形とされている。基材3の四隅には、コーナー凹部34が形成されている。コーナー凹部34は、半導体発光装置A1の製造方法において、セラミック材料を適切分割するために設けられた貫通孔の一部であり、断面四半円形状の溝とされている。基材3は、表面31と裏面32とを有している。本実施形態においては、収容凹部33の深さが、たとえば0.6mm程度とされている。
The
配線4は、複数のLEDチップ5に対して直流電力を供給するための経路として用いられるものであり、表面層41、中間層42、裏面層43、複数のアノード貫通配線44、および複数のカソード貫通配線45を有している。
The
図4は、図2のIV−IV線に沿う平面で半導体発光装置A1を切断したと仮定した場合の要部平面図である。本発明においては、便宜上、配線4のうち、収容凹部33に囲まれた円形の表面31と、基材3の厚さ方向において表面31と同位に存在する面とに形成された部位を、表面層41と称している。
FIG. 4 is a plan view of a main part assuming that the semiconductor light emitting device A1 is cut along a plane along the line IV-IV in FIG. In the present invention, for convenience, of the
表面層41は、複数のアノードパッド41a、複数のカソードパッド41b、バイパスカソードパッド41c、バイパスアノードパッド41d、アノードメッキ配線41e、およびカソードメッキ配線41fを含んでいる。本実施形態においては、表面層41のうちアノードメッキ配線41eおよびカソードメッキ配線41fを除く部分がAuからなり、アノードメッキ配線41eおよびカソードメッキ配線41fは、Auを含む適宜選択された金属からなる。
The
複数のアノードパッド41aおよび複数のカソードパッド41bは、LEDチップ5を実装するためのものである。図4によく表れているように、アノードパッド41aとカソードパッド41bとは隣り合う組として配置されている。本実施形態においては、アノードパッド41aとカソードパッド41bとの組が、5組形成されている。各アノードパッド41aは、3本の平行な枝状部分と、これらの枝状部分に対して直角につながる帯状部分と、この帯状部分につながる円形部分とを有している。カソードパッド41bは、帯状部分とこの帯状部分につながる円形部分とを有している。
The plurality of
バイパスカソードパッド41cとバイパスアノードパッド41dは、LEDチップ5に過大な逆電圧が印加されることを回避するためのバイパス機能素子を実装するためのものであり、本実施形態においては、バイパス機能素子としてツェナーダイオード6が実装されている。バイパスカソードパッド41cは、円形状とされており、バイパスアノードパッド41dは、矩形状部分とこの矩形状部分につながる円形部分とを有している。
The
アノードメッキ配線41eおよびカソードメッキ配線41fは、複数のアノードパッド41a、複数のカソードパッド41b、バイパスカソードパッド41c、バイパスアノードパッド41d、および裏面層43をメッキによって形成するために用いられるものである。アノードメッキ配線41eおよびカソードメッキ配線41fは、図4における基材3の図中上端から下端にわたって、互いにほぼ平行に延びている。
The
中間層42は、基材3の厚さ方向において表面31と裏面32とのほぼ中央(表面31から深さ0.2mm程度)に形成されている。図5は、図2のV−V線に沿う平面に沿って半導体発光装置A1を切断したと仮定した場合の要部平面図である。本図に示すように、中間層42は、カソード中継配線42aを含んでいる。カソード中継配線42aは、略五角形の部分と、この五角形部分につながる帯状部分と、この帯状部分に対して直角につながる帯状部分とを有している。
The
図6に示すように、裏面層43は、基材3の裏面32に形成されており、アノード実装電極43aとカソード実装電極43bとを有している。アノード実装電極43aおよびカソード実装電極43bは、半導体発光装置A1をたとえば回路基板などに面実装するために用いられる。本実施形態においては、アノード実装電極43aおよびカソード実装電極43bは、Auからなる。アノード実装電極43aは、略矩形状であり、図6において基材3の裏面32の右側2/3程度の領域を覆っている。カソード実装電極43bは、長矩形状であり、裏面32の左側1/4程度の領域を覆っている。
As shown in FIG. 6, the
複数のアノード貫通配線44は、複数の全厚アノード貫通配線44a、複数のメッキ用アノード貫通配線44b、およびバイパスカソード貫通配線44cを含んでいる。複数のアノード貫通配線44はそれぞれ、Ag、Ta、もしくはハンダからなり、本実施形態においてはAgからなる。図2に示すように全厚アノード貫通配線44aは、基材3を表面31から裏面32までその厚さ方向に貫通している。図4および図6から理解される通り、複数の全厚アノード貫通配線44aは、基材3の厚さ方向視において複数のアノードパッド41aおよびアノード実装電極43aの双方に重なっている。すなわち、各全厚アノード貫通配線44aは、その表面31側の端面が、アノードパッド41aの円形部分によって覆われており、裏面32側の端面が、アノード実装電極43aによって覆われている。
The plurality of anode through
複数のメッキ用アノード貫通配線44bは、基材3をその厚さ方向において全厚アノード貫通配線44aと同じ領域を貫通している。図4および図6から理解される通り、複数のメッキ用アノード貫通配線44bは、基材3の厚さ方向視においてアノードメッキ配線41eおよびアノード実装電極43aの双方に重なっている。すなわち、各メッキ用アノード貫通配線44bは、その表面31側の端面が、アノードメッキ配線41eによって覆われており、裏面32側の端面が、アノード実装電極43aによって覆われている。
The plurality of anode through-holes for plating 44b penetrate the
バイパスカソード貫通配線44cは、全厚アノード貫通配線44aと同様に基材3を表面31から裏面32までその厚さ方向に貫通している。図4および図6から理解される通り、バイパスカソード貫通配線44cは、基材3の厚さ方向視においてバイパスカソードパッド41cおよびアノード実装電極43aの双方に重なっている。すなわち、バイパスカソード貫通配線44cは、その表面31側の端面が、バイパスカソードパッド41cによって覆われており、裏面32側の端面が、アノード実装電極43aによって覆われている。
The bypass cathode through
複数のカソード貫通配線45は、複数の表面側カソード貫通配線45a、複数の裏面側カソード貫通配線45b、複数のメッキ用カソード貫通配線45c、およびバイパスアノード貫通配線45dを含んでおり、本実施形態においてはAgからなる。図2に示すように、表面側カソード貫通配線45aは、基材3のうちその厚さ方向において表面31から中間層42までの部分を貫通している。図4および図5から理解される通り、複数の表面側カソード貫通配線45aは、基材3の厚さ方向視において複数のカソードパッド41bおよびカソード中継配線42aと重なっている。すなわち、複数の表面側カソード貫通配線45aは、その表面31側の端面が複数のカソードパッド41bによって覆われており、中間層42側の端面がカソード中継配線42aによって覆われている。
The plurality of cathode through
複数の裏面側カソード貫通配線45bは、基材3のうちその厚さ方向において中間層42から裏面32までの部分を貫通している。図5および図6から理解される通り、複数の裏面側カソード貫通配線45bは、基材3の厚さ方向視においてカソード中継配線42aおよびカソード実装電極43bと重なっている。すなわち、複数の裏面側カソード貫通配線45bは、その中間層42側の端面がカソード中継配線42aによって覆われており、裏面32側の端面がカソード実装電極43bによって覆われている。中間層42のカソード中継配線42aを介して、複数の表面側カソード貫通配線45aと複数の裏面側カソード貫通配線45bとは互いに導通している。
The plurality of back-surface-side cathode through
複数のメッキ用カソード貫通配線45cは、基材3をその厚さ方向において全厚アノード貫通配線44aと同じ領域を貫通している。図4および図6から理解される通り、複数のメッキ用カソード貫通配線45cは、基材3の厚さ方向視においてカソードメッキ配線41fおよびカソード実装電極43bの双方に重なっている。すなわち、各メッキ用カソード貫通配線45cは、その表面31側の端面が、カソードメッキ配線41fによって覆われており、裏面32側の端面が、カソード実装電極43bによって覆われている。
The plurality of cathode through
バイパスアノード貫通配線45dは、表面側カソード貫通配線45aと同様に基材3を表面31から中間層42までを貫通している。図4および図5から理解される通り、バイパスアノード貫通配線45dは、基材3の厚さ方向視においてバイパスアノードパッド41dおよびカソード中継配線42aの双方に重なっている。すなわち、バイパスアノード貫通配線45dは、その表面31側の端面が、バイパスアノードパッド41dによって覆われており、中間層42側の端面が、カソード中継配線42aによって覆われている。
The bypass anode through
半導体発光装置A1の光源となる複数のLEDチップ5のそれぞれは、以下のように構成されている。まず、たとえばサファイアからなる基板5a上に、たとえばGaN系半導体からなるn型半導体層5bが積層されている。さらに、n型半導体層5b上に活性層5cが積層されている。活性層5cは、たとえばGaN系半導体からなる複数の層が積層された多重量子井戸構造とされている。p型半導体層5dは、活性層5c上に積層されており、たとえはGaN系半導体からなる。アノード電極5eは、p型半導体層5d上に積層されており、たとえばAl,Au,Ag等の金属からなる。カソード電極5fは、p型半導体層5dおよび活性層5cをエッチングにより取り除くことによって露出したn型半導体層5b上に積層されており、たとえばAl,Au,Ag等の金属からなる。
Each of the plurality of
個々のLEDチップ5は、それぞれが製造されたのちに、上下を反転させたいわゆるフリップチップと称される実装形態で、アノードパッド41aおよびカソードパッド41bに実装されている。詳細には、アノード電極5eは、接合部51を介してアノードパッド41aに接続されており、カソード電極5fは、接合部51を介してカソードパッド41bに接続されている。このような構成のLEDチップ5からは、たとえば青色光が発せられる。
After each
ツェナーダイオード6は、LEDチップ5に過大な逆電圧が印加されることを回避するための機能素子であり、本実施形態においては、バイパスカソードパッド41cにダイボンディングされており、バイパスカソードパッド41cに導通している。またツェナーダイオード6とバイパスアノードパッド41dとは、ワイヤ61によって接続されている。なお、ツェナーダイオード6に代えて、逆電圧印加を回避する機能素子として、バリスタ素子やESD(Electro Static Discharge)保護素子を用いてもよい。
The
封止樹脂7は、ケース2の収容凹部33を埋めており、複数のLEDチップ5を覆っている。封止樹脂7は、透明なエポキシ樹脂またはシリコーン樹脂に蛍光材料が混入された材質からなる。この蛍光材料は、LEDチップ5からの青色光によって励起されることにより、たとえば黄色光を発する。この黄色光と青色光とが混色されることにより、半導体発光装置A1からは白色光が出射される。
The sealing
次に、半導体発光装置A1の作用について説明する。 Next, the operation of the semiconductor light emitting device A1 will be described.
本実施形態によれば、図2および図3に示すように、活性層5cとケース2との間には、基板5aは介在していない。基板5aと比較して、p型半導体層5dはごく薄く、アノード電極5eは、熱伝導率が高い金属からなる。このため、LEDチップ5が点灯したときに発生する熱は、ケース2へと伝わりやすい。したがって、LEDチップ5からの放熱を促進することが可能であり、LEDチップ5の発光効率を高めることができる。
According to the present embodiment, as shown in FIGS. 2 and 3, the
アノードパッド41aは、全厚アノード貫通配線44aを介してアノード実装電極43aにつながっている。このため、LEDチップ5からの熱は、全厚アノード貫通配線44aを通じてアノード実装電極43a、さらには半導体発光装置A1が実装されたたとえば回路基板へと伝えられる。これは、LEDチップ5の放熱を促進し、LEDチップ5の発光効率を高めるのに適している。
The
また、カソードパッド41bは、表面側カソード貫通配線45a、カソード中継配線42a、および裏面側カソード貫通配線45bを介してカソード実装電極43bにつながっている。このため、LEDチップ5からの熱は、表面側カソード貫通配線45a、カソード中継配線42a、および裏面側カソード貫通配線45bを通じてカソード実装電極43b、さらには半導体発光装置A1が実装されたたとえば回路基板へと伝えられる。これは、LEDチップ5の放熱を促進し、LEDチップ5の発光効率を高めるのに適している。
In addition, the
複数のアノード貫通配線44および複数のカソード貫通配線45は、Agからなる。これは、LEDチップ5からの放熱を促進するのに有利である。また、複数のアノード貫通配線44および複数のカソード貫通配線45は、表面31側および裏面32側の端面が、表面層41および裏面層43によって覆われている。表面層41および裏面層43のうち、少なくともこれらの端面を覆う部分は、Auによって形成されている。これにより、比較的変質しやすいAgからなる複数のアノード貫通配線44および複数のカソード貫通配線45を適切に保護することができる。
The plurality of anode through
基材3は、アルミナなどのセラミックからなり、LEDチップ5の材料であるたとえばGaN系半導体と熱膨張率が比較的近似している。このため、LEDチップ5をケース2に実装する作業や、LEDチップ5の発光時などに、LEDチップ5とケース2との間に熱膨張差が生じにくい。これにより、LEDチップ5がケース2から剥離することを防止できる。
The
バイパスカソードパッド41cは、バイパスカソード貫通配線44cを介してアノード実装電極43aにつながっている。これは、LEDチップ5に過大な逆電圧が印加されるのを回避するために、一時的な大電流をスムーズに流すのに適している。
The
図7〜図9を用いて、本発明の第2実施形態について説明する。 A second embodiment of the present invention will be described with reference to FIGS.
同図に示す半導体発光装置A2は、図9の充填部8を備える点において、半導体発光装置A1における構成と主に異なる。具体的には以下のとおりである。 The semiconductor light emitting device A2 shown in the figure mainly differs from the structure of the semiconductor light emitting device A1 in that the semiconductor light emitting device A2 includes the filling portion 8 shown in FIG. The details are as follows.
半導体発光装置A1の説明では省略したが、実際には、アノード貫通配線44やカソード貫通配線45には、基材3の裏面32側に凹む凹部が形成される場合が多い。このような凹部は基材3を焼成する際に形成される。図9に、アノード貫通配線44のうちの全厚アノード貫通配線44aに形成された凹部44hを示している。本実施形態においては、図7、図8に示すように、全厚アノード貫通配線44aに重なる位置に、複数のLEDチップ5がそれぞれ配置されている。
Although omitted in the description of the semiconductor light emitting device A <b> 1, in practice, the anode through
なお、本実施形態においては、一つのLEDチップ5と重なる位置に全厚アノード貫通配線44aが3つ形成されているが、一つのLEDチップ5に重なる全厚アノード貫通配線44aの個数は3つに限られず、1つや2つでもよいし、4つ以上でもよい。全厚アノード貫通配線44aの数が多いと、LEDチップ5からの熱をより効率良くアノード実装電極43aに伝えることができる。このことは、半導体発光装置A2の放熱性向上の観点から好ましい。また、全厚アノード貫通配線44aの数が多いことは、表面層41(アノードパッド41a)とアノード実装電極43aとの間の電気抵抗を減少させるのに適する。
In the present embodiment, three full-thick anode through-
凹部44hを規定する表面は表面層41に覆われている。表面層41は全体にわたってほぼ均一な厚さである。そのため、表面層41にも凹部41hが形成されている。図9に示す凹部41hは、表面層41のうちアノードパッド41aに形成されている。凹部41hは、基材3の裏面32側に凹んでいる。凹部41hは、基材3の厚さ方向視において凹部44hに重なる。そのため、図9では、凹部41hは凹部44hの真上に位置している。なお特に図示しないが、本実施形態において表面層41は、Niよりなる層と、Auよりなる層とが積層された構造を有する。Niよりなる層は、Auよりなる層および基材3の間に介在している。
The surface defining the
充填部8は、凹部41hに充填されている。充填部8は、表面層41および接合部51に接している。充填部8は、導電性の材料よりなっていてもよいし、絶縁性の材料よりなっていてもよい。本実施形態では、充填部8は導電性の材料よりなる。充填部8を構成する導電性の材料としては、たとえば、AuとSnとの合金が挙げられる。充填部8は、LEDチップ5を表面層41に配置する前に形成される。充填部8の形成は、たとえば、凹部41hにペーストを塗布することにより行う。
The filling portion 8 is filled in the
本実施形態においても接合部51は、複数のLEDチップ5のいずれか一つと、表面層41との間に介在している。接合部51は、各LEDチップ5を表面層41に接合するためのものである。接合部51は、導電性の材料よりなっていてもよいし、絶縁性の材料よりなっていてもよい。本実施形態では、接合部51は導電性の材料よりなる。接合部51を構成する導電性の材料としては、たとえば、AuとSnとの合金が挙げられる。本実施形態とは異なり、接合部51を構成する導電性の材料は、銀ペーストやハンダであってもよい。
Also in the present embodiment, the
半導体発光装置A2によると、LEDチップ5を基材3に配置する前に、充填部8を凹部41hに形成することで、LEDチップ5が配置されるべき部位の表面をより平坦にすることができる。そのため、全厚アノード貫通配線44aに基材3の厚さ方向視において重なる位置にLEDチップ5を配置したとしても、LEDチップ5が凹部41hにはまり込まないから、LEDチップ5を配置する際にLEDチップ5の姿勢が崩れることを防止できる。したがって、半導体発光装置A2の製造上の歩留まりの向上を図ることができる。
According to the semiconductor light emitting device A2, the filling portion 8 is formed in the
なお、図9では、アノード貫通配線44に凹部44hが形成されており、表面層41のうちのアノードパッド41aに凹部41hが形成されている例を示した。図9に示したのと異なり、図10に示すように、カソード貫通配線45に凹部45hが形成されており、この凹部45hと基材3の厚さ方向視において重なる位置に凹部41hが形成されている場合も考えられる。この場合に、凹部41hに充填部8を形成し、カソード貫通配線45と基材3の厚さ方向視において重なる位置に、LEDチップを配置してもよい。
Note that FIG. 9 shows an example in which a
図11〜図13は、本発明の第3実施形態に基づく半導体発光装置を示している。本実施形態の半導体発光装置101は、ケース200、複数のLEDチップ500、ツェナーダイオード600、反射樹脂710、および封止樹脂700を備えている。なお、図11においては、理解の便宜上封止樹脂700を省略している。
11 to 13 show a semiconductor light emitting device according to a third embodiment of the present invention. The semiconductor
ケース200は、半導体発光装置101の土台となるものであり、基材300と配線400とを有している。ケース200のサイズは、平面視寸法が5〜10mm角程度、厚さが1.0mm程度とされている。
The
基材300は、平面視略矩形状の厚板状とされており、たとえばアルミナなどのセラミックからなる。本実施形態においては、このセラミックとして、低温同時焼成セラミックと称される、焼成温度が900℃程度と比較的低い材質が用いられている。この低温同時焼成セラミックは、低焼成温度により、配線400の材質となる金属と同時に焼成することが可能である。
The
基材300の中央には、収容凹部303が形成されている。収容凹部303は、複数のLEDチップ500を収容しており、平面視形状が矩形状とされている。基材300の四隅には、コーナー凹部304が形成されている。コーナー凹部304は、半導体発光装置101の製造方法において、セラミック材料を適切分割するために設けられた貫通孔の一部であり、断面四半円形状の溝とされている。基材300は、表面301と裏面302とを有している。収容凹部303の内壁面305は、環状であり、表面301に対して直角である。本実施形態においては、収容凹部303の深さが、たとえば0.6mm程度とされている。
An
基材300は、せき止め凹部306を有している。せき止め凹部306は、表面301から凹んでおり、内壁面305に接している。本実施形態においては、せき止め凹部306は矩形状とされている。
The
配線400は、複数のLEDチップ500に対して直流電力を供給するための経路として用いられるものであり、表面層410、中間層420、裏面層430、複数のアノード貫通配線440、および複数のカソード貫通配線450を有している。
The
表面層410は、複数のアノードパッド411、複数のカソードパッド412、バイパスカソードパッド413、およびバイパスアノードパッド414を含んでいる。表面層410は、たとえばAuからなる。
The
複数のアノードパッド411および複数のカソードパッド412は、LEDチップ500を実装するためのものである。アノードパッド411とカソードパッド412とは隣り合う組として配置されている。本実施形態においては、アノードパッド411とカソードパッド412との組が、5組形成されている。各アノードパッド411は、3本の平行な枝状部分と、これらの枝状部分に対して直角につながる帯状部分と、この帯状部分につながる円形部分とを有している。カソードパッド412は、帯状部分とこの帯状部分につながる円形部分とを有している。
The plurality of
バイパスカソードパッド413とバイパスアノードパッド414は、LEDチップ500に過大な逆電圧が印加されることを回避するためのバイパス機能素子を実装するためのものであり、本実施形態においては、バイパス機能素子としてツェナーダイオード600が実装されている。バイパスカソードパッド413は、円形状とされており、バイパスアノードパッド414は、矩形状部分とこの矩形状部分につながる円形部分とを有している。
The
中間層420は、基材300の厚さ方向において表面301と裏面302とのほぼ中央(表面301から深さ0.2mm程度)に形成されている。中間層420は、カソード中継配線421を含んでいる。
The
図12に示すように、裏面層430は、基材300の裏面302に形成されており、アノード実装電極431とカソード実装電極432とを有している。アノード実装電極431およびカソード実装電極432は、半導体発光装置101をたとえば回路基板などに面実装するために用いられる。本実施形態においては、アノード実装電極431およびカソード実装電極432は、Auからなる。アノード実装電極431は、略矩形状であり、基材300の裏面302の図中右側2/3程度の領域を覆っている。カソード実装電極432は、長矩形状であり、裏面302の図中左側1/4程度の領域を覆っている。
As shown in FIG. 12, the
複数のアノード貫通配線440は、複数の全厚アノード貫通配線441およびバイパスカソード貫通配線443を含んでいる。複数のアノード貫通配線440はそれぞれ、Ag、Ta、もしくはハンダからなり、本実施形態においてはAgからなる。図13に示すように全厚アノード貫通配線441は、基材300を表面301から裏面302までその厚さ方向に貫通している。各全厚アノード貫通配線441は、その表面301側の端面が、アノードパッド411の円形部分によって覆われており、裏面302側の端面が、アノード実装電極431によって覆われている。
The plurality of anode through
バイパスカソード貫通配線443は、全厚アノード貫通配線441と同様に基材300を表面301から裏面302までその厚さ方向に貫通している。バイパスカソード貫通配線443は、その表面301側の端面が、バイパスカソードパッド413によって覆われており、裏面302側の端面が、アノード実装電極431によって覆われている。
The bypass cathode through
複数のカソード貫通配線450は、複数の表面側カソード貫通配線451、複数の裏面側カソード貫通配線(図示略)、およびバイパスアノード貫通配線(図示略)を含んでおり、本実施形態においてはAgからなる。表面側カソード貫通配線451は、基材300のうちその厚さ方向において表面301から中間層420までの部分を貫通している。表面側カソード貫通配線451は、その表面301側の端面が複数のカソードパッド412によって覆われており、中間層420側の端面がカソード中継配線421によって覆われている。前記裏面側カソード貫通配線は、基材300のうちその厚さ方向において中間層420から裏面302までの部分を貫通している。前記裏面側カソード貫通配線は、その中間層420側の端面がカソード中継配線421によって覆われており、裏面302側の端面がカソード実装電極432によって覆われている。中間層420のカソード中継配線421を介して、複数の表面側カソード貫通配線451と前記複数の裏面側カソード貫通配線とは互いに導通している。前記バイパスアノード貫通配線は、表面側カソード貫通配線451と同様に基材300を表面301から中間層420までを貫通している。バイパスアノード貫通配線は、その表面301側の端面が、バイパスアノードパッド414によって覆われており、中間層420側の端面が、カソード中継配線421によって覆われている。
The plurality of cathode through
基材300の最上面には、2つのテスト電極460が形成されている。これらのテスト電極460は、複数のアノードパッド411および複数のカソードパッド412と導通している。半導体発光装置101の製造工程においては、テスト用の電源プローブを2つのテスト電極460に接触させることにより、LEDチップ500の点灯テストを行うことができる。
On the uppermost surface of the
半導体発光装置101の光源となる複数のLEDチップ500のそれぞれは、以下のように構成されている。まず、図14に示すようにたとえばサファイアからなる基板501上に、たとえばGaN系半導体からなるn型半導体層502が積層されている。さらに、n型半導体層502上に活性層503が積層されている。活性層503は、たとえばGaN系半導体からなる複数の層が積層された多重量子井戸構造とされている。p型半導体層504は、活性層503上に積層されており、たとえはGaN系半導体からなる。アノード電極505は、p型半導体層504上に積層されており、たとえばAl,Au,Ag等の金属からなる。カソード電極506は、p型半導体層504および活性層503をエッチングにより取り除くことによって露出したn型半導体層502上に積層されており、たとえばAl,Au,Ag等の金属からなる。
Each of the plurality of
個々のLEDチップ500は、それぞれが製造されたのちに、上下を反転させたいわゆるフリップチップと称される実装形態で、アノードパッド411およびカソードパッド412に実装されている。詳細には、アノード電極505は、接合部510を介してアノードパッド411に接続されており、カソード電極506は、接合部510を介してカソードパッド412に接続されている。このような構成のLEDチップ500からは、たとえば青色光が発せられる。
After each
ツェナーダイオード600は、LEDチップ500に過大な逆電圧が印加されることを回避するためのバイパス機能素子であり、本実施形態においては、バイパスカソードパッド413にダイボンディングされており、バイパスカソードパッド413に導通している。またツェナーダイオード600とバイパスアノードパッド414とは、ワイヤ610によって接続されている。ツェナーダイオード600、バイパスカソードパッド413、およびバイパスアノードパッド414は、せき止め凹部306内に形成されている。なお、ツェナーダイオード600に代えて、逆電圧印加を回避するバイパス機能素子として、バリスタ素子やESD(Electro Static Discharge)保護素子を用いてもよい。
The
反射樹脂710は、たとえばシリコーン樹脂に酸化チタンが混入された材料からなり、鮮やかな白色を呈する。図11および図13に示すように、反射樹脂710は、内縁712、外縁713、および反射面711を有している。内縁712は、複数のLEDチップ500から離間した位置において、これらを囲んでいる。外縁713は、内壁面305と接している。反射面711は、内縁712と外縁713とを繋ぐ面であり、内縁712から外縁713に向かうほど表面301からの高さが高い傾斜面とされている。内縁712は、表面301に接している。また、表面301から外縁713までの高さaは、表面301からLEDチップ500の活性層503までの高さbよりも高い。反射樹脂710は、ツェナーダイオード600、バイパスカソードパッド413、バイパスアノードパッド414、およびワイヤ610を覆っている。内縁712の一部は、せき止め凹部306の端縁の一部と一致している。反射樹脂710は、たとえば適度な粘性を有する樹脂材料を表面301およびせき止め凹部306に付着させることによって形成できる。この樹脂材料の流動および表面張力によって、上述した反射樹脂710の形状が実現される。
The
封止樹脂700は、ケース200の収容凹部303を埋めており、複数のLEDチップ500および反射樹脂710を覆っている。封止樹脂700は、透明なエポキシ樹脂またはシリコーン樹脂に蛍光材料が混入された材質からなる。この蛍光材料は、LEDチップ500からの青色光によって励起されることにより、たとえば黄色光を発する。この黄色光と青色光とが混色されることにより、半導体発光装置101からは白色光が出射される。
The sealing
次に、半導体発光装置101の作用について説明する。
Next, the operation of the semiconductor
本実施形態によれば、図13に示すように、LEDチップ500と内壁面305との間には、反射面711が存在する。反射面711は、LEDチップ500側の内縁712から内壁面305と接する外縁713に向かって、表面301からの高さが徐々に高くなるように傾斜している。これにより、LEDチップ500から側方に出射した光を図中上方へと適切に向かわせることができる。また、反射面711は、収容凹部303内に設けた反射樹脂710によって構成されている。このため、反射樹脂710を設けることによっては、ケース200のサイズを大きくする必要がない。したがって、半導体発光装置101の高輝度化と小型化とを図ることができる。
According to the present embodiment, as shown in FIG. 13, the
反射樹脂710は、基材300の材料であるセラミックよりも反射率が高い材料からなる。これにより、LEDチップ500からの光が反射面711によって反射されるときの減衰を抑制することができる。反射樹脂710の材料として、白色樹脂を用いることは、反射による減衰を抑制するのに好適である。
The
活性層503は、LEDチップ500における発光部位である。図13および図15に示すように、表面301から外縁713までの高さaは、表面301から活性層503までの高さbよりも高い。このため、活性層503から側方に出射された光の正面には、反射面711が位置している。したがって、活性層503から側方に出射された光を上方へと効率よく反射することができる。
The
内壁面305が表面301に対して直角であることは、ケース200の小型化に有利である。
The fact that the
一般的に、ツェナーダイオード600は、白色樹脂からなる反射樹脂710と比べてより多くの光を吸収する。このツェナーダイオード600を反射樹脂710によって覆うことにより、LEDチップ500からの光がツェナーダイオード600に吸収されることを防止可能であり、半導体発光装置101の高輝度化をさらに促進することができる。せき止め凹部306にツェナーダイオード600を配置することにより、反射樹脂710を形成する際に、液状あるいはペースト状の樹脂材料をせき止め凹部306に付着させると、この樹脂材料によってツェナーダイオード600を適切に覆いつつ、内縁712がせき止め凹部306の端縁を超えることを表面張力によって回避することができる。これは、高輝度化を図る一方、反射樹脂710がLEDチップ500のたとえば活性層503に付着してしまうことを防止するのに適している。
Generally, the
図15〜図22は、本発明の他の実施形態を示している。なお、これらの図において、前記実施形態と同一または類似の要素には、前記実施形態と同一の符号を付している。 15 to 22 show another embodiment of the present invention. In these drawings, the same or similar elements as those of the above-described embodiment are denoted by the same reference numerals as those of the above-described embodiment.
図15および図16は、本発明の第4実施形態に基づく半導体発光装置を示している。本実施形態の半導体発光装置102は、せき止め凹部306の構成が上述した実施形態と異なっている。
FIGS. 15 and 16 show a semiconductor light emitting device according to a fourth embodiment of the present invention. The semiconductor
本実施形態においては、せき止め凹部306は、包囲部307および突出部308を有している。包囲部307は、内壁面305に沿った環状であり、複数のLEDチップ500を囲んでいる。突出部308は、包囲部307から互いに隣り合うLEDチップ500どうしの間に突出している。突出部308の先端よりもケース200の中央寄り領域には、1つのLEDチップ500が配置されている。
In the present embodiment, the
本実施形態においては、反射樹脂710の内縁712すべてが、せき止め凹部306の端縁と一致している。すなわち、反射樹脂710は、表面301から退避した位置に設けられている。
In the present embodiment, the entire
このような実施形態によっても、半導体発光装置102の高輝度化と小型化をと図ることができる。また、せき止め凹部306に包囲部307を設けることにより、反射樹脂710の内縁712をLEDチップ500に対してより近い位置に設けるとともに、反射樹脂710を形成する際に誤ってLEDチップ500に樹脂材料が付着してしまうことを防止することができる。突出部308を設けることにより、隣り合うLEDチップ500どうしに挟まれたスペースに、反射樹脂710を適切に形成することができる。反射面711のうち突出部308によって延長された部分は、中央に位置するLEDチップ500からの光を効率よく反射することができる。
According to such an embodiment, the semiconductor
図17および図18は、本発明の第5実施形態に基づく半導体発光装置を示している。本実施形態の半導体発光装置103は、主にLEDチップ500の構成が上述した実施形態と異なっている。本実施形態においては、図19に示すように、LEDチップ500は、アノード電極505およびカソード電極506が上面側に形成されている。そして、これらのアノード電極505およびカソード電極506にワイヤ550が接続されている。このようなLEDチップ500は、いわゆる2ワイヤタイプと称される。
17 and 18 show a semiconductor light emitting device according to a fifth embodiment of the present invention. The semiconductor
図17に示すように、収容凹部303は、平面視円形状である。表面301には、複数のダイボンディングパッド417が形成されている。ダイボンディングパッド417には、LEDチップ500がダイボンディングされている。複数のダイボンディングパッド417を挟んで、複数のアノードパッド411と複数のカソードパッド412が配置されている。各アノードパッド411および各カソードパッド412には、ワイヤ550が接続されている。
As shown in FIG. 17, the
反射樹脂710は、複数のアノードパッド411および複数のカソードパッド412を覆っている。また、ワイヤ550は、複数のアノードパッド411および複数のカソードパッド412側の部分が反射樹脂710によって覆われている。内縁712は、複数のLEDチップ500および複数のダイボンディングパッド417から離間した位置においてこれらを囲んでいる。ツェナーダイオード600、ワイヤ610も、反射樹脂710に覆われている。
The
このような実施形態によっても、半導体発光装置103の高輝度化と小型化をと図ることができる。また、アノードパッド411およびカソードパッド412は、LEDチップ500に対して外側に配置されている。このため、2ワイヤタイプであるLEDチップ500に接続されたワイヤ550は、いずれもLEDチップ500に対して外側に延びる。ワイヤ550のうちアノードパッド411およびカソードパッド412にボンディングされた部分およびその近傍部分は、反射樹脂710を形成する際に、表面張力によって樹脂材料を引き寄せる機能を果たす。これにより、樹脂材料をLEDチップ500に対して外側に滞留させることができる。
According to such an embodiment as well, it is possible to achieve high brightness and small size of the semiconductor
図20および図21は、本発明の第6実施形態に基づく半導体発光装置を示している。本実施形態の半導体発光装置104は、主に、ケース200の全体構成、LEDチップ500の構造が、上述した実施形態と異なっている。
FIGS. 20 and 21 show a semiconductor light emitting device according to the sixth embodiment of the present invention. The semiconductor
本実施形態においては、図22に示すように、LEDチップ500は、たとえばSiからなるサブマウント基板507と、基板501、たとえばGaNからなるn型半導体層502、活性層503およびp型半導体層504が積層された半導体層とを有する構造とされており、たとえば青色光を発する。前記半導体層には、サブマウント基板507側にアノード電極505およびカソード電極506が形成されている。これらのアノード電極505およびカソード電極506は、サブマウント基板507に形成された配線パターン(図示略)に導電性ペースト511によって接合されている。サブマウント基板507には2つの電極(図示略)が形成されている。これらの電極には、2つのワイヤ550それぞれの一端がボンディングされている。図20および図21に示すように、一方のワイヤ550の他端は、アノードパッド411にボンディングされており、他方のワイヤ550の他端は、カソードパッド412にボンディングされている。
In the present embodiment, as shown in FIG. 22, the
基材300は、平面視長矩形状とされており、収容凹部303も長矩形状である。本実施形態においては、内壁面305が表面301と直角である方向に対して傾いている。反射樹脂710は、表面301のうちLEDチップ500のサブマウント基板507が接合された部分以外の領域を覆っている。反射樹脂710の内縁712は、サブマウント基板507に接している。アノードパッド411は、収容凹部303のほとんどを占める平面視寸法とされている。複数のLEDチップ500は、アノードパッド411にダイボンディングされている。ツェナーダイオード600、およびワイヤ610は、反射樹脂710に覆われている。なお、サブマウント基板507に、本発明でいうバイパス機能素子が作りこまれた構成としてもよい。
The
基材300の側面には、アノード側面配線461およびカソード側面配線462が形成されている。アノード側面配線461は、アノードパッド411とアノード実装電極431とに繋がっている。カソード側面配線462は、カソードパッド412とカソード実装電極432とに繋がっている。
An anode
このような実施形態によっても、半導体発光装置104の高輝度化と小型化とを図ることができる。収容凹部303内のほとんどを反射樹脂710によって覆うことにより、高輝度化をより促進することができる。サブマウント基板507は、表面301から確実に盛り上がった部位となっている。これにより、反射樹脂710を形成する際に、樹脂材料が活性層503へとはみ出ることを抑制することができる。サブマウント基板507は発光する部位ではないため、半導体発光装置104の高輝度化を阻害することはない。
According to such an embodiment, the semiconductor
なお、半導体発光装置104の変形例として、配線400がたとえばCuやFeおよびこれらの合金からなる板状のリードによって形成された構成としてもよい。具体的には、カソードパッド412、カソード側面配線462、およびカソード実装電極432に相当する部位を有するリードと、アノードパッド411、アノード側面配線461、アノード実装電極431に相当する部位を有するリードとを用いる。また、この変形例においては、基材300のうち内壁面305を構成する部分を熱硬化性樹脂または熱可塑性樹脂によって形成することが好ましい。
Note that, as a modified example of the semiconductor
図23〜図25を用いて、本発明の第7実施形態について説明する。 A seventh embodiment of the present invention will be described with reference to FIGS.
同図に示す半導体発光装置105は、図25の充填部800を備える点において、半導体発光装置101における構成と主に異なる。具体的には以下のとおりである。
The semiconductor
半導体発光装置101の説明では省略したが、実際には、アノード貫通配線440やカソード貫通配線450には、基材300の裏面302側に凹む凹部が形成される場合が多い。このような凹部は基材300を焼成する際に形成される。図25に、アノード貫通配線440のうちの全厚アノード貫通配線441に形成された凹部449を示している。本実施形態においては、図23、図24に示すように、全厚アノード貫通配線441に重なる位置に、複数のLEDチップ500がそれぞれ配置されている。
Although omitted in the description of the semiconductor
なお、本実施形態においては、一つのLEDチップ500と重なる位置に全厚アノード貫通配線441が3つ形成されているが、一つのLEDチップ500に重なる全厚アノード貫通配線441の個数は3つに限られず、1つや2つでもよいし、4つ以上でもよい。全厚アノード貫通配線441の数が多いと、LEDチップ500からの熱をより効率良くアノード実装電極431に伝えることができる。このことは、半導体発光装置105の放熱性向上の観点から好ましい。また、全厚アノード貫通配線441の数が多いことは、表面層410(アノードパッド411)とアノード実装電極431との間の電気抵抗を減少させるのに適する。
In the present embodiment, three full-thick anode through
凹部449を規定する表面は表面層410に覆われている。表面層410は全体にわたってほぼ均一な厚さである。そのため、表面層410にも凹部419が形成されている。図25に示す凹部419は、表面層410のうちアノードパッド411に形成されている。凹部419は、基材300の裏面302側に凹んでいる。凹部419は、基材300の厚さ方向視において凹部449に重なる。そのため図25では、凹部419は凹部449の真上に位置している。なお特に図示しないが、本実施形態において表面層410は、Niよりなる層と、Auよりなる層とが積層された構造を有する。Niよりなる層は、Auよりなる層および基材300の間に介在している。
The surface defining the
充填部800は凹部419に充填されている。充填部800は、表面層410および接合部510に接している。充填部800は、導電性の材料よりなっていてもよいし、絶縁性の材料よりなっていてもよい。本実施形態では、充填部800は導電性の材料よりなる。充填部800を構成する導電性の材料としては、たとえば、AuとSnとの合金が挙げられる。充填部800は、接合部510を介してLEDチップ500を表面層410に配置する前に形成される。充填部800の形成は、たとえば、凹部419にペーストを塗布することにより行う。
The filling
本実施形態においても接合部510は、複数のLEDチップ500のいずれか一つと、表面層410との間に介在している。接合部510は、各LEDチップ500を表面層410に接合するためのものである。接合部510は、導電性の材料よりなっていてもよいし、絶縁性の材料よりなっていてもよい。本実施形態では、接合部510は導電性の材料よりなる。接合部510を構成する導電性の材料としては、たとえば、AuとSnとの合金が挙げられる。本実施形態とは異なり、接合部510を構成する導電性の材料は、銀ペーストやハンダであってもよい。
Also in the present embodiment, the
半導体発光装置105によると、LEDチップ500を基材300に配置する前に、充填部800を凹部419に形成することで、LEDチップ500が配置されるべき部位の表面をより平坦にすることができる。そのため、全厚アノード貫通配線441に基材300の厚さ方向視において重なる位置にLEDチップ500を配置したとしても、LEDチップ500が凹部419にはまり込まないから、LEDチップ500を配置する際にLEDチップ500の姿勢が崩れることを防止できる。したがって、半導体発光装置105の製造上の歩留まりの向上を図ることができる。
According to the semiconductor
なお、図25では、アノード貫通配線440に凹部449が形成されており、表面層410のうちのアノードパッド411に凹部419が形成されている例を示した。図25に示したのと異なり、図26に示すように、カソード貫通配線450に凹部459が形成されており、この凹部459と基材300の厚さ方向視において重なる位置に凹部419が形成されている場合も考えられる。この場合に、凹部419に充填部800を形成し、カソード貫通配線450と基材300の厚さ方向視において重なる位置に、LEDチップ500を配置してもよい。
FIG. 25 shows an example in which a
また、半導体発光装置102や103にて半導体発光装置105の構成を採用してもよい。
Further, the configuration of the semiconductor
本発明にかかる半導体発光装置は、上述した実施形態に限定されるものではない。本発明にかかる半導体発光装置の各部の具体的な構成は、種々に設計変更自在である。 The semiconductor light emitting device according to the present invention is not limited to the above embodiment. The specific configuration of each part of the semiconductor light emitting device according to the present invention can be variously changed in design.
複数のLEDチップの個数は、5個に限定されず、いずれの個数であってもよい。 The number of the plurality of LED chips is not limited to five, and may be any number.
A1,A2:半導体発光装置
2:ケース
3:基材
31:表面
32:裏面
33:収容凹部
34:コーナー凹部
4:配線
41:表面層
41a:アノードパッド
41b:カソードパッド
41c:バイパスカソードパッド
41d:バイパスアノードパッド
41e:アノードメッキ配線
41f:カソードメッキ配線
41h:凹部(第2凹部)
42:中間層
42a:カソード中継配線
43:裏面層
43a:アノード実装電極
43b:カソード実装電極
44:アノード貫通配線
44a:全厚アノード貫通配線
44b:メッキ用アノード貫通配線
44c:バイパスカソード貫通配線
44h:凹部(第1凹部)
45:カソード貫通配線
45a:表面側カソード貫通配線
45b:裏面側カソード貫通配線
45c:メッキ用カソード貫通配線
45d:バイパスアノード貫通配線
45h:凹部(第1凹部)
5:LEDチップ
5a:基板
5b:n型半導体層
5c:活性層
5d:p型半導体層
5e:アノード電極
5f:カソード電極
51:接合部
6:ツェナーダイオード
61:ワイヤ
7:封止樹脂
8:充填部
9:半導体発光装置
91:基材
92:リード
93:LEDチップ
94:半導体層
95:サブマウント基板
96:ワイヤ
97:封止樹脂
a,b:高さ
101,102,103,104,105:半導体発光装置
200:ケース
300:基材
301:表面
302:裏面
303:収容凹部
304:コーナー凹部
305:内壁面
306:せき止め凹部
307:包囲部
308:突出部
400:配線
410:表面層
411:アノードパッド
412:カソードパッド
413:バイパスカソードパッド
414:バイパスアノードパッド
417:ダイボンディングパッド
419:凹部(第2凹部)
420:中間層
421:カソード中継配線
430:裏面層
431:アノード実装電極
432:カソード実装電極
440:アノード貫通配線
441:全厚アノード貫通配線
443:バイパスカソード貫通配線
449:凹部(第1凹部)
450:カソード貫通配線
451:表面側カソード貫通配線
459:凹部(第1凹部)
460:テスト電極
461:アノード側面配線
462:カソード側面配線
500:LEDチップ
501:基板
502:n型半導体層
503:活性層
504:p型半導体層
505:アノード電極
506:カソード電極
507:サブマウント基板
510:接合部
511:導電性ペースト
550:ワイヤ
600:ツェナーダイオード(バイパス機能素子)
610:ワイヤ
700:封止樹脂
710:反射樹脂
711:反射面
712:内縁
713:外縁
800:充填部
A1, A2: Semiconductor light emitting device 2: Case 3: Base material 31: Front surface 32: Back surface 33: Housing recess 34: Corner recess 4: Wiring 41:
42:
45: cathode through
5:
420: Intermediate layer 421: Cathode relay wiring 430: Backside layer 431: Anode mounting electrode 432: Cathode mounting electrode 440: Anode through wiring 441: Full thickness anode through wiring 443: Bypass cathode through wiring 449: Concave (first concave)
450: cathode through wiring 451: front side cathode through wiring 459: recess (first recess)
460: Test electrode 461: Anode side wiring 462: Cathode side wiring 500: LED chip 501: Substrate 502: N-type semiconductor layer 503: Active layer 504: P-type semiconductor layer 505: Anode electrode 506: Cathode electrode 507: Submount substrate 510: bonding part 511: conductive paste 550: wire 600: zener diode (bypass functional element)
610: wire 700: sealing resin 710: reflective resin 711: reflective surface 712: inner edge 713: outer edge 800: filling portion
Claims (15)
前記表面に形成された第1導電部と、
前記表面に形成された第2導電部と、
前記基板の内部に形成され、かつ前記第1導電部につながる第3導電部と、
前記基板の内部に形成され、かつ前記第2導電部につながる第4導電部と、
前記底面に形成され、かつ前記第3導電部を介して前記第1導電部に導通する第5導電部と、
前記底面に形成され、かつ前記第4導電部を介して前記第2導電部に導通する第6導電部と、
前記表面に対向する裏面と、前記裏面に形成され、かつ前記第1導電部に電気的に接合されたアノード電極と、前記裏面に形成され、かつ前記第2導電部に電気的に接合されたカソード電極と、を有するとともに、前記表面に搭載されたLEDチップと、を備え、
前記第3導電部と、前記第4導電部の一部と、が、前記側面に対して平行に沿って形成されていることを特徴とする、半導体発光装置。 A substrate having a surface and a bottom surface facing each other in the thickness direction, and a side surface connected to the surface and the bottom surface,
A first conductive portion formed on the surface;
A second conductive portion formed on the surface;
A third conductive portion formed inside the substrate and connected to the first conductive portion;
A fourth conductive portion formed inside the substrate and connected to the second conductive portion;
A fifth conductive portion formed on the bottom surface and electrically connected to the first conductive portion via the third conductive portion;
A sixth conductive portion formed on the bottom surface and electrically connected to the second conductive portion via the fourth conductive portion;
A back surface facing the front surface, an anode electrode formed on the back surface and electrically connected to the first conductive portion, and an anode electrode formed on the back surface and electrically connected to the second conductive portion; Having a cathode electrode, and an LED chip mounted on the surface,
The semiconductor light emitting device according to claim 1, wherein the third conductive portion and a part of the fourth conductive portion are formed parallel to the side surface.
前記封止樹脂は、前記表面に形成され、かつ前記LEDチップを覆うとともに、前記LEDチップから発せられる光を透過する、請求項1に記載の半導体発光装置。 Further comprising a sealing resin,
2. The semiconductor light emitting device according to claim 1, wherein the sealing resin is formed on the surface, covers the LED chip, and transmits light emitted from the LED chip.
前記反射樹脂は、前記厚さ方向に対して直交する方向において前記LEDチップから離れるほど、前記表面から徐々に遠ざかるように傾斜している、請求項2に記載の半導体発光装置。 Further comprising a reflective resin located between the surface and the sealing resin,
The semiconductor light emitting device according to claim 2, wherein the reflection resin is gradually inclined away from the surface as the reflection resin is away from the LED chip in a direction orthogonal to the thickness direction.
前記第1部の厚さは、前記第2部の厚さと異なる、請求項2ないし4のいずれかに記載の半導体発光装置。 The sealing resin has a first part that covers the LED chip, and a second part that covers the first conductive part,
The semiconductor light emitting device according to claim 2, wherein a thickness of the first part is different from a thickness of the second part.
前記厚さ方向に沿って視て、前記第4導電部は、前記LEDチップに重なる部分を含む、請求項1ないし8のいずれかに記載の半導体発光装置。 Seen along the thickness direction, the third conductive portion is located outside the LED chip,
The semiconductor light emitting device according to claim 1, wherein the fourth conductive portion includes a portion overlapping the LED chip when viewed along the thickness direction.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2021205852A JP7212753B2 (en) | 2010-11-05 | 2021-12-20 | semiconductor light emitting device |
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2010248494 | 2010-11-05 | ||
JP2010248494 | 2010-11-05 | ||
JP2010292644 | 2010-12-28 | ||
JP2010292644 | 2010-12-28 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017206034A Division JP2018050058A (en) | 2010-11-05 | 2017-10-25 | Semiconductor light-emitting apparatus |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2021205852A Division JP7212753B2 (en) | 2010-11-05 | 2021-12-20 | semiconductor light emitting device |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2019216250A true JP2019216250A (en) | 2019-12-19 |
Family
ID=55973307
Family Applications (4)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016024289A Pending JP2016086191A (en) | 2010-11-05 | 2016-02-12 | Semiconductor light-emitting device |
JP2017206034A Pending JP2018050058A (en) | 2010-11-05 | 2017-10-25 | Semiconductor light-emitting apparatus |
JP2019137545A Pending JP2019216250A (en) | 2010-11-05 | 2019-07-26 | Semiconductor light-emitting device |
JP2021205852A Active JP7212753B2 (en) | 2010-11-05 | 2021-12-20 | semiconductor light emitting device |
Family Applications Before (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016024289A Pending JP2016086191A (en) | 2010-11-05 | 2016-02-12 | Semiconductor light-emitting device |
JP2017206034A Pending JP2018050058A (en) | 2010-11-05 | 2017-10-25 | Semiconductor light-emitting apparatus |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2021205852A Active JP7212753B2 (en) | 2010-11-05 | 2021-12-20 | semiconductor light emitting device |
Country Status (1)
Country | Link |
---|---|
JP (4) | JP2016086191A (en) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7197646B1 (en) | 2021-07-28 | 2022-12-27 | 聯嘉光電股▲ふん▼有限公司 | Vertical light emitting diode chip package with electrical sensing position |
JP7197645B1 (en) | 2021-07-28 | 2022-12-27 | 聯嘉光電股▲ふん▼有限公司 | Light emitting diode package with multiple test terminals and parallel connection components |
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2016
- 2016-02-12 JP JP2016024289A patent/JP2016086191A/en active Pending
-
2017
- 2017-10-25 JP JP2017206034A patent/JP2018050058A/en active Pending
-
2019
- 2019-07-26 JP JP2019137545A patent/JP2019216250A/en active Pending
-
2021
- 2021-12-20 JP JP2021205852A patent/JP7212753B2/en active Active
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Also Published As
Publication number | Publication date |
---|---|
JP7212753B2 (en) | 2023-01-25 |
JP2016086191A (en) | 2016-05-19 |
JP2018050058A (en) | 2018-03-29 |
JP2022033187A (en) | 2022-02-28 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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