JP2017042009A - チャージポンプ回路 - Google Patents
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Abstract
Description
再びクロック信号CLKがLレベルとなり、反転クロック信号xCLKがHレベルとなると、点Bの電位は3×VDD−2×Vfとなり、ダイオードD3が容量素子C2の電荷を容量素子C3に転送して点Cの電位は3×VDD−3×Vfとなる。
なお、ダイオードD1〜Dnは、ゲートとドレインを接続しダイオード接続されたMOSトランジスタで構成されることも多い。その場合、MOSトランジスタのしきい値電圧をVthとすると、出力端子VOUTに得られる昇圧電圧はn×VDD−n×Vthとなる。
請求項2にかかる発明は、請求項1に記載のチャージポンプ回路において、入力端子と出力端子との間に直列に接続された複数のトランジスタは、MOSトランジスタで構成されていることを特徴とする。
請求項3にかかる発明は、請求項2に記載のチャージポンプ回路において、入力端子側からみて1段目のトランジスタは、バックゲートに入力電圧が印加されるように結線されていることを特徴とする。
請求項4にかかる発明は、請求項1乃至請求項3のいずれか1項に記載のチャージポンプ回路において、入力端子と出力端子との間に直列に接続された複数のトランジスタのうち、前記エンハンスメント型のトランジスタをダイオードに代えたことを特徴とする。
再びクロック信号CLKがLレベル、反転クロック信号xCLKがHレベルとなると、点Bの電位は3×VDD−Vthとなり、3段目のエンハンスメント型NチャネルMOSトランジスタM3が容量素子C2の電荷を容量素子C3に転送して、点Cの電位は3×VDD−2×Vthとなる。
M2〜Mn:エンハンスメント型のトランジスタ
C1〜Cn:容量素子
D1〜Dn:ダイオード
VIN:入力端子
VOUT:出力端子
Claims (4)
- 入力電圧を昇圧するチャージポンプ回路において、
入力端子と出力端子との間に直列に接続された複数のトランジスタと、
1段目のトランジスタのドレイン又はソースに入力電圧が印加され、前記トランジスタのソース又はドレインにそれぞれ一方の端子を接続し、他方の端子にはクロック信号が印加される容量素子を複数備え、
前記トランジスタは、入力端子側からみて1段目のトランジスタはデプレッション型で、後段のトランジスタはエンハンスメント型であり、
前記入力端子側からみて1段目のトランジスタのゲートと、入力端子側からみて偶数番目の前記容量素子の前記他方の端子に互いに逆相関係のクロック信号の一方の信号が印加され、入力端子側からみて奇数番目の前記容量素子の前記他方の端子に前記互いに逆相関係のクロック信号の他方の信号が印加されるように構成され、
前記エンハンスメント型のトランジスタはそれぞれダイオード接続されていることを特徴とするチャージポンプ回路。 - 請求項1に記載のチャージポンプ回路において、
前記入力端子と出力端子との間に直列に接続された複数のトランジスタは、MOSトランジスタで構成されていることを特徴とするチャージポンプ回路。 - 請求項2に記載のチャージポンプ回路において、
前記入力端子側からみて1段目のトランジスタは、バックゲートに入力電圧が印加されるように結線されていることを特徴とするチャージポンプ回路。 - 請求項1乃至請求項3のいずれか1項に記載のチャージポンプ回路において、
前記入力端子と出力端子との間に直列に接続された複数のトランジスタのうち、前記エンハンスメント型のトランジスタをダイオードに代えたことを特徴とするチャージポンプ回路。
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