JP2001202050A - 駆動回路および表示装置 - Google Patents

駆動回路および表示装置

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JP2001202050A JP2000160080A JP2000160080A JP2001202050A JP 2001202050 A JP2001202050 A JP 2001202050A JP 2000160080 A JP2000160080 A JP 2000160080A JP 2000160080 A JP2000160080 A JP 2000160080A JP 2001202050 A JP2001202050 A JP 2001202050A
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Abstract

(57)【要約】 【課題】 不要な高周波の電磁波の輻射を抑制すること
ができる駆動回路および表示装置を提供する。 【解決手段】 トランジスタＱ１，Ｑ２のドレイン・ソ
ース間にコンデンサＣ１，Ｃ２を並列に接続してトラン
ジスタＱ１，Ｑ２のドレイン・ソース間の全容量を増加
させ、配線Ｌ１，Ｌ２のインダクタンス成分とトランジ
スタＱ１，Ｑ２のドレイン・ソース間の容量ＣＰ１，Ｃ
Ｐ２およびコンデンサＣ１，Ｃ２とによるＬＣ共振の共
振周波数を低減する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、駆動パルスにより
容量性負荷を駆動するための駆動回路およびこの駆動回
路を用いた表示装置に関するものである。
【０００２】
【従来の技術】容量性負荷を駆動する従来の駆動回路と
しては、例えば、プラズマディスプレイパネルのサステ
イン電極を駆動するサステインドライバが知られてい
る。
【０００３】図１３は、従来のサステインドライバの構
成を示す回路図である。図１３に示すように、サステイ
ンドライバ４００は、回収コンデンサＣ１１、回収コイ
ルＬ１１、スイッチＳＷ１１，ＳＷ１２，ＳＷ２１，Ｓ
Ｗ２２およびダイオードＤ１１，Ｄ１２を含む。
【０００４】スイッチＳＷ１１は、電源端子Ｖ４とノー
ドＮ１１との間に接続され、スイッチＳＷ１２は、ノー
ドＮ１１と接地端子との間に接続されている。電源端子
Ｖ４には、電圧Ｖｓｕｓが印加される。ノードＮ１１
は、例えば４８０本のサステイン電極に接続され、図１
３では、複数のサステイン電極と接地端子との間の全容
量に相当するパネル容量Ｃｐが示されている。
【０００５】回収コンデンサＣ１１は、ノードＮ１３と
接地端子との間に接続されている。ノードＮ１３とノー
ドＮ１２との間にスイッチＳＷ２１およびダイオードＤ
１１が直列に接続され、ノードＮ１２とノードＮ１３と
の間にダイオードＤ１２およびスイッチＳＷ２２が直列
に接続されている。回収コイルＬ１１は、ノードＮ１２
とノードＮ１１との間に接続されている。
【０００６】図１４は、図１３のサステインドライバ４
００の維持期間の動作を示すタイミング図である。図１
４には、図１３のノードＮ１１の電圧およびスイッチＳ
Ｗ２１，ＳＷ１１，ＳＷ２２，ＳＷ１２の動作が示され
る。
【０００７】まず、期間Ｔａにおいて、スイッチＳＷ２
１がオンし、スイッチＳＷ１２がオフする。このとき、
スイッチＳＷ１１，ＳＷ２２はオフしている。これによ
り、回収コイルＬ１１およびパネル容量ＣｐによるＬＣ
共振により、ノードＮ１１の電圧が緩やかに上昇する。
次に、期間Ｔｂにおいて、スイッチＳＷ２１がオフし、
スイッチＳＷ１１がオンする。これにより、ノードＮ１
１の電圧が急激に上昇し、期間ＴｃではノードＮ１１の
電圧がＶｓｕｓに固定される。
【０００８】次に、期間Ｔｄでは、スイッチＳＷ１１が
オフし、スイッチＳＷ２２がオンする。これにより、回
収コイルＬ１１およびパネル容量ＣｐによるＬＣ共振に
より、ノードＮ１１の電圧が緩やかに降下する。その
後、期間Ｔｅにおいて、スイッチＳＷ２２がオフし、ス
イッチＳＷ１２がオンする。これにより、ノードＮ１１
の電圧が急激に降下し、接地電位に固定される。上記の
動作を維持期間において繰り返し行うことにより、複数
のサステイン電極に周期的な維持パルスＰｓｕが印加さ
れる。
【０００９】上記のように、維持パルスＰｓｕの立ち上
がり部分および立ち下がり部分は、スイッチＳＷ２１ま
たはスイッチＳＷ２２の動作による期間Ｔａ，ＴｄのＬ
Ｃ共振部とスイッチＳＷ１１またはスイッチＳＷ１２の
オン動作による期間Ｔｂ，Ｔｅのエッジ部ｅ１，ｅ２と
で構成されている。
【００１０】
【発明が解決しようとする課題】上記のスイッチＳＷ１
１，ＳＷ１２，ＳＷ２１，ＳＷ２２は、通常、スイッチ
ング素子であるＦＥＴ（電界効果型トランジスタ）によ
り構成され、各ＦＥＴは寄生容量としてドレイン・ソー
ス間に容量を有し、各ＦＥＴに接続される配線は、イン
ダクタンス成分を有している。このため、スイッチＳＷ
１１等がオフからオンへ変化するときに、ドレイン・ソ
ース間の容量と配線のインダクタンス成分とによりＬＣ
共振が発生し、このＬＣ共振により不要な電磁波が輻射
される。
【００１１】また、上記の各ダイオードＤ１１，Ｄ１２
も、寄生容量としてアノード・カソード間に容量を有
し、各ダイオードに接続される配線も、インダクタンス
成分を有している。このため、スイッチＳＷ１１等がオ
フからオンへ変化するときに、アノード・カソード間の
容量と配線のインダクタンス成分とによりＬＣ共振が発
生し、このＬＣ共振により不要な電磁波が輻射される。
【００１２】さらに、各ＦＥＴのドレイン・ソース間の
容量および各ダイオードのアノード・カソード間の容量
と各配線のインダクタンス成分とが小さいため、ＬＣ共
振の共振周波数が高くなり、発生する電磁波の周波数も
高くなる。一方、電気用品取締法による不要輻射の規格
では、３０ＭＨｚ以上の高周波の電磁波に対する限度値
が定められている。したがって、このような高周波の電
磁波の輻射は、他の電子機器に電磁的な悪影響を及ぼす
恐れがあるため、この不要な高周波の電磁波の輻射を抑
制することが望まれる。
【００１３】本発明の目的は、不要な高周波の電磁波の
輻射を抑制することができる駆動回路およびその駆動回
路を用いた表示装置を提供することである。
【００１４】
【課題を解決するための手段】（１）第１の発明 第１の発明に係る駆動回路は、駆動パルスを出力して容
量性負荷を駆動するための駆動回路であって、駆動パル
スを容量性負荷に供給するためのパルス供給経路に接続
される電気素子と、電気素子に接続される配線手段と、
電気素子の寄生容量と配線手段のインダクタンス成分と
のＬＣ共振の共振周波数を低減する周波数低減手段とを
備えるものである。
【００１５】本発明に係る駆動回路は、駆動パルスを容
量性負荷に供給するためのパルス供給経路に接続される
電気素子の寄生容量と配線手段のインダクタンス成分と
のＬＣ共振の共振周波数を低減しているので、ＬＣ共振
により発生される電磁波の周波数を低減することがで
き、不要な高周波の電磁波の輻射を抑制することができ
る。
【００１６】（２）第２の発明 第２の発明に係る駆動回路は、第１の発明に係る駆動回
路の構成において、電気素子は、容量性負荷に駆動パル
スを印加するためのスイッチング手段を含むものであ
る。
【００１７】この場合、容量性負荷に駆動パルスを印加
するためのスイッチング手段の寄生容量と配線手段のイ
ンダクタンス成分とのＬＣ共振の共振周波数を低減して
いるので、ＬＣ共振により発生される電磁波の周波数を
低減することができ、不要な高周波の電磁波の輻射を抑
制することができる。
【００１８】（３）第３の発明 第３の発明に係る駆動回路は、第２の発明に係る駆動回
路の構成において、容量性負荷は、複数の電極を有する
放電セルを含み、スイッチング手段は、放電セルを点灯
させる維持期間において容量性負荷に維持パルスを印加
するための維持パルス用スイッチング手段を含むもので
ある。
【００１９】この場合、放電セルを点灯させる維持期間
において容量性負荷に維持パルスを印加するための維持
パルス用スイッチング手段の寄生容量と配線手段のイン
ダクタンス成分とのＬＣ共振の共振周波数を低減してい
るので、維持期間においてＬＣ共振により発生される電
磁波の周波数を低減することができ、不要な高周波の電
磁波の輻射を抑制することができる。
【００２０】（４）第４の発明 第４の発明に係る駆動回路は、第２の発明に係る駆動回
路の構成において、容量性負荷は、複数の電極を有する
放電セルを含み、スイッチング手段は、放電セルの電極
の壁電荷を調整する初期化期間において容量性負荷に初
期化パルスを印加するための初期化パルス用スイッチン
グ手段を含むものである。
【００２１】この場合、放電セルの電極の壁電荷を調整
する初期化期間において容量性負荷に初期化パルスを印
加するための初期化パルス用スイッチング手段の寄生容
量と配線手段のインダクタンス成分とのＬＣ共振の共振
周波数を低減しているので、初期化パルスを印加する駆
動回路でも、維持期間においてＬＣ共振により発生され
る電磁波の周波数を低減することができ、不要な高周波
の電磁波の輻射を抑制することができる。
【００２２】（５）第５の発明 第５の発明に係る駆動回路は、第２〜第４のいずれかの
発明に係る駆動回路の構成において、スイッチング手段
は、電界効果型トランジスタを含むものである。
【００２３】この場合、電界効果型トランジスタのドレ
イン・ソース間の容量に起因するＬＣ共振の共振周波数
を低減することができる。
【００２４】（６）第６の発明 第６の発明に係る駆動回路は、第１の発明に係る駆動回
路の構成において、電気素子は、他の電気素子に過電圧
が印加されるのを防止するための保護手段を含むもので
ある。
【００２５】この場合、他の電気素子に過電圧が印加さ
れるのを防止するための保護手段の寄生容量と配線手段
のインダクタンス成分とのＬＣ共振の共振周波数を低減
しているので、ＬＣ共振により発生される電磁波の周波
数を低減することができ、不要な高周波の電磁波の輻射
を抑制することができる。
【００２６】（７）第７の発明 第７の発明に係る駆動回路は、第６の発明に係る駆動回
路の構成において、保護手段は、ダイオードを含むもの
である。
【００２７】この場合、ダイオードのアノード・カソー
ド間の容量に起因するＬＣ共振の共振周波数を低減する
ことができる。
【００２８】（８）第８の発明 第８の発明に係る駆動回路は、第１〜第７のいずれかの
発明に係る駆動回路の構成において、周波数低減手段
は、ＬＣ共振の共振周波数を３０ＭＨｚ未満に低減する
ものである。
【００２９】この場合、ＬＣ共振による共振周波数を３
０ＭＨｚ未満に低減しているので、３０ＭＨｚ以上の周
波数の電磁波の輻射を抑制することができる。
【００３０】（９）第９の発明 第９の発明に係る駆動回路は、第１〜第８のいずれかの
発明に係る駆動回路の構成において、周波数低減手段
は、電気素子に並列に接続される容量性素子を含むもの
である。
【００３１】この場合、電気素子の寄生容量に並列に容
量性素子の容量が付加され、ＬＣ共振経路における容量
が大きくなり、ＬＣ共振の共振周波数を低減することが
できる。
【００３２】（１０）第１０の発明 第１０の発明に係る駆動回路は、第２〜第５のいずれか
の発明に係る駆動回路の構成において、所定の電圧を供
給する電圧源をさらに含み、スイッチング手段の一端
は、電圧源に接続され、スイッチング手段の他端は、配
線手段に接続されるものである。
【００３３】この場合、電圧源から供給される電圧をス
イッチング手段および配線手段を介して容量性負荷に印
加し、容量性負荷をこの電圧により駆動することができ
るので、駆動パルスの印加時にＬＣ共振の共振周波数を
低減することができ、不要な高周波の電磁波の輻射をよ
り抑制することができる。
【００３４】（１１）第１１の発明 第１１の発明に係る駆動回路は、第１０の発明に係る駆
動回路の構成において、電圧源は、駆動パルスを立ち上
げるための第１の電圧を供給する第１の電圧源と、駆動
パルスを立ち下げるための、第１の電圧より低い第２の
電圧を供給する第２の電圧源とを含み、スイッチング手
段は、一端が第１の電圧源に接続される第１のスイッチ
ング手段と、一端が第２の電圧源に接続される第２のス
イッチング手段とを含み、配線手段は、一端が第１のス
イッチング手段の他端に接続される第１の配線手段と、
一端が第２のスイッチング手段の他端に接続され、他端
が第１の配線手段の他端に接続される第２の配線手段と
を含み、周波数低減手段は、第１のスイッチング手段に
並列に接続される第１の容量性素子と、第２のスイッチ
ング手段に並列に接続される第２の容量性素子とを含む
ものである。
【００３５】この場合、第１のスイッチング手段および
第１の配線手段を介して第１の電圧を供給することによ
り駆動パルスを立ち上げ、第２のスイッチング手段およ
び第２の配線手段を介して第２の電圧を供給することに
より駆動パルスを立ち下げることができる。また、第１
および第２の容量性素子によりＬＣ共振経路における容
量が大きくなり、各スイッチング手段および配線手段に
よるＬＣ共振の共振周波数を低減することができる。こ
の結果、駆動パルスの立ち上げおよび立ち下げを行うこ
とができるとともに、ＬＣ共振の共振周波数を低減する
ことができ、不要な高周波の電磁波の輻射をより抑制す
ることができる。
【００３６】（１２）第１２の発明 第１２の発明に係る駆動回路は、第２、第３および第５
のいずれかの発明に係る駆動回路の構成において、一端
が容量性負荷に接続されるインダクタンス素子と、容量
性負荷から電荷を回収するための回収用容量性素子とを
さらに含み、スイッチング手段は、一端がインダクタン
ス素子の他端に接続される一方向性導通素子と、一端が
一方向性導通素子の他端と接続されるスイッチング素子
とを含み、配線手段の一端は、スイッチング素子の他端
に接続され、配線手段の他端は、回収用容量性素子の一
端に接続され、周波数低減手段は、スイッチング素子に
並列に接続される容量性素子を含むものである。
【００３７】この場合、インダクタンス素子と容量性負
荷とのＬＣ共振により駆動パルスを立ち上げまたは立ち
下げることができるとともに、回収用容量性素子により
容量性負荷から電荷を回収することができるので、駆動
回路の消費電力を低減することができる。また、容量性
素子によりＬＣ共振経路における容量が大きくなり、ス
イッチング素子および配線手段によるＬＣ共振の共振周
波数を低減することができるので、不要な高周波の電磁
波の輻射を抑制することができる。
【００３８】（１３）第１３の発明 第１３の発明に係る駆動回路は、第２、第３および第５
のいずれかの発明に係る駆動回路の構成において、一端
が容量性負荷に接続されるインダクタンス素子と、容量
性負荷から電荷を回収するための回収用容量性素子とを
さらに含み、スイッチング手段は、一端が回収用容量性
素子の一端と接続されるスイッチング素子と、一端がス
イッチング素子の他端に接続される一方向性導通素子と
を含み、配線手段の一端は、一方向性導通素子の他端に
接続され、配線手段の他端は、インダクタンス素子の他
端に接続され、周波数低減手段は、一方向性導通素子に
並列に接続される容量性素子を含むものである。
【００３９】この場合、インダクタンス素子と容量性負
荷とのＬＣ共振により駆動パルスを立ち上げまたは立ち
下げることができるとともに、回収用容量性素子により
容量性負荷から電荷を回収することができるので、駆動
回路の消費電力を低減することができる。また、容量性
素子によりＬＣ共振経路における容量が大きくなり、一
方向性導通素子および配線手段によるＬＣ共振の共振周
波数を低減することができるので、不要な高周波の電磁
波の輻射を抑制することができる。
【００４０】（１４）第１４の発明 第１４の発明に係る駆動回路は、第６または第７の発明
に係る駆動回路の構成において、所定の電圧を供給する
電圧源と、一端が容量性負荷に接続されるインダクタン
ス素子と、容量性負荷から電荷を回収するための回収用
容量性素子と、回収用容量性素子とインダクタンス素子
とを接続するための接続手段とをさらに含み、保護手段
は、一端が電圧源に接続され、他端が接続手段のインダ
クタンス素子側の一端と接続される一方向性導通素子を
含み、周波数低減手段は、一方向性導通素子に並列に接
続される容量性素子を含むものである。
【００４１】この場合、一方向性導通素子により電圧源
から接続手段に過電圧が供給されるのを防止することが
できる。また、インダクタンス素子と容量性負荷とのＬ
Ｃ共振により駆動パルスを立ち上げまたは立ち下げるこ
とができるとともに、回収用容量性素子により容量性負
荷から電荷を回収することができるので、駆動回路の消
費電力を低減することができる。さらに、容量性素子に
よりＬＣ共振経路における容量が大きくなり、一方向性
導通素子および配線手段によるＬＣ共振の共振周波数を
低減することができるので、不要な高周波の電磁波の輻
射を抑制することができる。
【００４２】（１５）第１５の発明 第１５の発明に係る表示装置は、容量性負荷としての複
数の電極を含む表示パネルと、表示パネルの複数の電極
を駆動する第１〜第１４のいずれかの発明に係る駆動回
路とを備えるものである。
【００４３】第１５の発明に係る表示装置においては、
表示パネルの複数の電極を駆動しても、駆動回路から発
生される不要な高周波の電磁波の輻射が抑制されるの
で、表示装置から発生される不要な高周波の電磁波の輻
射を抑制することができる。
【００４４】
【発明の実施の形態】以下、本発明による駆動回路の一
例として、プラズマディスプレイ装置に用いられるサス
テインドライバについて説明する。なお、本発明の駆動
回路は、容量性負荷を駆動するものであれば、他の装置
にも同様に適用することができ、たとえば、プラズマデ
ィスプレイパネル、液晶ディスプレイ、エレクトロルミ
ネッセンスディスプレイ等の表示装置の駆動回路に適用
できる。また、本発明の駆動回路をプラズマディスプレ
イパネルに用いる場合は、ＡＣ型、ＤＣ型等のいずれの
プラズマディスプレイパネルの駆動回路にも適用でき、
アドレス電極、サステイン電極およびスキャン電極のい
ずれの駆動回路にも適用できるが、サステイン電極およ
びスキャン電極の駆動回路に好適に用いることができ
る。
【００４５】図１は、本発明の第１の実施の形態による
サステインドライバを用いたプラズマディスプレイ装置
の構成を示すブロック図である。
【００４６】図１のプラズマディスプレイ装置は、ＰＤ
Ｐ（プラズマディスプレイパネル）１、データドライバ
２、スキャンドライバ３、複数のスキャンドライバＩＣ
（回路）３ａおよびサステインドライバ４を含む。
【００４７】ＰＤＰ１は、複数のアドレス電極（データ
電極）１１、複数のスキャン電極（走査電極）１２およ
び複数のサステイン電極（維持電極）１３を含む。複数
のアドレス電極１１は、画面の垂直方向に配列され、複
数のスキャン電極１２および複数のサステイン電極１３
は、画面の水平方向に配列されている。また、複数のサ
ステイン電極１３は、共通に接続されている。アドレス
電極１１、スキャン電極１２およびサステイン電極１３
の各交点には、放電セルが形成され、各放電セルが画面
上の画素を構成する。
【００４８】データドライバ２は、ＰＤＰ１の複数のア
ドレス電極１１に接続されている。複数のスキャンドラ
イバＩＣ３ａは、スキャンドライバ３に接続されてい
る。各スキャンドライバＩＣ３ａには、ＰＤＰ１の複数
のスキャン電極１２が接続されている。サステインドラ
イバ４は、ＰＤＰ１の複数のサステイン電極１３に接続
されている。
【００４９】データドライバ２は、書き込み期間におい
て、画像データに応じてＰＤＰ１の該当するアドレス電
極１１に書き込みパルスを印加する。複数のスキャンド
ライバＩＣ３ａは、スキャンドライバ３により駆動さ
れ、書き込み期間において、シフトパルスＳＨを垂直走
査方向にシフトしつつＰＤＰ１の複数のスキャン電極１
２に書き込みパルスを順に印加する。これにより、該当
する放電セルにおいてアドレス放電が行われる。
【００５０】また、複数のスキャンドライバＩＣ３ａ
は、維持期間において、周期的な維持パルスをＰＤＰ１
の複数のスキャン電極１２に印加する。一方、サステイ
ンドライバ４は、維持期間において、ＰＤＰ１の複数の
サステイン電極１３にスキャン電極１２の維持パルスに
対して１８０°位相のずれた維持パルスを同時に印加す
る。これにより、該当する放電セルにおいて維持放電が
行われる。
【００５１】図２は、図１のＰＤＰ１におけるスキャン
電極１２およびサステイン電極１３の駆動電圧の一例を
示すタイミング図である。
【００５２】初期化および書き込み期間には、複数のス
キャン電極１２に初期化パルス（セットアップパルス）
Ｐｓｅｔが同時に印加される。その後、複数のスキャン
電極１２に書き込みパルスＰｗが順に印加される。これ
により、ＰＤＰ１の該当する放電セルにおいてアドレス
放電が起こる。
【００５３】次に、維持期間において、複数のスキャン
電極１２に維持パルスＰｓｃが周期的に印加され、複数
のサステイン電極１３に維持パルスＰｓｕが周期的に印
加される。維持パルスＰｓｕの位相は、維持パルスＰｓ
ｃの位相に対して１８０°ずれている。これにより、ア
ドレス放電に続いて維持放電が起こる。
【００５４】次に、図１に示すサステインドライバ４に
ついて説明する。図３は、図１に示すサステインドライ
バ４の構成を示す回路図である。
【００５５】図３のサステインドライバ４は、スイッチ
ング素子であるｎチャネル型のＦＥＴ（電界効果型トラ
ンジスタ、以下トランジスタと称す）Ｑ１〜Ｑ４、コン
デンサＣ１，Ｃ２、回収コンデンサＣｒ、回収コイルＬ
およびダイオードＤ１，Ｄ２を含む。
【００５６】トランジスタＱ１は、一端が電源端子Ｖ１
に接続され、他端が配線Ｌ１を介してノードＮ１に接続
され、ゲートには制御信号Ｓ１が入力される。トランジ
スタＱ１は、寄生容量としてドレイン・ソース間の容量
ＣＰ１を有し、トランジスタＱ１のドレイン・ソース間
には、コンデンサＣ１が並列に接続される。電源端子Ｖ
１には、電圧Ｖｓｕｓが印加される。
【００５７】トランジスタＱ２は、一端が配線Ｌ２を介
してノードＮ１に接続され、他端が接地端子に接続さ
れ、ゲートには制御信号Ｓ２が入力される。トランジス
タＱ２は、寄生容量としてドレイン・ソース間の容量Ｃ
Ｐ２を有し、トランジスタＱ２のドレイン・ソース間に
は、コンデンサＣ２が並列に接続される。
【００５８】ノードＮ１は、例えば４８０本のサステイ
ン電極１３に接続されているが、図３では、複数のサス
テイン電極１３と接地端子との間の全容量に相当するパ
ネル容量Ｃｐが示されている。
【００５９】回収コンデンサＣｒは、ノードＮ３と接地
端子との間に接続されている。トランジスタＱ３および
ダイオードＤ１は、ノードＮ３とノードＮ２との間に直
列に接続されている。ダイオードＤ２およびトランジス
タＱ４は、ノードＮ２とノードＮ３との間に直列に接続
されている。トランジスタＱ３のゲートには、制御信号
Ｓ３が入力され、トランジスタＱ４のゲートには制御信
号Ｓ４が入力される。回収コイルＬはノードＮ２とノー
ドＮ１との間に接続されている。
【００６０】本実施の形態では、トランジスタＱ１，Ｑ
２が電気素子、スイッチング手段および維持パルス用ス
イッチング手段に相当し、配線Ｌ１，Ｌ２が配線手段に
相当し、コンデンサＣ１，Ｃ２が周波数低減手段に相当
し、電源端子Ｖ１および接地端子が電圧源に相当する。
また、トランジスタＱ１が第１のスイッチング手段に相
当し、トランジスタＱ２が第２のスイッチング手段に相
当し、配線Ｌ１が第１の配線手段に相当し、配線Ｌ２が
第２の配線手段に相当し、コンデンサＣ１が第１の容量
性素子に相当し、コンデンサＣ２が第２の容量性素子に
相当し、電源端子Ｖ１が第１の電圧源に相当し、接地端
子が第２の電圧源に相当する。
【００６１】次に、上記のように構成されたサステイン
ドライバ４の維持期間の動作について説明する。
【００６２】まず、制御信号Ｓ２がローレベルになりト
ランジスタＱ２がオフし、制御信号Ｓ３がハイレベルに
なりトランジスタＱ３がオンする。このとき、制御信号
Ｓ１はローレベルにありトランジスタＱ１はオフし、制
御信号Ｓ４はローレベルにありトランジスタＱ４はオフ
している。したがって、回収コンデンサＣｒがトランジ
スタＱ３およびダイオードＤ１を介して回収コイルＬに
接続され、回収コイルＬおよびパネル容量ＣｐによるＬ
Ｃ共振によりノードＮ１の電圧が滑らかに上昇する。こ
のとき、回収コンデンサＣｒの電荷がトランジスタＱ
３、ダイオードＤ１および回収コイルＬを介してパネル
容量Ｃｐへ放出される。
【００６３】また、このとき、トランジスタＱ３、ダイ
オードＤ１および回収コイルＬを介して流れる電流は、
パネル容量Ｃｐに流入するだけでなく、配線Ｌ１を介し
てトランジスタＱ１のドレイン・ソース間の容量ＣＰ１
およびコンデンサＣ１を流れるとともに、配線Ｌ２を介
してトランジスタＱ２のドレイン・ソース間の容量ＣＰ
２およびコンデンサＣ２にも流れる。このため、配線Ｌ
１，Ｌ２の各インダクタンス成分とトランジスタＱ１，
Ｑ２の各ドレイン・ソース間の容量ＣＰ１，ＣＰ２およ
びコンデンサＣ１，Ｃ２によりＬＣ共振が発生する。
【００６４】しかしながら、本実施の形態では、このＬ
Ｃ共振に寄与する容量は、ドレイン・ソース間の容量Ｃ
Ｐ１，ＣＰ２とコンデンサＣ１，Ｃ２とをそれぞれ加算
した容量となるため、その共振周波数はドレイン・ソー
ス間の容量ＣＰ１，ＣＰ２のみによる共振周波数よりも
低減される。具体的には、ＬＣ共振の共振周波数が３０
ＭＨｚ未満になるように、各コンデンサＣ１，Ｃ２の容
量を各トランジスタＱ１，Ｑ２のドレイン・ソース間の
容量ＣＰ１，ＣＰ２に対して、例えば約５〜１０倍に設
定している。
【００６５】ここで、一例として、２０００ｐＦのコン
デンサをＦＥＴのドレイン・ソース間に並列に接続した
場合のドレイン・ソース間の容量とドレイン・ソース間
の電圧との関係について説明する。図４は、２０００ｐ
ＦのコンデンサをＦＥＴに並列に接続した場合と接続し
ない場合のドレイン・ソース間の容量Ｃｄｓ（ｐＦ）と
ドレイン・ソース間の電圧Ｖｄｓ（Ｖ）との関係を示す
図である。図４では、ＦＥＴのドレイン・ソース間にコ
ンデンサを接続していない場合を破線で示し、２０００
ｐＦのコンデンサを並列に接続した場合を実線で示して
いる。
【００６６】図４に示すように、２０００ｐＦのコンデ
ンサがＦＥＴのドレイン・ソース間に並列に接続される
と、接続しない場合に比べてドレイン・ソース間の容量
Ｃｄｓが増加することがわかる。本実施の形態の場合、
図３に示すトランジスタＱ１，Ｑ２のドレイン・ソース
間の電圧Ｖｄｓが約２００Ｖであるので、２０００ｐＦ
のコンデンサを各トランジスタＱ１，Ｑ２のドレイン・
ソース間に並列に接続することにより、各トランジスタ
Ｑ１，Ｑ２のドレイン・ソース間の容量Ｃｄｓがコンデ
ンサを接続しない場合に対して約１０倍程度増加するこ
とがわかる。
【００６７】上記のように、トランジスタＱ１，Ｑ２の
ドレイン・ソース間にコンデンサＣ１，Ｃ２を並列に接
続することにより、トランジスタＱ３がオフからオンへ
変化したときに発生する、配線Ｌ１，Ｌ２のインダクタ
ンス成分とトランジスタＱ１，Ｑ２のドレイン・ソース
間の容量ＣＰ１，ＣＰ２およびコンデンサＣ１，Ｃ２と
によるＬＣ共振の共振周波数が３０ＭＨｚ未満となり、
３０ＭＨｚ以上の不要な電磁波の輻射が抑制される。
【００６８】次に、制御信号Ｓ１がハイレベルになりト
ランジスタＱ１がオンし、制御信号Ｓ３がローレベルに
なりトランジスタＱ３がオフする。したがって、ノード
Ｎ１が電源端子Ｖ１に接続され、ノードＮ１の電圧が急
激に上昇し、電圧Ｖｓｕｓに固定される。
【００６９】このとき、電源端子Ｖ１からトランジスタ
Ｑ１を介して流れる電流は、パネル容量Ｃｐに流入する
だけでなく、配線Ｌ１，Ｌ２を介してトランジスタＱ２
のドレイン・ソース間の容量ＣＰ２およびコンデンサＣ
２にも流入する。このため、配線Ｌ１，Ｌ２のインダク
タンス成分とトランジスタＱ２のドレイン・ソース間の
容量ＣＰ２およびコンデンサＣ２によりＬＣ共振が発生
する。
【００７０】この場合も、上記と同様に、このＬＣ共振
に寄与する容量がドレイン・ソース間の容量ＣＰ２とコ
ンデンサＣ２とを加算した容量となるので、トランジス
タＱ１がオフからオンへ変化したときに発生する、配線
Ｌ１，Ｌ２のインダクタンス成分とトランジスタＱ２の
ドレイン・ソース間の容量ＣＰ２およびコンデンサＣ２
によるＬＣ共振の共振周波数が３０ＭＨｚ未満となり、
３０ＭＨｚ以上の不要な電磁波の輻射が抑制される。
【００７１】次に、制御信号Ｓ１がローレベルになりト
ランジスタＱ１がオフし、制御信号Ｓ４がハイレベルに
なりトランジスタＱ４がオンする。したがって、回収コ
ンデンサＣｒがダイオードＤ２およびトランジスタＱ４
を介して回収コイルＬに接続され、回収コイルＬおよび
パネル容量ＣｐによるＬＣ共振によりノードＮ１の電圧
が緩やかに降下する。このとき、パネル容量Ｃｐに蓄え
られた電荷は、回収コイルＬ、ダイオードＤ２およびト
ランジスタＱ４を介して回収コンデンサＣｒに蓄えら
れ、電荷の回収が行われる。
【００７２】また、このとき、パネル容量Ｃｐから流れ
る電流は、回収コイルＬ、ダイオードＤ２およびトラン
ジスタＱ４を介して回収コンデンサＣｒへ流入するだけ
でなく、配線Ｌ１，Ｌ２を介してトランジスタＱ１，Ｑ
２のドレイン・ソース間の容量ＣＰ１，ＣＰ２およびコ
ンデンサＣ１，Ｃ２へも流れる。このため、配線Ｌ１，
Ｌ２のインダクタンス成分とトランジスタＱ１，Ｑ２の
ドレイン・ソース間の容量ＣＰ１，ＣＰ２およびコンデ
ンサＣ１，Ｃ２によりＬＣ共振が発生する。
【００７３】この場合も、上記と同様に、このＬＣ共振
に寄与する容量がドレイン・ソース間の容量ＣＰ１，Ｃ
Ｐ２とコンデンサＣ１，Ｃ２とをそれぞれ加算した容量
となるので、トランジスタＱ４がオフからオンへ変化し
たときに発生する、配線Ｌ１，Ｌ２のインダクタンス成
分とトランジスタＱ１，Ｑ２のドレイン・ソース間の容
量ＣＰ１，ＣＰ２およびコンデンサＣ１，Ｃ２によるＬ
Ｃ共振の共振周波数が３０ＭＨｚ未満となり、３０ＭＨ
ｚ以上の不要な電磁波の輻射が抑制される。
【００７４】次に、制御信号Ｓ２がハイレベルになりト
ランジスタＱ２がオンし、制御信号Ｓ４がローレベルに
なりトランジスタＱ４がオフする。したがって、ノード
Ｎ１が接地端子に接続され、ノードＮ１の電圧が急激に
降下し、接地電位に固定される。
【００７５】このとき、トランジスタＱ２を介して接地
端子へ流れる電流は、パネル容量Ｃｐから流入するだけ
でなく、配線Ｌ１，Ｌ２を介してトランジスタＱ１のド
レイン・ソース間の容量ＣＰ１およびコンデンサＣ１か
らも流入する。このため、配線Ｌ１，Ｌ２のインダクタ
ンス成分とトランジスタＱ１のドレイン・ソース間の容
量ＣＰ１およびコンデンサＣ１によりＬＣ共振が発生す
る。
【００７６】この場合も、上記と同様に、このＬＣ共振
に寄与する容量がドレイン・ソース間の容量ＣＰ１とコ
ンデンサＣ１とを加算した容量となるので、トランジス
タＱ２がオフからオンへ変化したときに発生する、配線
Ｌ１，Ｌ２のインダクタンス成分とトランジスタＱ１の
ドレイン・ソース間の容量ＣＰ１およびコンデンサＣ１
によるＬＣ共振の共振周波数も、３０ＭＨｚ未満とな
り、３０ＭＨｚ以上の不要な電磁波の輻射が抑制され
る。
【００７７】上記の動作を維持期間において繰り返し行
うことにより、図１４に示す従来の維持パルスＰｓｕと
同様の波形を有する維持パルスＰｓｕが複数のサステイ
ン電極１３に周期的に印加されるとともに、３０ＭＨｚ
以上の不要な電磁波の輻射が抑制される。
【００７８】次に、上記のようにトランジスタＱ１，Ｑ
２にコンデンサＣ１，Ｃ２を並列に接続した場合の電磁
波の輻射レベルの低減効果について説明する。図５は、
図１に示すプラズマディスプレイ装置から放出される電
磁波の輻射レベルと周波数との関係を示す図である。図
５では、コンデンサＣ１，Ｃ２をトランジスタＱ１，Ｑ
２のドレイン・ソース間に並列に接続した場合を実線で
示し、コンデンサＣ１，Ｃ２を接続していない場合を破
線で示す。
【００７９】図５に示すように、コンデンサＣ１，Ｃ２
を接続していない場合、電磁波の輻射レベルは３０ＭＨ
ｚより高い周波数ｆ０でピークを取り、３０ＭＨｚ以上
の電磁波の輻射レベルが高くなっていることがわかる。
一方、コンデンサＣ１，Ｃ２をトランジスタＱ１，Ｑ２
のドレイン・ソース間に並列に接続した場合、共振周波
数がｆ０からｆ１へ低減され、３０ＭＨｚより低い周波
数ｆ１でピークを取るようになる。したがって、３０Ｍ
Ｈｚ以上の電磁波の輻射レベルが十分に低減され、３０
ＭＨｚ以上の不要な電磁波の輻射を十分に抑制できるこ
とがわかる。
【００８０】上記のように、本実施の形態では、コンデ
ンサＣ１，Ｃ２がトランジスタＱ１，Ｑ２のドレイン・
ソース間に並列に接続されているので、トランジスタＱ
１〜Ｑ４がオフからオンへ変化したときに発生するＬＣ
共振の共振周波数を３０ＭＨｚ未満の低い周波数へ移動
させることができる。したがって、３０ＭＨｚ以上の高
周波の電磁波の輻射を抑制することができる。
【００８１】次に、図１に示すサステインドライバ４と
して用いられる他のサステインドライバについて説明す
る。図６は、本発明の第２の実施の形態によるサステイ
ンドライバの構成を示す回路図である。
【００８２】図６に示すサステインドライバ４ａと図３
に示すサステインドライバ４とで異なる点は、コンデン
サＣ１，Ｃ２が省略され、トランジスタＱ３，Ｑ４に並
列に接続されるコンデンサＣ３，Ｃ４が付加された点で
あり、その他の点は図３に示すサステインドライバ４と
同様であるので、同一部分には同一符号を付し、以下詳
細な説明を省略する。
【００８３】図６に示すように、コンデンサＣ３は、ト
ランジスタＱ３のドレイン・ソース間に並列に接続さ
れ、コンデンサＣ４は、トランジスタＱ４のドレイン・
ソース間に並列に接続される。トランジスタＱ３の一端
は、配線Ｌ３を介してノードＮ３に接続され、トランジ
スタＱ４の一端は、配線Ｌ４を介してノードＮ３に接続
されている。なお、配線Ｌ３および配線Ｌ４は、トラン
ジスタＱ３およびトランジスタＱ４のドレイン・ソース
間の配線全体を指している。トランジスタＱ３は、寄生
容量としてドレイン・ソース間の容量ＣＰ３を有し、ト
ランジスタＱ４は、寄生容量としてドレイン・ソース間
の容量ＣＰ４を有する。ダイオードＤ１は、寄生容量と
してアノード・カソード間の容量ＣＰ５を有し、ダイオ
ードＤ２は、寄生容量としてアノード・カソード間の容
量ＣＰ６を有する。
【００８４】本実施の形態では、トランジスタＱ３，Ｑ
４が電気素子、スイッチング手段および維持パルス用ス
イッチング手段に相当し、配線Ｌ３，Ｌ４が配線手段に
相当し、コンデンサＣ３，Ｃ４が周波数低減手段に相当
し、回収コイルＬがインダクタンス素子に相当し、回収
コンデンサＣｒが回収用容量性素子に相当し、ダイオー
ドＤ１，Ｄ２が一方向性導通素子、トランジスタＱ３，
Ｑ４がスイッチング素子に相当する。
【００８５】次に、上記のように構成されたサステイン
ドライバ４ａの維持期間の動作について説明する。図７
は、図６に示すサステインドライバ４ａの維持期間の動
作を説明するためのタイミング図である。図７には、ト
ランジスタＱ１〜Ｑ４に入力される制御信号Ｓ１〜Ｓ４
およびノードＮ１〜Ｎ３の各電圧が示される。なお、図
６に示すサステインドライバ４ａの基本的な動作は、図
３に示すサステインドライバ４と同様であるので、ＬＣ
共振の発生メカニズム等の異なる点についてのみ以下詳
細に説明する。
【００８６】まず、トランジスタＱ４のドレイン・ソー
ス間の容量ＣＰ４および配線Ｌ４のインダクタンス成分
によるＬＣ共振は、トランジスタＱ４がオフ状態にあ
り、かつ、トランジスタＱ４のドレイン・ソース間に急
激な電圧変化が生じる場合に発生する。具体的には、図
７に示す時刻ｔ１，ｔ２においてドレイン・ソース間の
容量ＣＰ４および配線Ｌ４のインダクタンス成分による
ＬＣ共振が発生する。
【００８７】時刻ｔ１の場合、制御信号Ｓ３がハイレベ
ルになりトランジスタＱ３がオンし、ノードＮ２の電位
が０ＶからノードＮ３の電位約Ｖｓｕｓ／２に立ち上が
る瞬間に、ＬＣ共振が発生する。このとき、ダイオード
Ｄ２のアノード・カソード間の容量ＣＰ６、トランジス
タＱ４のドレイン・ソース間の容量ＣＰ４および配線Ｌ
４を介して高周波の電流がノードＮ２からノードＮ３に
向かって流れようとする。このため、トランジスタＱ４
のドレイン・ソース間の容量ＣＰ４および配線Ｌ４のイ
ンダクタンス成分により高周波のＬＣ共振が発生し、高
周波の電磁波として輻射される。
【００８８】また、時刻ｔ２の場合、ノードＮ１の電位
が回収コイルＬおよびパネル容量ＣｐによるＬＣ共振に
よりピーク電圧から下がり始め、回収コイルＬに流れる
電流の方向がノードＮ１からノードＮ２へと逆転する
と、ダイオードＤ１が非導通となるために、電流は経路
を断たれ、ノードＮ２の電位は、急激にノードＮ１の電
位に向かって上昇する。このとき、ダイオードＤ１のア
ノード・カソード間の容量ＣＰ５等のノードＮ２に接続
されている浮遊容量および回収コイルＬによるＬＣ共振
を発生し、ノードＮ２の電位がリンギングしながら上昇
する瞬間に、高周波のＬＣ共振が発生する。
【００８９】このとき、ダイオードＤ２はオンし、トラ
ンジスタＱ４のドレイン・ソース間の容量ＣＰ４および
配線Ｌ４を介して高周波の電流がノードＮ２からノード
Ｎ３に向かって流れようとする。このため、トランジス
タＱ４のドレイン・ソース間の容量ＣＰ４および配線Ｌ
４のインダクタンス成分により高周波のＬＣ共振が発生
し、高周波の電磁波として輻射される。
【００９０】しかしながら、本実施の形態では、トラン
ジスタＱ４に並列にコンデンサＣ４が接続されているた
め、トランジスタＱ４のドレイン・ソース間の容量ＣＰ
４および配線Ｌ４のインダクタンス成分によるＬＣ共振
に寄与する容量は、トランジスタＱ４のドレイン・ソー
ス間の容量ＣＰ４とコンデンサＣ４とを加算した容量と
なるため、その共振周波数はドレイン・ソース間の容量
ＣＰ４のみによる共振周波数よりも低減される。具体的
には、このＬＣ共振の共振周波数が３０ＭＨｚ未満にな
るように、コンデンサＣ４の容量が設定され、３０ＭＨ
ｚ以上の不要の電磁波の輻射を抑制している。
【００９１】次に、トランジスタＱ３のドレイン・ソー
ス間の容量ＣＰ３および配線Ｌ３のインダクタンス成分
によるＬＣ共振は、トランジスタＱ３がオフ状態にあ
り、かつ、トランジスタＱ３のドレイン・ソース間に急
激な電圧変化が生じる場合に発生する。具体的には、図
７に示す時刻ｔ３，ｔ４においてドレイン・ソース間の
容量ＣＰ３および配線Ｌ３のインダクタンス成分による
ＬＣ共振が発生する。
【００９２】時刻ｔ３の場合、維持パルスＰｓｕの立ち
上がり時の電力回収期間が終了して制御信号Ｓ１がハイ
レベルになりトランジスタＱ１がオンし、電源端子Ｖ１
の電圧ＶｓｕｓがノードＮ２に印加されている状態か
ら、制御信号Ｓ４がハイレベルになりトランジスタＱ４
がオンし、ノードＮ２の電位がＶｓｕｓからノードＮ３
の電位約Ｖｓｕｓ／２に立ち下がる瞬間に、ＬＣ共振が
発生する。
【００９３】このとき、配線Ｌ３、トランジスタＱ３の
ドレイン・ソース間の容量ＣＰ３およびダイオードＤ１
のアノード・カソード間の容量ＣＰ５を介して高周波の
電流がノードＮ３からノードＮ２に向かって流れようと
する。このため、トランジスタＱ３のドレイン・ソース
間の容量ＣＰ３および配線Ｌ３のインダクタンス成分に
より高周波のＬＣ共振が発生し、高周波の電磁波として
輻射される。
【００９４】また、時刻ｔ４の場合、維持パルスＰｓｕ
の立ち下がり時の電力回収期間が終了し、回収コイルＬ
に流れる電流の方向がノードＮ２からノードＮ１へと逆
転すると、ダイオードＤ２が非導通となるために、電流
は経路を断たれ、ノードＮ２の電位は、急激にノードＮ
１の電位に向かって降下する。このとき、ダイオードＤ
２のアノード・カソード間の容量ＣＰ６等のノードＮ２
に接続されている浮遊容量および回収コイルＬによるＬ
Ｃ共振を発生し、ノードＮ２の電位がリンギングしなが
ら下降する瞬間に、高周波のＬＣ共振が発生する。
【００９５】このとき、ダイオードＤ１はオンし、配線
Ｌ３およびトランジスタＱ３のドレイン・ソース間の容
量ＣＰ３を介して高周波の電流がノードＮ３からノード
Ｎ２に向かって流れようとする。このため、トランジス
タＱ３のドレイン・ソース間の容量ＣＰ３および配線Ｌ
３のインダクタンス成分により高周波のＬＣ共振が発生
し、高周波の電磁波として輻射される。
【００９６】しかしながら、本実施の形態では、トラン
ジスタＱ３に並列にコンデンサＣ３が接続されているた
め、トランジスタＱ３のドレイン・ソース間の容量ＣＰ
３および配線Ｌ３のインダクタンス成分によるＬＣ共振
に寄与する容量は、トランジスタＱ３のドレイン・ソー
ス間の容量ＣＰ３とコンデンサＣ３とを加算した容量と
なるため、その共振周波数はドレイン・ソース間の容量
ＣＰ３のみによる共振周波数よりも低減される。具体的
には、このＬＣ共振の共振周波数が３０ＭＨｚ未満にな
るように、コンデンサＣ３の容量が設定され、３０ＭＨ
ｚ以上の不要の電磁波の輻射を抑制している。
【００９７】上記のように、本実施の形態でも、コンデ
ンサＣ３，Ｃ４がトランジスタＱ３，Ｑ４のドレイン・
ソース間に並列に接続されているので、配線Ｌ３，Ｌ４
のインダクタンス成分とトランジスタＱ３，Ｑ４のドレ
イン・ソース間の容量ＣＰ３，ＣＰ４により発生するＬ
Ｃ共振の共振周波数を３０ＭＨｚ未満の低い周波数に移
動させることができる。したがって、３０ＭＨｚ以上の
高周波の電磁波の輻射を抑制することができる。
【００９８】図８は、本発明の第３の実施の形態による
サステインドライバの構成を示す回路図である。
【００９９】図８に示すサステインドライバ４ｂと図３
に示すサステインドライバ４とで異なる点は、コンデン
サＣ１，Ｃ２が省略され、ダイオードＤ１，Ｄ２に並列
に接続されるコンデンサＣ５，Ｃ６が付加された点であ
り、その他の点は図３に示すサステインドライバ４と同
様であるので、同一部分には同一符号を付し、以下詳細
な説明を省略する。
【０１００】図８に示すように、コンデンサＣ５は、ダ
イオードＤ１のアノード・カソード間に並列に接続さ
れ、コンデンサＣ６は、ダイオードＤ２のアノード・カ
ソード間に並列に接続される。ダイオードＤ１のカソー
ドは、配線Ｌ５を介してノードＮ２に接続され、ダイオ
ードＤ２のアノードは、配線Ｌ６を介してノードＮ２に
接続されている。ダイオードＤ１は、寄生容量としてア
ノード・カソード間の容量ＣＰ５を有し、ダイオードＤ
２は、寄生容量としてアノード・カソード間の容量ＣＰ
６を有する。なお、トランジスタＱ３，Ｑ４も第２の実
施の形態と同様に寄生容量ＣＰ３，ＣＰ４を有してい
る。
【０１０１】本実施の形態では、ダイオードＤ１，Ｄ２
が電気素子、スイッチング手段および維持パルス用スイ
ッチング手段に相当し、配線Ｌ５，Ｌ６が配線手段に相
当し、コンデンサＣ５，Ｃ６が周波数低減手段に相当
し、回収コイルＬがインダクタンス素子に相当し、回収
コンデンサＣｒが回収用容量性素子に相当し、ダイオー
ドＤ１，Ｄ２が一方向性導通素子、トランジスタＱ３，
Ｑ４がスイッチング素子に相当する。
【０１０２】次に、上記のように構成されたサステイン
ドライバ４ｂの維持期間の動作について説明する。な
お、図８に示すサステインドライバ４ｂの基本的な動作
は、図３および図６に示すサステインドライバ４，４ａ
と同様であるので、ＬＣ共振の発生メカニズム等の異な
る点についてのみ以下詳細に説明する。
【０１０３】まず、ダイオードＤ１のアノード・カソー
ド間の容量ＣＰ５および配線Ｌ５のインダクタンス成分
によるＬＣ共振は、ダイオードＤ１がオフ状態にあり、
かつ、ダイオードＤ１のアノード・カソード間に急激な
電圧変化が生じる場合に発生する。具体的には、図７に
示す時刻ｔ２，ｔ３においてアノード・カソード間の容
量ＣＰ５および配線Ｌ５のインダクタンス成分によるＬ
Ｃ共振が発生する。
【０１０４】時刻ｔ２の場合、制御信号Ｓ３がハイレベ
ルになりトランジスタＱ３がオンし、ノードＮ２の電位
がノードＮ３の電位約Ｖｓｕｓ／２と同じ電位になって
いる状態から、ノードＮ１の電位が回収コイルＬおよび
パネル容量ＣｐによるＬＣ共振によりピーク電圧から下
がり始め、回収コイルＬに流れる電流の方向がノードＮ
１からノードＮ２へと逆転すると、ダイオードＤ１が非
導通となるために、電流は経路を断たれ、ノードＮ２の
電位は、急激にノードＮ１の電位に向かって上昇する。
このとき、ダイオードＤ１のアノード・カソード間の容
量ＣＰ５等のノードＮ２に接続されている浮遊容量およ
び回収コイルＬによるＬＣ共振を発生し、ノードＮ２の
電位がリンギングしながら上昇する瞬間に、高周波のＬ
Ｃ共振が発生する。
【０１０５】このとき、ダイオードＤ１は逆バイアスの
状態にありオフされているが、トランジスタＱ３はオン
しているため、配線Ｌ５およびダイオードＤ１のアノー
ド・カソード間の容量ＣＰ５を介して高周波の電流がノ
ードＮ２からノードＮ３に向かって流れようとする。こ
のため、ダイオードＤ１のアノード・カソード間の容量
ＣＰ５および配線Ｌ５のインダクタンス成分により高周
波のＬＣ共振が発生し、高周波の電磁波として輻射され
る。
【０１０６】また、時刻ｔ３の場合、維持パルスＰｓｕ
の立ち上がり時の電力回収期間が終了して制御信号Ｓ１
がハイレベルになりトランジスタＱ１がオンし、電源端
子Ｖ１の電圧ＶｓｕｓがノードＮ２に印加されている状
態から、制御信号Ｓ４がハイレベルになりトランジスタ
Ｑ４がオンし、ノードＮ２の電位がＶｓｕｓからノード
Ｎ３の電位約Ｖｓｕｓ／２に立ち下がる瞬間に、ＬＣ共
振が発生する。
【０１０７】このとき、トランジスタＱ３のドレイン・
ソース間の容量ＣＰ３、ダイオードＤ１のアノード・カ
ソード間の容量ＣＰ５および配線Ｌ５を介して高周波の
電流がノードＮ３からノードＮ２に向かって流れようと
する。このため、ダイオードＤ１のアノード・カソード
間の容量ＣＰ５および配線Ｌ５のインダクタンス成分に
より高周波のＬＣ共振が発生し、高周波の電磁波として
輻射される。
【０１０８】しかしながら、本実施の形態では、ダイオ
ードＤ１に並列にコンデンサＣ５が接続されているた
め、ダイオードＤ１のアノード・カソード間の容量ＣＰ
５および配線Ｌ５のインダクタンス成分によるＬＣ共振
に寄与する容量は、ダイオードＤ１のアノード・カソー
ド間の容量ＣＰ５とコンデンサＣ５とを加算した容量と
なるため、その共振周波数はアノード・カソード間の容
量ＣＰ５のみによる共振周波数よりも低減される。具体
的には、このＬＣ共振の共振周波数が３０ＭＨｚ未満に
なるように、コンデンサＣ５の容量が設定され、３０Ｍ
Ｈｚ以上の不要の電磁波の輻射を抑制している。
【０１０９】次に、ダイオードＤ２のアノード・カソー
ド間の容量ＣＰ６および配線Ｌ６のインダクタンス成分
によるＬＣ共振は、ダイオードＤ２がオフ状態にあり、
かつ、ダイオードＤ２のアノード・カソード間に急激な
電圧変化が生じる場合に発生する。具体的には、図７に
示す時刻ｔ１，ｔ４においてアノード・カソード間の容
量ＣＰ６および配線Ｌ６のインダクタンス成分によるＬ
Ｃ共振が発生する。
【０１１０】時刻ｔ１の場合、制御信号Ｓ３がハイレベ
ルになりトランジスタＱ３がオンし、ノードＮ２の電位
が０ＶからノードＮ３の電位約Ｖｓｕｓ／２に立ち上が
る瞬間に、ＬＣ共振が発生する。このとき、配線Ｌ６、
ダイオードＤ２のアノード・カソード間の容量ＣＰ６お
よびトランジスタＱ４のドレイン・ソース間の容量ＣＰ
４を介して高周波の電流がノードＮ２からノードＮ３に
向かって流れようとする。このため、ダイオードＤ２の
アノード・カソード間の容量ＣＰ６および配線Ｌ６のイ
ンダクタンス成分により高周波のＬＣ共振が発生し、高
周波の電磁波として輻射される。
【０１１１】また、時刻ｔ４の場合、維持パルスＰｓｕ
の立ち下がり時の電力回収期間が終了し、回収コイルＬ
に流れる電流の方向がノードＮ２からノードＮ１へと逆
転すると、ダイオードＤ２が非導通となるために、電流
は経路を断たれ、ノードＮ２の電位は、急激にノードＮ
１の電位に向かって降下する。このとき、ダイオードＤ
２のアノード・カソード間の容量ＣＰ６等のノードＮ２
に接続されている浮遊容量および回収コイルＬによるＬ
Ｃ共振を発生し、ノードＮ２の電位がリンギングしなが
ら下降する瞬間に、高周波のＬＣ共振が発生する。
【０１１２】このとき、ダイオードＤ２は逆バイアスの
状態にありオフされているが、トランジスタＱ４はオン
しているため、ダイオードＤ２のアノード・カソード間
の容量ＣＰ６および配線Ｌ６を介して高周波の電流がノ
ードＮ３からノードＮ２に向かって流れようとする。こ
のため、ダイオードＤ２のアノード・カソード間の容量
ＣＰ６および配線Ｌ６のインダクタンス成分により高周
波のＬＣ共振が発生し、高周波の電磁波として輻射され
る。
【０１１３】しかしながら、本実施の形態では、ダイオ
ードＤ２に並列にコンデンサＣ６が接続されているた
め、ダイオードＤ２のアノード・カソード間の容量ＣＰ
６および配線Ｌ６のインダクタンス成分によるＬＣ共振
に寄与する容量は、ダイオードＤ２のアノード・カソー
ド間の容量ＣＰ６とコンデンサＣ６とを加算した容量と
なるため、その共振周波数はアノード・カソード間の容
量ＣＰ６のみによる共振周波数よりも低減される。具体
的には、このＬＣ共振の共振周波数が３０ＭＨｚ未満に
なるように、コンデンサＣ６の容量が設定され、３０Ｍ
Ｈｚ以上の不要の電磁波の輻射を抑制している。
【０１１４】上記のように、本実施の形態でも、コンデ
ンサＣ５，Ｃ６がダイオードＤ１，Ｄ２のアノード・カ
ソード間に並列に接続されているので、配線Ｌ５，Ｌ６
のインダクタンス成分とダイオードＤ１，Ｄ２のアノー
ド・カソード間の容量ＣＰ５，ＣＰ６により発生するＬ
Ｃ共振の共振周波数を３０ＭＨｚ未満の低い周波数に移
動させることができる。したがって、３０ＭＨｚ以上の
高周波の電磁波の輻射を抑制することができる。
【０１１５】図９は、本発明の第４の実施の形態による
サステインドライバの構成を示す回路図である。
【０１１６】図９に示すサステインドライバ４ｃと図３
に示すサステインドライバ４とで異なる点は、コンデン
サＣ１，Ｃ２が省略され、電源端子Ｖ１とノードＮ２と
の間にダイオードＤ３およびコンデンサＣ７が付加さ
れ、ノードＮ２と接地端子との間にダイオードＤ４およ
びコンデンサＣ８が付加された点であり、その他の点は
図３に示すサステインドライバ４と同様であるので、同
一部分には同一符号を付し、以下詳細な説明を省略す
る。
【０１１７】図９に示すように、ダイオードＤ３は、カ
ソードが電源端子Ｖ１に接続され、アノードが配線Ｌ７
を介してノードＮ２に接続される。ダイオードＤ３は、
寄生容量としてアノード・カソード間の容量ＣＰ７を有
し、ダイオードＤ３のアノード・カソード間には、コン
デンサＣ７が並列に接続される。
【０１１８】また、ダイオードＤ４は、カソードが配線
Ｌ８を介してノードＮ２に接続され、アノードが接地端
子に接続される。ダイオードＤ４は、寄生容量としてア
ノード・カソード間の容量ＣＰ８を有し、ダイオードＤ
４のアノード・カソード間には、コンデンサＣ８が並列
に接続される。
【０１１９】ダイオードＤ３，Ｄ４は、電流クリップの
目的で付加したものであり、トランジスタＱ３，Ｑ４の
耐圧が低い場合に、トランジスタＱ３，Ｑ４に耐圧以上
の電圧がかからないように保護している。したがって、
ダイオードＤ３は、通常オフ状態にあり、ノードＮ２の
電位がＶｓｕｓを超えるときにのみオンし、ダイオード
Ｄ４は、通常オフ状態にあり、ノードＮ２の電位が０Ｖ
を下回るときにのみオンする。したがって、ノードＮ２
の電位は、０Ｖ〜Ｖｓｕｓの範囲にクリップされる。
【０１２０】本実施の形態では、ダイオードＤ３，Ｄ４
が電気素子および保護手段に相当し、配線Ｌ７，Ｌ８が
配線手段に相当し、コンデンサＣ７，Ｃ８が周波数低減
手段に相当し、電源端子Ｖ１および接地端子が電圧源に
相当し、回収コイルＬがインダクタンス素子に相当し、
回収コンデンサＣｒが回収用容量性素子に相当し、トラ
ンジスタＱ３，Ｑ４およびダイオードＤ１，Ｄ２が接続
手段に相当し、ダイオードＤ３，Ｄ４が一方向性導通素
子、コンデンサＣ７，Ｃ８が容量性素子に相当する。
【０１２１】次に、上記のように構成されたサステイン
ドライバ４ｃの維持期間の動作について説明する。図１
０は、図９に示すサステインドライバ４ｃの維持期間の
動作を説明するためのタイミング図である。図１０に
は、トランジスタＱ１〜Ｑ４に入力される制御信号Ｓ１
〜Ｓ４およびノードＮ１〜Ｎ３の各電圧が示される。な
お、図９に示すサステインドライバ４ｃの基本的な動作
は、図３および図６に示すサステインドライバ４，４ａ
と同様であるので、ＬＣ共振の発生メカニズム等の異な
る点についてのみ以下詳細に説明する。
【０１２２】まず、ダイオードＤ３のアノード・カソー
ド間の容量ＣＰ７および配線Ｌ７のインダクタンス成分
によるＬＣ共振は、ダイオードＤ３がオフ状態にあり、
かつ、ダイオードＤ３のアノード・カソード間に急激な
電圧変化が生じる場合に発生する。ここで、ダイオード
Ｄ３のカソード側の電位が電源端子Ｖ１によりＶｓｕｓ
に固定されているため、ノードＮ２の電位が変化するす
べてのタイミングでダイオードＤ３のアノード・カソー
ド間の電圧が変化する。
【０１２３】具体的には、図１０に示すように、トラン
ジスタＱ３がオンしてノードＮ２の電位が０Ｖから約Ｖ
ｓｕｓ／２に向かって上昇する瞬間すなわち時刻ｔ１、
立ち上がり時の電力回収期間が終了してノードＮ２の電
位がＶｓｕｓに向かって上昇する瞬間すなわち時刻ｔ
２、トランジスタＱ４がオンしてノードＮ２の電位がＶ
ｓｕｓから約Ｖｓｕｓ／２に向かって下降する瞬間すな
わち時刻ｔ３、および立ち下がり時の電力回収期間が終
了してノードＮ２の電位が０Ｖに向かって下降する瞬間
すなわち時刻ｔ４の各タイミングで、ダイオードＤ３の
アノード・カソード間の電圧が変化する。このとき、ア
ノード・カソード間の容量ＣＰ７に高周波の電流が流
れ、ダイオードＤ３のアノード・カソード間の容量ＣＰ
７および配線Ｌ７のインダクタンス成分により高周波の
ＬＣ共振が発生し、高周波の電磁波として輻射される。
【０１２４】しかしながら、本実施の形態では、ダイオ
ードＤ３に並列にコンデンサＣ７が接続されているた
め、ダイオードＤ３のアノード・カソード間の容量ＣＰ
７および配線Ｌ７のインダクタンス成分によるＬＣ共振
に寄与する容量は、ダイオードＤ３のアノード・カソー
ド間の容量ＣＰ７とコンデンサＣ７とを加算した容量と
なるため、その共振周波数はアノード・カソード間の容
量ＣＰ７のみによる共振周波数よりも低減される。具体
的には、このＬＣ共振の共振周波数が３０ＭＨｚ未満に
なるように、コンデンサＣ７の容量が設定され、３０Ｍ
Ｈｚ以上の不要の電磁波の輻射を抑制している。
【０１２５】次に、ダイオードＤ４のアノード・カソー
ド間の容量ＣＰ８および配線Ｌ８のインダクタンス成分
によるＬＣ共振は、ダイオードＤ４がオフ状態にあり、
かつ、ダイオードＤ４のアノード・カソード間に急激な
電圧変化が生じる場合に発生する。ここで、ダイオード
Ｄ４のアノード側の電位が接地端子により０Ｖに固定さ
れているため、ノードＮ２の電位が変化するすべてのタ
イミングでダイオードＤ３のアノード・カソード間の電
圧が変化する。
【０１２６】したがって、ダイオードＤ３と同様に、上
記の時刻ｔ１〜ｔ４の各タイミングで、ダイオードＤ４
のアノード・カソード間の電圧が変化する。このとき、
アノード・カソード間の容量ＣＰ８に高周波の電流が流
れ、ダイオードＤ４のアノード・カソード間の容量ＣＰ
８および配線Ｌ８のインダクタンス成分により高周波の
ＬＣ共振が発生し、高周波の電磁波として輻射される。
【０１２７】しかしながら、本実施の形態では、ダイオ
ードＤ４に並列にコンデンサＣ８が接続されているた
め、ダイオードＤ４のアノード・カソード間の容量ＣＰ
８および配線Ｌ８のインダクタンス成分によるＬＣ共振
に寄与する容量は、ダイオードＤ４のアノード・カソー
ド間の容量ＣＰ８とコンデンサＣ８とを加算した容量と
なるため、その共振周波数はアノード・カソード間の容
量ＣＰ８のみによる共振周波数よりも低減される。具体
的には、このＬＣ共振の共振周波数が３０ＭＨｚ未満に
なるように、コンデンサＣ８の容量が設定され、３０Ｍ
Ｈｚ以上の不要の電磁波の輻射を抑制している。
【０１２８】上記のように、本実施の形態でも、コンデ
ンサＣ７，Ｃ８がダイオードＤ３，Ｄ４のアノード・カ
ソード間に並列に接続されているので、配線Ｌ７，Ｌ８
のインダクタンス成分とダイオードＤ３，Ｄ４のアノー
ド・カソード間の容量ＣＰ７，ＣＰ８により発生するＬ
Ｃ共振の共振周波数を３０ＭＨｚ未満の低い周波数に移
動させることができる。したがって、３０ＭＨｚ以上の
高周波の電磁波の輻射を抑制することができる。
【０１２９】図１１は、本発明の第５の実施の形態によ
るサステインドライバの構成を示す回路図である。
【０１３０】図１１に示すサステインドライバ４ｄと図
３に示すサステインドライバ４とで異なる点は、図８お
よび図９に示すサステインドライバ４ｂ，４ｃと同様に
ダイオードＤ３，Ｄ４およびコンデンサＣ５〜Ｃ８が付
加された点であり、その他の点は図３に示すサステイン
ドライバ４と同様であるので、同一部分には同一符号を
付し、以下詳細な説明を省略する。
【０１３１】本実施の形態では、第１、第３および第４
の実施の形態と同様にコンデンサＣ１，Ｃ２，Ｃ５〜Ｃ
８がトランジスタＱ１，Ｑ２およびダイオードＤ１〜Ｄ
４に並列に接続されているので、第１、第３および第４
の実施の形態の各効果を得ることができ、各ＬＣ共振の
共振周波数を３０ＭＨｚ未満の低い周波数に移動させ、
３０ＭＨｚ以上の高周波の電磁波の輻射をより抑制する
ことができる。なお、各実施の形態の組み合わせは、上
記の例に特に限定されず、種々組み合わせることがで
き、組み合わせた各実施の形態の効果を同様に得ること
ができる。
【０１３２】なお、上記の各説明では、駆動回路の一例
としてサステインドライバについて説明したが、スキャ
ンドライバについても上記と同様にして本発明を適用す
ることができ、その場合も同様の効果を得ることができ
る。例えば、本発明を図１に示すスキャンドライバ３に
適用した場合、以下のようになる。
【０１３３】図１２は、本発明の第６の実施の形態によ
るスキャンドライバの構成を示す回路図である。
【０１３４】図１２に示すスキャンドライバ３と図３に
示すサステインドライバ４とで異なる点は、初期化期間
において初期化パルスＰｓｅｔを発生させるためにトラ
ンジスタＱ３１〜Ｑ３６、コンデンサＣ３１〜Ｃ３４、
抵抗Ｒ３１，Ｒ３２、電源Ｖｃ１，Ｖｃ２および電源端
子Ｖ３１からなる初期化回路が付加されるとともに、保
護用のダイオードＤ３〜Ｄ５が付加された点であり、そ
の他の点は図３に示すサステインドライバ４と同様であ
るので、同一部分には同一符号を付し、以下詳細な説明
を省略する。
【０１３５】図１２に示すように、トランジスタＱ３１
の一端は電源端子Ｖ３１に接続され、他端は配線Ｌ３１
を介してノードＮ１に接続され、そのゲートはノードＮ
３１に接続される。トランジスタＱ３１は、寄生容量と
してドレイン・ソース間の容量ＣＰ３１を有し、トラン
ジスタＱ３１のドレイン・ソース間には、コンデンサＣ
３１が並列に接続される。コンデンサＣ３３は電源端子
Ｖ３１とノードＮ３１との間に接続される。電源端子Ｖ
３１には、セットアップ電圧Ｖｓｅｔが印加される。
【０１３６】トランジスタＱ３３の一端は、電源Ｖｃ１
を介してノードＮ１に接続され、他端は抵抗Ｒ３１の一
端に接続され、そのゲートには制御信号Ｓ３１が入力さ
れる。抵抗Ｒ３１の他端はノードＮ３１に接続される。
トランジスタＱ３５の一端はノードＮ３１に接続され、
他端はノードＮ１に接続され、そのゲートには制御信号
Ｓ３１が入力される。
【０１３７】トランジスタＱ３２の一端は接地端子に接
続され、他端は配線Ｌ３２を介してノードＮ１に接続さ
れ、そのゲートはノードＮ３２に接続される。トランジ
スタＱ３２は、寄生容量としてドレイン・ソース間の容
量ＣＰ３２を有し、トランジスタＱ３２のドレイン・ソ
ース間には、コンデンサＣ３２が並列に接続される。コ
ンデンサＣ３４はノードＮ１とノードＮ３２との間に接
続される。
【０１３８】トランジスタＱ３４の一端は、電源Ｖｃ２
を介して接地端子に接続され、他端は抵抗Ｒ３２の一端
に接続され、そのゲートには制御信号Ｓ３２が入力され
る。抵抗Ｒ３２の他端はノードＮ３２に接続される。ト
ランジスタＱ３６の一端はノードＮ３２に接続され、他
端は接地端子に接続され、そのゲートには制御信号Ｓ３
２が入力される。また、ダイオードＤ５とトランジスタ
Ｑ１との接続点とノードＮ２との間、ノードＮ２と接地
端子との間、および電源端子Ｖ１とトランジスタＱ１と
の間に保護用のダイオードＤ３〜Ｄ５が接続される。
【０１３９】本実施の形態では、トランジスタＱ３１，
Ｑ３２が電気素子、スイッチング手段および初期化パル
ス用スイッチング手段に相当し、配線Ｌ３１，Ｌ３２が
配線手段に相当し、コンデンサＣ３１，Ｃ３２が周波数
低減手段に相当し、電源端子Ｖ３１および接地端子が電
圧源に相当する。また、トランジスタＱ３１が第１のス
イッチング手段に相当し、トランジスタＱ３２が第２の
スイッチング手段に相当し、配線Ｌ３１が第１の配線手
段に相当し、配線Ｌ３２が第２の配線手段に相当し、コ
ンデンサＣ３１が第１の容量性素子に相当し、コンデン
サＣ３２が第２の容量性素子に相当し、電源端子Ｖ３１
が第１の電圧源に相当し、接地端子が第２の電圧源に相
当する。
【０１４０】次に、上記のように構成された初期化回路
の動作について説明する。なお、スキャンドライバ３の
維持期間の動作は、図１０に示すものと同様である。
【０１４１】まず、初期化パルスＰｓｅｔの電位が０Ｖ
にあるとき、トランジスタＱ３１，Ｑ３２はともにオフ
状態にある。すなわち、制御信号Ｓ３１，Ｓ３２がとも
にハイレベルになり、トランジスタＱ３５，Ｑ３６がオ
ンし、トランジスタＱ３１，Ｑ３２のゲート・ソース間
の電圧が０Ｖとなり、トランジスタＱ３１，Ｑ３２がと
もにオフ状態になる。
【０１４２】次に、制御信号Ｓ３１がローレベルになる
と、トランジスタＱ３５がオフし、トランジスタＱ３１
のゲートがノードＮ１から切り離される。このとき、ト
ランジスタＱ３３はオンし、コンデンサＣ３３および抵
抗Ｒ３１により決定される時定数で電源端子Ｖ３１から
電流がトランジスタＱ３１のゲートに流れ込み、トラン
ジスタＱ３１のゲートの電位が上昇し始める。
【０１４３】この状態でノードＮ３１の電圧がトランジ
スタＱ３１をオンできるレベルに達すると、トランジス
タＱ３１がオンし、トランジスタＱ３１のソース電位す
なわちノードＮ１の電位が徐々に上昇し始める。ノード
Ｎ１の電位が上昇すると、電源Ｖｃ１の電位もその上昇
とともに持ち上げられ、トランジスタＱ３３はオン状態
を継続する。この結果、ノードＮ１の電位が電源端子Ｖ
３１のセットアップ電圧Ｖｓｅｔに等しくなり飽和す
る。
【０１４４】次に、制御信号Ｓ３１をハイレベルに戻す
と、トランジスタＱ３５がオンし、トランジスタＱ３１
のゲートの電位は一気にソース電位と等しくなり、トラ
ンジスタＱ３１がオフする。この動作の直後に、制御信
号Ｓ３２をローレベルにすると、トランジスタＱ３６が
オフするとともにトランジスタＱ３４がオンし、抵抗Ｒ
３２およびコンデンサＣ３２により決定される時定数で
トランジスタＱ３２のゲートの電位が上昇し始める。
【０１４５】この状態でトランジスタＱ３２のゲートの
電位が所定の電位まで上昇すると、トランジスタＱ３２
がオンし始めるので、ノードＮ１に蓄えられた電荷は、
トランジスタＱ３２を介して徐々に放電されていき、ノ
ードＮ１の電圧は最後には０Ｖまで降下する。
【０１４６】上記の動作により、図２に示すように、初
期化期間において０Ｖから電圧Ｖｓｅｔまでランプ波形
により上昇し、Ｖｓｅｔから０Ｖまでランプ波形により
降下する三角波形の初期化パルスＰｓｅｔが出力され
る。
【０１４７】このように、トランジスタＱ３１，Ｑ３２
は、初期化期間において初期化パルスＰｓｅｔを発生さ
せるために用いられるが、パネル容量Ｃｐを充電および
放電するための電流が流れる電流供給経路のノードＮ１
に接続され、初期化期間以外の期間では、常にオフ状態
にされている。したがって、ノードＮ１に対してトラン
ジスタＱ３１，Ｑ３２のドレイン・ソース間の容量ＣＰ
３１，ＣＰ３２が負荷として接続されていることにな
る。
【０１４８】ここで、トランジスタＱ３１，Ｑ３２の一
端の電位が固定された電位すなわち電圧Ｖｓｅｔまたは
接地電位となっているため、ノードＮ１の電位が変化す
ると、ドレイン・ソース間の容量ＣＰ３１，ＣＰ３２に
高周波電流が流れる。特に、維持パルスＰｓｃが立ち上
がり時の電力回収期間からＶｓｕｓにクランプされる瞬
間すなわち時刻ｔ２の直後、および維持パルスＰｓｃが
立ち下がり時の電力回収期間から接地電位にクランプさ
れる瞬間すなわち時刻ｔ４の直後に、高周波電流が流れ
る。このため、トランジスタＱ３１，Ｑ３２のドレイン
・ソース間の容量ＣＰ３１，ＣＰ３２および配線Ｌ３
１，Ｌ３２により高周波のＬＣ共振が発生し、高周波の
電磁波として輻射される。
【０１４９】しかしながら、本実施の形態では、トラン
ジスタＱ３１，Ｑ３２にそれぞれ並列にコンデンサＣ３
１，Ｃ３２が接続されているため、トランジスタＱ３
１，Ｑ３２のドレイン・ソース間の容量ＣＰ３１，ＣＰ
３２および配線Ｌ３１，Ｌ３２のインダクタンス成分に
よるＬＣ共振に寄与する容量は、トランジスタＱ３１，
Ｑ３２のドレイン・ソース間の容量ＣＰ３１，ＣＰ３２
とコンデンサＣ３１，Ｃ３２とをそれぞれ加算した容量
となるため、その共振周波数はドレイン・ソース間の容
量ＣＰ３１，ＣＰ３２のみによる共振周波数より低減さ
れる。具体的には、これらのＬＣ共振の共振周波数が３
０ＭＨｚ未満になるように、コンデンサＣ３１，Ｃ３２
の容量が設定され、３０ＭＨｚ以上の不要の電磁波の輻
射を抑制している。
【０１５０】上記のように、本実施の形態でも、コンデ
ンサＣ３１，Ｃ３２がトランジスタＱ３１，Ｑ３２のド
レイン・ソース間に並列に接続されているので、配線Ｌ
３１，Ｌ３２のインダクタンス成分とトランジスタＱ３
１，Ｑ３２のドレイン・ソース間の容量ＣＰ３１，ＣＰ
３２により発生するＬＣ共振の共振周波数を３０ＭＨｚ
未満の低い周波数に移動させることができる。したがっ
て、３０ＭＨｚ以上の高周波の電磁波の輻射を抑制する
ことができる。
【０１５１】
【発明の効果】本発明によれば、駆動パルスを容量性負
荷に供給するためのパルス供給経路に接続される電気素
子の寄生容量と配線手段のインダクタンス成分とのＬＣ
共振の共振周波数を低減しているので、ＬＣ共振により
発生される電磁波の周波数を低減することができ、不要
な高周波の電磁波の輻射を抑制することができる。
【図面の簡単な説明】
【図１】本発明の第１の実施の形態によるサステインド
ライバを用いたプラズマディスプレイ装置の構成を示す
ブロック図
【図２】図１に示すＰＤＰにおけるスキャン電極および
サステイン電圧の駆動電圧の一例を示すタイミング図
【図３】本発明の第１の実施の形態による図１に示すサ
ステインドライバの構成を示す回路図
【図４】ＦＥＴのドレイン・ソース間にコンデンサを接
続した場合と接続しない場合とのドレイン・ソース間の
電圧と容量との関係を示す図
【図５】図１に示すプラズマディスプレイ装置から放出
される電磁波の輻射レベルと周波数との関係を示す図
【図６】本発明の第２の実施の形態によるサステインド
ライバの構成を示す回路図
【図７】図６に示すサステインドライバの維持期間の動
作を説明するためのタイミング図
【図８】本発明の第３の実施の形態によるサステインド
ライバの構成を示す回路図
【図９】本発明の第４の実施の形態によるサステインド
ライバの構成を示す回路図
【図１０】図９に示すサステインドライバの維持期間の
動作を説明するためのタイミング図
【図１１】本発明の第５の実施の形態によるサステイン
ドライバの構成を示す回路図
【図１２】本発明の第６の実施の形態によるスキャンド
ライバの構成を示す回路図
【図１３】従来のサステインドライバの構成を示す回路
図
【図１４】図１３に示すサステインドライバの維持期間
の動作を示すタイミング図
【符号の説明】
１ ＰＤＰ ２ データドライバ ３ スキャンドライバ ３ａ スキャンドライバＩＣ ４、４ａ〜４ｄ サステインドライバ １１ アドレス電極 １２ スキャン電極 １３ サステイン電極 Ｃ１〜Ｃ８，Ｃ３１〜Ｃ３４ コンデンサ Ｑ１〜Ｑ４，Ｑ３１〜Ｑ３６ 電界効果型トランジスタ Ｄ１〜Ｄ５ ダイオード
───────────────────────────────────────────────────── フロントページの続き (72)発明者 橋口 淳平 大阪府門真市大字門真1006番地 松下電器 産業株式会社内 Ｆターム(参考） 5C080 AA05 AA06 AA10 BB05 DD12 HH05 JJ02 JJ03 JJ04 JJ05

Claims (15)

    【特許請求の範囲】
  1. 【請求項１】 駆動パルスを出力して容量性負荷を駆動
    するための駆動回路であって、 前記駆動パルスを前記容量性負荷に供給するためのパル
    ス供給経路に接続される電気素子と、 前記電気素子に接続される配線手段と、 前記電気素子の寄生容量と前記配線手段のインダクタン
    ス成分とのＬＣ共振の共振周波数を低減する周波数低減
    手段とを備えることを特徴とする駆動回路。
  2. 【請求項２】 前記電気素子は、前記容量性負荷に前記
    駆動パルスを印加するためのスイッチング手段を含むこ
    とを特徴とする請求項１記載の駆動回路。
  3. 【請求項３】 前記容量性負荷は、複数の電極を有する
    放電セルを含み、 前記スイッチング手段は、前記放電セルを点灯させる維
    持期間において前記容量性負荷に維持パルスを印加する
    ための維持パルス用スイッチング手段を含むことを特徴
    とする請求項２記載の駆動回路。
  4. 【請求項４】 前記容量性負荷は、複数の電極を有する
    放電セルを含み、 前記スイッチング手段は、前記放電セルの前記電極の壁
    電荷を調整する初期化期間において前記容量性負荷に初
    期化パルスを印加するための初期化パルス用スイッチン
    グ手段を含むことを特徴とする請求項２記載の駆動回
    路。
  5. 【請求項５】 前記スイッチング手段は、電界効果型ト
    ランジスタを含むことを特徴とする請求項２〜４のいず
    れかに記載の駆動回路。
  6. 【請求項６】 前記電気素子は、他の電気素子に過電圧
    が印加されるのを防止するための保護手段を含むことを
    特徴とする請求項１記載の駆動回路。
  7. 【請求項７】 前記保護手段は、ダイオードを含むこと
    を特徴とする請求項６記載の駆動回路。
  8. 【請求項８】 前記周波数低減手段は、前記ＬＣ共振の
    共振周波数を３０ＭＨｚ未満に低減することを特徴とす
    る請求項１〜７のいずれかに記載の駆動回路。
  9. 【請求項９】 前記周波数低減手段は、前記電気素子に
    並列に接続される容量性素子を含むことを特徴とする請
    求項１〜８のいずれかに記載の駆動回路。
  10. 【請求項１０】 所定の電圧を供給する電圧源をさらに
    含み、 前記スイッチング手段の一端は、前記電圧源に接続さ
    れ、前記スイッチング手段の他端は、前記配線手段に接
    続されることを特徴とする請求項２〜５のいずれかに記
    載の駆動回路。
  11. 【請求項１１】 前記電圧源は、 前記駆動パルスを立ち上げるための第１の電圧を供給す
    る第１の電圧源と、 前記駆動パルスを立ち下げるための、前記第１の電圧よ
    り低い第２の電圧を供給する第２の電圧源とを含み、 前記スイッチング手段は、 一端が前記第１の電圧源に接続される第１のスイッチン
    グ手段と、 一端が前記第２の電圧源に接続される第２のスイッチン
    グ手段とを含み、 前記配線手段は、 一端が前記第１のスイッチング手段の他端に接続される
    第１の配線手段と、 一端が前記第２のスイッチング手段の他端に接続され、
    他端が前記第１の配線手段の他端に接続される第２の配
    線手段とを含み、 前記周波数低減手段は、 前記第１のスイッチング手段に並列に接続される第１の
    容量性素子と、 前記第２のスイッチング手段に並列に接続される第２の
    容量性素子とを含むことを特徴とする請求項１０記載の
    駆動回路。
  12. 【請求項１２】 一端が前記容量性負荷に接続されるイ
    ンダクタンス素子と、 前記容量性負荷から電荷を回収するための回収用容量性
    素子とをさらに含み、前記スイッチング手段は、 一端が前記インダクタンス素子の他端に接続される一方
    向性導通素子と、 一端が前記一方向性導通素子の他端と接続されるスイッ
    チング素子とを含み、 前記配線手段の一端は、前記スイッチング素子の他端に
    接続され、前記配線手段の他端は、前記回収用容量性素
    子の一端に接続され、 前記周波数低減手段は、前記スイッチング素子に並列に
    接続される容量性素子を含むことを特徴とする請求項
    ２、３および５のいずれかに記載の駆動回路。
  13. 【請求項１３】 一端が前記容量性負荷に接続されるイ
    ンダクタンス素子と、 前記容量性負荷から電荷を回収するための回収用容量性
    素子とをさらに含み、 前記スイッチング手段は、 一端が前記回収用容量性素子の一端と接続されるスイッ
    チング素子と、 一端が前記スイッチング素子の他端に接続される一方向
    性導通素子とを含み、 前記配線手段の一端は、前記一方向性導通素子の他端に
    接続され、前記配線手段の他端は、前記インダクタンス
    素子の他端に接続され、 前記周波数低減手段は、前記一方向性導通素子に並列に
    接続される容量性素子を含むことを特徴とする請求項
    ２、３および５のいずれかに記載の駆動回路。
  14. 【請求項１４】 所定の電圧を供給する電圧源と、 一端が前記容量性負荷に接続されるインダクタンス素子
    と、 前記容量性負荷から電荷を回収するための回収用容量性
    素子と、 前記回収用容量性素子と前記インダクタンス素子とを接
    続するための接続手段とをさらに含み、 前記保護手段は、一端が前記電圧源に接続され、他端が
    前記接続手段のインダクタンス素子側の一端と接続され
    る一方向性導通素子を含み、 前記周波数低減手段は、前記一方向性導通素子に並列に
    接続される容量性素子を含むことを特徴とする請求項６
    または７記載の駆動回路。
  15. 【請求項１５】 容量性負荷としての複数の電極を含む
    表示パネルと、 前記表示パネルの前記複数の電極を駆動する請求項１〜
    １４のいずれかに記載の駆動回路とを備える表示装置。
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