CN1783472A - 具有连接到布线的贯穿通道的衬底及其制造方法 - Google Patents
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- CN1783472A CN1783472A CNA2005101161393A CN200510116139A CN1783472A CN 1783472 A CN1783472 A CN 1783472A CN A2005101161393 A CNA2005101161393 A CN A2005101161393A CN 200510116139 A CN200510116139 A CN 200510116139A CN 1783472 A CN1783472 A CN 1783472A
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- 239000000758 substrate Substances 0.000 title claims abstract description 137
- 230000000149 penetrating effect Effects 0.000 title claims abstract description 78
- 238000000034 method Methods 0.000 title claims description 54
- 238000004519 manufacturing process Methods 0.000 title claims description 30
- 229910052751 metal Inorganic materials 0.000 claims description 64
- 239000002184 metal Substances 0.000 claims description 64
- 230000004888 barrier function Effects 0.000 claims description 46
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 claims description 33
- 238000010899 nucleation Methods 0.000 claims description 18
- 239000000853 adhesive Substances 0.000 claims description 15
- 230000001070 adhesive effect Effects 0.000 claims description 15
- 229910052763 palladium Inorganic materials 0.000 claims description 15
- 238000005868 electrolysis reaction Methods 0.000 claims description 13
- 238000009713 electroplating Methods 0.000 claims description 13
- 239000011347 resin Substances 0.000 claims description 11
- 229920005989 resin Polymers 0.000 claims description 11
- 230000015572 biosynthetic process Effects 0.000 claims description 10
- 238000010438 heat treatment Methods 0.000 claims description 8
- 239000002245 particle Substances 0.000 claims description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical group [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 19
- 238000003466 welding Methods 0.000 description 14
- 229920002120 photoresistant polymer Polymers 0.000 description 10
- 230000008569 process Effects 0.000 description 9
- 229910000679 solder Inorganic materials 0.000 description 9
- 238000007747 plating Methods 0.000 description 8
- 238000012545 processing Methods 0.000 description 7
- 238000011161 development Methods 0.000 description 6
- 239000003518 caustics Substances 0.000 description 5
- 230000007797 corrosion Effects 0.000 description 5
- 238000005260 corrosion Methods 0.000 description 5
- 230000007850 degeneration Effects 0.000 description 5
- 238000005516 engineering process Methods 0.000 description 5
- 239000003822 epoxy resin Substances 0.000 description 5
- 239000003112 inhibitor Substances 0.000 description 5
- 239000000463 material Substances 0.000 description 5
- 229920000647 polyepoxide Polymers 0.000 description 5
- 239000004065 semiconductor Substances 0.000 description 5
- 229910052710 silicon Inorganic materials 0.000 description 5
- 239000010703 silicon Substances 0.000 description 5
- 239000007921 spray Substances 0.000 description 5
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 4
- 239000007788 liquid Substances 0.000 description 4
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 4
- 238000005202 decontamination Methods 0.000 description 3
- 230000003588 decontaminative effect Effects 0.000 description 3
- 239000011521 glass Substances 0.000 description 3
- 238000007789 sealing Methods 0.000 description 3
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 3
- 238000002679 ablation Methods 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 239000003054 catalyst Substances 0.000 description 2
- 230000012010 growth Effects 0.000 description 2
- 229910000765 intermetallic Inorganic materials 0.000 description 2
- 238000003475 lamination Methods 0.000 description 2
- 238000012856 packing Methods 0.000 description 2
- 229910052697 platinum Inorganic materials 0.000 description 2
- 229920001721 polyimide Polymers 0.000 description 2
- 235000012239 silicon dioxide Nutrition 0.000 description 2
- 239000000377 silicon dioxide Substances 0.000 description 2
- VEXZGXHMUGYJMC-UHFFFAOYSA-M Chloride anion Chemical compound [Cl-] VEXZGXHMUGYJMC-UHFFFAOYSA-M 0.000 description 1
- 239000004642 Polyimide Substances 0.000 description 1
- 208000034189 Sclerosis Diseases 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- 238000000889 atomisation Methods 0.000 description 1
- 230000003197 catalytic effect Effects 0.000 description 1
- 238000005229 chemical vapour deposition Methods 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000012937 correction Methods 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 238000007772 electroless plating Methods 0.000 description 1
- 239000003063 flame retardant Substances 0.000 description 1
- 239000012530 fluid Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-M hydroxide Chemical compound [OH-] XLYOFNOQVPJJNP-UHFFFAOYSA-M 0.000 description 1
- 238000007654 immersion Methods 0.000 description 1
- 239000013528 metallic particle Substances 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 150000002940 palladium Chemical class 0.000 description 1
- 239000009719 polyimide resin Substances 0.000 description 1
- 238000006116 polymerization reaction Methods 0.000 description 1
- 238000007788 roughening Methods 0.000 description 1
- 238000005204 segregation Methods 0.000 description 1
- 238000003892 spreading Methods 0.000 description 1
- 230000007480 spreading Effects 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- NRUVOKMCGYWODZ-UHFFFAOYSA-N sulfanylidenepalladium Chemical compound [Pd]=S NRUVOKMCGYWODZ-UHFFFAOYSA-N 0.000 description 1
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Abstract
所公开的衬底由具有通孔的基底部件、提供在通孔中的贯穿通道、以及连接到贯穿通道的布线组成。此贯穿通道包括提供在通孔中的在基底部件二侧上具有二个端部的贯穿部分、形成在贯穿部分第一端部上以便被连接到布线的从基底部件伸出的第一突出、以及形成在贯穿部分第二端部上的从基底部件伸出的第二突出。第一突出和第二突出宽于通孔的直径。
Description
技术领域
本发明一般涉及到衬底及其制造方法,更确切地说是涉及到具有贯穿基底部件的贯穿通道和连接到贯穿通道的布线的衬底及其制造方法。
背景技术
近年来,利用半导体的精细加工技术,开发了微机械和诸如其中安装半导体器件的插件之类的衬底的所谓MEMS(微电机***)的封装件。上述衬底包括形成在衬底二侧上的布线以及贯穿衬底并电连接形成在衬底二侧上的布线的贯穿通道。
图1示出了一个常规衬底。如图1所示,衬底10由硅部件11、绝缘层13、贯穿通道15、布线17和21、阻焊剂19和24、以及布线21组成。在硅部件11中,形成了通孔12。绝缘层13被形成在其中形成通孔12的硅部件11的表面上。绝缘层13被提供来将硅部件11隔离于贯穿通道15、布线17、以及布线21。柱形的贯穿通道15被提供在其中形成绝缘层13的通孔12中。而且,贯穿通道15的端部15a和绝缘层13的表面13a要高度一样,且贯穿通道15的另一端部15b和绝缘层13的另一表面13b要高度一样。用下列步骤来形成上述的贯穿通道15:用溅射方法在其中形成绝缘层13的硅部件11上形成引晶层,以及用电解镀方法在引晶层上离析出导电金属层并生长金属层(例如见专利文献1)。
具有外部连接端子18的布线17,被提供在硅部件11的上表面上,以便被连接到贯穿通道15的端部15a。MEMS和半导体器件25被安装在外部连接端子18上。暴露外部连接端子18的阻焊剂层19,被提供在硅部件11的上表面上,以便覆盖除了外部连接端子18之外的布线17。
具有外部连接端子22的布线21,被提供在硅部件11的下表面上,以便被连接到贯穿通道15的另一端部15b。外部连接端子22被提供来连接到诸如母板之类的另一衬底。暴露外部连接端子22的阻焊剂24,被提供在硅部件11的下表面上,以便覆盖除了外部连接端子22之外的布线21。
[专利文献1]日本专利申请公开No.1-258457。
常规贯穿通道15的形状是柱形。但水渗透到贯穿通道15的端部15a与绝缘层13之间的间隙以及另一端部15b与绝缘层13之间的间隙中,从而使贯穿通道15退化,还使连接布线17和21的贯穿通道15的电连接可靠性退化。而且,根据形成贯穿通道15的常规方法,引晶层表面上的分立的导电金属层被形成在通孔12的内端部上,且导电金属层沿通孔12内端部生长,从而在贯穿通道15的中心附近保留一个空洞(空腔)。因此,连接到布线17和21的贯穿通道15的电连接可靠性退化。
发明内容
本发明的一般目的是提供一种衬底及其制造方法,此衬底改善了连接布线的贯穿通道的电连接可靠性,此方法基本上避免了由相关技术的限制和缺点所引起的一个或多个问题。
本发明的特点和优点在下列描述中被提出,并部分地从此描述和附图中变得明显,或可以借助于根据描述提供的技术来实施本发明而得到了解。利用说明书中使本技术领域一般熟练人员得以实施本发明的完整、清晰、简明而准确地具体指出的衬底,可以实现并得到本发明的这些目的和其它的特点和优点。
根据本发明的至少一个实施方案,提供了一种衬底,它包括具有通孔的基底部件、提供在通孔中的贯穿通道、以及连接到贯穿通道的第一布线和第二布线,其中,贯穿通道包括提供在通孔中的贯穿部分、从基底部件伸出的第一突出、以及从基底部件伸出的第二突出,贯穿部分具有第一端部和第二端部,第一突出被连接到贯穿部分的第一端部,以便被连接到第一布线,第二突出被连接到贯穿部分的第二端部,以便被连接到第二布线,其中,第一突出和第二突出比通孔的直径更宽。
因此,比通孔的直径更宽的第一突出和第二突出,被连接到贯穿通道,以便防止水渗透到贯穿部分与基底部件之间的间隙,从而防止了贯穿通道的退化;于是能够改善连接到布线的贯穿通道的电连接可靠性。
根据本发明的另一实施方案,提供了一种衬底,它包括具有通孔的基底部件、提供在通孔中的贯穿通道、以及连接到贯穿通道的第一布线和第二布线,其中,贯穿通道包括提供在具有第一端部和第二端部的通孔中的贯穿部分、要连接到被连接于贯穿部分第一端部的第一布线的一个突出、以及要连接到连接于贯穿部分第二端部的第二布线的另一突出,其中,突出比通孔的直径更宽。
因此,比通孔的直径更宽的突出,被连接到贯穿通道的各个端部,以便防止水渗透到贯穿部分与基底部件之间的间隙,从而防止了贯穿通道的退化;于是能够改善连接到布线的贯穿通道的电连接可靠性。
根据本发明的另一实施方案,提供了一种制造衬底的方法,此衬底包含具有通孔的基底部件、形成在基底部件内的通孔中的贯穿通道、以及连接到贯穿通道端部的布线,其中,贯穿通道包括提供在通孔中的具有第一端部和第二端部的贯穿部分、从基底部件伸出的被连接到贯穿部分第一端部以便被连接到布线的第一突出、以及从基底部件伸出的被连接到贯穿部分第二端部的第二突出,其中,第一突出和第二突出比通孔的直径更大。此方法还包括形成贯穿通道的步骤以及形成布线以便被连接到第一突出的步骤。
根据本发明的至少一个实施方案,比通孔直径都宽的第一突出和第二突出,被连接到贯穿通道,以便防止水渗透到贯穿部分与基底部件之间的间隙,从而防止了贯穿通道的退化;于是能够改善连接到布线的贯穿通道的电连接可靠性。
因此,能够提供其中改善了连接到布线的贯穿通道的电连接可靠性的衬底及其制造方法。
附图说明
从结合附图的下列详细描述中,本发明的其它目的和进一步特点是显而易见的,其中:
图1示出了现有技术的衬底。
图2是根据本发明第一实施方案的衬底的剖面图。
图3是用来制造根据本实施方案的衬底的基底部件的平面图。
图4-29示出了根据第一实施方案的衬底的各个制造步骤。
图30-36示出了衬底的其它制造步骤。
具体实施方式
下面参照附图来描述本发明的各个实施方案。
(第一实施方案)
首先参照图2来详细描述根据本发明第一实施方案的衬底50的构造。图2是根据本发明第一实施方案的衬底的剖面图。衬底50由基底部件51、绝缘层53、贯穿通道54、绝缘层65、布线68、第一扩散保护层61、第二扩散保护层71、以及阻焊剂层75组成。衬底50是一种插件。如图2所示,例如其中采用了制造半导体的精细加工技术的MEMS(微电机***)和半导体器件,被安装在衬底50的下表面上,同时,诸如母板之类的另一衬底被连接在衬底50的上侧上。
基底部件51是由硅组成的硅部件。基底部件51的厚度M1是例如150微米。用来安置贯穿通道54的多个通孔52被提供在基底部件51中以便贯穿基底部件51。形成了孔径为R1的通孔52。绝缘层53被提供在包括通孔52的基底部件51表面上。因此,借助于在包括通孔52的基底部件51表面上提供绝缘层53,基底部件51被隔离于贯穿通道54。应该指出的是,除了硅之外,诸如玻璃材料之类的材料也可以被用作基底部件51。此外,当采用诸如玻璃材料之类的具有绝缘性质的材料时,无须提供绝缘层53。
贯穿通道54由贯穿部分55、作为第一突出的布线连接部分56、以及作为第二突出的布线连接焊点57组成。贯穿部分55被提供在其上形成绝缘层53的通孔52中,且直径被预定为R1(以下,此直径被称为“直径R1”)。贯穿部分55的尺寸为直径R1。
布线连接部分56被提供在贯穿部分55的上端部上。布线连接部分56从基底部件51侧51a伸出,且布线连接部分56的尺寸比贯穿部分55的直径R1更宽。换言之,布线连接部分56的宽度W1被设定为大于贯穿部分55的直径R1(W1>R1)。布线连接部分56与贯穿部分55成统一体。布线连接部分56被提供来连接布线68。
连接焊点57被提供在贯穿部分55的下表面上。连接焊点57,从基底部件51的51b侧伸出,且连接焊点57的尺寸比贯穿部分55的直径R1更宽。换言之,连接焊点57的宽度W2被设定为大于贯穿部分55的直径R1(W2>R1)。连接焊点57被提供来连接诸如半导体器件之类的器件。导电金属层使贯穿部分55、布线连接部分56、以及连接焊点57成统一体。例如Cu可以被用作导电金属层。
第一扩散保护层61被提供在连接焊点57上。第一扩散保护层61被形成来改善焊料的浸润性并防止包含在贯穿通道54中的Cu扩散进入到连接于连接焊点57的焊料(未示出)中。第一扩散保护层包含例如由Ni层62和Au层63组成的叠层。Ni层62的厚度是例如2-5微米,而Au层63的厚度是例如0.1-0.5微米。应该指出的是,例如可以用Ni/Pd层和Ni/Pd/Au层代替上述Ni/Au层作为第一扩散保护层61(Ni层被连接到连接焊点57)。
具有暴露布线连接部分56的窗口部分的绝缘层65,被形成在基底部件51的表面51a上。例如其中分散有用作电镀催化剂的金属颗粒和金属化合物(氯化物、氢氧化物、氧化物等)颗粒的树脂,可以被用于绝缘层65。在此情况下例如可以采用环氧树脂和聚酰亚胺树脂作为树脂。钯和铂可以被用作起催化剂作用的金属,铂尤其可取。而且,例如氯化钯和硫化钯可以被用作金属化合物。在本实施方案中,其中分散有钯颗粒的环氧树脂被用作绝缘层65。利用包括钯的树脂作为绝缘层65,能够直接在绝缘层65上执行无电镀而无须执行去污处理和钯激活处理。因而能够简化衬底50的制造步骤。绝缘层65的厚度M2是例如5微米。
布线68被提供在绝缘层65上,以便被连接到布线连接部分56。具有外部连接端子69的布线68由导电金属层67和引晶层66组成。外部连接端子69被提供来连接到诸如母板之类的衬底。借助于提供外部连接端子69,外部连接端子69的位置能够相应于母板之类的衬底的外部连接端子的位置而被安置。例如Cu层可以被用作导电金属层67。当Cu层被用作导电金属层67时,导电金属层67的厚度M3是例如3-10微米。例如Ni层可以被用作引晶层66。引晶层66的厚度是例如约为0.1微米。
具有暴露外部连接端子69的窗口部分76的阻焊剂层75,被提供来覆盖布线68和除了外部连接端子69之外的绝缘层65。阻焊剂层75被提供来保护布线68。
第二扩散保护层71被提供在外部连接端子69上。第二扩散保护层71被提供来改善焊料的浸润性并防止包含在布线68中的Cu扩散进入到连接于外部连接端子69的焊料(未示出)中。第二扩散保护层71包含例如Ni层72和Au层73组成的叠层。Ni层72的厚度是例如2-5微米,而Au层73的厚度是例如0.1-0.5微米。应该指出的是,例如Ni/Pd层和Ni/Pd/Au层可以代替上述Ni/Au层被用作第二扩散保护层71(Ni层必须被连接到外部连接端子69)。
图3是用来制造根据本实施方案的衬底50的基底部件51的平面图。图3所示的“A”是其中形成衬底50的区域(以下“A”被称为“衬底形成区域A”)。如图3所示,根据本实施方案,具有多个衬底形成区域A的硅基底部件(硅晶片)被用作基底部件51。如上所述,硅部件被用作基底部件51,并在执行各个制造步骤之后,基底部件51被切割成多个小片,从而就同时提供了多个衬底50。因而改善了衬底50的制造产率。
接着,参照图4-29来描述用来制造根据第一实施方案的衬底50的方法。图4-29示出了根据第一实施方案的衬底50的各个制造步骤。应该指出的是,给出了其中硅部件被用作基底部件51的例子。
首先,如图4所示,粘合剂92被提供在支持板91上。支持板91被提供来支持基底部件51。例如玻璃部件和硅部件(更具体地说是硅晶片)可以被用作支持板91。当硅部件被用作支持板91时,支持板91的厚度M4是例如725微米。粘合剂92被提供在支持板91上,以便键合下面描述的金属箔93。例如,当被加热时丧失粘合性的热剥离带和热烧蚀粘合剂,可以被用作粘合剂92。
接着,如图5所示,诸如Cu层之类的金属箔93经由粘合剂92被键合在支持板91上(金属箔提供步骤)。然后如图6所示,不处于暴光状态的第一抗蚀剂层94被形成在金属箔93上(第一抗蚀剂层形成步骤)。例如光敏干膜抗蚀剂和液体抗蚀剂,可以被用作是为具有粘合性的抗蚀剂的第一抗蚀剂层94。
利用具有粘合性的抗蚀剂层94,具有通孔52的基底部件51能够经由第一抗蚀剂层94被固定在支持板91上(如图7所示)。第一抗蚀剂层的厚度是例如10-15微米。而且,可以用诸如环氧树脂和聚酰亚胺之类的其它粘合剂来代替第一抗蚀剂层94,只要粘合剂能够被某些处理液体溶解即可。
接着,如图7所示,直径为R2(R1=R2)的通孔52被形成,并在具有粘合性的第一抗蚀剂层94上提供和固定其中形成绝缘层53以便覆盖基底部件51(包括对应于通孔52的基底部件51部分)的基底部件51(基底部件安置步骤)。例如可以用钻孔加工、激光加工、以及各向异性腐蚀中的一种方法,来形成通孔52。而且,通孔52的直径R2可以被适当地选择为例如10-60微米。例如用CVD方法形成的氧化层(二氧化硅)以及用氧化炉形成的热氧化层(二氧化硅),可以被用作绝缘层53。而且,基底部件51的厚度M1是例如150微米。
接着,如图8所示,显影剂被馈送到通孔52内部,然后,显影剂就溶解通孔52所暴露的第一抗蚀剂层94,以形成空间97(空间形成步骤)。空间97比通孔52的直径R2更宽,且空间97的宽度W2大于通孔52的直径R2(W2>R2)。作为用来将显影剂馈送到通孔52中的一种方法,例如可以采用浸入显影和喷雾显影,在浸入显影中,图7所示的结构被浸入在显影剂中,而在喷雾显影中,显影剂像阵雨似地被喷洒到通孔52上。
无论在哪种显影方法中,借助于控制在显影剂中的浸润时间,都能够形成空间。作为用喷雾显影形成空间97的条件,例如显影剂喷雾压力为每平方厘米2.0kgf,温度为25-30℃,而显影剂喷雾时间为6分钟。应该指出的是,“通孔的尺寸”是通孔52的直径R2。然后,对图8所示的结构进行热处理(第一热处理),并对不处于暴露状态的第一抗蚀剂层94进行聚合反应,以便使第一抗蚀剂层94硬化(第一抗蚀剂层硬化步骤)。于是,第一抗蚀剂层被硬化,第一抗蚀剂层从而能够耐受镀液。
接着,如图9所示,通孔52被暴露在形成于基底部件51的表面51a上的绝缘层53上,并形成具有大于通孔52直径R2的窗口部分102的第二抗蚀剂层101(第二抗蚀剂层形成步骤)。第一窗口部分亦即窗口部分102的直径W1被形成为大于通孔52的直径R2(W1>R2)。
接着,如图10所示,利用金属箔93作为电源层,Au层63和Ni层62根据电解镀方法被依次离析在金属箔93上并生长,从而形成第一扩散保护层61(第一扩散保护层形成步骤)。Au层63的厚度是例如0.1-0.5微米,而Ni层62的厚度是例如2-5微米。于是,用电解镀方法形成了第一扩散保护层61;从而能够得到具有优越于无电镀方法形成的层的扩散保护层。
接着,如图11所示,利用金属箔93和Ni层62作为电源层,导电金属层104被离析和生长,以便填充空间97、通孔52、以及窗口部分102(导电金属层形成步骤)。在此情况下,导电金属层104从第二抗蚀剂层101的表面101a伸出。例如Cu层可以被用作导电金属层104。
接着,如图12所示,从第二抗蚀剂层101的表面101a伸出的导电金属层104被研磨清除,使导电金属层104与第二抗蚀剂层104的表面101a齐平。下列元件于是就被同时形成:空间97中宽度为W2的连接焊点57、通孔52中直径为R1的贯穿部分55、以及窗口部分102中宽度为W1的布线连接部分56(第一突出)。于是就形成了贯穿通道54。宽度W1和W2大于贯穿部分55的直径R1。
因此,借助于在贯穿通道54中形成宽于贯穿部分55的直径R1的连接焊点57和布线连接部分56,防止了水渗透到贯穿部分55与基底部件51之间的间隙,从而控制了贯穿通道54的退化。因此,改善了连接到布线68的贯穿通道54的电连接可靠性。
而且,金属箔93被用作电源层,导电金属层104被离析和生长在金属箔93上以填充空间97、通孔52、以及第一窗口部分102,从而防止了空洞(空腔)形成在贯穿通道54中。
接着,如图13所示,第二抗蚀剂层101被抗蚀剂剥离剂清除(第二抗蚀剂层清除步骤)。然后如图14所示,具有暴露布线连接部分56的窗口部分103的绝缘层65,被提供在基底部件51的表面51a上(绝缘层形成步骤)。在本实施方案中,例如其中包含钯颗粒的环氧树脂被用作绝缘层65。绝缘层65的厚度M2是例如5微米。
如图15所示,用无电镀方法,引晶层66被形成在绝缘层65的上表面65a和横向侧65b上(引晶层形成步骤)。应该指出的是,通常在用无电镀方法于树脂层上形成引晶层之前,预先对树脂(绝缘层)的表面执行去污处理和糙化,然后对树脂表面执行钯激活处理。此钯激活处理是将要镀敷的样品浸入在催化处理液或加速处理液之一中,待要成为用无电镀方法镀敷的核心的钯就被离析在树脂的表面上。根据常规的技术,直到执行钯激活处理,无法用无电镀方法来形成镀层。因此,根据常规技术,步骤是非常麻烦的。
相反,根据本实施方案,其中包含钯颗粒的环氧树脂材料被涂敷到绝缘层,使引晶层66能够用无电镀方法直接形成在绝缘层上而无须预先执行去污处理和钯激活处理。因而能够简化衬底50的制造步骤。例如Ni层可以被用作引晶层66。当其中包含钯颗粒的树脂被用作绝缘层65时,能够形成Ni-B层。
接着,如图16所示,具有对应于其中提供布线68的区域的窗口部分106的干膜抗蚀剂层105,被形成在引晶层66上。干膜抗蚀剂层105的厚度是例如10-15微米。然后如图17所示,用布线连接部分56和引晶层66作为电源层,用电解镀方法,导电金属层67被离析在窗口部分103和106上。导电金属层67和贯穿通道54因而被电连接。在连接导电金属层67和贯穿通道54之后,如图18所示,用抗蚀剂剥离剂清除干膜抗蚀剂层105。然后如图19所示,干膜抗蚀剂111被形成在图18所示的结构上,使对应于其中要形成外部连接端子69的区域B的导电金属层67暴露。窗口部分112被形成在干膜抗蚀剂层111中,且对应于区域B的导电金属层67从窗口部分112暴露。
接着,如图20所示,用导电金属层67作为电源层,根据电解镀方法,Ni层72和Au层73被依次离析和生长在从窗口部分112暴露的导电金属层67上,以便形成第二扩散保护层71(第二扩散保护层形成步骤)。Ni层72的厚度是例如2-5微米,而Au层73的厚度是例如0.1-0.5微米。从而用电解镀方法形成了第二扩散保护层71,于是,能够得到具有优越于用无电镀方法形成的层的第二扩散保护层71。在形成第二扩散保护层71之后,清除干膜抗蚀剂层111。
接着,如图21所示,干膜抗蚀剂层114被形成,以便仅仅覆盖导电金属层67和第二扩散保护层71。然后如图22所示,用腐蚀方法清除绝缘层65上形成的引晶层66。从而提供外部连接端子69,并形成包括引晶层66和导电金属层67的布线68。如图23所示,在清除引晶层66之后,用抗蚀剂剥离剂清除干膜抗蚀剂114。
接着,如图24所示,抗热保护部件亦即抗温带116被固定,以便覆盖布线68、第二扩散保护层71、以及绝缘层65的上表面65a(保护部件安置步骤)。抗温带116是具有抗腐蚀剂性质的带。布线68和第二扩散保护层于是被抗温带116覆盖,以便防止布线68和第二扩散保护层71受到在从基底部件51清除支持板91中执行的第二热处理(如图25所示)中产生的热的影响。例如阻燃的PET和PEN可以被用作抗温带116。应该指出的是,抗温带116被提供来覆盖至少布线68和第二扩散保护层71。
接着,如图25所示,图24所示的结构被加热(第二热处理),并从基底部件51清除粘合剂92和支持板91(支持板清除步骤)。根据本实施方案,在被加热时丧失粘合性的热剥离带被用作粘合剂92。例如作为第二热处理的条件,加热温度为150℃,而加热时间为30分钟。然后如图26所示,用腐蚀方法清除金属箔93(金属箔清除步骤)。第一抗蚀剂层94和第一扩散保护层61从而被暴露。如上所述,布线68被耐受腐蚀剂的抗温带116覆盖,布线68从而不被腐蚀。
接着,如图27所示,用烧蚀液清除第一抗蚀剂层94。然后如图28所示,清除抗热带116。在清除抗温带之后,如图29所示,阻焊剂75被提供,以便暴露第二扩散保护层71并覆盖布线68和绝缘层65。阻焊剂75具有暴露第二扩散保护层71的窗口部分76。在形成阻焊剂75之后,基底部件51被切割成多个图2所示的衬底50。
如所述各制造步骤那样,贯穿通道54被形成,它包括形成于贯穿部分55一端上且宽于贯穿部分55的直径R1的布线连接部分56以及形成于贯穿部分55另一端上并具有宽于贯穿部分55的直径R1的形状的连接焊点57。因而防止了水渗透到贯穿部分55与基底部件51之间的间隙,从而控制了贯穿通道54的退化;因此,改善了连接到布线68的贯穿通道54的电连接可靠性。而且,布线68被连接到具有宽于贯穿部分55直径R1的形状的布线连接部分56,布线连接部分56从而被容易地连接到布线68。
应该指出的是,在图13所示的衬底中,用电解镀方法,扩散保护层被形成在连接部分56上而无须形成诸如导电金属层之类的上述各层。然后,支持板91、粘合剂92、金属箔93、以及第一抗蚀剂层94被清除,以便得到仅仅具有贯穿通道54的衬底。此衬底也可以被应用于本发明。
(第二实施方案)
接着,参照图30-36来描述制造衬底50的另一种方法。图30-36示出了衬底50的其它方法的制造步骤。
首先,如图30所示,粘合剂92被提供在支持板91上,且诸如Cu之类的金属箔93被固定在粘合剂92上(金属箔安置步骤)。然后,具有窗口部分119的干膜抗蚀剂118被提供在金属箔93上。窗口部分119暴露了金属箔93。
接着,如图31所示,用金属箔93作为电源层,Au层63和Ni层62依次被离析和生长在从窗口部分119暴露的金属箔93上,以便形成第一扩散保护层61(第一扩散保护层形成步骤)。然后,如图32所示,用抗蚀剂剥离剂清除干膜抗蚀剂118。
接着,如图33所示,不处于暴光状态的第一抗蚀剂层121被提供在金属箔93上,以便覆盖第一扩散保护层61(第一抗蚀剂层形成步骤)。例如光敏干膜树脂可以被用作是为具有粘合性的抗蚀剂的第一抗蚀剂层121。第一抗蚀剂层121的厚度是例如10-15微米。
接着,如图34所示,具有直径R2的通孔52被形成,且其中形成绝缘层53以便覆盖基底部件51的表面的基底部件51(包括对应于通孔52的基底部件部分),被安置在具有粘合性的第一抗蚀剂层121上,并被固定在第一抗蚀剂层121上(基底部件安置步骤)。
接着,如图35所示,显影剂被馈送到通孔52中,且显影剂溶解暴露在通孔52上的第一抗蚀剂层121,以便形成空间123(空间形成步骤)。空间123是宽于通孔52的直径R2的空间,且空间123的宽度W3大于通孔52的直径R2(W3>R2)。空间123从Ni层62被暴露。至于用来馈送通孔52中的显影剂的方法,可以应用第一实施方案所述的浸入显影和喷雾显影。
接着,如图36所示,通孔52被暴露在形成于基底部件51的表面51a上的绝缘层53上,并形成具有宽于通孔52直径R2的窗口部分102的第二抗蚀剂层101(第二抗蚀剂层形成步骤)。是为第一窗口部分的窗口部分102的宽度W1大于通孔52的直径R2(W1>R2)。然后,可以用相似于图11-29的步骤来制造衬底50。
因此,借助于在第一扩散保护层形成步骤与导电金属层形成步骤之间***另一步骤(例如在本实施方案中是第一抗蚀剂层形成步骤),防止了用来形成Ni层63的镀液与用来形成导电金属层104的镀液发生混合。因此能够形成具有优异层的导电金属层104。
而且,本发明不局限于这些实施方案,而是可以做出各种改变和修正而不偏离本发明的范围。应该指出的是,布线68仅仅被形成在基底部件51的上表面51a上,但也可以根据图14-23所示相似的制造步骤来提供连接到连接焊点57的布线(包括外部连接端子)。于是,布线被安置在基底部件51的二侧51a和51b上,以便连接诸如母板之类的各种衬底、半导体器件、以及MEMS。因此,能够扩大衬底的应用范围,并能够改善形成在基底部件51二侧上的布线之间的电连接可靠性。
本发明能够被应用于改善连接布线的贯穿通道电连接可靠性的衬底及其制造方法。
根据本发明的至少一个实施方案,扩散保护层被提供在外部连接端子上和第二突出上,且当布线和贯穿通道包含其中的Cu时,由扩散保护层防止了包含在外部连接端子和第二突出中的Cu发生扩散。
利用金属箔作为电源层,导电金属层被离析在金属箔上,并根据电解镀方法生长;空间、通孔、以及第一窗口部分依次被导电金属层填充成为贯穿通道,从而防止了空洞(空腔)形成在贯穿通道中。
第一抗蚀剂层根据第一热处理而被硬化,以便提供耐受腐蚀剂的第一抗蚀剂层。
而且,第一扩散保护层根据电解镀方法而被形成,从而能够得到具有优越于根据无电镀方法形成的层的扩散保护层。
由于其中包含钯颗粒的树脂层被用于绝缘层,故当引晶层被形成在绝缘层上时,无须预先对绝缘层执行处理。因此,能够简化衬底的制造步骤。
第二扩散保护层根据电解镀方法而被形成,从而能够得到具有优越于根据无电镀方法形成的层的扩散保护层。
抗热保护部件被提供来覆盖至少布线和第二扩散保护层,从而防止了布线和第二扩散保护层受到在为从基底部件清除粘合剂和支持板而执行的第二热处理中产生的热的影响。
根据本发明实施方案的另一情况,制造衬底的方法包括在清除支持板的步骤之后用腐蚀方法清除金属箔的步骤、清除第一抗蚀剂层的步骤、以及在清除第一抗蚀剂层的步骤之后清除保护部件的步骤。
根据上述的各个步骤,在清除金属箔的步骤之后清除保护部件,以便防止布线被腐蚀。
根据本发明的实施方案,形成第一扩散保护层的步骤在安置金属箔的步骤之后立即被执行;于是防止了用来形成第一扩散保护层的镀液与用来形成贯穿通道的另一镀液发生混合,从而能够形成具有优异层的导电金属层。
根据本发明的实施方案,能够提供其中连接到布线的贯穿通道的电连接可靠性得到了改善的衬底及其制造方法。
Claims (13)
1.一种衬底,其特征是包含:
具有通孔的基底部件;
提供在所述通孔中的贯穿通道,
其中,所述贯穿通道包括
提供在所述通孔中的贯穿部分,所述贯穿部分具有第一端和第二端;
从所述基底部件伸出的第一突出,所述第一突出被连接到所述贯穿部分的第一端;以及
从所述基底部件伸出的第二突出,所述第二突出被连接到所述贯穿部分的第二端,
其中,所述第一突出和第二突出宽于所述通孔的直径。
2.权利要求1所述的衬底,其中,扩散保护层被形成在所述第一突出上和所述第二突出上。
3.一种衬底,其特征是包含:
具有通孔的基底部件;
提供在所述通孔中的贯穿通道;以及
连接到所述贯穿通道的第一布线和第二布线,其中,所述贯穿通道包括
提供在所述通孔中的贯穿部分,它具有第一端和第二端;以及
被连接于所述贯穿部分第一端的待要连接到所述第一布线的突出,以及被连接于所述贯穿部分第二端的待要连接到所述第二布线的另一突出,
其中,所述突出宽于所述通孔的直径。
4.权利要求3所述的衬底,其中,所述第一布线和所述第二布线之一具有外部连接端子;且扩散保护层被形成在所述外部连接端子上。
5.一种制造衬底的方法,此衬底的特征是包含具有通孔的基底部件;以及形成在所述基底部件中所述通孔内的贯穿通道,其中,所述贯穿通道包括:提供在所述通孔中的贯穿部分,所述贯穿部分具有第一端和第二端;从所述基底部件伸出的第一突出,所述第一突出被连接到所述贯穿部分的第一端;以及从所述基底部件伸出的第二突出,所述第二突出被连接到所述贯穿部分的第二端,其中,所述第一突出和第二突出宽于所述通孔的直径,
所述方法包含形成所述贯穿通道的步骤。
6.权利要求5所述的制造衬底的方法,其中,形成所述贯穿通道的步骤还包括下列步骤:
用粘合剂将金属箔固定在支持板上;
在所述金属箔上形成第一抗蚀剂层;
在所述第一抗蚀剂层上设置具有所述通孔的所述基底部件;
用显影剂清除从所述通孔暴露的所述第一抗蚀剂层,以便暴露所述金属箔并形成宽于所述通孔直径的空间;
形成具有宽于所述通孔直径的第一窗口部分的第二抗蚀剂层,以便暴露所述基底部件中的通孔;以及
按照电解镀方法形成导电金属层,以便填充所述空间、所述通孔、以及所述第一窗口部分。
7.权利要求6所述的制造衬底的方法,还包含在形成所述空间的步骤之后,按照热处理方法硬化所述第一抗蚀剂层的步骤。
8.权利要求6所述的制造衬底的方法,还包含在形成所述第二抗蚀剂层的步骤之后,按照电解镀方法,在所述空间中暴露的所述金属箔上形成第一扩散保护层的步骤。
9.权利要求6所述的制造衬底的方法,还包括形成布线以便连接到所述第一突出的布线形成步骤,所述布线形成步骤包含:
清除所述第二抗蚀剂层;
在所述基底部件上形成具有暴露所述第一突出的第二窗口部分的绝缘层;以及
在该处形成所述布线的所述绝缘层上形成引晶层;
其中,所述绝缘层包含其中含有钯颗粒的树脂。
10.权利要求9所述的制造衬底的方法,其中,所述布线具有外部连接端子,所述方法还包含在形成所述布线的步骤之后,按照电解镀方法,在所述外部连接端子上形成第二扩散保护层的步骤。
11.权利要求10所述的制造衬底的方法,还包括下列步骤:
在形成所述第二扩散保护层的步骤之后,设置抗热保护部件以便覆盖至少所述布线和所述第二扩散保护层;以及
在形成所述保护部件之后,按照热处理方法从所述基底部件清除所述粘合剂和所述支持板。
12.权利要求11所述的制造衬底的方法,还包括下列步骤:
清除所述第一抗蚀剂层;以及
在清除所述第一抗蚀剂层的步骤之后,清除所述保护部件。
13.权利要求8所述的制造衬底的方法,其中,在设置所述金属箔的步骤之后,立即执行形成所述第一扩散保护层的步骤。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004323939A JP3987521B2 (ja) | 2004-11-08 | 2004-11-08 | 基板の製造方法 |
JP2004323939 | 2004-11-08 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN1783472A true CN1783472A (zh) | 2006-06-07 |
CN100517678C CN100517678C (zh) | 2009-07-22 |
Family
ID=35784728
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CNB2005101161393A Expired - Fee Related CN100517678C (zh) | 2004-11-08 | 2005-10-24 | 具有连接到布线的贯穿通道的衬底及其制造方法 |
Country Status (7)
Country | Link |
---|---|
US (2) | US20060096781A1 (zh) |
EP (1) | EP1656006B1 (zh) |
JP (1) | JP3987521B2 (zh) |
KR (1) | KR20060054104A (zh) |
CN (1) | CN100517678C (zh) |
DE (1) | DE602005004586T2 (zh) |
TW (1) | TWI402956B (zh) |
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- 2004-11-08 JP JP2004323939A patent/JP3987521B2/ja active Active
-
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- 2005-10-10 EP EP05256299A patent/EP1656006B1/en not_active Expired - Fee Related
- 2005-10-10 DE DE602005004586T patent/DE602005004586T2/de active Active
- 2005-10-11 US US11/247,813 patent/US20060096781A1/en not_active Abandoned
- 2005-10-12 TW TW094135505A patent/TWI402956B/zh active
- 2005-10-19 KR KR1020050098430A patent/KR20060054104A/ko not_active Application Discontinuation
- 2005-10-24 CN CNB2005101161393A patent/CN100517678C/zh not_active Expired - Fee Related
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DE602005004586T2 (de) | 2009-03-19 |
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KR20060054104A (ko) | 2006-05-22 |
JP2006135174A (ja) | 2006-05-25 |
US20080261396A1 (en) | 2008-10-23 |
CN100517678C (zh) | 2009-07-22 |
EP1656006A1 (en) | 2006-05-10 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
CF01 | Termination of patent right due to non-payment of annual fee | ||
CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20090722 Termination date: 20161024 |