CN106782310A - 一种像素电路、驱动方法、显示面板以及显示装置 - Google Patents

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Abstract

本方案提供了一种像素电路、驱动方法、显示面板以及显示装置，通过在第一电源信号与所述驱动晶体管的输入端(源极)之间设置了开关管，当该驱动电路处于检测发光元件的驱动电流的第二侦测时段时，控制该开关管关断，使得第一电源信号与所述驱动晶体管的源极之间断路，此时，发光元件上没有电流流过，因此发光元件不发光。从而解决了现有技术中，发光元件在检测像素电路的驱动电流时，发光元件被点亮，出现暗态不暗的问题。

Description

一种像素电路、驱动方法、显示面板以及显示装置
技术领域
本发明涉及显示技术领域，更具体地说，涉及一种像素电路、驱动方法、显示面板以及显示装置。
背景技术
随着科技的不断发展，有机发光二极管(OLED)凭借其亮度高、驱动电压低、节能等优势得到了快速的发展。
通常，在有机发光二极管显示装置中，需要通过像素电路对发光元件(如OLED)进行驱动控制。然而，由于工艺以及驱动晶体管老化等原因，会导致像素电路中驱动晶体管的阈值电压Vth发生漂移，进而使得发光元件上的驱动电流大小不同。这就会出现显示装置上的显示亮度不均匀、画面均一性差的问题。
因此，为了解决上述问题，通常需要对像素电路的驱动电流进行检测及补偿。然而，发明人发现，为了保障驱动电流的检测不影响发光元件的正常发光，通常需要在发光元件处于暗态(不发光)时进行驱动电流的检测。但目前在检测像素电路的驱动电流时，发光元件有时会被点亮，出现暗态不暗的现象。
发明内容
有鉴于此，本发明提供了一种像素电路、驱动方法、显示面板以及显示装置，解决了检测驱动电流时，发光元件被点亮的问题。
为实现上述目的，本发明提供如下技术方案：
一种像素电路，包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、驱动晶体管、存储电容以及发光元件，
所述第一开关管由第一扫描信号控制，用于传输第一数据信号至所述驱动晶体管的源极，
所述第二开关管由第二扫描信号控制，用于传输基准电压信号至所述驱动晶体管的栅极，
所述存储电容串接在所述驱动晶体管的栅极和源极之间，用于将充电后的电压作为所述驱动晶体管的驱动电压，
所述驱动晶体管的源极与第一电源信号电连接，所述驱动晶体管的漏极与所述发光元件的阳极相连，用于将来自所述驱动晶体管的驱动电流传输至所述发光元件的阳极，
所述发光元件的阴极连接至第二电源信号，并响应所述驱动电流而发光，
所述像素电路还包括第三开关管，所述第三开关管由第三扫描信号控制，用于传输第一电源信号至所述驱动晶体管的源极；
或，至少一个所述像素子电路还包括第四开关管，所述第四开关管由第四扫描信号控制，用于传输第一电源信号至所述驱动晶体管的源极。
一种显示面板，包括：
呈阵列排布的像素单元，
多条数据线，用于为所述像素单元提供数据信号；
多条扫描线，用于为所述像素单元提供扫描信号；
多条参考线，用于为所述像素单元提供参考信号；
所述像素单元包括任一项上述的像素电路：
所述扫描线平行于像素行方向；
所述数据线平行于像素列方向；
在像素行方向上，相邻的两个像素单元共用一条数据线。
一种显示装置，包括任意一项上述的显示面板。
一种驱动方法，应用于上述的像素电路，所述像素电路包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、第三开关管、驱动晶体管、存储电容以及发光元件，该驱动方法包括：
第一侦测时段，关断所述第一开关管、所述第二开关管，开启所述第三开关管，所述数据线对所述存储电容充电；
第二侦测时段，开启所述第一开关管以及所述第二开关管，关断所述第三开关管，所述存储电容对所述驱动晶体管的源极放电，所述基准电压信号输入至所述驱动晶体管的栅极。
一种驱动方法，应用于上述的像素电路，所述像素电路包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、第四开关管、驱动晶体管、存储电容以及发光元件，该驱动方法包括：
第一侦测时段，关断所述第一开关管、所述第二开关管以及所述第四开关管，所述数据线对所述存储电容充电；
第二侦测时段，开启所述第一开关管以及所述第二开关管，关断所述第三开关管，所述存储电容对所述驱动晶体管的源极放电，所述基准电压信号输入至所述驱动晶体管的栅极；
第三侦测时段，关断所述第一开关管以及所述第二开关管，开启所述第三开关管，所述第一电源信号输入至所述发光元件，控制所述发光元件发光。
与现有技术相比，本发明所提供的技术方案具有以下优点：
本方案提供的驱动电路，通过在第一电源信号与所述驱动晶体管的输入端(源极)之间设置了开关管(第三开关管或第四开关管)，当该驱动电路处于检测发光元件的驱动电流的第二侦测时段时，控制第三开关管或第四开关管关断，使得第一电源信号与所述驱动晶体管的源极之间断路，此时，发光元件上没有电流流过，因此发光元件不发光。而，当驱动电路处于发光元件发光的第三侦测时段时，控制第三开关管以及第四开关管导通，使得在各个开关管的控制下，发光元件能够发光。可见，本方案提供的驱动电路解决了现有技术中，发光元件在检测像素电路的驱动电流时，发光元件被点亮，出现暗态不暗的问题。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据提供的附图获得其他的附图。
图1为本发明实施例提供的一种像素电路的结构示意图；
图2为本发明实施例提供的一种像素电路的驱动方法的开关控制时序图；
图3为本发明实施例提供的一种显示面板的结构示意图；
图4为本发明实施例提供的一种像素电路某时段的电流走向示意图；
图5为本发明实施例提供的一种像素电路又一时段的电流走向示意图；
图6为本发明实施例提供的一种像素电路的驱动方法的又一开关控制时序图；
图7为本发明实施例提供的一种显示面板的又一结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
请参阅图1，图1为本实施例提供的驱动方法所基于的像素电路的结构示意图，该像素电路包括至少一个像素子电路，所述像素子电路包括：第一开关管T1、第二开关管T2、驱动晶体管T3、存储电容Cload、发光元件OLED以及第三开关管T4。
具体的，该像素电路中各器件的连接关系为：
第一开关管T1的第一极与数据线相连，第二极分别与第一电容Cst的一端、驱动晶体管T3的第一极以及第三开关管T4的第一极相连，栅极与第一扫描线S1相连。
第二开关管T2的第一极与基准电压信号Vref相连，第二极分别与第一电容Cst的第二端以及驱动晶体管T3的栅极相连，栅极与第二扫描线S2相连。
驱动晶体管T3的第二极与发光元件OLED的阳极相连，发光元件OLED的阴极与第二电源信号VSS相连。
第三晶体管T4的第二极与第一电源信号VDD相连，栅极与第三扫描线S3相连。
存储电容Cload串接在所述数据线与地之间。
结合上述像素电路中器件的连接关系，其电路原理为：
所述第一开关管T1由第一扫描信号S1控制，用于传输第一数据信号(存储电容Cload上的电压信号)至所述驱动晶体管T3的源极，图中Vs处。所述第二开关管T2由第二扫描信号S2控制，用于传输基准电压信号Vref至所述驱动晶体管T3的栅极。所述第一电容Cst串接在所述驱动晶体管T3的栅极和源极之间，用于结合存储电容Cload充电后的电压作为所述驱动晶体管T3的驱动电压，并将来自所述驱动晶体管T3的驱动电流传输至所述发光元件OLED的阳极，所述发光元件并响应所述驱动电流而发光。第三开关管T4由第三扫描信号S3控制，用于传输第一电源信号VDD至所述驱动晶体管T3的源极。
具体的，结合图2，图2为本实施中像素电路的开关管的控制时序，如下：
在第一时间段P1(预充电时段)，第一扫描线信号S1以及第二扫描线信号S2为高电平，第三扫描线信号S3为低电平，则此时，第一开关管T1以及第二开关管T2关断，数据线对存储电容Cload进行充电。
在第二时间段P2(驱动电流检测时段)，第一扫描线信号S1以及第二扫描线信号S2为低电平，第三扫描线信号S3为高电平，则此时，第一开关管T1以及第二开关管T2导通，存储电容Cload通过第一开关管T1对驱动晶体管T3的源极进行放电，同时，基准电压Vref作用到驱动晶体管的栅极，此时，随着驱动晶体管T3的源极的电压升高，当驱动晶体管T3的栅源电压Vgs小于驱动晶体管T3的阈值电压Vth时，驱动晶体管T3导通，源极电压变为Vth+Vref，且保持恒定，即此时刻检测点Vs处的电压为Vth+Vref，又由于基准电压Vref的电压值已知，则此时采集到的检测点Vs处的电压能计算得到驱动晶体管的阈值电压Vth，然后驱动电路外接的数据驱动器可以对驱动晶体管T3的阈值电压Vth进行补偿，进而使得像素间的亮度相同，避免了显示亮度不均匀、显示画面均一性差的问题。
然而，发明人发现，现有的驱动电路在第二时间段P2(驱动电流检测时段)，其第一电源信号VDD直接与驱动晶体管T3的源极相连，因此，随着驱动晶体管T3的源极的电压升高，当驱动晶体管T3的栅源电压Vgs小于驱动晶体管T3的阈值电压Vth时，驱动晶体管T3导通，此时，第一电源信号VDD就会通过驱动晶体管T3加载在发光元件OLED的阳极，使得发光元件OLED发光。然而，正如背景技术所述，检测驱动电路的驱动电流是在显示面板除正常显示外的暗态时检测，因此，本实施例提供的驱动电路增加了第三开关管T4或者在第二时间段将第一电源信号VDD调成悬浮状态。
具体的，在第二时间段P2(驱动电流检测时段)，由于第三扫描线S3为高电平，所以第三开关管T4断开，使得第一电源信号VDD与驱动晶体管T3的源极断开，此时，由于第一电源信号VDD被断路，因此，驱动晶体管T3不能为发光元件OLED提供电流，即，此时发光元件OLED肯定不会发光。可见，本方案提供的驱动电路，在检测像素电路的驱动电流(检测驱动晶体管的阈值电压Vth)时，发光元件不会被点亮，实现了显示面板在暗态时(例如，屏幕黑屏时)保证没有亮点出现，彻底解决了现有驱动电路有时会出现暗态不暗的问题，如在锁屏的时候，屏幕中不会出现某个亮点，即发光元件在该时段不会被点亮。
除此，本实施例提供的驱动电路，还可以在第二时间段P2时，控制第一电源信号VDD处于悬浮状态，即此时VDD不接入电压，或者控制此时的VDD为0，那么，此时第一电源信号VDD上没有电流供给驱动晶体管T3，这样能保证像素电路的P2时间段内，没有电流通过驱动晶体管T3供给发光元件，进而发光元件OLED不发光，因此显示面板在该第二时间段P2呈现暗态(黑屏状态)，不会出现显示面板在暗态时偷亮的现象。
需要说明的是，本实施例将第一电源信号VDD设置为悬浮状态，目的是为了使第一电源信号和驱动晶体管T3的源极断开连接，其作用和控制第三开关管T4断开一致，因此，本实施例提供的驱动电路，可以是设置第四开关管断开的同时，控制第一电源信号VDD悬停，起到双重断路的作用。也可以是设置第四开关管断开或控制第一电源信号VDD悬停，即只要实现第一电源信号VDD不为发光元件OLED供电的作用即可。
除此，本实施例还在第三时间段P3，控制第一扫描线信号S1以及第二扫描线信号S2为高电平，第三扫描线信号S3为低电平，则此时，第一开关管T1以及第二开关管T2关断，数据线对存储电容Cload进行充电，输入补偿后的电压数据，而同时，由于第三开关管T4导通，第一电源信号VDD通过驱动晶体管T3加载在发光元件OLED上，使得发光元件OLED发光，实现显示面板的显示功能。
可见，本方案通过控制开关管的开启和关断的状态，在P2时刻，能检测到阈值电压Vth，然后在P3时刻对驱动晶体管T3进行的阈值电压Vth补偿，补偿了像素间的亮度差，避免了显示亮度不均匀、显示画面均一性差的问题。最重要的是，在P2时刻，控制第三开关管T4断开，使得第一电源信号VDD与发光元件OLED间断路，OLED由于没有电能加载，所以不发光，满足了在检测驱动电路驱动电流的时刻，发光元件OLED不发光、显示面板处于暗态的设计要求。
在上述实施例的基础上，请参阅图3，图3为本实施例提供的驱动方法所基于的又一像素电路的结构示意图，该像素电路包括至少一个像素子电路(101以及102，其中，101和102的电路结构相同)，所述像素子电路101包括：第一开关管T1、第二开关管T2、驱动晶体管T3、存储电容Cload以及发光元件OLED。
具体的，该像素电路中各器件的连接关系为：
第一开关管T1的第一极与数据线相连，第二极分别与第一电容Cst的一端以及驱动晶体管T3的第一极相连，栅极与第一扫描线S1相连。
第二开关管T2的第一极与基准电压信号Vref相连，第二极分别与第一电容Cst的第二端以及驱动晶体管T3的栅极相连，栅极与第二扫描线S2相连。
驱动晶体管T3的第二极与发光元件OLED的阳极相连，发光元件OLED的阴极与第二电源信号VSS相连，存储电容Cload串接在所述数据线与地之间。
除此，第四开关管SW的第一极与所述第一电源信号VDD相连，所述第四开关管SW的第二极与所述驱动晶体管T3的源极以及所述第一开关管T1的第二极相连，所述第四开关管SW的栅极接收所述第四扫描信号。
需要说明的是，本实施例中像素子单元的电路结构相同，因此可以互相参见，结合上述像素电路中器件的连接关系，其电路原理为：
所述第一开关管T1由第一扫描信号S1控制，用于传输第一数据信号(存储电容Cload上的电压信号)至所述驱动晶体管T3的源极，图中Vs处。所述第二开关管T2由第二扫描信号S2控制，用于传输基准电压信号Vref至所述驱动晶体管T3的栅极。所述第一电容Cst串接在所述驱动晶体管T3的栅极和源极之间，用于结合存储电容Cload充电后的电压作为所述驱动晶体管T3的驱动电压，并将来自所述驱动晶体管T3的驱动电流传输至所述发光元件OLED的阳极，所述发光元件响应所述驱动电流而发光。第四开关管SW由第四扫描信号控制，用于传输第一电源信号VDD至所述驱动晶体管T3的源极。
具体的，本实施例中，将第四开关管SW设置在显示面板的非显示区，即AA区外部，因此，需要先控制第四开关管SW关断，然后对像素子单元进行阈值侦测以及补偿，之后在将第四扫描信号变为低电平，使其导通，使得发光元件同时发光。
即，将图4中的各个子像素单元，先按照如下时序进行控制，如：
在第一时间段P1，第一扫描线信号S1以及第二扫描线信号S2为高电平，第三扫描线信号S3为低电平，则此时，第一开关管T1以及第二开关管T2关断，数据线对存储电容Cload进行充电。
在第二时间段P2，第一扫描线信号S1以及第二扫描线信号S2为低电平，第三扫描线信号S3为高电平，则此时，第一开关管T1以及第二开关管T2导通，存储电容Cload对驱动晶体管T3的源极进行放电，同时，基准电压Vref作用到驱动晶体管的栅极，此时，由于第四扫描信号为高电平，所以第四开关管SW断开，实现第一电源信号VDD与驱动晶体管T3的源极断开，防止第一电源信号VDD向驱动晶体管T3写入电压信号。
在第三时间段P3，第一扫描线信号S1以及第二扫描线信号S2为高电平，第三扫描线信号S3为低电平，则此时，第一开关管T1以及第二开关管T2关断，数据线对存储电容Cload进行充电，输入补偿后的电压数据。
然后，在第四时间段P4，控制第四扫描信号S4由高电平变为低电平，第四开关管SW导通，此时，第一电源信号VDD对所有的子像素单元中的驱动晶体管T3给电压信号，使得整个显示面板均发光。
需要说明的是，在本实施例中，整个显示面板同时发光有利于降低显示屏的余晖，降低视觉残留，减缓由于帧内像素电路中发光元件的发光延迟而带来的拖影现象对用户造成的眩晕感，因此，本实施例较上述实施例的驱动方式，更加适用于虚拟现实(VR)的显示控制场景。
除此，本发明实施例提供的像素子电路只包含三个晶体管，电路结构简单，更利于高PPI的实现。并且，本方案中，多个子像素电路均通过同一个第四开关管SW实现第一电源信号VDD与发光元件OLED之间的连接，因此开关管SW的宽长比需要根据情况具体设计。
具体的，如像素子电路的驱动电流为I1，而像素电路包括4个像素子电路，那么整个像素电路需要流经第四开关管SW的电流为4I1，根据公式：电流I＝K*W/L*(Vgs-Vth)2，可见，宽长比W/L正比于电流I，因此，根据显示面板的亮度需求，可以设定单个像素子电路中的驱动电流值，如，每个驱动子电路的驱动电流为1A，那么，整个像素电路的驱动电流为4A，将4A带入上述公式，进而得到第四开关管SW的宽长比W/L的值。
相比于在每个像素子电路上设置第三开关管T4的方案，第三开关管T4的驱动电流设定为1A，同理，根据电流计算公式，得到第三开关管T4的宽长比的值。
在上述实施例的基础上，本实施例提供的像素电路如图4和图5所示，还包括：第五开关管T5。
其中，所述第五开关管T5的第一极连接至第三电源信号vint，所述第五开关管T5的第二极与所述发光元件的阳极相连，所述第五开关管T5由第五扫描信号S4控制，用于传输所述第三电源信号vint至所述发光元件OLED的阳极。
结合图6，本实施例通过增设第五开关管T5，目的是为了在侦测阈值P2阶段，通过第五控制信号S4，使第三电源信号vint输入到发光元件OLED的阳极，实现对OLED的阳极复位。阳极复位也可以避免在阈值监测阶段，驱动晶体管T3会有电流流过，因此会导致发光元件OLED有发光的可能，进而导致发光元件的暗态不暗，即常规显示屏在需要进行黑屏显示时，出现屏幕有亮光的问题。
需要说明的是，本实施例中，像素电路的侦测时段和上述实施例相同，在此不重复叙述。
可选的，所述基准电压信号的电位高于所述第三电源信号的电位。即Vref大于vint，例如Vref＝-2，则Vint＝-3，VSS＝-3，这样能保证驱动晶体管T3正常导通，而不会由于电压差不满足驱动晶体管的工作条件，而处于截止的状态。除此，在本实施例中，所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管均为P型晶体管或N型晶体管。本发明的附图中，以P型晶体管进行举例说明。
如图7所示，本实施例还提供了一种显示面板，包括：呈阵列排布的像素单元、多条数据线以及多条扫描线S1-S4以及多条参考线。
其中，每个像素单元包括上述实施例中的像素电路，且多条数据线用于为所述像素单元提供数据信号，多条扫描线用于为所述像素单元提供扫描信号，多条参考线用于为所述像素单元提供参考信号。并且，本实施例提供的显示面板通过上述实施例中的驱动方法进行电流的检测。
在上述实施例的基础上，为了减少数据线的设置数量，本实施例提供的显示面板，在像素行方向上，相邻的两个像素单元共用一条数据线。具体的，像素单元101和像素单元102中的第一开关管T1的漏极均与数据线相连，均是通过存储电容Cload进行放电。
优选的，共用一条数据线的两个像素单元位于共用数据线的两侧，且两个像素单元的第一开关管的第二极分别与所述数据线相连。即图中，像素单元101与像素单元102位于共用数据线的两侧，且像素单元101中的第一开关管T1的漏极以及像素单元102中的第一开关管T1的漏极均与同一接数据线相连。
除此，本实施例还它可以设置成：共用一条数据线的两个像素单元的第一开关管的栅极均与第一扫描线相连，共用一条数据线的两个像素单元的第二开关管的栅极均与第二扫描线相连，共用一条数据线的两个像素单元的第四开关管的栅极均与第四扫描线相连。如图7中，像素单元101的第一开关管T1的栅极以及像素单元102中第一开关管T1的栅极均连第一扫描线S1，同时，像素单元101的第二开关管T2的栅极以及像素单元102中第二开关管T2的栅极均连第二扫描线S2，像素单元101的第四开关管T4的栅极以及像素单元102中第四开关管T4的栅极均连第五扫描线S4。
当然，上述实施例为优选的实施例，本实施例还可以不限定扫描线是否共用，如，像素单元101的第一开关管T1的栅极连第一扫描线S1，像素单元101的第二开关管T3的栅极连第二扫描线S2，像素单元101的第四开关管T4的栅极连第四扫描线S4。像素单元102的第一开关管T1的栅极连第五扫描线S5，像素单元102的第二开关管T2的栅极连第六扫描线S6，像素单元102的第四开关管T4的栅极连第八扫描线S8。
可选的，本实施例提供的显示面板还包括数据驱动器，所述数据驱动器用于为共用一条数据线的两个像素单元中的一个像素单元提供数据信号，为两个像素单元中的另一个像素单元提供黑色数据或关断电压，以使共用一条数据线的两个像素单元分时驱动。即，数据驱动器用于产生data1以及data2两个数据信号，其中，当data1为有效数据信号时，data2为黑色数据或关断数据，保证像素单元101在工作时，像素单元102关断不工作。具体的，当像素子单元101接收到的data1的数据为实施例一中的驱动时序时，控制像素子单元102接收到的data2的数据为高电平，由于像素子电路中的开关管均为PMOS管，因此，像素子电路102中的开关管均关断，即，像素子电路102中的OLED不发光。与此同时，像素子电路101执行上述的驱动时序，实现对OLED的发光控制以及驱动晶体管的阈值检测和补偿。
同理，还可以是控制data1为黑色数据，data2为有效数据，采用共用数据线的方式能够节省数据线的使用数量，降低了整个像素电路的成本。
需要说明的是，在本实施例中，驱动晶体管T3、第一开关管T1、第二开关管T2以及第四晶体管T4均为N型晶体管，当然，也可以均为P型晶体管，对此，本实施例并不进行限定。
除此，本实施例还提供了一种显示装置，应用了上述的显示面板。
综上所述，本方案提供了一种像素电路、驱动方法、显示面板以及显示装置，通过在第一电源信号与所述驱动晶体管的输入端(源极)之间设置了开关管，当该驱动电路处于检测发光元件的驱动电流的第二侦测时段时，控制该开关管关断，使得第一电源信号与所述驱动晶体管的源极之间断路，此时，发光元件上没有电流流过，因此发光元件不发光。从而解决了现有技术中，发光元件在检测像素电路的驱动电流时，发光元件被点亮，出现暗态不暗的问题。
本说明书中各个实施例采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似部分互相参见即可。对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本发明。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本发明的精神或范围的情况下，在其它实施例中实现。因此，本发明将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。

Claims (14)

1.一种像素电路，其特征在于，包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、驱动晶体管、存储电容以及发光元件，
所述第一开关管由第一扫描信号控制，用于传输第一数据信号至所述驱动晶体管的源极，
所述第二开关管由第二扫描信号控制，用于传输基准电压信号至所述驱动晶体管的栅极，
所述存储电容串接在所述驱动晶体管的栅极和源极之间，用于将充电后的电压作为所述驱动晶体管的驱动电压，
所述驱动晶体管的源极与第一电源信号电连接，所述驱动晶体管的漏极与所述发光元件的阳极相连，用于将来自所述驱动晶体管的驱动电流传输至所述发光元件的阳极，
所述发光元件的阴极连接至第二电源信号，并响应所述驱动电流而发光，
所述像素电路还包括第三开关管，所述第三开关管由第三扫描信号控制，用于传输第一电源信号至所述驱动晶体管的源极；
或，至少一个所述像素子电路还包括第四开关管，所述第四开关管由第四扫描信号控制，用于传输第一电源信号至所述驱动晶体管的源极。
2.根据权利要求1所述的像素电路，其特征在于，所述第三开关管的第一极与所述第一电源信号相连，所述第三开关管的第二极与每个所述驱动晶体管的源极以及所述第一开关管的第一极相连，所述第三开关管的栅极接收所述第三扫描信号。
3.根据权利要求1所述的像素电路，其特征在于，所述第四开关管的第一极与所述第一电源信号相连，所述第四开关管的第二极与所述驱动晶体管的源极以及所述第一开关管的第一极相连，所述第四开关管的栅极接收所述第四扫描信号。
4.根据权利要求1所述的像素电路，其特征在于，还包括：第五开关管，
所述第五开关管的第一极连接至第三电源信号，所述第五开关管的第二极与所述发光元件的阳极相连，所述第五开关管由第五扫描信号控制，用于传输所述第三电源信号至所述发光元件的阳极。
5.根据权利要求4所述的像素电路，其特征在于，所述基准电压信号的电位高于所述第三电源信号的电位。
6.根据权利要求4所述的像素电路，其特征在于，所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管均为P型晶体管或N型晶体管。
7.根据权利要求1所述的像素电路，其特征在于，所述发光元件为有机发光二极管。
8.一种显示面板，其特征在于，包括：
呈阵列排布的像素单元，
多条数据线，用于为所述像素单元提供数据信号；
多条扫描线，用于为所述像素单元提供扫描信号；
多条参考线，用于为所述像素单元提供参考信号；
所述像素单元包括如权利要求1-7任一项所述的像素电路：
所述扫描线平行于像素行方向；
所述数据线平行于像素列方向；
在像素行方向上，相邻的两个像素单元共用一条数据线。
9.根据权利要求8所述的显示面板，其特征在于，共用一条数据线的两个像素单元位于共用数据线的两侧，且两个像素单元的第一开关管的第二极分别与所述数据线相连。
10.根据权利要求9所述的显示面板，其特征在于，共用一条数据线的两个像素单元的第一开关管的栅极均与第一扫描线相连，共用一条数据线的两个像素单元的第二开关管的栅极均与第二扫描线相连，共用一条数据线的两个像素单元的第四开关管的栅极均与第四扫描线相连。
11.根据权利要求10所述的显示面板，其特征在于，还包括数据驱动器，
所述数据驱动器用于为共用一条数据线的两个像素单元中的一个像素单元提供数据信号，为两个像素单元中的另一个像素单元提供黑色数据或关断电压，以使共用一条数据线的两个像素单元分时驱动。
12.一种显示装置，其特征在于，包括如权利要求9-11中任意一项所述的显示面板。
13.一种驱动方法，应用于如权利要求1所述的像素电路，其特征在于，所述像素电路包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、第三开关管、驱动晶体管、存储电容以及发光元件，该驱动方法包括：
第一侦测时段，关断所述第一开关管、所述第二开关管，开启所述第三开关管，所述数据线对所述存储电容充电；
第二侦测时段，开启所述第一开关管以及所述第二开关管，关断所述第三开关管，所述存储电容对所述驱动晶体管的源极放电，所述基准电压信号输入至所述驱动晶体管的栅极。
14.一种驱动方法，应用于如权利要求1所述的像素电路，其特征在于，所述像素电路包括至少一个像素子电路，所述像素子电路包括：第一开关管、第二开关管、第四开关管、驱动晶体管、存储电容以及发光元件，该驱动方法包括：
第一侦测时段，关断所述第一开关管、所述第二开关管以及所述第四开关管，所述数据线对所述存储电容充电；
第二侦测时段，开启所述第一开关管以及所述第二开关管，关断所述第三开关管，所述存储电容对所述驱动晶体管的源极放电，所述基准电压信号输入至所述驱动晶体管的栅极；
第三侦测时段，关断所述第一开关管以及所述第二开关管，开启所述第三开关管，所述第一电源信号输入至所述发光元件，控制所述发光元件发光。
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