TWI413965B - 位移暫存器及具有位移暫存器之顯示裝置 - Google Patents

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Description

位移暫存器及具有位移暫存器之顯示裝置
本發明有關於在一顯示裝置中產生掃描信號的一閘極驅動器，更明確而言，有關在一閘極驅動器中能以減少數量的外部匯流排線操作的一位移暫存器、與使用此一位移暫存器的顯示裝置。
例如液晶顯示裝置的影像顯示裝置通常具有使用一薄膜封裝(tape carrier package,TCP)的一閘極驅動器、玻璃晶片(COG)等。然而，在此顯示裝置中，改善設計效力及減少閘極驅動器電路與顯示裝置的製造成本是不容易。
若要減緩困難度，發展例如不具有一閘極驅動器積體電路(IC)的閘極驅動技術。換句話說，一顯示裝置具有不是在顯示面板以積體電路形式安裝的一閘極驅動，而是整個在一部分顯示面板上形成的。此閘極驅動元件的結構在此描述中稱為"較少閘極IC結構"。在較少閘極IC結構中，通常使用無定形矽薄膜電晶體(非晶矽TFTs)。非晶矽TFT範例可在美國專利案號5,517,542及共同讓與的韓國專利案號2002-3398(或韓國公開公告案2002-66962)中找到。具較少閘極IC結構的傳統閘極驅動元件包括一或多個化移暫存器，以提供掃描信號給一顯示面板。
圖1描述一傳統位移暫存器單級電路圖。請即參考圖1，一傳統位移暫存器單級100包括一上拉元件110、一下拉元件120、一上拉驅動元件130、與一下拉驅動元件140。單級 100能響應一前級的一掃描開始信號STV或一輸出信號而產生一閘極信號(或掃描信號)。在單級100是一位移暫存器的第一級情況，單級100可接收掃描開始信號STV以輸出閘極信號。對照下，在單級100不是一位移暫存器的第一級的情況，單級100可接收從一前級產生的一閘極信號以輸出閘極信號。具有此單級的一位移暫存器是安裝在一顯示裝置的一TFT面盤。
圖2描述包括如圖1所示多級的一傳統位移暫存器方塊圖。請即參考圖1與2，位移暫存器174具有：'N'級SRC1 -SRCN ，以分別產生'N'個閘極信號(或掃描信號)GOUT1 -GOUTN ；與一虛擬級SRCN+1 ，以將一控制信號提供給前級。多級SRC1 -SRCN 的每一級可接收第一與第二時脈信號CKV、CKVB、高與接地位準電壓VDD、VSS以當作閘極關閉與導通電壓VON、VOFF、與來自下一級輸出的一控制信號。
特別是，第一級可接收除了前述信號之外的一掃描開始信號STV，以輸出用以選擇第一閘極線的第一閘極信號GOUT1 。第一閘極信號GOUT1 亦提供給第二級的一輸入端。除了前述信號之外，第二級SRC2 能從第一級接收第一閘極信號GOUT1 ，以輸出用以選擇第二閘極線的第二閘極信號GOUT2 。第二閘極信號GOUT2 亦提供給第三級SRC3 的輸入端。在類似方式中，除了其他時脈與電壓信號之外，第N級SRCN 能從一第(N-1)級接收第(N-1)閘極信號與來自虛擬級SRCN+1 的一控制信號，以輸出用於選擇第N閘極信號 GOUTN 。
圖3是圖1的位移暫存器信號波形圖。請即參考圖1-3，在位移暫存器174的一單級可接收第一或第二時脈信號CKV/CKVB，即是，即是奇數級可接收第一時脈信號CKV，且偶數級可接收第二時脈信號CKVB，其中該第二時脈信號CKVB的相位是與第一時脈信號CKV相反。位移暫存器174可連續產生一TFT基板閘極線的閘極信號。第一與第二時脈信號CKV、CKVB能從一時序控制器(未在圖顯示)的一輸出信號獲得。通常，時序控制器的輸出信號具有從0伏特至3伏特範圍的振幅，並能在-8伏特至24伏特範圍內放大，以驅動非晶矽TFT。第一與第二時脈信號可使用放大的輸出信號。
如前述，具有使用非晶矽電晶體的較少閘極IC結構之一傳統位移暫存器需要至少五條匯流排線：一匯流排線用於傳送掃描開始信號STV，且該掃描開始信號STV是在一水平方向的一開始信號；一匯流排線用於傳送第一時脈信號CKV以施加閘極關閉電壓，其中該匯流排線連接到奇數閘極線；一匯流排線用於傳送第二時脈信號CKVB以施加閘極關閉信號，其中該匯流排線連接到偶數閘極線；及一些匯流排線用以將高與接地位準電壓VDD、VSS提供給該等單級的每一者。五條匯流排線經由安裝有源極驅動器積體電路TCP的一虛擬接腳而連接到一顯示面板的閘極驅動IC區域，或五條匯流排線連接在顯示面板，而該顯示面連接到閘極驅動區域。
然而，傳統位移暫存器具有包括下列問題。需要用以形成一跳線以將信號與電力傳送給每一級的的一分開空間。尤其，在具有一增加有效顯示區域的小窄面液晶顯示面板中，匯流排線空間會受限制。且當五條或多條匯流排線經由TCP或FPC形成，TCP的虛擬空間與FPC的寬度會增加，所以製造成本會增加，且匯流排線的空間會是受限制。此外，當非晶矽電晶體用於一閘極驅動器電路時，非晶矽電晶體會在例如閘極導通與關閉電壓VON、VOFF的直流偏壓狀態中損壞。結果，非晶矽電晶體發生故障。此外，非晶矽電晶體需要例如-14伏特至20伏特的一大電壓差，所以顯示面板的金屬墊塊會由於大電壓差而損壞。尤其是，當顯示面板受到高溫度與濕氣時，金屬墊塊便會被侵蝕，或者不必要之電路徑會由於濕氣而在金屬墊塊間形成。
先前技術的前述及其缺點與不足能透過使用根據本發明的位移暫存器與顯示裝置而克服或減輕。在一具體實施例中，用以將閘極信號提供給在一顯示裝置中對應閘極線的位移暫存器包括複數個單級，以連續產生閘極信號，其中該等單級的每一級包括：一第一上拉驅動元件，以響應一相鄰前級的輸出信號而產生一第一控制信號或一控制信號；一上拉元件，以響應一第一時脈信號與第一控制信號而產生一電流輸出信號；一第二上拉驅動元件，以響應第一時脈信號與一第二時脈信號而產生至少一第二控制信號；與一第三上拉驅動元件，其連接到一低位準端，以響 應一相鄰後級的輸出信號而操作。該單級亦包括一下拉元件，以響應第二時脈信號而操作。位移暫存器可在顯示面板的選擇區域與顯示面板整個形成。
第二上拉驅動元件包括：一第一電晶體，其具有接收該閘極信號的一閘極與連接在接收第一時脈信號端與接收第二時脈信號間的一傳導路徑，其中一第二電晶體連接在該接收第一時脈信號端與第一電晶體之間，第二電晶體的工作如同二極體；及一第三電晶體，其具有接收第二時脈信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑，其中該共同節點連接到第三上拉驅動元件。第三上拉驅動元件包括：一第一電晶體，其具有連接到第一控制信號的兩端；一第二電晶體，其具有連接到第二上拉驅動元件共同節點的一閘極與連接在第一電晶體與第二時脈信號間的一傳導路徑；一第三電晶體，其具有連接到相鄰後級輸出信號的一閘極與連接在上拉元件與低位準端間的一傳導路徑；與一電容器，其連接在上拉元件與電流輸出信號之間。
在另一具體實施例中，第二上拉驅動元件包括：一第一電晶體，其具有接收閘極信號的一閘極與連接在一接收第一時脈信號端與一接收第二時脈信號端間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號端的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一電晶體間的一傳導路徑，其中第二上拉驅動元件的第一與第二電晶體的一共同節點連接到第一上拉驅動元件的 保持電晶體的閘極；一第三電晶體，其具有接收第二時脈信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與連接在接收第一時脈信號端與接收第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在接收第一時脈信號端與控制件的第四電晶體之間，其中第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到第二電晶體的閘極；及一第六電晶體，其具有連接到第二節點的一閘極與連接在接收第一時脈信號端與第四與第五電晶體共同節點間的傳導路徑。
在另一具體實施例中，第二上拉驅動元件包括：一第一電晶體，其具有接收閘極信號的一閘極與連接在一接收第一時脈信號端與一接收第二時脈信號端間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一電晶體間的一傳導路徑，其中第二上拉驅動元件的第一與第二電晶體的一共同節點連接到第一上拉驅動元件的保持電晶體的閘極；一第三電晶體，其具有接收第二時脈信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與連接在接收第一時脈信號端與接收第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在接收第一時脈信號端與控制件的第 四電晶體之間，其中第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到第二電晶體的閘極；一第六電晶體，其具有連接到第二節點的一閘極與連接在接收第一時脈信號端與第四與第五電晶體共同節點間的一傳導路徑；及一第七電晶體，其具有連接到第四與第五電晶體共同節點的一閘極與連接在第一節點與一輸出閘極信號端間的一傳導路徑。
在仍然另一具體實施例中，第二上拉驅動元件包括一第一電晶體，其具有接收閘極信號的一閘極與連接在接收第一時脈信號端接收第二時脈信號端間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一電晶體間的一傳導路徑，其中第二上拉驅動元件的第一與第二電晶體的一共同節點連接到第一上拉驅動元件的保持電晶體的閘極；一第三電晶體，其具有接收第二時脈信號的一閘極與連接在接收第一時脈信號端與第二上拉驅動元件的第一與第二電晶體的共同節點間的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與連接在接收第一時脈信號端與接收第二時脈信號端間的一傳導路徑；一第五電晶體連接在接收第一時脈信號端與控制件的第四電晶體之間，其中第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到第二電晶體的閘極；一第六電晶體，其具有連接到第二節點的一閘極與連接在接收第一時脈信號端與第四與第五電晶體共同節點間的一傳導路 徑；及一第七電晶體，其具有連接到第一與第二電晶體共同節點的一閘極與連接在第一節點與一輸出閘極信號端間的一傳導路徑。
本發明的這些及其他目的、特徵與優點可從下列連同附圖描述的具體實施例而變得更明顯。
本發明的詳細描述具體實施例將在此揭示。然而，在此揭示的特殊結構與功能細節點只描述本發明具體實施例的目的。
圖4是根據本發明的一具體實施例而描述一位移暫存器方塊圖。位移暫存器包括：'N'級ASRC1 -ASRCN ，用以分別產生閘極信號(或掃描信號)GOUT1 -GOUTN ；與一虛擬級ASRCN+1 ，用以產生當作一控制信號以提供給前級ASRCN 的一虛擬閘極信號GDUMMY。
當一顯示面板(例如，液晶顯示面板)形成時，位移暫存器會在相平面上形成。顯示平面具在閘極線(或掃描線)與資料線所定義區域上形成的切換裝置。位移暫存器可輸出閘極信號GOUT1 -GOUTN ，其每一信號是當作一掃描信號提供給該等切換裝置之對應一者。
在位移暫存器中，該等ASRC1 -ASRCN 級的每一者具有第一與第二時脈端CK1 、CK2 ，用以接收外部提供的第一與第二時脈信號CKV、CKVB。第一與第二時脈信號CKV、CKV的每一者是彼此反相。相對級ASRC1 -ASRCN 亦具有：第一至第三控制信號CT1 -CT3 ，以接收對應的控制信號及一輸出 端OUT，以產生相對閘極信號GOUT1 -GOUTN 。
特別是，第一級ASRC1 是分別經由第一與第二時脈端CK1 、CK2 而接收第一與第二時脈信號CKV、CKVB。第一級ASRC1 亦經由第一與第三控制端CT1 、CT3 而接收一掃描開始信號STV及接收經由第二控制端CT2 而從下一級ASRC2 產生的一第二閘極信號GOUT2 。然後，第一級ASRC1 能輸出第一閘極信號GOUT1 以選擇第一閘極線。第一閘極信號GOUT1 亦提供給第二級ASRC2 的第一控制端CT1 。
第二級ASRC2 是分別經由第二與第一時脈端CK2 、CK1 而接收第一與第二時脈信號CKV、CKVB。第二級ASRC2 是經由第一控制端CT1 而接收從第一單級ASRC1 產生的第一閘極信號GOUT1 與經由第二控制端CT2 而從第三級ASRC3 產生的一第三閘極信號GOUT3 。第二級ASRC2 亦經由第三控制端CT3 接收掃描開始信號STV。然後，第二級ASRC2 可輸出第二閘極信號GOUT2 以選擇第二閘極線。第二閘極信號GOUT2 是提供給第三級ASRC3 的第一控制端CT1 。
在類似方式中，第N級ASRCN 能分別經由第二與第一時脈端CK2 、CK1 而接收第一與第二時脈信號CKV、CKVB。第N級ASRCN 能經由第二控制端CT2 而接收從虛擬級ASRCN+1 產生的虛擬閘極信號GDUMMY。第N級ASRCN 亦經由第三控制端CT3 而接收掃描開始信號STV。第N級ASRCN 可輸出第N閘極信號GOUTN 以選擇第N閘極線。第N閘極信號GOUTN 亦提供給虛擬級ASRCN+1 的一第一控制端CT1 。
在本發明的此具體實施例中，位移暫存器只需要三條匯 流排線以接收掃描開始信號STV、與第一與第二時脈信號CK、CKVB，以輸出用以選擇閘極線的閘極信號GOUT1 -GOUTN 。換句話說，位移暫存器不需要匯流排線接收在傳統位移暫存器中需要的接地位準與高位準電壓。
透過減少在一位移暫存器的匯流排線數，由於在匯流排線間的耦合的雜訊能被減少，並獲得用以設計閘極驅動電路(或掃描驅動電路)的邊際。而且，可減少濕氣所引起的連接墊塊損害。
圖5描述圖4的位移暫存器單級電路圖，且圖6描述具有圖5單級的一位移暫存器電路圖。請即參考圖5與6，位移暫存器級200包括一上拉元件210、一下拉元件220、與第一、第二、第三上拉驅動元件230、250、240。極200可透過使用掃描開始信號STV與前級與下一級的輸出信號而輸出一閘級信號(或掃描信號)。
上拉元件210包括第一NMOS電晶體M1，其一汲極(或一第二電流電極)電連接到一第一時脈電端CK1；一源極(或第一電流電極)電連接到一輸出端GOUT。上拉元件210輸出閘極信號GOUT[N]。
下拉元件220包括第二與第三NMOS電晶體M2、M3。第二NMOS電晶體M2具有一汲極與一閘極，此兩電極係電連接到輸出端GOUT。第三NMOS電晶體M3具有：一汲極，其電連接到第二NMOS電晶體M2的一源極；一源極極，其電連接到第一NMOS電晶體M1的汲極；及一閘極，其電連接到第二時脈信號端CK2。在下拉元件220中，第二NMOS電 晶體M2是如同二極體操作。
第一上拉驅動元件230包括一第四NMOS電晶體M4。第四NMOS電晶體M4的閘極與汲極係電連接到一第一控制端CT1。第四NMOS電晶體M4的一源極係電連接到第一節點N1的電容器C。
第二上拉驅動零件250包括第八至第十NMOS電晶體M8-M10。第八NMOS電晶體M8包括：一源極，其經由第二節點N2而電連接到第二時脈信號端CK2及一閘極，其電連接到輸出端GOUT。第九NMOS電晶體M9包括共同連接到第一時脈信號端CK1的汲極與閘極。第九NMOS電晶體M9的一源極係電連接到第八NMOS電晶體M8的汲極。第十NMOS電晶體M10包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第八NMOS電晶體M8的汲極與第九NMOS電晶體M9的源極。
在此具體實施例中，第八NMOS電晶體M8具有大於第九NMOS電晶體M9的大小。換句話說，第八NMOS電晶體M8具有通道寬度(W)與通道長度(L)的比(W/L)是大於第九NMOS電晶體M9的比。當閘極信號GOUTN 是在一高位準狀態時，第八NMOS電晶體M8與第九NMOS電晶體M9可能同時導通。在此情況，一低位準輸入需要在第六NMOS電晶體M6的閘極上維持，以執行保持功能。為了要入將此達成，第八NMOS電晶體M8的W/L比要大於第九NMOS電晶體M9的W/L比。
第三上拉驅動元件240包括一電容器C與第四至第七NMOS電晶體M5-M7。電容器C電連接到第一NMOS電晶體M1的一閘極與輸出端GOUT。第五NMOS電晶體M5的汲極與閘極係電連接到在第一節點N1的電容器C。第六NMOS電晶體M6的一汲極係電連接到第五NMOS電晶體M5的一源極。第六NMOS電晶體M6的一閘極係電連接到第一時脈信號端CK1。第六NMOS電晶體M6的一源極係電連接到一第二節點N2，其中該第二節點N2連接到一第二時脈信號端CK2。
第七NMOS電晶體M7的一汲極係電連接到在第一節點N1的電容器C。第七NMOS電晶體M7的一閘極係電連接到一第二控制端CT2。第七NMOS電晶體M7的一源極係電連接到一低位準端CT3或STV信號。在第三上拉驅動元件240中，第四與第五NMOS電晶體M5是如同二極體操作。
當第一NMOS電晶體M1使用一非晶矽電晶體實施時，它便具有低電子移動率，所以第一NMOS電晶體M1需要有一足夠大小，以提供具一顯示裝置閘極線掃描信號，其中該等掃描信號在例如從大約20伏特到大約-14伏特範圍中具有一高電壓差。例如，在大約12.1吋(30.734公分)大小的一液晶顯示裝置的情況中，一閘極線的寄生電容是從大約250 pF至大約300 pF。在第一NMOS電晶體M1使用根據4微米最小設計規則所設計的一非晶矽電晶體實施的情況中，第一NMOS電晶體M1需要大約4微米通道長度(L)與大約5500微米通道寬度(W)。因此，在第一NMOS電晶體M1的閘極與汲 極之間的寄生電容會增加。
在第一NMOS電晶體M1的閘極與汲極之間的寄生電容是大約3 pF的情況中，因為寄生電容是與從大約20伏特至大約-14伏特範圍的時脈信號CKV、CKVB電耦合，所以第一NMOS電晶體M1將不會正確操作，且它的工作如同一耦合電容器，如此可將一閘極信號施加到第一NMOS電晶體M1。如果沒有裝置將耦合電容器維持具有閘極關閉電壓VOFF，第一NMOS電晶體M1的一閘極電壓會在從大約20伏特至大約-14伏特範圍，且第一NMOS電晶體M1能產生具有'20伏特-Vth'最大值的一輸出(在此，Vth是第一NMOS電晶體M1的一閘極臨界電壓)。當此一輸出提供給一液晶顯示面板的閘極線時，顯示品質便會惡化。
本發明的位移暫存器透過使用第六NMOS電晶體M6與第三NMOS電晶體M3以在第一NMOS電晶體M1的閘極上維持閘極關閉電壓VOFF而解決此一問題。第六NMOS電晶體M6執行將第一NMOS電晶體M1的閘極維持閘極關閉電壓VOFF的一保持操作。而且，在除了第一NMOS電晶體M1產生一主動閘極信號以激勵一對應像素時間週期之外的時間中，第三NMOS電晶體M3會將從第一NMOS電晶體M1的輸出閘極信號GOUT[N]下拉到閘極關閉電壓VOFF位準(或接地電壓位準)。
在操作期間，從一前級提供的先前閘極信號GOUT[N-1]施加在如同二極體工作的第四NMOS電晶體M4操作。第四NMOS電晶體M4可接收如同一運送信號的先前閘極信號 GOUT[N-1]。第八NMOS電晶體M8能以一高位準的目前閘極信號GOUT[N]導通；結果，第六NMOS電晶體M6會關閉。另一方面，當目前閘極信號GOUT[N]是非活動狀態(即是，一低位準)時，第八NMOS電晶體M8便會維特一關閉狀態。在此情況，第九NMOS電晶體M9會如同二極體工作，所以一高位準信號能施加在第六NMOS電晶體M6。當第一時脈信號CK1是一低位準狀態，且第二時脈信號CK2是在一高位準狀態時，第十NMOS電晶體M10便會導通，所以一低位準信號能施加在第六NMOS電晶體M6。結果，第二上拉驅動元件240能將具有與第一時脈信號CK1相同相位的一控制信號提供給第六NMOS電晶體M6。
由於NMOS電晶體的大電容，所以第一NMOS電晶體M1可執行維持一低位準的功能。當第一時脈信號CKV從一低位準狀態改變成一高位準狀態時，第六NMOS電晶體M6便可執行保持操作，以避免第一NMOS電晶體M1的一閘極電壓變成一較高臨界電壓。明確而言，當第一時脈信號CKV從一低位準狀態改變成一高位準狀態時，目前閘極信號GOUT[N]會在一高位準狀態，藉使第八NMOS電晶體M8導通。因此，既然第六NMOS電晶體M6的閘極是在一低位準狀態，所以電連接到第八NMOS電晶體M8汲極的第六NMOS電晶體M6會關閉。
第七NMOS電晶體M7能經由它的閘極而接收下一閘極信號GOUT[N+1]，並響應下一閘極信號GOUT[N+1]而將電容器C放電到閘極關閉電壓位準VOFF。當第七NMOS電晶體 M7導通時，閘極關閉電壓位準VOFF的掃描開始信號STV能施加在第七NMOS電晶體M7的源極。
如前述，具有非晶矽電晶體的位移暫存器在沒有可供應閘極關閉電壓VOFF與閘極導通電壓VON的分開電壓線而可產生閘極信號。
圖7是根據本發明另一具體實施例而描述一位移暫存器單級電路圖，且圖8描述包括圖7單級的一位移暫存器電路圖。在圖7中，與圖5顯示的相同元件是以相同參考數字表示，並可避免重複描述，因此，不詳細描述。
請即參考圖7與8，本發明的一位移暫存器單級包括一上拉元件210、一下拉元件220、一第一第一上拉驅動元件230、一第二上拉驅動元件350、與一第三上拉驅動元件240。單級300可透過使用一掃描開始信號STV、一前級的先前輸出信號GOUT[N-1]、與下一級的下一輸出信號GOUT[N+1]而輸出一閘極信號(或掃描信號)。在此具體實施例中，上拉元件210、下拉元件220、第一上拉驅動元件230、與第三上拉驅動元件240具有分別與上拉元件210、下拉元件220、第一上拉驅動元件230、與圖5第三上拉驅動元件240實質相同的功能與結構。因此，有關圖7的上拉元件210、下拉元件220、與第一上拉驅動元件230的進一步描述將省略。
第二上拉驅動元件350包括第八至第十三NMOS電晶體M8-M13。第八NMOS電晶體M8包括：一源極，其電連接到第二節點N2，且該第二節點N2連接到第二時脈信號端 CK2；及一閘極，其電連接到輸出端GOUT。第九NMOS電晶體M9包括：一汲極，其電連接到第一時脈信號端CK1；及一源極，其電連接到第八NMOS電晶體M8的一汲極。第十NMOS電晶體M10包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第八NMOS電晶體M8的汲極與第九NMOS電晶體M9的源極。
第十一NMOS電晶體M11包括：一源極，其電連接到第二時脈信號端CK2；及一閘極，其電連接到第八NMOS電晶體M8的閘極。第十二NMOS電晶體M12包括：汲極與閘極，其共同連接到第一時脈信號端CK1；及一源極，其電連接到第九NMOS電晶體M9的閘極與第十一NMOS電晶體M11的汲極。第十三NMOS電晶體M13包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第十一NMOS電晶體M11的汲極與第十二NMOS電晶體M12的源極。
操作上，當目前閘極信號GOUT[N]是在一主動狀態(即是，一高位準狀態)，所以第八NMOS電晶體M8導通時，第六NMOS電晶體M6便會維持關閉狀態。在此情況，一低電壓便會施加在第九NMOS電晶體M9的閘極。明確而言，既然第八NMOS電晶體M8與第十一NMOS電晶體M11的閘極能接收電電流輸出信號GOUT[N]，所以他們會導通。因此，電連接到第八NMOS電晶體M8汲極與第十一NMOS電晶體M11汲極的第九NMOS電晶體M9會關閉，藉此增加通道阻 抗。因此，即使當第九NMOS電晶體M9與第八NMOS電晶體M8同時導通，一低位準信號能施加在第六NMOS電晶體M6。
當目前閘極信號GOUT[N]是在一非主動狀態(即是，一低位準狀態)時，第八NMOS電晶體M8便維特關閉狀態，且第六NMOS電晶體M6能在它的閘極上接收一控制信號，且該控制信號的相位是與第一時脈信號CKV相同。明確而言，既然第二時脈信號端CK2是在一主動狀態，所以電連接到第二時脈信號端CK2的第十NMOS電晶體M10與第十三NMOS電晶體M13會導通。因此，第九NMOS電晶體M9的閘極是一低位準，藉使第六NMOS電晶體M6關閉。
在此具體實施例中，具有第八至第十三NMOS電晶體M8-M13的第二上拉驅動元件350能產生使第六NMOS電晶體M6導通以執行一保持操作的控制信號。
第一NMOS電晶體M1可執行將第一時脈信號CKV取樣的功能。換句話說，第一NMOS電晶體M1可透過寄生電容執行第一時脈信號CKV維持一低位準的功能。而且，當第一時脈信號CKV從一低位準改變成一高位準時，第六NMOS電晶體M6便會執行保持操作。換句話說，第六NMOS電晶體M6可避免第一NMOS電晶體M1的閘極超過第一NMOS電晶體M1的臨界電壓。
當第九NMOS電晶體M9的W/L比增加時，用以使第六NMOS電晶體M6導通的時間常數便會減少。在此具體實施例中，第九NMOS電晶體M9的W/L比大於第八NMOS電晶體 M8，如此便減少第六NMOS電晶體M6的時間常數。
圖9是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖，且圖10描述包括圖9單級的一位移暫存器電路圖。請即參考圖9與10，單級400包括一上拉元件210、一下拉元件220、一第一上拉驅動元件430、一第二上拉驅動元件440、與一第三上拉驅動元件450。單級400可接收第一與第二時脈信號CKV、CKVB、前級與下一級GOUT[N-1]、GOUT[N+1]輸出的閘極信號、與掃描開始信號STV以輸出閘極信號GOUT[N]。在此具體實施例中，上拉元件210與下拉元件220的功能與結構是實質與圖5的上拉元件210與下拉元件220相同，因此，省略詳細描述。
第一上拉驅動元件430包括一第六NMOS電晶體M6、一第七NMOS電晶體M7、與一電容器C。相較於圖5的暫存器級，圖5的第三上拉驅動元件240的第五NMOS電晶體M5未包括在圖9的具體實施例。
在第三上拉驅動元件450中，第四NMOS電晶體M4具有：閘極與汲極，其共同連接到第一控制信號CT1以接收先前閘極信號GOUT[N-1]及一源極，其電連接到第一節點N1，且該第一節點N1連接到在上拉元件210中的第一NMOS電晶體M1的閘極。第六NMOS電晶體M6包括：一汲極，其電連接到第一節點N1；一源極，其電連接到輸出端GOUT與一閘極，以接收來自第二上拉驅動元件440的信號。
第七NMOS電晶體M7包括：一汲極，其電連接到第一節點N1；一源極，其電連接到第三控制端CT3以接收掃描開 始信號STV；及一閘極，其連接到第二控制端CT2以接收來自下一級的下一閘極信號GOUT[N+1]。電容器C是電連接在第一節點N1與輸出端GOUT之間。
第二上拉驅動元件440包括第八、第九與第十NMOS電晶體M8、M9、M10。第八NMOS電晶體M8包括：一源極，其電連接到到第二節點N2，且該第二節點N2連接到第二時脈信號端CK2以接收第二時脈信號CKVB；及一閘極，其電連接到輸出端GOUT與第六NMOS電晶體M6的源極。
第九NMOS電晶體M9包括一源極，其電連接到第八NMOS電晶體M8的一汲極；及汲極與閘極，其共同連接到第一時脈信號端CK1以接收第一時脈信號CKV。第十NMOS電晶體M10包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第八NMOS電晶體M8的汲極與第九NMOS電晶體M9的源極。第十NMOS電晶體M10的源極亦電連接到第六NMOS電晶體M6的閘極。
操作上，第八NMOS電晶體M8能響應目前閘極信號GOUT[N]而導通或關閉。當目前閘極信號GOUT[N]是在一主動狀態(即是，一高位準)時，第八NMOS電晶體M8便會維特一導通狀態，所以第六NMOS電晶體M6會關閉。另一方面，當目前閘極信號GOUT[N]是在一非主動狀態(即是，一低位準)時，第八NMOS電晶體M8便會維特一關閉狀態。在此情況，具有與第一時脈信號CKV相同相位的一控制信號可施加於來自第二上拉驅動元件440的第六NMOS電晶體 M6。換句話說，既然第九NMOS電晶體M9能如同二極體工作，所以當第一時脈信號CKV是在一高位準狀態時，高位準信號便能施加在第六NMOS電晶體M6。當第一時脈信號CKV是在一低位準狀態時，與第一時脈信號CKV反相的第二時脈信號CKVB是在一高位準狀態，所以第十NMOS電晶體M10會導通。結果，一低位準信號能施加在第六NMOS電晶體M6。因此，第二上拉驅動元件440可將具有與第一時脈信號CKV相同相位的一控制信號提供給第六NMOS電晶體M6的閘極。
在此具體實施例中，當第六NMOS電晶體M6維持關閉狀態時，一高位準電壓便會施加在第六NMOS電晶體M6的源極，且當第六NMOS電晶體M6維持導通狀態時，一低位準電壓便會施加在第六NMOS電晶體M6的源極。
圖11是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖，且圖12描述包括圖11單級的一位移暫存器電路圖。請即參考圖11與12，單級500包括一上拉元件210、一下拉元件220、一第一上拉驅動元件430、一第二上拉驅動元件350與一第三上拉驅動元件440。單級500可接收第一與第二時脈信號CKV、CKVB、與從前級與下一級GOUT[N-1]、GOUT[N+1]輸出的閘極信號、與掃描開始信號STV，以輸出閘極信號GOUT[N]。
在此具體實施例中，上拉元件210與下拉元件220的功能與結構是實質與圖5的上拉元件210與下拉元件220相同。圖11的第一上拉驅動元件430與第三上拉上拉驅動元件440的 功能與結構是實質與圖9的第一上拉驅動元件430與第三上拉驅動元件450相同。圖11的第二上拉驅動元件350的功能與結構是實質與圖7的第二上拉驅動元件350相同。因此，上拉元件210、下拉元件220、第一上拉驅動元件430與第三上拉驅動元件440的詳細描述將省略。
在此具體實施例中，第九NMOS電晶體M9的大小(即是，W/L比)較大於第八NMOS電晶體M8。此是因為如果第九NMOS電晶體M9的大小會較小於第八NMOS電晶體M8，使第六NMOS電晶體M6導通的時間常數便會增加。因此，第九NMOS電晶體M9的大小會較大於第八NMOS電晶體M8的大小，以減少時間常數。
圖13是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖，且圖14描述包括圖13單級的一位移暫存器電路圖。請即參考圖13與14，單級600包括一上拉元件210、一下拉元件220、一第一上拉驅動元件230、一第二上拉驅動元件640、與一第三上拉驅動元件240。單級600可接收第一與第二時脈信號CKV、CKVB、從前級與下一級GOUT[N-1]、GOUT[N+1]輸出的閘極信號、與掃描開始信號STV，以輸出閘極信號GOUT[N]。
在此具體實施例中，上拉元件210、下拉元件220、第一上拉驅動元件230與第三上拉驅動元件240的功能與結構是實質與圖5的下拉元件220、第一上拉驅動元件230與一三上拉驅動元件240相同。因此，將省略詳細描述以避免重複。
第二上拉驅動元件640包括第八至第十四NMOS電晶體 M8-M14。第八NMOS電晶體M8包括一源極，其電連接到第二節點，且該第二節點連接到第二時脈信號端CK2以接收第二時脈信號CKVB；及一閘極，其電連接到輸出端GOUT。第九NMOS電晶體M9包括：一汲極，其電連接到第一時脈信號端CK1以接收第一時脈信號CKV及一源極，其電連接到第八NMOS電晶體M8的一汲極。第十NMOS電晶體M10包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二節點N2的第二時脈信號端CK2；及一源極，其電連接到第八NMOS電晶體M8的汲極與第九NMOS電晶體M9的源極。第十NMOS電晶體M10的源極亦連接到第六NMOS電晶體M6的閘極。
第十一NMOS電晶體M11包括：一源極，其電連接到第二時脈信號端CK2；及一閘極，其電連接到第八NMOS電晶體M8的閘極。第十二NMOS電晶體M12包括：一源極，其電連接到第九NMOS電晶體M9的閘極與第十一NMOS電晶體M11的汲極；及汲極與閘極，其共同連接到第一時脈信號端CK1。
第十三NMOS電晶體M13電包括：一汲極，其電連接到第一時脈信號CK1；一閘極，其電連接到第二時脈信號CK2；及一源極，其電連接到第十一NMOS電晶體M11的一汲極與第十二NMOS電晶體M12的一源極。第十四NMOS電晶體M14電包括：一汲極，其電連接到第一節點N1；一閘極，其電連接到第十二與第十三NMOS電晶體M12、M13的源極、與第九NMOS電晶體M9的閘極；及一源極，其電連接 到輸出端GOUT。
如圖13所示，即使當施加在第十四NMOS電晶體M14的閘極電連接到輸出端GOUT的一電壓不同於施加在第六NMOS電晶體M6閘極的電壓，使第六NMOS電晶體M6導通的一電壓可產生。
在此具體實施例中，第一NMOS電晶體M1可執行將第一時脈信號CKV取樣的功能。換句話說，由於NMOS電晶體的一電容，所以第一NMOS電晶體M1可執行一取樣功能以維持低位準。當第一時脈信號CKV從一低位準改變成一高位準時，第六NMOS電晶體M6可執行保持操作，例如避免第一NMOS電晶體M1的閘極超過第一NMOS電晶體M1的臨界電壓。
圖15是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖，且圖16描述包括圖15單級的一位移暫存器電路圖。
請即參考圖15與16，單級700包括一上拉元件210、一下拉元件220、一第一上拉驅動元件230、一第二上拉驅動元件740與一第三上拉驅動元件240。單級700可接收第一與第二時脈信號CKV、CKVB、從前級與下一級GOUT[N-1]、GOUT[N+1]輸出的閘極信號、與掃描開始信號STV以輸出閘極信號GOUT[N]。在此具體實施例中，上拉元件210、下拉元件220、第一上拉驅動元件230與一第三上拉驅動元件240的功能與結構是實質與圖5的上拉元件210、下拉元件220、第一上拉驅動元件230與第三上拉驅動元件240相同。 因此，將省略詳細描述以避免重複。
第二上拉驅動元件740包括第八至第十四NMOS電晶體M8-M14。第八NMOS電晶體M8包括：一源極，其電連接到第二時脈信號端CK2；及一閘極，其電連接到輸出端GOUT。第九NMOS電晶體M9包括：一汲極，其電連接到第一時脈信號端CK1；及一源極，其電連接到第八NMOS電晶體M8的一汲極。
第十NMOS電晶體包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第八NMOS電晶體M8的汲極與第九NMOS電晶體M9的源極。第十一NMOS電晶體M11包括：一源極，其電連接到第二時脈信號端CK2及一閘極，其電連接到第八NMOS電晶體M8的閘極。
第十二NMOS電晶體M12包括：一源極，其電連接到第九NMOS電晶體M9的閘極；及汲極與閘極，其共同連接到第一時脈信號端CK1。第十三NMOS電晶體M13包括：一汲極，其電連接到第一時脈信號端CK1；一閘極，其電連接到第二時脈信號端CK2；及一源極，其電連接到第十一NMOS電晶體M11的汲極與第十二NMOS電晶體M12的源極。
第十四NMOS電晶體M14電包括：一汲極，其電連接到輸出端GOUT；一閘極，其電連接到第九與第十NMOS電晶體M9與M10的源極；及一源極，其電連接到第三上拉驅動元件與電容器(C)末端部分的第四NMOS電晶體M4汲極。
如圖15所示，即使當施加在電連接到輸出端GOUT[N]的第十四NMOS電晶體M14閘極的一電壓是不同於施加在第六NMOS電晶體M6的閘極，其中該第六NMOS電晶體M6電連接到如同二極體工作的第五NMOS電晶體M5，以產生使第六NMOS電晶體M6導通的一電壓。
在此具體實施例中，第一NMOS電晶體M1可執行將第一時脈信號CKV取樣的功能。換句話說，由於NMOS電晶體的一電容，所以第一NMOS電晶體M1可執行一取樣功能以維持低位準。當第一時脈信號CKV從一低位準改變成一高位準時，第六NMOS電晶體M6可避免第一NMOS電晶體M1的閘極超過臨界電壓。
圖17是根據本發明的另一具體實施例而描述一位移暫存器電路圖。請即參考圖17，位移暫存器包括'N'級BSRC1 -BSRCN 與一虛擬級BSRCN+1 。BSRC1 -BSRCN 分別輸出閘極信號(或掃描信號)GOUT1 -GOUTN ，且虛擬級BSRCN+1 可產生一虛擬閘極信號GDUMMY。
第一級BSRC1 能分別經由第一與第二時脈信號端CK1 、CK2 而從一外部裝置接收第一與第二時脈信號CKV、CKVB。第一級BSRC1 亦經由第一與第三控制端CT1 、CT3 而接收一掃描開始信號STV。第一級BSRC1 亦經由第二控制端CT2 而接收從第二級BSRC2 產生的第二閘極信號GOUT2 。然後，第一級BSRC1 能經由輸出端OUT而產生第一閘極信號GOUT1 。第一閘極信號GOUT1 亦提供給第二級BSRC2 的第一控制端CT1 。
第二級BSRC2 能分別經由第二與第一時脈信號端CK2 、CK1 而接收從外部裝置產生的第一與第二時脈信號CKV、CKVB。第二級BSRC2 亦經由第一控制端CT1 而接收從第一級BSRC1 產生的第一閘極信號GOUT1 。第二級BSRC2 亦經由一第二控制端CT2 而接收從第三級BSRC3 產生的第三閘極信號GOUT3 。第二級BSRC2 亦經由第三控制端CT3 接收一閘極關閉電壓VOFF。然後，第二級BSRC2 能經由輸出端OUT而產生第二閘極信號GOUT2 。第二閘極信號GOUT2 亦提供給第三級BSRC3 的第一控制端CT1 。
在類似方式中，第N級BSRCN 能經由第一與第二時脈信號端CK1 、CK2 而從一外部裝置接收第一與第二時脈信號CKV、CKVB。第N級RSRCN 亦經由第一控制端CT1 接收來自前級的閘極信號。第N級BSRCN 亦經由一第二控制端CT2 而接收從虛擬級BSRCN+1 產生的虛擬閘極信號GDUMMY。第N級BSRCN 亦經由一第三控制端CT3 而接收閘極關閉電壓VOFF。然後，第N級BSRCN 能經由輸出端OUT而產生第N閘極信號GOUTN ，且閘極信號GOUTN 提供給虛擬級BSRCN+1 的一第一控制端CT1 。
在此具體實施例中，位移暫存器只接收掃描開始信號STV、第一與第二時脈信號CKV、CKVB、與閘極關閉電壓信號VOFF，以輸出用以選擇閘極線的閘極信號。透過使用此具體實施例的位移暫存器，因為外部電壓線的數量減少，所以匯流排線的數量會減少。此外，優點是可在顯示面板中提供閘極驅動電路(或掃描驅動電路)設計的邊際，並 減少或避免由於濕氣造成連接墊塊的任何損害。
在此具體實施例中，位移暫存器單級可使用前述圖5至16的任一級予以實施。在圖5顯示級的情況是使用在圖17的位移暫存器，第二級至第(N+1)級的每一級可接收閘極關閉電壓VOFF而不是掃描開始信號STV。
圖18描述包括本發明單級的一顯示面板電路圖。請即參考圖18，顯示面板1000包括一顯示區域DA與一週邊區域PA。顯示面板1000可將影像顯示在顯示區域DA。用以驅動顯示面板1000的驅動器電路是配置在週邊區域PA。液晶顯示面板1000亦包括彼此面對的下基板與上基板，且一液晶層是在下基板與上基板之間***。
複數條資料線DL與閘極線GL是在顯示區域DA形成。資料線DL是以第一方向配置，且閘極線GL是以第二方向配置，其中第二方向是實質垂直於第一方向。如同切換裝置工作的一薄膜電晶體1100係電連接到該等資料線DL的每一者、與該等閘極線GL的每一者。切換裝置1100包括：一汲極，其電連接到一像素電極1200；一閘極，其電連接到該等閘極線GL的對應一者；及一源極，其電連接到該等資料線DL的對應一者。影像資料能經由資料線DL與切換裝置1100而傳送給素電極1200。
一資料驅動元件1400配置在週邊區域PA。資料驅動元件1400係電連接到資料線DL，以將影像資料施加到切換裝置1100的源極。一閘極驅動元件1300亦配置在週邊區域PA。閘極驅動元件1300是例如透過圖4或圖17顯示的位移暫存 器實施。閘極驅動元件1300係電連接到閘極線GL，所以來自閘極驅動元件1300的閘極驅動信號能施加在對應切換裝置1100。
閘極驅動元件(即是，一位移暫存器)1300包括複數個單級。該等單級的每一者係電連接到該等閘極線GL的對應一者，所以從一單級輸出的一掃描信號(或閘極驅動信號)能經由該等閘極線GL的對應一者而施加在該等切換裝置對應一者的一閘極1100。當掃描信號施加在切換裝置1100的閘極時，資料驅動元件1400能響應掃描信號而將影像資料提供給對應像素電極1200。顯示面板的位移暫存器1300具有前面圖5-16描述任一具體實施例的單級。
此外，前述位移暫存器可用於一有機電激發光顯示面板、以及沒有閘極IC結構的一液晶顯示面板。
根據本發明描述位移暫存器與顯示裝置的具體實施例，鑑於前述，修改與變化可由熟諳此技者達成。因此，了解到本發明能以除了在此描述之外的方式實施，而且是在文後申請專利範圍所述的範圍內。
100,200,300,400,500,600,700‧‧‧位移暫存器單級
130‧‧‧上拉驅動元件
110,210‧‧‧上拉元件
120,220‧‧‧下拉元件
140‧‧‧下拉驅動元件
230,430‧‧‧第一上拉驅動元件
250,350,640,740‧‧‧第二上拉驅動元件
240‧‧‧第三上拉驅動元件
1000‧‧‧顯示面板
1100‧‧‧薄膜電晶體
1400‧‧‧資料驅動元件
1200‧‧‧像素電極
1300‧‧‧閘極驅動元件
本揭示將以下列參考附圖而詳細描述具體實施例，其中：圖1描述一傳統位移暫存器單級電路圖；圖2描述一傳統位移暫存器的方塊圖；圖3是圖1的位移暫存器信號波形圖式；圖4是根據本發明的一具體實施例而描述一位移暫存器方塊圖； 圖5描述圖4的位移暫存器單級電路圖；圖6描述圖4的位移暫存器電路圖；圖7是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；圖8描述包括圖7單級的一位移暫存器電路圖；圖9是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；圖10描述包括圖9單級的一位移暫存器電路圖；圖11是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；圖12描述包括圖11單級的一位移暫存器電路圖；圖13是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；圖14描述包括圖13單級的一位移暫存器電路圖；圖15是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；圖16描述包括圖15單級的一位移暫存器電路圖；圖17是根據本發明的另一具體實施例而描述一位移暫存器單級電路圖；及圖18描述包括圖17單級的一位移暫存器電路圖。
(無元件代表符號)

Claims (22)

  1. 一種用以在一顯示裝置中將閘極信號提供給對應閘極線之位移暫存器，該位移暫存器分別包含複數個單級，以連續產生該等閘極信號，該等單級的每一者包含：一第一上拉驅動元件，其響應一相鄰前級的輸出信號或一控制信號以產生一第一控制信號；一上拉元件，其響應一第一時脈信號與該第一控制信號而產生一電流輸出信號；一第二上拉驅動元件，其響應施加於該上拉元件之該第一時脈信號且響應於一第二時脈信號以產生至少一第二控制信號；及一第三上拉驅動元件，其連接到一低位準端，以響應一相鄰後級的一輸出信號而操作。
  2. 如申請專利範圍第1項之位移暫存器，其進一步包含響應該第二時脈信號操作的一下拉元件。
  3. 如申請專利範圍第2項之位移暫存器，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收閘極信號的一閘極與連接在接收該第一時脈信號端與接收第二時脈信號端之間的一傳導路徑；一第二電晶體，其連接在該用以接收第一時脈信號端與該第一電晶體之間，該第二電晶體的工作如同二極體；及一第三電晶體，其具有接收該第二時脈信號的一閘極 與連接在用以接收該第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體共同節點之間的一傳導路徑，其中該共同節點連接到該第三上拉驅動元件。
  4. 如申請專利範圍第3項之位移暫存器，其中該第三上拉驅動元件包括：一第一電晶體，其具有連接到該第一控制信號的兩端；一第二電晶體，其具有連接到該第二上拉驅動元件共同節點的一閘極與連接在該第一電晶體與該第二時脈信號之間的一傳導路徑；一第三電晶體，其具有連接到相鄰後級輸出端信號的一閘極與連接在該上拉元件與低位準端之間的一傳導路徑；及一電容器，其連接在該上拉元件與該電流輸出信號之間。
  5. 如申請專利範圍第4項之位移暫存器，其中該低位準端連接到一接地位準信號(VSS)或一掃描開始(STV)信號。
  6. 如申請專利範圍第5項之位移暫存器，其中該上拉元件包括一第一電晶體，該第一電晶體具有接收該第一控制信號的一閘極與連接在接收第一時脈信號端與輸出閘極信號端之間的一傳導路徑。
  7. 如申請專利範圍第6項之位移暫存器，其中該下拉元件包括： 一第一電晶體，該第一電晶體具有連接到輸出閘極信號端的兩端；及一第二電晶體，該第二電晶體具有連接到該第二時脈信號的一閘極與在該第二電晶體與該第一時脈信號間連接的一傳導路徑。
  8. 如申請專利範圍第7項之位移暫存器，其中該提供給奇數級的第一時脈信號，與該提供給偶數級的第一時脈具有彼此相反的相位。
  9. 如申請專利範圍第8項之位移暫存器，其中該提供給奇數級的第二時脈信號與該提供給偶數級的第二時脈信號具有彼此相反的相位。
  10. 如申請專利範圍第1項之位移暫存器，其中該控制信號是一STV信號。
  11. 如申請專利範圍第2項之位移暫存器，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收該閘極信號的一閘極與在接收第一時脈信號端與接收第二時脈信號端間連接的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的一閘極與在接收第一時脈信號端與第二上拉驅動元件的第一電晶體間連接的一傳導路徑，該第二上拉驅動元件的第一與第二電晶體共同節點連接到該第一上拉驅動元件保持電晶體的一閘極；一第三電晶體，其具有接收該第二時脈信號的一閘極 與在接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體共同節點間連接的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與在接收第一時脈信號端與接收第二時脈信號端間連接的一傳導路徑；一第五電晶體，其連接在接收第一時脈信號端與該第二上拉驅動元件的第四電晶體之間，該第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到該第二電晶體的閘極；及一第六電晶體，其具有連接到第二時脈信號的一閘極與在接收該第一時脈信號端與第四及第五電晶體共同節點間連接的一傳導路徑。
  12. 如申請專利範圍第2項之位移暫存器，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收該閘極信號的一閘極與連接在一接收第一時脈信號端與一接收第二時脈信號端間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的該第一電晶體間的一傳導路徑，該第二上拉驅動元件的第一與第二電晶體之共同節點連接到該第一上拉驅動元件的一保持電晶體的閘極；一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元 件的第一與第二電晶體共同節點間的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與連接在該接收第一時脈信號端與該接收第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在接收該第一時脈信號端與該第二上拉驅動元件的第四電晶體之間，該第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到該第二電晶體的閘極；一第六電晶體，其具有連接到該第二時脈信號的一閘極與連接在該接收第一時脈信號端與第四與第五電晶體共同節點間的一傳導路徑；及一第七電晶體，其具有連接到第四與第五電晶體共同節點的一閘極與連接在該第一上拉驅動元件與一輸出閘極信號端間的一傳導路徑。
  13. 如申請專利範圍第2項之位移暫存器，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收閘極信號的一閘極與連接在一接收第一時脈信號端與一接收第二時脈信號端間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一電晶體間的一傳導路徑，該第二上拉驅動元件的第一與第二電晶體共同節點連接到該第一上拉驅動元件的一保持電晶體的閘極； 一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑；一第四電晶體，其具有接收閘極信號的一閘極與連接在該接收第一時脈信號端與該第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在該接收第一時脈信號端與該第二上拉驅動元件的第四電晶體之間，該第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到該第二電晶體的閘極；一第六電晶體，其具有連接到該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該等第四與第五電晶體共同節點間的一傳導路徑；及一第七電晶體，其具有連接到該等第一與第二電晶體共同節點的一閘極與在連接在該第一上拉驅動元件與一輸出閘極信號端間的一傳導路徑。
  14. 一種用以將影像顯示在一顯示面板之顯示裝置，其包含：複數個像素，其各具有經由一掃描信號掃描的一切換元件；及一位移暫存器，其用以將閘極信號提供給該顯示面板的對應閘極線，該位移暫存器包含複數個單級，以分別連續產生閘極信號，該等單級的每一者包含：一第一上拉驅動元件，其響應一相鄰前級的輸出信 號或一控制信號而產生一第一控制信號；一上拉元件，其響應一第一時脈信號與該第一控制信號而產生一電流輸出信號；一第二上拉驅動元件，其響應施加於該上拉元件之該第一時脈信號且響應於一第二時脈信號而產生至少一第二控制信號；及一第三上拉驅動元件，該第三上拉驅動元件連接到一低位準端，以響應一相鄰後級的輸出信號而操作。
  15. 如申請專利範圍第14項之顯示裝置，其進一步包含一下拉元件，以響應該第二時脈信號而操作。
  16. 如申請專利範圍第15項之顯示裝置，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收閘極信號的一閘極與連接在一接收第一時脈信號端與一接收第二時脈信號端間的一傳導路徑；一第二電晶體，其連接在該第一時脈信號與該第一電晶體之間，該第二電晶體的工作如同二極體；及一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑，其中該共同節點連接到該第三上拉驅動元件。
  17. 如申請專利範圍第16項之顯示裝置，其中該第三上拉驅動元件包括：一第一電晶體，其具有連接到該第一控制信號的兩 端；一第二電晶體，其具有連接到該第二上拉驅動元件共同節點的一閘極與連接在該第一電晶體與該第二時脈信號間的一傳導路徑；一第三電晶體，其具有連接到該相鄰後級輸出信號的一閘極與連接在該上拉元件與該低位準端間的一傳導路徑；及一電容器，其連接在該上拉元件與該電流輸出信號之間。
  18. 如申請專利範圍第17項之顯示裝置，其中該上拉元件包括一第一電晶體，其具有接收該第一控制信號的一閘極與連接在一接收第一時脈信號端與一輸出閘極信號端間的一傳導路徑，且該下拉元件包括：一第一電晶體，其具有連接到一輸出閘極信號端的兩端；與一第二電晶體，其具有連接到該第二時脈信號的一閘極與連接在該第二電晶體與該第一時脈信號間的一傳導路徑。
  19. 如申請專利範圍第18項之顯示裝置，其中該提供給奇數級的第一時脈信號與該提供給偶數級的第一時脈信號具有彼此相反的相位，且該提供給奇數級的第二時脈信號與該提供給偶數級的第二時脈信號具有彼此相反的相位。
  20. 如申請專利範圍第15項之顯示裝置，其中該第二上拉驅動元件包括：一第一電晶體，其具有接收該閘極信號的一閘極與連 接在一接收第一時脈信號端與一接收第二時脈信號間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一電晶體間的一傳導路徑，該第二上拉驅動元件的第一與第二電晶體的一共同節點連接到該第一上拉驅動元件的一保持電晶體的閘極；一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體共同節點間的一傳導路徑；一第四電晶體，其具有接收該閘極信號的一閘極與連接在該接收第一時脈信號端與該接收第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在該接收第一時脈信號端與該第二上拉驅動元件的第四電晶體之間，該第五電晶體的工作如同二極體，且該等第四與第五電晶體的一共同節點連接到乾第二電晶體的閘極；及一第六電晶體，其具有連接到該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該等第四與第五電晶體共同節點間的一傳導路徑。
  21. 如申請專利範圍第15項之顯示裝置，其中第二上拉驅動元件包括：一第一電晶體，其具有接收該閘極信號的一閘極與連接一接收第一時脈信號端與一接收第二時脈信號端間 的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一電晶體間的一傳導路徑，該第二上拉驅動元件的第一第二電晶體的一共同節點連接到該第一上拉驅動元件保持電晶體的閘極；一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體的該共同節點間的一傳導路徑；一第四電晶體，其具有接收該閘極信號的一閘極與連接在該接收第一時脈信號端與接收該第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在該接收第一時脈信號端與該第二上拉驅動元件的第四電晶體之間，該第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到該第二電晶體的閘極；一第六電晶體，其具有連接該第二時脈信號的一閘極與連接在該接收第一時脈信號端與第四與第五電晶體共同節點間的一傳導路徑；及一第七電晶體，其具有連接到第四與第五電晶體共同節點的一閘極與連接在該第一上拉驅動元件與一輸出閘極信號端間的一傳導路徑。
  22. 如申請專利範圍第15項之顯示裝置，其中該第二上拉驅動元件包括： 一第一電晶體，其具有接收該閘極信號的一閘極與連接在一接收第一時脈信號端與接收第二時脈信號間的一傳導路徑；一第二電晶體，其具有接收一第二電晶體控制信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的該第一電晶體間的一傳導路徑，該第二上拉驅動元件的第一與第二電晶體的一共同節點連接到該第一上拉驅動元件的一保持電晶體的閘極；一第三電晶體，其具有接收該第二時脈信號的一閘極與連接在該接收第一時脈信號端與該第二上拉驅動元件的第一與第二電晶體的共同節點間的一傳導路徑；一第四電晶體，其具有接收該閘極信號的一閘極與連接在該接收第一時脈信號端與該接收第二時脈信號端間的一傳導路徑；一第五電晶體，其連接在該接收第一時脈信號端與該第二上拉驅動元件的該第四電晶體之間，該第五電晶體的工作如同二極體，且第四與第五電晶體的一共同節點連接到該第二電晶體的閘極；一第六電晶體，其具有連接到該第二時脈信號的一閘極與連接在該接收第一時脈信號端與第四與第五電晶體共同節點間的一傳導路徑；及一第七電晶體，其具有連接到第一與第二電晶體共同節點的一閘極與連接在一第一上拉驅動元件與一輸出閘極信號端間的一傳導路徑。
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