KR970025144A - 가변길이 복호화기의 메모리 인터페이스방법 및 회로 - Google Patents
가변길이 복호화기의 메모리 인터페이스방법 및 회로 Download PDFInfo
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Abstract
본 발명은 가변길이복호기의 메모리 인터페이스방법 및 회로에 관한 것으로서, 가변길이복호화기에서 출력되는 제1리퀘스트신호로부터 독출클럭과 독출어드레스를 생성하고, 독출어드레스가 소정 레벨에 도달하면 제2리퀘스트신호를 생성하여 외부메모리 콘트롤러로 공급하기 위한 독출제어부; 외부메모리 콘트롤러로부터 제2리퀘스트신호에 대한 억셉트신호가 발생되면 억셉트신호로부터 기입어드레스와 기입구간신호를 생성하기 위한 기입제어부; 외부메모리로부터 공급되는 데이터를 기입제어부에서 생성된 기입어드레스와 기입구간신호에 따라 기입되도록 제어하는 내부메모리 및 메모리제어부로 구성된다. 따라서 LD 와 외부 메모리간의 빈번한 메모리 억세스에 의한 신호처리의 복잡도를 경감시킬 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 가변길이복호화기의 메모리 인터페이스방법 및 회로를 나타낸 블럭도.
Claims (8)
- 가변길이복호화기에서 출력되는 제1리퀘스트신호로부터 독출클럭과 독출어드레스를 생성하여 내부 메모리에서 데이터를 독출하는 단계; 상기 내부메모리부터 소정 레벨 이상 데이터가 독출되면 제2 리퀘스트신호를 생성하여 외부메모리 콘트롤러로 공급하는 단계; 상기 외부메모리 콘트롤러에서 상기 제2 리퀘스트신호에 대한 억셉트신호가 발생되면 상기 내부메모리의 기입어드레스 및 기입구간을 생성하여 상기 외부메모리에서 공급되는 데이타를 상기 내부메모리에 기입하는 단계를 포함하는 것을 특징으로 하는 가변길이복호기의 메모리 인터페이스방법.
- 가변길이복호화기에서 출력되는 제1 리퀘스트신호로부터 돌출클럭과 독출어드레스를 생성하고, 상기 독출어드레스가 소정 레벨에 도달하면 제2 리퀘스트신호를 생성하여 외부메모리 콘트롤러를 공급하기 위한 독출제어부; 상기 외부메모리 콘트롤러로부터 상기 제2 리퀘스트신호에 대한 억셉트신호가 발생되면 상기 억셉트 신호로부터 기입어드레스와 기입구간신호를 생성하기 위한 기입제어부; 및 외부메모리로부터 공급되는 데이터를 상기 기입제어부에서 생성된 기입어드레스와 기입구간신호에 따라 기입되도록 제어하는 내부메모리 및 메모리 제어부를 포함하는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제2항에 있어서, 상기 독출인에이블신호는 상기 제1리퀘스트신호를 N번 토글하여 생성하는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제3항에 있어서, 상기 N의 값은 상기 내부메모리의 1개 데이터를 구성하는 비트수와 상기 가변길이복호화기의 처리비트수에 따라 결정되는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제2항에 있어서, 상기 독출제어부는 상기 제1리퀘스트신호로부터 제1클럭 레이트로 독출클럭을 생성하는 제1멀티 플렉서, 상기 독출클럭을 카운트하여 독출어드레스를 생성하는 제1카운터; 상기 독출어드레스가 제1소정레벨 혹은 제2 소정레벨인가를 판별하는 제1 및 제2디코더; 상기 제1 및 제2디코더의 디코딩 결과로부터 상기 제2 리퀘스트신호를 생성하는 제1 신호 생성기; 및 상기 독출클럭으로부터 제2 클럭 레이트로 독출용 칩인에이블신호를 생성하는 제2 신호 생성기로 구성되는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제5항에 있어서, 상기 기입제어부는 상기 억셉트신호로부터 리셋신호를 생성하는 제3신호 생성기; 상기 리셋신호에 의해 리셋되고, 상기 제1클럭을 카운트하여 기입어드레스를 생성하는 제2카운터; 상기 리셋신호와 상기 제2 카운터에서 출력되는 RC 신호에 의해 기입구간신호를 생성하는 제4신호생성기; 상기 기입구간신호와 상기 제1 클럭을 제2 클럭으로 래치한 신호로부터 독출/기입 선택신호를 생성하는 제5신호생성기; 및 상기 제2 클럭, 상기 기입구간신호 및 상기 제1 클럭을 제2클럭으로 래치한 신호로부터 기입용 칩인에이블신호를 생성하는 제6신호생성기로 구성되는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제6항에 있어서, 상기 내부메모리 및 메모리제어부는 상기 제1클럭을 제2클럭으로 래치한 신호를 선택 신호로하여 상기 독출어드레스와 기입어드레스를 절환하여 어드레스신호로 출력하는 제2멀티플렉서; 상기 독출용 칩인에이블신호와 기입용 칩인에이블신호로부터 칩인에이블신호를 생성하는 제7신호생성기; 상기 외부메모리 콘트롤러로부터 공급되는 데이터를 쉬프트시키는 제1쉬프트 레지스터; 상기 제1쉬프트 레지스터에서 출력되는 데이터, 칩인에이블신호, 어드레스신호, 독출/기입 선택신호를 입력으로 하는 내부메모리; 상기 내부메모리에서 출력되는 데이터를 상기 독출클럭에 따라 출력하는 제2쉬프트 레지스터; 및 상기 제2쉬프트 레지스터에서 출력되는 데이터를 상기 독출클럭에 따라 상위 및 하위비트로 분리하여 출력하는 제3멀티플렉서로 구성되는 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
- 제5항, 제6항 또는 제7항에 있어서, 상기 제1클럭은 상기 제2클럭을 2분주한 신호인 것을 특징으로 하는 가변길이복호화기의 메모리 인터페이스회로.
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