KR920007336A - 디지탈 회로 - Google Patents

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KR920007336A
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요시히토 나카무라
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아오이 죠이치
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다케다이 마사다카
도시바 마이크로 일렉트로닉스 가부시키가이샤
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
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    • G06F7/00—Methods or arrangements for processing data by operating upon the order or content of the data handled
    • G06F7/60—Methods or arrangements for performing computations using a digital non-denominational number representation, i.e. number representation without radix; Computing devices using combinations of denominational and non-denominational quantity representations, e.g. using difunction pulse trains, STEELE computers, phase computers
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    • G—PHYSICS
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Abstract

내용 없음

Description

디지탈 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 따른 PWM발생회로를 도시한 블럭도,
제2도는 상기 제1도에 도시한 PWM발생회로의 기본적인 동작을 나타낸 파형도,
제3도는 본 발명의 다른 실시예에 따른 디지탈회로를 도시한 블럭도.

Claims (5)

  1. 소정 비트의 디지탈데이터를 일정 시간동안 기억하는 제1수단(13a, 13b)과, 소정 비트의 바이너리데이터를 주기적으로 변화시키는 제2수단(11)및, 상기 소정 비트의 디지탈데이터와 상기 소정 비트의 바이너리데이터를 비교하여 PWM 데이터를 발생시키는 제3수단(12a)을 갖춘 PWM 발생회로에 있어서, 상기 제3수단(12a)에 PWM DUTY 량의 최소치를 PWM데이터에 가산할수 있는 가산기능을 갖게하여 상기 소정 비트의 디지탈데이터의 기억시간내에 PWM주기기준으로 상기 PWM DUTY량의 최소치의 가산을 시분할제어하도록 된 것을 특징으로 하는 디지탈회로.
  2. 제1항에 있어서, 상기 소정 비트의 디지탈데이타가 ROM 또는 디코더로 부터 출력되는 것을 특징으로하는 디지탈 회로.
  3. 제1항에 있어서, N비트인 디지탈데이터의 MSB측으로부터의 M비트와 N비트인 바이너리데이터의 LSB측으로부터의 M비트를 비교하여 PWM데이터에 PWM CUTY량의 최소치(1/2N-M)를 가산하기 위한 데이터를 상기 제3수단(12a)에 입력하는 비교수단(12b)을 설치함으로써 상기 PWM DUTY량의 최소치를 상기 N비트인 디지탈 데이터로부터 M비트를 뺀 (N-M)비트의 데이터에 따른 양으로 제어하도록 된 것을 특징으로 하는 디지탈회로.
  4. 제3항에 있어서, 상기 제3수단(12a)이 상기 제1 및 제2수단(13a, 13b, 11)으로부터의 데이터와 상기 비교수단(12b)으로부터의 데이터를 가산할수 있는 가산기능을 갖추고 있는 것을 특징으로 하는 디지탈 회로.
  5. 임의의 디지탈데이터를 ROM 또는 디코더에 의해 데이터변환하여, 그 데이터변환된 데이터에 따라 파형을 제어하는 회로에 있어서, ROM 또는 디코더의 어드레스로 되는 N비트의 데이터를 소정 주기의 2N배의 시간중에 1/2M배로 하고, 그 1/2M배된 데이터에 N비트데이터의 LSB 측으로부터 M비트의 데이터량을 시분할적으로 가산하여 ROM 또는 디코더의 어드레스신호로 하도록 된 것을 특징으로 하는 디지탈회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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