KR900001000A - 단일 폴리실리콘 자기-정합 트랜지스터 및 이의 제조 방법 - Google Patents
단일 폴리실리콘 자기-정합 트랜지스터 및 이의 제조 방법 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 제1처리 공정 단계후의 본 발명의 트랜지스터의 제1실시예의 단면도.
제2도는 제2처리 공정 단계후의 본 발명의 트랜지스터의 제1실시예의 단면도.
제3도는 제3처리 공정 단계후의 본 발명의 트랜지스터의 제1실시예의 단면도.
제4도는 제4처리 공정 단계후의 본 발명의 트랜지스터의 제1실시예의 단면도.
제5도는 제5처리 공정 단계후와 본 발명의 트랜지스터의 제1실시예의 단면도.
Claims (18)
- 자기-정합 트랜지스터를 제조하는 방법에 있어서, 반도체 표면에 베이스 영역을 형성하는 스텝, 베이스 영역상에 물질층을 형성하는 스텝, 물질층을 도핑하는 스텝, 에미터 영역을 정하기 위해 물질층상에 제1마스킹층을 형성하는 스텝, 제1마스킹층의 측벽상에 스페이서 영역을 형성하는 스텝, 제1마스킹층 또는 측벽 영역하부에 있지 않은 물질층 부분의 상부에 제2마스킹층을 형성하는 스텝, 스페이서 영역을 제거하는 스텝, 제1 똔느 제2마스킹층에 덮혀지지 않은 물질층 부분을 제거하는 스텝, 및 물질층으로부터 베이스 영역내로 도펀트를 확산시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제1항에 있어서, 물질층을 형성하는 스텝이 베이스 영역상에 폴리실리콘층을 형성하는 스텝을 포함하는 것을특징으로 하는 방법.
- 제1항에 있어서, 제1마스킹층을 형성하는 스텝이, 물질층 상부에 있는 제1마스킹층을 형성하는 스텝, 및 에미터가 요구되는 베이스 영역상부에 있는 제1마스킹층의 일부분을 제거하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제3항에 있어서, 물질층을 도핑하는 스텝이 제1마스킹층의 제거된 부분하부에 있는 물질층 영역을 도핑하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제1항에 있어서, 제1마스킹층을 형성하는 스텝이, 물질층 상부에 있는 제1마스킹층을 형성하는 스텝, 및 에미터가 요구되는 베이스 영역 상부에 있지 않은 제1마스킹층 부분을 제거하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제5항에 있어서, 물질층을 도핑하는 스텝이 마스킹층을 형성하기 전에 물질층의 상부 표면을 도핑하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제1마스킹층의 제거된 부분하부에 있는 물질층의 상부 표면 부분을 제거하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제1항에 있어서, 스페이서 영역을 형성하는 스텝이, 물질층 및 제1마스킹층 상에 컨포멀 질화물층을 형성하는 스텝, 및 질화물층을 비등방성 에칭시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제2항에 있어서, 제2 마스킹층을 형성하는 스텝이 물질층을 열적으로 산화시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 자기-정합 트랜지스터를 형성하는 방법에 있어서, 반도체 표면에 베이스 영역을 형성하는 스텝, 베이스 영역상에 물질층을 형성하는 스텝, 물질층을 노출시키고 베이스 영역내에 에미터를 정하는 윈도우를 갖는 물질층상부에 있는 제1마스킹층을 형성하는 스텝, 윈도우의 측벽상에 스페이서 영역을 형성하는 스텝, 정해진 에미터상부에 있는 물질층의 일부분을 도핑하는 스텝, 제1마스킹층 또는 스페이서 영역에 의해 덮혀지지 않은 물질층 부분상에 제2마스킹층을 형성하는 스텝, 스페이서 영역을 제거하는 스텝, 제1 또는 제2 마스킹층에 의해 덮혀지지 않은 물질층 부분을 제거하는 스텝, 및 물질층으로부터 베이스 영역내로 도펀트를 확산시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제10항에 있어서, 물질층을 도핑하는 스텝이 윈도우를 통해 물질층내로 도펀트를 이식시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제10항에 있어서, 물질층내에 베이스 접촉영역을 정하기 위해 제1마스킹층 부분을 제거하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제12항에 있어서, 베이스 접촉 영역을 도핑하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 자기-정합 트랜지스터를 형성하는 방법에 있어서, 반도체 표면에 베이스 영역을 형성하는 스텝, 베이스 영역상에 물질층을 형성하는 스텝, 물질층의 상부 표면을 도핑하는 스텝, 물질층상부에 있고, 베이스 영역내에 에미터를 정하는 제1마스킹층을 형성하는 스텝, 제1마스크에 덮혀지지 않은 상부 표면 부분을 제거하는 스텝, 제1마스크에 인접하여 스페이서 영역을 형성하는 스텝, 제1 마스킹층 또는 스페이퍼 영역에 의해 덮혀지지 않은 물질층 부분상부에 있는 제2마스크를 형성하는 스텝, 스페이서 영역을 제거하는 스텝, 제1 또는 제2마스킹층에 의해 덮혀지지 않는 물질층 부분을 제거하는 스텝, 및 물질층으로부터 베이스 영역내로 도펀트를 확산시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제14항에 있어서, 스페이서 영역을 형성하는 스텝이, 제1마스크내의 물질층상에 컨포멀 질화물층을 형성하는 스텝, 및 질화물층을 비등방성 에칭시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제15항에 있어서, 제2마스크를 형성하는 스텝이 제1마스킹 영역 또는 스스페이서 영역에 의해 덮혀지지 않은 물질층 부분을 열적으로 산화시키는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제14항에 있어서, 베이스 접촉 영역을 정하기 위해 제2마스크 부분을 제거하는 스텝을 포함하는 것을 특징으로 하는 방법.
- 제17항에 있어서, 베이스 접촉 영역을 도핑하는 스텝을 포함하는 것을 특징으로 하는 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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US5258644A (en) * | 1988-02-24 | 1993-11-02 | Hitachi, Ltd. | Semiconductor device and method of manufacture thereof |
US5001538A (en) * | 1988-12-28 | 1991-03-19 | Synergy Semiconductor Corporation | Bipolar sinker structure and process for forming same |
US5026663A (en) * | 1989-07-21 | 1991-06-25 | Motorola, Inc. | Method of fabricating a structure having self-aligned diffused junctions |
US4992848A (en) * | 1990-02-20 | 1991-02-12 | At&T Bell Laboratories | Self-aligned contact technology |
US5064774A (en) * | 1991-02-19 | 1991-11-12 | Motorola, Inc. | Self-aligned bipolar transistor process |
KR950000519B1 (ko) * | 1991-02-28 | 1995-01-24 | 현대전자산업 주식회사 | 폴리실리콘층을 이용한 자기정렬콘택 제조방법 |
US5169794A (en) * | 1991-03-22 | 1992-12-08 | National Semiconductor Corporation | Method of fabrication of pnp structure in a common substrate containing npn or MOS structures |
US5279976A (en) * | 1991-05-03 | 1994-01-18 | Motorola, Inc. | Method for fabricating a semiconductor device having a shallow doped region |
US5200352A (en) * | 1991-11-25 | 1993-04-06 | Motorola Inc. | Transistor having a lightly doped region and method of formation |
WO1993016494A1 (en) * | 1992-01-31 | 1993-08-19 | Analog Devices, Inc. | Complementary bipolar polysilicon emitter devices |
JPH05226352A (ja) * | 1992-02-17 | 1993-09-03 | Mitsubishi Electric Corp | 半導体装置及びその製造方法 |
US5236853A (en) * | 1992-02-21 | 1993-08-17 | United Microelectronics Corporation | Self-aligned double density polysilicon lines for ROM and EPROM |
US6011283A (en) * | 1992-10-19 | 2000-01-04 | Hyundai Electronics America | Pillar emitter for BiCMOS devices |
KR950009813B1 (ko) * | 1993-01-27 | 1995-08-28 | 삼성전자주식회사 | 반도체장치 및 그 제조방법 |
US5759881A (en) * | 1993-09-10 | 1998-06-02 | Micron Technology, Inc. | Low cost well process |
US5330924A (en) * | 1993-11-19 | 1994-07-19 | United Microelectronics Corporation | Method of making 0.6 micrometer word line pitch ROM cell by 0.6 micrometer technology |
US5444004A (en) * | 1994-04-13 | 1995-08-22 | Winbond Electronics Corporation | CMOS process compatible self-alignment lateral bipolar junction transistor |
US5378646A (en) * | 1994-07-07 | 1995-01-03 | United Microelectronics Corporation | Process for producing closely spaced conductive lines for integrated circuits |
US5548158A (en) * | 1994-09-02 | 1996-08-20 | National Semiconductor Corporation | Structure of bipolar transistors with improved output current-voltage characteristics |
US5659197A (en) * | 1994-09-23 | 1997-08-19 | Vlsi Technology, Inc. | Hot-carrier shield formation for bipolar transistor |
EP0766295A1 (en) * | 1995-09-29 | 1997-04-02 | Co.Ri.M.Me. Consorzio Per La Ricerca Sulla Microelettronica Nel Mezzogiorno | Process for forming a high frequency bipolar transistor structure comprising an oblique implantation step |
KR0182000B1 (ko) * | 1995-12-28 | 1999-04-15 | 김광호 | 바이폴라 트랜지스터의 제조방법 |
US5670417A (en) * | 1996-03-25 | 1997-09-23 | Motorola, Inc. | Method for fabricating self-aligned semiconductor component |
US6020246A (en) * | 1998-03-13 | 2000-02-01 | National Semiconductor Corporation | Forming a self-aligned epitaxial base bipolar transistor |
US6617220B2 (en) | 2001-03-16 | 2003-09-09 | International Business Machines Corporation | Method for fabricating an epitaxial base bipolar transistor with raised extrinsic base |
US20080238519A1 (en) * | 2007-03-26 | 2008-10-02 | Ashok Kumar Kapoor | Signaling circuit and method for integrated circuit devices and systems |
US20080237657A1 (en) * | 2007-03-26 | 2008-10-02 | Dsm Solution, Inc. | Signaling circuit and method for integrated circuit devices and systems |
US20090168508A1 (en) * | 2007-12-31 | 2009-07-02 | Dsm Solutions, Inc. | Static random access memory having cells with junction field effect and bipolar junction transistors |
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Family Cites Families (8)
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---|---|---|---|---|
US4331708A (en) * | 1980-11-04 | 1982-05-25 | Texas Instruments Incorporated | Method of fabricating narrow deep grooves in silicon |
DE3242113A1 (de) * | 1982-11-13 | 1984-05-24 | Ibm Deutschland Gmbh, 7000 Stuttgart | Verfahren zur herstellung einer duennen dielektrischen isolation in einem siliciumhalbleiterkoerper |
US4640721A (en) * | 1984-06-06 | 1987-02-03 | Hitachi, Ltd. | Method of forming bipolar transistors with graft base regions |
US4610730A (en) * | 1984-12-20 | 1986-09-09 | Trw Inc. | Fabrication process for bipolar devices |
JPS61214567A (ja) * | 1985-03-20 | 1986-09-24 | Hitachi Ltd | 半導体装置の製造方法 |
JPS61287233A (ja) * | 1985-06-14 | 1986-12-17 | Toshiba Corp | 半導体装置の製造方法 |
JPS62140462A (ja) * | 1985-12-16 | 1987-06-24 | Nec Corp | 半導体装置の製造方法 |
US4716126A (en) * | 1986-06-05 | 1987-12-29 | Siliconix Incorporated | Fabrication of double diffused metal oxide semiconductor transistor |
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