KR20170100648A - 데이터 구동회로, 그 구동방법 및 유기 발광 디스플레이 - Google Patents
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Abstract
데이터 구동회로, 데이터 회로의 구동방법 및 데이터 구동회로를 구비한 유기 발광 디스플레이에 있어서, 데이터 구동회로는 데이터 신호 다중화 구조를 구비하고, 전원(Vref)에 연결되도록 구성된 전원라인(50), 및 전원라인(50)에 연결된 제2 트랜지스터(T2'…Tm')를 더 포함하며; 제2 트랜지스터(T2'…Tm')의 소스 전극은 전원라인(50)에 전기적으로 연결되고, 제2 트랜지스터(T2'…Tm')의 게이트 전극은 동일한 행의 제어라인(Sel_1)에 전기적으로 연결되며; 제2 트랜지스터(T2'…Tm')의 드레인 전극은 각각 서로 다른 신호라인(Dj')에 전기적으로 연결되며, 연결점은 제1 트랜지스터(T1…Tm)와 표시구역(40) 사이에 위치한다. 신호라인(D1'…Dm')에 보상전원(Vref)을 액세스함으로써 화소 유닛(11…nm)을 초기화하여, 화소 유닛(11…nm)중 기생 용량의 영향을 감소함으로써, 이를 응용한 유기 발광 표시장치의 응답 특성 및 디스플레이 특성을 효과적으로 향상시킬 수 있다.
Description
본 발명은 표시 기술분야에 관한 것이고, 구체적으로 표시장치의 응답 특성을 효과적으로 향상시킬 수 있는 데이터 구동회로, 그 구동방법 및 유기 발광 디스플레이에 관한 것이다.
평판 디스플레이는, 완전한 평면이고, 가볍고 얇으며, 전력을 절감하는 등 특징을 가지므로, 화상 디스플레이 발전의 필연적 추세 및 연구 초점이 되었다. 각종 유형의 평판 표시장치에 있어서, 능동형 유기 발광 표시장치(Active Matrix Organic Light Emitting Display, AMOLED)는 자기 발광 유기 발광 다이오드(Organic Light Emitting Diode, OLED)를 이용하여 화상을 디스플레이함으로써 응답 시간이 짧고, 저전력으로 구동하고, 상대적으로 더욱 우수한 밝기와 색 순도의 특성을 가지므로, 유기 발광 표시장치는 이미 차세대 표시장치로서 주목받고 있다.
대형 능동형 유기 발광 표시장치는, 주사라인 및 데이터라인의 교차영역에 위치한 복수의 화소 유닛을 포함한다. 도1에 나타낸 바와 같이, 종래의 능동형 유기 발광 디스플레이 패널은, 데이터 드라이버(20), 스캔 드라이버(30) 및 화소 유닛(11, 12…nm) 등을 포함한다. 상기 데이터 드라이버(20)가 송신한 데이터 신호는 구동칩에서 제공하므로, 일반적으로 1열의 화소 유닛은 한 개의 데이터 신호를 필요로 하고, m열의 화소 유닛은 m개의 데어터 신호(D1, D2…Dm)를 필요로 한다. 구동칩의 원가가 비교적 높고, 그 원가와 구동칩의 면적은 정비례 관계를 이루며, 과다한 데이터 신호는 더욱 많은 칩 면적을 차지하므로, 구동칩의 원가가 올라가기에, 많은 회사에서는 데이터 신호 다중화(Mux/Demux) 구조를 이용하여 구동신호 수량을 줄임으로써 구동칩의 면적을 감소하여 구동칩의 원가를 절감할 수 있다.
도2는 데이터 신호 다중화 구조를 이용한 AMOLED패널을 나타내는 개략도이고, 이는 도1에서 나타낸 종래의 AMOLED 화소 회로의 기초 상에 m개의 P형 스위치 트랜지스터와 2개의 스위치 드랜지스터 제어 신호(Sel_1, Sel_2)를 추가하였다. 이러한 패널은 데이터 드라이버의 데이터 신호라인의 수량을 절반 감소하여, 기존의 m개로부터 m/2로 감소되었다. 실험 결과, 일부 특정 조건 하에, 데이터 다중화 구조를 이용한 AMOLED패널에는 디스플레이 이상 문제가 존재 가능한 것으로 나타났다.
도2 및 도3에 나타낸 바와 같이, 제1열 데이터라인 데이터 신호 기록 주기(T1)에 있어서, t1 시간 내에, 스위치 트랜지스터(T1)가 도통되고, 데이터 신호라인(D1)의 하이 레벨 신호(5V)가 표시구역 내의 신호라인(D1')에 전송되고; t2 시간 내에, 스위치 트랜지스터(T2)가 도통되고, 데이터 신호라인(D1)의 하이 레벨 신호가 표시구역 내의 신호라인(D2')에 전송된다. 제2열 데이터라인 데이터 신호 기록 주기(T2)에 있어서, t3 시간 내에, 스위치 트랜지스터(T1)가 도통되고, 데이터 신호라인(D1)의 로우 레벨 신호가 표시구역 내의 신호라인(D1')에 전송되고, 화소 유닛(21)이 로우 레벨로 로딩되며; 이때 신호라인(D2')은 플로트 상태에 처해있고, 신호라인의 기생 용량의 존재로 인해 신호라인(D2')은 t1 시간 내에 하이 레벨 상태를 유지하고, 화소 유닛(22)은 하이 레벨이 인가될 수 있다. t4 시간 내에, 스위치 트랜지스터(T2)가 도통되고, 데이터 신호라인(D1)의 로우 레벨 신호가 표시구역 내의 신호라인(D2')에 전송되지만; t3 시간 내에 화소 유닛(22)은 하이 레벨이 인가되었기에, t4 시간 내에 화소 유닛(22)은 유효한 로우 레벨 신호를 접수하기 어려워, 이러한 AMOLED패널에는 디스플레이 이상 현상이 나타날 수 있다.
동시에, 도4에 나타낸 바와 같이, 기술자들은 m개의 P형 스위치 트랜지스터와 3개의 스위치 드랜지스터 제어 신호(Sel_1, Sel_2, Sel_3)를 추가한 다른 데이터 신호 다중화 구조의 AMOLED패널을 개발하였다. 이러한 패널은 데이터 드라이버(20)의 데이터 신호라인의 수량의 2/3를 감소하여, 기존의 m개로부터 m/3개로 감소되었다.
도4 및 도5에 나타낸 바와 같이, Sel_1, Sel_2 및 Sel_3은 모두 주기 신호이고, S1、S2…Sn은 주사라인이며, Sel_1, Sel_2 및 Sel_3은 t1, t2…t3n 시간 내 신호가 순차적으로 로우 레벨이고, 스위치 트랜지스터(T1, T2…Tm)가 순차적으로 도통되도록 하며, 데이터 드라이버 신호라인(D1…D(m/3)) 상의 신호가 순차적으로 표시구역 내의 신호라인(D1'…Dm')에 분배되도록 한다. 도2에 나타낸 데이터 구동회로와 마찬가지로, 도4에 나타낸 데이터 구동회로의 AMOLED패널에도 일부 디스플레이 이상 현상이 나타날 수 있다.
도2 및 도4에 기재된 데이터 구동회로는 구동칩을 효과적으로 감소하여 생산원가를 저감할 수 있지만, 모두 응답 지연 현상이 존재하여 디스플레이 이상 문제을 초래할 수 있다.
이로써, 본 발명은, 기존 AMOLED의 데이터 구동회로에 존재하는 응답 지연으로 인해, 디스플레이 이상을 초래하는 문제점을 해결하는 것을 목적으로 하고, 디스플레이 부재의 응답 특성을 효과적으로 향상시킬 수 있는 데이터 구동회로, 그 구동방법 및 응용을 제공한다.
상기 기술적 과제를 해결하기 위해, 본 발명은 아래와 같은 기술방안을 채용한다.
본 발명에 기재된 데이터 구동회로는, m/i열 데이터라인을 통해 데이터 드라이버에 전기적으로 연결되고, n행 주사라인을 통해 스캔 드라이버에 전기적으로 연결되며;
각 데이터라인의 데이터 드라이버에서 떨어진 일단에 i열 신호라인이 연결되어 있고, 각 주사라인은 각각 표시구역에 설치된 각 행의 화소 유닛에 전기적으로 연결되며, 각 신호라인은 각각 표시구역에 설치된 각 열의 화소 유닛에 전기적으로 연결되며;
각 신호라인 중 데이터라인과 표시구역을 연결하는 구간 내에 제1 트랜지스터가 더 연결되어 있고, 상기 데이터 구동회로는 데이터 드라이버를 연결하는 i행 제어라인을 더 포함하며;
동일한 데이터라인에 연결되는 i개의 제1 트랜지스터의 게이트 전극은 각각 서로 다른 제어라인에 전기적으로 연결되며;
i는 2이상의 자연수이고, m은 i의 정수배의 0이 아닌 자연수 이며, n은 0이 아닌 자연수이며;
상기 데이터 구동회로는 전원라인, 및 상기 전원라인에 연결되는 m-m/i 개의 제2 트랜지스터를 더 포함하고, 상기 전원라인은 전원에 연결되는데 이용되며;
각 상기 제2 트랜지스터의 소스 전극은 모두 상기 전원라인에 전기적으로 연결되고, 각 상기 제2 트랜지스터의 게이트 전극은 동일한 행의 상기 제어라인에 전기적으로 연결되며, 상기 제2 트랜지스터의 드레인 전극은 각각 서로 다른 상기 신호라인에 전기적으로 연결되며, 연결점은 상기 제1 트랜지스터와 상기 표시구역 사이에 위치한다.
동일한 상기 신호라인에 연결되는 상기 제1 트랜지스터와 상기 제2 트랜지스터의 게이트 전극은 서로 다른 상기 제어라인에 연결되는 것이 바람직하다.
상기 전원의 전압값은 0V이하인 것이 바람직하다.
전부의 상기 제1 트랜지스터는 모두 P형 트랜지스터인 것이 바람직하다.
전부의 상기 제2 트랜지스터는 채널 극성이 서로 같은 전계효과 트랜지스터인 것이 바람직하다.
상기 제2 트랜지스터는 P형 전계효과 트랜지스터인 것이 더욱 바람직하다.
본 발명에 기재된 데이터 구동회로의 구동방법에 있어서, 각 열의 상기 데이터라인의 데이터 신호의 기록 주기를 i개의 시간 단계로 나누고, 매 개 상기 시간 단계에서 각 상기 제어라인을 순차적으로 로우 레벨로 설정하며,
첫번째 상기 시간 단계에서, 로우 레벨의 상기 제어라인에 연결된 제2 트랜지스터가 도통되고, 상기 제2 트랜지스터에 연결된 상기 신호라인은 상기 전원과 도통되며, 그 위치된 열의 각 화소 유닛은 초기화된다.
매 개 상기 시간 단계에서, 로우 레벨의 상기 제어라인에 연결된 제1 트랜지스터가 도통되고, 상기 제1 트랜지스터에 연결된 상기 신호라인은 상기 데이터라인과 도통되며, 그 위치된 열의 각 화소 유닛에 데이터 신호가 기록되는 것이 바람직하다.
상기 초기화 전압값은 0V이하인 것이 바람직하다.
본 발명에 기재된 유기 발광 디스플레이는 상기 데이터 구동회로를 포함한다.
본 발명의 상기 해결수단은 종래기술과 대비시 아래와 같은 유리한 효과를 가진다.
본 발명의 실시예에 기재된 데이터 구동회로는, 데이터라인을 통해 데이터 드라이버에 전기적으로 연결되고, 주사라인을 통해 스캔 드라이버에 전기적으로 연결되며; 각 데이터라인의 데이터 드라이버에서 떨어진 일단에 i열 신호라인이 연결되어 있고, 각 주사라인은 각각 표시구역에 설치된 각 행 화소 유닛에 전기적으로 연결되며, 각 신호라인은 각각 표시구역에 설치된 각 열 화소 유닛에 전기적으로 연결되며; 각 신호라인 중 데이터라인과 표시구역을 연결하는 구간 내에 제1 트랜지스터가 더 연결되어 있고, 상기 데이터 구동회로는 데이터 드라이버를 연결하는 제어라인을 더 포함하며; 동일한 데이터라인에 연결되는 i개의 제1 트랜지스터의 게이트 전극은 각각 제어라인에 전기적으로 연결되며; 상기 데이터 구동회로는 전원라인, 및 상기 전원라인에 연결되는 m(i-1)/i 개의 제2 트랜지스터 즉 (m-m/i) 개의 제2 트랜지스터를 더 포함한다. 상기 전원라인은 전원에 연결되는데 사용되며; 제2 트랜지스터의 소스 전극은 상기 전원라인에 전기적으로 연결되고, 상기 제2 트랜지스터의 소스 전극은 각각 동일한 데이터라인에 연결된 i열 신호라인 중의 i-1열의 신호라인에 전기적으로 연결되며, 연결점은 제1 트랜지스터와 표시구역 사이에 위치하며, 상기 제2 트랜지스터의 게이트 전극은 상기 제2 트랜지스터의 드레인 전극에 연결되지 않은 상기 제어라인 상에 전기적으로 연결된다. 신호라인에 보상전원을 액세스하는 것을 통해 화소 유닛을 초기화하여, 화소 유닛 중의 기생 용량에 의한 영향을 줄임으로써, 이를 이용한 상기 유기 발광 디스플레이의 응답 특성 및 디스플레이 특성을 효과적으로 향상시킬 수 있다.
본 발명의 내용을 더욱 용이하고 명확하게 이해하기 위해, 이하 본 발명의 구체적인 실시예와 도면에 근거하여 본 발명에 대해 더 상세하게 설명하고, 그 중,
도1은 종래기술 중 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 2는 종래기술 중 다른 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 3은 도 2 및 도 6 중의 상기 데이터 구동회로도의 제어 신호 타임차트;
도 4는 종래기술 중 다른 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 5는 도 4 및 도 7 중의 상기 데이터 구동회로도의 제어 신호 타임차트;
도 6은 본 발명의 실시예 1에 기재된 데이터 구동회로도;
도 7은 본 발명의 실시예 2에 기재된 데이터 구동회로도이다.
도1은 종래기술 중 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 2는 종래기술 중 다른 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 3은 도 2 및 도 6 중의 상기 데이터 구동회로도의 제어 신호 타임차트;
도 4는 종래기술 중 다른 유기 발광 디스플레이 부재의 데이터 구동회로도;
도 5는 도 4 및 도 7 중의 상기 데이터 구동회로도의 제어 신호 타임차트;
도 6은 본 발명의 실시예 1에 기재된 데이터 구동회로도;
도 7은 본 발명의 실시예 2에 기재된 데이터 구동회로도이다.
본 발명의 목적, 해결수단, 및 장점을 더욱 명확히 하기 위해, 이하에서 도면을 결합하여 본 발명의 실시예의 실시형태에 대해 더욱 상세하게 서술하였다.
이하 도면을 참조하여 본 발명에 따른 특정 예시 실시예를 설명한다. 그 중, 제1 소자가 제2 소자에 "연결"되었다고 서술된 경우, 제1 소자는 제2 소자에 직접적으로 연결되었거나, 또는 1개 또는 복수개의 부가적 소자를 거쳐 제2 소자에 연결될 수 있다. 나아가, 더욱 명확하게 하기 위해, 본 발명의 충분한 이해에 필수적이지 않는 일부 소자는 생략 서술하도록 한다. 그 외, 동일한 부호는 항상 동일한 소자를 나타낸다.
실시예
1
본 실시예에서 데이터 구동회로를 제공하고, 도 6에 나타낸 바와 같이, 상기 데이터 구동회로는 m/i열 데이터라인(D1, …D(m/2))을 통해 데이터 드라이버(20)에 전기적으로 연결되고, n행 주사라인(S1, S2, …Sn)을 통해 스캔 드라이버(30)에 전기적으로 연결되며, 본 실시예에서 i의 값은 2이다.
제1열 데이터라인(D1)의 데이터 드라이버(20)에서 떨어진 일단에 제1열 신호라인(D1') 및 제2열 신호라인(D2')이 연결되어 있고, 동일하게, 제j열 데이터라인(Dj)의 데이터 드라이버(20)에서 떨어진 일단에 제(2j-1)열 신호라인(D2j-1') 및 제2j열 신호라인(D(2j)')이 연결되어 있고, j=1, 2, 3, …m/2이며, 제m/2열 데이터라인(D(m/2))의 데이터 드라이버(20)에서 떨어진 일단에 2개의 신호라인, 즉 제m-1열 신호라인(D(m-1)') 및 제m열 신호라인(Dm')이 연결되어 있다. 상기 데이터 구동회로는 표시구역(40)에 설치된 화소 유닛(11, 12, …1(m-1), 1m, 21, 22…2(m-1), 2m…n1, n2…n(m-1), nm)을 더 포함하고, 본 실시예에서, 상기 표시구역(40)에는 n행 m열의 상기 화소 유닛이 설치되어 있고, 각 상기 주사라인(S1, S2…Sn)은 각각 표시구역(40)에 설치된 각 행의 상기 화소 유닛에 전기적으로 연결되며, 각 상기 신호라인(D1', D2', …D(m-1)', Dm')은 각각 상기 표시구역(40)에 설치된 각 열의 상기 화소 유닛에 전기적으로 연결된다. 즉 제m열 신호라인(Dm') 및 제n행 주사라인(Sn)은 모두 제n행 제m열의 상기 화소 유닛(nm)에 연결된다.
각 상기 신호라인(D1', D2', …D(m-1)', Dm') 중 상기 데이터라인(D(m/2))과 상기 표시구역(40)을 연결하는 구간 내에 제1 트랜지스터(T1, T2, …T(m-1), Tm)가 더 연결되어 있고, 상기 데이터 구동회로는 데이터 드라이버(20)를 연결하는 2행의 제어라인(Sel_1, Sel_2)을 더 포함하며, 상기 제1 트랜지스터(T1, T2, …T(m-1), Tm)는 P형 트랜지스터인 것이 바람직하다.
제1열 데이터라인(D1)에 연결된 2개의 제1 트랜지스터(T1, T2)의 게이트 전극은 각각 서로 다른 제어라인(Sel_1, Sel_2)에 전기적으로 연결되며;
마찬가지로, 동일한 상기 데이터라인(Dj)에 연결된 2개의 제1 트랜지스터(T(2j-1), T(2j))의 게이트 전극은 각각 서로 다른 제어라인(Sel_1, Sel_2)에 전기적으로 연결되고, j=1, 2, 3, …m/2이며;
제m/2열 데이터라인(D(m/2))에 연결된 2개의 제1 트랜지스터(T(m-1), Tm)의 게이트 전극은 각각 제어라인(Sel_1, Sel_2)에 전기적으로 연결된다.
상기 데이터 구동회로는 전원라인(50) 및 상기 전원라인(50)에 연결된 m/2개의 제2 트랜지스터(T2', …Tm')를 더 포함하며, 상기 전원라인(50)은 전원(Vref)에 연결되는데 사용되며; 상기 전원(Vref)의 전압값은 0V이하이며, 본 실시예에서는 0V인 것이 바람직하다.
각 상기 제2 트랜지스터(T2', …Tm')의 소스 전극은 상기 전원라인(50)에 전기적으로 연결되고, 게이트 전극은 동일한 행의 상기 제어라인(Sel_1)에 전기적으로 연결되며; 제j열 상기 제2 트랜지스터(Tj')의 드레인 전극은 제j열 신호라인(Dj')에 전기적으로 연결되며, 연결점은 제j열 상기 제1 트랜지스터(Tj)와 상기 표시구역(40) 사이에 위치하며, j=2, 4, 6, …, m이다. 즉, 제2열 제2 트랜지스터(T2')의 소스 전극은 상기 전원라인(50)에 전기적으로 연결되고, 그 드레인 전극은 제2열 신호라인(D2')에 연결되고, 연결점은 제2열 제1 트랜지스터(T2)와 상기 표시구역(40) 사이에 위치한다.
동일한 상기 신호라인(D2', D4', …D(m-2)', Dm')에 연결되는 상기 제1 트랜지스터(T2, T4, …T(m-2), Tm)와 상기 제2 트랜지스터(T2', T4', …T(m-2)', Tm')의 게이트 전극은 서로 다른 상기 제어라인에 연결되며, 본 실시예에 있어서, 각각 Sel_2, Sel_1에 연결된다. 구체적으로, 본 실시예에 있어서, 상기 제2열 제2 트랜지스터(T2')의 게이트 전극은 상기 제어라인(Sel_1)에 전기적으로 연결되고, 동일한 열의 제1 트랜지스터(T2)의 게이트 전극은 상기 제어라인(Sel_2)에 연결되며,… 상기 제m열 제2 트랜지스터(Tm')의 게이트 전극은 상기 제어라인 (Sel_1)에 전기적으로 연결되고, 동일한 열의 제1 트랜지스터(Tm)의 게이트 전극은 상기 제어라인(Sel_2)에 연결된다.
모든 상기 제2 트랜지스터(T2', …Tm')는 채널 극성이 서로 같은 전계효과 트랜지스터이고, 본 실시예에서, P형 전계효과 트랜지스터인 것이 바람직하다.
본 발명의 다른 실시예로서, 데이터라인은 m/i열일 수 있고, 각 열 데이터라인 단부에 연결된 신호라인은 i열일 수 있으며, 상기 제어라인은 i행이고, 상기 제2 트랜지스터의 수량은 m(i-1)/i개이며, 다시 말해서 제2 트랜지스터의 수량은 (m-m/i)개이며, i는 2이상의 자연수이고, m은 i의 정수배의 0이 아닌 자연수이며, 모두 본 발명의 목적을 실현할 수 있으며, 본 발명의 보호범위에 속한다.
상기 데이터 구동회로의 구동방법은, 각 열의 데이터라인의 데이터 신호 기록 주기(Tj, j=1, 2, 3…n)를 i개의 시간 단계로 나누며, 본 실시예에서는 2개의 시간단계(t1, t2)로 나누고, 제2행 화소 유닛을 예로 들면, 도 3에 나타낸 바와 같이,
제1열 데이터라인(D1)의 데이터 신호 기록 주기(T1)에서 제1열 데이터라인(D1)은 하이 레벨을 전송한다.
t1 시간 내에서, 상기 제어라인(Sel_1)은 로우 레벨이고, 상기 제어라인 (Sel_2)은 하이 레벨이며, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2')가 도통되고, 제2열 제1 트랜지스터(T2)가 차단되며; 제1열 데이터라인(D1)의 하이 레벨이 표시구역(40) 내의 제1열 신호라인(D1')상에 전송되고, 신호라인(D1') 상의 데이터 신호는 제1열 화소 유닛(11, 21, …n1)에 로딩되며; 제2열 신호라인(D2')은 전원(Vref)에 연결되며, 제2열 신호라인(D2')이 초기화되고, 제2열 화소 유닛(12, 22, …n2)에 로딩된 전압은 0V이다.
t2 시간 내에서, 상기 제어라인(Sel_2)은 로우 레벨이고, 상기 제어라인(Sel_1)은 하이 레벨이며, 제2열 제1 트랜지스터(T2)가 도통되고, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2')가 차단되며; 제1열 데이터라인(D1)의 하이 레벨 신호가 표시구역(40) 내의 제2열 신호라인(D2') 상에 전송되며, 신호라인(D2') 상의 데이터 신호는 제2열 화소 유닛(12, 22, …n2)에 로딩된다.
제2열 데이터라인(D1)의 데이터 신호 기록 주기(T2)에서 제1열 데이터라인(D1)은 로우 레벨을 전송한다.
t3 시간 내에서, 상기 제어라인(Sel_1)은 로우 레벨이고, 상기 제어라인(Sel_2)은 하이 레벨이며, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2')가 도통되고, 제2열 제1 트랜지스터(T2)가 차단되며; 제1열 데이터라인(D1)의 로우 레벨은 표시구역(40) 내의 제1열 신호라인(D1')상에 전송되며, 제1열 화소 유닛(11, 21, …n1)은 로우 레벨이 인가되며; 제2열 신호라인(D2')은 전원(Vref)에 연결되며, 제2열 화소 유닛(12, 22, …n2)은 데이터 신호 기록 주기(T1) 내의 하이 레벨은 초기화되어 0V가 된다.
t4 시간 내에서, 상기 제어라인(Sel_2)은 로우 레벨이고, 상기 제어라인(Sel_1)은 하이 레벨이며, 제2열 제1 트랜지스터(T2)가 도통되고, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2')가 차단되며; 제1열 데이터라인(D1)의 로우 레벨은 표시구역(40) 내의 제2열 신호라인(D2’)상에 전송되며; t3 시간 내에서, 제2열 화소 유닛(12, 22, …n2)의 전압이 0V로 초기화됨으로써, t4 시간에서, 제2열 화소 유닛(12, 22, …n2)은 제2열 신호라인(D2’)의 유효한 로우 레벨 신호를 수신할 수 있다.
이로써 상기 데이터 구동회로를 응용한 상기 유기 발광 디스플레이 부재는 신호라인과 화소 유닛의 기생 용량의 영향을 받지 않고, 응답이 빠르며 잔상 현상이 발생하지 않고, 디스플레이가 정상적이다.
실시예
2
본 실시예는 데이터 구동회로를 제공하고, 도7에서 나타낸 바와 같이, 구체적인 회로구조는 실시예 1과 같고, 유일한 다른 점은 i가 3이며, 다시 말해서, 각 열 데이터라인의 상기 데이터 드라이버(20)에서 떨어진 일단에 3열의 신호라인이 연결되어 있고, 상기 제어라인은 3행이며, 상기 제2 트랜지스터의 수량은 2m/3개이며, m은 3의 정수배의 0이 아닌 자연수이다.
구체적으로, 제1열 데이터라인(D1)의 데이터 드라이버(20)에서 떨어진 일단에 제1열 신호라인(D1'), 제2열 신호라인(D2’) 및 제3열 신호라인(D3')이 연결되어 있고, 동일하게, 제j열 데이터라인(Dj)의 데이터 드라이버(20)에서 떨어진 일단에 제3j-2열 신호라인(D(3j-2)'), 제3j-1열 신호라인(D(3j-1)') 및 제3j열 신호라인(D(3j)')이 연결되어 있고, j=1, 2, 3, …m/3이며; 제m/3열 데이터라인(D(m/3))의 데이터 드라이버(20)에서 떨어진 일단에 3개의 신호라인, 즉 제m-2열 신호라인(D(m-2)'), 제m-1열 신호라인(D(m-1)’) 및 제m열 신호라인(Dm’)이 연결되어 있다.
각 상기 신호라인(D1’, D2', …D(m-1)', Dm') 중 상기 데이터라인(D(m/3))과 상기 표시구역(40)을 연결하는 구간 내에 제1 트랜지스터(T1, T2, …T(m-1), Tm)가 더 연결되어 있고, 상기 데이터 구동회로는 데이터 드라이버(20)를 연결하는 3행의 제어라인(Sel_1, Sel_2, Sel_3)을 더 포함하며, 상기 제1 트랜지스터(T1, T2, …T(m-1), Tm)는 P형 트랜지스터인 것이 바람직하다.
제1열 데이터라인(D1)에 연결된 3개 제1 트랜지스터(T1, T2, T3)의 게이트 전극은 각각 서로 다른 제어라인(Sel_1, Sel_2, Sel_3)에 전기적으로 연결된다.
마찬가지로, 동일한 상기 데이터라인(Dj)에 연결된 3개 제1 트랜지스터(T(3j-2), T(3j-1), T(3j))의 게이트 전극은 각각 서로 다른 제어라인(Sel_1, Sel_2, Sel_3)에 전기적으로 연결되고, j=1, 2, 3, …m/3이며;
제m/3열 데이터라인D(m/3)에 연결된 3개 제1 트랜지스터(T(m-2), T(m-1), Tm)의 게이트 전극은 각각 제어라인(Sel_1, Sel_2, Sel_3)에 전기적으로 연결된다.
상기 데이터 구동회로는 전원라인(50), 및 상기 전원라인(50)에 연결된 2m/3개 제2 트랜지스터(T2', T3', …T(m-1)', Tm')를 더 포함하고, 상기 전원라인(50)은 전원(Vref)에 연결되는데 사용되며, 상기 전원(Vref)의 전압값은 0V이하이고, 본 실시예에서는 0V인 것이 바람직하다.
다시 말해서, 각 1열의 데이터라인의 데이터 드라이버(20)에서 떨어진 일단에 연결된 3개 신호라인 중, 마지막으로부터 2개의 신호라인과 전원라인(50) 사이에 각각 하나의 제2 트랜지스터를 설치하되, 예를 들어 데이터라인(D1)은 3개 신호라인(D1', D2', D3')과 연결되고, 신호라인(D2’) 및 신호라인(D3')과 전원라인(50) 사이에는 각각 제2 트랜지스터(T2') 및 제2 트랜지스터(T3')가 설치되며, 이와 같이, 데이터라인(D(m/3))은 3개 신호라인(D(m-2)', D(m-1)', Dm')과 연결되고, 신호라인(D(m-1)') 및 신호라인(Dm')과 전원라인(50)사이에는 각각 제2 트랜지스터(T(m-1)') 및 제2 트랜지스터(Tm')가 설치된다.
구체적으로 각 상기 제2 트랜지스터(T2', T3', …T(m-1)', Tm')의 소스 전극은 모두 상기 전원라인(50)에 전기적으로 연결되고, 게이트 전극은 동일한 행의 상기 제어라인(Sel_1)에 전기적으로 연결되며; 제j열 상기 제2 트랜지스터(Tj')의 드레인 전극은 각각 제j열 신호라인(Dj')에 전기적으로 연결되고, 연결점은 제j열 상기 제1 트랜지스터(Tj)와 상기 표시구역(40) 사이에 위치하며, j=2, 3, 5, 6, …, m-1, m이다. 즉, 제2열 제2 트랜지스터(T2')의 소스 전극은 상기 전원라인(50)에 전기적으로 연결되고, 그 드레인 전극은 제2열 신호라인(D2’)에 연결되며, 연결점은 제2열 제1 트랜지스터(T2)와 상기 표시구역(40) 사이에 위치한다.
동일한 상기 신호라인(D2', D3', …D(m-1)', Dm')에 연결되는 상기 제1 트랜지스터(T2, T3, …T(m-1), Tm)와 상기 제2 트랜지스터(T2', T3', …T(m-1)', Tm')의 게이트 전극은 서로 다른 상기 제어라인에 연결된다.
모든 상기 제2 트랜지스터(T2', …Tm')는 채널 극성이 서로 같은 전계효과 트랜지스터이고, 본 실시예에서는 P형 전계효과 트랜지스터인 것이 바람직하다.
본 발명의 다른 실시예로서, 데이터라인은 m/i열일 수 있고, 각 열의 데이터라인 단부에 연결된 신호라인은 i열일 수 있으며, 상기 제어라인은 i행이고, 상기 제2 트랜지스터의 수량은 m(i-1)/i개이며, 다시 말해서 제2 트랜지스터의 수량은 (m-m/i)개이고, i는 2이상의 자연수이며, m은 i의 정수배의 0이 아닌 자연수이며, 모두 본 발명의 목적을 실행할 수 있으며, 본 발명의 보호범위에 속한다.
상기 데이터 구동회로의 구동방법은, 도 5에 나타낸 바와 같이, 각 열의 데이터라인 데이터 신호 기록 주기(Tj, j=1, 2, 3…n)를 3개 시간단계로 나눈다.
t1 시간 내에서, 각 상기 제어라인(Sel_1)은 로우 레벨이고, 상기 제어라인(Sel_2, Sel_3)은 하이 레벨이며, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2'), 제3열 제2 트랜지스터(T3')가 도통되고, 제2열 제1 트랜지스터(T2), 제3열 제1 트랜지스터(T3)가 차단되며;
제1열 신호라인(D1') 상의 데이터 신호는 각각 제1열 화소 유닛(11, 21, …n1)에 로딩되고, 제2열 신호라인(D2’), 제3열 신호라인(D3')은 전원(Vref)에 연결되며, 제2열 화소 유닛(12, 22, …n2) 및 제3열 화소 유닛(13, 23, …n3)의 전압은 0V로 초기화된다.
t2 시간 내에서, 상기 제어라인(Sel_2)은 로우 레벨이고, 상기 제어라인(Sel_1), 상기 제어라인(Sel_3)은 하이 레벨이며, 제2열 제1 트랜지스터(T2)가 도통되고, 제1열 제1 트랜지스터(T1), 제2열 제2 트랜지스터(T2'), 제3열 제1 트랜지스터(T3), 제3열 제2 트랜지스터(T3')가 차단되며;
제1열 데이터라인(D1)의 레벨 신호는 표시구역(40) 내의 제2열 신호라인(D2')에 전송되고, 신호라인(D2') 상의 데이터 신호는 제2열 화소 유닛(12, 22, …n2)에 로딩된다.
t3 시간 내에서, 상기 제어라인(Sel_3)은 로우 레벨이고, 상기 제어라인(Sel_1), 상기 제어라인(Sel_2)은 하이 레벨이며, 제3열 제1 트랜지스터(T3)가 도통되고, 제1열 제1 트랜지스터(T1), 제2열 제1 트랜지스터(T2), 제2열 제2 트랜지스터(T2'), 제3열 제2 트랜지스터(T3')가 차단되며; 제3열 신호라인(D3') 상의 데이터 신호는 각각 제3열 화소 유닛(13, 23, …n3) 상에 로딩된다.
이로써, 다음 열 데이터라인 데이터 신호 기록 주기가 시작되기 전에, 각 열의 신호라인이 위치한 열의 화소 유닛은 초기화되고, 화소 유닛 및 신호라인의 기생 용량의 영향을 받지 않으며, 응답이 빠르고 잔상현상이 존재하지 않으며, 정상적인 디스플레이를 확보할 수 있다.
본 발명은 상술한 데이터 드라이버를 포함하는 유기 발광 디스플레이를 더 제공하고, 여기서 구체적인 구조는 더 서술하지 않겠다. 상기 유기 발광 디스플레이는 화소 유닛 및 신호라인의 기생 용량의 영향을 받지 않으며, 응답이 빠르고 잔상현상이 발생하지 않는다.
위로부터 알 수 있다시피, 상기 실시예는 본 발명을 명확하게 설명하기 위한 것을 목적으로 할 뿐, 실시형태를 한정하는 것이 아니다. 해당 분야의 당업자는 상기 설명에 기초하여 기타 다른 형태의 변화 또는 변동을 실시할 수 있다. 여기서 모든 실시형태에 대해 전부 열거할 필요가 없거니와 열거할 수도 없다. 하지만 이에 근거한 자명한 변화 또는 변동은 여전히 본 발명의 보호 범위에 속한다.
20: 데이터 드라이버
30: 스캔 드라이버
40: 표시구역
50: 전원라인
Vref: 전원
D1: 제1열 데이터라인
D2: 제2열 데이터라인
D(m-1): 제m-1열 데이터라인
Dm: 제m열 데이터라인
D(m/2): 제m/2열 데이터라인
D(m/3): 제m/3열 데이터라인
S1: 제1행 주사라인
S2: 제2행 주사라인
Sn: 제n행 주사라인
D1': 제1열 신호라인
D2': 제2열 신호라인
D(m-1)': 제m-1열 신호라인
Dm': 제m열 신호라인
T1: 제1열 제1 트랜지스터
T2: 제2열 제1 트랜지스터
T(m-1): 제m-1열 제1 트랜지스터
Tm: 제m열 제1 트랜지스터
T2': 제2열 제2 트랜지스터
T3': 제3열 제2 트랜지스터
T(m-1)': 제m-1열 제2 트랜지스터
Tm': 제m열 제2 트랜지스터
Sel_1: 제1행 제어라인
Sel_2: 제2행 제어라인
Sel_3: 제3행 제어라인
11, 12, 13…1(m-2), 1(m-1), 1m, 21, 22, 23…2(m-2), 2(m-1), 2m…n1, n2, n3…n(m-2), n(m-1), nm: 화소 유닛
30: 스캔 드라이버
40: 표시구역
50: 전원라인
Vref: 전원
D1: 제1열 데이터라인
D2: 제2열 데이터라인
D(m-1): 제m-1열 데이터라인
Dm: 제m열 데이터라인
D(m/2): 제m/2열 데이터라인
D(m/3): 제m/3열 데이터라인
S1: 제1행 주사라인
S2: 제2행 주사라인
Sn: 제n행 주사라인
D1': 제1열 신호라인
D2': 제2열 신호라인
D(m-1)': 제m-1열 신호라인
Dm': 제m열 신호라인
T1: 제1열 제1 트랜지스터
T2: 제2열 제1 트랜지스터
T(m-1): 제m-1열 제1 트랜지스터
Tm: 제m열 제1 트랜지스터
T2': 제2열 제2 트랜지스터
T3': 제3열 제2 트랜지스터
T(m-1)': 제m-1열 제2 트랜지스터
Tm': 제m열 제2 트랜지스터
Sel_1: 제1행 제어라인
Sel_2: 제2행 제어라인
Sel_3: 제3행 제어라인
11, 12, 13…1(m-2), 1(m-1), 1m, 21, 22, 23…2(m-2), 2(m-1), 2m…n1, n2, n3…n(m-2), n(m-1), nm: 화소 유닛
Claims (10)
- m/i열 데이터라인을 통해 데이터 드라이버에 전기적으로 연결되고, n행 주사라인을 통해 스캔 드라이버에 전기적으로 연결되며;
각 데이터라인의 데이터 드라이버에서 떨어진 일단에 i열 신호라인이 연결되어 있고, 각 주사라인은 각각 표시구역에 설치된 각 행의 화소 유닛에 전기적으로 연결되며, 각 신호라인은 각각 표시구역에 설치된 각 열의 화소 유닛에 전기적으로 연결되며;
각 신호라인 중 데이터라인과 표시구역을 연결하는 구간 내에 제1 트랜지스터가 더 연결되어 있고, 상기 데이터 구동회로는 데이터 드라이버를 연결하는 i행 제어라인을 더 포함하며;
동일한 데이터라인에 연결되는 i개의 제1 트랜지스터의 게이트 전극은 각각 서로 다른 제어라인에 전기적으로 연결되며;
i는 2이상의 자연수이고, m은 i의 정수배의 0이 아닌 자연수 이며, n은 0이 아닌 자연수인 데이터 구동회로에 있어서,
상기 데이터 구동회로는 전원라인, 및 상기 전원라인에 연결되는 m-m/i개의 제2 트랜지스터를 더 포함하고, 상기 전원라인은 전원에 연결되는데 사용되며,
각 상기 제2 트랜지스터의 소스 전극은 모두 상기 전원라인에 전기적으로 연결되고, 각 상기 제2 트랜지스터의 게이트 전극은 동일한 행의 상기 제어라인에 전기적으로 연결되며; 상기 제2 트랜지스터의 드레인 전극은 각각 서로 다른 상기 신호라인에 전기적으로 연결되며, 연결점은 상기 제1 트랜지스터와 상기 표시구역 사이에 위치하는 것을 특징으로 하는 데이터 구동회로. - 청구항 1에 있어서,
동일한 상기 신호라인에 연결되는 상기 제1 트랜지스터와 상기 제2 트랜지스터의 게이트 전극은 서로 다른 상기 제어라인에 연결되는 것을 특징으로 하는 데이터 구동회로. - 청구항 1에 있어서,
상기 전원의 전압값은 0V이하인 것을 특징으로 하는 데이터 구동회로. - 청구항 1에 있어서,
전부의 상기 제1 트랜지스터는 모두 P형 트랜지스터인 것을 특징으로 하는 데이터 구동회로. - 청구항 1 내지 청구항 4 중 어느 한 항에 있어서,
전부의 상기 제2 트랜지스터는 채널 극성이 서로 같은 전계효과 트랜지스터인 것을 특징으로 하는 데이터 구동회로. - 청구항 5에 있어서,
상기 제2 트랜지스터는 P형 전계효과 트랜지스터인 것을 특징으로 하는 데이터 구동회로. - 청구항 1 내지 청구항 6 중 어느 한 항에 따른 데이터 구동회로의 구동방법에 있어서,
각 열의 상기 데이터라인의 데이터 신호의 기록 주기를 i개의 시간 단계로 나누고; 매 개 상기 시간 단계에서, 각 상기 제어라인을 순차적으로 로우 레벨로 설정하며;
첫번째 상기 시간 단계에서, 로우 레벨의 상기 제어라인에 연결된 제2 트랜지스터가 도통되고, 상기 제2 트랜지스터에 연결된 상기 신호라인은 상기 전원과 도통되며, 그 위치된 열의 각 화소 유닛이 초기화되는 것을 특징으로 하는 구동방법. - 청구항 7에 있어서,
매 개 상기 시간 단계에서, 로우 레벨의 상기 제어라인에 연결된 제1 트랜지스터가 도통되고, 상기 제1 트랜지스터에 연결된 상기 신호라인은 상기 데이터라인과 도통되며, 그 위치된 열의 각 화소 유닛에 데이터 신호가 기록되는 것을 특징으로 하는 구동방법. - 청구항 7에 있어서,
상기 초기화 전압값은 0V이하인 것을 특징으로 하는 구동방법. - 청구항 1 내지 청구항 6 중 어느 한 항에 따른 데이터 구동회로를 포함하는, 유기 발광 디스플레이.
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