JPS6336547A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS6336547A JPS6336547A JP17884386A JP17884386A JPS6336547A JP S6336547 A JPS6336547 A JP S6336547A JP 17884386 A JP17884386 A JP 17884386A JP 17884386 A JP17884386 A JP 17884386A JP S6336547 A JPS6336547 A JP S6336547A
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- Pending
Links
- 238000004519 manufacturing process Methods 0.000 title claims description 8
- 239000004065 semiconductor Substances 0.000 title claims description 7
- 229920001721 polyimide Polymers 0.000 claims abstract description 17
- 229910052710 silicon Inorganic materials 0.000 claims abstract description 17
- 239000010703 silicon Substances 0.000 claims abstract description 17
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims abstract description 16
- 239000011229 interlayer Substances 0.000 claims abstract description 16
- 239000010936 titanium Substances 0.000 claims abstract description 16
- 229910052719 titanium Inorganic materials 0.000 claims abstract description 16
- 239000000463 material Substances 0.000 claims abstract description 12
- 238000000034 method Methods 0.000 claims abstract description 11
- 239000009719 polyimide resin Substances 0.000 claims abstract description 11
- 238000001020 plasma etching Methods 0.000 claims abstract description 7
- 238000004544 sputter deposition Methods 0.000 claims abstract description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 14
- 238000009413 insulation Methods 0.000 claims description 4
- 238000000151 deposition Methods 0.000 claims description 2
- 238000005516 engineering process Methods 0.000 claims description 2
- 238000010438 heat treatment Methods 0.000 claims 1
- 238000000059 patterning Methods 0.000 claims 1
- 238000000206 photolithography Methods 0.000 claims 1
- 238000005530 etching Methods 0.000 abstract description 18
- 229920002120 photoresistant polymer Polymers 0.000 abstract description 6
- 239000010410 layer Substances 0.000 abstract description 5
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 10
- 229910052782 aluminium Inorganic materials 0.000 description 10
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 5
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 2
- 230000007547 defect Effects 0.000 description 2
- 229910052750 molybdenum Inorganic materials 0.000 description 2
- 239000011733 molybdenum Substances 0.000 description 2
- 239000000377 silicon dioxide Substances 0.000 description 2
- 239000000758 substrate Substances 0.000 description 2
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 2
- 229910052721 tungsten Inorganic materials 0.000 description 2
- 239000010937 tungsten Substances 0.000 description 2
- 239000004642 Polyimide Substances 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 229910052681 coesite Inorganic materials 0.000 description 1
- 229910052906 cristobalite Inorganic materials 0.000 description 1
- 235000012239 silicon dioxide Nutrition 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 229910052682 stishovite Inorganic materials 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 229910052905 tridymite Inorganic materials 0.000 description 1
Landscapes
- Drying Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
C産業上の利用分野〕
本発明は半導体装置の製造方法に関し、特に眉間膜とし
てシリコン含有ポリイミド系樹脂を使用した多層配線に
おけるスルーホールの形成方法に関する。
てシリコン含有ポリイミド系樹脂を使用した多層配線に
おけるスルーホールの形成方法に関する。
近年の半導体装置のa細化、高集積化に伴って多層配線
構造が多用されている。この多層配線構造は、下層配線
の上に層間絶縁膜を形成し、この上に上層配線を形成し
ており、上、下の配線は層間絶縁膜に形成したスルーホ
ールを通して相互に電気接続を行っている。この層間絶
縁膜には種々の材質が使用されてきたが、最近ではポリ
イミド系樹脂膜も利用されている。
構造が多用されている。この多層配線構造は、下層配線
の上に層間絶縁膜を形成し、この上に上層配線を形成し
ており、上、下の配線は層間絶縁膜に形成したスルーホ
ールを通して相互に電気接続を行っている。この層間絶
縁膜には種々の材質が使用されてきたが、最近ではポリ
イミド系樹脂膜も利用されている。
従来、このポリイミド系樹脂を層間絶縁膜に使用する場
合、これにスルーホールを開設するためのエツチングマ
スクとしては、シリカフィルム。
合、これにスルーホールを開設するためのエツチングマ
スクとしては、シリカフィルム。
アルミニウム膜等が用いられている。しかし、シリコン
含有ポリイミド系樹脂膜は、エツチングガスとしてOt
にF系のものを混合するので、SiO2系の材料は使用
することができず、したがってこれまではアルミニウム
が用いられている。
含有ポリイミド系樹脂膜は、エツチングガスとしてOt
にF系のものを混合するので、SiO2系の材料は使用
することができず、したがってこれまではアルミニウム
が用いられている。
上述した従来のエツチング方法では、マスク材としてア
ルミニウムを用いてシリコン含有ポリイミド系樹脂膜の
エツチングを行うと、アルミニウムは02ガスでもF系
ガスでも揮発性のない物質であるため、エツチング中に
スパッタされ、このスパッタされたアルミニウムがエツ
チング面に再付着するという問題が生じる。このため、
エツチングの進行が阻害され、良好なエツチングが困難
になる。
ルミニウムを用いてシリコン含有ポリイミド系樹脂膜の
エツチングを行うと、アルミニウムは02ガスでもF系
ガスでも揮発性のない物質であるため、エツチング中に
スパッタされ、このスパッタされたアルミニウムがエツ
チング面に再付着するという問題が生じる。このため、
エツチングの進行が阻害され、良好なエツチングが困難
になる。
また、アルミニウムに代えて、タングステン。
モリブデン等の材料をマスクに使用することが考えられ
ているが、この種の材料はF系によるエツチングスピー
ドが大きく、エツチングの進行とともにマスク形状が損
傷され、良好なパターンのエツチングが行われなくなる
という問題もある。
ているが、この種の材料はF系によるエツチングスピー
ドが大きく、エツチングの進行とともにマスク形状が損
傷され、良好なパターンのエツチングが行われなくなる
という問題もある。
本発明の半導体装置の製造方法は、エツチング面への再
付着や残渣の発生を防止するとともに良好なパターン形
状のスルーホールを開設することを可能とするものであ
る。
付着や残渣の発生を防止するとともに良好なパターン形
状のスルーホールを開設することを可能とするものであ
る。
本発明の半導体装置の製造方法は、多層配線構造の層間
絶縁膜にシリコン含有ポリイミド系樹脂を用い、この層
間絶縁膜に02ガスとF系のガスの混合ガスを用いたリ
アクティブイオンエッチング(RIE)法でスルーホー
ルを開設する際に、マスク材にチタン膜を用いることを
特徴としている。
絶縁膜にシリコン含有ポリイミド系樹脂を用い、この層
間絶縁膜に02ガスとF系のガスの混合ガスを用いたリ
アクティブイオンエッチング(RIE)法でスルーホー
ルを開設する際に、マスク材にチタン膜を用いることを
特徴としている。
−〔実施例〕
次に、本発明を図面を参照して説明する。
第1図乃至第5図は本発明の一実施例を製造工程順に示
す断面図である。
す断面図である。
先ず、第1図のように、シリコン基板1上に設けたシリ
コン酸化膜等の絶縁膜2上にアルミニウム膜を形成し、
かつこれを図外のフォトレジストを用いた選択エツチン
グ法によってパターニングし、下層のアルミニウム配線
3を形成する。
コン酸化膜等の絶縁膜2上にアルミニウム膜を形成し、
かつこれを図外のフォトレジストを用いた選択エツチン
グ法によってパターニングし、下層のアルミニウム配線
3を形成する。
次いで、第2図のように層間絶縁膜としてのシリコン含
有ポリイミド膜4を1μm程度の厚さに塗布し、熱処理
を行う。
有ポリイミド膜4を1μm程度の厚さに塗布し、熱処理
を行う。
次いで、第3図のように前記シリコン含有ポリイミド膜
4の上に3000人程度0チタン膜5をスパッタ法によ
り堆積する。
4の上に3000人程度0チタン膜5をスパッタ法によ
り堆積する。
そして、第4図のように、前記チタン膜5上にフォトレ
ジスト膜6を形成し、かつこれを露光。
ジスト膜6を形成し、かつこれを露光。
現像処理してスルーホール形成箇所に窓6aを開設する
。そして、このフォトレジスト膜6をマスクにして前記
チタン膜5を選択エツチングしてバターニングする。
。そして、このフォトレジスト膜6をマスクにして前記
チタン膜5を選択エツチングしてバターニングする。
その後、第5図のように、前記チタン膜3をマスクにし
てoz +SF&ガスを用いたRIE法により前記シリ
コン含有ポリイミド膜4のエツチングを行い、前記アル
ミニウム配線3に達するスルーホール7を開設する。
てoz +SF&ガスを用いたRIE法により前記シリ
コン含有ポリイミド膜4のエツチングを行い、前記アル
ミニウム配線3に達するスルーホール7を開設する。
しかる上で、図示を省略する上層の配線を形成し、この
スルーホール7を通して上、下の配線を相互に電気接続
することは言うまでもない。
スルーホール7を通して上、下の配線を相互に電気接続
することは言うまでもない。
したがって、この方法によれば、チタン膜5をマスクに
してシリコン含有ポリイミド膜4をエツチングしている
ので、このチタン膜5はエツチング時に多少エツチング
されて揮発され、エツチング面に再付着することはない
。また、タングステンやモリブデンに比較してエツチン
グスピードが小さいので十分にマスクとして機能でき、
マスク形状の損傷によるエツチングパターンの不良が防
止できる。これにより、層間絶縁膜へのスルーホールの
開設において、残渣等によるエツチング不良を防止でき
るとともに良好なパターン形状の工゛ツチングを実現で
きる。
してシリコン含有ポリイミド膜4をエツチングしている
ので、このチタン膜5はエツチング時に多少エツチング
されて揮発され、エツチング面に再付着することはない
。また、タングステンやモリブデンに比較してエツチン
グスピードが小さいので十分にマスクとして機能でき、
マスク形状の損傷によるエツチングパターンの不良が防
止できる。これにより、層間絶縁膜へのスルーホールの
開設において、残渣等によるエツチング不良を防止でき
るとともに良好なパターン形状の工゛ツチングを実現で
きる。
以上説明したように本発明は、多層配線における層間絶
縁膜としてシリコン含有ポリイミド系樹脂を用いる場合
に、この層間絶縁膜に開設するスルーホールのエツチン
グのマスク材としてチタン膜を用いているので、マスク
としての機能を十分に備えるとともに、再付着、残渣の
ない良好なエツチングを行うことができる。
縁膜としてシリコン含有ポリイミド系樹脂を用いる場合
に、この層間絶縁膜に開設するスルーホールのエツチン
グのマスク材としてチタン膜を用いているので、マスク
としての機能を十分に備えるとともに、再付着、残渣の
ない良好なエツチングを行うことができる。
第1図乃至第5図は本発明の一実施例を製造工程順に示
す断面図である。 1・・・シリコン基板、2・・・絶縁膜、3・・・アル
ミニウム配線、4・・・シリコン含有ポリイミド、5・
・・チタン膜、6・・・フォトレジスト膜、7・・・ス
ルーホール。
す断面図である。 1・・・シリコン基板、2・・・絶縁膜、3・・・アル
ミニウム配線、4・・・シリコン含有ポリイミド、5・
・・チタン膜、6・・・フォトレジスト膜、7・・・ス
ルーホール。
Claims (2)
- (1)多層配線構造の層間絶縁膜にシリコン含有ポリイ
ミド系樹脂を用い、この層間絶縁膜にO_2ガスとF系
のガスの混合ガスを用いたリアクティブイオンエッチン
グ法でスルーホールを開設する際に、マスク材にチタン
膜を用いることを特徴とする半導体装置の製造方法。 - (2)未効果のシリコン含有ポリイミド系樹脂を塗布し
かつこれを加熱硬化した上に、チタン膜をスパッタ法で
被着し、これをフォトリソグラフィ技術でパターニング
してマスクを形成してなる特許請求の範囲第1項記載の
半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17884386A JPS6336547A (ja) | 1986-07-31 | 1986-07-31 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17884386A JPS6336547A (ja) | 1986-07-31 | 1986-07-31 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6336547A true JPS6336547A (ja) | 1988-02-17 |
Family
ID=16055638
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17884386A Pending JPS6336547A (ja) | 1986-07-31 | 1986-07-31 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6336547A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5176792A (en) * | 1991-10-28 | 1993-01-05 | At&T Bell Laboratories | Method for forming patterned tungsten layers |
US5913148A (en) * | 1989-09-08 | 1999-06-15 | Lucent Technologies Inc | Reduced size etching method for integrated circuits |
-
1986
- 1986-07-31 JP JP17884386A patent/JPS6336547A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5913148A (en) * | 1989-09-08 | 1999-06-15 | Lucent Technologies Inc | Reduced size etching method for integrated circuits |
US5176792A (en) * | 1991-10-28 | 1993-01-05 | At&T Bell Laboratories | Method for forming patterned tungsten layers |
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