JPS63220695A - 時分割回線交換機における半固定回線収容方式 - Google Patents
時分割回線交換機における半固定回線収容方式Info
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- JPS63220695A JPS63220695A JP5462087A JP5462087A JPS63220695A JP S63220695 A JPS63220695 A JP S63220695A JP 5462087 A JP5462087 A JP 5462087A JP 5462087 A JP5462087 A JP 5462087A JP S63220695 A JPS63220695 A JP S63220695A
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- JP
- Japan
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- memory
- control
- semi
- fixed line
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- Pending
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- 230000015654 memory Effects 0.000 claims abstract description 69
- 238000000034 method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000004308 accommodation Effects 0.000 description 1
Landscapes
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は時分割回線交換機に関し、特に時分割回線交換
機内に半固定接続の回線を収容する方式〔従来の技術〕 従来、時分割交換機に半固定回線を収容する場合、時分
割通話路スイッチの制御メモリに対し、交換機の初期設
定時あるいは、手動による半固定回線の設定時に呼制御
装置から半固定回線の接続データを時分割通話路スイッ
チの制御メモリに書込み、この接続データをタイムスロ
ットごとに読出して通話路メモリを制御している。した
がって制御メモリのデータが書換えられない限り、同じ
入線は同じ出線と接続されて通信データが転送される。
機内に半固定接続の回線を収容する方式〔従来の技術〕 従来、時分割交換機に半固定回線を収容する場合、時分
割通話路スイッチの制御メモリに対し、交換機の初期設
定時あるいは、手動による半固定回線の設定時に呼制御
装置から半固定回線の接続データを時分割通話路スイッ
チの制御メモリに書込み、この接続データをタイムスロ
ットごとに読出して通話路メモリを制御している。した
がって制御メモリのデータが書換えられない限り、同じ
入線は同じ出線と接続されて通信データが転送される。
上述した従来の半固定回線収容方式は、交換機の初期設
定時あるいは手動による半固定回線の設定時に呼制御装
置から半固定回線の接続データを設定する方式となって
いるので、呼制御装置のプログラムに半固定回線制御の
プログラムを組み込む必要がある。また、通話路中に含
まれる共通線信号回線や長期間接続の重要回線などは上
記のような接続データの設定において呼制御装置が正常
に動作して制御メモリに必要なデータが書込まれるまで
、待たねばならない、特に呼制御装置の障害時には半固
定回線の復旧接続に時間がかかるという欠点がある。
定時あるいは手動による半固定回線の設定時に呼制御装
置から半固定回線の接続データを設定する方式となって
いるので、呼制御装置のプログラムに半固定回線制御の
プログラムを組み込む必要がある。また、通話路中に含
まれる共通線信号回線や長期間接続の重要回線などは上
記のような接続データの設定において呼制御装置が正常
に動作して制御メモリに必要なデータが書込まれるまで
、待たねばならない、特に呼制御装置の障害時には半固
定回線の復旧接続に時間がかかるという欠点がある。
したがって本発明が解決しようとする問題点、換言すれ
ば本発明の目的は半固定回線の設定手段を独立に設ける
ことによって上記の問題点を改善することにある。
ば本発明の目的は半固定回線の設定手段を独立に設ける
ことによって上記の問題点を改善することにある。
本発明の時分割回線交換機における半固定回線収容方式
は、呼制御装置によって呼ごとに書換えられる通話路の
接続データを格納する第1の制御メモリと、前記第一の
制御メモリより1ビット多いビット幅を有して半固定的
な通話路の接続データおよび制御信号を格納する第2の
制御メモリと、前記第2の制御メモリに接続データおよ
び制御信号を設定するための半固定回線制御装置と、前
記第2の制御メモリの制御信号に従って前記第1の制御
メモリの接続データまたは前記第2の制御メモリの接続
データのいずれが一方を選択する選択回路とを有し、前
記選択回路の出力にょって時分割スイッチの通話路メモ
リのデータ読み出しアドレスを与え、前記半固定回線制
御装置が指示した回線を半固定回線として時分割回線交
換機に収容するようにして構成される。
は、呼制御装置によって呼ごとに書換えられる通話路の
接続データを格納する第1の制御メモリと、前記第一の
制御メモリより1ビット多いビット幅を有して半固定的
な通話路の接続データおよび制御信号を格納する第2の
制御メモリと、前記第2の制御メモリに接続データおよ
び制御信号を設定するための半固定回線制御装置と、前
記第2の制御メモリの制御信号に従って前記第1の制御
メモリの接続データまたは前記第2の制御メモリの接続
データのいずれが一方を選択する選択回路とを有し、前
記選択回路の出力にょって時分割スイッチの通話路メモ
リのデータ読み出しアドレスを与え、前記半固定回線制
御装置が指示した回線を半固定回線として時分割回線交
換機に収容するようにして構成される。
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例のブロック図である。
同図において時分割回線交換機の時分割通話路スイッチ
は2チヤネルの入ハイウェイ9と出ハイウェイ10とに
接続されたシーケンシャル書込みランダム読出しの通話
路メモリ1と、この通話路メモリ]に選択回路2を介し
て通話路メモリ1の読出しアドレスを与える第1の制御
メモリ3および第2の制御メモリ4と、クロック信号に
もとづき通話路メモリ1の書込アドレスや上記の制御メ
モリ3および4の読出しアドレスを発生するカウンタ5
と、第2の制御メモリ4に接続された半固定回線制御装
置7およびマンマシンインタフェース8とを有して構成
され、さらに第1の制御メモリ3に呼制御装置6が接続
されている。
は2チヤネルの入ハイウェイ9と出ハイウェイ10とに
接続されたシーケンシャル書込みランダム読出しの通話
路メモリ1と、この通話路メモリ]に選択回路2を介し
て通話路メモリ1の読出しアドレスを与える第1の制御
メモリ3および第2の制御メモリ4と、クロック信号に
もとづき通話路メモリ1の書込アドレスや上記の制御メ
モリ3および4の読出しアドレスを発生するカウンタ5
と、第2の制御メモリ4に接続された半固定回線制御装
置7およびマンマシンインタフェース8とを有して構成
され、さらに第1の制御メモリ3に呼制御装置6が接続
されている。
通話路メモリ1は通常の例えば読出し側制御の通話路メ
モリて2″のチャネルを持つ。また第1の制御メモリ3
は通常のnビット幅2アドレスの保持メモリである。さ
らに第2の制御メモリ4はn+1ビット幅2′″アドレ
スの保持メモリであり、半固定的に接続を行なう出チャ
ネルに対応するアドレスの下位nピッI〜に通常の制御
メモリドと同じくタイムスロツ1〜を入替える通話メモ
リのアドレスを記憶し、上位1ビツトにはその出チャネ
ルにおいて第1の制御メモリ3の出力にもとづいて通話
路接続を行なう場合には” o ’を、第2の制御メモ
リ4の出力にもとづいて通話路接続を行なう場合には“
1゛°を記憶する。
モリて2″のチャネルを持つ。また第1の制御メモリ3
は通常のnビット幅2アドレスの保持メモリである。さ
らに第2の制御メモリ4はn+1ビット幅2′″アドレ
スの保持メモリであり、半固定的に接続を行なう出チャ
ネルに対応するアドレスの下位nピッI〜に通常の制御
メモリドと同じくタイムスロツ1〜を入替える通話メモ
リのアドレスを記憶し、上位1ビツトにはその出チャネ
ルにおいて第1の制御メモリ3の出力にもとづいて通話
路接続を行なう場合には” o ’を、第2の制御メモ
リ4の出力にもとづいて通話路接続を行なう場合には“
1゛°を記憶する。
選択回路2は第2の制御メモリ4がらの読出しデータの
上位1ビツトが1″であると第2の制御メモリ4からの
読出しデータを通話路メモリ1に送り、」1位1ビット
がo″であると第1の制御メモリ3からの読出しデータ
を通話路メモリ]に送る。
上位1ビツトが1″であると第2の制御メモリ4からの
読出しデータを通話路メモリ1に送り、」1位1ビット
がo″であると第1の制御メモリ3からの読出しデータ
を通話路メモリ]に送る。
第2の制御メモリ4が保持するデータはマンマシンイン
タフェース8および半固定回線制御装置7によって呼制
御装W6を使用することなく書込まれる。
タフェース8および半固定回線制御装置7によって呼制
御装W6を使用することなく書込まれる。
したがってマンマシンインタフェース8および半固定回
線制御装置7によって第2の制御メモリ4に半固定的な
接続を要する通話路メモリ1のアドレスと上位1ビツト
に“′1″′とを記憶させ、第1の制御メモリ3には通
常の呼に対応する通話路メモリ1のアドレスのみを呼制
御装置6によって格納することにより、第1の制御メモ
リ3まなは第2の制御メモリ4がら続出された通話路メ
モリ1のアドレスによって必要なすべての通話路が設定
される。
線制御装置7によって第2の制御メモリ4に半固定的な
接続を要する通話路メモリ1のアドレスと上位1ビツト
に“′1″′とを記憶させ、第1の制御メモリ3には通
常の呼に対応する通話路メモリ1のアドレスのみを呼制
御装置6によって格納することにより、第1の制御メモ
リ3まなは第2の制御メモリ4がら続出された通話路メ
モリ1のアドレスによって必要なすべての通話路が設定
される。
また第1の制御メモリ3の内容が記憶されない、すなわ
ち呼制御装置6が動作していない時でも、カウンタ5が
正常に動作すれば第2の制御メモリ4を介して半固定の
通話路の接続は確保される。
ち呼制御装置6が動作していない時でも、カウンタ5が
正常に動作すれば第2の制御メモリ4を介して半固定の
通話路の接続は確保される。
以上説明したように本発明は時分割回線交換機において
呼制御装置の呼処理プログラムから独立した半固定回線
制御装置によって特定の通話路が設定できるので、交換
機自身のプログラム格納を遠隔地から特定の通話路を介
して実行したり、共通線信号用の通話路の設定・変更、
長期間接続の重要回線の通話路設定などが呼処理プログ
ラムから独立して実行できる効果がある。
呼制御装置の呼処理プログラムから独立した半固定回線
制御装置によって特定の通話路が設定できるので、交換
機自身のプログラム格納を遠隔地から特定の通話路を介
して実行したり、共通線信号用の通話路の設定・変更、
長期間接続の重要回線の通話路設定などが呼処理プログ
ラムから独立して実行できる効果がある。
第1゜図は本発明の一実施例のブロック図である。
1・・・通話路メモリ、2・・・選択回路、3・・第1
の制御メモリ、4・・・第2の制御メモリ、5山カウン
タ、6・・・呼制御装置、7・・・半固定回線制御装置
、8・・・マンマシンインタフェース、9・・・入ハイ
ウェイ、10・・・出ハイウェイ。
の制御メモリ、4・・・第2の制御メモリ、5山カウン
タ、6・・・呼制御装置、7・・・半固定回線制御装置
、8・・・マンマシンインタフェース、9・・・入ハイ
ウェイ、10・・・出ハイウェイ。
Claims (1)
- 【特許請求の範囲】 呼制御装置によって呼ごとに書換えられる通話路の接続
データを格納する第1の制御メモリと、前記第一の制御
メモリより1ビット多いビット幅を有して半固定的な通
話路の接続データおよび制御信号を格納する第2の制御
メモリと、前記第2の制御メモリに接続データおよび制
御信号を設定するための半固定回線制御装置と、前記第
2の制御メモリの制御信号に従って前記第1の制御メモ
リの接続データまたは前記第2の制御メモリの接続デー
タのいずれか一方を選択する選択回路とを有し、 前記選択回路の出力によって時分割スイッチの通話路メ
モリのデータ読み出しアドレスを与え、前記半固定回線
制御装置が指示した回線を半固定回線として時分割回線
交換機に収容することを特徴とする半固定回線収容方式
。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5462087A JPS63220695A (ja) | 1987-03-09 | 1987-03-09 | 時分割回線交換機における半固定回線収容方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5462087A JPS63220695A (ja) | 1987-03-09 | 1987-03-09 | 時分割回線交換機における半固定回線収容方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63220695A true JPS63220695A (ja) | 1988-09-13 |
Family
ID=12975781
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5462087A Pending JPS63220695A (ja) | 1987-03-09 | 1987-03-09 | 時分割回線交換機における半固定回線収容方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63220695A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0738929A (ja) * | 1993-06-28 | 1995-02-07 | Nec Corp | 時間スイッチ装置 |
JPH0759183A (ja) * | 1993-08-13 | 1995-03-03 | Oki Electric Ind Co Ltd | 時分割時間スイッチの制御方式 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5979697A (ja) * | 1982-10-27 | 1984-05-08 | Fujitsu Ltd | 通話路メモリ制御方式 |
JPS60257699A (ja) * | 1984-06-04 | 1985-12-19 | Hitachi Ltd | 時分割スイツチ制御装置 |
-
1987
- 1987-03-09 JP JP5462087A patent/JPS63220695A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5979697A (ja) * | 1982-10-27 | 1984-05-08 | Fujitsu Ltd | 通話路メモリ制御方式 |
JPS60257699A (ja) * | 1984-06-04 | 1985-12-19 | Hitachi Ltd | 時分割スイツチ制御装置 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0738929A (ja) * | 1993-06-28 | 1995-02-07 | Nec Corp | 時間スイッチ装置 |
JPH0759183A (ja) * | 1993-08-13 | 1995-03-03 | Oki Electric Ind Co Ltd | 時分割時間スイッチの制御方式 |
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