JPS63142408A - 電圧監視回路 - Google Patents
電圧監視回路Info
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- JPS63142408A JPS63142408A JP61288802A JP28880286A JPS63142408A JP S63142408 A JPS63142408 A JP S63142408A JP 61288802 A JP61288802 A JP 61288802A JP 28880286 A JP28880286 A JP 28880286A JP S63142408 A JPS63142408 A JP S63142408A
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- 230000007257 malfunction Effects 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 4
- 230000006378 damage Effects 0.000 description 3
- 230000014759 maintenance of location Effects 0.000 description 3
- 238000001514 detection method Methods 0.000 description 2
- 240000008168 Ficus benjamina Species 0.000 description 1
- 102100030551 Protein MEMO1 Human genes 0.000 description 1
- 101710176845 Protein MEMO1 Proteins 0.000 description 1
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- Power Sources (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Stand-By Power Supply Arrangements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、メモリバックアップシステムに用いる電圧監
視回路に係り、特に、メモリの情報破壊を防止するに好
適な電圧監視回路に関する。
視回路に係り、特に、メモリの情報破壊を防止するに好
適な電圧監視回路に関する。
この種電圧監視回路に関する従来技術として、例えば、
ＴＩ半導体技術資料肩４０、検出電圧可変型電圧監視用
ＩＣＴＬ７７００（昭和５８年１０月１０日）に記載さ
れた電圧監視用ＩＣが知られている。この電圧監視用Ｉ
Ｃは、基準電圧源とコンパレータによる電圧検出回路と
、タイミング発生回路と、オープンコレクタ回路による
出力ドライブ回路により構成されている。
ＴＩ半導体技術資料肩４０、検出電圧可変型電圧監視用
ＩＣＴＬ７７００（昭和５８年１０月１０日）に記載さ
れた電圧監視用ＩＣが知られている。この電圧監視用Ｉ
Ｃは、基準電圧源とコンパレータによる電圧検出回路と
、タイミング発生回路と、オープンコレクタ回路による
出力ドライブ回路により構成されている。
前記従来技術における電圧監視用ＩＣは、該ＩＣに印加
される電源電圧が立上るとき、および立下るときにおけ
る出力状態の安定化についての配慮がなされておらず、
内部の基準電圧源が安定化しない、電源電圧がＯＶ〜１
．５ｖの間にあるときに、回路が不安定となって、出力
に１ｖ程度の電圧値を持つノイズを発生するという問題
点がある。そして、このような電圧監視用ＩＣの出力を
、メモリのチップセレクト入力の制御のための論理回路
に直接印加すると、このノイズによりメモリの情報を破
壊する場合が生じるという問題点がある。
される電源電圧が立上るとき、および立下るときにおけ
る出力状態の安定化についての配慮がなされておらず、
内部の基準電圧源が安定化しない、電源電圧がＯＶ〜１
．５ｖの間にあるときに、回路が不安定となって、出力
に１ｖ程度の電圧値を持つノイズを発生するという問題
点がある。そして、このような電圧監視用ＩＣの出力を
、メモリのチップセレクト入力の制御のための論理回路
に直接印加すると、このノイズによりメモリの情報を破
壊する場合が生じるという問題点がある。
本発明の目的は、前記電源電圧の立上り、立下り時の電
圧監視用ＩＣの動作が不安定な期間においても、出力に
ノイズを発生させることのない電圧監視回路を提供する
ことにある。
圧監視用ＩＣの動作が不安定な期間においても、出力に
ノイズを発生させることのない電圧監視回路を提供する
ことにある。
本発明によれば、前記目的は、従来技術による電圧監視
用ＩＣの出力に、エミッタフォロアで動作するトランジ
スタと、ノベルシフトダイオードと、バイアス抵抗とに
よるレベルシフト出力回路を接続し、前記電圧監視用Ｉ
Ｃの出力に、発生するノイズ電圧よりも大きなレベルシ
フトを与えることにより達成される。
用ＩＣの出力に、エミッタフォロアで動作するトランジ
スタと、ノベルシフトダイオードと、バイアス抵抗とに
よるレベルシフト出力回路を接続し、前記電圧監視用Ｉ
Ｃの出力に、発生するノイズ電圧よりも大きなレベルシ
フトを与えることにより達成される。
従来技術による電圧監視用ＩＣに接続されるエミッタフ
ォロア動作のトランジスタは、レベルシフトダイオード
を介してバイアス抵抗に接続されている。本発明による
電圧監視回路の出力は、前記レベルシフトダイオードと
バイアス抵抗との接読点から取出されており、従来技術
による電圧監視用ＩＣの動作に追従して動作しようとす
る。しかし、この電圧監視用ＩＣが不安定なときに発生
するノイズ電圧は、エミッタフォロア動作のトランジス
タのペース・エミッタ電圧ＶＢ！＋とレベルシフトダイ
オードのフォワード電圧Ｖｙとの和、約１．５Ｖより低
いため、このノイズ電圧は、出力に伝達されない。これ
により、本発明による電圧監視回路は、電源電圧の立上
り、立下り時にノイズを発生することがなくなり、次段
以降に接続される論理回路を誤動作させる等の影響を与
えない。
ォロア動作のトランジスタは、レベルシフトダイオード
を介してバイアス抵抗に接続されている。本発明による
電圧監視回路の出力は、前記レベルシフトダイオードと
バイアス抵抗との接読点から取出されており、従来技術
による電圧監視用ＩＣの動作に追従して動作しようとす
る。しかし、この電圧監視用ＩＣが不安定なときに発生
するノイズ電圧は、エミッタフォロア動作のトランジス
タのペース・エミッタ電圧ＶＢ！＋とレベルシフトダイ
オードのフォワード電圧Ｖｙとの和、約１．５Ｖより低
いため、このノイズ電圧は、出力に伝達されない。これ
により、本発明による電圧監視回路は、電源電圧の立上
り、立下り時にノイズを発生することがなくなり、次段
以降に接続される論理回路を誤動作させる等の影響を与
えない。
以下、本発明の一実施例を図面により詳細に説明する。
第１図は本発明による電圧監視回路をメモリバッテリバ
ックアップシステムに適用した一実施例のプ臥ツク図、
第２図はその動作波形図である。
ックアップシステムに適用した一実施例のプ臥ツク図、
第２図はその動作波形図である。
第１図において、１はメイン電源給電線、２は電圧監視
用ＩＣ，３は接地線、４，１０はプルアップ抵抗、５は
トランジスタ、６はレベルシフトダイオード、７はバイ
アス抵抗、８は論理入力信号ビン、９はＮＡＮＤゲート
、１１は電源切換回路、１２は補助電源、１３はメモリ
である。
用ＩＣ，３は接地線、４，１０はプルアップ抵抗、５は
トランジスタ、６はレベルシフトダイオード、７はバイ
アス抵抗、８は論理入力信号ビン、９はＮＡＮＤゲート
、１１は電源切換回路、１２は補助電源、１３はメモリ
である。
第１図に示す実施例において、メイン電源給電線１は、
電圧監視用ＩＣ２、プルアップ抵抗４、エミッタフォロ
ア動作のトランジスタ５のコレクタおよび電源切換回路
１１に接続される。電圧監視用ＩＣ２の出力は、プルア
ップ抵抗４とトランジスタ５のベースに接続され、トラ
ンジスタ５のエミッタは、レベルシフトダイオード６の
アノードに接続される。レベルシフトダイオード６のカ
ソードは、バイアス抵抗７とＮＡＮＤゲート９の一方の
入力に接続される。ＮＡＮＤゲート９の他方の入力は、
論理入力信号ビン８に接続される。
電圧監視用ＩＣ２、プルアップ抵抗４、エミッタフォロ
ア動作のトランジスタ５のコレクタおよび電源切換回路
１１に接続される。電圧監視用ＩＣ２の出力は、プルア
ップ抵抗４とトランジスタ５のベースに接続され、トラ
ンジスタ５のエミッタは、レベルシフトダイオード６の
アノードに接続される。レベルシフトダイオード６のカ
ソードは、バイアス抵抗７とＮＡＮＤゲート９の一方の
入力に接続される。ＮＡＮＤゲート９の他方の入力は、
論理入力信号ビン８に接続される。
ＮＡＮＤゲート９の出力は、プルアップ抵抗１０とメモ
リ１３のチップセレクト人力Ｃ８に接続される。また、
補助電源１２とメイン電源給電線１に接続される電源切
換回路１１の出力は、メモリ１３の電源ビン、プルアッ
プ抵抗１０、ＮＡＮＤゲート９の電源ピンに接続される
。接地線３は、電源監視用ＩＣ２、ＮＡＮＤゲート９の
グランドビン、メモリ１３のグランドビンおよびバイア
ス抵抗７に接続される。
リ１３のチップセレクト人力Ｃ８に接続される。また、
補助電源１２とメイン電源給電線１に接続される電源切
換回路１１の出力は、メモリ１３の電源ビン、プルアッ
プ抵抗１０、ＮＡＮＤゲート９の電源ピンに接続される
。接地線３は、電源監視用ＩＣ２、ＮＡＮＤゲート９の
グランドビン、メモリ１３のグランドビンおよびバイア
ス抵抗７に接続される。
次に、第２図に示す動作波形を参照して、第１図に示す
本発明の一実施例の動作を説明する。
本発明の一実施例の動作を説明する。
′ｒＩＬ源切換回路１１は、メイン電源給′成線１にメ
イン電源が印加されていない場合、メイン電源が印加さ
れ、七゛の電圧値が予備電源１２の電圧ＶＤに立上るま
での間、およびメイン電源がオフとされ、その電圧値が
予備電源】２の電圧ＶＤ以下となった場合に、予備ｒｌ
！源１２の電圧ＶＤを、メイン電源線１の電圧値が予備
電源１２の電圧Ｖｕ以上となっている場合に１ メイン
電源給゛ｔｔｌ ＃ｉ！１の電圧をメモリ１３とＮＡＮ
Ｄゲート９の電源ピンに印加するようＫ［源の切換えを
行っている。この結果、メモリ１３とＮＡＮＤゲート９
の電源ピンに印加される電圧波形は、第２図に０部波形
として示されるような波形となる。
イン電源が印加されていない場合、メイン電源が印加さ
れ、七゛の電圧値が予備電源１２の電圧ＶＤに立上るま
での間、およびメイン電源がオフとされ、その電圧値が
予備電源】２の電圧ＶＤ以下となった場合に、予備ｒｌ
！源１２の電圧ＶＤを、メイン電源線１の電圧値が予備
電源１２の電圧Ｖｕ以上となっている場合に１ メイン
電源給゛ｔｔｌ ＃ｉ！１の電圧をメモリ１３とＮＡＮ
Ｄゲート９の電源ピンに印加するようＫ［源の切換えを
行っている。この結果、メモリ１３とＮＡＮＤゲート９
の電源ピンに印加される電圧波形は、第２図に０部波形
として示されるような波形となる。
メモ＋７１３は、電源ピンに補助電源１２の電圧ＶＤが
印加されている間、チップセレクト入力で下に与えられ
る信号が論理″ １ ′であることを条件に、情報の保
持を行っており、電源ビンに補助電源１２の電圧より高
いメイン電源給電線ｌの電圧が印加されている状態で、
論理入力信号ピン８に与えられる信号に基づいて、書込
み、読出しが制御される。このため、メモリ１３が情報
の保持動作を行っている間、ＮＡＮＤゲート９０入力の
いずれか一方の入力信号は、必ず論理％Ｏ＃どなってい
る必要がある。ところで、この期間中、論理入力信号ビ
ン８に与えられる信号の論理値は不定であるので、必然
的に′￥Ｊ１圧監視回路の出力信号を論理１０′の状態
に保持しておかなければならない。もし、この出力信号
にノイズ等が発生して、この出力信号が論理′″ １
′の状態となると、ＮＡＮＤゲート９の出力が論理％Ｏ
′となる場合を生じ、メモリ１３の情報破壊を招く恐れ
がある。
印加されている間、チップセレクト入力で下に与えられ
る信号が論理″ １ ′であることを条件に、情報の保
持を行っており、電源ビンに補助電源１２の電圧より高
いメイン電源給電線ｌの電圧が印加されている状態で、
論理入力信号ピン８に与えられる信号に基づいて、書込
み、読出しが制御される。このため、メモリ１３が情報
の保持動作を行っている間、ＮＡＮＤゲート９０入力の
いずれか一方の入力信号は、必ず論理％Ｏ＃どなってい
る必要がある。ところで、この期間中、論理入力信号ビ
ン８に与えられる信号の論理値は不定であるので、必然
的に′￥Ｊ１圧監視回路の出力信号を論理１０′の状態
に保持しておかなければならない。もし、この出力信号
にノイズ等が発生して、この出力信号が論理′″ １
′の状態となると、ＮＡＮＤゲート９の出力が論理％Ｏ
′となる場合を生じ、メモリ１３の情報破壊を招く恐れ
がある。
本発明による電圧監視回路は、このようなメモリ１３の
情報破壊を招くようなノイズを発生することのないもの
であり、電圧監視用ＩＣ２と、トランジスタ５、レベル
シフトダイオード６、バイアス抵抗７より成るレベルシ
フト出力回路とＫより構成される。
情報破壊を招くようなノイズを発生することのないもの
であり、電圧監視用ＩＣ２と、トランジスタ５、レベル
シフトダイオード６、バイアス抵抗７より成るレベルシ
フト出力回路とＫより構成される。
τを圧監視用■Ｃ２は、メイン電源給Ｍ、線１の電圧が
立上るとき、内部回路動作の不安定である電圧範囲で、
ノイズを発生し、その後、メイン電源給電線１の電圧が
所定値に達するまで論理′ｏ′を出力する。メイン電源
給電線１の電圧値が所定値に達した後、所定時間経過後
に、電圧監視回路Ｃ２の出力は、論理１１ ′となる。
立上るとき、内部回路動作の不安定である電圧範囲で、
ノイズを発生し、その後、メイン電源給電線１の電圧が
所定値に達するまで論理′ｏ′を出力する。メイン電源
給電線１の電圧値が所定値に達した後、所定時間経過後
に、電圧監視回路Ｃ２の出力は、論理１１ ′となる。
一方、メイン電源給電線１の電圧が立下るとき、電圧監
視用ＩＣ２は、メイン電源給ＴＲ，線１の電圧が所定値
以下となると直ちＫその出力を論理１０ ′とし、さら
に、メイン電源給電線】の電圧が低下すると、立上り時
と同様に出力にノイズを発生する。このような電圧監視
用ＩＣ２の出力の波形が第２図に示す０部波形であり、
この出力がレベルシフト回路を構成するトランジスタ５
０ペースに入力すれる。
視用ＩＣ２は、メイン電源給ＴＲ，線１の電圧が所定値
以下となると直ちＫその出力を論理１０ ′とし、さら
に、メイン電源給電線】の電圧が低下すると、立上り時
と同様に出力にノイズを発生する。このような電圧監視
用ＩＣ２の出力の波形が第２図に示す０部波形であり、
この出力がレベルシフト回路を構成するトランジスタ５
０ペースに入力すれる。
トランジスタ５、レベルシフトダイオード６、バイアス
抵抗７より成り、レベルシフトダイオード６とバイアス
抵抗７どの接続点を出力とするレベルシフト出力回路は
、トランジスタ５がエミッタフォロア動作し、トランジ
スタ５のベース・エミック電圧ＶＢＺとレベルシフトダ
イオードのフォワード電圧Ｖｙの和、約１．５ｖより低
いレベルの入力信号がトランジスタ五のベースに与えら
れた場合には、その入力信号を出力に伝達しないように
動作する。
抵抗７より成り、レベルシフトダイオード６とバイアス
抵抗７どの接続点を出力とするレベルシフト出力回路は
、トランジスタ５がエミッタフォロア動作し、トランジ
スタ５のベース・エミック電圧ＶＢＺとレベルシフトダ
イオードのフォワード電圧Ｖｙの和、約１．５ｖより低
いレベルの入力信号がトランジスタ五のベースに与えら
れた場合には、その入力信号を出力に伝達しないように
動作する。
電圧監視用ＩＣ２が、メイン電源給電線ｌに印加される
電圧の立上り、立下り時に発生するノイズのレベルはＩ
Ｖ程度であるため、前述のレベルシフト出力回路は、こ
のノイズをその出力に伝達することはない。従って、レ
ベルシフト出力回路の定値以上であることな示す論理１
１ ′の信号のみをＮＡＮＤゲート９に伝達する。この
ため、ＮＡＮＤゲート９は゛、電圧監視回路からノイズ
が入力されることがなくなり、メモリ１３の情報保持動
作中に、メモリ１３のチップセレクト入力Ｕ石に、第２
図に（イ）、１口）として示すようなノイズによる論理
％Ｏ′の信号を与えることがなく、メモリ１３内の電圧
が所定値以上に立上って、レベルシフト出力回路のＩＢ
力が論１哩′ １ ′となった後、ＮＡＮＯゲート９の
論理入力信号ピン８に与えられる信号によって制御され
る。
電圧の立上り、立下り時に発生するノイズのレベルはＩ
Ｖ程度であるため、前述のレベルシフト出力回路は、こ
のノイズをその出力に伝達することはない。従って、レ
ベルシフト出力回路の定値以上であることな示す論理１
１ ′の信号のみをＮＡＮＤゲート９に伝達する。この
ため、ＮＡＮＤゲート９は゛、電圧監視回路からノイズ
が入力されることがなくなり、メモリ１３の情報保持動
作中に、メモリ１３のチップセレクト入力Ｕ石に、第２
図に（イ）、１口）として示すようなノイズによる論理
％Ｏ′の信号を与えることがなく、メモリ１３内の電圧
が所定値以上に立上って、レベルシフト出力回路のＩＢ
力が論１哩′ １ ′となった後、ＮＡＮＯゲート９の
論理入力信号ピン８に与えられる信号によって制御され
る。
前述した本発明の実施例は、本発明にょる電圧監視回路
を、メモリバックアップシステムＦｃ 適Ｆｑし、メモ
リカ゛を情報保持状態にある場合に、メモ１）内の情報
破壊等のメモリの誤＠作を防ＩＥできるものであるが、
本発明は、この実施例にかぎらず、電圧監視を必要とす
る全ての論理回路＝？）に適用可能である。
を、メモリバックアップシステムＦｃ 適Ｆｑし、メモ
リカ゛を情報保持状態にある場合に、メモ１）内の情報
破壊等のメモリの誤＠作を防ＩＥできるものであるが、
本発明は、この実施例にかぎらず、電圧監視を必要とす
る全ての論理回路＝？）に適用可能である。
なお、第１図に示す実り＆例において、プルアップ抵抗
４は、電圧監視用ＩＣ２の出方がオープンコレクタ回路
であるために必要な抵抗であり、また、プルアップ抵抗
１ｏは、メモリー３の情報保持を安定化させるための抵
抗である。
４は、電圧監視用ＩＣ２の出方がオープンコレクタ回路
であるために必要な抵抗であり、また、プルアップ抵抗
１ｏは、メモリー３の情報保持を安定化させるための抵
抗である。
以上説明したように、本発明によれば、電圧の゛立上り
、立下り時の電圧監視回路の動作が不安定； ・・である電圧範囲においても、ノイズを発生すること
のない電圧監視回路を提供することができ、電圧監視回
路を用いる論理回路等の回路装置の誤動作を防止するこ
とができる。
、立下り時の電圧監視回路の動作が不安定； ・・である電圧範囲においても、ノイズを発生すること
のない電圧監視回路を提供することができ、電圧監視回
路を用いる論理回路等の回路装置の誤動作を防止するこ
とができる。
第１図は本発明による電圧監視回路をメモリバツテリパ
ックアップシステＪ・に適用した一実施例のブロック図
、第２図はその動作波形図である。 １・・・・・・メイン電源給ｔｇ！、２・・・・・・電
圧監視用ＩＣ。 ３・・・・・・接地線、４，１０・・・・・・プルアッ
プ抵抗、５・・・・・・トランジスタ、６・・・・・・
レベルシフトダイオード、７・・・・・・バイアス抵抗
、８・・・・・・論理入力信゛号ビン、９・・・・・・
ＮＡＮＤゲート、１３・・・・・・電源切換回路、１２
・・・・・・補助電源、１３・・・・・・メモリ。 第１図 第 ２ 図
ックアップシステＪ・に適用した一実施例のブロック図
、第２図はその動作波形図である。 １・・・・・・メイン電源給ｔｇ！、２・・・・・・電
圧監視用ＩＣ。 ３・・・・・・接地線、４，１０・・・・・・プルアッ
プ抵抗、５・・・・・・トランジスタ、６・・・・・・
レベルシフトダイオード、７・・・・・・バイアス抵抗
、８・・・・・・論理入力信゛号ビン、９・・・・・・
ＮＡＮＤゲート、１３・・・・・・電源切換回路、１２
・・・・・・補助電源、１３・・・・・・メモリ。 第１図 第 ２ 図
Claims (1)
- 【特許請求の範囲】 １、電圧監視用ＩＣと該ＩＣの出力を入力として動作す
る出力回路より成る電圧監視回路において、前記出力回
路は、前記電圧監視用ＩＣの状態が不確定のとき発生す
るノイズ電圧より大きい電圧レベルシフトを行うレベル
シフト出力回路であることを特徴とする電圧監視回路。 ２、前記レベルシフト回路は、エミッタフォロア動作を
行うトランジスタと、該トランジスタのエミッタに接続
されたレベルシフトダイオードおよびバイアス抵抗の直
列回路より成ることを特徴とする前記特許請求の範囲第
１項記載の電圧監視回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61288802A JPS63142408A (ja) | 1986-12-05 | 1986-12-05 | 電圧監視回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61288802A JPS63142408A (ja) | 1986-12-05 | 1986-12-05 | 電圧監視回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63142408A true JPS63142408A (ja) | 1988-06-14 |
Family
ID=17734919
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61288802A Pending JPS63142408A (ja) | 1986-12-05 | 1986-12-05 | 電圧監視回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63142408A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2020137381A1 (ja) * | 2018-12-26 | 2020-07-02 | 株式会社デンソー | 車両用制御装置 |
-
1986
- 1986-12-05 JP JP61288802A patent/JPS63142408A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2020137381A1 (ja) * | 2018-12-26 | 2020-07-02 | 株式会社デンソー | 車両用制御装置 |
| JP2020108198A (ja) * | 2018-12-26 | 2020-07-09 | 株式会社デンソー | 車両用制御装置 |
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