JPS6295654A - 非同期デ−タ伝送方式 - Google Patents
非同期デ−タ伝送方式Info
- Publication number
- JPS6295654A JPS6295654A JP60235782A JP23578285A JPS6295654A JP S6295654 A JPS6295654 A JP S6295654A JP 60235782 A JP60235782 A JP 60235782A JP 23578285 A JP23578285 A JP 23578285A JP S6295654 A JPS6295654 A JP S6295654A
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- JP
- Japan
- Prior art keywords
- data
- line
- signal line
- control signal
- signal
- Prior art date
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- Pending
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- Information Transfer Systems (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は情報処理装置で使用される装置間の非同期デー
タ転送方式に関する。
タ転送方式に関する。
本発明は互いに非同期である二つの装置間でハイドシェ
イクによりデータ伝送を行う方式において、 制御信号線に論理ｒＮを送信している要求状態でこの信
号線に相手側が論理ｒＯＪを送信すると、この信号線が
実質的に短絡されて論理ｒＯＪとなって応答状態を示す
構成とすることにより、制御信号線を１回線双方向とし
て制御信号線の削減を行うものである。
イクによりデータ伝送を行う方式において、 制御信号線に論理ｒＮを送信している要求状態でこの信
号線に相手側が論理ｒＯＪを送信すると、この信号線が
実質的に短絡されて論理ｒＯＪとなって応答状態を示す
構成とすることにより、制御信号線を１回線双方向とし
て制御信号線の削減を行うものである。
非同期データ転送には通常１バイトのデータ転送ごとに
、装置間の同期をとるためのハンドシェイクが必要であ
るが、このためには従来少なくとも２つ以上の制御信号
を用いていた。
、装置間の同期をとるためのハンドシェイクが必要であ
るが、このためには従来少なくとも２つ以上の制御信号
を用いていた。
第４図は、２本の制御信号線１．Ｊを用いてノ＼ンドシ
ェイクを行う最も単純なインタフェースの例である。第
４図において図面符号ｌおよびＪは対構成でハンドシェ
イクを行う信号線、Ｄは８ビツトの双方向データライン
、Ｅはデータ転送の方向を示す信号線、Ｆはデータライ
ンＤ上の内容がコマンドかデータかを示す信号線、Ｇお
よびＨはそれぞれ装置１１および装置１２が「レディ」
状態であることを示す信号線で、Ｅ、Ｆ、Ｉ、Ｊは有効
であるか否かを示す。装置１１および装置１２の間のデ
ータ転送は、信号線Ｅ、、ＦＳＣ，ＳＨの値により装置
間の状態を設定し、信号線■およびＪのやりとりにより
ハンドシェイクを行いながらデータラインＤを通じて転
送されるものである。
ェイクを行う最も単純なインタフェースの例である。第
４図において図面符号ｌおよびＪは対構成でハンドシェ
イクを行う信号線、Ｄは８ビツトの双方向データライン
、Ｅはデータ転送の方向を示す信号線、Ｆはデータライ
ンＤ上の内容がコマンドかデータかを示す信号線、Ｇお
よびＨはそれぞれ装置１１および装置１２が「レディ」
状態であることを示す信号線で、Ｅ、Ｆ、Ｉ、Ｊは有効
であるか否かを示す。装置１１および装置１２の間のデ
ータ転送は、信号線Ｅ、、ＦＳＣ，ＳＨの値により装置
間の状態を設定し、信号線■およびＪのやりとりにより
ハンドシェイクを行いながらデータラインＤを通じて転
送されるものである。
第５図は第４図に示したインタフェースにおけるハンド
シェイクのタイムチャートである。
シェイクのタイムチャートである。
第５図において装置１１が信号線■をｒｌＪにすること
によって装置１２にデータ転送を要求し、装置１２は信
号線Ｊを「１」にすることにより応答する。装置１１は
その応答によって信号線■を０にし、装置１２は信号線
Ｉが０になることにより信号線ＪをＯにして応答する。
によって装置１２にデータ転送を要求し、装置１２は信
号線Ｊを「１」にすることにより応答する。装置１１は
その応答によって信号線■を０にし、装置１２は信号線
Ｉが０になることにより信号線ＪをＯにして応答する。
このように矢印ｉ−ｊなどの複数の状態変化が必要とな
る。
る。
前記のようにハンドシェイクを行うのに多数の状態変化
とそれに伴うケーブルやデバイス遅延が生ずることが避
けられない。
とそれに伴うケーブルやデバイス遅延が生ずることが避
けられない。
本発明は上記の問題点を解決するものであり、装置間の
ハンドシェイクに必要な制御信号線の削減やさらにハン
ドシェイクの状態変化自体を削減することにより、高速
な非同期データ転送手段を提供することを目的とする。
ハンドシェイクに必要な制御信号線の削減やさらにハン
ドシェイクの状態変化自体を削減することにより、高速
な非同期データ転送手段を提供することを目的とする。
本発明は、互いに非同期の二つの装置の間のハンドシェ
イクのための制御信号を送受信してデータ伝送を行う方
式において、上記制御信号を送受信する信号先を双方向
伝送用の一つの信号線とし、上記二つの装置には、それ
ぞれこの一つの信号線に制御信号を送信するドライバー
およびこの一つの信号線から制御信号を受信するレシー
バ−を接続し、上記ドライバーは、一方のドライバーが
上記信号線に論理「１」を送信している状態で他方のド
ライバーがこの信号線に論理「０」を送信するとこの信
号線が実質的に短絡されて論理「０」になる構成であり
、この信号線に論理「１」を送信することにより要求を
示し、この要求に対してこの信号線を論理ｒＯＪにする
ことによりこの要求に対する応答を意味する構成とする
ことを特徴とする。
イクのための制御信号を送受信してデータ伝送を行う方
式において、上記制御信号を送受信する信号先を双方向
伝送用の一つの信号線とし、上記二つの装置には、それ
ぞれこの一つの信号線に制御信号を送信するドライバー
およびこの一つの信号線から制御信号を受信するレシー
バ−を接続し、上記ドライバーは、一方のドライバーが
上記信号線に論理「１」を送信している状態で他方のド
ライバーがこの信号線に論理「０」を送信するとこの信
号線が実質的に短絡されて論理「０」になる構成であり
、この信号線に論理「１」を送信することにより要求を
示し、この要求に対してこの信号線を論理ｒＯＪにする
ことによりこの要求に対する応答を意味する構成とする
ことを特徴とする。
本発明は、二つの装置間のハタのために１本の双方向制
御信号線を用い、データを送出する側の装置がこの双方
向制御信号を立上げ、データを受は取る側の装置がこの
双方向制御信号に立下げることにり、ハンドシェイクを
行いデータ転送を行う。
御信号線を用い、データを送出する側の装置がこの双方
向制御信号を立上げ、データを受は取る側の装置がこの
双方向制御信号に立下げることにり、ハンドシェイクを
行いデータ転送を行う。
次に本発明について添付図面を参照して説明する。
第１図は本発明の実施例ハンドシェイクを行う制御信号
のインタフェース回路図である。第１図において、装置
１１．１２間は信号線Ｅ−Ｄによって結合される。図面
符号Ｃは本発明の特徴である装置１１．１２間を一本で
結合しその間のハンドシェイクを行う制御信号線りは８
ビツトの双方向データライン、Ｅはデータ転送の方向を
示す信号線、ＦはデータラインＤ上の内容がコマンドか
データかを示す信号線、ＧおよびＨはそれぞれ装置１０
および装置２０がレディ状態であることを示す信号線で
ある。また装置１１と１２とを結合する信号線Ｇ、 Ｈ
は各信号線Ｃ，Ｅ、Ｆの制御信号が有効であることを示
す。
のインタフェース回路図である。第１図において、装置
１１．１２間は信号線Ｅ−Ｄによって結合される。図面
符号Ｃは本発明の特徴である装置１１．１２間を一本で
結合しその間のハンドシェイクを行う制御信号線りは８
ビツトの双方向データライン、Ｅはデータ転送の方向を
示す信号線、ＦはデータラインＤ上の内容がコマンドか
データかを示す信号線、ＧおよびＨはそれぞれ装置１０
および装置２０がレディ状態であることを示す信号線で
ある。また装置１１と１２とを結合する信号線Ｇ、 Ｈ
は各信号線Ｃ，Ｅ、Ｆの制御信号が有効であることを示
す。
第２図は本発明の特徴である制御信号線Ｃを含むインタ
フェース回路図である。第２図において図面符号３０お
よび４０はＴＴＬを用いたドライバーであり、図面符号
５０．６０はＴＴＬを用いたレシーバ−である。信号Ａ
は装置１０により駆動されるドライバー３０の入力信号
であり、信号Ｂは装置２０により駆動されるドライバー
４０の入力信号である。
フェース回路図である。第２図において図面符号３０お
よび４０はＴＴＬを用いたドライバーであり、図面符号
５０．６０はＴＴＬを用いたレシーバ−である。信号Ａ
は装置１０により駆動されるドライバー３０の入力信号
であり、信号Ｂは装置２０により駆動されるドライバー
４０の入力信号である。
制御信号線Ｃはドライバー３０および４０の出力をワイ
ヤード・オア結合して作られる信号線でレシーバ−５０
および６０を通じて装置１０および２０へ入力される。
ヤード・オア結合して作られる信号線でレシーバ−５０
および６０を通じて装置１０および２０へ入力される。
ここで「マスク」を装置１０５「スレーブ」を装置２０
とし「マスク」が「スレーブ」にコマンドを送出し、そ
のコマンドの内容によりデータ転送を行う例を説明する
。すなわち、電源投入直後、あいはコマンドの実行終了
後は「スレーブ」である装置２０が受信側となるものと
する。第３図は本発明の実施例のタイムチャートである
。第３図においてコマンドあるいは第１図における制御
信号線已によりデータ転送の方向が決定した後、信号線
ＡおよびＢが共に「１」の初期状態から装置２０がデー
タ転送受は付ける状態になったとき、信号線ＢをＯにし
て装置１０からのデータ転送要求を待つ。
とし「マスク」が「スレーブ」にコマンドを送出し、そ
のコマンドの内容によりデータ転送を行う例を説明する
。すなわち、電源投入直後、あいはコマンドの実行終了
後は「スレーブ」である装置２０が受信側となるものと
する。第３図は本発明の実施例のタイムチャートである
。第３図においてコマンドあるいは第１図における制御
信号線已によりデータ転送の方向が決定した後、信号線
ＡおよびＢが共に「１」の初期状態から装置２０がデー
タ転送受は付ける状態になったとき、信号線ＢをＯにし
て装置１０からのデータ転送要求を待つ。
装置ｌＯはデータラインＣ上に転送すべきデータｄを用
意した後に信号線Ａを０にする。もし、このときすでに
信号線Ｂが０であれば信号線ＡがＯになることにより信
号線Ｃが１になり、もし、信号線ＢがＯでなければ信号
Ｂが０になった時点で信号線Ｃが１になる。
意した後に信号線Ａを０にする。もし、このときすでに
信号線Ｂが０であれば信号線ＡがＯになることにより信
号線Ｃが１になり、もし、信号線ＢがＯでなければ信号
Ｂが０になった時点で信号線Ｃが１になる。
装置２０は信号線Ｃが１になることにより装置１０から
のデータ転送要求を知り、データラインＤ上のデータｄ
をラッチした後に応答として信号線Ｂを１にすることに
より信号線Ｃが０になる。装置２０は信号線Ｃが０にな
ったことにより装置２０からの応答を知り、直ちに信号
線Ａを１にして次の転送データをデータラインＤに送出
する準備を行う。
のデータ転送要求を知り、データラインＤ上のデータｄ
をラッチした後に応答として信号線Ｂを１にすることに
より信号線Ｃが０になる。装置２０は信号線Ｃが０にな
ったことにより装置２０からの応答を知り、直ちに信号
線Ａを１にして次の転送データをデータラインＤに送出
する準備を行う。
装置２０は信号ＢをＯから１にして時間Ｔ２後、再び０
にし、装置１０からの次のデータ転送要求を待つ。時間
Ｔ２は、装置２０が信号線Ｂを１にしてから信号線Ｃを
通じて信号線Ａが１になるまでに要する時間Ｔ１より大
きいことを保証する必要がある。以上は装置１０から装
置２０へのデータ転送の例であるが、制御信号線已によ
りデータ転送方向決定後に前記の第３図の動作説明にお
いて信号線ＡおよびＢの動作を互いに置き換えることに
より装置２０から装置ｌＯへのデータ転送を行うことが
できる。
にし、装置１０からの次のデータ転送要求を待つ。時間
Ｔ２は、装置２０が信号線Ｂを１にしてから信号線Ｃを
通じて信号線Ａが１になるまでに要する時間Ｔ１より大
きいことを保証する必要がある。以上は装置１０から装
置２０へのデータ転送の例であるが、制御信号線已によ
りデータ転送方向決定後に前記の第３図の動作説明にお
いて信号線ＡおよびＢの動作を互いに置き換えることに
より装置２０から装置ｌＯへのデータ転送を行うことが
できる。
以上説明したように、同一の制御信号を一方の装置が立
上げ、他の一方の装置が立下げることにより、一本の制
御信号による立上りと立下りの２つの状態変化のみのハ
ンドシェイクで１バイトのデータ転送が可能であり、制
御信号線の削減およびハンドシェイクの高速化に効果が
ある。
上げ、他の一方の装置が立下げることにより、一本の制
御信号による立上りと立下りの２つの状態変化のみのハ
ンドシェイクで１バイトのデータ転送が可能であり、制
御信号線の削減およびハンドシェイクの高速化に効果が
ある。
【図面の簡単な説明】
第１図は本発明実施例ハンドシェイクを行う制御信号の
インタフェース回路図。 第２図は本発明の実施例のインタフェース回路図。 第３図は、第１図インタフェース回路のハンドシェイク
タイムチャート。 第４図は従来の非同期転送を行うインタフェース回路図
。 第５図は従来の２つの制御信号を用いたハンドシェイク
のタイムチャート。 １０．１１．１２．２０・・・データ転送を行う装置、
３０．４０・・・ドライバー、５０．６０・・・レシー
バ−１Ａ・・・ドライバー３０の入力信号、Ｂ・・・ド
ライバー４０の入力信号、Ｃ・・・データ転送装置間に
作られる単線式制御信号線、Ｄ・・・８ビツトの双方向
データライン、ＥｌＦ、Ｇ、Ｈ・・・装置間の状態設定
を行う信号線、Ｉ、Ｊ・・・従来のハンドシェイクを行
う対（ペア）線式％式％
インタフェース回路図。 第２図は本発明の実施例のインタフェース回路図。 第３図は、第１図インタフェース回路のハンドシェイク
タイムチャート。 第４図は従来の非同期転送を行うインタフェース回路図
。 第５図は従来の２つの制御信号を用いたハンドシェイク
のタイムチャート。 １０．１１．１２．２０・・・データ転送を行う装置、
３０．４０・・・ドライバー、５０．６０・・・レシー
バ−１Ａ・・・ドライバー３０の入力信号、Ｂ・・・ド
ライバー４０の入力信号、Ｃ・・・データ転送装置間に
作られる単線式制御信号線、Ｄ・・・８ビツトの双方向
データライン、ＥｌＦ、Ｇ、Ｈ・・・装置間の状態設定
を行う信号線、Ｉ、Ｊ・・・従来のハンドシェイクを行
う対（ペア）線式％式％
Claims (1)
- （１）互いに非同期の二つの装置の間にハンドシェイク
のための制御信号を送受信してデータ伝送を行う方式に
おいて、 上記制御信号を送受信する信号先を双方向伝送用の一つ
の信号線とし、 上記二つの装置には、それぞれこの一つの信号線に制御
信号を送信するドライバーおよびこの一つの信号線から
制御信号を受信するレシーバーを接続し、 上記ドライバーは、一方のドライバーが上記信号線に論
理「１」を送信している状態で他方のドライバーがこの
信号線に論理「０」を送信するとこの信号線が実質的に
短絡されて論理「０」になる構成であり、 この信号線に論理「１」を送信することにより要求を示
し、この要求に対してこの信号線を論理「０」にするこ
とによりこの要求に対する応答を意味する構成とする ことを特徴とする非同期データ伝送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60235782A JPS6295654A (ja) | 1985-10-21 | 1985-10-21 | 非同期デ−タ伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60235782A JPS6295654A (ja) | 1985-10-21 | 1985-10-21 | 非同期デ−タ伝送方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6295654A true JPS6295654A (ja) | 1987-05-02 |
Family
ID=16991161
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60235782A Pending JPS6295654A (ja) | 1985-10-21 | 1985-10-21 | 非同期デ−タ伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6295654A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5412644A (en) * | 1992-09-16 | 1995-05-02 | Deutsche Itt Industries Gmbh | Serial bus system with a single-wire line |
| US5903570A (en) * | 1995-06-23 | 1999-05-11 | U.S. Philips Corporation | Timing circuit using handshake connections |
-
1985
- 1985-10-21 JP JP60235782A patent/JPS6295654A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5412644A (en) * | 1992-09-16 | 1995-05-02 | Deutsche Itt Industries Gmbh | Serial bus system with a single-wire line |
| US5903570A (en) * | 1995-06-23 | 1999-05-11 | U.S. Philips Corporation | Timing circuit using handshake connections |
| EP0786112B1 (en) * | 1995-06-23 | 2001-11-21 | Koninklijke Philips Electronics N.V. | A circuit for coordinating the timing of operations of asynchronously operating sub-circuits |
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