JPS62213289A - 半導体レ−ザ - Google Patents

半導体レ−ザ

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JPS62213289A
JPS62213289A JP61057323A JP5732386A JPS62213289A JP S62213289 A JPS62213289 A JP S62213289A JP 61057323 A JP61057323 A JP 61057323A JP 5732386 A JP5732386 A JP 5732386A JP S62213289 A JPS62213289 A JP S62213289A
Authority
JP
Japan
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layer
inp
resonator
buried
active
Prior art date
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Pending
Application number
JP61057323A
Other languages
English (en)
Inventor
Yuji Kotaki
小滝 裕二
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Publication of JPS62213289A publication Critical patent/JPS62213289A/ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
    • H01S5/20Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers
    • H01S5/22Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers having a ridge or stripe structure
    • H01S5/227Buried mesa structure ; Striped active layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
    • H01S5/04Processes or apparatus for excitation, e.g. pumping, e.g. by electron beams
    • H01S5/042Electrical excitation ; Circuits therefor
    • H01S5/0421Electrical excitation ; Circuits therefor characterised by the semiconducting contacting layers
    • H01S5/0422Electrical excitation ; Circuits therefor characterised by the semiconducting contacting layers with n- and p-contacts on the same side of the active layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
    • H01S5/20Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers
    • H01S5/22Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers having a ridge or stripe structure
    • H01S5/227Buried mesa structure ; Striped active layer
    • H01S5/2275Buried mesa structure ; Striped active layer mesa created by etching

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  • Physics & Mathematics (AREA)
  • Geometry (AREA)
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  • Optics & Photonics (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概要〕 従来の埋込み構造レーザにおいては、高出力、高温時に
は漏れ電流が多くなるため、注入電流を共振器長方向に
流すようにした構造にして漏れ電流の増加を防ぎ、製作
が容易で、低容量で高速応答可能な半導体レーザを提起
する。
〔産業上の利用分野〕
本発明は埋込構造のレーザの埋込と電極構造に関する。
半導体レーザは光通信用光源として用いられ、発振のた
めの、レーザへの注入電流は効率よく活性層に流れるよ
うにし、その他の領域への漏れ電流を極力抑えることが
重要である。
そのために、埋込構造は層構造が簡単で成長しやすく、
かつ漏れ電流阻止効果の大きいことが望ましい。
また、レーザの高速変調を可能とするために、注入電流
を流すための両電極間の寄生容量を低減する必要がある
〔従来の技術〕
第4図(11〜(3)はそれぞれ従来例による、単層の
活性層を有する埋込構造の半導体レーザの断面図である
図は回折格子を有する分布帰還(DFB)型レーザであ
る。
第4図(1)において、1はn型インジウム燐(n4n
P)基板、2はガイド層でn型インジウムガリウム砒素
燐(n−InGaAsP)層、3は活性層でアンドープ
のInGaAsP層、4はクラッド層でp型インジウム
燐(p−InP)層で、ここまでを液相成長(LPE)
法で成長して、これらの層をストライプ状にメサエッチ
ングする。
なお、n−InP基板1とガイド層のn−InGaAs
P層2の界面に回折格子が形成される。
つぎに、メサを二酸化珪素(Sing)等のマスクで覆
って、同様にLPE法により埋込層としてp−InP層
5、n−InP層6 、p−InP層7を順次成長して
、メサの両側を埋め込む。
この例は、活性層の両側の埋込層によりp−n−p−n
接合を形成して漏れ電流を阻止するものであるが、成長
が複雑で歩留が悪い。
また、図示していないが電極は対向して形成されるため
、容量が大きい。
第4図(2)において、■はn−1nP基板、2はガイ
ド層でn−InGaAsP層、3は活性層でアンドープ
のInGaAsP層、4はクラッド層でp−1nP層で
、ここまでをLPE法で成長して、これらの層をストラ
イプ状にメサエッチングする。
つぎに、メサを覆って全体をp−InP層5で埋め込む
この例は、層構造は簡単であるが、活性領域外のpn接
合面積が極めて大きいため、漏れ電流が大きい。
この場合もまた、電極は対向して形成されるため、容量
が大きい。
第4図(3)において、図番1〜5の層構造は第4図(
2)と同様であるが、これらの層構造は半絶縁性(Si
−1nP)基板6上に形成され、p側電極7はp−In
P層5上に、n側電極8はn−InP層1上に形成する
この例では、電極は対向していないので、容量は低減で
きるが、pn接合面積が大きく、高出力、高温時には漏
れ電流が大きくなる。
以上説明したレーザは、単層活性層のため、最大光出力
が小さい。
これに対して、多層活性層のレーザの従来例について説
明する。
第5図(1)、(2)はそれぞれ従来例による、多層の
活性層を有する埋込構造の半導体レーザの断面図である
第5図(1)の例において、11はn−InP基板、1
2は第1の活性層でアンドープのInGaAsP層、1
3はアンドープのInP層、14は第2の活性層でアン
ドープのInGaAsP層、15ははクラフト層でp−
InP層で、ここまでをLPE法で成長して、これらの
層をストライプ状にメサエッチングする。
つぎに、メサを5iOt等のマスクで覆って、同様にL
PE法により埋込層として高抵抗の1−1nP Ji1
6を成長してメサの両側を埋め込み、さらに、Si0g
マスクを除去して基板全面にp−InP層17を成長す
る。
この例は、上側の活性層により形成されるヘテロ接合の
漏れ電流が、下側の活性層に電流注入されるので、効率
が悪い。
第5図(2)の例は、第5図(1)のアンドープのIn
P層13の代わりに、p”−1nP層18とn”−In
P基板19よりなるp +−n *接合を入れたもので
ある。
この例は、p +−n *逆バイアス接合のトンネル電
流により電流注入を行うものであるが、この接合におけ
る電力損失が大きくなり、電力効率が悪い欠点がある。
(発明が解決しようとする問題点〕 従来の埋込構造の半導体レーザにおいては、漏れ電流阻
止効果が充分でなかった。
さらに、多層活性層のレーザにおいては、各活性層への
電流注入が困難で、レーザの高出力化を阻害していた。
〔問題点を解決するための手段〕
上記問題点の解決は、共振器の真上に少なくともクラッ
ド層を介して第1の電極と、該共振器の片側の端面より
外側に第2の電極を設け、該電極間の注入電流を共振器
長方向に流すようにした構造を有する半導体レーザによ
り達成される。
前記第2の電極は、共振器の片側の端面に埋込層を成長
し、該埋込層上に設けてもよい。
また、前記共振器が2層以上よりなる場合は各活性層へ
の電流注入が容易になる。
〔作用〕
通常、半導体レーザにおいては、活性層の下側にはn型
クラッド層、上側にはp型りラフト層があり、レーザ発
振のための注入電流はp型りラフト層−活性層−n型ク
ラフト層の経路で流れる。
本発明においては、ストライプ状の活性層とストライブ
状のn型クラフト層をp型りラフト層で囲んで包み込ん
だ構造となり、またn型クラッド層はp型クラッド層に
比し2桁位抵抗が低いので、両方のクラフト層間で形成
されるpn接合部の面積は小さくなり、漏れ電流を低く
抑制することができる。
この場合の、注入電流は、第1のくp側)!極からp型
クラッド層を通って活性層に垂直にストライブ状の活性
層、ストライブ状のn型クラッド層に流れ込み、ストラ
イブ状のn型クラフト層の中を活性層に平行に、かつス
トライプ方向に、すなわち共振器長方向に流れて第2の
くn側)電極に流れ込む。
このように電流の流れが非対称でも、n型クラフト層の
抵抗が低いことから、ここを流れる電流は均一に近いと
見做し得る。
〔実施例〕
第1図(1)、(2)はそれぞれ本発明の詳細な説明す
る単層の活性層を有する埋込構造の半導体レーザの側断
面図と、斜視図である。
図は回折格子を有する叶B型レーザである。
第1図(1)において、101はSl(半絶縁性)−1
nP基板、102はn−InP層、103はガイド層で
n−InGaAsP層、104は活性層でアンドープの
InGaAsP層、105はクラッド層でp−1nP層
で、ここまでをLPIE法で成長して、これらの層をス
トライブ状にメサエッチングする。
なお、n−InP層102とガイド層のn−InGaA
sP層103の界面に回折格子が形成される。
つぎに、同様にLPE法により、埋込層としてp−In
P層106を成長して、メサの両側と上部を埋め込む。
つぎに、所定の共振器長を保って、共振器の片側の端面
が露出するように、埋込層のp−1nP層106と、ク
ラッド層のp−InP Ji105と、活性層のInG
aAsP層104と、ガイド層のn−InGaAsP層
103を除去し、除去部に端面埋込層としてn−InP
層107を成長する。
つぎに、この共振器端面において、ストライプ幅を残し
て切り込み10B 、109を形成し、p−InP層1
06の上にp側電極としてチタン/白金/金(Ti /
 Pt/ Au)層110 、n−1nP Ji107
の上にn側電極として金/錫/金(Au/Sn/Au)
層111を形成する。
このような構造においては、p−InP Jii106
とn−InP層102とにより形成されるpnn接部部
面積十分小さく、かつp−InP層106とInGaA
sP層104とにより形成されるヘテロ接合のビルトイ
ン電位が前記pn接合のそれより低いため、はとんどの
電流が活性層に流れ、漏れ電流を低(抑えることができ
る。
また、端面埋込層のn−InP層107は反射防止(A
R)層としてはたらき、DFBレーザにとって有害な、
共振器内にたつファブリペロ−(FP)モードを抑制し
ている。
埋込み層は、p−InP層106のみで成長が簡単で製
造が容易である。
また、電極は対向しないで形成されるため、容量が小さ
い。
第2図は本発明の他の実施例を説明する単層の活性層を
有する埋込構造の半導体レーザの側断面図である。
図は通常のファブリペロー(FP)モードレーザである
図は、第1図のガイド層のn−InGaAsP層103
と、端面埋込層のn−InP層107とが省略され、n
側電極のAu/Sn/Au層tiiがn−InP層10
2上に形成される。このようにすれば、エッチミラ一端
面とへき開面による通常のFPモードレーザとなる。
第3図(1)、(2)はそれぞれ本発明の詳細な説明す
る多層の活性層を有する埋込構造の半導体レーザの断面
図である。
図は回折格子を有するDFB型レーザである。
第5図(1)の例において、121は1−1nP基板、
122は第1の活性層でアンドープのInGaAsP層
、123はn−InP層、124はガイド層でn−In
GaAsP層、125は第2の活性層でアンドープのI
nGaAsP層、126はクラッド層でp−InP層で
、ここまでをLPE法で成長して、これらの層をストラ
イブ状にメサエッチングする。
つぎに、同様にLPE法により、埋込層としてp−In
P層127を成長して、メサの両側と上部を埋め込む。
つぎに、所定の共振器長を保9て、共振器の片側の端面
が露出するように、埋込層のp−InP層127と、ク
ラフト層のp−InP層126と、第2の活性層のIn
GaAsP Jii125と、ガイド層のn−InGa
AsP層124と、n−InP層123と、第1の活性
層のInGaAsP層122とを層表22除去部に端面
埋込層としてn−InP層128を成長する。
つぎに、この共振器端面において、ストライブ幅を残し
て切り込み129.130を形成し、p−InP層12
7の上にp側電極としてTi / Pt/ AuJi 
131、n−InP層128の上にnm!極としAu/
Sn/^U層132を形成する。
このような構造においては、p−InP層127とn−
InP Jii102とにより形成されるpn接合部面
積が十分小さく、かつp−InP層127とInGaA
sP層122、あ層表22nGaAsP層125とによ
り形成されるヘテロ接合のビルトイン電位が前記pn接
合のそれより低いため、はとんどの電流が活性層に流れ
る。
このようなレーザにおいては、2つの活性層が光学的に
結合するために、層間距離を0.5〜1.0μmにして
いる。また、光分布あり円形に近くなるため、遠視野像
(PFP)が対称形になり、その角度が狭くなり、従っ
てレーザとファイバとを結合する際レーザ光をレンズで
絞りやすくなるといった利点もある。
〔発明の効果〕
以上詳細に説明したように本発明による埋込構造の半導
体レーザは、漏れ電流が小さく、製造が容易で、かつ低
容量で高速応答が可能である。
さらに、多層活性層のレーザにおいては、各活性層への
電流注入が容易でレーザの高出力化が可能となる。
【図面の簡単な説明】
第1図(1)、(2)はそれぞれ本発明の詳細な説明す
る単層の活性層を有する埋込構造の半導体レーザの側断
面図と、斜視図、 第2図は本発明の他の実施例を説明する単層の活性層を
有する埋込構造の半導体レーザの側断面図、 第3図(1)、(2)はそれぞれ本発明の詳細な説明す
る多層の活性層を存する埋込構造の半導体レーザの断面
図、 第4図(1)〜(3)はそれぞれ従来例による、単層の
活性層を有する埋込構造の半導体レーザの断面図、第5
図(1)、(2)はそれぞれ従来例による、多層の活性
層を有する埋込構造の半導体レーザの断面図である。 図において、 101は5I−InP基板、 102はn−InP層、 103はガイド層でn−InGaAsP層、104は活
性層でア“ンドーブのInGaAsP N、105はク
ラッド層でp−InP層、 106は埋込層でp−InP層、 107は端面埋込層で1−InP層、 108.109は切り込み、 110はp側電極でT t / P t / A u層
、111はn側電極でAu/Sn/AU層、121は1
−InP 基板、 122は第1の活性層でInGaAsP層、123はn
−InP層、 124はガイド層でn−InGaAsP層、125は第
2の活性層でInGaAsP層、126はクラフト層で
p−InP層、 127は埋込層でp−InP層、 128は端面埋込層でn−InP層、 129.130は切り込み、 131はn側電極でTi/Pt/Au層、132はn側
電極でAu/Sn/Au層(1) イロ・IN 面図 (2)卦梶圃 1=−RGFJ f14層活十生一層nレー゛ワ−’(
DFI3)第 1 図 (1)側断面図 (2)@視口 木り明/7多43# +’L4 /+ b−”J” (
D7−13)第3 図 祷釆合・1.114.I−8・避層/7し−ブ滴園りシ
ロ (3使V第4 図 ィ九束脅・If1多眉〕占十を層nし−ザ釣断命図 (
2脅11) 第′:; 図

Claims (3)

    【特許請求の範囲】
  1. (1)共振器の真上に少なくともクラッド層を介して第
    1の電極と、該共振器の片側の端面より外側に第2の電
    極を設け、該電極間の注入電流を共振器長方向に流すよ
    うにした構造を有することを特徴とする半導体レーザ。
  2. (2)共振器の片側の端面に埋込層を成長し、該埋込層
    上に前記第2の電極を設けてなることを特徴とする特許
    請求の範囲第1項記載の半導体レーザ。
  3. (3)前記共振器が2層以上よりなることを特徴とする
    特許請求の範囲第1項記載の半導体レーザ。
JP61057323A 1986-03-14 1986-03-14 半導体レ−ザ Pending JPS62213289A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2000016390A1 (de) * 1998-09-15 2000-03-23 Infineon Technologies Ag Verfahren zur herstellung einer stufe auf der oberfläche eines substrats aus halbleitermaterial, anwendung des verfahrens und substrat mit einer stufe

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2000016390A1 (de) * 1998-09-15 2000-03-23 Infineon Technologies Ag Verfahren zur herstellung einer stufe auf der oberfläche eines substrats aus halbleitermaterial, anwendung des verfahrens und substrat mit einer stufe

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