JPS6116529A - 半導体装置表面の平坦化方法 - Google Patents
半導体装置表面の平坦化方法Info
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は半導体装置表面の平坦化方法、詳しくは、同装
置表面に生じた凹部を絶縁物等で埋めることによって、
表面を平坦化する方法に関するものである。
置表面に生じた凹部を絶縁物等で埋めることによって、
表面を平坦化する方法に関するものである。
従来例の構成とその問題点
近年、半導体集積回路の高集積化にともない、素子の加
工寸法は縮小の一途をたどっている。ところが、配線金
属層の厚さに関しては配線抵抗の増大の点から、また素
子間分離層の厚さに関しては寄生トランジスタ効果の増
大の点から、いずれも、比例縮小的に小さくすることは
できない。従って、配線金属層を例にとると、その幅と
厚さとが同程度の寸法となシ、結果として半導体装置の
表面は激しい凹凸を持つようになる。このような表面の
凹凸は、その上に形成される配線金属の段差部での断線
などの原因となり、素子歩留の著しい低下を招く0その
ため、このような表面の凹凸を絶縁物等により平坦化す
る方法が種々提案されている。以下、従来の表面平坦化
方法の一例について図面により概略的に述べる。
工寸法は縮小の一途をたどっている。ところが、配線金
属層の厚さに関しては配線抵抗の増大の点から、また素
子間分離層の厚さに関しては寄生トランジスタ効果の増
大の点から、いずれも、比例縮小的に小さくすることは
できない。従って、配線金属層を例にとると、その幅と
厚さとが同程度の寸法となシ、結果として半導体装置の
表面は激しい凹凸を持つようになる。このような表面の
凹凸は、その上に形成される配線金属の段差部での断線
などの原因となり、素子歩留の著しい低下を招く0その
ため、このような表面の凹凸を絶縁物等により平坦化す
る方法が種々提案されている。以下、従来の表面平坦化
方法の一例について図面により概略的に述べる。
第1図(a) 、 (b)は、従来例の表面平坦化方法
を工程順に示す流れ図である。
を工程順に示す流れ図である。
第1図(−)は、金属配線形成工程が完了した時点の半
導体装置の断面図であり、シリコン基板1上に熱酸化膜
2.金属配線層3が形成されている。
導体装置の断面図であり、シリコン基板1上に熱酸化膜
2.金属配線層3が形成されている。
金属配線層3の最小幅と厚さとは同程度の寸法であり、
かつ、金属配線層3の隣接相互間に最小幅と深さとが同
程度の寸法であるような間げき4が形成されている。
かつ、金属配線層3の隣接相互間に最小幅と深さとが同
程度の寸法であるような間げき4が形成されている。
次に、第1図(b)に示すように、表面全面に金属配線
層3と同程度の厚さのCVD法で形成されたシリコン酸
化膜(以下、5102膜という)5を成長させ、通常の
フォトリングラフィ法により、金属配線層3上のSio
2膜6を除去する。これにより、間げき4は埋めること
ができるが、一般にフォトリングラフィ法ではマスク合
せずれをゼロにすることは不可能であるため、結果とし
て、金属配線層3上の突起6および金属配線層3と5i
n2膜6との間の空げき7のいずれか一方丑たは両方が
形成されてしまう。突起6を除去したり、または空げき
7を埋め込んで表面を平坦にするためには、非常に複雑
な工程が必要であり、工程数が多く、また制御も容易で
ないため、かえって歩留の低下を招くことがある。
層3と同程度の厚さのCVD法で形成されたシリコン酸
化膜(以下、5102膜という)5を成長させ、通常の
フォトリングラフィ法により、金属配線層3上のSio
2膜6を除去する。これにより、間げき4は埋めること
ができるが、一般にフォトリングラフィ法ではマスク合
せずれをゼロにすることは不可能であるため、結果とし
て、金属配線層3上の突起6および金属配線層3と5i
n2膜6との間の空げき7のいずれか一方丑たは両方が
形成されてしまう。突起6を除去したり、または空げき
7を埋め込んで表面を平坦にするためには、非常に複雑
な工程が必要であり、工程数が多く、また制御も容易で
ないため、かえって歩留の低下を招くことがある。
マスク合せずれを防ぐために、フォトレジストを用いた
リフトオフ法によ)、金属配線層3上の3102膜を自
己整合的に除去し、間げき4を埋め込む方法も提案され
ているが、やはり金属配線層とS iO2膜との間に空
げきが形成され、その空げきを埋めるのに複雑な工程を
要することに変わりはない。
リフトオフ法によ)、金属配線層3上の3102膜を自
己整合的に除去し、間げき4を埋め込む方法も提案され
ているが、やはり金属配線層とS iO2膜との間に空
げきが形成され、その空げきを埋めるのに複雑な工程を
要することに変わりはない。
発明の目的
本発明は、上述のような従来例の問題点を解消するもの
であり、工程が簡単であり、かつ、高集積化に適した半
導体装置表面の平坦化方法を提供するものである。
であり、工程が簡単であり、かつ、高集積化に適した半
導体装置表面の平坦化方法を提供するものである。
発明の構成
本発明は、要約するに、半導体装置表面の一部を光化学
反応により選択的に食刻する工程と、食刻に用いた反応
室から前記半導体装置を取シ出すことなく、前記食刻工
程により食刻された部分と大略同一部分に光化学反応に
より選択的に絶縁膜を形成する工程とをそなえた半導体
装置の表面平坦化方法であり、これにより、簡単な工程
で、突起や空げきの無い平坦な表面を有する半導体装置
を実現することが可能である。
反応により選択的に食刻する工程と、食刻に用いた反応
室から前記半導体装置を取シ出すことなく、前記食刻工
程により食刻された部分と大略同一部分に光化学反応に
より選択的に絶縁膜を形成する工程とをそなえた半導体
装置の表面平坦化方法であり、これにより、簡単な工程
で、突起や空げきの無い平坦な表面を有する半導体装置
を実現することが可能である。
実施例の説明
以下に、実施例を参照して、本発明の詳細な説明する。
第2図(a) 、 (b) 、 (C)は、本発明の一
実施例として、集積回路の配線金属層表面の平坦化過程
を工程順に示す流れ図である。
実施例として、集積回路の配線金属層表面の平坦化過程
を工程順に示す流れ図である。
第2図(a)は、シリコン基板11上に熱酸化法によっ
て形成されたS x O2膜12.アルミニウム薄膜1
3が形成された状態である。この状態の基板を反応室(
不図示)に投入し、反応室を10〜1o−’Pa程度の
圧力1で排気する。
て形成されたS x O2膜12.アルミニウム薄膜1
3が形成された状態である。この状態の基板を反応室(
不図示)に投入し、反応室を10〜1o−’Pa程度の
圧力1で排気する。
次に、この反応室に塩素系の反応ガス、例えば、Cl3
を1o○〜数千P数千Pa圧力になるように導入する。
を1o○〜数千P数千Pa圧力になるように導入する。
ついで、周知の技術である投影露光法などの方法を用い
て、第2図(b)に示す照射範囲15に選択的に光を照
射すると、光化学反応により照射範囲16においてアル
ミニウム薄膜13がエツチングされ、配線層13′と、
間げき14とが形成される。
て、第2図(b)に示す照射範囲15に選択的に光を照
射すると、光化学反応により照射範囲16においてアル
ミニウム薄膜13がエツチングされ、配線層13′と、
間げき14とが形成される。
このエツチングの際のシリコン基板11の温度は室温で
もよいし、2oO℃程度まで加熱してもよいO 次に、反応室からCl3を排出し、再び10−5〜1o
−’P祷度の圧力とした後、シリコンを含む反応ガス、
例えばS I H4と、窒素を含む反応ガス、例えばN
H3とを、10o〜1o00Pa程度の圧力になるよう
に導入する。
もよいし、2oO℃程度まで加熱してもよいO 次に、反応室からCl3を排出し、再び10−5〜1o
−’P祷度の圧力とした後、シリコンを含む反応ガス、
例えばS I H4と、窒素を含む反応ガス、例えばN
H3とを、10o〜1o00Pa程度の圧力になるよう
に導入する。
この状態で、シリコン基板11を200〜400℃程度
の温度に加熱しながら、第2図(c)に示すように、第
2図(b)の工程での照射範囲15と同一の゛部分、す
なわち照射範囲16′に光を照射すると、光化学反応に
より照射範囲15′においてSi3N4膜16が形成さ
れ、間げき14が埋め込まれる。
の温度に加熱しながら、第2図(c)に示すように、第
2図(b)の工程での照射範囲15と同一の゛部分、す
なわち照射範囲16′に光を照射すると、光化学反応に
より照射範囲15′においてSi3N4膜16が形成さ
れ、間げき14が埋め込まれる。
この時Si3N4膜16の膜厚は配線層13′の膜厚と
同程度にするのが適当である。また、Si3N4膜16
0幅は、光強度等の形成条件により変えることが可能な
ので、表面が最も平坦になる条件を得ることは容易であ
る。
同程度にするのが適当である。また、Si3N4膜16
0幅は、光強度等の形成条件により変えることが可能な
ので、表面が最も平坦になる条件を得ることは容易であ
る。
上記一連のエツチング及び膜形成湯圧において、シリコ
ン基板11は反応室外に取り出す必要はない。また、投
影露光に用いるフォトマスク等モ交換または移動する必
要がないので、反応室内でシリコン基板11を固定して
おけば、アルミニウム薄膜13のエツチング時とSi3
N4膜16の膜形成時との光の照射範囲は同一にでき、
工程間の位置ずれは生じない。また、露光法としていわ
ゆるステップ・アンド・リピート法を用いた場合でも、
エツチング時と膜形成時との照射範囲の位置ずれは、基
板が固定されている台座の機械的送り精度のみで決捷る
。この送り精度は、最近の装置では数nm程度が得られ
ており、大きな問題とはならない。また、エツチング時
と膜形成時との基板温度の差による基板の伸縮に関して
も、投影時の像の倍率を機械的に変化させるなどの方法
で容易に対応できる。
ン基板11は反応室外に取り出す必要はない。また、投
影露光に用いるフォトマスク等モ交換または移動する必
要がないので、反応室内でシリコン基板11を固定して
おけば、アルミニウム薄膜13のエツチング時とSi3
N4膜16の膜形成時との光の照射範囲は同一にでき、
工程間の位置ずれは生じない。また、露光法としていわ
ゆるステップ・アンド・リピート法を用いた場合でも、
エツチング時と膜形成時との照射範囲の位置ずれは、基
板が固定されている台座の機械的送り精度のみで決捷る
。この送り精度は、最近の装置では数nm程度が得られ
ており、大きな問題とはならない。また、エツチング時
と膜形成時との基板温度の差による基板の伸縮に関して
も、投影時の像の倍率を機械的に変化させるなどの方法
で容易に対応できる。
上記実施例においては、被エツチング膜はアルミニウム
を例として用いたが、エツチング条件を変えることによ
り、多結晶シリコン、単結晶シリコン、 S 102膜
その他の材料に対しても用いることができる。捷た形成
膜はSi3N4膜を例として用いたが、S z O2膜
、多結晶シリコン膜なども形成することができる。さら
に、半導体基板とじてはシリコン以外の材料を用いるこ
とができるのは言うまでもない。
を例として用いたが、エツチング条件を変えることによ
り、多結晶シリコン、単結晶シリコン、 S 102膜
その他の材料に対しても用いることができる。捷た形成
膜はSi3N4膜を例として用いたが、S z O2膜
、多結晶シリコン膜なども形成することができる。さら
に、半導体基板とじてはシリコン以外の材料を用いるこ
とができるのは言うまでもない。
発明の効果
本発明によれば、次のような効果が有る。
第1に、少ない工程数で表面の平坦化が達成できるので
、素子歩留の良好外半導体素子を得ることができる。
、素子歩留の良好外半導体素子を得ることができる。
第2に、エツチングおよび膜形成にイオンやプラズマの
効果を利用しないので、素子に与える損傷が少なく、電
気的特性の良好な半導体素子を得ることができる。
効果を利用しないので、素子に与える損傷が少なく、電
気的特性の良好な半導体素子を得ることができる。
第3に、エツチング領域と埋込み領域との位置合わせか
、最悪でも装置の機械的精度のみで決剪り、いわゆる工
程間の合わせずれがほとんど発生しないので、表面に微
細な突起や空げきが形成されることがない。
、最悪でも装置の機械的精度のみで決剪り、いわゆる工
程間の合わせずれがほとんど発生しないので、表面に微
細な突起や空げきが形成されることがない。
第1図(a)、−’−(b)は、従来例の表面平坦化方
法の工程順流れ図、第2図(a)〜(C)は本発明実施
例の工程順流れ図である。 1.11・・・・シリコン基板、2.12・萌・・熱酸
化膜、3・・・・・・金属配線層、4.14・・・・・
間げき、6・・・・・CVD酸化膜、6・・・・・・突
起、7・・・・・・空げき、13・・・・・・アルミニ
ウム薄膜、13′・・・・・・配線層、15 、15’
・・・・・・照射範囲、16・・・・・・S 1 s
N 4膜。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第2
図
法の工程順流れ図、第2図(a)〜(C)は本発明実施
例の工程順流れ図である。 1.11・・・・シリコン基板、2.12・萌・・熱酸
化膜、3・・・・・・金属配線層、4.14・・・・・
間げき、6・・・・・CVD酸化膜、6・・・・・・突
起、7・・・・・・空げき、13・・・・・・アルミニ
ウム薄膜、13′・・・・・・配線層、15 、15’
・・・・・・照射範囲、16・・・・・・S 1 s
N 4膜。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第2
図
Claims (1)
- 半導体装置表面の一部を光化学反応により選択的に食刻
する工程と、食刻に用いた反応室から前記半導体装置を
取り出すことなく、前記食刻工程により食刻された部分
と大略同一部分に光化学反応により選択的に絶縁膜を形
成する工程とをそなえた半導体装置表面の平坦化方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13830984A JPS6116529A (ja) | 1984-07-03 | 1984-07-03 | 半導体装置表面の平坦化方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13830984A JPS6116529A (ja) | 1984-07-03 | 1984-07-03 | 半導体装置表面の平坦化方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6116529A true JPS6116529A (ja) | 1986-01-24 |
Family
ID=15218865
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13830984A Pending JPS6116529A (ja) | 1984-07-03 | 1984-07-03 | 半導体装置表面の平坦化方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6116529A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011029222A (ja) * | 2009-07-21 | 2011-02-10 | Murata Mfg Co Ltd | 電子部品 |
-
1984
- 1984-07-03 JP JP13830984A patent/JPS6116529A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011029222A (ja) * | 2009-07-21 | 2011-02-10 | Murata Mfg Co Ltd | 電子部品 |
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