JPS61124227A - 負荷状態判別装置 - Google Patents
負荷状態判別装置Info
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- JPS61124227A JPS61124227A JP59242436A JP24243684A JPS61124227A JP S61124227 A JPS61124227 A JP S61124227A JP 59242436 A JP59242436 A JP 59242436A JP 24243684 A JP24243684 A JP 24243684A JP S61124227 A JPS61124227 A JP S61124227A
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- Circuit Arrangement For Electric Light Sources In General (AREA)
- Electronic Switches (AREA)
- Protection Of Static Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の技術分野１
この発明は、例えば車両における各種ランプ等の電気的
負荷の状態を正確にかつ効率良く検出することができる
ようにした負荷状態判別装置に関する。
負荷の状態を正確にかつ効率良く検出することができる
ようにした負荷状態判別装置に関する。
〔発明の技術的背景及びその問題点］
例えば車両等において、そのヘッドライト、テールラン
プ、ブレーキランプ等の各種ランプの動作状態を監視し
、その短絡状態や断線状態等の異常状態を検出し、この
検出した異常状態を車両の運ｆ１者に通報することは車
両を安全に走行する上で重要なことである。従来、この
ようなランプ等の負荷の短絡状態や（ｇｉ線状態を検出
するのに、負荷を駆動すべく直列に接続されたスイッチ
ング素子、例えばパワーＭＯ８トランジスタに流れる負
荷電流や該ＭＯＳトランジスタのドレイン−ソース間の
電圧Ｖｏｓ等を監視する方法等が既に提案されるに至っ
ている。（特開昭５８−１３９６２４、特開昭５８−２
２２５５４） このような従来の方法においては、例えばＭＯＳトラン
ジスタに流れる負荷電流を監視して短絡状態を検出する
ために、ＭＯＳトランジスタに直列に低抵抗を接続し、
この抵抗の両端の電圧を監視しでいたが、この抵抗には
ランプ駆動時常にランプ駆動電流と同じ値の電流例えば
数アンペア桿度の電流が流れるため、この抵抗の形状が
大きくなる１電力消費も大きいという問題がある。また
、負荷がランプのように電源投入時にラッシュカレン［
・が流れるような場合には、このラッシュカレントを短
絡電流として誤検出することを避けるために、このラッ
シュカレントの期間（例えば数１０ｍ秒）に相当する間
短絡電流の監視を行なわないようにしている。そのため
少くともこの期間の間、ＭＯＳトランジスタに短絡電流
に相当する電流が流れても破損しないように大きな放熱
板を設けなければならないという問題がある。
プ、ブレーキランプ等の各種ランプの動作状態を監視し
、その短絡状態や断線状態等の異常状態を検出し、この
検出した異常状態を車両の運ｆ１者に通報することは車
両を安全に走行する上で重要なことである。従来、この
ようなランプ等の負荷の短絡状態や（ｇｉ線状態を検出
するのに、負荷を駆動すべく直列に接続されたスイッチ
ング素子、例えばパワーＭＯ８トランジスタに流れる負
荷電流や該ＭＯＳトランジスタのドレイン−ソース間の
電圧Ｖｏｓ等を監視する方法等が既に提案されるに至っ
ている。（特開昭５８−１３９６２４、特開昭５８−２
２２５５４） このような従来の方法においては、例えばＭＯＳトラン
ジスタに流れる負荷電流を監視して短絡状態を検出する
ために、ＭＯＳトランジスタに直列に低抵抗を接続し、
この抵抗の両端の電圧を監視しでいたが、この抵抗には
ランプ駆動時常にランプ駆動電流と同じ値の電流例えば
数アンペア桿度の電流が流れるため、この抵抗の形状が
大きくなる１電力消費も大きいという問題がある。また
、負荷がランプのように電源投入時にラッシュカレン［
・が流れるような場合には、このラッシュカレントを短
絡電流として誤検出することを避けるために、このラッ
シュカレントの期間（例えば数１０ｍ秒）に相当する間
短絡電流の監視を行なわないようにしている。そのため
少くともこの期間の間、ＭＯＳトランジスタに短絡電流
に相当する電流が流れても破損しないように大きな放熱
板を設けなければならないという問題がある。
−万、断線状態を検出するのにＭＯＳトランジスタのド
レイン−ソース間の電圧降下を監視する方法においては
、この電圧降下がＭＯＳ トランジスタのオン抵抗に依
存し、かつこれは温度特性に依存しているため、例えば
負荷がブレーキランプのように２乃至４個並列である場
合にはこのオン抵抗のバラツキやＭＯＳトランジスタの
電圧特性の変化による誤差を補正するために別の補正回
路が必要になり、非経済的であるという問題がある。
レイン−ソース間の電圧降下を監視する方法においては
、この電圧降下がＭＯＳ トランジスタのオン抵抗に依
存し、かつこれは温度特性に依存しているため、例えば
負荷がブレーキランプのように２乃至４個並列である場
合にはこのオン抵抗のバラツキやＭＯＳトランジスタの
電圧特性の変化による誤差を補正するために別の補正回
路が必要になり、非経済的であるという問題がある。
［発明の目的〕
この発明は、上記に鑑みてなされたもので、その目的と
するところは、負荷の異常状態を正確かつ迅速に検出で
きる経済的な負荷状態判別装置を提供することにある。
するところは、負荷の異常状態を正確かつ迅速に検出で
きる経済的な負荷状態判別装置を提供することにある。
［発明の概要Ｊ
状態を判別しようとする負荷の電気的特性に相似する負
荷等価手段と、ワンチップに形成され前記負荷の駆動制
御指令によって同時に作動制御せしめられる前記負荷に
給電する第１のスイッチング素子および前記負荷等価手
段に給電する第２のスイッチング素子を有するスイッチ
ング素子と、第１のスイッチング素子の出力信号と第２
のスイッチング素子の出力信号とを比較して前記負荷の
状態を判別する判別手段とを有する構成としたことを要
旨とする。
荷等価手段と、ワンチップに形成され前記負荷の駆動制
御指令によって同時に作動制御せしめられる前記負荷に
給電する第１のスイッチング素子および前記負荷等価手
段に給電する第２のスイッチング素子を有するスイッチ
ング素子と、第１のスイッチング素子の出力信号と第２
のスイッチング素子の出力信号とを比較して前記負荷の
状態を判別する判別手段とを有する構成としたことを要
旨とする。
「発明の実施例」
以下、この発明の実施例を図面を用いて説明する。
第１図はこの発明の一実施例に係わる負荷状態判別装置
の回路図である。この負荷状態判別装置は、負荷として
例えば負荷回路９に示されている４つのランプ１，３．
５．７をスイッチ１１のオンオフ制御により駆動制御し
ようとするものであり、このような負荷の駆動制御にお
いて負荷、すなわちランプ１，３，５．７が断線又は短
絡した場合にこれを検出して短絡信号用出力端子５７及
び断線信号用出力端子５９にそれぞれ短絡信号ＳＳ及び
断線信号ｓｂを出力し、これを例えば保守パネル等に供
給して故障表示を行なおうとするものである。
の回路図である。この負荷状態判別装置は、負荷として
例えば負荷回路９に示されている４つのランプ１，３．
５．７をスイッチ１１のオンオフ制御により駆動制御し
ようとするものであり、このような負荷の駆動制御にお
いて負荷、すなわちランプ１，３，５．７が断線又は短
絡した場合にこれを検出して短絡信号用出力端子５７及
び断線信号用出力端子５９にそれぞれ短絡信号ＳＳ及び
断線信号ｓｂを出力し、これを例えば保守パネル等に供
給して故障表示を行なおうとするものである。
この負荷状態判別装置はｔｒｉ端子１３に供給されでい
る電源電圧＋ＶＢで作動するようになっている。前記ス
イッチ１１の一端はアースに接続され、他端は入力処理
部６７を構成するスイッチ回路１５を介して駆動回路１
９を構成するランプ駆動用ＮチャンネルパワーＭ ＯＳ
ｔ〜ランジスタ２１及び負荷等価回路駆動用Ｎチャン
ネルＭＯＳトランジスタ２３０ゲートに接続されている
。各ＭＯＳトランジスタ２１及び２３は負荷がソースを
介してアース側に接続されたソースホロワを構成してい
るので、各ＭＯＳトランジスタ２１及び２３を駆動する
ゲート信号は前記スイッチ回路１５を介して昇圧回路１
７によって形成される電源電圧＋Ｖａの２倍の電圧Ｖ２
Ｂが供給され、これによって各ＭＯＳトランジスタ２１
．２３はオンオフ動作するようになっている。各ＭＯ８
Ｉ−ランジスタ２１及び２３のドレインは互いに接続さ
れて、前記電源電圧＋ＶＢが供給されている。ランプ駆
動用パワーＭＯＳトランジスタ２１のソースは前記負荷
回路を構成するランプ１．３．５．７の各一端に接続さ
れ、各ランプ１．３．５．７の他端はアースに接続され
ている。負荷等価回路駆動用ＭＯＳトランジスタ２３の
ソースは負荷等価回路４１を構成する抵抗４３の一端に
接続されている。
る電源電圧＋ＶＢで作動するようになっている。前記ス
イッチ１１の一端はアースに接続され、他端は入力処理
部６７を構成するスイッチ回路１５を介して駆動回路１
９を構成するランプ駆動用ＮチャンネルパワーＭ ＯＳ
ｔ〜ランジスタ２１及び負荷等価回路駆動用Ｎチャン
ネルＭＯＳトランジスタ２３０ゲートに接続されている
。各ＭＯＳトランジスタ２１及び２３は負荷がソースを
介してアース側に接続されたソースホロワを構成してい
るので、各ＭＯＳトランジスタ２１及び２３を駆動する
ゲート信号は前記スイッチ回路１５を介して昇圧回路１
７によって形成される電源電圧＋Ｖａの２倍の電圧Ｖ２
Ｂが供給され、これによって各ＭＯＳトランジスタ２１
．２３はオンオフ動作するようになっている。各ＭＯ８
Ｉ−ランジスタ２１及び２３のドレインは互いに接続さ
れて、前記電源電圧＋ＶＢが供給されている。ランプ駆
動用パワーＭＯＳトランジスタ２１のソースは前記負荷
回路を構成するランプ１．３．５．７の各一端に接続さ
れ、各ランプ１．３．５．７の他端はアースに接続され
ている。負荷等価回路駆動用ＭＯＳトランジスタ２３の
ソースは負荷等価回路４１を構成する抵抗４３の一端に
接続されている。
この抵抗４３の他端は別の抵抗４５を介してアースに接
続され、抵抗４３と４５との接続点はコンデンサ４７を
介してアースに接続されている。。
続され、抵抗４３と４５との接続点はコンデンサ４７を
介してアースに接続されている。。
この負荷等価回路４１は前記ランプ１，３．５゜７で構
成される負荷回路９に電気的に等１ｌＩＶｉな回路を構
成しているものであり、抵抗４３及び４５との直列合成
抵抗は負荷回路９を構成する４つの並列に接続されたラ
ンプの合成抵抗を模擬しているものであり、抵抗４５に
並列に接続されたコンデンサ４７はランプ点灯時におけ
るラッシュカレントに相当する電流を流す役目を果して
いるものである。
成される負荷回路９に電気的に等１ｌＩＶｉな回路を構
成しているものであり、抵抗４３及び４５との直列合成
抵抗は負荷回路９を構成する４つの並列に接続されたラ
ンプの合成抵抗を模擬しているものであり、抵抗４５に
並列に接続されたコンデンサ４７はランプ点灯時におけ
るラッシュカレントに相当する電流を流す役目を果して
いるものである。
また、前記ＭＯＳトランジスタ２１．２３は、それぞれ
差動増幅回路２５を構成する抵抗２７及び２９を介して
演算増幅器３１の反転入力端子及び非反転入力端子に接
続されている。この演算増幅器３１には前記昇圧回路１
７からの電源電圧ＶＢの２倍に相当する電圧Ｖ２Ｂが供
給されている。
差動増幅回路２５を構成する抵抗２７及び２９を介して
演算増幅器３１の反転入力端子及び非反転入力端子に接
続されている。この演算増幅器３１には前記昇圧回路１
７からの電源電圧ＶＢの２倍に相当する電圧Ｖ２Ｂが供
給されている。
演算増幅器３１の反転入力端子と出力端子との間には抵
抗３３が接続され、演算増幅器３１の非反転入力端子に
一端が接続された抵抗３５の他端は、直列に接続された
抵抗３９と３７との接続点に接続されている。抵抗３９
の一端には電源電圧＋ＶＢが供給され、抵抗３７の一端
はアースに接続されている。この直列に接続された抵抗
３９と３７との接続点は中点電圧ＶＣを与える心のであ
り、この中点電圧Ｖｃは、例えば電源電圧＋ＶＢの十分
（７） １ （Ｖｃ ＝Ｖａ ／ １０） ニナルヨウ
ニ抵抗４つと４７と・が選択されている。この差動増幅
回路２５は、抵抗２７及び２９を介して供給される入力
端子の差に相当する電圧を演算増幅器３１の出力側から
出力するものであり、今この演算増幅器３１の出力電圧
を■０とし、抵抗２７及び２つを介して供給されるＭＯ
Ｓトランジスタに２１及び２３のソースの電圧をそれぞ
れＶ２ ＋ Ｓ及びｖ２３Ｓとすると、出力電圧ＶＯは
次式のようになる。
抗３３が接続され、演算増幅器３１の非反転入力端子に
一端が接続された抵抗３５の他端は、直列に接続された
抵抗３９と３７との接続点に接続されている。抵抗３９
の一端には電源電圧＋ＶＢが供給され、抵抗３７の一端
はアースに接続されている。この直列に接続された抵抗
３９と３７との接続点は中点電圧ＶＣを与える心のであ
り、この中点電圧Ｖｃは、例えば電源電圧＋ＶＢの十分
（７） １ （Ｖｃ ＝Ｖａ ／ １０） ニナルヨウ
ニ抵抗４つと４７と・が選択されている。この差動増幅
回路２５は、抵抗２７及び２９を介して供給される入力
端子の差に相当する電圧を演算増幅器３１の出力側から
出力するものであり、今この演算増幅器３１の出力電圧
を■０とし、抵抗２７及び２つを介して供給されるＭＯ
Ｓトランジスタに２１及び２３のソースの電圧をそれぞ
れＶ２ ＋ Ｓ及びｖ２３Ｓとすると、出力電圧ＶＯは
次式のようになる。
ｖｏ ＝ｔｌ （Ｖ２３ Ｓ −Ｖ２１ Ｓ ） ＋Ｖ
ｃ−（＋）ここにおいて、今抵抗２７．２９，３３．３
５の抵抗値をそれぞれＲ２ｙ 、 Ｒ２９、Ｒ３３、Ｒ
３５とすると、μ＝Ｒ：＋ ３ ／Ｒ２７＝Ｒ３５／Ｒ
２９である。こり差動増幅回路２５に供給される入力電
圧Ｖ２１ Ｓ及びＶ２３Ｓは、負荷回路が正常すなわち
どのランプにも短絡状態や断線状態が発生していない正
常状態においては等しい値にあるため、差動増幅回路２
５の出力電圧ｖＯは中点電圧ＶＣが出力されているのみ
である。しかしながら、例えばランプの何れかが短絡し
たような場合には、電圧Ｖ２ ＋ Ｓは小さくなるため
、この差動増幅回路２５の差動出力電圧Ｖｏは大きくな
る。
ｃ−（＋）ここにおいて、今抵抗２７．２９，３３．３
５の抵抗値をそれぞれＲ２ｙ 、 Ｒ２９、Ｒ３３、Ｒ
３５とすると、μ＝Ｒ：＋ ３ ／Ｒ２７＝Ｒ３５／Ｒ
２９である。こり差動増幅回路２５に供給される入力電
圧Ｖ２１ Ｓ及びＶ２３Ｓは、負荷回路が正常すなわち
どのランプにも短絡状態や断線状態が発生していない正
常状態においては等しい値にあるため、差動増幅回路２
５の出力電圧ｖＯは中点電圧ＶＣが出力されているのみ
である。しかしながら、例えばランプの何れかが短絡し
たような場合には、電圧Ｖ２ ＋ Ｓは小さくなるため
、この差動増幅回路２５の差動出力電圧Ｖｏは大きくな
る。
また負荷回路９のランプの何れかが断線したような場合
には負荷回路９の合成抵抗は大きくなるため、電圧Ｖ２
、ｓは大きくなり、このため、差動増幅回路２５の差
動出力電圧ＶＯは小さくなる。
には負荷回路９の合成抵抗は大きくなるため、電圧Ｖ２
、ｓは大きくなり、このため、差動増幅回路２５の差
動出力電圧ＶＯは小さくなる。
すなわち、この差動増幅回路２５の出力電圧ＶＯは、負
荷回路９のランプが短絡状態になったのか断線状態にな
ったのかによって正常の値よりも高くなったり低くなっ
たりする。
荷回路９のランプが短絡状態になったのか断線状態にな
ったのかによって正常の値よりも高くなったり低くなっ
たりする。
従って次段の比較部４つにおいては、この差動増幅回路
２５の出力を監視し、その出力電圧ＶＯが所定の基準電
圧より高くなったのか低くなったのかを比較検出するこ
とにより、短絡状態が発生したのか断線状態が発生した
のかを検出し得るのである。差動増幅回路２５の出力は
、比較部４９を・構成する時間遅れ回路５１にまず接続
されている。この時間遅れ回路５１は、ノイズを除去す
るだめのものであり、例えばコンデンサと抵抗からなる
ＣＲ回路により構成されているものである。
２５の出力を監視し、その出力電圧ＶＯが所定の基準電
圧より高くなったのか低くなったのかを比較検出するこ
とにより、短絡状態が発生したのか断線状態が発生した
のかを検出し得るのである。差動増幅回路２５の出力は
、比較部４９を・構成する時間遅れ回路５１にまず接続
されている。この時間遅れ回路５１は、ノイズを除去す
るだめのものであり、例えばコンデンサと抵抗からなる
ＣＲ回路により構成されているものである。
この時間遅れ回路５１によってノイズを除去された信号
は断線検出用の比較器５３の一方の比較入力端子である
非反転入力端子及び短絡検出用比較器５５の一方の比較
入力端子である反転入力端子に入力電圧Ｖｉｎとして供
給されている。断線検出用比較器５３の他方の比較入力
端子である反転入力端子には断線検出用の基ｔ￥雷電圧
ｒｂが供給され、短絡検出用比較器５５の他方の比較入
力端子である非反転入力端子には短絡検出用のＶｒｓが
供給されている。また各比較器５３．５５には電源電圧
子ｖＢが供給されている。差動増幅回路２５から時間遅
れ回路５１を介して各比較器５３．５５に供給される入
力電圧ｖｉｎが、断線検出用基準電圧Ｖｒｂよりも小さ
い場合には、ｆｌＪｉ線検出用比較器５３の出力から断
線信号３ Ｂが出力され、また入力電圧■ｉｎが短絡検
出用基準電圧ｖｒＳよりも大ぎい場合には短絡検出用比
較器５５から短絡信号Ｓｓが出力される。
は断線検出用の比較器５３の一方の比較入力端子である
非反転入力端子及び短絡検出用比較器５５の一方の比較
入力端子である反転入力端子に入力電圧Ｖｉｎとして供
給されている。断線検出用比較器５３の他方の比較入力
端子である反転入力端子には断線検出用の基ｔ￥雷電圧
ｒｂが供給され、短絡検出用比較器５５の他方の比較入
力端子である非反転入力端子には短絡検出用のＶｒｓが
供給されている。また各比較器５３．５５には電源電圧
子ｖＢが供給されている。差動増幅回路２５から時間遅
れ回路５１を介して各比較器５３．５５に供給される入
力電圧ｖｉｎが、断線検出用基準電圧Ｖｒｂよりも小さ
い場合には、ｆｌＪｉ線検出用比較器５３の出力から断
線信号３ Ｂが出力され、また入力電圧■ｉｎが短絡検
出用基準電圧ｖｒＳよりも大ぎい場合には短絡検出用比
較器５５から短絡信号Ｓｓが出力される。
今、負荷回路９を構成する４つのランプが自動車のスト
ップランプであり、各ランプの消費電力が２１１ノツト
であり、電源電圧＋ｖ８が１２ボルトであり、またμ＝
１０と設定した場合の前記断線検出用基準電圧Ｖｒｂ及
び短絡検出用基準電圧Ｖｒｓの設定について説明する。
ップランプであり、各ランプの消費電力が２１１ノツト
であり、電源電圧＋ｖ８が１２ボルトであり、またμ＝
１０と設定した場合の前記断線検出用基準電圧Ｖｒｂ及
び短絡検出用基準電圧Ｖｒｓの設定について説明する。
ランプの断線状態の検出にあたっては、４個のランプの
中の１個が断線場合にも検出できるように、１個のラン
プの消費電流の６０％が減ったとき断線と判断し得るよ
うに、断線検出用比較器５３の基ｒｒ＆電圧Ｖｒｂを設
定する。また短絡状態の検出に対しては４個のランプの
３倍の電流が流れたときに短絡状態と判断し得るように
短絡検出用比較器５５の１１電圧Ｖｒｓを設定する。
中の１個が断線場合にも検出できるように、１個のラン
プの消費電流の６０％が減ったとき断線と判断し得るよ
うに、断線検出用比較器５３の基ｒｒ＆電圧Ｖｒｂを設
定する。また短絡状態の検出に対しては４個のランプの
３倍の電流が流れたときに短絡状態と判断し得るように
短絡検出用比較器５５の１１電圧Ｖｒｓを設定する。
まず、１個のランプが断線した場合の前記差動増幅回路
２５の出力電圧Ｖｏ （すなわら比較器５３．５５に
対する入力電圧Ｖ ｉｎ）は次式のようになる。
２５の出力電圧Ｖｏ （すなわら比較器５３．５５に
対する入力電圧Ｖ ｉｎ）は次式のようになる。
Ｖｏ＝（Ｖａ／１０）−（２１／１２）Ｘ５０× １０
＝ （ＶＢ ／１ ０） −０，８７５＝ ０
．３２５ ここにおいて、上式中に示す５０の単位は、ミリオーム
であり、これは後述するようにランプ駆動用パワーＭｏ
Ｓトランジスタ２１のオン抵抗である。
．３２５ ここにおいて、上式中に示す５０の単位は、ミリオーム
であり、これは後述するようにランプ駆動用パワーＭｏ
Ｓトランジスタ２１のオン抵抗である。
また、短絡時（すなわち４１ｉｌのランプの３倍の電流
が流れたとき）の出力電圧０は次式のようになる。
が流れたとき）の出力電圧０は次式のようになる。
Ｖｏ−（ＶＢ／１０） ＋（２１／１２）Ｘ４Ｘ（４−
１）Ｘ５０Ｘ１０ −（Ｖａ／１０）＋１０．５＝１１．７以上の値から断
線検出用比較器５３の基１［圧■ｒｂ及び短絡検出用比
較器５５用の基準電圧Ｖｒｓは、それぞれ電源電圧変動
等を考慮して０．４７ボルト及び８．０ボルトに設定し
である。
１）Ｘ５０Ｘ１０ −（Ｖａ／１０）＋１０．５＝１１．７以上の値から断
線検出用比較器５３の基１［圧■ｒｂ及び短絡検出用比
較器５５用の基準電圧Ｖｒｓは、それぞれ電源電圧変動
等を考慮して０．４７ボルト及び８．０ボルトに設定し
である。
負荷回路９のランプが短絡した場合にはランプ駆動用Ｍ
ＯＳトランジスタ２１に多大な電流が流れ、これによっ
てＭ ＯＳ トランジスタ２１が破壊される恐れがある
ので、これを防止するために、短絡検出用比較器５５で
検出された短絡信号Ｓｓは保護口２８６１を構成するホ
ールド回路６３に入力されている。ホールド回路６３は
この短絡信号ＳＳが入力されると、その出力により、Ｍ
ＯＳトランジスタ２１に及び２３をカットオフ状態に保
持する劣うにしている。またこのホールド回路６３には
、リセット回路６５を介してスイッチ１１のオフ信号が
供給されるようになっている。これによりスイッチ１１
がオフ状態になった場合リセット回路６５を介して供給
されるスイッチ１１のオフ信号によりホールド回路６３
は初期状態にリセッｊ〜され、ＭＯＳトランジスタ２１
及び２３のカットオフ状態を解除するようになっている
。
ＯＳトランジスタ２１に多大な電流が流れ、これによっ
てＭ ＯＳ トランジスタ２１が破壊される恐れがある
ので、これを防止するために、短絡検出用比較器５５で
検出された短絡信号Ｓｓは保護口２８６１を構成するホ
ールド回路６３に入力されている。ホールド回路６３は
この短絡信号ＳＳが入力されると、その出力により、Ｍ
ＯＳトランジスタ２１に及び２３をカットオフ状態に保
持する劣うにしている。またこのホールド回路６３には
、リセット回路６５を介してスイッチ１１のオフ信号が
供給されるようになっている。これによりスイッチ１１
がオフ状態になった場合リセット回路６５を介して供給
されるスイッチ１１のオフ信号によりホールド回路６３
は初期状態にリセッｊ〜され、ＭＯＳトランジスタ２１
及び２３のカットオフ状態を解除するようになっている
。
次に、駆動回路１つを構成するランプ駆動用Ｎチャンネ
ルパワーＭｏＳトランジスタ２１及び負荷等価回路駆動
用ＮチャンネルＭＯＳトランジスタ２３について説明す
る。これらの各ＭＯ３トランジスタ２１及び２３は、各
種電気的特性を同一にするため第２図に示すようなワン
チップで構成されている。第２図（ａ ）はこのワンチ
ップＭＯＳトランジスタのチップ表面を示した図であり
、第２図（ｂ）はその一部所面を示した図であり、第２
図（Ｃ）はその等両回路を示した図である。
ルパワーＭｏＳトランジスタ２１及び負荷等価回路駆動
用ＮチャンネルＭＯＳトランジスタ２３について説明す
る。これらの各ＭＯ３トランジスタ２１及び２３は、各
種電気的特性を同一にするため第２図に示すようなワン
チップで構成されている。第２図（ａ ）はこのワンチ
ップＭＯＳトランジスタのチップ表面を示した図であり
、第２図（ｂ）はその一部所面を示した図であり、第２
図（Ｃ）はその等両回路を示した図である。
第２図（ａ ）において、７１はランプ駆動用パワーＭ
Ｏ８トランジスタ２１用のソースバットであり、７３は
負荷等価回路駆動用ＭＯＳトランジスタ２３用のソース
パッドであり、７５は両ＭＯＳトランジスタに対するゲ
ートパッドである。この各ソースパッドの大きさの違い
から解るように、ランプ駆動用パワーＭＯ８ｔ−ランジ
スタ２１は５アンペアの負荷を駆動し得るように約２０
０００個のパワーセルで構成され、負荷等価回路駆動用
ＮチャンネルＭＯＳトランジスタ２３はこれに対して５
００分の１の約４０個の単位セルのパワーＭ ＯＳ ｔ
’ランジスタで構成されている。また、夫々のトランジ
スタ２１．２３は、第２図（ｂ）に示すように縦型構造
のＮチャンネル型Ｍ ＯＳ トランジスタで構成され、
これによって大電流が流し得ると共に、自動車用に適す
るように寄生ダイオードがツェナーダイオードとして作
用し、かつサージ耐量の大きいパワーＭＯＳトランジス
タ構造になっている。第２図（０）において７９はゲー
トであり、７７はドレインであり、８１はソースである
。第２図（Ｃ）に示ずように、各ＭＯＳトランジスタ２
１及び２３にはそれぞれ奇生ダイオードによりツェナー
ダイオード８３及び８５が並列に形成され、これによっ
て大きなサージ電圧がソースドレイン間に印加された場
合にも破損を防止し得るようになっている。−例として
、第２図（ａ ＞に示すワンチップ構成のＭＯＳトラン
ジスタのチップサイズは３．５Ｉｌ＋ｍｘ３．５ｍｍで
あり、このチップの裏面側がドレイン電穫になっている
。
Ｏ８トランジスタ２１用のソースバットであり、７３は
負荷等価回路駆動用ＭＯＳトランジスタ２３用のソース
パッドであり、７５は両ＭＯＳトランジスタに対するゲ
ートパッドである。この各ソースパッドの大きさの違い
から解るように、ランプ駆動用パワーＭＯ８ｔ−ランジ
スタ２１は５アンペアの負荷を駆動し得るように約２０
０００個のパワーセルで構成され、負荷等価回路駆動用
ＮチャンネルＭＯＳトランジスタ２３はこれに対して５
００分の１の約４０個の単位セルのパワーＭ ＯＳ ｔ
’ランジスタで構成されている。また、夫々のトランジ
スタ２１．２３は、第２図（ｂ）に示すように縦型構造
のＮチャンネル型Ｍ ＯＳ トランジスタで構成され、
これによって大電流が流し得ると共に、自動車用に適す
るように寄生ダイオードがツェナーダイオードとして作
用し、かつサージ耐量の大きいパワーＭＯＳトランジス
タ構造になっている。第２図（０）において７９はゲー
トであり、７７はドレインであり、８１はソースである
。第２図（Ｃ）に示ずように、各ＭＯＳトランジスタ２
１及び２３にはそれぞれ奇生ダイオードによりツェナー
ダイオード８３及び８５が並列に形成され、これによっ
て大きなサージ電圧がソースドレイン間に印加された場
合にも破損を防止し得るようになっている。−例として
、第２図（ａ ＞に示すワンチップ構成のＭＯＳトラン
ジスタのチップサイズは３．５Ｉｌ＋ｍｘ３．５ｍｍで
あり、このチップの裏面側がドレイン電穫になっている
。
第２図（ａ ＞において、負荷等価回路駆動用ＭｏＳト
ランジスタ２３のソースバッド７３の位置は、チップ全
体の平均チャンネル温度が監視でき、かつワイヤボンド
が容易であるところが望ましい。
ランジスタ２３のソースバッド７３の位置は、チップ全
体の平均チャンネル温度が監視でき、かつワイヤボンド
が容易であるところが望ましい。
単位セルＭｏＳトランジスタのオン抵抗は１にオームで
あるので、約２００００個のＭＯ８ランジスタで構成さ
れるランプ駆動用パワーＭＯＳトランジスタ２１の全体
のオン抵抗は５０ミリＡ−ムである。前述したように、
負荷回路９は２１ワ・ノドのストツノランプを４個並Ｉ
Ｊ１１に構成であるため、ランプ駆動用パワーＭＯＳト
ランジスタ２１がオンした場合には、このパワーＭＯＳ
トランジスタ２１のソース電流１２＋ＳＬよ、次式のよ
うになる。
あるので、約２００００個のＭＯ８ランジスタで構成さ
れるランプ駆動用パワーＭＯＳトランジスタ２１の全体
のオン抵抗は５０ミリＡ−ムである。前述したように、
負荷回路９は２１ワ・ノドのストツノランプを４個並Ｉ
Ｊ１１に構成であるため、ランプ駆動用パワーＭＯＳト
ランジスタ２１がオンした場合には、このパワーＭＯＳ
トランジスタ２１のソース電流１２＋ＳＬよ、次式のよ
うになる。
＋２１３−４Ｘ（２１／１２）Ｘ（ＶＢ／１２＞またこ
の場合のランプ駆動用パワーＭ ＯＳ ｈランラスタ２
１のソースにおける電圧Ｖ２１ Ｓは次代のようになる
。
の場合のランプ駆動用パワーＭ ＯＳ ｈランラスタ２
１のソースにおける電圧Ｖ２１ Ｓは次代のようになる
。
Ｖ２１Ｓ＝ＶＢ−ＲＯＮ２１ＸＩ２１Ｓ負荷等価回路４
１は、前述したようにランプ１゜３．５．７で構成され
る負荷回路９を模擬しているものであるが、この負荷等
価回路４１の各回路定数は正常な状態において前述した
各ＭＯ８ｌ−ランジスタ２１及び２３のソース点におけ
る電圧、すなわち差動増幅回路２５に対する入力電圧ｖ
２１Ｓ及びＶ２３３がＷＬＩイ（Ｖ２１ Ｓ ＝Ｖ２１
１ Ｓ ）になるように決定されている。従って、今抵
抗４３及び４５の値をそれぞれＲ４３及びＲ４５とする
と、両者の直列合成抵抗は次式によって与えられる。
１は、前述したようにランプ１゜３．５．７で構成され
る負荷回路９を模擬しているものであるが、この負荷等
価回路４１の各回路定数は正常な状態において前述した
各ＭＯ８ｌ−ランジスタ２１及び２３のソース点におけ
る電圧、すなわち差動増幅回路２５に対する入力電圧ｖ
２１Ｓ及びＶ２３３がＷＬＩイ（Ｖ２１ Ｓ ＝Ｖ２１
１ Ｓ ）になるように決定されている。従って、今抵
抗４３及び４５の値をそれぞれＲ４３及びＲ４５とする
と、両者の直列合成抵抗は次式によって与えられる。
Ｒ４３＋Ｒ４５＝ （２００００／４０）Ｘ（ＲＬ ／
４ ） −（２００００／４０）Ｘ （１２２／２１Ｘ４） −８５７（Ω） また、この負荷等価回路駆動用ＭＯＳトランジスタ２３
のソース電流１２３Ｓは次式のようになる。
４ ） −（２００００／４０）Ｘ （１２２／２１Ｘ４） −８５７（Ω） また、この負荷等価回路駆動用ＭＯＳトランジスタ２３
のソース電流１２３Ｓは次式のようになる。
１２３＝（４０／２００００） Ｘ Ｉ２１ Ｓ負荷等
価回路４１は、前述したようにランプのラッシュカレン
トを模擬しているものであるが、ここにおいて抵抗４３
はそのラッシュカレントのピーク電流値を決定している
ものであり、コンデンサ４７はラッシュカレントの時定
数を決定している巳のである。そして、各回路定数の関
係は、今抵抗４３及び４５の抵抗値をＲ４３，Ｒ４５と
し、コンデンサ４３の容量値を０４７とすると、実際の
ランプの測定から次の値に設定されている。
価回路４１は、前述したようにランプのラッシュカレン
トを模擬しているものであるが、ここにおいて抵抗４３
はそのラッシュカレントのピーク電流値を決定している
ものであり、コンデンサ４７はラッシュカレントの時定
数を決定している巳のである。そして、各回路定数の関
係は、今抵抗４３及び４５の抵抗値をＲ４３，Ｒ４５と
し、コンデンサ４３の容量値を０４７とすると、実際の
ランプの測定から次の値に設定されている。
（Ｒ４３＋Ｒ４５） ／Ｒ４３＝７
Ｒ４３Ｃ４７＝１０１１ ３
次に本実施例に係る負荷状態判別装置の作用を説明する
。
。
まず正常動作時について説明する。ｉＥ常動作時、すな
わち負荷回路９を構成するランプ１，３，５゜７のいず
れもが断線状態にもなければ短絡状態にもない状態につ
いて説明する。この場合には、スイッチ１１をオンにす
ると、スイッチ回路１５を介して昇圧回路１７からの電
＆Ｍ圧＋ｖ８の２１音の電圧に相当する電圧Ｖ２Ｂが駆
動回路１９のランプ駆動用ＮチャンネルパワーＭ ＯＳ
ｔ”ランジスタ２１及び負荷等価回路駆動用Ｎチャン
ネルＭＯ８＋−ランジスタ２３のグー１−に印加され、
各１’ＶＩ ＯＳトランジスタはオン状態になる。その
結果、各Ｍ ＯＳ ［−ランジスク２１，２３を介して
電源′電圧＋ＶＢからそれぞれ負荷回路９及び負荷等価
回路４１に゛電流が流れ、負荷回路９の各ランプ１．３
゜５．７は点灯する。この各ランプが点幻した瞬間には
、ラッシュカレントとが流れるが、このラッシュカレン
トは負荷等油回路４１においては抵抗４３とこれに直列
に接続されたコンデンサ４７とによって模擬され、負荷
回路９及び負荷等価回路４１で発生する電圧降下Ｖ２１
３及びＶ２３ ｓ 。
わち負荷回路９を構成するランプ１，３，５゜７のいず
れもが断線状態にもなければ短絡状態にもない状態につ
いて説明する。この場合には、スイッチ１１をオンにす
ると、スイッチ回路１５を介して昇圧回路１７からの電
＆Ｍ圧＋ｖ８の２１音の電圧に相当する電圧Ｖ２Ｂが駆
動回路１９のランプ駆動用ＮチャンネルパワーＭ ＯＳ
ｔ”ランジスタ２１及び負荷等価回路駆動用Ｎチャン
ネルＭＯ８＋−ランジスタ２３のグー１−に印加され、
各１’ＶＩ ＯＳトランジスタはオン状態になる。その
結果、各Ｍ ＯＳ ［−ランジスク２１，２３を介して
電源′電圧＋ＶＢからそれぞれ負荷回路９及び負荷等価
回路４１に゛電流が流れ、負荷回路９の各ランプ１．３
゜５．７は点灯する。この各ランプが点幻した瞬間には
、ラッシュカレントとが流れるが、このラッシュカレン
トは負荷等油回路４１においては抵抗４３とこれに直列
に接続されたコンデンサ４７とによって模擬され、負荷
回路９及び負荷等価回路４１で発生する電圧降下Ｖ２１
３及びＶ２３ ｓ 。
すなわち差動増幅回路２５に供給される入力電圧Ｖ２１
８及びＶ２３ｓは常に同じ値になっている。
８及びＶ２３ｓは常に同じ値になっている。
その結果、差動増幅回路２５の出力電圧ＶＯは前述した
式（１）に示すように中点電圧ＶＣのみとなっている。
式（１）に示すように中点電圧ＶＣのみとなっている。
この出力゛電圧■０は比較部４９の時間送れ回路５１に
よってノイズを除去された後各比較器５３．５５の一方
の比較入力に供給され、それぞれ断線検出用基準電圧■
ｒｂ及び短絡検出用Ｖｒｓと比較されるようになってい
る。今の場合、差動増幅回路２５の出力電圧ＶＯは、上
述したように中点電圧ＶＣに等しく、今電源電圧＋ＶＢ
を１２ボルトとするとこの値は１．２ボルトであるので
、断線検出用比較器５３の基準電圧Ｖｒｂの０゜４７ボ
ルトより小さくなく、かつ短絡検出用比較器５５の基準
電圧Ｖｒｓの８．０ボルトよりも大きくないので各比較
器５３．５５は断線信号ｓｂも短絡信号ＳＳも出力する
こはない。従って、前述したホールド回路６３も作動す
ることはなく、負荷回路９のランプはスイッチ１１がオ
ンになっている間点灯し続ける。スイッチ１１をオフに
すると、スイッチ回路１５を介した各ＭＯＳトランジス
タ２１及び２３のゲートに対する入力電圧は除去される
ので、各ＭｏＳトランジスタ２１及び２３はオフ状態に
なり、負荷回路９の各ランプは消灯する。この場合、差
動増幅回路２５に供給される入力電圧Ｖ２１ Ｓ及びＶ
２３Ｓはそれぞれ負荷回路９のランプ及び負荷等価回路
４１の抵抗を介したアース電位になっていて、同じ電位
であるので、差動増幅回路２５の出力電圧ｖＯは前述し
たと同じ値になっており、比較部４９では断線信号ｓｂ
も短絡信号Ｓｓも出力することなく、正常に動作する。
よってノイズを除去された後各比較器５３．５５の一方
の比較入力に供給され、それぞれ断線検出用基準電圧■
ｒｂ及び短絡検出用Ｖｒｓと比較されるようになってい
る。今の場合、差動増幅回路２５の出力電圧ＶＯは、上
述したように中点電圧ＶＣに等しく、今電源電圧＋ＶＢ
を１２ボルトとするとこの値は１．２ボルトであるので
、断線検出用比較器５３の基準電圧Ｖｒｂの０゜４７ボ
ルトより小さくなく、かつ短絡検出用比較器５５の基準
電圧Ｖｒｓの８．０ボルトよりも大きくないので各比較
器５３．５５は断線信号ｓｂも短絡信号ＳＳも出力する
こはない。従って、前述したホールド回路６３も作動す
ることはなく、負荷回路９のランプはスイッチ１１がオ
ンになっている間点灯し続ける。スイッチ１１をオフに
すると、スイッチ回路１５を介した各ＭＯＳトランジス
タ２１及び２３のゲートに対する入力電圧は除去される
ので、各ＭｏＳトランジスタ２１及び２３はオフ状態に
なり、負荷回路９の各ランプは消灯する。この場合、差
動増幅回路２５に供給される入力電圧Ｖ２１ Ｓ及びＶ
２３Ｓはそれぞれ負荷回路９のランプ及び負荷等価回路
４１の抵抗を介したアース電位になっていて、同じ電位
であるので、差動増幅回路２５の出力電圧ｖＯは前述し
たと同じ値になっており、比較部４９では断線信号ｓｂ
も短絡信号Ｓｓも出力することなく、正常に動作する。
次に負荷回路９のランプが断線した場合について説明す
る。ランプが断線した場合には負荷回路９の合成抵抗は
大きくなるので、スイッチ１１がオン状態においてスイ
ッチ回路１５を介して駆動されるランプ駆動用パワーＭ
ｏＳトランジスタ２１のソースの電位、すなわ差動増幅
回路２５に対する入力電圧Ｖ２ 、ｓは負荷等価回路４
１側からの差動増幅回路２５に対する入力電圧Ｖ２３
ｓよりも大きくなり、差動増幅回路２５に対する入力電
圧のバランスはくずれるため、前述したように差動増幅
回路２５の出力電圧Ｖｏは断線検出用比較器５３に対す
る基準電圧Ｖｒｂの０．４７ボルトよりも小さくなる。
る。ランプが断線した場合には負荷回路９の合成抵抗は
大きくなるので、スイッチ１１がオン状態においてスイ
ッチ回路１５を介して駆動されるランプ駆動用パワーＭ
ｏＳトランジスタ２１のソースの電位、すなわ差動増幅
回路２５に対する入力電圧Ｖ２ 、ｓは負荷等価回路４
１側からの差動増幅回路２５に対する入力電圧Ｖ２３
ｓよりも大きくなり、差動増幅回路２５に対する入力電
圧のバランスはくずれるため、前述したように差動増幅
回路２５の出力電圧Ｖｏは断線検出用比較器５３に対す
る基準電圧Ｖｒｂの０．４７ボルトよりも小さくなる。
この結果断線検出用比較器５３は断線信号ｓｂを出力す
る。この断線信＠Ｓｂは断線信号用出力端子５９を介し
て図示せぬ保守パネル等に送出され、故障表示がなされ
るようになっているのである。
る。この断線信＠Ｓｂは断線信号用出力端子５９を介し
て図示せぬ保守パネル等に送出され、故障表示がなされ
るようになっているのである。
次に負荷回路９のランプが短絡状態になった場合につい
て説明する。ランプが短絡状態になった場合には、負荷
回路９の合成抵抗は小さくなるので、差動増幅回路２５
に対する入力電圧Ｖ２ ＋ ３は負荷等価回路４１側か
ら差動増幅回路２５に供給される入力電圧Ｖ２３よりも
小さくなるので、前述したように、差動増幅回路２５の
出力電圧ＶＯは、短絡検出用比較器５５の基ｒ＄電圧ｖ
ｒＳの８゜０ボルトよりも大きくなり、短絡検出用比較
器５５は、短絡信号ＳＳを出力する。その結果この帰路
信号ＳＳは、短絡信号用出力端子５７を介して保守パネ
ルに供給され、これによって短絡状態を示す故障表示が
なされると共に、短絡検出用比較器５５からの短絡出力
信号ＳＳは前記ホールド回路６３を駆動し、このホール
ド回路６３を介して駆動回路１９の各ＭＯＳトランジス
タ２１及び２３をカットオフ状態に付勢し、過大な電流
がランプ駆動用パワーＭＯ３Ｉ−ランジスタ２１に流れ
ないように保護する。このホールド回路６３によるパワ
ーＭＯＳトランジスタのカットオフ状態は、スイッチ１
１がオフの状態に戻ったとき、リセット回路６５を介し
て解除される。
て説明する。ランプが短絡状態になった場合には、負荷
回路９の合成抵抗は小さくなるので、差動増幅回路２５
に対する入力電圧Ｖ２ ＋ ３は負荷等価回路４１側か
ら差動増幅回路２５に供給される入力電圧Ｖ２３よりも
小さくなるので、前述したように、差動増幅回路２５の
出力電圧ＶＯは、短絡検出用比較器５５の基ｒ＄電圧ｖ
ｒＳの８゜０ボルトよりも大きくなり、短絡検出用比較
器５５は、短絡信号ＳＳを出力する。その結果この帰路
信号ＳＳは、短絡信号用出力端子５７を介して保守パネ
ルに供給され、これによって短絡状態を示す故障表示が
なされると共に、短絡検出用比較器５５からの短絡出力
信号ＳＳは前記ホールド回路６３を駆動し、このホール
ド回路６３を介して駆動回路１９の各ＭＯＳトランジス
タ２１及び２３をカットオフ状態に付勢し、過大な電流
がランプ駆動用パワーＭＯ３Ｉ−ランジスタ２１に流れ
ないように保護する。このホールド回路６３によるパワ
ーＭＯＳトランジスタのカットオフ状態は、スイッチ１
１がオフの状態に戻ったとき、リセット回路６５を介し
て解除される。
上記実施例においては、差動増幅回路２５の演算増幅器
３１は、電源電圧として昇圧回路１７から供給される電
源電圧十ＶＢの２倍の電圧を考えているため、バイポー
ラＩＣで実現されている場合について説明したが、スタ
ンバイ電流を少なくするためＭＯ８ＦＥＴ演口増幅器で
実現したいときには、このＩＣの耐圧上の制限から電源
電圧をＶｓとし、かつ演算増幅回路２５の入力抵抗２７
及び２９と直列に電圧レベルシフト回路を挿入すればよ
い。
３１は、電源電圧として昇圧回路１７から供給される電
源電圧十ＶＢの２倍の電圧を考えているため、バイポー
ラＩＣで実現されている場合について説明したが、スタ
ンバイ電流を少なくするためＭＯ８ＦＥＴ演口増幅器で
実現したいときには、このＩＣの耐圧上の制限から電源
電圧をＶｓとし、かつ演算増幅回路２５の入力抵抗２７
及び２９と直列に電圧レベルシフト回路を挿入すればよ
い。
また、差動増幅回路２５の増幅率μは、上記実施例にお
いてはμ＝Ｒ：＋３／Ｒ２ｙであるが、前述したように
負荷回路９のランプが短絡された場合には差動増幅回路
２５に対する入力電圧Ｖ２１Ｓは小さくなる方向であり
、またランプが断線したときには入力電圧Ｖ２１ Ｓは
大きくなる方向であり、更にこれらの場合における電圧
の変化分も大きさ的に異なっていて、扱いづらいので、
増幅率μをランプの短絡時と断線時とで分けることが好
ましい。これは、抵抗３３に並列に抵抗とダイオードと
を直列に繋いだ回路を接続することにより行うことがで
き、こうすることによって検出精度及び全体としての回
路コストを低減することができる。
いてはμ＝Ｒ：＋３／Ｒ２ｙであるが、前述したように
負荷回路９のランプが短絡された場合には差動増幅回路
２５に対する入力電圧Ｖ２１Ｓは小さくなる方向であり
、またランプが断線したときには入力電圧Ｖ２１ Ｓは
大きくなる方向であり、更にこれらの場合における電圧
の変化分も大きさ的に異なっていて、扱いづらいので、
増幅率μをランプの短絡時と断線時とで分けることが好
ましい。これは、抵抗３３に並列に抵抗とダイオードと
を直列に繋いだ回路を接続することにより行うことがで
き、こうすることによって検出精度及び全体としての回
路コストを低減することができる。
上記実施例には負荷回路をｊ！４成するものとしてラン
プを例に挙げた場合について説明したが、この負荷とし
てはランプに限定されるらのでなく、ヒータやその他各
種の抵抗負荷のもの、インダクタンス負荷のもの等種々
のちのに適用できることは勿論のことである。
プを例に挙げた場合について説明したが、この負荷とし
てはランプに限定されるらのでなく、ヒータやその他各
種の抵抗負荷のもの、インダクタンス負荷のもの等種々
のちのに適用できることは勿論のことである。
［発明の効果］
以上説明したように、この発明によれば、第１のスイッ
チング素子で状態を判別しようとする負荷を駆動し、こ
の負荷と略同じ電気的特性を有する負荷等価手段を、前
記第１のスイッチング素子と共にワンチップ上に形成さ
れた第２のスイッチング素子で駆動し、両スイッチング
素子の出力信号を比較して前記負荷の異常状態を判別し
ているので、温度変化等に対する各種電気的特性の変動
を無視することができ、もって正確に、かつ補正回路が
不要のため経済的に前記負荷の異常状態を検出できると
共に、負荷等価回路によりラツシコカレンｉ−等の時間
豹変１ヒを含んで構成されているため、これに対する放
熱対策を必要とせずｆ済的にかつ迅速に前記負荷の異常
状態を検出できる。
チング素子で状態を判別しようとする負荷を駆動し、こ
の負荷と略同じ電気的特性を有する負荷等価手段を、前
記第１のスイッチング素子と共にワンチップ上に形成さ
れた第２のスイッチング素子で駆動し、両スイッチング
素子の出力信号を比較して前記負荷の異常状態を判別し
ているので、温度変化等に対する各種電気的特性の変動
を無視することができ、もって正確に、かつ補正回路が
不要のため経済的に前記負荷の異常状態を検出できると
共に、負荷等価回路によりラツシコカレンｉ−等の時間
豹変１ヒを含んで構成されているため、これに対する放
熱対策を必要とせずｆ済的にかつ迅速に前記負荷の異常
状態を検出できる。
第１図はこの発明の一実施例を示す負荷状態判別装置の
回路図、第２図（ａ＞（ｂ）（ｃ）は第１図の負荷状態
判別装置に使用されるワンチップパワーＭＯＳトランジ
スタの上面図、断面図及び等価回路である。 １．３．５．７・・・ランプ、９・・・負荷回路、１・
・・１・・・スイッチ、１つ・・・駆動回路、２１・・
・ランプ駆動用ＮチャンネルパワーＭＯＳトランジスタ
、２３・・・負荷等価回路駆動用ＮチャンネルＭＯＳト
ランジスタ、２５・・・差動増幅回路、３１・・・演算
増幅器、４１・・・負荷等価回路、４９・・・比較部、
５３・・・断線検出用比較器、５５・・・短絡検出用比
較器、６１・・・保護回路。
回路図、第２図（ａ＞（ｂ）（ｃ）は第１図の負荷状態
判別装置に使用されるワンチップパワーＭＯＳトランジ
スタの上面図、断面図及び等価回路である。 １．３．５．７・・・ランプ、９・・・負荷回路、１・
・・１・・・スイッチ、１つ・・・駆動回路、２１・・
・ランプ駆動用ＮチャンネルパワーＭＯＳトランジスタ
、２３・・・負荷等価回路駆動用ＮチャンネルＭＯＳト
ランジスタ、２５・・・差動増幅回路、３１・・・演算
増幅器、４１・・・負荷等価回路、４９・・・比較部、
５３・・・断線検出用比較器、５５・・・短絡検出用比
較器、６１・・・保護回路。
Claims (1)
- 状態を判別しようとする負荷の電気的特性に相似する負
荷等価手段と、ワンチップに形成され前記負荷の駆動制
御指令によつて同時に作動制御せしめられる前記負荷に
給電する第１のスイッチング素子および前記負荷等価手
段に給電する第２のスイッチング素子を有するスイッチ
ング手段と、第１のスイッチング素子の出力信号と第２
のスイッチング素子の出力信号とを比較して前記負荷の
状態を判別する判別手段とを有することを特徴とする負
荷状態判別装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59242436A JPS61124227A (ja) | 1984-11-19 | 1984-11-19 | 負荷状態判別装置 |
| US06/795,460 US4661717A (en) | 1984-11-19 | 1985-11-06 | Load condition determining apparatus |
| GB08528373A GB2168211B (en) | 1984-11-19 | 1985-11-18 | Electrical load condition determining apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59242436A JPS61124227A (ja) | 1984-11-19 | 1984-11-19 | 負荷状態判別装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61124227A true JPS61124227A (ja) | 1986-06-12 |
| JPH0126250B2 JPH0126250B2 (ja) | 1989-05-23 |
Family
ID=17089060
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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