JPS6072239A - 半導体デバイスの試験方法 - Google Patents
半導体デバイスの試験方法Info
- Publication number
- JPS6072239A JPS6072239A JP17808283A JP17808283A JPS6072239A JP S6072239 A JPS6072239 A JP S6072239A JP 17808283 A JP17808283 A JP 17808283A JP 17808283 A JP17808283 A JP 17808283A JP S6072239 A JPS6072239 A JP S6072239A
- Authority
- JP
- Japan
- Prior art keywords
- wafer
- tester
- testing
- model
- test
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
Landscapes
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は少蓋多品棟又は多品種混合ウェハを自動的(二
試験する半導体デバイスの試験方法に関する。本発明の
方法は例えばゲートアレー構造にて製造された多品種混
合の集積回路ウェハ(ICウェハ)の試験に用いられる
。
試験する半導体デバイスの試験方法に関する。本発明の
方法は例えばゲートアレー構造にて製造された多品種混
合の集積回路ウェハ(ICウェハ)の試験に用いられる
。
従来技術と問題点
近年ICの多様化と共にセミカスタムICの需要が多く
なってきた。これらの多くはゲートアレーを用いて生産
されているが多様化に伴う少量多品種生産のため製造工
程I:於ける作業能率は必ずし良くはない。特に電気的
特性の検査工程に於いては試験項目の増大と共C″−1
品種毎に検査内容が変わるためその都度集積回路テスタ
ー(ICテスター)へのプログラム登録、呼出し等の操
作に時間を要しICテスターの稼動率を低下させてきた
。
なってきた。これらの多くはゲートアレーを用いて生産
されているが多様化に伴う少量多品種生産のため製造工
程I:於ける作業能率は必ずし良くはない。特に電気的
特性の検査工程に於いては試験項目の増大と共C″−1
品種毎に検査内容が変わるためその都度集積回路テスタ
ー(ICテスター)へのプログラム登録、呼出し等の操
作に時間を要しICテスターの稼動率を低下させてきた
。
云うまでもなく少量多品種のゲートアレーではロット構
成が小規模となり極端な場合ではロットの最小単位がウ
ェハの4分の1になることもあるが、一般的C:は数枚
のウェハで1品種が構成される場合、試験装置である全
自動ウェハブローバにおいてロード/アンロード等の機
能を充分に活用しきれない面があった。一方、第1図(
a)、ら)(二示すように1枚のウェハl内に多品種の
回路を製造することは既に行われているが、この場合の
試験は、ウェハの製造に際して図(二矢印で示すような
品種配列(A、B)の制限全段けておき、ウェハプロー
バの制御可能な配列によって試験を行つてきた。
成が小規模となり極端な場合ではロットの最小単位がウ
ェハの4分の1になることもあるが、一般的C:は数枚
のウェハで1品種が構成される場合、試験装置である全
自動ウェハブローバにおいてロード/アンロード等の機
能を充分に活用しきれない面があった。一方、第1図(
a)、ら)(二示すように1枚のウェハl内に多品種の
回路を製造することは既に行われているが、この場合の
試験は、ウェハの製造に際して図(二矢印で示すような
品種配列(A、B)の制限全段けておき、ウェハプロー
バの制御可能な配列によって試験を行つてきた。
しかしながら、このように品種配列全行ってもそれぞれ
の品種(A又はB)毎の試験プログラムの呼び出し、ウ
エハプローバの送りピッチ、方向等(二おいて依然とし
て人手の介入を必要としてきた。
の品種(A又はB)毎の試験プログラムの呼び出し、ウ
エハプローバの送りピッチ、方向等(二おいて依然とし
て人手の介入を必要としてきた。
発明の目的
本発明の目的は少量多品種又は多品種混合ウェハの製造
工程における試験においてウェハに設けられた品種を示
すマークを利用して多品種を自動的に試験し作業能率の
向上を図る半導体デバイスの試験方法を提供することに
ある。
工程における試験においてウェハに設けられた品種を示
すマークを利用して多品種を自動的に試験し作業能率の
向上を図る半導体デバイスの試験方法を提供することに
ある。
発明の構成
この目的は、本発明によれば、少量多品覆着くは多品種
混合のウェハ全試験する半導体デバイスの試験方法にお
いて、ウェハ上に設けられた種別を示す品種コードを光
学的手段を有する品種識別装置を用いて読取り、読取ら
れた信号C二基づいて集積回路テスタよりホスト計算機
へ予め用意された該当する品種を試験するための試験プ
ログラムを呼出し、該試験プログラムが該集積回路テス
タにロードされると該集積回路テスタよりウェハブロー
バ仁スタート信号金送出しウェハの試験を開始すること
を特徴とする半導体デバイスの試験方法、を提供するこ
とに↓って達成される。
混合のウェハ全試験する半導体デバイスの試験方法にお
いて、ウェハ上に設けられた種別を示す品種コードを光
学的手段を有する品種識別装置を用いて読取り、読取ら
れた信号C二基づいて集積回路テスタよりホスト計算機
へ予め用意された該当する品種を試験するための試験プ
ログラムを呼出し、該試験プログラムが該集積回路テス
タにロードされると該集積回路テスタよりウェハブロー
バ仁スタート信号金送出しウェハの試験を開始すること
を特徴とする半導体デバイスの試験方法、を提供するこ
とに↓って達成される。
実施例
第2図は種々の品種(A−E)?!l−有するウェハ1
の収納されたカセットケースを示す。この場合にはlウ
ェハ1品種の場合であるが、このカセットケース2に第
1図(a) 、 (blに示すような1ウエハ内に種々
の品種の含まれる多品種混合ウェハが収納される場合も
ある。
の収納されたカセットケースを示す。この場合にはlウ
ェハ1品種の場合であるが、このカセットケース2に第
1図(a) 、 (blに示すような1ウエハ内に種々
の品種の含まれる多品種混合ウェハが収納される場合も
ある。
第3図は本発明による試験方法を実施する装置を示すブ
ロック図である。これらの装置はホストコンピユータラ
除いてブローパステーション(図示せず)内に組込まれ
る。第3図において、1゜は試験装置としてのウェハプ
ローバであってウェハプローバには集積回路用として数
10本のマルチプローブとX、Yおよび回転方向の位置
合せと自動送9が可能な送り機構を有し、さらC二各集
積回路を選別するためのインカーの取付けも可能である
。試験段階のウェハ上の各回路にはまだ端子を有してい
ないので試験に必要な数のプローブを回路のアルミニウ
ム電極のパッドに接触させる。
ロック図である。これらの装置はホストコンピユータラ
除いてブローパステーション(図示せず)内に組込まれ
る。第3図において、1゜は試験装置としてのウェハプ
ローバであってウェハプローバには集積回路用として数
10本のマルチプローブとX、Yおよび回転方向の位置
合せと自動送9が可能な送り機構を有し、さらC二各集
積回路を選別するためのインカーの取付けも可能である
。試験段階のウェハ上の各回路にはまだ端子を有してい
ないので試験に必要な数のプローブを回路のアルミニウ
ム電極のパッドに接触させる。
これらのプローブは従来はICテスター30に連結され
品種ごとに設けられた試験プログラムを人手によりセッ
トしこのプログラムに従って回路の特性が試験されるが
、本発明においてはウェハブローバlOの後に品種識別
装置20が設けられる。
品種ごとに設けられた試験プログラムを人手によりセッ
トしこのプログラムに従って回路の特性が試験されるが
、本発明においてはウェハブローバlOの後に品種識別
装置20が設けられる。
品種識別装@20L第1図(c)に示す如くチップ3上
に設けられた品種コードSt読取る丸めの光学的手段を
有し読取られた品種コード信号をデジタル信号に変換し
てICテスター30に送出する。
に設けられた品種コードSt読取る丸めの光学的手段を
有し読取られた品種コード信号をデジタル信号に変換し
てICテスター30に送出する。
品種コード信号を受信したICテスター30は複数のI
Cテスターを群管理するホストコンピュータ40の外部
記憶装@50、例えば磁気ディスク、磁気チーブエフそ
の品種に腰当する試験プログラムラ呼び出しICテスタ
ー30(二ロードするOICテスター30にプログラム
がロード京れるとウェハブローバ1 (+にテストベク
トルを示すスタート信号を送出しICの測定を開始1−
・る。1枚のウェハの測定が終了すると再び同様の作業
を繰り返し全ウェハカセットの測定を人手(ニよる試験
プログラムのセラトラ必要とせずに実施することができ
る。tA l 図(a) 、 (b)に示すような1枚
のウェハに多品種が存在する場合には規則的(二配列し
でいる場合はスケジューリングによる自動プログラムロ
ードが丁で(二存在するが、本発明では上述し1こよう
に品種コードの読取Vζ二よる方法である1こめ規則的
な配列でなくとも効率工〈測定することができ、予め数
10枚ないし100枚程度のウェハをウェハ万セットに
収納しておき自動的に試験することが可能である。尚ホ
ストコンピータ側には各品種ごとの試験プログラムが適
切な外部記憶装置50に用意されている。ま1こ説明は
ウェハ段階での試験方法についてなされたがパッケージ
に封入された完成品の試験においてもパッケージC二記
載された品種コードを読取ること(=Lつで同様に試験
し得る。
Cテスターを群管理するホストコンピュータ40の外部
記憶装@50、例えば磁気ディスク、磁気チーブエフそ
の品種に腰当する試験プログラムラ呼び出しICテスタ
ー30(二ロードするOICテスター30にプログラム
がロード京れるとウェハブローバ1 (+にテストベク
トルを示すスタート信号を送出しICの測定を開始1−
・る。1枚のウェハの測定が終了すると再び同様の作業
を繰り返し全ウェハカセットの測定を人手(ニよる試験
プログラムのセラトラ必要とせずに実施することができ
る。tA l 図(a) 、 (b)に示すような1枚
のウェハに多品種が存在する場合には規則的(二配列し
でいる場合はスケジューリングによる自動プログラムロ
ードが丁で(二存在するが、本発明では上述し1こよう
に品種コードの読取Vζ二よる方法である1こめ規則的
な配列でなくとも効率工〈測定することができ、予め数
10枚ないし100枚程度のウェハをウェハ万セットに
収納しておき自動的に試験することが可能である。尚ホ
ストコンピータ側には各品種ごとの試験プログラムが適
切な外部記憶装置50に用意されている。ま1こ説明は
ウェハ段階での試験方法についてなされたがパッケージ
に封入された完成品の試験においてもパッケージC二記
載された品種コードを読取ること(=Lつで同様に試験
し得る。
発明の効果
本発明の方法C二よれば少量多品種又は多品種混合のウ
ェハを製造工程において人手を介さずに効率↓く試験す
ることができる。
ェハを製造工程において人手を介さずに効率↓く試験す
ることができる。
第1図(a) 、 (b)は多品種混合ウニノ1を示テ
図、In図1(c)社チップ内に設けられ1r、、品種
コードを示テ図、 第2図は多品種が収納され1こウェハカセットヲ示す図
、お工ひ 第3図は本発明1ニよる試験方法を実施する装置を示す
ブロック図である。 (符号の説明) 10・・・・・・ウェハフローバ、20・・・・・・品
種識別装置t、30・・・・・・ICテスター、40・
・・・・・ホストコンヒーータ、50・・・・・・外部
記憶装@C第1図 A〈−−〉B 第2図 第3図
図、In図1(c)社チップ内に設けられ1r、、品種
コードを示テ図、 第2図は多品種が収納され1こウェハカセットヲ示す図
、お工ひ 第3図は本発明1ニよる試験方法を実施する装置を示す
ブロック図である。 (符号の説明) 10・・・・・・ウェハフローバ、20・・・・・・品
種識別装置t、30・・・・・・ICテスター、40・
・・・・・ホストコンヒーータ、50・・・・・・外部
記憶装@C第1図 A〈−−〉B 第2図 第3図
Claims (1)
- 1、少量多品積着くは多品種混合のウェハを試験する半
導体デバイスの試験方法において、ウェハ上シニ設けら
れ7ca別を示す品種コードを光学的手段を有する品種
識別装置を用いて読取り、読取うtL7c信号(二基づ
いて集積回路テスタよりホスト計算機へ予め用意された
該当する品種を試験するための試験プログラムを呼出し
、咳試験プログラムが該集積回路テスタにロードされる
と該集積回路テスタよりウエハブローパにスタートCa
号f送出しウェハの試験を開始する仁と?!−特徴とす
る半導体デバイスの試験方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17808283A JPS6072239A (ja) | 1983-09-28 | 1983-09-28 | 半導体デバイスの試験方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17808283A JPS6072239A (ja) | 1983-09-28 | 1983-09-28 | 半導体デバイスの試験方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6072239A true JPS6072239A (ja) | 1985-04-24 |
Family
ID=16042306
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17808283A Pending JPS6072239A (ja) | 1983-09-28 | 1983-09-28 | 半導体デバイスの試験方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6072239A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0250448A (ja) * | 1988-08-12 | 1990-02-20 | Nec Kyushu Ltd | 半導体集積回路測定装置 |
US20150127986A1 (en) * | 2012-08-30 | 2015-05-07 | Advantest Corporation | Test program and test system |
-
1983
- 1983-09-28 JP JP17808283A patent/JPS6072239A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0250448A (ja) * | 1988-08-12 | 1990-02-20 | Nec Kyushu Ltd | 半導体集積回路測定装置 |
US20150127986A1 (en) * | 2012-08-30 | 2015-05-07 | Advantest Corporation | Test program and test system |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3009743B2 (ja) | 半導体デバイス搬送処理装置 | |
US4985676A (en) | Method and apparatus of performing probing test for electrically and sequentially testing semiconductor device patterns | |
KR19980042525A (ko) | 반도체 제조 공정중에 정보를 저장하는 시스템, 방법 및 장치 | |
CN108807212A (zh) | 晶圆测试方法及晶圆测试装置 | |
US7719301B2 (en) | Testing method of semiconductor integrated circuit and information recording medium | |
US6830941B1 (en) | Method and apparatus for identifying individual die during failure analysis | |
CN102928761B (zh) | 晶圆测试***及晶圆测试方法 | |
JP2765771B2 (ja) | 半導体記憶装置の試験方法 | |
US6974710B2 (en) | Fabrication method of semiconductor integrated circuit device and testing method | |
JPS6072239A (ja) | 半導体デバイスの試験方法 | |
JP2951166B2 (ja) | 半導体テスト装置、半導体テスト回路チップ及びプローブカード | |
JP2011226809A (ja) | 半導体試験方法および半導体試験システム | |
JPS59202652A (ja) | 半導体装置の製造方法 | |
JP4409687B2 (ja) | 電子部品試験装置および電子部品の試験方法 | |
JPH0252446A (ja) | 集積回路の試験装置 | |
CN117476082A (zh) | 多芯片集成测试方法及*** | |
TW562929B (en) | Wafer level board/card assembly method and equipment thereof | |
CN213633700U (zh) | 一种可适应于智能开关控制芯片测试和成品测试*** | |
TW562947B (en) | Analysis method for memory repair | |
JP2549085B2 (ja) | 半導体試験装置 | |
JP2002156404A (ja) | 半導体測定方法及び半導体測定装置 | |
JP3287590B2 (ja) | 半導体集積回路装置 | |
JPS604234A (ja) | 集積回路装置 | |
JPH02119235A (ja) | プローブ装置 | |
CN117409842A (zh) | 多项目晶圆测试***及方法 |