JPS59229686A - Icカ−ド - Google Patents
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- JPS59229686A JPS59229686A JP58103346A JP10334683A JPS59229686A JP S59229686 A JPS59229686 A JP S59229686A JP 58103346 A JP58103346 A JP 58103346A JP 10334683 A JP10334683 A JP 10334683A JP S59229686 A JPS59229686 A JP S59229686A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、集積回路チップをカード状基体に組込んで
なるICカードに関する。
なるICカードに関する。
近年の著しい半導体集積回路技術および実装技術の進歩
によシ、従来から広く用いられているクレジットカード
、キャッシュカード等と同様のグラスチック製カードに
情報処理機能を有する集積回路チップ(以下、ICチッ
プという)、すなわち比較的簡単なCPUおよびメモI
J t−実装した、いわゆるICカードが開発され実用
段階に達しつつある。
によシ、従来から広く用いられているクレジットカード
、キャッシュカード等と同様のグラスチック製カードに
情報処理機能を有する集積回路チップ(以下、ICチッ
プという)、すなわち比較的簡単なCPUおよびメモI
J t−実装した、いわゆるICカードが開発され実用
段階に達しつつある。
第1図はこのようなICカードの一構成例を示すもので
、グラスチック製のカード状基体1に従来のクレジット
カード等の磁気カードとの互換性を確保するための磁気
ストライプ(図示せず)とICエリア2が構成されてい
る。ICエリア2は第1図(b)にその断面を拡大して
示すように、カード状基体1に形成した凹部にスペーサ
3を介して固定した支持板4の内側面上にICチップ5
を取付け、このICチ、fsの端子(デンディングパッ
ド)をリード線6を介して支持板4上に被着形成させた
5〜8個程度の電極7に接続し、これらの電極7全通し
てICチップ5とICカードリーグ等の外部装置との接
続をなすように構成されたものである。
、グラスチック製のカード状基体1に従来のクレジット
カード等の磁気カードとの互換性を確保するための磁気
ストライプ(図示せず)とICエリア2が構成されてい
る。ICエリア2は第1図(b)にその断面を拡大して
示すように、カード状基体1に形成した凹部にスペーサ
3を介して固定した支持板4の内側面上にICチップ5
を取付け、このICチ、fsの端子(デンディングパッ
ド)をリード線6を介して支持板4上に被着形成させた
5〜8個程度の電極7に接続し、これらの電極7全通し
てICチップ5とICカードリーグ等の外部装置との接
続をなすように構成されたものである。
しかしながら、このような構造ではICチップ5上の端
子からリード線6を取出すためのスペースが必要である
ため、カードの厚みを小さくすることが困難であシ、ま
た実装工程がワイヤボンディングを含み複雑であるとい
う問題がある・さらに、多数の電極7と外部装置との接
続の信頼性を確保することが難しいことも欠点となって
いる。
子からリード線6を取出すためのスペースが必要である
ため、カードの厚みを小さくすることが困難であシ、ま
た実装工程がワイヤボンディングを含み複雑であるとい
う問題がある・さらに、多数の電極7と外部装置との接
続の信頼性を確保することが難しいことも欠点となって
いる。
この発明の目的は、薄形化に適した構造で、実装も容易
であシ、さらに外部装置との電気的接続を確実に行なう
ことができるICカードを提供することである。
であシ、さらに外部装置との電気的接続を確実に行なう
ことができるICカードを提供することである。
この発明は、ICチップに電源大刀および信号の入出力
を兼ねる2個の端子を対向する2つの面に位置するよう
に設けるとともに、カード状基体の表裏両面にICチッ
プの2個の端子と接続された電極を配設したことを特徴
としている。
を兼ねる2個の端子を対向する2つの面に位置するよう
に設けるとともに、カード状基体の表裏両面にICチッ
プの2個の端子と接続された電極を配設したことを特徴
としている。
この発明によれば、ICチップの端子をカード状基体上
の電極に直接接続できるため、従来のリード線によるポ
ンディングを用いた場合のようなボンディングのための
スペースが不要となシ、ICカードの厚みをよシ薄くす
ることができる。また、煩雑なワイヤボンディングが不
要となることで実装が簡単となシ、工数の大幅な削減が
可能となる。
の電極に直接接続できるため、従来のリード線によるポ
ンディングを用いた場合のようなボンディングのための
スペースが不要となシ、ICカードの厚みをよシ薄くす
ることができる。また、煩雑なワイヤボンディングが不
要となることで実装が簡単となシ、工数の大幅な削減が
可能となる。
さらに、電極数が少ないことを電極面積を大きくとれる
ことによって、外部装置との電気的接続が容易かつ確実
となシ、動作の信頼性を上げることができる。この場合
、副次的効果としてICチップの端子が信号入出力のみ
ならず電源入力を兼ねているため、大きな電流が流れる
ことによる電極のクリーニング作用が期待できることも
信頼性の向上に寄与する。
ことによって、外部装置との電気的接続が容易かつ確実
となシ、動作の信頼性を上げることができる。この場合
、副次的効果としてICチップの端子が信号入出力のみ
ならず電源入力を兼ねているため、大きな電流が流れる
ことによる電極のクリーニング作用が期待できることも
信頼性の向上に寄与する。
また、電極の形状、大きさの自由度が高いため、外部装
置側の電極配置、形状等を工夫することで、ICカード
の挿入方向の制限を取シ除く、あるいは緩和することも
可能である。
置側の電極配置、形状等を工夫することで、ICカード
の挿入方向の制限を取シ除く、あるいは緩和することも
可能である。
第2図はこの発明の一実施例に係るICカードの断面図
である。図において、ICチップ10は対向する2つの
面上に電源入力および信号の入出力を兼ねる第1.第2
の端子11.12が形成されたもので、グラスチック等
の絶縁材料からなる2枚のカード状基体13.14によ
って保持され、かつ端子11.12はそれぞれカード状
基体13.14に形成された電極15゜16に接続され
ている。すなわち、カード状基体13.14はICエリ
アに、径が2段階に変化する貫通孔を有し、この孔の径
大部を互いに対向させて接続剤にて貼合せられることに
よってICチ、ゾ10を挟持固定する。電極15゜16
はこの場合、カード状基体13.14の上記貫通孔の径
小部に充填された導電性エポキシ樹脂等の導電物質から
なシ、ICチップ10の端子11.12と後述する外部
装置とを接続する役割を果たす。
である。図において、ICチップ10は対向する2つの
面上に電源入力および信号の入出力を兼ねる第1.第2
の端子11.12が形成されたもので、グラスチック等
の絶縁材料からなる2枚のカード状基体13.14によ
って保持され、かつ端子11.12はそれぞれカード状
基体13.14に形成された電極15゜16に接続され
ている。すなわち、カード状基体13.14はICエリ
アに、径が2段階に変化する貫通孔を有し、この孔の径
大部を互いに対向させて接続剤にて貼合せられることに
よってICチ、ゾ10を挟持固定する。電極15゜16
はこの場合、カード状基体13.14の上記貫通孔の径
小部に充填された導電性エポキシ樹脂等の導電物質から
なシ、ICチップ10の端子11.12と後述する外部
装置とを接続する役割を果たす。
第3図(a)(b)はICチップ101cモノリシツク
で構成した場合の端子11.12の配設構造の例を示す
もので、半導体基板30の素子領域の上にあるアルミ等
の電極配線31上に5102、ポリイミド、シリコン窒
化膜等からなる絶縁層32を形成し、その上に第1の端
子11を蒸着等によシ被着形成し、また基板30の裏面
に第2の端子12を蒸着形成している。ここで第2の端
子12はアース端子となるもので、体)の例では基板3
0上のアース配線31′と内部的に接続され、(b)の
例では基板30の側面上で導電性エポキシ樹脂等の導電
性接着物質33、例えば銀ペーストによってアース配線
31′と接続されている。
で構成した場合の端子11.12の配設構造の例を示す
もので、半導体基板30の素子領域の上にあるアルミ等
の電極配線31上に5102、ポリイミド、シリコン窒
化膜等からなる絶縁層32を形成し、その上に第1の端
子11を蒸着等によシ被着形成し、また基板30の裏面
に第2の端子12を蒸着形成している。ここで第2の端
子12はアース端子となるもので、体)の例では基板3
0上のアース配線31′と内部的に接続され、(b)の
例では基板30の側面上で導電性エポキシ樹脂等の導電
性接着物質33、例えば銀ペーストによってアース配線
31′と接続されている。
次に、ICチップ10の具体的な回路構成を説明する。
第4図(a)(b)はICチッf10および外部装置2
0の回路構成を原理的に示すもので、体)は電圧駆動形
の例、(b)は電流駆動形の例である。
0の回路構成を原理的に示すもので、体)は電圧駆動形
の例、(b)は電流駆動形の例である。
第4図(a)において、外部装置20はICチッfxo
への電力供給を行なうための直流電圧源voと、送信デ
ータ信号S1に対応して電圧が0とVsとの2値に変化
する可変電圧源Vsと、電流変化検出用の抵抗rと、直
流成分阻止用のコンデンサC1および受信データ信号S
2を得るセンスアンプA1とからなっている。
への電力供給を行なうための直流電圧源voと、送信デ
ータ信号S1に対応して電圧が0とVsとの2値に変化
する可変電圧源Vsと、電流変化検出用の抵抗rと、直
流成分阻止用のコンデンサC1および受信データ信号S
2を得るセンスアンプA1とからなっている。
一方、ICチ、プ10はCPU 、メモリ等を含む負荷
回路RLと、このRLに流れ込む電流変化を検出するた
めの直流成分阻止用のレベルシフト回路LSおよび受信
データ信号83を得るセンスアンfA2と、送信データ
信号S4に応じて抵抗値がωとR8との2値に変化する
可変抵抗Rsとからなっておシ、端子11.12を介し
て外部装置20に接続されている。
回路RLと、このRLに流れ込む電流変化を検出するた
めの直流成分阻止用のレベルシフト回路LSおよび受信
データ信号83を得るセンスアンfA2と、送信データ
信号S4に応じて抵抗値がωとR8との2値に変化する
可変抵抗Rsとからなっておシ、端子11.12を介し
て外部装置20に接続されている。
今、外部装置20よ、9ICチツグ10へ送信データ信
号S1が送られる場合を考える。この状態では可変抵抗
R8の値はωとされておシ、センスアンプA2の入力に
はピーク・ツウ・ビークれが増幅されて受信データ信号
S3として取出される。なお、rは抵抗rの抵抗値、R
Lは負荷回路九の等側内部抵抗を表わす。一方、逆にI
Cチップ10よシ外部装置20へ送信データS4が送ら
れる場合には、可変電圧源■8の電圧は0とされ、セン
スアンプA1の入力にはピーク・ツウ・ピークで (亙釦蓄−閂)・・・ なる方形波電圧が印加され、これが増幅されて受信デー
タ信号S2として取出される。■0は直流電圧源■oの
電圧を表わす0なお・負荷回路RLの等側内部抵抗RL
はICチップ10の内部状態によらず、はぼ一定の値を
示すものとする。
号S1が送られる場合を考える。この状態では可変抵抗
R8の値はωとされておシ、センスアンプA2の入力に
はピーク・ツウ・ビークれが増幅されて受信データ信号
S3として取出される。なお、rは抵抗rの抵抗値、R
Lは負荷回路九の等側内部抵抗を表わす。一方、逆にI
Cチップ10よシ外部装置20へ送信データS4が送ら
れる場合には、可変電圧源■8の電圧は0とされ、セン
スアンプA1の入力にはピーク・ツウ・ピークで (亙釦蓄−閂)・・・ なる方形波電圧が印加され、これが増幅されて受信デー
タ信号S2として取出される。■0は直流電圧源■oの
電圧を表わす0なお・負荷回路RLの等側内部抵抗RL
はICチップ10の内部状態によらず、はぼ一定の値を
示すものとする。
ちなみにRL=100Ω、r=100Ω、Rs=575
Ω、V、=0.4V、Vo=5Vとすると、センスアン
プAI+A2の入力電圧はいずれも0.2 V、、、と
なシ、センスアンプにて十分検知可能な電圧となる。
Ω、V、=0.4V、Vo=5Vとすると、センスアン
プAI+A2の入力電圧はいずれも0.2 V、、、と
なシ、センスアンプにて十分検知可能な電圧となる。
一方、第4図(blの電流駆動形構成によれば、外部装
置20はICチップ10へ電力供給を行なうだめの電流
源1.と、送信データ信号Slに対応して電流がOとI
sとの2値に変化する可変電流源rsと、電圧変化を検
出するだめの直流成分阻止用のコンデンサC1およびセ
ンスアンプA、とからなっている。ま7z、ICチップ
10は負荷回路恥と、この負荷回路RLに印加される電
圧変化を検出するだめの直流成分阻止用のレベルシフト
回路L8およびセンスアy f A2 ト、送信データ
信号S4に対応して抵抗値が0とR8との2値に変化す
る可変抵抗R,とからなっている。
置20はICチップ10へ電力供給を行なうだめの電流
源1.と、送信データ信号Slに対応して電流がOとI
sとの2値に変化する可変電流源rsと、電圧変化を検
出するだめの直流成分阻止用のコンデンサC1およびセ
ンスアンプA、とからなっている。ま7z、ICチップ
10は負荷回路恥と、この負荷回路RLに印加される電
圧変化を検出するだめの直流成分阻止用のレベルシフト
回路L8およびセンスアy f A2 ト、送信データ
信号S4に対応して抵抗値が0とR8との2値に変化す
る可変抵抗R,とからなっている。
今、外部装置20からICチップ10へ送信データS1
が送られる場合は、可変抵抗R8はRs ”” O、す
なわち短絡状態とされておシ、センスアンfA2の入力
にはピーク・ツウ・ピークでl5RLfiる方形波電圧
が印加され、これが増幅されて受信データS3として取
出される。逆にICチップ10から外部装置4Qへ送信
データ8番が送られる場合は、可変電流源Isの電流が
0とされることにより、センスアンプA、の入力にピー
ク・ツウ・ピークでIoRsなる方形波電圧が印加され
、これが増幅されて受信データS3として取出される。
が送られる場合は、可変抵抗R8はRs ”” O、す
なわち短絡状態とされておシ、センスアンfA2の入力
にはピーク・ツウ・ピークでl5RLfiる方形波電圧
が印加され、これが増幅されて受信データS3として取
出される。逆にICチップ10から外部装置4Qへ送信
データ8番が送られる場合は、可変電流源Isの電流が
0とされることにより、センスアンプA、の入力にピー
ク・ツウ・ピークでIoRsなる方形波電圧が印加され
、これが増幅されて受信データS3として取出される。
Rt、 = 100Ω、Rs = 8Ω、Io = 2
5mAs Is = 2mAとすれば、センスアンプ
A□IA2の入力電圧は0.2V、pと、十分検知可能
な電圧となる。
5mAs Is = 2mAとすれば、センスアンプ
A□IA2の入力電圧は0.2V、pと、十分検知可能
な電圧となる。
なお、上記説明では負荷回路RLの等側内部抵抗RL’
t”はぼ一定としたが、実際にはその内部動作状態の変
化に伴なって変化し、その変化はセンスアンプA2の入
力に誤差電圧として現われ、Sハの低下を招き、誤動作
の原因ともなる。S/N i 10 dB以上確保する
ものとすると、送受信データ信号の周波数近傍以上の抵
抗RLの変化は第4図(a)の電圧駆動形構成では±3
0%まで、また(blの電流駆動形構成では±2.5%
まで許容されることになり、(&)の電圧駆動形構成の
方がSハの点で有利となる。
t”はぼ一定としたが、実際にはその内部動作状態の変
化に伴なって変化し、その変化はセンスアンプA2の入
力に誤差電圧として現われ、Sハの低下を招き、誤動作
の原因ともなる。S/N i 10 dB以上確保する
ものとすると、送受信データ信号の周波数近傍以上の抵
抗RLの変化は第4図(a)の電圧駆動形構成では±3
0%まで、また(blの電流駆動形構成では±2.5%
まで許容されることになり、(&)の電圧駆動形構成の
方がSハの点で有利となる。
負荷回路RLの抵抗変化(負荷変動)によるセンスアン
プA20入力電圧の変動を許容値以下に抑えるだめの方
策としては、例えば第5図(a)(b)に示すように負
荷回路RLと直列または並列にダミー抵抗Roを付加し
、RLの変動による影響な少なくする方法がある。また
、第5図(IL)(b)をさらに発展させ、第5図(c
) (d)に示すようにRLの変動を制御回路C0NT
よシ検出し、それに応じてダミー抵抗Rnの値を変化さ
せることによって、負荷が常に本来の機能を発揮してい
るときの最大負荷近傍の一定値となるよう制御すれば一
層効果的である〇 別の方法としては、負荷回路RL自身に状態変化による
負荷変動の少ないものを用いるとか、あるいはデータ信
号の送受信時は例えばバッファメモリの書込み、読出し
動作など単純かつ負荷変動のよシ小さい動作のみを行な
い、それ以外の複雑でより大きい負荷変動を伴なう動作
は送受信時板外の状態において行なうなどの方法も有効
である。
プA20入力電圧の変動を許容値以下に抑えるだめの方
策としては、例えば第5図(a)(b)に示すように負
荷回路RLと直列または並列にダミー抵抗Roを付加し
、RLの変動による影響な少なくする方法がある。また
、第5図(IL)(b)をさらに発展させ、第5図(c
) (d)に示すようにRLの変動を制御回路C0NT
よシ検出し、それに応じてダミー抵抗Rnの値を変化さ
せることによって、負荷が常に本来の機能を発揮してい
るときの最大負荷近傍の一定値となるよう制御すれば一
層効果的である〇 別の方法としては、負荷回路RL自身に状態変化による
負荷変動の少ないものを用いるとか、あるいはデータ信
号の送受信時は例えばバッファメモリの書込み、読出し
動作など単純かつ負荷変動のよシ小さい動作のみを行な
い、それ以外の複雑でより大きい負荷変動を伴なう動作
は送受信時板外の状態において行なうなどの方法も有効
である。
あるものの同時には行なわない、いわゆるピンポン伝送
であるが、例えば第6図に示すようにセンスアンプ人の
前に自装置(ICチップ10または外部装置20)よシ
送信したデータ信号を打消すためのハイブリッド回路a
ybを挿入することによって、双方向同時伝送を行なう
ことも可能である。
であるが、例えば第6図に示すようにセンスアンプ人の
前に自装置(ICチップ10または外部装置20)よシ
送信したデータ信号を打消すためのハイブリッド回路a
ybを挿入することによって、双方向同時伝送を行なう
ことも可能である。
第7図は第4図(a)の電圧駆動形構成をよシ具体的に
示すもので、ICチップ1oにおいてスイッチングトラ
ンジスタ(図示の例ではMOSFET ) 102およ
び抵抗102は可変抵抗RSニ、レベルシフト回路10
3はレベルシフト回路り、S’に、抵抗104およびコ
ンパレータ;’105はセンスアンプA2にそれぞれ対
応し、また安定化電源106並びにここから電力の供給
を受ける同期発振器107、エンコーダ108、デコー
ダ109、コントローラおよびメモリ110は負荷回路
RLに対地している。一方、外部装置20において電源
201は電圧源Voに、抵抗202は抵抗rに、ドライ
バ203およびコンデンサ204は可変電圧源VBに、
コンデンサ205はコンデンサc1に、また抵抗206
おヨヒコンノ4レータ207はセンスアンプA1に、そ
れぞれ対応している〇 さて、上記構成において、ICチップ10と外部装置2
0との間で送受されるデータ信号は、第8図に示すよう
にデータ信号部の初めに装置間でのクロック信号の同期
をとるだめのプリアンプル信号が付加されたもので、そ
の後に所望のデータ信号、さらに必要があればデータ信
号の後にCRC等の誤シ訂正符号が付加される。これら
の信号はクロック信号を重畳する形式の符号、例えば第
9図に示すようなマンチェスタ符号に変換されている。
示すもので、ICチップ1oにおいてスイッチングトラ
ンジスタ(図示の例ではMOSFET ) 102およ
び抵抗102は可変抵抗RSニ、レベルシフト回路10
3はレベルシフト回路り、S’に、抵抗104およびコ
ンパレータ;’105はセンスアンプA2にそれぞれ対
応し、また安定化電源106並びにここから電力の供給
を受ける同期発振器107、エンコーダ108、デコー
ダ109、コントローラおよびメモリ110は負荷回路
RLに対地している。一方、外部装置20において電源
201は電圧源Voに、抵抗202は抵抗rに、ドライ
バ203およびコンデンサ204は可変電圧源VBに、
コンデンサ205はコンデンサc1に、また抵抗206
おヨヒコンノ4レータ207はセンスアンプA1に、そ
れぞれ対応している〇 さて、上記構成において、ICチップ10と外部装置2
0との間で送受されるデータ信号は、第8図に示すよう
にデータ信号部の初めに装置間でのクロック信号の同期
をとるだめのプリアンプル信号が付加されたもので、そ
の後に所望のデータ信号、さらに必要があればデータ信
号の後にCRC等の誤シ訂正符号が付加される。これら
の信号はクロック信号を重畳する形式の符号、例えば第
9図に示すようなマンチェスタ符号に変換されている。
外部装置20内の別の回路により上記のプリアングル信
号等が付加され、さらに符号化された送信データ信号S
1は、ドライバ203、コンデンサ204を経てICチ
、プ10へ送られ、端子11、コンデンサ103を介し
てコンパレータ105及び同期発振器107に印加され
る。上述の符号化信号よシクロツク信号を抽出するため
の回路金偏えた同期信号発振器107では、抽出したク
ロック信号と同期したよル高い周波数のクロック信号を
発生し、エンコーダ108、デコーダ109さらにコン
トロールおよびメモリ110に供給する。一方、レベル
シフト回路10Bを通して検出されコンパレータ104
によシ整形および増幅された信号は、デコーダ109に
て復号化され、受信データ信号S3としてコントローラ
およびメモリ110に送られる。逆にICチップ10よ
シ外部装置20に送信データ信号84を送る場合は、7
リーランニング状態となった同期発振器107からのク
ロック信号を受けてコントローラおよびメモリ110で
プリアンプル信号等が付加された送信データ信号が生成
され、さらにエンコーダ108にて符号化された後、こ
の符号化信号によってトランジスタ101が0N10F
Fされることによって、抵抗103に流れる電流が制御
される。この電流変化は端子11゜12を介して外部装
置20に伝送され、コンデンサ205を経て抵抗206
及びコンパレータ207にて検出、増幅された後、外部
装置20内の別の回路に供給される、また外部装置20
よシICチップ10内に端子11.12f介して供給さ
れた直流電力は、第9図に示すように端子11の平均電
圧VTよシ低い電圧VDDに安定化電源106にて変換
され、ICチ、プ10内の電源として供給される。
号等が付加され、さらに符号化された送信データ信号S
1は、ドライバ203、コンデンサ204を経てICチ
、プ10へ送られ、端子11、コンデンサ103を介し
てコンパレータ105及び同期発振器107に印加され
る。上述の符号化信号よシクロツク信号を抽出するため
の回路金偏えた同期信号発振器107では、抽出したク
ロック信号と同期したよル高い周波数のクロック信号を
発生し、エンコーダ108、デコーダ109さらにコン
トロールおよびメモリ110に供給する。一方、レベル
シフト回路10Bを通して検出されコンパレータ104
によシ整形および増幅された信号は、デコーダ109に
て復号化され、受信データ信号S3としてコントローラ
およびメモリ110に送られる。逆にICチップ10よ
シ外部装置20に送信データ信号84を送る場合は、7
リーランニング状態となった同期発振器107からのク
ロック信号を受けてコントローラおよびメモリ110で
プリアンプル信号等が付加された送信データ信号が生成
され、さらにエンコーダ108にて符号化された後、こ
の符号化信号によってトランジスタ101が0N10F
Fされることによって、抵抗103に流れる電流が制御
される。この電流変化は端子11゜12を介して外部装
置20に伝送され、コンデンサ205を経て抵抗206
及びコンパレータ207にて検出、増幅された後、外部
装置20内の別の回路に供給される、また外部装置20
よシICチップ10内に端子11.12f介して供給さ
れた直流電力は、第9図に示すように端子11の平均電
圧VTよシ低い電圧VDDに安定化電源106にて変換
され、ICチ、プ10内の電源として供給される。
なお、この安定化電源106には、前述した等側内部抵
抗ヲt1は一定に保つためのダミー抵抗並びに必要があ
れば制御回路が内蔵されている。また、直流成分除去用
のレベルシフト回路103は、好ましくはトランジスタ
のVBEあるいはダイオードの順方向電圧降下を利用し
たものが用いられるが、コントロ−ラ105の入力抵抗
が極めて大きいため、小容量のコンデンサを用いた場合
でも所望の帯域信号を通過させることが可能であシ、い
ずれの場合もモノリシックIC内に構成す゛ることかで
きる。
抗ヲt1は一定に保つためのダミー抵抗並びに必要があ
れば制御回路が内蔵されている。また、直流成分除去用
のレベルシフト回路103は、好ましくはトランジスタ
のVBEあるいはダイオードの順方向電圧降下を利用し
たものが用いられるが、コントロ−ラ105の入力抵抗
が極めて大きいため、小容量のコンデンサを用いた場合
でも所望の帯域信号を通過させることが可能であシ、い
ずれの場合もモノリシックIC内に構成す゛ることかで
きる。
第10図はICチップ10の他の構成例を示すもので、
第7図におけるトランジスタ101及び抵抗102の部
分はドライバ111に置換され、ドライバ111の出力
端はコンデンサ112を介して第1の端子11に接続さ
れる。
第7図におけるトランジスタ101及び抵抗102の部
分はドライバ111に置換され、ドライバ111の出力
端はコンデンサ112を介して第1の端子11に接続さ
れる。
また第70におけるレベルシフト回路103と抵抗10
4およびコンパレータ105の部分はコントロ−ラ11
3に、・安定化電源106は昇圧安定化電源114およ
びコンデンサ115に同期発振器107は発振器116
に、それぞれ置換されている。送受されるデータ信号は
第11図に示すように例えば−ダイ7工、;4−p、’
符号に符号化されておシ、デコーダ109では自励発振
している発振器116からのクロック信号を用いてブイ
−7、、、ズ“符号のパルス幅をカウントすることによ
シ復号を行ない、受信データ信号s3金出力する。同様
に、コントローラおよびメモリ110からの送信データ
信号s4はエンコーダ108にて、発振器116からの
クロック信号によシダイフェーズ符号に符号化され、適
切な出力インピーダンスを有するドライバ111にて増
幅された後、コンデンサ112を介して第1の端子11
にAC結合される。一方、昇圧安定化電源114の出方
は第11図のダイフェーズ符号の平均レベルVTと同じ
電圧となるよう昇圧安定化されておシ、コンパレータ1
13の基準電圧として用いられる。従って、コンパレー
タ113の信号入力端は、第7図に見られるような直流
成分阻止用レベルシフト回路103を介することなく第
1の端子11に直結されている。なお、本実施例ではコ
ンデンサ112゜115として比較的大容量のものが必
要であるため、現状の技術レベルではチップコンデンサ
等を用いたハイブリッド構成となる。
4およびコンパレータ105の部分はコントロ−ラ11
3に、・安定化電源106は昇圧安定化電源114およ
びコンデンサ115に同期発振器107は発振器116
に、それぞれ置換されている。送受されるデータ信号は
第11図に示すように例えば−ダイ7工、;4−p、’
符号に符号化されておシ、デコーダ109では自励発振
している発振器116からのクロック信号を用いてブイ
−7、、、ズ“符号のパルス幅をカウントすることによ
シ復号を行ない、受信データ信号s3金出力する。同様
に、コントローラおよびメモリ110からの送信データ
信号s4はエンコーダ108にて、発振器116からの
クロック信号によシダイフェーズ符号に符号化され、適
切な出力インピーダンスを有するドライバ111にて増
幅された後、コンデンサ112を介して第1の端子11
にAC結合される。一方、昇圧安定化電源114の出方
は第11図のダイフェーズ符号の平均レベルVTと同じ
電圧となるよう昇圧安定化されておシ、コンパレータ1
13の基準電圧として用いられる。従って、コンパレー
タ113の信号入力端は、第7図に見られるような直流
成分阻止用レベルシフト回路103を介することなく第
1の端子11に直結されている。なお、本実施例ではコ
ンデンサ112゜115として比較的大容量のものが必
要であるため、現状の技術レベルではチップコンデンサ
等を用いたハイブリッド構成となる。
また、以上の説明ではデータ信号を基底帯域のまま伝送
しているが、FM 、 AM 、 PM等の変調波に変
換した後、直流電力に重畳してもよいことは勿論である
。特にその変調に際し、搬送波を短波、H短波等高周波
に選べば、コンデンサ112.115等は容量の小さな
もので済み、工Cチップ内に形成することも容易となる
。
しているが、FM 、 AM 、 PM等の変調波に変
換した後、直流電力に重畳してもよいことは勿論である
。特にその変調に際し、搬送波を短波、H短波等高周波
に選べば、コンデンサ112.115等は容量の小さな
もので済み、工Cチップ内に形成することも容易となる
。
第12図はこの発明に係るICカードの構造の他の例を
示すもので、ICチップ10およびその端子11.12
は第2図、第3図で説明したものと同様である。
示すもので、ICチップ10およびその端子11.12
は第2図、第3図で説明したものと同様である。
第12図(a)においては、電極22.23はカード状
基体21の表裏全面に形成され、導電ゴムのような可撓
性を有する導電性部材24゜25によってICチップ1
oの端子11,12と接続されている。
基体21の表裏全面に形成され、導電ゴムのような可撓
性を有する導電性部材24゜25によってICチップ1
oの端子11,12と接続されている。
第12図(b)は第12図(a)の導電ゴム等の代シに
スプリング接点26.27を用いて電極22゜23と端
子11.12とを接続したものである。
スプリング接点26.27を用いて電極22゜23と端
子11.12とを接続したものである。
第12図(C)は電極22.23の内面に突起22h、
23aを一体的に形成し、突起22thと23aとの間
にICチップ10f挾んで電極22.23と端子11.
12との接続をなすようにしたものである。
23aを一体的に形成し、突起22thと23aとの間
にICチップ10f挾んで電極22.23と端子11.
12との接続をなすようにしたものである。
第12図(d)は電極22.23をカード状基体21の
一部に設けた魚具外は第2図(IL)のものと同様であ
る。
一部に設けた魚具外は第2図(IL)のものと同様であ
る。
第12図(e)は電極22.23を導電ゴムあるいは導
電プラスチックのような可撓性を有する導電性部材で形
成してICチップ1oの端子11.12と直接接続した
例である。この場合、カード状基体21も軟質ゴムのよ
うな可撓性材料で形成すれば、全体として可撓性のある
ICカードとなる。
電プラスチックのような可撓性を有する導電性部材で形
成してICチップ1oの端子11.12と直接接続した
例である。この場合、カード状基体21も軟質ゴムのよ
うな可撓性材料で形成すれば、全体として可撓性のある
ICカードとなる。
この発明に係るICカードの具体的□な構造はその他種
々変形でき、例えば電極22.23と端子11.12と
の接続にワイヤーを用いてもよい。
々変形でき、例えば電極22.23と端子11.12と
の接続にワイヤーを用いてもよい。
ところで、第7図あるいは第10図の回路構成では、I
Cカードを外部装置2oに表裏逆に挿入した場合、逆方
向に電流が流れICチ、プ10内の回路を破損するおそ
れがある。第13図はICカードを表裏逆に挿入可能と
する実施流電力およびデータ信号を供給するようにした
ものである。このような構成にすると、ICカードを表
裏逆に外部装置2oに挿入したとしても回路が破壊され
ることはなく、さらに外部装置20側にてICカードを
挿入した時にICチツブ10内に流れ入む電流を検出し
て、適正な電流が流れている場合にはそのままデータ信
号伝送を開始し、逆に適正な電流が流れていない時は、
外部装置20内にてICチ、プ1oの端子11.12と
の接続の向きを自動的に逆になるよう切シ替え、適正な
電流が流れ始めたことを確認した後、データ信号伝送を
開始することも可能である。
Cカードを外部装置2oに表裏逆に挿入した場合、逆方
向に電流が流れICチ、プ10内の回路を破損するおそ
れがある。第13図はICカードを表裏逆に挿入可能と
する実施流電力およびデータ信号を供給するようにした
ものである。このような構成にすると、ICカードを表
裏逆に外部装置2oに挿入したとしても回路が破壊され
ることはなく、さらに外部装置20側にてICカードを
挿入した時にICチツブ10内に流れ入む電流を検出し
て、適正な電流が流れている場合にはそのままデータ信
号伝送を開始し、逆に適正な電流が流れていない時は、
外部装置20内にてICチ、プ1oの端子11.12と
の接続の向きを自動的に逆になるよう切シ替え、適正な
電流が流れ始めたことを確認した後、データ信号伝送を
開始することも可能である。
第14図はこうした構成のICチップ10fいわゆる電
子コインに応用した実施例を示すもので、2枚の円形カ
ード状基体41.42の間にICチップ10を挟持固定
し、ICチツflOの端子11.12を電極15.16
に接続している。このようなコインは表裏を一切意識す
ることなく、自動販売機等に通常のコインと同様に使用
することができる。
子コインに応用した実施例を示すもので、2枚の円形カ
ード状基体41.42の間にICチップ10を挟持固定
し、ICチツflOの端子11.12を電極15.16
に接続している。このようなコインは表裏を一切意識す
ることなく、自動販売機等に通常のコインと同様に使用
することができる。
第1図(a)〜(1))は従来のICカードの÷弁醤芒
僧u面図および要部拡大断面図、第2図はこの発明の一
実施例に係るICカードの構造を示す断面図、第3図(
IL) (b)はICチップの具体的構造を示す断面図
、第4図(a)(b)は電圧駆動型および電流駆動屋I
Cテ、fとそれに接続される外部装置の原理的回路構成
を示す図、第5図(a)〜(d)はダミー抵抗による負
荷回路の等側内部抵抗の変動補償方法を説明するだめの
図、第6図は同時双方向伝送を行なうための構成を示す
図、第7図は第4図(a)の構成に基く具体例を示す図
、第8図は伝送データ信号のフォーマツ)1示す図、第
9図はデータ信号をマンチェスタ符号化した一例な示す
図、第10図は第4図(&)の構成に基く他の具体例を
示す図、第11図は第10図におけるデータ信号のダイ
フェーズ符号化の例を示す図、第12図(a)〜(e)
はこの発明の他の実施例に係るICカードの断面図、第
13図は表裏逆に挿入可能としたICカードにおけるI
Cチップの回路構成の一部を示す図、第14図(a)
(b)はこの発明のICカードを電子コインに適用した
例を示す平面図および断面図である。 10・・・ICチップ、11 、12−・・端子、20
・・・外部装置、13.14.21.41.42・・・
カード状基体、15,16.22.23・・・電極、2
4.25・・・導電コム、26.27・・・スプリング
接点、101,102,111,112・・・信号送出
手段、103,104,105,113−・・信号検出
手段% 10B、109.110・・・信号処理手段。 出願人代理人 弁理士 鈴 江 武 彦第1図 (1)) 第2図 第11図 第13図 第14図 (a)
僧u面図および要部拡大断面図、第2図はこの発明の一
実施例に係るICカードの構造を示す断面図、第3図(
IL) (b)はICチップの具体的構造を示す断面図
、第4図(a)(b)は電圧駆動型および電流駆動屋I
Cテ、fとそれに接続される外部装置の原理的回路構成
を示す図、第5図(a)〜(d)はダミー抵抗による負
荷回路の等側内部抵抗の変動補償方法を説明するだめの
図、第6図は同時双方向伝送を行なうための構成を示す
図、第7図は第4図(a)の構成に基く具体例を示す図
、第8図は伝送データ信号のフォーマツ)1示す図、第
9図はデータ信号をマンチェスタ符号化した一例な示す
図、第10図は第4図(&)の構成に基く他の具体例を
示す図、第11図は第10図におけるデータ信号のダイ
フェーズ符号化の例を示す図、第12図(a)〜(e)
はこの発明の他の実施例に係るICカードの断面図、第
13図は表裏逆に挿入可能としたICカードにおけるI
Cチップの回路構成の一部を示す図、第14図(a)
(b)はこの発明のICカードを電子コインに適用した
例を示す平面図および断面図である。 10・・・ICチップ、11 、12−・・端子、20
・・・外部装置、13.14.21.41.42・・・
カード状基体、15,16.22.23・・・電極、2
4.25・・・導電コム、26.27・・・スプリング
接点、101,102,111,112・・・信号送出
手段、103,104,105,113−・・信号検出
手段% 10B、109.110・・・信号処理手段。 出願人代理人 弁理士 鈴 江 武 彦第1図 (1)) 第2図 第11図 第13図 第14図 (a)
Claims (1)
- 【特許請求の範囲】 ゛(1)情報処理機能を持つ集積回路チップをカード状
基体に組込んでなるICカードにおいて、前記集積回路
チップは電源入力および信号の入出力を兼ねる2個の端
子が対向する2つの面にそれぞれ形成され、前記カード
状基体の表裏両面に前記集積回路チップの2個の端子と
接続された電極がそれぞれ配設されていることを特徴と
するICカード。 (2)集積回路チップは前記端子を介して外部装置よシ
供給される電源入力に重畳された信号を検出する信号検
出手段と、前記端子に前記外部装置へ伝達すべき信号を
送出する信号送出手段と、前記信号検出手段で検出され
た信号を処理するとともに、前記信号送出手段から送出
する信号を生成する信号処理手段とを含むものであるこ
とを特徴とする特許請求の範囲第1項記載のICカード
。 (3)集積回路チップと外部装置との間の信号の送受お
よび外部装置から集積回路チップへの電力供給は、前記
端子に接続されたダイオードを介して行なわれることを
特徴とする特許請求の範囲第1項または第2項記載のI
Cカード。 (4)集積回路チップは信号送出手段の最終段を除く回
路部分の消費電力をその内部動作状態の変化によらずほ
ぼ一定とするためのダミー抵抗を含むものであることを
特徴とする特許請求の範囲第2項記載のICカード。 (5)ダミー抵抗は可変抵抗であることを特徴とする特
許請求の範囲第4項記載のICカード。 (6)集積回路チップは信号の送受信時は負荷変動のよ
シ小さい限定された動作のみを行なうものであることを
特徴とする特許請求の範囲第1項〜第4項のいずれかに
記載のICカード。 (7)集積回路チップはモノリシック構造であることを
特徴とする特許請求の範囲第1項〜第4項、第5項のい
ずれかに記載のICカード。 (8)集積回路テップは2枚のカード状基体に挟持固定
され、カード状基体は集積回路チップの両端子に対向し
た位置に貫通孔を有し、この貫通孔に導電物質が充填さ
れて電極が形成されていることを特徴とする特許請求の
範囲第1項記載のICカード。 (9) 電極はカード状基体の表裏全面に形成されて
いることを特徴とする特許請求の範囲第1項記載のIC
カード。 αQ 電極は可撓性を有する導電性部材を介して集積回
路tツノの端子に接続されていることを特徴とする特許
請求の範囲第1項または第9項記載のICカード。 α埠 電極はスプリング接点によって集積回路チップの
端子と接続されていることを特徴とする特許請求の範囲
第1項または第9項記載のICカード。 (2)電極はその内面に突起を有し、この突起の間に集
積回路チップを挾んで集積回路チップの端子と接続され
ていることを特徴とする特許請求の範囲第1項または第
9項記載のICカード。 (6) 電極は可撓性を有する導電性部材によって形成
され、集積回路テップの端子と直接接続されていること
を特徴とする特許請求の範囲第1項または第9項記載の
ICカードO α→ カード状基体は円形状に形成されていることを特
徴とする特許請求の範囲第1項または第8項記載のIC
カード。
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