JPS59181627A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS59181627A JPS59181627A JP58055984A JP5598483A JPS59181627A JP S59181627 A JPS59181627 A JP S59181627A JP 58055984 A JP58055984 A JP 58055984A JP 5598483 A JP5598483 A JP 5598483A JP S59181627 A JPS59181627 A JP S59181627A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、半導体チップとこの半導体装ツブの゛電極取
り出しボンディングワイヤとを保護するためシリコーン
ゲル層で覆い、史にこのシリコーンゲル層を樹脂で封止
してなる半導体装置の製造方法に係り、特に電力変換部
の主回路を交換可能な1個の電気部品として集積化して
半導体チップした直方用半導体モジュールの組立製造方
法において有効な方法に関する。
り出しボンディングワイヤとを保護するためシリコーン
ゲル層で覆い、史にこのシリコーンゲル層を樹脂で封止
してなる半導体装置の製造方法に係り、特に電力変換部
の主回路を交換可能な1個の電気部品として集積化して
半導体チップした直方用半導体モジュールの組立製造方
法において有効な方法に関する。
従来のこの種製造方法を、最も構造の簡単な絶縁放射板
付の樹脂封止トランジスタの組立製造方法を例にとり、
以下説明する。第1図はそのトランジスタの断面図を示
すものである。同図において、 (1)、先ず、表面にトランジスタのエミッタ、ベース
、コレクタ電極とすべき3個の分極された銅板Za、z
b、zc、a而に他部品゛と′半田付けするための銅板
Idが、例えば直接接合されたセラミック基板llを作
成する。
付の樹脂封止トランジスタの組立製造方法を例にとり、
以下説明する。第1図はそのトランジスタの断面図を示
すものである。同図において、 (1)、先ず、表面にトランジスタのエミッタ、ベース
、コレクタ電極とすべき3個の分極された銅板Za、z
b、zc、a而に他部品゛と′半田付けするための銅板
Idが、例えば直接接合されたセラミック基板llを作
成する。
(2)、次に、表面のコレクタ′電極とすべき銅板Ia
上ζこ半田12を介してトランジスタチップI3をマウ
ントする。また、残る2ケ所の銅板lb、icと、トラ
ンジスタチップ13のエミッタ、ヘース電極とを例えば
Al(アルミニウム)ワイヤ14で結線する。これζこ
より、銅板1bはエミッタ成極、銅板ZCはベース成極
となる。
上ζこ半田12を介してトランジスタチップI3をマウ
ントする。また、残る2ケ所の銅板lb、icと、トラ
ンジスタチップ13のエミッタ、ヘース電極とを例えば
Al(アルミニウム)ワイヤ14で結線する。これζこ
より、銅板1bはエミッタ成極、銅板ZCはベース成極
となる。
(3)、次に、あらかじめ所定の場所に半田12より低
融点の半田ペーストを塗布した銅ベース15、電極取り
出し端子16,17.1&、及び上記トランジスタチッ
プ13付きのセラミック基板11とをアライメントする
。
融点の半田ペーストを塗布した銅ベース15、電極取り
出し端子16,17.1&、及び上記トランジスタチッ
プ13付きのセラミック基板11とをアライメントする
。
(4)、次Oこ、チップマウントした半田12が溶けな
い程度の低い温度lこ設足したりフロー炉内なこ上記に
3)でアライメントされた各部品を入れて、電極取り出
し端子16,17.18とセラミック基45−11の表
面の銅板1a、lb、IG、及びセラミック基板11の
裏面の銅板ldと銅ベース15とをそれぞれ半田19付
けする。
い程度の低い温度lこ設足したりフロー炉内なこ上記に
3)でアライメントされた各部品を入れて、電極取り出
し端子16,17.18とセラミック基45−11の表
面の銅板1a、lb、IG、及びセラミック基板11の
裏面の銅板ldと銅ベース15とをそれぞれ半田19付
けする。
(5)、次(こ、半田ペースト含有のフラックスを除去
した後、接着剤2oを塗布した筒状の樹脂ケース2Iを
上記リフロー済の銅ペース154こ取り付け、接着させ
る。この時、樹脂ケース21はセラミック基板11を一
定の距離を置いて取り囲んでいる。
した後、接着剤2oを塗布した筒状の樹脂ケース2Iを
上記リフロー済の銅ペース154こ取り付け、接着させ
る。この時、樹脂ケース21はセラミック基板11を一
定の距離を置いて取り囲んでいる。
(6)、次に、樹脂ケース2Iの開口部から十分ζこ脱
泡したシリコーンゲルを電極取り出し端子16 、1.
7 、18に触れないように注入し、シリコーンゲル層
22を形成する。注入量は、前記AlワイヤZ4を少な
くとも完全ζこ埋込む量とする、注入後、150 ’C
前後のオーブンに1時間以上この製品を入れ、シリコー
ンゲル層22を硬化させる。なお、シリコーンゲル層2
2は−液性、あるいは二液性であることは問わない。
泡したシリコーンゲルを電極取り出し端子16 、1.
7 、18に触れないように注入し、シリコーンゲル層
22を形成する。注入量は、前記AlワイヤZ4を少な
くとも完全ζこ埋込む量とする、注入後、150 ’C
前後のオーブンに1時間以上この製品を入れ、シリコー
ンゲル層22を硬化させる。なお、シリコーンゲル層2
2は−液性、あるいは二液性であることは問わない。
(7)、次に、上記硬化したシリコーンケル層22の上
から粘度を低めるために約70〜80℃に予熱した封止
用のエポキシ樹脂を注入し、エポキシ樹脂層23を形成
する。注入量(ま、樹脂ケースzrの上面から溢れ出な
い程すτとする。
から粘度を低めるために約70〜80℃に予熱した封止
用のエポキシ樹脂を注入し、エポキシ樹脂層23を形成
する。注入量(ま、樹脂ケースzrの上面から溢れ出な
い程すτとする。
ここで、エポキシ樹脂層23を予熱して注入する理由を
説明するために、通常の二液性の熱硬化型エポキシ樹脂
の温度と粘度との関係図を第2図に示す。
説明するために、通常の二液性の熱硬化型エポキシ樹脂
の温度と粘度との関係図を第2図に示す。
同図において、硼化剤と主剤とを混合した後、便化反応
は時間と共に進行していくが、粘度は付近で粘度の最小
値になり、それ以上の呂度で応が進まないため、樹脂粘
度6ffその雰囲気温度の粘度以下(こは、これ以上下
がらずに時間と共に除々ζこ硬化が進み、次第に粘度は
上昇していく。従って、通常、エポキシ樹脂の注入作条
は、中のa(70℃〜80℃)の温度)にm脂温rit
を保ぢながら、富(晶に放置された一裂^6に注入して
いく。
は時間と共に進行していくが、粘度は付近で粘度の最小
値になり、それ以上の呂度で応が進まないため、樹脂粘
度6ffその雰囲気温度の粘度以下(こは、これ以上下
がらずに時間と共に除々ζこ硬化が進み、次第に粘度は
上昇していく。従って、通常、エポキシ樹脂の注入作条
は、中のa(70℃〜80℃)の温度)にm脂温rit
を保ぢながら、富(晶に放置された一裂^6に注入して
いく。
(8八次ζこ、エポキシ樹脂層23を完全に硬化させる
ため、樹脂注入を終えた製品を150 ”C前後のオー
ブンに入れ、8時間以上キュアする。
ため、樹脂注入を終えた製品を150 ”C前後のオー
ブンに入れ、8時間以上キュアする。
これにより、組立は光子する。
従来の製造方法により製造した樹脂封止トランジスタを
信頼性確詔のため、実装条件に見合った一40℃〜12
5℃の温度サイクル先暎を行ってろたところ、第1図中
の′電極取り出し端子16,17.I’Sとセラミック
基all上の銅板1a、Zb、lcとを接ノ靜する半田
19にクラックが生じ、電極J収り出し端子16 、1
7゜18がオーブンしたり、更に著しい」鵡今に6ば、
樹脂ケース21と銅ベース15との間の接着剤20が剥
離されることがわかった。また、エポキシ樹脂層23の
厚さhが小さい場合(ば、電極破り出し端子16,17
.18とエポキシ樹脂層23、樹脂ケース21とエポキ
シ樹脂層23との間からシリコーンゲルがは6出して欠
ることもあった。
信頼性確詔のため、実装条件に見合った一40℃〜12
5℃の温度サイクル先暎を行ってろたところ、第1図中
の′電極取り出し端子16,17.I’Sとセラミック
基all上の銅板1a、Zb、lcとを接ノ靜する半田
19にクラックが生じ、電極J収り出し端子16 、1
7゜18がオーブンしたり、更に著しい」鵡今に6ば、
樹脂ケース21と銅ベース15との間の接着剤20が剥
離されることがわかった。また、エポキシ樹脂層23の
厚さhが小さい場合(ば、電極破り出し端子16,17
.18とエポキシ樹脂層23、樹脂ケース21とエポキ
シ樹脂層23との間からシリコーンゲルがは6出して欠
ることもあった。
原因を究明したところ、エポキシ樹脂層23を完全硬化
させるために、常温状態にある製品を、150°Cのオ
ーブン中に入れるのであるが、そのときエポキシ41月
旨J脅23とシリコーンケル1mν22との間に短時間
ではあるが、大きな温度履歴差があることがわかった。
させるために、常温状態にある製品を、150°Cのオ
ーブン中に入れるのであるが、そのときエポキシ41月
旨J脅23とシリコーンケル1mν22との間に短時間
ではあるが、大きな温度履歴差があることがわかった。
例えば、前述のようにエポキシ4@脂層23は硬化促進
反応が始まる約100℃を通過すると、3〜4分後(・
こげ粘度はほぼ固体化完了時の80%程度にまで硬くな
っており、樹脂ケース21と電極取り出し端子16,1
7.18としつかり固着している。
反応が始まる約100℃を通過すると、3〜4分後(・
こげ粘度はほぼ固体化完了時の80%程度にまで硬くな
っており、樹脂ケース21と電極取り出し端子16,1
7.18としつかり固着している。
しかし、その時、内部のシリコーンケル層22はまだ約
70°C1’!l1gtであり、以降の温度上昇では他
部品の熱膨張係数が、シリコーンケル治22の約2分の
1以下であるため、(温度上昇X熱膨張係数)分の体積
増加は見込めない。
70°C1’!l1gtであり、以降の温度上昇では他
部品の熱膨張係数が、シリコーンケル治22の約2分の
1以下であるため、(温度上昇X熱膨張係数)分の体積
増加は見込めない。
従って、前述のように、製品保証温く巾の一40°C〜
−125℃の温度サイクル試7.倹をすると、シリコー
ンゲル層22は約70℃以下では内圧を有しな(他に影
響を与えないが、それ以上の温度では圧力X体g−一定
の法則にならい、内圧は非電に増加する。このため、構
造上弱い電極取り出し端子1’6,17.18の半田1
9部に引張り応力をかけることになる。この引張り応力
の繰り返しにより、半田クラック、半田オーブン、樹脂
ケース21の接壇オーブンが発生していた。
−125℃の温度サイクル試7.倹をすると、シリコー
ンゲル層22は約70℃以下では内圧を有しな(他に影
響を与えないが、それ以上の温度では圧力X体g−一定
の法則にならい、内圧は非電に増加する。このため、構
造上弱い電極取り出し端子1’6,17.18の半田1
9部に引張り応力をかけることになる。この引張り応力
の繰り返しにより、半田クラック、半田オーブン、樹脂
ケース21の接壇オーブンが発生していた。
このような半導体装置では、実装上、トランジスタ9)
オン−オフ動作によるトランジスタチップ13の発熱温
度サイクル(25℃〜1.50℃)でも、容易に半田ク
ラックが発生し、使用に耐えないこきがわかる。
オン−オフ動作によるトランジスタチップ13の発熱温
度サイクル(25℃〜1.50℃)でも、容易に半田ク
ラックが発生し、使用に耐えないこきがわかる。
また、このような半田クラック発生において、固接I関
係する部品及び材料の電極取り出し端子16.17.1
8の長さ方向ζこおける熱PM張伸び量を25°C〜1
25℃の温度差で計算してみると次のようになる。
係する部品及び材料の電極取り出し端子16.17.1
8の長さ方向ζこおける熱PM張伸び量を25°C〜1
25℃の温度差で計算してみると次のようになる。
■
温度差△T=100℃における呻び祷(電極取り出し端
子16,17.18における半田19の下面を基糸とす
る。)は、 (A) 半田十′砥・甑取り出し端子 23.06x
lO−3wtb(B) ケース十受着剤 3
6.45x10 ff1Iy(C) シリコーンゲ
ル+エポキシ樹脂 62.00 X ]、 0 ”
*+ノ半田クラックの発生少因となる熱膨張伸び量の
差は、 (B)−(A)=1 3.39 x 10 ”’ 、
(C) (A)=38.94xlO妨・ 従って、半田クラックが発生する除の半田伸びで機械的
伸び着)23%を考慮しても、(A)+0.1x0.2
3+46xl O”wn、以上Qこ他部品が熱膨張伸び
を示せば、半田は引張り破断されることになる。
子16,17.18における半田19の下面を基糸とす
る。)は、 (A) 半田十′砥・甑取り出し端子 23.06x
lO−3wtb(B) ケース十受着剤 3
6.45x10 ff1Iy(C) シリコーンゲ
ル+エポキシ樹脂 62.00 X ]、 0 ”
*+ノ半田クラックの発生少因となる熱膨張伸び量の
差は、 (B)−(A)=1 3.39 x 10 ”’ 、
(C) (A)=38.94xlO妨・ 従って、半田クラックが発生する除の半田伸びで機械的
伸び着)23%を考慮しても、(A)+0.1x0.2
3+46xl O”wn、以上Qこ他部品が熱膨張伸び
を示せば、半田は引張り破断されることになる。
次に、封止用のエポキシ樹脂1穆23で固着された領棹
を無視して、シリコーンケル層22の充填領域たけの長
さく5駄)で熱膨張伸び号の匙を見ると、△T=100
℃において、(A)′ 半田十電極取り出し端子 ]
1.94 X 10−ss。
を無視して、シリコーンケル層22の充填領域たけの長
さく5駄)で熱膨張伸び号の匙を見ると、△T=100
℃において、(A)′ 半田十電極取り出し端子 ]
1.94 X 10−ss。
(B)”T−ス+g着斉’1 18.3 x
1.0 ”at;a 。
1.0 ”at;a 。
IC)′ シリコーンゲル 37.5 X
1. Q nノrC)’ −(A)’= 25.56
x 10 ’ 肋’トナi’)、上sa (7) コ
とく機械的半田伸び(23’xlO’ηl)を考慮して
も、半田クラック発生の原因上なることがわかる。
1. Q nノrC)’ −(A)’= 25.56
x 10 ’ 肋’トナi’)、上sa (7) コ
とく機械的半田伸び(23’xlO’ηl)を考慮して
も、半田クラック発生の原因上なることがわかる。
この発明は上記実情に烈みてなされたもので、その目的
は、内部シリコーンゲルの熱膨張による応力発生を防止
し、他の構成部品に悪影響を与えることがなく、信腿性
を向上させることのできる半導体装置の製造方法を提供
することにある。
は、内部シリコーンゲルの熱膨張による応力発生を防止
し、他の構成部品に悪影響を与えることがなく、信腿性
を向上させることのできる半導体装置の製造方法を提供
することにある。
この発明は、半導体チップとこの半導体チップの電極取
り出しボンディングワイヤとを覆い、これらを保hφす
るシリコーンゲル層と、前記シリコーンゲル層よりも熱
膨張係数が小さく、かつ少な(とも一部が前記シリコー
ンゲル層ト接する樹脂層とを具備する半導体装置の製造
方法Oこおいて、前記樹脂層が硬化促進反応を起こす以
前に、製品環境保証湯度(例えば125℃)までシリコ
ーンゲル層を熱膨張させておき、そのときのシリコーン
ゲル層の体積を維持したまま樹脂層を完全硬化させ、他
部品と固層させる。
り出しボンディングワイヤとを覆い、これらを保hφす
るシリコーンゲル層と、前記シリコーンゲル層よりも熱
膨張係数が小さく、かつ少な(とも一部が前記シリコー
ンゲル層ト接する樹脂層とを具備する半導体装置の製造
方法Oこおいて、前記樹脂層が硬化促進反応を起こす以
前に、製品環境保証湯度(例えば125℃)までシリコ
ーンゲル層を熱膨張させておき、そのときのシリコーン
ゲル層の体積を維持したまま樹脂層を完全硬化させ、他
部品と固層させる。
従って、製品保証最高温度に製品を放置しても、シリコ
ーンゲル層の内部応力はほぼ零に近く、伺ら他の構成部
品に悪影響を与えることがない。
ーンゲル層の内部応力はほぼ零に近く、伺ら他の構成部
品に悪影響を与えることがない。
〔発明の実施例1〕
以下、図面を参照してこの発明の一実施例を説明する。
製品における温度差による熱膨張時の応力関係は、総合
的にはさらに複雑となるが、前述の(C)’−(A)’
、すなわち、第1図のシリコーンゲル層22の熱膨張伸
び量と(半田19+電極取り出し端子I6.I7,18
)の熱膨張伸び看との差を零に近づければ、電極敗り出
し端子16.1.7.18の半田19にかかる引張応力
を高温時でも紋小にできることがわかる。(C)’ −
姉= o cこするに(ハシリコーンゲル層22を製品
保証最高温度の状態に保ち、シリコーンゲル層22をそ
の温度状態で有する体積才で熱膨張させておいて、制止
用エポキシ樹脂23で固めてしまう方法がある。常温ま
で冷却しても、製品内部では例えば125 ’Cでのシ
リコーンゲル熱膨張時のスペースが保たれていること番
こなり、再び125℃(こ製品を昇温しでも、シリコー
ンゲル層22は前記スペース以上にIf&張することは
なく、このため半田19に引張応力を加えることはない
。
的にはさらに複雑となるが、前述の(C)’−(A)’
、すなわち、第1図のシリコーンゲル層22の熱膨張伸
び量と(半田19+電極取り出し端子I6.I7,18
)の熱膨張伸び看との差を零に近づければ、電極敗り出
し端子16.1.7.18の半田19にかかる引張応力
を高温時でも紋小にできることがわかる。(C)’ −
姉= o cこするに(ハシリコーンゲル層22を製品
保証最高温度の状態に保ち、シリコーンゲル層22をそ
の温度状態で有する体積才で熱膨張させておいて、制止
用エポキシ樹脂23で固めてしまう方法がある。常温ま
で冷却しても、製品内部では例えば125 ’Cでのシ
リコーンゲル熱膨張時のスペースが保たれていること番
こなり、再び125℃(こ製品を昇温しでも、シリコー
ンゲル層22は前記スペース以上にIf&張することは
なく、このため半田19に引張応力を加えることはない
。
このような考察に基づき、次に本発明の具体的製造方法
を述べる。この方法は、従来例に示した方法の(7)
、 (8)の工程を次のように改善したものであり、(
1)〜16)の工程については同様であるのでその説明
は省略する。
を述べる。この方法は、従来例に示した方法の(7)
、 (8)の工程を次のように改善したものであり、(
1)〜16)の工程については同様であるのでその説明
は省略する。
(7)I シリコーンゲル層22を硬化させた後、半
#品を■(120℃〜130°C)の温度に設定したヒ
ータ上に乗せ、十分放置して半製品が■(120℃〜1
30℃)の温度になったことを確認して(例えば、シリ
コーンゲルJ@22の表面温度が120℃〜130℃で
あることを辿1定する。)、約70〜80℃に予熱した
制止用のエポキシ樹脂を注入する。すべての半製品に樹
脂を注入し終えたら、半製品を■(120℃〜130℃
)の温txから低下させることなく、130±5℃に設
定したオーブンに入れる。
#品を■(120℃〜130°C)の温度に設定したヒ
ータ上に乗せ、十分放置して半製品が■(120℃〜1
30℃)の温度になったことを確認して(例えば、シリ
コーンゲルJ@22の表面温度が120℃〜130℃で
あることを辿1定する。)、約70〜80℃に予熱した
制止用のエポキシ樹脂を注入する。すべての半製品に樹
脂を注入し終えたら、半製品を■(120℃〜130℃
)の温txから低下させることなく、130±5℃に設
定したオーブンに入れる。
(8)′ 最後に、■の謡度のオーブンにて8時間以上
キュアして朝立を完了する。
キュアして朝立を完了する。
上記工程において、従来工程のときエポキシ樹脂ノ脅2
3のキュア温度が150℃であったのを130°Cに変
更したのは、シリコーンゲル層22の熱膨張が△T=2
0℃の温度差により、エポキシ樹脂層23の硬化キュア
中に半田19に引張応力が力pわるのを1余外すること
を加味したものである。
3のキュア温度が150℃であったのを130°Cに変
更したのは、シリコーンゲル層22の熱膨張が△T=2
0℃の温度差により、エポキシ樹脂層23の硬化キュア
中に半田19に引張応力が力pわるのを1余外すること
を加味したものである。
また、■の温度を120℃〜130°Cにしたのは、半
製品をヒータ上に乗せ、下面の銅ベース15からの熱伝
導によりシリコーンゲル層22の昇温を計る方法を取っ
たため、ヒータ温度を半田I9の融点180℃以下にす
る制限からによる。製品をオーブン加熱方式により加熱
する場合には、■の温度はそれ以上昇温可能(例えば、
150℃)であるが、オーブンから出してのエポキシ樹
脂1fJ23注入時間経過前の製品温度保持が困難であ
り、作業性が悪くなる。
製品をヒータ上に乗せ、下面の銅ベース15からの熱伝
導によりシリコーンゲル層22の昇温を計る方法を取っ
たため、ヒータ温度を半田I9の融点180℃以下にす
る制限からによる。製品をオーブン加熱方式により加熱
する場合には、■の温度はそれ以上昇温可能(例えば、
150℃)であるが、オーブンから出してのエポキシ樹
脂1fJ23注入時間経過前の製品温度保持が困難であ
り、作業性が悪くなる。
本発明の効果を実証するために、前記■温度、■温度を
各種変更したサンプルを製造し、温度限界サイクル試験
をしてみた。サンプル内科は下記の通りである。
各種変更したサンプルを製造し、温度限界サイクル試験
をしてみた。サンプル内科は下記の通りである。
第3図に温度サイクル試験(TCT)(−25°C〜1
25℃)の結果を、第4図に通電オンーオフサイクル試
験(製品発熱ケース視度125℃〜25℃)の結果を示
す。
25℃)の結果を、第4図に通電オンーオフサイクル試
験(製品発熱ケース視度125℃〜25℃)の結果を示
す。
この試験結果から、前記■、■の温度により半田クラッ
ク発生は大きく左右されることがわかる。そして、半田
クラック発生を防止するには、製品保証温度以上の温度
で、シリコーンゲル層22を熱膨張させておき、封止用
のエポキシ樹脂層23で固めることが必要である。また
、製品部品寸法、シリコーンゲル量、封と用エポキシ樹
脂量、他部品の熱膨張係数を製品製造、設計上変更した
サンプルでも同様の効果が認められた。
ク発生は大きく左右されることがわかる。そして、半田
クラック発生を防止するには、製品保証温度以上の温度
で、シリコーンゲル層22を熱膨張させておき、封止用
のエポキシ樹脂層23で固めることが必要である。また
、製品部品寸法、シリコーンゲル量、封と用エポキシ樹
脂量、他部品の熱膨張係数を製品製造、設計上変更した
サンプルでも同様の効果が認められた。
第1図に示した樹脂封止トランジスタ(こおいては、セ
ラミックと銅との直接接合基板を用いているが、直接接
合基板を用いることなく、第5図に示すような銅とメタ
ライズされたセラミック、を銀ろう付けした部品を使用
するようにした樹脂封止トランジスタにおいても同様の
効果が得られる。同図において、31は両面メタライズ
されたセラミック基板、32(−5半田、33はセラミ
ックであり、その他第1図と同一構成部分は同一符号を
付してその説明を省略する。
ラミックと銅との直接接合基板を用いているが、直接接
合基板を用いることなく、第5図に示すような銅とメタ
ライズされたセラミック、を銀ろう付けした部品を使用
するようにした樹脂封止トランジスタにおいても同様の
効果が得られる。同図において、31は両面メタライズ
されたセラミック基板、32(−5半田、33はセラミ
ックであり、その他第1図と同一構成部分は同一符号を
付してその説明を省略する。
このように本発明の製造方法によれば、実使用上非常に
信頼性の高い大電力用半導体モジュール製品の製造が容
易にできる。
信頼性の高い大電力用半導体モジュール製品の製造が容
易にできる。
尚、上記実施例においては、大電力用半導体モジュール
製品について説明したが、これに限定するものではなく
、シリコーンゲル使用のすべての樹脂刺止製品製造に適
用できるものである。例えば、本発明は、樹脂封止した
個別半導体においても、シリコーンゲルを使用した場合
あるいは熱膨張係数の大きい材質を使用した場合の内部
材料の熱膨張による樹脂とステムのはがれ防止にも適用
できるものである。
製品について説明したが、これに限定するものではなく
、シリコーンゲル使用のすべての樹脂刺止製品製造に適
用できるものである。例えば、本発明は、樹脂封止した
個別半導体においても、シリコーンゲルを使用した場合
あるいは熱膨張係数の大きい材質を使用した場合の内部
材料の熱膨張による樹脂とステムのはがれ防止にも適用
できるものである。
以上のように本発明によれば、内部シリコーンゲルの熱
膨張による応力発生を防止し、他の構成部品に悪影響を
与えることがなく、半導体装置の信頼性か著しく向上す
る。
膨張による応力発生を防止し、他の構成部品に悪影響を
与えることがなく、半導体装置の信頼性か著しく向上す
る。
第1図は直接接合基板を使用した樹脂封止トランジスタ
の構成を示す断面図、第2図はエポキシ樹脂の温度と粘
度との関係を示す特性図、第3図は温度サイクル試験時
の半田クラックの発生状況を従来製品と本発明製品とを
比較して示す特性図、第4図は通電オン−オフサイクル
試験時の半田クラック発生状況を従来製品と本発明製品
とを比較して示す特性図、第5図は直接接合基’4ff
l”を使用しない樹脂封止トランジスタの構成を示す断
面図である。 la、Jb、Ic、1’d”・y狗板、11・・−セラ
ミック基板、12・・・半田、13・・・トランジスタ
チップ、14・・・A/ワイヤ、15・・・銅ベース、
16.17.18・・・電極取り出し端子、I9・・・
半田、20・・・接着剤、21・・・樹脂ケース、22
・・・シリコーンゲル層、23・・・エポキシ樹脂層。 出願人代理人 弁理士 鈴 江 武 彦第3図 第5図
の構成を示す断面図、第2図はエポキシ樹脂の温度と粘
度との関係を示す特性図、第3図は温度サイクル試験時
の半田クラックの発生状況を従来製品と本発明製品とを
比較して示す特性図、第4図は通電オン−オフサイクル
試験時の半田クラック発生状況を従来製品と本発明製品
とを比較して示す特性図、第5図は直接接合基’4ff
l”を使用しない樹脂封止トランジスタの構成を示す断
面図である。 la、Jb、Ic、1’d”・y狗板、11・・−セラ
ミック基板、12・・・半田、13・・・トランジスタ
チップ、14・・・A/ワイヤ、15・・・銅ベース、
16.17.18・・・電極取り出し端子、I9・・・
半田、20・・・接着剤、21・・・樹脂ケース、22
・・・シリコーンゲル層、23・・・エポキシ樹脂層。 出願人代理人 弁理士 鈴 江 武 彦第3図 第5図
Claims (2)
- (1) 半導体チップとこの半導体チップの電極取り
出しボンディングワイヤとを榎い、これらを保護するシ
リコーンゲル層と、前記シリコーンゲルj輌上りも熱膨
張係数が小さく、かつ少なくとも一部が前記シリコーン
ゲル層と接する樹脂とを具備する半導体装置の製造方法
において、前記シリコーンゲル層を熱硬化させた後の半
製品を常温よりも高い温度に保った状態で、前記樹脂を
注入した後、轟該温度よりも前記半製品の温度を低下さ
せることなく、更に高温で熱処理を行い前記樹力旨層を
硬化させることを特徴とする半導体装置の製造方法。 - (2)前記半製品を、製品環境保証最高温度より少なく
とも25℃低い温度以上に保つ特許請求の範囲第1項記
載の半導体装置の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58055984A JPS59181627A (ja) | 1983-03-31 | 1983-03-31 | 半導体装置の製造方法 |
US06/592,596 US4558510A (en) | 1983-03-31 | 1984-03-23 | Method of producing a semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58055984A JPS59181627A (ja) | 1983-03-31 | 1983-03-31 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59181627A true JPS59181627A (ja) | 1984-10-16 |
JPS646538B2 JPS646538B2 (ja) | 1989-02-03 |
Family
ID=13014343
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58055984A Granted JPS59181627A (ja) | 1983-03-31 | 1983-03-31 | 半導体装置の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4558510A (ja) |
JP (1) | JPS59181627A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3616226A1 (de) * | 1985-05-15 | 1986-11-20 | Mitsubishi Denki K.K., Tokio/Tokyo | Halbleitereinrichtung |
JPH03225943A (ja) * | 1990-01-31 | 1991-10-04 | Nippondenso Co Ltd | 混成集積回路装置 |
Families Citing this family (30)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4769744A (en) * | 1983-08-04 | 1988-09-06 | General Electric Company | Semiconductor chip packages having solder layers of enhanced durability |
JPS60239051A (ja) * | 1984-05-11 | 1985-11-27 | Mitsubishi Electric Corp | 半導体装置 |
DE3521572A1 (de) * | 1985-06-15 | 1986-12-18 | Brown, Boveri & Cie Ag, 6800 Mannheim | Leistungshalbleitermodul mit keramiksubstrat |
JPH07120733B2 (ja) * | 1985-09-27 | 1995-12-20 | 日本電装株式会社 | 車両用半導体素子パッケージ構造とその製造方法 |
WO1988006348A1 (en) * | 1987-02-20 | 1988-08-25 | Lsi Logic Corporation | Integrated circuit package assembly |
IT1202657B (it) * | 1987-03-09 | 1989-02-09 | Sgs Microelettronica Spa | Procedimento di fabbricazione di un dispositivo modulare di potenza a semiconduttore e dispositivo con esso ottenento |
FR2614494B1 (fr) * | 1987-04-22 | 1989-07-07 | Power Compact | Procede d'assemblage de circuits de puissance et de circuits de commande sur plusieurs niveaux sur un meme module et module ainsi obtenu |
DE3717489A1 (de) * | 1987-05-23 | 1988-12-01 | Asea Brown Boveri | Leistungshalbleitermodul und verfahren zur herstellung des moduls |
US5026667A (en) * | 1987-12-29 | 1991-06-25 | Analog Devices, Incorporated | Producing integrated circuit chips with reduced stress effects |
US4903118A (en) * | 1988-03-30 | 1990-02-20 | Director General, Agency Of Industrial Science And Technology | Semiconductor device including a resilient bonding resin |
JPH0267731A (ja) * | 1988-09-02 | 1990-03-07 | Toshiba Corp | はんだバンプ形半導体装置とその製造方法 |
US5173766A (en) * | 1990-06-25 | 1992-12-22 | Lsi Logic Corporation | Semiconductor device package and method of making such a package |
US5243217A (en) * | 1990-11-03 | 1993-09-07 | Fuji Electric Co., Ltd. | Sealed semiconductor device with protruding portion |
FR2678773B1 (fr) * | 1991-07-05 | 1997-03-14 | Thomson Csf | Procede de cablage entre des sorties de boitier et des elements d'hybride. |
IT1259370B (it) * | 1992-03-27 | 1996-03-12 | Marelli Autronica | Unita' elettronica, particolarmente per il controllo di funzioni di un motore a combustione interna |
EP0661748A1 (en) * | 1993-12-28 | 1995-07-05 | Hitachi, Ltd. | Semiconductor device |
FR2719157B1 (fr) * | 1994-04-20 | 1996-08-09 | Rv Electronique | Dispositif de puissance à semiconducteur à double isolation. |
DE4446527A1 (de) * | 1994-12-24 | 1996-06-27 | Ixys Semiconductor Gmbh | Leistungshalbleitermodul |
US5972738A (en) * | 1997-05-07 | 1999-10-26 | Lsi Logic Corporation | PBGA stiffener package |
US5837558A (en) * | 1997-11-04 | 1998-11-17 | Texas Instruments Incorporated | Integrated circuit chip packaging method |
JP3257500B2 (ja) * | 1998-02-27 | 2002-02-18 | ティーディーケイ株式会社 | 磁気ヘッド装置 |
US6404065B1 (en) * | 1998-07-31 | 2002-06-11 | I-Xys Corporation | Electrically isolated power semiconductor package |
JP4442833B2 (ja) * | 1998-08-04 | 2010-03-31 | キヤノン株式会社 | 光電変換装置 |
US6087200A (en) * | 1998-08-13 | 2000-07-11 | Clear Logic, Inc. | Using microspheres as a stress buffer for integrated circuit prototypes |
KR20010058771A (ko) * | 1999-12-30 | 2001-07-06 | 구자홍 | 전기/전자 제품용 원 시스템 모듈 |
US6727585B2 (en) | 2001-05-04 | 2004-04-27 | Ixys Corporation | Power device with a plastic molded package and direct bonded substrate |
JP2008141122A (ja) * | 2006-12-05 | 2008-06-19 | Denso Corp | 樹脂モールド電子部品及びその製造方法 |
US7851267B2 (en) * | 2007-10-18 | 2010-12-14 | Infineon Technologies Ag | Power semiconductor module method |
US7944033B2 (en) * | 2007-10-18 | 2011-05-17 | Infineon Technologies Ag | Power semiconductor module |
DE112008003425B4 (de) | 2007-12-20 | 2023-08-31 | Aisin Aw Co., Ltd. | Verfahren zum Herstellen eines Halbleiterbauelements |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3824328A (en) * | 1972-10-24 | 1974-07-16 | Texas Instruments Inc | Encapsulated ptc heater packages |
US3839660A (en) * | 1973-02-05 | 1974-10-01 | Gen Motors Corp | Power semiconductor device package |
JPS5435666B2 (ja) * | 1975-02-11 | 1979-11-05 | ||
US4163072A (en) * | 1977-06-07 | 1979-07-31 | Bell Telephone Laboratories, Incorporated | Encapsulation of circuits |
JPS5591150A (en) * | 1978-12-28 | 1980-07-10 | Hitachi Ltd | Manufacture of resin-sealed semiconductor device |
JPS58128755A (ja) * | 1982-01-27 | 1983-08-01 | Toshiba Corp | 半導体装置 |
-
1983
- 1983-03-31 JP JP58055984A patent/JPS59181627A/ja active Granted
-
1984
- 1984-03-23 US US06/592,596 patent/US4558510A/en not_active Expired - Lifetime
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3616226A1 (de) * | 1985-05-15 | 1986-11-20 | Mitsubishi Denki K.K., Tokio/Tokyo | Halbleitereinrichtung |
JPH03225943A (ja) * | 1990-01-31 | 1991-10-04 | Nippondenso Co Ltd | 混成集積回路装置 |
Also Published As
Publication number | Publication date |
---|---|
JPS646538B2 (ja) | 1989-02-03 |
US4558510A (en) | 1985-12-17 |
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