JPS59108418A - 信号発生回路 - Google Patents
信号発生回路Info
- Publication number
- JPS59108418A JPS59108418A JP57217769A JP21776982A JPS59108418A JP S59108418 A JPS59108418 A JP S59108418A JP 57217769 A JP57217769 A JP 57217769A JP 21776982 A JP21776982 A JP 21776982A JP S59108418 A JPS59108418 A JP S59108418A
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- JP
- Japan
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- voltage
- circuit
- transistor
- switch
- capacitor
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- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/13—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/01—Shaping pulses
- H03K5/04—Shaping pulses by increasing duration; by decreasing duration
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Pulse Circuits (AREA)
- Manipulation Of Pulses (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、特にＩＣ化に適した高精度の信号発生回路に
関するものである。
関するものである。
従来の信号発生回路としては、第１図（Ａ）に示すよう
なものがあった。
なものがあった。
同図において、１はタイミング信号発生回路、２は比較
回路、Ｒ１，Ｒ２は比較用抵抗、Ｖｌは比較電圧、Ｑｌ
はスイッチング用トランジスタ、Ｒはタイミング用外付
抵抗、およびＣはタイミング用外付コンデンサである。
回路、Ｒ１，Ｒ２は比較用抵抗、Ｖｌは比較電圧、Ｑｌ
はスイッチング用トランジスタ、Ｒはタイミング用外付
抵抗、およびＣはタイミング用外付コンデンサである。
タイミング信号発生回路１から信号Ｓ＋が発生すると、
スイッチング用トランジスタＱ＋ はターンオンし、Ｓ
２の電圧は第１図（Ｂ）のようにスイッチング用トラン
ジスタＱ１のコレクタ飽和電圧Ｖ ＣＥＳとなる。
スイッチング用トランジスタＱ＋ はターンオンし、Ｓ
２の電圧は第１図（Ｂ）のようにスイッチング用トラン
ジスタＱ１のコレクタ飽和電圧Ｖ ＣＥＳとなる。
次に、信号Ｓ１が’Ｌｏ−”レベルになり、スイッチン
グ用トランジスタＱｌがターンオフすると、外付抵抗Ｒ
から外付コンデンサＣに充電電流が流れる。このとき、
Ｓ２の電圧Ｅは、 で表わされる（第１図（Ｂ））。
グ用トランジスタＱｌがターンオフすると、外付抵抗Ｒ
から外付コンデンサＣに充電電流が流れる。このとき、
Ｓ２の電圧Ｅは、 で表わされる（第１図（Ｂ））。
よって、Ｅ ＝Ｖ １ となるまでの時間Ｔは、となり
、Ｅ−■１となった時点で比較回路２が反転し、出力す
る。
、Ｅ−■１となった時点で比較回路２が反転し、出力す
る。
しかしながら、従来の信号発生回路はこのように構成さ
れていたため、ｓ２の電圧が比較電圧に等しくなるまで
の時間Ｔに、上式で示したように電源電圧Ｖｃｃおよび
コレクタ飽和電圧Ｖ Ｃ２０の項を含んでいる。
れていたため、ｓ２の電圧が比較電圧に等しくなるまで
の時間Ｔに、上式で示したように電源電圧Ｖｃｃおよび
コレクタ飽和電圧Ｖ Ｃ２０の項を含んでいる。
したがって、時間Ｔは電源電圧Ｖｃｃの変動の影響を直
接受け、かつ、コレクタ飽和電圧Ｖ ｃＥｓはＩＣ内部
で大きくばらつき、しかも温度変化もあるため、高精度
の時定数（Ｔ）の設定ができなかった。特に、電源電圧
Ｖｃｃの小さな低電圧回路においては、誤差が大きかっ
た。
接受け、かつ、コレクタ飽和電圧Ｖ ｃＥｓはＩＣ内部
で大きくばらつき、しかも温度変化もあるため、高精度
の時定数（Ｔ）の設定ができなかった。特に、電源電圧
Ｖｃｃの小さな低電圧回路においては、誤差が大きかっ
た。
本発明の目的は、上記従来の技術の欠点を克服し、電源
電圧の変動や温度の変動、トランジスタのばらつきにも
影響を受けることがなく、かつ構成の簡単な、ｒｃ化に
適した高精度の信号発生回路を提供することにある。
電圧の変動や温度の変動、トランジスタのばらつきにも
影響を受けることがなく、かつ構成の簡単な、ｒｃ化に
適した高精度の信号発生回路を提供することにある。
以下、図によって本発明を具体的に説明する。
第２図（Ａ）は本発明の信号発生回路の基本構成を示す
ブロック図であり、第２図（Ｂ）は各ブロックの電圧波
形を示すものである。
ブロック図であり、第２図（Ｂ）は各ブロックの電圧波
形を示すものである。
同図（Ａ）において、Ｖａは基準電圧、ｖｂは比較電圧
、およびＳＷはスイッチである。
、およびＳＷはスイッチである。
いま、タイミング信号発生回路１から信号Ｓ＋が発生す
ると、同図（Ｂ）のようにスイッチｓｗがオンとなり、
この間外付コンデンサＣに充電電流が流れ、Ｓ２の電圧
Ｅば基準電圧Ｖａに等しくなっている。このとき、比較
回路２がら出方ｓ３が発生している。
ると、同図（Ｂ）のようにスイッチｓｗがオンとなり、
この間外付コンデンサＣに充電電流が流れ、Ｓ２の電圧
Ｅば基準電圧Ｖａに等しくなっている。このとき、比較
回路２がら出方ｓ３が発生している。
次に、信号Ｓｌが“’ Ｌｏｗ ”レベルになり、スイ
ッチＳＷがオフになると、外付コンデンサＣがら放電電
流が外付抵抗Ｒを通して流れる。このとき、Ｓ２の電圧
Ｅは、 で表わされ、Ｅ＝Ｖｂとなるまでの時間Ｔｏは、Ｖａ となる。ここで、Ｖ ｂ −（Ｒ２／ Ｒ１＋ Ｒ２）
Ｖａなので、 ｐ＋ と表わされる。
ッチＳＷがオフになると、外付コンデンサＣがら放電電
流が外付抵抗Ｒを通して流れる。このとき、Ｓ２の電圧
Ｅは、 で表わされ、Ｅ＝Ｖｂとなるまでの時間Ｔｏは、Ｖａ となる。ここで、Ｖ ｂ −（Ｒ２／ Ｒ１＋ Ｒ２）
Ｖａなので、 ｐ＋ と表わされる。
ずなわち、Ｖａ 、Ｖｂの絶対値には無関係に比較用抵
抗Ｒｒ、Ｒ２の値のみによって、時間Ｔ。
抗Ｒｒ、Ｒ２の値のみによって、時間Ｔ。
が決定される。なお、タイミングの調整は、外付抵抗Ｒ
または外付コンデンサＣの値を調整することによって可
能である。
または外付コンデンサＣの値を調整することによって可
能である。
次に、実施例について説明する。
第３図は、本発明の一実施例よりなる信号発生回路の回
路図である。
路図である。
同図において、トランジスタＱ１と０２は差動ベアであ
り、トランジスタＱＢの定電流回路で駆動される。トラ
ンジスタＱ３とＱ４は電流ミラー回路であり、トランジ
スタＱ３に流れる電流と等しい電流をトランジスタＱ４
は流そうとする。
り、トランジスタＱＢの定電流回路で駆動される。トラ
ンジスタＱ３とＱ４は電流ミラー回路であり、トランジ
スタＱ３に流れる電流と等しい電流をトランジスタＱ４
は流そうとする。
トランジスタＱ５は電流増幅用であり、外付抵抗Ｒおよ
び外付コンデンサＣに電流を流す。トランジスタＱ１〜
Ｑ５はトランジスタＱ６により駆動される１００％負帰
還のアンプであり、定電圧源とスイッチの動作を行なう
。
び外付コンデンサＣに電流を流す。トランジスタＱ１〜
Ｑ５はトランジスタＱ６により駆動される１００％負帰
還のアンプであり、定電圧源とスイッチの動作を行なう
。
トランジスタＱ７とＱ８は差動ペアであり、電流源１ｏ
によって駆動される。トランジスタＱ＠とＱ＋ａは電流
ミラー回路であり、トランジスタＱ７に流れる電流と等
しい電流をＱ ＋ｏに流そうとする。トランジスタＱ７
〜Ｑ＋ｏと電流源１ｏで構成されるものは、電圧利得の
非常に大きな増幅器であり、電圧比較回路２として動作
する。
によって駆動される。トランジスタＱ＠とＱ＋ａは電流
ミラー回路であり、トランジスタＱ７に流れる電流と等
しい電流をＱ ＋ｏに流そうとする。トランジスタＱ７
〜Ｑ＋ｏと電流源１ｏで構成されるものは、電圧利得の
非常に大きな増幅器であり、電圧比較回路２として動作
する。
Ｖａば内部で発生される適当な大きさの電圧の電圧源で
ある。
ある。
Ｓ＋ は充放電のコントロールをするためのタイミング
信号であり、Ｉ（ｉ″レベルときトランジスタＱｂのベ
ースに適当な大きさの電圧を与え、差動アンプを動作さ
せる。トランジスタＱ２のベース、すなわち外付用端子
の電圧は、トランジスタＱ１のベース、すなわち基準電
圧■ａと等しくなる。このとき、外付抵抗Ｒと外付コン
デンサＣには、トランジスタＱ５から電流が供給される
。
信号であり、Ｉ（ｉ″レベルときトランジスタＱｂのベ
ースに適当な大きさの電圧を与え、差動アンプを動作さ
せる。トランジスタＱ２のベース、すなわち外付用端子
の電圧は、トランジスタＱ１のベース、すなわち基準電
圧■ａと等しくなる。このとき、外付抵抗Ｒと外付コン
デンサＣには、トランジスタＱ５から電流が供給される
。
このトランジスタＱ５は、外付コンデンサＣを十分速く
充電する能力をもつ。
充電する能力をもつ。
信号Ｓ１が“Ｌｏｗ”レベルになると、トランジスタＱ
６に電流を流さな（なるため、トランジスタＱ１〜Ｑ５
はずべてオフとなり、外付コンデンサＣは放電を始める
。
６に電流を流さな（なるため、トランジスタＱ１〜Ｑ５
はずべてオフとなり、外付コンデンサＣは放電を始める
。
このとき、Ｓ２の電圧Ｅは、
となる。誤差成分はトランジスタＱ７のベース電流分だ
けであり、十分にＨＦＥの高いトランジスタを使うか、
あるいはダーリントン接続することによって、誤差を無
視することができる。
けであり、十分にＨＦＥの高いトランジスタを使うか、
あるいはダーリントン接続することによって、誤差を無
視することができる。
電圧比較回路２のトランジスタＱａのベースは、比較電
圧ｖｂに固定されているため、Ｅ＝Ｖｂになったとき、
出力Ｓ３は“Ｌｏｗ ”レベルとなる。
圧ｖｂに固定されているため、Ｅ＝Ｖｂになったとき、
出力Ｓ３は“Ｌｏｗ ”レベルとなる。
その時間Ｔｏは、すでに説明したように、２
Ｔｏ＝−ＣＲ７！ｎ□
Ｒ１＋Ｒ２
となる。したがって、たとえ基準電圧Ｖａに温度特性あ
るいは電源電圧依存性があったとしても、時間Ｔｏには
全く影響を与えない。
るいは電源電圧依存性があったとしても、時間Ｔｏには
全く影響を与えない。
この時間Ｔｏに影響を与える一因子はＲ２／Ｒ１＋Ｒ２
であるが、このばらつきは、外付抵抗Ｒを半固定としこ
れを調整することによって補償できる。一度調整をして
おけば、抵抗Ｒ１とＲ２は同し温度特性（ＩＣ内部抵抗
）であるため、時間Ｔｏには影響を与えない。
であるが、このばらつきは、外付抵抗Ｒを半固定としこ
れを調整することによって補償できる。一度調整をして
おけば、抵抗Ｒ１とＲ２は同し温度特性（ＩＣ内部抵抗
）であるため、時間Ｔｏには影響を与えない。
また、もう−因子としてＣＲがあるが、これは部品を選
択することにより補償できる。
択することにより補償できる。
外付コンデンサＣは、第４図のように電源Ｖｃｃに接続
してもよい。ただし、この場合には、電源リップルの影
響を受ける。
してもよい。ただし、この場合には、電源リップルの影
響を受ける。
また、第５図のように、トランジスタのＮＰＮとＰＮＰ
とを逆にするように構成してもよい。
とを逆にするように構成してもよい。
第６図（Ａ）は、ＳＲフリップフロップ３を併用して、
同図（Ｂ）のようにタイミング信号の前縁からの時間を
設定できるようにしたものである。
同図（Ｂ）のようにタイミング信号の前縁からの時間を
設定できるようにしたものである。
すなわち、タイミング信号Ｓ＋ によってＳＲフリップ
フロップ３をセントする。このＱ信号により、スイッチ
ＳＷがオフとなり、外付コンデンサＣが放電を開始する
。Ｓ２の電圧がｖ６になると、電圧比較回路２の出力Ｓ
３が反転して“Ｈｉ”レベルとなり、ＳＲフリップフロ
ップ３をリセットする。０信号は”Ｈｉ”となり、スイ
ッチＳＷをオンし、充電を始めるために出力Ｓ３がすく
にまた反転し、次の信号Ｓ＋が入るまで充電状態で待機
する。
フロップ３をセントする。このＱ信号により、スイッチ
ＳＷがオフとなり、外付コンデンサＣが放電を開始する
。Ｓ２の電圧がｖ６になると、電圧比較回路２の出力Ｓ
３が反転して“Ｈｉ”レベルとなり、ＳＲフリップフロ
ップ３をリセットする。０信号は”Ｈｉ”となり、スイ
ッチＳＷをオンし、充電を始めるために出力Ｓ３がすく
にまた反転し、次の信号Ｓ＋が入るまで充電状態で待機
する。
第７図（Ａ）は、二つの電圧比較回路２，２′を使用し
てウィンドコンパレータとし、同図（Ｂ）のようにトリ
ガー信号からある遅延をもったパルスを発生するように
したものである。
てウィンドコンパレータとし、同図（Ｂ）のようにトリ
ガー信号からある遅延をもったパルスを発生するように
したものである。
これは、たとえばビデオ信号のキードクランプのキー信
号の発生に使用できる。
号の発生に使用できる。
以上説明したように、本発明の信号発生回路においては
電源電圧に対する依存性がなく、ＩＣ内部と外部の温度
変動が異なっていても温度補償ができ、非常に高精度に
時定数を決定することかできる。
電源電圧に対する依存性がなく、ＩＣ内部と外部の温度
変動が異なっていても温度補償ができ、非常に高精度に
時定数を決定することかできる。
また、この回路は構成が簡単であり、外付用端子も１個
で済む。
で済む。
第１図（Ａ）（Ｂ）は従来の回路の回路図と波形図、第
２図（Ａ）（Ｂ）は本発明の信号発生回路の基本構成を
示す回路図と波形図、第３図は一実施例よりなる回路図
、第４図、第５図はその変形例を示す回路図、第６図（
Ａ）（Ｂ）は引用例よりなる回路図と波形図、および第
７図（Ａ）（Ｂ）は他の転用例よりなる回路図と波形図
である。 ■・・・・・・タイミング信号発生回路、２・・・・・
・比較回路、Ｒ１，Ｒ２・・・・・・比較用抵抗、Ｖａ
・・・・・・基準電圧、ｖｂ・・・・・・比較電圧、Ｒ
・・・・・・外付抵抗、Ｃ・・・・・・外付コンデンサ
。 特許出願人 パイオニア株式会社 ０ （Ａ） （Ｂ） 第２図 （Ａ） （Ｂ） ＳＷ＋ （ＯＮ ） 第４図 第６図 （Ａ） （Ｂ） ３ 第７図 （Ｂ） Ｓｓ（ＯＵＴ）
２図（Ａ）（Ｂ）は本発明の信号発生回路の基本構成を
示す回路図と波形図、第３図は一実施例よりなる回路図
、第４図、第５図はその変形例を示す回路図、第６図（
Ａ）（Ｂ）は引用例よりなる回路図と波形図、および第
７図（Ａ）（Ｂ）は他の転用例よりなる回路図と波形図
である。 ■・・・・・・タイミング信号発生回路、２・・・・・
・比較回路、Ｒ１，Ｒ２・・・・・・比較用抵抗、Ｖａ
・・・・・・基準電圧、ｖｂ・・・・・・比較電圧、Ｒ
・・・・・・外付抵抗、Ｃ・・・・・・外付コンデンサ
。 特許出願人 パイオニア株式会社 ０ （Ａ） （Ｂ） 第２図 （Ａ） （Ｂ） ＳＷ＋ （ＯＮ ） 第４図 第６図 （Ａ） （Ｂ） ３ 第７図 （Ｂ） Ｓｓ（ＯＵＴ）
Claims (1)
- タイミング信号によって駆動されるスイッチと、直流電
圧を分圧する分圧抵抗と、前記スイッチを介して直流電
圧によって充電される時定数回路と、前記スイッチのオ
フ時に前記分圧抵抗による電圧と前記時定数回路による
放電電圧とを比較する比較回路とを備えたことを特徴と
する信号発生回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57217769A JPS59108418A (ja) | 1982-12-14 | 1982-12-14 | 信号発生回路 |
| GB08332876A GB2134736B (en) | 1982-12-14 | 1983-12-09 | Signal generating circuit |
| DE3345297A DE3345297C2 (de) | 1982-12-14 | 1983-12-14 | Schaltung zum Erzeugen einer Signalverzögerung |
| US06/561,439 US4611136A (en) | 1982-12-14 | 1983-12-14 | Signal delay generating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57217769A JPS59108418A (ja) | 1982-12-14 | 1982-12-14 | 信号発生回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59108418A true JPS59108418A (ja) | 1984-06-22 |
Family
ID=16709440
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57217769A Pending JPS59108418A (ja) | 1982-12-14 | 1982-12-14 | 信号発生回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4611136A (ja) |
| JP (1) | JPS59108418A (ja) |
| DE (1) | DE3345297C2 (ja) |
| GB (1) | GB2134736B (ja) |
Families Citing this family (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR900004191B1 (ko) * | 1987-03-18 | 1990-06-18 | 삼성전자 주식회사 | Rc시정수를 이용한 가변 클럭 지연회로 |
| DE3905689A1 (de) * | 1989-02-24 | 1990-08-30 | Philips Patentverwaltung | Schaltungsanordnung mit zwei parallelen zweigen zur uebertragung eines binaersignales |
| FR2655218A1 (fr) * | 1989-11-28 | 1991-05-31 | Radiotechnique Compelec | Circuit retardateur a retard reglable. |
| US5124597A (en) * | 1991-04-01 | 1992-06-23 | Tektronix, Inc. | Timer circuit including an analog ramp generator and a CMOS counter |
| US5144157A (en) * | 1991-09-23 | 1992-09-01 | Raytheon Company | Pin diode driver circuit for radar system |
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| WO1999000900A1 (en) * | 1997-06-27 | 1999-01-07 | Koninklijke Philips Electronics N.V. | Generation of a time period |
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-
1982
- 1982-12-14 JP JP57217769A patent/JPS59108418A/ja active Pending
-
1983
- 1983-12-09 GB GB08332876A patent/GB2134736B/en not_active Expired
- 1983-12-14 DE DE3345297A patent/DE3345297C2/de not_active Expired
- 1983-12-14 US US06/561,439 patent/US4611136A/en not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5242622A (en) * | 1975-09-30 | 1977-04-02 | Takeshige Shimonohara | Building constitution element and its preparation method |
Also Published As
| Publication number | Publication date |
|---|---|
| US4611136A (en) | 1986-09-09 |
| GB8332876D0 (en) | 1984-01-18 |
| DE3345297C2 (de) | 1986-08-28 |
| GB2134736B (en) | 1986-12-03 |
| DE3345297A1 (de) | 1984-07-05 |
| GB2134736A (en) | 1984-08-15 |
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