JPS58172044A - デ−タハイウエイ方式 - Google Patents
デ−タハイウエイ方式Info
- Publication number
- JPS58172044A JPS58172044A JP57054455A JP5445582A JPS58172044A JP S58172044 A JPS58172044 A JP S58172044A JP 57054455 A JP57054455 A JP 57054455A JP 5445582 A JP5445582 A JP 5445582A JP S58172044 A JPS58172044 A JP S58172044A
- Authority
- JP
- Japan
- Prior art keywords
- data
- node
- frame
- check
- error
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野
本発明は少なくとも１台のハイウェイ監視ノードと複数
台のステージ璽ンノードを環状の伝送路で接続して、任
意のノード間でデータの授受を行うデータハイウェイ方
式に関し、特に伝送路エラーのチェックを可能とする本
のである。
台のステージ璽ンノードを環状の伝送路で接続して、任
意のノード間でデータの授受を行うデータハイウェイ方
式に関し、特に伝送路エラーのチェックを可能とする本
のである。
技術の背景
通常のデータハイウェイシステムでは、フレームヘッダ
内に同期フラグを持ち、各ノードは該同期フラグを基に
同期を確立してデータの授受を行う。
内に同期フラグを持ち、各ノードは該同期フラグを基に
同期を確立してデータの授受を行う。
第１図は一般的なデータハイウェイシステムの構成図で
、ハイウェイ監視ノードＳｖと複数台のステージ欝ンノ
ードＳＴ（添字により相互間を区別する、以下同じ）と
の間は環状の伝送路ＬＫより接続されている０図では伝
送路ｔは１本で示されているが、実際のシステムでは信
頼度対策のため二重化がなされているのが一般的である
。各ステージ璽ンノード８ＴＫはサブシステム８８が接
続され、これらのサブシステム関でステージ曹ンノード
および伝送路つまシデータハイウェイを介しデータの授
受が行なわれる。第２図は伝送路ｔを流れる情報の単位
フレームを示す図で、通常１フレームにはフレームヘッ
ダＦＨＤ と複数のパケットＰ・〜Ｐ、が収容される０
図ではパケット形式で示されているが、全領域がデータ
形式であって亀差し支えはない、１つのパケットには画
数パケットが使用中か否か、パケット内データは送るべ
きデータ群の中の何番目のデータか等を示すプント四−
ル部ＣＴＬ、データを受けてほしい相手方のチャネル（
サブシステム）アドレスロム、データを送り出す発信元
のチャネルアドレスＯＡ％ ｊｌ初ｔｉブランクで相手
側からの応答（受信した勢の）が１込まれる応答部ＲＥ
Ｄ、有効データ長を示すしングス部ＬＮＧ、データ部、
該データ部に対するチェ、クバイトＬＲＣが収容される
。
、ハイウェイ監視ノードＳｖと複数台のステージ欝ンノ
ードＳＴ（添字により相互間を区別する、以下同じ）と
の間は環状の伝送路ＬＫより接続されている０図では伝
送路ｔは１本で示されているが、実際のシステムでは信
頼度対策のため二重化がなされているのが一般的である
。各ステージ璽ンノード８ＴＫはサブシステム８８が接
続され、これらのサブシステム関でステージ曹ンノード
および伝送路つまシデータハイウェイを介しデータの授
受が行なわれる。第２図は伝送路ｔを流れる情報の単位
フレームを示す図で、通常１フレームにはフレームヘッ
ダＦＨＤ と複数のパケットＰ・〜Ｐ、が収容される０
図ではパケット形式で示されているが、全領域がデータ
形式であって亀差し支えはない、１つのパケットには画
数パケットが使用中か否か、パケット内データは送るべ
きデータ群の中の何番目のデータか等を示すプント四−
ル部ＣＴＬ、データを受けてほしい相手方のチャネル（
サブシステム）アドレスロム、データを送り出す発信元
のチャネルアドレスＯＡ％ ｊｌ初ｔｉブランクで相手
側からの応答（受信した勢の）が１込まれる応答部ＲＥ
Ｄ、有効データ長を示すしングス部ＬＮＧ、データ部、
該データ部に対するチェ、クバイトＬＲＣが収容される
。
第４図はフレームヘッダＦＨＤの詳細図で、８ＹＮはパ
ケット位置の規準となる同期フラグ、ＮＡＤは稜続する
ノードコマンドＮＣＭＤを受信すべきノードのアドレス
、ＮＣＭＤは使用回線等を指示するノードコマンド、Ｎ
ＲＥ８はノードレスポンスである。第５図はこのノード
レスポンスＮＲＥ８の詳細図で、全体は８ビツト構成で
ある。Ｐはビット０〜６のパリティビット、ＷＲＡＰは
折り返しモードを指示するビット、ＬＩＮＥは伝送路０
／１（現用／予備）のいずれを使用するを指示するビッ
ト、ＬＲＣＣＫはチェックバイトエラーを示すピッ）、
ＬＶＬＣＫは伝送路からの信号のレベル低下を示すビッ
ト、ＤＢＲＣＫはノード内にあるデータバッファ中のパ
リティエラーを示すビット、ＰＯＷＣＫは電源回路の異
常を示すピッ）、ＮＲＥ８はビ、ト１〜７が有効である
（−１’）か否かを示すビットである。フレームヘッダ
はＳ■と８７との交信用に使用される。
ケット位置の規準となる同期フラグ、ＮＡＤは稜続する
ノードコマンドＮＣＭＤを受信すべきノードのアドレス
、ＮＣＭＤは使用回線等を指示するノードコマンド、Ｎ
ＲＥ８はノードレスポンスである。第５図はこのノード
レスポンスＮＲＥ８の詳細図で、全体は８ビツト構成で
ある。Ｐはビット０〜６のパリティビット、ＷＲＡＰは
折り返しモードを指示するビット、ＬＩＮＥは伝送路０
／１（現用／予備）のいずれを使用するを指示するビッ
ト、ＬＲＣＣＫはチェックバイトエラーを示すピッ）、
ＬＶＬＣＫは伝送路からの信号のレベル低下を示すビッ
ト、ＤＢＲＣＫはノード内にあるデータバッファ中のパ
リティエラーを示すビット、ＰＯＷＣＫは電源回路の異
常を示すピッ）、ＮＲＥ８はビ、ト１〜７が有効である
（−１’）か否かを示すビットである。フレームヘッダ
はＳ■と８７との交信用に使用される。
従来技術と問題点
上述したデータハイウェイではあるサブシステム例えば
ＳＳ・・が他のサブシステム例えば８１１！１１・と交
信しようとするときは空きパケットを発見してその中に
アドレス及びデータを入れて送出し、各ステージ冒ンノ
ードは各パケットの送）先アドレスＤムをチェックして
自局のものであればそれを取り込む、自局の受信データ
に対するチェックは当該パケットのチェックバイトＬＲ
Ｃ（第２図）を用いて行なっているが自局宛のものでな
ければそのパケットは次ステージ曹ンノードヘ送）出し
ているだけで、エラーチェックなどはしない、従ってサ
ブシステム８８ｏｏから送出されてサブシステム８８ｍ
・に受信されたデータにエラーが有りた、無いは分るが
、エラーがあってもそのエラーは伝送中何処で発生した
かは分らない、ｔた同期フラグＳＹＮにより検出される
同期エラーが発生すると、発生箇所以降に接続されてい
るノードでこれを検出することができる。しかしハイウ
ェイ監視ノード８ｖは同期エラーを検出しても、どの区
間で同期エラーが発生したかを特定できない、このよう
に１従来方式ではエラー発生は分るが、そのエラーの発
生区間を限定することができない欠点があった。
ＳＳ・・が他のサブシステム例えば８１１！１１・と交
信しようとするときは空きパケットを発見してその中に
アドレス及びデータを入れて送出し、各ステージ冒ンノ
ードは各パケットの送）先アドレスＤムをチェックして
自局のものであればそれを取り込む、自局の受信データ
に対するチェックは当該パケットのチェックバイトＬＲ
Ｃ（第２図）を用いて行なっているが自局宛のものでな
ければそのパケットは次ステージ曹ンノードヘ送）出し
ているだけで、エラーチェックなどはしない、従ってサ
ブシステム８８ｏｏから送出されてサブシステム８８ｍ
・に受信されたデータにエラーが有りた、無いは分るが
、エラーがあってもそのエラーは伝送中何処で発生した
かは分らない、ｔた同期フラグＳＹＮにより検出される
同期エラーが発生すると、発生箇所以降に接続されてい
るノードでこれを検出することができる。しかしハイウ
ェイ監視ノード８ｖは同期エラーを検出しても、どの区
間で同期エラーが発生したかを特定できない、このよう
に１従来方式ではエラー発生は分るが、そのエラーの発
生区間を限定することができない欠点があった。
発明の目的
本発明の目的は各ステージ１ンノードが伝送路エラーを
検出し、これが検出された時にエラー発生を知らせて、
ハイウェイ監視ノードでエラー発生区間を特定すること
が可能な、データハイウェイ方式を提供することにある
。
検出し、これが検出された時にエラー発生を知らせて、
ハイウェイ監視ノードでエラー発生区間を特定すること
が可能な、データハイウェイ方式を提供することにある
。
発明の構成
本発明は、少なくとも１台のハイウェイ監視ノードと複
数のステージ璽ンノードとを環状伝送路で接続し、各ス
テージ曹ンノードに接続される任意のサブシステム相互
間でデータ交換を行うデータハイウェイ方式において、
上記伝送路を流れるデータ形式フレーム内の特定の領域
内にフレーム専用のチェックバイトを設定し、また各ノ
ードには該チェックバイトの作成回路と検査回路を設け
、そして各ノードから該塊状伝送路へのデータ送出時に
は該作成回路から該チェックバイトにチェックデータを
書込み、また該環状伝送路からのデータ受信時には各ノ
ードは該検査回路によって該チェックバイト上のデータ
を検査するととＫより１各伝送区間毎のエラー検出をす
るようにしてなることを特徴とするが、以下図面を参照
し表からこれを詳細に説明する。
数のステージ璽ンノードとを環状伝送路で接続し、各ス
テージ曹ンノードに接続される任意のサブシステム相互
間でデータ交換を行うデータハイウェイ方式において、
上記伝送路を流れるデータ形式フレーム内の特定の領域
内にフレーム専用のチェックバイトを設定し、また各ノ
ードには該チェックバイトの作成回路と検査回路を設け
、そして各ノードから該塊状伝送路へのデータ送出時に
は該作成回路から該チェックバイトにチェックデータを
書込み、また該環状伝送路からのデータ受信時には各ノ
ードは該検査回路によって該チェックバイト上のデータ
を検査するととＫより１各伝送区間毎のエラー検出をす
るようにしてなることを特徴とするが、以下図面を参照
し表からこれを詳細に説明する。
発明の実施例
本発明では伝送路を流れるデータ形式内に第３図に示す
フレームチェックバイトＦＣＫを付加する。
フレームチェックバイトＦＣＫを付加する。
このチェックバイトＦＣＫ社エラーチェック用データで
あり、例えば”１″の数は奇数個などそれ自体が規則性
を有してチェックによりエラーかが分るもの、あるいは
１フレーム中の全ビットに対する水平パリティであって
もよい、第２図に示すチェックバイトＬＲＣはパケット
内データのエラーチェック用であるからこれとは異なる
。そして各ノードはフレーム送出時にこのフレームチェ
ックバ（） ＣＫＢにチェックデータを付加して送出す
る。又フレーム受信時にはこのフレームチェックバイト
ＦＣＫのチェックを行ない、ノード間の伝送路エラーを
チェックする。これによりハイウェイ監視ノード８ＶＫ
対して伝送路エラーを検出した旨を通報することが可能
となる。
あり、例えば”１″の数は奇数個などそれ自体が規則性
を有してチェックによりエラーかが分るもの、あるいは
１フレーム中の全ビットに対する水平パリティであって
もよい、第２図に示すチェックバイトＬＲＣはパケット
内データのエラーチェック用であるからこれとは異なる
。そして各ノードはフレーム送出時にこのフレームチェ
ックバ（） ＣＫＢにチェックデータを付加して送出す
る。又フレーム受信時にはこのフレームチェックバイト
ＦＣＫのチェックを行ない、ノード間の伝送路エラーを
チェックする。これによりハイウェイ監視ノード８ＶＫ
対して伝送路エラーを検出した旨を通報することが可能
となる。
次に第６図を参照しながら本発明の一実施例を説明する
。同図は１つのステージ冒ンノードＳ丁のブーツク図で
、１０１，１０２ｋｉレピータである。レピータ１０１
，１０２は、伝送路ＬＯ，ＬＩ上のシリアルな光信号か
らクロック成分とデータ成分を抽出して電気信号に変換
する機能および逆方向の変換機能を有する。１０３はシ
リアルデータをパラレルデータに変換するレジスタ、１
０４はフレーム上の同期フラグＳＹＮを検出する回路、
１０５はレピータ１０１または１０２で抽出したりｐツ
ク成分から各回路に必要々り四ツク信号およびタイミン
グ信号を作成する回路、１０６はパラレルデータを蓄え
るバッファレジスタ、、１０７はノードアドレス設定回
路、ノードアドレス検出回路、ノードコマンド解析回路
及びノードレスポンス制御回路を含む回路（以下これら
を区別するときｕ 記号１０７Ａ〜１ｏ７Ｄを使う）、
１０１５はフレームの水平パリティ（７レームチエツク
バイトＦＣＫ ）の作成（ＧＥＮ）およびｆ ｚ ｙ
／ （ＣＨＫ）Ｄａ路（こｏ区別は１０８Ａ、１０８１
１−７’行なう）、１０９は同期フラグ等のデータをフ
レーム形式に作成する回路、１１ｏはステージ冒ンノー
ド全体の制御を行なう回路、１１１はデータ、制御情報
の送出を切替えるための回路、１１２はパラレルデータ
をシリアルデータに変換するためのレジスタ、１１５，
１１４は前述した伝送路ＬＤ、 ｘ、１であり、現用系
と予備系が用意されている。
。同図は１つのステージ冒ンノードＳ丁のブーツク図で
、１０１，１０２ｋｉレピータである。レピータ１０１
，１０２は、伝送路ＬＯ，ＬＩ上のシリアルな光信号か
らクロック成分とデータ成分を抽出して電気信号に変換
する機能および逆方向の変換機能を有する。１０３はシ
リアルデータをパラレルデータに変換するレジスタ、１
０４はフレーム上の同期フラグＳＹＮを検出する回路、
１０５はレピータ１０１または１０２で抽出したりｐツ
ク成分から各回路に必要々り四ツク信号およびタイミン
グ信号を作成する回路、１０６はパラレルデータを蓄え
るバッファレジスタ、、１０７はノードアドレス設定回
路、ノードアドレス検出回路、ノードコマンド解析回路
及びノードレスポンス制御回路を含む回路（以下これら
を区別するときｕ 記号１０７Ａ〜１ｏ７Ｄを使う）、
１０１５はフレームの水平パリティ（７レームチエツク
バイトＦＣＫ ）の作成（ＧＥＮ）およびｆ ｚ ｙ
／ （ＣＨＫ）Ｄａ路（こｏ区別は１０８Ａ、１０８１
１−７’行なう）、１０９は同期フラグ等のデータをフ
レーム形式に作成する回路、１１ｏはステージ冒ンノー
ド全体の制御を行なう回路、１１１はデータ、制御情報
の送出を切替えるための回路、１１２はパラレルデータ
をシリアルデータに変換するためのレジスタ、１１５，
１１４は前述した伝送路ＬＤ、 ｘ、１であり、現用系
と予備系が用意されている。
動作を説明する。今、伝送路ＬＯが現用で皺伝送路から
フレームが到着すると、レピータ１０１によりデータ成
分とりμツク成分の抽出が行われる。このうちり四ツク
成分はクロック作成回路１０５に導ひかれ、ここで必要
なりロックが発生される。またこの回路１０５でフレー
ムヘッダＦＨＤ内の同期フラグＳＹＮを検出するととＫ
よシ、受信データの位置（パケットの位置）を知ること
ができる。一方、ＦＣＫチェック回路ＩＱ１５１はフレ
ームが到着する毎にフレームチェックバイ） ＦＣＫを
用いてフレームの水平パリティチェックを行う、そして
パリティエラーを検出したらノードレスポンス制御回路
１０７Ｄにエラー情報を記憶する（書込む）、そして次
のフレームを受信し、そのフレームヘッダＦＨＤＫおけ
るノードレスポンス部ＮＲｇ８にデータが書込まれてい
ない時は、ノードアドレス設定回路１０７ムにょシェラ
−を検出し九ノードっまヤ自己のノードアドレスＮＡＤ
を畳込み、またエラー検出を示すノードレスポンスＮＲ
ｇ８を書込んで該フレームを伝送路ＬＯに送出する。こ
れらのフレームへの書込みは切替え回路１１１を操作す
ることにより可能となる。又、ＦＣＫ作成回路１０８Ａ
は送出するデータを常時監視し、フレームの最後つまプ
フレームチェックバイトＦＣＫにチェックデータを付加
し、伝送路ＬＯに送出する。
フレームが到着すると、レピータ１０１によりデータ成
分とりμツク成分の抽出が行われる。このうちり四ツク
成分はクロック作成回路１０５に導ひかれ、ここで必要
なりロックが発生される。またこの回路１０５でフレー
ムヘッダＦＨＤ内の同期フラグＳＹＮを検出するととＫ
よシ、受信データの位置（パケットの位置）を知ること
ができる。一方、ＦＣＫチェック回路ＩＱ１５１はフレ
ームが到着する毎にフレームチェックバイ） ＦＣＫを
用いてフレームの水平パリティチェックを行う、そして
パリティエラーを検出したらノードレスポンス制御回路
１０７Ｄにエラー情報を記憶する（書込む）、そして次
のフレームを受信し、そのフレームヘッダＦＨＤＫおけ
るノードレスポンス部ＮＲｇ８にデータが書込まれてい
ない時は、ノードアドレス設定回路１０７ムにょシェラ
−を検出し九ノードっまヤ自己のノードアドレスＮＡＤ
を畳込み、またエラー検出を示すノードレスポンスＮＲ
ｇ８を書込んで該フレームを伝送路ＬＯに送出する。こ
れらのフレームへの書込みは切替え回路１１１を操作す
ることにより可能となる。又、ＦＣＫ作成回路１０８Ａ
は送出するデータを常時監視し、フレームの最後つまプ
フレームチェックバイトＦＣＫにチェックデータを付加
し、伝送路ＬＯに送出する。
一方、ハイウェイ監視ノードＳｖも第６図と同様な回路
構成を持ち、ノードレスポンスＮＲＥ８ 内（）ＦＣＫ
エラー情報とそれを発したノードアドレスＮＡＤを監視
しているので、これにより伝送路エラー区間が限定でき
る拳 なおエラーが発生すると後続のステージ嘗ンノードで次
々とエラー検出することが予想される臥フレームヘッダ
のノードレスポンス部へは１ノードしかデータを書込め
ないので、螢絖ステージ冒ンノードは単にエラー検出を
するにとどする。勿論、当＃フレームが監視ノードに達
するとデータが吸い上げられ、ノードレスポンス部はク
リヤされるから、次サイクルでは再び書込みが可能にな
る。なお、上述した７レ一五単位０ＦＣＩエラーチェッ
クと並行して自局宛のパケット単位のＬｍＩＣエラーチ
ェック龜行なわれる。
構成を持ち、ノードレスポンスＮＲＥ８ 内（）ＦＣＫ
エラー情報とそれを発したノードアドレスＮＡＤを監視
しているので、これにより伝送路エラー区間が限定でき
る拳 なおエラーが発生すると後続のステージ嘗ンノードで次
々とエラー検出することが予想される臥フレームヘッダ
のノードレスポンス部へは１ノードしかデータを書込め
ないので、螢絖ステージ冒ンノードは単にエラー検出を
するにとどする。勿論、当＃フレームが監視ノードに達
するとデータが吸い上げられ、ノードレスポンス部はク
リヤされるから、次サイクルでは再び書込みが可能にな
る。なお、上述した７レ一五単位０ＦＣＩエラーチェッ
クと並行して自局宛のパケット単位のＬｍＩＣエラーチ
ェック龜行なわれる。
発明の詳細
な説明した様に本発明によれば、７レームに専用のチェ
ックバイトを設け、各ステージ１ンノードが７レームを
送出の際に＃バイトにチェツタデータを付加し、フレー
ムを受信する際にそれをチェックする方式であるために
、エラー発生があれば直ちにそれが次のノードで分夛、
伝送路エラー発生区間が限定できる。又、フレームヘッ
ダのノードアドレスとノードレスポンスによってハイウ
ェイ監視ノードに該エラー情報を転送できるため、広範
囲に設置されたノードを該監視ノード１箇所で監視でき
る利点がある。
ックバイトを設け、各ステージ１ンノードが７レームを
送出の際に＃バイトにチェツタデータを付加し、フレー
ムを受信する際にそれをチェックする方式であるために
、エラー発生があれば直ちにそれが次のノードで分夛、
伝送路エラー発生区間が限定できる。又、フレームヘッ
ダのノードアドレスとノードレスポンスによってハイウ
ェイ監視ノードに該エラー情報を転送できるため、広範
囲に設置されたノードを該監視ノード１箇所で監視でき
る利点がある。
第１図は一般的なデータハイウェイシステムの概略構成
図、第２図は従来の単位フレームの構成図、第３図は本
発明に係る単位フレームの構成図、第４図はフレームヘ
ッダの説明図、第５図はフレームヘッダ内ノードレスポ
ンスの詳細図、第６図は本発明の一実施例を示す構成図
である。 図中、Ｓｖはハイウェイ監視ノード、ｓＴはステージ璽
ンノード、ｔは環状伝送路、ｓｓはサブシステ人、ＦＣ
Ｋはフレームチェ、クバイト、１０Ｂはチェックバイト
作成および検査回路、１０７はエラー情報の記憶および
送出機能を有する回路である。 出飄人 富士通株式会社
図、第２図は従来の単位フレームの構成図、第３図は本
発明に係る単位フレームの構成図、第４図はフレームヘ
ッダの説明図、第５図はフレームヘッダ内ノードレスポ
ンスの詳細図、第６図は本発明の一実施例を示す構成図
である。 図中、Ｓｖはハイウェイ監視ノード、ｓＴはステージ璽
ンノード、ｔは環状伝送路、ｓｓはサブシステ人、ＦＣ
Ｋはフレームチェ、クバイト、１０Ｂはチェックバイト
作成および検査回路、１０７はエラー情報の記憶および
送出機能を有する回路である。 出飄人 富士通株式会社
Claims (2)
- （１）少なくとも１台のハイウェイ監視ノードとＩＩ黴
のステージ璽ンノードとを環状伝送路で接続し各ステー
ジ冒ンノードに接続される任意０１プシステム相互間で
データ交換を行うデータ＾イウェイ、方式において、上
記伝送路を流れ為データ形式フレーム内の特定Ｏ領域内
にフレーム専用のチェックバイトを設定し、壇九各ノー
ドには該チェックバイ）０作成回路と検査回路を設け、
そして各ノードから該環状伝送路へのデータ送出時には
該作成回路から該チェックバイトにチェックデータを書
込み、壕え該環状伝送路からのデータ受信時には各ノー
ドは該検査回路にようて該チェックバイト上のデータを
検査する仁とＫより、各伝送区間毎のエラー検出をする
ようＫしてなることを特徴とするデータハイウェイ方式
。 - （２）ステージ冒ンノードはエラー記憶回路と自己のア
ドレスを含むエラー情報の送出回路とを備え、チェック
バイト検出回路で検出した伝送区間エラー情報をハイウ
ェイ監視ノードに転送可能としてなることを特徴とする
特許請求の範囲第１項記載のデータハイウェイ方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57054455A JPS58172044A (ja) | 1982-04-01 | 1982-04-01 | デ−タハイウエイ方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57054455A JPS58172044A (ja) | 1982-04-01 | 1982-04-01 | デ−タハイウエイ方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58172044A true JPS58172044A (ja) | 1983-10-08 |
Family
ID=12971150
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57054455A Pending JPS58172044A (ja) | 1982-04-01 | 1982-04-01 | デ−タハイウエイ方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58172044A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02180451A (ja) * | 1988-12-29 | 1990-07-13 | Nec Home Electron Ltd | データ伝送方式 |
| US5252961A (en) * | 1988-02-12 | 1993-10-12 | Fujitsu Limited | System for monitoring status of plurality of repeaters |
-
1982
- 1982-04-01 JP JP57054455A patent/JPS58172044A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5252961A (en) * | 1988-02-12 | 1993-10-12 | Fujitsu Limited | System for monitoring status of plurality of repeaters |
| JPH02180451A (ja) * | 1988-12-29 | 1990-07-13 | Nec Home Electron Ltd | データ伝送方式 |
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