JPH1083309A - 情報処理装置、プログラム更新方法、および、情報処理システム - Google Patents
情報処理装置、プログラム更新方法、および、情報処理システムInfo
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- JPH1083309A JPH1083309A JP9587997A JP9587997A JPH1083309A JP H1083309 A JPH1083309 A JP H1083309A JP 9587997 A JP9587997 A JP 9587997A JP 9587997 A JP9587997 A JP 9587997A JP H1083309 A JPH1083309 A JP H1083309A
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Abstract
(57)【要約】
【課題】 元のＢＩＯＳを所定の記憶領域に記憶した
後、ＢＩＯＳの更新を行う。 【解決手段】 フラッシュＲＯＭボード５２のフラッシ
ュＲＯＭのバンクＡに記憶されているＢＩＯＳをバンク
Ｂに移動し、ホームサーバからネットワークインタフェ
ースカード５７に供給された新しいＢＩＯＳをバンクＡ
に記憶させて、ＢＩＯＳの更新を行う。新しいＢＩＯＳ
が良好に動作しない場合、フラッシュＲＯＭのバンクＢ
のＢＩＯＳを、ＲＡＭ５３を介してバンクＡに移動する
ことにより、元のＢＩＯＳを復帰させることができる。
後、ＢＩＯＳの更新を行う。 【解決手段】 フラッシュＲＯＭボード５２のフラッシ
ュＲＯＭのバンクＡに記憶されているＢＩＯＳをバンク
Ｂに移動し、ホームサーバからネットワークインタフェ
ースカード５７に供給された新しいＢＩＯＳをバンクＡ
に記憶させて、ＢＩＯＳの更新を行う。新しいＢＩＯＳ
が良好に動作しない場合、フラッシュＲＯＭのバンクＢ
のＢＩＯＳを、ＲＡＭ５３を介してバンクＡに移動する
ことにより、元のＢＩＯＳを復帰させることができる。
Description
【０００１】
【発明の属する技術分野】本発明は情報処理装置、プロ
グラム更新方法、および、情報処理システムに関し、特
に、ＢＩＯＳ等のプログラムをネットワーク経由で更新
するのに好適な情報処理装置、プログラム更新方法、お
よび、情報処理システムに関する。
グラム更新方法、および、情報処理システムに関し、特
に、ＢＩＯＳ等のプログラムをネットワーク経由で更新
するのに好適な情報処理装置、プログラム更新方法、お
よび、情報処理システムに関する。
【０００２】
【従来の技術】最近、インターネットに代表されるネッ
トワークが発達し、パーソナルコンピュータなどをネッ
トワークに接続して、各種の情報を授受することができ
るようになってきた。
トワークが発達し、パーソナルコンピュータなどをネッ
トワークに接続して、各種の情報を授受することができ
るようになってきた。
【０００３】このような、インターネットに対する接続
は、アナログ電話回線、ＩＳＤＮ(Integrated Services
Digital Network)といった通信回線を介して行うこと
が可能である。また、最近では、ケーブルテレビジョン
（ＣＡＴＶ）システムのケーブルを介して、インターネ
ットなどのネットワークにアクセスすることができるよ
うになってきた。
は、アナログ電話回線、ＩＳＤＮ(Integrated Services
Digital Network)といった通信回線を介して行うこと
が可能である。また、最近では、ケーブルテレビジョン
（ＣＡＴＶ）システムのケーブルを介して、インターネ
ットなどのネットワークにアクセスすることができるよ
うになってきた。
【０００４】このように、インターネットなどのネット
ワークにアクセスする場合、所定の通信回線を介して送
信および受信を行う送受信回路を有する情報処理装置が
使用される。
ワークにアクセスする場合、所定の通信回線を介して送
信および受信を行う送受信回路を有する情報処理装置が
使用される。
【０００５】図１８は、そのような情報処理装置の一例
を示している。この情報処理装置は、モデム１０５を利
用し、アナログ電話回線を介して送信および受信を行う
ことができる。ＣＰＵ１０１は、フラッシュＲＯＭ（Ｆ
ＥＥＰＲＯＭ(Flash Electrical Erasable Programmabl
e ROM)以下、単にフラッシュＲＯＭと略称する）１０２
に記憶されているプログラムに従って、各種の処理を実
行する。ＲＡＭ１０３には、ＣＰＵ１０１が各種の処理
を実行する上において必要なデータなどが、適宜記憶さ
れる。ＣＰＵ１０１は、モデム１０５を利用して、アナ
ログ電話回線を介して送信されてくるデータを受信す
る。そして、ＣＰＵ１０１は、そのデータを処理し、例
えば、ディスプレイインタフェース１０６を介して、受
信した画像データをディスプレイ（図示せず）に表示さ
せる。
を示している。この情報処理装置は、モデム１０５を利
用し、アナログ電話回線を介して送信および受信を行う
ことができる。ＣＰＵ１０１は、フラッシュＲＯＭ（Ｆ
ＥＥＰＲＯＭ(Flash Electrical Erasable Programmabl
e ROM)以下、単にフラッシュＲＯＭと略称する）１０２
に記憶されているプログラムに従って、各種の処理を実
行する。ＲＡＭ１０３には、ＣＰＵ１０１が各種の処理
を実行する上において必要なデータなどが、適宜記憶さ
れる。ＣＰＵ１０１は、モデム１０５を利用して、アナ
ログ電話回線を介して送信されてくるデータを受信す
る。そして、ＣＰＵ１０１は、そのデータを処理し、例
えば、ディスプレイインタフェース１０６を介して、受
信した画像データをディスプレイ（図示せず）に表示さ
せる。
【０００６】フラッシュＲＯＭ１０２には、モデム１０
５を介して供給されたデータを処理するためのプログラ
ムの他、装置の起動時にＣＰＵ１０１によって実行さ
れ、ＲＡＭ１０３の構成の設定や、フロッピーディスク
ドライブ１０４の初期設定などを行う基本プログラム
（ハードウェアに依存する制御プログラム群）であるＢ
ＩＯＳ（Basic Input/Output System）が記憶さ れてい
る。フラッシュＲＯＭ１０２は、電気的に書き換え（消
去と書込）が可能な不揮発性のメモリであり、その記憶
内容を変更することができる。このように書き換えが可
能であるフラッシュＲＯＭ１０２を利用することによ
り、本装置に接続する他の装置の仕様が変更されたとき
や、本装置のＯＳ（Operating System）が更新されたと
きなど、それらの更新に対応してＢＩＯＳを更新するこ
とができる。
５を介して供給されたデータを処理するためのプログラ
ムの他、装置の起動時にＣＰＵ１０１によって実行さ
れ、ＲＡＭ１０３の構成の設定や、フロッピーディスク
ドライブ１０４の初期設定などを行う基本プログラム
（ハードウェアに依存する制御プログラム群）であるＢ
ＩＯＳ（Basic Input/Output System）が記憶さ れてい
る。フラッシュＲＯＭ１０２は、電気的に書き換え（消
去と書込）が可能な不揮発性のメモリであり、その記憶
内容を変更することができる。このように書き換えが可
能であるフラッシュＲＯＭ１０２を利用することによ
り、本装置に接続する他の装置の仕様が変更されたとき
や、本装置のＯＳ（Operating System）が更新されたと
きなど、それらの更新に対応してＢＩＯＳを更新するこ
とができる。
【０００７】この情報処理装置においてＢＩＯＳを更新
する場合、最初に、所定のＢＩＯＳ更新用プログラムを
動作させ、フラッシュＲＯＭ１０２に記憶されているＢ
ＩＯＳを、フロッピーディスクドライブ１０４でフロッ
ピーディスクに記録した後、そのフロッピーディスクを
抜き取り、新しいＢＩＯＳが記録されている他のフロッ
ピーディスクをフロッピーディスクドライブ１０４に挿
入し、その新しいＢＩＯＳをフロッピーディスクから読
み出してフラッシュＲＯＭ１０２に記憶させる。
する場合、最初に、所定のＢＩＯＳ更新用プログラムを
動作させ、フラッシュＲＯＭ１０２に記憶されているＢ
ＩＯＳを、フロッピーディスクドライブ１０４でフロッ
ピーディスクに記録した後、そのフロッピーディスクを
抜き取り、新しいＢＩＯＳが記録されている他のフロッ
ピーディスクをフロッピーディスクドライブ１０４に挿
入し、その新しいＢＩＯＳをフロッピーディスクから読
み出してフラッシュＲＯＭ１０２に記憶させる。
【０００８】このように、元のＢＩＯＳをフロッピーデ
ィスクに記録することにより、ＢＩＯＳの更新に失敗し
た場合、新しいＢＩＯＳを記録しているフロッピーディ
スクに欠陥があり、新しいＢＩＯＳを読み込むことがで
きない場合、あるいは、新しいＢＩＯＳのプログラム自
体に欠陥（バグ）があり、正常に動作しない場合などに
おいて、元のＢＩＯＳを復帰させることができる。
ィスクに記録することにより、ＢＩＯＳの更新に失敗し
た場合、新しいＢＩＯＳを記録しているフロッピーディ
スクに欠陥があり、新しいＢＩＯＳを読み込むことがで
きない場合、あるいは、新しいＢＩＯＳのプログラム自
体に欠陥（バグ）があり、正常に動作しない場合などに
おいて、元のＢＩＯＳを復帰させることができる。
【０００９】
【発明が解決しようとする課題】しかしながら、ＣＡＴ
Ｖシステムのケーブルを介して、インターネットなどの
ネットワークにアクセスする場合に使用されるセットト
ップボックス（ＳＴＢ）のようにフロッピーディスクド
ライブを有していない情報処理装置においては、例え
ば、所定の接続端子を設け、その端子に他の端末装置を
接続し、その端末装置に元のＢＩＯＳを保存させた後、
ＢＩＯＳの更新を行うので、ＢＩＯＳの更新時の操作が
煩雑であるという問題を有している。
Ｖシステムのケーブルを介して、インターネットなどの
ネットワークにアクセスする場合に使用されるセットト
ップボックス（ＳＴＢ）のようにフロッピーディスクド
ライブを有していない情報処理装置においては、例え
ば、所定の接続端子を設け、その端子に他の端末装置を
接続し、その端末装置に元のＢＩＯＳを保存させた後、
ＢＩＯＳの更新を行うので、ＢＩＯＳの更新時の操作が
煩雑であるという問題を有している。
【００１０】本発明はこのような状況に鑑みてなされた
ものであり、元のＢＩＯＳを予備の記憶領域に退避した
後に、ＢＩＯＳの更新を行うことにより、ＢＩＯＳの書
き込みに失敗が生じた場合でも、即座に元の状態に復帰
させることが可能で、操作の手違い等により、元のＢＩ
ＯＳを失ってしまう事態を未然に防止することができる
ようにするものである。
ものであり、元のＢＩＯＳを予備の記憶領域に退避した
後に、ＢＩＯＳの更新を行うことにより、ＢＩＯＳの書
き込みに失敗が生じた場合でも、即座に元の状態に復帰
させることが可能で、操作の手違い等により、元のＢＩ
ＯＳを失ってしまう事態を未然に防止することができる
ようにするものである。
【００１１】
【課題を解決するための手段】請求項１に記載の情報処
理装置は、現行の基本プログラムが記憶保持される主領
域、基本プログラムを更新するための手順を示す更新プ
ログラムが記憶保持される共通領域、および、更新前の
基本プログラムが記憶保持される予備領域を有する記憶
手段と、記憶手段の共通領域に格納された更新プログラ
ムに基づいて、主領域から読み出した現行の基本プログ
ラムを予備領域に複写した後に、新たな基本プログラム
を主領域へ書き込む更新処理を行う処理手段とを備える
ことを特徴とする。
理装置は、現行の基本プログラムが記憶保持される主領
域、基本プログラムを更新するための手順を示す更新プ
ログラムが記憶保持される共通領域、および、更新前の
基本プログラムが記憶保持される予備領域を有する記憶
手段と、記憶手段の共通領域に格納された更新プログラ
ムに基づいて、主領域から読み出した現行の基本プログ
ラムを予備領域に複写した後に、新たな基本プログラム
を主領域へ書き込む更新処理を行う処理手段とを備える
ことを特徴とする。
【００１２】請求項７に記載のプログラム更新方法は、
記憶部の共通領域に記憶保持された更新プログラムに基
づいて、記憶部の主領域に記憶保持された現行の基本プ
ログラムを、新たな基本プログラムに更新するプログラ
ム更新方法であって、主領域から読み出した現行の基本
プログラムを記憶部の予備領域へ複写するステップと、
更新プログラムに基づいて、新たな基本プログラムを主
領域に書き込む更新処理を行うステップとを備えること
を特徴とする。
記憶部の共通領域に記憶保持された更新プログラムに基
づいて、記憶部の主領域に記憶保持された現行の基本プ
ログラムを、新たな基本プログラムに更新するプログラ
ム更新方法であって、主領域から読み出した現行の基本
プログラムを記憶部の予備領域へ複写するステップと、
更新プログラムに基づいて、新たな基本プログラムを主
領域に書き込む更新処理を行うステップとを備えること
を特徴とする。
【００１３】請求項８に記載のプログラム更新方法は、
記憶部の共通領域に記憶保持された更新プログラムに基
づいて、記憶部の主領域に記憶保持された現行の基本プ
ログラムを、新たな基本プログラムに更新するプログラ
ム更新方法であって、主領域から読み出した現行の基本
プログラムを一時記憶領域へ退避するステップと、一時
記憶領域に退避した現行の基本プログラムを、記憶部の
予備領域へ書き込むステップと、一時記憶領域に退避し
た現行の基本プログラムと、記憶部の予備領域に書き込
んだ現行の基本プログラムとを照合するステップと、外
部から供給された新たな基本プログラムを一時記憶領域
に書き込んだ後、この新たな基本プログラムを記憶部の
主領域へ書き込むステップと、一時記憶領域に書き込ん
だ新たな基本プログラムと、記憶部の主領域に書き込ん
だ新たな基本プログラムとを照合するステップとを備え
ることを特徴とする。
記憶部の共通領域に記憶保持された更新プログラムに基
づいて、記憶部の主領域に記憶保持された現行の基本プ
ログラムを、新たな基本プログラムに更新するプログラ
ム更新方法であって、主領域から読み出した現行の基本
プログラムを一時記憶領域へ退避するステップと、一時
記憶領域に退避した現行の基本プログラムを、記憶部の
予備領域へ書き込むステップと、一時記憶領域に退避し
た現行の基本プログラムと、記憶部の予備領域に書き込
んだ現行の基本プログラムとを照合するステップと、外
部から供給された新たな基本プログラムを一時記憶領域
に書き込んだ後、この新たな基本プログラムを記憶部の
主領域へ書き込むステップと、一時記憶領域に書き込ん
だ新たな基本プログラムと、記憶部の主領域に書き込ん
だ新たな基本プログラムとを照合するステップとを備え
ることを特徴とする。
【００１４】請求項９に記載の情報処理システムは、所
定の伝送チャンネルを介して情報を提供する情報提供手
段と、記憶部の共通領域に格納された更新プログラムに
基づいて、記憶部の主領域から読み出した現行の基本プ
ログラムを記憶部の予備領域に複写した後に、伝送チャ
ンネルを介して供給された新たな基本プログラムを記憶
部の主領域へ書き込んで更新処理を行う情報処理手段と
を備えることを特徴とする。
定の伝送チャンネルを介して情報を提供する情報提供手
段と、記憶部の共通領域に格納された更新プログラムに
基づいて、記憶部の主領域から読み出した現行の基本プ
ログラムを記憶部の予備領域に複写した後に、伝送チャ
ンネルを介して供給された新たな基本プログラムを記憶
部の主領域へ書き込んで更新処理を行う情報処理手段と
を備えることを特徴とする。
【００１５】請求項１に記載の情報処理装置において
は、記憶手段が、現行の基本プログラムが記憶保持され
る主領域、基本プログラムを更新するための手順を示す
更新プログラムが記憶保持される共通領域、および、更
新前の基本プログラムが記憶保持される予備領域を有
し、処理手段が、記憶手段の共通領域に格納された更新
プログラムに基づいて、主領域から読み出した現行の基
本プログラムを予備領域に複写した後に、新たな基本プ
ログラムを主領域へ書き込む更新処理を行う。
は、記憶手段が、現行の基本プログラムが記憶保持され
る主領域、基本プログラムを更新するための手順を示す
更新プログラムが記憶保持される共通領域、および、更
新前の基本プログラムが記憶保持される予備領域を有
し、処理手段が、記憶手段の共通領域に格納された更新
プログラムに基づいて、主領域から読み出した現行の基
本プログラムを予備領域に複写した後に、新たな基本プ
ログラムを主領域へ書き込む更新処理を行う。
【００１６】請求項７に記載のプログラム更新方法にお
いては、記憶部の共通領域に記憶保持された更新プログ
ラムに基づいて、記憶部の主領域に記憶保持された現行
の基本プログラムを、新たな基本プログラムに更新する
プログラム更新方法であって、主領域から読み出した現
行の基本プログラムを記憶部の予備領域へ複写するステ
ップと、更新プログラムに基づいて、新たな基本プログ
ラムを主領域に書き込む更新処理を行うステップとを備
える。
いては、記憶部の共通領域に記憶保持された更新プログ
ラムに基づいて、記憶部の主領域に記憶保持された現行
の基本プログラムを、新たな基本プログラムに更新する
プログラム更新方法であって、主領域から読み出した現
行の基本プログラムを記憶部の予備領域へ複写するステ
ップと、更新プログラムに基づいて、新たな基本プログ
ラムを主領域に書き込む更新処理を行うステップとを備
える。
【００１７】請求項８に記載のプログラム更新方法にお
いては、記憶部の共通領域に記憶保持された更新プログ
ラムに基づいて、記憶部の主領域に記憶保持された現行
の基本プログラムを、新たな基本プログラムに更新する
プログラム更新方法であって、主領域から読み出した現
行の基本プログラムを一時記憶領域へ退避するステップ
と、一時記憶領域に退避した現行の基本プログラムを、
記憶部の予備領域へ書き込むステップと、一時記憶領域
に退避した現行の基本プログラムと、記憶部の予備領域
に書き込んだ現行の基本プログラムとを照合するステッ
プと、外部から供給された新たな基本プログラムを一時
記憶領域に書き込んだ後、この新たな基本プログラムを
記憶部の主領域へ書き込むステップと、一時記憶領域に
書き込んだ新たな基本プログラムと、記憶部の主領域に
書き込んだ新たな基本プログラムとを照合するステップ
とを備える。
いては、記憶部の共通領域に記憶保持された更新プログ
ラムに基づいて、記憶部の主領域に記憶保持された現行
の基本プログラムを、新たな基本プログラムに更新する
プログラム更新方法であって、主領域から読み出した現
行の基本プログラムを一時記憶領域へ退避するステップ
と、一時記憶領域に退避した現行の基本プログラムを、
記憶部の予備領域へ書き込むステップと、一時記憶領域
に退避した現行の基本プログラムと、記憶部の予備領域
に書き込んだ現行の基本プログラムとを照合するステッ
プと、外部から供給された新たな基本プログラムを一時
記憶領域に書き込んだ後、この新たな基本プログラムを
記憶部の主領域へ書き込むステップと、一時記憶領域に
書き込んだ新たな基本プログラムと、記憶部の主領域に
書き込んだ新たな基本プログラムとを照合するステップ
とを備える。
【００１８】請求項９に記載の情報処理システムにおい
ては、情報処理手段が、所定の伝送チャンネルを介して
情報を提供し、情報処理手段が、記憶部の共通領域に格
納された更新プログラムに基づいて、記憶部の主領域か
ら読み出した現行の基本プログラムを記憶部の予備領域
に複写した後に、伝送チャンネルを介して供給された新
たな基本プログラムを記憶部の主領域へ書き込んで更新
処理を行う。
ては、情報処理手段が、所定の伝送チャンネルを介して
情報を提供し、情報処理手段が、記憶部の共通領域に格
納された更新プログラムに基づいて、記憶部の主領域か
ら読み出した現行の基本プログラムを記憶部の予備領域
に複写した後に、伝送チャンネルを介して供給された新
たな基本プログラムを記憶部の主領域へ書き込んで更新
処理を行う。
【００１９】
【発明の実施の形態】図１は、本発明を適用した情報処
理システムの一実施の形態の構成例を示す図である。な
お、本明細書において、システムの用語は、複数の装置
で構成される全体的な装置を表すものとする。
理システムの一実施の形態の構成例を示す図である。な
お、本明細書において、システムの用語は、複数の装置
で構成される全体的な装置を表すものとする。
【００２０】サーバ１−１，１−２（情報提供手段）
は、主に、画像とそれに対応する音声あるいはデータな
どからなるＶＯＤ（ビデオオンデマンドサービス）に関
する情報を、各家庭にネットワークを介して提供してい
る。ネットワークとしては、この実施の形態において
は、ケーブルテレビジョンネットワーク２、ＩＳＤＮ
３、およびアナログ電話回線４が用いられている。
は、主に、画像とそれに対応する音声あるいはデータな
どからなるＶＯＤ（ビデオオンデマンドサービス）に関
する情報を、各家庭にネットワークを介して提供してい
る。ネットワークとしては、この実施の形態において
は、ケーブルテレビジョンネットワーク２、ＩＳＤＮ
３、およびアナログ電話回線４が用いられている。
【００２１】すなわち、例えば、サーバ１−１は、情報
を、ケーブルテレビジョンネットワーク２を介してケー
ブルテレビジョンセンタ２−１あるいは２−２に提供す
る。ケーブルテレビジョンセンタ２−１は、提供された
情報を、そのケーブルテレビジョンシステムに加入して
いる家庭５−１，５−２に提供する。また、ケーブルテ
レビジョンセンタ２−２は、同様に、そのケーブルテレ
ビジョンシステムに加入している家庭５−１，５−３，
５−４に情報を提供する。
を、ケーブルテレビジョンネットワーク２を介してケー
ブルテレビジョンセンタ２−１あるいは２−２に提供す
る。ケーブルテレビジョンセンタ２−１は、提供された
情報を、そのケーブルテレビジョンシステムに加入して
いる家庭５−１，５−２に提供する。また、ケーブルテ
レビジョンセンタ２−２は、同様に、そのケーブルテレ
ビジョンシステムに加入している家庭５−１，５−３，
５−４に情報を提供する。
【００２２】サーバ１−１はまた、ＩＳＤＮ３あるいは
アナログ電話回線４を介して、情報を提供している。従
って、家庭５−１乃至５−６は、ＩＳＤＮ３またはアナ
ログ電話回線４を介してサーバ１−１にアクセスし、情
報の提供を受けることができる。
アナログ電話回線４を介して、情報を提供している。従
って、家庭５−１乃至５−６は、ＩＳＤＮ３またはアナ
ログ電話回線４を介してサーバ１−１にアクセスし、情
報の提供を受けることができる。
【００２３】サーバ１−２も、サーバ１−１と同様に、
家庭５−１乃至５−６に対して、各種の情報を提供して
いる。
家庭５−１乃至５−６に対して、各種の情報を提供して
いる。
【００２４】なお、このような映像伝送システムとして
は、伝送チャンネルの幹線を光ファイバで構成し、３０
０乃至５００世帯をカバーする光ファイバノードを設置
して、光ファイバノードから、各家庭には、同軸ケーブ
ルを介して情報を伝送するＨＦＣ（Hybrid Fiber Coa
x）を用いることもできる。あるいはまた、家庭のごく
近くの、２４世帯程度をカバーするペデスタル（中継装
置）まで光ファイバで情報を伝送し、ペデスタルから同
軸ケーブルで、各家庭に情報を提供するＦＴＴＣ（Fibe
r To The Curb）と呼ばれる方式、あるいは各家庭まで
光ファイバで情報を伝送するＦＴＴＨ（Fiber To The H
ome）などとすることもできる。
は、伝送チャンネルの幹線を光ファイバで構成し、３０
０乃至５００世帯をカバーする光ファイバノードを設置
して、光ファイバノードから、各家庭には、同軸ケーブ
ルを介して情報を伝送するＨＦＣ（Hybrid Fiber Coa
x）を用いることもできる。あるいはまた、家庭のごく
近くの、２４世帯程度をカバーするペデスタル（中継装
置）まで光ファイバで情報を伝送し、ペデスタルから同
軸ケーブルで、各家庭に情報を提供するＦＴＴＣ（Fibe
r To The Curb）と呼ばれる方式、あるいは各家庭まで
光ファイバで情報を伝送するＦＴＴＨ（Fiber To The H
ome）などとすることもできる。
【００２５】図１の実施の形態の場合、ネットワークの
伝送容量は、大きい方から、ケーブルテレビジョンネッ
トワーク２、ＩＳＤＮ３、アナログ電話回線４の順番と
なっている。従って、ケーブルテレビジョンネットワー
ク２を利用することで、最も高画質で、高速の動画をリ
アルタイムで受信することができる。また、ＩＳＤＮ３
を利用した場合においては、ケーブルテレビジョンネッ
トワーク２ほど迅速ではないが、一般的な動画像をリア
ルタイムで受信することができる。しかしながら、あま
り高速に変化する動画像をリアルタイムで受信すること
はできない。これに対して、アナログ電話回線４を利用
する場合においては、その伝送容量が小さいため、動画
像を受信することができず、静止画だけを受信すること
ができる。音声信号は、いずれのネットワークを利用す
る場合においても、リアルタイムで受信することができ
る。
伝送容量は、大きい方から、ケーブルテレビジョンネッ
トワーク２、ＩＳＤＮ３、アナログ電話回線４の順番と
なっている。従って、ケーブルテレビジョンネットワー
ク２を利用することで、最も高画質で、高速の動画をリ
アルタイムで受信することができる。また、ＩＳＤＮ３
を利用した場合においては、ケーブルテレビジョンネッ
トワーク２ほど迅速ではないが、一般的な動画像をリア
ルタイムで受信することができる。しかしながら、あま
り高速に変化する動画像をリアルタイムで受信すること
はできない。これに対して、アナログ電話回線４を利用
する場合においては、その伝送容量が小さいため、動画
像を受信することができず、静止画だけを受信すること
ができる。音声信号は、いずれのネットワークを利用す
る場合においても、リアルタイムで受信することができ
る。
【００２６】図２は、家庭５−１に設けられている情報
受信システムの構成例を表している。なお、その図示は
省略するが、その他の家庭５−２乃至５−６において
も、基本的に同様の情報処理システムが備えられてい
る。
受信システムの構成例を表している。なお、その図示は
省略するが、その他の家庭５−２乃至５−６において
も、基本的に同様の情報処理システムが備えられてい
る。
【００２７】ホームサーバ１１は、ケーブルテレビジョ
ンネットワーク２、ＩＳＤＮ３、アナログ電話回線４に
接続されており、少なくともいずれか１つのネットワー
クをパーソナルコンピュータ１２−１，１２−２、ＳＴ
Ｂ１６（情報処理手段）、または電話機１８に接続する
ようになされている。
ンネットワーク２、ＩＳＤＮ３、アナログ電話回線４に
接続されており、少なくともいずれか１つのネットワー
クをパーソナルコンピュータ１２−１，１２−２、ＳＴ
Ｂ１６（情報処理手段）、または電話機１８に接続する
ようになされている。
【００２８】パーソナルコンピュータ１２−１には、キ
ーボード１４−１とマウス１５−１が接続されており、
各種の指令が入力されるようになされている。また、デ
ィスプレイ１３−１に、パーソナルコンピュータ１２−
１からの画像が、適宜出力され、表示されるようになさ
れている。
ーボード１４−１とマウス１５−１が接続されており、
各種の指令が入力されるようになされている。また、デ
ィスプレイ１３−１に、パーソナルコンピュータ１２−
１からの画像が、適宜出力され、表示されるようになさ
れている。
【００２９】同様に、パーソナルコンピュータ１２−２
には、キーボード１４−２とマウス１５−２、さらにデ
ィスプレイ１３−２が接続されている。
には、キーボード１４−２とマウス１５−２、さらにデ
ィスプレイ１３−２が接続されている。
【００３０】ＳＴＢ１６は、ホームサーバ１１から供給
された画像データを受信し、これを復調して、テレビジ
ョン受像機１７に出力し、表示させるようになされてい
る。なお、ＳＴＢ１６は、ユーザのリクエストに対応し
て番組を提供するビデオオンデマンド（ＶＯＤ）サービ
スにも利用される。また、電話機１８は、ホームサーバ
１１を介して、通話を行うことができるようになされて
いる。
された画像データを受信し、これを復調して、テレビジ
ョン受像機１７に出力し、表示させるようになされてい
る。なお、ＳＴＢ１６は、ユーザのリクエストに対応し
て番組を提供するビデオオンデマンド（ＶＯＤ）サービ
スにも利用される。また、電話機１８は、ホームサーバ
１１を介して、通話を行うことができるようになされて
いる。
【００３１】図３は、ホームサーバ１１の内部の構成例
を表している。ＣＰＵ３１は、ＲＯＭ３２に記憶されて
いるプログラムに従って、各種の処理を実行するように
なされている。ＲＡＭ３３には、ＣＰＵ３１が各種の指
令を実行する上において必要なデータなどが、適宜記憶
される。ハードディスクドライブ３４は、内蔵するハー
ドディスクに対して、情報を記録再生する。
を表している。ＣＰＵ３１は、ＲＯＭ３２に記憶されて
いるプログラムに従って、各種の処理を実行するように
なされている。ＲＡＭ３３には、ＣＰＵ３１が各種の指
令を実行する上において必要なデータなどが、適宜記憶
される。ハードディスクドライブ３４は、内蔵するハー
ドディスクに対して、情報を記録再生する。
【００３２】また、ホームサーバ１１は、各種のインタ
フェースを有している。ネットワークインタフェース３
５乃至３７は、それぞれケーブルテレビジョンネットワ
ーク２、ＩＳＤＮ３、アナログ電話回線４との間におい
て、データを授受するときインタフェース処理を行う。
ＳＴＢインタフェース３８は、ＳＴＢ１６との間におけ
るＡＴＭ（Asynchronous Transfer Mode）モードのイン
タフェース処理を実行する。コンピュータインタフェー
ス３９は、パーソナルコンピュータ１２−１に接続さ
れ、Ｅｔｈｅｒｎｅｔのインタフェース処理を行う。コ
ンピュータインタフェース４０は、パーソナルコンピュ
ータ１２−２に接続され、そのパーソナルコンピュータ
に専用のプロトコルに対応するインタフェース処理を実
行する。電話機インタフェース４１は、電話機１８との
インタフェース処理を実行する。
フェースを有している。ネットワークインタフェース３
５乃至３７は、それぞれケーブルテレビジョンネットワ
ーク２、ＩＳＤＮ３、アナログ電話回線４との間におい
て、データを授受するときインタフェース処理を行う。
ＳＴＢインタフェース３８は、ＳＴＢ１６との間におけ
るＡＴＭ（Asynchronous Transfer Mode）モードのイン
タフェース処理を実行する。コンピュータインタフェー
ス３９は、パーソナルコンピュータ１２−１に接続さ
れ、Ｅｔｈｅｒｎｅｔのインタフェース処理を行う。コ
ンピュータインタフェース４０は、パーソナルコンピュ
ータ１２−２に接続され、そのパーソナルコンピュータ
に専用のプロトコルに対応するインタフェース処理を実
行する。電話機インタフェース４１は、電話機１８との
インタフェース処理を実行する。
【００３３】図４は、パーソナルコンピュータ１２−１
の内部の構成例を表している。ＣＰＵ７１は、ＲＯＭ７
２に記憶されているプログラムに従って、各種の処理を
実行する。ＲＡＭ７３には、ＣＰＵ７１が各種の処理を
実行する上において必要なデータなどが、適宜記憶され
る。ハードディスクドライブ７４は、ＣＰＵ７１に制御
され、各種のデータやプログラムなどを内蔵するハード
ディスクに記録再生する。フロッピーディスクドライブ
７５は、フロッピーディスクに対する記録再生処理を実
行する。
の内部の構成例を表している。ＣＰＵ７１は、ＲＯＭ７
２に記憶されているプログラムに従って、各種の処理を
実行する。ＲＡＭ７３には、ＣＰＵ７１が各種の処理を
実行する上において必要なデータなどが、適宜記憶され
る。ハードディスクドライブ７４は、ＣＰＵ７１に制御
され、各種のデータやプログラムなどを内蔵するハード
ディスクに記録再生する。フロッピーディスクドライブ
７５は、フロッピーディスクに対する記録再生処理を実
行する。
【００３４】ホームサーバインタフェース７６は、ホー
ムサーバ１１との間におけるインタフェース処理を実行
する。キーボードインタフェース７７とマウスインタフ
ェース７８は、それぞれキーボード１４−１とマウス１
５−１との間におけるインタフェース処理を実行する。
また、ディスプレイインタフェース７９は、ディスプレ
イ１３−１に対するインタフェース処理を実行する。
ムサーバ１１との間におけるインタフェース処理を実行
する。キーボードインタフェース７７とマウスインタフ
ェース７８は、それぞれキーボード１４−１とマウス１
５−１との間におけるインタフェース処理を実行する。
また、ディスプレイインタフェース７９は、ディスプレ
イ１３−１に対するインタフェース処理を実行する。
【００３５】なお、パーソナルコンピュータ１２−２
も、パーソナルコンピュータ１２−１と同様に構成され
ている。
も、パーソナルコンピュータ１２−１と同様に構成され
ている。
【００３６】図５は、本発明の情報処理装置の一実施の
形態であるＳＴＢ１６の内部の構成例を表している。Ｃ
ＰＵ５１（処理手段）は、フラッシュＲＯＭボード５２
に実装されているフラッシュＲＯＭ９１（図６）に記憶
されているプログラムに従って、各種の処理を実行す
る。ＲＡＭ５３には、ＣＰＵ５１が各種の処理を実行す
る上において必要なデータなどが、適宜記憶される。グ
ラフィックスコントローラ５４は、ＣＰＵ５１から供給
されたグラフィックスデータをテレビジョン受像機１７
に出力し、表示させる。ＭＰＥＧ(Moving Picture Expe
rts Group)２ビデオデコーダ５５とＭＰＥＧオーディオ
デコーダ５６は、ネットワークインタフェースカード５
７（受信手段）を介して、ホームサーバ１１より供給さ
れたビデオデータとオーディオデータを、それぞれＭＰ
ＥＧ２またはＭＰＥＧ方式でデコードし、テレビジョン
受像機１７に出力し、表示または放音させる。
形態であるＳＴＢ１６の内部の構成例を表している。Ｃ
ＰＵ５１（処理手段）は、フラッシュＲＯＭボード５２
に実装されているフラッシュＲＯＭ９１（図６）に記憶
されているプログラムに従って、各種の処理を実行す
る。ＲＡＭ５３には、ＣＰＵ５１が各種の処理を実行す
る上において必要なデータなどが、適宜記憶される。グ
ラフィックスコントローラ５４は、ＣＰＵ５１から供給
されたグラフィックスデータをテレビジョン受像機１７
に出力し、表示させる。ＭＰＥＧ(Moving Picture Expe
rts Group)２ビデオデコーダ５５とＭＰＥＧオーディオ
デコーダ５６は、ネットワークインタフェースカード５
７（受信手段）を介して、ホームサーバ１１より供給さ
れたビデオデータとオーディオデータを、それぞれＭＰ
ＥＧ２またはＭＰＥＧ方式でデコードし、テレビジョン
受像機１７に出力し、表示または放音させる。
【００３７】ネットワークインタフェースカード５７
は、ホームサーバ１１との間に接続され、ホームサーバ
１１に対するインタフェース処理を実行する。スマート
カードインタフェース５８は、スマートカード５９との
間におけるインタフェース処理を実行する。スマートカ
ード５９は、ＳＴＢ１６に対して、適宜、着脱される。
このスマートカード５９には、その使用者の個人的な情
報、データをスクランブルするためのキー情報、あるい
は課金情報などが記憶される。
は、ホームサーバ１１との間に接続され、ホームサーバ
１１に対するインタフェース処理を実行する。スマート
カードインタフェース５８は、スマートカード５９との
間におけるインタフェース処理を実行する。スマートカ
ード５９は、ＳＴＢ１６に対して、適宜、着脱される。
このスマートカード５９には、その使用者の個人的な情
報、データをスクランブルするためのキー情報、あるい
は課金情報などが記憶される。
【００３８】ジョイスティックインタフェース６０は、
ＳＴＢ１６に接続されるゲーム機６１との間のインタフ
ェース処理を実行する。ＩＲリモートコマンダインタフ
ェース６２は、リモートコマンダ６３からの赤外線（Ｉ
Ｒ）信号を受信し、その指令をＣＰＵ５１に出力する処
理を実行する。
ＳＴＢ１６に接続されるゲーム機６１との間のインタフ
ェース処理を実行する。ＩＲリモートコマンダインタフ
ェース６２は、リモートコマンダ６３からの赤外線（Ｉ
Ｒ）信号を受信し、その指令をＣＰＵ５１に出力する処
理を実行する。
【００３９】フラッシュＲＯＭボード５２に実装されて
いるフラッシュＲＯＭ９１（記憶手段）には、ネットワ
ークインタフェースカード５７を介して供給されたデー
タを処理するためのプログラムの他、装置の起動時にＣ
ＰＵ５１によって実行され、ＲＡＭ５３の構成の設定や
ゲーム機６１などの外部装置とのデータ授受の制御を行
う基本プログラムであるＢＩＯＳ（ＣＰＵ５１で実行さ
れるＯＳの内、ハードウェアに依存する制御プログラム
群）が記憶されている。フラッシュＲＯＭボード５２内
のフラッシュＲＯＭ９１は、電気的に書き換え（消去と
書込）が可能な不揮発性のメモリであり、その記憶内容
を変更することができ、電源を切った後も記憶内容を保
持し続ける。このように電気的に書き換えが可能である
フラッシュＲＯＭ９１を利用することにより、必要に応
じてＢＩＯＳを更新することができる。新しいＢＩＯＳ
は、サーバ１−１またはサーバ１−２によって送信さ
れ、所定の通信回線およびホームサーバ１１を介してＳ
ＴＢ１６に供給され、ＳＴＢ１６のネットワークインタ
フェースカード５７で受信される。
いるフラッシュＲＯＭ９１（記憶手段）には、ネットワ
ークインタフェースカード５７を介して供給されたデー
タを処理するためのプログラムの他、装置の起動時にＣ
ＰＵ５１によって実行され、ＲＡＭ５３の構成の設定や
ゲーム機６１などの外部装置とのデータ授受の制御を行
う基本プログラムであるＢＩＯＳ（ＣＰＵ５１で実行さ
れるＯＳの内、ハードウェアに依存する制御プログラム
群）が記憶されている。フラッシュＲＯＭボード５２内
のフラッシュＲＯＭ９１は、電気的に書き換え（消去と
書込）が可能な不揮発性のメモリであり、その記憶内容
を変更することができ、電源を切った後も記憶内容を保
持し続ける。このように電気的に書き換えが可能である
フラッシュＲＯＭ９１を利用することにより、必要に応
じてＢＩＯＳを更新することができる。新しいＢＩＯＳ
は、サーバ１−１またはサーバ１−２によって送信さ
れ、所定の通信回線およびホームサーバ１１を介してＳ
ＴＢ１６に供給され、ＳＴＢ１６のネットワークインタ
フェースカード５７で受信される。
【００４０】図６は、フラッシュＲＯＭボード５２の構
成例を示している。フラッシュＲＯＭ９１は、プログラ
ムなどのデータを記憶する、書換可能な不揮発性の記憶
素子であり、２つのバンク（バンク９１ａ（主領域）と
バンク９１ｂ（予備領域））として使用される。これら
のバンクＡ（バンク９１ａ）とバンクＢ（バンク９１
ｂ）は、ＣＰＵ５１によって、同じ論理アドレス空間と
して使用される。即ち、図７（ａ）に示すように、同じ
論理アドレス空間に、２つの物理アドレス空間（バンク
９１ａとバンク９１ｂ）が割り当てられる。そして、バ
ンク切替回路９２のバンク切り替えに応じて、バンク９
１ａに記憶されている内容（プログラムなどのデータ）
（図７（ｂ））またはバンク９１ｂに記憶されている内
容（図７（ｃ））が読み出される。プログラムなどのデ
ータを記憶させる（書き込む）場合においても、データ
は、バンク切替回路９２のバンク切り替えに応じて、バ
ンク９１ａまたはバンク９１ｂに記憶される（書き込ま
れる）。すなわち、バンク切替回路９２は、ＣＰＵ５１
からアドレスされる論理アドレスを実際のフラッシュＲ
ＯＭ９１の（バンク９１ａまたはバンク９１ｂの）物理
アドレスに変換するための回路である。
成例を示している。フラッシュＲＯＭ９１は、プログラ
ムなどのデータを記憶する、書換可能な不揮発性の記憶
素子であり、２つのバンク（バンク９１ａ（主領域）と
バンク９１ｂ（予備領域））として使用される。これら
のバンクＡ（バンク９１ａ）とバンクＢ（バンク９１
ｂ）は、ＣＰＵ５１によって、同じ論理アドレス空間と
して使用される。即ち、図７（ａ）に示すように、同じ
論理アドレス空間に、２つの物理アドレス空間（バンク
９１ａとバンク９１ｂ）が割り当てられる。そして、バ
ンク切替回路９２のバンク切り替えに応じて、バンク９
１ａに記憶されている内容（プログラムなどのデータ）
（図７（ｂ））またはバンク９１ｂに記憶されている内
容（図７（ｃ））が読み出される。プログラムなどのデ
ータを記憶させる（書き込む）場合においても、データ
は、バンク切替回路９２のバンク切り替えに応じて、バ
ンク９１ａまたはバンク９１ｂに記憶される（書き込ま
れる）。すなわち、バンク切替回路９２は、ＣＰＵ５１
からアドレスされる論理アドレスを実際のフラッシュＲ
ＯＭ９１の（バンク９１ａまたはバンク９１ｂの）物理
アドレスに変換するための回路である。
【００４１】フラッシュＲＯＭ９１のバンクＡは、現行
の新しいＢＩＯＳなどのプログラムを記憶し、バンクＢ
は、更新前の（旧バージョンの）ＢＩＯＳなどのプログ
ラムを記憶、保存するようになされている。また、フラ
ッシュＲＯＭ９１の一部は、共通領域９１ｃとして使用
される。この共通領域９１ｃは、バンクの切り替えに関
係なくアクセスすることができる。即ち、バンクの切り
替えに関係なく、所定の論理アドレスで、同じ記憶領域
（物理アドレス）が指定される。この領域には、装置が
起動したときに最初に読み込まれるデータや、ＢＩＯＳ
更新用のプログラムが記憶され、その内容は書き換えら
れないようになされている。
の新しいＢＩＯＳなどのプログラムを記憶し、バンクＢ
は、更新前の（旧バージョンの）ＢＩＯＳなどのプログ
ラムを記憶、保存するようになされている。また、フラ
ッシュＲＯＭ９１の一部は、共通領域９１ｃとして使用
される。この共通領域９１ｃは、バンクの切り替えに関
係なくアクセスすることができる。即ち、バンクの切り
替えに関係なく、所定の論理アドレスで、同じ記憶領域
（物理アドレス）が指定される。この領域には、装置が
起動したときに最初に読み込まれるデータや、ＢＩＯＳ
更新用のプログラムが記憶され、その内容は書き換えら
れないようになされている。
【００４２】バンク切替回路９２は、ハードウェアロジ
ック回路によって構成され、バンク状態レジスタ９３が
保持する値に応じて、フラッシュＲＯＭ９１におけるバ
ンクをバンクＡまたはバンクＢに切り替え、アドレスバ
スを介して供給されたアドレスの記憶領域に対して、プ
ログラムなどのデータの記憶または読み出しを行うよう
になされている。なお、記憶されるデータおよび読み出
されたデータは、データバスを介して入力または出力さ
れる。
ック回路によって構成され、バンク状態レジスタ９３が
保持する値に応じて、フラッシュＲＯＭ９１におけるバ
ンクをバンクＡまたはバンクＢに切り替え、アドレスバ
スを介して供給されたアドレスの記憶領域に対して、プ
ログラムなどのデータの記憶または読み出しを行うよう
になされている。なお、記憶されるデータおよび読み出
されたデータは、データバスを介して入力または出力さ
れる。
【００４３】バンク状態レジスタ９３は、バンクＡおよ
びバンクＢのうち、使用するバンクに対応する値を保持
するようになされている。この値は、データバスを介し
てＣＰＵ５１より供給される。なお、ＢＩＯＳなどの通
常使用されるプログラムはバンクＡに記憶されているの
で、ＢＩＯＳの更新時以外においては、バンク状態レジ
スタ９３は、バンクＡに対応する値を保持している。ま
た、本実施の形態であるＳＴＢ１６の電源が投入された
とき、バンク状態レジスタ９３は、バンクＡに対応する
値にリセットされるようになされている。
びバンクＢのうち、使用するバンクに対応する値を保持
するようになされている。この値は、データバスを介し
てＣＰＵ５１より供給される。なお、ＢＩＯＳなどの通
常使用されるプログラムはバンクＡに記憶されているの
で、ＢＩＯＳの更新時以外においては、バンク状態レジ
スタ９３は、バンクＡに対応する値を保持している。ま
た、本実施の形態であるＳＴＢ１６の電源が投入された
とき、バンク状態レジスタ９３は、バンクＡに対応する
値にリセットされるようになされている。
【００４４】このように、フラッシュＲＯＭボード５２
においては、バンク状態レジスタ９３の保持する値に応
じて、フラッシュＲＯＭ９１のバンクＡまたはバンクＢ
が使用され、ＢＩＯＳの更新時以外は、主に、バンクＡ
からのデータの読み出しが行われる。
においては、バンク状態レジスタ９３の保持する値に応
じて、フラッシュＲＯＭ９１のバンクＡまたはバンクＢ
が使用され、ＢＩＯＳの更新時以外は、主に、バンクＡ
からのデータの読み出しが行われる。
【００４５】次に、図８のフローチャートと図９乃至図
１７の概念図を参照して、フラッシュＲＯＭボード５２
のＢＩＯＳの更新時の、本実施の形態の動作について説
明する。なお、本実施の形態においては、フロッピーデ
ィスクなどの携帯用記録媒体を駆動する装置を設けてい
ないので、所定の通信回線を介して、新しいＢＩＯＳを
ネットワークインタフェースカード５７で取得し、ＢＩ
ＯＳを更新するようになされている。
１７の概念図を参照して、フラッシュＲＯＭボード５２
のＢＩＯＳの更新時の、本実施の形態の動作について説
明する。なお、本実施の形態においては、フロッピーデ
ィスクなどの携帯用記録媒体を駆動する装置を設けてい
ないので、所定の通信回線を介して、新しいＢＩＯＳを
ネットワークインタフェースカード５７で取得し、ＢＩ
ＯＳを更新するようになされている。
【００４６】リモートコマンダ６３等が操作されＢＩＯ
Ｓの更新の旨の指示を受けるとＣＰＵ５１は共通領域９
１ｃに格納された更新用プログラムに基づいて、以下の
処理を開始する。
Ｓの更新の旨の指示を受けるとＣＰＵ５１は共通領域９
１ｃに格納された更新用プログラムに基づいて、以下の
処理を開始する。
【００４７】最初にステップＳ１において、図９に示す
ように、ＣＰＵ５１は、フラッシュＲＯＭ９１のバンク
Ａ（バンク９１ａ）に記憶されている更新すべき現行バ
ージョンのＢＩＯＳを読み出し、ＲＡＭ５３に一旦記憶
（退避）させる。
ように、ＣＰＵ５１は、フラッシュＲＯＭ９１のバンク
Ａ（バンク９１ａ）に記憶されている更新すべき現行バ
ージョンのＢＩＯＳを読み出し、ＲＡＭ５３に一旦記憶
（退避）させる。
【００４８】次にステップＳ２において、ＣＰＵ５１
は、バンク状態レジスタ９３の値を変更し、バンクをバ
ンクＢに切り替える。
は、バンク状態レジスタ９３の値を変更し、バンクをバ
ンクＢに切り替える。
【００４９】ステップＳ３において、図１０に示すよう
に、ＣＰＵ５１は、フラッシュＲＯＭ９１のバンクＢ
（バンク９１ｂ）の旧バージョンのＢＩＯＳを消去し、
ステップＳ４において、図１１に示すように、ＲＡＭ５
３から現行バージョンのＢＩＯＳを読み出し、バンクＢ
（バンク９１ｂ）に記憶させる。
に、ＣＰＵ５１は、フラッシュＲＯＭ９１のバンクＢ
（バンク９１ｂ）の旧バージョンのＢＩＯＳを消去し、
ステップＳ４において、図１１に示すように、ＲＡＭ５
３から現行バージョンのＢＩＯＳを読み出し、バンクＢ
（バンク９１ｂ）に記憶させる。
【００５０】次に、ステップＳ５において、図１２に示
すように、ＣＰＵ５１は、ＲＡＭ５３の現行ＢＩＯＳ
と、フラッシュＲＯＭ９１のバンクＢ（バンク９１ｂ）
の現行ＢＩＯＳを照合し、ステップＳ６において、両者
が一致するか否かを判断し、一致しないと判断した場
合、ステップＳ７で、バンク状態レジスタ９３を、バン
クＡに切り替えた後、ステップＳ１に戻り、再度、フラ
ッシュＲＯＭ９１のバンクＡ（バンク９１ａ）に記憶さ
れているＢＩＯＳを、ＲＡＭ５３を介してバンクＢ（バ
ンク９１ｂ）に移動させる動作を行う。
すように、ＣＰＵ５１は、ＲＡＭ５３の現行ＢＩＯＳ
と、フラッシュＲＯＭ９１のバンクＢ（バンク９１ｂ）
の現行ＢＩＯＳを照合し、ステップＳ６において、両者
が一致するか否かを判断し、一致しないと判断した場
合、ステップＳ７で、バンク状態レジスタ９３を、バン
クＡに切り替えた後、ステップＳ１に戻り、再度、フラ
ッシュＲＯＭ９１のバンクＡ（バンク９１ａ）に記憶さ
れているＢＩＯＳを、ＲＡＭ５３を介してバンクＢ（バ
ンク９１ｂ）に移動させる動作を行う。
【００５１】一方、ステップＳ６において、ＲＡＭ５３
のＢＩＯＳと、フラッシュＲＯＭ９１のバンクＢ（バン
ク９１ｂ）のＢＩＯＳが一致したと判断された場合、ス
テップＳ８に進み、ＣＰＵ５１は、バンク状態レジスタ
９３の値を変更し、バンクをバンクＡに切り替える。
のＢＩＯＳと、フラッシュＲＯＭ９１のバンクＢ（バン
ク９１ｂ）のＢＩＯＳが一致したと判断された場合、ス
テップＳ８に進み、ＣＰＵ５１は、バンク状態レジスタ
９３の値を変更し、バンクをバンクＡに切り替える。
【００５２】次に、ステップＳ９において、ネットワー
クインタフェースカード５７は、所定の通信回線および
ホームサーバ１１を介して供給される新しいＢＩＯＳを
受信し、図１３に示すように、ＣＰＵ５１は、ネットワ
ークインタフェースカード５７が受信した新しいＢＩＯ
ＳをＲＡＭ５３に記憶させる。
クインタフェースカード５７は、所定の通信回線および
ホームサーバ１１を介して供給される新しいＢＩＯＳを
受信し、図１３に示すように、ＣＰＵ５１は、ネットワ
ークインタフェースカード５７が受信した新しいＢＩＯ
ＳをＲＡＭ５３に記憶させる。
【００５３】そして、ステップＳ１０において、図１４
に示すように、ＣＰＵ５１は、フラッシュＲＯＭ９１の
バンクＡの内容（現行ＢＩＯＳ）を消去した後、ステッ
プＳ１１において、図１５に示すように、ＲＡＭ５３に
記憶されている、新しいＢＩＯＳをフラッシュＲＯＭ９
１のバンクＡ（バンク９１ａ）に記憶させる。
に示すように、ＣＰＵ５１は、フラッシュＲＯＭ９１の
バンクＡの内容（現行ＢＩＯＳ）を消去した後、ステッ
プＳ１１において、図１５に示すように、ＲＡＭ５３に
記憶されている、新しいＢＩＯＳをフラッシュＲＯＭ９
１のバンクＡ（バンク９１ａ）に記憶させる。
【００５４】次に、ステップＳ１２において、図１６に
示すように、ＣＰＵ５１は、ＲＡＭ５３のＢＩＯＳと、
フラッシュＲＯＭ９１のバンクＡ（バンク９１ａ）のＢ
ＩＯＳを照合し、ステップＳ１３において、両者が一致
するか否かを判断し、一致しないと判断した場合、ステ
ップＳ９に戻り、再度、ＲＡＭ５３に記憶されている新
しいＢＩＯＳを、フラッシュＲＯＭ９１のバンクＡ（バ
ンク９１ａ）に移動させる動作を行う。
示すように、ＣＰＵ５１は、ＲＡＭ５３のＢＩＯＳと、
フラッシュＲＯＭ９１のバンクＡ（バンク９１ａ）のＢ
ＩＯＳを照合し、ステップＳ１３において、両者が一致
するか否かを判断し、一致しないと判断した場合、ステ
ップＳ９に戻り、再度、ＲＡＭ５３に記憶されている新
しいＢＩＯＳを、フラッシュＲＯＭ９１のバンクＡ（バ
ンク９１ａ）に移動させる動作を行う。
【００５５】一方、ステップＳ１３において、ＲＡＭ５
３のＢＩＯＳと、フラッシュＲＯＭ９１のバンクＡ（バ
ンク９１ａ）のＢＩＯＳが一致したと判断された場合、
ＢＩＯＳの更新の処理を終了する。その結果、図１７に
示す状態で更新処理が終了される。
３のＢＩＯＳと、フラッシュＲＯＭ９１のバンクＡ（バ
ンク９１ａ）のＢＩＯＳが一致したと判断された場合、
ＢＩＯＳの更新の処理を終了する。その結果、図１７に
示す状態で更新処理が終了される。
【００５６】このように、ステップＳ１乃至ステップＳ
７において、フラッシュＲＯＭ９１のバンクＡ（バンク
９１ａ）のＢＩＯＳをバンクＢ（バンク９１ｂ）に移動
し、ステップＳ８乃至ステップＳ１３において、所定の
通信回線を介して供給された新しいＢＩＯＳをバンクＡ
（バンク９１ａ）に記憶させて、ＢＩＯＳの更新を行
う。このようにして更新を行った後、新しいＢＩＯＳが
良好に動作しない場合、上述のステップＳ１乃至ステッ
プＳ７とは逆の動作を行い、フラッシュＲＯＭ９１のバ
ンクＢ（バンク９１ｂ）のＢＩＯＳを、ＲＡＭ５３を介
してバンクＡ（バンク９１ａ）に移動することにより、
元のＢＩＯＳを復帰させることができる。
７において、フラッシュＲＯＭ９１のバンクＡ（バンク
９１ａ）のＢＩＯＳをバンクＢ（バンク９１ｂ）に移動
し、ステップＳ８乃至ステップＳ１３において、所定の
通信回線を介して供給された新しいＢＩＯＳをバンクＡ
（バンク９１ａ）に記憶させて、ＢＩＯＳの更新を行
う。このようにして更新を行った後、新しいＢＩＯＳが
良好に動作しない場合、上述のステップＳ１乃至ステッ
プＳ７とは逆の動作を行い、フラッシュＲＯＭ９１のバ
ンクＢ（バンク９１ｂ）のＢＩＯＳを、ＲＡＭ５３を介
してバンクＡ（バンク９１ａ）に移動することにより、
元のＢＩＯＳを復帰させることができる。
【００５７】なお、上記実施の形態においては、複数の
バンクを有するフラッシュＲＯＭ９１を使用したが、フ
ラッシュＲＯＭ９１の代わりに、単一の記憶領域を有す
るフラッシュＲＯＭを複数個使用することもできる。
バンクを有するフラッシュＲＯＭ９１を使用したが、フ
ラッシュＲＯＭ９１の代わりに、単一の記憶領域を有す
るフラッシュＲＯＭを複数個使用することもできる。
【００５８】上記実施の形態においては、ＢＩＯＳの更
新を行っているが、他のプログラム（例えばＯＳ）の更
新を行うようにすることもできる。また、フラッシュＲ
ＯＭは、ホームサーバ１１、パーソナルコンピュータ１
２−１，１２−２などにおいても用いることができる。
新を行っているが、他のプログラム（例えばＯＳ）の更
新を行うようにすることもできる。また、フラッシュＲ
ＯＭは、ホームサーバ１１、パーソナルコンピュータ１
２−１，１２−２などにおいても用いることができる。
【００５９】
【発明の効果】以上の如く、請求項１に記載の情報処理
装置および請求項７に記載のプログラム更新方法によれ
ば、主領域から読み出した現行の基本プログラムを予備
領域に複写し、更新プログラムに基づいて、新たな基本
プログラムを主領域に書き込むようにしたので、フロッ
ピーディスクドライブなどの記録装置を有していない装
置においても、元のＢＩＯＳを予備の記憶領域に退避し
た後、ＢＩＯＳの更新を行うことができる。従って、Ｂ
ＩＯＳの書き込みに失敗が生じた場合でも、即座に元の
状態に復帰させることができ、操作の手違い等により元
のＢＩＯＳを失ってしまう事態を未然に防止することが
できる。
装置および請求項７に記載のプログラム更新方法によれ
ば、主領域から読み出した現行の基本プログラムを予備
領域に複写し、更新プログラムに基づいて、新たな基本
プログラムを主領域に書き込むようにしたので、フロッ
ピーディスクドライブなどの記録装置を有していない装
置においても、元のＢＩＯＳを予備の記憶領域に退避し
た後、ＢＩＯＳの更新を行うことができる。従って、Ｂ
ＩＯＳの書き込みに失敗が生じた場合でも、即座に元の
状態に復帰させることができ、操作の手違い等により元
のＢＩＯＳを失ってしまう事態を未然に防止することが
できる。
【００６０】また、請求項８に記載のプログラム更新方
法によれば、主領域から読み出した現行の基本プログラ
ム、または外部から供給された新たなプログラムを、一
時記憶領域と予備領域に書き込み、両者の照合を行うよ
うにしたので、より確実に、更新処理を行うことができ
る。
法によれば、主領域から読み出した現行の基本プログラ
ム、または外部から供給された新たなプログラムを、一
時記憶領域と予備領域に書き込み、両者の照合を行うよ
うにしたので、より確実に、更新処理を行うことができ
る。
【００６１】請求項９に記載の情報処理システムによれ
ば、主領域から読み出した現行の基本プログラムを予備
領域に複写した後、伝送チャンネルからの新たな基本プ
ログラムを主領域に書き込むようにしたので、フロッピ
ーディスクドライブなどの記録装置を有していない装置
においても、元のＢＩＯＳを予備の記憶領域に退避した
後、伝送チャンネル等のネットワークを介して新しいＢ
ＩＯＳを取得し、ＢＩＯＳの更新を行うことができる。
ば、主領域から読み出した現行の基本プログラムを予備
領域に複写した後、伝送チャンネルからの新たな基本プ
ログラムを主領域に書き込むようにしたので、フロッピ
ーディスクドライブなどの記録装置を有していない装置
においても、元のＢＩＯＳを予備の記憶領域に退避した
後、伝送チャンネル等のネットワークを介して新しいＢ
ＩＯＳを取得し、ＢＩＯＳの更新を行うことができる。
【図１】本発明の情報受信装置が適用された情報提供シ
ステムの構成を示す図である。
ステムの構成を示す図である。
【図２】図１の家庭５−１における情報処理装置の構成
を示す図である。
を示す図である。
【図３】図２のホームサーバ１１の内部の構成例を示す
ブロック図である。
ブロック図である。
【図４】図２のパーソナルコンピュータ１２−１の内部
の構成例を示すブロック図である。
の構成例を示すブロック図である。
【図５】図２のＳＴＢ１６の内部の構成例を示すブロッ
ク図である。
ク図である。
【図６】図５のフラッシュＲＯＭ９１の内部の構成例を
示すブロック図である。
示すブロック図である。
【図７】図５のフラッシュＲＯＭ９１における論理アド
レス空間と物理アドレス空間の関係を説明する図であ
る。
レス空間と物理アドレス空間の関係を説明する図であ
る。
【図８】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明する
フローチャートである。
フローチャートである。
【図９】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明する
概念図である。
概念図である。
【図１０】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１１】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１２】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１３】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１４】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１５】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１６】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１７】ＢＩＯＳ更新時のＳＴＢ１６の動作を説明す
る概念図である。
る概念図である。
【図１８】記録装置を有する情報処理装置の一例を示す
ブロック図である。
ブロック図である。
１−１，１−２ サーバ， ２ ケーブルテレビジョン
ネットワーク， ２−１，２−２ ケーブルテレビジョ
ンセンタ， ３ ＩＳＤＮ， ４ アナログ電話回線，
５−１乃至５−６ 家庭， １１ ホームサーバ，
１２−１，１２−２ パーソナルコンピュータ， １３
−１，１３−２ ディスプレイ， １４−１，１４−２
キーボード， １５−１，１５−２ マウス， １６
セットトップボックス， １７ テレビジョン受像
機， １８ 電話機， ５１ ＣＰＵ， ５２ フラッ
シュＲＯＭボード， ５３ ＲＡＭ， ５７ ネットワ
ークインタフェースカード， ９１ フラッシュＲＯ
Ｍ， ９２ バンク切替回路，９３ バンク状態レジス
タ
ネットワーク， ２−１，２−２ ケーブルテレビジョ
ンセンタ， ３ ＩＳＤＮ， ４ アナログ電話回線，
５−１乃至５−６ 家庭， １１ ホームサーバ，
１２−１，１２−２ パーソナルコンピュータ， １３
−１，１３−２ ディスプレイ， １４−１，１４−２
キーボード， １５−１，１５−２ マウス， １６
セットトップボックス， １７ テレビジョン受像
機， １８ 電話機， ５１ ＣＰＵ， ５２ フラッ
シュＲＯＭボード， ５３ ＲＡＭ， ５７ ネットワ
ークインタフェースカード， ９１ フラッシュＲＯ
Ｍ， ９２ バンク切替回路，９３ バンク状態レジス
タ
Claims (9)
- 【請求項１】 現行の基本プログラムが記憶保持される
主領域、前記基本プログラムを更新するための手順を示
す更新プログラムが記憶保持される共通領域、および、
更新前の基本プログラムが記憶保持される予備領域を有
する記憶手段と、 前記記憶手段の共通領域に格納された更新プログラムに
基づいて、前記主領域から読み出した現行の基本プログ
ラムを前記予備領域に複写した後に、新たな基本プログ
ラムを前記主領域へ書き込む更新処理を行う処理手段と
を備えることを特徴とする情報処理装置。 - 【請求項２】 前記基本プログラムは、ハードウェアに
依存する制御プログラム群であるＢＩＯＳであることを
特徴とする請求項１に記載の情報処理装置。 - 【請求項３】 所定の伝送チャンネルを介して供給され
る情報を受信する受信手段をさらに備え、 前記受信手段は、前記伝送チャンネルから、前記情報と
して、新たな基本プログラムを受信し、 前記処理手段は、前記記憶手段の共通領域に格納された
更新プログラムに基づいて、前記記憶手段の主領域から
読み出した現行の基本プログラムを前記記憶手段の予備
領域に複写した後に、前記受信手段によって受信された
新たな基本プログラムを前記記憶手段の主領域へ書き込
んで更新処理を行うことを特徴とする請求項１に記載の
情報処理装置。 - 【請求項４】 前記受信手段は、前記伝送チャンネルか
ら、ビデオオンデマンドサービスに関する情報を受信す
ることを特徴とする請求項３に記載の情報処理装置。 - 【請求項５】 前記記憶手段は、電気的に消去可能で、
かつ書き換え可能な半導体記憶素子であるＥＥＰＲＯＭ
で構成されていることを特徴とする請求項１に記載の情
報処理装置。 - 【請求項６】 前記記憶手段の主領域および予備領域
は、別個のバンクとして、同一論理アドレス空間に割り
当てられ、バンク切換によって一方のバンクが択一的に
選択されてアドレスされることを特徴とする請求項５に
記載の情報処理装置。 - 【請求項７】 記憶部の共通領域に記憶保持された更新
プログラムに基づいて、前記記憶部の主領域に記憶保持
された現行の基本プログラムを、新たな基本プログラム
に更新するプログラム更新方法であって、 前記主領域から読み出した現行の基本プログラムを前記
記憶部の予備領域へ複写するステップと、 前記更新プログラムに基づいて、新たな基本プログラム
を前記主領域に書き込む更新処理を行うステップとを備
えることを特徴とするプログラム更新方法。 - 【請求項８】 記憶部の共通領域に記憶保持された更新
プログラムに基づいて、前記記憶部の主領域に記憶保持
された現行の基本プログラムを、新たな基本プログラム
に更新するプログラム更新方法であって、 前記主領域から読み出した現行の基本プログラムを一時
記憶領域へ退避するステップと、 前記一時記憶領域に退避した現行の基本プログラムを、
前記記憶部の予備領域へ書き込むステップと、 前記一時記憶領域に退避した現行の基本プログラムと、
前記記憶部の予備領域に書き込んだ現行の基本プログラ
ムとを照合するステップと、 外部から供給された新たな基本プログラムを前記一時記
憶領域に書き込んだ後、この新たな基本プログラムを前
記記憶部の主領域へ書き込むステップと、 前記一時記憶領域に書き込んだ新たな基本プログラム
と、前記記憶部の主領域に書き込んだ新たな基本プログ
ラムとを照合するステップとを備えることを特徴とする
プログラム更新方法。 - 【請求項９】 所定の伝送チャンネルを介して情報を提
供する情報提供手段と、 記憶部の共通領域に格納された更新プログラムに基づい
て、前記記憶部の主領域から読み出した現行の基本プロ
グラムを前記記憶部の予備領域に複写した後に、前記伝
送チャンネルを介して供給された新たな基本プログラム
を前記記憶部の主領域へ書き込んで更新処理を行う情報
処理手段とを備えることを特徴とする情報処理システ
ム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09587997A JP3904099B2 (ja) | 1996-04-24 | 1997-04-14 | 情報処理装置、プログラム更新方法、および、情報処理システム |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10220496 | 1996-04-24 | ||
| JP8-102204 | 1996-04-24 | ||
| JP09587997A JP3904099B2 (ja) | 1996-04-24 | 1997-04-14 | 情報処理装置、プログラム更新方法、および、情報処理システム |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2006244096A Division JP2007042120A (ja) | 1996-04-24 | 2006-09-08 | 情報処理装置、プログラム更新方法、および、情報処理システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1083309A true JPH1083309A (ja) | 1998-03-31 |
| JP3904099B2 JP3904099B2 (ja) | 2007-04-11 |
Family
ID=26437038
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP09587997A Expired - Lifetime JP3904099B2 (ja) | 1996-04-24 | 1997-04-14 | 情報処理装置、プログラム更新方法、および、情報処理システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3904099B2 (ja) |
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| US9235426B2 (en) | 2010-03-17 | 2016-01-12 | Fujitsu Limited | Multicore processor system, computer product, and notification method for updating operating system |
-
1997
- 1997-04-14 JP JP09587997A patent/JP3904099B2/ja not_active Expired - Lifetime
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