JPH10233973A - 画像処理装置 - Google Patents
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- JPH10233973A JPH10233973A JP9034892A JP3489297A JPH10233973A JP H10233973 A JPH10233973 A JP H10233973A JP 9034892 A JP9034892 A JP 9034892A JP 3489297 A JP3489297 A JP 3489297A JP H10233973 A JPH10233973 A JP H10233973A
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/44—Receiver circuitry for the reception of television signals according to analogue transmission standards
- H04N5/445—Receiver circuitry for the reception of television signals according to analogue transmission standards for displaying additional information
- H04N5/45—Picture in picture, e.g. displaying simultaneously another television channel in a region of the screen
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Studio Circuits (AREA)
Abstract
(57)【要約】
【課題】 メモリ容量を小さくできる画像処理装置を提
供できる。 【解決手段】 本発明の画像処理装置は、第２のビデオ
データをディジタル化するアナログ／デジタル変換器
と；ディジタル化された画像データを第２のビデオデー
タのサブサンプル周波数（ｆsub）でサンプルし圧縮す
るデータサンプル回路と；データサンプル回路でサンプ
ルされた圧縮データを（１／３）ｆsubで読み出して書
き込むメモリと；メモリから第１のビデオデータのサブ
サンプル周波数（ｆmain）の３／４の周波数で読み出さ
れた画像データを４／３倍に伸長して小画面用ビデオデ
ータを生成するデータ伸長回路と；データ伸長回路で伸
長された画像データをアナログデータに変換するディジ
タル／アナログ変換器と；ディジタル／アナログ変換器
から出力される小画面用ビデオデータを全画面用の第１
のビデオデータに挿入するために切り替える切替回路を
備えるように構成される。
供できる。 【解決手段】 本発明の画像処理装置は、第２のビデオ
データをディジタル化するアナログ／デジタル変換器
と；ディジタル化された画像データを第２のビデオデー
タのサブサンプル周波数（ｆsub）でサンプルし圧縮す
るデータサンプル回路と；データサンプル回路でサンプ
ルされた圧縮データを（１／３）ｆsubで読み出して書
き込むメモリと；メモリから第１のビデオデータのサブ
サンプル周波数（ｆmain）の３／４の周波数で読み出さ
れた画像データを４／３倍に伸長して小画面用ビデオデ
ータを生成するデータ伸長回路と；データ伸長回路で伸
長された画像データをアナログデータに変換するディジ
タル／アナログ変換器と；ディジタル／アナログ変換器
から出力される小画面用ビデオデータを全画面用の第１
のビデオデータに挿入するために切り替える切替回路を
備えるように構成される。
Description
【０００１】
【発明の属する技術分野】本発明は画像処理装置に関す
るものであり、より詳細にはモニタ画面中に小さな小画
面を表示させる画像処理装置に関するものである。
るものであり、より詳細にはモニタ画面中に小さな小画
面を表示させる画像処理装置に関するものである。
【０００２】
【従来の技術】従来のモニタ画面（親画面）中に小さな
小画面（子画面）を表示させる画像処理装置は、親画面
中に挿入される子画面を面積比で親画面の１／９または
１／１６に切り替える方式が用いられていた。この場
合、（１／９）子画面は、ｆsub／３でサブサンプリン
グしてメモリに書き込み、（１／１６）子画面は、ｆsu
b／４でサブサンプリングしてメモリに書き込み、ｆmai
nで読み出していた。ここで、ｆsubは子画面サブサンプ
リング周波数（１４．３１８ＭＨｚ）であり、また、ｆ
mainは親画面サブサンプリング周波数（ｆsubと同じく
１４．３１８ＭＨｚ）である。ｆmainとｆsubとは周波
数は同じであるが同期していない信号である。
小画面（子画面）を表示させる画像処理装置は、親画面
中に挿入される子画面を面積比で親画面の１／９または
１／１６に切り替える方式が用いられていた。この場
合、（１／９）子画面は、ｆsub／３でサブサンプリン
グしてメモリに書き込み、（１／１６）子画面は、ｆsu
b／４でサブサンプリングしてメモリに書き込み、ｆmai
nで読み出していた。ここで、ｆsubは子画面サブサンプ
リング周波数（１４．３１８ＭＨｚ）であり、また、ｆ
mainは親画面サブサンプリング周波数（ｆsubと同じく
１４．３１８ＭＨｚ）である。ｆmainとｆsubとは周波
数は同じであるが同期していない信号である。
【０００３】図７はモニタ画面（親画面）中に小さな小
画面（子画面）を表示させる従来の画像処理装置を示す
図である。図７において、１１は親画面を表示するため
の親ビデオ信号が入力する親ビデオ信号入力端子であ
る。ここで、親ビデオ信号は輝度信号Ｙおよび色信号Ｃ
を有するビデオ信号である。１２は子画面を表示するた
めの子ビデオ信号が入力する子ビデオ信号入力端子であ
る。ここで、子ビデオ信号はコンポジット信号として入
力されるコンポジットビデオ信号である。１４は子ビデ
オ信号入力端子１２から入力するコンポジットビデオ信
号をアナログ／デジタル変換するアナログ／デジタル変
換器である。１５はアナログ／デジタル変換器１４で得
られたディジタル信号から輝度信号Ｙと色差信号（Ｂ−
ＹおよびＲ−Ｙ）を分離するためのＹ／Ｃ分離フィルタ
１５である。ここで、Ｂは青信号成分、Ｒは赤信号成分
を示す。１６はカラー復調回路を示す図である。カラー
復調回路１６は、色信号Ｃを色差信号Ｂ−ＹおよびＲ−
Ｙに変換する回路である。
画面（子画面）を表示させる従来の画像処理装置を示す
図である。図７において、１１は親画面を表示するため
の親ビデオ信号が入力する親ビデオ信号入力端子であ
る。ここで、親ビデオ信号は輝度信号Ｙおよび色信号Ｃ
を有するビデオ信号である。１２は子画面を表示するた
めの子ビデオ信号が入力する子ビデオ信号入力端子であ
る。ここで、子ビデオ信号はコンポジット信号として入
力されるコンポジットビデオ信号である。１４は子ビデ
オ信号入力端子１２から入力するコンポジットビデオ信
号をアナログ／デジタル変換するアナログ／デジタル変
換器である。１５はアナログ／デジタル変換器１４で得
られたディジタル信号から輝度信号Ｙと色差信号（Ｂ−
ＹおよびＲ−Ｙ）を分離するためのＹ／Ｃ分離フィルタ
１５である。ここで、Ｂは青信号成分、Ｒは赤信号成分
を示す。１６はカラー復調回路を示す図である。カラー
復調回路１６は、色信号Ｃを色差信号Ｂ−ＹおよびＲ−
Ｙに変換する回路である。
【０００４】２０は画面サイズ変換回路、２１は画面サ
イズ変換回路２０への入力端子、２２は画面サイズ変換
回路２０からの出力端子である。２３は出力端子２２か
ら入力する子ビデオ信号の輝度成分Ｙ、色差成分Ｂ−Ｙ
およびＲ−Ｙのそれぞれをサンプルするデータサンプル
回路である。データサンプル回路２３は（１／９）子画
面に対しては（１／３）ｆsubでサンプルし、各水平走
査線の画素を１／３に圧縮し、（１／１６）子画面に対
しては（１／４）ｆsubでサンプルし、各水平走査線の
画素を１／４に圧縮する。これらの圧縮された画像デー
タはスイッチ２４によっていずれかが読み出され、メモ
リ２５にストアされる。メモリ２５にストアされた画像
データはｆmainで読み出され、色差信号（Ｂ−Ｙおよび
Ｒ−Ｙ）はＤ／Ａ変換器１７でアナログ信号に変換さ
れ、その後ＲＧＢマトリクス回路１８で輝度信号Ｙと色
信号が混合されＹ、Ｃビデオ信号を作る。マトリクス回
路１８からの子ビデオ信号はスイッチ３０で親ビデオ信
号入力端子１１からの親ビデオ信号に挿入され、親画面
中に子画面が挿入され、出力端子１３に親ビデオ信号お
よび親ビデオ信号中に挿入された子ビデオ信号が出力さ
れる。
イズ変換回路２０への入力端子、２２は画面サイズ変換
回路２０からの出力端子である。２３は出力端子２２か
ら入力する子ビデオ信号の輝度成分Ｙ、色差成分Ｂ−Ｙ
およびＲ−Ｙのそれぞれをサンプルするデータサンプル
回路である。データサンプル回路２３は（１／９）子画
面に対しては（１／３）ｆsubでサンプルし、各水平走
査線の画素を１／３に圧縮し、（１／１６）子画面に対
しては（１／４）ｆsubでサンプルし、各水平走査線の
画素を１／４に圧縮する。これらの圧縮された画像デー
タはスイッチ２４によっていずれかが読み出され、メモ
リ２５にストアされる。メモリ２５にストアされた画像
データはｆmainで読み出され、色差信号（Ｂ−Ｙおよび
Ｒ−Ｙ）はＤ／Ａ変換器１７でアナログ信号に変換さ
れ、その後ＲＧＢマトリクス回路１８で輝度信号Ｙと色
信号が混合されＹ、Ｃビデオ信号を作る。マトリクス回
路１８からの子ビデオ信号はスイッチ３０で親ビデオ信
号入力端子１１からの親ビデオ信号に挿入され、親画面
中に子画面が挿入され、出力端子１３に親ビデオ信号お
よび親ビデオ信号中に挿入された子ビデオ信号が出力さ
れる。
【０００５】図８は親画面に子画面を挿入する各信号の
タイミングチャートを示す図である。図８（ａ）は、図
７の親ビデオ信号入力端子１１から入力する親ビデオ信
号を示す。図８（ａ）において、６１は水平同期を取る
ための水平同期パルス、６２は色信号の情報を送るため
のカラーバースト信号、６３は親画面用の映像信号であ
る。図８（ｂ）は、子ビデオ信号６４を示す図である。
子ビデオ信号６４は子画面を表示する部分のみに、図中
の鋸歯状波で示す部分に子画面用の画像信号が存在す
る。図８（ｃ）は、子画面を挿入するための親画面切り
抜き用信号６５を示す図である。親画面切り抜き用信号
６５はタイミング発生器（ＴＧ）３２によって発生され
る信号である。高速スイッチ（ＦＳＷ）３１は、親画面
切り抜き用信号６５が論理「Ｌ」の期間にスイッチ３０
を子ビデオ信号側に切り替え、親画面切り抜き用信号６
５が論理「Ｈ」の期間に親ビデオ信号側に切り替える制
御を行う。図８（ｄ）は、親ビデオ信号と子ビデオ信号
を重ね合わせたときの、水平走査線１ライン分の信号を
示す図である。図８（ｄ）に示すように、スイッチ３０
の切替によって、親画面用の映像信号６３中に子ビデオ
信号６４が挿入される。
タイミングチャートを示す図である。図８（ａ）は、図
７の親ビデオ信号入力端子１１から入力する親ビデオ信
号を示す。図８（ａ）において、６１は水平同期を取る
ための水平同期パルス、６２は色信号の情報を送るため
のカラーバースト信号、６３は親画面用の映像信号であ
る。図８（ｂ）は、子ビデオ信号６４を示す図である。
子ビデオ信号６４は子画面を表示する部分のみに、図中
の鋸歯状波で示す部分に子画面用の画像信号が存在す
る。図８（ｃ）は、子画面を挿入するための親画面切り
抜き用信号６５を示す図である。親画面切り抜き用信号
６５はタイミング発生器（ＴＧ）３２によって発生され
る信号である。高速スイッチ（ＦＳＷ）３１は、親画面
切り抜き用信号６５が論理「Ｌ」の期間にスイッチ３０
を子ビデオ信号側に切り替え、親画面切り抜き用信号６
５が論理「Ｈ」の期間に親ビデオ信号側に切り替える制
御を行う。図８（ｄ）は、親ビデオ信号と子ビデオ信号
を重ね合わせたときの、水平走査線１ライン分の信号を
示す図である。図８（ｄ）に示すように、スイッチ３０
の切替によって、親画面用の映像信号６３中に子ビデオ
信号６４が挿入される。
【０００６】図９は親画面中に子画面をはめ込んだ時の
モニタ画面を示す図である。図９（ａ）は、子画面８１
が親画面８０の１／１６の面積の場合を示す図である。
図９（ｂ）は、子画面８２が親画面８０の１／９の面積
の場合を示す図である。上述したように、従来は親画面
の１／１６の面積を有する子画面または親画面の１／９
の面積を有する圧縮された子画面用の子ビデオ信号を必
要に応じて切り替えてメモリに書き込んでおき、それを
読み出してモニタ画面に表示していた。
モニタ画面を示す図である。図９（ａ）は、子画面８１
が親画面８０の１／１６の面積の場合を示す図である。
図９（ｂ）は、子画面８２が親画面８０の１／９の面積
の場合を示す図である。上述したように、従来は親画面
の１／１６の面積を有する子画面または親画面の１／９
の面積を有する圧縮された子画面用の子ビデオ信号を必
要に応じて切り替えてメモリに書き込んでおき、それを
読み出してモニタ画面に表示していた。
【０００７】
【発明が解決しようとする課題】しかしながら、図７の
ような画像処理装置においては、メモリ２５はメモリを
多く使用する方の容量のものを用いる必要が有り、すな
わち、親画面の１／９の面積を有する圧縮された子画面
用の子ビデオ信号（たとえば、１走査線分）を記録出来
るメモリ容量が必要であった。このメモリをＩＣ上に組
み込む場合、メモリ容量が大きくなるとＩＣチップの形
状が大きくなりＩＣの小型化がはかれない欠点があっ
た。
ような画像処理装置においては、メモリ２５はメモリを
多く使用する方の容量のものを用いる必要が有り、すな
わち、親画面の１／９の面積を有する圧縮された子画面
用の子ビデオ信号（たとえば、１走査線分）を記録出来
るメモリ容量が必要であった。このメモリをＩＣ上に組
み込む場合、メモリ容量が大きくなるとＩＣチップの形
状が大きくなりＩＣの小型化がはかれない欠点があっ
た。
【０００８】本発明は、親画面の１／１６の面積を有す
る圧縮された子画面用の子ビデオ信号（たとえば、１走
査線分）をメモリに記録し、親画面の１／９の面積を有
する子画面用の子ビデオ信号は、メモリから読み出した
親画面の１／１６の面積を有する子画面用の子ビデオ信
号を伸長して生成することによって、メモリ容量を小さ
くできる画像処理装置を提供するものである。
る圧縮された子画面用の子ビデオ信号（たとえば、１走
査線分）をメモリに記録し、親画面の１／９の面積を有
する子画面用の子ビデオ信号は、メモリから読み出した
親画面の１／１６の面積を有する子画面用の子ビデオ信
号を伸長して生成することによって、メモリ容量を小さ
くできる画像処理装置を提供するものである。
【０００９】さらに、本発明は、親画面の１／１６の面
積を有する圧縮された子画面用の子ビデオ信号（たとえ
ば、１走査線分）をメモリに記録し、親画面の１／９の
面積を有する子画面制御表示する場合は、メモリから読
み出した親画面の１／１６の面積を有する子画面用の子
ビデオ信号を伸長して生成し、親画面の１／１６の面積
を有する子画面を表示する場合は、メモリから読み出し
た信号を伸張することなくそのまま使用することによっ
て、（１／９）子画面と（１／１６）子画面とを切り替
え、それによってメモリ容量を小さくできる画像処理装
置を提供するものである。
積を有する圧縮された子画面用の子ビデオ信号（たとえ
ば、１走査線分）をメモリに記録し、親画面の１／９の
面積を有する子画面制御表示する場合は、メモリから読
み出した親画面の１／１６の面積を有する子画面用の子
ビデオ信号を伸長して生成し、親画面の１／１６の面積
を有する子画面を表示する場合は、メモリから読み出し
た信号を伸張することなくそのまま使用することによっ
て、（１／９）子画面と（１／１６）子画面とを切り替
え、それによってメモリ容量を小さくできる画像処理装
置を提供するものである。
【００１０】
【課題を解決するための手段】本発明の画像処理装置
は、第２のビデオデータをディジタル化するアナログ／
デジタル変換器と；ディジタル化された画像データを第
２のビデオデータのサブサンプル周波数（ｆsub）でサ
ンプルし圧縮するデータサンプル回路と；データサンプ
ル回路でサンプルされた圧縮データを（１／ｎ）ｆsub
で読み出して書き込むメモリと；メモリから第１のビデ
オデータのサブサンプル周波数（ｆmain）のｍ／ｎの周
波数で読み出された画像データをｎ／ｍ倍に伸長して小
画面用ビデオデータを生成するデータ伸長回路と；デー
タ伸長回路で伸長された画像データをアナログデータに
変換するディジタル／アナログ変換器と；ディジタル／
アナログ変換器から出力される小画面用ビデオデータを
全画面用の第１のビデオデータに挿入するために切り替
える第１の切替回路を備えるように構成される。
は、第２のビデオデータをディジタル化するアナログ／
デジタル変換器と；ディジタル化された画像データを第
２のビデオデータのサブサンプル周波数（ｆsub）でサ
ンプルし圧縮するデータサンプル回路と；データサンプ
ル回路でサンプルされた圧縮データを（１／ｎ）ｆsub
で読み出して書き込むメモリと；メモリから第１のビデ
オデータのサブサンプル周波数（ｆmain）のｍ／ｎの周
波数で読み出された画像データをｎ／ｍ倍に伸長して小
画面用ビデオデータを生成するデータ伸長回路と；デー
タ伸長回路で伸長された画像データをアナログデータに
変換するディジタル／アナログ変換器と；ディジタル／
アナログ変換器から出力される小画面用ビデオデータを
全画面用の第１のビデオデータに挿入するために切り替
える第１の切替回路を備えるように構成される。
【００１１】また、本発明の画像処理装置は、さらに、
第２の切替回路を備え、１／ｍ小画面ビデオデータを生
成するときは、メモリから（ｍ／ｎ）ｆmainの周波数で
データを読み出し、データ伸長回路で伸張し、１／ｎ小
画面ビデオデータを生成するときは、メモリからｆmain
の周波数でデータを読み出し、その読み出したデータ伸
張することなく出力することによって、１／ｍ2子画面
用子ビデオデータまたは１／ｎ2子画面用子ビデオデー
タのいずれかの小画面用ビデオデータを生成するように
構成される。
第２の切替回路を備え、１／ｍ小画面ビデオデータを生
成するときは、メモリから（ｍ／ｎ）ｆmainの周波数で
データを読み出し、データ伸長回路で伸張し、１／ｎ小
画面ビデオデータを生成するときは、メモリからｆmain
の周波数でデータを読み出し、その読み出したデータ伸
張することなく出力することによって、１／ｍ2子画面
用子ビデオデータまたは１／ｎ2子画面用子ビデオデー
タのいずれかの小画面用ビデオデータを生成するように
構成される。
【００１２】さらに、本発明の画像処理装置において、
ｎは整数４、ｍは整数３であるように構成される。
ｎは整数４、ｍは整数３であるように構成される。
【００１３】また、本発明の画像処理装置において、デ
ータ伸長回路は、入力画像データ信号をＹｉ（ｉ＝０，
１，２，３，・・・の自然数）とすると、出力画像データ
信号は次の式で表わされるように構成される。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３）） ここで、ｊ＝３ｉ＝０、３、６、９、１２、・・・であ
る。
ータ伸長回路は、入力画像データ信号をＹｉ（ｉ＝０，
１，２，３，・・・の自然数）とすると、出力画像データ
信号は次の式で表わされるように構成される。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３）） ここで、ｊ＝３ｉ＝０、３、６、９、１２、・・・であ
る。
【００１４】さらに、本発明の画像処理装置において、
データ伸長回路は、入力画像データ信号を直接出力する
第１の経路と、入力画像データ信号に第１の定数を乗算
する第１の乗算回路、入力画像データ信号に第２の定数
を乗算する第２の乗算回路、これらの乗算結果を加算す
る加算器および加算器の出力結果を１／２にする回路に
よって構成される第２の経路と、第１の経路と第２の経
路とを切り替える切替回路とを有するように構成され
る。
データ伸長回路は、入力画像データ信号を直接出力する
第１の経路と、入力画像データ信号に第１の定数を乗算
する第１の乗算回路、入力画像データ信号に第２の定数
を乗算する第２の乗算回路、これらの乗算結果を加算す
る加算器および加算器の出力結果を１／２にする回路に
よって構成される第２の経路と、第１の経路と第２の経
路とを切り替える切替回路とを有するように構成され
る。
【００１５】さらに、本発明の画像処理装置において、
第１および第２の定数は、乗算回路の第２の入力端子に
入力する制御信号の値と以下のように対応するように構
成される。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
第１および第２の定数は、乗算回路の第２の入力端子に
入力する制御信号の値と以下のように対応するように構
成される。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
【００１６】さらに、本発明の画像処理装置において、
データ伸長回路は：入力画像信号を第１の入力端子に受
け、第１の制御信号を第２の入力端子に受け、その第１
の制御信号に従って入力画像信号を出力端子から出力す
る第１のＤフリップフロップと、入力画像信号を第１の
入力端子に受け、第２の制御信号を第２の入力端子に受
け、その第２の信号制御信号ＬＥＮ信号に従って入力画
像信号を出力端子から出力する第２のＤフリップフロッ
プと、第１のＤフリップフロップの出力と第２のＤフリ
ップフロップの出力を第３の制御信号によって切り替え
る第１の切替回路と、入力画像信号に第４の制御信号の
値に対応した定数を乗算する第１の乗算器と、入力画像
信号に第５の制御信号の値に対応した定数を乗算する第
２の乗算器と、第１の乗算器の出力をラッチする第３の
Ｄフリップフロップと、第２の乗算器の出力をラッチす
る第４のＤフリップフロップと、第１の切替器の出力と
第３のＤフリップフロップの出力とを第６の制御信号に
従って切り替える第２の切替器と、第３のＤフリップフ
ロップの出力と第４のＤフリップフロップの出力とを加
算する加算器と、第２の切替器の出力を第７の制御信号
に従ってラッチする第５のＤフリップフロップと、第５
のフリップフロップの出力と加算器の出力とを第７の制
御信号に従って切り替える第３の切替器と、第３の切替
器の出力をラッチする第６のＤフリップフロップとを有
し、第１から第７の制御信号に従って入力画像信号を４
／３倍に伸張するように構成される。
データ伸長回路は：入力画像信号を第１の入力端子に受
け、第１の制御信号を第２の入力端子に受け、その第１
の制御信号に従って入力画像信号を出力端子から出力す
る第１のＤフリップフロップと、入力画像信号を第１の
入力端子に受け、第２の制御信号を第２の入力端子に受
け、その第２の信号制御信号ＬＥＮ信号に従って入力画
像信号を出力端子から出力する第２のＤフリップフロッ
プと、第１のＤフリップフロップの出力と第２のＤフリ
ップフロップの出力を第３の制御信号によって切り替え
る第１の切替回路と、入力画像信号に第４の制御信号の
値に対応した定数を乗算する第１の乗算器と、入力画像
信号に第５の制御信号の値に対応した定数を乗算する第
２の乗算器と、第１の乗算器の出力をラッチする第３の
Ｄフリップフロップと、第２の乗算器の出力をラッチす
る第４のＤフリップフロップと、第１の切替器の出力と
第３のＤフリップフロップの出力とを第６の制御信号に
従って切り替える第２の切替器と、第３のＤフリップフ
ロップの出力と第４のＤフリップフロップの出力とを加
算する加算器と、第２の切替器の出力を第７の制御信号
に従ってラッチする第５のＤフリップフロップと、第５
のフリップフロップの出力と加算器の出力とを第７の制
御信号に従って切り替える第３の切替器と、第３の切替
器の出力をラッチする第６のＤフリップフロップとを有
し、第１から第７の制御信号に従って入力画像信号を４
／３倍に伸張するように構成される。
【００１７】さらに、本発明の画像処理装置において、
データ伸長回路を（１／１６）子画面用子ビデオ信号生
成に使用する場合には、第１の制御信号は論理「Ｌ」、
第３の制御信号は１０進数の２、第６の制御信号は論理
「Ｈ」、第７の制御信号は論理「Ｌ」、第８の制御信号
は論理「Ｌ」に設定されるように構成される。
データ伸長回路を（１／１６）子画面用子ビデオ信号生
成に使用する場合には、第１の制御信号は論理「Ｌ」、
第３の制御信号は１０進数の２、第６の制御信号は論理
「Ｈ」、第７の制御信号は論理「Ｌ」、第８の制御信号
は論理「Ｌ」に設定されるように構成される。
【００１８】
実施の形態１．図１は本発明の実施の形態１の画像処理
装置示す図である。図１において、１１は親画面を表示
するための親ビデオ信号が入力する親ビデオ信号入力端
子である。ここで、親ビデオ信号は輝度信号Ｙおよび色
信号Ｃを有するビデオ信号である。１２は子画面を表示
するための子ビデオ信号が入力する子ビデオ信号入力端
子である。ここで、子ビデオ信号はコンポジット信号と
して入力されるコンポジットビデオ信号である。１４は
子ビデオ信号入力端子１２から入力するコンポジットビ
デオ信号をアナログ／デジタル変換するアナログ／デジ
タル変換器である。１５はアナログ／デジタル変換器１
４で得られたディジタル信号から輝度信号Ｙと色差信号
（Ｂ−ＹおよびＲ−Ｙ）を分離するためのＹ／Ｃ分離フ
ィルタ（Ｆ）１５である。ここで、Ｂは青信号成分、Ｒ
は赤信号成分を示す。１６はカラー復調回路（ＤＥＭ）
１６を示す図である。カラー復調回路１６は、色信号Ｃ
を色差信号Ｂ−ＹおよびＲ−Ｙに変換する回路である。
装置示す図である。図１において、１１は親画面を表示
するための親ビデオ信号が入力する親ビデオ信号入力端
子である。ここで、親ビデオ信号は輝度信号Ｙおよび色
信号Ｃを有するビデオ信号である。１２は子画面を表示
するための子ビデオ信号が入力する子ビデオ信号入力端
子である。ここで、子ビデオ信号はコンポジット信号と
して入力されるコンポジットビデオ信号である。１４は
子ビデオ信号入力端子１２から入力するコンポジットビ
デオ信号をアナログ／デジタル変換するアナログ／デジ
タル変換器である。１５はアナログ／デジタル変換器１
４で得られたディジタル信号から輝度信号Ｙと色差信号
（Ｂ−ＹおよびＲ−Ｙ）を分離するためのＹ／Ｃ分離フ
ィルタ（Ｆ）１５である。ここで、Ｂは青信号成分、Ｒ
は赤信号成分を示す。１６はカラー復調回路（ＤＥＭ）
１６を示す図である。カラー復調回路１６は、色信号Ｃ
を色差信号Ｂ−ＹおよびＲ−Ｙに変換する回路である。
【００１９】２０は画面サイズ変換回路、２１は画面サ
イズ変換回路２０への入力端子、２２は画面サイズ変換
回路２０からの出力端子である。２３は出力端子２２か
ら入力する子ビデオ信号の輝度成分Ｙ、色差成分Ｂ−Ｙ
およびＲ−Ｙのそれぞれをサンプルするデータサンプル
回路である。データサンプル回路２３は（１／１６）子
画面を作るために、輝度成分Ｙ、色差成分Ｂ−Ｙおよび
Ｒ−Ｙのそれぞれを１／４ｆsubでサンプルし、各成分
の画素を１／４に圧縮する。これらの圧縮された画像デ
ータはメモリ２５にストアされる。メモリ２５にストア
された画像信号は、ｆmain信号の３／４の周波数または
ｆmain信号の周波数のいずれかで読み出され、それぞれ
（１／９）子画面用子ビデオ信号または（１／１６）子
画面用子ビデオ信号の画像信号として切替回路２６の入
力端子２８に供給される。
イズ変換回路２０への入力端子、２２は画面サイズ変換
回路２０からの出力端子である。２３は出力端子２２か
ら入力する子ビデオ信号の輝度成分Ｙ、色差成分Ｂ−Ｙ
およびＲ−Ｙのそれぞれをサンプルするデータサンプル
回路である。データサンプル回路２３は（１／１６）子
画面を作るために、輝度成分Ｙ、色差成分Ｂ−Ｙおよび
Ｒ−Ｙのそれぞれを１／４ｆsubでサンプルし、各成分
の画素を１／４に圧縮する。これらの圧縮された画像デ
ータはメモリ２５にストアされる。メモリ２５にストア
された画像信号は、ｆmain信号の３／４の周波数または
ｆmain信号の周波数のいずれかで読み出され、それぞれ
（１／９）子画面用子ビデオ信号または（１／１６）子
画面用子ビデオ信号の画像信号として切替回路２６の入
力端子２８に供給される。
【００２０】上述のように、メモリ２５の書き込みはｆ
subの周波数で行われ、読出しはｆmainの周波数で行わ
れる。ここで、ｆsubは子画面用画像信号のサブサンプ
ル周波数であり、ｆmainは親画面用画像信号のサブサン
プル周波数である。ｆsubとｆmainとのソースが異なる
ので、各周波数は同期は取れていないが、それぞれの周
波数は同じく１４．３１８ＭＨｚである。また、有効画
像データ期間（１水平期間中で画像信号が画面に表示さ
れる期間）を、たとえば、１水平期間の８０％とする
と、水平圧縮率１／４ではメモリ２５に書き込まれる画
素数は１８２ピクセル／水平期間となる。このメモリ２
５に書き込まれたデータを３／４ｆmainでデータ伸長を
行うと、１８２×４／３＝２４２ピクセル／水平期間と
なる。すなわち、この場合の水平圧縮率は１／３とな
り、子画面サイズ１／９の子画面が生成されることにな
る。
subの周波数で行われ、読出しはｆmainの周波数で行わ
れる。ここで、ｆsubは子画面用画像信号のサブサンプ
ル周波数であり、ｆmainは親画面用画像信号のサブサン
プル周波数である。ｆsubとｆmainとのソースが異なる
ので、各周波数は同期は取れていないが、それぞれの周
波数は同じく１４．３１８ＭＨｚである。また、有効画
像データ期間（１水平期間中で画像信号が画面に表示さ
れる期間）を、たとえば、１水平期間の８０％とする
と、水平圧縮率１／４ではメモリ２５に書き込まれる画
素数は１８２ピクセル／水平期間となる。このメモリ２
５に書き込まれたデータを３／４ｆmainでデータ伸長を
行うと、１８２×４／３＝２４２ピクセル／水平期間と
なる。すなわち、この場合の水平圧縮率は１／３とな
り、子画面サイズ１／９の子画面が生成されることにな
る。
【００２１】図２は切替回路２６の詳細回路を示す図で
ある。図２において、２８はメモリ２５から読み出され
た画像信号が入力する入力端子、７０は（１／９）子画
面用子ビデオ信号と（１／１６）子画面用親ビデオ信号
を切り替える切替回路である。２９は（１／９）子画面
用子ビデオ信号と（１／１６）子画面用親ビデオ信号を
切り替えるための切替信号端子である。データ伸長回路
４０は、切替信号端子２９から（１／９）子画面切替信
号が入力した時は、メモリ２５から読み出された子ビデ
オ信号を４／３倍に伸長して出力し、（１／１６）子画
面切替信号が入力した時は、メモリ２５から読み出され
た子ビデオ信号を伸張することなく出力するデータ伸長
回路である。２２はデータ伸長回路４０で得られた（１
／９）子画面用子ビデオ信号または（１／１６）子画面
用子ビデオ信号を出力する出力端子である。（１／９）
子画面用子ビデオ信号は１水平走査時間（Ｈ）当たり２
４２ピクセルを有し、また（１／１６）子画面用子ビデ
オ信号は１水平走査時間（Ｈ）当たり１８２ピクセルを
有する。以下に、データ伸長回路４０に構成および動作
について説明する。
ある。図２において、２８はメモリ２５から読み出され
た画像信号が入力する入力端子、７０は（１／９）子画
面用子ビデオ信号と（１／１６）子画面用親ビデオ信号
を切り替える切替回路である。２９は（１／９）子画面
用子ビデオ信号と（１／１６）子画面用親ビデオ信号を
切り替えるための切替信号端子である。データ伸長回路
４０は、切替信号端子２９から（１／９）子画面切替信
号が入力した時は、メモリ２５から読み出された子ビデ
オ信号を４／３倍に伸長して出力し、（１／１６）子画
面切替信号が入力した時は、メモリ２５から読み出され
た子ビデオ信号を伸張することなく出力するデータ伸長
回路である。２２はデータ伸長回路４０で得られた（１
／９）子画面用子ビデオ信号または（１／１６）子画面
用子ビデオ信号を出力する出力端子である。（１／９）
子画面用子ビデオ信号は１水平走査時間（Ｈ）当たり２
４２ピクセルを有し、また（１／１６）子画面用子ビデ
オ信号は１水平走査時間（Ｈ）当たり１８２ピクセルを
有する。以下に、データ伸長回路４０に構成および動作
について説明する。
【００２２】図３はデータ伸長回路４０の詳細回路を示
す図である。図４は（１／１６）子画面用子ビデオ信号
から（１／９）子画面用子ビデオ信号を生成するデータ
伸長の論理を説明する図である。図５は（１／９）子画
面用子ビデオ信号を生成するときのデータ伸長回路４０
のタイミングチャートを示す図である。図６は（１／１
６）子画面用子ビデオ信号を生成するときのデータ伸長
回路４０のタイミングチャートを示す図である。
す図である。図４は（１／１６）子画面用子ビデオ信号
から（１／９）子画面用子ビデオ信号を生成するデータ
伸長の論理を説明する図である。図５は（１／９）子画
面用子ビデオ信号を生成するときのデータ伸長回路４０
のタイミングチャートを示す図である。図６は（１／１
６）子画面用子ビデオ信号を生成するときのデータ伸長
回路４０のタイミングチャートを示す図である。
【００２３】図３は（１／９）子画面用子ビデオ信号生
成時および（１／１６）子画面用子ビデオ信号生成時の
両方において動作するので、まず図３、図４および図５
を用いて（１／９）子画面用子ビデオ信号生成時につい
て説明し、次に図３と図６を用いて（１／１６）子画面
用子ビデオ信号生成時について説明する。
成時および（１／１６）子画面用子ビデオ信号生成時の
両方において動作するので、まず図３、図４および図５
を用いて（１／９）子画面用子ビデオ信号生成時につい
て説明し、次に図３と図６を用いて（１／１６）子画面
用子ビデオ信号生成時について説明する。
【００２４】［（１／９）子画面用子ビデオ信号］ま
ず、図４に示すデータ伸長論理を用いて「３ｔｏ４」伸
長回路の論理を説明する。図４の信号列Ｙ０，Ｙ１，Ｙ
２，Ｙ３，Ｙ４，Ｙ５，Ｙ６，Ｙ７，Ｙ８，Ｙ９，Ｙ１
０・・・は、図３のデータ伸長回路４０に入力される図５
（ｂ）に示す入力信号ＤＩＮ＜５：０＞である。図４に
示す信号列Ｙ０、Ｘ１、Ｘ２、Ｘ３、Ｙ３、Ｘ４、Ｘ
５、Ｘ６、Ｙ６・・・は図３のデータ伸長回路４０の出力
端子７４から出力される図５（ｒ）に示す信号ＺＹ＜
５：０＞である。
ず、図４に示すデータ伸長論理を用いて「３ｔｏ４」伸
長回路の論理を説明する。図４の信号列Ｙ０，Ｙ１，Ｙ
２，Ｙ３，Ｙ４，Ｙ５，Ｙ６，Ｙ７，Ｙ８，Ｙ９，Ｙ１
０・・・は、図３のデータ伸長回路４０に入力される図５
（ｂ）に示す入力信号ＤＩＮ＜５：０＞である。図４に
示す信号列Ｙ０、Ｘ１、Ｘ２、Ｘ３、Ｙ３、Ｘ４、Ｘ
５、Ｘ６、Ｙ６・・・は図３のデータ伸長回路４０の出力
端子７４から出力される図５（ｒ）に示す信号ＺＹ＜
５：０＞である。
【００２５】（１／９）子画面用子ビデオ信号生成回路
における入力入力信号ＤＩＮ＜５：０＞と出力信号ＺＹ
＜５：０＞との関係は以下の式で表わされる。
における入力入力信号ＤＩＮ＜５：０＞と出力信号ＺＹ
＜５：０＞との関係は以下の式で表わされる。
【００２６】入力入力信号ＤＩＮ＜５：０＞はＹｉ（ｉ
＝１，２，３，４，・・・の自然数）で表され、出力信号
ＺＹ＜５：０＞は以下の式で表される。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３）） ここで、ｊ＝３ｉ（０、３、６、９、１２、・・・）であ
る。
＝１，２，３，４，・・・の自然数）で表され、出力信号
ＺＹ＜５：０＞は以下の式で表される。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３）） ここで、ｊ＝３ｉ（０、３、６、９、１２、・・・）であ
る。
【００２７】上記の式を、図４中で入力信号ＤＩＮ＜
５：０＞と信号ＺＹ＜５：０＞とを対応づけて表わす
と、出力信号ＺＹ＜５：０＞中のＹ０，Ｙ３，Ｙ６，Ｙ
９，Ｙ１２・・・は入力信号ＤＩＮ＜５：０＞中のＹ０，
Ｙ３，Ｙ６，Ｙ９，Ｙ１２・・・と同じ値となる。また、
出力信号ＺＹ＜５：０＞中のＸ１、Ｘ２、Ｘ３、Ｘ４、
Ｘ５、Ｘ６・・・等は入力信号ＤＩＮ＜５：０＞中の各要
素と対応付けるとそれぞれ以下のようになる。 ＺＹ＜５：０＞ ＤＩＮ＜５：０＞ Ｙ０ ＝ Ｙ０、 Ｘ１ ＝ １／２（１／２Ｙ０＋３／２Ｙ１）、 Ｘ２ ＝ （Ｙ１＋Ｙ２）、 Ｘ３ ＝ １／２（３／２Ｙ２＋１／２Ｙ３）、 Ｙ３ ＝ Ｙ３、 Ｘ４ ＝ １／２（１／２Ｙ３＋３／２Ｙ４）、 Ｘ５ ＝ （Ｙ４＋Ｙ５）、 Ｘ６ ＝ １／２（３／２Ｙ５＋１／２Ｙ６） Ｙ６ ＝ Ｙ６、 Ｘ７ ＝ １／２（１／２Ｙ６＋３／２Ｙ７）、 Ｘ８ ＝ （Ｙ７＋Ｙ８）、 Ｘ９ ＝ １／２（３／２Ｙ８＋１／２Ｙ９）、 ・・・・・・・・・ ・・・・・・・・・
５：０＞と信号ＺＹ＜５：０＞とを対応づけて表わす
と、出力信号ＺＹ＜５：０＞中のＹ０，Ｙ３，Ｙ６，Ｙ
９，Ｙ１２・・・は入力信号ＤＩＮ＜５：０＞中のＹ０，
Ｙ３，Ｙ６，Ｙ９，Ｙ１２・・・と同じ値となる。また、
出力信号ＺＹ＜５：０＞中のＸ１、Ｘ２、Ｘ３、Ｘ４、
Ｘ５、Ｘ６・・・等は入力信号ＤＩＮ＜５：０＞中の各要
素と対応付けるとそれぞれ以下のようになる。 ＺＹ＜５：０＞ ＤＩＮ＜５：０＞ Ｙ０ ＝ Ｙ０、 Ｘ１ ＝ １／２（１／２Ｙ０＋３／２Ｙ１）、 Ｘ２ ＝ （Ｙ１＋Ｙ２）、 Ｘ３ ＝ １／２（３／２Ｙ２＋１／２Ｙ３）、 Ｙ３ ＝ Ｙ３、 Ｘ４ ＝ １／２（１／２Ｙ３＋３／２Ｙ４）、 Ｘ５ ＝ （Ｙ４＋Ｙ５）、 Ｘ６ ＝ １／２（３／２Ｙ５＋１／２Ｙ６） Ｙ６ ＝ Ｙ６、 Ｘ７ ＝ １／２（１／２Ｙ６＋３／２Ｙ７）、 Ｘ８ ＝ （Ｙ７＋Ｙ８）、 Ｘ９ ＝ １／２（３／２Ｙ８＋１／２Ｙ９）、 ・・・・・・・・・ ・・・・・・・・・
【００２８】（１／９）子画面用子ビデオ信号を生成す
るために上述した論理に基づいて図３のデータ伸長回路
４０は以下のように構成され、かつ動作する。図３にお
いて、７１は入力信号ＤＩＮ＜５：０＞の入力端子であ
る。（１／９）子画面用子ビデオ信号を生成するときは
メモリ２５の画像データを３／４ｆmainの周波数で読み
出す。図５（ａ）に示す切替信号ＲＥは、ｆmainの周波
数で４回に３回だけ、メモリ２５からデータを読み出す
ことを指示する信号である。この切替信号ＲＥによっ
て、図２に示す切替回路７０はメモリ２５からｆmainの
周波数で４回に３回だけデータを読み出してデータ伸長
回路４０に出力する。この出力された入力信号ＤＩＮ＜
５：０＞は図５（ｂ）に示される。ここで、＜５：０＞
は０ビットから５ビットまでの６ビットで構成され、そ
の全６ビット構成のデータは０〜６ビットまでのデータ
を全て含むことを意味する。また、＜６：１＞は０ビッ
トから６ビットまでの７ビットで構成されたデータのう
ち１ビット〜６ビットまでを抜き出したデータを意味す
る。すなわち、＜６：０＞のデータは、＜６：１＞のデ
ータ信号の０ビット目を使用しないで１ビット〜６ビッ
トを使用することを意味し、そのために、＜６：１＞デ
ータは、＜６：０＞データの最下位ビットが１ビットシ
フトされるために、＜６：０＞のデータの１／２の値を
有するデータを意味する。
るために上述した論理に基づいて図３のデータ伸長回路
４０は以下のように構成され、かつ動作する。図３にお
いて、７１は入力信号ＤＩＮ＜５：０＞の入力端子であ
る。（１／９）子画面用子ビデオ信号を生成するときは
メモリ２５の画像データを３／４ｆmainの周波数で読み
出す。図５（ａ）に示す切替信号ＲＥは、ｆmainの周波
数で４回に３回だけ、メモリ２５からデータを読み出す
ことを指示する信号である。この切替信号ＲＥによっ
て、図２に示す切替回路７０はメモリ２５からｆmainの
周波数で４回に３回だけデータを読み出してデータ伸長
回路４０に出力する。この出力された入力信号ＤＩＮ＜
５：０＞は図５（ｂ）に示される。ここで、＜５：０＞
は０ビットから５ビットまでの６ビットで構成され、そ
の全６ビット構成のデータは０〜６ビットまでのデータ
を全て含むことを意味する。また、＜６：１＞は０ビッ
トから６ビットまでの７ビットで構成されたデータのう
ち１ビット〜６ビットまでを抜き出したデータを意味す
る。すなわち、＜６：０＞のデータは、＜６：１＞のデ
ータ信号の０ビット目を使用しないで１ビット〜６ビッ
トを使用することを意味し、そのために、＜６：１＞デ
ータは、＜６：０＞データの最下位ビットが１ビットシ
フトされるために、＜６：０＞のデータの１／２の値を
有するデータを意味する。
【００２９】Ｄフリップフロップ４１は、入力端子７１
に入力された入力信号ＤＩＮ＜５：０＞をＤ端子に受
け、Ｅ端子に入力される図５（ｃ）の制御信号ＦＥＮの
立ち上がり時にその直前に存在した入力信号ＤＩＮ＜
５：０＞をＱ端子に図５（ｄ）に示すようにＦＱ＜５：
０＞として、Ｙ０，Ｙ２，Ｙ４，Ｙ６，Ｙ８，Ｙ１０・・
・のように出力する。一方、Ｄフリップフロップ４２
は、入力端子７１に入力された入力信号ＤＩＮ＜５：０
＞をＤ端子に受け、Ｅ端子に入力される図５（ｇ）の制
御信号ＬＥＮの立ち上がり時にその直前に存在した入力
信号ＤＩＮ＜５：０＞をＱ端子に図５（ｈ）に示すよう
にＬＱ＜５：０＞として、Ｙ１，Ｙ３，Ｙ５，Ｙ７，Ｙ
９・・・のように出力する。
に入力された入力信号ＤＩＮ＜５：０＞をＤ端子に受
け、Ｅ端子に入力される図５（ｃ）の制御信号ＦＥＮの
立ち上がり時にその直前に存在した入力信号ＤＩＮ＜
５：０＞をＱ端子に図５（ｄ）に示すようにＦＱ＜５：
０＞として、Ｙ０，Ｙ２，Ｙ４，Ｙ６，Ｙ８，Ｙ１０・・
・のように出力する。一方、Ｄフリップフロップ４２
は、入力端子７１に入力された入力信号ＤＩＮ＜５：０
＞をＤ端子に受け、Ｅ端子に入力される図５（ｇ）の制
御信号ＬＥＮの立ち上がり時にその直前に存在した入力
信号ＤＩＮ＜５：０＞をＱ端子に図５（ｈ）に示すよう
にＬＱ＜５：０＞として、Ｙ１，Ｙ３，Ｙ５，Ｙ７，Ｙ
９・・・のように出力する。
【００３０】切替回路４３は、図５（ｌ）に示される制
御信号ＬＳＥＬが論理「Ｈ」の時にＡ端子に入力される
信号ＬＱ＜５：０＞を選択し、制御信号ＬＳＥＬが論理
「Ｌ」の時にＢ端子に入力される信号ＦＱ＜５：０＞を
選択し、その選択した信号をＹ端子に６ビットの信号Ｌ
ＳＥＬＹ＜５：０＞信号として出力する。ここで、切替
回路４３中に表示される「ＳＡ」の記号は、そこに入力
される信号が論理「Ｈ」のときに「Ａ」端子に入力され
る信号を選択し、論理「Ｌ」のときに「Ａ」でない方の
入力端子、すなわち、「Ｂ」端子に入力する信号を選択
することを意味する。
御信号ＬＳＥＬが論理「Ｈ」の時にＡ端子に入力される
信号ＬＱ＜５：０＞を選択し、制御信号ＬＳＥＬが論理
「Ｌ」の時にＢ端子に入力される信号ＦＱ＜５：０＞を
選択し、その選択した信号をＹ端子に６ビットの信号Ｌ
ＳＥＬＹ＜５：０＞信号として出力する。ここで、切替
回路４３中に表示される「ＳＡ」の記号は、そこに入力
される信号が論理「Ｈ」のときに「Ａ」端子に入力され
る信号を選択し、論理「Ｌ」のときに「Ａ」でない方の
入力端子、すなわち、「Ｂ」端子に入力する信号を選択
することを意味する。
【００３１】乗算回路４４は、Ａ端子に信号ＦＱ＜５：
０＞を受け、Ｋ端子に制御信号ＫＦ＜１：０＞を受け、
制御信号ＫＦ＜１：０＞の値に対応する定数をＦＱ＜
５：０＞に乗算する演算を行い、その結果をＹ端子に７
ビットの信号Ｙ＜６：０＞として出力する。図３の右下
の表は、Ｋ端子に入力される制御信号の値と定数（ＣＡ
Ｌ１）との関係を示す。Ｋ端子は２ビット入力端子を有
するのでＫ＜１：０＞と表わされている。表中におい
て、たとえば、（００）ｈは１６進数で０を表わし、
（１１）ｈは１６進数で３を表わす。図５（ｅ）の制御
信号ＫＦ＜１：０＞中ではこの値は１０進数で表わされ
ている。たとえば、図５（ｃ）の信号ＦＱ＜５：０＞が
Ｙ０であり、制御信号ＫＦ＜１：０＞が１である時に
は、表のＫ＜１：０＞の値が１に対する定数ＣＡＬ１は
１／２であるので、乗算回路４４ではＹ０に１／２が乗
算され、１／２Ｙ０がＹ端子に信号Ｙ＜６：０＞として
得られる。Ｄフリップフロップ４６は乗算回路４４の出
力を次の信号Ｙ＜６：０＞が出力されるまでラッチする
回路である。Ｄフリップフロップ４６でラッチされた信
号はＱ端子から信号ＦＰＲＯＣＱ＜６：０＞としてＱ端
子から出力される。
０＞を受け、Ｋ端子に制御信号ＫＦ＜１：０＞を受け、
制御信号ＫＦ＜１：０＞の値に対応する定数をＦＱ＜
５：０＞に乗算する演算を行い、その結果をＹ端子に７
ビットの信号Ｙ＜６：０＞として出力する。図３の右下
の表は、Ｋ端子に入力される制御信号の値と定数（ＣＡ
Ｌ１）との関係を示す。Ｋ端子は２ビット入力端子を有
するのでＫ＜１：０＞と表わされている。表中におい
て、たとえば、（００）ｈは１６進数で０を表わし、
（１１）ｈは１６進数で３を表わす。図５（ｅ）の制御
信号ＫＦ＜１：０＞中ではこの値は１０進数で表わされ
ている。たとえば、図５（ｃ）の信号ＦＱ＜５：０＞が
Ｙ０であり、制御信号ＫＦ＜１：０＞が１である時に
は、表のＫ＜１：０＞の値が１に対する定数ＣＡＬ１は
１／２であるので、乗算回路４４ではＹ０に１／２が乗
算され、１／２Ｙ０がＹ端子に信号Ｙ＜６：０＞として
得られる。Ｄフリップフロップ４６は乗算回路４４の出
力を次の信号Ｙ＜６：０＞が出力されるまでラッチする
回路である。Ｄフリップフロップ４６でラッチされた信
号はＱ端子から信号ＦＰＲＯＣＱ＜６：０＞としてＱ端
子から出力される。
【００３２】一方、乗算回路４５は、Ａ端子に信号ＬＱ
＜５：０＞を受け、Ｋ端子に制御信号ＫＬ＜１：０＞を
受け、制御信号ＫＬ＜１：０＞の値に対応する定数を信
号ＬＱ＜５：０＞に乗算する演算を行い、その結果をＹ
端子に７ビットの信号Ｙ＜６：０＞として出力する。定
数ＣＡＬ１に関しては、乗算回路４４の場合と同じであ
るので、説明を省略する。Ｄフリップフロップ４７は乗
算回路４５の出力を次の信号Ｙ＜６：０＞が出力される
までラッチする回路である。Ｄフリップフロップ４７で
ラッチされた信号はＱ端子から信号ＬＰＲＯＣＱ＜６：
０＞としてＱ端子から出力される。
＜５：０＞を受け、Ｋ端子に制御信号ＫＬ＜１：０＞を
受け、制御信号ＫＬ＜１：０＞の値に対応する定数を信
号ＬＱ＜５：０＞に乗算する演算を行い、その結果をＹ
端子に７ビットの信号Ｙ＜６：０＞として出力する。定
数ＣＡＬ１に関しては、乗算回路４４の場合と同じであ
るので、説明を省略する。Ｄフリップフロップ４７は乗
算回路４５の出力を次の信号Ｙ＜６：０＞が出力される
までラッチする回路である。Ｄフリップフロップ４７で
ラッチされた信号はＱ端子から信号ＬＰＲＯＣＱ＜６：
０＞としてＱ端子から出力される。
【００３３】切替回路４８は、制御信号ＴＨＲＳＥＬが
論理「Ｈ」のときは、Ａ端子に入力されるＦＰＲＯＣＱ
＜６：０＞を選択し、制御信号ＴＨＲＳＥＬが論理
「Ｌ」のときは、Ｂ端子に入力される切替回路４３から
の出力信号ＬＳＥＬＹ＜５：０＞を選択するように構成
される。（１／９）子画面用子ビデオ信号を供給する場
合は、この制御信号ＴＨＲＳＥＬは図５（ｎ）に示すよ
うに、常に論理「Ｌ」となるように設定されるので、そ
の場合は常にＢ端子側に入力される信号ＬＳＥＬＹ＜
５：０＞を選択する。
論理「Ｈ」のときは、Ａ端子に入力されるＦＰＲＯＣＱ
＜６：０＞を選択し、制御信号ＴＨＲＳＥＬが論理
「Ｌ」のときは、Ｂ端子に入力される切替回路４３から
の出力信号ＬＳＥＬＹ＜５：０＞を選択するように構成
される。（１／９）子画面用子ビデオ信号を供給する場
合は、この制御信号ＴＨＲＳＥＬは図５（ｎ）に示すよ
うに、常に論理「Ｌ」となるように設定されるので、そ
の場合は常にＢ端子側に入力される信号ＬＳＥＬＹ＜
５：０＞を選択する。
【００３４】一方、加算器４９はＤフリップフロップ４
６からの７ビットの出力信号ＦＰＲＯＣＱ＜６：０＞の
最上位ビットＭＳＢを除去した６ビット信号＜５：０＞
とＤフリップフロップ４７からの７ビットの出力信号Ｌ
ＰＲＯＣＱ＜６：０＞の最上位ビットＭＳＢを除去した
６ビット信号＜５：０＞とを加算しその加算結果をＹ端
子に７ビット信号ＫＦ９Ｓ＜６：０＞として出力する。
６からの７ビットの出力信号ＦＰＲＯＣＱ＜６：０＞の
最上位ビットＭＳＢを除去した６ビット信号＜５：０＞
とＤフリップフロップ４７からの７ビットの出力信号Ｌ
ＰＲＯＣＱ＜６：０＞の最上位ビットＭＳＢを除去した
６ビット信号＜５：０＞とを加算しその加算結果をＹ端
子に７ビット信号ＫＦ９Ｓ＜６：０＞として出力する。
【００３５】Ｄフリップフロップ５１は、図５（ｏ）に
示される信号ＴＨＲＥＮの立ち上がり時にその直前に存
在した切替回路４８の出力信号ＬＳＥＬＹ＜５：０＞を
Ｑ端子に信号ＴＨＲＱ＜５：０＞として出力する。
示される信号ＴＨＲＥＮの立ち上がり時にその直前に存
在した切替回路４８の出力信号ＬＳＥＬＹ＜５：０＞を
Ｑ端子に信号ＴＨＲＱ＜５：０＞として出力する。
【００３６】切替回路５２は、制御信号ＰＲＯＣＳＥＬ
が論理「Ｈ」のときは、Ａ端子に入力される信号ＫＦ９
Ｓ＜６：０＞から分岐された信号ＫＦ９Ｓ＜６：１＞を
選択し、制御信号ＰＲＯＣＳＥＬが論理「Ｌ」のとき
は、Ｂ端子に入力されるＤフリップフロップ５１からの
出力信号ＴＨＲＱ＜５：０＞を選択するように構成され
る。
が論理「Ｈ」のときは、Ａ端子に入力される信号ＫＦ９
Ｓ＜６：０＞から分岐された信号ＫＦ９Ｓ＜６：１＞を
選択し、制御信号ＰＲＯＣＳＥＬが論理「Ｌ」のとき
は、Ｂ端子に入力されるＤフリップフロップ５１からの
出力信号ＴＨＲＱ＜５：０＞を選択するように構成され
る。
【００３７】Ｄフリップフロップ５３は、切替回路５２
の出力信号が切り替わるまでその信号をラッチする回路
である。Ｄフリップフロップ５３でラッチされた信号は
Ｑ端子から出力端子７４に、図５（ｒ）に示される６ビ
ット出力信号ＺＹ＜５：０＞として、Ｙ０、Ｘ１、Ｘ
２、Ｘ３、Ｙ３、Ｘ４、Ｘ５、Ｘ６、Ｙ６・・・のように
送出され、出力端子７４から（１／９）子画面用子ビデ
オ信号として出力される。
の出力信号が切り替わるまでその信号をラッチする回路
である。Ｄフリップフロップ５３でラッチされた信号は
Ｑ端子から出力端子７４に、図５（ｒ）に示される６ビ
ット出力信号ＺＹ＜５：０＞として、Ｙ０、Ｘ１、Ｘ
２、Ｘ３、Ｙ３、Ｘ４、Ｘ５、Ｘ６、Ｙ６・・・のように
送出され、出力端子７４から（１／９）子画面用子ビデ
オ信号として出力される。
【００３８】［（１／１６）子画面用子ビデオ信号］
（１／１６）子画面用子ビデオ信号生成においては、図
６に示すように、制御信号ＦＥＮは論理「Ｌ」であり、
制御信号ＫＦ＜１：０＞は１０進数で２であり、制御信
号ＴＨＲＳＥＬは論理「Ｌ」であり、制御信号ＰＲＯＣ
ＳＥＬは論理「Ｌ」であるように選択される。以下に図
３をおよび図６を用いて（１／１６）子画面用子ビデオ
信号を生成する場合について説明する。
（１／１６）子画面用子ビデオ信号生成においては、図
６に示すように、制御信号ＦＥＮは論理「Ｌ」であり、
制御信号ＫＦ＜１：０＞は１０進数で２であり、制御信
号ＴＨＲＳＥＬは論理「Ｌ」であり、制御信号ＰＲＯＣ
ＳＥＬは論理「Ｌ」であるように選択される。以下に図
３をおよび図６を用いて（１／１６）子画面用子ビデオ
信号を生成する場合について説明する。
【００３９】図３において、７１は入力信号ＤＩＮ＜
５：０＞の入力端子である。（１／１６）子画面用子ビ
デオ信号を生成するときはメモリ２５の画像データをｆ
mainの周波数で読み出す。図６（ａ）に示す切替信号Ｒ
Ｅは、データ読出し期間は常時論理「Ｌ」であるので、
メモリ２５からｆmainの周波数でデータを読み出すこと
を指示する信号である。この切替信号ＲＥによって、図
２に示す切替回路７０はメモリ２５からｆmainの周波数
でデータを読み出してデータ伸長回路４０に出力する。
この出力された入力信号ＤＩＮ＜５：０＞は図６（ｂ）
に示される。
５：０＞の入力端子である。（１／１６）子画面用子ビ
デオ信号を生成するときはメモリ２５の画像データをｆ
mainの周波数で読み出す。図６（ａ）に示す切替信号Ｒ
Ｅは、データ読出し期間は常時論理「Ｌ」であるので、
メモリ２５からｆmainの周波数でデータを読み出すこと
を指示する信号である。この切替信号ＲＥによって、図
２に示す切替回路７０はメモリ２５からｆmainの周波数
でデータを読み出してデータ伸長回路４０に出力する。
この出力された入力信号ＤＩＮ＜５：０＞は図６（ｂ）
に示される。
【００４０】（１／１６）子画面用子ビデオ信号生成時
には、上述のように、制御信号ＰＲＯＣＳＥＬは、図６
（ｑ）に示すように、常時論理「Ｌ」であるので、切替
回路５２では信号ＴＨＲＱ＜５：０＞が一義的に選択さ
れる。一方、制御信号ＴＨＲＳＥＬは、図６（ｎ）に示
すように、常時論理「Ｈ」であるので、切替回路４８に
おいては、信号ＦＰＲＯＣＱ＜５：０＞が一義的に選択
される。従って、切替回路４３、乗算回路４５のＡ端子
に入力される信号ＬＱ＜５：０＞、加算器４９に入力さ
れる信号ＬＰＲＯＣＱ＜６：０＞、乗算回路４５のＢ端
子に入力される制御信号ＫＬ＜１：０＞、切替回路５２
に入力される信号ＫＦ９Ｓ＜６：１＞はどのような値で
もかまわない。また、切替回路４８は常にＡ端子の信号
が選択されるので、切替回路４８のＢ端子に入力する信
号ＬＳＥＬＹ＜５：０＞はどのような値でも良いので制
御信号ＬＳＥＬの不定でよい。次に、（１／１６）子画
面用子ビデオ信号が生成されるルートに沿って信号の流
れを説明する。
には、上述のように、制御信号ＰＲＯＣＳＥＬは、図６
（ｑ）に示すように、常時論理「Ｌ」であるので、切替
回路５２では信号ＴＨＲＱ＜５：０＞が一義的に選択さ
れる。一方、制御信号ＴＨＲＳＥＬは、図６（ｎ）に示
すように、常時論理「Ｈ」であるので、切替回路４８に
おいては、信号ＦＰＲＯＣＱ＜５：０＞が一義的に選択
される。従って、切替回路４３、乗算回路４５のＡ端子
に入力される信号ＬＱ＜５：０＞、加算器４９に入力さ
れる信号ＬＰＲＯＣＱ＜６：０＞、乗算回路４５のＢ端
子に入力される制御信号ＫＬ＜１：０＞、切替回路５２
に入力される信号ＫＦ９Ｓ＜６：１＞はどのような値で
もかまわない。また、切替回路４８は常にＡ端子の信号
が選択されるので、切替回路４８のＢ端子に入力する信
号ＬＳＥＬＹ＜５：０＞はどのような値でも良いので制
御信号ＬＳＥＬの不定でよい。次に、（１／１６）子画
面用子ビデオ信号が生成されるルートに沿って信号の流
れを説明する。
【００４１】Ｄフリップフロップ４１は、入力端子７１
に入力された入力信号ＤＩＮ＜５：０＞をＤ端子に受
け、Ｅ端子に入力される図６（ｃ）の制御信号ＦＥＮが
常時論理「Ｌ」であるので、入力信号ＤＩＮ＜５：０＞
を１クロック分遅らせた信号をＱ端子に図５（ｄ）に示
すように信号ＦＱ＜５：０＞として、Ｙ１，Ｙ２，Ｙ
３，Ｙ４，Ｙ５，Ｙ６，Ｙ７，Ｙ８，Ｙ９，Ｙ１０・・・
のように出力する。
に入力された入力信号ＤＩＮ＜５：０＞をＤ端子に受
け、Ｅ端子に入力される図６（ｃ）の制御信号ＦＥＮが
常時論理「Ｌ」であるので、入力信号ＤＩＮ＜５：０＞
を１クロック分遅らせた信号をＱ端子に図５（ｄ）に示
すように信号ＦＱ＜５：０＞として、Ｙ１，Ｙ２，Ｙ
３，Ｙ４，Ｙ５，Ｙ６，Ｙ７，Ｙ８，Ｙ９，Ｙ１０・・・
のように出力する。
【００４２】Ｄフリップフロップ４１からの出力信号Ｆ
Ｑ＜５：０＞は乗算回路４４のＡ端子に入力される。乗
算回路４４は、Ｋ端子に制御信号ＫＦ＜１：０＞を受
け、その制御信号ＫＦ＜１：０＞の値に対応した定数を
信号ＦＱ＜５：０＞に乗算する演算を行い、その結果を
Ｙ端子に７ビットの信号Ｙ＜６：０＞として出力する。
図６（ｅ）に示すように、制御信号ＫＦ＜１：０＞は常
に１０進数で２であるので、図３の右下の表に示される
ように、表のＫ＜１：０＞の値２に対する定数ＣＡＬ１
は１であるので、乗算回路４４の出力信号Ｙ＜６：０＞
は信号ＦＱ＜５：０＞と同じ値が得られる。Ｄフリップ
フロップ４６は乗算回路４４の出力を次の信号Ｙ＜６：
０＞が出力されるまでラッチする回路である。Ｄフリッ
プフロップ４６でラッチされた信号はＱ端子から信号Ｆ
ＰＲＯＣＱ＜６：０＞としてＱ端子から出力される。
Ｑ＜５：０＞は乗算回路４４のＡ端子に入力される。乗
算回路４４は、Ｋ端子に制御信号ＫＦ＜１：０＞を受
け、その制御信号ＫＦ＜１：０＞の値に対応した定数を
信号ＦＱ＜５：０＞に乗算する演算を行い、その結果を
Ｙ端子に７ビットの信号Ｙ＜６：０＞として出力する。
図６（ｅ）に示すように、制御信号ＫＦ＜１：０＞は常
に１０進数で２であるので、図３の右下の表に示される
ように、表のＫ＜１：０＞の値２に対する定数ＣＡＬ１
は１であるので、乗算回路４４の出力信号Ｙ＜６：０＞
は信号ＦＱ＜５：０＞と同じ値が得られる。Ｄフリップ
フロップ４６は乗算回路４４の出力を次の信号Ｙ＜６：
０＞が出力されるまでラッチする回路である。Ｄフリッ
プフロップ４６でラッチされた信号はＱ端子から信号Ｆ
ＰＲＯＣＱ＜６：０＞としてＱ端子から出力される。
【００４３】切替回路４８は、図６（ｎ）に示されるよ
うに、制御信号ＴＨＲＳＥＬが論理「Ｈ」であるので、
Ａ端子に入力されるＤフリップフロップ４６からのＦＰ
ＲＯＣＱ＜６：０＞を分岐した信号ＦＰＲＯＣＱ＜５：
０＞を選択する。
うに、制御信号ＴＨＲＳＥＬが論理「Ｈ」であるので、
Ａ端子に入力されるＤフリップフロップ４６からのＦＰ
ＲＯＣＱ＜６：０＞を分岐した信号ＦＰＲＯＣＱ＜５：
０＞を選択する。
【００４４】Ｄフリップフロップ５１は、図６（ｏ）に
示されるように、Ｅ端子に入力する信号ＴＨＲＥＮが常
時論理「Ｌ」であるので、Ｄ端子に入力する信号ＦＰＲ
ＯＣＱ＜５：０＞を１ビットシフトさせてＤフリップフ
ロップ５１のＱ出力端子からＴＨＲＱ＜５：０＞として
出力する。
示されるように、Ｅ端子に入力する信号ＴＨＲＥＮが常
時論理「Ｌ」であるので、Ｄ端子に入力する信号ＦＰＲ
ＯＣＱ＜５：０＞を１ビットシフトさせてＤフリップフ
ロップ５１のＱ出力端子からＴＨＲＱ＜５：０＞として
出力する。
【００４５】切替回路５２は、図６（ｑ）に示されるよ
うに、制御信号ＰＲＯＣＳＥＬが常時論理「Ｌ」である
ので、切替回路５２はＢ端子に入力される信号ＴＨＲＱ
＜５：０＞を選択し出力する。Ｄフリップフロップ５３
は、切替回路５２の出力信号が切り替わるまでラッチす
る回路である。Ｄフリップフロップ５３でラッチされた
信号はＱ端子から出力端子７４に６ビット出力信号ＺＹ
＜５：０＞として、図６（ｒ）に示されるように、Ｙ
０、Ｙ１、Ｙ２、Ｙ３、Ｙ４、Ｙ５、Ｙ６・・・のように
送出され、出力端子７４から（１／１６）子画面用子ビ
デオ信号として出力される。
うに、制御信号ＰＲＯＣＳＥＬが常時論理「Ｌ」である
ので、切替回路５２はＢ端子に入力される信号ＴＨＲＱ
＜５：０＞を選択し出力する。Ｄフリップフロップ５３
は、切替回路５２の出力信号が切り替わるまでラッチす
る回路である。Ｄフリップフロップ５３でラッチされた
信号はＱ端子から出力端子７４に６ビット出力信号ＺＹ
＜５：０＞として、図６（ｒ）に示されるように、Ｙ
０、Ｙ１、Ｙ２、Ｙ３、Ｙ４、Ｙ５、Ｙ６・・・のように
送出され、出力端子７４から（１／１６）子画面用子ビ
デオ信号として出力される。
【００４６】
【発明の効果】以上説明したように、本発明の画像処理
装置は、第２のビデオデータをディジタル化するアナロ
グ／デジタル変換器と；ディジタル化された画像データ
を第２のビデオデータのサブサンプル周波数（ｆsub）
でサンプルし圧縮するデータサンプル回路と；データサ
ンプル回路でサンプルされた圧縮データを（１／ｎ）ｆ
subで読み出して書き込むメモリと；メモリから第１の
ビデオデータのサブサンプル周波数（ｆmain）のｍ／ｎ
の周波数で読み出された画像データをｎ／ｍ倍に伸長し
て小画面用ビデオデータを生成するデータ伸長回路と；
データ伸長回路で伸長された画像データをアナログデー
タに変換するディジタル／アナログ変換器と；ディジタ
ル／アナログ変換器から出力される小画面用ビデオデー
タを全画面用の第１のビデオデータに挿入するために切
り替える第１の切替回路を備えるように構成されるの
で、画像処理装置のメモリ容量を小さくできる。
装置は、第２のビデオデータをディジタル化するアナロ
グ／デジタル変換器と；ディジタル化された画像データ
を第２のビデオデータのサブサンプル周波数（ｆsub）
でサンプルし圧縮するデータサンプル回路と；データサ
ンプル回路でサンプルされた圧縮データを（１／ｎ）ｆ
subで読み出して書き込むメモリと；メモリから第１の
ビデオデータのサブサンプル周波数（ｆmain）のｍ／ｎ
の周波数で読み出された画像データをｎ／ｍ倍に伸長し
て小画面用ビデオデータを生成するデータ伸長回路と；
データ伸長回路で伸長された画像データをアナログデー
タに変換するディジタル／アナログ変換器と；ディジタ
ル／アナログ変換器から出力される小画面用ビデオデー
タを全画面用の第１のビデオデータに挿入するために切
り替える第１の切替回路を備えるように構成されるの
で、画像処理装置のメモリ容量を小さくできる。
【００４７】また、本発明の画像処理装置は、さらに、
第２の切替回路を備え、１／ｍ小画面ビデオデータを生
成するときは、メモリから（ｍ／ｎ）ｆmainの周波数で
データを読み出し、データ伸長回路で伸張し、（１／
ｎ）小画面ビデオデータを生成するときは、メモリから
ｆmainの周波数でデータを読み出し、その読み出したデ
ータ伸張することなく出力することによって、（１／ｍ
2）子画面用子ビデオデータまたは（１／ｎ2）子画面用
子ビデオデータのいずれかの小画面用ビデオデータを生
成するように構成されるので、２つの子画面を切り替え
ることができると共に、画像処理装置のメモリ容量を小
さくできる。さらに、静止画像を用いた場合でも、（１
／９）子画面と（１／１６）子画面との切替が可能であ
る。
第２の切替回路を備え、１／ｍ小画面ビデオデータを生
成するときは、メモリから（ｍ／ｎ）ｆmainの周波数で
データを読み出し、データ伸長回路で伸張し、（１／
ｎ）小画面ビデオデータを生成するときは、メモリから
ｆmainの周波数でデータを読み出し、その読み出したデ
ータ伸張することなく出力することによって、（１／ｍ
2）子画面用子ビデオデータまたは（１／ｎ2）子画面用
子ビデオデータのいずれかの小画面用ビデオデータを生
成するように構成されるので、２つの子画面を切り替え
ることができると共に、画像処理装置のメモリ容量を小
さくできる。さらに、静止画像を用いた場合でも、（１
／９）子画面と（１／１６）子画面との切替が可能であ
る。
【００４８】さらに、本発明の画像処理装置において、
ｎは整数４、ｍは整数３であるように構成されるので、
（１／９）子画面と（１／１６）子画面とを小さなメモ
リ容量を用いて切り替えることができる。
ｎは整数４、ｍは整数３であるように構成されるので、
（１／９）子画面と（１／１６）子画面とを小さなメモ
リ容量を用いて切り替えることができる。
【００４９】また、本発明の画像処理装置において、デ
ータ伸長回路は、入力画像データ信号をＹｉ（ｉ＝０，
１，２，３，・・・の自然数）とすると、出力画像データ
信号は次の式で表わされるように構成されるので、伸張
が簡単な回路で実現でき、画像処理装置のメモリ容量を
小さくできる。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３＋３）） ここで、ｊ＝３ｉ＝０、３、６、９、１２、・・・であ
る。
ータ伸長回路は、入力画像データ信号をＹｉ（ｉ＝０，
１，２，３，・・・の自然数）とすると、出力画像データ
信号は次の式で表わされるように構成されるので、伸張
が簡単な回路で実現でき、画像処理装置のメモリ容量を
小さくできる。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３＋３）） ここで、ｊ＝３ｉ＝０、３、６、９、１２、・・・であ
る。
【００５０】さらに、本発明の画像処理装置において、
データ伸長回路は、入力画像データ信号を直接出力する
第１の経路と、入力画像データ信号に第１の定数を乗算
する第１の乗算回路、入力画像データ信号に第２の定数
を乗算する第２の乗算回路、これらの乗算結果を加算す
る加算器および加算器の出力結果を１／２にする回路に
よって構成される第２の経路と、第１の経路と第２の経
路とを切り替える切替回路とを有するように構成される
ので、伸張が簡単な回路で実現でき、画像処理装置のメ
モリ容量を小さくできる。
データ伸長回路は、入力画像データ信号を直接出力する
第１の経路と、入力画像データ信号に第１の定数を乗算
する第１の乗算回路、入力画像データ信号に第２の定数
を乗算する第２の乗算回路、これらの乗算結果を加算す
る加算器および加算器の出力結果を１／２にする回路に
よって構成される第２の経路と、第１の経路と第２の経
路とを切り替える切替回路とを有するように構成される
ので、伸張が簡単な回路で実現でき、画像処理装置のメ
モリ容量を小さくできる。
【００５１】さらに、本発明の画像処理装置において、
第１および第２の定数は、乗算回路の第２の入力端子に
入力する制御信号の値と以下のように対応するように構
成されるので、伸張が簡単な回路で実現でき、画像処理
装置のメモリ容量を小さくできる。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
第１および第２の定数は、乗算回路の第２の入力端子に
入力する制御信号の値と以下のように対応するように構
成されるので、伸張が簡単な回路で実現でき、画像処理
装置のメモリ容量を小さくできる。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
【００５２】さらに、本発明の画像処理装置において、
データ伸長回路は、入力画像信号を第１の入力端子に受
け、第１の制御信号を第２の入力端子に受け、その第１
の制御信号に従って入力画像信号を出力端子から出力す
る第１のＤフリップフロップと、入力画像信号を第１の
入力端子に受け、第２の制御信号を第２の入力端子に受
け、その第２の信号制御信号ＬＥＮ信号に従って入力画
像信号を出力端子から出力する第２のＤフリップフロッ
プと、第１のＤフリップフロップの出力と第２のＤフリ
ップフロップの出力を第３の制御信号によって切り替え
る第１の切替回路と、入力画像信号に第４の制御信号の
値に対応した定数を乗算する第１の乗算器と、入力画像
信号に第５の制御信号の値に対応した定数を乗算する第
２の乗算器と、第１の乗算器の出力をラッチする第３の
Ｄフリップフロップと、第２の乗算器の出力をラッチす
る第４のＤフリップフロップと、第１の切替器の出力と
第３のＤフリップフロップの出力とを第６の制御信号に
従って切り替える第２の切替器と、第３のＤフリップフ
ロップの出力と第４のＤフリップフロップの出力とを加
算する加算器と、第２の切替器の出力を第７の制御信号
に従ってラッチする第５のＤフリップフロップと、第５
のフリップフロップの出力と加算器の出力とを第７の制
御信号に従って切り替える第３の切替器と、第３の切替
器の出力をラッチする第６のＤフリップフロップとを有
し、第１から第７の制御信号に従って入力画像信号を３
／４倍に伸張するように構成されるので、伸張が簡単な
回路で実現でき、画像処理装置のメモリ容量を小さくで
きる。
データ伸長回路は、入力画像信号を第１の入力端子に受
け、第１の制御信号を第２の入力端子に受け、その第１
の制御信号に従って入力画像信号を出力端子から出力す
る第１のＤフリップフロップと、入力画像信号を第１の
入力端子に受け、第２の制御信号を第２の入力端子に受
け、その第２の信号制御信号ＬＥＮ信号に従って入力画
像信号を出力端子から出力する第２のＤフリップフロッ
プと、第１のＤフリップフロップの出力と第２のＤフリ
ップフロップの出力を第３の制御信号によって切り替え
る第１の切替回路と、入力画像信号に第４の制御信号の
値に対応した定数を乗算する第１の乗算器と、入力画像
信号に第５の制御信号の値に対応した定数を乗算する第
２の乗算器と、第１の乗算器の出力をラッチする第３の
Ｄフリップフロップと、第２の乗算器の出力をラッチす
る第４のＤフリップフロップと、第１の切替器の出力と
第３のＤフリップフロップの出力とを第６の制御信号に
従って切り替える第２の切替器と、第３のＤフリップフ
ロップの出力と第４のＤフリップフロップの出力とを加
算する加算器と、第２の切替器の出力を第７の制御信号
に従ってラッチする第５のＤフリップフロップと、第５
のフリップフロップの出力と加算器の出力とを第７の制
御信号に従って切り替える第３の切替器と、第３の切替
器の出力をラッチする第６のＤフリップフロップとを有
し、第１から第７の制御信号に従って入力画像信号を３
／４倍に伸張するように構成されるので、伸張が簡単な
回路で実現でき、画像処理装置のメモリ容量を小さくで
きる。
【００５３】さらに、本発明の画像処理装置において、
データ伸長回路中の第１の乗算器は第４の制御信号の値
に対応する定数を入力信号に乗算し、データ伸長回路中
の第２の乗算器は第５の制御信号の値に対応する定数を
入力信号に乗算し、その第１および第２の定数は、乗算
回路の制御端子に入力する制御信号の値と以下のように
対応するように構成されるので、伸張が簡単な回路で実
現でき、画像処理装置のメモリ容量を小さくできる。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
データ伸長回路中の第１の乗算器は第４の制御信号の値
に対応する定数を入力信号に乗算し、データ伸長回路中
の第２の乗算器は第５の制御信号の値に対応する定数を
入力信号に乗算し、その第１および第２の定数は、乗算
回路の制御端子に入力する制御信号の値と以下のように
対応するように構成されるので、伸張が簡単な回路で実
現でき、画像処理装置のメモリ容量を小さくできる。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２
【００５４】さらに、本発明の画像処理装置において、
データ伸長回路を（１／１６）子画面用子ビデオ信号生
成に使用する場合には、第１の制御信号は論理「Ｌ」、
第３の制御信号は１０進数の２、第６の制御信号は論理
「Ｈ」、第７の制御信号は論理「Ｌ」、第８の制御信号
は論理「Ｌ」に設定されるように構成されるので、伸張
が簡単な回路で実現でき、画像処理装置のメモリ容量を
小さくできる。
データ伸長回路を（１／１６）子画面用子ビデオ信号生
成に使用する場合には、第１の制御信号は論理「Ｌ」、
第３の制御信号は１０進数の２、第６の制御信号は論理
「Ｈ」、第７の制御信号は論理「Ｌ」、第８の制御信号
は論理「Ｌ」に設定されるように構成されるので、伸張
が簡単な回路で実現でき、画像処理装置のメモリ容量を
小さくできる。
【図１】 本発明の実施の形態１の画像処理装置示す図
である。
である。
【図２】 切替回路２６の詳細回路を示す図である。
【図３】 データ伸長回路４０の詳細回路を示す図であ
る。
る。
【図４】 （１／１６）子画面用子ビデオ信号から（１
／９）子画面用子ビデオ信号を生成するデータ伸長の論
理を説明する図である。
／９）子画面用子ビデオ信号を生成するデータ伸長の論
理を説明する図である。
【図５】 （１／９）子画面用子ビデオ信号を生成する
ときのデータ伸長回路４０のタイミングチャートを示す
図である。
ときのデータ伸長回路４０のタイミングチャートを示す
図である。
【図６】 （１／１６）子画面用子ビデオ信号を生成す
るときのデータ伸長回路４０のタイミングチャートを示
す図である。
るときのデータ伸長回路４０のタイミングチャートを示
す図である。
【図７】 モニタ画面（親画面）中に小さな小画面（子
画面）を表示させる従来の画像処理装置を示す図であ
る。
画面）を表示させる従来の画像処理装置を示す図であ
る。
【図８】 親画面に子画面を挿入する各信号のタイミン
グチャートを示す図である。
グチャートを示す図である。
【図９】 親画面中に子画面をはめ込んだ時のモニタ画
面を示す図である。
面を示す図である。
１１・・・親ビデオ信号入力端子、１２・・・子ビデオ信号入
力端子、１３・・・出力端子、１４・・・アナログ／デジタル
変換器、１５・・・Ｙ／Ｃ分離フィルタ、１６・・・カラー復
調回路、１７・・・Ｄ／Ａ変換器、１８・・・ＲＧＢマトリク
ス回路、２０・・・画面サイズ変換回路、２１・・・入力端
子、２２・・・出力端子、２３・・・データサンプル回路、２
５・・・メモリ、２６・・・切替回路、３０・・・スイッチ、３
１・・・高速スイッチ（ＦＳＷ）、３２・・・タイミング発生
器、４０・・・データ伸長回路、４１，４２・・・Ｄフリップ
フロップ、４３，４８，５２・・・切替回路、４４，４５・
・・乗算器、４６，４７・・・Ｄフリップフロップ、４９・・・
加算器、５１，５３・・・Ｄフリップフロップ、７０・・・切
替回路
力端子、１３・・・出力端子、１４・・・アナログ／デジタル
変換器、１５・・・Ｙ／Ｃ分離フィルタ、１６・・・カラー復
調回路、１７・・・Ｄ／Ａ変換器、１８・・・ＲＧＢマトリク
ス回路、２０・・・画面サイズ変換回路、２１・・・入力端
子、２２・・・出力端子、２３・・・データサンプル回路、２
５・・・メモリ、２６・・・切替回路、３０・・・スイッチ、３
１・・・高速スイッチ（ＦＳＷ）、３２・・・タイミング発生
器、４０・・・データ伸長回路、４１，４２・・・Ｄフリップ
フロップ、４３，４８，５２・・・切替回路、４４，４５・
・・乗算器、４６，４７・・・Ｄフリップフロップ、４９・・・
加算器、５１，５３・・・Ｄフリップフロップ、７０・・・切
替回路
Claims (9)
- 【請求項１】 全画面用の第１のビデオデータと小画面
用の第２のビデオデータとを切り替えて、モニタ画面の
一部に第２のビデオデータによる小画面を表示させる画
像処理装置において：第２のビデオデータをディジタル
化するアナログ／デジタル変換器と；前記ディジタル化
された画像データを第２のビデオデータのサブサンプル
周波数（ｆsub）でサンプルし圧縮するデータサンプル
回路と；前記データサンプル回路でサンプルされた圧縮
データを（１／ｎ）ｆsubで読み出して書き込むメモリ
と；前記メモリから第１のビデオデータのサブサンプル
周波数（ｆmain）のｍ／ｎの周波数で読み出された画像
データをｎ／ｍ倍に伸長して小画面用ビデオデータを生
成するデータ伸長回路と；前記データ伸長回路で伸長さ
れた画像データをアナログデータに変換するディジタル
／アナログ変換器と；前記ディジタル／アナログ変換器
から出力される小画面用ビデオデータを前記全画面用の
第１のビデオデータに挿入するために切り替える第１の
切替回路とを有することを特徴とする画像処理装置。 - 【請求項２】 請求項１記載の画像処理装置において：
さらに、第２の切替回路を備え、１／ｍ小画面ビデオデ
ータを生成するときは、前記メモリから（ｍ／ｎ）ｆma
inの周波数でデータを読み出し、前記データ伸長回路で
伸張し、１／ｎ小画面ビデオデータを生成するときは、
前記メモリからｆmainの周波数でデータを読み出し、そ
の読み出したデータ伸張することなく出力することによ
って、１／ｍ2子画面用子ビデオデータまたは１／ｎ2子
画面用子ビデオデータのいずれかの小画面用ビデオデー
タを生成することを特徴とする画像処理装置。 - 【請求項３】 請求項１または２記載の画像処理装置に
おいて：前記ｎは整数４、ｍは整数３であることを特徴
とする画像処理装置。 - 【請求項４】 請求項１ないし３のいずれかに記載の画
像処理装置において：前記データ伸長回路は、 入力画像データ信号をＹｉ（ｉ＝０，１，２，３，・・・
の自然数）とすると、 出力画像データ信号は次の式で表わされることを特徴と
する画像処理装置。 Ｙｊ＝Ｙｊ、 Ｘ（ｊ＋１）＝１／２（１／２Ｙｊ＋３／２Ｙ（ｊ＋
１））、 Ｘ（ｊ＋２）＝（Ｙ（ｊ＋１）＋Ｙ（ｊ＋２））、 Ｘ（ｊ＋３）＝１／２（３／２Ｙ（ｊ＋２）＋１／２Ｙ
（ｊ＋３）） ここで、ｊ＝３ｉ＝０、３、６、９、１２、・・・であ
る。 - 【請求項５】 請求項１ないし４のいずれかに記載の画
像処理装置において：前記データ伸長回路は、 入力画像データ信号を直接出力する第１の経路と、 入力画像データ信号に第１の定数を乗算する第１の乗算
回路、入力画像データ信号に第２の定数を乗算する第２
の乗算回路、これらの乗算結果を加算する加算器および
前記加算器の出力結果を１／２にする回路によって構成
される第２の経路と、 前記第１の経路と第２の経路とを切り替える切替回路と
を有することを特徴とする画像処理装置。 - 【請求項６】 請求項５記載の画像処理装置において：
前記第１および第２の定数は、乗算回路の第２の入力端
子に入力する制御信号の値と以下のように対応すること
を特徴とする画像処理装置。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２ - 【請求項７】 請求項１または２記載の画像処理装置に
おいて：前記データ伸長回路は：入力画像信号を第１の
入力端子に受け、第１の制御信号を第２の入力端子に受
け、その第１の制御信号に従って入力画像信号を出力端
子から出力する第１のＤフリップフロップと、 入力画像信号を第１の入力端子に受け、第２の制御信号
を第２の入力端子に受け、その第２の信号制御信号ＬＥ
Ｎ信号に従って入力画像信号を出力端子から出力する第
２のＤフリップフロップと、 前記第１のＤフリップフロップの出力と第２のＤフリッ
プフロップの出力を第３の制御信号によって切り替える
第１の切替回路と、 前記入力画像信号に第４の制御信号の値に対応した定数
を乗算する第１の乗算器と、 前記入力画像信号に第５の制御信号の値に対応した定数
を乗算する第２の乗算器と、 前記第１の乗算器の出力をラッチする第３のＤフリップ
フロップと、 前記第２の乗算器の出力をラッチする第４のＤフリップ
フロップと、 前記第１の切替器の出力と前記第３のＤフリップフロッ
プの出力とを第６の制御信号に従って切り替える第２の
切替器と、 前記第３のＤフリップフロップの出力と前記第４のＤフ
リップフロップの出力とを加算する加算器と、 前記第２の切替器の出力を第７の制御信号に従ってラッ
チする第５のＤフリップフロップと、 前記第５のフリップフロップの出力と前記加算器の出力
とを第７の制御信号に従って切り替える第３の切替器
と、 前記第３の切替器の出力をラッチする第６のＤフリップ
フロップとを有し、 前記第１から第７の制御信号に従って入力画像信号を４
／３倍に伸張することを特徴とする画像処理装置。 - 【請求項８】 請求項７記載の画像処理装置において：
前記データ伸長回路中の第１の乗算器は第４の制御信号
の値に対応する定数を入力信号に乗算し、 前記データ伸長回路中の第２の乗算器は第５の制御信号
の値に対応する定数を入力信号に乗算し、 その第１および第２の定数は、乗算回路の制御端子に入
力する制御信号の値と以下のように対応することを特徴
とする画像処理装置。 第１のおよび第２の制御信号 第１および第２の定数 ０ ０ １ １／２ ２ １ ３ ３／２ - 【請求項９】 請求項７または８記載の画像処理装置に
おいて：前記データ伸長回路を（１／１６）子画面用子
ビデオ信号生成に使用する場合には、前記第１の制御信
号は論理「Ｌ」、前記第３の制御信号は１０進数の２、
前記第６の制御信号は論理「Ｈ」、前記第７の制御信号
は論理「Ｌ」、前記第８の制御信号は論理「Ｌ」に設定
されることを特徴とする画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03489297A JP3726929B2 (ja) | 1997-02-19 | 1997-02-19 | 画像処理装置 |
| US08/888,352 US6052154A (en) | 1997-02-19 | 1997-07-03 | Image processing device with expander minimizing memory requirements for obtaining multiple sub window image data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03489297A JP3726929B2 (ja) | 1997-02-19 | 1997-02-19 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10233973A true JPH10233973A (ja) | 1998-09-02 |
| JP3726929B2 JP3726929B2 (ja) | 2005-12-14 |
Family
ID=12426823
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03489297A Expired - Fee Related JP3726929B2 (ja) | 1997-02-19 | 1997-02-19 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6052154A (ja) |
| JP (1) | JP3726929B2 (ja) |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63123284A (ja) * | 1986-11-12 | 1988-05-27 | Sharp Corp | テレビジヨン受像機 |
| JPH0530440A (ja) * | 1991-07-24 | 1993-02-05 | Sharp Corp | 二画面表示テレビジヨン受像機 |
| US5398074A (en) * | 1992-11-24 | 1995-03-14 | Thomson Consumer Electronics, Inc. | Programmable picture-outside-picture display |
| JPH08256297A (ja) * | 1995-03-17 | 1996-10-01 | Toshiba Corp | ２画面テレビ受像機 |
| US5729300A (en) * | 1995-06-07 | 1998-03-17 | Samsung Electronics Co., Ltd. | Double-screen simultaneous viewing circuit of a wide-television |
| JPH0965225A (ja) * | 1995-08-24 | 1997-03-07 | Hitachi Ltd | テレビジョン装置及びその表示方法 |
| US5917958A (en) * | 1996-10-31 | 1999-06-29 | Sensormatic Electronics Corporation | Distributed video data base with remote searching for image data features |
-
1997
- 1997-02-19 JP JP03489297A patent/JP3726929B2/ja not_active Expired - Fee Related
- 1997-07-03 US US08/888,352 patent/US6052154A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JP3726929B2 (ja) | 2005-12-14 |
| US6052154A (en) | 2000-04-18 |
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