JPH0883864A - 電力用半導体装置 - Google Patents

電力用半導体装置

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JPH0883864A
JPH0883864A JP21776294A JP21776294A JPH0883864A JP H0883864 A JPH0883864 A JP H0883864A JP 21776294 A JP21776294 A JP 21776294A JP 21776294 A JP21776294 A JP 21776294A JP H0883864 A JPH0883864 A JP H0883864A
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JP
Japan
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copper foil
heat dissipation
plate
board
substrate
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Pending
Application number
JP21776294A
Other languages
English (en)
Inventor
Kazushiro Oishi
和城 大石
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Meidensha Corp
Meidensha Electric Manufacturing Co Ltd
Original Assignee
Meidensha Corp
Meidensha Electric Manufacturing Co Ltd
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Publication date
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Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0201Thermal arrangements, e.g. for cooling, heating or preventing overheating
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/0306Inorganic insulating substrates, e.g. ceramic, glass

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  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Abstract

(57)【要約】 【目的】 半導体モジュールの熱歪み・応力を低減す
る。 【構成】 セラミック板2の上面に配線用銅箔板3が貼
着され、下面に放熱用銅箔板4が貼着されたサンドイッ
チ構造のDBC基板1を用い、この基板1の上面に半導
体チップ6を設け、下面に放熱用銅板5を接合した半導
体モジュールにおいて、基板の配線用銅箔板3の厚みを
放熱用銅箔板4の厚みより大きくする。これにより放熱
用銅板5との力学的な不均衡を是正され、半導体モジュ
ールの熱歪み・応力が低減する。そのため長寿命の電力
用半導体装置が得られる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体モジュールの熱
歪み・応力を低減しうるようにした電力用半導体装置に
関する。
【0002】
【従来の技術】一般に電力用半導体モジュールは図3に
示すように、放熱用銅板5を取り付けたセラミック基板
1の上に銅配線を施し、半導体チップ6を半田付けし、
チップ6上の電極と上記銅配線とをアルミワイヤで電気
的に接続する。更に、各端子10やPBT,PPS(エ
ジニヤリングプラスチック)で作られた枠8や端子台9
を取り付けた後、内部の空間部に応力緩和のためシリコ
ンゲル11で満たし、エポキシ樹脂12で気密に封止し
て構成されている。
【0003】一般にセラミック基板1としては図4に示
すように、予めセラミック板2の上面に配線用銅箔板3
が、下面に放熱用銅箔板4が張り付けられたサンドイッ
チ構造のBDC(Direct Bonded Cop
por)基板1が用いられている。
【0004】
【発明が解決しようとする課題】現在用いられている一
般的なBDC基板1に接合されている銅箔板3,4とし
ては、同じ厚み(t1=t2=0.3mm)のものが用
いられている。
【0005】図5に、セラミック板2が厚さ0.635
mm,長さ75mm,幅53mm、銅箔板3,4が厚み
0.3mmのBDC基板を用い、その裏面に長さ106
mm,幅60mm,厚さtの放熱用銅板5を接合し、温
度差100℃として放熱用銅板の厚みtを変えた時のた
わみ量を示す。放熱用銅板5は3.5mmの厚さの場合
100℃の温度差で基板2と共に0.2mm程たわむ。
(ただし、銅自身の降伏現象は考慮していない。)放熱
用銅板の厚さを厚くする程放熱板の曲げ方向強度が強く
なり、たわみ量は減少するが、図6に示すように、放熱
用銅板5とDBC基板1との間に発生するせん断応力が
高くなり接合面の剥離が生じる危険性がある。従って上
記従来のサイズのDBC基板では放熱用銅板5の厚みt
は3.5mmが適当とされる。
【0006】上記従来のDBC基板を用いて作成した半
導体モジュールはその構成材料の熱膨張係数等の違いか
ら、実用時に発声する熱でかなりの大きさの熱歪み・応
力が生じ、断続動作等のヒートショックの繰り返しでモ
ジュールが壊れてしまう。
【0007】本発明は、従来のこのような問題点に鑑み
てなされたものであり、その目的とするところは、半導
体モジュールの熱歪み・応力を低減しうる電力用半導体
装置を提供することにある。
【0008】
【課題を解決するための手段】上記目的を達成するため
に、本発明における電力用半導体装置は、セラミック板
の上面に配線用銅箔板が貼着され、下面に放熱用銅箔板
が貼着されたサンドイッチ構造のDBC基板を用い、こ
の基板の上面に半導体チップを設け、下面に放熱用銅板
を接合した半導体モジュールにおいて、前記基板の配線
用銅箔板の厚みを放熱用銅箔板の厚みより大きくしたこ
とを特徴とする。
【0009】
【作用】基板の放熱用銅板が接合される面と反対側面の
銅箔板の厚みを放熱用銅板が接合される面の銅箔板より
大きくしたので、放熱用銅板との力学的な不均衡が是正
され、基板の熱応力及び歪みが減少する。従って半導体
モジュールの熱歪み・応力が低減する。
【0010】
【実施例】図1は電力用半導体モジュールのDBC基板
部分の側面を示すもので、1はDBC基板で、寸法0.
635mm×30mm(厚さt×長さL)のセラミック
板2の表面に寸法0.6mm(t1)×20mmの銅箔
3を接合し、裏面に寸法0.3mm(t2)×20mm
の銅箔4を接合して構成されている。5はDBC基板2
の銅箔4の下面に固着された寸法3.5mm×30mm
の放熱板、6は銅箔3の上面に固着された寸法1mm×
10mmのSiチップである。
【0011】上記実施例に対して比較例として実施例の
DC基板の銅箔3の厚みt1のみを銅箔4の厚み(t
2)と同じく0.3mmとしたDBC基板を用い、これ
に実施例と同様に放熱板5及びSiチップ6を固着した
ものを作り、実施例及び比較例のものに、温度差dT=
100℃を与え、このとき発生するDBC基板のセラミ
ック板の端部aのひずみと、銅箔板3の端部bにおける
Cu−セラミック接合部bの垂直応力と、銅箔4の端部
cにおけるDBC−Cu接合部cの垂直応力と、Siチ
ップ6の端部dにおけるSi−DBC接合部dの垂直応
力をシミュレーションした結果、表1に示すデータが得
られた。
【0012】
【表1】
【0013】このデータから明らかなように、DBC基
板1の銅箔3,4の厚みt1,t2をt1=2×t2と
することにより比較例のt1=t2のものより銅箔4の
端部におけるDBC−Cu接合部cの垂直応力が約70
N/mm2から約40N/mm2と約43%減少した。
【0014】即ち、DBC基板の銅箔板の厚みを従来の
t1=t2からt1>t2とすることで、銅の放熱板と
の力学的な不均衡を是正することができた。
【0015】なお、DBC基板の配線用銅箔3を厚くす
るには、図2(A)に示すように高温下で銅を半溶解
し、物理的に接合させる方法(接合界面に接合材を使っ
たものを含む)、又は図2(B)に示すように従来のD
BC基板上に新たな銅箔板を常温又は高温下で張り合わ
せる方法(加工圧接,半田結合、他金属接合など。特に
接合面にモリブデン,タングステン等,低熱膨張材を用
いるクラッド化も含む)を用いればよい。
【0016】
【発明の効果】本発明は、上述のとおりDBC基板の銅
配線側銅箔板の厚みを放熱板接合面側銅箔板の厚みより
大きくしたので、半導体モジュールにかかる熱応力・歪
みが低減され、長寿命の電力用半導体装置が得られる。
【図面の簡単な説明】
【図1】本発明の実施例に係る半導体モジュールのDB
C基板部分を示す側面図。
【図2】実施例のDBC基板の配線を厚くする方法の説
明図。
【図3】電力用半導体モジュール構造の構成説明図。
【図4】従来DBC構造の説明図。
【図5】DBC基板に固着された放熱用銅板の板厚とD
BC基板のたわみ量の関係を示すグラフ。
【図6】DBC基板に固着された放熱用銅板の板厚とD
BC基板との間に生ずるせん断応力を示すグラフ。
【符号の説明】
1…セラミック基板(DBC基板) 2…セラミック板 3…配線用銅箔板(銅配線) 3′…銅配線 4…放熱用銅箔板 5…放熱用銅板 6…半導体(Si)チップ 7…リード 8…枠 9…端子台 11…Siゲル 12…エポキシ樹脂

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 セラミック板の上面に配線用銅箔板が貼
    着され、下面に放熱用銅箔板が貼着されたサンドイッチ
    構造のDBC基板を用い、この基板の上面に半導体チッ
    プを設け、下面に放熱用銅板を接合した半導体モジュー
    ルにおいて、 前記基板の配線用銅箔板の厚みを放熱用銅箔板の厚みよ
    り大きくし、半導体モジュールの熱歪み・応力を低減す
    ることを特徴とした電力用半導体装置。
JP21776294A 1994-09-13 1994-09-13 電力用半導体装置 Pending JPH0883864A (ja)

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