JPH08191459A - ビデオ信号処理回路 - Google Patents
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- JPH08191459A JPH08191459A JP7017409A JP1740995A JPH08191459A JP H08191459 A JPH08191459 A JP H08191459A JP 7017409 A JP7017409 A JP 7017409A JP 1740995 A JP1740995 A JP 1740995A JP H08191459 A JPH08191459 A JP H08191459A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/77—Circuits for processing the brightness signal and the chrominance signal relative to each other, e.g. adjusting the phase of the brightness signal relative to the colour signal, correcting differential gain or differential phase
- H04N9/78—Circuits for processing the brightness signal and the chrominance signal relative to each other, e.g. adjusting the phase of the brightness signal relative to the colour signal, correcting differential gain or differential phase for separating the brightness signal or the chrominance signal from the colour television signal, e.g. using comb filter
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- H04N9/00—Details of colour television systems
- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/87—Regeneration of colour television signals
- H04N9/88—Signal drop-out compensation
- H04N9/882—Signal drop-out compensation the signal being a composite colour television signal
- H04N9/885—Signal drop-out compensation the signal being a composite colour television signal using a digital intermediate memory
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/765—Interface circuits between an apparatus for recording and another apparatus
- H04N5/77—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera
- H04N5/772—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera the recording apparatus and the television camera being placed in the same enclosure
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- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】
【目的】 ディジタル回路でＹくし形フィルタ及びＣく
し形フィルタを構成した場合に回路規模の削減を図れる
ようにする。 【構成】 ＶＴＲ再生時には、帯域制限された輝度信号
とクロマ信号とを加算した信号がＹくし形フィルタ及び
Ｃくし形フィルタに入力されるので、１つのＡ／Ｄコン
バータだけで処理が行なえる。更に、カメラ信号処理用
に既に設けられているＡ／Ｄコンバータや２Ｈ分のライ
ン遅延回路と、Ｙくし形フィルタ及びＣくし形フィルタ
を構成するためのＡ／Ｄコンバータやライン遅延回路と
が兼用されているため、殆ど回路を追加する必要がな
い。
し形フィルタを構成した場合に回路規模の削減を図れる
ようにする。 【構成】 ＶＴＲ再生時には、帯域制限された輝度信号
とクロマ信号とを加算した信号がＹくし形フィルタ及び
Ｃくし形フィルタに入力されるので、１つのＡ／Ｄコン
バータだけで処理が行なえる。更に、カメラ信号処理用
に既に設けられているＡ／Ｄコンバータや２Ｈ分のライ
ン遅延回路と、Ｙくし形フィルタ及びＣくし形フィルタ
を構成するためのＡ／Ｄコンバータやライン遅延回路と
が兼用されているため、殆ど回路を追加する必要がな
い。
Description
【０００１】
【産業上の利用分野】この発明は、カムコーダの再生系
のクロストーク除去用のＹくし形フィルタ及びＣくし形
フィルタに用いて好適なビデオ信号処理回路に関する。
のクロストーク除去用のＹくし形フィルタ及びＣくし形
フィルタに用いて好適なビデオ信号処理回路に関する。
【０００２】
【従来の技術】従来のＶＴＲの再生系には、クロストー
ク除去用のＹくし形フィルタ及びＣくし形フィルタが設
けられている。このＹくし形フィルタ及びＣくし形フィ
ルタは、従来、アナログ回路で構成されている。このＹ
くし形フィルタ及びＣくし形フィルタをディジタル回路
で構成することが検討されている。
ク除去用のＹくし形フィルタ及びＣくし形フィルタが設
けられている。このＹくし形フィルタ及びＣくし形フィ
ルタは、従来、アナログ回路で構成されている。このＹ
くし形フィルタ及びＣくし形フィルタをディジタル回路
で構成することが検討されている。
【０００３】
【発明が解決しようとする課題】ところが、従来のアナ
ログのＹくし形フィルタ及びＣくし形フィルタをディジ
タル回路で置き換えた場合、輝度信号用とクロマ信号用
とで、２つのＡ／Ｄコンバータが必要になる。また、Ｙ
くし形フィルタ用の１ライン遅延回路と、Ｃくし形フィ
ルタ用の１ライン遅延回路とを、夫々別々に設けなけれ
ばならない。このため、回路規模が増大するという問題
がある。
ログのＹくし形フィルタ及びＣくし形フィルタをディジ
タル回路で置き換えた場合、輝度信号用とクロマ信号用
とで、２つのＡ／Ｄコンバータが必要になる。また、Ｙ
くし形フィルタ用の１ライン遅延回路と、Ｃくし形フィ
ルタ用の１ライン遅延回路とを、夫々別々に設けなけれ
ばならない。このため、回路規模が増大するという問題
がある。
【０００４】特に、ディジタルで信号処理を行う小型の
カムコーダが知られている。このようなカムコーダで
は、回路規模を如何に小型化するか、コストを如何に削
減するかが重要な問題である。ディジタルでカメラ信号
処理を行うカムコーダには、撮像信号をディジタル化す
るＡ／Ｄコンバータが設けられている。このようなディ
ジタルで信号処理を行う小型のカムコーダに、ディジタ
ルのＹくし形フィルタ及びＣくし形フィルタを設ける
と、更に、Ａ／Ｄコンバータとくし形フィルタ用の１ラ
イン遅延回路が追加されることになり、回路規模が増大
すると共に、コストアップになる。
カムコーダが知られている。このようなカムコーダで
は、回路規模を如何に小型化するか、コストを如何に削
減するかが重要な問題である。ディジタルでカメラ信号
処理を行うカムコーダには、撮像信号をディジタル化す
るＡ／Ｄコンバータが設けられている。このようなディ
ジタルで信号処理を行う小型のカムコーダに、ディジタ
ルのＹくし形フィルタ及びＣくし形フィルタを設ける
と、更に、Ａ／Ｄコンバータとくし形フィルタ用の１ラ
イン遅延回路が追加されることになり、回路規模が増大
すると共に、コストアップになる。
【０００５】したがって、この発明の目的は、ディジタ
ル回路でＹくし形フィルタ及びＣくし形フィルタを構成
した場合に回路規模の削減を図れるようにしたビデオ信
号処理回路を提供することにある。
ル回路でＹくし形フィルタ及びＣくし形フィルタを構成
した場合に回路規模の削減を図れるようにしたビデオ信
号処理回路を提供することにある。
【０００６】
【課題を解決するための手段】この発明は、輝度信号の
成分とクロマ信号の成分とが加算されたビデオ信号又は
撮像素子で撮像された撮像信号を選択的に入力するため
の入力選択回路と、入力選択回路で選択された、輝度信
号の成分とクロマ信号の成分とが加算されたビデオ信号
又は撮像素子で撮像された撮像信号をディジタル化する
Ａ／Ｄコンバータと、Ａ／Ｄコンバータから出力される
信号を遅延する縦続接続された複数のライン遅延回路
と、縦続接続された複数のライン遅延回路の段間の出力
が供給される輝度信号くし形フィルタ及びクロマ信号く
し形フィルタ並びにカメラ信号処理回路と、輝度信号く
し形フィルタ及びクロマ信号くし形フィルタの出力と、
カメラ信号処理回路の出力とを選択的に出力する出力選
択回路とからなるビデオ信号処理回路である。
成分とクロマ信号の成分とが加算されたビデオ信号又は
撮像素子で撮像された撮像信号を選択的に入力するため
の入力選択回路と、入力選択回路で選択された、輝度信
号の成分とクロマ信号の成分とが加算されたビデオ信号
又は撮像素子で撮像された撮像信号をディジタル化する
Ａ／Ｄコンバータと、Ａ／Ｄコンバータから出力される
信号を遅延する縦続接続された複数のライン遅延回路
と、縦続接続された複数のライン遅延回路の段間の出力
が供給される輝度信号くし形フィルタ及びクロマ信号く
し形フィルタ並びにカメラ信号処理回路と、輝度信号く
し形フィルタ及びクロマ信号くし形フィルタの出力と、
カメラ信号処理回路の出力とを選択的に出力する出力選
択回路とからなるビデオ信号処理回路である。
【０００７】
【作用】ＶＴＲ再生時には、帯域制限された輝度信号と
クロマ信号とを加算した信号がＹくし形フィルタ及びＣ
くし形フィルタに入力されるので、１つのＡ／Ｄコンバ
ータだけで処理が行なえる。更に、カメラ信号処理用に
既に設けられているＡ／Ｄコンバータや２Ｈ分のライン
遅延回路と、Ｙくし形フィルタ及びＣくし形フィルタを
構成するためのＡ／Ｄコンバータやライン遅延回路とが
兼用されている。このため、殆ど回路を追加する必要が
ない。
クロマ信号とを加算した信号がＹくし形フィルタ及びＣ
くし形フィルタに入力されるので、１つのＡ／Ｄコンバ
ータだけで処理が行なえる。更に、カメラ信号処理用に
既に設けられているＡ／Ｄコンバータや２Ｈ分のライン
遅延回路と、Ｙくし形フィルタ及びＣくし形フィルタを
構成するためのＡ／Ｄコンバータやライン遅延回路とが
兼用されている。このため、殆ど回路を追加する必要が
ない。
【０００８】
【実施例】以下、この発明の一実施例について図面を参
照して説明する。図１は、この発明の一実施例を示し、
この実施例は、８ミリ規格のカムコーダに適用されたも
のである。図１において、１は再生ＶＴＲ信号の入力端
子、１１はカメラ信号の入力端子である。
照して説明する。図１は、この発明の一実施例を示し、
この実施例は、８ミリ規格のカムコーダに適用されたも
のである。図１において、１は再生ＶＴＲ信号の入力端
子、１１はカメラ信号の入力端子である。
【０００９】入力端子１には、ＶＴＲ再生時に、輝度信
号と、クロストーク成分を含むクロマ信号とが加算され
た再生ビデオ信号が供給される。すなわち、図２に示す
ように、輝度信号Ｙとクロマ信号Ｃとが帯域制限され、
輝度信号Ｙの成分とクロマ信号Ｃの成分とが周波数上で
分離可能な状態で加算され、この信号が入力端子１に供
給される。入力端子１１には、ＣＣＤ撮像素子の撮像信
号が供給される。
号と、クロストーク成分を含むクロマ信号とが加算され
た再生ビデオ信号が供給される。すなわち、図２に示す
ように、輝度信号Ｙとクロマ信号Ｃとが帯域制限され、
輝度信号Ｙの成分とクロマ信号Ｃの成分とが周波数上で
分離可能な状態で加算され、この信号が入力端子１に供
給される。入力端子１１には、ＣＣＤ撮像素子の撮像信
号が供給される。
【００１０】２１〜２５は、カメラ信号入力時とＶＴＲ
再生時とで切りえられるスイッチ回路である。スイッチ
回路２１は、カメラ信号入力時には端子２１Ａ側に設定
され、ＶＴＲ再生時には端子２１Ｂ側に設定される。ス
イッチ回路２２は、カメラ信号入力時には端子２２Ａ側
に設定され、ＶＴＲ再生時には端子２２Ｂ側に設定され
る。スイッチ回路２３は、カメラ信号入力時には端子２
３Ａ側に設定され、そして、通常のＶＴＲ再生時には端
子２３Ａ側に設定され、輝度信号の帯域が３ＭＨｚ以下
に制限されている８ミリ規格のモード（以下、ノーマル
モードと称する）でドロップアウト発生時には、端子２
３Ｂ側に設定される。スイッチ回路２４は、カメラ信号
入力時には端子２４Ａ側に設定され、通常のＶＴＲ再生
時には端子２４Ｂ側に設定され、輝度信号の帯域が５Ｍ
Ｈｚ以上のモード（以下Ｈｉ８モードと称する）でドロ
ップアウト発生時には端子４３Ｃ側に設定される。スイ
ッチ回路２５は、カメラ信号入力時には端子２５Ａ側に
設定され、ＶＴＲ再生時には端子２５Ｂ側に設定され
る。
再生時とで切りえられるスイッチ回路である。スイッチ
回路２１は、カメラ信号入力時には端子２１Ａ側に設定
され、ＶＴＲ再生時には端子２１Ｂ側に設定される。ス
イッチ回路２２は、カメラ信号入力時には端子２２Ａ側
に設定され、ＶＴＲ再生時には端子２２Ｂ側に設定され
る。スイッチ回路２３は、カメラ信号入力時には端子２
３Ａ側に設定され、そして、通常のＶＴＲ再生時には端
子２３Ａ側に設定され、輝度信号の帯域が３ＭＨｚ以下
に制限されている８ミリ規格のモード（以下、ノーマル
モードと称する）でドロップアウト発生時には、端子２
３Ｂ側に設定される。スイッチ回路２４は、カメラ信号
入力時には端子２４Ａ側に設定され、通常のＶＴＲ再生
時には端子２４Ｂ側に設定され、輝度信号の帯域が５Ｍ
Ｈｚ以上のモード（以下Ｈｉ８モードと称する）でドロ
ップアウト発生時には端子４３Ｃ側に設定される。スイ
ッチ回路２５は、カメラ信号入力時には端子２５Ａ側に
設定され、ＶＴＲ再生時には端子２５Ｂ側に設定され
る。
【００１１】なお、カメラ信号入力時には、ＶＴＲ再生
部の動作は不要なるで、ＶＴＲ再生に係わる部分には、
クロックの供給や信号の供給は停止される。また、ＶＴ
Ｒ再生時には、カメラ信号処理部の動作は不要なるで、
カメラ信号処理に係わる部分には、クロックの供給や信
号の供給は停止される。これにより、不必要な電力の増
加を防ぐようにしている。
部の動作は不要なるで、ＶＴＲ再生に係わる部分には、
クロックの供給や信号の供給は停止される。また、ＶＴ
Ｒ再生時には、カメラ信号処理部の動作は不要なるで、
カメラ信号処理に係わる部分には、クロックの供給や信
号の供給は停止される。これにより、不必要な電力の増
加を防ぐようにしている。
【００１２】先ず、カメラ信号入力時から説明する。カ
メラ信号入力時には、入力端子１１に、ＣＣＤ撮像素子
から撮像信号が供給される。入力端子１１からの撮像信
号がＡＧＣ回路１２、サンプルホールド回路１３を介し
てスイッチ回路２１の端子２１Ａに供給される。カメラ
信号入力時には、スイッチ回路２１は端子２１Ａ側に設
定されている。このため、サンプルホールド回路１３の
出力は、スイッチ回路２１を介して、Ａ／Ｄコンバータ
１４に供給される。Ａ／Ｄコンバータ１４で、撮像信号
がディジタル化される。
メラ信号入力時には、入力端子１１に、ＣＣＤ撮像素子
から撮像信号が供給される。入力端子１１からの撮像信
号がＡＧＣ回路１２、サンプルホールド回路１３を介し
てスイッチ回路２１の端子２１Ａに供給される。カメラ
信号入力時には、スイッチ回路２１は端子２１Ａ側に設
定されている。このため、サンプルホールド回路１３の
出力は、スイッチ回路２１を介して、Ａ／Ｄコンバータ
１４に供給される。Ａ／Ｄコンバータ１４で、撮像信号
がディジタル化される。
【００１３】Ａ／Ｄコンバータ１４の出力がカメラ信号
処理回路１５に供給されると共に、スイッチ回路２２の
端子２２Ｂに供給される。カメラ信号処理回路１５の出
力がスイッチ回路２２の端子２２Ａに供給される。カメ
ラ信号入力時には、スイッチ回路２２は端子２２Ａ側に
設定されており、スイッチ回路２３は端子２３Ａ側に設
定されている。このため、Ａ／Ｄコンバータ１４の出力
は、カメラ信号処理回路１５で前処理がなされた後、ス
イッチ回路２２、スイッチ回路２３を介して、１ライン
遅延回路１６と１ライン遅延回路１７との縦続接続に供
給される。スイッチ回路２３の出力と、１ライン遅延回
路１６と１ライン遅延回路１７との段間の出力と、１ラ
イン遅延回路１７の出力とから連続する３ラインの出力
信号が得られる。これらの信号がカメラ信号処理回路１
５に供給される。
処理回路１５に供給されると共に、スイッチ回路２２の
端子２２Ｂに供給される。カメラ信号処理回路１５の出
力がスイッチ回路２２の端子２２Ａに供給される。カメ
ラ信号入力時には、スイッチ回路２２は端子２２Ａ側に
設定されており、スイッチ回路２３は端子２３Ａ側に設
定されている。このため、Ａ／Ｄコンバータ１４の出力
は、カメラ信号処理回路１５で前処理がなされた後、ス
イッチ回路２２、スイッチ回路２３を介して、１ライン
遅延回路１６と１ライン遅延回路１７との縦続接続に供
給される。スイッチ回路２３の出力と、１ライン遅延回
路１６と１ライン遅延回路１７との段間の出力と、１ラ
イン遅延回路１７の出力とから連続する３ラインの出力
信号が得られる。これらの信号がカメラ信号処理回路１
５に供給される。
【００１４】カメラ信号処理回路１５は、このようにし
て得られた連続する３ラインの撮像信号から、輝度信号
Ｙとクロマ信号Ｃとを形成する。そして、輝度信号Ｙ及
びクロマ信号Ｃに対して、ガンマ補正やアパーチャ補正
等のカメラ信号処理が行われる。輝度信号Ｙは、スイッ
チ回路２４の端子２４Ａに供給される。クロマ信号Ｃ
は、スイッチ回路２５の端子２５Ａに供給される。
て得られた連続する３ラインの撮像信号から、輝度信号
Ｙとクロマ信号Ｃとを形成する。そして、輝度信号Ｙ及
びクロマ信号Ｃに対して、ガンマ補正やアパーチャ補正
等のカメラ信号処理が行われる。輝度信号Ｙは、スイッ
チ回路２４の端子２４Ａに供給される。クロマ信号Ｃ
は、スイッチ回路２５の端子２５Ａに供給される。
【００１５】カメラ信号入力時には、スイッチ回路２４
は端子２４Ａ側に設定されている。このため、カメラ信
号処理回路１５からの輝度信号は、スイッチ回路２４を
介して、可変遅延回路１８に供給される。なお、可変遅
延回路１８は、カメラ信号処理回路１５内に設けられて
いる。この可変遅延回路１８の出力がＤ／Ａコンバータ
１９に供給される。Ｄ／Ａコンバータ１９で、ディジタ
ル輝度信号がアナログ信号に変換される。Ｄ／Ａコンバ
ータ１９の出力が出力端子２０から出力される。
は端子２４Ａ側に設定されている。このため、カメラ信
号処理回路１５からの輝度信号は、スイッチ回路２４を
介して、可変遅延回路１８に供給される。なお、可変遅
延回路１８は、カメラ信号処理回路１５内に設けられて
いる。この可変遅延回路１８の出力がＤ／Ａコンバータ
１９に供給される。Ｄ／Ａコンバータ１９で、ディジタ
ル輝度信号がアナログ信号に変換される。Ｄ／Ａコンバ
ータ１９の出力が出力端子２０から出力される。
【００１６】また、カメラ信号入力時には、スイッチ回
路２５は端子２５Ａ側に設定されている。このため、カ
メラ信号処理回路１５からのクロマ信号は、スイッチ回
路２５を介して、可変遅延回路２１に供給される。な
お、可変遅延回路２１は、カメラ信号処理回路１５内に
設けられている。この可変遅延回路２１の出力がＤ／Ａ
コンバータ２２に供給される。Ｄ／Ａコンバータ２２
で、ディジタルクロマ信号がアナログ信号に変換され
る。Ｄ／Ａコンバータ４１の出力が出力端子４２から出
力される。
路２５は端子２５Ａ側に設定されている。このため、カ
メラ信号処理回路１５からのクロマ信号は、スイッチ回
路２５を介して、可変遅延回路２１に供給される。な
お、可変遅延回路２１は、カメラ信号処理回路１５内に
設けられている。この可変遅延回路２１の出力がＤ／Ａ
コンバータ２２に供給される。Ｄ／Ａコンバータ２２
で、ディジタルクロマ信号がアナログ信号に変換され
る。Ｄ／Ａコンバータ４１の出力が出力端子４２から出
力される。
【００１７】次に、ＶＴＲ再生時について説明する。Ｖ
ＴＲ再生時には、入力端子１に、前述したような、輝度
信号と、クロストーク成分を含むクロマ信号とが加算さ
れた再生ビデオ信号が供給される。この信号がサンプル
ホールド回路２に供給される。ＶＴＲ再生信号入力時
（以下ＶＴＲ入力時と称する）には、スイッチ回路２１
は端子２１Ｂ側に設定されている。このため、サンプル
ホールド回路２の出力は、スイッチ回路２１を介して、
Ａ／Ｄコンバータ１４に供給される。Ａ／Ｄコンバータ
１４で、入力端子１からの信号がディジタル化される。
ＴＲ再生時には、入力端子１に、前述したような、輝度
信号と、クロストーク成分を含むクロマ信号とが加算さ
れた再生ビデオ信号が供給される。この信号がサンプル
ホールド回路２に供給される。ＶＴＲ再生信号入力時
（以下ＶＴＲ入力時と称する）には、スイッチ回路２１
は端子２１Ｂ側に設定されている。このため、サンプル
ホールド回路２の出力は、スイッチ回路２１を介して、
Ａ／Ｄコンバータ１４に供給される。Ａ／Ｄコンバータ
１４で、入力端子１からの信号がディジタル化される。
【００１８】Ａ／Ｄコンバータ１４の出力がスイッチ回
路２２の端子２２Ｂに供給される。通常のＶＴＲ再生時
には、スイッチ回路２２は端子２２Ｂ側に設定され、ス
イッチ回路２３は端子２３Ａ側に設定されている。この
ため、Ａ／Ｄコンバータ１４の出力は、スイッチ回路２
２、スイッチ回路２３を介して、１ライン遅延回路１６
と１ライン遅延回路１７との縦続接続に供給される。
路２２の端子２２Ｂに供給される。通常のＶＴＲ再生時
には、スイッチ回路２２は端子２２Ｂ側に設定され、ス
イッチ回路２３は端子２３Ａ側に設定されている。この
ため、Ａ／Ｄコンバータ１４の出力は、スイッチ回路２
２、スイッチ回路２３を介して、１ライン遅延回路１６
と１ライン遅延回路１７との縦続接続に供給される。
【００１９】Ｙくし形フィルタ３には、スイッチ回路２
３の出力と、１ライン遅延回路１６と１ライン遅延回路
１７との段間の出力とが供給される。Ｃくし形フィルタ
４には、スイッチ回路２３の出力と、１ライン遅延回路
１６と１ライン遅延回路１７との段間の出力と、１ライ
ン遅延回路１７の出力とが供給される。
３の出力と、１ライン遅延回路１６と１ライン遅延回路
１７との段間の出力とが供給される。Ｃくし形フィルタ
４には、スイッチ回路２３の出力と、１ライン遅延回路
１６と１ライン遅延回路１７との段間の出力と、１ライ
ン遅延回路１７の出力とが供給される。
【００２０】Ｙくし形フィルタ３からの出力信号がスイ
ッチ回路２４の端子２４Ｂに供給される。通常のＶＴＲ
再生時には、スイッチ回路２４は端子２４Ｂ側に設定さ
れている。このため、Ｙくし形フィルタ３からの出力信
号は、可変遅延回路１８を介して、Ｄ／Ａコンバータ１
９に供給される。Ｄ／Ａコンバータ１９の出力が出力端
子２０から出力される。
ッチ回路２４の端子２４Ｂに供給される。通常のＶＴＲ
再生時には、スイッチ回路２４は端子２４Ｂ側に設定さ
れている。このため、Ｙくし形フィルタ３からの出力信
号は、可変遅延回路１８を介して、Ｄ／Ａコンバータ１
９に供給される。Ｄ／Ａコンバータ１９の出力が出力端
子２０から出力される。
【００２１】Ｃくし形フィルタ４からの出力信号がスイ
ッチ回路２５の端子２５Ｂに供給される。ＶＴＲ再生時
には、スイッチ回路２５は端子２５Ｂ側に設定されてい
る。このため、Ｃくし形フィルタ４から出力信号は、可
変遅延回路２１を介して、Ｄ／Ａコンバータ２２に供給
される。Ｄ／Ａコンバータ２２の出力が出力端子２３か
ら出力される。
ッチ回路２５の端子２５Ｂに供給される。ＶＴＲ再生時
には、スイッチ回路２５は端子２５Ｂ側に設定されてい
る。このため、Ｃくし形フィルタ４から出力信号は、可
変遅延回路２１を介して、Ｄ／Ａコンバータ２２に供給
される。Ｄ／Ａコンバータ２２の出力が出力端子２３か
ら出力される。
【００２２】また、１ライン遅延回路１６と１ライン遅
延回路１７との段間の出力がスイッチ回路２３の端子２
３Ｂに供給される。ノーマルモードでドロップアウト発
生時には、スイッチ回路２３が端子２３Ｂ側に設定さ
れ、入力信号が１ライン前の信号に置き換えられる。
延回路１７との段間の出力がスイッチ回路２３の端子２
３Ｂに供給される。ノーマルモードでドロップアウト発
生時には、スイッチ回路２３が端子２３Ｂ側に設定さ
れ、入力信号が１ライン前の信号に置き換えられる。
【００２３】また、１ライン遅延回路１６の段間部（１
ライン−αの遅延量の部分）からの出力がスイッチ回路
２４の端子２４Ｃに供給される。Ｈｉ８モードでドロッ
プアウト発生時には、スイッチ回路２４が端子２４Ｃに
設定される。このため、１ライン遅延回路１６の段間部
からの信号がスイッチ回路２４、可変遅延回路１８を介
して、Ｄ／Ａコンバータ１９に供給される。Ｄ／Ａコン
バータ１９の出力が出力端子２０から出力される。
ライン−αの遅延量の部分）からの出力がスイッチ回路
２４の端子２４Ｃに供給される。Ｈｉ８モードでドロッ
プアウト発生時には、スイッチ回路２４が端子２４Ｃに
設定される。このため、１ライン遅延回路１６の段間部
からの信号がスイッチ回路２４、可変遅延回路１８を介
して、Ｄ／Ａコンバータ１９に供給される。Ｄ／Ａコン
バータ１９の出力が出力端子２０から出力される。
【００２４】可変遅延回路１８及び２１により、ＶＴＲ
再生時に輝度信号Ｙとクロマ信号Ｃとの遅延合わせが行
われる。このように、Ｙくし形フィルタ３及びＣくし形
フィルタ４の後段にディジタルの可変遅延回路１８及び
２１が設けられているので、輝度信号Ｙとクロマ信号Ｃ
との遅延を簡単に合わせることができる。
再生時に輝度信号Ｙとクロマ信号Ｃとの遅延合わせが行
われる。このように、Ｙくし形フィルタ３及びＣくし形
フィルタ４の後段にディジタルの可変遅延回路１８及び
２１が設けられているので、輝度信号Ｙとクロマ信号Ｃ
との遅延を簡単に合わせることができる。
【００２５】このように、この発明の一実施例では、Ｖ
ＴＲ再生モードでは、帯域制限された輝度信号とクロマ
信号とを加算した信号が入力されているので、１つのＡ
／Ｄコンバータ１４だけで処理が行なえる。更に、カメ
ラ信号処理用に既に設けられているＡ／Ｄコンバータ１
４や２Ｈ分の遅延回路１６、１７と兼用されているた
め、殆ど回路を追加する必要がない。
ＴＲ再生モードでは、帯域制限された輝度信号とクロマ
信号とを加算した信号が入力されているので、１つのＡ
／Ｄコンバータ１４だけで処理が行なえる。更に、カメ
ラ信号処理用に既に設けられているＡ／Ｄコンバータ１
４や２Ｈ分の遅延回路１６、１７と兼用されているた
め、殆ど回路を追加する必要がない。
【００２６】なお、Ｙくし形フィルタ３及びＣくし形フ
ィルタ４の出力中には、夫々、クロマ成分及び輝度成分
が残留している。これらの残留輝度成分及び残留クロマ
成分は、図示しない後段のフィルタにより取り除かれ
る。なお、この残留輝度成分及び残留クロマ成分を取り
除くフィルタは、Ｄ／Ａ変換後にアナログフィルタで取
り除いても良いし、Ｄ／Ａ変換前にディジタルフィルタ
で取り除いても良い。
ィルタ４の出力中には、夫々、クロマ成分及び輝度成分
が残留している。これらの残留輝度成分及び残留クロマ
成分は、図示しない後段のフィルタにより取り除かれ
る。なお、この残留輝度成分及び残留クロマ成分を取り
除くフィルタは、Ｄ／Ａ変換後にアナログフィルタで取
り除いても良いし、Ｄ／Ａ変換前にディジタルフィルタ
で取り除いても良い。
【００２７】また、上述の実施例では、ノーマルモード
ではディジタル回路だけでドロップアウト補償が行わ
れ、Ｈｉ８モードではディジタル回路と共に外部のアナ
ログ回路を用いてドロップアウト補償が行われる。つま
り、８ミリＶＴＲにおけるＨｉ８モードのような輝度信
号の帯域の広いモードの場合には、輝度信号とクロマ信
号とを合成したような信号入力でくし形フィルタを形成
すると、輝度信号とクロマ信号との干渉により、画質劣
化が生じる。干渉を避けるためには、輝度信号Ｙの帯域
を予めクロマ信号と加算する前に制限しなければならな
い。このため、Ｈｉ８モードでは、Ｙくし形フィルタで
の処理は行わず、Ｃくし形フィルタでのみ処理が行われ
る。そして、１ライン遅延回路１６の段間部（１ライン
−αの遅延量の部分）から出力を取り出すことで、外部
のアナログ部と合わせて、ドロップアウト補償を行なえ
るようにしている。遅延量αは、サンプルホールド回路
からＤ／Ａコンバータの間の回路以外の外部のアナログ
部分を考慮して、ドロップアウト補償のループがトータ
ルで１ラインの遅延と等しくなるような値に設定され
る。ドロップアウト信号は、クロマ信号の帯域にあたる
輝度信号の成分が取り除かれるため、正常信号よりも帯
域が狭くなるが、視覚上は何等問題とならない。
ではディジタル回路だけでドロップアウト補償が行わ
れ、Ｈｉ８モードではディジタル回路と共に外部のアナ
ログ回路を用いてドロップアウト補償が行われる。つま
り、８ミリＶＴＲにおけるＨｉ８モードのような輝度信
号の帯域の広いモードの場合には、輝度信号とクロマ信
号とを合成したような信号入力でくし形フィルタを形成
すると、輝度信号とクロマ信号との干渉により、画質劣
化が生じる。干渉を避けるためには、輝度信号Ｙの帯域
を予めクロマ信号と加算する前に制限しなければならな
い。このため、Ｈｉ８モードでは、Ｙくし形フィルタで
の処理は行わず、Ｃくし形フィルタでのみ処理が行われ
る。そして、１ライン遅延回路１６の段間部（１ライン
−αの遅延量の部分）から出力を取り出すことで、外部
のアナログ部と合わせて、ドロップアウト補償を行なえ
るようにしている。遅延量αは、サンプルホールド回路
からＤ／Ａコンバータの間の回路以外の外部のアナログ
部分を考慮して、ドロップアウト補償のループがトータ
ルで１ラインの遅延と等しくなるような値に設定され
る。ドロップアウト信号は、クロマ信号の帯域にあたる
輝度信号の成分が取り除かれるため、正常信号よりも帯
域が狭くなるが、視覚上は何等問題とならない。
【００２８】
【発明の効果】この発明によれば、ＶＴＲ再生時には、
帯域制限された輝度信号とクロマ信号とを合成した信号
がＹくし形フィルタ及びＣくし形フィルタに入力されて
いるので、１つのＡ／Ｄコンバータだけで処理が行なえ
る。更に、カメラシステム用に既に設けられているＡ／
Ｄコンバータや２Ｈ分の遅延回路がＹくし形フィルタ及
びＣくし形フィルタと兼用されている。このため、殆ど
回路を追加する必要がない。そして、カメラ処理回路で
設けられている可変遅延回路を、ＶＴＲ再生時の輝度信
号Ｙとクロマ信号Ｃとの遅延合わせに用いることで、遅
延合わせが容易に行なえる。更に、ノーマルモードでは
ディジタル回路だけでドロップアウト補償が行われ、Ｈ
ｉ８モードではディジタル回路と共に外部のアナログ回
路を用いてドロップアウト補償が行われるので、Ｈｉ８
モードでドロップアウト補償を行う場合にも、画面の乱
れが発生することがない。
帯域制限された輝度信号とクロマ信号とを合成した信号
がＹくし形フィルタ及びＣくし形フィルタに入力されて
いるので、１つのＡ／Ｄコンバータだけで処理が行なえ
る。更に、カメラシステム用に既に設けられているＡ／
Ｄコンバータや２Ｈ分の遅延回路がＹくし形フィルタ及
びＣくし形フィルタと兼用されている。このため、殆ど
回路を追加する必要がない。そして、カメラ処理回路で
設けられている可変遅延回路を、ＶＴＲ再生時の輝度信
号Ｙとクロマ信号Ｃとの遅延合わせに用いることで、遅
延合わせが容易に行なえる。更に、ノーマルモードでは
ディジタル回路だけでドロップアウト補償が行われ、Ｈ
ｉ８モードではディジタル回路と共に外部のアナログ回
路を用いてドロップアウト補償が行われるので、Ｈｉ８
モードでドロップアウト補償を行う場合にも、画面の乱
れが発生することがない。
【図１】この発明の一実施例のブロック図である。
【図２】この発明の一実施例の説明に用いる周波数スペ
クトラム図である。
クトラム図である。
１ ＶＴＲの再生信号の入力端子 ３ Ｙくし形フィルタ ４ Ｃくし形フィルタ １１ 撮像信号の入力端子 １４ Ａ／Ｄコンバータ １６、１７ １ライン遅延回路 １５ カメラ信号処理回路 ２１〜２５ スイッチ回路
Claims (3)
- 【請求項１】 輝度信号の成分とクロマ信号の成分とが
加算されたビデオ信号又は撮像素子で撮像された撮像信
号を選択的に入力するための入力選択回路と、 上記入力選択回路で選択された、輝度信号の成分とクロ
マ信号の成分とが加算されたビデオ信号又は撮像素子で
撮像された撮像信号をディジタル化するＡ／Ｄコンバー
タと、 上記Ａ／Ｄコンバータから出力される信号を遅延する縦
続接続された複数のライン遅延回路と、 上記縦続接続された複数のライン遅延回路の段間の出力
が供給される輝度信号くし形フィルタ及びクロマ信号く
し形フィルタ並びにカメラ信号処理回路と、 上記輝度信号くし形フィルタ及びクロマ信号くし形フィ
ルタの出力と、上記カメラ信号処理回路の出力とを選択
的に出力する出力選択回路とからなるビデオ信号処理回
路。 - 【請求項２】 回路全体の遅延量が１ライン分となるよ
うに、上記縦続接続された複数のライン遅延回路の一部
からドロップアウト補償用の信号を導出するようにした
請求項１記載のビデオ信号処理回路。 - 【請求項３】 上記輝度信号くし形フィルタ及びクロマ
信号くし形フィルタの後段に可変遅延回路を設けるよう
にした請求項１記載のビデオ信号処理回路。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7017409A JPH08191459A (ja) | 1995-01-10 | 1995-01-10 | ビデオ信号処理回路 |
| US08/583,551 US5911028A (en) | 1995-01-10 | 1996-01-05 | Video signal and camera signal processing apparatus |
| DE69622290T DE69622290T2 (de) | 1995-01-10 | 1996-01-09 | Fernsehsignalbearbeitung |
| EP96300154A EP0722255B1 (en) | 1995-01-10 | 1996-01-09 | Video signal processing |
| KR1019960000333A KR100387454B1 (ko) | 1995-01-10 | 1996-01-10 | 비디오신호처리장치 |
| CN96101435A CN1112812C (zh) | 1995-01-10 | 1996-01-10 | 视频信号处理电路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7017409A JPH08191459A (ja) | 1995-01-10 | 1995-01-10 | ビデオ信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08191459A true JPH08191459A (ja) | 1996-07-23 |
Family
ID=11943212
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7017409A Pending JPH08191459A (ja) | 1995-01-10 | 1995-01-10 | ビデオ信号処理回路 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5911028A (ja) |
| EP (1) | EP0722255B1 (ja) |
| JP (1) | JPH08191459A (ja) |
| KR (1) | KR100387454B1 (ja) |
| CN (1) | CN1112812C (ja) |
| DE (1) | DE69622290T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7208703B2 (en) | 2002-05-16 | 2007-04-24 | Nippon Electric Glass Co., Ltd. | Cooking top plate |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6163300A (en) * | 1997-08-07 | 2000-12-19 | Tokin Corporation | Multi-band antenna suitable for use in a mobile radio device |
| KR101168968B1 (ko) * | 2009-09-14 | 2012-07-26 | 순환엔지니어링 주식회사 | 불규칙 이상신호 검출 및 필터링 방법 |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59171285A (ja) * | 1983-03-17 | 1984-09-27 | Victor Co Of Japan Ltd | 映像信号のドロツプアウト補償回路 |
| JPS61134198A (ja) * | 1984-12-05 | 1986-06-21 | Matsushita Electric Ind Co Ltd | 映像信号処理装置 |
| US5142375A (en) * | 1988-09-27 | 1992-08-25 | Sony Corporation | Video camera integral with magnetic recording and reproducing device, and with color video signal processing apparatus |
| US4961108A (en) * | 1988-10-24 | 1990-10-02 | Rca Licensing Corporation | Circuitry for comb filtering PAL and NTSC video signals |
| EP0428310A3 (en) * | 1989-11-06 | 1992-08-05 | Canon Kabushiki Kaisha | Image processing apparatus and image transmitting apparatus |
| US5032900A (en) * | 1990-04-30 | 1991-07-16 | Thomson Consumer Electronics, Inc. | Television receiver with auxiliary input connector for video signals of a separated y-c format |
| CN1030236C (zh) * | 1992-04-13 | 1995-11-08 | 西安电子科技大学 | 背景噪声与拖点干扰抑制电路 |
| KR0137197B1 (ko) * | 1992-11-05 | 1998-04-28 | 윤종용 | 영상처리장치에 있어서 화질 열화방지회로 |
| EP0868090B1 (en) * | 1993-03-19 | 2002-01-16 | Canon Kabushiki Kaisha | Digital video camera apparatus and recording apparatus |
-
1995
- 1995-01-10 JP JP7017409A patent/JPH08191459A/ja active Pending
-
1996
- 1996-01-05 US US08/583,551 patent/US5911028A/en not_active Expired - Fee Related
- 1996-01-09 EP EP96300154A patent/EP0722255B1/en not_active Expired - Lifetime
- 1996-01-09 DE DE69622290T patent/DE69622290T2/de not_active Expired - Fee Related
- 1996-01-10 CN CN96101435A patent/CN1112812C/zh not_active Expired - Fee Related
- 1996-01-10 KR KR1019960000333A patent/KR100387454B1/ko not_active IP Right Cessation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7208703B2 (en) | 2002-05-16 | 2007-04-24 | Nippon Electric Glass Co., Ltd. | Cooking top plate |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0722255A2 (en) | 1996-07-17 |
| US5911028A (en) | 1999-06-08 |
| DE69622290D1 (de) | 2002-08-22 |
| KR100387454B1 (ko) | 2003-11-17 |
| CN1112812C (zh) | 2003-06-25 |
| KR960030722A (ko) | 1996-08-17 |
| EP0722255B1 (en) | 2002-07-17 |
| CN1136259A (zh) | 1996-11-20 |
| DE69622290T2 (de) | 2003-03-06 |
| EP0722255A3 (en) | 1997-12-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20040302 |