JPH06161387A - 表示装置の駆動回路 - Google Patents
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Abstract
(57)【要約】
【構成】 絵素に特定の電圧を印加することにより映像
を表示する表示装置の駆動回路であって、複数の階調用
基準電圧が与えられ、その複数の階調用基準電圧に基づ
いて、その複数の階調用基準電圧の間の補間電圧をその
絵素に印加するための第１の電圧信号出力手段、及びそ
の複数の階調用基準電圧とは異なる電圧をその絵素に印
加するための第２の電圧信号出力手段を備えた表示装置
の駆動回路。 【効果】 液晶パネルに表示可能な最大のコントラスト
を実現することができる。
を表示する表示装置の駆動回路であって、複数の階調用
基準電圧が与えられ、その複数の階調用基準電圧に基づ
いて、その複数の階調用基準電圧の間の補間電圧をその
絵素に印加するための第１の電圧信号出力手段、及びそ
の複数の階調用基準電圧とは異なる電圧をその絵素に印
加するための第２の電圧信号出力手段を備えた表示装置
の駆動回路。 【効果】 液晶パネルに表示可能な最大のコントラスト
を実現することができる。
Description
【０００１】
【産業上の利用分野】本発明は、平面型表示装置の駆動
回路に関し、特に、デジタル映像信号が与えられ、その
デジタル映像信号に応じて階調表示を行う表示装置のた
めの駆動回路に関する。
回路に関し、特に、デジタル映像信号が与えられ、その
デジタル映像信号に応じて階調表示を行う表示装置のた
めの駆動回路に関する。
【０００２】
【従来の技術】図１は、デジタル映像データが与えら
れ、そのデジタル映像データに応じて階調表示を行う表
示装置のための従来の駆動回路におけるデータドライバ
を示す。なお、ここでは簡単のために、デジタル映像デ
ータは、２ビット（Ｄ0、Ｄ1）からなるものとする。こ
の駆動回路は、走査信号により選択された１走査線上の
Ｎ個の絵素に駆動電圧を供給する。
れ、そのデジタル映像データに応じて階調表示を行う表
示装置のための従来の駆動回路におけるデータドライバ
を示す。なお、ここでは簡単のために、デジタル映像デ
ータは、２ビット（Ｄ0、Ｄ1）からなるものとする。こ
の駆動回路は、走査信号により選択された１走査線上の
Ｎ個の絵素に駆動電圧を供給する。
【０００３】図２は、図１に示されるデータドライバの
一部の回路であって、Ｎ個の絵素のうち第ｎ番目の絵素
に対応する回路２０を示す。この回路２０は、デジタル
映像データ（Ｄ0、Ｄ1）の各ビット毎に設けられた第１
段目のサンプリングフリップフロップ２１、第２段目の
ホールドフリップフロップ２２、デコーダ２３、及び４
個のアナログスイッチ２４〜２７により構成される。ア
ナログスイッチ２４〜２７のそれぞれには、４種の電圧
源から信号電圧Ｖ0〜Ｖ3が供給される。なお、サンプリ
ングフリップフロップ２１は、Ｄフリップフロップの他
種々のものを用いることができる。
一部の回路であって、Ｎ個の絵素のうち第ｎ番目の絵素
に対応する回路２０を示す。この回路２０は、デジタル
映像データ（Ｄ0、Ｄ1）の各ビット毎に設けられた第１
段目のサンプリングフリップフロップ２１、第２段目の
ホールドフリップフロップ２２、デコーダ２３、及び４
個のアナログスイッチ２４〜２７により構成される。ア
ナログスイッチ２４〜２７のそれぞれには、４種の電圧
源から信号電圧Ｖ0〜Ｖ3が供給される。なお、サンプリ
ングフリップフロップ２１は、Ｄフリップフロップの他
種々のものを用いることができる。
【０００４】図２に示される回路２０は次のように動作
する。デジタル映像データ（Ｄ0、Ｄ1）は、第ｎ番目の
絵素に対応するサンプリングパルスＴSMPnの立ち上がり
時点でサンプリングフリップフロップ２１に取り込ま
れ、保持される。１水平期間のサンプリングが終了した
時点で出力パルスＯＥがホールドフリップフロップ２２
に与えられ、サンプリングフリップフロップ２１に保持
されていたデジタル映像データ（Ｄ0、Ｄ1）はホールド
フリップフロップ２２に取り込まれると共にデコーダ２
３に出力される。デコーダ２３は、デジタル映像データ
（Ｄ0、Ｄ1）の各ビットをデコードし、デコードされた
各ビットの値に応じてアナログスイッチ２４〜２７のい
ずれか１個をオン状態とすることにより、４種の電圧源
から供給される信号電圧Ｖ0〜Ｖ3のいずれかを出力す
る。
する。デジタル映像データ（Ｄ0、Ｄ1）は、第ｎ番目の
絵素に対応するサンプリングパルスＴSMPnの立ち上がり
時点でサンプリングフリップフロップ２１に取り込ま
れ、保持される。１水平期間のサンプリングが終了した
時点で出力パルスＯＥがホールドフリップフロップ２２
に与えられ、サンプリングフリップフロップ２１に保持
されていたデジタル映像データ（Ｄ0、Ｄ1）はホールド
フリップフロップ２２に取り込まれると共にデコーダ２
３に出力される。デコーダ２３は、デジタル映像データ
（Ｄ0、Ｄ1）の各ビットをデコードし、デコードされた
各ビットの値に応じてアナログスイッチ２４〜２７のい
ずれか１個をオン状態とすることにより、４種の電圧源
から供給される信号電圧Ｖ0〜Ｖ3のいずれかを出力す
る。
【０００５】上述のデータドライバによれば、デジタル
映像データのビット数の増加に応じて必要とされる電圧
源の数は２の累乗で増加する。例えば、デジタル映像デ
ータが４ビットで与えられ１６階調の表示が行われる場
合には、必要とされる電圧源の数は２4＝１６個とな
る。同様に、デジタル映像データが５ビットで与えられ
３２階調の表示が行われる場合には、必要とされる電圧
源の数は２5＝３２個となり、デジタル映像データが６
ビットで与えられ６４階調の表示が行われる場合には、
必要とされる電圧源の数は２6＝６４個となる。
映像データのビット数の増加に応じて必要とされる電圧
源の数は２の累乗で増加する。例えば、デジタル映像デ
ータが４ビットで与えられ１６階調の表示が行われる場
合には、必要とされる電圧源の数は２4＝１６個とな
る。同様に、デジタル映像データが５ビットで与えられ
３２階調の表示が行われる場合には、必要とされる電圧
源の数は２5＝３２個となり、デジタル映像データが６
ビットで与えられ６４階調の表示が行われる場合には、
必要とされる電圧源の数は２6＝６４個となる。
【０００６】電圧源はアナログスイッチを介して液晶パ
ネルに接続されるため、液晶パネルという重い負荷を十
分に駆動できるだけの性能を備える必要がある。従っ
て、そのような性能を備えた電圧源の数が増加すること
は駆動回路のコストを上昇させる重大な要因となる。ま
た、そのような電圧源を駆動回路のＬＳＩの内部に備え
ることは困難であるので、液晶パネルを駆動するための
信号電圧はＬＳＩの外部の電圧源から供給せざるを得な
い。その結果、電圧源の数が増加すれば、駆動回路を構
成するＬＳＩの入力端子数もそれと同数だけ増加するこ
とになる。従って、実際にはＬＳＩの作製が困難にな
る。仮にＬＳＩの作製が可能としても実装上又は生産上
の問題が発生し、実際の量産化は不可能という事態に立
ち至る。
ネルに接続されるため、液晶パネルという重い負荷を十
分に駆動できるだけの性能を備える必要がある。従っ
て、そのような性能を備えた電圧源の数が増加すること
は駆動回路のコストを上昇させる重大な要因となる。ま
た、そのような電圧源を駆動回路のＬＳＩの内部に備え
ることは困難であるので、液晶パネルを駆動するための
信号電圧はＬＳＩの外部の電圧源から供給せざるを得な
い。その結果、電圧源の数が増加すれば、駆動回路を構
成するＬＳＩの入力端子数もそれと同数だけ増加するこ
とになる。従って、実際にはＬＳＩの作製が困難にな
る。仮にＬＳＩの作製が可能としても実装上又は生産上
の問題が発生し、実際の量産化は不可能という事態に立
ち至る。
【０００７】階調の数と同じ数の電圧源が必要とされる
という従来の駆動方法における問題点を解決するため
に、外部から与えられる階調用基準電圧の間に複数の補
間電圧を得ることによって電圧源の数を減らし、電圧源
の数以上の階調を得ることが可能な駆動方法、及び駆動
回路が出願人により提案されている（特願平４−１２９
１６４）。また、上記の駆動方法及び駆動回路は、既に
数機種のデータドライバに適用され実用化されている。
という従来の駆動方法における問題点を解決するため
に、外部から与えられる階調用基準電圧の間に複数の補
間電圧を得ることによって電圧源の数を減らし、電圧源
の数以上の階調を得ることが可能な駆動方法、及び駆動
回路が出願人により提案されている（特願平４−１２９
１６４）。また、上記の駆動方法及び駆動回路は、既に
数機種のデータドライバに適用され実用化されている。
【０００８】図３は、既に提案されている駆動回路にお
けるデータドライバの一部の回路３０を示す。
けるデータドライバの一部の回路３０を示す。
【０００９】表１は、回路３０によって絵素に印加され
る電圧Ｖ0〜Ｖ7と階調用基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7
との関係を示す。回路３０によれば、４個の階調用基準
電圧Ｖ0、Ｖ2、Ｖ5、及びＶ7から４個の補間電圧（Ｖ0
＋２Ｖ2）／３、（２Ｖ2＋Ｖ5）／３、（Ｖ2＋２Ｖ5）
／３、及び（２Ｖ5＋Ｖ7）／３を得ることができる。こ
れにより、４個の階調用基準電圧を用いて８階調を実現
することができる。
る電圧Ｖ0〜Ｖ7と階調用基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7
との関係を示す。回路３０によれば、４個の階調用基準
電圧Ｖ0、Ｖ2、Ｖ5、及びＶ7から４個の補間電圧（Ｖ0
＋２Ｖ2）／３、（２Ｖ2＋Ｖ5）／３、（Ｖ2＋２Ｖ5）
／３、及び（２Ｖ5＋Ｖ7）／３を得ることができる。こ
れにより、４個の階調用基準電圧を用いて８階調を実現
することができる。
【００１０】
【表１】
【００１１】
【発明が解決しようとする課題】図４は、上述の回路３
０により絵素に印加される電圧と透過率との関係を示
す。本発明が解決しようとする問題点を、電圧Ｖ0を例
にとり説明する。電圧Ｖ0は最小の透過率、即ち最大階
調（黒）を得るための電圧である。
０により絵素に印加される電圧と透過率との関係を示
す。本発明が解決しようとする問題点を、電圧Ｖ0を例
にとり説明する。電圧Ｖ0は最小の透過率、即ち最大階
調（黒）を得るための電圧である。
【００１２】図４に示されるように、透過率が０になる
近傍では、電圧が上昇するにつれて透過率はなだらかに
０に近づいていく。従って、電圧Ｖ0は合理的な範囲内
で絶対値を大きくすればするほど透過率は０に近づく。
ところで、回路３０によれば電圧Ｖ0は補間電圧Ｖ1を得
るために用いられているから、電圧Ｖ0を補間電圧Ｖ１
と独立に調整することはできない。電圧Ｖ１に対して適
切な階調が得られるように電圧Ｖ1を調整すれば、電圧
Ｖ1に応じて電圧Ｖ0が決定される。逆に、電圧Ｖ0に対
して適切な階調が得られるように電圧Ｖ0を調整すれ
ば、電圧Ｖ0に応じて電圧Ｖ1が決定される。本例では、
電圧Ｖ0が関連する補間電圧はＶ1のみである。しかし、
デジタル映像信号のビット数が増加するにつれて電圧Ｖ
0が関連する補間電圧の数も増加するので、電圧Ｖ0を補
間電圧と独立に調整することはより困難になる。このた
め、例えば、もう少し電圧Ｖ0を大きくすれば黒がもう
少し締まる（すなわち、表示上のコントラストが高くな
る）という場合でも、中間階調を含めた総合的な階調特
性を考慮すると電圧Ｖ0を大きくすることができないと
いう不都合が生じる。なお、最大の透過率、即ち最小階
調（白）を得るための電圧Ｖ7についても同様の不都合
が生じ得る。
近傍では、電圧が上昇するにつれて透過率はなだらかに
０に近づいていく。従って、電圧Ｖ0は合理的な範囲内
で絶対値を大きくすればするほど透過率は０に近づく。
ところで、回路３０によれば電圧Ｖ0は補間電圧Ｖ1を得
るために用いられているから、電圧Ｖ0を補間電圧Ｖ１
と独立に調整することはできない。電圧Ｖ１に対して適
切な階調が得られるように電圧Ｖ1を調整すれば、電圧
Ｖ1に応じて電圧Ｖ0が決定される。逆に、電圧Ｖ0に対
して適切な階調が得られるように電圧Ｖ0を調整すれ
ば、電圧Ｖ0に応じて電圧Ｖ1が決定される。本例では、
電圧Ｖ0が関連する補間電圧はＶ1のみである。しかし、
デジタル映像信号のビット数が増加するにつれて電圧Ｖ
0が関連する補間電圧の数も増加するので、電圧Ｖ0を補
間電圧と独立に調整することはより困難になる。このた
め、例えば、もう少し電圧Ｖ0を大きくすれば黒がもう
少し締まる（すなわち、表示上のコントラストが高くな
る）という場合でも、中間階調を含めた総合的な階調特
性を考慮すると電圧Ｖ0を大きくすることができないと
いう不都合が生じる。なお、最大の透過率、即ち最小階
調（白）を得るための電圧Ｖ7についても同様の不都合
が生じ得る。
【００１３】本発明は上述のような問題点を解決するた
めになされたものであり、最大階調や最小階調を得るた
めの電圧を階調用基準電圧とは異なる電圧とし、その電
圧を独立に調整可能とすることにより、液晶パネルに表
示可能な最大のコントラストを実現し得る表示装置の駆
動回路を提供することを目的とする。
めになされたものであり、最大階調や最小階調を得るた
めの電圧を階調用基準電圧とは異なる電圧とし、その電
圧を独立に調整可能とすることにより、液晶パネルに表
示可能な最大のコントラストを実現し得る表示装置の駆
動回路を提供することを目的とする。
【００１４】
【課題を解決するための手段】本発明の駆動回路は、絵
素に特定の電圧を印加することにより映像を表示する表
示装置の駆動回路であって、複数の階調用基準電圧が与
えられ、該複数の階調用基準電圧に基づいて、該複数の
階調用基準電圧の間の補間電圧を該絵素に印加するため
の第１の電圧出力手段、及び該複数の階調用基準電圧と
は異なる電圧を該絵素に印加するための第２の電圧出力
手段を備えており、これにより、上記目的が達成され
る。
素に特定の電圧を印加することにより映像を表示する表
示装置の駆動回路であって、複数の階調用基準電圧が与
えられ、該複数の階調用基準電圧に基づいて、該複数の
階調用基準電圧の間の補間電圧を該絵素に印加するため
の第１の電圧出力手段、及び該複数の階調用基準電圧と
は異なる電圧を該絵素に印加するための第２の電圧出力
手段を備えており、これにより、上記目的が達成され
る。
【００１５】前記第２の電圧出力手段によって前記絵素
に印加される電圧は最大階調を得るための電圧であって
もよい。
に印加される電圧は最大階調を得るための電圧であって
もよい。
【００１６】前記第２の電圧出力手段によって前記絵素
に印加される電圧は最小階調を得るための電圧であって
もよい。
に印加される電圧は最小階調を得るための電圧であって
もよい。
【００１７】
【実施例】以下に本発明の実施例について説明する。以
下では、マトリクス型の液晶表示装置を表示装置の例に
とって説明を行うが、本発明は他の種類の表示装置にも
適用可能である。
下では、マトリクス型の液晶表示装置を表示装置の例に
とって説明を行うが、本発明は他の種類の表示装置にも
適用可能である。
【００１８】図５は、データドライバの一部の回路であ
って、Ｎ個の絵素のうち第ｎ番目の絵素に対応する回路
５０の構成例を示す。この例では、デジタル映像データ
は、３ビットからなるものとする。
って、Ｎ個の絵素のうち第ｎ番目の絵素に対応する回路
５０の構成例を示す。この例では、デジタル映像データ
は、３ビットからなるものとする。
【００１９】回路５０は、デジタル映像データを受け取
り、保持するための第１段目のサンプリングフリップフ
ロップ５１及び第２段目のホールドフリップフロップ５
２、デジタル映像データに応じてアナログスイッチのオ
ン・オフ状態を制御するための選択制御回路５３、並び
に互いに異なる電圧レベルの階調用基準電圧が供給され
るアナログスイッチ５５〜５８、及び階調用基準電圧と
は異なる電圧が供給されるアナログスイッチ５４を有す
る。選択制御回路５３には、信号ｔが入力される。回路
５０の出力はデータ線（不図示）に接続される。
り、保持するための第１段目のサンプリングフリップフ
ロップ５１及び第２段目のホールドフリップフロップ５
２、デジタル映像データに応じてアナログスイッチのオ
ン・オフ状態を制御するための選択制御回路５３、並び
に互いに異なる電圧レベルの階調用基準電圧が供給され
るアナログスイッチ５５〜５８、及び階調用基準電圧と
は異なる電圧が供給されるアナログスイッチ５４を有す
る。選択制御回路５３には、信号ｔが入力される。回路
５０の出力はデータ線（不図示）に接続される。
【００２０】本明細書では、「階調用基準電圧」とは、
上述の特許出願（特願平４−１２９１６４）に開示され
る振動電圧駆動方法により少なくとも１つの補間階調を
得るために使用される電圧と定義する。
上述の特許出願（特願平４−１２９１６４）に開示され
る振動電圧駆動方法により少なくとも１つの補間階調を
得るために使用される電圧と定義する。
【００２１】次に、図５を参照して、回路５０の動作を
説明する。デジタル映像データ（Ｄ0、Ｄ1、Ｄ2）は第
ｎ番目の絵素に対応するサンプリングパルスＴSMPnの立
ち上がり時点でサンプリングフリップフロップ５１に取
り込まれ、保持される。１水平期間のサンプリングが終
了した時点で出力パルスＯＥがホールドフリップフロッ
プ５２に与えられ、サンプリングフリップフロップ５１
に保持されていたデジタル映像データ（Ｄ0、Ｄ1、
Ｄ2）はホールドフリップフロップ５２に取り込まれる
と共に選択制御回路５３に出力される。選択制御回路５
３は入力端子ｄ0、ｄ1、及びｄ2、並びに出力端子
Ｓ0’、Ｓ0、Ｓ2、Ｓ5、及びＳ7を有している。選択制
御回路５３の入力端子ｄ0、ｄ1、及びｄ2には、デジタ
ル映像データ（Ｄ0、Ｄ1、Ｄ2）の各ビットが入力され
る。選択制御回路５３の出力端子Ｓ0’、Ｓ0、Ｓ2、
Ｓ5、及びＳ7からはアナログスイッチ５４〜５８のオン
・オフ状態の切り換えを制御するための制御信号が出力
される。アナログスイッチ５５〜５８のそれぞれには、
互いに異なった電圧レベルの階調用基準電圧Ｖ0、Ｖ2、
Ｖ5及びＶ7が供給される。アナログスイッチ５４には、
階調用基準電圧と異なる電圧Ｖ0’が供給される。これ
らの電圧は、アナログスイッチ５４〜５８がオン状態の
ときのみデータ線に出力される。
説明する。デジタル映像データ（Ｄ0、Ｄ1、Ｄ2）は第
ｎ番目の絵素に対応するサンプリングパルスＴSMPnの立
ち上がり時点でサンプリングフリップフロップ５１に取
り込まれ、保持される。１水平期間のサンプリングが終
了した時点で出力パルスＯＥがホールドフリップフロッ
プ５２に与えられ、サンプリングフリップフロップ５１
に保持されていたデジタル映像データ（Ｄ0、Ｄ1、
Ｄ2）はホールドフリップフロップ５２に取り込まれる
と共に選択制御回路５３に出力される。選択制御回路５
３は入力端子ｄ0、ｄ1、及びｄ2、並びに出力端子
Ｓ0’、Ｓ0、Ｓ2、Ｓ5、及びＳ7を有している。選択制
御回路５３の入力端子ｄ0、ｄ1、及びｄ2には、デジタ
ル映像データ（Ｄ0、Ｄ1、Ｄ2）の各ビットが入力され
る。選択制御回路５３の出力端子Ｓ0’、Ｓ0、Ｓ2、
Ｓ5、及びＳ7からはアナログスイッチ５４〜５８のオン
・オフ状態の切り換えを制御するための制御信号が出力
される。アナログスイッチ５５〜５８のそれぞれには、
互いに異なった電圧レベルの階調用基準電圧Ｖ0、Ｖ2、
Ｖ5及びＶ7が供給される。アナログスイッチ５４には、
階調用基準電圧と異なる電圧Ｖ0’が供給される。これ
らの電圧は、アナログスイッチ５４〜５８がオン状態の
ときのみデータ線に出力される。
【００２２】表２は、選択制御回路５３の入力と出力と
の関係を示す論理表である。表２の第１欄は、選択制御
回路５３の入力端子ｄ2、ｄ1、及びｄ0のそれぞれに入
力されるの各ビットの値を示している。表２の第２欄
は、選択制御回路５３の出力端子Ｓ0’、Ｓ0、Ｓ2、
Ｓ5、及びＳ7のそれぞれから出力される制御信号の値を
示している。制御信号の値が１のとき、その出力端子に
接続されるアナログスイッチはオン状態となる。制御信
号の値が０のとき、その出力端子に接続されるアナログ
スイッチはオフ状態となる。表２の第２欄における空白
の部分は、制御信号の値が０であることを示す。また、
「ｔ」は、信号ｔの値が１のとき制御信号の値が１とな
り、信号ｔの値が０のとき制御信号の値が０となること
を示す。「ｔバー」は、信号ｔの値が１のとき制御信号
の値が０となり、信号ｔの値が０のとき制御信号の値が
１となることを示す。なお、本明細書では、「ｔバー」
という表記はｔの上方に横棒線を付した表記と同義とす
る。
の関係を示す論理表である。表２の第１欄は、選択制御
回路５３の入力端子ｄ2、ｄ1、及びｄ0のそれぞれに入
力されるの各ビットの値を示している。表２の第２欄
は、選択制御回路５３の出力端子Ｓ0’、Ｓ0、Ｓ2、
Ｓ5、及びＳ7のそれぞれから出力される制御信号の値を
示している。制御信号の値が１のとき、その出力端子に
接続されるアナログスイッチはオン状態となる。制御信
号の値が０のとき、その出力端子に接続されるアナログ
スイッチはオフ状態となる。表２の第２欄における空白
の部分は、制御信号の値が０であることを示す。また、
「ｔ」は、信号ｔの値が１のとき制御信号の値が１とな
り、信号ｔの値が０のとき制御信号の値が０となること
を示す。「ｔバー」は、信号ｔの値が１のとき制御信号
の値が０となり、信号ｔの値が０のとき制御信号の値が
１となることを示す。なお、本明細書では、「ｔバー」
という表記はｔの上方に横棒線を付した表記と同義とす
る。
【００２３】
【表２】
【００２４】図６は、上述した信号ｔの波形を示す。信
号ｔは、０又は１の値を交互にとるパルス信号である。
信号ｔのデューティ比は１：２とされる。すなわち、信
号ｔの値が０となる期間と信号ｔの値が１となる期間と
の比は１：２である。
号ｔは、０又は１の値を交互にとるパルス信号である。
信号ｔのデューティ比は１：２とされる。すなわち、信
号ｔの値が０となる期間と信号ｔの値が１となる期間と
の比は１：２である。
【００２５】次に、表２を参照して、選択制御回路５３
の動作を説明する。
の動作を説明する。
【００２６】例えば、選択制御回路５３の入力端子
ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビット
の値が、それぞれ０、０、及び１の場合、選択制御回路
５３の出力端子Ｓ0から出力される制御信号の値は信号
ｔバーの値に従い、選択制御回路５３の出力端子Ｓ2か
ら出力される制御信号の値は信号ｔの値に従う。信号ｔ
の値が１の時にはアナログスイッチ５６がオン状態とな
り、信号ｔの値が０の時には信号ｔバーの値が１となる
のでアナログスイッチ５５がオン状態となる。その結
果、データ線に出力される電圧は、信号ｔと同一周期で
階調基準電圧Ｖ0とＶ2との間を振動する振動電圧とな
る。この振動電圧は、データ線を介して結果的に階調用
基準電圧Ｖ0とＶ2との間の補間電圧（Ｖ0＋２Ｖ2）／３
を絵素に印加することになる。
ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビット
の値が、それぞれ０、０、及び１の場合、選択制御回路
５３の出力端子Ｓ0から出力される制御信号の値は信号
ｔバーの値に従い、選択制御回路５３の出力端子Ｓ2か
ら出力される制御信号の値は信号ｔの値に従う。信号ｔ
の値が１の時にはアナログスイッチ５６がオン状態とな
り、信号ｔの値が０の時には信号ｔバーの値が１となる
のでアナログスイッチ５５がオン状態となる。その結
果、データ線に出力される電圧は、信号ｔと同一周期で
階調基準電圧Ｖ0とＶ2との間を振動する振動電圧とな
る。この振動電圧は、データ線を介して結果的に階調用
基準電圧Ｖ0とＶ2との間の補間電圧（Ｖ0＋２Ｖ2）／３
を絵素に印加することになる。
【００２７】同様に、階調用基準電圧Ｖ2とＶ5との間を
振動する振動電圧、及び階調用基準電圧Ｖ5とＶ7との間
を振動する振動電圧がデータ線に出力される。その結
果、それらの振動電圧もデータ線を介して結果的に補間
電圧を絵素に印加することになる。このように、階調用
基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7はいづれも補間電圧に関
連するので、補間電圧と独立に調整することはできな
い。
振動する振動電圧、及び階調用基準電圧Ｖ5とＶ7との間
を振動する振動電圧がデータ線に出力される。その結
果、それらの振動電圧もデータ線を介して結果的に補間
電圧を絵素に印加することになる。このように、階調用
基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7はいづれも補間電圧に関
連するので、補間電圧と独立に調整することはできな
い。
【００２８】これに対し、選択制御回路５３の入力端子
ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビット
の値がすべて０の場合、選択制御回路５３の出力端子Ｓ
0’から出力される制御信号の値が１となり、アナログ
スイッチ５４がオン状態となる。アナログスイッチ５５
〜５８はオフ状態のままである。従って、データ線に
は、電圧Ｖ0’が出力される。この電圧Ｖ0’は振動電圧
の生成には使用されない。従って、電圧Ｖ0’を他の電
圧と独立に調整することが可能となる。
ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビット
の値がすべて０の場合、選択制御回路５３の出力端子Ｓ
0’から出力される制御信号の値が１となり、アナログ
スイッチ５４がオン状態となる。アナログスイッチ５５
〜５８はオフ状態のままである。従って、データ線に
は、電圧Ｖ0’が出力される。この電圧Ｖ0’は振動電圧
の生成には使用されない。従って、電圧Ｖ0’を他の電
圧と独立に調整することが可能となる。
【００２９】図７は、データドライバの一部の回路であ
って、Ｎ個の絵素のうち第ｎ番目の絵素に対応する回路
７０の構成例を示す。アナログスイッチ７９は、選択制
御回路７３の出力端子Ｓ7’に接続される。アナログス
イッチ７９には、階調用基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7
とは異なる電圧Ｖ7’が供給される。その他の構成は、
図５に示される回路５０の構成と同様であるので、説明
を省略する。
って、Ｎ個の絵素のうち第ｎ番目の絵素に対応する回路
７０の構成例を示す。アナログスイッチ７９は、選択制
御回路７３の出力端子Ｓ7’に接続される。アナログス
イッチ７９には、階調用基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7
とは異なる電圧Ｖ7’が供給される。その他の構成は、
図５に示される回路５０の構成と同様であるので、説明
を省略する。
【００３０】回路７０は、電圧Ｖ0’と同様に、階調用
基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7とは異なる電圧Ｖ7’を
データ線に出力することにより、最小階調を得るための
電圧を他の電圧とは独立に調整可能とするものである。
基準電圧Ｖ0、Ｖ2、Ｖ5及びＶ7とは異なる電圧Ｖ7’を
データ線に出力することにより、最小階調を得るための
電圧を他の電圧とは独立に調整可能とするものである。
【００３１】表３は、選択制御回路７３の入力と出力の
関係を示す論理表である。
関係を示す論理表である。
【００３２】表３を参照して、選択制御回路７３の入力
端子ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビ
ットの値がすべて１の場合、選択制御回路７３の出力端
子Ｓ7’から出力される制御信号の値が１となり、アナ
ログスイッチ７９がオン状態となる。アナログスイッチ
７４〜７８はオフ状態のままである。従って、データ線
には、電圧Ｖ7’が出力される。この電圧Ｖ7’は振動電
圧の生成には使用されない。従って、電圧Ｖ7’を他の
電圧と独立に調整することが可能となる。
端子ｄ2、ｄ1、及びｄ0のそれぞれに入力されるの各ビ
ットの値がすべて１の場合、選択制御回路７３の出力端
子Ｓ7’から出力される制御信号の値が１となり、アナ
ログスイッチ７９がオン状態となる。アナログスイッチ
７４〜７８はオフ状態のままである。従って、データ線
には、電圧Ｖ7’が出力される。この電圧Ｖ7’は振動電
圧の生成には使用されない。従って、電圧Ｖ7’を他の
電圧と独立に調整することが可能となる。
【００３３】
【表３】
【００３４】図８は、本発明の駆動回路により絵素に印
加される電圧と透過率との関係を示す。電圧Ｖ0’を階
調用基準電圧Ｖ0より大きな値とし、電圧Ｖ7’を階調用
基準電圧Ｖ7より小さい値とすることにより、電圧Ｖ0’
により最大階調、及び電圧Ｖ7’により最小階調が得ら
れるように電圧Ｖ0’及び電圧Ｖ7’を他の電圧と独立に
調整することができる。その結果、液晶パネルに表示可
能な最大のコントラストを実現し得る。
加される電圧と透過率との関係を示す。電圧Ｖ0’を階
調用基準電圧Ｖ0より大きな値とし、電圧Ｖ7’を階調用
基準電圧Ｖ7より小さい値とすることにより、電圧Ｖ0’
により最大階調、及び電圧Ｖ7’により最小階調が得ら
れるように電圧Ｖ0’及び電圧Ｖ7’を他の電圧と独立に
調整することができる。その結果、液晶パネルに表示可
能な最大のコントラストを実現し得る。
【００３５】もちろん、最大階調及び最小階調を得るた
めの電圧の一方のみを独立に調整するようにしてもよ
い。
めの電圧の一方のみを独立に調整するようにしてもよ
い。
【００３６】なお、本発明は、その代償として駆動回路
を構成するＬＳＩ（すなわち、データドライバ）の端子
数、及びデータドライバを構成するアナログスイッチの
数を増加させる。しかし、例えば、振動電圧駆動方法を
用いて９個の階調用基準電圧から６４階調を実現する６
ビット６４階調データドライバに本発明を適用して、最
大階調及び最小階調を得るための電圧の一方を独立に調
整可能とした場合、必要とされる電圧源の数は９個から
１０個に増加するだけであり、必要とされるアナログス
イッチの数はデータドライバの１出力当り９個から１０
個に増加するだけである。このように、電圧源の増加に
伴うＬＳＩの端子数の増加、及びアナログスイッチの数
の増加の影響は小さい。
を構成するＬＳＩ（すなわち、データドライバ）の端子
数、及びデータドライバを構成するアナログスイッチの
数を増加させる。しかし、例えば、振動電圧駆動方法を
用いて９個の階調用基準電圧から６４階調を実現する６
ビット６４階調データドライバに本発明を適用して、最
大階調及び最小階調を得るための電圧の一方を独立に調
整可能とした場合、必要とされる電圧源の数は９個から
１０個に増加するだけであり、必要とされるアナログス
イッチの数はデータドライバの１出力当り９個から１０
個に増加するだけである。このように、電圧源の増加に
伴うＬＳＩの端子数の増加、及びアナログスイッチの数
の増加の影響は小さい。
【００３７】
【発明の効果】本発明によれば、階調用基準電圧とは異
なる電圧が与えられ、その電圧を他の電圧と独立に調整
することが可能となる。その結果、最大階調又は最小階
調を得るための電圧を他の電圧と独立に調整することが
可能となる。これにより、振動電圧駆動方法に特有の電
圧源の数以上の階調を得ることが可能であるという利点
を維持しつつ、しかも液晶パネルに表示可能な最大のコ
ントラストを実現することができる。
なる電圧が与えられ、その電圧を他の電圧と独立に調整
することが可能となる。その結果、最大階調又は最小階
調を得るための電圧を他の電圧と独立に調整することが
可能となる。これにより、振動電圧駆動方法に特有の電
圧源の数以上の階調を得ることが可能であるという利点
を維持しつつ、しかも液晶パネルに表示可能な最大のコ
ントラストを実現することができる。
【図１】従来のデータドライバの回路を示す図である。
【図２】従来のデータドライバの一部の回路を示す図で
ある。
ある。
【図３】データドライバの一部の回路を示す図である。
【図４】絵素に印加される電圧と透過率との関係を示す
図である。
図である。
【図５】本発明の一実施例を示すものであって、データ
ドライバの一部の回路を示す図である。
ドライバの一部の回路を示す図である。
【図６】図５に示される選択制御回路５３に入力される
信号ｔの波形を示す図である。
信号ｔの波形を示す図である。
【図７】本発明の他の実施例を示すものであって、デー
タドライバの一部の回路を示す図である。
タドライバの一部の回路を示す図である。
【図８】絵素に印加される電圧と透過率との関係を示す
図である。
図である。
５１ サンプリングフリップフロップ ５２ ホールドフリップフロップ ５３ 選択制御回路 ５４〜５８ アナログスイッチ
Claims (3)
- 【請求項１】 絵素に特定の電圧を印加することにより
映像を表示する表示装置の駆動回路であって、 複数の階調用基準電圧が与えられ、該複数の階調用基準
電圧に基づいて、該複数の階調用基準電圧の間の補間電
圧を該絵素に印加するための第１の電圧出力手段、及び
該複数の階調用基準電圧とは異なる電圧を該絵素に印加
するための第２の電圧出力手段を備えた表示装置の駆動
回路。 - 【請求項２】 前記第２の電圧出力手段によって前記絵
素に印加される電圧は最大階調を得るための電圧であ
る、請求項１に記載の表示装置の駆動回路。 - 【請求項３】 前記第２の電圧出力手段によって前記絵
素に印加される電圧は最小階調を得るための電圧であ
る、請求項１に記載の表示装置の駆動回路。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4315421A JP2849010B2 (ja) | 1992-11-25 | 1992-11-25 | 表示装置の駆動回路 |
| EP19930309359 EP0599621B1 (en) | 1992-11-25 | 1993-11-24 | A driving circuit for a display apparatus, which improves voltage setting operations |
| DE1993613587 DE69313587T2 (de) | 1992-11-25 | 1993-11-24 | Steuervorrichtung für ein Anzeigegerät, die die Spannungseinstellung verbessert |
| EP19930309360 EP0599622B1 (en) | 1992-11-25 | 1993-11-24 | A driving circuit for driving a display apparatus and a method for the same |
| DE1993616852 DE69316852T2 (de) | 1992-11-25 | 1993-11-24 | Steuerschaltung zur Steuerung einer Anzeigeeinrichtung und Verfahren für dieselbe |
| KR1019930025574A KR960014499B1 (ko) | 1992-11-25 | 1993-11-25 | 표시장치의 구동회로 |
| CN93120323A CN1029712C (zh) | 1992-11-25 | 1993-11-25 | 显示设备的驱动电路 |
| US08/503,328 US5680148A (en) | 1992-11-25 | 1995-07-17 | Driving circuit for a display apparatus capable of display of an image with gray scales |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4315421A JP2849010B2 (ja) | 1992-11-25 | 1992-11-25 | 表示装置の駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06161387A true JPH06161387A (ja) | 1994-06-07 |
| JP2849010B2 JP2849010B2 (ja) | 1999-01-20 |
Family
ID=18065182
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4315421A Expired - Lifetime JP2849010B2 (ja) | 1992-11-25 | 1992-11-25 | 表示装置の駆動回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5680148A (ja) |
| JP (1) | JP2849010B2 (ja) |
| KR (1) | KR960014499B1 (ja) |
| CN (1) | CN1029712C (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100435082B1 (ko) * | 2000-05-30 | 2004-06-09 | 엔이씨 엘씨디 테크놀로지스, 엘티디. | 액정 표시 장치 |
| JP2011237496A (ja) * | 2010-05-07 | 2011-11-24 | Sony Corp | 表示装置、電子機器、表示装置の駆動方法 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR0140041B1 (ko) * | 1993-02-09 | 1998-06-15 | 쯔지 하루오 | 표시 장치용 전압 발생 회로, 공통 전극 구동 회로, 신호선 구동 회로 및 계조 전압 발생 회로 |
| JPH08115060A (ja) * | 1994-10-14 | 1996-05-07 | Sharp Corp | 表示装置の駆動回路及び液晶表示装置 |
| JP2003172915A (ja) * | 2001-09-26 | 2003-06-20 | Sharp Corp | 液晶表示装置 |
| JP3829809B2 (ja) * | 2003-02-18 | 2006-10-04 | セイコーエプソン株式会社 | 表示装置の駆動回路及び駆動方法、並びに表示装置及び投射型表示装置 |
| JP4936854B2 (ja) * | 2006-10-25 | 2012-05-23 | ルネサスエレクトロニクス株式会社 | 表示装置、及び表示パネルドライバ |
Citations (1)
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|---|---|---|---|---|
| JPH04140787A (ja) * | 1990-10-01 | 1992-05-14 | Sharp Corp | 表示装置の駆動回路 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0214856B1 (en) * | 1985-09-06 | 1992-07-29 | Matsushita Electric Industrial Co., Ltd. | Method of driving liquid crystal matrix panel |
| US5266936A (en) * | 1989-05-09 | 1993-11-30 | Nec Corporation | Driving circuit for liquid crystal display |
| EP0478386B1 (en) * | 1990-09-28 | 1995-12-13 | Sharp Kabushiki Kaisha | Drive circuit for a display apparatus |
| JP2659473B2 (ja) * | 1990-09-28 | 1997-09-30 | 富士通株式会社 | 表示パネル駆動回路 |
| JP2761128B2 (ja) * | 1990-10-31 | 1998-06-04 | 富士通株式会社 | 液晶表示装置 |
| JP3075006B2 (ja) * | 1993-03-26 | 2000-08-07 | 神鋼電機株式会社 | フォークリフトの昇降制御方法 |
-
1992
- 1992-11-25 JP JP4315421A patent/JP2849010B2/ja not_active Expired - Lifetime
-
1993
- 1993-11-25 KR KR1019930025574A patent/KR960014499B1/ko not_active IP Right Cessation
- 1993-11-25 CN CN93120323A patent/CN1029712C/zh not_active Expired - Lifetime
-
1995
- 1995-07-17 US US08/503,328 patent/US5680148A/en not_active Expired - Lifetime
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|---|---|---|---|---|
| JPH04140787A (ja) * | 1990-10-01 | 1992-05-14 | Sharp Corp | 表示装置の駆動回路 |
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|---|---|---|---|---|
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| JP2011237496A (ja) * | 2010-05-07 | 2011-11-24 | Sony Corp | 表示装置、電子機器、表示装置の駆動方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| US5680148A (en) | 1997-10-21 |
| JP2849010B2 (ja) | 1999-01-20 |
| KR940013190A (ko) | 1994-06-25 |
| CN1029712C (zh) | 1995-09-06 |
| CN1092194A (zh) | 1994-09-14 |
| KR960014499B1 (ko) | 1996-10-16 |
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