JPH0569433B2 - - Google Patents
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- JPH0569433B2 JPH0569433B2 JP60230659A JP23065985A JPH0569433B2 JP H0569433 B2 JPH0569433 B2 JP H0569433B2 JP 60230659 A JP60230659 A JP 60230659A JP 23065985 A JP23065985 A JP 23065985A JP H0569433 B2 JPH0569433 B2 JP H0569433B2
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
- G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
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- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
- G09G2310/0264—Details of driving circuits
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- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of El Displays (AREA)
Description
【発明の詳細な説明】
技術分野
この発明はフラツト型ELパネル駆動装置、詳
しくは複数の薄膜エレクトロ・ルミネツセンス表
示セルをマトリツクス状に配置して成るELパネ
ル駆動装置に関する。
しくは複数の薄膜エレクトロ・ルミネツセンス表
示セルをマトリツクス状に配置して成るELパネ
ル駆動装置に関する。
技術背景
例えば、第1図に示すように、ガラス基板1に
複数の帯状透明電極2を互いに平行に設け、この
上に第1誘電物質層3、エレクトロ・ルミネツセ
ンス(以下にELと記す)層4および第2誘電物
質層5を積層し、さらにその上に上記透明電極2
と直交するように複数の帯状背面電極6を設けて
形成した2重絶縁型容量性薄膜EL表示装置、い
わゆるフラツト型ELパネルが公知である。
複数の帯状透明電極2を互いに平行に設け、この
上に第1誘電物質層3、エレクトロ・ルミネツセ
ンス(以下にELと記す)層4および第2誘電物
質層5を積層し、さらにその上に上記透明電極2
と直交するように複数の帯状背面電極6を設けて
形成した2重絶縁型容量性薄膜EL表示装置、い
わゆるフラツト型ELパネルが公知である。
この種の薄膜EL表示装置は、例えば、第2図
に示すような駆動回路により駆動される。
に示すような駆動回路により駆動される。
第2図において、10は(Xi×Yj)個の容量
性薄膜EL表示セルをマトリツクス状に配置して
方形状の表示画面が形成された薄膜EL表示装置
(以下にELパネルという)であり、図中ELパネ
ルを形成する各EL表示セルの対向電極のみを示
す。このELパネルにおける各行(X方向)電極
群X1〜Xiが走査ラインとされかつ各列(Y方向)
電極群Y1〜Yjがデータラインとされる。
性薄膜EL表示セルをマトリツクス状に配置して
方形状の表示画面が形成された薄膜EL表示装置
(以下にELパネルという)であり、図中ELパネ
ルを形成する各EL表示セルの対向電極のみを示
す。このELパネルにおける各行(X方向)電極
群X1〜Xiが走査ラインとされかつ各列(Y方向)
電極群Y1〜Yjがデータラインとされる。
20は奇数行電極群、即ち奇数走査ラインX1,
X3,X5…とそれぞれ接続されたn型高耐圧MOS
トランジスタ群NT1,NT3,NT5…を含む集積
駆動回路(以下に走査側N−chMOSICという)、
30は偶数行電極群、即ち偶数走査ラインX2,
X4,X6…とそれぞれ接続されたn型MOSトラン
ジスタ群NT2,NT4,NT6…を含む集積駆動回
路(以下に、走査側N−chMOSICという)であ
る。21および31はそれぞれ上記走査側N−
chMOSIC20および30中に形成されたシフト
レジスタである。これらのシフトレジスタ21お
よび31はそれぞれ走査ラインX1〜Xiの線順次
走査時の駆動パルス信号を走査側N−chMOSIC
20および30における各MOSトランジスタ
NT1〜NTiに印加するようになつている。
X3,X5…とそれぞれ接続されたn型高耐圧MOS
トランジスタ群NT1,NT3,NT5…を含む集積
駆動回路(以下に走査側N−chMOSICという)、
30は偶数行電極群、即ち偶数走査ラインX2,
X4,X6…とそれぞれ接続されたn型MOSトラン
ジスタ群NT2,NT4,NT6…を含む集積駆動回
路(以下に、走査側N−chMOSICという)であ
る。21および31はそれぞれ上記走査側N−
chMOSIC20および30中に形成されたシフト
レジスタである。これらのシフトレジスタ21お
よび31はそれぞれ走査ラインX1〜Xiの線順次
走査時の駆動パルス信号を走査側N−chMOSIC
20および30における各MOSトランジスタ
NT1〜NTiに印加するようになつている。
40および50は、上記走査側N−chMOSIC
20および30と同様、各奇数および偶数走査ラ
インと対応したp型高耐圧MOSトランジスタ群
PT1,PT3,PT5…およびPT2,PT4,PT6…を
含む集積駆動回路(以下に、走査側P−
chMOSICという)、41および51は走査側P−
chMOSIC40および50中に形成されたシフト
レジスタである。これらのシフトレジスタ41お
よび51はそれぞれ走査ラインX1〜Xiの線順次
走査時の駆動パルス信号を走査側P−chMOSIC
40および50における各MOSトランジスタ
PT1,PT3,PT5…およびPT2,PT4,PT6…に
印加するようになつている。
20および30と同様、各奇数および偶数走査ラ
インと対応したp型高耐圧MOSトランジスタ群
PT1,PT3,PT5…およびPT2,PT4,PT6…を
含む集積駆動回路(以下に、走査側P−
chMOSICという)、41および51は走査側P−
chMOSIC40および50中に形成されたシフト
レジスタである。これらのシフトレジスタ41お
よび51はそれぞれ走査ラインX1〜Xiの線順次
走査時の駆動パルス信号を走査側P−chMOSIC
40および50における各MOSトランジスタ
PT1,PT3,PT5…およびPT2,PT4,PT6…に
印加するようになつている。
60は列電極群、即ちデータラインY1〜Yjと
それぞれ接続されたn型高耐圧MOSトランジス
タ群Nt1〜Ntjを含む集積駆動回路(以下にデー
タ側N−chMOSICという)、61は上記N−
chMOSIC60中に形成されたシフトレジスタで
ある。
それぞれ接続されたn型高耐圧MOSトランジス
タ群Nt1〜Ntjを含む集積駆動回路(以下にデー
タ側N−chMOSICという)、61は上記N−
chMOSIC60中に形成されたシフトレジスタで
ある。
70は各データラインY1〜Yjと接続されたダ
イオードから成るダイオードアレイである。この
ダイオードアレイ70は各データラインをそれら
の駆動回路から分離するとともに該駆動回路に含
まれる種々のスイツチング素子への逆バイアスを
保護する。
イオードから成るダイオードアレイである。この
ダイオードアレイ70は各データラインをそれら
の駆動回路から分離するとともに該駆動回路に含
まれる種々のスイツチング素子への逆バイアスを
保護する。
80は予備充電駆動回路、90は電圧引き上げ
充電駆動回路、100は書き込み駆動回路であ
る。
充電駆動回路、100は書き込み駆動回路であ
る。
110は上記走査側N−chMOSIC20および
30用のソース電位切り換え回路であり、この回
路110の出力端子はS4信号がオフ時にアース
電位とされる。
30用のソース電位切り換え回路であり、この回
路110の出力端子はS4信号がオフ時にアース
電位とされる。
第3図に上記したMOSIC20,30,40,
50および60における各MOSトランジスタ並
びに回路80,90,100および110の動作
タイムチヤートを、第4図に第2図のELパネル
10における絵素、即ち、EL表示セルAおよび
Bの対向電極間に印加される電圧を示す。
50および60における各MOSトランジスタ並
びに回路80,90,100および110の動作
タイムチヤートを、第4図に第2図のELパネル
10における絵素、即ち、EL表示セルAおよび
Bの対向電極間に印加される電圧を示す。
上記従来の駆動装置は以下のようにELパネル
10を線順次駆動する。なお、第3図および第4
図に示す期間TX2は絵素Aを含む走査ラインX2
が選択された状態、期間TX3は絵素Bを含む走
査ラインX3が選択された状態であることを示す。
この場合、絵素Aは点灯、絵素Bは非点灯とす
る。また、この明細書において1フイールドとは
ELパネル10の全走査ラインX1〜Xiに対する1
回の線順次駆動が行なわれる期間をいう。
10を線順次駆動する。なお、第3図および第4
図に示す期間TX2は絵素Aを含む走査ラインX2
が選択された状態、期間TX3は絵素Bを含む走
査ラインX3が選択された状態であることを示す。
この場合、絵素Aは点灯、絵素Bは非点灯とす
る。また、この明細書において1フイールドとは
ELパネル10の全走査ラインX1〜Xiに対する1
回の線順次駆動が行なわれる期間をいう。
第1フイールドの動作
第1段階T1:予備充電期間
ソース電位切り換え回路110の出力端子がア
ース電位とされ、走査側N−chMOSIC20およ
び30内のすべてのMOSトランジスタNT1〜
NTiがオンとされる。これと同時に、予備充電
駆動回路80がオンとされ、その出力電圧1/2
VM=30V)がダイオードアレイ70を介して全
データラインY1〜Yjに印加され、当該ELパネル
10全体が充電される。この時、データ側N−
chMOSIC60内の全MOSトランジスタNt1〜
Ntj及び走査側P−chMOSIC40および50内
の全MOSトランジスタPT1〜PTiがオフとされ
る。
ース電位とされ、走査側N−chMOSIC20およ
び30内のすべてのMOSトランジスタNT1〜
NTiがオンとされる。これと同時に、予備充電
駆動回路80がオンとされ、その出力電圧1/2
VM=30V)がダイオードアレイ70を介して全
データラインY1〜Yjに印加され、当該ELパネル
10全体が充電される。この時、データ側N−
chMOSIC60内の全MOSトランジスタNt1〜
Ntj及び走査側P−chMOSIC40および50内
の全MOSトランジスタPT1〜PTiがオフとされ
る。
第2段階T2:放電および電圧引き上げ充電期間
走査側N−chMOSIC20および30内の全
MOSトランジスタNT1〜NTiがオフとされかつ
データ側N−chMOSIC60内の選択データライ
ン、例えばY2と接続されたMOSトランジスタ
Nt2のみがオフのままとされ、他のデータライン
と接続されたMOSトランジスタNt1〜Ntjがオン
に切り換えられる。これと同時に、走査側P−
chMOSIC40および50内の全MOSトランジス
タPT1〜PTiがオンとされる。非選択データライ
ン(Yj≠2)上の各ELセルの充電電荷は、オン
とされるデータ側N−chMOSIC60内のMOSト
ランジスタNt1〜Ntj(Nt2をのぞく)と走査側P
−chMOSIC40および50内の全MOSトランジ
スタPT1〜PTi並びに書き込み駆動回路100内
のダイオード101とから成る接地回路を介して
放電される。
MOSトランジスタNT1〜NTiがオフとされかつ
データ側N−chMOSIC60内の選択データライ
ン、例えばY2と接続されたMOSトランジスタ
Nt2のみがオフのままとされ、他のデータライン
と接続されたMOSトランジスタNt1〜Ntjがオン
に切り換えられる。これと同時に、走査側P−
chMOSIC40および50内の全MOSトランジス
タPT1〜PTiがオンとされる。非選択データライ
ン(Yj≠2)上の各ELセルの充電電荷は、オン
とされるデータ側N−chMOSIC60内のMOSト
ランジスタNt1〜Ntj(Nt2をのぞく)と走査側P
−chMOSIC40および50内の全MOSトランジ
スタPT1〜PTi並びに書き込み駆動回路100内
のダイオード101とから成る接地回路を介して
放電される。
その後、電圧引き上げ充電駆動回路90がオン
とされ、その出力電圧1/2VM=30Vが全走査ラ
インX1〜Xiに印加され、ELパネル10における
全走査側電極の電位が30Vに引き上げられる。こ
の時、走査側N−chMOSIC20および30内の
全MOSトランジスタNT1〜NTiがオフとされる。
この結果、走査ラインX1〜Xiの電位を規準とし
て選択データラインY2の電位は+30V、非選択
データラインYj≠2の電位は−30Vとなる。
とされ、その出力電圧1/2VM=30Vが全走査ラ
インX1〜Xiに印加され、ELパネル10における
全走査側電極の電位が30Vに引き上げられる。こ
の時、走査側N−chMOSIC20および30内の
全MOSトランジスタNT1〜NTiがオフとされる。
この結果、走査ラインX1〜Xiの電位を規準とし
て選択データラインY2の電位は+30V、非選択
データラインYj≠2の電位は−30Vとなる。
第3段階T3:書き込み駆動期間
線順次駆動において選択走査ラインX2と接続
された走査側N−chMOSIC30内のMOSトラン
ジスタNT2のみがオンに切り換えられるととも
に偶数走査ラインのP−chMOSIC50内の全
MOSトランジスタPT2〜PTiがオフとされる。
この時、奇数走査ライン側P−chMOSIC40内
の全MOSトランジスタPT1〜PTi-1がオンとされ
るとともに書き込み駆動回路100がオンとさ
れ、この回路100の出力電圧VW=190Vが奇
数走査ライン側P−chMOSIC40内の全MOSト
ランジスタPT1〜PTi-1を介して全ての奇数走査
ラインX1,X3,X5…に印加され、これらの全奇
数走査ラインの電位が190Vに引き上げられる。
よつて当該ELパネル10の容量結合性に基づき
当該選択走査ラインX2および選択データライン
Y2の交点に相当する絵素Aのデータ側の電位は
VW+1/2VM=220Vに引き上げられる一方、非
選択データライン(Yj≠2)の電位はVW−1/2
VM=160Vに引き上げられる(第4図参照)。
された走査側N−chMOSIC30内のMOSトラン
ジスタNT2のみがオンに切り換えられるととも
に偶数走査ラインのP−chMOSIC50内の全
MOSトランジスタPT2〜PTiがオフとされる。
この時、奇数走査ライン側P−chMOSIC40内
の全MOSトランジスタPT1〜PTi-1がオンとされ
るとともに書き込み駆動回路100がオンとさ
れ、この回路100の出力電圧VW=190Vが奇
数走査ライン側P−chMOSIC40内の全MOSト
ランジスタPT1〜PTi-1を介して全ての奇数走査
ラインX1,X3,X5…に印加され、これらの全奇
数走査ラインの電位が190Vに引き上げられる。
よつて当該ELパネル10の容量結合性に基づき
当該選択走査ラインX2および選択データライン
Y2の交点に相当する絵素Aのデータ側の電位は
VW+1/2VM=220Vに引き上げられる一方、非
選択データライン(Yj≠2)の電位はVW−1/2
VM=160Vに引き上げられる(第4図参照)。
なお、選択走査ラインが奇数走査ラインである
場合には、偶数走査ラインと接続された走査側P
−chMOSIC50内の全てのMOSトランジスタ
PT2〜PTiがオンとされ、よつて全ての偶数走査
ラインの電位が190Vに引き上げられる。
場合には、偶数走査ラインと接続された走査側P
−chMOSIC50内の全てのMOSトランジスタ
PT2〜PTiがオンとされ、よつて全ての偶数走査
ラインの電位が190Vに引き上げられる。
以上、選択走査ラインX2に関する動作を説明
したが、この第1段階から第3段階までの走査を
走査ラインX1からXiに対し順次行なうことによ
つて第1フイールドの駆動が完了する。次いで第
2フイールド駆動が開始される。
したが、この第1段階から第3段階までの走査を
走査ラインX1からXiに対し順次行なうことによ
つて第1フイールドの駆動が完了する。次いで第
2フイールド駆動が開始される。
第2フイールドの動作
第1段階T1′:予備充電期間
この予備充電期間は、上記第1フイールドにお
ける第1段階と同様の操作が行なわれる。
ける第1段階と同様の操作が行なわれる。
第2段階T2′:放電および電圧引き上げ充電期間
走査側N−chMOSIC20および30内の全
MOSトランジスタNT1〜NTiがオフとされると
ともに第1フイールドにおける場合とは逆にデー
タ側N−chMOSIC60における選択データライ
ンY2と接続されたMOSトランジスタNt2のみが
オンとされる一方、他の非選択データラインと接
続されたMOSトランジスタNt1〜Ntj(Nt2を除
く)がオフに切り換えられる。これと同時に、走
査側P−chMOSIC40および50内の全MOSト
ランジスタPT1〜PTiがオンとされる。選択デー
タラインの充電電荷は、データ側N−chMOSIC
60内のオン状態のMOSトランジスタNt2、走
査側P−chMOSIC40および50内の全MOSト
ランジスタPT1〜PTi並びに書き込み駆動回路1
00内のダイオード101により形成される接地
回路を介して放電される。
MOSトランジスタNT1〜NTiがオフとされると
ともに第1フイールドにおける場合とは逆にデー
タ側N−chMOSIC60における選択データライ
ンY2と接続されたMOSトランジスタNt2のみが
オンとされる一方、他の非選択データラインと接
続されたMOSトランジスタNt1〜Ntj(Nt2を除
く)がオフに切り換えられる。これと同時に、走
査側P−chMOSIC40および50内の全MOSト
ランジスタPT1〜PTiがオンとされる。選択デー
タラインの充電電荷は、データ側N−chMOSIC
60内のオン状態のMOSトランジスタNt2、走
査側P−chMOSIC40および50内の全MOSト
ランジスタPT1〜PTi並びに書き込み駆動回路1
00内のダイオード101により形成される接地
回路を介して放電される。
次いで、電圧引き上げ充電駆動回路90がオン
とされ、この回路90の出力電圧1/2VM=30V
が全走査ラインX1〜Xiに印加され、これらの走
査ラインX1〜Xiの電位が30Vに引き上げられる。
この時、走査側N−chMOSIC20および30内
の全MOSトランジスタNT1〜NTiはオフとされ
る。この結果、走査ラインの電位を基準として選
択データラインY2の電位は−30V、非選択デー
タライン(Yj≠2)の電位は+30Vとなる。
とされ、この回路90の出力電圧1/2VM=30V
が全走査ラインX1〜Xiに印加され、これらの走
査ラインX1〜Xiの電位が30Vに引き上げられる。
この時、走査側N−chMOSIC20および30内
の全MOSトランジスタNT1〜NTiはオフとされ
る。この結果、走査ラインの電位を基準として選
択データラインY2の電位は−30V、非選択デー
タライン(Yj≠2)の電位は+30Vとなる。
第3段階T3′:書き込み駆動期間
選択走査ラインX2と接続された走査側P−
chMOSIC50におけるMOSトランジスタPT2の
みがオンとされるとともにその他がオフに切り換
えられる。また、各偶数走査ラインと接続された
走査側N−chMOSIC30における全てのMOSト
ランジスタNT2〜NTiがオフとされ、各奇数走
査ラインと接続された走査側N−chMOSIC20
内の全MOSトランジスタNT1〜NTi−1がオン
に切り換えられる。次いで、書き込み駆動回路1
00に入力されるS31信号およびS32信号に
よつて、この回路100の出力電圧VW+1/2
VMがオン状態のMOSトランジスタPT2を介し
て選択走査ラインX2に印加され、該選択走査ラ
インX2の電位を220Vとする。この時ソース電位
切り換え回路110の出力電圧が1/2VM=30V
に切り換えられ、各奇数走査ラインと接続された
N−chMOSIC20における各MOSトランジスタ
NT1,NT3,NT5…のソース電位が30Vとされ、
これらの奇数走査ラインの電位が+30Vに引き上
げられる。これにより、当該ELパネル10の容
量結合性に基づき選択データラインY2の電位が
−220Vに引き下げられる一方、非選択データラ
インYj≠2の電位は−160Vに引き下げられる
(第4図参照)。
chMOSIC50におけるMOSトランジスタPT2の
みがオンとされるとともにその他がオフに切り換
えられる。また、各偶数走査ラインと接続された
走査側N−chMOSIC30における全てのMOSト
ランジスタNT2〜NTiがオフとされ、各奇数走
査ラインと接続された走査側N−chMOSIC20
内の全MOSトランジスタNT1〜NTi−1がオン
に切り換えられる。次いで、書き込み駆動回路1
00に入力されるS31信号およびS32信号に
よつて、この回路100の出力電圧VW+1/2
VMがオン状態のMOSトランジスタPT2を介し
て選択走査ラインX2に印加され、該選択走査ラ
インX2の電位を220Vとする。この時ソース電位
切り換え回路110の出力電圧が1/2VM=30V
に切り換えられ、各奇数走査ラインと接続された
N−chMOSIC20における各MOSトランジスタ
NT1,NT3,NT5…のソース電位が30Vとされ、
これらの奇数走査ラインの電位が+30Vに引き上
げられる。これにより、当該ELパネル10の容
量結合性に基づき選択データラインY2の電位が
−220Vに引き下げられる一方、非選択データラ
インYj≠2の電位は−160Vに引き下げられる
(第4図参照)。
なお、走査ラインが奇数ラインである場合、走
査側P−chMOSIC40における選択走査ライン
と接続されたMOSトランジスタおよび走査側N
−chMOSIC30における全MOSトランジスタ
NT2〜NTiがオンとされる。
査側P−chMOSIC40における選択走査ライン
と接続されたMOSトランジスタおよび走査側N
−chMOSIC30における全MOSトランジスタ
NT2〜NTiがオンとされる。
上記第1段階から第3段階の操作が全走査ライ
ンX1〜Xiに対して順次行なわれ、これで第2フ
イールドの動作が完了する。
ンX1〜Xiに対して順次行なわれ、これで第2フ
イールドの動作が完了する。
上記従来の駆動装置によれば、選択走査ライン
と選択データラインとの交点に相当するEL表示
セルには予備充電電圧(1/2VM)と書き込み電
圧(VW)の加算電圧(1/2VM+VM=±220V)
が印加される一方、選択走査ラインおよび非選択
データラインの交点に相当するEL表示セルには
書き込み電圧(VW)と予備充電電圧(1/2VM)
の減算電圧(±160V)が印加され、このように
して発光しきい値電圧が約190VとされるEL表示
セルは点灯または非点灯とするように駆動され
る。
と選択データラインとの交点に相当するEL表示
セルには予備充電電圧(1/2VM)と書き込み電
圧(VW)の加算電圧(1/2VM+VM=±220V)
が印加される一方、選択走査ラインおよび非選択
データラインの交点に相当するEL表示セルには
書き込み電圧(VW)と予備充電電圧(1/2VM)
の減算電圧(±160V)が印加され、このように
して発光しきい値電圧が約190VとされるEL表示
セルは点灯または非点灯とするように駆動され
る。
また、第4図から明らかなように、第1フイー
ルドと第2フイールドの2つのフイールドをもつ
てELパネル10は交流駆動される。このように、
第1および第2フイールドでいずれ(走査ライ
ン)においても正・負の書き込みパルスが加えら
れるタイミング関係が同一とされ、予備充電電圧
による直流電圧の影響をも相殺されるようになつ
ている。
ルドと第2フイールドの2つのフイールドをもつ
てELパネル10は交流駆動される。このように、
第1および第2フイールドでいずれ(走査ライ
ン)においても正・負の書き込みパルスが加えら
れるタイミング関係が同一とされ、予備充電電圧
による直流電圧の影響をも相殺されるようになつ
ている。
ところで、上記ELパネル10を用いて文字等
を表示する際、選択走査ライン上に点灯絵素が存
在しない状態となることが度々生じる。例えば、
上記ELパネル10において数行の文章を表示す
る際の行間とか、20行分の表示能力を有する表示
画面に対し数行分が表示に使用されて残りの10数
行分がブランクとされる場合等である。
を表示する際、選択走査ライン上に点灯絵素が存
在しない状態となることが度々生じる。例えば、
上記ELパネル10において数行の文章を表示す
る際の行間とか、20行分の表示能力を有する表示
画面に対し数行分が表示に使用されて残りの10数
行分がブランクとされる場合等である。
このように表示画面における数行分のみが表示
に使用される場合、当該表示画面における非表示
部分の走査ラインを駆動する際、当該選択走査ラ
インと選択データラインとの交点に相当する表示
セルに対し上述した予備充電電圧(30V)および
書き込み電圧(190V)が印加され、可なりの電
力が無駄に消費されるという問題があつた。
に使用される場合、当該表示画面における非表示
部分の走査ラインを駆動する際、当該選択走査ラ
インと選択データラインとの交点に相当する表示
セルに対し上述した予備充電電圧(30V)および
書き込み電圧(190V)が印加され、可なりの電
力が無駄に消費されるという問題があつた。
解決しようとする課題
この発明は、上記問題点を解消するためになさ
れたものであり、ELパネルを線順次駆動するに
あたり、選択走査ライン上に点灯絵素が存在する
かどうかを判別し、点灯絵素が存在しないと判別
されたときには当該選択走査ライン上の各EL表
示セルへの予備充電電圧および書き込み電圧の印
加を阻止し、最小限の消費電力をもつてELパネ
ルの有効な表示を行うようにしたELパネル駆動
装置を提供することを目的とする。
れたものであり、ELパネルを線順次駆動するに
あたり、選択走査ライン上に点灯絵素が存在する
かどうかを判別し、点灯絵素が存在しないと判別
されたときには当該選択走査ライン上の各EL表
示セルへの予備充電電圧および書き込み電圧の印
加を阻止し、最小限の消費電力をもつてELパネ
ルの有効な表示を行うようにしたELパネル駆動
装置を提供することを目的とする。
以下に、この発明を実施例を示す添付図面とと
もに説明する。
もに説明する。
実施例
第5図にはこの発明の一実施例のELパネル駆
動装置のブロツク図を示す。
動装置のブロツク図を示す。
上記ELパネル駆動装置は、第2図の従来形式
の装置と比べて二重の点線で囲んで示される駆動
電圧制御回路140を付加した点が異なり、その
他の構成部分は同一であり、これらの構成部分に
は第2図におけると同一の符号を付してその詳細
な説明を省略する。
の装置と比べて二重の点線で囲んで示される駆動
電圧制御回路140を付加した点が異なり、その
他の構成部分は同一であり、これらの構成部分に
は第2図におけると同一の符号を付してその詳細
な説明を省略する。
第5図において、二重の点線で囲んで示す駆動
電圧制御回路140は選択走査ライン上に点灯絵
素、即ち、表示データが存在するかどうかを判別
する判別回路151と駆動電圧信号阻止回路15
2とから構成される。
電圧制御回路140は選択走査ライン上に点灯絵
素、即ち、表示データが存在するかどうかを判別
する判別回路151と駆動電圧信号阻止回路15
2とから構成される。
判別回路151は3つのリセツト端子R付フリ
ツプフロツプ141,142および143とイン
バータ144とから構成される。フリツプフロツ
プ141のQ出力端子はフリツプフロツプ142
のD入力端子と接続され、該フリツプフロツプ1
42のQ出力端子はフリツプフロツプ143のD
入力端子と接続される。フリツプフロツプ141
のクロツク端子CLに図示しない表示制御回路か
ら表示データ信号が入力されるとともにリセツト
端子Rにリセツト信号が入力される一方、上記表
示制御回路からインバータ144を介して2段目
のフリツプフロツプ142のクロツク端子CLお
よび最終段のフリツプフロツプ143のクロツク
端子CLに当該表示データの有効期間を表わす信
号HDが入力されるようになつている。この構成
により、判別回路151は表示制御回路からEL
パネル10に表示すべき表示データ信号、即ち、
各走査ラインにおける絵素の点灯または非点灯を
表わすデータ信号、リセツト信号および当該表示
データの有効期間を表わす信号を受けて次の駆動
すべき走査ライン、即ち、選択走査ライン上に点
灯絵素が存在するかどうかを判定する。次の走査
ライン上に点灯絵素が1つでも存在する場合には
該走査ラインの駆動、すなわち、選択時に出力端
子Q3に“1”を、全く存在しない場合には該出
力端子Q3に“0”を出力するようになつている。
ツプフロツプ141,142および143とイン
バータ144とから構成される。フリツプフロツ
プ141のQ出力端子はフリツプフロツプ142
のD入力端子と接続され、該フリツプフロツプ1
42のQ出力端子はフリツプフロツプ143のD
入力端子と接続される。フリツプフロツプ141
のクロツク端子CLに図示しない表示制御回路か
ら表示データ信号が入力されるとともにリセツト
端子Rにリセツト信号が入力される一方、上記表
示制御回路からインバータ144を介して2段目
のフリツプフロツプ142のクロツク端子CLお
よび最終段のフリツプフロツプ143のクロツク
端子CLに当該表示データの有効期間を表わす信
号HDが入力されるようになつている。この構成
により、判別回路151は表示制御回路からEL
パネル10に表示すべき表示データ信号、即ち、
各走査ラインにおける絵素の点灯または非点灯を
表わすデータ信号、リセツト信号および当該表示
データの有効期間を表わす信号を受けて次の駆動
すべき走査ライン、即ち、選択走査ライン上に点
灯絵素が存在するかどうかを判定する。次の走査
ライン上に点灯絵素が1つでも存在する場合には
該走査ラインの駆動、すなわち、選択時に出力端
子Q3に“1”を、全く存在しない場合には該出
力端子Q3に“0”を出力するようになつている。
駆動電圧信号阻止回路152は4つの2入力ア
ンドゲート146,147,148および149
を用いて構成される。各アンドゲート146〜1
49の一方の入力端子は共通に上記判別回路15
1の出力端子Q3と接続され、これらのアンドゲ
ートの他方の入力端子は上記表示制御回路と接続
されてそれぞれ予備充電指令信号S1、電圧引き
上げ充電指令信号S2、書き込み指令信号S31
およびソース電位切り換え指令信号S4が入力さ
れるようになつている。この構成により、上記判
別回路151の出力が“0”、即ち選択走査ライ
ン上に点灯絵素が全く存在しない場合、全てのア
ンドゲート146〜149を閉じて信号S1,S
2,S31およびS4を遮断し、ELパネル10
における選択走査ライン上の各EL表示セルに対
する予備充電電圧(1/2VM=30V)および書
き込み電圧(VW=190V)の印加を阻止する。
ンドゲート146,147,148および149
を用いて構成される。各アンドゲート146〜1
49の一方の入力端子は共通に上記判別回路15
1の出力端子Q3と接続され、これらのアンドゲ
ートの他方の入力端子は上記表示制御回路と接続
されてそれぞれ予備充電指令信号S1、電圧引き
上げ充電指令信号S2、書き込み指令信号S31
およびソース電位切り換え指令信号S4が入力さ
れるようになつている。この構成により、上記判
別回路151の出力が“0”、即ち選択走査ライ
ン上に点灯絵素が全く存在しない場合、全てのア
ンドゲート146〜149を閉じて信号S1,S
2,S31およびS4を遮断し、ELパネル10
における選択走査ライン上の各EL表示セルに対
する予備充電電圧(1/2VM=30V)および書
き込み電圧(VW=190V)の印加を阻止する。
次に、上記構成のELパネル駆動装置の動作を
第6図のタイムチヤートを用いて説明する。
第6図のタイムチヤートを用いて説明する。
第5図に示すELパネル10において走査ライ
ンX2上の絵素Aが点灯され、次の走査ラインX3
上には点灯絵素が全く存在しないものとする。ま
た、走査ラインX1上には点灯絵素が存在し、し
たがつてフリツプフロツプ142および143の
出力Q2およびQ3が“1”の状態にあるとする。
ンX2上の絵素Aが点灯され、次の走査ラインX3
上には点灯絵素が全く存在しないものとする。ま
た、走査ラインX1上には点灯絵素が存在し、し
たがつてフリツプフロツプ142および143の
出力Q2およびQ3が“1”の状態にあるとする。
いま、走査ラインX1が駆動、即ち、走査ライ
ンX1の選択された状態にあるとする。この走査
ラインX1の選択期間において、図示しない表示
制御回路から次の走査ラインX2に関する表示デ
ータ信号(点灯“1”、非点灯“0”)が判別回路
151のフリツプフロツプ141のクロツク端子
CLに入力される。該表示データ信号に点灯信号
“1”が1つでも存在する場合、フリツプフロツ
プ141の出力Q1が“1”となる。走査ライン
X2には点灯絵素Aが存在するフリツプフロツプ
141の出力Q1が“1”とされる。
ンX1の選択された状態にあるとする。この走査
ラインX1の選択期間において、図示しない表示
制御回路から次の走査ラインX2に関する表示デ
ータ信号(点灯“1”、非点灯“0”)が判別回路
151のフリツプフロツプ141のクロツク端子
CLに入力される。該表示データ信号に点灯信号
“1”が1つでも存在する場合、フリツプフロツ
プ141の出力Q1が“1”となる。走査ライン
X2には点灯絵素Aが存在するフリツプフロツプ
141の出力Q1が“1”とされる。
次に、データ有効期間信号HDの立ち下がり
時、したがつて該HD信号の反転信号の立ち
上がり時にフリツプフロツプ142のクロツク端
子CLに信号“1”が印加される。この時、フリ
ツプフロツプ142の出力Q2は“1”に保持さ
れる。
時、したがつて該HD信号の反転信号の立ち
上がり時にフリツプフロツプ142のクロツク端
子CLに信号“1”が印加される。この時、フリ
ツプフロツプ142の出力Q2は“1”に保持さ
れる。
次いで、HD信号が“0”の期間中に上記表示
制御回路から判別回路151のフリツプフロツプ
141にリセツト信号が印加され、該リセツト信
号の立ち下りにより出力Q1が“0”に切り換わ
る。
制御回路から判別回路151のフリツプフロツプ
141にリセツト信号が印加され、該リセツト信
号の立ち下りにより出力Q1が“0”に切り換わ
る。
このように、走査ラインX1の選択期間中、判
別回路151の出力Q3は“1”に保持される。
よつて駆動電圧信号阻止回路152の各アンドゲ
ート146〜149は上記表示制御回路からそれ
ぞれ予備充電指令信号S1、電圧引き上げ充電指
令信号S2、書き込み指令信号S31およびソー
ス電位切り換え指令信号S4を回路80,90,
100および110に入力する。よつて、当該走
査ラインX1に対し第2図の従来の駆動装置にお
けると同様に第1〜第3段階が実行される。
別回路151の出力Q3は“1”に保持される。
よつて駆動電圧信号阻止回路152の各アンドゲ
ート146〜149は上記表示制御回路からそれ
ぞれ予備充電指令信号S1、電圧引き上げ充電指
令信号S2、書き込み指令信号S31およびソー
ス電位切り換え指令信号S4を回路80,90,
100および110に入力する。よつて、当該走
査ラインX1に対し第2図の従来の駆動装置にお
けると同様に第1〜第3段階が実行される。
その後、上記HD信号が判別回路151に印加
され、即ち次の走査ラインX2の駆動が開始され
る。これと同時に、上記表示制御回路から判別回
路151に次の走査ラインX3に関する表示デー
タ信号が入力される。この走査ラインX3上には
点灯絵素が全く存在せず、したがつてフリツプフ
ロツプ141のクロツク端子CLには“1”信号
が入力されず、その出力Q1は元の状態、即ち、
“0”とされる。また、フリツプフロツプ142
および143の出力Q2およびQ3も元の状態Q
2=Q3=“1”を保持する。
され、即ち次の走査ラインX2の駆動が開始され
る。これと同時に、上記表示制御回路から判別回
路151に次の走査ラインX3に関する表示デー
タ信号が入力される。この走査ラインX3上には
点灯絵素が全く存在せず、したがつてフリツプフ
ロツプ141のクロツク端子CLには“1”信号
が入力されず、その出力Q1は元の状態、即ち、
“0”とされる。また、フリツプフロツプ142
および143の出力Q2およびQ3も元の状態Q
2=Q3=“1”を保持する。
次いで、上記信号HDが立ち下ると、該信号
HDがインバータ144により反転され、この反
転信号がフリツプフロツプ142のクロツク
端子CLに入力される。これにより、フリツプフ
ロツプ142の出力Q2は“0”に切り換えられ
る。これは次ぎの走査ラインX3上に点灯絵素が
全く存在しないことを表す。
HDがインバータ144により反転され、この反
転信号がフリツプフロツプ142のクロツク
端子CLに入力される。これにより、フリツプフ
ロツプ142の出力Q2は“0”に切り換えられ
る。これは次ぎの走査ラインX3上に点灯絵素が
全く存在しないことを表す。
その後、走査ラインX1の選択時と同様、フリ
ツプフロツプ141のリセツト端子Rにリセツト
信号が印加されるが、その出力Q1は“0”であ
り、したがつてその状態“0”に出力Q1が保持
される。このQ1=Q2=“0”およびQ3=
“1”は次のHD信号の立ち上りまで、即ち次の
走査ラインX3の駆動が開始されるまで保持され
る。
ツプフロツプ141のリセツト端子Rにリセツト
信号が印加されるが、その出力Q1は“0”であ
り、したがつてその状態“0”に出力Q1が保持
される。このQ1=Q2=“0”およびQ3=
“1”は次のHD信号の立ち上りまで、即ち次の
走査ラインX3の駆動が開始されるまで保持され
る。
このように走査ラインX2の駆動時、判別回路
151の出力Q3は“1”とされ、よつて当該走
査ラインX2は上述した走査ラインX1に対する操
作と同様にして駆動される。この様子を第7図お
よび第8図に示す。なお、第7図において、各
MOSIC20,30,40,50および60の動
作は第3図におけると同様であり、これらの
MOSICの動作の説明を省略する。
151の出力Q3は“1”とされ、よつて当該走
査ラインX2は上述した走査ラインX1に対する操
作と同様にして駆動される。この様子を第7図お
よび第8図に示す。なお、第7図において、各
MOSIC20,30,40,50および60の動
作は第3図におけると同様であり、これらの
MOSICの動作の説明を省略する。
第8図から明らかなように、走査ラインX2お
よびデータラインY2の選択時、判別回路151
の出力Q3が“1”とされ、したがつて全てのア
ンドゲート146〜149が開とされ、よつて予
備充電指令信号S1、電圧引き上げ充電指令信号
S2、書き込み指令信号S31およびソース電位
切り換え指令信号S4がそれぞれ回路80,9
0,100および110に印加され、当該絵素A
には予備充電電圧(30V)および書き込み電圧
(190V)が印加される。よつて、第1フイールド
においては1/2VM+VW=220Vが絵素Aに印
加されて点灯するとともに第2フイールドにおい
ては−220Vが印加されて点灯する。
よびデータラインY2の選択時、判別回路151
の出力Q3が“1”とされ、したがつて全てのア
ンドゲート146〜149が開とされ、よつて予
備充電指令信号S1、電圧引き上げ充電指令信号
S2、書き込み指令信号S31およびソース電位
切り換え指令信号S4がそれぞれ回路80,9
0,100および110に印加され、当該絵素A
には予備充電電圧(30V)および書き込み電圧
(190V)が印加される。よつて、第1フイールド
においては1/2VM+VW=220Vが絵素Aに印
加されて点灯するとともに第2フイールドにおい
ては−220Vが印加されて点灯する。
次いで、上記HD信号が判別回路151のフリ
ツプフロツプ143のクロツク端子CLに入力さ
れて次の走査ラインX3の駆動が開始されると、
該フリツプフロツプ143の出力Q3が“0”に
切り換えられる。この出力Q3=“0”は走査ラ
インX2の選択期間における判別結果、即ち、当
該走査ラインX3上に点灯絵素が全く存在しない
ことを示す。これと同時に、前述の走査ライン
X1およびX2の選択時におけると同様にして、上
記表示制御回路から次の走査ラインX4に関する
表示データ信号が判別回路151に入力され、前
述の動作と同様にしてデータ判別を行う。そし
て、次のHD信号の立ち上り、即ち、走査ライン
X4の駆動が開始されるまで当該判別回路151
の出力Q3は“0”に保持される。
ツプフロツプ143のクロツク端子CLに入力さ
れて次の走査ラインX3の駆動が開始されると、
該フリツプフロツプ143の出力Q3が“0”に
切り換えられる。この出力Q3=“0”は走査ラ
インX2の選択期間における判別結果、即ち、当
該走査ラインX3上に点灯絵素が全く存在しない
ことを示す。これと同時に、前述の走査ライン
X1およびX2の選択時におけると同様にして、上
記表示制御回路から次の走査ラインX4に関する
表示データ信号が判別回路151に入力され、前
述の動作と同様にしてデータ判別を行う。そし
て、次のHD信号の立ち上り、即ち、走査ライン
X4の駆動が開始されるまで当該判別回路151
の出力Q3は“0”に保持される。
このようにして、走査ラインX3の選択期間に
おける判別回路151および駆動電圧信号阻止回
路152の様子を第7図および第8図に示す。第
7図に示すように、走査ラインX3の選択時、即
ち、絵素Bの駆動時に判別回路151の出力Q3
が“0”とされ、駆動電圧信号阻止回路152の
全てのアンドゲート146〜149が閉じられ、
上記信号S1,S2,S31およびS4が回路8
0,90,100および110に印加されるのが
阻止される。この結果、第8図に示すように、当
該選択走査ラインX3上の絵素Bおよび非選択走
査ライン上の絵素Aには第1フイールドおよび第
2フイールドのいずれにおいても予備充電電圧
(30V)および書き込み電圧の印加が阻止される。
その後、走査ラインX4,5…Xiが線順次駆動され
る。この動作は上述したと同様にして行なわれ、
その説明を省略する。
おける判別回路151および駆動電圧信号阻止回
路152の様子を第7図および第8図に示す。第
7図に示すように、走査ラインX3の選択時、即
ち、絵素Bの駆動時に判別回路151の出力Q3
が“0”とされ、駆動電圧信号阻止回路152の
全てのアンドゲート146〜149が閉じられ、
上記信号S1,S2,S31およびS4が回路8
0,90,100および110に印加されるのが
阻止される。この結果、第8図に示すように、当
該選択走査ラインX3上の絵素Bおよび非選択走
査ライン上の絵素Aには第1フイールドおよび第
2フイールドのいずれにおいても予備充電電圧
(30V)および書き込み電圧の印加が阻止される。
その後、走査ラインX4,5…Xiが線順次駆動され
る。この動作は上述したと同様にして行なわれ、
その説明を省略する。
以上に説明したように上記構成の駆動装置によ
れば、選択走査ライン上に点灯絵素が全く存在し
ないときには駆動電圧信号制御回路140により
ELパネル10における当該走査ライン上の各非
点灯EL表示セルに予備充電電圧および書き込み
電圧が無駄に印加されるのを阻止し、必要最小限
の消費電力をもつて当該ELパネルにおける表示
を行うことができる。
れば、選択走査ライン上に点灯絵素が全く存在し
ないときには駆動電圧信号制御回路140により
ELパネル10における当該走査ライン上の各非
点灯EL表示セルに予備充電電圧および書き込み
電圧が無駄に印加されるのを阻止し、必要最小限
の消費電力をもつて当該ELパネルにおける表示
を行うことができる。
また、上記駆動装置は何ら支障もなく2つの第
1および第2フイールドをもつて交流駆動を行う
ことができ、ELパネル10の各EL表示セルには
略同レベルで異極性の電圧が印加される。よつて
従来の駆動方式におけると同様に当該ELパネル
10の発光機能の劣化を有効に抑制することがで
きる。
1および第2フイールドをもつて交流駆動を行う
ことができ、ELパネル10の各EL表示セルには
略同レベルで異極性の電圧が印加される。よつて
従来の駆動方式におけると同様に当該ELパネル
10の発光機能の劣化を有効に抑制することがで
きる。
効 果
以上に説明したことから明らかなように、この
発明によれば、複数の容量性EL表示セルをマト
リツクス状に配置してなるELパネルにおける各
行の走査側電極群を線順次走査し、表示データに
応じて選択走査ライン上のEL表示セルに予備充
電電圧および書き込み電圧を印加することにより
該表示データに該当する表示セルを点灯させて画
像を表示するにあたり、判別回路により選択走査
ライン上に点灯絵素が全く存在しないと判定され
たときには駆動電圧信号阻止回路により当該選択
走査ライン上の各EL表示セルへの予備充電電圧
および書き込み電圧の印加を阻止するようにした
から、非点灯とされる走査ラインに対して不要な
電圧が印加されることがなく、最小限の消費電力
をもつてELパネルの表示駆動を行うことができ
る。
発明によれば、複数の容量性EL表示セルをマト
リツクス状に配置してなるELパネルにおける各
行の走査側電極群を線順次走査し、表示データに
応じて選択走査ライン上のEL表示セルに予備充
電電圧および書き込み電圧を印加することにより
該表示データに該当する表示セルを点灯させて画
像を表示するにあたり、判別回路により選択走査
ライン上に点灯絵素が全く存在しないと判定され
たときには駆動電圧信号阻止回路により当該選択
走査ライン上の各EL表示セルへの予備充電電圧
および書き込み電圧の印加を阻止するようにした
から、非点灯とされる走査ラインに対して不要な
電圧が印加されることがなく、最小限の消費電力
をもつてELパネルの表示駆動を行うことができ
る。
また、この発明は交流駆動方式のELパネル駆
動装置として何ら支障もなく使用することができ
る。
動装置として何ら支障もなく使用することができ
る。
第1図は本発明を適用できる二重絶縁型容量性
ELパネルの一部切欠部分斜視図、第2図は第1
図のELパネルを駆動するための従来の駆動装置
の概略回路図、第3図は第2図の装置における主
要構成部分の動作タイミングを示すタイムチヤー
ト、第4図は第2図のELパネルにおける点灯絵
素Aおよび非点灯絵素Bに印加される電圧を示す
グラフ、第5図は本発明の一実施例のELパネル
駆動装置の概略回路図、第6図は第5図の装置に
おける駆動電圧信号制御回路の動作タイミングを
示すタイムチヤート、第7図は第5図の装置にお
ける主要構成部分の動作タイミングを示すタイム
チヤート、第8図は第5図のELパネルにおける
点灯絵素Aおよび非点灯絵素Bに印加される電圧
を示すグラフである。 10……ELパネル(容量性薄膜EL表示装置)、
20,30……走査側N−ch集積駆動回路(走
査側N−chMOSIC)、21,31……シフトレジ
スタ、40,50……走査側P−ch集積駆動回
路、41,51……シフトレジスタ、60……デ
ータ側N−ch集積駆動回路(データ側N−
chMOSIC)、61……シフトレジスタ、70……
ダイオードアレイ、80……予備充電駆動回路、
90……電圧引き上げ充電駆動回路、100……
書き込み駆動回路、110……ソース電位切り換
え回路、140……データ判別及び駆動電圧信号
制御回路、141〜143……フリツプフロツ
プ、144……インバータ、146〜149……
アンドゲート、151……判別回路、152……
駆動電圧信号阻止回路。
ELパネルの一部切欠部分斜視図、第2図は第1
図のELパネルを駆動するための従来の駆動装置
の概略回路図、第3図は第2図の装置における主
要構成部分の動作タイミングを示すタイムチヤー
ト、第4図は第2図のELパネルにおける点灯絵
素Aおよび非点灯絵素Bに印加される電圧を示す
グラフ、第5図は本発明の一実施例のELパネル
駆動装置の概略回路図、第6図は第5図の装置に
おける駆動電圧信号制御回路の動作タイミングを
示すタイムチヤート、第7図は第5図の装置にお
ける主要構成部分の動作タイミングを示すタイム
チヤート、第8図は第5図のELパネルにおける
点灯絵素Aおよび非点灯絵素Bに印加される電圧
を示すグラフである。 10……ELパネル(容量性薄膜EL表示装置)、
20,30……走査側N−ch集積駆動回路(走
査側N−chMOSIC)、21,31……シフトレジ
スタ、40,50……走査側P−ch集積駆動回
路、41,51……シフトレジスタ、60……デ
ータ側N−ch集積駆動回路(データ側N−
chMOSIC)、61……シフトレジスタ、70……
ダイオードアレイ、80……予備充電駆動回路、
90……電圧引き上げ充電駆動回路、100……
書き込み駆動回路、110……ソース電位切り換
え回路、140……データ判別及び駆動電圧信号
制御回路、141〜143……フリツプフロツ
プ、144……インバータ、146〜149……
アンドゲート、151……判別回路、152……
駆動電圧信号阻止回路。
Claims (1)
- 【特許請求の範囲】 1 対向電極間にEL発光層を挾み込んで成る複
数のEL表示セルをマトリツクス状に配置して表
示画面を形成したELパネルにおける各行のEL表
示セル群の走査ラインに線順次に予備充電電圧を
印加する回路、 上記ELパネルに対する表示データに基づき書
き込み絵素を含む走査ライン上のEL表示セル群
に書き込み電圧を印加する回路、 上記表示データに基づき走査ライン上に点灯絵
素が存在するかどうかを判別する回路、および 上記走査ライン上に点灯絵素が全く存在しない
ときに該走査ラインの選択時に上記予備充電電圧
および書き込み電圧の印加を阻止する回路 を具備することを特徴とするELパネル駆動装置。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60230659A JPS6289090A (ja) | 1985-10-15 | 1985-10-15 | Elパネル駆動装置 |
GB8623943A GB2183385B (en) | 1985-10-15 | 1986-10-06 | Electroluminescent panel driving system |
DE19863634686 DE3634686A1 (de) | 1985-10-15 | 1986-10-11 | Steuersystem fuer eine elektrolumineszierende bildanzeige |
US06/918,902 US4823121A (en) | 1985-10-15 | 1986-10-15 | Electroluminescent panel driving system for driving the panel's electrodes only when non-blank data is present to conserve power |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60230659A JPS6289090A (ja) | 1985-10-15 | 1985-10-15 | Elパネル駆動装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6289090A JPS6289090A (ja) | 1987-04-23 |
JPH0569433B2 true JPH0569433B2 (ja) | 1993-10-01 |
Family
ID=16911274
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60230659A Granted JPS6289090A (ja) | 1985-10-15 | 1985-10-15 | Elパネル駆動装置 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4823121A (ja) |
JP (1) | JPS6289090A (ja) |
DE (1) | DE3634686A1 (ja) |
GB (1) | GB2183385B (ja) |
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JP2527820B2 (ja) * | 1989-08-14 | 1996-08-28 | 株式会社テック | 端面発光型elプリンタ |
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-
1985
- 1985-10-15 JP JP60230659A patent/JPS6289090A/ja active Granted
-
1986
- 1986-10-06 GB GB8623943A patent/GB2183385B/en not_active Expired - Lifetime
- 1986-10-11 DE DE19863634686 patent/DE3634686A1/de active Granted
- 1986-10-15 US US06/918,902 patent/US4823121A/en not_active Expired - Lifetime
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---|---|
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US4823121A (en) | 1989-04-18 |
GB2183385A (en) | 1987-06-03 |
DE3634686A1 (de) | 1987-04-23 |
GB8623943D0 (en) | 1986-11-12 |
JPS6289090A (ja) | 1987-04-23 |
DE3634686C2 (ja) | 1990-01-25 |
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