JPH0556645B2 - - Google Patents

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JPH0556645B2
JPH0556645B2 JP59079507A JP7950784A JPH0556645B2 JP H0556645 B2 JPH0556645 B2 JP H0556645B2 JP 59079507 A JP59079507 A JP 59079507A JP 7950784 A JP7950784 A JP 7950784A JP H0556645 B2 JPH0556645 B2 JP H0556645B2
Authority
JP
Japan
Prior art keywords
mask
exposure
semiconductor substrate
alignment
alignment method
Prior art date
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Expired - Lifetime
Application number
JP59079507A
Other languages
English (en)
Other versions
JPS60224224A (ja
Inventor
Katsumi Suzuki
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP59079507A priority Critical patent/JPS60224224A/ja
Publication of JPS60224224A publication Critical patent/JPS60224224A/ja
Publication of JPH0556645B2 publication Critical patent/JPH0556645B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F9/00Registration or positioning of originals, masks, frames, photographic sheets or textured or patterned surfaces, e.g. automatically
    • G03F9/70Registration or positioning of originals, masks, frames, photographic sheets or textured or patterned surfaces, e.g. automatically for microlithography

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は、半導体装置の製造工程に於いて使用
するマスクアライメント方法に関するものであ
る。
(従来技術とその問題点) 従来、縮小投影型光露光法によるパターン形成
工程に於いては、レチクル上に形成したパターン
を、半導体基板上の所定の位置に精度良く転写す
る為に該半導体基板の位置を高精度に制御しなが
ら、ステツプ・アンド・リピート露光を行なう方
法が一般的である。上記の方法で半導体基板上に
所望のマスクパターンをステツプ・アンド・リピ
ート露光する場合、一般に第1図に示すように半
導体基板11の外周近傍には、パターン12を形
成しない空白領域13が生ずる。これは一般に、
半導体基板の外周近傍は、半導体装置の製造工程
に於いて種々の治具等と接触する為に傷つき易い
為であるが、従来の縮小投影型光露光装置に於い
ては、一般に1ステツプ当りの露光領域が、数mm
角ないし十mm角程度と比較的小さく、半導体基板
の外周近傍に生ずる余白領域を比較的小さく抑え
ることが可能である為、従来は余り問題にならな
かつた。ところが近年縮小投影型光露光の生産性
を高める為に、1ステツプ当りの露光面積を十数
mm角ないし20mm角程度まで拡大した露光装置が開
発され、一般に使用されるようになつた。また超
微細パターンの高精度転写技術として注目されて
いるX線露光に於いても1ステツプ当りの露光面
積を約10mm角ないし30mm角としたステツプ・アン
ド・リピート露光装置が開発されている。上記ご
とき露光装置に於いては、第2図に示すように1
ステツプの露光領域21の中にチツプパターン2
2とアライメントマーク23を複数個形成するの
が一般的である。この場合第3図の露光例に示す
ように、半導体基板31の周辺部の余白領域32
に於いては、チツプパターン33を形成する余裕
が十分有るにもかかわらず露光マスクの外周端近
傍に形成さないるアライメントマーク34が半導
体基板31の外にはみ出してしまう為にマスクア
ライメントが行なえず、多大な余白領域を生じて
しまい、半導体基板の利用効率及び生産性を低下
させる一因となつていた。
(発明の目的) 本発明の目的は上記のごとき従来のマスクアラ
イメント方法の欠点を改良し、半導体基板のほぼ
全域を有効に利用できるマスクアライメント方法
を提供することである。
(発明の構成) 本発明によれば可視光および光学レンズ系を用
いたマスクアライメント方法に於いて、4系統以
上の光学レンズ系と該レンズ系の各々に対応して
設けたアライメントマークを有するマスクを用
い、前記光学レンズ系およびアライメントマーク
の中から任意の2系統の組合せを用いて行なうこ
とを特徴とするマスクアライメント方法が得られ
る。
(構成の詳細な説明) 以下、本発明の詳細を図面を用いて説明する。
本発明のマスクアライメント方法に於いては4
系統のアライメント用光学系と、これに対応して
設けた4つのアライメントマークを有するマスク
を用いる。
第4図は、本発明のマスクアライメント方法に
用いるマスクの主要部分を抜き出して模式的に示
したもので、41はチツプパターン、42はアラ
イメントマークをそれぞれ示す。
第5図は、本発明のマスクアライメント方法に
よるステツプ・アンド・リピート露光の一実施例
を模式的に示したものである。従来、第3図に示
した半導体基板の空白領域32にチツプパターン
の形成が出来なかつたが、本発明のマスクアライ
メント方法に於いては、パターンを転写する基板
の形状に応じて、第4図に示した4つのアライメ
ントマーク42の中、任意の2個のアライメント
マークを用いてマスクアライメントを行なう為、
第5図に示すように半導体基板51の全面にむだ
無くチツプ52が形成できる。
(発明の効果) 本発明のマスクアライメント方法によれば、同
一寸法の半導体基板上に同一寸法のチツプパター
ンを露光する場合、従来方法に比べてチツプが10
%以上多く形成でき、半導体装置の生産性の向上
および低価格化をもたらすことができる。
【図面の簡単な説明】
第1図は、従来のステツプ・アンド・リピート
露光による半導体基板上のチツプパターン形成領
域を示す概略平面図、第2図は、大口径レチクル
又はX線露光マスク上の一般的パターン配列を示
す模式的平面図、第3図は大口径レチクルを用い
たステツプ・アンド・リピート光露光又は一般的
ステツプ・アンド・リピート型X線露光による半
導体基板上のチツプ・パターン形成領域を示す模
式的平面図、第4図は本発明のマスクアライメン
ト方法に於いて用いるマスクの主要部分を抜き出
して示した模式的平面図、第5図は本発明のマス
クアライメント方法を用いたステツプ・アンド・
リピートX線露光による半導体基板上のチツプパ
ターン形成状態を示す模式的平面図である。 図中各番号はそれぞれ次のものを示す。11,
31,51……半導体基板、12,22,33,
41,52……チツプパターン形成領域、13,
32……空白領域、23,34,42……アライ
メントマーク。

Claims (1)

    【特許請求の範囲】
  1. 1 可視光および光学レンズ系を用いたマスクア
    ライメント方法に於いて、4系統以上の光学レン
    ズ系と該レンズ系の各々に対応して設けたアライ
    メントマークを有するマスクを用い、前記光学レ
    ンズ系およびアライメントマークの中から任意の
    2系統の組合せを用いて行なうことを特徴とする
    マスクアライメント方法。
JP59079507A 1984-04-20 1984-04-20 マスクアライメント方法 Granted JPS60224224A (ja)

Priority Applications (1)

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JP59079507A JPS60224224A (ja) 1984-04-20 1984-04-20 マスクアライメント方法

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JP59079507A JPS60224224A (ja) 1984-04-20 1984-04-20 マスクアライメント方法

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JPS60224224A JPS60224224A (ja) 1985-11-08
JPH0556645B2 true JPH0556645B2 (ja) 1993-08-20

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61166026A (ja) * 1984-12-19 1986-07-26 Fujitsu Ltd 位置合わせ方法
US5451261A (en) * 1992-09-11 1995-09-19 Matsushita Electric Industrial Co., Ltd. Metal film deposition apparatus and metal film deposition method

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS53132271A (en) * 1977-04-20 1978-11-17 Thomson Csf Thin semiconductor plate* method of positioning pattern projected to said plate in projector* and projector

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JPS60224224A (ja) 1985-11-08

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