JPH05244141A - フレーム同期方式 - Google Patents
フレーム同期方式Info
- Publication number
- JPH05244141A JPH05244141A JP4044256A JP4425692A JPH05244141A JP H05244141 A JPH05244141 A JP H05244141A JP 4044256 A JP4044256 A JP 4044256A JP 4425692 A JP4425692 A JP 4425692A JP H05244141 A JPH05244141 A JP H05244141A
- Authority
- JP
- Japan
- Prior art keywords
- frame
- signal
- circuit
- frame synchronization
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Time-Division Multiplex Systems (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】
【構成】入力される誤り訂正符号を含む第１のフレーム
多重信号を復号器に供給してフレーム同期信号を生成す
る際に同期確立判定を行うフレーム同期回路を有するフ
レーム同期方式において、第１のフレーム多重信号を所
定時間ｔだけ遅延させる遅延回路６と、この遅延回路６
により所定の遅延を受けた第２のフレーム多重信号およ
び前記第１のフレーム多重信号を入力してフレーム同期
確立の判定を行う。 【効果】伝送効率の低下を招くことなくフレーム同期確
立の信頼度を向上することができる。
多重信号を復号器に供給してフレーム同期信号を生成す
る際に同期確立判定を行うフレーム同期回路を有するフ
レーム同期方式において、第１のフレーム多重信号を所
定時間ｔだけ遅延させる遅延回路６と、この遅延回路６
により所定の遅延を受けた第２のフレーム多重信号およ
び前記第１のフレーム多重信号を入力してフレーム同期
確立の判定を行う。 【効果】伝送効率の低下を招くことなくフレーム同期確
立の信頼度を向上することができる。
Description
【０００１】
【産業上の利用分野】本発明はブロック符号を用いた誤
り訂正符号およびフレーム同期信号を有するディジタル
信号系において複数のフレームから検出されるフレーム
同期信号判定を効率的に行うフレーム同期方式に関す
る。
り訂正符号およびフレーム同期信号を有するディジタル
信号系において複数のフレームから検出されるフレーム
同期信号判定を効率的に行うフレーム同期方式に関す
る。
【０００２】
【従来の技術】従来のフレーム同期方式は、同期多重お
よび分離化に使用するフレーム同期信号、及び、誤り訂
正に用いる付加ビット等を多重化した１系列の多重化デ
ィジタル信号をフレーム同期回路へ入力し、多重化信号
から検出されたフレーム同期信号を直列的に複数フレー
ムにわたり順次監視を行い、複数個のフレームにわたり
フレーム同期符号が基準フレーム符号パターンと合致し
ていれば（後方保護）、このフレーム同期によりフレー
ム同期を確立する。その後、フレーム同期信号を基に誤
り訂正を実行していた。
よび分離化に使用するフレーム同期信号、及び、誤り訂
正に用いる付加ビット等を多重化した１系列の多重化デ
ィジタル信号をフレーム同期回路へ入力し、多重化信号
から検出されたフレーム同期信号を直列的に複数フレー
ムにわたり順次監視を行い、複数個のフレームにわたり
フレーム同期符号が基準フレーム符号パターンと合致し
ていれば（後方保護）、このフレーム同期によりフレー
ム同期を確立する。その後、フレーム同期信号を基に誤
り訂正を実行していた。
【０００３】従来の回路構成は図２に示すように、復調
器（図示せず）からのフレーム同期信号及び誤り訂正に
用いる付加ビットを多重した１系列の多重化信号１０１
を誤り訂正復号器１，フレーム同期回路４に入力する。
誤り訂正復号器１は演算回路２，遅延回路３，誤り訂正
回路５より構成される。ここでフレーム同期回路４は図
３に示す信号フォーマットに示すように、１系列の多重
化信号１０１に付加されたフレーム同期信号Ｆ１〜Ｆ６
を直列的に複数個のフレームを順次監視することにより
同期を確立する。例えば図３のτ時間内にＦ１〜Ｆ６の
６個のフレーム同期パターンが基準フレームパターンと
一致していれば同期確立と判定する。この同期確立され
たフレーム同期信号１０２は誤り訂正復号器１の中の演
算回路２を制御し、誤り訂正信号１０３を誤り訂正回路
５に出力する。誤り訂正回路５では、遅延回路３によっ
て演算回路２の演算時間分遅らせた多重化信号１０１Ａ
を入力して誤り訂正を行った出力信号１０４を後段へ出
力していた。
器（図示せず）からのフレーム同期信号及び誤り訂正に
用いる付加ビットを多重した１系列の多重化信号１０１
を誤り訂正復号器１，フレーム同期回路４に入力する。
誤り訂正復号器１は演算回路２，遅延回路３，誤り訂正
回路５より構成される。ここでフレーム同期回路４は図
３に示す信号フォーマットに示すように、１系列の多重
化信号１０１に付加されたフレーム同期信号Ｆ１〜Ｆ６
を直列的に複数個のフレームを順次監視することにより
同期を確立する。例えば図３のτ時間内にＦ１〜Ｆ６の
６個のフレーム同期パターンが基準フレームパターンと
一致していれば同期確立と判定する。この同期確立され
たフレーム同期信号１０２は誤り訂正復号器１の中の演
算回路２を制御し、誤り訂正信号１０３を誤り訂正回路
５に出力する。誤り訂正回路５では、遅延回路３によっ
て演算回路２の演算時間分遅らせた多重化信号１０１Ａ
を入力して誤り訂正を行った出力信号１０４を後段へ出
力していた。
【０００４】
【発明が解決しようとする課題】上述した様に、従来の
フレーム同期方式では１系列の多重化信号のフレーム同
期信号を複数フレームにわたり直列的に順次監視してフ
レーム同期を確立するために、フレーム同期引込時間に
多大の時間を要することになる。特に衛星通信等の回線
雑音が多い場合に、不一致の判定が多く時間を要してい
た。一方、フレーム同期引込時間を短縮するためにはフ
レーム同期信号の冗長度、すなわち主信号に対する監視
すべきフレーム同期信号の付加率を増す方法もあるが、
主信号のタイムスロットを減少させ、伝送効率が低下す
るという欠点があった。
フレーム同期方式では１系列の多重化信号のフレーム同
期信号を複数フレームにわたり直列的に順次監視してフ
レーム同期を確立するために、フレーム同期引込時間に
多大の時間を要することになる。特に衛星通信等の回線
雑音が多い場合に、不一致の判定が多く時間を要してい
た。一方、フレーム同期引込時間を短縮するためにはフ
レーム同期信号の冗長度、すなわち主信号に対する監視
すべきフレーム同期信号の付加率を増す方法もあるが、
主信号のタイムスロットを減少させ、伝送効率が低下す
るという欠点があった。
【０００５】
【課題を解決するための手段】本発明のフレーム同期方
式は入力される誤り訂正符号を含む第１のフレーム多重
信号を復号器に供給してフレーム同期信号を生成する際
に同期確立判定を行うフレーム同期回路を有するフレー
ム同期方式において、前記第１のフレーム多重信号を所
定時間ｔだけ遅延させる遅延回路と、この遅延回路によ
り所定の遅延を受けた第２のフレーム多重信号および前
記第１のフレーム多重信号を入力してフレーム同期確立
の判定を行う。
式は入力される誤り訂正符号を含む第１のフレーム多重
信号を復号器に供給してフレーム同期信号を生成する際
に同期確立判定を行うフレーム同期回路を有するフレー
ム同期方式において、前記第１のフレーム多重信号を所
定時間ｔだけ遅延させる遅延回路と、この遅延回路によ
り所定の遅延を受けた第２のフレーム多重信号および前
記第１のフレーム多重信号を入力してフレーム同期確立
の判定を行う。
【０００６】
【実施例】次に本発明について図面を参照して説明す
る。図１は本発明の一実施例のブロック図、図４は本実
施例の信号フォーマットの説明図である。
る。図１は本発明の一実施例のブロック図、図４は本実
施例の信号フォーマットの説明図である。
【０００７】図１において図２の従来例と同一の符号は
同一の構成と機能を有する。すなわち、本実施例では遅
延回路６を追加し、後述する多重化信号１０１を所定時
間遅延させた信号もフレーム同期回路に入力している。
同一の構成と機能を有する。すなわち、本実施例では遅
延回路６を追加し、後述する多重化信号１０１を所定時
間遅延させた信号もフレーム同期回路に入力している。
【０００８】図１において、フレーム同期信号及び誤り
訂正に用いる付加ビット等を多重した復調器（図示せ
ず）からの１系列の多重化信号１０１は、誤り訂正復号
器１及びフレーム同期回路４に入力される。誤り訂正復
号器１に入力された多重化信号１０１はそれぞれ演算回
路２，遅延回路３に入力され遅延回路３より演算回路２
の演算時間分遅らせた入力信号１０１Ａが出力される。
フレーム同期回路４では多重化信号１０１と遅延回路６
により後述するｔ時間遅延された多重化信号１０５を生
成して現時点のフレーム同期信号１０１および遅延多重
化信号１０５の２系列の多重化信号に含まれるフレーム
同期信号を監視することにより、フレーム同期を確立す
る。同期確立後は従来と同様に、フレーム同期信号１０
２により、誤り訂正復号器１内の演算回路２を制御し、
誤り訂正信号１０３を誤り訂正回路５に出力して誤り訂
正動作を行い、出力信号１０４を後段へ出力する。
訂正に用いる付加ビット等を多重した復調器（図示せ
ず）からの１系列の多重化信号１０１は、誤り訂正復号
器１及びフレーム同期回路４に入力される。誤り訂正復
号器１に入力された多重化信号１０１はそれぞれ演算回
路２，遅延回路３に入力され遅延回路３より演算回路２
の演算時間分遅らせた入力信号１０１Ａが出力される。
フレーム同期回路４では多重化信号１０１と遅延回路６
により後述するｔ時間遅延された多重化信号１０５を生
成して現時点のフレーム同期信号１０１および遅延多重
化信号１０５の２系列の多重化信号に含まれるフレーム
同期信号を監視することにより、フレーム同期を確立す
る。同期確立後は従来と同様に、フレーム同期信号１０
２により、誤り訂正復号器１内の演算回路２を制御し、
誤り訂正信号１０３を誤り訂正回路５に出力して誤り訂
正動作を行い、出力信号１０４を後段へ出力する。
【０００９】ここで図３の従来例ではτ時間の間に６フ
レーム分のフレーム同期信号を監視しているが、図４に
示す本発明の実施例では、同じτ時間の間に多重化信号
１０１のＦ１〜Ｆ６の６個のフレーム同期信号に加え
て、ｔ時間だけ遅延させたＦ１〜Ｆ５の５個のフレーム
同期信号を再度監視している。τ＋ｔ時間ではＦ１〜Ｆ
６の計１２個のフレーム同期信号を監視している。この
ことについて図４を用いて説明する。
レーム分のフレーム同期信号を監視しているが、図４に
示す本発明の実施例では、同じτ時間の間に多重化信号
１０１のＦ１〜Ｆ６の６個のフレーム同期信号に加え
て、ｔ時間だけ遅延させたＦ１〜Ｆ５の５個のフレーム
同期信号を再度監視している。τ＋ｔ時間ではＦ１〜Ｆ
６の計１２個のフレーム同期信号を監視している。この
ことについて図４を用いて説明する。
【００１０】図４は従来回路構成における単位時間τ内
の多重化信号１０１に多重しているフレーム同期信号Ｆ
１〜Ｆ６の監視の様子を示している。図４から明らかな
様に、本発明によるフレーム同期方式は２系列同時監視
となり、単位時間τ内におけるフレーム同期信号の監視
数が従来例の２倍になるので、フレーム同期信号の位置
検出確率が高くなり、等価的にフレーム同期引込時間が
短くなる。
の多重化信号１０１に多重しているフレーム同期信号Ｆ
１〜Ｆ６の監視の様子を示している。図４から明らかな
様に、本発明によるフレーム同期方式は２系列同時監視
となり、単位時間τ内におけるフレーム同期信号の監視
数が従来例の２倍になるので、フレーム同期信号の位置
検出確率が高くなり、等価的にフレーム同期引込時間が
短くなる。
【００１１】本実施例では遅延回路を１個としたので２
系列同時監視であるが、遅延回路６の遅延時間ｔを１フ
レーム期間Ｔの中でｔ×ｎ個配列して同時監視数を増加
することも可能である。なお、同じフレーム同期信号を
複数回監視することにより冗長度を増加し同期確立の信
頼度を向上できる。
系列同時監視であるが、遅延回路６の遅延時間ｔを１フ
レーム期間Ｔの中でｔ×ｎ個配列して同時監視数を増加
することも可能である。なお、同じフレーム同期信号を
複数回監視することにより冗長度を増加し同期確立の信
頼度を向上できる。
【００１２】
【発明の効果】以上説明した様に、本発明におけるフレ
ーム同期方式は、フレーム同期信号を多重した多重化信
号と同一の多重化信号を所定時間分遅延させた信号を加
えて２系列信号を並列的に同時監視してフレーム同期の
確立をはかっているので、伝送効率の低下を招くことな
くフレーム同期確立の信頼度を向上することができる効
果がある。
ーム同期方式は、フレーム同期信号を多重した多重化信
号と同一の多重化信号を所定時間分遅延させた信号を加
えて２系列信号を並列的に同時監視してフレーム同期の
確立をはかっているので、伝送効率の低下を招くことな
くフレーム同期確立の信頼度を向上することができる効
果がある。
【図１】本発明の一実施例のブロック図である。
【図２】従来のフレーム同期方式のブロック図である。
【図３】従来例の信号フォーマットの監視を示す説明図
である。
である。
【図４】本実施例の信号フォーマットの監視を示す説明
図である。
図である。
１ 誤り訂正復号器 ２ 演算回路 ３，６ 遅延回路 ４ フレーム同期回路 ５ 誤り訂正回路
Claims (2)
- 【請求項１】 入力される誤り訂正符号を含む第１のフ
レーム多重信号を復号器に供給してフレーム同期信号を
生成する際に同期確立判定を行うフレーム同期回路を有
するフレーム同期方式において、前記第１のフレーム多
重信号を所定時間ｔだけ遅延させる遅延回路と、この遅
延回路により所定の遅延を受けた第２のフレーム多重信
号および前記第１のフレーム多重信号を入力してフレー
ム同期確立の判定を行うことを特徴とするフレーム同期
方式。 - 【請求項２】 複数のフレーム同期信号間のフレーム時
間間隔をＴとすると、最大Ｎ（Ｎ≦Ｔ／ｔ）個までの前
記遅延回路を並列接続して前記第１のフレーム多重信号
を並列に入力し、出力されるＮ系列の第２のフレーム多
重信号をフレーム同期回路に供給することを特徴とする
請求項１記載のフレーム同期方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04425692A JP3146263B2 (ja) | 1992-03-02 | 1992-03-02 | フレーム同期方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04425692A JP3146263B2 (ja) | 1992-03-02 | 1992-03-02 | フレーム同期方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05244141A true JPH05244141A (ja) | 1993-09-21 |
| JP3146263B2 JP3146263B2 (ja) | 2001-03-12 |
Family
ID=12686445
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP04425692A Expired - Fee Related JP3146263B2 (ja) | 1992-03-02 | 1992-03-02 | フレーム同期方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3146263B2 (ja) |
-
1992
- 1992-03-02 JP JP04425692A patent/JP3146263B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3146263B2 (ja) | 2001-03-12 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000201 |
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| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20001128 |
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| S531 | Written request for registration of change of domicile |
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Free format text: PAYMENT UNTIL: 20090112 Year of fee payment: 8 |
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