JPH05150216A - 特に液晶表示スクリーンの制御回路用保護回路 - Google Patents
特に液晶表示スクリーンの制御回路用保護回路Info
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- JPH05150216A JPH05150216A JP3268459A JP26845991A JPH05150216A JP H05150216 A JPH05150216 A JP H05150216A JP 3268459 A JP3268459 A JP 3268459A JP 26845991 A JP26845991 A JP 26845991A JP H05150216 A JPH05150216 A JP H05150216A
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- G09G3/2011—Display of intermediate tones by amplitude modulation
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- Theoretical Computer Science (AREA)
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal (AREA)
Abstract
(57)【要約】 （修正有）
【目的】液晶表示スクリーンの制御電圧が切換わるとき
に回路に誘導される寄生高電界による損傷から素子を保
護する。本発明は特に液晶表示スクリーン用の制御保護
回路である。 【構成】出力プロット（Ｓ）への電圧の転送と中間点
（ｍ）のゼロリセット及び出力プロットのゼロリセット
とを可能にする３つのトランジスタ（Ｔ１，Ｔ２，Ｔ
３）を備えた保護回路を制御回路に付加する。
に回路に誘導される寄生高電界による損傷から素子を保
護する。本発明は特に液晶表示スクリーン用の制御保護
回路である。 【構成】出力プロット（Ｓ）への電圧の転送と中間点
（ｍ）のゼロリセット及び出力プロットのゼロリセット
とを可能にする３つのトランジスタ（Ｔ１，Ｔ２，Ｔ
３）を備えた保護回路を制御回路に付加する。
Description
【０００１】
【産業上の利用分野】本発明は制御回路用保護回路に係
る。本発明は特に液晶表示スクリーンの制御に適用され
る。
る。本発明は特に液晶表示スクリーンの制御に適用され
る。
【０００２】
【従来技術】液晶表示スクリーンは一般に図１に示す形
態である。所謂ＥＣＲスクリーンはアドレシングライン
Ｌ及びカラムＣと、ラインＬ及びカラムＣの組み合わせ
により制御される状態を有するトランジスタＴＦＴに各
々接続された画素マトリックスＰとから構成される。
態である。所謂ＥＣＲスクリーンはアドレシングライン
Ｌ及びカラムＣと、ラインＬ及びカラムＣの組み合わせ
により制御される状態を有するトランジスタＴＦＴに各
々接続された画素マトリックスＰとから構成される。
【０００３】このようなスクリーンは、ラインにアドレ
シング電圧（例えば数ボルト）を逐次印加するライン制
御回路ＣＣＬと、アドレスされたラインに表示すべき点
の光強度を表す電圧をカラム全体に印加するカラム制御
回路ＣＣＣとにより制御される。全体の画像はこうして
ライン毎に表示される。
シング電圧（例えば数ボルト）を逐次印加するライン制
御回路ＣＣＬと、アドレスされたラインに表示すべき点
の光強度を表す電圧をカラム全体に印加するカラム制御
回路ＣＣＣとにより制御される。全体の画像はこうして
ライン毎に表示される。
【０００４】カラム制御回路ＣＣＣはビデオ回路ＣＶに
より発生されるビデオ信号ＳＶを受信する。この信号は
一般にカラー画像の３原色に対応する３つの成分から構
成される。
より発生されるビデオ信号ＳＶを受信する。この信号は
一般にカラー画像の３原色に対応する３つの成分から構
成される。
【０００５】スクリーンＥＣＲが１６２本のカラムを有
する場合、回路ＣＣＣは並列に配置された１６２個のカ
ラム制御要素回路と、種々のカラムに接続された１６２
個の出力とを備える。各カラム制御要素回路（技術文献
中では「ドライバカラム」とも呼称される）は、制御す
べきカラムに対応する所定の時刻にビデオ信号をサンプ
リングし、１本のラインをアドレスする間中このサンプ
ルをカラム上に保持する機能を有するサンプルホールド
回路から構成される。
する場合、回路ＣＣＣは並列に配置された１６２個のカ
ラム制御要素回路と、種々のカラムに接続された１６２
個の出力とを備える。各カラム制御要素回路（技術文献
中では「ドライバカラム」とも呼称される）は、制御す
べきカラムに対応する所定の時刻にビデオ信号をサンプ
リングし、１本のラインをアドレスする間中このサンプ
ルをカラム上に保持する機能を有するサンプルホールド
回路から構成される。
【０００６】本発明はこのようなサンプルホールド回路
に係る。
に係る。
【０００７】液晶表示スクリーンの大部分は約１２Ｖの
ピークピーク制御電圧を必要とする。このような電圧に
耐える制御回路を使用すると、集積化の可能性及び作動
速度が制限される。しかしながら、大型のスクリーンに
は高集積密度が必要であり、高い制御速度が望ましい。
ピークピーク制御電圧を必要とする。このような電圧に
耐える制御回路を使用すると、集積化の可能性及び作動
速度が制限される。しかしながら、大型のスクリーンに
は高集積密度が必要であり、高い制御速度が望ましい。
【０００８】従って、対電極を使用するなどしてスクリ
ーンで方策を講じることにより、６Ｖピークピークを発
生する回路で運転することが好ましい。対電極に印加さ
れる極性を反転することにより、電圧変動を夫々０〜６
Ｖ及び−６Ｖ〜０とすることができ、従って１２Ｖのピ
ークピーク（−６Ｖ〜＋６Ｖ）とすることができる。
ーンで方策を講じることにより、６Ｖピークピークを発
生する回路で運転することが好ましい。対電極に印加さ
れる極性を反転することにより、電圧変動を夫々０〜６
Ｖ及び−６Ｖ〜０とすることができ、従って１２Ｖのピ
ークピーク（−６Ｖ〜＋６Ｖ）とすることができる。
【０００９】しかしながら、これらの方法は主に切換え
時に制御回路に寄生電圧を誘導するという欠点がある。
従って、出力トランジスタのドレーンとソース間の電圧
は１２Ｖとなり得る。疲労及びアバランシェ現象が現
れ、ついには回路を毀損する。
時に制御回路に寄生電圧を誘導するという欠点がある。
従って、出力トランジスタのドレーンとソース間の電圧
は１２Ｖとなり得る。疲労及びアバランシェ現象が現
れ、ついには回路を毀損する。
【００１０】
【発明が解決しようとする課題】本発明の目的はこれら
の欠点を解消することである。このために、本発明はス
イッチとして機能する１組のトランジスタを含む保護回
路を提案する。これらのトランジスタの適切な切換えは
中間点のゼロリセットを確保し、過電圧の危険を制限す
る。
の欠点を解消することである。このために、本発明はス
イッチとして機能する１組のトランジスタを含む保護回
路を提案する。これらのトランジスタの適切な切換えは
中間点のゼロリセットを確保し、過電圧の危険を制限す
る。
【００１１】
【課題を解決するための手段】詳細には本発明は、入力
信号、特にビデオ信号のサンプリング手段と得られたサ
ンプルの蓄積及び転送手段とを含む制御回路の出力と、
該サンプルを受信すべき外部負荷に接続されるように構
成された出力プロットとの間に挿入されるように構成さ
れた保護回路に係り、前記負荷は特に液晶表示のカラム
であり得、前記保護回路は制御回路の手段を出力プロッ
トに出現し得る過電圧から保護するように構成されてお
り、この保護回路は、相互に直列に配置された第１の電
子スイッチ及び第２の電子スイッチと、第１及び第２の
スイッチの間に配置された点とゼロ電位に導かれる点と
の間に配置された第３の電子スイッチと、制御回路によ
り発生される各サンプル毎に、ａ）サンプルを制御回路
から出力プロットに向かって転送するように第１及び第
２のスイッチを閉じ且つ第３のスイッチを開き、ｂ）第
１及び第２のスイッチの間にゼロ電位を導くように第１
及び第２のスイッチを開き且つ第３のスイッチを閉じ、
ｃ）出力プロットをゼロ電位に導くように第２のスイッ
チを閉じるべく、これらのスイッチの制御信号を発生す
るための手段とを備えることを特徴とする。
信号、特にビデオ信号のサンプリング手段と得られたサ
ンプルの蓄積及び転送手段とを含む制御回路の出力と、
該サンプルを受信すべき外部負荷に接続されるように構
成された出力プロットとの間に挿入されるように構成さ
れた保護回路に係り、前記負荷は特に液晶表示のカラム
であり得、前記保護回路は制御回路の手段を出力プロッ
トに出現し得る過電圧から保護するように構成されてお
り、この保護回路は、相互に直列に配置された第１の電
子スイッチ及び第２の電子スイッチと、第１及び第２の
スイッチの間に配置された点とゼロ電位に導かれる点と
の間に配置された第３の電子スイッチと、制御回路によ
り発生される各サンプル毎に、ａ）サンプルを制御回路
から出力プロットに向かって転送するように第１及び第
２のスイッチを閉じ且つ第３のスイッチを開き、ｂ）第
１及び第２のスイッチの間にゼロ電位を導くように第１
及び第２のスイッチを開き且つ第３のスイッチを閉じ、
ｃ）出力プロットをゼロ電位に導くように第２のスイッ
チを閉じるべく、これらのスイッチの制御信号を発生す
るための手段とを備えることを特徴とする。
【００１２】この回路は、この回路を構成するトランジ
スタの端子の電圧がＶを越えるのを危惧する必要なし
に、単独出力プロット上に−Ｖ〜＋Ｖ（即ち１２Ｖの範
囲）の出力電圧を有し得る二重制御回路の製造に適用さ
れ得る。このような回路は上記に定義した回路に一致す
る２つの制御回路を含み、これらの回路は交互に作動し
て逆極性のビデオ入力信号を受信し、２つの保護回路の
夫々の電子スイッチは相補的信号により制御され、２つ
の保護回路は単独の出力プロットに接続されている。
スタの端子の電圧がＶを越えるのを危惧する必要なし
に、単独出力プロット上に−Ｖ〜＋Ｖ（即ち１２Ｖの範
囲）の出力電圧を有し得る二重制御回路の製造に適用さ
れ得る。このような回路は上記に定義した回路に一致す
る２つの制御回路を含み、これらの回路は交互に作動し
て逆極性のビデオ入力信号を受信し、２つの保護回路の
夫々の電子スイッチは相補的信号により制御され、２つ
の保護回路は単独の出力プロットに接続されている。
【００１３】
【実施例】いずれにせよ、本発明の特徴及び利点は以下
の説明からよく理解されよう。この説明は添付図面を参
考に非限定的な実施例に関する。
の説明からよく理解されよう。この説明は添付図面を参
考に非限定的な実施例に関する。
【００１４】図２に示すカラム制御回路ＣＣＣは電圧パ
ルスを発生することが可能な手段１０を備える。液晶表
示スクリーンのカラムを制御する場合、該手段は、ビデ
オ電圧Ｖを受信し且つサンプリングパルスＥＣＨにより
決定される時刻にこれをサンプリングするサンプルホー
ルド回路である。このような回路の一例を図４に示す。
手段１０の出力ｓには、最終的にスクリーンのカラムＣ
に印加されるように出力プロットＳに転送される電圧が
現れる。本発明によると、制御回路ＣＣＣは更に、３つ
の電子スイッチ（実際にはトランジスタ夫々Ｔ１，Ｔ２
及びＴ３）から構成される保護回路ＣＰを備える。トラ
ンジスタＴ１及びＴ２は出力ｓとプロットＳとの間に直
列に配置されている。第３のトランジスタＴ３は前記ト
ランジスタＴ１とＴ２との中間点ｍとアースに導かれる
点Ｍとの間に配置されている。これらの３つのトランジ
スタは回路２０により発生される信号Ｓ１，Ｓ２，Ｓ３
により制御される。
ルスを発生することが可能な手段１０を備える。液晶表
示スクリーンのカラムを制御する場合、該手段は、ビデ
オ電圧Ｖを受信し且つサンプリングパルスＥＣＨにより
決定される時刻にこれをサンプリングするサンプルホー
ルド回路である。このような回路の一例を図４に示す。
手段１０の出力ｓには、最終的にスクリーンのカラムＣ
に印加されるように出力プロットＳに転送される電圧が
現れる。本発明によると、制御回路ＣＣＣは更に、３つ
の電子スイッチ（実際にはトランジスタ夫々Ｔ１，Ｔ２
及びＴ３）から構成される保護回路ＣＰを備える。トラ
ンジスタＴ１及びＴ２は出力ｓとプロットＳとの間に直
列に配置されている。第３のトランジスタＴ３は前記ト
ランジスタＴ１とＴ２との中間点ｍとアースに導かれる
点Ｍとの間に配置されている。これらの３つのトランジ
スタは回路２０により発生される信号Ｓ１，Ｓ２，Ｓ３
により制御される。
【００１５】保護回路の動作を図３に示す。この動作は
３段階を含む。
３段階を含む。
【００１６】ａ）第１段階：Ｔ１及びＴ２を閉じ且つＴ
３を開く。出力ｓで得られる制御電圧は出力プロットＳ
に転送される。
３を開く。出力ｓで得られる制御電圧は出力プロットＳ
に転送される。
【００１７】ｂ）第２段階：Ｔ１及びＴ２を開き且つＴ
３を閉じる。Ｔ１とＴ２との中間点ｍはアースに接続さ
れ、出力ｓは出力プロットＳから分離される。
３を閉じる。Ｔ１とＴ２との中間点ｍはアースに接続さ
れ、出力ｓは出力プロットＳから分離される。
【００１８】ｃ）第３段階：Ｔ１を開いたまま、Ｔ２及
びＴ３を閉じる。出力プロットＳはアースに接続され
る。
びＴ３を閉じる。出力プロットＳはアースに接続され
る。
【００１９】新しいラインの走査時にカラムＣに新しい
パルスを印加するためには、同一サイクルが繰り返され
る。
パルスを印加するためには、同一サイクルが繰り返され
る。
【００２０】従って、上記３段階の各々においてＶが制
御電圧の振幅とするならば、カラムにより如何なる撹乱
が導入されようともトランジスタの端子間の電圧はＶ以
上にならない。
御電圧の振幅とするならば、カラムにより如何なる撹乱
が導入されようともトランジスタの端子間の電圧はＶ以
上にならない。
【００２１】図４は、ビデオ信号Ｖ+で作動する回路Ｃ
Ｃ+とビデオ信号Ｖ-で作動する回路ＣＣ-とを備える表
示スクリーン用カラム制御二重回路ＣＣＣを示す。これ
らの２つの回路は、液晶に印加される電圧がライン走査
毎に符号を交替する液晶表示スクリーンの制御回路の場
合のように交互に作動する。２つのビデオ信号Ｖ+及び
Ｖ-は、２つのビデオバス即ち正のバスＢＶ+及び負のバ
スＢＶ-に信号を供給するビデオ回路ＣＶにより発生さ
れる。
Ｃ+とビデオ信号Ｖ-で作動する回路ＣＣ-とを備える表
示スクリーン用カラム制御二重回路ＣＣＣを示す。これ
らの２つの回路は、液晶に印加される電圧がライン走査
毎に符号を交替する液晶表示スクリーンの制御回路の場
合のように交互に作動する。２つのビデオ信号Ｖ+及び
Ｖ-は、２つのビデオバス即ち正のバスＢＶ+及び負のバ
スＢＶ-に信号を供給するビデオ回路ＣＶにより発生さ
れる。
【００２２】回路ＣＣ+はサンプリング信号ＥＣＨ+によ
り制御されるサンプリングトランジスタＴｅ+に接続さ
れたサンプリングコンデンサＣｅ+と、増幅器Ａ+と、該
増幅器に並列に配置された蓄積コンデンサＣｓ+とを備
え、Ｔｅ+，Ｃｅ+，Ａ+，Ｃｓ+のアセンブリはサンプル
ホールド回路を構成する。回路ＣＣ+は更に、３つのト
ランジスタＴ１+，Ｔ２+，Ｔ３+を有する保護回路ＣＰ+
を備える。
り制御されるサンプリングトランジスタＴｅ+に接続さ
れたサンプリングコンデンサＣｅ+と、増幅器Ａ+と、該
増幅器に並列に配置された蓄積コンデンサＣｓ+とを備
え、Ｔｅ+，Ｃｅ+，Ａ+，Ｃｓ+のアセンブリはサンプル
ホールド回路を構成する。回路ＣＣ+は更に、３つのト
ランジスタＴ１+，Ｔ２+，Ｔ３+を有する保護回路ＣＰ+
を備える。
【００２３】回路ＣＣ-は回路ＣＣ+と同様であり、符号
＋の代わりに符号−を付した同一の参照番号により表さ
れる同一エレメントを含む。
＋の代わりに符号−を付した同一の参照番号により表さ
れる同一エレメントを含む。
【００２４】２つの回路ＣＣ+及びＣＣ-は同一プロット
Ｓに接続された出力を有しており、該プロットは表示ス
クリーンの１本のカラムＣに接続されている。
Ｓに接続された出力を有しており、該プロットは表示ス
クリーンの１本のカラムＣに接続されている。
【００２５】保護回路のトランジスタの制御信号は相補
的であり、即ちＳ１-＝バー（Ｓ１+），Ｓ２-＝バー
（Ｓ２+）及びＳ３-＝バー（Ｓ３+）（バーは「論理補
数」を意味する）である。更に、Ｓ３+（又はＳ３-）は
Ｓ１+（又はＳ１-）の補数である。換言するならばスイ
ッチＴ３+（又はＴ３-）は常にスイッチＴ１+（又はＴ
１-）の状態と反対の状態にある（図３参照）。ＣＣ+の
制御論理は０とＶＤＤとの間に含まれ、ＣＣ-の制御論
理はＶＳＳと０との間に含まれる。
的であり、即ちＳ１-＝バー（Ｓ１+），Ｓ２-＝バー
（Ｓ２+）及びＳ３-＝バー（Ｓ３+）（バーは「論理補
数」を意味する）である。更に、Ｓ３+（又はＳ３-）は
Ｓ１+（又はＳ１-）の補数である。換言するならばスイ
ッチＴ３+（又はＴ３-）は常にスイッチＴ１+（又はＴ
１-）の状態と反対の状態にある（図３参照）。ＣＣ+の
制御論理は０とＶＤＤとの間に含まれ、ＣＣ-の制御論
理はＶＳＳと０との間に含まれる。
【００２６】図４の二重回路の動作を図５のタイムチャ
ートにより説明する。第１行はビデオ信号Ｖを示す。次
の２行は２つのサンプリングパルスＥＣＨ+及びＥＣＨ-
を示す。第４行はスイッチＴ１+の状態とその補数であ
るＴ３+の状態、Ｔ１-の状態及びＴ３-の状態を規定す
るパルスＳ１+を示す。第５行はスイッチＴ２+の状態と
その補数であるＴ２-の状態とを規定するパルスＳ２+を
示す。最後の行はサンプリングされ交互に正Ｓ+及び負
Ｓ-に維持された出力信号を示す。
ートにより説明する。第１行はビデオ信号Ｖを示す。次
の２行は２つのサンプリングパルスＥＣＨ+及びＥＣＨ-
を示す。第４行はスイッチＴ１+の状態とその補数であ
るＴ３+の状態、Ｔ１-の状態及びＴ３-の状態を規定す
るパルスＳ１+を示す。第５行はスイッチＴ２+の状態と
その補数であるＴ２-の状態とを規定するパルスＳ２+を
示す。最後の行はサンプリングされ交互に正Ｓ+及び負
Ｓ-に維持された出力信号を示す。
【００２７】以上記載した回路は表示スクリーンの制御
に制限されず、エレクトロニクスの他の技術にも適用す
ることができる。
に制限されず、エレクトロニクスの他の技術にも適用す
ることができる。
【図１】液晶表示スクリーンの概略説明図である。
【図２】本発明に従って出力を保護された制御回路の説
明図である。
明図である。
【図３】保護回路の３状態を示す説明図である。
【図４】本発明による二重制御回路の説明図である。
【図５】図４の回路に関するタイムチャートである。
ＣＰ 保護回路 ＣＣＣ 制御回路 Ｃｅ，Ｔｅ サンプリング手段 Ｃｓ 蓄積及び転送手段 Ｓ 出力プロット Ｔ１，Ｔ２，Ｔ３ 電子スイッチ ２０ 信号発生手段 ＣＣ+，ＣＣ- 二重制御回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 アラン・ルラー フランス国、38000・グルノーブル、リ ユ・キユビエ・16 (72)発明者 ジルベール・マルテル フランス国、38240・メラン、リユ・デ・ ゼギナール・７
Claims (2)
- 【請求項１】 入力信号、特にビデオ信号のサンプリン
グ手段と得られたサンプルの蓄積及び転送手段とを含む
制御回路の出力と、該サンプルを受信すべき外部負荷に
接続されるように構成された出力プロットとの間に挿入
されるように構成された保護回路であって、前記負荷は
特に液晶表示のカラムであり得、前記保護回路は制御回
路の手段を出力プロットに出現し得る過電圧から保護す
るように構成されており、前記保護回路が、相互に直列
に配置された第１の電子スイッチ及び第２の電子スイッ
チと、第１及び第２のスイッチの間に配置された点とゼ
ロ電位に導かれる点との間に配置された第３の電子スイ
ッチと、制御回路により発生される各サンプル毎に、
ａ）サンプルを制御回路から出力プロットに向かって転
送するように第１及び第２のスイッチを閉じ且つ第３の
スイッチを開き、ｂ）第１及び第２のスイッチの間にゼ
ロ電位を導くように第１及び第２のスイッチを開き且つ
第３のスイッチを閉じ、ｃ）出力プロットをゼロ電位に
導くように第２のスイッチを閉じるべく、これらのスイ
ッチの制御信号を発生するための手段とを備えることを
特徴とする保護回路。 - 【請求項２】 逆極性の２つの入力信号に基づいて交互
に作動する二重制御回路と、同一出力プロットとの間に
挿入されるように構成されており、相補的信号により制
御される２つの回路を含む二重回路であることを特徴と
する請求項１に記載の保護回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR9011681A FR2667187A1 (fr) | 1990-09-21 | 1990-09-21 | Circuit de commande, notamment pour ecran d'affichage a cristal liquide, a sortie protegee. |
| FR9011681 | 1990-09-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05150216A true JPH05150216A (ja) | 1993-06-18 |
Family
ID=9400530
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3268459A Pending JPH05150216A (ja) | 1990-09-21 | 1991-09-19 | 特に液晶表示スクリーンの制御回路用保護回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5289332A (ja) |
| EP (1) | EP0477099B1 (ja) |
| JP (1) | JPH05150216A (ja) |
| DE (1) | DE69105431T2 (ja) |
| FR (1) | FR2667187A1 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006178356A (ja) * | 2004-12-24 | 2006-07-06 | Nec Electronics Corp | 表示装置の駆動回路 |
| JP2007286586A (ja) * | 2006-04-13 | 2007-11-01 | Lg Phillips Lcd Co Ltd | 表示装置の駆動回路及びその駆動方法 |
| JP2008077080A (ja) * | 2006-09-18 | 2008-04-03 | Toppoly Optoelectronics Corp | イメージ表示システムとその方法 |
Families Citing this family (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE69415903T2 (de) * | 1993-08-30 | 1999-07-22 | Sharp K.K., Osaka | Datensignalleitungsstruktur in einer Flüssigkristallanzeigeeinrichtung mit aktiver Matrix |
| US5798747A (en) * | 1995-11-17 | 1998-08-25 | National Semiconductor Corporation | Methods and apparatuses for high-speed video sample and hold amplification for analog flat panel display |
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