JPH0450124B2 - - Google Patents
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- JPH0450124B2 JPH0450124B2 JP78684A JP78684A JPH0450124B2 JP H0450124 B2 JPH0450124 B2 JP H0450124B2 JP 78684 A JP78684 A JP 78684A JP 78684 A JP78684 A JP 78684A JP H0450124 B2 JPH0450124 B2 JP H0450124B2
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- Japan
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- discharge
- pulse
- current
- machining
- circuit
- Prior art date
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- 238000001514 detection method Methods 0.000 claims description 35
- 238000003754 machining Methods 0.000 claims description 21
- 230000010355 oscillation Effects 0.000 claims description 11
- 238000009763 wire-cut EDM Methods 0.000 claims description 5
- 238000000034 method Methods 0.000 claims description 2
- 239000003990 capacitor Substances 0.000 description 6
- 238000010586 diagram Methods 0.000 description 5
- 230000001419 dependent effect Effects 0.000 description 1
- 238000007599 discharging Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000012530 fluid Substances 0.000 description 1
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23H—WORKING OF METAL BY THE ACTION OF A HIGH CONCENTRATION OF ELECTRIC CURRENT ON A WORKPIECE USING AN ELECTRODE WHICH TAKES THE PLACE OF A TOOL; SUCH WORKING COMBINED WITH OTHER FORMS OF WORKING OF METAL
- B23H7/00—Processes or apparatus applicable to both electrical discharge machining and electrochemical machining
- B23H7/02—Wire-cutting
- B23H7/04—Apparatus for supplying current to working gap; Electric circuits specially adapted therefor
Landscapes
- Chemical & Material Sciences (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Electrochemistry (AREA)
- Engineering & Computer Science (AREA)
- Mechanical Engineering (AREA)
- Electrical Discharge Machining, Electrochemical Machining, And Combined Machining (AREA)
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、ワイヤ電極と工作物との間に形成さ
れる加工間隙に間欠放電を発生させて工作物を加
工を行なうワイヤ放電加工用パルス電源装置に関
するものである。
れる加工間隙に間欠放電を発生させて工作物を加
工を行なうワイヤ放電加工用パルス電源装置に関
するものである。
ワイヤ放電加工機の加工速度は近年急激な向上
が図られているが、加工速度の向上はパルス電源
の改良に頼るところが大きい。本発明はそのうち
のパルス制御回路に関するものである。
が図られているが、加工速度の向上はパルス電源
の改良に頼るところが大きい。本発明はそのうち
のパルス制御回路に関するものである。
第１図は従来のこの種のパルス電源装置の全体
構成を示したものであり、第２図は第１図の回路
動作を説明する波形図である。第１図に示すよう
に、工作物１とワイヤ電極２で形成される加工間
隙３には加工液が満され、そのワイヤ電極２には
通電端子４を介して電圧が印加される構成であ
る。
構成を示したものであり、第２図は第１図の回路
動作を説明する波形図である。第１図に示すよう
に、工作物１とワイヤ電極２で形成される加工間
隙３には加工液が満され、そのワイヤ電極２には
通電端子４を介して電圧が印加される構成であ
る。
また、工作物１には主直流電源１３と補助直流
電源５の陽極が接続され、それぞれの電源１３，
５よりの電流供給はスイツチング素子１２，６の
オン制御により電源閉回路が形成されることによ
り行われる。１１は検出電流に応じてスイツチン
グ素子６，１２をオン、オフ制御するパルス制御
回路、７はコンデンサ、８は抵抗、９はダイオー
ド、１０は電流検出器、１４はインダクタンス、
１５はダイオード、１７は主直流電源１３と直列
接続した第３の直流電源で、抵抗１６が並列接続
してある。
電源５の陽極が接続され、それぞれの電源１３，
５よりの電流供給はスイツチング素子１２，６の
オン制御により電源閉回路が形成されることによ
り行われる。１１は検出電流に応じてスイツチン
グ素子６，１２をオン、オフ制御するパルス制御
回路、７はコンデンサ、８は抵抗、９はダイオー
ド、１０は電流検出器、１４はインダクタンス、
１５はダイオード、１７は主直流電源１３と直列
接続した第３の直流電源で、抵抗１６が並列接続
してある。
第１図の回路動作を説明すると次のとおりであ
る。
る。
まず、低電流容量の補助直流電源５から第１の
スイツチング素子６を第２図ｃに示すようにオン
状態とし、放電用コンデンサ７に抵抗８を介して
充電する。その時の加工間隙３の電圧は第２図ａ
のようになる。この状態から放電用コンデンサ７
の充電電圧が上昇し、加工間〓３で放電が開始す
ると放電用コンデンサ７から出力した電流は第２
図ｂ中の３角波の前の小さな弧状波形をもつて加
工間隙３、電流検出器１０、ダイオード９を流れ
る。この放電の開始は電流検出器１０で検出さ
れ、パルス制御回路１１に入力されると、第１の
スイツチング素子６が第２図ｃのようにオフされ
ると共に、第２のスイツチング素子１２が第２図
ｄのようにオン状態となるようにパルス制御回路
１１から制御信号が出力される（電流検出器１０
による前記放電開始検出時点から実際にスイツチ
ング素子６，１２がオフ、オンするまでには僅か
な時遅れが生じる）。そして加工間隙３に大電流
容量の主直流電源１３から大電流（主放電電流）
が第２図ｂのように出力され、第２のスイツチン
グ素子１２がt1時間後にオフすると通電系のイン
ダクタンス１４に蓄積した電磁エネルギーがダイ
オード１５と抵抗１６を通つて第２図ｂの（T1
−t1）時間で放出される。しかし、通電系のイン
ダクタンス１４、加工部におけるインダクタン
ス、あるいはワイヤ電極２と通電端子４の抵抗の
変動などにより、第２図ｂの実戦と破線で示すよ
うに加工電流が変動し、その結果、各放電パルス
毎の放電エネルギーが変動して加工状態を不安定
にするばかりか、加工面あらさを不均一にすると
いう問題を残していた。
スイツチング素子６を第２図ｃに示すようにオン
状態とし、放電用コンデンサ７に抵抗８を介して
充電する。その時の加工間隙３の電圧は第２図ａ
のようになる。この状態から放電用コンデンサ７
の充電電圧が上昇し、加工間〓３で放電が開始す
ると放電用コンデンサ７から出力した電流は第２
図ｂ中の３角波の前の小さな弧状波形をもつて加
工間隙３、電流検出器１０、ダイオード９を流れ
る。この放電の開始は電流検出器１０で検出さ
れ、パルス制御回路１１に入力されると、第１の
スイツチング素子６が第２図ｃのようにオフされ
ると共に、第２のスイツチング素子１２が第２図
ｄのようにオン状態となるようにパルス制御回路
１１から制御信号が出力される（電流検出器１０
による前記放電開始検出時点から実際にスイツチ
ング素子６，１２がオフ、オンするまでには僅か
な時遅れが生じる）。そして加工間隙３に大電流
容量の主直流電源１３から大電流（主放電電流）
が第２図ｂのように出力され、第２のスイツチン
グ素子１２がt1時間後にオフすると通電系のイン
ダクタンス１４に蓄積した電磁エネルギーがダイ
オード１５と抵抗１６を通つて第２図ｂの（T1
−t1）時間で放出される。しかし、通電系のイン
ダクタンス１４、加工部におけるインダクタン
ス、あるいはワイヤ電極２と通電端子４の抵抗の
変動などにより、第２図ｂの実戦と破線で示すよ
うに加工電流が変動し、その結果、各放電パルス
毎の放電エネルギーが変動して加工状態を不安定
にするばかりか、加工面あらさを不均一にすると
いう問題を残していた。
本発明の目的は上記した従来技術の問題点をな
くし、各放電パルスの放電エネルギーを均一化す
ることのできるワイヤ放電加工用パルス電源装置
を提供するにある。
くし、各放電パルスの放電エネルギーを均一化す
ることのできるワイヤ放電加工用パルス電源装置
を提供するにある。
本発明の特徴は、加工間〓を形成するワイヤ電
極及び工作物相互間にスイツチング素子を介して
加工用直流電源を接続し、前記スイツチング素子
をオン、オフ制御することにより前記加工間〓に
前記加工用直流電源をパルス状に与え間欠的な放
電を発生させて前記工作物を加工するワイヤ放電
加工用パルス電源装置において、前記加工用間〓
に流れる放電電流を検出する電流検出器と、この
電流検出器からの検出信号に応じて前記スイツチ
ング素子をオン、オフ制御するパルス制御回路と
を備えてなり、前記パルス制御回路は、前記電流
検出器からの検出信号により放電開始時点を検出
する放電開始検出回路と、この放電開始検出回路
で検出された放電開始時点から所定時間後の放電
電流値又は電流変化率を前記電流検出器からの検
出信号により検出する放電開始後電流値検出回路
と、この電流値検出回路により検出される電流値
又は電流変化率に応じてあらかじめ選定されたも
ので各放電パルスの放電エネルギーを一定とし得
るパルス幅設定値を前記電流値又は電流変化率に
応じて出力するメモリと、このメモリから出力さ
れたパルス幅設定値に従つた放電パルス幅となる
ように発振パルスオフ時点が制御される、前記ス
イツチング素子のオン、オフ制御用のパルス発振
回路とを具備することにある。
極及び工作物相互間にスイツチング素子を介して
加工用直流電源を接続し、前記スイツチング素子
をオン、オフ制御することにより前記加工間〓に
前記加工用直流電源をパルス状に与え間欠的な放
電を発生させて前記工作物を加工するワイヤ放電
加工用パルス電源装置において、前記加工用間〓
に流れる放電電流を検出する電流検出器と、この
電流検出器からの検出信号に応じて前記スイツチ
ング素子をオン、オフ制御するパルス制御回路と
を備えてなり、前記パルス制御回路は、前記電流
検出器からの検出信号により放電開始時点を検出
する放電開始検出回路と、この放電開始検出回路
で検出された放電開始時点から所定時間後の放電
電流値又は電流変化率を前記電流検出器からの検
出信号により検出する放電開始後電流値検出回路
と、この電流値検出回路により検出される電流値
又は電流変化率に応じてあらかじめ選定されたも
ので各放電パルスの放電エネルギーを一定とし得
るパルス幅設定値を前記電流値又は電流変化率に
応じて出力するメモリと、このメモリから出力さ
れたパルス幅設定値に従つた放電パルス幅となる
ように発振パルスオフ時点が制御される、前記ス
イツチング素子のオン、オフ制御用のパルス発振
回路とを具備することにある。
以下、第３図、第４図に従つて本発明の一実施
例を詳述する。第３図はその具体的な回路構成を
示すものであり、説明を簡単にするため第１図に
示したパルス制御回路１１部分のみを示してい
る。またここではパルス制御回路１１は電流検出
器１０の検出電流（放電電流検出信号）を処理し
て第２のスイツチング素子１２の制御信号を出力
する回路部分のみを示している。第３図のS1，S2
は第１図の電流検出器１０の出力端子であり、S3
は第２のスイツチング素子の制御信号端子となる
ものである。
例を詳述する。第３図はその具体的な回路構成を
示すものであり、説明を簡単にするため第１図に
示したパルス制御回路１１部分のみを示してい
る。またここではパルス制御回路１１は電流検出
器１０の検出電流（放電電流検出信号）を処理し
て第２のスイツチング素子１２の制御信号を出力
する回路部分のみを示している。第３図のS1，S2
は第１図の電流検出器１０の出力端子であり、S3
は第２のスイツチング素子の制御信号端子となる
ものである。
第３図において１８は差動アンプで、端子S1，
S2より入力された検出電流を比較増幅するもので
ある。１９ａ，１９ｂ，１９ｃ…１９ｎは差動ア
ンプ１８の出力を一方の入力とし、それぞれ基準
電圧E1，E2，E3…Enを他方の入力とするコンパ
レータである。２０はタイミングパルス発生回
路、２１ａ，２１ｂ，２１ｃ，…２１ｍはアンド
ゲート回路（以下、ゲート回路と略称する）を示
し、タイミングパルス発生回路２０の出力と、対
応するコンパレータの出力と、次段のコンパレー
タの出力をインバータ回路２５ａ，２５ｂを介し
て反転した出力とを入力としている。２２は各ゲ
ート回路２１の出力レベル状態に応じてあらかじ
め選定されたもので、各放電パルスの放電エネル
ギーを一定とし得るパルス幅設定値を前記出力レ
ベル状態に応じて出力するメモリ、２３は前記電
流検出器１０からの検出信号（差動アンプ１８の
出力信号）により放電開始時点を検出する放電開
始検出回路、２４は前記メモリ２２から出力され
たパルス幅設定値に従つた放電パルス幅となるよ
うに発振パルスオフ時点が制御される、前記スイ
ツチング素子のオン、オフ制御用のパルス発振回
路であつて、図示の如く接続構成してある。な
お、前記タイミングパルス発生回路２０、コンパ
レータ１９及びゲート回路２１は、放電開始検出
回路２３で検出された放電開始時点から所定時間
tC後の放電電流値を前記電流検出器１０からの検
出信号（差動アンプ１８の出力信号）により検出
する放電開始後電流値検出回路を構成する。
S2より入力された検出電流を比較増幅するもので
ある。１９ａ，１９ｂ，１９ｃ…１９ｎは差動ア
ンプ１８の出力を一方の入力とし、それぞれ基準
電圧E1，E2，E3…Enを他方の入力とするコンパ
レータである。２０はタイミングパルス発生回
路、２１ａ，２１ｂ，２１ｃ，…２１ｍはアンド
ゲート回路（以下、ゲート回路と略称する）を示
し、タイミングパルス発生回路２０の出力と、対
応するコンパレータの出力と、次段のコンパレー
タの出力をインバータ回路２５ａ，２５ｂを介し
て反転した出力とを入力としている。２２は各ゲ
ート回路２１の出力レベル状態に応じてあらかじ
め選定されたもので、各放電パルスの放電エネル
ギーを一定とし得るパルス幅設定値を前記出力レ
ベル状態に応じて出力するメモリ、２３は前記電
流検出器１０からの検出信号（差動アンプ１８の
出力信号）により放電開始時点を検出する放電開
始検出回路、２４は前記メモリ２２から出力され
たパルス幅設定値に従つた放電パルス幅となるよ
うに発振パルスオフ時点が制御される、前記スイ
ツチング素子のオン、オフ制御用のパルス発振回
路であつて、図示の如く接続構成してある。な
お、前記タイミングパルス発生回路２０、コンパ
レータ１９及びゲート回路２１は、放電開始検出
回路２３で検出された放電開始時点から所定時間
tC後の放電電流値を前記電流検出器１０からの検
出信号（差動アンプ１８の出力信号）により検出
する放電開始後電流値検出回路を構成する。
次に、第３図の回路動作を第４図の波形図と共
に説明する。まず、前述した第１図の電流検出器
１０からの検出信号が差動アンプ１８に入力さ
れ、その出力は放電開始検出回路２３とコンパレ
ータ１９ａ，１９ｂ，１９ｃ…１９ｎに入力され
る。放電開始検出回路２３は第１図にて示した放
電用コンデンサ７による放電電流を前記電流検出
器１０（差動アンプ１８の出力信号）からの検出
信号で検出することにより放電開始時点を検出
し、その出力信号をパルス発振回路２４に与え
る。これによりパルス発振回路２４は第２のスイ
ツチング素子１２の制御信号、ここではオン信号
S3を出力する。また、S3はタイミングパルス発生
回路２０へ入力され、第４図のｃに示すように、
放電開始検出回路２３で検出された放電開始時点
から所定時間tc遅れてタイミングパルスを出力
し、そのパルスはゲート回路２１ａ，２１ｂ，
…，２１ｍへ入力される。コンパレータ１９ａ，
１９ｂ，１９ｃ，…１９ｎには基準電圧E1，E2，
E3，…Enが印加されており、主放電電流に比例
する信号eiと比較され、その結果がインバータ回
路２５ａ，２５ｂ，…，２５ｎを介してゲート回
路２１ａ，２１ｂ，…，２１ｎに入力する。
に説明する。まず、前述した第１図の電流検出器
１０からの検出信号が差動アンプ１８に入力さ
れ、その出力は放電開始検出回路２３とコンパレ
ータ１９ａ，１９ｂ，１９ｃ…１９ｎに入力され
る。放電開始検出回路２３は第１図にて示した放
電用コンデンサ７による放電電流を前記電流検出
器１０（差動アンプ１８の出力信号）からの検出
信号で検出することにより放電開始時点を検出
し、その出力信号をパルス発振回路２４に与え
る。これによりパルス発振回路２４は第２のスイ
ツチング素子１２の制御信号、ここではオン信号
S3を出力する。また、S3はタイミングパルス発生
回路２０へ入力され、第４図のｃに示すように、
放電開始検出回路２３で検出された放電開始時点
から所定時間tc遅れてタイミングパルスを出力
し、そのパルスはゲート回路２１ａ，２１ｂ，
…，２１ｍへ入力される。コンパレータ１９ａ，
１９ｂ，１９ｃ，…１９ｎには基準電圧E1，E2，
E3，…Enが印加されており、主放電電流に比例
する信号eiと比較され、その結果がインバータ回
路２５ａ，２５ｂ，…，２５ｎを介してゲート回
路２１ａ，２１ｂ，…，２１ｎに入力する。
このようにして主直流電源１３による主放電が
開始（厳密には前述したように放電用コンデンサ
７による放電開始を、前記電流検出器１０からの
検出信号により放電開始検出回路２３で検出して
いるが、ここではそれを主放電の開始とみなして
いる。）して、tc時間後の値がコンパレータの基
準電圧E1，E2，E3，…，Enのどの間に達してい
るかを検出する。第４図ａのei1の波形の時には
基準電圧がE1とE2の間であるから、第３図の第
１のゲート回路２１ａの出力だけが「Ｈ」レベル
となり、他のゲート回路の出力は「Ｌ」レベルと
なる。
開始（厳密には前述したように放電用コンデンサ
７による放電開始を、前記電流検出器１０からの
検出信号により放電開始検出回路２３で検出して
いるが、ここではそれを主放電の開始とみなして
いる。）して、tc時間後の値がコンパレータの基
準電圧E1，E2，E3，…，Enのどの間に達してい
るかを検出する。第４図ａのei1の波形の時には
基準電圧がE1とE2の間であるから、第３図の第
１のゲート回路２１ａの出力だけが「Ｈ」レベル
となり、他のゲート回路の出力は「Ｌ」レベルと
なる。
各ゲート回路２１の出力はメモリ２２へ入力さ
れる。メモリ２２は、各ゲート回路２１の出力レ
ベル状態をアドレスとして、そのアドレス（前記
出力レベル状態）に応じてあらかじめ記憶されて
いるパルス幅設定値を出力する。例えば、第４図
ａの波形ei1の場合（差動アンプ１８の出力信号
（電流検出器１０からの検出信号）eiが基準電圧
E1とE2の間にあり、ゲート回路２１ａの出力だ
けが「Ｈ」レベルにある場合）のパルス幅はt1
（第４図ｂ参照）、同じくei2の場合のパルス幅は
t′1（第４図ｄ参照）となるように、パルス設定値
がメモリ２２に記憶されており、各ゲート回路２
１の出力レベル状態に応じて該当するパルス幅設
定値を出力する。この際、パルス幅設定値として
は、各ゲート回路２１の出力レベル状態の相違に
拘らず各放電パルスの放電エネルギーを一定とし
得る値が選定されている。
れる。メモリ２２は、各ゲート回路２１の出力レ
ベル状態をアドレスとして、そのアドレス（前記
出力レベル状態）に応じてあらかじめ記憶されて
いるパルス幅設定値を出力する。例えば、第４図
ａの波形ei1の場合（差動アンプ１８の出力信号
（電流検出器１０からの検出信号）eiが基準電圧
E1とE2の間にあり、ゲート回路２１ａの出力だ
けが「Ｈ」レベルにある場合）のパルス幅はt1
（第４図ｂ参照）、同じくei2の場合のパルス幅は
t′1（第４図ｄ参照）となるように、パルス設定値
がメモリ２２に記憶されており、各ゲート回路２
１の出力レベル状態に応じて該当するパルス幅設
定値を出力する。この際、パルス幅設定値として
は、各ゲート回路２１の出力レベル状態の相違に
拘らず各放電パルスの放電エネルギーを一定とし
得る値が選定されている。
パルス発振回路２４は、メモリ２２から出力さ
れたパルス幅設定値に従つた放電パルス幅となる
ように発振パルスオフ時点が制御されるもので、
パルスオン時点は放電開始検出回路２３で検出さ
れた放電開始時点を基準として一定であるから、
結局、差動アンプ１８の出力信号（電流検出器１
０からの検出信号）eiの大きさに応じてパルス幅
が制御され、各放電パルスの放電エネルギーは一
定になる。
れたパルス幅設定値に従つた放電パルス幅となる
ように発振パルスオフ時点が制御されるもので、
パルスオン時点は放電開始検出回路２３で検出さ
れた放電開始時点を基準として一定であるから、
結局、差動アンプ１８の出力信号（電流検出器１
０からの検出信号）eiの大きさに応じてパルス幅
が制御され、各放電パルスの放電エネルギーは一
定になる。
なお上述実施例では、差動アンプ１８の出力信
号（電流検出器１０からの検出信号）eiの大きさ
に応じてパルス幅を制御するようにしたが、前記
信号eiの変化率（電流変化率）に応じてパルス幅
を制御するようにしてもよい。この場合は、eiの
微分値をコンパレータ１９に入力するようにすれ
ばよい。
号（電流検出器１０からの検出信号）eiの大きさ
に応じてパルス幅を制御するようにしたが、前記
信号eiの変化率（電流変化率）に応じてパルス幅
を制御するようにしてもよい。この場合は、eiの
微分値をコンパレータ１９に入力するようにすれ
ばよい。
また上述実施例では、補助直流電源５をもつ装
置に適用した場合について述べたが、補助直流電
源５をもたない装置にも適用できる。
置に適用した場合について述べたが、補助直流電
源５をもたない装置にも適用できる。
上述の実施例からも明らかなように本発明によ
れば、各放電パルスの放電エネルギーを均一化す
ることができるので、放電加工が安定化できるば
かりか、良質な加工表面が得られるという利点が
ある。
れば、各放電パルスの放電エネルギーを均一化す
ることができるので、放電加工が安定化できるば
かりか、良質な加工表面が得られるという利点が
ある。
第１図は従来のワイヤ放電加工用パルス電源装
置の回路構成図、第２図は第１図の回路動作説明
をする波形図、第３図は本発明の一実施例を示す
要部回路構成図、第４図は第３図の回路動作説明
をする波形図である。 １……工作物、２……ワイヤ電極、５，１３，
１７……直流電源、６……第１のスイツチング素
子、１１……パルス制御回路、１２……第２のス
イツチング素子、１８……差動アンプ、１９ａ，
１９ｂ，１９ｃ〜１９ｎ……コンパレータ、２０
……タイミングパルス発生回路、２１ａ，２１ｂ
〜２１ｎ……ゲート回路、２２……メモリ、２３
……放電開始検出回路、２４……パルス発振回
路、２５ａ，２５ｂ……インバータ回路。
置の回路構成図、第２図は第１図の回路動作説明
をする波形図、第３図は本発明の一実施例を示す
要部回路構成図、第４図は第３図の回路動作説明
をする波形図である。 １……工作物、２……ワイヤ電極、５，１３，
１７……直流電源、６……第１のスイツチング素
子、１１……パルス制御回路、１２……第２のス
イツチング素子、１８……差動アンプ、１９ａ，
１９ｂ，１９ｃ〜１９ｎ……コンパレータ、２０
……タイミングパルス発生回路、２１ａ，２１ｂ
〜２１ｎ……ゲート回路、２２……メモリ、２３
……放電開始検出回路、２４……パルス発振回
路、２５ａ，２５ｂ……インバータ回路。
Claims (1)
- １ 加工間〓を形成するワイヤ電極及び工作物相
互間にスイツチング素子を介して加工用直流電源
を接続し、前記スイツチング素子をオン、オフ制
御することにより前記加工間〓に前記加工用直流
電源をパルス状に与え間欠的な放電を発生させて
前記工作物を加工するワイヤ放電加工用パルス電
源装置において、前記加工間〓に流れる放電電流
を検出する電流検出器と、この電流検出器からの
検出信号に応じて前記スイツチング素子をオン、
オフ制御するパルス制御回路とを備えてなり、前
記パルス制御回路は、前記電流検出器からの検出
信号により放電開始時点を検出する放電開始検出
回路と、この放電開始検出回路で検出された放電
開始時点から所定時間後の放電電流値又は電流変
化率を前記電流検出器からの検出信号により検出
する放電開始後電流値検出回路と、この電流値検
出回路により検出される電流値又は電流変化率に
応じてあらかじめ選定されたもので各放電パルス
の放電エネルギーを一定とし得るパルス幅設定値
を前記電流値又は電流変化率に応じて出力するメ
モリと、このメモリから出力されたパルス幅設定
値に従つた放電パルス幅となるように発振パルス
オフ時点が制御される、前記スイツチング素子の
オン、オフ制御用のパルス発振回路とを具備する
ことを特徴とするワイヤ放電加工用パルス電源装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP78684A JPS60146628A (ja) | 1984-01-09 | 1984-01-09 | ワイヤ放電加工用パルス電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP78684A JPS60146628A (ja) | 1984-01-09 | 1984-01-09 | ワイヤ放電加工用パルス電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60146628A JPS60146628A (ja) | 1985-08-02 |
| JPH0450124B2 true JPH0450124B2 (ja) | 1992-08-13 |
Family
ID=11483377
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP78684A Granted JPS60146628A (ja) | 1984-01-09 | 1984-01-09 | ワイヤ放電加工用パルス電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60146628A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6165210B2 (ja) * | 2015-09-25 | 2017-07-19 | 株式会社ソディック | ワイヤ放電加工装置の加工電源装置 |
-
1984
- 1984-01-09 JP JP78684A patent/JPS60146628A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60146628A (ja) | 1985-08-02 |
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