JPH0220107A - 入力インピーダンス切換型増幅回路 - Google Patents
入力インピーダンス切換型増幅回路Info
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- JPH0220107A JPH0220107A JP63170269A JP17026988A JPH0220107A JP H0220107 A JPH0220107 A JP H0220107A JP 63170269 A JP63170269 A JP 63170269A JP 17026988 A JP17026988 A JP 17026988A JP H0220107 A JPH0220107 A JP H0220107A
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- JP
- Japan
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- amplifier circuit
- amplifier
- input
- circuit
- signal
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- 238000010586 diagram Methods 0.000 description 4
- 239000002253 acid Substances 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
Landscapes
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、入力インピーダンスを例えば接点式の切換ス
イッチ等の構成の切換要素（以下「切換スイッチ」とい
う）を用いて切換えて入力段増幅器を用いて増幅し出力
する例えばオシロスコープ等に使用される入力インピー
ダンス切換型増幅回路に係わり、特に、前記切換スイッ
チの切換位置にかかわらず前記入力段増幅器のオフセッ
トを直流補正することができる入力インピーダンス切換
型入力段増幅器の直流補正回路を具価した入力インピー
ダンス切換型増幅回路に関するものである。
イッチ等の構成の切換要素（以下「切換スイッチ」とい
う）を用いて切換えて入力段増幅器を用いて増幅し出力
する例えばオシロスコープ等に使用される入力インピー
ダンス切換型増幅回路に係わり、特に、前記切換スイッ
チの切換位置にかかわらず前記入力段増幅器のオフセッ
トを直流補正することができる入力インピーダンス切換
型入力段増幅器の直流補正回路を具価した入力インピー
ダンス切換型増幅回路に関するものである。
［従来の技術］
以下、従来の技術を図面を用いて説明する。
第２図は従来の入力インピーダンス切換型増幅回路を示
す図である。
す図である。
第２図において、ＳＷ、は一対（前段の入力側をｓｗ、
Ａ 、後段をｓｗ、Ｂで示す）で構成されて夫々可動接
点ａ笈びｂと固定接点Ｃを有する連動型の切換スイッチ
（以下「連動切換スイッチ」という）である、この連動
切換スイッチＳＷ、は、各ＳＷ、＾、ＳＷ、、の可動接
点ａ−ａ間に例えば５０Ωというような値の第１の入力
インピーダンスＲａが接続され、可動接点ｂ−ｂ間に例
えばＩＭΩというような第２の入力インピーダンスＲｂ
と入力段増幅器となる高入力インピーダンスバッファＩ
Ｑの直列回路が接続され、ｓｗ、Ａの固定接点Ｃが入力
端子１に接続され、ＳＷｌ、の固定接点Ｃが入力段増幅
器となる増幅器ＯＰ、を介して出力端子２に接続される
。
Ａ 、後段をｓｗ、Ｂで示す）で構成されて夫々可動接
点ａ笈びｂと固定接点Ｃを有する連動型の切換スイッチ
（以下「連動切換スイッチ」という）である、この連動
切換スイッチＳＷ、は、各ＳＷ、＾、ＳＷ、、の可動接
点ａ−ａ間に例えば５０Ωというような値の第１の入力
インピーダンスＲａが接続され、可動接点ｂ−ｂ間に例
えばＩＭΩというような第２の入力インピーダンスＲｂ
と入力段増幅器となる高入力インピーダンスバッファＩ
Ｑの直列回路が接続され、ｓｗ、Ａの固定接点Ｃが入力
端子１に接続され、ＳＷｌ、の固定接点Ｃが入力段増幅
器となる増幅器ＯＰ、を介して出力端子２に接続される
。
この様な構造とすることで、連動切換スイッチＳＷ、の
選択・切換により、いずれかの入力インピーダンスを選
択・切換えて増幅器ＯＰ、に接続することができる。
選択・切換により、いずれかの入力インピーダンスを選
択・切換えて増幅器ＯＰ、に接続することができる。
し発明が解決しようとする課題］
ところで通常高入力インピーダンスバッファＩＢ、増幅
器ＯＰｌ等の入力段増幅器にはオフセットが有り、この
オフセット補正は通常入出力値の比較により行なわれる
が、第２図のような入力インピーダンス切換型増幅回路
にあっては、連動切換スイッチＳＷ１を用いて入力イン
ピーダンスを切換えな時に、連動スイッチＳ Ｗ 、の
前後段ＳＷ、Ａ、ＳＷ、ａが同時に切換わるため、入出
力値を比較しての増幅器自身のオフセットの直流補正は
できない、という問題点があった。
器ＯＰｌ等の入力段増幅器にはオフセットが有り、この
オフセット補正は通常入出力値の比較により行なわれる
が、第２図のような入力インピーダンス切換型増幅回路
にあっては、連動切換スイッチＳＷ１を用いて入力イン
ピーダンスを切換えな時に、連動スイッチＳ Ｗ 、の
前後段ＳＷ、Ａ、ＳＷ、ａが同時に切換わるため、入出
力値を比較しての増幅器自身のオフセットの直流補正は
できない、という問題点があった。
本発明は、従来の技術の有するこのような問題点に鑑み
てなされたものであり、その目的とするところは、入力
インピーダンスを切換えても、入力段増幅器自身のオフ
セットが出力されないように直流補正を行うことができ
る入力インピーダンス切換型増幅回路を提供するもので
ある。
てなされたものであり、その目的とするところは、入力
インピーダンスを切換えても、入力段増幅器自身のオフ
セットが出力されないように直流補正を行うことができ
る入力インピーダンス切換型増幅回路を提供するもので
ある。
［課題を解決するための手段］
上記目的を達成するなめに本発明は、入力インピーダン
スを切換要素を用いて切換えて増幅して出力する入力イ
ンピーダンス切換型増幅回路において、入力端子と他方
の可動接点が直接接続される切換要素の一方の可動接点
と前記入力端子との間に設けられた入力段増幅器を構成
する第１増幅回路と、前記切換要素の固定接点に接続す
る入力段増幅器を構成する第２増幅回路と、前記第１増
幅回路の信号と前記第２増幅回路の信号を比較してその
直流成分の誤差を補正して前記第１増幅回路と前記第２
増幅回路又は第２増幅回路で構成する入力段増幅器のオ
フセットを調整するオフセット調整信号を前記第１増幅
回路及び前記第２増幅回路に出力する補正回路と、を具
備したことを特徴とするものである。
スを切換要素を用いて切換えて増幅して出力する入力イ
ンピーダンス切換型増幅回路において、入力端子と他方
の可動接点が直接接続される切換要素の一方の可動接点
と前記入力端子との間に設けられた入力段増幅器を構成
する第１増幅回路と、前記切換要素の固定接点に接続す
る入力段増幅器を構成する第２増幅回路と、前記第１増
幅回路の信号と前記第２増幅回路の信号を比較してその
直流成分の誤差を補正して前記第１増幅回路と前記第２
増幅回路又は第２増幅回路で構成する入力段増幅器のオ
フセットを調整するオフセット調整信号を前記第１増幅
回路及び前記第２増幅回路に出力する補正回路と、を具
備したことを特徴とするものである。
［作用］
入力端子と切換要素の一方の可動接点との間に第１の入
力段増幅器である第１増幅回路が設けられ、入力端子と
前記切換要素の他方の可動接点とが直接接続され、切換
要素の固定接点に第２の入力段増幅器である第２増幅回
路が設けられ、前記第１増幅回路から前記入力端子に入
力する入力値に比例した第１信号及び第２増幅回路から
出力に比例した第２信号が補正回路に入力して、これ等
第１，２信号を比較してその直流成分の誤差を補正して
入力段増幅器のオフセットを調整するオフセット調整信
号を第１．２増幅回路に出力して、切換要素を切換えて
第１．２増幅回路を接続した時は前記オフセット調整信
号でこれ等増幅回路が直流補正され、切換要素を切換え
て第２増幅回路のみとした時はオフセット調整信号でこ
の第２増幅回路のみでこの入力段増幅器全体の直流補正
する。
力段増幅器である第１増幅回路が設けられ、入力端子と
前記切換要素の他方の可動接点とが直接接続され、切換
要素の固定接点に第２の入力段増幅器である第２増幅回
路が設けられ、前記第１増幅回路から前記入力端子に入
力する入力値に比例した第１信号及び第２増幅回路から
出力に比例した第２信号が補正回路に入力して、これ等
第１，２信号を比較してその直流成分の誤差を補正して
入力段増幅器のオフセットを調整するオフセット調整信
号を第１．２増幅回路に出力して、切換要素を切換えて
第１．２増幅回路を接続した時は前記オフセット調整信
号でこれ等増幅回路が直流補正され、切換要素を切換え
て第２増幅回路のみとした時はオフセット調整信号でこ
の第２増幅回路のみでこの入力段増幅器全体の直流補正
する。
［実施例］
実施例について図面を参照して説明する。
尚、以下の図面において、第２図と重複する部分は同一
番号を付してその説明は省略する。
番号を付してその説明は省略する。
第１図は本発明の入力インピーダンス切換型増幅回路を
示す図である。
示す図である。
第１図において、ＯＰＡは入力端子１と切換スイッチＳ
Ｗ２の一方の可動接点ａとの間に設けられた第１の入力
段増幅器である第１増幅回路である。ここで入力端子１
と切換スイッチＳＷ２の他方の可動接点すとは直接接続
されている。ＯＰａは切換スイッチＳＷ２の固定接点Ｃ
と出力端子２との間に設けられた第２の入力段増幅器で
ある第２増幅回路である。Ｆは、第１増幅回路ＯＰＡか
ら入力端子１に入力する入力値に比例した第１信号１１
を入力し、第２増幅回路ＯＰａの出力に比例した第２信
号ＩＱが入力して、これ等、第１信号ＩＡと第２信号Ｉ
Ｂを比較してそのＩＬ流酸成分誤差を補正し、入力段増
幅器（切換スイッチＳＷ２の切換により第１増幅回路Ｏ
ＰＡと第２増幅回路ＯＰＢ又は第２増幅回路０Ｐｓ）の
オフセットを調整するオフセット調整信号Ｓ、、Ｓ２を
第１増幅回路ＯＰＡ及び第２増幅回路ＯＰＢに同時に出
力する補正回路である。
Ｗ２の一方の可動接点ａとの間に設けられた第１の入力
段増幅器である第１増幅回路である。ここで入力端子１
と切換スイッチＳＷ２の他方の可動接点すとは直接接続
されている。ＯＰａは切換スイッチＳＷ２の固定接点Ｃ
と出力端子２との間に設けられた第２の入力段増幅器で
ある第２増幅回路である。Ｆは、第１増幅回路ＯＰＡか
ら入力端子１に入力する入力値に比例した第１信号１１
を入力し、第２増幅回路ＯＰａの出力に比例した第２信
号ＩＱが入力して、これ等、第１信号ＩＡと第２信号Ｉ
Ｂを比較してそのＩＬ流酸成分誤差を補正し、入力段増
幅器（切換スイッチＳＷ２の切換により第１増幅回路Ｏ
ＰＡと第２増幅回路ＯＰＢ又は第２増幅回路０Ｐｓ）の
オフセットを調整するオフセット調整信号Ｓ、、Ｓ２を
第１増幅回路ＯＰＡ及び第２増幅回路ＯＰＢに同時に出
力する補正回路である。
ここで各回路を、例えば、以下のように構成することで
、第２図の回路構成に対応することができ、切換スイッ
チＳＷ２を選択・切換えていずれの時でも入力段増幅器
のオフセットの直流補正が出来る構成とすることができ
る。
、第２図の回路構成に対応することができ、切換スイッ
チＳＷ２を選択・切換えていずれの時でも入力段増幅器
のオフセットの直流補正が出来る構成とすることができ
る。
第１増幅回路’ＯＰＡは、ゲートに入力端子１からの入
力値か導かれドレインが共通電圧に接続しソースが切換
スイッチＳＷ２の可動接点ａに接続されるＦＥＴＱ＋
と、コレクタにＦ Ｅ Ｔ Ｑ １のソスが接続されエ
ミッタにｆｌ！！＠が共通電圧に接続された抵抗Ｒ９の
一端が接続されたトランジスタＱ２と、Ｆ ＥＴ Ｑ
＋のゲートに一端が接続され他端に一端がアース接続さ
れた抵抗Ｒ２の他端が接続された抵抗Ｒ１と、抵抗Ｒ１
と抵抗Ｒ２との接続端に接続された抵抗Ｒ１とで構成す
ることができる。この時抵抗Ｒ１〜Ｒ１の関係は、Ｒ＋
＋ （Ｒ２／’Ｒ３）＝ＩＭΩ ・・・（１）
［但し、Ｒ２／’ Ｒ３はＲ２とＲ３の合成抵抗を示す
］で、第１増幅回路ＯＰＡの入力インピーダンスを形成
し、Ｆ ＥＴ Ｑ ＋はＪＦＥＴで、トランジスタＱ２
と抵抗Ｒ９により出力Ｔｏが決まりｖＯ６が決まる。
力値か導かれドレインが共通電圧に接続しソースが切換
スイッチＳＷ２の可動接点ａに接続されるＦＥＴＱ＋
と、コレクタにＦ Ｅ Ｔ Ｑ １のソスが接続されエ
ミッタにｆｌ！！＠が共通電圧に接続された抵抗Ｒ９の
一端が接続されたトランジスタＱ２と、Ｆ ＥＴ Ｑ
＋のゲートに一端が接続され他端に一端がアース接続さ
れた抵抗Ｒ２の他端が接続された抵抗Ｒ１と、抵抗Ｒ１
と抵抗Ｒ２との接続端に接続された抵抗Ｒ１とで構成す
ることができる。この時抵抗Ｒ１〜Ｒ１の関係は、Ｒ＋
＋ （Ｒ２／’Ｒ３）＝ＩＭΩ ・・・（１）
［但し、Ｒ２／’ Ｒ３はＲ２とＲ３の合成抵抗を示す
］で、第１増幅回路ＯＰＡの入力インピーダンスを形成
し、Ｆ ＥＴ Ｑ ＋はＪＦＥＴで、トランジスタＱ２
と抵抗Ｒ９により出力Ｔｏが決まりｖＯ６が決まる。
第２増幅回路ＯＰａは、固定接点Ｃに接続される他端が
アース接続する抵抗Ｒ１０と、この抵抗Ｒ４゜が共通に
ベースに接続されたトランジスタＱ３．Ｑ４と、一端が
共通電圧に接続されｌｔ！！端がトランジスタＱ３のエ
ミッタに接続される抵抗Ｒ，２と、一端が共通電圧に接
続され他端がトランジスタＱ４のエミッタに接続される
抵抗Ｒ１１と、トランジスタＱ３とＱ４のコレクタが共
通接続されて、ベースに接続されるトランジスタＱ５と
、一端が共通電圧に接続され他端がトランジスタＱ５の
ベースに接続される抵抗１亡、３と、一端がアース接続
され他端がトランジスタＱｚのベースに接続される抵抗
Ｒ７４と、コレクタが共通電圧に接続されエミッタか抵
抗丁ｔ’ｓに接続されるトランジスタＱ６と、コレクタ
がトランジスタＱ３Ｑ４のコレクタに接続されエミッタ
が前記抵抗Ｒ４６と他端が共通電圧に接続される抵抗Ｒ
１７接続部に接続されるトランジスタＱ７とで構成する
ことができる。
アース接続する抵抗Ｒ１０と、この抵抗Ｒ４゜が共通に
ベースに接続されたトランジスタＱ３．Ｑ４と、一端が
共通電圧に接続されｌｔ！！端がトランジスタＱ３のエ
ミッタに接続される抵抗Ｒ，２と、一端が共通電圧に接
続され他端がトランジスタＱ４のエミッタに接続される
抵抗Ｒ１１と、トランジスタＱ３とＱ４のコレクタが共
通接続されて、ベースに接続されるトランジスタＱ５と
、一端が共通電圧に接続され他端がトランジスタＱ５の
ベースに接続される抵抗１亡、３と、一端がアース接続
され他端がトランジスタＱｚのベースに接続される抵抗
Ｒ７４と、コレクタが共通電圧に接続されエミッタか抵
抗丁ｔ’ｓに接続されるトランジスタＱ６と、コレクタ
がトランジスタＱ３Ｑ４のコレクタに接続されエミッタ
が前記抵抗Ｒ４６と他端が共通電圧に接続される抵抗Ｒ
１７接続部に接続されるトランジスタＱ７とで構成する
ことができる。
この時、例えは、抵抗Ｒ１ｏを５０Ωとして第２増幅回
路ＯＰ８の入力インピーダンスとし、第２増幅回路ＯＰ
ＢのゲインＧυはＲ，、＝Ｒ，２とした時に、 Ｇυ＝２ （Ｒ＋ ３ ／／ Ｒ＋ ａ ） ／Ｒ＋
＋ ・・・（２）となる。
路ＯＰ８の入力インピーダンスとし、第２増幅回路ＯＰ
ＢのゲインＧυはＲ，、＝Ｒ，２とした時に、 Ｇυ＝２ （Ｒ＋ ３ ／／ Ｒ＋ ａ ） ／Ｒ＋
＋ ・・・（２）となる。
補正回路Ｆは、第１増幅回路ＯＰＡの第１信号■１を反
転端子に入力するオへアンプＱＢと、オペアンプＱ８の
非反転端子に接続される他端がアース接続された抵抗Ｒ
５と、オペ７２１９日の反転端子に接続された抵抗Ｒ４
と、オペアンプＱ６の出力端子にアノードが接続されカ
ソードのオフセット調整信号Ｓ２が前記第２増幅回路Ｏ
Ｐａ内のトランジスタＱ６のベースに接続されたツェナ
ーダイオードＺと、ツェナーダイオードＺのカソードと
共通電圧間に設けられた抵抗Ｒ６と、オペアンプＱ８の
出力端子と共通電圧との間に設けられる直列接続される
この接続点から前記第１増゛幅回路ＯＰＡ内のトランジ
スタＱ２のベースに前記オフセット調整信号Ｓ１を出力
する配置の抵抗Ｒ７、Ｒ８と、第２増幅回路ＯＰＨの出
力である第２信号ＩＢが一端に導かれ他端が前記抵抗Ｒ
４と他端がアース接続された抵抗Ｒ１９との接続部に接
続される抵抗Ｒ７８とで構成することができる。
転端子に入力するオへアンプＱＢと、オペアンプＱ８の
非反転端子に接続される他端がアース接続された抵抗Ｒ
５と、オペ７２１９日の反転端子に接続された抵抗Ｒ４
と、オペアンプＱ６の出力端子にアノードが接続されカ
ソードのオフセット調整信号Ｓ２が前記第２増幅回路Ｏ
Ｐａ内のトランジスタＱ６のベースに接続されたツェナ
ーダイオードＺと、ツェナーダイオードＺのカソードと
共通電圧間に設けられた抵抗Ｒ６と、オペアンプＱ８の
出力端子と共通電圧との間に設けられる直列接続される
この接続点から前記第１増゛幅回路ＯＰＡ内のトランジ
スタＱ２のベースに前記オフセット調整信号Ｓ１を出力
する配置の抵抗Ｒ７、Ｒ８と、第２増幅回路ＯＰＨの出
力である第２信号ＩＢが一端に導かれ他端が前記抵抗Ｒ
４と他端がアース接続された抵抗Ｒ１９との接続部に接
続される抵抗Ｒ７８とで構成することができる。
この時、例えば、Ｒ３＝Ｒ４とすると、（（Ｒ＋ ＋
Ｒ２／’ Ｒコ ）／Ｒ２／／ Ｒ３）Ｘ１２ （Ｒ
１３／／Ｒ＋ ａ ）／Ｒ＋ ＋ ） ＝（Ｒ＋ ｓ
十Ｒ＋ ９ ）／Ｒ＋ ｓ・・・（３）となる、又、Ｒ
７，Ｒ，はオペアンプＱ８の出力がフルに振れてもトラ
ンジスタＱ２が飽和しないような値に選定される。この
時トランジスタＱ５のベース電圧（ＶＢＥ）の直流分は
トランジスタＱ７のコレクタ電流ＩＣによって決まる。
Ｒ２／’ Ｒコ ）／Ｒ２／／ Ｒ３）Ｘ１２ （Ｒ
１３／／Ｒ＋ ａ ）／Ｒ＋ ＋ ） ＝（Ｒ＋ ｓ
十Ｒ＋ ９ ）／Ｒ＋ ｓ・・・（３）となる、又、Ｒ
７，Ｒ，はオペアンプＱ８の出力がフルに振れてもトラ
ンジスタＱ２が飽和しないような値に選定される。この
時トランジスタＱ５のベース電圧（ＶＢＥ）の直流分は
トランジスタＱ７のコレクタ電流ＩＣによって決まる。
又、オペアンプＱ８の出力から第１増幅回路ＯＰＡのオ
フセット迄のゲインＧＡは、 ＧＡ＝ （Ｒｓ ／ （Ｒ７＋Ｒ［］ ） ｌ Ｘ１／
（ｇｔ ＣＱ＋ ）・ＲＳ）・・・（４）オペアンプ
Ｑ８の出力から第２増幅回路ＯＰａのオフセット迄のゲ
インＣａは、 ＧＢ＝（Ｒ＋ ３ ／／Ｒ＋ ａ ）／Ｒ＋ ｓ
・・・（５）となる、尚、この時、Ｑ Ａ：＞ Ｑ Ｂ
となる。
フセット迄のゲインＧＡは、 ＧＡ＝ （Ｒｓ ／ （Ｒ７＋Ｒ［］ ） ｌ Ｘ１／
（ｇｔ ＣＱ＋ ）・ＲＳ）・・・（４）オペアンプ
Ｑ８の出力から第２増幅回路ＯＰａのオフセット迄のゲ
インＣａは、 ＧＢ＝（Ｒ＋ ３ ／／Ｒ＋ ａ ）／Ｒ＋ ｓ
・・・（５）となる、尚、この時、Ｑ Ａ：＞ Ｑ Ｂ
となる。
このように構成する結果、入力と出力を補正回路で比軸
してその直流成分の誤差を補正するために、オフセット
調整信号Ｓ、、Ｓ２が第１増幅回路ＯＰＡ及び第２増幅
回路ＯＰａに同時に導かれて、切換スイッチＳＷ２を切
換えていずれの時でも入力段増幅器の直流補正が行われ
る。
してその直流成分の誤差を補正するために、オフセット
調整信号Ｓ、、Ｓ２が第１増幅回路ＯＰＡ及び第２増幅
回路ＯＰａに同時に導かれて、切換スイッチＳＷ２を切
換えていずれの時でも入力段増幅器の直流補正が行われ
る。
即ち、切換スイッチＳＷ２を可動接点ａ側として、第１
増幅回路ＯＰ１と第２増幅回路ＯＰ２を接続した入力段
増幅回路の構成とした時は、上記具体的数字を代入した
例においては、Ｑ Ａ ’：＞ Ｑ Ｂなので、オフセ
ット調整はほとんど第１増幅回路ＯＰＡにおいて行われ
る（オフセット調整信号Ｓ１により第１増幅回路のオフ
セットが直流補正されることとなる）。又、切換スイッ
チＳＷ２を切換えて可動接点す側とし、第２増幅回路Ｏ
Ｐａのみとした時は、第１増幅回路ＯＰＡの出力が切り
離され、入力段増幅回路の出力としては第２増幅回路０
Ｐａ１つになり、第２増幅回路ＯＰＢだけが調整される
（オフセット調整信号Ｓ２により第２増幅回路ＯＰａが
直流補正される）。
増幅回路ＯＰ１と第２増幅回路ＯＰ２を接続した入力段
増幅回路の構成とした時は、上記具体的数字を代入した
例においては、Ｑ Ａ ’：＞ Ｑ Ｂなので、オフセ
ット調整はほとんど第１増幅回路ＯＰＡにおいて行われ
る（オフセット調整信号Ｓ１により第１増幅回路のオフ
セットが直流補正されることとなる）。又、切換スイッ
チＳＷ２を切換えて可動接点す側とし、第２増幅回路Ｏ
Ｐａのみとした時は、第１増幅回路ＯＰＡの出力が切り
離され、入力段増幅回路の出力としては第２増幅回路０
Ｐａ１つになり、第２増幅回路ＯＰＢだけが調整される
（オフセット調整信号Ｓ２により第２増幅回路ＯＰａが
直流補正される）。
尚、以上述べた各抵抗値等の具体的数値はこれに限定さ
れるものではなく、任意に設定・変更できる設計的事項
であることはいうまでもない、この時のオフセット条件
は、その数値によって異なる０例えば、可動接点ａ側に
おいては、場合によっては第１．２増幅回路のオフセッ
ト調整が同等に行なわれること＼も有得る。
れるものではなく、任意に設定・変更できる設計的事項
であることはいうまでもない、この時のオフセット条件
は、その数値によって異なる０例えば、可動接点ａ側に
おいては、場合によっては第１．２増幅回路のオフセッ
ト調整が同等に行なわれること＼も有得る。
［発明の効果］
本発明は、以上説明したように構成されているので、次
に記載するような効果を奏する。
に記載するような効果を奏する。
■：２つの増幅回路のオフセットを、補正回路を用いて
調整するので、回路簡素化ができ、この結果回路構成を
ローコスト化できる。
調整するので、回路簡素化ができ、この結果回路構成を
ローコスト化できる。
■：オフセットを調整する回路構成とした時にあっても
、例えば、この実施例のように、５０Ω入力の時に１Ｍ
Ω入力の第１増幅回路を通さなくともよいため、５０Ω
入力の周波数帯域を広くできる。
、例えば、この実施例のように、５０Ω入力の時に１Ｍ
Ω入力の第１増幅回路を通さなくともよいため、５０Ω
入力の周波数帯域を広くできる。
第１図は本発明の入力インピーダンス切換型増幅回路を
示す図、第２図は従来の入力インピーダンス切換型増幅
回路を示す図である。
示す図、第２図は従来の入力インピーダンス切換型増幅
回路を示す図である。
Claims (1)
- 入力インピーダンスを切換要素を用いて切換えて増幅し
て出力する入力インピーダンス切換型増幅回路において
、入力端子と他方の可動接点が直接接続される切換要素
の一方の可動接点と前記入力端子との間に設けられた入
力段増幅器を構成する第１増幅回路と、前記切換要素の
固定接点に接続する入力段増幅器を構成する第２増幅回
路と、前記第１増幅回路の信号と前記第２増幅回路の信
号を比較してその直流成分の誤差を補正して前記第１増
幅回路と前記第２増幅回路又は第２増幅回路で構成する
入力段増幅器のオフセットを調整するオフセット調整信
号を前記第１増幅回路及び前記第２増幅回路に出力する
補正回路と、を具備したことを特徴とする入力インピー
ダンス切換型増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63170269A JPH0220107A (ja) | 1988-07-08 | 1988-07-08 | 入力インピーダンス切換型増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63170269A JPH0220107A (ja) | 1988-07-08 | 1988-07-08 | 入力インピーダンス切換型増幅回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0220107A true JPH0220107A (ja) | 1990-01-23 |
Family
ID=15901807
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63170269A Pending JPH0220107A (ja) | 1988-07-08 | 1988-07-08 | 入力インピーダンス切換型増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0220107A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001007660A (ja) * | 1999-06-22 | 2001-01-12 | Advantest Corp | アナログ信号処理回路、ａｄ変換装置、半導体デバイス試験装置およびオシロスコープ |
-
1988
- 1988-07-08 JP JP63170269A patent/JPH0220107A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001007660A (ja) * | 1999-06-22 | 2001-01-12 | Advantest Corp | アナログ信号処理回路、ａｄ変換装置、半導体デバイス試験装置およびオシロスコープ |
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