JP6188647B2 - 半導体装置 - Google Patents
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Description
先ず、本願において開示される代表的な実施の形態について概要を説明する。代表的な実施の形態についての概要説明で括弧を付して参照する図面中の参照符号はそれが付された構成要素の概念に含まれるものを例示するに過ぎない。
複数のラインで構成される1フレーム毎の画像データを表示する表示パネル(5)を駆動するための駆動信号を出力可能な表示駆動回路(3)を備える半導体装置(2または3)であって、以下のように構成される。
項1において、前記半導体装置は、前記表示パネル上に積層されたタッチパネル(6)のタッチ状態を検知可能な、タッチパネルコントローラ(4)をさらに備え、以下のように構成される。
項1または項2において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内のM(Mは1以上の整数)ライン周期でN(Nは1以上の整数)ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する、駆動信号を出力可能に構成される。
項3において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内の前記Mライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動する、駆動信号を出力可能に構成される。
項4において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内の2ライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なる他の複数のラインを駆動する、駆動信号を出力可能に構成される。
項3において、前記表示駆動回路は、以下のような動作をさせるための駆動信号を出力可能に構成される。
項6において、前記表示駆動回路は、以下のような動作をさせるための駆動信号を出力可能に構成される。
項1から項7のうちの1項において、前記表示駆動回路は、メモリ(14)と制御部(13)とを備える。
項2において、前記表示駆動回路は、メモリ(14)と制御部(13)とを備える。
項2または項9において、前記表示駆動回路と前記タッチパネルコントローラとが、同一半導体基板上に集積される。
項8において、前記表示駆動回路は、圧縮回路(33)と展開回路(34)とをさらに備える。
項11において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内のM(Mは1以上の整数)ライン周期でN(Nは1以上の整数)ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する、駆動信号を出力可能に構成される。
複数のラインで構成される1フレーム毎の画像データを表示する表示パネル(5)と、前記表示パネルを駆動するための駆動信号を出力可能な表示駆動回路(3)とを備え、以下のように構成される。
項13において、前記表示パネル上に積層されたタッチパネル(6)と、前記タッチパネルのタッチ状態を検知するタッチパネルコントローラ(4)とをさらに備える。
項13または項14において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内のM(Mは1以上の整数)ライン周期でN(Nは1以上の整数)ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する。
項15において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内の前記Mライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動する。
項16において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内の2ライン周期で1ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なる他の複数のラインを駆動する。
項15において、前記表示駆動回路は、第1フレームの第1表示駆動期間に前記第1フレーム内のM(Mは1以上の整数)ライン周期でN(Nは1以上の整数)ライン毎に分散する、前記表示パネルの複数のラインを駆動する。さらに前記表示駆動回路は、前記第1フレームの第2表示駆動期間には、前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記第1フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する。さらに前記表示駆動回路は、前記第1フレームと連続する第2フレームの第1表示駆動期間に、前記第1フレームの第1表示駆動期間に表示駆動された複数のラインとは異なり、前記第2フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する。
項18において、前記表示駆動回路は、第1フレームの第1表示駆動期間に前記第1フレーム内の奇数ラインを駆動し、前記第1フレームの第2表示駆動期間に前記第1フレーム内の偶数ラインを駆動し、前記第1フレームと連続する第2フレームの第1表示駆動期間に前記第2フレーム内の偶数ラインを駆動し、前記第2フレームの第2表示駆動期間に前記第2フレーム内の奇数ラインを駆動する。
項15において、前記表示駆動回路は、表示駆動すべきラインを示すフラグを前記表示パネルに供給し、前記表示パネルは、前記Mライン周期で前記Nライン毎に記憶素子を設けたシフトレジスタ(22)を備える。前記シフトレジスタは、前記フラグが入力され1ライン毎にシフト可能に構成される。
項20において、前記表示パネルは、2ライン周期で1ライン毎に記憶素子を設けた2組のシフトレジスタ(22_4、22_5)を備える。
項21において、前記2組のシフトレジスタは、前記表示パネルの表示領域を挟む領域に配置される。
項15において、前記表示駆動回路は、圧縮回路(33)とメモリ(14)と展開回路(34)と制御部(13)とを備える。
項23において、前記表示駆動回路は、前記第1表示駆動期間に1フレーム内のM(Mは1以上の整数)ライン周期でN(Nは1以上の整数)ライン毎に分散する、前記表示パネルの複数のラインを駆動し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する、駆動信号を出力可能に構成される。
項24において、前記表示駆動回路は、表示駆動すべきラインを示すフラグを前記表示パネルに供給し、前記表示パネルは、前記Mライン周期で前記Nライン毎に記憶素子を設けたシフトレジスタを備え、前記シフトレジスタは、前記フラグが入力され1ライン毎にシフト可能に構成される、表示装置。
実施の形態について更に詳述する。
図1は、本発明に係る表示装置の構成例を表すブロック図である。
図1に示した表示装置1を構成する他のブロックについて説明する。表示装置1は、表示駆動回路3を内蔵したIC2と表示パネル5の上に積層されているタッチパネル6を含んで構成されるものとして説明する。表示パネル5とタッチパネル6は、単純に重ね合せられたオンセル方式でも、一体化されたインセル方式でもよい。IC2は、表示駆動回路3の他、タッチパネル6に接続されるタッチパネルコントローラ4と、表示装置1全体を制御するMPU7とを含んで構成される。
ラインを均等に複数の表示駆動期間に分散して表示する動作について、より詳細に説明する。
<パネル内ゲート制御回路>
図4は、表示パネル5の表示素子を駆動するパネル内ゲート制御回路20の構成例を表す回路図である。
本実施形態1において、表示駆動回路3は、1フレーム内に2回の表示駆動期間を持つ時分割動作を行ない、それぞれの表示駆動期間に1ラインごとに交互に表示駆動を行う。例えば、一方の表示駆動期間に奇数ラインを、他方の表示駆動期間に偶数ラインを、それぞれ表示する。
図8は、実施形態1の表示装置におけるパネル内ゲート制御回路の構成例を表す回路図である。
図10は、実施形態2の表示装置におけるパネル内ゲート制御回路の構成例を表す回路図である。パネル内ゲート制御回路20を、奇数ラインのゲートを駆動するパネル内ゲート制御回路20_1と、偶数ラインのゲートを駆動するパネル内ゲート制御回路20_2に分けて備える。奇数ラインのゲートを駆動するパネル内ゲート制御回路20_1には、ゲートドライバ21_1、21_3、…21_1023を備え、それぞれには、シフトレジスタ22_4を構成するフリップフロップ23_1、23_3、…23_1023の出力が入力され、ゲート線G1,G3,…G1023を出力する。偶数ラインのゲートを駆動するパネル内ゲート制御回路20_2には、ゲートドライバ21_2、21_4、…21_1024を備え、それぞれには、シフトレジスタ22_5を構成するフリップフロップ23_2、23_4、…23_1024の出力が入力され、ゲート線G2,G4,…G1024を出力する。
以上説明した実施の形態では、各表示駆動期間に駆動するラインの番号は、フレーム毎に同じであるものとして、換言すれば各フレームで表示駆動されるラインの順序は、一定であるものとして説明した。例えば、あるフレームで、第1表示駆動期間にG1,G4,G7…が駆動され、第2表示駆動期間にG2,G5,G8…が駆動され、第3表示駆動期間にG3,G6,G9…が駆動されるとする。そのとき次のフレームでも第1表示駆動期間には同じG1,G4,G7…が駆動され、第2表示駆動期間にも前フレームの第2表示駆動期間と同じG2,G5,G8…が駆動され、第3表示駆動期間も同様に前フレームの第3表示駆動期間と同じG3,G6,G9…が駆動される。
以上は、1フレーム内の表示駆動期間が3回の場合を例に採って説明したが、1フレーム内の表示駆動期間の数は任意である。
図15は、本実施形態4に係る表示装置の構成例を表すブロック図である。図1に示した表示装置の構成例と比較して、表示駆動回路3は、圧縮回路33と展開回路34とをさらに備える。
2 タッチパネルコントローラを内蔵した表示ドライバIC
3 表示駆動回路
4 タッチパネルコントローラ
5 表示パネル(液晶表示パネル)
6 タッチパネル
7 MCU
8 ゲート制御ドライバ
9 ソースドライバ
10 電源回路
11 システムインタフェース
12 表示インタフェース
13 制御部
14 メモリ
15 データラッチ
16 階調電圧選択
17 表示素子(液晶素子)
20 パネル内ゲート制御回路
21 ゲートドライバ
22 シフトレジスタ
23 フリップフロップ
31 第1表示駆動期間に表示駆動される領域
32 第2表示駆動期間に表示駆動される領域
33 圧縮回路
34 展開回路
Claims (3)
- 複数のラインで構成される1フレーム毎の画像データを表示する表示パネルを駆動するための駆動信号を出力可能な表示駆動回路と、前記表示パネル上に積層されたタッチパネルのタッチ状態を検知可能な、タッチパネルコントローラとを備える半導体装置であって、
前記表示パネルは、前記ラインを構成する複数の画素の1画素ごとに、前記画像データに対応する量の電荷を保持するキャパシタを備え、
前記表示駆動回路は、1フレーム期間内に、第1表示駆動期間と第1ブランク期間と第2表示駆動期間とを順次含む、時分割動作を可能に構成され、
前記第1及び第2表示駆動期間は、それぞれ、前記第1ブランク期間以上の長い期間、前記表示パネルの駆動が停止される、ブランク期間を含まず、
前記表示駆動回路は、前記第1表示駆動期間に、1フレーム内のMライン周期でNライン毎に分散する、前記表示パネルの1フレーム内の複数のラインを駆動し(ただし、Nは2以上の整数であり、Mは、M/Nが整数であるような整数)、前記第1ブランク期間に前記表示パネルの駆動を停止し、前記第2表示駆動期間に前記1フレーム内の前記第1表示駆動期間に表示駆動された複数のラインとは異なり、前記フレーム内の前記Mライン周期で前記Nライン毎に分散する、前記表示パネルの複数のラインを駆動する、駆動信号を出力可能に構成され、
前記タッチパネルコントローラは、前記第1ブランク期間に前記タッチ状態を検知するタッチ状態検知動作を行い、前記第1及び第2表示駆動期間に前記タッチ状態検知動作を停止し、
前記表示駆動回路は、メモリと制御部とを備え、
前記制御部は、表示すべき1フレームの上のラインから順次走査された順序で入力される画像データを、前記メモリに書き込み、前記第1表示駆動期間に、前記第1表示駆動期間に表示すべきラインの画像データを、表示駆動すべき順序で前記メモリから読み出し、前記第2表示駆動期間に、前記第2表示駆動期間に表示すべきラインの画像データを、前記メモリから読み出し、
前記表示駆動回路は、読み出された画像データに基づいて前記駆動信号を生成する、
半導体装置。 - 請求項1において、前記表示駆動回路は、圧縮回路と展開回路とをさらに備え、
前記制御部は、表示すべき1フレームの上のラインから順次走査された順序で入力される画像データを、前記圧縮回路によってデータ圧縮して前記メモリに書き込み、前記第1表示駆動期間に、前記第1表示駆動期間に表示すべきラインの画像データを含む、データ圧縮されたデータを、表示駆動すべき順序で前記メモリから読み出し、前記第2表示駆動期間に、前記第2表示駆動期間に表示すべきラインの画像データを含むデータ圧縮されたデータを、前記メモリから読み出し、
前記展開回路は、前記メモリから読み出されたデータ圧縮された前記データを展開することにより、表示すべき前記ラインの画像データを復元し、
前記表示駆動回路は、復元された前記画像データに基づいて前記駆動信号を生成する、
半導体装置。 - 請求項2において、前記圧縮回路は、前記Nラインを単位として画像データの前記データ圧縮を実行し、前記展開回路は、前記Nラインを単位として前記データ圧縮のデータを展開することにより画像データを復元する、
半導体装置。
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