JP5854673B2 - 固体撮像装置 - Google Patents
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Description
<第1実施形態>
本発明の第1実施形態にかかる固体撮像装置1を、図2(a)を参照しながら説明する。固体撮像装置1は、複数の画素10がアレイ状に配置された画素部20と、画素部20から出力されたアナログ信号をデジタル信号へ変換する変換部30と、クロック信号を後述のカウンタ部33のそれぞれに供給するクロック供給部40と、を含む。変換部30は、少なくとも一つのアナログデジタル変換部31を含む第1グループ91および少なくとも一つのアナログデジタル変換部31を含む第2グループ92を有する。本実施形態においては第1グループ91および第2グループ92の2つのグループを例示するが、変換部30は、アナログデジタル変換部31を含む他のグループをさらに有してもよい。クロック供給部40は、クロック信号を伝搬するように直列に接続された第1のクロックバッファ100および第2のクロックバッファ100を有する。第1グループ91のアナログデジタル変換部31および第2グループ92のアナログデジタル変換部31のそれぞれは、比較部32およびカウンタ部33を有する。比較部32は、アナログ信号と時間的に変化する参照電位(例えば、ランプ信号)とを比較してその結果を出力する。カウンタ部33は、比較部32において比較を開始してから比較結果が変化するまで時間を、クロック信号をカウントすることにより計測する。クロックバッファ100は、例えば、図3に示すような、差動回路3を含む。
<第2実施形態>
本発明の第2実施形態を説明する。第2実施形態は、クロックバッファ100に、図6に示すような差動回路4を使用する点で、第1実施形態と異なる。差動回路4は、差動回路3の回路構成に加え、NMOSトランジスタM5(第5のトランジスタ)とNMOSトランジスタM6(第6のトランジスタ)を、さらに含む。トランジスタM5は、トランジスタM3と並列に配置され、トランジスタM5のゲートはn2に接続されている。トランジスタM6は、トランジスタM4と並列に配置され、トランジスタM6のゲートはn1に接続されている。図3に示す差動回路3を使用した場合は、前述の第1のケース(図4)において、n1およびn2がフローティング状態となる期間T2およびT4があるという問題がある。この差動回路4をクロックバッファ100として使用することにより、この問題を解決し、さらに信頼性の高い固体撮像装置1を提供することができる。
<第3実施形態>
本発明の第3実施形態にかかる固体撮像装置2を、図2(b)を参照しながら説明する。第3実施形態は、クロックバッファ100における差動クロック信号の両方を使用する点で、第1実施形態と異なる。例えば、カウンタ部に、図8(b)に示すようなリップルカウンタ33a’を用いて、カウンタ部33’とすることが可能である。このカウンタ33a’は、タイムチャート(図4、図5等)に示すCKa_OUTの波形の立ち上がりエッジ、およびCKb_OUTの波形の立ち上がりエッジによってカウント動作する。即ち、CKa_OUTの立ち上がりと立ち下がりの両方のエッジによって動作する。従って、バッファリングによるクロック信号のデューティ比が崩れることは回避されたい。そこで本発明を適用することにより、クロック供給部40の末端までクロック信号のデューティ比を一定に保つことが可能である。
Claims (3)
- 複数の画素がアレイ状に配置された画素部と、
各々が前記画素部の各列に対応し該対応する列の各画素からのアナログ信号をデジタル信号に変換するための複数のアナログデジタル変換部を有する変換部であって、前記画素部の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第1グループと前記画素部の他の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第2グループとを含む変換部と、
クロック信号を供給するためのクロック供給部と、を含み、
前記第1グループのアナログデジタル変換部および前記第2グループのアナログデジタル変換部のそれぞれは、比較部およびカウンタ部を有し、
前記比較部は、前記アナログ信号と時間的に変化する参照電位とを比較して該比較の結果を出力し、
前記カウンタ部は、前記比較を開始してから前記比較の結果が変化するまでの時間を前記クロック供給部からのクロック信号をカウントすることにより計測し、
前記クロック供給部は、前記第1グループのアナログデジタル変換部のカウンタ部にクロック信号を供給する第1のクロックバッファおよび前記第2グループのアナログデジタル変換部のカウンタ部にクロック信号を供給する第2のクロックバッファを含み、
前記第1のクロックバッファは、互いに逆位相の2つのクロック信号を2つの入力端子でそれぞれ受けてデューティ比が補正された互いに逆位相の2つのクロック信号を2つの出力端子にそれぞれ出力する第1差動回路と、前記第1差動回路から出力された互いに逆位相の2つのクロック信号をそれぞれ偶数段のCMOSインバータ回路を介して出力し、 前記第2のクロックバッファは、前記第1のクロックバッファから出力された互いに逆位相の2つのクロック信号を2つの入力端子でそれぞれ受けてデューティ比が補正された互いに逆位相の2つのクロック信号を2つの出力端子にそれぞれ出力する第2差動回路と、前記第2差動回路から出力された互いに逆位相の2つのクロック信号をそれぞれ偶数段のCMOSインバータ回路を介して出力する、
ことを特徴とする固体撮像装置。 - 複数の画素がアレイ状に配置された画素部と、
各々が前記画素部の各列に対応し該対応する列の各画素からのアナログ信号をデジタル信号に変換するための複数のアナログデジタル変換部を有する変換部であって、前記画素部の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第1グループと前記画素部の他の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第2グループとを含む変換部と、
クロック信号を供給するためのクロック供給部と、を含み、
前記第1グループのアナログデジタル変換部および前記第2グループのアナログデジタル変換部のそれぞれは、比較部およびカウンタ部を有し、
前記比較部は、前記アナログ信号と時間的に変化する参照電位とを比較して該比較の結果を出力し、
前記カウンタ部は、前記比較を開始してから前記比較の結果が変化するまでの時間を前記クロック供給部からのクロック信号をカウントすることにより計測し、
前記クロック供給部は、互いに直列に接続された第1のクロックバッファおよび第2のクロックバッファであってクロック信号をバッファリングするための第1のクロックバッファおよび第2のクロックバッファを含んでおり、
前記第1のクロックバッファは、クロック信号のデューティ比を差動回路によって補正し、偶数段のCMOSインバータ回路を介して前記第1グループのカウンタ部のそれぞれと前記第2のクロックバッファとに出力し、
前記第2のクロックバッファは、前記第1のクロックバッファから供給されたクロック信号のデューティ比を差動回路によって補正し、偶数段のCMOSインバータ回路を介して前記第2グループのカウンタ部のそれぞれに出力し、
前記差動回路は、
電源電位と基準電位の間に第1ノード、第2ノード、第1のトランジスタ、第2のトランジスタ、第3のトランジスタ、および第4のトランジスタを含み、
前記第1のトランジスタは、PMOSトランジスタであって前記電源電位と前記第1ノードの間に配置され、
前記第1のトランジスタのゲートは前記第2ノードと電気的に接続され、
前記第2のトランジスタは、PMOSトランジスタであって前記電源電位と前記第2ノードの間に配置され、
前記第2のトランジスタのゲートは前記第1ノードと電気的に接続され、
前記第3のトランジスタは、NMOSトランジスタであって前記第1ノードと前記基準電位の間に配置され、
前記第4のトランジスタは、NMOSトランジスタであって前記第2ノードと前記基準電位の間に配置される、
ことを特徴とする固体撮像装置。 - 複数の画素がアレイ状に配置された画素部と、
各々が前記画素部の各列に対応し該対応する列の各画素からのアナログ信号をデジタル信号に変換するための複数のアナログデジタル変換部を有する変換部であって、前記画素部の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第1グループと前記画素部の他の少なくとも1列に対応する少なくとも1つのアナログデジタル変換部を含む第2グループとを含む変換部と、
クロック信号を供給するためのクロック供給部と、を含み、
前記第1グループのアナログデジタル変換部および前記第2グループのアナログデジタル変換部のそれぞれは、比較部およびカウンタ部を有し、
前記比較部は、前記アナログ信号と時間的に変化する参照電位とを比較して該比較の結果を出力し、
前記カウンタ部は、前記比較を開始してから前記比較の結果が変化するまでの時間を前記クロック供給部からのクロック信号をカウントすることにより計測し、
前記クロック供給部は、互いに直列に接続された第1のクロックバッファおよび第2のクロックバッファであってクロック信号をバッファリングするための第1のクロックバッファおよび第2のクロックバッファを含んでおり、
前記第1のクロックバッファは、クロック信号のデューティ比を差動回路によって補正し、偶数段のCMOSインバータ回路を介して前記第1グループのカウンタ部のそれぞれと前記第2のクロックバッファとに出力し、
前記第2のクロックバッファは、前記第1のクロックバッファから供給されたクロック信号のデューティ比を差動回路によって補正し、偶数段のCMOSインバータ回路を介して前記第2グループのカウンタ部のそれぞれに出力し、
前記差動回路は、
電源電位と基準電位の間に第1ノード、第2ノード、第1のトランジスタ、第2のトランジスタ、第3のトランジスタ、第4のトランジスタ、第5のトランジスタ、および第6のトランジスタを含み、
前記第1のトランジスタは、PMOSトランジスタであって前記電源電位と前記第1ノードの間に配置され、
前記第1のトランジスタのゲートは前記第2ノードと電気的に接続され、
前記第2のトランジスタは、PMOSトランジスタであって前記電源電位と前記第2ノードの間に配置され、
前記第2のトランジスタのゲートは前記第1ノードと電気的に接続され、
前記第3のトランジスタは、NMOSトランジスタであって前記第1ノードと前記基準電位の間に配置され、
前記第4のトランジスタは、NMOSトランジスタであって前記第2ノードと前記基準電位の間に配置され、
前記第5のトランジスタは、NMOSトランジスタであって前記第1ノードと前記基準電位の間に配置され、
前記第5のトランジスタのゲートは前記第2ノードと電気的に接続され、
前記第6のトランジスタは、NMOSトランジスタであって前記第2ノードと前記基準電位の間に配置され、
前記第6のトランジスタのゲートは前記第1ノードと電気的に接続される、
ことを特徴とする固体撮像装置。
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