JP5701003B2 - 半導体装置 - Google Patents

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Description

酸化物半導体を用いる半導体装置に関する。
なお、本明細書中において半導体装置とは、半導体特性を利用することで機能しうる装置全般を指し、液晶表示装置や発光装置などの電気光学装置、半導体回路及び電子機器は全て半導体装置である。
近年、絶縁表面を有する基板上に形成された半導体薄膜(厚さ数〜数百nm程度)を用いてトランジスタを構成する技術が注目されている。トランジスタはICや電気光学装置のような電子デバイスに広く応用され、特に画像表示装置のスイッチング素子として開発が急がれている。
半導体特性を示す材料の一つとして、金属酸化物が挙げられる。半導体特性を示す金属酸化物としては、例えば、酸化タングステン、酸化錫、酸化インジウム、酸化亜鉛などがあり、この様な半導体特性を示す金属酸化物をチャネル形成領域とするトランジスタが既に知られている(特許文献1及び特許文献2)。
また、酸化物半導体を用いたトランジスタは、比較的電界効果移動度が高い。そのため、該トランジスタを用いて、表示装置などの駆動回路を構成することもできる。
特開2007−123861号公報 特開2007−96055号公報
絶縁表面上に複数の異なる回路を形成する場合、例えば、画素回路(画素部とも言う)と駆動回路を同一基板上に形成する場合には、画素回路に用いるトランジスタには、オンオフ比が大きいなどの優れたスイッチング特性が要求され、駆動回路に用いるトランジスタには高速動作が可能なことが要求される。特に、表示部が高精細であればあるほど、表示画像の書き込み時間が短くなるため、駆動回路に用いるトランジスタは高速動作させることが好ましい。また、高精細化に伴って低下する開口率を向上させることで表示品質を高めることができる。
従って、本発明の一態様は、上記課題を解決することを目的とする。すなわち、優れたスイッチング特性を有し、高速動作が可能であり、かつ表示部を高精細化しても開口率の低減を引き起こさない半導体装置を提供することを目的とする。
本明細書で開示する本発明の一態様は、同一基板上にトランジスタで駆動回路部及び画素部を形成した半導体装置及びその作製方法であり、当該トランジスタは、ソース領域及びドレイン領域に酸化物導電体を含み、且つ半導体層が酸化物半導体によって構成されていることを特徴とする。
本明細書で開示する本発明の一態様は、同一基板上に第1のトランジスタを有する画素部と、第2のトランジスタを有する駆動回路部を有し、第1のトランジスタ及び第2のトランジスタは、ゲート電極層と、ゲート電極層上にゲート絶縁層と、ゲート絶縁層上に表層がナノ結晶からなる微結晶群で形成された酸化物半導体層と、酸化物半導体層の一部と重なるソース電極層及びドレイン電極層と、酸化物半導体層と接する酸化物絶縁層と、を有し、第1のトランジスタのゲート電極層、ソース電極層及びドレイン電極層は、非晶質の酸化物導電体で形成されており、第2のトランジスタのゲート電極層、ソース電極層及びドレイン電極層は、金属で形成されていることを特徴とする半導体装置である。
なお、本明細書において、第1、第2として付される序数詞は便宜上用いるものであり、工程順または積層順を示すものではない。また、本明細書において発明を特定するための事項として固有の名称を示すものではない。
上記構成において、第1のトランジスタのゲート電極層、ソース電極層及びドレイン電極層に透光性を有する材料を用いることで、開口率を高くすることができる。
また、第2のトランジスタのゲート電極層、ソース電極層及びドレイン電極層には、Ti、Mo、W、Al、Cr、Cu、Ta、から選ばれた元素を主成分とする単膜、または合金膜か、該膜の積層膜を用いることができる。
また、第2のトランジスタのソース電極層と酸化物半導体層、及び第2のトランジスタのドレイン電極層と酸化物半導体層のそれぞれの間には、酸化物導電層が形成されている。この構成とすることで接触抵抗を低減することができ、高速動作が可能なトランジスタを実現できる。
第1及び第2のトランジスタの酸化物半導体層上に形成される酸化物絶縁層には、酸化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜、または酸化窒化アルミニウムなどを用いることができる。
また、本発明の一態様であるトランジスタを用いて、駆動回路部及び画素回路部を同一基板上に形成し、EL素子、液晶素子または電気泳動素子などを用いて半導体装置を作製することができる。
また、本明細書で開示する本発明の他の一態様は、絶縁表面を有する基板上に第1のゲート電極層と第2のゲート電極層を形成し、第1のゲート電極層及び第2のゲート電極層上にゲート絶縁層を形成し、ゲート絶縁層上に第1の酸化物半導体層と第2の酸化物半導体層を形成し、加熱処理によって第1の酸化物半導体層及び第2の酸化物半導体層の表層にナノ結晶からなる微結晶群を形成し、ゲート絶縁層、第1の酸化物半導体層及び第2の酸化物半導体層上に酸化物導電層を形成し、酸化物導電層上に金属層を形成し、金属層及び酸化物導電層を選択的にエッチングすることにより、第1の酸化物半導体層の一部と重なるように酸化物導電層からなる第1のソース電極層及び第1のドレイン電極層を形成し、第2の酸化物半導体層の一部と重なり、かつ酸化物導電層と金属層の積層からなる第2のソース電極層と第2のドレイン電極層を形成し、第1の酸化物半導体層、第2の酸化物半導体層、第1のソース電極層、第1のドレイン電極層、第2のソース電極層及び第2のドレイン電極層上に酸化物絶縁層を形成することを特徴とする半導体装置の作製方法である。
本発明の一態様は逆スタガ型のボトムゲート構造のトランジスタであり、酸化物導電層の一部をエッチングすることでソース電極層、ドレイン電極層及びチャネル領域を形成する。このとき、酸化物導電層と、表層にナノ結晶からなる微結晶群を有した酸化物半導体層に対して高いエッチング選択比を有するリン酸、酢酸及び硝酸を含む混酸を用いると良い。該混酸を用いることで、酸化物導電層下部の酸化物半導体層の表層にあるナノ結晶からなる微結晶群は、ほとんどエッチングされない状態で残すことができる。
また、第1の酸化物半導体層及び第2の酸化物半導体層の加熱処理はラピッドサーマルアニール法で行うことが好ましい。
本発明の一態様によって、電気特性が良好で信頼性の高いトランジスタを作製することができ、表示品質及び信頼性の高い半導体装置を提供することができる。
本発明の一態様を示す断面工程図。 本発明の一態様を示す断面図。 本発明の一態様を示す断面図。 半導体装置を説明する平面図及び断面図。 半導体装置を説明する断面図。 半導体装置を説明する平面図及び断面図。 本発明の一態様を示す断面図。 半導体装置を説明する断面図。 電子機器を示す図。 電子機器を示す図。 電子機器を示す図。 電子機器を示す図。 電子機器を示す図。
以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は以下の説明に限定されず、その形態及び詳細を様々に変更し得ることは、当業者であれば容易に理解される。また、本発明は以下に示す実施の形態の記載内容に限定して解釈されるものではない。なお、本明細書中の図面において、同一部分または同様な機能を有する部分には同一の符号を付し、その説明は省略する場合がある。
(実施の形態1)
本実施の形態では、本発明の一形態である半導体装置及びその作製方法を説明する。
図1(E)は同一基板上に作製された異なる構造の2つのトランジスタの断面構造を示しており、トランジスタ440、460は、逆スタガ型と呼ばれるボトムゲート構造の一つである。
画素に配置されるトランジスタ460は、絶縁表面を有する基板400上に、ゲート電極層451a、ゲート絶縁層402、酸化物半導体層405、ソース電極層455a、及びドレイン電極層455bを含んで構成される。また、トランジスタ460を覆い、酸化物半導体層405の側面に接する酸化物絶縁層426、上面に接する酸化物の絶縁層427が設けられている。なお、酸化物絶縁層426を省いた構成とすることもできる。
また、画素に配置されるトランジスタ460は、一例としてシングルゲート構造のトランジスタを図示したが、チャネル形成領域を複数有するマルチゲート構造のトランジスタであっても良い。
トランジスタ460は、ゲート電極層451a上にゲート絶縁層402及び酸化物半導体層405が重なり、該酸化物半導体層405上にソース電極層455a、及びドレイン電極層455bの一部が重なって形成されている。ここで、トランジスタ460のチャネル形成領域は、酸化物半導体層405のうち、ソース電極層455aの側面と該側面と向かい合うドレイン電極層455bの側面で挟まれる領域、即ち、ゲート絶縁層402と接し、且つゲート電極層451aと重なる領域である。
また、トランジスタ460は、ゲート電極層451a、ソース電極層455a、及びドレイン電極層455bに透光性を有する導電膜を用いることで、高開口率を有する半導体装置を実現することができる。
透光性を有する導電膜には、可視光に対して透光性を有する導電材料、例えばIn−Sn−O系、In−Sn−Zn−O系、In−Al−Zn−O系、Sn−Ga−Zn−O系、Al−Ga−Zn−O系、Sn−Al−Zn−O系、In−Zn−O系、Sn−Zn−O系、Al−Zn−O系、In−O系、Sn−O系、Zn−O系の酸化物導電材料を用いることができる。なお、透光性を有する該導電膜の形成にスパッタ法を用いる場合は、酸化珪素を2重量%以上10重量%以下含むターゲットを用いて成膜を行い、透光性を有する導電膜にSiOx(X>0)を含ませ、非晶質の状態としても良い。
駆動回路部に配置されるトランジスタ440は、絶縁表面を有する基板400上に、ゲート電極層421a、ゲート絶縁層402、酸化物半導体層404、酸化物導電層446a、446b、ソース電極層445a、及びドレイン電極層445bを含んで構成される。また、チャネル形成領域443、ソース電極層445a、及びドレイン電極層445b上には絶縁層427及び保護絶縁層428が設けられる。
トランジスタ440のゲート電極層421a、ソース電極層445a及びドレイン電極層445bは、Ti、Mo、W、Al、Cr、Cu、Taから選ばれた元素を主成分とする単膜、または合金膜か、該膜の積層膜で形成することができる。また、ソース電極層445aと酸化物半導体層404、及びドレイン電極層445bと酸化物半導体層404の間にはそれぞれの酸化物導電層446a、446bが形成されている。この構成とすることで接触抵抗を低減することができ、高速動作が可能なトランジスタを実現できる。なお、該酸化物導電層446a、446bは、トランジスタ460のソース電極層455a及びドレイン電極層455bと同一の材料で形成される。
また、酸化物絶縁層426と重なる酸化物半導体層404の第1領域444c、第2領域444dは、チャネル形成領域443と同じ酸素過剰な状態であり、リーク電流の低減や、寄生容量を低減する機能も果たしている。
酸化物半導体層404、405には、四元系金属酸化物であるIn−Sn−Ga−Zn−O系金属酸化物や、三元系金属酸化物であるIn−Ga−Zn−O系金属酸化物、In−Sn−Zn−O系金属酸化物、In−Al−Zn−O系金属酸化物、Sn−Ga−Zn−O系金属酸化物、Al−Ga−Zn−O系金属酸化物、Sn−Al−Zn−O系金属酸化物や、二元系金属酸化物であるIn−Zn−O系金属酸化物、Sn−Zn−O系金属酸化物、Al−Zn−O系金属酸化物、Zn−Mg−O系金属酸化物、Sn−Mg−O系金属酸化物、In−Mg−O系金属酸化物や、In−O系金属酸化物、Sn−O系金属酸化物、Zn−O系金属酸化物などの酸化物半導体を用いることができる。また、上記酸化物半導体に酸化珪素を含んでもよい。
なお、酸化物半導体層404、405としては、InMO(ZnO)(m>0)で表記される薄膜を用いることができる。ここで、Mは、Ga、Al、Mn及びCoから選ばれた一または複数の金属元素を示す。例えばMとして、Ga、Ga及びAl、Ga及びMn、またはGa及びCoなどがある。InMO(ZnO)(m>0)で表記される構造の酸化物半導体膜のうち、MとしてGaを含む構造の酸化物半導体膜を、上記したIn−Ga−Zn−O酸化物半導体膜とよび、その薄膜をIn−Ga−Zn−O膜ともよぶこととする。
また、酸化物半導体層404、405は、RTA(ラピッドサーマルアニール)法等で高温短時間の脱水化または脱水素化処理が施される。脱水化または脱水素化処理は、不活性ガス雰囲気下で抵抗加熱やランプ照射などの手段を用い、500℃以上750℃以下(若しくはガラス基板の歪点以下の温度)で1分間以上10分間以下程度、好ましくは650℃、3分間以上6分間以下程度の加熱処理で行うことができる。RTA法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の歪点を超える温度でも処理することができる。
酸化物半導体層404、405は、成膜された段階では多くの未結合手を有する非晶質であるが、上記脱水化または脱水素化処理の加熱工程を行うことで、近距離にある未結合手同士が結合し合い、秩序化された非晶質構造とすることができる。また、秩序化が発展すると、非晶質領域中に微結晶が点在した非晶質酸化物半導体と微結晶酸化物半導体の混合物、または全体が微結晶群で形成されるようになる。ここで、微結晶の粒子サイズは1nm以上20nm以下の所謂ナノクリスタル(ナノ結晶とも呼ぶ)であり、一般的にマイクロクリスタルと呼ばれる微結晶粒子よりも小さいサイズである。
また、上記加熱工程で結晶領域となる酸化物半導体層404、405の表層部は、膜表面に対し垂直方向にc軸配向をしたナノサイズの微結晶が形成され、c軸方向に結晶の長軸を有し、短軸方向は1nm以上20nm以下となる。
従って、酸化物半導体層404、405の表層部は、ナノ結晶の微結晶群404a、405aで構成された緻密な結晶領域が存在するため、表層部を通しての水分の侵入や、酸素の脱離によりn型化し、その影響で電気特性が劣化することを防止することができる。また、酸化物半導体層404、405の表層部は、バックチャネル側であり、n型化の防止は寄生チャネルの抑制にも効果がある。また、結晶領域を有することで導電率が向上した表層部とソース電極層445a、455aまたはドレイン電極層445b、455bとの接触抵抗を下げることができる。
ここで、In−Ga−Zn−O膜は、用いる金属酸化物ターゲットによって、成長しやすい結晶構造が異なる。例えば、モル数比がIn:Ga:ZnO=1:1:1となるIn、Ga、及びZnを含む金属酸化物ターゲットを用いてIn−Ga−Zn−O膜を成膜し、加熱工程を経て結晶化させた場合、In酸化物層で挟まれる領域は、GaとZnを含む1層または2層の酸化物層が混在する六方晶系層状化合物型の結晶構造となりやすい。また、モル数比がIn:Ga:ZnO=1:1:2のターゲットを用いて成膜し、加熱工程を経て結晶化させた場合は、In酸化物層で挟まれるGaとZnを含む酸化物層は2層となりやすい。安定な結晶構造は後者のGaとZnを含む酸化物層が2層のものであり、結晶成長も起こりやすく、モル数比がIn:Ga:ZnO=1:1:2のターゲットを用いて成膜し、加熱工程を経て結晶化させた場合は、表層からゲート絶縁膜界面までつながった結晶が形成されることがある。なお、モル数比は酸化物層中の金属の原子数比と言い換えても良い。
なお、工程の順序によっては酸化物半導体層の側面部には結晶領域は形成されず、側面部を除く上層部のみに結晶領域は形成される。ただし、側面部の面積比率は小さく、この場合においても、電気特性の劣化や寄生チャネルに対する上記効果が維持される。
以下、図1(A)、(B)、(C)、(D)、(E)を用い、同一基板上にトランジスタ440及びトランジスタ460を作製する工程を説明する。
まず、絶縁表面を有する基板400上に導電膜を形成した後、第1のフォトリソグラフィ工程及びエッチング工程によりゲート電極層421a、421bを形成する。
なお、レジストマスクをインクジェット法で形成してもよい。レジストマスクをインクジェット法で形成するとフォトマスクを使用しないため、製造コストを低減できる。もちろん、第1のフォトリソグラフィ工程だけでなく、他のフォトリソグラフィ工程にもインクジェット法を適用できる。
ゲート電極層421a、421bを形成する導電膜としては、Ti、Mo、W、Al、Cr、Cu、Taから選ばれた元素を主成分とする単膜、または合金膜か、該膜の積層膜等が挙げられる。
また、基板400としては、後の加熱処理の温度が高い場合には、歪み点が730℃以上のガラス基板を用いると良い。また、ガラス基板には、例えば、アルミノシリケートガラス、アルミノホウケイ酸ガラス、バリウムホウケイ酸ガラスなどのガラス材料が用いられている。なお、一般的に酸化ホウ素と比較して酸化バリウム(BaO)を多く含ませることで、より実用的な耐熱ガラスが得られる。このため、BよりBaOを多く含むガラス基板を用いることが好ましい。
なお、上記のガラス基板に代えて、セラミック基板、石英基板、サファイア基板などの絶縁体でなる基板を用いても良い。他にも、結晶化ガラスなどを用いることができる。
また、下地膜となる絶縁層を基板400とゲート電極層421a、421bの間に設けてもよい。下地膜は、基板400からの不純物元素の拡散を防止する機能があり、窒化珪素膜、酸化珪素膜、窒化酸化珪素膜、または酸化窒化珪素膜から選ばれた一つ、または複数の膜による積層構造により形成することができる。
次いで、ゲート電極層421a、421bを覆って透光性を有する酸化物導電層を成膜した後、第2のフォトリソグラフィ工程及びエッチング工程によりゲート電極層451a、451bを形成する。本実施の形態では、配線抵抗を低減するため、画素部に配置されるゲート配線は、ゲート電極層421bと同じ金属膜で形成する。
透光性を有する酸化物導電層としては、可視光に対して透光性を有する導電材料であり、例えばIn−Sn−O系、In−Sn−Zn−O系、In−Al−Zn−O系、Sn−Ga−Zn−O系、Al−Ga−Zn−O系、Sn−Al−Zn−O系、In−Zn−O系、Sn−Zn−O系、Al−Zn−O系、In−O系、Sn−O系、Zn−O系の酸化物導電材料を適用することができ、スパッタ法を用いる場合は、酸化珪素を2重量%以上10重量%以下含むターゲットを用いて成膜を行い、透光性を有する導電膜にSiOx(X>0)を含ませ、非晶質の状態としても良い。本実施の形態では酸化珪素を含むインジウム錫酸化物を用いる。
次いで、ゲート電極層421a、421b、451a、451b上にゲート絶縁層402を形成する。
本実施の形態において、ゲート絶縁層402の形成は、高密度プラズマ装置により行う。ここでは、高密度プラズマ装置は、1×1011/cm以上のプラズマ密度を達成できる装置を指している。例えば、3kW〜6kWのマイクロ波電力を印加してプラズマを発生させて、絶縁膜の成膜を行う。
チャンバーに材料ガスとしてモノシランガス(SiH)と亜酸化窒素(NO)と希ガスを導入し、10Pa〜30Paの圧力下で高密度プラズマを発生させてガラス等の絶縁表面を有する基板上に絶縁膜を形成する。その後、モノシランガスの供給を停止し、基板を大気に曝すことなく亜酸化窒素(NO)と希ガスとを導入して絶縁膜表面にプラズマ処理を行ってもよい。上記プロセス順序を経た絶縁膜は、膜厚が薄く、例えば100nm未満であっても半導体装置の信頼性を確保することができる絶縁膜である。
ゲート絶縁層402の形成の際、チャンバーに導入するモノシランガス(SiH)と亜酸化窒素(NO)との流量比は、1:10から1:200の範囲とする。また、チャンバーに導入する希ガスとしては、ヘリウム、アルゴン、クリプトン、キセノンなどを用いることができるが、中でも安価であるアルゴンを用いることが好ましい。
また、高密度プラズマ装置により得られた絶縁膜は、一定した厚さの膜形成ができるため段差被覆性に優れている。また、高密度プラズマ装置を用いることにより、絶縁膜の厚みを精密に制御することができる。
上記プロセス順序を経た絶縁膜は、従来の平行平板型のPCVD装置で得られる絶縁膜とは大きく異なっており、同じエッチャントを用いてエッチング速度を比較した場合において、平行平板型のPCVD装置で得られる絶縁膜の10%以上または20%以上遅く、高密度プラズマ装置で得られる絶縁膜は緻密な膜と言える。
本実施の形態では、ゲート絶縁層402として高密度プラズマ装置による膜厚100nmの酸化窒化珪素膜(SiOxNyとも呼ぶ、ただし、x>y>0)を用いる。
他の方法としてゲート絶縁層402は、プラズマCVD法またはスパッタリング法等を用いて形成することができる。この場合、ゲート絶縁層402は、酸化珪素層、窒化珪素層、酸化窒化珪素層または窒化酸化珪素層の単層、またはそれらの積層で形成することができる。例えば、成膜ガスとして、SiH、酸素及び窒素を用いてプラズマCVD法により酸化窒化珪素層を形成すればよい。ゲート絶縁層402の膜厚は、100nm以上500nm以下とし、積層の場合は、例えば、膜厚50nm以上200nm以下の第1のゲート絶縁層と、第1のゲート絶縁層上に膜厚5nm以上300nm以下の第2のゲート絶縁層の積層とする。
次いで、第3のフォトリソグラフィ工程及びエッチング工程により、ゲート電極層421bに達するコンタクトホールをゲート絶縁層402に形成する。ただし、酸化物半導体膜を成膜、エッチングした後に酸化物半導体層上にレジストマスクを形成し、ゲート電極層421bに達するコンタクトホールを形成しても良い。その場合には逆スパッタを行い、酸化物半導体層及びゲート絶縁層402の表面に付着しているレジスト残渣などを除去することが好ましい。
本実施の形態では、第3のフォトリソグラフィ工程及びエッチング工程により、ゲート電極層421bに達するコンタクトホールをゲート絶縁層402に形成するため、コンタクトホール形成後に、不活性ガス雰囲気(窒素、またはヘリウム、ネオン、アルゴン等)下において加熱処理(400℃以上基板の歪み点未満)を行い、ゲート絶縁層402に含まれる水素及び水などの不純物を除去した後、酸化物半導体膜を成膜することが好ましい。
次いで、ゲート絶縁層402上に、膜厚5nm以上200nm以下、好ましくは10nm以上20nm以下の酸化物半導体膜403を形成する(図1(A)参照)。
酸化物半導体膜403は、四元系金属酸化物であるIn−Sn−Ga−Zn−O系や、三元系金属酸化物であるIn−Ga−Zn−O系金属酸化物、In−Sn−Zn−O系金属酸化物、In−Al−Zn−O系金属酸化物、Sn−Ga−Zn−O系金属酸化物、Al−Ga−Zn−O系金属酸化物、Sn−Al−Zn−O系金属酸化物や、二元系金属酸化物であるIn−Zn−O系金属酸化物、Sn−Zn−O系金属酸化物、Al−Zn−O系金属酸化物、Zn−Mg−O系金属酸化物、Sn−Mg−O系金属酸化物、In−Mg−O系金属酸化物や、In−O系金属酸化物、Sn−O系金属酸化物、Zn−O系金属酸化物などの酸化物半導体膜を用いることができる。また、上記酸化物半導体膜に酸化珪素を含んでもよい。また、酸化物半導体膜403は、希ガス(代表的にはアルゴン)雰囲気下、酸素雰囲気下、または希ガス(代表的にはアルゴン)及び酸素雰囲気下においてスパッタ法により形成することができる。
ここでは、In、Ga、及びZnを含む金属酸化物ターゲット(モル数比がIn:Ga:ZnO=1:1:1、またはIn:Ga:ZnO=1:1:2を用いて、基板とターゲットの間との距離を100mm、圧力0.6Pa、直流(DC)電源0.5kW、酸素(酸素流量比率100%)雰囲気下で成膜する。なお、パルス直流(DC)電源を用いると、成膜時に発生する粉状物質(パーティクル、ゴミともいう)が軽減でき、膜厚分布も均一となるために好ましい。本実施の形態では、酸化物半導体膜403として、In−Ga−Zn−O系金属酸化物ターゲットを用いてスパッタ法により膜厚15nmのIn−Ga−Zn−O膜を成膜する。
スパッタ法にはスパッタ用電源に高周波電源を用いるRFスパッタ法と、DCスパッタ法があり、さらにパルス的にバイアスを与えるパルスDCスパッタ法もある。RFスパッタ法は主に絶縁層を成膜する場合に用いられ、DCスパッタ法は主に導電層を成膜する場合に用いられる。
また、材料の異なるターゲットを複数設置できる多元スパッタ装置もある。多元スパッタ装置は、同一チャンバーで異なる材料膜を積層成膜することも、同一チャンバーで複数種類の材料を同時に放電させて成膜することもできる。
また、チャンバー内部に磁石機構を備えたマグネトロンスパッタ法を用いるスパッタ装置や、グロー放電を使わずマイクロ波を用いて発生させたプラズマを用いるECRスパッタ法を用いるスパッタ装置がある。
また、成膜中にターゲット物質とスパッタガスとを化学反応させてそれらの化合物薄膜を形成するリアクティブスパッタ法や、成膜中に基板にも電圧をかけるバイアススパッタ法もある。
なお、酸化物半導体膜をスパッタ法により成膜する前に、アルゴンガスを導入してプラズマを発生させる逆スパッタを行い、ゲート絶縁層402の表面に付着しているゴミを除去することが好ましい。逆スパッタとは、アルゴン雰囲気下で基板側にRF電源を用いて電圧を印加し、イオン化したアルゴンを基板に衝突させて表面を改質する方法である。なお、アルゴンに代えて窒素、ヘリウム、酸素などを用いてもよい。
また、酸化物半導体膜の成膜前に、不活性ガス雰囲気(窒素、またはヘリウム、ネオン、アルゴン等)下において加熱処理を行い、ゲート絶縁層402内に含まれる水素及び水などの不純物を除去したゲート絶縁層としてもよい。
次いで、酸化物半導体膜403を第4のフォトリソグラフィ工程及びエッチング工程により島状の酸化物半導体層404、405に加工する。
次いで、酸化物半導体層404、405の脱水化または脱水素化を行う。この脱水化または脱水素化を行う第1の加熱処理は、不活性ガス雰囲気下で抵抗加熱やランプ照射などの手段を用い、500℃以上750℃以下(若しくはガラス基板の歪点以下の温度)で1分間以上10分間以下、好ましくは650℃、3分間以上6分間以下の加熱処理で行うことができる。RTA法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の歪点を超える温度でも処理することができる。なお、第1の加熱処理は、このタイミングに限らず、フォトリソグラフィ工程や成膜工程の前後などで複数回行っても良い。
なお、本明細書では、酸化物半導体層に対して行う、窒素、または希ガス等の不活性気体雰囲気下での加熱処理を脱水化または脱水素化のための加熱処理と呼ぶ。本明細書では、この加熱処理によってHとして脱離させていることのみを脱水素化と呼んでいるわけではなく、H、OHなどを脱離することを含めて脱水化または脱水素化と便宜上呼ぶこととする。
脱水化または脱水素化を行った酸化物半導体層は、大気に触れさせることなく、水または水素を再び混入させないことが重要である。脱水化または脱水素化を行い、酸化物半導体層をn型化(n、nなど)、即ち低抵抗化させた後、i型として高抵抗化させた酸化物半導体層を用いたトランジスタは、そのしきい値電圧値が正であり、所謂ノーマリーオフ特性を示す。表示装置に用いるトランジスタは、ゲート電圧が0Vにできるだけ近い正のしきい値電圧であることが好ましい。アクティブマトリクス型の表示装置においては、回路を構成するトランジスタの電気特性が重要であり、この電気特性が表示装置の性能を左右する。特に、トランジスタのしきい値電圧は重要である。トランジスタのしきい値電圧値が負であると、ゲート電圧が0Vでもソース電極とドレイン電極の間に電流が流れる、所謂ノーマリーオン特性となり、該トランジスタで構成した回路を制御することが困難となる。また、しきい値電圧値が正であっても、その絶対値が高いトランジスタの場合には、駆動電圧が高くなり、場合によってはスイッチング動作そのものができないことがある。nチャネル型のトランジスタの場合は、ゲート電圧に正の電圧を印加してはじめてチャネルが形成されて、ドレイン電流が流れ出すトランジスタであることが望ましい。駆動電圧を高くしないとチャネルが形成されないトランジスタや、負の電圧状態でもチャネルが形成されてドレイン電流が流れるトランジスタは、回路に用いるトランジスタとしては不向きである。
脱水化または脱水素化後の酸化物半導体層の冷却は、脱水化または脱水素化時の雰囲気と異なる雰囲気で行っても良い。例えば、脱水化または脱水素化を行った同じ炉で大気に触れさせることなく、炉の中を高純度の酸素ガスまたはNOガス、ドライエアー(露点が−40℃以下、好ましくは−60℃以下)で満たして冷却を行うことができる。
なお、第1の加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水や水素などが含まれないことが好ましい。ここで、加熱処理装置に導入する窒素、またはヘリウム、ネオン、アルゴン等の希ガスの純度は、6N(99.9999%)以上、好ましくは7N(99.99999%)以上とすることが好ましい。
上記、不活性気体雰囲気下での第1の加熱処理を行った場合、酸化物半導体層は第1の加熱処理により酸素欠乏型となってn型化(n化など)、即ち低抵抗化する。その後、酸化物半導体層に接する酸化物絶縁層の形成を行うことにより酸化物半導体層を酸素過剰な状態とすることで高抵抗化、即ちi型化させているとも言える。これにより、電気特性が良好で信頼性のよいトランジスタを作製することができる。
昇温脱離ガス分析法(TDS:(Thermal Desorption Spectroscopy)で第1の加熱処理をしていない酸化物半導体層を分析すると、スペクトル中に450℃までに水分の脱離を示す2つのピークが見られる。一方で、上記条件で脱水化または脱水素化を十分に行った酸化物半導体層は、該ピークのうち、少なくとも250〜300℃に現れる1つのピークは検出されない。
本実施の形態ではRTA(ラピッドサーマルアニール)装置に基板を導入し、酸化物半導体層404、405に対して窒素雰囲気下で650℃、6分間の加熱処理を行う。このとき、酸化物半導体層404、405の脱水化または脱水素化が行われるだけでなく、酸化物半導体層404、405の表層は結晶化し、ナノ結晶からなる微結晶群404a、405aが形成される(図1(B)参照)。
第1の加熱処理後の酸化物半導体層は、酸素欠乏型となって成膜直後よりもキャリア濃度が高まり、1×1018/cm以上のキャリア濃度を有し、低抵抗化した酸化物半導体層404、405となる。また、第1の加熱処理の条件、または酸化物半導体層の材料によっては、膜全体が結晶化し、微結晶または多結晶となる場合もある。
また、ゲート電極層451a、451bも第1の加熱処理の条件、または材料によっては、結晶化し、微結晶または多結晶となる場合もある。例えば、ゲート電極層451a、451bとして、インジウム錫酸化物を用いる場合は450℃1時間の第1の加熱処理で結晶化するが、酸化珪素を含むインジウム錫酸化物を用いる場合は結晶化が起こりにくい。
また、酸化物半導体層の第1の加熱処理は、島状の酸化物半導体層に加工する前の酸化物半導体膜403に行うこともできる。
次いで、ゲート絶縁層402、及び酸化物半導体層404、405上に、スパッタ法で酸化物絶縁層を形成した後、第5のフォトリソグラフィ工程によりレジストマスクを形成し、選択的にエッチングを行って酸化物絶縁層426を形成し、その後レジストマスクを除去する。この段階で酸化物半導体層404、405の周縁及び側面は、酸化物絶縁層426で覆われる。ただし、この酸化物絶縁層426は省くこともできる。次に、第5のフォトリソグラフィ工程及びエッチング工程によりゲート電極層421bに達するコンタクトホールの形成を行う。
酸化物絶縁層426は、少なくとも1nm以上の膜厚とし、酸化物絶縁層426に水、水素等の不純物を混入させない方法を適宜用いて形成することができる。本実施の形態では、酸化物絶縁層426として酸化珪素膜をスパッタ法で成膜する。成膜時の基板温度は、室温以上300℃以下とすればよく、本実施の形態では100℃とする。ここで、成膜時に水、水素等の不純物を混入させない方法として、成膜前に減圧下で150℃以上350℃以下の温度で2分間以上10分間以下のプリベークを行い、大気に触れることなく酸化物絶縁層を形成することが望ましい。酸化珪素膜のスパッタ法による成膜は、希ガス(代表的にはアルゴン)及び酸素の一方の雰囲気下、または両方が混合された雰囲気下において行うことができる。また、成膜用ターゲットとして酸化珪素ターゲットまたは珪素ターゲットを用いることができる。例えば、珪素ターゲットを用いて、酸素、及び希ガス雰囲気下でスパッタ法により酸化珪素膜を形成することができる。低抵抗化した酸化物半導体層に接して形成する酸化物絶縁層としては、水分や、水素イオンや、OHなどの不純物を含まず、これらが外部から侵入することをブロックする無機絶縁膜を用い、代表的には酸化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜、または酸化窒化アルミニウム膜などを用いる。
本実施の形態では、純度が6Nであり、柱状多結晶Bドープの珪素ターゲット(抵抗値0.01Ωcm)を用い、基板とターゲットの間との距離(T−S間距離)を89mm、圧力0.4Pa、直流(DC)電源6kW、酸素(酸素流量比率100%)雰囲気下でパルスDCスパッタ法により成膜する。膜厚は300nmとする。
次いで、ゲート絶縁層402、酸化物絶縁層426、及び酸化物半導体層404、405上に、酸化物導電層と金属層の積層を形成する。スパッタ法を用いれば、酸化物導電層と金属層の積層を大気に触れることなく連続的に成膜を行うことができる(図1(C)参照)。
酸化物導電層としては、前述したゲート電極層451a、451bに適用する可視光に対して透光性を有する導電材料を用いることが望ましい。本実施の形態では酸化珪素を含むインジウム錫酸化物を用いる。
また、金属膜としては、Ti、Mo、W、Al、Cr、Cu、Ta、から選ばれた元素、または上述した元素を成分とする合金か、上述した元素を組み合わせた合金等を用いる。また、上述した元素を含む単層に限定されず、積層を用いることができる。金属膜の成膜方法は、上述したスパッタ法だけでなく、真空蒸着法(電子ビーム蒸着法など)や、アーク放電イオンプレーティング法や、スプレー法なども用いることができる。本実施の形態ではスパッタ法で形成するチタン膜を用いる。
次いで、第6のフォトリソグラフィ工程によりレジストマスクを形成し、金属膜を選択的にエッチングして駆動回路部に配置されるトランジスタのソース電極層445a、ドレイン電極層445bと接続電極層449を形成した後、レジストマスクを除去する。このとき、画素部に配置されるトランジスタ460上には金属膜は残されずにエッチングされる。
次いで、第7のフォトリソグラフィ工程によりレジストマスクを形成し、酸化物導電層を選択的にエッチングして駆動回路部に配置されるトランジスタ440のソース電極層445aと重なる酸化物導電層446a、ドレイン電極層445bと重なる酸化物導電層446b、画素部に配置されるトランジスタ460のソース電極層455a、ドレイン電極層455b及び接続電極層448、449を形成した後、レジストマスクを除去する(図1(D)参照)。
ここで、酸化物導電層のエッチングには、リン酸、酢酸及び硝酸を含む混酸を用いる。例えば、リン酸72.3%、酢酸9.8%、硝酸2.0%、水15.9%で構成された混酸を用いることができる。酸化物導電層と酸化物半導体層は組成が類似しているため、エッチングの選択比が小さいものが多い。しかしながら、本実施の形態で用いている酸化物導電層(酸化珪素を含むインジウム錫酸化物)は非晶質であり、酸化物半導体層(In−Ga−Zn−O膜)404、405の表層にはナノ結晶の微結晶群が形成されているため、比較的大きなエッチングの選択比が取れる。上記混酸を用いた場合のエッチングレートは、酸化物導電層が18.6nm/secであったのに対し、ナノ結晶からなる微結晶群が形成されている酸化物半導体層が4.0nm/secであった。従って、酸化物導電層を上記混酸を用いて時間制御でエッチングすることで、酸化物半導体層404、405の表層にあるナノ結晶の微結晶群をほとんどエッチングされない状態で残すことができる。
また、酸化物半導体層404とソース電極層445a及びドレイン電極層445bとの間に酸化物導電層446a、446bを設けることによって接触抵抗を下げ、高速動作が可能なトランジスタを実現できる。本実施の形態では、駆動回路部に設置されるトランジスタ440のソース電極層445aと酸化物半導体層404との間に設けられる酸化物導電層446aはソース領域として機能し、ドレイン電極層445bと酸化物半導体層404との間に設けられる酸化物導電層446bはドレイン領域として機能する。これらは、例えば、周辺回路(駆動回路)の周波数特性の向上に有効となる。
一方、画素部に設置されるトランジスタ460のソース電極層455a及びドレイン電極層455bは透光性を有する酸化物導電層で形成されるため、光を透過することができ、開口率を向上させることができる。
次いで、酸化物絶縁層426、画素部に設置されるトランジスタ460のソース電極層455a、ドレイン電極層455b、駆動回路部に配置されるトランジスタ440のソース電極層445a、ドレイン電極層445b及び接続電極層449上に絶縁層427を形成する(図1(E)参照)。絶縁層427としては、前述した酸化物絶縁層426と同様に酸化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜、または酸化窒化アルミニウム膜などを用いることができる。本実施の形態では、絶縁層427にRFスパッタ法を用いて形成した酸化珪素膜を用いる。
次いで、窒素ガス等の不活性ガス雰囲気下、200℃以上400℃以下、好ましくは250℃以上350℃以下で第2の加熱処理を行う。例えば、窒素雰囲気下で250℃、1時間の加熱処理を行う。または、第1の加熱処理と同様に高温短時間のRTA処理を行っても良い。
第2の加熱処理では、酸化物である絶縁層427と酸化物半導体層404、405の一部が接した状態で加熱される。このため、第1の加熱処理で低抵抗化された酸化物半導体層404、405は、絶縁層427から酸素が供給されて酸素過剰な状態となり、高抵抗化(i型化)される。
本実施の形態では、絶縁層427成膜後に第2の加熱処理を行ったが、加熱処理のタイミングは絶縁層427の成膜以降であれば問題なく、絶縁層427の成膜直後に限定されるものではない。また、回数も1回に限られない。
次いで、第8のフォトリソグラフィ工程によりレジストマスクを形成し、絶縁層427にドレイン電極層455bに達するコンタクトホールを形成し、後の工程で画素電極層と接続される接続電極層442を形成する。接続電極層442には、Al、Cr、Cu、Ta、Ti、Mo、Wから選ばれた元素を主成分とする単膜、または合金膜か、該膜の積層膜を用いることができる。ただし、ドレイン電極層455bと画素電極層が直接接続される場合は接続電極層442を省いても良い。
次いで、絶縁層427上に保護絶縁層428を形成する(図1(E)参照)。保護絶縁層428としては、窒化珪素膜、窒化酸化珪素膜、または窒化アルミニウム膜などを用いる。本実施の形態では、RFスパッタ法を用いて窒化珪素膜の保護絶縁層428を形成する。
また、図示はしないが、画素部において絶縁層427と保護絶縁層428の間に平坦化絶縁層を設けても良い。平坦化絶縁層としては、アクリル樹脂、ポリイミド、ベンゾシクロブテン系樹脂、ポリアミド、エポキシ樹脂等の、耐熱性を有する有機材料を用いることができる。また上記有機材料の他に、低誘電率材料(low−k材料)、シロキサン系樹脂、PSG(リンガラス)、BPSG(リンボロンガラス)等を用いることができる。なお、これらの材料で形成される絶縁層を複数積層させてもよい。また、カラーフィルタ層を平坦化絶縁層として用いることもできる。
以上により、本実施の形態では同一基板上に高速動作が可能な駆動回路部と、開口率が向上した画素部を有した半導体装置の作製方法を提供することができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態2)
本実施の形態では、実施の形態1に示したトランジスタを用いて同一基板上に画素部と駆動回路部を形成し、アクティブマトリクス型の液晶表示装置及び発光装置を作製する一例を示す。
アクティブマトリクス基板の断面構造として、液晶表示装置の一例を図2に示す。
本実施の形態では、同一基板上に駆動回路部及び画素部を有する構成について、駆動回路部用のトランジスタ440、画素部用のトランジスタ460、ゲート配線コンタクト部、保持容量、ゲート配線とソース配線及びその交差部、画素電極等を図示して説明する。保持容量、ゲート配線、ソース配線は、実施の形態1に示すトランジスタの作製工程と同じ工程で形成することができ、フォトマスク枚数の増加や、工程数を増加することなく作製することができる。
図2において、トランジスタ440は、駆動回路部に設けられるトランジスタであり、画素電極層457aと電気的に接続するトランジスタ460は、画素部に設けられるトランジスタである。
本実施の形態において、基板400上に形成されるトランジスタ460は、実施の形態1のトランジスタと同じ構造を用いることができる。
トランジスタ460のゲート電極層と同じ材料、及び同じ工程で形成される容量配線層430は、誘電体となるゲート絶縁層402を介して容量電極層431と重なり、保持容量を形成する。なお、容量電極層431は、トランジスタ460のソース電極層455aまたはドレイン電極層455bと同じ材料、及び同じ工程で形成される。
なお、保持容量は、画素電極層457aの下方に設けられ、容量電極層431が画素電極層457aと電気的に接続される。
本実施の形態では、容量電極層431、及び容量配線層430を用いて保持容量を形成する例を示したが、保持容量を形成する構造については特に限定されない。例えば、ゲート配線、平坦化絶縁層、保護絶縁層、ゲート絶縁層、及び画素電極層457aを重ねて保持容量を形成してもよい。
また、ゲート配線、ソース配線、及び容量配線層は画素密度に応じて複数本設けられるものである。また、端子部においては、ゲート配線と同電位の第1の端子電極、ソース配線と同電位の第2の端子電極、容量配線層と同電位の第3の端子電極などが複数並べられて配置される。それぞれの端子電極の数は、それぞれ任意な数で設ければ良いものとし、実施者が適宣決定すれば良い。
ゲート配線コンタクト部において、ゲート電極層421bは、低抵抗の金属材料で形成することができる。ゲート電極層421bは、ゲート配線に達するコンタクトホールを介してゲート配線と電気的に接続される。
ここで、酸化物半導体層に対する脱水化・脱水素化の熱処理は、酸化物半導体層の成膜後、酸化物半導体層上に酸化物導電層を積層させた後、ソース電極及びドレイン電極上にパッシベーション膜を形成した後、のいずれかで行えば良い。
また、駆動回路部のトランジスタ440のゲート電極層421aは、酸化物半導体層の上方に設けられた導電層417と電気的に接続させる構造としてもよい。
また、配線交差部において、図2に示すように寄生容量を低減するため、ゲート配線層421cとソース配線層422との間には、ゲート絶縁層402及び酸化物絶縁層426を積層する構成としている。
また、アクティブマトリクス型の液晶表示装置を作製する場合には、アクティブマトリクス基板と、対向電極が設けられた対向基板との間に液晶層を設け、アクティブマトリクス基板と対向基板とを固定する。なお、対向基板に設けられた対向電極と電気的に接続する共通電極をアクティブマトリクス基板上に設け、共通電極と電気的に接続する第4の端子電極を端子部に設ける。この第4の端子電極は、共通電極を固定電位、例えばGND、0Vなどに設定するための端子である。第4の端子電極は、画素電極層457aと同じく透光性を有する材料で形成することができる。
また、ゲート電極層、ソース電極層、ドレイン電極層、画素電極層、またはその他の電極層や、その他の配線層に同じ材料を用いれば、原材料や製造装置を共用することができ、製造コストを削減することができる。
また、図2の構造において、平坦化絶縁層456として感光性の樹脂材料を用いる場合、レジストマスクを形成する工程を省略することができる。
また、図3にアクティブマトリクス型発光装置として、第1電極(画素電極)上にEL層を形成する前の基板の状態を示す断面図を示す。
図3においては、逆スタガ型のトランジスタが図示されており、実施の形態1と同様の構造のトランジスタを用いることができる。また、下記に示す画素部の構成以外は前述した液晶表示装置と同様の構成とすることができる。
絶縁層427を形成した後、カラーフィルタ層453を形成する。カラーフィルタ層は、赤色、緑色、及び青色があり、印刷法、インクジェット法、フォトリソグラフィ技術を用いたエッチング方法などでそれぞれを順次形成する。カラーフィルタ層453を基板400側に設けることによって、カラーフィルタ層453と発光素子の発光領域との位置合わせが不要になる。
次いで、カラーフィルタ層453を覆うオーバーコート層458を形成する。オーバーコート層458には、透光性を有する樹脂を用いる。
ここでは赤色、緑色、及び青色の3色のカラーフィルタ層を用いてフルカラー表示する例を示したが、特に限定されず、シアン、マゼンタ、イエロー、またはホワイトのカラーフィルタ層を加えてフルカラー表示を行ってもよい。
次いで、オーバーコート層458及び絶縁層427を覆う保護絶縁層428を形成する。保護絶縁層428は、無機絶縁膜を用い、窒化珪素膜、窒化アルミニウム膜、窒化酸化珪素膜、または酸化窒化アルミニウム膜などを用いる。
次いで、フォトリソグラフィ工程により保護絶縁層428を選択的にエッチングして接続電極層452に達するコンタクトホールを形成する。また、このフォトリソグラフィ工程により端子部の保護絶縁層428及び絶縁層427を選択的にエッチングして端子電極の一部を露呈させる。また、後に形成される発光素子の第2電極と共通電位線とを接続するため、共通電位線に達するコンタクトホールも形成する。
次いで、透光性を有する導電膜を形成し、フォトリソグラフィ工程及びエッチング工程により接続電極層452と電気的に接続する第1電極457bを形成する。
次いで、第1電極457bの周縁部を覆うように隔壁459を形成する。隔壁459は、ポリイミド、アクリル樹脂、ポリアミド、エポキシ樹脂等の有機樹脂膜、無機絶縁膜または有機ポリシロキサンを用いて形成する。隔壁459は、第1の電極457b上に側壁が曲率を有する傾斜面となる開口部を第1の電極457b上に有する様に形成することが好ましい。この様な開口部は、隔壁459を感光性の樹脂材料を用いて形成することで容易に形成することができる。
以上の工程を経て図3に示す基板の状態を得ることができる。以降の工程は第1電極457b上にEL層を形成し、EL層上に第2電極を形成して発光素子を形成する。なお、第2の電極は、共通電位線と電気的に接続する。
また、図3に示す駆動回路部のトランジスタ440には、酸化物半導体層の上方に導電層417を設けてもよい。導電層417は、画素電極層457aまたは、第1電極457bと同じ材料、同じ工程で形成することができる。
導電層417を酸化物半導体層のチャネル形成領域443と重なる位置に設けることによって、トランジスタ440のしきい値電圧の経時変化量を低減することができる。また、導電層417は、ゲート電極層421aと同電位とすることで、第2のゲート電極層として機能させることもできる。また、導電層417にゲート電極層421aと異なる電位を与えても良い。また、導電層417の電位がGND、0V、或いはフローティング状態であってもよい。
また、トランジスタは静電気などにより破壊されやすいため、画素部と駆動回路部と同一基板上に保護回路を設けることが好ましい。保護回路は、酸化物半導体層を用いた非線形素子を用いて構成することが好ましい。例えば、保護回路は画素部と、走査線入力端子及び信号線入力端子との間に配設されている。本実施の形態では複数の保護回路を配設して、走査線、信号線及び容量バス線に静電気等によりサージ電圧が印加され、画素トランジスタなどが破壊されないように構成されている。そのため、保護回路にはサージ電圧が印加されたときに、共通配線に電荷を逃がすように構成する。また、保護回路は、走査線に対して並列に配置された非線形素子によって構成されている。非線形素子は、ダイオードの様な二端子素子またはトランジスタのような三端子素子で構成される。例えば、画素部のトランジスタ460と同じ工程で形成することも可能であり、例えばゲート端子とドレイン端子を接続することによりダイオードと同様の特性を持たせることができる。
なお、本実施の形態では、実施の形態1のトランジスタと同じ構造を用いており、トランジスタ460のゲート電極層451a、ソース電極層455a、ドレイン電極層455b、保持容量部の容量配線層430、及び容量電極層431は透光性を有する酸化物導電層で形成されている。従って、画素部のトランジスタ460及び保持容量部は透光性を有し、開口率を向上させることができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態3)
実施の形態1に示したトランジスタを用いて表示機能を有する半導体装置(表示装置ともいう)を作製することができる。また、トランジスタを有する駆動回路部及び画素部を同じ基板上に一体形成し、システムオンパネルを形成することができる。
表示装置は表示素子を含んで構成される。表示素子としては液晶素子(液晶表示素子ともいう)、電子インクなど、電気的作用によりコントラストが変化する表示媒体も適用することができる。
なお、本明細書中における表示装置とは、画像表示デバイス、表示デバイス、もしくは光源(照明装置含む)を指す。また、FPC(Flexible printed circuit)もしくはTAB(Tape Automated Bonding)テープが取り付けられたモジュール、TABテープの先にプリント配線板が設けられたモジュール、または表示素子にCOG(Chip On Glass)方式によりIC(集積回路)が直接実装されたモジュールも全て表示装置に含むものとする。
半導体装置の一形態に相当する液晶表示パネルの外観及び断面について、図4を用いて説明する。図4(A1)、(A2)は、トランジスタ4010、4011、及び液晶素子4013を、第1の基板4001と第2の基板4006との間にシール材4005によって封止した、パネルの平面図であり、図4(B)は、図4(A1)、(A2)のM−Nにおける断面図に相当する。
第1の基板4001上に設けられた画素部4002と、走査線駆動回路部4004とを囲むようにして、シール材4005が設けられている。また画素部4002と、走査線駆動回路部4004の上に第2の基板4006が設けられている。よって画素部4002と、走査線駆動回路部4004とは、第1の基板4001とシール材4005と第2の基板4006とによって、液晶層4008と共に封止されている。また第1の基板4001上のシール材4005によって囲まれている領域とは異なる領域に、単結晶半導体または多結晶半導体で形成された信号線駆動回路部4003が実装されている。
なお、信号線駆動回路部4003の接続方法は、特に限定されるものではなく、COG方法、ワイヤボンディング方法、或いはTAB方法などを用いることができる。図4(A1)は、COG方法により信号線駆動回路部4003を実装する例であり、図4(A2)は、TAB方法により信号線駆動回路部4003を実装する例である。
また第1の基板4001上に設けられた画素部4002と、走査線駆動回路部4004は、トランジスタを複数有しており、図4(B)では、画素部4002に含まれるトランジスタ4010と、走査線駆動回路部4004に含まれるトランジスタ4011とを例示している。トランジスタ4010、4011上には絶縁層4041、4020、4021が設けられている。
トランジスタ4010、4011は、実施の形態1で示した酸化物半導体層を含む信頼性の高いトランジスタを適用することができる。本実施の形態において、トランジスタ4010、4011はnチャネル型トランジスタである。
絶縁層4021上において、駆動回路部用のトランジスタ4011の酸化物半導体層のチャネル形成領域と重なる位置に導電層4040が設けられている。導電層4040を酸化物半導体層のチャネル形成領域と重なる位置に設けることによって、トランジスタ4011のしきい値電圧の変化量を低減することができる。また、導電層4040は、電位がトランジスタ4011のゲート電極と同じでもよいし、異なっていても良く、第2のゲート電極として機能させることもできる。また、導電層4040の電位がGND、0V、或いはフローティング状態であってもよい。
また、液晶素子4013が有する画素電極4030は、トランジスタ4010と電気的に接続されている。そして、液晶素子4013の対向電極4031は、第2の基板4006上に形成されている。画素電極4030と対向電極4031と液晶層4008とが重なっている部分が、液晶素子4013に相当する。なお、画素電極4030、対向電極4031には、それぞれ配向膜として機能する絶縁層4032、4033が設けられている。
なお、第1の基板4001、第2の基板4006としては、透光性基板を用いることができ、ガラス、セラミックス、またはプラスチックを用いることができる。プラスチックとしては、FRP(Fiberglass−Reinforced Plastics)板、PVF(ポリビニルフルオライド)フィルム、ポリエステルフィルムまたはアクリル樹脂フィルムを用いることができる。
また、スペーサ4035は絶縁層を選択的にエッチングすることで得られ、画素電極4030と対向電極4031との間の距離(セルギャップ)を制御するために設けられている。なお、球状のスペーサを用いていても良い。また、対向電極4031は、トランジスタ4010と同一基板上に設けられる共通電位線と電気的に接続される。共通接続部を用いて、一対の基板間に配置される導電性粒子を介して対向電極4031と共通電位線とを電気的に接続することができる。なお、導電性粒子はシール材4005に含有させる。
また、配向膜を用いないブルー相を示す液晶を用いてもよい。ブルー相は液晶相の一つであり、コレステリック液晶を昇温していくと、コレステリック相から等方相へ転移する直前に発現する相である。ブルー相は狭い温度範囲でしか発現しないため、温度範囲を改善するために5重量%以上のカイラル剤を混合させた液晶組成物を用いて液晶層4008に用いる。ブルー相を示す液晶とカイラル剤とを含む液晶組成物は、応答速度が1msec以下と短く、光学的等方性であるため配向処理が不要であり、視野角依存性が小さい。
また、液晶表示装置では、基板の外側(視認側)に偏光板を設け、内側に着色層、表示素子に用いる電極層という順に設ける例を示すが、偏光板は基板の内側に設けてもよい。また、偏光板と着色層の積層構造も本実施の形態に限定されず、偏光板及び着色層の材料や作製工程条件によって適宜設定すればよい。
トランジスタ4011は、チャネル形成領域を含む半導体層に接して絶縁層4041が形成されている。絶縁層4041は、実施の形態1で示した絶縁層427と同様な材料及び方法で形成すればよい。また、トランジスタ起因の表面凹凸を低減するため、平坦化絶縁層として機能する絶縁層4021で覆う構成となっている。ここでは、絶縁層4041として、実施の形態1と同様にスパッタ法により酸化珪素膜を形成する。
また、絶縁層4041上に保護絶縁層4020が形成されている。保護絶縁層4020は実施の形態1で示した保護絶縁層428と同様な材料及び方法で形成すればよい。ここでは、保護絶縁層4020として、PCVD法により窒化珪素膜を形成する。
また、平坦化絶縁層として絶縁層4021を形成する。絶縁層4021としては、アクリル樹脂、ポリイミド、ベンゾシクロブテン系樹脂、ポリアミド、エポキシ樹脂等の、耐熱性を有する有機材料を用いることができる。また上記有機材料の他に、低誘電率材料(low−k材料)、シロキサン系樹脂、PSG(リンガラス)、BPSG(リンボロンガラス)等を用いることができる。なお、これらの材料で形成される絶縁層を複数積層させることで、絶縁層4021を形成してもよい。
なお、シロキサン系樹脂とは、シロキサン系材料を出発材料として形成されたSi−O−Si結合を含む樹脂に相当する。シロキサン系樹脂は置換基としては有機基(例えばアルキル基やアリール基)やフルオロ基を用いても良い。また、有機基はフルオロ基を有していても良い。
絶縁層4021の形成法は、特に限定されず、その材料に応じて、スパッタ法、SOG法、スピンコート、ディップ、スプレー塗布、液滴吐出法(インクジェット法、スクリーン印刷、オフセット印刷等)、ドクターナイフ、ロールコーター、カーテンコーター、ナイフコーター等を用いることができる。絶縁層4021の焼成工程と酸化物半導体層のアニールを兼ねることで効率よく半導体装置を作製することが可能となる。
画素電極4030、対向電極4031は、酸化タングステンを含むインジウム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタンを含むインジウム酸化物、酸化チタンを含むインジウム錫酸化物、インジウム錫酸化物(以下、ITOと示す。)、インジウム亜鉛酸化物、酸化珪素を添加したインジウム錫酸化物などの透光性を有する導電性材料を用いることができる。
また、画素電極4030、対向電極4031として、導電性高分子(導電性ポリマーともいう)を含む導電性組成物を用いて形成することができる。導電性組成物を用いて形成した画素電極は、シート抵抗が10000Ω/□以下、波長550nmにおける光の透過率が70%以上であることが好ましい。また、導電性組成物に含まれる導電性高分子の抵抗率が0.1Ω・cm以下であることが好ましい。
導電性高分子としては、いわゆるπ電子共役系導電性高分子が用いることができる。例えば、ポリアニリンまたはその誘導体、ポリピロールまたはその誘導体、ポリチオフェンまたはその誘導体、若しくはこれらの2種以上の共重合体などがあげられる。
また別途形成された信号線駆動回路部4003と、走査線駆動回路部4004または画素部4002に与えられる各種信号及び電位は、FPC4018を介して供給されている。
接続端子電極4015は、液晶素子4013が有する画素電極4030と同じ導電膜で形成され、端子電極4016は、トランジスタ4010、4011のソース電極層及びドレイン電極層と同じ導電膜で形成されている。
接続端子電極4015は、FPC4018が有する端子と、異方性導電膜4019を介して電気的に接続されている。
また図4においては、信号線駆動回路部4003を別途形成し、第1の基板4001に実装している例を示しているがこの構成に限定されない。信号線駆動回路部4003を第1の基板4001上に形成しても構わない。
図5は、本明細書に開示する作製方法により作製されるトランジスタを形成した基板を用いて液晶表示モジュールを構成する一例を示している。
図5は液晶表示モジュールの一例であり、トランジスタを形成した基板2600と対向基板2601がシール材2602により固着され、その間にトランジスタ等を含む画素部2603、液晶層を含む表示素子2604、着色層2605が設けられ表示領域を形成している。着色層2605はカラー表示を行う場合に必要であり、RGB方式の場合は、赤、緑、青の各色に対応した着色層が各画素に設けられている。トランジスタを形成した基板2600と対向基板2601の外側には偏光板2606、偏光板2607、拡散板2613が配設されている。光源は冷陰極管2610と反射板2611により構成され、回路基板2612は、フレキシブル配線基板2609によりトランジスタを形成した基板2600の配線回路部2608と接続され、コントロール回路や電源回路などの外部回路が組みこまれている。また偏光板と、液晶層との間に位相差板を有した状態で積層してもよい。
液晶表示モジュールには、TN(Twisted Nematic)モード、IPS(In−Plane−Switching)モード、FFS(Fringe Field Switching)モード、MVA(Multi−domain Vertical Alignment)モード、PVA(Patterned Vertical Alignment)モード、ASM(Axially Symmetric aligned Micro−cell)モード、OCB(Optical Compensated Birefringence)モード、FLC(Ferroelectric Liquid Crystal)モード、AFLC(Antiferroelectric Liquid Crystal)などを用いることができる。
以上の工程により、半導体装置として信頼性の高い液晶表示パネルを作製することができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態4)
本実施の形態では、発光表示パネル(発光パネルともいう)の外観及び断面について、図6を用いて説明する。図6は、第1の基板上に形成されたトランジスタ及び発光素子を第2の基板との間にシール材によって封止したパネルの平面図であり、図6(B)は、図6(A)のH−Iにおける断面図に相当する。
第1の基板4501上に設けられた画素部4502、信号線駆動回路部4503a、4503b、及び走査線駆動回路部4504a、4504bを囲むようにして、シール材4505が設けられている。また画素部4502、信号線駆動回路部4503a、4503b、及び走査線駆動回路部4504a、4504bの上に第2の基板4506が設けられている。
従って、画素部4502、信号線駆動回路部4503a、4503b、及び走査線駆動回路部4504a、4504bは、第1の基板4501とシール材4505と第2の基板4506とによって、充填材4507と共に密封されている。さらに外気に曝されないように気密性が高く、脱ガスの少ない保護フィルム(貼り合わせフィルム、紫外線硬化樹脂フィルム等)やカバー材でパッケージング(封入)することが好ましい。
また、第1の基板4501上に設けられた画素部4502、信号線駆動回路部4503a、4503b、及び走査線駆動回路部4504a、4504bは、トランジスタを複数有しており、図6(B)では、画素部4502に含まれるトランジスタ4510と信号線駆動回路部4503aに含まれるトランジスタ4509を例示している。
トランジスタ4509、4510は、実施の形態1で示した酸化物半導体層を含む信頼性の高いトランジスタを適用することができる。本実施の形態において、トランジスタ4509、4510はnチャネル型トランジスタである。
絶縁層4544上において駆動回路部用のトランジスタ4509の酸化物半導体層のチャネル形成領域と重なる位置に導電層4540が設けられている。導電層4540を酸化物半導体層のチャネル形成領域と重なる位置に設けることによって、トランジスタ4509のしきい値電圧の変化量を低減することができる。また、導電層4540は、トランジスタ4509のゲート電極層と同電位とすることで、第2のゲート電極層として機能させることもできる。また、トランジスタ4509のゲート電極層と異なる電位を与えても良い。また、導電層4540の電位がGND、0V、或いはフローティング状態であってもよい。
トランジスタ4509には、酸化物半導体層の周縁部(側面を含む)を覆う酸化物絶縁層4541が形成されている。
また、トランジスタ4510は、接続電極層4548を介して第1電極4517と電気的に接続されている。また、トランジスタ4510の酸化物半導体層の周縁部(側面を含む)を覆う酸化物絶縁層4542が形成されている。
酸化物絶縁層4541、4542は実施の形態1で示した酸化物絶縁層426と同様な材料及び方法で形成すればよい。また、酸化物絶縁層4541、4542を覆う絶縁層4544が形成される。絶縁層4544は、実施の形態1で示した保護絶縁層428と同様な材料及び方法で形成すればよい。
発光素子4511の発光領域と重なるようにカラーフィルタ層4545が、トランジスタ4510上に形成される。
また、カラーフィルタ層4545起因の表面凹凸を低減するため平坦化絶縁層として機能するオーバーコート層4543で覆う構成となっている。
また、オーバーコート層4543上に絶縁層4546が形成されている。絶縁層4546は、実施の形態1で示した保護絶縁層428と同様な材料及び方法で形成すればよい。
また、発光素子4511が有する画素電極である第1電極4517は、トランジスタ4510のソース電極層またはドレイン電極層と電気的に接続されている。なお、発光素子4511の構成は、第1電極4517、電界発光層4512、第2電極4513の積層構造であるが、示した構成に限定されない。発光素子4511から取り出す光の方向などに合わせて、発光素子4511の構成は適宜変えることができる。
隔壁4520は、有機樹脂膜、無機絶縁膜または有機ポリシロキサンを用いて形成する。側壁が曲率を有する傾斜面となる様な開口部を第1の電極4517上に有する様に形成することが好ましい。この様な開口部は、隔壁4520を感光性の樹脂材料を用いて形成することで容易に形成することができる。
電界発光層4512は、単層に限らず、複数の層の積層で構成されていても良い。
発光素子4511に酸素、水素、水分、二酸化炭素等が侵入しないように、第2の電極4513及び隔壁4520上に保護膜を形成してもよい。保護膜としては、窒化珪素膜、窒化酸化珪素膜、DLC膜等を形成することができる。
また、信号線駆動回路部4503a、4503b、走査線駆動回路部4504a、4504b、または画素部4502に与えられる各種信号及び電位は、FPC4518a、4518bを介して供給されている。
接続端子電極4515は、発光素子4511が有する第1電極4517と同じ導電膜から形成され、端子電極4516は、トランジスタ4509のソース電極層及びドレイン電極層と同じ導電膜から形成されている。
接続端子電極4515は、FPC4518aが有する端子と、異方性導電膜4519を介して電気的に接続されている。
発光素子4511からの光の取り出し方向に位置する第1の基板は透光性でなければならない。その場合には、ガラス板、プラスチック板、ポリエステルフィルムまたはアクリルフィルムのような透光性を有する材料を用いる。
また、充填材4507としては窒素やアルゴンなどの不活性な気体の他に、紫外線硬化樹脂または熱硬化樹脂を用いることができ、PVC(ポリビニルクロライド)、アクリル樹脂、ポリイミド、エポキシ樹脂、シリコーン樹脂、PVB(ポリビニルブチラル)またはEVA(エチレンとビニルアセテートとの共重合体)を用いることができる。
また、必要であれば、発光素子の射出面に偏光板、または円偏光板(楕円偏光板を含む)、位相差板(λ/4板、λ/2板)などの光学フィルムを適宜設けてもよい。また、偏光板または円偏光板に反射防止膜を設けてもよい。例えば、表面の凹凸により反射光を拡散し、映り込みを低減できるアンチグレア処理を施すことができる。
信号線駆動回路部4503a、4503b、及び走査線駆動回路部4504a、4504bの一部を別途形成して実装しても良く、図6(A)、(B)の構成に限定されない。
以上の工程により、信頼性の高い発光表示装置(表示パネル)を作製することができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態5)
本実施の形態では、保持容量の構成について、実施の形態2と異なる例を図7(A)及び図7(B)に示す。図7(A)は、図2及び図3と保持容量の構成が異なる点以外は同じであるため、同じ箇所には同じ符号を用い、同じ箇所の詳細な説明は省略する。なお、図7(A)では画素部のトランジスタ460と保持容量の断面構造を示す。
図7(A)は、誘電体を絶縁層427、保護絶縁層428及び平坦化絶縁層456とし、画素電極層457と該画素電極層457と重なる容量配線層432を電極として保持容量を形成する例である。容量配線層432は、画素部のトランジスタ460のソース電極層とドレイン電極層同じ透光性を有する材料、及び同じ工程で形成されるため、トランジスタ460のソース配線層と重ならないようにレイアウトされる。
図7(A)に示す保持容量は、一対の電極及び誘電体が透光性を有しており、保持容量全体として透光性を有する。
また、図7(B)は、図7(A)と異なる保持容量の構成の例である。図7(B)も、図2及び図3と保持容量の構成が異なる点以外は同じであるため、同じ箇所には同じ符号を用い、同じ箇所の詳細な説明は省略する。
図7(B)は、誘電体をゲート絶縁層402とし、容量配線層430と、該容量配線層430と重なる酸化物半導体層405と容量電極層431との積層で保持容量を形成する例である。また、容量電極層431は酸化物半導体層405上に接して積層されており、保持容量の一方の電極として機能する。なお、容量電極層431は、トランジスタ460のソース電極層とドレイン電極層と同じ透光性を有する材料、同じ工程で形成する。また、容量配線層430は、トランジスタ460のゲート電極層と同じ透光性を有する材料、同じ工程で形成されるため、トランジスタ460のゲート配線層と重ならないようにレイアウトされる。
また、容量電極層431は画素電極層457と電気的に接続されている。
図7(B)に示す保持容量も、一対の電極及び誘電体が透光性を有しており、保持容量全体として透光性を有する。
図7(A)及び図7(B)に示す保持容量は、透光性を有しており、ゲート配線の本数を増やすなどして表示画像の高精細化を図るため、画素寸法を微細化しても、十分な容量を得ることができ、且つ、高い開口率を実現することができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態6)
本実施の形態では、実施の形態1に示すトランジスタを適用した半導体装置として電子ペーパーの例を示す。
図8は、半導体装置の例としてアクティブマトリクス型の電子ペーパーを示す。半導体装置に用いられるトランジスタ581としては、実施の形態1で示すトランジスタを適用することができる。
図8の電子ペーパーは、ツイストボール表示方式を用いた表示装置の例である。ツイストボール表示方式とは、白と黒に塗り分けられた球形粒子を表示素子に用いる電極層である第1の電極層及び第2の電極層の間に配置し、第1の電極層及び第2の電極層に電位差を生じさせて球形粒子の向きを制御することにより、表示を行う方法である。
第1の基板580上に形成されたトランジスタ581はボトムゲート構造のトランジスタであり、ソース電極層またはドレイン電極層によって第1の電極層587と、絶縁層585に形成する開口で接しており電気的に接続している。第1の電極層587と第2の基板596に設けられた第2の電極層588との間には球形粒子589が設けられており、球形粒子589の周囲は樹脂等の充填材595で充填されている。球形粒子589内のキャビティ594は液体で満たされており、かつ黒色領域590a及び白色領域590bを有する粒子が存在している。本実施の形態においては、第1の電極層587が画素電極に相当し、第2の電極層588が共通電極(対向電極)に相当する。第2の電極層588は、トランジスタ581と同一基板上に設けられる共通電位線と電気的に接続される。実施の形態1に示すいずれか一つの接続部を用いて、一対の基板間に配置される導電性粒子を介して第2の電極層588と共通電位線とを電気的に接続することができる。
また、ツイストボールの代わりに、電気泳動素子を用いることも可能である。透明な液体と、正に帯電した白い微粒子と負に帯電した黒い微粒子とを封入した直径10μm以上200μm以下程度のマイクロカプセルを用いる。第1の電極層と第2の電極層との間に設けられるマイクロカプセルは、第1の電極層と第2の電極層によって、電場が与えられると、白い微粒子と、黒い微粒子が逆の方向に移動し、白または黒を表示することができる。この原理を応用した表示素子が電気泳動表示素子であり、一般的に電子ペーパーとよばれている。電気泳動表示素子は、液晶表示素子に比べて反射率が高いため、補助ライトは不要であり、また消費電力が小さく、薄暗い場所でも表示部を認識することが可能である。また、表示部に電源が供給されない場合であっても、一度表示した像を保持することが可能であるため、電源から表示機能付き半導体装置(単に表示装置、または表示装置を具備する半導体装置ともいう)を切断した場合であっても、表示された画像を保存しておくことが可能となる。
以上の工程により、半導体装置として信頼性の高い電子ペーパーを作製することができる。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
(実施の形態7)
実施の形態1に示すトランジスタを適用した半導体装置は、電子ペーパーとして適用することができる。電子ペーパーは、情報を表示するものであればあらゆる分野の電子機器に用いることが可能である。例えば、電子ペーパーを用いて、電子書籍(電子ブック)、ポスター、電車などの乗り物の車内広告、クレジットカード等の各種カードにおける表示等に適用することができる。電子機器の一例を図9、図10に示す。
図9(A)は、電子ペーパーで作られたポスター2631を示している。広告媒体が紙の印刷物である場合には、広告の交換は人手によって行われるが、電子ペーパーを用いればポスター2631自体を交換をすることなく広告の表示を変えることができる。また、表示も崩れることなく安定した画像が得られる。なお、ポスターは無線で情報を送受信できる構成としてもよい。
また、図9(B)は、電車などの乗り物の車内広告2632を示している。広告媒体が紙の印刷物である場合には、広告の交換は人手によって行われるが、電子ペーパーを用いれば人手を多くかけることなくポスター2631自体を交換をすることなく広告の表示を変えることができる。また表示も崩れることなく安定した画像が得られる。なお、車内広告は無線で情報を送受信できる構成としてもよい。
また、図10は、電子書籍の一例を示している。例えば、電子書籍2700は、筐体2701及び筐体2703の2つの筐体で構成されている。筐体2701及び筐体2703は、軸部2711により一体とされており、該軸部2711を軸として開閉動作を行うことができる。このような構成により、紙の書籍の様に取り扱いをすることが可能となる。
筐体2701には表示部2705が組み込まれ、筐体2703には表示部2707が組み込まれている。表示部2705及び表示部2707は、連続する画像を表示する構成としてもよいし、異なる画像を表示する構成としてもよい。異なる画像を表示する構成とすることで、例えば右側の表示部(図10では表示部2705)に文章を表示し、左側の表示部(図10では表示部2707)に画像を表示することができる。
また、図10では、筐体2701に操作部などを備えた例を示している。例えば、筐体2701において、電源2721、操作キー2723、スピーカ2725などを備えている。操作キー2723により、頁を送ることができる。なお、筐体の表示部と同一面にキーボードやポインティングディバイスなどを備える構成としてもよい。また、筐体2701、2727の裏面や側面に、外部接続用端子(イヤホン端子、USB端子、または電源ケーブルや他の信号ケーブルなどの各種ケーブルと接続可能な端子など)、記録媒体挿入部などを備える構成としてもよい。さらに、電子書籍2700は、電子辞書としての機能を持たせた構成としてもよい。
また、電子書籍2700は、無線で情報を送受信できる構成としてもよい。無線により、電子書籍サーバから、所望の書籍データなどを購入し、ダウンロードする構成とすることも可能である。
なお、本実施の形態に示す構成は、他の実施の形態に示した構成を適宜組み合わせて用いることができることとする。
(実施の形態8)
実施の形態1に示すトランジスタを用いた半導体装置は、さまざまな電子機器(遊技機も含む)に適用することができる。電子機器としては、例えば、テレビジョン装置(テレビ、またはテレビジョン受信機ともいう)、コンピュータ用などのモニタ、デジタルカメラ、デジタルビデオカメラ、デジタルフォトフレーム、携帯電話機(携帯電話、携帯電話装置ともいう)、携帯型ゲーム機、携帯情報端末、音響再生装置、パチンコ機などの大型ゲーム機などが挙げられる。
図11(A)は、テレビジョン装置の一例を示している。テレビジョン装置9600は、筐体9601に表示部9603が組み込まれている。表示部9603により、映像を表示することが可能である。また、ここでは、スタンド9605により筐体9601を支持した構成を示している。
テレビジョン装置9600の操作は、筐体9601が備える操作スイッチや、別体のリモコン操作機9610により行うことができる。リモコン操作機9610が備える操作キー9609により、チャンネルの切り替えや音量の操作を行うことができ、表示部9603に表示される映像を操作することができる。また、リモコン操作機9610に、当該リモコン操作機9610から出力する情報を表示する表示部9607を設ける構成としてもよい。
なお、テレビジョン装置9600は、受信機やモデムなどを備えた構成とする。受信機により一般のテレビ放送の受信を行うことができ、さらにモデムを介して有線または無線による通信ネットワークに接続することにより、一方向(送信者から受信者)または双方向(送信者と受信者間、あるいは受信者間同士など)の情報通信を行うことも可能である。
図11(B)は、デジタルフォトフレームの一例を示している。例えば、デジタルフォトフレーム9700は、筐体9701に表示部9703が組み込まれている。表示部9703は、各種画像を表示することが可能であり、例えばデジタルカメラなどで撮影した画像データを表示させることで、通常の写真立てと同様に機能させることができる。
なお、デジタルフォトフレーム9700は、操作部、外部接続用端子(USB端子)、外部メモリスロットなどを備える構成とする。これらの構成は、表示部と同一面に組み込まれていてもよいが、側面や裏面に備えるとデザイン性が向上するため好ましい。例えば、デジタルフォトフレームの外部メモリスロットに、デジタルカメラで撮影した画像データを記憶したメモリを挿入して画像データを取り込み、取り込んだ画像データを表示部9703に表示させることができる。
また、デジタルフォトフレーム9700は、無線で情報を送受信できる構成としてもよい。無線により、所望の画像データを取り込み、表示させる構成とすることもできる。
図12(A)は携帯型遊技機であり、筐体9881と筐体9891の2つの筐体で構成されており、連結部9893により、開閉可能に連結されている。筐体9881には表示部9882が組み込まれ、筐体9891には表示部9883が組み込まれている。また、図12(A)に示す携帯型遊技機は、その他、スピーカ部9884、記録媒体挿入部9886、LEDランプ9890、入力手段(操作キー9885、接続端子9887、センサ9888(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学物質、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい、または赤外線を測定する機能を含むもの)、マイクロフォン9889)等を備えている。もちろん、携帯型遊技機の構成は上述のものに限定されず、少なくとも本発明に係る半導体装置を備えた構成であればよく、その他付属設備が適宜設けられた構成とすることができる。図12(A)に示す携帯型遊技機は、記録媒体に記録されているプログラムまたはデータを読み出して表示部に表示する機能や、他の携帯型遊技機と無線通信を行って情報を共有する機能を有する。なお、図12(A)に示す携帯型遊技機が有する機能はこれに限定されず、様々な機能を有することができる。
図12(B)は大型遊技機であるスロットマシンの一例を示している。スロットマシン9900は、筐体9901に表示部9903が組み込まれている。また、スロットマシン9900は、その他、スタートレバーやストップスイッチなどの操作手段、コイン投入口、スピーカなどを備えている。もちろん、スロットマシン9900の構成は上述のものに限定されず、少なくとも本発明に係る半導体装置を備えた構成であればよく、その他付属設備が適宜設けられた構成とすることができる。
図13(A)は、携帯電話機の一例を示している。携帯電話機1000は、筐体1001に組み込まれた表示部1002の他、操作ボタン1003、外部接続ポート1004、スピーカ1005、マイク1006などを備えている。
図13(A)に示す携帯電話機1000は、表示部1002を指などで触れることで、情報を入力ことができる。また、通話やメールの送受信などの操作は、表示部1002を指などで触れることにより行うことができる。
表示部1002の画面は主として3つのモードがある。第1は、画像の表示を主とする表示モードであり、第2は、文字等の情報の入力を主とする入力モードである。第3は表示モードと入力モードの2つのモードが混合した表示+入力モードである。
例えば、通話や、メールの文章を作成する場合は、表示部1002を文字の入力を主とする文字入力モードとし、画面に表示させた文字の入力操作を行えばよい。この場合、表示部1002の画面のほとんどにキーボードまたは番号ボタンを表示させることが好ましい。
また、携帯電話機1000内部に、ジャイロ、加速度センサ等の傾きを検出するセンサを有する検出装置を設けることで、携帯電話機1000の向き(縦か横か)を判断して、表示部1002の画面表示を自動的に切り替えるようにすることができる。
また、画面モードの切り替えは、表示部1002を触れること、または筐体1001の操作ボタン1003の操作により行われる。また、表示部1002に表示される画像の種類によって切り替えるようにすることもできる。例えば、表示部に表示する画像信号が動画のデータであれば表示モード、テキストデータであれば入力モードに切り替える。
また、入力モードにおいて、表示部1002の光センサで検出される信号を検知し、表示部1002のタッチ操作による入力が一定期間ない場合には、画面のモードを入力モードから表示モードに切り替えるように制御してもよい。
表示部1002は、イメージセンサとして機能させることもできる。例えば、表示部1002に掌や指を触れることで、掌紋、指紋等を撮像することで、本人認証を行うことができる。また、表示部に近赤外光を発光するバックライトまたは近赤外光を発光するセンシング用光源を用いれば、指静脈、掌静脈などを撮像することもできる。
図13(B)も携帯電話機の一例である。図13(B)の携帯電話機は、筐体9411に、表示部9412、及び操作ボタン9413を含む表示装置9410と、筐体9401に操作ボタン9402、外部入力端子9403、マイク9404、スピーカ9405、及び着信時に発光する発光部9406を含む通信装置9400とを有しており、表示機能を有する表示装置9410は電話機能を有する通信装置9400と矢印の2方向に脱着可能である。よって、表示装置9410と通信装置9400の短軸同士を取り付けることも、表示装置9410と通信装置9400の長軸同士を取り付けることもできる。また、表示機能のみを必要とする場合、通信装置9400より表示装置9410を取り外し、表示装置9410を単独で用いることもできる。通信装置9400と表示装置9410とは無線通信または有線通信により画像または入力情報を授受することができ、それぞれ充電可能なバッテリーを有する。
なお、本実施の形態は他の実施の形態と自由に組み合わせることができる。
400 基板
402 ゲート絶縁層
404 酸化物半導体層
405 酸化物半導体層
417 導電層
422 ソース配線層
426 酸化物絶縁層
427 絶縁層
428 保護絶縁層
430 容量配線層
431 容量電極層
432 容量配線層
440 トランジスタ
442 接続電極層
443 チャネル形成領域
448 接続電極層
449 接続電極層
452 接続電極層
453 カラーフィルタ層
456 平坦化絶縁層
457 画素電極層
458 オーバーコート層
459 隔壁
460 トランジスタ
404a 微結晶群
405a 微結晶群
421a ゲート電極層
421b ゲート電極層
421c ゲート配線層
444c 領域
444d 領域
445a ソース電極層
445b ドレイン電極層
446a 酸化物導電層
446b 酸化物導電層
451a ゲート電極層
451b ゲート電極層
455a ソース電極層
455b ドレイン電極層
457a 画素電極層
457b 電極
580 第1の基板
581 トランジスタ
585 絶縁層
587 電極層
588 電極層
589 球形粒子
590a 黒色領域
590b 白色領域
594 キャビティ
595 充填材
596 第2の基板
1000 携帯電話機
1001 筐体
1002 表示部
1003 操作ボタン
1004 外部接続ポート
1005 スピーカ
1006 マイク
2600 基板
2601 対向基板
2602 シール材
2603 画素部
2604 表示素子
2605 着色層
2606 偏光板
2607 偏光板
2608 配線回路部
2609 フレキシブル配線基板
2610 冷陰極管
2611 反射板
2612 回路基板
2613 拡散板
2631 ポスター
2700 電子書籍
2701 筐体
2703 筐体
2705 表示部
2707 表示部
2711 軸部
2721 電源
2723 操作キー
2725 スピーカ
4001 第1の基板
4002 画素部
4003 信号線駆動回路部
4004 走査線駆動回路部
4005 シール材
4006 第2の基板
4008 液晶層
4010 トランジスタ
4011 トランジスタ
4013 液晶素子
4015 接続端子電極
4016 端子電極
4018 FPC
4019 異方性導電膜
4020 保護絶縁層
4021 絶縁層
4030 画素電極
4031 対向電極
4032 絶縁層
4033 絶縁層
4035 スペーサ
4040 導電層
4041 絶縁層
4501 第1の基板
4502 画素部
4505 シール材
4506 第2の基板
4507 充填材
4509 トランジスタ
4510 トランジスタ
4511 発光素子
4512 電界発光層
4513 電極
4515 接続端子電極
4516 端子電極
4517 電極
4519 異方性導電膜
4520 隔壁
4540 導電層
4541 酸化物絶縁層
4542 酸化物絶縁層
4543 オーバーコート層
4544 絶縁層
4545 カラーフィルタ層
4546 絶縁層
4548 接続電極層
4503a 信号線駆動回路部
4503a 信号線駆動回路部
4504a 走査線駆動回路部
4504b 走査線駆動回路部
4518a FPC
4518b FPC
9400 通信装置
9401 筐体
9402 操作ボタン
9403 外部入力端子
9404 マイク
9405 スピーカ
9406 発光部
9410 表示装置
9411 筐体
9412 表示部
9413 操作ボタン
9600 テレビジョン装置
9601 筐体
9603 表示部
9605 スタンド
9607 表示部
9609 操作キー
9610 リモコン操作機
9700 デジタルフォトフレーム
9701 筐体
9703 表示部
9881 筐体
9882 表示部
9883 表示部
9884 スピーカ部
9885 操作キー
9886 記録媒体挿入部
9887 接続端子
9888 センサ
9889 マイクロフォン
9890 LEDランプ
9891 筐体
9893 連結部
9900 スロットマシン
9901 筐体
9903 表示部

Claims (4)

  1. 同一基板上に第1のトランジスタを有する画素部と、第2のトランジスタを有する駆動回路を有し、
    前記第1のトランジスタ及び前記第2のトランジスタは、
    ゲート電極層と、ゲート絶縁層と、表層に微結晶を有する酸化物半導体層と、前記酸化物半導体層の一部と重なるソース電極層及びドレイン電極層と、前記酸化物半導体層と接する酸化物絶縁層と、を有し、
    前記第1のトランジスタのゲート電極層、ソース電極層及びドレイン電極層は、酸化物導電層であり
    前記第2のトランジスタのゲート電極層、ソース電極層及びドレイン電極層は、金属層を有することを特徴とする半導体装置。
  2. 同一基板上に第1のトランジスタを有する画素部と、第2のトランジスタを有する駆動回路を有し、
    前記第1のトランジスタ及び前記第2のトランジスタは、
    ゲート電極層と、ゲート絶縁層と、表層に微結晶を有する酸化物半導体層と、前記酸化物半導体層の一部と重なるソース電極層及びドレイン電極層と、前記酸化物半導体層と接する酸化物絶縁層と、を有し、
    前記第1のトランジスタのゲート電極層は、酸化物導電層であり
    前記第1のトランジスタのソース電極層は、酸化物導電層であり
    前記第1のトランジスタのドレイン電極層は、酸化物導電層であり
    前記第2のトランジスタのゲート電極層は、金属層を有し、
    前記第2のトランジスタのソース電極層は、金属層を有し、
    前記第2のトランジスタのドレイン電極層は、金属層を有し、
    前記第2のトランジスタは、前記ソース電極層が有する金属層と前記酸化物半導体層との間に酸化物導電層を有し、
    前記第2のトランジスタは、前記ドレイン電極層が有する金属層と前記酸化物半導体層との間に酸化物導電層を有することを特徴とする半導体装置。
  3. 請求項1又は2において、
    前記金属層は、Ti、Mo、W、Al、Cr、Cu、Taから選ばれた元素を主成分とする膜を有するとを特徴とする半導体装置。
  4. 請求項1乃至3のいずれか一項において、
    前記酸化物絶縁層は、酸化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜又は酸化窒化アルミニウム膜を有することを特徴とする半導体装置。
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Publication number Priority date Publication date Assignee Title
KR101801500B1 (ko) 2009-07-10 2017-11-24 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 그 제조 방법
EP2486593B1 (en) 2009-10-09 2017-02-01 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
MY180559A (en) 2009-10-30 2020-12-02 Semiconductor Energy Lab Logic circuit and semiconductor device
KR20230007544A (ko) * 2009-11-06 2023-01-12 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 그 제작 방법
KR101876473B1 (ko) 2009-11-06 2018-07-10 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제작 방법
KR101943051B1 (ko) 2009-11-27 2019-01-28 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제작방법
WO2011068032A1 (en) 2009-12-04 2011-06-09 Semiconductor Energy Laboratory Co., Ltd. Display device
KR101813460B1 (ko) * 2009-12-18 2017-12-29 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치
CN102903758B (zh) 2009-12-28 2015-06-03 株式会社半导体能源研究所 半导体装置
KR20130090405A (ko) 2010-07-02 2013-08-13 가부시키가이샤 한도오따이 에네루기 켄큐쇼 액정 표시 장치
US8664097B2 (en) 2010-09-13 2014-03-04 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
US8823092B2 (en) 2010-11-30 2014-09-02 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
US8809852B2 (en) 2010-11-30 2014-08-19 Semiconductor Energy Laboratory Co., Ltd. Semiconductor film, semiconductor element, semiconductor device, and method for manufacturing the same
TWI562379B (en) 2010-11-30 2016-12-11 Semiconductor Energy Lab Co Ltd Semiconductor device and method for manufacturing semiconductor device
US8629496B2 (en) 2010-11-30 2014-01-14 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
CN103339715B (zh) 2010-12-03 2016-01-13 株式会社半导体能源研究所 氧化物半导体膜以及半导体装置
TWI426334B (zh) * 2010-12-27 2014-02-11 Au Optronics Corp 薄膜電晶體陣列基板及其製作方法
US8916868B2 (en) 2011-04-22 2014-12-23 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing semiconductor device
US10079053B2 (en) 2011-04-22 2018-09-18 Semiconductor Energy Laboratory Co., Ltd. Memory element and memory device
US8878288B2 (en) 2011-04-22 2014-11-04 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
US8932913B2 (en) 2011-04-22 2015-01-13 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
US8809854B2 (en) 2011-04-22 2014-08-19 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
US8847233B2 (en) 2011-05-12 2014-09-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device having a trenched insulating layer coated with an oxide semiconductor film
US8952377B2 (en) 2011-07-08 2015-02-10 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
CN103843145B (zh) 2011-09-29 2017-03-29 株式会社半导体能源研究所 半导体装置
KR20130040706A (ko) 2011-10-14 2013-04-24 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제작 방법
CN104025301B (zh) 2011-10-14 2017-01-18 株式会社半导体能源研究所 半导体装置
JP6076038B2 (ja) * 2011-11-11 2017-02-08 株式会社半導体エネルギー研究所 表示装置の作製方法
JP6111398B2 (ja) * 2011-12-20 2017-04-12 株式会社Joled 表示装置および電子機器
JP6019330B2 (ja) * 2012-02-09 2016-11-02 株式会社Joled 薄膜トランジスタ、薄膜トランジスタの製造方法、表示装置および電子機器
KR102083380B1 (ko) * 2012-01-25 2020-03-03 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제작 방법
KR20150040873A (ko) 2012-08-03 2015-04-15 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치
DE102013216824A1 (de) 2012-08-28 2014-03-06 Semiconductor Energy Laboratory Co., Ltd. Halbleitervorrichtung
TWI575663B (zh) 2012-08-31 2017-03-21 半導體能源研究所股份有限公司 半導體裝置
KR20230175323A (ko) 2012-09-13 2023-12-29 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치
US9366933B2 (en) * 2012-09-21 2016-06-14 Sharp Kabushiki Kaisha Semiconductor display device comprising an upper and lower insulator arranged in a non-display area
TWI627483B (zh) 2012-11-28 2018-06-21 半導體能源研究所股份有限公司 顯示裝置及電視接收機
US9905585B2 (en) 2012-12-25 2018-02-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device comprising capacitor
KR102370069B1 (ko) 2012-12-25 2022-03-04 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치
US8981374B2 (en) * 2013-01-30 2015-03-17 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
US9231002B2 (en) 2013-05-03 2016-01-05 Semiconductor Energy Laboratory Co., Ltd. Display device and electronic device
TWI639235B (zh) 2013-05-16 2018-10-21 半導體能源研究所股份有限公司 半導體裝置
KR102108121B1 (ko) 2013-06-10 2020-05-08 삼성디스플레이 주식회사 박막 트랜지스터 기판
US20150001533A1 (en) * 2013-06-28 2015-01-01 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
JP6400961B2 (ja) * 2013-07-12 2018-10-03 株式会社半導体エネルギー研究所 表示装置
JP2016131062A (ja) * 2015-01-13 2016-07-21 日立アプライアンス株式会社 誘導加熱調理器
CN104932137B (zh) * 2015-07-03 2018-06-05 京东方科技集团股份有限公司 一种彩膜基板、阵列基板、显示面板及显示装置
US11227825B2 (en) * 2015-12-21 2022-01-18 Intel Corporation High performance integrated RF passives using dual lithography process
JP6668455B2 (ja) 2016-04-01 2020-03-18 株式会社半導体エネルギー研究所 酸化物半導体膜の作製方法
CN106098699B (zh) * 2016-06-23 2019-04-05 京东方科技集团股份有限公司 一种阵列基板、其制作方法、显示面板及其制作方法
US10756118B2 (en) 2016-11-30 2020-08-25 Semiconductor Energy Laboratory Co., Ltd. Display device, display module, and electronic device
CN107818991B (zh) * 2017-10-23 2020-06-05 京东方科技集团股份有限公司 一种阵列基板及其制备方法、显示面板

Family Cites Families (155)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0695186B2 (ja) * 1986-03-05 1994-11-24 松下電器産業株式会社 薄膜トランジスタアレイ
JP2714016B2 (ja) * 1988-08-05 1998-02-16 株式会社東芝 表示装置
JPH05326953A (ja) * 1991-04-26 1993-12-10 Tonen Corp アクティブマトリックス型画像表示パネルの製造方法
JP3573778B2 (ja) * 1993-03-12 2004-10-06 株式会社東芝 液晶表示装置
DE69635107D1 (de) 1995-08-03 2005-09-29 Koninkl Philips Electronics Nv Halbleiteranordnung mit einem transparenten schaltungselement
JP3625598B2 (ja) * 1995-12-30 2005-03-02 三星電子株式会社 液晶表示装置の製造方法
JP4170454B2 (ja) 1998-07-24 2008-10-22 Hoya株式会社 透明導電性酸化物薄膜を有する物品及びその製造方法
JP2000101091A (ja) * 1998-09-28 2000-04-07 Sharp Corp 薄膜トランジスタ
JP2000150861A (ja) * 1998-11-16 2000-05-30 Tdk Corp 酸化物薄膜
JP3276930B2 (ja) * 1998-11-17 2002-04-22 科学技術振興事業団 トランジスタ及び半導体装置
JP2000231124A (ja) * 1999-02-12 2000-08-22 Sony Corp 電気光学装置、電気光学装置用の駆動基板、及びこれらの製造方法
TW460731B (en) 1999-09-03 2001-10-21 Ind Tech Res Inst Electrode structure and production method of wide viewing angle LCD
JP3882539B2 (ja) * 2000-07-18 2007-02-21 ソニー株式会社 半導体発光素子およびその製造方法、並びに画像表示装置
JP4089858B2 (ja) 2000-09-01 2008-05-28 国立大学法人東北大学 半導体デバイス
KR20020038482A (ko) * 2000-11-15 2002-05-23 모리시타 요이찌 박막 트랜지스터 어레이, 그 제조방법 및 그것을 이용한표시패널
JP3997731B2 (ja) * 2001-03-19 2007-10-24 富士ゼロックス株式会社 基材上に結晶性半導体薄膜を形成する方法
JP2002289859A (ja) 2001-03-23 2002-10-04 Minolta Co Ltd 薄膜トランジスタ
JP2003029293A (ja) 2001-07-13 2003-01-29 Minolta Co Ltd 積層型表示装置及びその製造方法
JP4090716B2 (ja) 2001-09-10 2008-05-28 雅司 川崎 薄膜トランジスタおよびマトリクス表示装置
JP3925839B2 (ja) 2001-09-10 2007-06-06 シャープ株式会社 半導体記憶装置およびその試験方法
JP4634673B2 (ja) * 2001-09-26 2011-02-16 シャープ株式会社 液晶表示装置及びその製造方法
US7061014B2 (en) * 2001-11-05 2006-06-13 Japan Science And Technology Agency Natural-superlattice homologous single crystal thin film, method for preparation thereof, and device using said single crystal thin film
JP4164562B2 (ja) 2002-09-11 2008-10-15 独立行政法人科学技術振興機構 ホモロガス薄膜を活性層として用いる透明薄膜電界効果型トランジスタ
JP4083486B2 (ja) * 2002-02-21 2008-04-30 独立行政法人科学技術振興機構 LnCuO(S,Se,Te)単結晶薄膜の製造方法
CN1445821A (zh) * 2002-03-15 2003-10-01 三洋电机株式会社 ZnO膜和ZnO半导体层的形成方法、半导体元件及其制造方法
JP3933591B2 (ja) * 2002-03-26 2007-06-20 淳二 城戸 有機エレクトロルミネッセント素子
US7339187B2 (en) 2002-05-21 2008-03-04 State Of Oregon Acting By And Through The Oregon State Board Of Higher Education On Behalf Of Oregon State University Transistor structures
JP2004022625A (ja) * 2002-06-13 2004-01-22 Murata Mfg Co Ltd 半導体デバイス及び該半導体デバイスの製造方法
US7105868B2 (en) * 2002-06-24 2006-09-12 Cermet, Inc. High-electron mobility transistor with zinc oxide
JP4183990B2 (ja) * 2002-07-11 2008-11-19 シャープ株式会社 薄膜フォトトランジスタ及びそれを用いたアクティブマトリクス基板並びにそれを用いた画像読み取り装置。
US7067843B2 (en) * 2002-10-11 2006-06-27 E. I. Du Pont De Nemours And Company Transparent oxide semiconductor thin film transistors
JP4166105B2 (ja) 2003-03-06 2008-10-15 シャープ株式会社 半導体装置およびその製造方法
JP2004273732A (ja) 2003-03-07 2004-09-30 Sharp Corp アクティブマトリクス基板およびその製造方法
JP4108633B2 (ja) 2003-06-20 2008-06-25 シャープ株式会社 薄膜トランジスタおよびその製造方法ならびに電子デバイス
US7262463B2 (en) * 2003-07-25 2007-08-28 Hewlett-Packard Development Company, L.P. Transistor including a deposited channel region having a doped portion
US7145174B2 (en) * 2004-03-12 2006-12-05 Hewlett-Packard Development Company, Lp. Semiconductor device
US7282782B2 (en) * 2004-03-12 2007-10-16 Hewlett-Packard Development Company, L.P. Combined binary oxide semiconductor device
US7297977B2 (en) 2004-03-12 2007-11-20 Hewlett-Packard Development Company, L.P. Semiconductor device
KR101019337B1 (ko) 2004-03-12 2011-03-07 도꾸리쯔교세이호징 가가꾸 기쥬쯔 신꼬 기꼬 아몰퍼스 산화물 및 박막 트랜지스터
WO2005102523A1 (en) * 2004-04-27 2005-11-03 Toyota Jidosha Kabushiki Kaisha Process for producing metal oxide particle and exhaust gas purifying catalyst
US7211825B2 (en) 2004-06-14 2007-05-01 Yi-Chi Shih Indium oxide-based thin film transistors and circuits
JP2006100760A (ja) * 2004-09-02 2006-04-13 Casio Comput Co Ltd 薄膜トランジスタおよびその製造方法
US7285501B2 (en) * 2004-09-17 2007-10-23 Hewlett-Packard Development Company, L.P. Method of forming a solution processed device
US7298084B2 (en) * 2004-11-02 2007-11-20 3M Innovative Properties Company Methods and displays utilizing integrated zinc oxide row and column drivers in conjunction with organic light emitting diodes
EP1812969B1 (en) * 2004-11-10 2015-05-06 Canon Kabushiki Kaisha Field effect transistor comprising an amorphous oxide
CA2585063C (en) * 2004-11-10 2013-01-15 Canon Kabushiki Kaisha Light-emitting device
US7829444B2 (en) * 2004-11-10 2010-11-09 Canon Kabushiki Kaisha Field effect transistor manufacturing method
US7863611B2 (en) * 2004-11-10 2011-01-04 Canon Kabushiki Kaisha Integrated circuits utilizing amorphous oxides
US7453065B2 (en) * 2004-11-10 2008-11-18 Canon Kabushiki Kaisha Sensor and image pickup device
US7791072B2 (en) * 2004-11-10 2010-09-07 Canon Kabushiki Kaisha Display
CA2585071A1 (en) * 2004-11-10 2006-05-18 Canon Kabushiki Kaisha Field effect transistor employing an amorphous oxide
US7579224B2 (en) * 2005-01-21 2009-08-25 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing a thin film semiconductor device
TWI445178B (zh) * 2005-01-28 2014-07-11 Semiconductor Energy Lab 半導體裝置,電子裝置,和半導體裝置的製造方法
TWI505473B (zh) * 2005-01-28 2015-10-21 Semiconductor Energy Lab 半導體裝置,電子裝置,和半導體裝置的製造方法
US7858451B2 (en) * 2005-02-03 2010-12-28 Semiconductor Energy Laboratory Co., Ltd. Electronic device, semiconductor device and manufacturing method thereof
US7948171B2 (en) * 2005-02-18 2011-05-24 Semiconductor Energy Laboratory Co., Ltd. Light emitting device
JP5117667B2 (ja) * 2005-02-28 2013-01-16 カシオ計算機株式会社 薄膜トランジスタパネル
US20060197092A1 (en) * 2005-03-03 2006-09-07 Randy Hoffman System and method for forming conductive material on a substrate
US8681077B2 (en) * 2005-03-18 2014-03-25 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, and display device, driving method and electronic apparatus thereof
WO2006105077A2 (en) * 2005-03-28 2006-10-05 Massachusetts Institute Of Technology Low voltage thin film transistor with high-k dielectric material
JP2005208678A (ja) * 2005-03-28 2005-08-04 Hitachi Ltd 液晶表示装置
US7645478B2 (en) * 2005-03-31 2010-01-12 3M Innovative Properties Company Methods of making displays
US8300031B2 (en) * 2005-04-20 2012-10-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device comprising transistor having gate and drain connected through a current-voltage conversion element
JP2006344849A (ja) 2005-06-10 2006-12-21 Casio Comput Co Ltd 薄膜トランジスタ
US7691666B2 (en) 2005-06-16 2010-04-06 Eastman Kodak Company Methods of making thin film transistors comprising zinc-oxide-based semiconductor materials and transistors made thereby
US7402506B2 (en) * 2005-06-16 2008-07-22 Eastman Kodak Company Methods of making thin film transistors comprising zinc-oxide-based semiconductor materials and transistors made thereby
US7507618B2 (en) 2005-06-27 2009-03-24 3M Innovative Properties Company Method for making electronic devices using metal oxide nanoparticles
KR100711890B1 (ko) * 2005-07-28 2007-04-25 삼성에스디아이 주식회사 유기 발광표시장치 및 그의 제조방법
JP2007059128A (ja) * 2005-08-23 2007-03-08 Canon Inc 有機el表示装置およびその製造方法
JP5116225B2 (ja) * 2005-09-06 2013-01-09 キヤノン株式会社 酸化物半導体デバイスの製造方法
JP4850457B2 (ja) 2005-09-06 2012-01-11 キヤノン株式会社 薄膜トランジスタ及び薄膜ダイオード
JP2007073705A (ja) * 2005-09-06 2007-03-22 Canon Inc 酸化物半導体チャネル薄膜トランジスタおよびその製造方法
JP4280736B2 (ja) * 2005-09-06 2009-06-17 キヤノン株式会社 半導体素子
KR100729043B1 (ko) 2005-09-14 2007-06-14 삼성에스디아이 주식회사 투명 박막 트랜지스터 및 그의 제조방법
JP5078246B2 (ja) * 2005-09-29 2012-11-21 株式会社半導体エネルギー研究所 半導体装置、及び半導体装置の作製方法
EP1770788A3 (en) * 2005-09-29 2011-09-21 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device having oxide semiconductor layer and manufacturing method thereof
JP5064747B2 (ja) 2005-09-29 2012-10-31 株式会社半導体エネルギー研究所 半導体装置、電気泳動表示装置、表示モジュール、電子機器、及び半導体装置の作製方法
JP5037808B2 (ja) * 2005-10-20 2012-10-03 キヤノン株式会社 アモルファス酸化物を用いた電界効果型トランジスタ、及び該トランジスタを用いた表示装置
JP5129473B2 (ja) 2005-11-15 2013-01-30 富士フイルム株式会社 放射線検出器
US7745798B2 (en) * 2005-11-15 2010-06-29 Fujifilm Corporation Dual-phosphor flat panel radiation detector
CN101577231B (zh) * 2005-11-15 2013-01-02 株式会社半导体能源研究所 半导体器件及其制造方法
JP2007157916A (ja) * 2005-12-02 2007-06-21 Idemitsu Kosan Co Ltd Tft基板及びtft基板の製造方法
KR100732849B1 (ko) 2005-12-21 2007-06-27 삼성에스디아이 주식회사 유기 발광 표시장치
JP5244295B2 (ja) * 2005-12-21 2013-07-24 出光興産株式会社 Tft基板及びtft基板の製造方法
TWI292281B (en) * 2005-12-29 2008-01-01 Ind Tech Res Inst Pixel structure of active organic light emitting diode and method of fabricating the same
US7867636B2 (en) * 2006-01-11 2011-01-11 Murata Manufacturing Co., Ltd. Transparent conductive film and method for manufacturing the same
JP4977478B2 (ja) * 2006-01-21 2012-07-18 三星電子株式会社 ZnOフィルム及びこれを用いたTFTの製造方法
US7576394B2 (en) * 2006-02-02 2009-08-18 Kochi Industrial Promotion Center Thin film transistor including low resistance conductive thin films and manufacturing method thereof
JP2007212699A (ja) * 2006-02-09 2007-08-23 Idemitsu Kosan Co Ltd 反射型tft基板及び反射型tft基板の製造方法
US7977169B2 (en) * 2006-02-15 2011-07-12 Kochi Industrial Promotion Center Semiconductor device including active layer made of zinc oxide with controlled orientations and manufacturing method thereof
JP2007250982A (ja) * 2006-03-17 2007-09-27 Canon Inc 酸化物半導体を用いた薄膜トランジスタ及び表示装置
US20070215945A1 (en) * 2006-03-20 2007-09-20 Canon Kabushiki Kaisha Light control device and display
KR20070101595A (ko) * 2006-04-11 2007-10-17 삼성전자주식회사 ZnO TFT
JP2007286150A (ja) * 2006-04-13 2007-11-01 Idemitsu Kosan Co Ltd 電気光学装置、並びに、電流制御用tft基板及びその製造方法
US20070252928A1 (en) 2006-04-28 2007-11-01 Toppan Printing Co., Ltd. Structure, transmission type liquid crystal display, reflection type display and manufacturing method thereof
JP5386069B2 (ja) * 2006-06-02 2014-01-15 株式会社半導体エネルギー研究所 半導体装置、表示装置、液晶表示装置、表示モジュール及び電子機器
JP5028033B2 (ja) 2006-06-13 2012-09-19 キヤノン株式会社 酸化物半導体膜のドライエッチング方法
US8013331B2 (en) * 2006-06-19 2011-09-06 Panasonic Corporation Thin film transistor, method of manufacturing the same, and electronic device using the same
US7906415B2 (en) * 2006-07-28 2011-03-15 Xerox Corporation Device having zinc oxide semiconductor and indium/zinc electrode
JP4999400B2 (ja) 2006-08-09 2012-08-15 キヤノン株式会社 酸化物半導体膜のドライエッチング方法
JP4609797B2 (ja) * 2006-08-09 2011-01-12 Nec液晶テクノロジー株式会社 薄膜デバイス及びその製造方法
US7833427B2 (en) * 2006-08-14 2010-11-16 Micron Technology, Inc. Electron beam etching device and method
JP4332545B2 (ja) * 2006-09-15 2009-09-16 キヤノン株式会社 電界効果型トランジスタ及びその製造方法
JP4274219B2 (ja) * 2006-09-27 2009-06-03 セイコーエプソン株式会社 電子デバイス、有機エレクトロルミネッセンス装置、有機薄膜半導体装置
JP5164357B2 (ja) * 2006-09-27 2013-03-21 キヤノン株式会社 半導体装置及び半導体装置の製造方法
JP2008112136A (ja) * 2006-10-04 2008-05-15 Mitsubishi Electric Corp 表示装置及びその製造方法
US7622371B2 (en) * 2006-10-10 2009-11-24 Hewlett-Packard Development Company, L.P. Fused nanocrystal thin film semiconductor and method
US7511343B2 (en) * 2006-10-12 2009-03-31 Xerox Corporation Thin film transistor
JP5090708B2 (ja) * 2006-10-20 2012-12-05 株式会社ジャパンディスプレイイースト 画像表示装置とその製造方法
US7772021B2 (en) * 2006-11-29 2010-08-10 Samsung Electronics Co., Ltd. Flat panel displays comprising a thin-film transistor having a semiconductive oxide in its channel and methods of fabricating the same for use in flat panel displays
JP2008140684A (ja) * 2006-12-04 2008-06-19 Toppan Printing Co Ltd カラーelディスプレイおよびその製造方法
KR101303578B1 (ko) * 2007-01-05 2013-09-09 삼성전자주식회사 박막 식각 방법
US8207063B2 (en) * 2007-01-26 2012-06-26 Eastman Kodak Company Process for atomic layer deposition
KR100851215B1 (ko) * 2007-03-14 2008-08-07 삼성에스디아이 주식회사 박막 트랜지스터 및 이를 이용한 유기 전계 발광표시장치
JP5244331B2 (ja) * 2007-03-26 2013-07-24 出光興産株式会社 非晶質酸化物半導体薄膜、その製造方法、薄膜トランジスタの製造方法、電界効果型トランジスタ、発光装置、表示装置及びスパッタリングターゲット
JP2008276212A (ja) * 2007-04-05 2008-11-13 Fujifilm Corp 有機電界発光表示装置
WO2008126879A1 (en) * 2007-04-09 2008-10-23 Canon Kabushiki Kaisha Light-emitting apparatus and production method thereof
JP5197058B2 (ja) * 2007-04-09 2013-05-15 キヤノン株式会社 発光装置とその作製方法
US7795613B2 (en) * 2007-04-17 2010-09-14 Toppan Printing Co., Ltd. Structure with transistor
KR101325053B1 (ko) 2007-04-18 2013-11-05 삼성디스플레이 주식회사 박막 트랜지스터 기판 및 이의 제조 방법
KR20080094300A (ko) 2007-04-19 2008-10-23 삼성전자주식회사 박막 트랜지스터 및 그 제조 방법과 박막 트랜지스터를포함하는 평판 디스플레이
KR101334181B1 (ko) * 2007-04-20 2013-11-28 삼성전자주식회사 선택적으로 결정화된 채널층을 갖는 박막 트랜지스터 및 그제조 방법
WO2008133345A1 (en) * 2007-04-25 2008-11-06 Canon Kabushiki Kaisha Oxynitride semiconductor
JP2009194351A (ja) * 2007-04-27 2009-08-27 Canon Inc 薄膜トランジスタおよびその製造方法
JPWO2008136505A1 (ja) * 2007-05-08 2010-07-29 出光興産株式会社 半導体デバイス及び薄膜トランジスタ、並びに、それらの製造方法
JP5542296B2 (ja) * 2007-05-17 2014-07-09 株式会社半導体エネルギー研究所 液晶表示装置、表示モジュール及び電子機器
US8803781B2 (en) * 2007-05-18 2014-08-12 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and display device
KR101345376B1 (ko) 2007-05-29 2013-12-24 삼성전자주식회사 ZnO 계 박막 트랜지스터 및 그 제조방법
US7935964B2 (en) * 2007-06-19 2011-05-03 Samsung Electronics Co., Ltd. Oxide semiconductors and thin film transistors comprising the same
KR101484297B1 (ko) * 2007-08-31 2015-01-19 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시장치 및 표시장치의 제작방법
JPWO2009034953A1 (ja) 2007-09-10 2010-12-24 出光興産株式会社 薄膜トランジスタ
JP2009099847A (ja) * 2007-10-18 2009-05-07 Canon Inc 薄膜トランジスタとその製造方法及び表示装置
JP2009099887A (ja) * 2007-10-19 2009-05-07 Hitachi Displays Ltd 表示装置
JP5357493B2 (ja) * 2007-10-23 2013-12-04 株式会社半導体エネルギー研究所 半導体装置の作製方法
TW200921226A (en) * 2007-11-06 2009-05-16 Wintek Corp Panel structure and manufacture method thereof
JP5215158B2 (ja) * 2007-12-17 2013-06-19 富士フイルム株式会社 無機結晶性配向膜及びその製造方法、半導体デバイス
US20100295042A1 (en) * 2008-01-23 2010-11-25 Idemitsu Kosan Co., Ltd. Field-effect transistor, method for manufacturing field-effect transistor, display device using field-effect transistor, and semiconductor device
JP5540517B2 (ja) 2008-02-22 2014-07-02 凸版印刷株式会社 画像表示装置
JP2009265271A (ja) 2008-04-23 2009-11-12 Nippon Shokubai Co Ltd 電気光学表示装置
KR101461127B1 (ko) * 2008-05-13 2014-11-14 삼성디스플레이 주식회사 반도체 장치 및 이의 제조 방법
US9041202B2 (en) 2008-05-16 2015-05-26 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method of the same
JP5602390B2 (ja) * 2008-08-19 2014-10-08 富士フイルム株式会社 薄膜トランジスタ、アクティブマトリクス基板、及び撮像装置
JP5451280B2 (ja) * 2008-10-09 2014-03-26 キヤノン株式会社 ウルツ鉱型結晶成長用基板およびその製造方法ならびに半導体装置
WO2011007675A1 (en) * 2009-07-17 2011-01-20 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
WO2011007677A1 (en) * 2009-07-17 2011-01-20 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
CN102751295B (zh) * 2009-07-18 2015-07-15 株式会社半导体能源研究所 半导体装置与用于制造半导体装置的方法
KR101870460B1 (ko) * 2009-07-18 2018-06-22 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제조 방법
WO2011010545A1 (en) * 2009-07-18 2011-01-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
KR101782176B1 (ko) * 2009-07-18 2017-09-26 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제조 방법
WO2011010542A1 (en) * 2009-07-23 2011-01-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
WO2011013522A1 (en) * 2009-07-31 2011-02-03 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
CN105448937A (zh) * 2009-09-16 2016-03-30 株式会社半导体能源研究所 晶体管及显示设备
KR101608923B1 (ko) * 2009-09-24 2016-04-04 가부시키가이샤 한도오따이 에네루기 켄큐쇼 산화물 반도체막 및 반도체 장치
CN105185837B (zh) * 2009-10-08 2018-08-03 株式会社半导体能源研究所 半导体器件、显示装置和电子电器
KR20230007544A (ko) * 2009-11-06 2023-01-12 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 그 제작 방법

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