JP5277533B2 - デジタル信号処理装置 - Google Patents
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Description
かかる発明によれば、複数のバンクが命令データを分担して処理するようにしたので、1つの命令データを処理する回路の規模を小さくし、命令データの処理のために発生する消費電力を減らすことができる。また、命令データの書き込みを行わないレジスタに対するクロックの供給を停止するようにしたので、さらに消費電力を低減することができる。
なお、特許文献1は、デジタル信号処理装置の省電力化のための技術として、データメモリをバンク分けし、アクセスを行わないバンクに対するクロックの供給を停止する技術を開示している。しかし、本発明は、このようにデータメモリをバンク分けするものではなく、命令データを処理する回路をバンク分けし、バンク単位で省電力化のための制御を行うものであり、特許文献1に開示の技術とは本質的に異なる。
図1はこの発明の一実施形態によるデジタル信号処理装置の構成を示すブロック図である。図1において、プログラムメモリ10は、例えばRAMにより構成されており、1または複数の命令を含むnビットの命令データ(nは複数)の集合体であるプログラムを記憶している。アドレスカウンタ11は、所定周波数のクロックCLKのカウントを行い、そのカウント値を読み出しアドレスとしてプログラムメモリ10に供給し、プログラムメモリ10から命令データを順次読み出す回路である。
a.プログラムメモリ10から読み出された命令データを処理するバンク0または1のレジスタ101にクロックCLK0またはCLK1を供給するためのクロックゲーティング制御回路40および41の制御
b.プログラムメモリ10から今回読み出された命令データの処理を行うバンクが前回読み出された命令データの処理を行ったバンクから切り換わっているときに、前回読み出された命令データの処理を行ったバンクのレジスタ101に記憶された命令データを無効化する制御
c.プログラムメモリ10から今回読み出された命令データの処理を行うバンクが前回読み出された命令データの処理を行ったバンクから切り換わっているときに、前回読み出された命令データの処理を行ったバンクのレジスタ101に対するクロックCLK0またはCLK1の供給を停止するためのクロックゲーティング制御回路40および41の制御
以上、この発明の一実施形態について説明したが、この発明には他にも実施形態があり得る。例えば上記実施形態では、バンクの数を2個としたが、バンクの数は3個以上であってもよい。なお、バンクの数を3個以上にする場合には、バンク指定情報として複数ビットを使用すればよい。また、上記実施形態では、レジスタ101にクリア信号を与えてレジスタ101の記憶内容を空にすることにより、レジスタ101に記憶された命令データの無効化を行ったが、レジスタ101の出力側にANDゲート等によるゲートを設け、このゲートにより命令データ処理部102への命令データの供給を遮断することで命令データの無効化を行うようにしてもよい。また、上記実施形態において、バンク0および1のレジスタ101として、クロック非同期型の記憶内容消去動作を行う構成のものを採用してもよい。その場合には、ORゲート35および36を省略し、クロックゲーティング制御回路40には信号E0のみを、クロックゲーティング制御回路41には信号E1のみを供給するようにすればよい。
Claims (2)
- 1または複数の命令からなる命令データを記憶するプログラムメモリと、
各々特定種類の命令データを分担して処理する複数の回路であり、各々レジスタを備え、各々のレジスタに記憶された命令データを処理して演算部を制御するための制御信号を発生する複数のバンクと、
複数のバンクの後段に位置する共通の演算部と、
前記プログラムメモリから読み出された命令データの処理を行うバンクを判定し、そのバンクのレジスタにクロックを供給して当該命令データを書き込み、命令データの書き込みを行わない他のバンクのレジスタへのクロックの供給の停止制御を行う命令データ振り分け部と、を備え、
前記複数のバンクの各々の前段には、各々の後段のバンクのレジスタにクロックを供給するか否かを切り換える複数のクロックゲーティング制御回路が配置され、
前記命令データ振り分け部は、前記プログラムメモリから読み出された命令データを処理するバンクのレジスタにクロックを供給するためのクロックゲーティング制御回路の制御を行い、前記プログラムメモリから今回読み出された命令データの処理を行うバンクが前回読み出された命令データの処理を行ったバンクから切り換わっているときには、前回読み出された命令データの処理を行ったバンクのレジスタに記憶された命令データを無効化する制御を行ったのち、前回読み出された命令データの処理を行ったバンクのレジスタに対するクロックの供給を停止するためのクロックゲーティング制御回路の制御を行う
ことを特徴とするデジタル信号処理装置。 - 前記命令データは、その処理を行うバンクを指定するバンク指定情報を含み、前記命令データ振り分け部は、前記プログラムメモリから読み出された命令データに含まれるバンク指定情報に基づき、当該命令データの処理を行うバンクを判定することを特徴とする請求項1に記載のデジタル信号処理装置。
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