JP5218758B2 - デジタル・オシロスコープ - Google Patents
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Description
本発明の第2態様は、第1態様において、マスク定義回路は;デジタル信号、高しきい値レベル信号及び低しきい値レベル信号を入力として受け、高データ及び低データを出力として発生するしきい値比較回路と;基準クロックから早いクロック及び遅いクロックを導出するクロック導出回路とを具え;高及び低しきい値レベルと、早い及び遅いクロックとが単位時間間隔内で矩形としてのマスクを定義する。
本発明の第3態様は、第2態様において、違反検出回路は;高データ、低データ、早いクロック及び遅いクロックを入力とし、出力として違反信号を発生する。
本発明の第4態様は、第3態様において、デジタル信号から導出したデータ信号を入力とし、基準クロックとしての回復クロックを出力するデータ/クロック回復回路を更に具えている。
本発明の第5態様は、第4態様において、データ/クロック回復回路は;違反検出回路の入力に供給される回復データ出力を有し、違反信号を供給する。
本発明の第6態様は、第2態様において、高及び低データから基準クロックを回復する回路を更に具える。
本発明の第7態様は、第3態様において、しきい値比較回路は;デジタル信号及び低しきい値を入力とし、出力として低データを発生する低比較器と;デジタル信号及び高しきい値を入力とし、出力として高データを発生する高比較器とを具えている。
本発明の第8態様は、第7態様において、状態判断回路は;低データを入力とする1対のラッチを具え、一方のラッチが早いクロックによりクロックされ、他方のラッチが遅いクロックによりクロックされて、マスクの2つの角の低データの状態を捕捉し;高データを入力とする1対のラッチを具え、一方のラッチが早いクロックでクロックされ、他方のラッチが遅いクロックでクロックされて、マスクの対向する2つの角の高データの状態を捕捉し、角でのラッチの状態がマスクに対するデジタル信号の状態を定める。
本発明の第9態様は、第8態様において、違反定義回路は;ラッチの出力を入力とし、ラッチの出力が互いに等しくないときに、違反信号を出力とする。
本発明の第10態様は、第9態様において、しきい値比較回路は;デジタル信号及び中間レベルしきい値を入力とし、データ信号を出力として発生する公称比較器を更に具える。
本発明の第11態様は、第10態様において、状態判断回路は;データ信号から導出した回復データを入力とし、基準クロックによりクロックされて、マスクの中心のデジタル信号の状態を捕捉する入力ラッチを更に具え、マスクの角及び中心でのデジタル信号の状態がマスクに対するデジタル信号の状態を定める。
本発明の第12態様は、第11態様において、違反検出回路は;各々がラッチの各1つからの出力を第1入力とし、入力ラッチからの回復データを第2入力とし、出力端を有する複数の排他的オア・ゲートと;これら排他的オア・ゲートの出力端に結合された入力端を有するオア・ゲートとを具え;排他的オア・ゲートからの出力の少なくとも1つが、少なくとも1つの排他的オア・ゲートの入力での不一致を示すとき、出力に違反信号が発生する。
本発明の第13態様は、第2態様において、違反検出回路は;反転高データをセット入力とし、早いクロックをリセット入力とする高ラッチを具え;デジタル信号が高しきい値に対して上から下に遷移したとき、又はデジタル信号が高しきい値の下になったときに、この高ラッチがセットされ;低データをセット入力とし、早いクロックをリセット入力とする低ラッチを更に具え;デジタル信号から低しきい値の下から上に遷移したとき、又はデジタル信号が低しきい値の上のときに、低ラッチがセットされ;遅いクロックが生じたときに低及び高ラッチの両方がセットされると、違反信号を発生する回路を更に具える。
本発明の第14態様は、第13態様において、違反信号を発生する回路は;高ラッチからの出力を入力とし、遅いクロックをクロック入力として、遅いクロックが生じたときに高ラッチの状態を捕捉する高出力ラッチと;低ラッチからの出力を入力とし、遅いクロックをクロック入力とし、遅いクロックが生じたときに低ラッチの状態を捕捉する低出力ラッチと;遅いクロックが生じたときに、高及び低出力ラッチの状態を組合せて、両方の出力ラッチの状態が高ならば違反信号を発生するロジックとを具えている。
本発明の第15態様は、第13態様において、違反信号を発生する回路は;高及び低ラッチからの出力を組合せて違反指示を発生するロジックと;遅いクロックによりクロックされ、違反指示を入力として、違反信号を出力として発生する出力ラッチとを具えている。
本発明の第16態様は、第1態様において、違反信号は、違反に関するデジタル信号からのデータを捕捉するためのトリガ信号であり;違反信号が示す違反の数を計数するカウンタを更に具える。
本発明の第17態様は、第16態様において、違反の数に関する時間を測定して、特定の期間内に生じる違反の数に関連するパラメータを決める時間測定回路を更に具える。
本発明の第18態様は、第17態様において、違反の数に関する時間を測定して、特定数の違反が生じる内の期間に関連するパラメータを決める時間測定回路を更に具える。
本発明の第19態様は、第1態様において、マスク定義回路は;各対が夫々の高しきい値及び低しきい値を有して、夫々高及び低データを発生する高/低が対の複数の比較器と具え;基準クロックから複数の早い及び遅いクロックを導出し、高及び低データを夫々早い及び遅いクロック対と組合せて、次元を異ならせる複数の矩形を発生し;矩形を組合せて、しきい値及びクロックが定めた任意の多角形形状を近似するマスクを発生するマスク組合せ回路を更に具える。
本発明の第21態様は、第20態様において、定義するステップは;デジタル信号から夫々高及び低しきい値に関連する高データ及び低データを求めるステップと;基準クロックから早いクロック及び遅いクロックを導出するステップとを具え;高及び低しきい値並びに早い及び遅いクロックがマスクとしての矩形を定義し;発生ステップは;高データ、低データ、早いクロック及び遅いクロックを組合せて、マスクに関連するデジタル信号の状態を作るステップと;状態がデジタル信号がマスクに交差していることを示すとき、違反信号を出力するステップとを具えている。
本発明の第23態様は、第22態様において、マスク定義回路は;デジタル信号、高しきい値レベル信号及び低しきい値レベル信号を入力として受け、高データ及び低データを出力として発生するしきい値比較回路と;基準クロックから早いクロック及び遅いクロックを導出するクロック導出回路とを具え;高及び低しきい値レベルと、早い及び遅いクロックとが単位時間間隔内で矩形としてのマスクを定義する。
本発明の第23態様は、第22態様において、違反検出回路は;高データ、低データ、早いクロック及び遅いクロックを入力とし、出力として違反信号を発生し;違反検出回路は、高データ、低データ、早いクロック、遅いクロックを入力とし、違反信号を出力する。
本発明の第24態様は、第23態様において、出力回路は、表示及びデータ出力ポートの一方である。
12 矩形マスク
14、16 電圧しきい値
18、20 時間値
30 アイ違反トリガ回路
32 比較器セクション
33、34、35 比較器(比較回路)
36 クロック/データ回復セクション(回路)
37 クロック回復回路
40、40’ アイ違反検出セクション
42、44 クロック位相/遅延回路
46 入力ラッチ
48、50、52、54 ラッチ
55 同等ゲート
56、58、60、62 排他的オア・ゲート
64 出力オア・ゲート
70、80 入力信号
72、74、76、78 角
92、94、96、98 セット/リセット・ラッチ
100 アンド・ゲート
Claims (1)
- デジタル信号のアイ違反を含む部分を表示用に取込むデジタル・オシロスコープであって、
被試験デジタル信号のサンプルを取り込む取込み回路と、
上記被試験デジタル信号の単位時間間隔内にマスク領域を定義するマスク定義回路と、
上記単位時間間隔の期間中に上記被試験デジタル信号が上記マスタ領域と交差するときに違反信号を発生するように、上記被試験デジタル信号を取込みながら、上記単位時間間隔内の上記被試験デジタル信号の上記部分中の上記アイ違反を検出する違反検出回路と、
上記被試験デジタル信号を表示する表示ユニットとを具え、
上記マスク定義回路が、上記被試験デジタル信号、高しきい値レベル信号及び低しきい値レベル信号を受けて、高データ及び低データを出力信号として供給するしきい値比較回路と、基準クロックから早いクロック及び遅いクロックを導出するクロック導出回路とを含み、上記高しきい値レベル信号及び上記低しきい値レベル信号並びに上記早いクロック及び上記遅いクロックによって、上記単位時間間隔内に矩形の上記マスク領域が定義され、
上記違反検出回路が、上記高データ及び上記低データ並びに上記早いクロック及び上記遅いクロックを入力として受けて、上記違反信号を出力し、該違反信号がトリガ信号となり、該トリガ信号によって、上記デジタル・オシロスコープが上記アイ違反に関連するデータを上記被試験デジタル信号から取り込んで処理し、上記表示ユニット上に表示することを特徴とするデジタル・オシロスコープ。
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